CN211426761U - 一种检测cvbs信号输入的电路 - Google Patents
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Abstract
本实用新型属于CVBS信号检测技术领域，尤其涉及一种检测CVBS信号输入的电路，包括第一三级管Q1和第二三极管Q2，CVBS信号CVBS‑IN通过第十电容C10和第十一电阻R11所组成的耦合电路进来之后，第二三极管Q2会导通，此时第一三级管Q1的射极和集极之间的电压差即e‑b极压降为0.7V,第一三级管Q1导通，第一三级管Q1的集极由0V变为3.3V,而第一三级管Q1的集极又连接到CPU的IO口，当此IO口检测到此高电平之后，即判断为CVBS信号有输入，通过电子方式来说检测CVBS信号相比传统的机械方式检测CVBS信号，更加精准，不会出现接触弹片接触不良判断不准的现象。
Description
技术领域
本实用新型属于CVBS信号检测技术领域，尤其涉及一种检测CVBS信号输入的电路。
背景技术
传统的CVBS检测电路，如说明书附图2所示，采用机械的方式，平时当耳机头没有插入时，弹片4和弹片5是接触的，CVBS DETECT信号为低电平，当耳机线插入时，弹片4和弹片5分离，此时CVBS DETECT信号变为高电平，当CPU的IO口检测到此电平由低变高时，即判断有CVBS信号输入。
另一方面，长时间使用，弹片容易氧化，信号插头插入会造成接触不良，检测不稳定，经常拔插时弹片容易变形，会影响弹片寿命，导致检测不准确。
实用新型内容
为克服上述技术中全部或部分的缺陷，本实用新型提出一种检测CVBS信号输入的电路，是通过如下技术方案实现的。
一种检测CVBS信号输入的电路，包括第一三级管Q1和第二三极管Q2，其中CVBS信号经串接在一起的第十电容C10和第十一电阻R11所组成的耦合电路接入第二三极管Q2的基极，第二三极管Q2的射极经第十八电阻R18接地，第二三极管Q2的集极经起上拉作用的第十五电阻R15连接VDD-VLCM电源，并且第二三极管Q2的集极依次经反向连接的第一二极管D1和第十四电阻R14与第一三级管Q1的基极连接在一起，第一三级管Q1的射极连接VDD-VLCM电源，第一三级管Q1的集极经第十六电阻R16接地，并且第一三级管Q1的射极和基极之间连接起上拉作用的第十九电阻R19，第一三级管Q1的射极引出CVBS检测信号，用以与CPU的IO口相连接。
作为本实用新型一种检测CVBS信号输入的电路的进一步改进，所述第二三极管Q2为NPN型三极管，第一三级管Q1为PNP型三极管。
作为本实用新型一种检测CVBS信号输入的电路的进一步改进，所述第二三极管Q2的型号为2N3904，第一三级管Q1的型号为2N3906。
作为本实用新型一种检测CVBS信号输入的电路的进一步改进，所述第一三级管Q1的集极还经第六电容C6接地，第二三极管Q2的射极还经第七电容C7接地。
作为本实用新型一种检测CVBS信号输入的电路的进一步改进，所述第二三极管Q2的基极与集极之间还连接并联在一起的第二电容C2和第二十五电阻R25。
作为本实用新型一种检测CVBS信号输入的电路的进一步改进，所述第一二极管D1和第十四电阻R14之间连接接地的第四电容C4。
该实用新型一种检测CVBS信号输入的电路的有益效果，通过电子的方式，即利用三极管检测CVBS信号替代传统的机械弹片式检测CVBS信号，不会出现接触不良的现象，使检测更加准确。
附图说明
图1为本实用新型检测CVBS信号的电路图；
图2为现有技术检测CVBS信号的电路图；
具体实施方式
下面将结合本实用新型实施例中的附图，对本实用新型实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本实用新型一部分实施例，而不是全部的实施例。基于本实用新型中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本实用新型保护的范围。
该实用新型提供的一种检测CVBS信号输入的电路，主要通过用一级NPN三极管和一级PNP三极管线路来检测是否有CVBS信号输入，如说明书附图1所示，CVBS信号CVBS-IN经第十电容C10和第十一电阻R11所组成的耦合电路接入第二三极管Q2的基极，第二三极管Q2即为上述的一级NPN三极管，此处型号为2N3904，第二三极管Q2的射极经起负载作用的第十八电阻R18接地，以及经起滤波作用的第七电容C7接地，第二三极管Q2的集极经起上拉作用的第十五电阻R15连接VDD-VLCM电源，并且第二三极管Q2的集极和基极之间还连接并联在一起起滤波作用的第二电容C2和第二十五电阻R25，同时第二三极管Q2的集极依次经反向连接的第一二极管D1和第十四电阻R14与第一三级管Q1的基极连接在一起，并且第一二极管D1和第十四电阻R14之间连接接地的第四电容C4接地，其中第一二极管D1起信号隔离的作用，第一三级管Q1即为上述的一级PNP三极管，此处型号为2N3906，第一三级管Q1的的射极连接VDD-VLCM电源，第一三级管Q1的集极经起负载作用的第十六电阻R16接地，以及经起滤波作用的第六电容C6接地，并且第一三级管Q1的射极和基极之间连接起上拉作用的第十九电阻R19，同时第一三级管Q1的射极引出CVBS检测信号GPIO1-CVBS-DET，用以与单片机的IO口相连接。
则CVBS信号CVBS-IN通过第十电容C10和第十一电阻R11所组成的耦合电路进来之后，第二三极管Q2会导通，此时第一三级管Q1的射极和集极之间的电压差即e-b极压降为0.7V,第一三级管Q1导通，第一三级管Q1的集极由0V变为3.3V,而第一三级管Q1的集极又连接到CPU的IO口，当此IO口检测到此高电平之后，即判断为CVBS信号有输入。可见通过电子方式来说检测CVBS信号相比传统的机械方式检测CVBS信号，更加精准，不会出现接触弹片接触不良判断不准的现象。
其以上所述，仅是本实用新型的较佳实施例而已，并非对本实用新型作任何形式上的限制，虽然本实用新型已以较佳实施例揭露如上，然而并非用以限定本实用新型，任何熟悉本专业的技术人员，在不脱离本实用新型技术方案范围内，当可利用上述揭示的技术内容作出些许更动或修饰为等同变化的等效实施例，但凡是未脱离本实用新型技术方案内容，依据本实用新型的技术实质对以上实施例所作的任何简单修改、等同变化与修饰，均仍属于本实用新型技术方案的范围内。
Claims (6)
1.一种检测CVBS信号输入的电路，其特征在于：包括第一三级管Q1和第二三极管Q2，其中CVBS信号经串接在一起的第十电容C10和第十一电阻R11所组成的耦合电路接入第二三极管Q2的基极，第二三极管Q2的射极经第十八电阻R18接地，第二三极管Q2的集极经起上拉作用的第十五电阻R15连接VDD-VLCM电源，并且第二三极管Q2的集极依次经反向连接的第一二极管D1和第十四电阻R14与第一三级管Q1的基极连接在一起，第一三级管Q1的射极连接VDD-VLCM电源，第一三级管Q1的集极经第十六电阻R16接地，并且第一三级管Q1的射极和基极之间连接起上拉作用的第十九电阻R19，第一三级管Q1的射极引出CVBS检测信号，用以与CPU的IO口相连接。
2.根据权利要求1所述的一种检测CVBS信号输入的电路，其特征在于：所述第二三极管Q2为NPN型三极管，第一三级管Q1为PNP型三极管。
3.根据权利要求2所述的一种检测CVBS信号输入的电路，其特征在于：所述第二三极管Q2的型号为2N3904，第一三级管Q1的型号为2N3906。
4.根据权利要求1所述的一种检测CVBS信号输入的电路，其特征在于：所述第一三级管Q1的集极还经第六电容C6接地，第二三极管Q2的射极还经第七电容C7接地。
5.根据权利要求1所述的一种检测CVBS信号输入的电路，其特征在于：所述第二三极管Q2的基极与集极之间还连接并联在一起的第二电容C2和第二十五电阻R25。
6.根据权利要求1所述的一种检测CVBS信号输入的电路，其特征在于：所述第一二极管D1和第十四电阻R14之间连接接地的第四电容C4。
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2019
- 2019-11-27 CN CN201922081090.2U patent/CN211426761U/zh active Active
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