CN209017167U - 一种视频信号生成装置 - Google Patents
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Abstract
一种视频信号生成装置，属于电子技术领域，其特征在于：包括FPGA主控模块、CameraLink编码模块、PCIe通信模块和电源模块；所述FPGA主控模块包括FPGA、存储模块、晶振和通信接口；所述存储模块、晶振和通信接口均与FPGA相电连接；所述PCIe通信模块设置有PCIe接口；所述CameraLink编码模块和电源模块均与FPGA相电连接；所述PCIe通信模块通过PCIe接口与FPGA相电连接。通过FPGA产生CameraLink输出视频，充分利用FPGA的现场可编程特性，用于多种CameraLink信号处理设备的调试和仿真，显著提高CameraLink开发调试的灵活性，降低开发成本。
Description
技术领域
本实用新型属于电子技术领域，尤其涉及一种视频信号生成装置。
背景技术
CameraLink接口是数字图像接口。目前在图像采集、安防监控和工业生产等领域大量使用，基于CameraLink接口的图像处理产品种类繁多。由于CameraLink没有标准的通信规范，各厂家的不同产品虽均采用CameraLink接口，但在传输时序和定义上存在差异，造成不同产品间的兼容性不高。CameraLink接口的产品主要包括图像采集前端的摄像头和图像处理后端的图像处理设备。在这两种产品的开发阶段，均需要对端设备进行联调和验证。在产品使用阶段，两种产品由于兼容性问题往往不能更换对端产品型号。若需要更换其中一端的产品型号，往往需要对端产品进行更换或修改。
针对CameraLink摄像头的联调和验证，市面上存在CameraLink图像采集卡。这种采集卡功能丰富，可支持多种分辨率和帧频，并提供摄像头的参数控制。对于CameraLink图像处理设备，市面上尚没有很好的联调和验证设备；当更换摄像头型号时，往往带来图像处理设备的更改。在更改的过程中，需要多种参数的调整和验证，这就需要一种参数可灵活调整的视频信号生成装置。
发明内容
本实用新型旨在解决上述问题，提供一种参数可灵活调整的视频信号生成装置。
本实用新型所述视频信号生成装置，包括FPGA主控模块、CameraLink编码模块、PCIe通信模块和电源模块；所述FPGA主控模块包括FPGA、存储模块、晶振和通信接口；所述存储模块、晶振和通信接口均与FPGA相电连接；所述PCIe通信模块设置有PCIe接口；所述CameraLink编码模块和电源模块均与FPGA相电连接；所述PCIe通信模块通过PCIe接口与FPGA相电连接。
本实用新型所述视频信号生成装置，所述存储模块包括NOR FLASH 和DDR IIISDRAM；所述DDR III SDRAM设置有两个；所述NOR FLASH 设置有QSPI接口；NOR FLASH用于存储工作代码、DDR III SDRAM用于运行缓存。
本实用新型所述视频信号生成装置，所述通信接口包括JPTG接口，JPTG接口用于调试。
本实用新型所述视频信号生成装置，所述编码模块由LVDS串行器模块组成。
本实用新型所述视频信号生成装置，所述电源模块包括若干个并列设置的DC/DC芯片；电源模块将输入的电源降压为视频信号发生装置内部需要的各种低压电源，供各模块电路工作使用。若干个DC/DC处于平级关系，分别从同一电压源取电后生成不同电压输出。
本实用新型所述视频信号生成装置，所述电源模块包括四个LTM4623芯片和一个TPS51100芯片。
本实用新型所述视频信号生成装置，所述四个LTM4623芯片的输出电压分别为3.3V、1.0V、1.2V、和1.5V；所述TPS51100芯片的输出电压为0.75V。
本实用新型所述视频信号生成装置的生成方法，将需要显示的视频内容及控制命令通过PCIe通信模块的PCIe接口传输至FPGA，FPGA主控模块对视频内容进行缓存后通过FPGA根据控制命令对视频内容中的图像进行图像调制处理，再通过CameraLink编码模块进行串行处理后输出。
本实用新型所述视频信号生成装置的生成方法，所述图像调制处理包括图像缩放、DDR缓存、图像锐化、色彩空间转换、图像叠加、帧频变换和分辨率设置。
本实用新型所述视频信号生成装置的生成方法，所述出串行处理为将28位并行数据信号转换为LVDS差分信号。
本实用新型所述视频信号生成装置及方法，包括FPGA主控模块、CameraLink编码模块、PCIe通信模块和电源模块；所述FPGA主控模块包括FPGA、存储模块、晶振和通信接口；所述存储模块、晶振和通信接口均与FPGA相电连接；通过FPGA产生CameraLink输出视频，充分利用FPGA的现场可编程特性，显著提高CameraLink开发调试的灵活性，降低开发成本。
附图说明
图1为本实用新型所述视频信号生成装置的结构示意框图；
图2为本实用新型视频信号生成方法的流程示意图；
图3为本实用新型所述视频信号生成装置的CameraLink编码模块结构示意图；
图4为本实用新型所述视频信号生成装置PCIe通信模块结构示意图；
图5为本实用新型所述视频信号生成装置电源模块结构示意图。
具体实施方式
下面通过实施例对本实用新型所述视频信号生成装置进行详细说明。
实施例一
本实用新型所述视频信号生成装置，如图1所示，包括FPGA主控模块、CameraLink编码模块、PCIe通信模块和电源模块；所述FPGA主控模块包括FPGA、存储模块、晶振和通信接口；所述存储模块、晶振和通信接口均与FPGA相电连接；所述PCIe通信模块设置有PCIe接口；所述CameraLink编码模块和电源模块均与FPGA相电连接；所述PCIe通信模块通过PCIe接口与FPGA相电连接。所述存储模块包括NOR FLASH 和DDR III SDRAM；所述DDR IIISDRAM设置有两个；所述NOR FLASH 设置有QSPI接口；NOR FLASH用于存储工作代码、DDRIII SDRAM用于运行缓存。所述通信接口包括JPTG接口，JPTG接口用于调试。
本实用新型所述视频信号生成装置，如图3所示，所述CameraLink编码模块由LVDS串行器模块组成。如图5所示，所述电源模块包括五个并列设置的DC/DC芯片；包括四个LTM4623芯片和一个TPS51100芯片，电源模块将输入的电源降压为视频信号发生装置内部需要的各种低压电源，供各模块电路工作使用。四个LTM4623芯片的输出电压分别为3.3V、1.0V、1.2V、和1.5V；所述TPS51100芯片的输出电压为0.75V；输入为PCIe接口的12V电源。
在本实施例中，FPGA根据消耗IO管脚数选择XC7A100T-FGG676型号，FPGA主控模块接收连接各功能模块，主要完成数字图像处理，包括图像缩放、DDR缓存、图像锐化、色彩空间转换、图像叠加、帧频变换、分辨率设置等。CameraLink编码模块主要功能是将FPGA输出的并行28位数据串行处理为符合CameraLink传输规范的差分LVDS信号。PCIe通信模块主要完成视频信号发生器与PC主机间的数据通信，通信内容包括显示图像和控制命令等。电源模块将从PC主机输入的电源降压为视频信号发生器内部需要的各种低压电源，供各模块电路工作使用。PCIe接口的金手指部分，可直接对插在PC主机的PCIe插槽内，如图4所示，以X1速率的PCIe通信为例，可根据使用环境扩展至PCIe的X16速率通信。PC主机通过金手指接口为视频信号生成装置提供通信和供电。
FPGA主控模块由FPGA、QSPI接口的NOR FLASH、DDR3 SDRAM、晶振和JTAG接口等组成。FPGA包含了8对高速口，外挂两片美光公司的型号为MT41K256M16HA-125IT:E 的DDR3SDRAM作为图像的缓存，容量为512MB，两片共1GB，时钟频率高达667MHz，满足FPGA运算处理过程中的数据缓冲需求。在数据处理中，两片缓存做乒乓操作，保证数据正常通信。FPGA配置ROM采用QSPI接口的NOR FALSH芯片，型号为W25Q128FV，工作电压3.3V，直接与FPGA连接。
如图3所示，CameraLink编码模块主要由LVDS串行器DS90CR287芯片组成，将FPGA输出的28位3.3V并行数据信号转换为LVDS差分信号，编码的数据位符合CameraLink传输规范。输出连接器为CameraLink标准接插件MDR26。
如图4所示，PCIe通信模块采用PCIe桥芯片来实现视频信号发生器与PC主机间的通信，完成视频数据传输。在本实施例中PCIe桥芯片型号选用PEX8311。设计PCIe使用X1连接，该芯片每方向速度可达2.5Gbps。
实施例二
在实施例一的基础上，本实用新型所述视频信号生成装置的生成方法，如图2所示，将需要显示的视频内容及控制命令通过PCIe通信模块的PCIe接口传输至FPGA，FPGA主控模块对视频内容进行缓存后通过FPGA根据控制命令对视频内容中的图像进行图像调制处理，再通过CameraLink编码模块进行串行处理后输出。所述图像调制处理包括图像缩放、DDR缓存、图像锐化、色彩空间转换、图像叠加、帧频变换和分辨率设置。所述出串行处理为将28位并行数据信号转换为LVDS差分信号。
PC主机通过上位机内的软件产生需要显示的视频；视频内容通过PCIe接口通信至视频信号发生器的FPGA，FPGA进行图像缓存、图形变换、叠加强化等处理后，通过CameraLink视频接口进行输出显示。FPGA可产生自定义的输出时序，因此产生不同帧频和分辨率的视频信号。
本实用新型所述视频信号生成装置采用模块化设计，配合简单的结构外壳可形成功能丰富的视频信号源，用于多种CameraLink信号处理设备的调试和仿真，具有极高的灵活性。
Claims (7)
1.一种视频信号生成装置，其特征在于：包括FPGA主控模块、CameraLink编码模块、PCIe通信模块和电源模块；所述FPGA主控模块包括FPGA、存储模块、晶振和通信接口；所述存储模块、晶振和通信接口均与FPGA相电连接；所述PCIe通信模块设置有PCIe接口；所述CameraLink编码模块和电源模块均与FPGA相电连接；所述PCIe通信模块通过PCIe接口与FPGA相电连接。
2. 根据权利要求1所述视频信号生成装置，其特征在于：所述存储模块包括NOR FLASH和DDR III SDRAM；所述DDR III SDRAM设置有两个；所述NOR FLASH 设置有QSPI接口。
3.根据权利要求2所述视频信号生成装置，其特征在于：所述通信接口包括JPTG接口。
4.根据权利要求3所述视频信号生成装置，其特征在于：所述编码模块由LVDS串行器模块组成。
5.根据权利要求4所述视频信号生成装置，其特征在于：所述电源模块包括若干个并列设置的DC/DC芯片。
6.根据权利要求5所述视频信号生成装置，其特征在于：所述电源模块包括四个LTM4623芯片和一个TPS51100芯片。
7.根据权利要求6所述视频信号生成装置，其特征在于：所述四个LTM4623芯片的输出电压分别为3.3V、1.0V、1.2V、和1.5V；所述TPS51100芯片的输出电压为0.75V。
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| CN109413339A (zh) * | 2018-12-27 | 2019-03-01 | 西安奇维科技有限公司 | 一种视频信号生成装置及方法 |
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