CN203775239U - 一种阻抗匹配的t型拓扑电路 - Google Patents
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Abstract
本实用新型公开了一种阻抗匹配的T型拓扑电路,包括信号发送端11、第一接收端和第二接收端，所述信号发送端11连接有第一传输线，所述第一接收端连接有第二传输线，所述第二接收端连接有第三传输线，所述第一传输线、第二传输线和第三传输线在节点处汇聚连接形成T型结构，所述第一传输线上串联有阻抗匹配电阻。本实用新型通过在T型拓扑电路中串入阻抗能够做到信号在T型拓扑结构节点前后阻抗的完全匹配，理想情况下不会发生任何反射，可以有效提高信号传输质量。本实用新型可广泛应用于各种T型拓扑电路。
Description
技术领域
本实用新型涉及电子电路领域，尤其涉及一种T型拓扑电路。
背景技术
T型拓扑电路：指三个电抗元件（如传输线）结成“T”型结构的电路。
进入21世纪以来，电子产品的时钟频率越来越高,传输的信号速率也越来越快,信号完整性问题越来越突出,而设计人员用于解决信号完整性问题及用于设计新产品的时间却越来越短，如何快速有效地解决信号完整性问题是设计工程师需要面对的难题。而解决信号完整性问题的关键在于如何做到阻抗匹配，也就是如何能够尽可能的减小由于阻抗不匹配引起的反射的问题。
当信号在传输线中传播时，信号所感受到的瞬态阻抗发生变化，部分信号将沿着与原传播方向相反的方向反射回信号源，这种现象称作反射。
目前，有许许多多的信号需要走T型拓扑结构，如图1所示，而信号在经过T型拓扑结构节点时由于阻抗减半会发生反射，如何完成T型拓扑结构的阻抗匹配就显得非常重要了。
实用新型内容
为了解决上述技术问题，本实用新型的目的是提供一种可以方便实现阻抗匹配、结构简单的T型拓扑电路。
本实用新型所采用的技术方案是：
一种阻抗匹配的T型拓扑电路,包括信号发送端、第一接收端和第二接收端，所述信号发送端连接有第一传输线，所述第一接收端连接有第二传输线，所述第二接收端连接有第三传输线，所述第一传输线、第二传输线和第三传输线在节点处汇聚连接形成T型结构，所述第一传输线上串联有阻抗匹配电阻。
优选的，所述第一传输线、第二传输线和第三传输线的阻抗相等，所述阻抗匹配电阻的阻值为各传输线阻抗的二分之一。
优选的，所述第一传输线、第二传输线和第三传输线的阻抗均为50欧，所述阻抗匹配电阻的阻值为25欧。
本实用新型的有益效果是：
本实用新型通过在T型拓扑电路中串入阻抗能够做到信号在T型拓扑结构节点前后阻抗的完全匹配，理想情况下不会发生任何反射，可以有效提高信号传输质量。
另外，串入匹配电阻使得该匹配方案避免增加拓扑结构的旁路分支，不会对信号质量产生负面影响；由于信号的高频分量的衰减速率远高于低频分量，因此在链路中串入一个电阻会使得高频分量衰减，改善信号质量，降低电磁干扰。
本实用新型可广泛应用于各种T型拓扑电路。
附图说明
下面结合附图对本实用新型的具体实施方式作进一步说明：
图1是本实用新型一种实施例的电路结构示意图。
具体实施方式
需要说明的是，在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互组合。
如图1所示，一种阻抗匹配的T型拓扑电路,包括信号发送端11、第一接收端12和第二接收端13，所述信号发送端11连接有第一传输线21，所述第一接收端12连接有第二传输线22，所述第二接收端13连接有第三传输线23，所述第一传输线21、第二传输线22和第三传输线23在节点31处汇聚连接形成T型结构，所述第一传输线21上串联有阻抗匹配电阻41。
本实施例中，所述第一传输线21、第二传输线22和第三传输线23的阻抗相等，所述阻抗匹配电阻41的阻值为各传输线阻抗的二分之一。所述第一传输线21、第二传输线22和第三传输线23的阻抗均为50欧，所述阻抗匹配电阻41的阻值为25欧。
下面详述本实用新型的工作原理。信号由信号发送端11发出，走T型拓扑结构分别到达第一接收端12和第二接收端13，该实施例中信号经过第一传输线21、第二传输线22和第三传输线23的阻抗均为50欧。在不做匹配的情况下，信号经过第一传输线21后到达T型拓扑结构的节点31时感受到的阻抗是第二传输线22和第三传输线23并联后的阻抗，两个50欧姆传输线并联后的阻抗25欧姆，信号感受到的阻抗由50欧姆变为25欧姆，阻抗不匹配从而发生反射。由于电阻为集总元器件，通常认为信号经过电阻不需要时间，这里在第一传输线21靠近T型拓扑结构节的位置串入一个25欧姆的阻抗匹配电阻41。当信号将要经过电阻时，信号感受到的阻抗是该25欧姆电阻和两个50欧姆传输线并联后的阻抗的串联，因此此时信号感受到的阻抗为50欧姆，信号在经过第一传输线21和经过T型拓扑结构节点31时感受到的阻抗未发生变化，这样就解决了阻抗失配的问题。
本实用新型通过在T型拓扑电路中串入阻抗能够做到信号在T型拓扑结构节点31前后阻抗的完全匹配，理想情况下不会发生任何反射，可以有效提高信号传输质量。另外，相对于在T型拓扑结构的第一输入线并入带有匹配电阻的支路的技术方案，串入匹配电阻使得该匹配方案避免增加拓扑结构的旁路分支，不会对信号质量产生负面影响。而且由于信号的高频分量的衰减速率远高于低频分量，因此在链路中串入一个电阻会使得高频分量衰减，改善信号质量，降低电磁干扰。
以上是对本实用新型的较佳实施进行了具体说明，但本发明创造并不限于所述实施例，熟悉本领域的技术人员在不违背本实用新型精神的前提下还可做作出种种的等同变形或替换，这些等同的变形或替换均包含在本申请权利要求所限定的范围内。
Claims (4)
1.一种阻抗匹配的T型拓扑电路,其特征在于：包括信号发送端、第一接收端和第二接收端，所述信号发送端连接有第一传输线，所述第一接收端连接有第二传输线，所述第二接收端连接有第三传输线，所述第一传输线、第二传输线和第三传输线在节点处汇聚连接形成T型结构，所述第一传输线上串联有阻抗匹配电阻。
2.根据权利要求1所述的一种阻抗匹配的T型拓扑电路，其特征在于：所述第一传输线、第二传输线和第三传输线的阻抗相等，所述阻抗匹配电阻的阻值为各传输线阻抗的二分之一。
3.根据权利要求1所述的一种阻抗匹配的T型拓扑电路，其特征在于：所述第一传输线、第二传输线和第三传输线的阻抗均为50欧，所述阻抗匹配电阻的阻值为25欧。
4.根据权利要求1所述的一种阻抗匹配的T型拓扑电路，其特征在于：所述阻抗匹配电阻设置在靠近节点的位置。
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|---|---|---|---|
| CN201420051799.2U CN203775239U (zh) | 2014-01-26 | 2014-01-26 | 一种阻抗匹配的t型拓扑电路 |
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Publications (1)
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| CN201420051799.2U Expired - Lifetime CN203775239U (zh) | 2014-01-26 | 2014-01-26 | 一种阻抗匹配的t型拓扑电路 |
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Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN113316319A (zh) * | 2021-05-08 | 2021-08-27 | 珠海全志科技股份有限公司 | 智能设备、可读存储介质、印刷电路板及其使用方法 |
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2014
- 2014-01-26 CN CN201420051799.2U patent/CN203775239U/zh not_active Expired - Lifetime
Cited By (2)
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| CN113316319A (zh) * | 2021-05-08 | 2021-08-27 | 珠海全志科技股份有限公司 | 智能设备、可读存储介质、印刷电路板及其使用方法 |
| CN113316319B (zh) * | 2021-05-08 | 2022-11-11 | 珠海全志科技股份有限公司 | 智能设备、可读存储介质、印刷电路板及其使用方法 |
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