CN203149574U - 集成电路芯片内模块间单线总线数据传输电路 - Google Patents
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Abstract
本实用新型具体涉及集成电路芯片内模块间单线总线数据传输电路。解决现有集成电路的芯片内各个模块间通过多线总线进行数据传输造成布线资源增多,设计的灵活性差,增加了人力物力成本的问题。该电路,主要包括霍夫曼编码器和发送寄存器、采集寄存器和霍夫曼解码器。本实用新型占用最少的布线资源;传输方式灵活,可以随时发送和接收数据;传输协议简单,无需复杂的帧结构和打包设计,电路结构简单易实现,硬件无特殊要求。
Description
技术领域
本实用新型涉及集成电路芯片领域,具体涉及集成电路芯片内模块间单线总线数据传输电路。
背景技术
在集成电路的后端版图设计中,布线资源极其重要和有限,少的走线意味着设计的灵活性和低人力物力成本。现有集成电路的芯片内各个模块间的数据传输是通过多线总线传输实现的,多线传输必然会造成布线资源增多,设计的灵活性差,增加了人力物力成本。
发明内容
本实用新型的目的在于:提供一种用最少的布线资源实现集成电路芯片内部电路模块之间的数据传输的电路,解决现有集成电路的芯片内各个模块间通过多线总线进行数据传输造成布线资源增多,设计的灵活性差,增加人力物力成本的问题。
本实用新型的技术解决方案是:
集成电路芯片内模块间单线总线数据传输电路,包括发送端数据缓存单元和接收端数据缓存单元,其特殊之处在于,该电路还包括霍夫曼编码器和发送寄存器、采集寄存器和霍夫曼解码器;
所述霍夫曼编码器的输入端与发送端数据缓存单元连接,霍夫曼编码器的输出端与发送寄存器的输入端连接;所述霍夫曼解码器的输出端与接收端数据缓存单元连接,霍夫曼解码器的输入端与采集寄存器的输出端连接,所述发送寄存器和采集寄存器之间通过单线总线进行连接。
上述单线总线的输出端连接一个或并联有多个采集寄存器。
上述霍夫曼编码器和/或发送寄存器设置在发送端数据缓存单元所在的模块内。
上述采集寄存器和/或霍夫曼解码器设置在接收端数据缓存单元所在的模块内。
本实用新型的优点在于:
1、单线总线占用最少的布线资源;
2、传输方式灵活,可以随时发送和接收数据;例如,发送端的待发数据可以采取循环滚动或者多次重复等方式进行发送,接收端可以随时获取单线总线上的信息;
3、传输协议简单,无需复杂的帧结构和打包设计,电路结构简单易实现,硬件无特殊要求。
附图说明
图1为本实用新型电路结构图。
具体实施方式
集成电路芯片内模块间单线总线数据传输方法,包括以下步骤:
(1)将芯片上模块内的待发送数据(一般存储在模块内的数据缓存单元data fifo内)进行霍夫曼编码,霍夫曼编码由霍夫曼编码器(huffman encoder)实现,将编码好的数据存储在发送寄存器(tDFF);
(2)发送寄存器(tDFF)中存储的数据通过单线总线以比特流(bit-stream)的方式发送至待接收数据的模块内的采集寄存器(rDFF)内,比特流中有霍夫曼编码的特征,霍夫曼解码器(huffman decoder)对接收到的数据进行霍夫曼解码,根据霍夫曼编码的特征,由霍夫曼解码器判定数据的起始或结束位置以及比特流的数据内容,提取有效数据后存储于待接收数据的模块内的数据缓存单元data fifo。
同一个发送寄存器发送的数据可以被传送至一个或多个连在同一单线总线上的采集寄存器,保证发送寄存器的时钟频率等于每一个采集寄存器的时钟频率。
集成电路芯片内模块间单线总线数据传输电路,包括发送端数据缓存单元和接收端数据缓存单元,还包括设置在发送端数据缓存单元所在模块内的霍夫曼编码器和发送寄存器,以及设置在接收端数据缓存单元所在模块内的采集寄存器和霍夫曼解码器;
霍夫曼编码器的输入端与发送端数据缓存单元连接,发送寄存器的输入端与霍夫曼编码器的输出端连接;所述霍夫曼解码器的输出端与接收端数据缓存单元连接,采集寄存器的输出端与霍夫曼解码器的输入端连接,所述发送寄存器和采集寄存器之间通过单线总线进行连接。
单线总线的输出端可以连接一个或并联多个采集寄存器,保证单线总线的各个输出端的时钟频率等于输入端的时钟频率。
本实用新型的结构可以应用到各种集成电路芯片上电路模块间数据传输。
Claims (4)
1.集成电路芯片内模块间单线总线数据传输电路,包括发送端数据缓存单元和接收端数据缓存单元,其特征在于,该电路还包括霍夫曼编码器和发送寄存器、采集寄存器和霍夫曼解码器;
所述霍夫曼编码器的输入端与发送端数据缓存单元连接,霍夫曼编码器的输出端与发送寄存器的输入端连接;所述霍夫曼解码器的输出端与接收端数据缓存单元连接,霍夫曼解码器的输入端与采集寄存器的输出端连接,所述发送寄存器和采集寄存器之间通过单线总线进行连接。
2.根据权利要求1所述的集成电路芯片内模块间单线总线数据传输电路,其特征在于,所述单线总线的输出端连接一个或并联有多个采集寄存器。
3.根据权利要求1或2所述的集成电路芯片内模块间单线总线数据传输电路,其特征在于,所述霍夫曼编码器和/或发送寄存器设置在发送端数据缓存单元所在的模块内。
4.根据权利要求1或2所述的集成电路芯片内模块间单线总线数据传输电路,其特征在于,所述采集寄存器和/或霍夫曼解码器设置在接收端数据缓存单元所在的模块内。
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