CN201828937U - 集成双频发卡器 - Google Patents
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Abstract
本实用新型涉及一种发卡器装置,公开了一种集成13.56MHZ和2.4GHZ双频段的双频发卡器,它针对移动支付SIMpass、RF-SIM等多频段、多应用手机射频应用提供双频段发卡服务。它包括微处理器电路(2)和与微处理器电路(2)相连接的电源电路(5)、读写电路(3)、感应天线电路(1)、JTAG接口电路(6)、STM32ISP下载电路(7)和RS232串口电路(4),RS232串口电路(4)与上位机(8)电连接。本实用新型针对13.56MHz和2.4GHz的两个频段的射频应用,特别将发卡的读写电路和感应天线集成于同一PCB板上,对两种频段的应用使用同一处理器,有效减小发卡器的大小体积,降低成本并使结构简单,并有效简化数据处理过程和复杂度,增加系统可靠性。
Description
技术领域
本实用新型涉及一种发卡器装置,尤其涉及一种集成13.56MHZ和2.4GHZ双频段的射频发卡器装置,它针对移动支付SIMpass、RF-SIM等多频段、多应用手机射频应用提供双频段发卡服务。
背景技术
随着移动短距通信技术的发展和进步,基于手机短距射频通信的RF-SIM和SIMpass等技术得到广泛发展的应用,针对上述技术出现各种各样的发卡器装置,正逐渐向银行、门禁、公交、计算机系统、手机支付、消费支付等领域普及。
传统的射频卡发卡器针对频段区分主要有三类:一类是高频射频卡主要为915MHz、2.4GHz、5.8GHz等,高频系统应用于需要较长的读写距离和高读写速度的场合;第二类是中频射频卡频率主要为13.56MHz,中频系统用于门禁控制、消费、公交和需传送大量数据的应用系统;第三类是低频系统主要用于短距离、低成本的应用中。其中13.56MHz和2.4GHz两个频段广泛应用在移动短距射频通信业务中。
但是在现有情况下,现有的发卡器装置大多只能读一种卡,即对于不同种类、不同频段的卡,常需要不同的发卡器装置来读取。由于针对多频段的信号需要对应的读写电路和感应天线,现有情况多使用两个频段的发卡器共用,或将两个频段的发卡器装置简单的叠加,分别去读不同的卡。这样既增加了整个发卡器的体积和成本,不利于对现有系统的升级和改造,也增加系统的复杂性容易造成故障且对使用者也增加操作的繁琐。
实用新型内容
本实用新型针对现有发卡器存在的缺陷和不足,而提供了一种能够实现双频段发卡的集成双频发卡器。它针对13.56MHz和2.4GHz的两个频段的射频应用,特别将发卡的读写电路和感应天线集成于同一PCB板上,对两种频段的应用使用同一处理器,有效减小发卡器的大小体积,降低成本并使结构简单,并有效简化数据处理过程和复杂度,增加系统可靠性。
为了解决上述技术问题,本实用新型通过下述技术方案得以解决:
集成双频发卡器,包括微处理器电路、与微处理器电路相连接的电源电路和读写电路,所述微处理器电路上还连接有感应天线电路、JTAG接口电路、STM32_ISP下载电路和RS232串口电路,RS232串口电路与上位机电连接。
作为优选,所述的电源电路包括12V转5V电源电路和5V转3V电源电路,所述的12V转5V电源电路包括瞬态抑制二极管SMBJ18CA、二极管D2、滤波电容C1、滤波电容C2、DC/DC变换转换元件MC34063、肖特基稳压二极管SS14、滤波电容C16、滤波电容C17、滤波电感L1、电阻R2和电阻R3,电阻R2和R3返回电压至MC34063引脚CII与参考电压VREF比较决定输出通路是否关断。所述的5V转3V电源电路包括电压转换芯片LM1117-3.3、输出3.3V电路滤波电容C4和C10。
作为优选,所述的微处理器电路包括基于ARM的32位处理器STM32F101和双频发卡器配置电路,还包括时钟信号发生电路和复位电路。复位电路包括电阻R11、电容C5,为微处理器提供复位信号。双频发卡器配置电路包括跳线接口J4、J5、J6,跳线接口一端分别与微处理器PB12、PB13、PB14连接,另一端接地,实现对发卡器有效配置。
作为优选,所述的JTAG接口电路为发卡器调试接口电路,它能够对下位机微处理器软件进行调试,R4~R8为对应引脚上拉电阻。所述的STM32_ISP下载电路通过接口J2与外围电路相连,可通过J2接口以串口方式烧写程序,通过ISP_TXD,ISP_RXD引脚与微处理器进行串口数据传输,实现双频发卡器的软件升级。同时上位机可发送控制信号至微处理器BOOT0引脚控制发卡器装置启动。
作为优选,所述的感应天线电路和读写电路包括发卡模块ZLG522S、感应天线ZLG522ST和通信模块SHNM100,具体为13.56MHz发卡模块ZLG522S、ZLG522ST型天线、2.4GHz通信模块SHNM100。13.56MHz发卡模块ZLG522S通过引脚RXD_TTL、TXD_TTL与微处理器进行串口数据通信,通过接口J3连接模块天线。所述的通信模块SHNM100都为2.4G频段通信模块。
作为优选,所述的RS232串口电路包括电平转换芯片MAX232和串口接口J7。所述的MAX232芯片将微处理器与上位机通信的TTL电平转化为RS232电平。MAX232的11、12引脚分别与微处理器的USART3_TX、USART3_RX连接,分别作为微处理器与上位机通信的数据发送端口与接受端口。
本实用新型由于采用以上技术方案,具有显著的技术效果:(1)本实用新型兼容双频段,以便对13.56MHz和2.4GHz的两个频段都能发卡;(2)将发卡的读写电路和感应天线集成于同一PCB板上,对两种频段的应用使用同一处理器,有效减小发卡器的大小体积,降低成本并使结构简单,并有效简化数据处理过程和复杂度,增加系统可靠性;(3)本实用新型对两种频段的读写电路和天线的合理排布,有效控制读写的灵敏度和信号干扰程度;(4)本实用新型选用基于ARM的STM32F101芯片,能够高效扩展其他功能应用。
附图说明
图1为本实用新型实施例的电路原理功能示意图。
图2为本实用新型实施例中电源电路原理示意图。
图3为本实用新型实施例中微处理器电路、感应天线电路和读写电路的原理示意图。
图4为本实用新型实施例中RS232串口电路的原理示意图。
具体实施方式
下面结合附图与实施例对本实用新型作进一步详细描述:
实施例
集成双频发卡器,如图1所示,包括微处理器电路2、与微处理器电路2相连接的电源电路5和读写电路3,所述微处理器电路2上还连接有感应天线电路1、JTAG接口电路6、STM32_ISP下载电路7和RS232串口电路4,RS232串口电路4与上位机8电连接。
其中,感应天线电路1和读写电路3包括13.56M和2.4G发卡模块,由跳线接口J6选择2.4G发卡实际工作模块。微处理器STM32F101通过发卡模块与外部射频应用交换数据。同时微处理器可通过RS232串口电路4与上位机8交换数据。所述的STM32_ISP下载电路7和JTAG接口电路6起对下位机系统软件升级和调试,电源电路5为发卡器所有部件进行供电。
如图2所示,电源电路5包括+12V转+5V电源电路51和+5V转+3V电源电路52,所述的+12V转+5V电源电路51包括瞬态抑制二极管SMBJ18CA、二极管D2、滤波电容C1、滤波电容C2、DC/DC变换转换元件MC34063、肖特基稳压二极管SS14、滤波电容C16、滤波电容C17、滤波电感L1、电阻R2和电阻R3,其中电阻R2与R3通路返回电压至MC34063引脚CII与参考电压芯片内参考电压VREF比较决定输出通路是否关断。+12V直流接入通过DC/DC变换转换元件MC34063输出+5V直流电压。所述的+5V转+3V电源电路52包括电压转换芯片LM1117-3.3、输出+3.3V电路滤波电容C4和C10,滤波电容C4和C10对+3.3V直流输出起稳压作用。
如图3所示,微处理器电路2包括基于ARM的32位处理器STM32F101和双频发卡器配置电路23。所述的感应天线电路1和读写电路3包括发卡模块ZLG522S、感应天线ZLG522ST和通信模块SHNM100。具体为13.56MHz发卡模块ZLG522S、ZLG522ST型天线、2.4GHz通信模块SHNM100。13.56MHz发卡模块ZLG522S引脚RXD_TTL、TXD_TTL与微处理器PA9(USART1_TX)、PA10(USAR2_RX)端口连接,进行串口数据通信。接口J3连接ZLG522ST型模块天线。所述的通信模块SHNM100为2.4G频段通信模块,与微处理器PA9/USART1_TX、PA10/USART1_RX端口连接。
如图4所示,所述的RS232串口电路4包括电平转换芯片MAX232和串口接口J7。MAX232芯片将微处理器与上位机通信的TTL电平转化为RS232电平。MAX232的11、12引脚分别与微处理器的USART3_TX、USART3_RX连接,分别作为微处理器与上位机通信的数据发送端口与接受端口。
本实用新型的工作原理是:该主电路通过跳线借口对双频发卡器进行硬件配置,选择2.4GHz频段使用模块。发卡器初始化完成后,通过13.56MHz、2.4GHz通信模块同时检测应用设备存在,实现双频段数据通信。本实用新型采用STM32F101实现对通信模块进行控制、数据传输、信息处理,并通过RS232电路与上位机交换数据信息。
总之,以上所述仅为本实用新型的较佳实施例,凡依本实用新型申请专利范围所作的均等变化与修饰,皆应属本实用新型专利的涵盖范围。
Claims (6)
1.集成双频发卡器,包括微处理器电路(2)、与微处理器电路(2)相连接的电源电路(5)和读写电路(3),其特征在于:所述微处理器电路(2)上还连接有感应天线电路(1)、JTAG接口电路(6)、STM32_ISP下载电路(7)和RS232串口电路(4),RS232串口电路(4)与上位机(8)电连接。
2.根据权利要求1所述的集成双频发卡器,其特征在于:所述的电源电路(5)包括12V转5V电源电路(51)和5V转3V电源电路(52),所述的12V转5V电源电路(51)包括瞬态抑制二极管SMBJ18CA、二极管D2、滤波电容C1、滤波电容C2、DC/DC变换转换元件MC34063、肖特基稳压二极管SS14、滤波电容C16、滤波电容C17、滤波电感L1、电阻R2和电阻R3,所述的5V转3V电源电路(52)包括电压转换芯片LM1117-3.3、输出+3.3V电路滤波电容C4和C10。
3.根据权利要求1所述的集成双频发卡器,其特征在于:所述的微处理器电路(2)包括基于ARM的32位处理器STM32F101(21)和双频发卡器配置电路(23)。
4.根据权利要求1所述的集成双频发卡器,其特征在于:所述的JTAG接口电路(6)为发卡器调试接口电路;所述的STM32_ISP下载电路(7)与外围电路相连。
5.根据权利要求1所述的集成双频发卡器,其特征在于:所述的感应天线电路(1)和读写电路(3)包括发卡模块ZLG522S(31)、感应天线ZLG522ST(32)和通信模块SHNM100(22)。
6.根据权利要求1所述的集成双频发卡器,其特征在于:所述的RS232串口电路(4)包括电平转换芯片MAX232(41)和串口接口J7(42)。
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