CN1300686C - 一种sdh类逻辑仿真激励数据缓存方法 - Google Patents

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Abstract

本发明有关一种SDH类逻辑仿真激励数据缓存方法；包括：A)一报文生成模块生成初始报文，将初始报文放入第一FIFO(先进先出)装置；B)一LAPS封装模块从第一FIFO装置中取得一定量的报文进行LAPS封装，将封装后的报文放入第二FIFO装置；C)一VC4虚级联映射模块从第二FIFO装置中取得封装后的报文进行VC4虚级联映射，生成STM－1帧，放入第三FIFO装置；D)一总线接口转换模块从第三FIFO装置中取得STM-1帧数据；进行总线接口转换，生成总线数据，放入第四FIFO装置；再将生成的总线数据发送给被测试设备。本发明方法能提高SDH类逻辑仿真中激励产生的效率，加快仿真速度。

Description

一种SDH类逻辑仿真激励数据缓存方法
技术领域
本发明涉及通信或电子领域的仿真技术，尤指一种SDH类逻辑仿真激励数据缓存方法。
背景技术
在SDH(Synchronous Digital Hierarchy，同步数字体系)类逻辑仿真中，激励产生是一项复杂的工作，因为SDH涉及到的协议众多，处理过程复杂，中间会产生大量的临时数据，如何合理的管理和使用这些临时数据一直是仿真人员面临的一个难点。
目前在SDH类逻辑仿真中，激励产生采用的方法是将激励产生过程中所需的每个模块设计成一个个独立的程序(在C/C++中体现为含有一个名称为main的主函数)，每个独立的程序产生的临时数据将写入一个文件中，然后下一个相关的独立程序从该文件中获取所需要的数据进行处理，处理完毕后，再次写入另外一个文件中供下一个相关独立程序使用，以此类推。处理过程图l所示。
如上所述，由于SDH类逻辑协议的复杂性使得处理过程中会产生大量的临时数据，现有技术是将所有的临时数据存入数据文件中，而数据文件是保存在硬盘上，其存储速度比较慢。因为数据不是一次性写入的，故需要频繁的访问硬盘，使得仿真效率非常低下，仿真速度非常慢。另外由于各个模块都是一个个独立的可执行程序，彼此之间没有任何联系，使得激励产生过程不能从整体上来控制，仿真的自动化程度不高；而且每个模块的参数都是通过文件的形式配置的，参数一旦配置好后就很难再次改变，给用户使用带来很大的不方便。
发明内容
本发明提供一种SDH类逻辑仿真激励数据缓存方法，解决SDH类逻辑仿真速度慢、参数配置及修改不便的问题。
本发明提供的SDH类逻辑仿真激励数据缓存方法，包括下列步骤：
A)一报文生成模块生成初始报文，将初始报文放入第一FIFO装置；
B)一LAPS模块从第一FIFO装置中取得报文进行LAPS封装，将封装后的报文放入第二FIFO装置；
C)一VC4虚级联映射模块从第二FIFO装置中取得封装后的报文进行VC4虚级联映射，生成STM-1帧，放入第三FIFO装置；
D)一总线接口转换模块从第三FIFO装置中取得STM-1帧数据，进行总线接口转换，生成总线数据，放入第四FIFO装置；再将生成的总线数据发送给被测试设备。
根据本发明的上述方法，所述各模块都设置有相应的图形化参数配置界面，实现动态访问并修改各模块的参数。
根据本发明的上述方法，所述各模块在所述的第一FIFO装置、第二FIFO装置、第三FIFO装置中读取数据前，要对所访问的FIFO装置是否为空进行检查，若所述的FIFO装置为空，则中止数据的读取。。
根据本发明的上述方法，所述总线接口转换模块与被测试设备之间通过可编程语言接口传递数据。
根据本发明的上述方法，所述第一、第二、第三和第四FIFO装置为计算机内存。
本发明的优点如下：
1、提高SDH类逻辑仿真中激励产生的效率，加快仿真速度；
2、将SDH类逻辑仿真中激励产生涉及到的多种协议组合成一个整体，提高仿真的自动化程度；
3、本发明对中间的临时数据不再需要保存到文件中去，而以FIFO的方式全部保存在计算机的内存中，可以快速的对中间的临时数据进行访问。
附图说明
图1为现有技术中SDH类逻辑仿真激励数据产生过程示意图。
图2为本发明SDH类逻辑仿真激励数据产生过程示意图。
具体实施方式
本发明提供的技术方案区别于现有技术方案之处在于：一是从整体上来考虑SDH类逻辑仿真激励产生的所有模块，各个模块之间不再是彼此独立的，而是前后有关联的；二是采用FIFO(First Input First Output)装置(存储介质可为计算机的内存)来替换原有技术方案中的文件(存储介质为计算机的硬盘)，这样可以大大加快激励产生程序对中间数据的访问速度，而且所有配置的参数存放在内存中，可以通过设计相应的图形化界面动态访问每个模块涉及到的参数的值。
本发明的SDH类逻辑仿真激励数据产生的工作过程如图2所示，描述如下：
1、由一报文生成模块生成需要的初始报文，将初始报文放入FIFO A；
2、从初始报文的FIFO A中取得一定量的报文进行LAPS(Link AccessProcedure-SDH，链路接入规程-SDH)封装，封装后的报文放入FIFO B；
3、从FIFO B中取得封装处理后的数据流进行VC4(VirtualConcatenation/4)虚级联映射，生成STM-1(Synchronous Transport Module-1，1级同步传输模块)帧，放入FIFO C；
4、从FIFO C中取得STM-1帧数据，进行总线接口转换生成总线数据，放入FIFO D；最后从FIFO D中取得总线数据，通过可编程语言接口(ProgramLanguage Interface，PLI)发送给DUT(Device Under Test，被测试设备)。
在图2中出现的每个模块都有相应的图形化的参数配置界面，可以动态的访问(读取和修改)本模块涉及到的参数，而且每个模块都会对被访问的FIFO是否为空进行检查，如果出现FIFO为空的情况(在处理过程中，模块之间通过FIFO交换数据，即前面的模块处理好数据后放入FIFO中供下级模块取用，在下级模块取用FIFO中的数据时可能会把FIFO中的数据取空，而且可能FIFO中的数据不够，还需要向前一级模块申请数据。)，则返回，处理流程中止。
FIFO是一种先进先出的缓存装置，在计算机中表现为计算机分配的一段内存。可以使用各种各样的FIFO装置来实现。
以上所述，仅为本发明较佳的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到的变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应该以权利要求书的保护范围为准。

Claims (5)

1、一种SDH类逻辑仿真激励数据缓存方法，其特征在于，包括下列步骤：
A)一报文生成模块生成初始报文，将初始报文放入第一FIFO装置；
B)一LAPS封装模块从第一FIFO装置中取得报文进行LAPS封装，将封装后的报文放入第二FIFO装置；
C)一VC4虚级联映射模块从第二FIFO装置中取得封装后的报文进行VC4虚级联映射，生成STM-1帧，放入第三FIFO装置；
D)一总线接口转换模块从第三FIFO装置中取得STM-1帧数据，进行总线接口转换，生成总线数据，放入第四FIFO装置；再将生成的总线数据发送给被测试设备。
2、如权利要求1所述的SDH类逻辑仿真激励数据缓存方法，其特征在于：所述各模块都设置有相应的图形化参数配置界面，实现动态访问并修改各模块的参数。
3、如权利要求1或2所述的SDH类逻辑仿真激励数据缓存方法，其特征在于：所述各模块在所述的第一FIFO装置、第二FIFO装置、第三FIFO装置中读取数据前，要对所访问的FIFO装置是否为空进行检查，若所述的FIFO装置为空，则中止数据的读取。
4、如权利要求1或2所述的SDH类逻辑仿真激励数据缓存方法，其特征在于：所述总线接口转换模块与被测试设备之间通过可编程语言接口传递数据。
5、如权利要求4所述的SDH类逻辑仿真激励数据缓存方法，其特征在于：所述第一、第二、第三和第四FIFO装置为计算机内存。
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