CN117290154B - 一种基于汽车功能安全的axi_dma冗余设计方法 - Google Patents
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Abstract
本发明提供一种基于汽车功能安全的AXI_DMA冗余设计方法,包括以下步骤:步骤一:不再在每个dma通道内部集成FIFO,将每个dma通道内部FIFO外置,模块增加通道FIFO Memory相关接口;步骤二:在FIFO存储器添加ECC保护功能;步骤三:在AXI接口添加ECC保护功能,其中AXI通道包括AR、AW、W、R、B通道。该基于汽车功能安全的AXI_DMA冗余设计方法通过将FIFO外置不参与冗余,并添加ECC校验,由于通道越多,fifo数据宽度越大,深度越深,节省面积越多,进而该方案能够有效的减少面积消耗,降低了生产成本;同时也能够提高存储数据的安全性。
Description
技术领域
本发明涉及汽车功能安全领域,具体为一种基于汽车功能安全的AXI_DMA冗余设计方法。
背景技术
在汽车功能安全领域,对系统的可靠性有苛刻的要求。要求DMA功能模块具有冗余设计,即使发生单点故障也不影响系统正常运行。
DMA功能模块冗余设计一般采用延迟锁步设计。主DMA实例称为主DMA控制器,冗余实例称为影子/辅助DMA控制器。主DMA控制器和影子DMA控制器具有相同的输入,其中影子DMA控制器的输入延迟两个时钟周期,连接到校验器的主DMA控制器的输出延迟两个时钟周期。然后由校验器电路进行比较,如果输出不匹配,则标记错误。
由于DMA在两个时钟周期后将执行相同的运算,冲击这两个DMA并以相同的方式影响其功能的噪声脉冲的概率将大大减少。现有技术中的AXI_DMA冗余设计面积过大,该问题就导致产品的制造成本高。
发明内容
针对现有技术存在的不足,本发明目的是提供一种基于汽车功能安全的AXI_DMA冗余设计方法,以解决上述背景技术中提出的问题,本发明通过将FIFO外置不参与冗余,并添加ECC校验,从而减少面积消耗,降低生产成本。
为了实现上述目的,本发明是通过如下的技术方案来实现:一种基于汽车功能安全的AXI_DMA冗余设计方法,包括以下步骤:步骤一:不再在每个dma通道内部集成FIFO,将每个dma通道内部FIFO外置,模块增加通道FIFO Memory相关接口;步骤二:在FIFO存储器添加ECC保护功能;步骤三:在AXI接口添加ECC保护功能,其中AXI通道包括AR、AW、W、R、B通道。
进一步的,所述步骤一中,FIFO Memory不再参与冗余复制。
进一步的,所述ECC功能模块能够写入FIFO存储器的每个字计算ECC校验位,计算的ECC校验位与正在写入FIFO的数据一起存储。
进一步的,从FIFO存储器读取数据时,使用ECC功能模块重新计算ECC校验位。重新计算的ECC校验位与读取的ECC校验位进行比较。
进一步的,所述ECC功能模块能矫正单比特错误,并通过相关寄存器和中断指示多比特错误。
进一步的,所述ECC校验位位宽取决于FIFO数据位宽。
进一步的,所述AR通道中,将{arqos,arprot,arcache,arlock,arburst,arsize,arlen,arid,araddr}作为ECC功能模块输入,计算ECC校验位,计算出的ECC校验位通过aruser输出。
进一步的,所述AW通道中,将{awqos,awprot,awcache,awlock,awburst,awsize,awlen,awid,awaddr}作为ECC功能模块输入,计算ECC校验位,计算出的ECC校验位通过awuser输出;所述W通道中,将{wlast,wstrb,wid,wdata}作为ECC功能模块输入,计算ECC校验位,计算出的ECC校验位通过wuser输出。
进一步的,所述R通道中,将{rlast,rresp,rid,rdata}作为ECC功能模块输入,计算ECC校验位,将计算出的ECC校验位与ruser输入进行比较,如果发现单比特错误,ECC功能模块会进行纠错,如果检测到多比特错误,则通过相关寄存器和中断指示多比特错误。
进一步的,所述B通道中,将{blast,bresp,bid}作为ECC功能模块输入,计算ECC校验位,将计算出的ECC校验位与buser输入进行比较,如果发现单比特错误,ECC功能模块会进行纠错,如果检测到多比特错误,则通过相关寄存器和中断指示多比特错误。
本发明的有益效果:
1.该基于汽车功能安全的AXI_DMA冗余设计方法通过将FIFO外置不参与冗余,并添加ECC校验,由于通道越多,fifo数据宽度越大,深度越深,节省面积越多,进而该方案有效的减少面积消耗,降低了生产成本;同时也提高了存储数据的安全性。
附图说明
图1为本发明一种基于汽车功能安全的AXI_DMA冗余设计方法的各模块结构图。
具体实施方式
为使本发明实现的技术手段、创作特征、达成目的与功效易于明白了解,下面结合具体实施方式,进一步阐述本发明。
请参阅图1,本发明提供一种技术方案:一种基于汽车功能安全的AXI_DMA冗余设计方法,其具体方案包括以下几点:
(1)不再在每个dma通道内部集成FIFO,将每个dma通道内部FIFO外置,模块增加通道FIFO Memory相关接口(FIFO Memory不再参与冗余复制)
(2)在FIFO存储器添加ECC保护功能
本实施例,ECC功能模块能够写入FIFO存储器的每个字计算ECC校验位,计算的ECC校验位与正在写入FIFO的数据一起存储。当从FIFO存储器读取数据时,使用ECC功能模块重新计算ECC校验位。重新计算的ECC校验位与读取的ECC校验位进行比较。
ECC功能模块能矫正单比特错误(如果有的话),并通过相关寄存器和中断指示多比特错误。
ECC校验位位宽取决于FIFO数据位宽。
(3)在AXI接口添加ECC保护功能
本实施例,在每个AXI通道上(包含AR、AW、W、R、B通道)添加ECC保护功能。
AR通道——将{arqos,arprot,arcache,arlock,arburst,arsize,arlen,arid,araddr}作为ECC功能模块输入,计算ECC校验位,计算出的ECC校验位通过aruser输出;
AW通道——将{awqos,awprot,awcache,awlock,awburst,awsize,awlen,awid,awaddr}作为ECC功能模块输入,计算ECC校验位,计算出的ECC校验位通过awuser输出;
W通道——将{wlast,wstrb,wid,wdata}作为ECC功能模块输入,计算ECC校验位,计算出的ECC校验位通过wuser输出;
R通道——将{rlast,rresp,rid,rdata}作为ECC功能模块输入,计算ECC校验位,将计算出的ECC校验位与ruser输入进行比较,如果发现单比特错误,ECC功能模块会进行纠错,如果检测到多比特错误,则通过相关寄存器和中断指示多比特错误;
B通道——将{blast,bresp,bid}作为ECC功能模块输入,计算ECC校验位,将计算出的ECC校验位与buser输入进行比较,如果发现单比特错误,ECC功能模块会进行纠错,如果检测到多比特错误,则通过相关寄存器和中断指示多比特错误。
以上显示和描述了本发明的基本原理和主要特征和本发明的优点,对于本领域技术人员而言,显然本发明不限于上述示范性实施例的细节,而且在不背离本发明的精神或基本特征的情况下,能够以其他的具体形式实现本发明。因此,无论从哪一点来看,均应将实施例看作是示范性的,而且是非限制性的,本发明的范围由所附权利要求而不是上述说明限定,因此旨在将落在权利要求的等同要件的含义和范围内的所有变化囊括在本发明内。不应将权利要求中的任何附图标记视为限制所涉及的权利要求。
此外,应当理解,虽然本说明书按照实施方式加以描述,但并非每个实施方式仅包含一个独立的技术方案,说明书的这种叙述方式仅仅是为清楚起见,本领域技术人员应当将说明书作为一个整体,各实施例中的技术方案也可以经适当组合,形成本领域技术人员可以理解的其他实施方式。
Claims (10)
1.一种基于汽车功能安全的AXI_DMA冗余设计方法,其特征在于,包括以下步骤:步骤一:不再在每个dma通道内部集成FIFO,将每个dma通道内部FIFO外置,AXI_DMA模块增加通道FIFO 存储器相关接口;步骤二:在FIFO 存储器添加ECC保护功能;步骤三:在AXI接口添加ECC保护功能,其中AXI通道包括AR、AW、W、R、B通道。
2.根据权利要求1所述的一种基于汽车功能安全的AXI_DMA冗余设计方法,其特征在于:所述步骤一中,FIFO 存储器不再参与冗余复制。
3.根据权利要求1所述的一种基于汽车功能安全的AXI_DMA冗余设计方法,其特征在于:所述ECC保护功能为写入FIFO存储器的每个字计算ECC校验位,计算的ECC校验位与正在写入FIFO的数据一起存储。
4.根据权利要求2所述的一种基于汽车功能安全的AXI_DMA冗余设计方法,其特征在于:从FIFO存储器读取数据时,使用ECC功能模块重新计算ECC校验位,重新计算的ECC校验位与读取的ECC校验位进行比较。
5.根据权利要求4所述的一种基于汽车功能安全的AXI_DMA冗余设计方法,其特征在于:所述ECC功能模块能矫正单比特错误,并通过相关寄存器和中断指示多比特错误。
6.根据权利要求5所述的一种基于汽车功能安全的AXI_DMA冗余设计方法,其特征在于:所述ECC校验位位宽取决于FIFO数据位宽。
7.根据权利要求1所述的一种基于汽车功能安全的AXI_DMA冗余设计方法,其特征在于:所述AR通道中,将{arqos, arprot, arcache, arlock, arburst, arsize, arlen,arid, araddr}作为ECC功能模块输入,计算ECC校验位,计算出的ECC校验位通过aruser输出。
8.根据权利要求1所述的一种基于汽车功能安全的AXI_DMA冗余设计方法,其特征在于:所述AW通道中,将{awqos, awprot, awcache, awlock, awburst, awsize, awlen,awid, awaddr}作为ECC功能模块输入,计算ECC校验位,计算出的ECC校验位通过awuser输出;所述W通道中,将{wlast, wstrb, wid, wdata}作为ECC功能模块输入,计算ECC校验位,计算出的ECC校验位通过wuser输出。
9.根据权利要求1所述的一种基于汽车功能安全的AXI_DMA冗余设计方法,其特征在于:所述R通道中,将{rlast, rresp, rid, rdata}作为ECC功能模块输入,计算ECC校验位,将计算出的ECC校验位与ruser输入进行比较,如果发现单比特错误,ECC功能模块会进行纠错,如果检测到多比特错误,则通过相关寄存器和中断指示多比特错误。
10.根据权利要求1所述的一种基于汽车功能安全的AXI_DMA冗余设计方法,其特征在于:所述B通道中,将{blast, bresp, bid}作为ECC功能模块输入,计算ECC校验位,将计算出的ECC校验位与buser输入进行比较,如果发现单比特错误,ECC功能模块会进行纠错,如果检测到多比特错误,则通过相关寄存器和中断指示多比特错误。
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Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1031646A (ja) * | 1996-07-15 | 1998-02-03 | Hitachi Ltd | Dma制御方式 |
CN1760838A (zh) * | 2004-10-16 | 2006-04-19 | 鸿富锦精密工业(深圳)有限公司 | 基本输入输出系统只读存储器数据检测系统及方法 |
KR20070068809A (ko) * | 2005-12-27 | 2007-07-02 | 삼성전자주식회사 | 시스템 온 칩 시스템에서 데이터 전송을 위한 시스템 및방법 |
US7398449B1 (en) * | 2004-06-16 | 2008-07-08 | Azul Systems, Inc. | Encoding 64-bit data nibble error correct and cyclic-redundancy code (CRC) address error detect for use on a 76-bit memory module |
CN202939603U (zh) * | 2012-12-04 | 2013-05-15 | 济南大学 | 外置式数据处理装置 |
JP2019208977A (ja) * | 2018-06-07 | 2019-12-12 | 株式会社藤商事 | 遊技機 |
CN115114103A (zh) * | 2022-08-23 | 2022-09-27 | 摩尔线程智能科技(北京)有限责任公司 | 直接存储器访问数据传输的测试方法和装置 |
Family Cites Families (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100462177B1 (ko) * | 2002-08-26 | 2004-12-17 | 삼성전자주식회사 | 주변 장치의 동작 상태를 실시간으로 백업할 수 있는엠베디드 컨트롤러 |
US11645178B2 (en) * | 2018-07-27 | 2023-05-09 | MIPS Tech, LLC | Fail-safe semi-autonomous or autonomous vehicle processor array redundancy which permits an agent to perform a function based on comparing valid output from sets of redundant processors |
-
2023
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Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH1031646A (ja) * | 1996-07-15 | 1998-02-03 | Hitachi Ltd | Dma制御方式 |
US7398449B1 (en) * | 2004-06-16 | 2008-07-08 | Azul Systems, Inc. | Encoding 64-bit data nibble error correct and cyclic-redundancy code (CRC) address error detect for use on a 76-bit memory module |
CN1760838A (zh) * | 2004-10-16 | 2006-04-19 | 鸿富锦精密工业(深圳)有限公司 | 基本输入输出系统只读存储器数据检测系统及方法 |
KR20070068809A (ko) * | 2005-12-27 | 2007-07-02 | 삼성전자주식회사 | 시스템 온 칩 시스템에서 데이터 전송을 위한 시스템 및방법 |
CN202939603U (zh) * | 2012-12-04 | 2013-05-15 | 济南大学 | 外置式数据处理装置 |
JP2019208977A (ja) * | 2018-06-07 | 2019-12-12 | 株式会社藤商事 | 遊技機 |
CN115114103A (zh) * | 2022-08-23 | 2022-09-27 | 摩尔线程智能科技(北京)有限责任公司 | 直接存储器访问数据传输的测试方法和装置 |
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