CN116110323A - 显示装置 - Google Patents

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Abstract

显示装置包括：外部存储器装置，配置在印刷电路基板区域中且存储第一IC驱动信息；内部存储器装置，配置在IC区域中且存储复制所述第一IC驱动信息而生成的第二IC驱动信息；缓冲部，配置在所述IC区域中且接收所述第二IC驱动信息，检测静电放电电流；纠错码运算部，配置在所述IC区域中，在检测到所述静电放电电流的情况下，决定所述第一IC驱动信息的第一纠错码，并决定所述第二IC驱动信息的第二纠错码；以及纠错码比较部，配置在所述IC区域中，比较所述第一纠错码和所述第二纠错码。所述内部存储器装置根据所述第一纠错码和所述第二纠错码的比较结果，利用所述第一IC驱动信息选择性地更新所述第二IC驱动信息。

Description

显示装置
技术领域
本发明涉及显示装置。更详细而言，涉及防止因静电放电(electro staticdischarge)产生的显示装置的误操作(soft fail)的显示装置。
背景技术
通常，显示装置包括显示面板、栅极驱动部、数据驱动部以及驱动控制部。显示面板包括多个栅极线、多个数据线以及与多个栅极线及多个数据线电连接的多个像素。栅极驱动部向多个栅极线提供栅极信号，数据驱动部向数据线提供数据电压，驱动控制部控制栅极驱动部和数据驱动部。
内部存储器装置在显示装置通电(power-on)或解除睡眠(sleep out)时复制存储在外部存储器装置中的数据来进行存储，当存在以往从外部存储器装置复制的数据的情况下，可以更新以往从外部存储器装置复制的数据。但是，在显示装置中因静电放电(electrostatic discharge)而产生静电放电电流的情况下，可能会产生内部存储器装置的误操作(soft fail)。此外，内部存储器装置输入IC驱动信息时，因静电放电电流，所输入的IC驱动信息可能会被污染。另外，存储在内部存储器装置中的IC驱动信息也可能会被静电放电电流污染。
发明内容
本发明的一目的在于，提供一种显示装置，在检测到静电放电电流的情况下，比较存储在内部存储器装置中的第一IC驱动信息和存储在外部存储器装置中的第二IC驱动信息，基于比较结果，利用第一IC驱动信息更新第二IC驱动信息。
本发明的其他目的在于，提供一种显示装置，在通过内部存储器装置所包括的电源箝位电路检测到静电放电电流的情况下，比较存储在内部存储器装置中的第一IC驱动信息和存储在外部存储器装置中的第二IC驱动信息，基于比较结果，利用第一IC驱动信息更新第二IC驱动信息。
但是，本发明想要解决的课题并不限于以上所提及的课题，在不超出本发明的思想和领域的范围可以进行各种扩展。
为了达成本发明的目的，本发明的实施例涉及的显示装置包括：外部存储器装置，配置在印刷电路基板区域中且存储第一IC驱动信息；内部存储器装置，配置在IC区域中且存储复制所述第一IC驱动信息而生成的第二IC驱动信息；缓冲部，配置在所述IC区域中且接收所述第二IC驱动信息，检测静电放电电流；纠错码运算部，配置在所述IC区域中，在检测到所述静电放电电流的情况下，决定所述第一IC驱动信息的第一纠错码，并决定所述第二IC驱动信息的第二纠错码；以及纠错码比较部，配置在所述IC区域中，比较所述第一纠错码和所述第二纠错码。所述内部存储器装置根据所述第一纠错码和所述第二纠错码的比较结果，利用所述第一IC驱动信息选择性地更新所述第二IC驱动信息。
在一实施例中，可以是，所述显示装置还包括：显示面板，包括像素；栅极驱动部，向所述像素施加栅极信号；数据驱动部，配置在所述IC区域中且包括所述缓冲部，向所述像素施加数据电压；以及驱动控制部，配置在所述IC区域中且包括所述纠错码运算部和所述纠错码比较部，控制所述栅极驱动部和所述数据驱动部。
在一实施例中，可以是，所述内部存储器装置在所述第一纠错码和所述第二纠错码不同的情况下，利用所述第一IC驱动信息更新所述第二IC驱动信息。
在一实施例中，可以是，所述内部存储器装置在所述显示装置通电(power-on)或解除睡眠(sleep out)时利用所述第一IC驱动信息更新所述第二IC驱动信息。
在一实施例中，可以是，所述纠错码运算部在从主处理器接收更新信号的情况下，决定所述第二纠错码。
在一实施例中，可以是，所述缓冲部包括：多个缓冲区域，所述多个缓冲区域中的每一个包括接收所述第二IC驱动信息的缓冲模块；以及静电放电检测电路，检测所述静电放电电流。
在一实施例中，可以是，所述纠错码运算部决定对于检测到所述静电放电电流的所述缓冲区域的所述第二IC驱动信息的所述第二纠错码，所述纠错码比较部比较对于检测到所述静电放电电流的所述缓冲区域的所述第一IC驱动信息的所述第一纠错码和对于检测到所述静电放电电流的所述缓冲区域的所述第二IC驱动信息的所述第二纠错码，所述内部存储器装置在对于检测到所述静电放电电流的所述缓冲区域的所述第一IC驱动信息的所述第一纠错码和对于检测到所述静电放电电流的所述缓冲区域的所述第二IC驱动信息的所述第二纠错码不同的情况下，利用对于检测到所述静电放电电流的所述缓冲区域的所述第一IC驱动信息更新对于检测到所述静电放电电流的所述缓冲区域的所述第二IC驱动信息。
在一实施例中，可以是，所述静电放电检测电路包括：第一电阻，包括被施加向所述内部存储器装置施加的第一存储器电压的第一电极以及与第一电容器连接的第二电极；第二电阻，包括与所述第一电容器连接的第一电极以及被施加向所述内部存储器装置施加的第二存储器电压的第二电极；所述第一电容器，包括与所述第一电阻的所述第二电极连接的第一电极以及与所述第二电阻的所述第一电极连接的第二电极；第三电阻，包括与所述第二电阻的所述第一电极连接的第一电极以及与比较器连接的第二电极；以及所述比较器，包括与所述第三电阻连接的第一输入端、被施加模拟电压的第二输入端以及与所述纠错码运算部连接的输出端。
在一实施例中，可以是，所述纠错码运算部在从主处理器接收更新信号的情况下，决定对于根据所述更新信号决定的所述缓冲区域的所述第二IC驱动信息的所述第二纠错码。
在一实施例中，可以是，所述缓冲部包括第一缓冲区域、第二缓冲区域以及第三缓冲区域，所述第一缓冲区域包括第一缓冲模块以及与所述第一缓冲模块及第二缓冲模块相邻的第一静电放电检测电路，所述第二缓冲区域包括与所述第一缓冲模块相邻的所述第二缓冲模块以及与所述第二缓冲模块相邻的第二静电放电检测电路，所述第三缓冲区域包括与所述第二缓冲模块相邻的第三缓冲模块以及与所述第二缓冲模块及所述第三缓冲模块相邻的第三静电放电检测电路。
在一实施例中，可以是，在所述第一缓冲区域中检测到所述静电放电电流的情况下，所述纠错码运算部决定对于所述第一缓冲区域和所述第二缓冲区域的所述第二IC驱动信息的所述第二纠错码，在所述第二缓冲区域中检测到所述静电放电电流的情况下，所述纠错码运算部决定对于所述第二缓冲区域的所述第二IC驱动信息的所述第二纠错码，在所述第三缓冲区域中检测到所述静电放电电流的情况下，所述纠错码运算部决定对于所述第二缓冲区域及所述第三缓冲区域的所述第二IC驱动信息的所述第二纠错码。
在一实施例中，可以是，所述纠错码运算部包括：延时缓冲器，从所述缓冲部接收检测信号且使所述检测信号延迟；以及纠错码运算电路，从所述延时缓冲器接收所述检测信号，响应于所述检测信号而决定所述第一IC驱动信息的所述第一纠错码和所述第二IC驱动信息的所述第二纠错码。
在一实施例中，可以是，所述第一纠错码是所述第一IC驱动信息的校验和(checksum)值，所述第二纠错码是所述第二IC驱动信息的校验和值。
为了达成本发明的其他目的，本发明的实施例涉及的显示装置可以包括：外部存储器装置，配置在印刷电路基板区域中且存储第一IC驱动信息；内部存储器装置，配置在IC区域中且存储复制所述第一IC驱动信息生成的第二IC驱动信息，并且包括检测静电放电电流的电源箝位电路；缓冲部，配置在所述IC区域中且接收所述第二IC驱动信息；纠错码运算部，配置在所述IC区域中，在检测到所述静电放电电流的情况下，决定所述第一IC驱动信息的第一纠错码，并且决定所述第二IC驱动信息的第二纠错码；以及纠错码比较部，配置在所述IC区域中且比较所述第一纠错码和所述第二纠错码，所述内部存储器装置根据所述第一纠错码和所述第二纠错码的比较结果，利用所述第一IC驱动信息选择性地更新所述第二IC驱动信息。
在一实施例中，可以是，所述电源箝位电路包括：检测部，检测所述静电放电电流；放电部，提供所述静电放电电流的放电路径；以及控制电路，控制所述放电部。
在一实施例中，可以是，所述检测部包括：第一电阻，包括被施加第一存储器电压的第一电极以及与第一电容器连接的第二电极；以及所述第一电容器，包括与所述第一电阻的所述第二电极连接的第一电极以及被施加第二存储器电压的第二电极。可以是，所述放电部包括：放电晶体管，包括与所述控制电路连接的控制电极、被施加所述第一存储器电压的第一电极以及被施加所述第二存储器电压的第二电极。可以是，所述控制电路包括：转换器，包括与所述第一电容器的所述第一电极连接的第一电极以及与所述放电晶体管的所述控制电极连接的第二电极。
在一实施例中，可以是，所述内部存储器装置在所述第一纠错码和所述第二纠错码不同的情况下利用所述第一IC驱动信息更新所述第二IC驱动信息。
在一实施例中，可以是，所述内部存储器装置在所述显示装置通电(power-on)或解除睡眠(sleep out)时利用所述第一IC驱动信息更新所述第二IC驱动信息。
在一实施例中，可以是，所述纠错码运算部在从主处理器接收更新信号的情况下决定所述第二纠错码。
在一实施例中，可以是，所述第一纠错码是所述第一IC驱动信息的校验和(checksum)值，所述第二纠错码是所述第二IC驱动信息的校验和值。
(发明效果)
本发明的实施例涉及的显示装置可以包括：外部存储器装置，配置在印刷电路基板区域中且存储第一IC驱动信息；内部存储器装置，配置在IC区域中且存储复制所述第一IC驱动信息生成的第二IC驱动信息；缓冲部，配置在所述IC区域中且接收所述第二IC驱动信息，检测静电放电电流；纠错码运算部，配置在所述IC区域中，在检测到所述静电放电电流的情况下，决定所述第一IC驱动信息的第一纠错码，并且决定所述第二IC驱动信息的第二纠错码；以及纠错码比较部，配置在所述IC区域，并且比较所述第一纠错码和所述第二纠错码，根据所述第一纠错码和所述第二纠错码的比较结果，利用所述第一IC驱动信息选择性地更新所述第二IC驱动信息，从而可以防止因静电放电(electro static discharge)引起的所述内部存储器装置的误操作(soft fail)、施加到所述缓冲部的所述第二IC驱动信息的污染以及存储在所述内部存储器装置中的所述第二IC驱动信息的污染。
此外，本发明的实施例涉及的显示装置可以包括：外部存储器装置，配置在印刷电路基板区域中且存储第一IC驱动信息；内部存储器装置，配置在IC区域中且存储复制所述第一IC驱动信息生成的第二IC驱动信息，并且包括检测静电放电电流的电源箝位电路；缓冲部，配置在所述IC区域中且接收所述第二IC驱动信息；纠错码运算部，配置在所述IC区域中，在检测到所述静电放电电流的情况下，决定所述第一IC驱动信息的第一纠错码，并且决定所述第二IC驱动信息的第二纠错码；以及纠错码比较部，配置在所述IC区域中且比较所述第一纠错码和所述第二纠错码，根据所述第一纠错码和所述第二纠错码的比较结果，利用所述第一IC驱动信息选择性地更新所述第二IC驱动信息，从而可以在所述缓冲部中不存在单独的静电放电检测电路的情况下防止因静电放电引起的所述内部存储器装置的误操作、施加到所述缓冲部的所述第二IC驱动信息的污染以及存储在所述内部存储器装置中的所述第二IC驱动信息的污染。
但是，本发明的效果并不限于上述的效果，在不超出本发明的思想和领域的范围可以进行各种扩展。
附图说明
图1是表示本发明的实施例涉及的显示装置的框图。
图2是表示图1的显示装置的印刷电路基板区域和IC区域的一例的框图。
图3是表示图1的显示装置的静电放电检测电路和纠错码运算部的一例的电路图。
图4是表示本发明的实施例涉及的显示装置的印刷电路基板区域和IC区域的一例的框图。
图5是表示本发明的实施例涉及的显示装置的印刷电路基板区域和IC区域的一例的框图。
图6是表示本发明的实施例涉及的显示装置的缓冲部的一例的图。
图7是表示本发明的实施例涉及的显示装置的框图。
图8是表示图7的显示装置的电源箝位电路、检测信号生成部和纠错码运算部的一例的电路图。
图9是表示本发明的实施例涉及的显示装置的印刷电路基板区域和IC区域的一例的框图。
符号说明：
100：显示面板；200：驱动控制部；300：栅极驱动部；400：数据驱动部；1000：显示装置；1100：印刷电路基板区域；1110：外部存储器装置；1120：印刷电路基板；1200：IC区域；1210：内部存储器装置；1211：电源箝位电路；1212：检测部；1213：控制电路；1214：放电部；1220：缓冲部；1221：比较器；1230：纠错码运算部；1240：纠错码比较部；1250：睡眠操作部；1260：检测信号生成部。
具体实施方式
以下，参照附图，更详细说明本发明。
图1是表示本发明的实施例涉及的显示装置1000的框图。
参照图1，显示装置1000可以包括显示面板100、驱动控制部200、栅极驱动部300、数据驱动部400、内部存储器装置1210以及外部存储器装置1110。驱动控制部200、数据驱动部400和内部存储器装置1210可以配置在IC区域1200。外部存储器装置1110可以配置在印刷电路基板区域1100。
印刷电路基板区域1100可以是印刷电路基板1120上的区域。例如，印刷电路基板1120可以是柔性印刷电路基板(flexible printed circuit board)。印刷电路基板1120可以将从主处理器(例如，图形处理单元(graphic processing unit；GPU)等)接收到的输入图像数据IMG和输入控制信号CONT施加到驱动控制部200。
外部存储器装置1110可以存储第一IC驱动信息IIC1。第一IC驱动信息IIC1可以包括用于补偿输出到数据线DL的数据电压的补偿信息。外部存储器装置1110可以向内部存储器装置1210施加第一IC驱动信息IIC1。在一实施例中，外部存储器装置1110可以响应于重新加载信号RS而向内部存储器装置1210施加第一IC驱动信息IIC1。在一实施例中，外部存储器装置1110可以响应于检测信号DS而向驱动控制部200施加第一IC驱动信息IIC1。在一实施例中，外部存储器装置1110可以在显示装置1000通电(power-on)或解除睡眠(sleepout)时向内部存储器装置1210施加第一IC驱动信息IIC1。因此，外部存储器装置1110可以在显示装置1000通电(power-on)或解除睡眠时、或者外部存储器装置1110接收重新加载信号RS时，向内部存储器装置1210施加第一IC驱动信息IIC1。
例如，在显示装置1000通电时，可以被施加用于驱动显示装置1000的电源电压。例如，在显示装置1000被解除睡眠时，用于驱动显示装置1000的电源电压可以上升至用于驱动显示装置1000的电压电平。即，在显示装置1000通电之后，显示装置1000可以使用于驱动显示装置1000的电源电压的电压电平下降(即，进入睡眠(sleep in))或上升(即，解除睡眠)。
IC区域1200可以包括集成有驱动控制部200和数据驱动部400的芯片。例如，IC区域1200可以包括集成有驱动控制部200、数据驱动部400和内部存储器装置1210的一个芯片。例如，在IC区域1200中，可以通过COG(chip on glass，玻璃上芯片)、COF(chip onfilm，覆晶薄膜)和COP(chip on plastic，塑料上芯片)等方式搭载所述芯片。
显示面板100可以包括显示图像的显示部AA以及与显示部AA相邻配置的周边部PA。在一实施例中，栅极驱动部300可以被安装在周边部PA中。
显示面板100可以包括多个栅极线GL、多个数据线DL以及与栅极线GL及数据线DL电连接的多个像素P。栅极线GL可以在第一方向D1上延伸，数据线DL可以在与第一方向D1交叉的第二方向D2上延伸。
驱动控制部200可以通过印刷电路基板1120而从主处理器接收输入图像数据IMG和输入控制信号CONT。例如，输入图像数据IMG可以包括红色图像数据、绿色图像数据和蓝色图像数据。在一实施例中，输入图像数据IMG还可以包括白色图像数据。又例如，输入图像数据IMG可以包括品红色(magenta)图像数据、黄色(yellow)图像数据和青色(cyan)图像数据。输入控制信号CONT可以包括主时钟信号和数据选通信号。输入控制信号CONT还可以包括垂直同步信号和水平同步信号。在一实施例中，驱动控制部200可以基于第一IC驱动信息IIC1、第二IC驱动信息IIC2和检测信号DS生成重新加载信号RS。
驱动控制部200可以基于输入图像数据IMG和输入控制信号CONT，生成第一控制信号CONT1、第二控制信号CONT2和输出图像数据OIMG。
驱动控制部200可以基于输入控制信号CONT生成用于控制栅极驱动部300的操作的第一控制信号CONT1来将其输出到栅极驱动部300。第一控制信号CONT1可以包括垂直开始信号以及栅极时钟信号。
驱动控制部200可以基于输入控制信号CONT生成用于控制数据驱动部400的操作的第二控制信号CONT2来将其输出到数据驱动部400。第二控制信号CONT2可以包括水平开始信号和加载信号。
驱动控制部200可以接收输入图像数据IMG和输入控制信号CONT来生成输出图像数据OIMG。驱动控制部200可以将输出图像数据OIMG输出到数据驱动部400。
栅极驱动部300可以响应于从驱动控制部200输入的第一控制信号CONT1，生成用于驱动栅极线GL的栅极信号。栅极驱动部300可以向栅极线GL输出栅极信号。例如，栅极驱动部300可以向栅极线GL依次输出栅极信号。
数据驱动部400可以从驱动控制部200接收第二控制信号CONT2和输出图像数据OIMG。数据驱动部400可以从内部存储器装置1210接收第二IC驱动信息IIC2。数据驱动部400可以将输出图像数据OIMG变换成模拟形态的电压，基于变换成模拟形态的电压的输出图像数据OIMG和第二IC驱动信息IIC2来生成数据电压。数据驱动部400可以向数据线DL输出数据电压。
数据驱动部400可以向驱动控制部200施加从内部存储器装置1210接收的第二IC驱动信息IIC2。数据驱动部400可以检测因静电放电(electro static discharge)产生的静电放电电流来生成检测信号DS。数据驱动部400可以向驱动控制部200和外部存储器装置1110施加检测信号DS。
内部存储器装置1210可以复制第一IC驱动信息IIC1来生成第二IC驱动信息IIC2，并存储第二IC驱动信息IIC2。即，第二IC驱动信息IIC2也包括所述补偿信息。内部存储器装置1210可以向数据驱动部400施加第二IC驱动信息IIC2。向内部存储器装置1210可以施加用于驱动内部存储器装置1210的第一存储器电压和第二存储器电压。例如，第一存储器电压可以具有高电压电平，第二存储器电压可以具有低电压电平。
例如，内部存储器装置1210可以在显示装置1000首次通电时复制第一IC驱动信息IIC1来生成第二IC驱动信息IIC2。例如，内部存储器装置1210可以在生成第二IC驱动信息IIC2之后，当显示装置1000通电(power-on)或解除睡眠(sleep out)时，接收第一IC驱动信息IIC1，从而利用第一IC驱动信息IIC1更新第二IC驱动信息IIC2。在一实施例中，在外部存储器装置1110响应于重新加载信号RS而向内部存储器装置1210施加第一IC驱动信息IIC1时，内部存储器装置1210可以接收第一IC驱动信息IIC1，从而利用第一IC驱动信息IIC1更新第二IC驱动信息IIC2。
图2是表示图1的显示装置1000的印刷电路基板区域1100和IC区域1200的一例的框图，图3是表示图1的显示装置1000的静电放电检测电路EDC和纠错码运算部1230的一例的电路图。
参照图2和图3，显示装置1000可以包括配置在印刷电路基板区域1100中且存储第一IC驱动信息IIC1的外部存储器装置1110。显示装置1000可以包括配置在IC区域中且存储复制第一IC驱动信息IIC1生成的第二IC驱动信息IIC2的内部存储器装置1210。显示装置1000可以包括配置在IC区域1200中且接收第二IC驱动信息IIC2并检测静电放电电流的缓冲部1220。显示装置1000可以包括配置在IC区域1200中且在检测到静电放电电流的情况下决定第一IC驱动信息IIC1的第一纠错码ECC1并决定第二IC驱动信息IIC2的第二纠错码ECC2的纠错码运算部1230。显示装置1000可以包括配置在IC区域1200中且比较第一纠错码ECC1和第二纠错码ECC2的纠错码比较部1240。内部存储器装置1210可以根据第一纠错码ECC1和第二纠错码ECC2的比较结果，利用第一IC驱动信息IIC1选择性地更新第二IC驱动信息IIC2。
驱动控制部200可以包括纠错码运算部1230和纠错码比较部1240，数据驱动部400可以包括缓冲部1220。
缓冲部1220可以接收第二IC驱动信息IIC2，检测静电放电电流。缓冲部1220可以包括检测静电放电电流的静电放电检测电路EDC。
缓冲部1220可以接收第二IC驱动信息IIC2，基于第二IC驱动信息IIC2补偿变换成模拟形态的电压的输出图像数据OIMG来生成数据电压DV。缓冲部1220可以向纠错码运算部1230施加从内部存储器装置1210接收的第二IC驱动信息IIC2。
静电放电检测电路EDC可以检测因静电放电产生的静电放电电流来生成检测信号DS。例如，静电放电检测电路EDC可以包括：第一电阻R1，包括被施加向内部存储器装置1210施加的第一存储器电压MV的第一电极以及与第一电容器C1连接的第二电极；第二电阻R2，包括与第一电容器C1连接的第一电极以及被施加向内部存储器装置1210施加的第二存储器电压MGND的第二电极；第一电容器C1，包括与第一电阻R1的所述第二电极连接的第一电极以及与第二电阻R2的所述第一电极连接的第二电极；第三电阻R3，包括与第二电阻R2的所述第一电极连接的第一电极以及与比较器1221连接的第二电极；以及比较器1221，包括与第三电阻R3连接的第一输入端、被施加模拟电压VA的第二输入端以及与纠错码运算部1230连接的输出端。
例如，在静电放电电流流入被施加第二存储器电压MGND的线的情况下，第二电阻R2的所述第二电极的电压可以上升。由此，比较器1221的所述第一输入端的电压可以上升。比较器1221可以在比较器1221的所述第一输入端的电压大于模拟电压VA的情况下输出具有1的值的检测信号DS，在比较器1221的所述第一输入端的电压小于模拟电压VA的情况下输出具有0的值的检测信号DS。因此，在因静电放电电流而比较器1221的所述第一输入端的电压变成比模拟电压VA大的情况下，比较器1221可以输出具有1的值的检测信号DS。纠错码运算部1230在接收具有1的值的检测信号DS的情况下(即，检测到静电放电电流的情况下)，可以决定第一IC驱动信息IIC1的第一纠错码ECC1，并且决定第二IC驱动信息IIC2的第二纠错码ECC2。模拟电压VA可以被决定为适合检测静电放电电流的值。在一实施例中，比较器1221的所述输出端可以与外部存储器装置1110连接，外部存储器装置1110可以在接收到具有1的值的检测信号DS的情况下向纠错码运算部1230和内部存储器装置1210输出第一IC驱动信息IIC1。
纠错码运算部1230可以在检测到静电放电电流的情况下决定第一IC驱动信息IIC1的第一纠错码ECC1，并且决定第二IC驱动信息IIC2的第二纠错码ECC2。例如，纠错码运算部1230可以包括：延时缓冲器1231，从缓冲部1220接收检测信号DS并使检测信号DS延迟；以及纠错码运算电路1232，从延时缓冲器1231接收检测信号DS，响应于检测信号DS，决定第一IC驱动信息IIC1的第一纠错码ECC1和第二IC驱动信息IIC2的第二纠错码ECC2。
例如，延时缓冲器1231可以暂时存储且输出检测信号DS。因此，纠错码运算电路1232可以在静电放电电流经过之后接收检测信号DS，并响应于检测信号DS来计算出第一纠错码ECC1和第二纠错码ECC2。纠错码运算电路1232可以从缓冲部1220接收第二IC驱动信息IIC2，并且从外部存储器装置1110接收第一IC驱动信息IIC1。
第一纠错码ECC1和第二纠错码ECC2可以具有用于检查第一IC驱动信息IIC1和第二IC驱动信息IIC2的值是否相同的值。例如，第一纠错码ECC1可以是第一IC驱动信息IIC1的校验和(checksum)值，第二纠错码ECC2可以是第二IC驱动信息IIC2的校验和值。本实施例涉及的第一纠错码ECC1和第二纠错码ECC2并不限于此，可以包括用于比较第一IC驱动信息IIC1和第二IC驱动信息IIC2的值的任何形态。
纠错码比较部1240可以比较第一纠错码ECC1和第二纠错码ECC2。内部存储器装置1210可以在第一纠错码ECC1和第二纠错码ECC2不同的情况下，利用第一IC驱动信息IIC1更新第二IC驱动信息IIC2。
例如，纠错码比较部1240可以在第一纠错码ECC1和第二纠错码ECC2不同的情况下，向外部存储器装置1110施加重新加载信号RS。若外部存储器装置1110被施加重新加载信号RS，则外部存储器装置1110可以向内部存储器装置1210施加第一IC驱动信息IIC1。若内部存储器装置1210从外部存储器装置1110接收第一IC驱动信息IIC1，则内部存储器装置1210可以利用第一IC驱动信息IIC1更新第二IC驱动信息IIC2。在因静电放电电流而在内部存储器装置1210中产生误操作(soft fail)，或者内部存储器装置1210输入第二IC驱动信息IIC2时因静电放电电流而所输入的第二IC驱动信息IIC2被污染，或者存储在内部存储器装置1210中的第二IC驱动信息IIC2因静电放电电流被污染的情况下，第一IC驱动信息IIC1和第二IC驱动信息IIC2可以不同(即，第一纠错码ECC1和第二纠错码ECC2可以不同)。即，内部存储器装置1210可以在因静电放电电流而第一IC驱动信息IIC1和第二IC驱动信息IIC2变得不同的情况下利用第一IC驱动信息IIC1更新第二IC驱动信息IIC2，从而防止第二IC驱动信息IIC2的污染。
图4是表示本发明的实施例涉及的显示装置的印刷电路基板区域1100和IC区域1200的一例的框图。
本实施例涉及的显示装置除了纠错码比较部1240和睡眠操作部1250以外与图1的显示装置1000的构成实质上相同，因此对于相同或类似的构成要素使用相同的符号和标记，省略重复的说明。
参照图4，纠错码比较部1240可以在第一纠错码ECC1和第二纠错码ECC2不同的情况下，向睡眠操作部1250施加进入睡眠/解除睡眠信号SA。睡眠操作部1250可以响应于进入睡眠/解除睡眠信号SA，使显示装置进入睡眠之后解除睡眠。如上所述，若显示装置被解除睡眠，则外部存储器装置1110可以向内部存储器装置1210施加第一IC驱动信息IIC1，内部存储器装置1210可以利用第一IC驱动信息IIC1更新第二IC驱动信息IIC2。
图5是表示本发明的实施例涉及的显示装置的印刷电路基板区域1100和IC区域1200的一例的框图。
本实施例涉及的显示装置除了基于更新信号US的操作以外与图1的显示装置1000的构成实质上相同，因此对于相同或类似的构成要素使用相同的符号和标记，省略重复的说明。
参照图5，纠错码运算部1230可以在从主处理器接收到更新信号US的情况下，决定第二纠错码ECC2。纠错码运算部1230可以在接收到更新信号US的情况下，与静电放电电流的检测与否无关地决定第二纠错码ECC2。纠错码比较部1240可以在第一纠错码ECC1和第二纠错码ECC2不同的情况下，向外部存储器装置1110施加重新加载信号RS。即，显示装置可以在从主处理器接收到更新信号US的情况下，与静电放电电流的检测与否无关地比较第一IC驱动信息IIC1和第二IC驱动信息IIC2，根据比较结果，更新存储在内部存储器装置1210中的第二IC驱动信息IIC2。
图6是表示本发明的实施例涉及的显示装置的缓冲部1220的一例的图。
本实施例涉及的显示装置除了将第二IC驱动信息IIC2区分成对于各个缓冲区域BA的第二IC驱动信息IIC2的情况以外与图1的显示装置1000的构成实质上相同，因此对于相同或类似的构成要素使用相同的符号和标记，省略重复的说明。
参照图2和图6，缓冲部1220可以具有多个缓冲区域BA，在多个缓冲区域BA的每一个中可以包括接收第二IC驱动信息IIC2的缓冲模块BB以及检测静电放电电流的静电放电检测电路EDC。缓冲模块BB可以包括位于第一缓冲区域BA1的第一缓冲模块BB1、位于第二缓冲区域BA2的第二缓冲模块BB2以及位于第三缓冲区域BA3的第三缓冲模块BB3。静电放电检测电路EDC可以包括位于第一缓冲区域BA1的第一静电放电检测电路EDC1、位于第二缓冲区域BA2的第二静电放电检测电路EDC2以及位于第三缓冲区域BA3的第三静电放电检测电路EDC3。
缓冲模块BB可以接收第二IC驱动信息IIC2，基于第二IC驱动信息IIC2来补偿变换成模拟形态的电压的输出图像数据OIMG，从而生成数据电压DV。缓冲模块BB可以向纠错码运算部1230施加从内部存储器装置1210接收的第二IC驱动信息IIC2。
第二IC驱动信息IIC2可以在每个被施加的缓冲模块BB中具有彼此不同的值。由于显示面板100的所有像素P并不是被同样地补偿，因此可以施加在每个缓冲模块BB中具有不同的值的第二IC驱动信息IIC2。
在一实施例中，纠错码运算部1230可以决定对于检测到静电放电电流的缓冲区域BA(即，包括检测到静电放电电流的静电放电检测电路EDC的缓冲区域BA)的第二IC驱动信息IIC2的第二纠错码ECC2。
例如，如图6所示，缓冲部1220(即多个缓冲区域BA)可以具有第一缓冲区域BA1、第二缓冲区域BA2以及第三缓冲区域BA3，第一缓冲区域BA1可以包括第一缓冲模块BB1以及第一静电放电检测电路EDC1，第二缓冲区域BA2可以包括第二缓冲模块BB2以及第二静电放电检测电路EDC2，第三缓冲区域BA3可以包括第三缓冲模块BB3以及第三静电放电检测电路EDC3。在一实施例中，纠错码运算部1230可以在第一缓冲区域BA1中检测到静电放电电流的情况下(即，由第一静电放电检测电路EDC1检测到静电放电电流的情况下)，决定对于第一缓冲区域BA1的第二IC驱动信息IIC2(即，向第一缓冲模块BB1施加的第二IC驱动信息IIC2)的第二纠错码ECC2，在第二缓冲区域BA2中检测到静电放电电流的情况下(即，由第二静电放电检测电路EDC2检测到静电放电电流的情况下)，决定对于第二缓冲区域BA2的第二IC驱动信息IIC2(即，向第二缓冲模块BB2施加的第二IC驱动信息IIC2)的第二纠错码ECC2，在第三缓冲区域BA3中检测到静电放电电流的情况下(即，由第三静电放电检测电路EDC3检测到静电放电电流的情况下)，决定对于第三缓冲区域BA3的第二IC驱动信息IIC2(即，向第三缓冲模块BB3施加的第二IC驱动信息IIC2)的第二纠错码ECC2。
纠错码比较部1240可以比较对于检测到静电放电电流的缓冲区域BA的第一IC驱动信息IIC1的第一纠错码ECC1和对于检测到静电放电电流的缓冲区域BA的第二IC驱动信息IIC2的第二纠错码ECC2。纠错码比较部1240可以在对于检测到静电放电电流的缓冲区域BA的第一IC驱动信息IIC1的第一纠错码ECC1和对于检测到静电放电电流的缓冲区域BA的第二IC驱动信息IIC2的第二纠错码ECC2不同的情况下，向外部存储器装置1110施加重新加载信号RS。外部存储器装置1110可以响应于重新加载信号RS，向内部存储器装置1210施加对于检测到静电放电电流的缓冲区域BA的第一IC驱动信息IIC1。内部存储器装置1210可以接收对于检测到静电放电电流的缓冲区域BA的第一IC驱动信息IIC1，利用对于检测到静电放电电流的缓冲区域BA的第一IC驱动信息IIC1更新对于检测到静电放电电流的缓冲区域BA的第二IC驱动信息IIC2。即，内部存储器装置1210可以在对于检测到静电放电电流的缓冲区域BA的第一IC驱动信息IIC1的第一纠错码ECC1和对于检测到静电放电电流的缓冲区域BA的第二IC驱动信息IIC2的第二纠错码ECC2不同的情况下，利用对于检测到静电放电电流的缓冲区域BA的第一IC驱动信息IIC1更新对于检测到静电放电电流的缓冲区域BA的第二IC驱动信息IIC2。因此，可以仅更新对于检测到静电放电电流的缓冲区域BA的第二IC驱动信息IIC2。
例如，如图6所示，缓冲部1220(即多个缓冲区域BA)可以具有第一缓冲区域BA1、第二缓冲区域BA2以及第三缓冲区域BA3，第一缓冲区域BA1可以包括第一缓冲模块BB1以及与第一缓冲模块BB1及第二缓冲模块BB2相邻的第一静电放电检测电路EDC1，第二缓冲区域BA2可以包括第二缓冲模块BB2以及与第二缓冲模块BB2相邻的第二静电放电检测电路EDC2，第三缓冲区域BA3可以包括第三缓冲模块BB3以及与第二缓冲模块BB2及第三缓冲模块BB3相邻的第三静电放电检测电路EDC3。在一实施例中，纠错码运算部1230可以在第一缓冲区域BA1中检测到静电放电电流的情况下决定对于第一缓冲区域BA1和第二缓冲区域BA2的第二IC驱动信息IIC2的第二纠错码ECC2，在第二缓冲区域BA2中检测到静电放电电流的情况下决定对于第二缓冲区域BA2的第二IC驱动信息IIC2的第二纠错码ECC2，并且在第三缓冲区域BA3中检测到静电放电电流的情况下决定对于第二缓冲区域BA2和第三缓冲区域BA3的第二IC驱动信息IIC2的第二纠错码ECC2。因此，显示装置可以更新对于虽然不包括检测静电放电电流的静电放电检测电路EDC但是与检测静电放电电流的静电放电检测电路EDC相邻的缓冲区域BA的第二IC驱动信息IIC2。
参照图5和图6，在一实施例中，纠错码运算部1230可以在从主处理器接收到更新信号US的情况下，决定对于根据更新信号US决定的缓冲区域BA的第二IC驱动信息IIC2的第二纠错码ECC2。纠错码运算部1230可以与根据更新信号US决定的缓冲区域BA中的静电放电电流的检测与否无关地决定对于根据更新信号US决定的缓冲区域BA的第二IC驱动信息IIC2的第二纠错码ECC2。纠错码比较部1240可以在对于根据更新信号US决定的缓冲区域BA的第一IC驱动信息IIC1的第一纠错码ECC1和对于根据更新信号US决定的缓冲区域BA的第二IC驱动信息IIC2的第二纠错码ECC2不同的情况下，向外部存储器装置1110施加重新加载信号RS。即，显示装置可以在从主处理器接收到更新信号US的情况下，与根据更新信号US决定的缓冲区域BA中的静电放电电流的检测与否无关地比较对于根据更新信号US决定的缓冲区域BA的第一IC驱动信息IIC1和对于根据更新信号US决定的缓冲区域BA的第二IC驱动信息IIC2，根据比较结果，更新存储在内部存储器装置1210中的对于根据更新信号US决定的缓冲区域BA的第二IC驱动信息IIC2。
图7是表示本发明的实施例涉及的显示装置的框图，图8是表示图7的显示装置的电源箝位电路1211、检测信号生成部1260以及纠错码运算部1230的一例的电路图。
本实施例涉及的显示装置除了静电放电电流的检测以外与图1的显示装置1000的构成实质上相同，因此对于相同或类似的构成要素使用相同的符号和标记，省略重复的说明。其中，用R4和C2表示检测部1212的第一电阻和第一电容器。
参照图7，显示装置可以包括配置在IC区域1200中且存储复制第一IC驱动信息IIC1生成的第二IC驱动信息IIC2的内部存储器装置1210，内部存储器装置1210包括检测静电放电电流的电源箝位电路1211。显示装置可以包括配置在IC区域1200中且接收第二IC驱动信息IIC2的缓冲部1220。
电源箝位电路1211可以检测静电放电电流，向纠错码运算部1230和外部存储器装置1110施加检测静电放电电流来生成的检测信号DS。在一实施例中，电源箝位电路1211可以通过检测信号生成部1260向纠错码运算部1230和外部存储器装置1110施加检测信号DS。
例如，电源箝位电路1211可以包括检测静电放电电流的检测部1212、提供静电放电电流的放电路径的放电部1214以及控制放电部1214的控制电路1213。检测部1212可以包括：第一电阻R4，包括被施加第一存储器电压MV的第一电极以及与第一电容器C2连接的第二电极；以及第一电容器C2，包括与第一电阻R4的第二电极连接的第一电极以及被施加第二存储器电压MGND的第二电极。放电部1214可以包括：放电晶体管DCT，包括与控制电路1213连接的控制电极、被施加第一存储器电压MV的第一电极以及被施加第二存储器电压MGND的第二电极。控制电路1213可以包括：转换器INV，包括与第一电容器C2的第一电极连接的第一电极以及与放电晶体管DCT的控制电极连接的第二电极。检测信号生成部1260可以包括：与逻辑电路AND，包括被施加具有高电压电平的高电压VH的第一输入端、与转换器INV的第二电极连接的第二输入端以及与纠错码运算部1230连接的输出端。
例如，假设第一存储器电压MV具有高电压电平并且第二存储器电压MGND具有低电压电平，则在静电放电电流流入被施加第二存储器电压MGND的线的情况下，第一电容器C2的第一电极的电压可以具有低电压电平。由此，可以向转换器INV的输出端施加高电压电平。通过向与逻辑电路AND的第二输入端施加高电压电平，从而与逻辑电路AND可以向纠错码运算部1230和外部存储器装置1110输出具有1的值的检测信号DS。此外，放电晶体管DCT可以被导通，从而对静电放电电流进行放电(即，放电晶体管DCT可以提供放电路径)。因此，电源箝位电路1211不仅可以检测在内部存储器装置1210中产生的静电放电电流，还可以对在内部存储器装置1210中产生的静电放电电流进行放电。
图9是表示本发明的实施例涉及的显示装置的印刷电路基板区域1100和IC区域1200的一例的框图。
本实施例涉及的显示装置除了基于更新信号US的操作以外与图7的显示装置的构成实质上相同，因此对于相同或类似的构成要素使用相同的符号和标记，省略重复的说明。
参照图9，纠错码运算部1230可以在从主处理器接收到更新信号US的情况下，决定第二纠错码ECC2。纠错码运算部1230可以在接收到更新信号US的情况下，与静电放电电流的检测与否无关地决定第二纠错码ECC2。纠错码比较部1240可以在第一纠错码ECC1和第二纠错码ECC2不同的情况下向外部存储器装置1110施加重新加载信号RS。即，显示装置可以在从主处理器接收到更新信号US的情况下，与静电放电电流的检测与否无关地，比较第一IC驱动信息IIC1和第二IC驱动信息IIC2，根据比较结果，更新存储在内部存储器装置1210中的第二IC驱动信息IIC2。
本发明可以适用于显示装置以及包括其的电子设备中。例如，本发明可以适用于数字TV、3D TV、移动电话、智能电话、平板计算机、VR设备、PC、家用电子设备、笔记本计算机、PDA、PMP、数码相机、音乐播放器、便携式游戏机、导航仪等中。
以上，参照实施例进行了说明，但是本领域技术人员应当能够理解在不超出权利要求书所记载的本发明的思想和领域的范围内可以对本发明进行各种修正以及变更。

Claims (20)

1.一种显示装置，其特征在于，包括：
外部存储器装置，配置在印刷电路基板区域中且存储第一IC驱动信息；
内部存储器装置，配置在IC区域中且存储复制所述第一IC驱动信息而生成的第二IC驱动信息；
缓冲部，配置在所述IC区域中且接收所述第二IC驱动信息，检测静电放电电流；
纠错码运算部，配置在所述IC区域中，在检测到所述静电放电电流的情况下，决定所述第一IC驱动信息的第一纠错码，并决定所述第二IC驱动信息的第二纠错码；以及
纠错码比较部，配置在所述IC区域中，比较所述第一纠错码和所述第二纠错码，
所述内部存储器装置根据所述第一纠错码和所述第二纠错码的比较结果，利用所述第一IC驱动信息选择性地更新所述第二IC驱动信息。
2.根据权利要求1所述的显示装置，其特征在于，还包括：
显示面板，包括像素；
栅极驱动部，向所述像素施加栅极信号；
数据驱动部，配置在所述IC区域中且包括所述缓冲部，向所述像素施加数据电压；以及
驱动控制部，配置在所述IC区域中且包括所述纠错码运算部和所述纠错码比较部，控制所述栅极驱动部和所述数据驱动部。
3.根据权利要求1所述的显示装置，其特征在于，
所述内部存储器装置在所述第一纠错码和所述第二纠错码不同的情况下，利用所述第一IC驱动信息更新所述第二IC驱动信息。
4.根据权利要求1所述的显示装置，其特征在于，
所述内部存储器装置在所述显示装置通电或解除睡眠时利用所述第一IC驱动信息更新所述第二IC驱动信息。
5.根据权利要求1所述的显示装置，其特征在于，
所述纠错码运算部在从主处理器接收更新信号的情况下，决定所述第二纠错码。
6.根据权利要求1所述的显示装置，其特征在于，
所述缓冲部包括：
多个缓冲区域，所述多个缓冲区域中的每一个包括接收所述第二IC驱动信息的缓冲模块；以及
静电放电检测电路，检测所述静电放电电流。
7.根据权利要求6所述的显示装置，其特征在于，
所述纠错码运算部决定对于检测到所述静电放电电流的所述缓冲区域的所述第二IC驱动信息的所述第二纠错码，
所述纠错码比较部比较对于检测到所述静电放电电流的所述缓冲区域的所述第一IC驱动信息的所述第一纠错码和对于检测到所述静电放电电流的所述缓冲区域的所述第二IC驱动信息的所述第二纠错码，
所述内部存储器装置在对于检测到所述静电放电电流的所述缓冲区域的所述第一IC驱动信息的所述第一纠错码和对于检测到所述静电放电电流的所述缓冲区域的所述第二IC驱动信息的所述第二纠错码不同的情况下，利用对于检测到所述静电放电电流的所述缓冲区域的所述第一IC驱动信息更新对于检测到所述静电放电电流的所述缓冲区域的所述第二IC驱动信息。
8.根据权利要求6所述的显示装置，其特征在于，
所述静电放电检测电路包括：
第一电阻，包括被施加向所述内部存储器装置施加的第一存储器电压的第一电极以及与第一电容器连接的第二电极；
第二电阻，包括与所述第一电容器连接的第一电极以及被施加向所述内部存储器装置施加的第二存储器电压的第二电极；
所述第一电容器，包括与所述第一电阻的所述第二电极连接的第一电极以及与所述第二电阻的所述第一电极连接的第二电极；
第三电阻，包括与所述第二电阻的所述第一电极连接的第一电极以及与比较器连接的第二电极；以及
所述比较器，包括与所述第三电阻的所述第二电极连接的第一输入端、被施加模拟电压的第二输入端以及与所述纠错码运算部连接的输出端。
9.根据权利要求6所述的显示装置，其特征在于，
所述纠错码运算部在从主处理器接收更新信号的情况下，决定对于根据所述更新信号决定的所述缓冲区域的所述第二IC驱动信息的所述第二纠错码。
10.根据权利要求1所述的显示装置，其特征在于，
所述缓冲部具有第一缓冲区域、第二缓冲区域以及第三缓冲区域，
所述第一缓冲区域包括第一缓冲模块以及与所述第一缓冲模块及第二缓冲模块相邻的第一静电放电检测电路，
所述第二缓冲区域包括与所述第一缓冲模块相邻的所述第二缓冲模块以及与所述第二缓冲模块相邻的第二静电放电检测电路，
所述第三缓冲区域包括与所述第二缓冲模块相邻的第三缓冲模块以及与所述第二缓冲模块及所述第三缓冲模块相邻的第三静电放电检测电路。
11.根据权利要求10所述的显示装置，其特征在于，
所述纠错码运算部
在所述第一缓冲区域中检测到所述静电放电电流的情况下，决定对于所述第一缓冲区域和所述第二缓冲区域的所述第二IC驱动信息的所述第二纠错码，
在所述第二缓冲区域中检测到所述静电放电电流的情况下，决定对于所述第二缓冲区域的所述第二IC驱动信息的所述第二纠错码，
在所述第三缓冲区域中检测到所述静电放电电流的情况下，决定对于所述第二缓冲区域及所述第三缓冲区域的所述第二IC驱动信息的所述第二纠错码。
12.根据权利要求1所述的显示装置，其特征在于，
所述纠错码运算部包括：
延时缓冲器，从所述缓冲部接收检测信号且使所述检测信号延迟；以及
纠错码运算电路，从所述延时缓冲器接收所述检测信号，响应于所述检测信号而决定所述第一IC驱动信息的所述第一纠错码和所述第二IC驱动信息的所述第二纠错码。
13.根据权利要求1所述的显示装置，其特征在于，
所述第一纠错码是所述第一IC驱动信息的校验和值，
所述第二纠错码是所述第二IC驱动信息的校验和值。
14.一种显示装置，其特征在于，包括：
外部存储器装置，配置在印刷电路基板区域中且存储第一IC驱动信息；
内部存储器装置，配置在IC区域中且存储复制所述第一IC驱动信息生成的第二IC驱动信息，并且包括检测静电放电电流的电源箝位电路；
缓冲部，配置在所述IC区域中且接收所述第二IC驱动信息；
纠错码运算部，配置在所述IC区域中，在检测到所述静电放电电流的情况下，决定所述第一IC驱动信息的第一纠错码，并且决定所述第二IC驱动信息的第二纠错码；以及
纠错码比较部，配置在所述IC区域中且比较所述第一纠错码和所述第二纠错码，
所述内部存储器装置根据所述第一纠错码和所述第二纠错码的比较结果，利用所述第一IC驱动信息选择性地更新所述第二IC驱动信息。
15.根据权利要求14所述的显示装置，其特征在于，
所述电源箝位电路包括：
检测部，检测所述静电放电电流；
放电部，提供所述静电放电电流的放电路径；以及
控制电路，控制所述放电部。
16.根据权利要求15所述的显示装置，其特征在于，
所述检测部包括：
第一电阻，包括被施加向所述内部存储器装置施加的第一存储器电压的第一电极以及与第一电容器连接的第二电极；以及
所述第一电容器，包括与所述第一电阻的所述第二电极连接的第一电极以及被施加向所述内部存储器装置施加的第二存储器电压的第二电极，
所述放电部包括：放电晶体管，包括与所述控制电路连接的控制电极、被施加所述第一存储器电压的第一电极以及被施加所述第二存储器电压的第二电极，
所述控制电路包括：转换器，包括与所述第一电容器的所述第一电极连接的第一电极以及与所述放电晶体管的所述控制电极连接的第二电极。
17.根据权利要求14所述的显示装置，其特征在于，
所述内部存储器装置在所述第一纠错码和所述第二纠错码不同的情况下利用所述第一IC驱动信息更新所述第二IC驱动信息。
18.根据权利要求14所述的显示装置，其特征在于，
所述内部存储器装置在所述显示装置通电或解除睡眠时利用所述第一IC驱动信息更新所述第二IC驱动信息。
19.根据权利要求14所述的显示装置，其特征在于，
所述纠错码运算部在从主处理器接收更新信号的情况下决定所述第二纠错码。
20.根据权利要求14所述的显示装置，其特征在于，
所述第一纠错码是所述第一IC驱动信息的校验和值，
所述第二纠错码是所述第二IC驱动信息的校验和值。
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