CN114286073B - 一种基于图形编码的视频图像在线检测系统及方法 - Google Patents

一种基于图形编码的视频图像在线检测系统及方法 Download PDF

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Abstract

本发明公开了一种基于图形编码的视频图像在线检测系统及方法，包括视频发送端、视频接收端和FSMC总线；所述视频发送端包含前端视频图像解码器、前端FPGA、前端视频图像编码器、电光转换模块、前端ARM、时钟有效计数器、像素计数器、行计数器和帧频计数器；所述视频接受端包含光电转换模块、后端视频图像解码器、后端FPGA、后端视频图像编码器、后端ARM、时钟有效计数器、像素计数器、行计数器和帧频计数器；本发明通过对视频图像链路上逻辑处理模块和常见视频故障类型进行统一而简单的图形编码，即可针对视频链路出现视频图像异常显示时进行快速在线故障定位，其故障定位准确、快速，无需掉电，不额外增加硬件成本。

Description

一种基于图形编码的视频图像在线检测系统及方法
技术领域
本发明属于视频图像信号处理技术领域，具体涉及一种基于图形编码的视频图像在线检测系统及方法。
背景技术
视频图像在诸如工业视觉、安全监控等领域中扮演着越来越重要的角色，而清晰稳定的视频图像是用户执行环境感知、态势生成、关联事物状态判断、身份估计等任务的关键。使用场景不同，视频链路会有不同，相机与显示设备部署位置亦有差别。当视频图像发生异常时，即使在特定使用场景下，用户每次都需要对视频链路每个环节进行检查，并借助大量标准仪器或者定制化测试设备进行排查与确认。
这种传统的人工故障排查方法不仅耗费了大量的时间与人力，也无法保证时效性和可靠性。
发明内容
有鉴于此，本发明提供了一种基于图形编码的视频图像在线检测系统及方法，能够针对视频链路出现视频图像异常显示时进行快速在线故障定位。
实现本发明的技术方案如下：
一种基于图形编码的视频图像在线检测系统，包括视频发送端、视频接收端和FSMC总线；其中，
所述视频发送端包含前端视频图像解码器、前端FPGA、前端视频图像编码器、电光转换模块、前端ARM、时钟有效计数器、像素计数器、行计数器和帧频计数器；
所述视频接受端包含光电转换模块、后端视频图像解码器、后端FPGA、后端视频图像编码器、后端ARM、时钟有效计数器、像素计数器、行计数器和帧频计数器；
所述FSMC总线用于芯片之间的通信，用于所述前端ARM和后端ARM分别与前端FPGA和后端FPGA通信；
所述前端ARM用于按照既定协议实时解析当前视频源信息，通过所述FSMC总线将解析后的视频源信息发送至所述前端FPGA；
所述前端视频图像解码器为与可见光或热像相机接口编码芯片相匹配的视频图像解码芯片，用于将来自相机的串行差分视频信号转换为并行视频数据，并发送至所述前端FPGA模块；
所述前端FPGA模块用于接收所述前端视频图像解码器产生的并行视频数据，并且根据所述时钟有效计数器、像素计数器、行计数器和帧频计数器的实时统计数据，与前端ARM模块接收到的视频源信息相比较，若存在故障，按照既定协议输出图形编码图像，并以图形编码图像更新所述并行视频数据并输出至所述前端视频图像编码器，否则直接输出所述并行视频数据；
所述前端视频图像编码器用于将来自所述前端FPGA模块的并行视频数据转换为串行差分视频信号，并发送至所述电光转换模块；
所述电光转换模块用于将所述前端视频图像编码器的串行差分视频信号转换成光信号，通过光纤进行传输；
所述光电转换模块用于将接收到光信号转换为串行差分视频信号，并发送至所述后端视频图像解码器；
所述后端视频图像解码器用于将来自所述后端视频图像解码器的串行差分视频信号转换为并行视频数据，并发送至所述后端FPGA模块；
所述后端ARM用于按照既定协议实时解析当前视频源信息，通过所述FSMC总线将解析后的视频源信息发送至所述后端FPGA模块；
所述后端FPGA模块用于接收所述后端视频图像解码器产生的并行视频数据，并且根据所述时钟有效计数器、像素计数器、行计数器和帧频计数器的实时统计数据，与后端ARM模块接收到的视频源信息相比较，若存在故障，按照既定协议输出图形编码图像，并以图形编码图像更新所述并行视频数据并输出至所述后端视频图像编码器，否则直接输出所述并行视频数据；
所述后端视频图像编码器为与显示设备接口解码芯片相匹配的视频图像编码芯片，用于将来自所述后端FPGA模块的并行视频数据转换为LVDS信号，并发送至显示设备；
所述时钟有效计数器用于依据FPGA模块本地时钟信号对并行视频数据的时钟信号进行有效性检测计数统计；
所述像素计数器用于依据视频图像时钟上升沿对并行视频数据的行同步有效信号进行逐行像素点计数统计；
所述行计数器用于在FPGA模块的控制下，对并行视频数据的场同步有效信号进行行数计数统计；
所述帧频计数器用于在FPGA模块的控制下，对并行视频数据的场同步有效信号上升沿进行1秒内上升沿次数统计；
所述图形编码包含故障诊断位置编码和故障诊断类型编码两组图形编码区域；将视频水平向像素数分成五等分，依次编号为B0、B1、E0、E1、E2；其中，B0和B1为故障诊断位置编码，用于区分视频图像在线检测系统诊断结果为前端FPGA或者后端FPGA，E0、E1和E2为故障诊断类型编码，用于区分视频图像故障类型。
进一步地，所述图形编码具体如表1和表2：
表1故障诊断位置编码
表2故障诊断类型编码
所述无效时钟为所述FPGA获取的时钟有效计数器统计的有效性检测计数数据异常，即并行视频数据的时钟信号在规定时间内没有正常翻转；
所述无效时钟型故障类型优先于水平向分辨率不符、垂直向水平分辨率不符和帧频不符故障类型，只有所述FPGA不存在无效时钟型故障时，才会对像素计数器、行计数器和帧频计数器进行统计；
所述水平向分辨率不符为所述FPGA获取的像素计数器统计的有效性检测计数数据与所述ARM处理器发送的当前视频源水平向像素数不符；
所述垂直向分辨率不符为所述FPGA获取的像素计数器统计的有效性检测计数数据与所述ARM处理器发送的当前视频源垂直向像素数不符；
所述帧频不符为所述FPGA获取的像素计数器统计的有效性检测计数数据与所述ARM处理器发送的当前视频源帧频不符；
所述前端FPGA故障点为所述前端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符等故障类型；
所述后端FPGA故障点为所述后端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符等故障类型。
进一步地，当后端FPGA故障点和前端FPGA故障点均存在时，所述后端FPGA故障点所产生的图形编码优先于前端FPGA故障点在显示设备上进行显示。
进一步地，所述并行视频数据为28～32位的视频数据。
进一步地，所述ARM处理器、FSMC总线集成为一个ARM逻辑单元。
进一步地，所述ARM逻辑单元为STM32F207芯片。
进一步地，所述FPGA为XC7K325T芯片。
进一步地，将所述时钟有效计数器、像素计数器、行计数器、帧频计数器与FPGA模块集成为一个逻辑控制模块。
一种应用于权利要求1所述在线检测系统的检测方法，包括以下步骤：
步骤1：所述FPGA模块接收所述ARM处理器发送的当前视频源信息，包括水平向像素数为H、垂直平向像素数为V和帧频为F；
步骤2：所述时钟有效计数器Cv在FPGA模块的控制下，依据所述FPGA本地低频时钟信号对并行视频数据的时钟信号进行时钟有效性检测计数统计；
所述像素计数器Cp在FPGA模块的控制下，依据并行视频数据的时钟上升沿对并行视频数据的行同步有效信号HSACTIVE进行逐行像素点计数统计；
所述行计数器Cl在FPGA模块的控制下，对并行视频数据的场同步有效信号VSACTIVE进行行数计数统计；
所述帧频计数器Cf在FPGA模块的控制下，对并行视频数据的场同步有效信号VSACTIVE上升沿进行1秒内上升沿次数统计；
步骤3：所述前端FPGA获取时钟有效计数器Cv、像素计数器Cp、行计数器Cl和帧频计数器Cf统计的时钟有效性检测计数数据、像素点计数数据、行数计数数据和帧频计数数据，当前端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符等故障类型时，依据故障类型定义进行图形编码10XXX，XXX依据实际故障类型进行填充，否则继续传输前级传输的视频图像；
步骤4：所述后端FPGA获取时钟有效计数器Cv、像素计数器Cp、行计数器Cl和帧频计数器Cf统计的时钟有效性检测计数数据、像素点计数数据、行数计数数据和帧频计数数据，当后端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符等故障类型时，依据故障类型定义进行图形编码01XXX，XXX依据实际故障类型进行填充，否则继续传输前级传输的视频图像；
步骤5：所述后端FPGA检测点发生故障时，不管所述前端FPGA检测点是否发生故障，显示设备显示图形编码01XXX，即诊断出故障疑似范围为相机与所述后端视频图像解码器之间；
若所述前端ARM接受到前端FPGA获取的时钟有效性检测计数数据、像素点计数数据、行数计数数据和帧频计数数据，且四项计数数据均无误，说明前端FPGA检测点没有发生故障，则进一步诊断出故障范围为前端视频图像编码器与所述后端视频图像解码器之间；
所述前端FPGA检测点发生故障时且所述后端FPGA检测点没有发生故障时，显示设备显示图形编码10XXX，即诊断出故障疑似范围为相机与所述前端视频图像解码器之间；
显示设备没有显示视频图像或者图形编码图像，即诊断出故障疑似范围为所述后端视频图像编码器与显示设备之间。
有益效果：
与现有技术相比较，本发明具备如下有益效果：
(1)在线检测系统故障定位准确、定位快速，无需掉电。
(2)基于图形编码的视频图像在线检测系统，图形编码简单，记忆负担较小，仅需在原有视频链路系统中嵌入视频诊断模块，不额外增加硬件成本。
附图说明
图1为本发明方案原理示意图。
图2为本发明的图形编码示意图。
具体实施方式
下面结合附图并举实施例，对本发明进行详细描述。
如图1所示，本发明提供了一种基于图形编码的视频图像在线检测系统，包括视频发送端、视频接收端和FSMC总线；其中，
所述视频发送端包含前端视频图像解码器、前端FPGA、前端视频图像编码器、电光转换模块、前端ARM、时钟有效计数器、像素计数器、行计数器和帧频计数器；
所述视频接受端包含光电转换模块、后端视频图像解码器、后端FPGA、后端视频图像编码器、后端ARM、时钟有效计数器、像素计数器、行计数器和帧频计数器；
所述FSMC总线用于芯片之间的通信，用于所述前端ARM和后端ARM分别与前端FPGA和后端FPGA通信；
所述前端ARM用于按照既定协议实时解析当前视频源信息，通过所述FSMC总线将解析后的视频源信息发送至所述前端FPGA；
所述前端视频图像解码器为与可见光或热像相机接口编码芯片相匹配的视频图像解码芯片，用于将来自相机的串行差分视频信号转换为并行视频数据，并发送至所述前端FPGA模块；
所述前端FPGA模块用于接收所述前端视频图像解码器产生的并行视频数据，并且根据所述时钟有效计数器、像素计数器、行计数器和帧频计数器的实时统计数据，与前端ARM模块接收到的视频源信息相比较，若存在故障，按照既定协议输出图形编码图像，并以图形编码图像更新所述并行视频数据并输出至所述前端视频图像编码器，否则直接输出所述并行视频数据；
所述前端视频图像编码器用于将来自所述前端FPGA模块的并行视频数据转换为串行差分视频信号，并发送至所述电光转换模块；
所述电光转换模块用于将所述前端视频图像编码器的串行差分视频信号转换成光信号，通过光纤进行传输；
所述光电转换模块用于将接收到光信号转换为串行差分视频信号，并发送至所述后端视频图像解码器；
所述后端视频图像解码器用于将来自所述后端视频图像解码器的串行差分视频信号转换为并行视频数据，并发送至所述后端FPGA模块；
所述后端ARM用于按照既定协议实时解析当前视频源信息，通过所述FSMC总线将解析后的视频源信息发送至所述后端FPGA模块；
所述后端FPGA模块用于接收所述后端视频图像解码器产生的并行视频数据，并且根据所述时钟有效计数器、像素计数器、行计数器和帧频计数器的实时统计数据，与后端ARM模块接收到的视频源信息相比较，若存在故障，按照既定协议输出图形编码图像，并以图形编码图像更新所述并行视频数据并输出至所述后端视频图像编码器，否则直接输出所述并行视频数据；
所述后端视频图像编码器为与显示设备接口解码芯片相匹配的视频图像编码芯片，用于将来自所述后端FPGA模块的并行视频数据转换为LVDS信号，并发送至显示设备；
所述时钟有效计数器用于依据FPGA模块本地时钟信号对并行视频数据的时钟信号进行有效性检测计数统计；
所述像素计数器用于依据视频图像时钟上升沿对并行视频数据的行同步有效信号进行逐行像素点计数统计；
所述行计数器用于在FPGA模块的控制下，对并行视频数据的场同步有效信号进行行数计数统计；
所述帧频计数器用于在FPGA模块的控制下，对并行视频数据的场同步有效信号上升沿进行1秒内上升沿次数统计；
所述图形编码包含故障诊断位置编码和故障诊断类型编码两组图形编码区域；如图2所示，将视频水平向像素数分成五等分，依次编号为B0、B1、E0、E1、E2；其中，B0和B1为故障诊断位置编码，用于区分视频图像在线检测系统诊断结果为前端FPGA或者后端FPGA，E0、E1和E2为故障诊断类型编码，用于区分视频图像故障类型。
所述图形编码具体如表1和表2：
表1故障诊断位置编码
表2故障诊断类型编码
所述无效时钟为所述FPGA获取的时钟有效计数器统计的有效性检测计数数据异常，即并行视频数据的时钟信号在规定时间内没有正常翻转；
所述无效时钟型故障类型优先于水平向分辨率不符、垂直向水平分辨率不符和帧频不符故障类型，只有所述FPGA不存在无效时钟型故障时，才会对像素计数器、行计数器和帧频计数器进行统计；
所述水平向分辨率不符为所述FPGA获取的像素计数器统计的有效性检测计数数据与所述ARM处理器发送的当前视频源水平向像素数不符；
所述垂直向分辨率不符为所述FPGA获取的像素计数器统计的有效性检测计数数据与所述ARM处理器发送的当前视频源垂直向像素数不符；
所述帧频不符为所述FPGA获取的像素计数器统计的有效性检测计数数据与所述ARM处理器发送的当前视频源帧频不符；
所述前端FPGA故障点为所述前端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符等故障类型；
所述后端FPGA故障点为所述后端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符等故障类型。
当后端FPGA故障点和前端FPGA故障点均存在时，所述后端FPGA故障点所产生的图形编码优先于前端FPGA故障点在显示设备上进行显示。
所述并行视频数据为28～32位的视频数据。
所述ARM处理器、FSMC总线集成为一个ARM逻辑单元。
所述ARM逻辑单元为STM32F207芯片。
所述FPGA为XC7K325T芯片。
将所述时钟有效计数器、像素计数器、行计数器、帧频计数器与FPGA模块集成为一个逻辑控制模块。
所述的相机、视频发送端、视频接收端可以集成为了一个视频链路。
一种应用于权利要求1所述在线检测系统的检测方法，包括以下步骤：
步骤1：所述FPGA模块接收所述ARM处理器发送的当前视频源信息，包括水平向像素数为H、垂直平向像素数为V和帧频为F；
步骤2：所述时钟有效计数器Cv在FPGA模块的控制下，依据所述FPGA本地低频时钟信号对并行视频数据的时钟信号进行时钟有效性检测计数统计；
所述像素计数器Cp在FPGA模块的控制下，依据并行视频数据的时钟上升沿对并行视频数据的行同步有效信号HSACTIVE进行逐行像素点计数统计；
所述行计数器Cl在FPGA模块的控制下，对并行视频数据的场同步有效信号VSACTIVE进行行数计数统计；
所述帧频计数器Cf在FPGA模块的控制下，对并行视频数据的场同步有效信号VSACTIVE上升沿进行1秒内上升沿次数统计；
步骤3：所述前端FPGA获取时钟有效计数器Cv、像素计数器Cp、行计数器Cl和帧频计数器Cf统计的时钟有效性检测计数数据、像素点计数数据、行数计数数据和帧频计数数据，当前端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符等故障类型时，依据故障类型定义进行图形编码(10XXX)，XXX依据实际故障类型进行填充，否则继续传输前级传输的视频图像；
步骤4：所述后端FPGA获取时钟有效计数器Cv、像素计数器Cp、行计数器Cl和帧频计数器Cf统计的时钟有效性检测计数数据、像素点计数数据、行数计数数据和帧频计数数据，当后端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符等故障类型时，依据故障类型定义进行图形编码(01XXX)，XXX依据实际故障类型进行填充，否则继续传输前级传输的视频图像；
步骤5：所述后端FPGA检测点发生故障时，不管所述前端FPGA检测点是否发生故障，显示设备显示图形编码(01XXX)，即诊断出故障疑似范围为相机与所述后端视频图像解码器之间；
若所述前端ARM接受到前端FPGA获取的时钟有效性检测计数数据、像素点计数数据、行数计数数据和帧频计数数据，且四项计数数据均无误，说明前端FPGA检测点没有发生故障，则进一步诊断出故障范围为前端视频图像编码器与所述后端视频图像解码器之间；
所述前端FPGA检测点发生故障时且所述后端FPGA检测点没有发生故障时，显示设备显示图形编码(10XXX)，即诊断出故障疑似范围为相机与所述前端视频图像解码器之间；
显示设备没有显示视频图像或者图形编码图像，即诊断出故障疑似范围为所述后端视频图像编码器与显示设备之间。
本发明通过对视频图像链路上FPGA模块和常见视频故障类型进行统一而简单的图形编码，可以在系统不断电的情况下，即可快速诊断出视频图像故障范围，结合故障发生点可在视频链路的位置，查询前一别ARM处理器状态上报信息，可有效缩小视频图像故障范围。
综上所述，以上仅为本发明的较佳实施例而已，并非用于限定本发明的保护范围。凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (9)

1.一种基于图形编码的视频图像在线检测系统，其特征在于，包括视频发送端、视频接收端和FSMC总线；其中，
所述视频发送端包含前端视频图像解码器、前端FPGA、前端视频图像编码器、电光转换模块、前端ARM、时钟有效计数器、像素计数器、行计数器和帧频计数器；
所述视频接收端包含光电转换模块、后端视频图像解码器、后端FPGA、后端视频图像编码器、后端ARM、时钟有效计数器、像素计数器、行计数器和帧频计数器；
所述FSMC总线用于所述前端ARM和后端ARM分别与前端FPGA和后端FPGA的通信；
所述前端ARM用于按照既定协议实时解析当前视频源信息，通过所述FSMC总线将解析后的视频源信息发送至所述前端FPGA；
所述前端视频图像解码器用于将来自相机的串行差分视频信号转换为并行视频数据，并发送至所述前端FPGA；
所述前端FPGA用于接收所述前端视频图像解码器产生的并行视频数据，并且根据所述时钟有效计数器、像素计数器、行计数器和帧频计数器的实时统计数据，与前端ARM接收到的视频源信息相比较，若存在故障，按照既定协议输出图形编码图像，并以图形编码图像更新所述并行视频数据并输出至所述前端视频图像编码器，否则直接输出所述并行视频数据；
所述前端视频图像编码器用于将来自所述前端FPGA的并行视频数据转换为串行差分视频信号，并发送至所述电光转换模块；
所述电光转换模块用于将所述前端视频图像编码器的串行差分视频信号转换成光信号，通过光纤进行传输；
所述光电转换模块用于将接收到光信号转换为串行差分视频信号，并发送至所述后端视频图像解码器；
所述后端视频图像解码器用于将来自所述后端视频图像解码器的串行差分视频信号转换为并行视频数据，并发送至所述后端FPGA；
所述后端ARM用于按照既定协议实时解析当前视频源信息，通过所述FSMC总线将解析后的视频源信息发送至所述后端FPGA；
所述后端FPGA用于接收所述后端视频图像解码器产生的并行视频数据，并且根据所述时钟有效计数器、像素计数器、行计数器和帧频计数器的实时统计数据，与后端ARM接收到的视频源信息相比较，若存在故障，按照既定协议输出图形编码图像，并以图形编码图像更新所述并行视频数据并输出至所述后端视频图像编码器，否则直接输出所述并行视频数据；
所述后端视频图像编码器用于将来自所述后端FPGA的并行视频数据转换为LVDS信号，并发送至显示设备；
所述时钟有效计数器用于依据前端或后端FPGA本地时钟信号对并行视频数据的时钟信号进行有效性检测计数统计；
所述像素计数器用于依据视频图像时钟上升沿对并行视频数据的行同步有效信号进行逐行像素点计数统计；
所述行计数器用于在前端或后端FPGA的控制下，对并行视频数据的场同步有效信号进行行数计数统计；
所述帧频计数器用于在前端或后端FPGA的控制下，对并行视频数据的场同步有效信号上升沿进行1秒内上升沿次数统计；
所述图形编码包含故障诊断位置编码和故障诊断类型编码两组图形编码区域；将视频水平向像素数分成五等分，依次编号为B0、B1、E0、E1、E2；其中，B0和B1为故障诊断位置编码，用于区分视频图像在线检测系统诊断结果为前端FPGA或者后端FPGA，E0、E1和E2为故障诊断类型编码，用于区分视频图像故障类型。
2.如权利要求1所述的一种基于图形编码的视频图像在线检测系统，其特征在于，所述图形编码具体如表1和表2：
表1故障诊断位置编码
表2故障诊断类型编码
所述无效时钟为所述前端或后端FPGA获取的时钟有效计数器统计的有效性检测计数数据异常，即并行视频数据的时钟信号在规定时间内没有正常翻转；
所述无效时钟型故障类型优先于水平向分辨率不符、垂直向水平分辨率不符和帧频不符故障类型，只有所述前端或后端FPGA不存在无效时钟型故障时，才会对像素计数器、行计数器和帧频计数器进行统计；
所述水平向分辨率不符为所述前端或后端FPGA获取的像素计数器统计的有效性检测计数数据与所述前端或后端ARM发送的当前视频源水平向像素数不符；
所述垂直向分辨率不符为所述前端或后端FPGA获取的像素计数器统计的有效性检测计数数据与所述前端或后端ARM发送的当前视频源垂直向像素数不符；
所述帧频不符为所述前端或后端FPGA获取的像素计数器统计的有效性检测计数数据与所述前端或后端ARM发送的当前视频源帧频不符；
所述前端FPGA故障点为所述前端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符故障类型；
所述后端FPGA故障点为所述后端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符故障类型。
3.如权利要求2所述的一种基于图形编码的视频图像在线检测系统，其特征在于，当后端FPGA故障点和前端FPGA故障点均存在时，所述后端FPGA故障点所产生的图形编码优先于前端FPGA故障点在显示设备上进行显示。
4.如权利要求1所述的一种基于图形编码的视频图像在线检测系统，其特征在于，所述并行视频数据为28～32位的视频数据。
5.如权利要求1所述的一种基于图形编码的视频图像在线检测系统，其特征在于，所述前端或后端ARM、FSMC总线集成为一个ARM逻辑单元。
6.如权利要求5所述的一种基于图形编码的视频图像在线检测系统，其特征在于，所述ARM逻辑单元为STM32F207芯片。
7.如权利要求1所述的一种基于图形编码的视频图像在线检测系统，其特征在于，所述前端或后端FPGA为XC7K325T芯片。
8.如权利要求1所述的一种基于图形编码的视频图像在线检测系统，其特征在于，将所述时钟有效计数器、像素计数器、行计数器、帧频计数器与前端或后端FPGA集成为一个逻辑控制模块。
9.一种应用于权利要求1所述在线检测系统的检测方法，其特征在于，包括以下步骤：
步骤1：前端或后端FPGA接收前端或后端ARM发送的当前视频源信息，包括水平向像素数为H、垂直平向像素数为V和帧频为F；
步骤2：所述时钟有效计数器Cv在前端或后端FPGA的控制下，依据所述前端或后端FPGA本地低频时钟信号对并行视频数据的时钟信号进行时钟有效性检测计数统计；
所述像素计数器Cp在前端或后端FPGA的控制下，依据并行视频数据的时钟上升沿对并行视频数据的行同步有效信号HSACTIVE进行逐行像素点计数统计；
所述行计数器Cl在前端或后端FPGA的控制下，对并行视频数据的场同步有效信号VSACTIVE进行行数计数统计；
所述帧频计数器Cf在前端或后端FPGA的控制下，对并行视频数据的场同步有效信号VSACTIVE上升沿进行1秒内上升沿次数统计；
步骤3：所述前端FPGA获取时钟有效计数器Cv、像素计数器Cp、行计数器Cl和帧频计数器Cf统计的时钟有效性检测计数数据、像素点计数数据、行数计数数据和帧频计数数据，当前端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符故障类型时，依据故障类型定义进行图形编码10XXX，XXX依据实际故障类型进行填充，否则继续传输前级传输的视频图像；
步骤4：所述后端FPGA获取时钟有效计数器Cv、像素计数器Cp、行计数器Cl和帧频计数器Cf统计的时钟有效性检测计数数据、像素点计数数据、行数计数数据和帧频计数数据，当后端FPGA检测出无效时钟、水平向分辨率不符、垂直向分辨率不符或者帧频不符故障类型时，依据故障类型定义进行图形编码01XXX，XXX依据实际故障类型进行填充，否则继续传输前级传输的视频图像；
步骤5：所述后端FPGA检测点发生故障时，不管所述前端FPGA检测点是否发生故障，显示设备显示图形编码01XXX，即诊断出故障疑似范围为相机与所述后端视频图像解码器之间；
若所述前端ARM接受到前端FPGA获取的时钟有效性检测计数数据、像素点计数数据、行数计数数据和帧频计数数据，且四项计数数据均无误，说明前端FPGA检测点没有发生故障，则诊断出故障范围为前端视频图像编码器与所述后端视频图像解码器之间；
所述前端FPGA检测点发生故障时且所述后端FPGA检测点没有发生故障时，显示设备显示图形编码10XXX，即诊断出故障疑似范围为相机与所述前端视频图像解码器之间；
显示设备没有显示视频图像或者图形编码图像，即诊断出故障疑似范围为所述后端视频图像编码器与显示设备之间。
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