CN114138055A - 一种直流b码转换为电力系统串口时间报文的方法及其装置 - Google Patents

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Abstract

本发明属于时间同步技术领域，具体涉及一种直流B码转换为电力系统串口时间报文的方法及装置。主旨在于解决传统方法采用CPU转换模式精度低、成本高的问题，本发明电力系统串口时间报文信号时间准确度可达到优于1μs。主要方案包括10倍频模块、码元识别模块、B码信息解析模块、秒准时沿提取模块、1PPS生成模块、时间修正模块、串口时间报文编码模块、串口时间报文发送模块、串行接口驱动电路。除串行接口驱动电路以外，其余模块均由FPGA实现。本发明采用FPGA实现直流B码转换为电力系统串口时间报文，实现高精度串口时间报文信号输出，不使用CPU，硬件架构简单，稳定可靠，成本低廉，装置可以做到小型化、模块化，应用灵活，扩展性好。

Description

一种直流B码转换为电力系统串口时间报文的方法及其装置
技术领域
本发明属于时间同步技术领域，具体涉及一种直流B码转换为电力系统串口时间报文的方法及装置。
背景技术
IRIG是美国靶场司令部委员会的下属机构靶场仪器组的简称(Inter-RangeInstrumentation Group)。IRIG串行时间码，共有六种格式，即A、B、D、E、 G、H，其中IRIG-B格式时间码(以下简称B码)应用最为广泛。B码的时帧速率为1帧/s，包含100位信息，分别表示BCD时间信息和控制功能信息，同时也可从中提取1Hz和100Hz脉冲信号。
在实际应用中，连接时间同步装置和被授时二次设备之间的时间信号传输介质通常为双绞线或光纤，信号类型通常是IRIG-B(DC)(直流B码)。
直流B码和电力系统串口时间报文是电力系统常用的对时方式，它们的共同特点是：接口简单，信息全面(包含时间质量、闰秒信息、夏时制信息和时区信息)。它们的区别是：直流B码通常由逻辑电路输出，输出信号精度高，常用于嵌入式设备对时；电力系统串口时间报文通常由CPU输出，输出信号精度低，补偿算法复杂，常用于服务器或工作站对时。
本发明针对串口时间报文输出信号精度低、补偿算法复杂的应用不足，采用FPGA实现直流B码直接转换生成串口时间报文，实现高精度的串口时间报文信号输出。另一方面，本发明不使用CPU，硬件架构简单、成本低、可靠性高，装置可以做到小型模块化，扩展性好。
发明内容
本发明所要解决的技术问题是提供一种直流B码转换为电力系统串口时间报文的方法及其装置，解决传统方法采用CPU转换模式精度低、成本高的问题，本发明电力系统串口时间报文信号时间准确度可达到优于1μs。
本发明为了实现上述目的采用以下技术手段：
本发明提供了一种直流B码转换为电力系统串口时间报文的装置，包括以下模板：
10倍频模块：采用FPGA内部自带的时钟管理模块将外部输入的10MHz信号倍频到100MHz，供码元识别模块、秒准时沿提取模块用作参考时钟信号；
码元识别模块：根据B码的码元特征以10倍频模块输出的100MHz信号作参考对输入的直流B码信号进行码元类型识别，输出串行码元类型信息；
B码信息解析模块：根据所述码元识别模块输出的串行码元类型信息以及秒准时沿提取模块输出的秒准时沿信号，以及直流B码编码规则，解析出直流 B码编码信息；
秒准时沿提取模块：根据码元识别模块输出的串行码元类型信息，判断B 码信息解析模块输出的直流B码编码信息中的码元P的信息位置，根据直流B 码编码规则，确定直流B码的秒准时沿信号；
1PPS生成模块：以秒准时沿提取模块输出的秒准时沿信号，延时1秒生成脉宽为10ms的1PPS信号；
时间修正模块：根据时钟走时规律完成1秒走时，一帧B码信号传输周期为1秒，接收到B码信号并解析出时间、闰秒、夏时制、时区信息，再进行串口时间报文编码，时间已经经过1秒，需要对时间信息作1秒走时处理；
处理时，需根据闰秒规则和夏时制规则，参照B码信息中的闰秒预告、闰秒标志、夏时制预告和夏时制标志信息，做相应的闰秒执行或夏时制调整，执行完成时进行闰秒预告和夏时制预告信息的清除；
串口时间报文编码模块：将时间修正模块输出的包含年、月、日、时、分、秒信息的时间、闰秒预告及闰秒标志、夏时制预告及夏时制标志、时区偏移、时间质量信息，按照电力系统标准时间报文协议进行串口时间报文编码；
串口时间报文发送模块，以所述1PPS生成模块输出的1PPS信号作触发，以电力系统串口时间报文设定的串口参数将串口时间报文编码模块输出的串口时间报文编码输出到串行接口驱动电路。
上述技术方案中，还包括串行接口驱动电路：将所述串口时间报文发送模块发送的串行报文做物理层接口信号转换，以RS-232、RS-485和光纤接口输出电力系统串口时间报文信号。
上述技术方案中，B码编码信息包括包含年、月、日、时、分、秒的时间信息、闰秒预告及闰秒标志信息、夏时制预告及夏时制标志信息、时区偏移信息、时间质量信息。
上述技术方案中，秒准时沿提取模块中出现2个连续的“P”码元“P0”、“Pr”时，“Pr”码元的上升沿为直流B码的秒准时沿信号。
本发明还提供了一种直流B码转换为电力系统串口时间报文的方法，包括如下步骤：
10倍频步骤：采用FPGA内部自带的时钟管理模块将外部输入的10MHz信号倍频到100MHz，供码元识别步骤、秒准时沿提取步骤用作参考时钟信号；
码元识别步骤：根据B码的码元特征以10倍频步骤输出的100MHz信号作参考对输入的直流B码信号进行码元类型识别，输出串行码元类型信息；
B码信息解析步骤：根据所述码元识别步骤输出的串行码元类型信息以及秒准时沿提取步骤输出的秒准时沿信号，以及直流B码编码规则，解析出直流 B码编码信息；
秒准时沿提取步骤：根据码元识别步骤输出的串行码元类型信息，判断B 码信息解析步骤输出的直流B码编码信息中的码元P的信息位置，根据直流B 码编码规则，确定直流B码的秒准时沿信号；
1PPS生成步骤：以所述秒准时沿提取步骤输出的秒准时沿信号，延时1秒生成脉宽为10ms的1PPS信号；
时间修正步骤：根据时钟走时规律完成1秒走时，一帧B码信号传输周期为1秒，接收到B码信号并解析出时间、闰秒、夏时制、时区信息，再进行串口时间报文编码，时间已经经过1秒，需要对时间信息作1秒走时处理；
处理时，需根据闰秒规则和夏时制规则，参照B码信息中的闰秒预告、闰秒标志、夏时制预告和夏时制标志信息，做相应的闰秒执行或夏时制调整，执行完成时进行闰秒预告和夏时制预告信息的清除；
串口时间报文编码步骤：将时间修正步骤输出的包含年、月、日、时、分、秒信息的时间、闰秒预告及闰秒标志、夏时制预告及夏时制标志、时区偏移、时间质量信息，按照电力系统标准时间报文协议进行串口时间报文编码；
串口时间报文发送步骤，以所述1PPS生成步骤输出的1PPS信号作触发，以电力系统串口时间报文设定的串口参数将串口时间报文编码步骤输出的串口时间报文编码输出到串行接口驱动电路。
上述技术方案中，B码编码信息包括包含年、月、日、时、分、秒的时间信息、闰秒预告及闰秒标志信息、夏时制预告及夏时制标志信息、时区偏移信息、时间质量信息。
上述技术方案中，秒准时沿提取步骤中出现2个连续的“P”码元“P0”、“Pr”时，“Pr”码元的上升沿为直流B码的秒准时沿信号。
本发明还提供了一种存储介质，所述存储介质存储有一种直流B码转换为电力系统串口时间报文的程序，FPGA执行所述程序时，实现一种直流B码转换为电力系统串口时间报文的方法。
本发明因为采用上述技术方案，因此具备以下有益效果：
本发明采用FPGA实现直流B码转换为电力系统串口时间报文，实现高精度串口时间报文信号输出，不使用CPU，硬件架构简单，稳定可靠，成本低廉，装置可以做到小型化、模块化，应用灵活，扩展性好。
上述所述方法也同样适用于直流B码转换为其它格式串口时间报文或自定义格式串口时间报文。
附图说明
图1为直流B码转换串口时间报文逻辑框图；
图2为直流B码的码元示意图；
图3为直流B码的准时沿提取时序示意图；
图4为直流B码转换串口时间报文流程框图。
具体实施方式
下面通过实施例对本发明进行具体描述，有必要在此指出的是本实施例只用于对本发明进行进一步说明，不能理解为对本发明保护范围的限制，该领域的技术熟练人员可以根据以上发明的内容做出一些非本质的改进和调整。在不冲突的情况下，本发明中的实施例及实施例中的特征可以相互组合。
本发明解决上述技术问题所采取的技术方案是：直流B码转换为电力系统串口时间报文的方法及装置，包括：10倍频模块、码元识别模块、B码信息解析模块、秒准时沿提取模块、1PPS生成模块、时间修正模块、串口时间报文编码模块、串口时间报文发送模块、串行接口驱动电路。除串行接口驱动电路以外，其余模块均由FPGA实现，如图1所示。
所述10倍频模块，采用FPGA内部自带的时钟管理模块(DCM、DLL或 PLL)，将外部输入的10MHz信号倍频到100MHz，供码元识别模块、秒准时沿提取模块用作参考时钟信号，提高分辨率到10ns。
所述码元识别模块，根据B码的码元特征(码元宽度10ms，码元“P”脉宽8ms、码元“1”脉宽5ms、码元“0”脉宽2ms，如图2所示)对输入的直流B码信号进行码元类型识别。模块采用10倍频模块输出的100MHz时钟信号，判定码元宽度偏差小于200μs且码元脉宽偏差小于200μs的为符合直流 B码码元特征的信号。
所述B码信息解析模块，根据所述码元识别模块输出的串行码元信息以及所述秒准时沿提取模块输出的秒准时沿信号，根据直流B码编码规则，解析出直流B码编码信息，包含时间(年、月、日、时、分、秒)、闰秒预告及闰秒标志、夏时制预告及夏时制标志、时区偏移、时间质量等信息。
所述秒准时沿提取模块，根据码元识别模块输出的串行码元信息，判断码元P的信息位置，根据直流B码编码规则，出现2个连续的“P”码元(P0、 Pr)时，“Pr”码元的上升沿为直流B码的秒准时沿，如图3所示。
所述1PPS生成模块，以所述秒准时沿提取模块输出的秒准时沿信号，延时 1秒生成脉宽为10ms的1PPS信号。
所述时间修正模块，根据时钟走时规律完成1秒走时。因为一帧B码信号传输周期为1秒，接收到信号并解析出时间、闰秒、夏时制、时区等信息，再进行串口时间报文编码，时间已经经过1秒，需要对时间信息作1秒走时处理。处理时，需根据闰秒规则和夏时制规则，参照B码信息中的闰秒预告、闰秒标志、夏时制预告和夏时制标志信息，做相应的闰秒执行或夏时制调整，执行完成时进行闰秒预告和夏时制预告信息的清除。
所述串口时间报文编码模块，将时间修正模块输出的时间(年、月、日、时、分、秒)、闰秒预告及闰秒标志、夏时制预告及夏时制标志、时区偏移、时间质量等信息，按照电力系统标准时间报文协议进行串口时间报文编码。
所述串口时间报文发送模块，以所述1PPS生成模块输出的1PPS信号作触发，以电力系统串口时间报文设定的串口参数将串口时间报文编码模块输出的串口时间报文编码输出到所述串行接口驱动电路。
所述串行接口驱动电路，是将所述串口时间报文发送模块发送的串行报文做物理层接口信号转换，以RS-232、RS-485和光纤接口输出电力系统串口时间报文信号。
实施例
本发明公开一种直流B码转换为电力系统串口时间报文的方法及其装置，如图1所示。装置包括：10倍频模块、码元识别模块、B码信息解析模块、秒准时沿提取模块、1PPS生成模块、时间修正模块、串口时间报文编码模块、串口时间报文发送模块、串行接口驱动电路。除串行接口驱动电路以外，其余模块均由FPGA实现，图4为本发明的直流B码转换为电力系统串口时间报文的流程框图，以下对流程框图做具体说明。
所述直流B码转换串口时间报文装置中含有1个恒温晶振为FPGA提供 10MHz时钟信号，10倍频模块利用FPGA内部自带的时钟管理模块(DCM、 DLL或PLL)将10MHz信号倍频为100MHz时钟信号，以100MHz时钟驱动一个32位计数器Time_ns做1秒计时器，以1秒计时溢出信号驱动一个32位计数器Time_s做累计秒计时，计时周期约为136年，可不考虑计数器溢出的问题；码元识别模块内部设置200个64位寄存器TS_Reg64[200]用于存储B码信号的上升沿和下降沿时间戳，序号为奇数的存储上升沿时间戳，序号为偶数的存储下降沿时间戳；设置一个8位寄存器TS_Index存储时间戳计数值；设置 100个2位寄存器IRIG_B_Reg[100]存储时间戳计数值；设置一个8位寄存器 IRIG_Index存储码元计数值。
装置上电后，码元识别模块初始化寄存器TS_Reg64[200]值为0，初始寄存器TS_Index为1，初始化完成后，对输入的直流B码信号进行检测，在直流B 码电平变换时读取计数器Time_s和Time_ns的计数值组合为64位时间戳，取得上升沿时间戳以后判断TS_Index是否为奇数，是则存入寄存器TS_Reg64[TS _Index],否则认为时序错误，丢弃数值，同时设置寄存器TS_Index为1，重启时序；取得下降沿时间戳以后判断TS_Index是否为偶数，是则存入寄存器TS_ Reg64[TS_Index],否则认为时序错误，丢弃数值，同时设置寄存器TS_Index 为1，重启时序。取得奇数序号时间戳TS_Index_odd且TS_Index_odd大于等于3时，码元识别模块开始做码元正确性判别，用奇数序号的时间戳TS_Reg64 [TS_Index_odd]减去前面相邻奇数序号的时间戳TS_Reg64[TS_Index_odd-2] 计算码元宽度，用偶数序号时间戳TS_Reg64[TS_Index_odd-1]减去其前一序号时间戳TS_Reg64[TS_Index_odd-2]计算码元脉宽，码元宽度误差和码元脉宽误差小于200us的为正常码元，否则认为数据错误，设置寄存器TS_Index 为1，重启时序。码元识别模块将通过正确性判别的码元依据码元定义(见图 2，直流B码的码元示意图)规则解析出码元类型，存储到IRIG_B_Reg[IRIG_I ndex](注：IRIG_Index＝(TS_Index-1)/2)。
秒准时沿提取模块在寄存器IRIG_B_Reg[IRIG_Index]有新数据存入且IRIG_Index大于等于2时检测IRIG_B_Reg[IRIG_Index]和 IRIG_B_Reg[IRIG_Index-1]是否为连续码元P，是则将对应秒准时沿时间戳 TS_Reg64[IRIG_Index*2-1]存储下来，同时置IRIG_Index为2；不是连续码元 P则等待下一次检测。
1PPS生成模块利用两个相邻的秒准时沿时间戳相减得到1s的时钟周期计数NS(s＝1,2…100)。模块采用100个1s时长的计数平均值
Figure BDA0003398616350000071
作为1PPS的周期，来消除信号抖动及测量误差对1s走时的影响，算术平均值
Figure BDA0003398616350000072
为：
Figure BDA0003398616350000073
1PPS生成模块在B码准时沿到来后延时1s生成一个脉宽为10ms的脉冲信号，10ms时长的计数值为
Figure BDA0003398616350000074
B码信息解析模块在码元计数值达到99时，开始解析B码信息，模块根据表1“IRIG-B码码元定义”按位提取码元信息，计算获得秒、分、时、日、月、年、闰秒预告、闰秒标志、夏时制预告、夏时制标志、时区偏移、时间质量信息。
直流B码信号的码元接收和解码需要1秒时间才能完成，时间修正模块需要做1秒走时处理。处理规则如下：
(1)平时，“秒”最大值为59，进位归零；正闰秒时刻来临时，“秒”最大值为60，进位归零(正闰秒处理方式：…→57s→58s→59s→60s →00s→01s→02s→…，即第59分钟总秒数为61秒)；负闰秒时刻来临时，“秒”最大值为58，进位归零(负闰秒处理方式：…→57s→58s→ 00s→01s→02s→…，即第59分钟总秒数为59秒)。闰秒可能发生在北京时间1月1日7时59分、7月1日7时59分两个时间点，闰秒预告标志在闰秒执行后需置0。
(2)“分”最大值为59，进位归零。
(3)“时”最大值为23，进位归零。
(4)“日”的进位，不同的“月”规则不同，首先判定闰年，设定Y为“年”的值，满足下述2种情况之一的年份即为闰年：①Y能被4整除，且不能被100整除，判定为普通闰年；②Y能被400整除，判定为世纪闰年。非闰年1到12月相应的“日”最大值分别为31、28、31、30、31、30、31、31、 30、31、30、31；闰年1到12月相应的“日”最大值分别为31、29、31、 30、31、30、31、31、30、31、30、31，进位归零。
(5)“月”最大值为12，进位归零。
(6)我国在1992年已停止执行夏时制，夏时制预告及夏时制标志可不作处理，串口时间报文编码时信息原值传递。
串口时间报文编码模块在码元计数值达到99，并且完成时间修正后，按如下步骤完成符合表2“电力系统标准时间报文协议”要求的串口时间报文编码：
(1)将帧头符号“#”的ASCII码作为串口时间报文的第1字节；
(2)根据闰秒预告和闰秒标准按位运算组成2位二进制数，并按数值转换为相应ASCII码，作为串口时间报文的第2字节；
(3)根据夏时制预告和夏时制标志、半小时时区偏移、时区偏移符号按位运算组成4位二进制数，并按数值转换为相应ASCII码，作为串口时间报文的第3字节；
(4)取时区偏移信息低四位，并按数值转换为相应ASCII码，作为串口时间报文的第4字节；
(5)将时间质量按数值转换为相应ASCII码，作为串口时间报文的第5字节；
(6)串口时间报文第6字节固定为ASCII码“2”；
(7)串口时间报文第7字节固定为ASCII码“0”；
(8)将年信息的“十”位按数值转换为相应ASCII码，作为串口时间报文的第8字节；
(9)将年信息的“个”位按数值转换为相应ASCII码，作为串口时间报文的第9字节；
(10)将月信息的“十”位按数值转换为相应ASCII码，作为串口时间报文的第10字节；
(11)将月信息的“个”位按数值转换为相应ASCII码，作为串口时间报文的第11字节；
(12)将日信息的“十”位按数值转换为相应ASCII码，作为串口时间报文的第12字节；
(13)将日信息的“个”位按数值转换为相应ASCII码，作为串口时间报文的第13字节；
(14)将时信息的“十”位按数值转换为相应ASCII码，作为串口时间报文的第14字节；
(15)将时信息的“个”位按数值转换为相应ASCII码，作为串口时间报文的第15字节；
(16)将分信息的“十”位按数值转换为相应ASCII码，作为串口时间报文的第16字节；
(17)将分信息的“个”位按数值转换为相应ASCII码，作为串口时间报文的第17字节；
(18)将秒信息的“十”位按数值转换为相应ASCII码，作为串口时间报文的第18字节；
(19)将秒信息的“个”位按数值转换为相应ASCII码，作为串口时间报文的第19字节；
(20)将串口时间报文的第2字节至第19字节的总数18个字节逐字节异或运算，将运算结果的高四位按数值转换为相应ASCII码，作为串口时间报文的第20字节，将运算结果的低四位按数值转换为相应ASCII码，作为串口时间报文的第21字节；
(21)串口时间报文第22字节固定为数值0D；
(22)串口时间报文第23字节固定为数值0A。
串口时间报文发送模块在1PPS生成模块输出的1PPS信号上升沿到来时，以设定的串口参数将串口时间报文编码模块输出的报文发送到串行接口驱动电路。
串行接口驱动电路完成串行报文信号的物理层接口转换，以RS-232、RS- 485和光纤接口输出电力系统串口时间报文信号。
表1IRIG-B码码元定义
Figure BDA0003398616350000101
Figure BDA0003398616350000111
Figure BDA0003398616350000121
Figure BDA0003398616350000131
表2电力系统标准时间报文协议
Figure BDA0003398616350000132
Figure BDA0003398616350000141
Figure BDA0003398616350000151
Figure BDA0003398616350000161

Claims (8)

1.一种直流B码转换为电力系统串口时间报文的装置，其特征在于，包括以下模块：
10倍频模块：采用FPGA内部自带的时钟管理模块将外部输入的10MHz信号倍频到100MHz，供码元识别模块、秒准时沿提取模块用作参考时钟信号；
码元识别模块：根据B码的码元特征以10倍频模块输出的100MHz信号作参考对输入的直流B码信号进行码元类型识别，输出串行码元类型信息；
B码信息解析模块：根据所述码元识别模块输出的串行码元类型信息以及秒准时沿提取模块输出的秒准时沿信号，以及直流B码编码规则，解析出直流B码编码信息；
秒准时沿提取模块：根据码元识别模块输出的串行码元类型信息，判断B码信息解析模块输出的直流B码编码信息中的码元P的信息位置，根据直流B码编码规则，确定直流B码的秒准时沿信号；
1PPS生成模块：以秒准时沿提取模块输出的秒准时沿信号，延时1秒生成脉宽为10ms的1PPS信号；
时间修正模块：根据时钟走时规律完成1秒走时，一帧B码信号传输周期为1秒，接收到B码信号并解析出时间、闰秒、夏时制、时区信息，再进行串口时间报文编码，时间已经经过1秒，需要对时间信息作1秒走时处理；
处理时，需根据闰秒规则和夏时制规则，参照B码信息中的闰秒预告、闰秒标志、夏时制预告和夏时制标志信息，做相应的闰秒执行或夏时制调整，执行完成时进行闰秒预告和夏时制预告信息的清除；
串口时间报文编码模块：将时间修正模块输出的包含年、月、日、时、分、秒信息的时间、闰秒预告及闰秒标志、夏时制预告及夏时制标志、时区偏移、时间质量信息，按照电力系统标准时间报文协议进行串口时间报文编码；
串口时间报文发送模块，以所述1PPS生成模块输出的1PPS信号作触发，以电力系统串口时间报文设定的串口参数将串口时间报文编码模块输出的串口时间报文编码输出到串行接口驱动电路。
2.根据权利要求1所述的一种直流B码转换为电力系统串口时间报文的装置，其特征在于，还包括串行接口驱动电路：将所述串口时间报文发送模块发送的串行报文做物理层接口信号转换，以RS-232、RS-485和光纤接口输出电力系统串口时间报文信号。
3.根据权利要求1所述的一种直流B码转换为电力系统串口时间报文的装置，其特征在于，B码编码信息包括包含年、月、日、时、分、秒的时间信息、闰秒预告及闰秒标志信息、夏时制预告及夏时制标志信息、时区偏移信息、时间质量信息。
4.根据权利要求1所述的一种直流B码转换为电力系统串口时间报文的装置，其特征在于，秒准时沿提取模块中出现2个连续的“P”码元“P0”、“Pr”时，“Pr”码元的上升沿为直流B码的秒准时沿信号。
5.一种直流B码转换为电力系统串口时间报文的方法，其特征在于，包括如下步骤：
10倍频步骤：采用FPGA内部自带的时钟管理模块将外部输入的10MHz信号倍频到100MHz，供码元识别步骤、秒准时沿提取步骤用作参考时钟信号；
码元识别步骤：根据B码的码元特征以10倍频步骤输出的100MHz信号作参考对输入的直流B码信号进行码元类型识别，输出串行码元类型信息；
B码信息解析步骤：根据所述码元识别步骤输出的串行码元类型信息以及秒准时沿提取步骤输出的秒准时沿信号，以及直流B码编码规则，解析出直流B码编码信息；
秒准时沿提取步骤：根据码元识别步骤输出的串行码元类型信息，判断B码信息解析步骤输出的直流B码编码信息中的码元P的信息位置，根据直流B码编码规则，确定直流B码的秒准时沿信号；
1PPS生成步骤：以所述秒准时沿提取步骤输出的秒准时沿信号，延时1秒生成脉宽为10ms的1PPS信号；
时间修正步骤：根据时钟走时规律完成1秒走时，一帧B码信号传输周期为1秒，接收到B码信号并解析出时间、闰秒、夏时制、时区信息，再进行串口时间报文编码，时间已经经过1秒，需要对时间信息作1秒走时处理；
处理时，需根据闰秒规则和夏时制规则，参照B码信息中的闰秒预告、闰秒标志、夏时制预告和夏时制标志信息，做相应的闰秒执行或夏时制调整，执行完成时进行闰秒预告和夏时制预告信息的清除；
串口时间报文编码步骤：将时间修正步骤输出的包含年、月、日、时、分、秒信息的时间、闰秒预告及闰秒标志、夏时制预告及夏时制标志、时区偏移、时间质量信息，按照电力系统标准时间报文协议进行串口时间报文编码；
串口时间报文发送步骤，以所述1PPS生成步骤输出的1PPS信号作触发，以电力系统串口时间报文设定的串口参数将串口时间报文编码步骤输出的串口时间报文编码输出到串行接口驱动电路。
6.根据权利要求5所述的一种直流B码转换为电力系统串口时间报文的方法，其特征在于，B码编码信息包括包含年、月、日、时、分、秒的时间信息、闰秒预告及闰秒标志信息、夏时制预告及夏时制标志信息、时区偏移信息、时间质量信息。
7.根据权利要求5所述的一种直流B码转换为电力系统串口时间报文的方法，其特征在于，秒准时沿提取步骤中出现2个连续的“P”码元“P0”、“Pr”时，“Pr”码元的上升沿为直流B码的秒准时沿信号。
8.一种存储介质，其特征在于，所述存储介质存储有一种直流B码转换为电力系统串口时间报文的程序，FPGA执行所述程序时，实现如权利要求5-7任一所述的一种直流B码转换为电力系统串口时间报文的方法。
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