CN114080596A - 用于存储器的数据保护方法及其存储装置 - Google Patents

用于存储器的数据保护方法及其存储装置 Download PDF

Info

Publication number
CN114080596A
CN114080596A CN202180002928.1A CN202180002928A CN114080596A CN 114080596 A CN114080596 A CN 114080596A CN 202180002928 A CN202180002928 A CN 202180002928A CN 114080596 A CN114080596 A CN 114080596A
Authority
CN
China
Prior art keywords
valid
address pointers
memory
blocks
address
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
CN202180002928.1A
Other languages
English (en)
Inventor
陈永刚
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Yangtze Memory Technologies Co Ltd
Original Assignee
Yangtze Memory Technologies Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Yangtze Memory Technologies Co Ltd filed Critical Yangtze Memory Technologies Co Ltd
Publication of CN114080596A publication Critical patent/CN114080596A/zh
Pending legal-status Critical Current

Links

Images

Classifications

    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
    • G06F3/0601—Interfaces specially adapted for storage systems
    • G06F3/0668—Interfaces specially adapted for storage systems adopting a particular infrastructure
    • G06F3/0671—In-line storage system
    • G06F3/0683—Plurality of storage devices
    • G06F3/0689—Disk arrays, e.g. RAID, JBOD
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
    • G06F3/0601—Interfaces specially adapted for storage systems
    • G06F3/0668—Interfaces specially adapted for storage systems adopting a particular infrastructure
    • G06F3/0671—In-line storage system
    • G06F3/0673—Single storage device
    • G06F3/0679—Non-volatile semiconductor memory device, e.g. flash memory, one time programmable memory [OTP]
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00—Error detection; Error correction; Monitoring
    • G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/08—Error detection or correction by redundancy in data representation, e.g. by using checking codes
    • G06F11/10—Adding special bits or symbols to the coded information, e.g. parity check, casting out 9's or 11's
    • G06F11/1008—Adding special bits or symbols to the coded information, e.g. parity check, casting out 9's or 11's in individual solid state devices
    • G06F11/1068—Adding special bits or symbols to the coded information, e.g. parity check, casting out 9's or 11's in individual solid state devices in sector programmable memories, e.g. flash disk
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
    • G06F3/0601—Interfaces specially adapted for storage systems
    • G06F3/0602—Interfaces specially adapted for storage systems specifically adapted to achieve a particular effect
    • G06F3/0614—Improving the reliability of storage systems
    • G06F3/0619—Improving the reliability of storage systems in relation to data integrity, e.g. data losses, bit errors
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
    • G06F3/0601—Interfaces specially adapted for storage systems
    • G06F3/0602—Interfaces specially adapted for storage systems specifically adapted to achieve a particular effect
    • G06F3/062—Securing storage systems
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
    • G06F3/0601—Interfaces specially adapted for storage systems
    • G06F3/0628—Interfaces specially adapted for storage systems making use of a particular technique
    • G06F3/0638—Organizing or formatting or addressing of data
    • G06F3/064—Management of blocks
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C29/00—Checking stores for correct operation ; Subsequent repair; Testing stores during standby or offline operation
    • G11C29/04—Detection or location of defective memory elements, e.g. cell constructio details, timing of test signals
    • G11C29/08—Functional testing, e.g. testing during refresh, power-on self testing [POST] or distributed testing
    • G11C29/12—Built-in arrangements for testing, e.g. built-in self testing [BIST] or interconnection details
    • G11C29/38—Response verification devices
    • G11C29/42—Response verification devices using error correcting codes [ECC] or parity check

Abstract

本发明公开了一种能够基于RAID来恢复存储器中的一个存储块丢失的数据的方法及其存储装置，所述存储器包括多个存储块，所述方法包括：基于所述多个存储块中的多个有效存储块的存储数据生成校验因子的校验码数据；在所述校验因子中为所述多个存储块配置第一多个地址指针；以及在每一个所述有效存储块中设置第二多个地址指针，其中，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，所述第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链。

Description

用于存储器的数据保护方法及其存储装置
技术领域
本公开总体上涉及数据存储领域，以及更具体地，涉及一种能够基于RAID来恢复存储器中的一个存储块丢失的数据的方法及其存储装置。
背景技术
RAID(Redundant Array of Independent Disks，独立磁盘冗余阵列)是将多个独立磁盘通过不同的组合方式组合在一起形成的磁盘阵列。由于RAID可以通过数据校验/镜像功能提供容错，从而增强了数据存储的安全性。因此，RAID已经广泛应用于数据存储和数据保护的各个领域中。
近年来，为了进一步提高闪速存储器件的位密度以及降低其成本，开发出了三维(3D)NAND闪存存储器(3D NAND Flash Memory Device)。但是，在对3D NAND闪存存储器的某一存储块进行写入的过程中，由于各种原因(例如掉电、写入失败等)，导致要写入的数据不能全部成功写入到这一存储块中，此时对这一存储块的写入并未完成，从而写入到这一存储块的一部分数据将不可用。在重新开始写入时，也将跳过这一存储块从相邻的存储块开始写入。为了能够在写入完成后利用RAID技术来恢复一个“成功写入”的存储块中丢失的数据，在基于多个“成功写入”的存储块中的存储数据计算校验码数据时将跳过那些“未成功写入”的存储块中的不可用数据，并且在利用校验码数据恢复所述一个“成功写入”的存储块中后来丢失的数据时也同样需要跳过那些“未成功写入”的存储块中的不可用数据，所以在计算校验码数据时还需要生成用于记录跳过了哪些数据的附加数据，其中，校验码数据和附加数据一起形成用于恢复某一个“成功写入”的存储块中后来丢失的数据的校验因子。
因此，需要一种用于存储器的数据保护方法及其存储装置，其能够大大降低对校验因子的附加数据的空间要求，维持系统的ECC纠错能力，并且大大降低存储器的空间浪费。
发明内容
根据本公开的实施例，提供了一种用于存储器的数据保护方法，所述存储器包括多个存储块，所述方法包括：基于所述多个存储块中的多个有效存储块的存储数据生成校验因子的校验码数据；在所述校验因子中为所述多个存储块配置第一多个地址指针；以及在每一个所述有效存储块中设置第二多个地址指针，其中，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，所述第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链。
在一些实施例中，所述第一多个地址指针为2个地址指针，所述第二多个地址指针为2个地址指针，在所述多个有效存储块的某一个有效存储块的数据丢失及其对应设置的第二多个地址指针丢失的情况下，所述第一多个地址指针以及所述多个有效存储块的其他有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的其他有效存储块的全部有效存储块的地址链。
在一些实施例中，所述方法还包括步骤：当所述多个有效存储块中的某一个有效存储块的数据丢失时，基于所述校验因子的所述校验码数据以及通过所述第一多个地址指针和所述多个有效存储块的其他有效存储块的第二多个地址指针形成的地址链读取所述多个有效存储块的相应有效存储块的存储数据，来恢复所述某一个有效存储块所丢失的数据。
在一些实施例中，所述第一多个地址指针为N个地址指针，所述第二多个地址指针为N个地址指针，N为大于或等于2的整数；针对某一个有效存储块设置的N个地址指针分别指向在所述某一个有效存储块成功写入之前最近成功写入的N个有效存储块之一；所述校验因子的N个地址指针分别指向所述有效存储块中的最后成功写入的N个有效存储块之一。
在一些实施例中，所述多个存储块的多个有效存储块的最先成功写入的有效存储块的N个地址指针指向为空，所述多个存储块的第(N-M)个成功写入的有效存储块的N个地址指针中，(M+1)个地址指针指向为空，M为大于或等于0且小于N的整数。
在一些实施例中，所述地址链自动跳过所述多个存储块中的无效存储块。
在一些实施例中，基于所述多个存储块中的全部有效存储块的存储数据生成所述校验因子的校验码数据。
在一些实施例中，对所述多个存储块中的所述多个有效存储块的存储数据执行异或操作来生成所述校验因子的校验码数据。
在一些实施例中，对所述校验码数据以及通过所述地址链读取的相应有效存储块的存储数据执行异或操作来恢复所述某一个有效存储块所丢失的数据。
在一些实施例中，所述存储器为3D NAND闪存存储器。
根据本公开的另一实施例，提供了一种用于存储器的数据恢复方法，所述存储器包括多个存储块，所述方法包括：确定所述多个存储块中的多个有效存储块的某一个有效存储块的数据丢失；以及基于校验因子的校验码数据以及通过地址链读取所述多个有效存储块的相应有效存储块的存储数据，来恢复所述某一个有效存储块所丢失的数据；其中，所述校验因子包括所述校验码数据和为所述多个存储块配置的第一多个地址指针，所述地址链通过所述第一多个地址指针以及在每一个所述有效存储块中设置的第二多个地址指针形成，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，从而所述地址链能够覆盖所述多个有效存储块的全部有效存储块。
在一些实施例中，所述第一多个地址指针为2个地址指针，所述第二多个地址指针为2个地址指针，在所述多个有效存储块的某一个有效存储块的数据丢失及其对应设置的第二多个地址指针丢失的情况下，所述第一多个地址指针以及所述多个有效存储块的其他有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的其他有效存储块的全部有效存储块的地址链。
在一些实施例中，在读取某一个有效存储块的存储数据时，存储在所述某一个有效存储块的第二多个地址指针也被读取，并且基于所述第二多个地址指针确定接下来读取的相应有效存储块。
在一些实施例中，所述第一多个地址指针为N个地址指针，所述第二多个地址指针为N个地址指针，N为大于或等于2的整数；针对某一个有效存储块设置的N个地址指针分别指向在所述某一个有效存储块成功写入之前最近成功写入的N个有效存储块之一；所述校验因子的N个地址指针分别指向所述有效存储块中的最后成功写入的N个有效存储块之一。
在一些实施例中，对所述校验码数据以及通过所述地址链读取的相应有效存储块的存储数据执行异或操作来恢复所述某一个有效存储块所丢失的数据。
根据本公开的再一实施例，提供了一种存储器系统，包括：存储器，所述存储器包括多个存储块；以及存储器控制器，所述存储器控制器耦接至所述存储器并且被配置为：基于所述多个存储块中的多个有效存储块的存储数据生成校验因子的校验码数据；在所述校验因子中为所述多个存储块配置第一多个地址指针；以及在每一个所述有效存储块中设置第二多个地址指针，其中，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，所述第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链。
在一些实施例中，所述第一多个地址指针为2个地址指针，所述第二多个地址指针为2个地址指针，在所述多个有效存储块的某一个有效存储块的数据丢失及其对应设置的第二多个地址指针丢失的情况下，所述第一多个地址指针以及所述多个有效存储块的其他有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的其他有效存储块的全部有效存储块的地址链。
在一些实施例中，所述控制器还被配置为当所述多个有效存储块中的某一个有效存储块的数据丢失时，基于所述校验因子的所述校验码数据以及通过所述第一多个地址指针和所述多个有效存储块的其他有效存储块的第二多个地址指针形成的地址链读取所述多个有效存储块的相应有效存储块的存储数据，来恢复所述某一个有效存储块所丢失的数据。
在一些实施例中，所述第一多个地址指针为N个地址指针，所述第二多个地址指针为N个地址指针，N为大于或等于2的整数；针对某一个有效存储块设置的N个地址指针分别指向在所述某一个有效存储块成功写入之前最近成功写入的N个有效存储块之一；所述校验因子的N个地址指针分别指向所述有效存储块中的最后成功写入的N个有效存储块之一。
在一些实施例中，所述多个存储块的多个有效存储块的最先成功写入的有效存储块的N个地址指针指向为空，所述多个存储块的第(N-M)个成功写入的有效存储块的N个地址指针中，(M+1)个地址指针指向为空，M为大于或等于0且小于N的整数。
在一些实施例中，所述地址链自动跳过所述多个存储块中的无效存储块。
在一些实施例中，所述控制器被配置为基于所述多个存储块中的全部有效存储块的存储数据生成所述校验因子的校验码数据。
在一些实施例中，所述控制器被配置为对所述多个存储块中的所述多个有效存储块的存储数据执行异或操作来生成所述校验因子的校验码数据。
在一些实施例中，所述控制器被配置为对所述校验码数据以及通过所述地址链读取的相应有效存储块的存储数据执行异或操作来恢复所述某一个有效存储块所丢失的数据。
在一些实施例中，所述存储器为3D NAND闪存存储器。
根据本公开的再一实施例，提供了一种存储器系统，包括：存储器，所述存储器包括多个存储块；以及存储器控制器，所述存储器控制器耦接至所述存储器并且被配置为：确定所述多个存储块中的多个有效存储块的某一个有效存储块的数据丢失；以及基于校验因子的校验码数据以及通过地址链读取所述多个有效存储块的相应有效存储块的存储数据，来恢复所述某一个有效存储块所丢失的数据；其中，所述校验因子包括校验码数据和为所述多个存储块配置的第一多个地址指针，所述地址链通过所述第一多个地址指针以及在每一个所述有效存储块中设置的第二多个地址指针形成，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，从而所述地址链能够覆盖所述多个有效存储块的全部有效存储块。
在一些实施例中，所述第一多个地址指针为2个地址指针，所述第二多个地址指针为2个地址指针，在所述多个有效存储块的某一个有效存储块的数据丢失及其对应设置的第二多个地址指针丢失的情况下，所述第一多个地址指针以及所述多个有效存储块的其他有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的其他有效存储块的全部有效存储块的地址链。
在一些实施例中，所述存储器控制器被配置为在读取某一个有效存储块的存储数据时，存储在所述某一个有效存储块的第二多个地址指针也被读取，并且基于所述第二多个地址指针确定接下来读取的相应有效存储块。
在一些实施例中，所述第一多个地址指针为N个地址指针，所述第二多个地址指针为N个地址指针，N为大于或等于2的整数；针对某一个有效存储块设置的N个地址指针分别指向在所述某一个有效存储块成功写入之前最近成功写入的N个有效存储块之一；所述校验因子的N个地址指针分别指向所述有效存储块中的最后成功写入的N个有效存储块之一。
在一些实施例中，所述存储器控制器被配置为对所述校验码数据以及通过所述地址链读取的相应有效存储块的存储数据执行异或操作来恢复所述某一个有效存储块所丢失的数据。
根据本公开的再一实施例，提供了一种一种存储器系统，包括：存储器，所述存储器包括校验用存储区域和多个存储块；以及存储器控制器，所述存储器控制器耦接至所述存储器；所述校验用存储区域存储有对应所述多个存储块的多个有效存储块的校验因子，所述校验因子包括校验码数据和为所述多个存储块配置的第一多个地址指针；每一个所述有效存储块中设置有第二多个地址指针，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块；其中，所述第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链。
附图说明
附图被并入本文并形成说明书的一部分，例示了本公开的实施例并与说明书一起进一步用以解释本公开的原理，并使相关领域的技术人员能够做出和使用本公开。
图1示出了根据本公开一实施例的用于存储器的数据保护方法的示意图。
图2示出了根据本公开又一实施例的用于存储器的数据保护方法的示意图。
图3示出了根据本公开一实施例的用于存储器的数据保护方法的流程图；
图4示出了根据本公开一实施例的用于存储器的数据恢复方法的流程图；以及
图5示出了根据本公开一实施例的存储器系统的示意图。
具体实施方式
现在将参考示例实施方式讨论本文描述的主题。应该理解，讨论这些实施方式只是为了使得本领域技术人员能够更好地理解从而实现本文描述的主题，并非是对权利要求书中所阐述的保护范围、适用性或者示例的限制。可以在不脱离本说明书内容的保护范围的情况下，对所讨论的元素的功能和排列进行改变。各个示例可以根据需要，省略、替代或者添加各种过程或组件。例如，所描述的方法可以按照与所描述的顺序不同的顺序来执行，以及各个步骤可以被添加、省略或者组合。另外，相对一些示例所描述的特征在其它例子中也可以进行组合。
要指出的是，在说明书中提到“一个实施例”、“实施例”、“一些实施例”等表示所述的实施例可包括特定的特征、结构或特性，但未必每个实施例都包括该特定特征、结构或特性。此外，这样的措辞用语未必是指相同的实施例。另外，在结合实施例描述特定的特征、结构或特性时，结合明确或未明确描述的其它实施例实现此类特征、结构或特性应在相关领域技术人员的知识范围之内。
尽管将参考3D NAND闪存存储器来描述本公开的实施例，但应当理解，本公开创造性概念的实施例不限于此配置。例如，在不脱离本公开的范围的情况下，本公开适用于其他非易失性存储器件，例如电可擦除可编程ROM(EEPROM)、NOR闪存、相变RAM(PRAM)、磁RAM(MRAM)、电阻RAM(RRAM)、铁电RAM(FRAM)等。
图1示出了根据本公开一实施例的用于存储器的数据保护方法的示意图，其中，以位图形式记录跳过了哪些数据。也就是说，位图数据作为校验因子F的附加数据。如图1中所示，3D NAND闪存存储器100包括存储块D0、存储块D1、存储块D2、……、存储块Dn。在写入过程中，完成写入的存储块标记为“有效”并且在位图中以“0”来表示，未完成写入导致其写入的一部分数据不可用的存储块标记为“跳过”并且在位图中以“1”来表示。为了利用RAID技术来恢复在某一有效存储块中成功写入并且在写入完成后丢失的数据，在基于多个有效存储块中的存储数据计算校验码数据时将跳过这些标记为“1”的存储块中的不可用数据，并且在利用校验码数据恢复所述存储块中丢失的数据时也同样需要跳过这些标记为“1”的存储块中的不可用数据
然而，即使以位图形式进行压缩，仍然需要占用很大的存储器空间。在如图1所示的用于存储器的数据保护方法中，在RAID的比例(被保护数据的量和校验因子的量)为127：1的情况下，位图需要占用16个字节；在RAID的比例为255：1的情况下，位图更是需要占用32个字节。在作为校验因子F的附加数据的位图需要占用16个字节或32个字节的情况下，这将导致每个有效存储块的16个字节或32个字节的空间浪费而不能用于存储数据，因为即使在每个有效存储块的这些空间中写入数据，也无法在写入完成后利用RAID技术来恢复在某一有效存储块的该空间中成功写入且后来丢失的数据。因此，除了需要在校验因子F中保留很大的空间用于附加数据(例如，位图)，从而极大降低系统的ECC纠错能力之外，每个有效存储块还浪费与该附加数据大小相同的空间。
图2示出了根据本公开又一实施例的用于存储器的数据保护方法的示意图。如图2中所示，3D NAND闪存存储器200包括存储块D0、存储块D1、存储块D2、……存储块D126。
如图2中所示，在3D NAND闪存存储器200的写入过程中，成功写入的存储块D标记为“有效”，例如存储块D0、存储块D2、……存储块D123、存储块D125、存储块D126。在写入过程中因为某些原因(例如，掉电、写入失败等)导致数据未能全部成功写入的存储块D标记为“跳过”，例如存储块D1、存储块D3、……存储块D124，被标记为“跳过”的存储块中的数据不可用。也就是说，在完成对存储器200的写入之后，如果某一有效存储块D中存储的数据丢失，如果利用RAID技术来恢复该有效存储块D中丢失的数据，在计算用来恢复该有效存储块D中丢失的数据的校验码数据P时不能用到这些被标记为“跳过”的存储块D中写入的数据。
如图2中所示，校验码数据P可以通过对3D NAND闪存存储器200的全部存储块中的多个有效存储块D中存储的数据执行“异或”(XOR)操作来生成。在一个实施例中，校验码数据P可以通过对3D NAND闪存存储器200的全部有效存储块D中存储的数据执行“异或”(XOR)操作来生成。XOR是对两个操作数的逻辑运算，如果进行“异或”的两个值不同，则它产生逻辑值“1”；如果进行“异或”的两个值相同，则它产生逻辑值“0”。例如，如果有效存储块D0存储的数据为“11001010”，并且有效存储块D2存储的数据为“10000011”，则“异或”之后的结果为“01001001”。接下来，将上述结果与下一个有效存储块D中存储的数据再执行“异或”操作，直至全部有效存储块D中存储的数据都执行了“异或”操作，从而得到校验码数据P。
与图1所示的一样，用来恢复某一有效存储块D在写入完成后丢失的数据的校验因子F除了校验码数据P之外，同样还包括附加数据。但是与图1中使用位图作为校验因子F的附加数据不同的是，在图2中，使用地址链作为校验因子F的附加数据。例如，如图2中所示，校验因子F除了通过对多个有效存储块D中存储的数据进行“异或”操作得到的校验码数据P之外，还包括两个地址指针L1、L2，这两个地址指针L1、L2分别指向3D NAND闪存存储器200的相应一个有效存储块D。在一个实施例中，这两个地址指针L1、L2中分别记录了所述相应一个有效存储块D的编号。在这种情况下，如果RAID的比例为127：1，则这两个地址指针L1、L2可以只需要占用两个字节的空间；如果RAID的比例为255：1，则这两个地址指针L1、L2可以只需要占用四个字节的空间。
如图2中所示，作为校验因子F的附加数据的两个地址指针L1、L2可以分别指向3DNAND闪存存储器200中的从时间上来说最后成功写入的两个有效存储块之一。例如，地址指针L2指向最后成功写入的有效存储块D126，并且地址指针L1指向倒数第二个成功写入的有效存储块D125。应理解，图2中所示的情况是示例性的，假如最后一个存储块D126被标记为“跳过”，从时间上来说最后成功写入的有效存储块为D125，并且从时间上来说倒数第二个成功写入的有效存储块为D124，则作为校验因子F的附加数据的地址指针L2指向有效存储块D125，并且地址指针L1指向有效存储块D124。
与图1中位图作为校验因子F的附加数据一样，在图2中，在校验因子F的两个地址指针L1、L2占用两个字节的空间的情况下，每个有效存储块D中除了写入的存储数据之外，还分别占用两个字节的空间来存储两个地址指针DL1、DL2，这两个地址指针DL1、DL2分别指向在完成对该有效存储块D的写入之前最近成功写入的两个有效存储块D之一。如图2中所示，有效存储块D126中除了存储的数据之外，还存储有两个地址指针D126L1、D126L2，其中地址指针D126L2指向在对有效存储块D126成功写入之前从时间上来说最近成功写入的有效存储块，例如D125，并且地址指针D126L1指向在对有效存储块D126成功写入之前倒数第二个成功写入的有效存储块，例如D123。因为存储块D124被标记为“跳过”，尽管存储块D124比存储块D123更接近有效存储块D126，但是地址指针D126L1也不会指向存储块D124。类似地，有效存储块D125中除了存储的数据之外，还存储有两个地址指针D125L1、D125L2，其中地址指针D125L2指向在对有效存储块D125成功写入之前最近成功写入的有效存储块，例如D123，并且地址指针D125L1指向在对有效存储块D125成功写入之前倒数第二个成功写入的有效存储块，例如D122(图2中未示出)。因为存储块D124被标记为“跳过”，尽管存储块D124比存储块D123更接近有效存储块D125，但是有效存储块D125中的两个地址指针D125L1、D125L2都不会指向存储块D124。依次类推，可以确定每个有效存储块D存储的两个地址指针DL1、DL2分别所指向的存储块。
如图2中所示，对3D NAND闪存存储器200的写入过程如下：首先对存储块D0进行写入，假如对存储块D0写入成功(被标记为“有效”)，因为在对存储块D0成功写入之前没有存储块D被成功写入，所以有效存储块D0中的两个地址指针D0L1、D0L2指向为空；接下来，对存储块D1进行写入，写入过程中，因为某一原因(例如，掉电)导致存储块D1未能成功写入(被标记为“跳过”)；接下来，在恢复写入过程之后，对存储块D2进行写入，假如对存储块D2成功写入(被标记为“有效”)，因为在对存储块D2成功写入之前只有存储块D0成功写入，则有效存储块D2中的地址指针D2L2指向有效存储块D0，并且有效存储块D2的地址指针D2L1指向为空；接下来，对存储块D3进行写入，写入过程中，因为某一原因(例如，掉电)导致存储块D3未能成功写入(被标记为“跳过”)；接下来，在恢复写入过程之后，对存储块D4(图2中未示出)进行写入，假如对存储块D4成功写入，因为在对存储块D4成功写入之前存储块D0、存储块D2被成功写入，则有效存储块D4中的地址指针D4L2指向在有效存储块D4成功写入之前最近成功写入的有效存储块D2，并且有效存储块D4中的地址指针D4L1指向在有效存储块D4成功写入之前倒数第二个成功写入的有效存储块D0，……，依次类推，直至完成所有存储块D的写入。
在完成3D NAND闪存存储器200的写入之后，如果某一有效存储块D存储的数据丢失，则利用RAID技术能够恢复该有效存储块D中丢失的数据。具体而言，为了恢复某一有效存储块D丢失的数据，除了需要在写入过程中基于3D NAND闪存存储器200的多个存储块中全部成功写入的有效存储块D中的存储数据得到的校验码数据P之外，还需要读取3D NAND闪存存储器200的多个存储块D中除丢失数据的有效存储块D之外的其他有效存储块D中的存储数据。为了读取除丢失数据的有效存储块D之外的其他有效存储块D中的存储数据，可以通过校验因子F中的地址指针以及除丢失数据的有效存储块D之外的其他有效存储块D中的地址指针形成的地址链来读取相应有效存储块D中存储的数据。例如，在完成对3D NAND闪存存储器200的写入之后，假设有效存储块D123中存储的数据丢失，为了恢复有效存储块D123中丢失的数据，根据校验因子F中的地址指针L2，知道存储块D126成功写入，因此需要读取有效存储块D126中的存储数据；接下来，根据有效存储块D126中的地址指针D126L2，知道存储块D125成功写入，因此需要读取有效存储块D125中的存储数据；再接下来，因为有效存储块D125中的地址指针D125L2指向存储块D123，但是存储块D123中的数据丢失已经无法读取，这时利用有效存储块D125中的地址指针D125L1，知道存储块D122(图2中未示出)成功写入，因此需要读取有效存储块D122中的存储数据；再接下来，根据有效存储块D122中的地址指针D122L2，……；依次类推，直至有效存储块D0中的存储数据也被读取。由此可见，通过校验因子F中的地址指针以及除丢失数据的有效存储块D123之外的其他有效存储块D中的地址指针形成的地址链可以自动跳过3D NAND闪存存储器200中被标记为“跳过”的存储块D以及丢失数据的有效存储块D123。也就是说，该地址链自动跳过3D NAND闪存存储器200的多个存储块D中的无效存储块。在获得写入过程中基于3D NAND闪存存储器200的全部有效存储块D中的存储数据得到的校验码数据P以及读取到的除丢失数据的有效存储块D123之外的其他有效存储块D中的存储数据之后，可以对校验码数据P以及通过校验因子F中的地址指针和除丢失数据的有效存储块D123之外的其他有效存储块D中的地址指针形成的地址链读取的相应有效存储块D中的存储数据执行“异或”操作，以恢复存储块D123中丢失的数据。
在图2所示的实施例中，如果在完成对3D NAND闪存存储器200的写入之后，如果有效存储块D126中存储的数据丢失，为了利用RAID技术恢复该有效存储块D126中后来丢失的数据，需要读取除有效存储块D126之外的其他有效存储块D中的存储数据。校验因子F的地址指针L2指向存储块D126，因为此时已经无法读取到存储块D126中存储的数据，所以此时可以利用校验因子F的地址指针L1指向有效存储块D125，先读取有效存储块D125中存储的数据。接下来，根据有效存储块D125中的地址指针D125L2，知道存储块D123成功写入，因此需要读取有效存储块D123中的存储数据；再接下来，根据有效存储块D123中的地址指针D123L2，……；依次类推，直至有效存储块D0中的存储数据也被读取。同样地，在获得写入过程中基于3D NAND闪存存储器200的全部有效存储块D中的存储数据得到的校验码数据P以及通过校验因子F中的地址指针和除丢失数据的有效存储块D126之外的其他有效存储块D中的地址指针形成的地址链读取到的除丢失数据的有效存储块D126之外的其他有效存储块D中的存储数据之后，可以对校验码数据P以及所读取的相应有效存储块D中的存储数据执行“异或”操作，以恢复存储块D126中丢失的数据。
在一个实施例中，可以对生成的校验码数据P以及通过地址链读取的相应有效存储块的存储数据执行“异或”操作来恢复在写入过程之后某一个有效存储块D中丢失的数据。例如，仍以图2所示的方法为例，假设在写入过程之后，有效存储块D123中存储的数据丢失。为了恢复有效存储块D123中丢失的数据，可以首先将生成的附加校验码P与通过校验因子F中的地址指针L2读取到的有效存储块D126中的存储数据执行“异或”操作，然后将所得结果与通过有效存储块D126中的地址指针L2读取到的有效存储块D125中的存储数据再执行“异或”操作，然后将所得结果与通过有效存储块D125中的地址指针L1读取到的有效存储块D122(图2中未示出)中的存储数据再执行“异或”操作，……，直至将所得结果与读取到的有效存储块D2中的存储数据再执行“异或”操作，从而获得上述多个“异或”操作的最终结果，该最终结果也是有效存储块D0中存储的数据与有效存储块123中原来存储的数据执行“异或”操作的结果。因此，通过对生成的校验码数据P以及通过地址链读取的相应有效存储块的存储数据执行“异或”操作可以恢复在写入过程之后有效存储块D123中丢失的数据。
在图2所示的实施例中，因为校验因子F的两个地址指针L1、L2分别指向3D NAND闪存存储器200的有效存储块D中最后成功写入的两个有效存储块之一，在不是最后成功写入的有效存储块D中存储的数据后来丢失时，利用校验因子F的地址指针L2以及除丢失数据的有效存储块D之外的其他有效存储块D中的地址指针形成的地址链，来读取除数据丢失的有效存储块D之外的其他有效存储块D中存储的数据。另外，即使在最后成功写入的有效存储块D(例如，存储块D126)中存储的数据后来丢失时，也可以利用校验因子F的地址指针L1以及除最后成功写入的有效存储块D之外的其他有效存储块D中的地址指针形成的地址链，来读取除最后成功写入的有效存储块D之外的其他有效存储块D中存储的数据。由于可以根据发生数据丢失的有效存储块D的位置选择性地利用校验因子F的两个地址指针L1、L2之一作为链首的地址链来读取相应有效存储块D中存储的数据，所以不会发生断链。相反地，如果校验因子F只有一个地址指针L并且该地址指针L指向有效存储块中最后成功写入的有效存储块D，例如有效存储块D126，当有效存储块D126中存储的数据丢失时，将不能读取除有效存储块D126之外的其他有效存储块D中存储的数据。也就是说，这时将发生断链，从而无法利用RAID技术来恢复存储块D126中丢失的数据。
另外，在RAID的比例为127：1的情况下，如果如图1所示的以位图形式记录跳过了哪些数据，作为校验因子F的附加数据的位图需要占用16个字节的空间，并且每个有效存储块D也相应地浪费16个字节的空间；而如图2所示的以地址链的形式记录哪些存储块存储中的数据有效，作为校验因子F的附加数据的地址链只需要占用2个字节的空间，并且每个有效存储块D也相应地只浪费例如2个字节的空间，从而大大节省存储器的空间。
应理解，图2中所示的校验因子F包括两个地址指针L1、L2以及每个有效存储块D包括两个地址指针仅仅是示例性的。在一个实施例中，校验因子F可以包括N个地址指针(N为大于或等于2的整数)，其分别指向3D NAND闪存存储器200的有效存储块D中的最后成功写入的N个有效存储块之一。在这种情况下，每个有效存储块D除了所写入的存储数据之外，同样包括N个地址指针(N为大于或等于2的整数)，其分别指向在相应有效存储块D成功写入之前最近成功写入的N个有效存储块D之一。例如，校验因子F可以包括三个地址指针L1、L2、L3并且每个有效存储块D可以包括三个地址指针，校验因子F的地址指针L3指向有效存储块D中的最后成功写入的有效存储块，地址指针L2指向有效存储块D中倒数第二个成功写入的有效存储块，并且地址指针L1指向有效存储块D中倒数第三个成功写入的有效存储块。相应地，每个有效存储块D的三个地址指针分别指向在该有效存储块D成功写入之前最近成功写入的三个有效存储块之一。
图3示出了根据本公开一实施例的用于存储器的数据保护方法的流程图，存储器包括多个存储块。如图3中所示，方法300包括：基于所述多个存储块中的多个有效存储块的存储数据生成校验因子的校验码数据(步骤S310)；在所述校验因子中为所述多个存储块配置第一多个地址指针(步骤S320)；以及在每一个所述有效存储块中设置第二多个地址指针，其中，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，所述第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链(步骤S330)。步骤S310-S330说明如下：
步骤S310：基于所述多个存储块中的多个有效存储块的存储数据生成校验因子的校验码数据。仍以图2所示的方法为例，在3D NAND闪存存储器的写入过程中，可以对全部有效存储块D中存储的数据执行“异或”操作生成校验因子F的校验码数据P。
步骤S320：在所述校验因子中为所述多个存储块配置第一多个地址指针。如图2中所示，校验因子F除了在步骤S310中得到的校验码数据P之外，还包括为所述多个存储块配置的作为附加数据的两个地址指针L1、L2，所述两个地址指针L1、L2分别指向所述多个有效存储块中的最后成功写入的两个有效存储块之一。
步骤S330：在每一个所述有效存储块中设置第二多个地址指针，其中，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，所述第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链。仍以图2所示的方法为例，每一个有效存储块D中除了写入的存储数据之外，还设置有两个地址指针，所述两个地址指针分别指向在该有效存储块D成功写入之前最近成功写入的两个有效存储块之一。校验因子F的两个地址指针L1、L2以及每一个有效存储块D的两个地址指针能够一起形成覆盖全部有效存储块D的地址链。
图4示出了根据本公开一实施例的用于存储器的数据恢复方法的流程图，所述存储器包括多个存储块。如图4中所示，方法400包括：确定所述多个存储块中的多个有效存储块的某一个有效存储块的数据丢失(步骤S410)；以及基于校验因子的校验码数据以及通过地址链读取所述多个有效存储块的相应有效存储块的存储数据，来恢复所述某一个有效存储块所丢失的数据，其中，所述校验因子包括所述校验码数据和为所述多个存储块配置的第一多个地址指针，所述地址链通过所述第一多个地址指针以及在每一个所述有效存储块中设置的第二多个地址指针形成，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，从而所述地址链能够覆盖所述多个有效存储块的全部有效存储块(步骤S420)。
仍以图2所示的方法为例，首先确定多个有效存储块的某一个有效存储块D的数据丢失，例如，在写入过程之后，确定存储块D123中存储的数据丢失；然后读取除丢失数据的有效存储块D123之外的其他有效存储块D中的存储数据，为了读取其他有效存储块D中的存储数据，可以通过校验因子F中的两个地址指针以及其他有效存储块D中的地址指针形成的地址链来读取除有效存储块D123之外的全部有效存储块D中存储的数据；最后，可以对写入过程中基于3D NAND闪存存储器200的全部有效存储块D中的存储数据得到的校验码数据P以及通过所述地址链读取到的除有效存储块D123之外的全部有效存储块D中的存储数据执行“异或”操作，以恢复存储块D123中丢失的数据。
图5示出了根据本公开一实施例的具有存储器的系统500的示意图。系统500可以是移动电话、台式计算机、膝上型计算机、平板计算机、游戏控制台、打印机、定位设备、可穿戴电子设备、智能传感器、虚拟现实(VR)设备、增强现实(AR)设备或具有存储器的任何其他合适电子设备。如图5中所示，系统500可以包括主机510和具有一个或多个存储器501和存储器控制器502的存储器系统520。主机510可以被配置为将数据发送到存储器501或从存储器501接收数据。
存储器501可以是本文所公开的任何存储器，例如3D NAND闪存存储器，其包括检验用存储区域5011和多个存储块，例如存储块0、存储块1、存储块2、……、存储块n。检验用存储区域5011存储有对应多个存储块的多个有效存储块的校验因子，所述校验因子包括校验码数据和为所述多个存储块配置的第一多个地址指针。另外，存储器501的多个存储块的每一个有效存储块中设置有第二多个地址指针，每一个有效存储块的第二多个地址指针中的每一个分别指向相应一个其他有效存储块。其中，第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链。
如图5中所示，存储器控制器502包括前端接口5021和后端接口5022，前端接口5021通过通道Lane 0、Lane 1、Lane2、Lane3耦接到主机510，并且后端接口5022通过通道CH0、CH1、……、CHn耦接到存储器501的检验用存储区域5011以及相应存储块，其中前端接口5021可以根据特定通信协议(例如，PCIe、NVMe)与主机510通信；后端接口5022包括RAID模块。RAID模块具体可以通过例如在后端接口5022的控制器中所写入的固件(Firmware)等实现，也可以通过专用的硬件引擎电路实现。
在一个实施例中，RAID模块可以被配置为基于存储器501的多个存储块中的多个有效存储块的存储数据生成校验因子的校验码数据；在所述校验因子中为所述多个存储块配置第一多个地址指针；以及在每一个所述有效存储块中针对其存储的存储数据设置第二多个地址指针，其中，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，所述第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链。在另一实施例中，RAID模块可以被配置为确定存储器501的多个存储块中的多个有效存储块的某一个有效存储块的数据丢失；以及基于校验因子的校验码数据以及通过地址链读取所述多个有效存储块的相应有效存储块的存储数据，来恢复所述某一个有效存储块所丢失的数据；其中，所述校验因子包括校验码数据和为所述多个存储块配置的第一多个地址指针，所述地址链通过所述第一多个地址指针以及在每一个所述有效存储块中针对其存储的所述存储数据而设置的第二多个地址指针形成，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，从而所述地址链能够覆盖所述多个有效存储块的全部有效存储块。
存储器控制器502还包括具有处理单元1、处理单元2、……、处理单元n的处理模块5023，对应处理单元可以配置有相应的固件，例如，实现FTL(Flash to Logic，闪存到逻辑)功能的固件，处理单元上运行的相应固件可以基于接收的来自主机510的指令来控制存储器501的操作，例如，读取、擦除和编程操作。存储器控制器502还包括静态随机存取存储器(SRAM)5024、动态随机存取存储器(DRAM)控制器5025、动态随机存取存储器(DRAM)接口5026，其中动态随机存取存储器(DRAM)接口5026耦接至动态随机存取存储器(DRAM)503。如图5中所示，存储器控制器502的各部件可以连接至总线&电桥5027。
如上所述，根据本公开一实施例的存储器系统520能够利用地址链作为校验因子的附加数据，从而能够大大降低对校验因子的附加数据的空间要求，维持系统的ECC纠错能力，并且大大降低存储器的空间浪费。
根据一个实施例，提供了一种计算机可读存储介质，在其上存储有程序代码，当所述程序代码由处理器执行时，使得所述处理器能够执行本说明书结合图1-4描述的各个实施例中的各种操作和功能。具体地，可以提供配有可读存储介质的系统或者装置，在该可读存储介质上存储着实现上述实施例中任一实施例的功能的软件程序代码，且使该系统或者装置的计算机或处理器读出并执行存储在该可读存储介质中的指令。
可读存储介质的实施例包括非易失性存储卡和ROM等。可选择地，可以由通信网络从服务器计算机上或云上下载程序代码。
需要说明的是，上述各流程和各系统结构图中不是所有的步骤和单元都是必须的，可以根据实际的需要忽略某些步骤或单元。各步骤的执行顺序不是固定的，可以根据需要进行确定。上述各实施例中描述的装置结构可以是物理结构，也可以是逻辑结构，即，有些单元可能由同一物理实体实现，或者，有些单元可能分由多个物理实体实现，或者，可以由多个独立设备中的某些部件共同实现。
已经结合各种装置和方法描述了控制器。所述控制器可以使用电子硬件、计算机软件或其任意组合来实施。所述控制器是实施为硬件还是软件将取决于具体的应用以及施加在系统上的总体设计约束。作为示例，本公开中给出的控制器、控制器的任意部分、或者控制器的任意组合可以实施为微处理器、微控制器、数字信号处理器(DSP)、现场可编程门阵列(FPGA)、可编程逻辑器件(PLD)、状态机、门逻辑、分立硬件电路、以及配置用于执行在本公开中描述的各种功能的其它适合的处理部件。本公开给出的控制器、控制器的任意部分、或者控制器的任意组合的功能可以实施为由微处理器、微控制器、DSP或其它适合的平台所执行的软件。
本公开内容的上述描述被提供来使得本领域任何普通技术人员能够实现或者使用本公开内容。对于本领域普通技术人员来说，对本公开内容进行的各种修改是显而易见的，并且，也可以在不脱离本公开内容的保护范围的情况下，将本文所定义的一般性原理应用于其它变型。因此，本公开内容并不限于本文所描述的示例和设计，而是与符合本文公开的原理和新颖性特征的最广范围相一致。

Claims (31)

1.一种用于存储器的数据保护方法，所述存储器包括多个存储块，所述方法包括：
基于所述多个存储块中的多个有效存储块的存储数据生成校验因子的校验码数据；
在所述校验因子中为所述多个存储块配置第一多个地址指针；以及
在每一个所述有效存储块中设置第二多个地址指针，其中，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，所述第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链。
2.根据权利要求1所述的方法，其中，所述第一多个地址指针为2个地址指针，所述第二多个地址指针为2个地址指针，在所述多个有效存储块的某一个有效存储块的数据丢失及其对应设置的第二多个地址指针丢失的情况下，所述第一多个地址指针以及所述多个有效存储块的其他有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的其他有效存储块的全部有效存储块的地址链。
3.根据权利要求1所述的方法，其中，还包括步骤：
当所述多个有效存储块中的某一个有效存储块的数据丢失时，基于所述校验因子的所述校验码数据以及通过所述第一多个地址指针和所述多个有效存储块的其他有效存储块的第二多个地址指针形成的地址链读取所述多个有效存储块的相应有效存储块的存储数据，来恢复所述某一个有效存储块所丢失的数据。
4.根据权利要求1所述的方法，其中，所述第一多个地址指针为N个地址指针，所述第二多个地址指针为N个地址指针，N为大于或等于2的整数；
针对某一个有效存储块设置的N个地址指针分别指向在所述某一个有效存储块成功写入之前最近成功写入的N个有效存储块之一；
所述校验因子的N个地址指针分别指向所述有效存储块中的最后成功写入的N个有效存储块之一。
5.根据权利要求4所述的方法，其中，所述多个存储块的多个有效存储块的最先成功写入的有效存储块的N个地址指针指向为空，所述多个存储块的第(N-M)个成功写入的有效存储块的N个地址指针中，(M+1)个地址指针指向为空，M为大于或等于0且小于N的整数。
6.根据权利要求1所述的方法，其中，所述地址链自动跳过所述多个存储块中的无效存储块。
7.根据权利要求1所述的方法，其中，基于所述多个存储块中的全部有效存储块的存储数据生成所述校验因子的校验码数据。
8.根据权利要求1所述的方法，其中，对所述多个存储块中的所述多个有效存储块的存储数据执行异或操作来生成所述校验因子的校验码数据。
9.根据权利要求3所述的方法，其中，对所述校验码数据以及通过所述地址链读取的相应有效存储块的存储数据执行异或操作来恢复所述某一个有效存储块所丢失的数据。
10.根据权利要求1所述的方法，其中，所述存储器为3D NAND闪存存储器。
11.一种用于存储器的数据恢复方法，所述存储器包括多个存储块，所述方法包括：
确定所述多个存储块中的多个有效存储块的某一个有效存储块的数据丢失；以及
基于校验因子的校验码数据以及通过地址链读取所述多个有效存储块的相应有效存储块的存储数据，来恢复所述某一个有效存储块所丢失的数据；
其中，所述校验因子包括所述校验码数据和为所述多个存储块配置的第一多个地址指针，所述地址链通过所述第一多个地址指针以及在每一个所述有效存储块中设置的第二多个地址指针形成，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，从而所述地址链能够覆盖所述多个有效存储块的全部有效存储块。
12.根据权利要求11所述的方法，其中，所述第一多个地址指针为2个地址指针，所述第二多个地址指针为2个地址指针，在所述多个有效存储块的某一个有效存储块的数据丢失及其对应设置的第二多个地址指针丢失的情况下，所述第一多个地址指针以及所述多个有效存储块的其他有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的其他有效存储块的全部有效存储块的地址链。
13.根据权利要求11所述的方法，其中，在读取某一个有效存储块的存储数据时，存储在所述某一个有效存储块的第二多个地址指针也被读取，并且基于所述第二多个地址指针确定接下来读取的相应有效存储块。
14.根据权利要求11所述的方法，其中，所述第一多个地址指针为N个地址指针，所述第二多个地址指针为N个地址指针，N为大于或等于2的整数；
针对某一个有效存储块设置的N个地址指针分别指向在所述某一个有效存储块成功写入之前最近成功写入的N个有效存储块之一；
所述校验因子的N个地址指针分别指向所述有效存储块中的最后成功写入的N个有效存储块之一。
15.根据权利要求11所述的方法，其中，对所述校验码数据以及通过所述地址链读取的相应有效存储块的存储数据执行异或操作来恢复所述某一个有效存储块所丢失的数据。
16.一种存储器系统，包括：
存储器，所述存储器包括多个存储块；以及
存储器控制器，所述存储器控制器耦接至所述存储器并且被配置为：基于所述多个存储块中的多个有效存储块的存储数据生成校验因子的校验码数据；在所述校验因子中为所述多个存储块配置第一多个地址指针；以及在每一个所述有效存储块中设置第二多个地址指针，其中，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，所述第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链。
17.根据权利要求16所述的存储器系统，其中，所述第一多个地址指针为2个地址指针，所述第二多个地址指针为2个地址指针，在所述多个有效存储块的某一个有效存储块的数据丢失及其对应设置的第二多个地址指针丢失的情况下，所述第一多个地址指针以及所述多个有效存储块的其他有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的其他有效存储块的全部有效存储块的地址链。
18.根据权利要求16所述的存储器系统，其中，所述控制器还被配置为当所述多个有效存储块中的某一个有效存储块的数据丢失时，基于所述校验因子的所述校验码数据以及通过所述第一多个地址指针和所述多个有效存储块的其他有效存储块的第二多个地址指针形成的地址链读取所述多个有效存储块的相应有效存储块的存储数据，来恢复所述某一个有效存储块所丢失的数据。
19.根据权利要求16所述的存储器系统，其中，所述第一多个地址指针为N个地址指针，所述第二多个地址指针为N个地址指针，N为大于或等于2的整数；
针对某一个有效存储块设置的N个地址指针分别指向在所述某一个有效存储块成功写入之前最近成功写入的N个有效存储块之一；
所述校验因子的N个地址指针分别指向所述有效存储块中的最后成功写入的N个有效存储块之一。
20.根据权利要求19所述的存储器系统，其中，所述多个存储块的多个有效存储块的最先成功写入的有效存储块的N个地址指针指向为空，所述多个存储块的第(N-M)个成功写入的有效存储块的N个地址指针中，(M+1)个地址指针指向为空，M为大于或等于0且小于N的整数。
21.根据权利要求16所述的存储器系统，其中，所述地址链自动跳过所述多个存储块中的无效存储块。
22.根据权利要求16所述的存储器系统，所述控制器被配置为基于所述多个存储块中的全部有效存储块的存储数据生成所述校验因子的校验码数据。
23.根据权利要求16所述的存储器系统，所述控制器被配置为对所述多个存储块中的所述多个有效存储块的存储数据执行异或操作来生成所述校验因子的校验码数据。
24.根据权利要求18所述的存储器系统，所述控制器被配置为对所述校验码数据以及通过所述地址链读取的相应有效存储块的存储数据执行异或操作来恢复所述某一个有效存储块所丢失的数据。
25.根据权利要求16所述的存储器系统，其中，所述存储器为3D NAND闪存存储器。
26.一种存储器系统，包括：
存储器，所述存储器包括多个存储块；以及
存储器控制器，所述存储器控制器耦接至所述存储器并且被配置为：确定所述多个存储块中的多个有效存储块的某一个有效存储块的数据丢失；以及基于校验因子的校验码数据以及通过地址链读取所述多个有效存储块的相应有效存储块的存储数据，来恢复所述某一个有效存储块所丢失的数据；其中，所述校验因子包括校验码数据和为所述多个存储块配置的第一多个地址指针，所述地址链通过所述第一多个地址指针以及在每一个所述有效存储块中设置的第二多个地址指针形成，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块，从而所述地址链能够覆盖所述多个有效存储块的全部有效存储块。
27.根据权利要求26所述的存储器系统，其中，所述第一多个地址指针为2个地址指针，所述第二多个地址指针为2个地址指针，在所述多个有效存储块的某一个有效存储块的数据丢失及其对应设置的第二多个地址指针丢失的情况下，所述第一多个地址指针以及所述多个有效存储块的其他有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的其他有效存储块的全部有效存储块的地址链。
28.根据权利要求26所述的存储器系统，所述存储器控制器被配置为在读取某一个有效存储块的存储数据时，存储在所述某一个有效存储块的第二多个地址指针也被读取，并且基于所述第二多个地址指针确定接下来读取的相应有效存储块。
29.根据权利要求26所述的存储器系统，其中，所述第一多个地址指针为N个地址指针，所述第二多个地址指针为N个地址指针，N为大于或等于2的整数；
针对某一个有效存储块设置的N个地址指针分别指向在所述某一个有效存储块成功写入之前最近成功写入的N个有效存储块之一；
所述校验因子的N个地址指针分别指向所述有效存储块中的最后成功写入的N个有效存储块之一。
30.根据权利要求26所述的存储器系统，所述存储器控制器被配置为对所述校验码数据以及通过所述地址链读取的相应有效存储块的存储数据执行异或操作来恢复所述某一个有效存储块所丢失的数据。
31.一种存储器系统，包括：
存储器，所述存储器包括校验用存储区域和多个存储块；以及
存储器控制器，所述存储器控制器耦接至所述存储器；
所述校验用存储区域存储有对应所述多个存储块的多个有效存储块的校验因子，所述校验因子包括校验码数据和为所述多个存储块配置的第一多个地址指针；
每一个所述有效存储块中设置有第二多个地址指针，每一个所述有效存储块中的第二多个地址指针中的每一个分别指向相应一个其他有效存储块；
其中，所述第一多个地址指针以及所述多个有效存储块的第二多个地址指针能够一起形成覆盖所述多个有效存储块的全部有效存储块的地址链。
CN202180002928.1A 2021-09-29 2021-09-29 用于存储器的数据保护方法及其存储装置 Pending CN114080596A (zh)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
PCT/CN2021/121705 WO2023050147A1 (zh) 2021-09-29 2021-09-29 用于存储器的数据保护方法及其存储装置

Publications (1)

Publication Number Publication Date
CN114080596A true CN114080596A (zh) 2022-02-22

Family

ID=80284708

Family Applications (1)

Application Number Title Priority Date Filing Date
CN202180002928.1A Pending CN114080596A (zh) 2021-09-29 2021-09-29 用于存储器的数据保护方法及其存储装置

Country Status (3)

Country Link
US (1) US20230103004A1 (zh)
CN (1) CN114080596A (zh)
WO (1) WO2023050147A1 (zh)

Family Cites Families (31)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CA1259680A (en) * 1986-05-06 1989-09-19 Mosaid Technologies Inc. Digital signal scrambler
US4924330A (en) * 1988-10-11 1990-05-08 Next, Inc. System and method for improving the performance of high-density data storage media
KR100242178B1 (ko) * 1990-11-09 2000-08-01 토마스 에프.멀베니 융통적인 호스트 인터페이스 제어구조
DE69718355T2 (de) * 1996-09-30 2003-09-04 Matsushita Electric Ind Co Ltd Aufzeichnungsverfahren zur Aufzeichnung audiovisueller Daten auf einer Platte und Informationsverarbeitungssystem
US6269464B1 (en) * 1997-06-18 2001-07-31 Sutmyn Storage Corporation Error checking technique for use in mass storage systems
WO1999010893A2 (en) * 1997-08-28 1999-03-04 Seagate Technology, Inc. Object reconstruction on object oriented data storage device
US6247099B1 (en) * 1999-06-03 2001-06-12 International Business Machines Corporation System and method for maintaining cache coherency and data synchronization in a computer system having multiple active controllers
US20020087956A1 (en) * 2000-09-26 2002-07-04 Pierre-Alain Darlet System and method for linear processing of software modules
US8271672B1 (en) * 2001-08-31 2012-09-18 Juniper Networks, Inc. Guaranteed bandwidth memory apparatus and method
US6950976B1 (en) * 2002-01-25 2005-09-27 Palmone, Inc. Maximum likelihood decoding for input streams containing known data
JP4058322B2 (ja) * 2002-10-07 2008-03-05 株式会社ルネサステクノロジ メモリカード
JP2004220450A (ja) * 2003-01-16 2004-08-05 Hitachi Ltd ストレージ装置、その導入方法、及びその導入プログラム
US20050144516A1 (en) * 2003-12-30 2005-06-30 Gonzalez Carlos J. Adaptive deterministic grouping of blocks into multi-block units
KR20070054735A (ko) * 2004-10-20 2007-05-29 가부시키가이샤 야스카와덴키 인코더 신호 처리 장치 및 그 신호 처리 방법
US7810085B2 (en) * 2005-12-07 2010-10-05 Microsoft Corporation Removal of unnecessary read-to-update upgrades in software transactional memory
US8799882B2 (en) * 2005-12-07 2014-08-05 Microsoft Corporation Compiler support for optimizing decomposed software transactional memory operations
US7747837B2 (en) * 2005-12-21 2010-06-29 Sandisk Corporation Method and system for accessing non-volatile storage devices
US9288010B2 (en) * 2009-08-19 2016-03-15 Qualcomm Incorporated Universal file delivery methods for providing unequal error protection and bundled file delivery services
US8364864B2 (en) * 2010-03-17 2013-01-29 Juniper Networks, Inc. Multi-bank queuing architecture for higher bandwidth on-chip memory buffer
US8537613B2 (en) * 2011-03-31 2013-09-17 Sandisk Technologies Inc. Multi-layer memory system
US8922922B2 (en) * 2012-07-20 2014-12-30 HGST Netherlands B.V. Method to reduce written-in errors in storage media
CN103268266A (zh) * 2013-01-04 2013-08-28 苏州懿源宏达知识产权代理有限公司 闪存校验存储方法
US10043156B2 (en) * 2014-10-16 2018-08-07 Tata Consultancy Services Limited System and method for cross enterprise collaboration
US10296236B2 (en) * 2015-07-01 2019-05-21 Pure Storage, Inc. Offloading device management responsibilities from a storage device in an array of storage devices
US10339000B2 (en) * 2016-09-13 2019-07-02 Sandisk Technologies Llc Storage system and method for reducing XOR recovery time by excluding invalid data from XOR parity
CN108108148B (zh) * 2016-11-24 2021-11-16 舒尔电子(苏州)有限公司 一种数据处理方法和装置
US11188251B2 (en) * 2017-12-19 2021-11-30 Western Digital Technologies, Inc. Partitioned non-volatile memory express protocol for controller memory buffer
US20190303622A1 (en) * 2018-03-28 2019-10-03 Ca, Inc. Bicameral framework for fast and tamper-resistant blockchain validation
TWI704451B (zh) * 2019-01-02 2020-09-11 慧榮科技股份有限公司 用來進行關於容錯式磁碟陣列的動態復原管理之方法與裝置以及依據該方法來運作之儲存系統
US11573723B2 (en) * 2021-05-06 2023-02-07 EMC IP Holding Company LLC Method for managing extents of a system having a protection pool
TWI802324B (zh) * 2022-03-18 2023-05-11 群聯電子股份有限公司 異常斷電恢復方法、記憶體控制電路單元以及記憶體儲存裝置

Also Published As

Publication number Publication date
US20230103004A1 (en) 2023-03-30
WO2023050147A1 (zh) 2023-04-06

Similar Documents

Publication Publication Date Title
TWI514139B (zh) 實體頁、邏輯頁及碼字對應
US20200218602A1 (en) Data Storage Devices and Methods for Rebuilding a Memory Address Mapping Table
TWI528174B (zh) 基於可用記憶體空間選擇冗餘儲存組態
KR102571747B1 (ko) 데이터 저장 장치 및 그것의 동작 방법
CN105009087A (zh) 用于数据存储系统的数据可靠性方案
US11720249B2 (en) Data storage device and method for rewriting parameters thereof
CN113227959A (zh) 具有读取错误处理的存储器控制器
KR20190038964A (ko) 에러 정정 코드 유닛, 그것의 인코딩 및 디코딩 방법
US11288183B2 (en) Operating method of memory system and host recovering data with write error
JP2010079856A (ja) 記憶装置およびメモリ制御方法
CN114503082B (zh) 配备有数据保护方案的存储器装置
CN113467709A (zh) 存储器系统及其操作方法
CN112905107A (zh) 数据存储装置及其操作方法
KR20210152738A (ko) 스트라이프 형태로 데이터를 액세스하는 메모리 시스템 및 메모리 시스템의 동작방법
CN114080596A (zh) 用于存储器的数据保护方法及其存储装置
CN113966499B (zh) 用于存储器的数据保护方法及其存储装置
JP4582078B2 (ja) メモリコントローラ及びフラッシュメモリシステム、並びにフラッシュメモリの制御方法
US10922025B2 (en) Nonvolatile memory bad row management
US10754548B2 (en) Data storage device and method for rewriting parameters thereof
CN107632902B (zh) 用于程序化失败时回复数据的方法、控制器及存储系统
CN113703684A (zh) 基于raid的数据存储方法、数据读取方法及存储器系统
CN115705906A (zh) 具有数据校验电路的数据存储设备

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination