CN113936608A - 级和包括级的显示装置 - Google Patents

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Abstract

提供了级和包括级的显示装置。级包括节点控制单元、节点维护单元和输出单元，节点控制单元与供给到第一输入端子的第一输入信号、供给到第二输入端子的第二输入信号和供给到第三输入端子的第三输入信号对应地控制第一控制节点的电压和第二控制节点的电压。节点控制单元包括第一晶体管、第二晶体管和短路防止晶体管，短路防止晶体管连接在第一晶体管与第二晶体管之间并且包括与第二晶体管的第二电极连接的第一电极和与第一晶体管的第二电极连接的第二电极。

Description

级和包括级的显示装置
相关申请的交叉引用
本申请要求于2020年6月29日提交的第10-2020-0079406号韩国专利申请的优先权和权益，该韩国专利申请出于所有目的通过引用并入本文中，如同在本文中全面阐述一样。
技术领域
本发明的示例性实施方式总体上涉及级和具有级的显示装置，并且更具体地，涉及用于向像素供给光发射控制信号的级和具有级的显示装置。
背景技术
显示装置使用布置在显示单元中的像素来显示图像。像素连接到扫描线和数据线，并且由从扫描线和数据线供给的扫描信号和数据信号来驱动。
像素还可连接到光发射控制线，并且可使用供给到光发射控制线的光发射控制信号来控制像素的光发射时段。在这种情况下，显示装置包括用于生成光发射控制信号的光发射控制驱动器。
光发射控制驱动器包括用于分别将光发射控制信号供给到光发射控制线的级。在定位在每个水平线上的像素的光发射时段期间，级向连接到对应像素的光发射控制线输出第二栅极电压的光发射控制信号，并且在其它时段中，级向光发射控制线输出第一栅极电压的光发射控制信号以阻止光发射。
显示装置可具有当装置需要被保护(诸如从外部施加意外冲击的情况)时在装置被强制复位之后再一次开启电源的时序。
当显示装置被强制复位时，输出第二栅极电压(栅极导通电压)的光发射控制信号可瞬间改变为接地电压。当在强制复位之后经过足够时间之前装置被通电时，在光发射控制驱动器的多个级之中的较低级中，与较高级相比，第一栅极电压(栅极关断电压)相对缓慢地被施加到输出单元的低缓冲栅极。因此，在第二栅极电压与第一栅极电压之间可发生短路。
当第一栅极电压与第二栅极电压之间发生短路时，在像素电路中，第一像素电源(VDD)与数据电压(Vdata)(即，数据信号)之间可发生短路。因此，可发生诸如屏幕闪烁的初始异常光发射现象(闪动现象)。
在本背景技术部分中公开的以上信息仅用于理解本发明概念的背景，并且因此，其可包含不构成现有技术的信息。
发明内容
本发明的示例性实施方式提供了在强制复位之后的通电过程中输出正常光发射控制信号的级。
本发明的示例性实施方式还提供了在强制复位之后的通电过程中输出正常光发射控制信号的显示装置。
本发明概念的附加特征将在下面的描述中阐述，并且部分地将通过该描述而显而易见，或者可通过实践本发明概念而习得。
本发明的示例性实施方式提供了包括节点控制单元、节点维护单元和输出单元的级，节点控制单元与供给到第一输入端子的第一输入信号、供给到第二输入端子的第二输入信号和供给到第三输入端子的第三输入信号对应地控制第一控制节点的电压和第二控制节点的电压，节点维护单元与第二控制节点的电压对应地将第一控制节点的电压保持为恒定，输出单元与第一控制节点的电压和第二控制节点的电压对应地将供给到第一电源端子的第一栅极电压或供给到第二电源端子的第二栅极电压供给到输出端子。
节点控制单元包括第一晶体管、第二晶体管和短路防止晶体管，第一晶体管连接在第一输入端子与第二控制节点之间并且包括连接到第一输入端子的第一电极，第二晶体管连接在第一电源端子与第三输入端子之间并且包括连接到第一电源端子的第一电极，短路防止晶体管连接在第一晶体管与第二晶体管之间并且包括与第二晶体管的第二电极连接的第一电极和与第一晶体管的第二电极连接的第二电极。
短路防止晶体管的栅电极可连接到第三输入端子，并且短路防止晶体管可与第三输入信号对应地导通。
第一晶体管的栅电极可连接到第二输入端子，并且第一晶体管可与第二输入信号对应地导通。
节点控制单元可包括第三晶体管、第四晶体管、第五晶体管、第一耦合晶体管、第一耦合电容器、第六晶体管和第七晶体管，第三晶体管包括与第二晶体管的第二电极连接的第一电极、连接到第三输入端子的第二电极和连接到第二控制节点的栅电极，第四晶体管包括与第二晶体管的栅电极连接的第一电极、连接到第二输入端子的第二电极和与第一晶体管的第二电极连接的栅电极，第五晶体管包括与第四晶体管的第一电极连接的第一电极、连接到第二电源端子的第二电极和连接到第二输入端子的栅电极，第一耦合晶体管包括与第五晶体管的第一电极连接的第一电极，包括第二电极，并且包括连接到第二电源端子的栅电极，第一耦合电容器包括与第一耦合晶体管的第二电极连接的第一电极，并且包括第二电极，第六晶体管包括连接到第一控制节点的第一电极、与第一耦合电容器的第二电极连接的第二电极和连接到第三输入端子的栅电极，第七晶体管包括与第一耦合电容器的第二电极连接的第一电极、连接到第三输入端子的第二电极和与第一耦合电容器的第一电极连接的栅电极。
节点控制单元还可包括第二耦合电容器和第二耦合晶体管，第二耦合电容器包括连接到第二晶体管的第二电极的第一电极和连接到第三晶体管的栅电极的第二电极，第二耦合晶体管连接在第一晶体管的第二电极与第二控制节点之间并且与第二栅极电压对应地导通。
节点维护单元可包括第八晶体管和第一电容器，第八晶体管包括连接到第一电源端子的第一电极、连接到第一控制节点的第二电极和连接到第一晶体管的第二电极的栅电极，第一电容器包括连接到第一电源端子的第一电极和连接到第一控制节点的第二电极。
输出单元可包括上拉晶体管和下拉晶体管，上拉晶体管包括连接到第一电源端子的第一电极、连接到输出端子的第二电极和连接到第一控制节点的栅电极，下拉晶体管包括连接到输出端子的第一电极，连接到第二电源端子的第二电极，以及连接到第二控制节点的栅电极。
第一栅极电压可设置为栅极关断电压，并且第二栅极电压可设置为栅极导通电压。
第一输入信号可为起始脉冲或前一级的输出信号，并且第二输入信号和第三输入信号可分别是第一时钟信号和第二时钟信号。
第一时钟信号和第二时钟信号可交替地具有栅极导通电压部分，并且起始脉冲或前一级的输出信号可被供给以与第一时钟信号的至少一个栅极导通电压部分重叠。
本发明的另一示例性实施方式提供一种显示装置，其包括连接到扫描线、数据线和光发射控制线的像素、向扫描线供给扫描信号的扫描驱动器、向数据线供给数据信号的数据驱动器，以及包括多个级以向光发射控制线供给光发射控制信号的光发射控制驱动器。
级中的每个包括节点控制单元、节点维护单元和输出单元，节点控制单元与供给到第一输入端子的第一输入信号、供给到第二输入端子的第二输入信号和供给到第三输入端子的第三输入信号对应地，控制第一控制节点的电压和第二控制节点的电压，并且包括第一晶体管、第二晶体管和短路防止晶体管，第一晶体管连接在第一输入端子与第二控制节点之间并且包括连接到第一输入端子的第一电极，第二晶体管连接在第一电源端子与第三输入端子之间并且包括连接到第一电源端子的第一电极，短路防止晶体管连接在第一晶体管与第二晶体管之间并且包括与第二晶体管的第二电极连接的第一电极和与第一晶体管的第二电极连接的第二电极，节点维护单元与第二控制节点的电压对应地将第一控制节点的电压保持为恒定，输出单元与第一控制节点的电压和第二控制节点的电压对应地，将供给到第一电源端子的第一栅极电压或供给到第二电源端子的第二栅极电压供给到输出端子。
将理解的是，前面的一般描述和下面的详细描述都是示例性和解释性的，并且旨在提供对所要求保护的本发明的进一步解释。
附图说明
附图被包括以提供对本发明的进一步理解并且被并入本说明书中并且构成了本说明书的一部分，附图示出了本发明的示例性实施方式并且与描述一同用于解释本发明概念。
图1示出了根据本发明的示例性实施方式的显示装置。
图2A和图2B分别示出了根据本发明的示例性实施方式的像素。
图3示出了根据本发明的示例性实施方式的光发射控制驱动器。
图4示出了图3中所示的级的示例性实施方式。
图5是示出在图4的第一级中测量的信号的实例的波形图。
图6A和图6B是示出用于描述本发明的第十三晶体管的效果的关于显示装置的序列的示意性显示的波形图。
图7是用于描述图4中所示的第一级的操作的信号流图。
具体实施方式
在下面的描述中，为了解释的目的，阐述了许多具体细节以提供对本发明的各种示例性实施方式的透彻理解。如本文中所使用的，“实施方式”是采用本文中所公开的本发明概念中的一种或多种的装置或方法的非限制性实例。然而，显而易见的是，各种示例性实施方式可在没有具体细节的情况下或者在一个或多个等同排列的情况下实践。在其它实例中，公知的结构和装置以框图形式示出，以避免不必要地混淆各种示例性实施方式。另外，各种示例性实施方式可为不同的，但是不必是排他的。例如，在不背离本发明概念的情况下，示例性实施方式的具体形状、配置和特性可使用或实现在另一示例性实施方式中。
除非另有指明，否则所示的示例性实施方式将被理解为提供本发明概念可在实践中实现的一些方式的变化细节的示例性特征。因此，除非另有指明，否则各种实施方式的特征、部件、模块、层、膜、面板、区和/或方面等(在下文中单独称为或统称为“元件”)可在不背离本发明概念的情况下以其它方式组合、分离、互换和/或重新排列。
交叉影线和/或阴影在附图中的使用通常被提供以阐明相邻元件之间的边界。由此，除非指明，否则无论交叉影线或阴影存在与否，都不传达或指示对特定材料、材料性能、尺寸、比例、所示元件之间的共性和/或元件的任何其它特性、属性、性能等的任何偏好或要求。另外，在附图中，出于清楚和/或描述的目的，元件的尺寸和相对尺寸可被夸大。当示例性实施方式可不同地实现时，可与所描述的顺序不同地执行具体工艺顺序。例如，两个连续描述的工艺可基本上同时执行或者以与所描述的顺序相反的顺序执行。此外，相似的附图标记表示相似的元件。
当元件(诸如，层)被称为在另一元件或层“上”、“连接到”或“联接到”另一元件或层时，它可直接在另一元件或层上、直接连接到或联接到另一元件或层，或者可存在有中间元件或层。然而，当元件或层被称为“直接”在另一元件或层“上”、“直接连接到”或“直接联接到”另一元件或层时，则不存在中间元件或层。为此，措辞“连接”可是指在具有或不具有中间元件的情况下的物理、电气和/或流体连接。另外，D1-轴、D2-轴和D3-轴不限于直角坐标系的三个轴(诸如x-轴、y-轴和z-轴)，并且可以更广泛的含义解释。例如，D1-轴、D2-轴和D3-轴可彼此垂直，或者可代表彼此不垂直的不同方向。为了这种公开的目的，“X、Y和Z中的至少一个”和“选自由X、Y和Z构成的集群中的至少一个”可被解释为仅X、仅Y、仅Z、或X、Y和Z中的两个或更多个的任何组合，诸如，以XYZ、XYY、YZ和ZZ为例。如本文中所使用的，措辞“和/或”包括相关联所列项目中的一个或多个的任何和所有组合。
虽然措辞“第一”、“第二”等可在本文中用于描述各种类型的元件，但是这些元件不应受这些措辞的限制。这些措辞用于将一个元件与另一元件区分开。因此，在不背离本公开的教导的情况下，以下讨论的第一元件可被称为第二元件。
空间相对措辞诸如“之下(beneath)”、“下方(below)”、“下面(under)”、“下(lower)”、“上方(above)”、“上(upper)”、“上面(over)”、“更高(higher)”、“侧(side)”(例如，如在“侧壁(sidewall)”中)等可在本文中出于描述性目的使用，并且因此，用于描述如附图中所示的一个元件与另一元件的关系。除了图中描绘的取向以外，空间相对措辞还旨在涵盖设备在使用、操作和/或制造中的不同取向。例如，如果附图中的设备被翻转，则被描述为在其它元件或特征“下方”或“之下”的元件将随后被取向为在其它元件或特征“上方”。因此，示例性措辞“下方”能涵盖上方和下方的取向这两者。此外，设备可以其它方式取向(例如，旋转90度或在其它取向处)，并且由此，本文中所使用的空间相对描述词被相应地解释。
本文中所使用的专业用语是出于描述特定实施方式的目的，并且不旨在限制。除非上下文另有清楚指示，否则如本文中所使用的单数形式“一(a)”、“一(an)”和“该(the)”也旨在包括复数形式。此外，措辞“包括(comprises)”、“包括(comprising)”、“包括(includes)”和/或“包括(including)”，当在本说明书中使用时，指明所陈述的特征、整数、步骤、操作、元件、部件和/或其集群的存在，但是不排除一个或多个其它特征、整数、步骤、操作、元件、部件和/或其集群的存在或添加。也要注意的是，如本文中所使用的，措辞“基本上(substantially)”、“约(about)”以及相似措辞被用作近似的措辞而不是程度的措辞，并且由此，被利用以考虑本领域普通技术人员将认识到的测量值、计算值和/或提供值的固有偏差。
本文中参照作为理想化的示例性实施方式和/或中间结构的示意性图示的剖面图示和/或分解图示对各种示例性实施方式进行描述。由此，由例如制造技术和/或公差的结果所导致的图示的形状的变化将被预料。因此，本文中所公开的示例性实施方式不应必须被解释为限于特定所示的区的形状，而是将包括由例如制造导致的形状的偏差。通过这种方式，图中所示的区本质上可为示意性的，并且这些区的形状可不反映装置的区的实际形状，并且由此不必旨在进行限制。
如本领域中的惯例，在功能的块、单元和/或模块方面，在附图中示出并且描述了一些示例性实施方式。本领域技术人员将领会的是，这些块、单元和/或模块通过电子(或光学)电路(诸如可使用基于半导体的制造技术或其它制造技术形成的逻辑电路、分立部件、微处理器、硬连线电路、存储器元件和布线连接件等)物理地实现。在由微处理器或其它相似硬件实现块、单元和/或模块的情况下，可使用软件(例如，微代码)对它们进行编程和控制，以执行本文中所讨论的各种功能，并且可选择性由固件和/或软件来驱动。也预期到的是，每个块、单元和/或模块可由专用硬件实现，或者可实现为执行一些功能的专用硬件与执行其它功能的处理器(例如，一个或多个编程的微处理器和相关联的电路)的组合。而且，在不背离本发明概念的范围的情况下，一些示例性实施方式的每个块、单元和/或模块可在物理上分离成两个或更多个交互和分立的块、单元和/或模块。此外，在不背离本发明概念的范围的情况下，一些示例性实施方式的块、单元和/或模块可物理地组合成更复杂的块、单元和/或模块。
除非另有限定，否则本文中所使用的所有术语(包括技术术语和科学术语)具有与本公开所属技术领域的普通技术人员通常理解的含义相同的含义。除非在本文中明确地这样限定，否则术语(诸如常用词典中限定的那些)应被解释为具有与它们在相关领域的上下文中的含义一致的含义，并且不应以理想化或过于正式的含义来解释。
图1示出了根据本发明的示例性实施方式的显示装置1。图1示出了作为显示装置1的实例的包括发光元件的发光显示装置，但是根据本发明概念的显示装置1不限于此。
参照图1，根据本发明的示例性实施方式的显示装置1可包括显示单元10、用于驱动显示单元10的扫描驱动器20、光发射控制驱动器30、数据驱动器40和时序控制器50。
显示单元10可包括多个扫描线S1至Sn、多个光发射控制线E1至En以及连接到多个数据线D1至Dm的多个像素PXL。在描述本发明的示例性实施方式时，“连接”可全面地意味着电连接和/或物理连接。例如，多个像素PXL可电连接到多个扫描线S1至Sn、多个光发射控制线E1至En以及多个数据线D1至Dm。
多个像素PXL可分别从多个扫描线S1至Sn、多个光发射控制线E1至En和多个数据线D1至Dm接收扫描信号、光发射控制信号和数据信号。此外，像素PXL还可接收驱动电源，诸如第一像素电源VDD和第二像素电源VSS。
当从多个扫描线S1至Sn供给各自的扫描信号时，像素PXL可从多个数据线D1至Dm接收各自的数据信号，并且发射具有与数据信号对应的亮度的光。因此，与每帧的数据信号对应的图像可显示在显示单元10上。
每个像素PXL可包括发光元件和用于驱动发光元件的像素电路。像素电路与数据信号对应地控制经由发光元件从第一像素电源VDD流向第二像素电源VSS的驱动电流。
扫描驱动器20可从时序控制器50接收扫描驱动控制信号SCS，并且与扫描驱动控制信号SCS对应地将扫描信号供给到多个扫描线S1至Sn。例如，扫描驱动器20可将扫描信号顺序地供给到多个扫描线S1至Sn。当扫描信号被顺序地供给到多个扫描线S1至Sn时，与每个扫描信号对应地，以水平线为单位来选择像素PXL。
扫描信号可用于以水平线为单位来选择像素PXL。例如，扫描信号可具有连接到多个数据线D1至Dm的每个像素PXL的晶体管可导通的第二栅极电压(例如，逻辑低电平)，并且每个水平时间可供给到布置在对应水平线上的像素PXL。
接收扫描信号的像素PXL可在扫描信号被供给的时段期间连接到多个数据线D1至Dm，并且因此接收每个数据信号。也即，可供给扫描信号以将数据信号传送到像素PXL。
光发射控制驱动器30可从时序控制器50接收光发射驱动控制信号ECS，并且与光发射驱动控制信号ECS对应地将光发射控制信号供给到多个光发射控制线E1至En。例如，光发射控制驱动器30可将光发射控制信号顺序地供给到多个光发射控制线E1至En。
光发射控制信号可用于以水平线为单位来控制像素PXL的光发射时段(例如，光发射时间点和/或光发射持续时间)。例如，光发射控制信号可具有第一栅极电压(栅极关断电压，例如，逻辑高电平)，而在第一栅极电压处，布置在多个像素PXL中的每个的电流路径上的至少一个晶体管可关断。在这种情况下，接收光发射控制信号的像素PXL可在光发射控制信号被供给的时段期间设置为非光发射状态，并且可在其它时段期间设置为光发射状态。同时，当与黑色灰度对应的数据信号被供给到具体像素PXL时，即使没有供给光发射控制信号，像素PXL也可与数据信号对应地保持非光发射状态。
数据驱动器40可从时序控制器50接收数据驱动控制信号DCS和图像数据RGB，并且与数据驱动控制信号DCS和图像数据RGB对应地将数据信号供给到多个数据线D1至Dm。供给到多个数据线D1至Dm的数据信号被供给到由扫描信号选择的像素PXL。为此，数据驱动器40可与每个扫描信号同步地将数据信号供给到多个数据线D1至Dm。例如，针对每个水平时间，数据驱动器40可与扫描信号同步地将与对应的水平线的像素PXL对应的数据信号输出到多个数据线D1至Dm。
时序控制器50从外部(例如，主机处理器)接收各种控制信号(例如，垂直同步信号(例如，图6A中的Vsync)、水平同步信号、主时钟信号等)，并且与控制信号对应地生成扫描驱动控制信号SCS、光发射驱动控制信号ECS和数据驱动控制信号DCS。扫描驱动控制信号SCS、光发射驱动控制信号ECS和数据驱动控制信号DCS可分别被供给到扫描驱动器20、光发射控制驱动器30和数据驱动器40。
扫描驱动控制信号SCS可包括起始脉冲和时钟信号。起始脉冲控制第一扫描信号(例如，供给到第一扫描线S1的扫描信号)的输出时序，并且时钟信号用于使起始脉冲移位。
光发射驱动控制信号ECS包括起始脉冲和时钟信号。起始脉冲控制第一光发射控制信号(例如，供给到第一光发射控制线E1的光发射控制信号)的输出时序，并且时钟信号用于使起始脉冲移位。
数据驱动控制信号DCS包括源起始脉冲和时钟信号。源起始脉冲控制数据的采样起始时间点，并且时钟信号用于控制采样操作。
另外，时序控制器50从外部接收输入图像数据，重新排列输入图像数据，并且生成图像数据RGB。时序控制器50可将图像数据RGB供给到数据驱动器40。
图2A和图2B分别示出了根据本发明的示例性实施方式的像素。例如，图2A和图2B示出了可布置在图1的显示单元10上的像素PXL的不同实施方式。像素PXL或像素PXL'可布置在显示单元10的第i(i是自然数)水平线和第j(j是自然数)竖直线上，并且可连接到第i扫描线Si、第i光发射控制线Ei和第j数据线Dj。根据示例性实施方式，布置在图1的显示单元10上的像素PXL可具有基本上相同的结构。在下文中，“第i扫描线Si”、“第i光发射控制线Ei”和“第j数据线Dj”分别被称为“扫描线Si”、“光发射控制线Ei”和“数据线Dj”。
参照图2A，根据本发明的示例性实施方式的像素PXL包括发光元件LD和用于驱动发光元件LD的像素电路PXC。根据示例性实施方式，发光元件LD可连接在像素电路PXC与第二像素电源VSS之间，但是发光元件LD的位置不限于此。例如，在另一实施方式中，发光元件LD可连接在第一像素电源VDD与像素电路PXC之间。
发光元件LD在正向方向上连接在第一像素电源VDD与第二像素电源VSS之间。例如，发光元件LD的阳极可经由像素电路PXC连接到第一像素电源VDD，并且发光元件LD的阴极可连接到第二像素电源VSS。第一像素电源VDD和第二像素电源VSS可具有允许发光元件LD发射光的电位差。例如，第一像素电源VDD可为高电位像素电源，并且第二像素电源VSS可具有低电位像素电源，该低电位像素电源具有比第一像素电源VDD的电位低了发光元件LD的阈值电压或更大电压的电位。
发光元件LD可由有机发光二极管配置。另外，发光元件LD可由微发光二极管(LED)或无机LED(诸如量子点LED)配置。另外，发光元件LD可以复合方式由有机材料和无机材料配置。在图2A和图2B中，像素PXL和像素PXL'各自包括单个发光元件LD，但是在另一实施方式中，像素PXL和像素PXL'可各自包括多个发光元件LD，并且多个发光元件LD可彼此串联、并联、或串联和并联地连接。像素电路PXC包括第一晶体管T1(驱动晶体管)、第二晶体管T2、第三晶体管T3和存储电容器Cst。
第一晶体管T1连接在第一像素电源VDD与发光元件LD之间。例如，第一晶体管T1的第一电极(例如，源电极)可连接到第一像素电源VDD，并且第一晶体管T1的第二电极(例如，漏电极)可经由第三晶体管T3连接到发光元件LD的阳极。另外，第一晶体管T1的栅电极连接到第十节点N10。与第十节点N10的电压对应地，第一晶体管T1控制经由第三晶体管T3和发光元件LD从第一像素电源VDD流向第二像素电源VSS的驱动电流。
第二晶体管T2连接在数据线Dj与第十节点N10之间。例如，第二晶体管T2的第一电极(例如，源电极)可连接到数据线Dj，并且第二晶体管T2的第二电极(例如，漏电极)可连接到第十节点N10。另外，第二晶体管T2的栅电极连接到扫描线Si。第二晶体管T2在扫描信号(例如，逻辑低电平的扫描信号)被供给到扫描线Si时导通，以将来自数据线Dj的数据信号传送到第十节点N10。
第三晶体管T3连接在第一晶体管T1与发光元件LD之间。例如，第三晶体管T3的第一电极(例如，源电极)可连接到第一晶体管T1的第二电极，并且第三晶体管T3的第二电极(例如，漏电极)可连接到发光元件LD的阳极。另外，第三晶体管T3的栅电极连接到光发射控制线Ei。第三晶体管T3在光发射控制信号(例如，逻辑高电平的光发射控制信号)被供给到光发射控制线Ei时关断，并且在其它情况下(例如，当光发射控制信号的供给停止并且光发射控制线Ei的电压保持在第二栅极电压处时)导通。
当第三晶体管T3关断时，第一晶体管T1与发光元件LD之间的连接被切断。因此，在像素PXL内部阻挡了电流路径，并且因此像素PXL不发射光。当第三晶体管T3导通时，第一晶体管T1和发光元件LD彼此电连接。因此，在像素PXL中形成了驱动电流可流过的电流路径，并且因此像素PXL可发射光。
存储电容器Cst连接在第一像素电源VDD与第十节点N10之间。存储电容器Cst充电有与第十节点N10的电压对应的电压。
同时，像素PXL的结构可根据本发明概念进行各种改变。例如，像素电路PXC的结构可如图2B中所示的实施方式中的那样改变。
参照图2B，像素PXL'包括发光元件LD和用于驱动发光元件LD的像素电路PXC'。像素电路PXC'包括第一晶体管T1至第七晶体管T7和存储电容器Cst。
发光元件LD的阳极经由第三晶体管T3连接到第一晶体管T1，并且发光元件LD的阴极连接到第二像素电源VSS。当从第一晶体管T1供给驱动电流时，发光元件LD生成与驱动电流的电流量对应的亮度的光。
第一晶体管T1的第一电极经由第四晶体管T4连接到第一像素电源VDD，并且第一晶体管T1的第二电极经由第三晶体管T3连接到发光元件LD的阳极。另外，第一晶体管T1的栅电极可连接到第十节点N10。与第十节点N10的电压对应地，第一晶体管T1控制经由发光元件LD从第一像素电源VDD流向第二像素电源VSS的驱动电流。
第二晶体管T2连接在数据线Dj与第一晶体管T1的第一电极之间。另外，第二晶体管T2的栅电极连接到扫描线Si。第二晶体管T2在扫描信号被供给到扫描线Si时导通，以连接数据线Dj和第一晶体管T1的第一电极。因此，当第二晶体管T2导通时，来自数据线Dj的数据信号可被传送到第一晶体管T1的第一电极。同时，在第二晶体管T2由扫描信号导通的时段期间，第一晶体管T1通过第五晶体管T5以二极管连接的形式导通。因此，来自数据线Dj的数据信号可经由第二晶体管T2、第一晶体管T1和第五晶体管T5传送到第十节点N10。然后，存储电容器Cst充电有与数据信号对应的电压和第一晶体管T1的阈值电压。
第三晶体管T3连接在第一晶体管T1与发光元件LD之间，并且第三晶体管T3的栅电极连接到光发射控制线Ei。第三晶体管T3在光发射控制信号被供给到光发射控制线Ei时关断，并且在其它情况下导通。
第四晶体管T4连接在第一像素电源VDD与第一晶体管T1之间。另外，第四晶体管T4的栅电极连接到光发射控制线Ei。第四晶体管T4在光发射控制信号被供给到光发射控制线Ei时关断，并且在其它情况下导通。
也即，第三晶体管T3和第四晶体管T4可通过光发射控制信号同时导通或关断。当第三晶体管T3和第四晶体管T4导通时，在像素PXL'中形成驱动电流流过的电流路径。相反，当第三晶体管T3和第四晶体管T4关断时，电流路径被阻挡，并且因此像素PXL'不发射光。
第五晶体管T5连接在第一晶体管T1与第十节点N10之间。另外，第五晶体管T5的栅电极连接到扫描线Si。第五晶体管T5在扫描信号被供给到扫描线Si时导通，以连接第一晶体管T1的第二电极和第十节点N10。因此，当第五晶体管T5导通时，第一晶体管T1以二极管的形式连接。
第六晶体管T6连接在第十节点N10与初始化电源Vint之间。另外，第六晶体管T6的栅电极连接到前一扫描线，例如，第(i-1)扫描线Si-1。第六晶体管T6在扫描信号被供给到第(i-1)扫描线Si-1时导通，以将第十节点N10的电压初始化为初始化电源Vint的电压。
同时，在本实施方式中，第(i-1)扫描线Si-1被用作用于初始化第一晶体管T1的栅电极(即，第十节点N10)的初始化控制线，但是本发明概念不限于此。例如，在另一实施方式中，包括第(i-2)扫描线的另一控制线可被用作用于初始化第一晶体管T1的栅电极的初始化控制线。
初始化电源Vint的电压可设置为低于数据信号的电压。也即，初始化电源Vint的电压可设置为等于或小于数据信号的最小电压。因此，在将当前帧的数据信号发送到每个像素PXL'之前，当由前一帧的数据信号充电的第十节点N10的电压被初始化为等于或小于数据信号的最小电压时，与前一帧的数据信号无关地，第一晶体管T1在扫描信号被供给到扫描线Si的情况下在正向方向上以二极管连接。因此，当前帧的数据信号可稳定地传送到第十节点N10。
第七晶体管T7连接在初始化电源Vint与发光元件LD的阳极之间。另外，第七晶体管T7的栅电极连接到第(i+1)扫描线Si+1。第七晶体管T7在扫描信号被供给到第(i+1)扫描线Si+1时导通，以将发光元件LD的阳极电压初始化为初始化电源Vint的电压。因此，像素PXL'可表现出统一的亮度特性。
同时，在本实施方式中，与第七晶体管T7的栅电极连接的阳极初始化控制线是第(i+1)扫描线Si+1的情况被描述为实例，但是本发明概念不限于此。例如，在另一实施方式中，第七晶体管T7的栅电极可连接到当前扫描线，即扫描线Si(或另一控制线)。在这种情况下，当扫描信号被供给到扫描线Si时，发光元件LD的阳极电压可被初始化为初始化电源Vint的电压。
存储电容器Cst连接在第一像素电源VDD与第十节点N10之间。存储电容器Cst充电有与数据信号对应的电压和与第一晶体管T1的阈值电压对应的电压。
同时，像素PXL和像素PXL'的结构不限于图2A和图2B中所示的实施方式。例如，像素电路PXC和像素电路PXC'可具有当前已知的各种结构。
图3示出了根据本发明的示例性实施方式的光发射控制驱动器30。为了方便起见，在图3中，仅示出了四个级ST，例如，第一级ST1至第四级ST4。根据实施方式，光发射控制驱动器30可包括独立地连接到起始脉冲SP的输入端子(例如，第一级ST1的第一输入端子101)的多个级ST，诸如，第一级ST1至第四级ST4。
参照图3，根据本发明的示例性实施方式的光发射控制驱动器30可包括多个级ST，以分别将多个光发射控制信号供给到多个光发射控制线E。级ST可连接到第一光发射控制线E1至第四光发射控制线E4中的任何一个，并且可与至少一个时钟信号CLK(例如，第一时钟信号CLK1和第二时钟信号CLK2)对应地被驱动。例如，第一级ST1至第四级ST4可分别连接到第一光发射控制线E1至第四光发射控制线E4，并且可使用第一时钟信号CLK1和第二时钟信号CLK2生成各自的光发射控制信号。第一级ST1至第四级ST4可将光发射控制信号顺序地输出到第一光发射控制线E1至第四光发射控制线E4。根据示例性实施方式，多个级ST可具有基本上相同的电路结构。
多个级ST中的每个可包括第一输入端子101、第二输入端子102、第三输入端子103和输出端子104。
第一输入端子101可接收第一输入信号。根据示例性实施方式，第一输入信号可为起始脉冲SP或前一级的输出信号(即，前一级的光发射控制信号)。例如，第一级(在下文中称为“第一级ST1”)可通过第一输入端子101接收起始脉冲SP，并且剩余的级ST可通过各自的第一输入端子101接收前一级的输出信号。
第二输入端子102和第三输入端子103可分别接收第二输入信号和第三输入信号。根据示例性实施方式，第k(k是奇数或偶数)级STk的第二输入信号和第三输入信号可分别为第一时钟信号CLK1和第二时钟信号CLK2。另外，第(k+1)级STk+1的第二输入信号和第三输入信号可分别为第二时钟信号CLK2和第一时钟信号CLK1。例如，第k级STk可分别通过第二输入端子102和第三输入端子103接收第一时钟信号CLK1和第二时钟信号CLK2，并且第(k+1)级STk+1可分别通过第二输入端子102和第三输入端子103接收第二时钟信号CLK2和第一时钟信号CLK1。
第一时钟信号CLK1和第二时钟信号CLK2可交替地具有第二栅极电压。例如，第一时钟信号CLK1和第二时钟信号CLK2可为具有相同的周期和彼此不重叠的相位的信号。例如，第二时钟信号CLK2可为第一时钟信号CLK1被移位半个周期的形式的时钟信号。
附加地，级ST可通过接收第一栅极电压VGH和第二栅极电压VGL来操作。第一栅极电压VGH可设置为栅极关断电压，例如，逻辑高电平，并且第二栅极电压VGL可设置为栅极导通电压，例如，逻辑低电平(当像素由P型晶体管形成时)。在这种情况下，传送到输出端子104的第一栅极电压VGH可被用作防止像素PXL的光发射的光发射控制信号。
图4示出了图3中所示的级ST的实施方式。根据实施方式，配置光发射控制驱动器30的多个级ST可具有基本上相同的电路结构。因此，在图4中，代表多个级ST仅示出了第一级ST1和第二级ST2。
参照图3和图4，级ST可包括节点控制单元SST1、输出单元SST2(或缓冲单元)和节点维护单元SST3。
级ST可使用分别通过第一输入端子101至第三输入端子103供给的第一输入信号至第三输入信号来生成光发射控制信号，并且将生成的光发射控制信号供给到输出端子104。例如，级ST可使用分别通过第一输入端子101至第三输入端子103供给的起始脉冲SP或前一级的输出信号以及第一时钟信号CLK1和第二时钟信号CLK2，来输出光发射控制信号。
此外，级ST可分别通过第一电源端子105和第二电源端子106接收第一栅极电压VGH和第二栅极电压VGL。级ST可使用分别供给到第一电源端子105和第二电源端子106的第一栅极电压VGH和第二栅极电压VGL的电压来控制输出端子104的电压。为了方便起见，以下基于第一级ST1对每个级ST的电路结构进行描述。
首先，输出单元SST2可连接到第一电源端子105和第二电源端子106，并且输出单元SST2可基于第二控制节点Q的电压和第一控制节点QB的电压来将第一栅极电压VGH输出到输出端子104作为光发射控制信号。
输出单元SST2可包括第九晶体管M9(或上拉晶体管)和第十晶体管M10(或下拉晶体管)。
第九晶体管M9可包括连接到第一电源端子105的第一电极、连接到输出端子104的第二电极和连接到第一控制节点QB的栅电极。
第十晶体管M10可包括连接到输出端子104的第一电极、连接到第二电源端子106的第二电极和连接到第二控制节点Q的栅电极。
节点控制单元SST1可连接到第一输入端子101、第二输入端子102、第三输入端子103、第一电源端子105和第二电源端子106。节点控制单元SST1可使用通过第一输入端子101提供的起始脉冲SP(或前一级的光发射控制信号)来控制第一控制节点QB的电压和第二控制节点Q的电压。
节点控制单元SST1可包括第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7、第十一晶体管M11、第十二晶体管M12和第十三晶体管M13、第二电容器C2(或第一耦合电容器)和第三电容器C3(或第二耦合电容器)。
第一晶体管M1可包括连接到第一输入端子101的第一电极、与第十二晶体管M12的第一电极连接的第二电极以及连接到第二输入端子102的栅电极。
第二晶体管M2可包括连接到第一电源端子105的第一电极、与第三晶体管M3的第一电极连接的第二电极和连接到第十一晶体管M11的第一电极的栅电极。
第三晶体管M3可包括与第二晶体管M2的第二电极连接的第一电极、连接到第三输入端子103的第二电极和连接到第二控制节点Q的栅电极。
第三电容器C3可形成在第二晶体管M2的第二电极与第二控制节点Q之间，并且可包括与第二晶体管M2的第二电极连接的第一电极和连接到第二控制节点Q的第二电极。根据实施方式，第三电容器C3的第二电极可连接到第三晶体管M3的栅电极。
第四晶体管M4可包括与第二晶体管M2的栅电极连接的第一电极、连接到第二输入端子102的第二电极和与第一晶体管M1的第二电极连接的栅电极。第四晶体管M4可通过串联地连接晶体管M41和晶体管M42来配置。
第五晶体管M5可包括与第二晶体管M2的栅电极连接的第一电极、连接到第二电源端子106的第二电极和连接到第二输入端子102的栅电极。
第六晶体管M6可包括连接到第一控制节点QB的第一电极、与第七晶体管M7的第一电极连接的第二电极和连接到第三输入端子103的栅电极。
第七晶体管M7可包括与第六晶体管M6的第二电极连接的第一电极、连接到第三输入端子103的第二电极和与第十一晶体管M11的第二电极连接的栅电极。
第二电容器C2(或第一耦合电容器)可形成在第十一晶体管M11的第二电极与第六晶体管M6的第二电极之间，并且可包括与第十一晶体管M11的第二电极连接的第一电极和与第六晶体管M6的第二电极连接的第二电极。
第十一晶体管M11(或第一耦合晶体管)可包括与第二晶体管M2的栅电极连接的第一电极、与第二电容器C2的第一电极连接的第二电极和连接到第二电源端子106的栅电极。
第十二晶体管M12(或第二耦合晶体管)可包括与第一晶体管M1的第二电极连接的第一电极、连接到第二控制节点Q的第二电极和连接到第二电源端子106的栅电极。
第十三晶体管M13(或短路保护晶体管)可包括与第二晶体管M2的第二电极连接的第一电极、与第一晶体管M1的第二电极连接的第二电极和连接到第三输入端子103的栅电极。当显示装置1在被强制复位之后被通电时，逻辑低电平的第二时钟信号CLK2可被施加到第三输入端子103，并且因此，第十三晶体管M13可响应于逻辑低电平的第二时钟信号CLK2而导通。因此，第一晶体管M1的第二电极(即，第二控制节点Q)处的电压可立即具有第一栅极电压VGH，并且因此，可快速地执行第十晶体管M10的关断操作。
节点维护单元SST3可响应于第二控制节点Q的电压将第一控制节点QB的电压保持为恒定。节点维护单元SST3可包括第一电容器C1和第八晶体管M8。
第一电容器C1形成在第一电源端子105和第一控制节点QB之间，并且可包括连接到第一电源端子105的第一电极和连接到第一控制节点QB的第二电极。
第八晶体管M8可包括连接到第一电源端子105的第一电极、连接到第一控制节点QB的第二电极以及与第一晶体管M1的第二电极连接的栅电极。第八晶体管M8可响应于第一晶体管M1的第二电极处的电压(即，第二控制节点Q的电压)，将第一控制节点QB的电压保持为恒定。例如，当第二控制节点Q的电压具有逻辑低电平时，第八晶体管M8可使用第一栅极电压VGH将第一控制节点QB的电压保持为逻辑高电平。
第一晶体管M1至第十三晶体管M13中的每个可为P型晶体管。在图4中，第一晶体管M1至第三晶体管M3和第五晶体管M5至第十三晶体管M13是单栅极晶体管，并且第四晶体管M4是双栅极晶体管(即，由彼此串联连接并且具有彼此连接的栅电极的两个晶体管配置的双栅极晶体管)，但是本发明概念不限于此。例如，为了改善可靠性，第一晶体管M1至第三晶体管M3和第五晶体管M5至第十三晶体管M13中的至少一个可附加地实现为双栅极晶体管。
分别供给到第二级ST2的第一输入端子101至第三输入端子103的第一输入信号至第三输入信号与第一级ST1的那些不同，并且第二级ST2的电路结构和操作过程可与第一级ST1基本上相同。例如，第二级ST2可分别通过第一输入端子101至第三输入端子103接收第一级ST1的输出信号(供给到第一光发射控制线E1的第一光发射控制信号)、第二时钟信号CLK2和第一时钟信号CLK1，并且使用第一级ST1的输出信号、第二时钟信号CLK2和第一时钟信号CLK1来生成光发射控制信号。由第二级ST2生成的光发射控制信号被供给到第二光发射控制线E2。
级ST可以上述方法顺序地将光发射控制信号输出到每个光发射控制线E。第二级ST2和后续的级ST中的每个的电路结构和操作过程可与第一级ST1基本上相同。因此，省略对其的详细描述。
为了描述第一级ST1和第二级ST2的操作，可参照图4。
图5是示出在图4的第一级ST1中测量的信号的实例的波形图。由于第一级ST1和第二级ST2的操作基本上彼此相同或相似，所以通过覆盖第一级ST1和第二级ST2来对第一级ST1的操作进行描述。
参照图4和图5，被施加到第二输入端子102的第一时钟信号CLK1可在2个水平时间2H的时段中具有逻辑低电平和逻辑高电平。这里，逻辑低电平可与使P型晶体管导通的第二栅极电压VGL的电压电平相同。逻辑高电平可与使P型晶体管关断的第一栅极电压VGH的电平相同。
被施加到第三输入端子103的第二时钟信号CLK2可具有第一时钟信号CLK1被延迟半个周期(即，一个水平时间1H)的波形。
在第一时间点t1处，第一输入端子101处的输入电压V_IN(例如，起始脉冲SP)可从逻辑低电平改变为逻辑高电平。例如，输入电压V_IN可在四个水平时间4H中保持为逻辑高电平。
在第一时间点t1处，第二控制节点Q处的第二节点电压V_Q可具有逻辑低电平，第一控制节点QB处的第一节点电压V_QB可具有逻辑高电平，并且输出端子104处的输出电压V_OUT(即，光发射控制信号)可具有逻辑低电平。
在第二时间点t2处，第一时钟信号CLK1可从逻辑高电平改变为逻辑低电平。
第一晶体管M1可响应于逻辑低电平的第一时钟信号CLK1而导通，并且逻辑高电平的输入电压V_IN可被施加到第十二晶体管M12的第一电极。因为第十二晶体管M12由第二栅极电压VGL导通，所以逻辑高电平的输入电压V_IN可通过第十二晶体管M12被施加到第二控制节点Q。也即，第二节点电压V_Q可改变为具有逻辑高电平。
另外，第五晶体管M5可响应于逻辑低电平的第一时钟信号CLK1而导通，并且第二栅极电压VGL可被施加到第十一晶体管M11的第一电极。因为第十一晶体管M11由第二栅极电压VGL导通，所以第二栅极电压VGL可被施加到第二电容器C2的第一电极。第七晶体管M7可响应于第二栅极电压VGL(即，被施加到第二电容器C2的第一电极的第二栅极电压VGL)而导通，并且逻辑高电平的第二时钟信号CLK2可被施加到第二电容器C2的第二电极。因此，与逻辑高电平和逻辑低电平之间的差对应的电压可在第二电容器C2中充电。
第二晶体管M2可响应于第二栅极电压VGL而导通，并且第一栅极电压VGH可被施加到第三电容器C3的第一电极。因为第三电容器C3的第二电极连接到第二控制节点Q，并且第二节点电压V_Q具有逻辑高电平，所以第三电容器C3可放电。
在第三时间点t3处，第二时钟信号CLK2可从逻辑高电平转变为逻辑低电平。
在这种情况下，第六晶体管M6可响应于逻辑低电平的第二时钟信号CLK2而导通，并且逻辑低电平的第二时钟信号CLK2可通过由第二电容器C2导通的第七晶体管M7和导通的第六晶体管M6被施加到第一控制节点QB。也即，第一节点电压V_QB可改变为具有逻辑低电平。
第九晶体管M9可响应于逻辑低电平的第一节点电压V_QB而导通，并且第一栅极电压VGH可通过第一电源端子105和第九晶体管M9被施加到输出端子104。也即，输出电压V_OUT可改变为具有逻辑高电平。
同时，第十三晶体管M13可响应于逻辑低电平的第二时钟信号CLK2而导通，并且通过导通的第十三晶体管M13和由第二栅极电压VGL导通的第十二晶体管M12而被施加到第三电容器C3的第二电极的第一栅极电压VGH可被施加到第二控制节点Q。
如图4中所示，当第九晶体管M9导通时，作为第一级ST1的输出电压V_OUT(即，光发射控制信号)的第一栅极电压VGH被供给到输出端子104。供给到输出端子104的第一栅极电压VGH可作为光发射控制信号供给到第一光发射控制线E1。
此后，即使第一控制节点QB通过第一时钟信号CLK1和第二时钟信号CLK2的变化而处于浮置状态，第一节点电压V_QB也可通过第一电容器C1而保持为逻辑低电平，并且输出电压V_OUT可保持为逻辑高电平。
在第四时间点t4处，输入电压V_IN可从逻辑高电平转变为逻辑低电平。
在第五时间点t5处，第一时钟信号CLK1可从逻辑高电平转变为逻辑低电平。
在这种情况下，第一晶体管M1可响应于逻辑低电平的第一时钟信号CLK1而导通，并且逻辑低电平的输入电压V_IN可被施加到第十二晶体管M12的第一电极。因为第十二晶体管M12由第二栅极电压VGL而导通，所以逻辑低电平的输入电压V_IN可通过第十二晶体管M12被施加到第二控制节点Q。
第十晶体管M10可响应于逻辑低电平的第二节点电压V_Q而导通，并且第二栅极电压VGL可被施加到输出端子104。
同时，第四晶体管M4可由通过第一晶体管M1提供的逻辑低电平的输入电压V_IN而导通。另外，第五晶体管M5可响应于逻辑低电平的第一时钟信号CLK1而导通，并且第二栅极电压VGL(和第一时钟信号CLK1)可被施加到第二晶体管M2的栅电极。
第二晶体管M2可响应于第二栅极电压VGL而导通，并且第一栅极电压VGH可被施加到第三电容器C3的第一电极。因为第三电容器C3的第二电极连接到第二控制节点Q，所以逻辑低电平的第二节点电压V_Q可被施加到第三电容器C3的第二电极。
同时，第八晶体管M8可由逻辑低电平的输入电压V_IN导通，并且第一栅极电压VGH可被施加到第一控制节点QB。也即，第一节点电压V_QB可改变为具有逻辑高电平。
在第六时间点t6处，第二时钟信号CLK2可从逻辑高电平转变为逻辑低电平。
因为第三晶体管M3由第二节点电压V_Q导通，所以逻辑低电平的第二时钟信号CLK2可被施加到第三电容器C3的第一电极。第二节点电压V_Q可由第三电容器C3升压，并且第二节点电压V_Q可改变为具有第二逻辑低电平。另外，输出电压V_OUT可与第二逻辑低电平的第二节点电压V_Q对应地具有逻辑低电平。这里，第二逻辑低电平可具有比逻辑低电平低的电压电平，例如，比逻辑低电平低了第二栅极电压VGL的电压电平(即，2VGL)。
图6A和图6B是示出用于描述本公开的第十三晶体管M13的效果的关于显示装置的序列的示意性显示的波形图。图7是用于描述图4中所示的第一级ST1的操作的信号流程图。此时，图6A的波形图假设了图4中所示的第一级ST1不包括第十三晶体管M13，并且图6B的波形图假设了图4中所示的第一级ST1包括第十三晶体管M13。
参考图1、图4和图6A，为了保护各种驱动器，处于异常状态(诸如受到来自外部的冲击的情况)的显示装置1可被强制复位。在这种情况下，可发生初始异常光发射现象(闪动现象)，在该初始异常光发射现象(闪动现象)中，逻辑高电平的输入电压V_IN缓慢地被施加到第二控制节点Q并且显示装置1的屏幕闪烁。
具体地，当显示装置1被强制复位时，光发射控制驱动器30可立刻将以逻辑低电平输出的光发射控制信号的大部分改变为接地电平(GND)。
当显示装置1被强制复位并且然后被通电时，逻辑高电平的起始脉冲SP以及逻辑低电平的第一时钟信号CLK1和第二时钟信号CLK2可被施加到光发射控制驱动器30，在经过一定时间之后，如图5中所示，针对每一个帧在四个水平时间4H期间保持逻辑高电平的起始脉冲SP以及在两个水平时间2H中具有逻辑低电平和逻辑高电平的第一时钟信号CLK1和第二时钟信号CLK2可被施加到光发射控制驱动器30(即，EM开启)。
在这种情况下，在逻辑高电平的起始脉冲SP和逻辑低电平的第一时钟信号CLK1和第二时钟信号CLK2被施加到光发射控制驱动器30期间，黑色灰度的源Source可被施加到数据驱动器40(即，源开启)。此外，用于生成扫描信号的起始脉冲FLM以及第三时钟信号CLK3和第四时钟信号CLK4可被施加，以在一个时段中开始显示图像(即，扫描开启)，在该一个时段中，针对每一个帧在四个水平时间4H期间具有逻辑高电平的起始脉冲SP以及在两个水平时间2H中具有逻辑低电平和逻辑高电平的第一时钟信号CLK1和第二时钟信号CLK2被施加到光发射控制驱动器30。(在图6A和图6B中，尽管第三时钟信号CLK3和第四时钟信号CLK4被表示为被供给，但是与扫描驱动器20的结构对应地，三个或更多个时钟信号可被供给。)
当显示装置1被强制复位并且然后被通电时，因为逻辑高电平的起始脉冲SP以及逻辑低电平的第一时钟信号CLK1和第二时钟信号CLK2在一定时段期间被施加到光发射控制驱动器30，所以理想地，具有第一栅极电压VGH(即，逻辑高电平)的光发射控制信号需要被输出。
然而，在光发射控制驱动器30的第一级ST1至第四级ST4(参见图3)之中，在较低级(例如，ST4)中，与较高级(例如，ST1)相比，第一栅极电压VGH可相对缓慢地被施加到输出端子104的低缓冲栅极(第二控制节点Q)。在这种情况下，因为与第一栅极电压VGH对应地关断的第十晶体管M10没有完全关断，所以第二栅极电压VGL与第一栅极电压VGH之间可发生短路。
因此，因为电压电平下降的光发射控制信号被施加到图2A的像素电路PXC的第三晶体管T3或图2B的像素电路PXC'的第三晶体管T3和第四晶体管T4，所以通过没有完全关断的图2A的第三晶体管T3或图2B的第四晶体管T4，在第一像素电源VDD与数据电压Vdata之间可发生短路，并且因此可发生初始异常光发射(闪动现象)。在图6A中，由虚线指示的四边形框部指示第一像素电源VDD泄漏，并且因此第一像素电源VDD与数据电压Vdata之间发生短路。
参照图6B和图7，根据本公开的实施方式的第一级ST1可附加地排列了用于通过布置在第二晶体管M2的第二电极与第一晶体管M1的第二电极之间的第十三晶体管M13来施加第一栅极电压VGH的路径，并且因此，与第一栅极电压VGH对应地被关断的第十晶体管M10可完全关断。也即，因为第二栅极电压VGL没有被施加到输出端子104，所以在第一栅极电压VGH与第二栅极电压VGL之间没有生成短路，并且可输出逻辑高电平的光发射控制信号。
因此，因为电压电平没有下降的光发射控制信号被施加到图2A的像素电路PXC的第三晶体管T3或图2B的像素电路PXC'的第三晶体管T3和第四晶体管T4，所以图2A的第三晶体管T3或图2B的第四晶体管T4可完全关断。因为在第一像素电源VDD与数据电压Vdata之间没有生成短路，所以可不发生初始异常光发射(闪动现象)。由图6B中的虚线指示的四边形框部指示的第一像素电源VDD的泄漏被防止。
通过对输出单元的低缓冲栅极添加提供第一栅极电压(栅极关断电压)的晶体管，根据本发明概念的级输出了正常的光发射控制信号，从而防止了初始异常光发射现象。
通过对输出单元的低缓冲栅极添加提供第一栅极电压(栅极关断电压)的晶体管，根据本发明概念的显示装置输出了正常的光发射控制信号，从而防止了初始异常光发射现象。
尽管已参照本发明概念的实施方式描述了本发明概念，但是本领域技术人员将理解的是，在不背离所附的权利要求中所公开的本发明概念的精神和范围的情况下，可对本发明概念进行各种修改和改变。

Claims (20)

1.一种级，包括：
节点控制单元，所述节点控制单元根据供给到第一输入端子的第一输入信号、供给到第二输入端子的第二输入信号和供给到第三输入端子的第三输入信号来控制第一控制节点的电压和第二控制节点的电压；
节点维护单元，所述节点维护单元根据所述第二控制节点的所述电压将所述第一控制节点的所述电压保持为恒定；以及
输出单元，所述输出单元根据所述第一控制节点的所述电压和所述第二控制节点的所述电压，将供给到第一电源端子的第一栅极电压或供给到第二电源端子的第二栅极电压供给到输出端子，
其中，所述节点控制单元包括：
第一晶体管，所述第一晶体管连接在所述第一输入端子与所述第二控制节点之间并且包括连接到所述第一输入端子的第一电极；
第二晶体管，所述第二晶体管连接在所述第一电源端子与所述第三输入端子之间并且包括连接到所述第一电源端子的第一电极；以及
短路防止晶体管，所述短路防止晶体管连接在所述第一晶体管与所述第二晶体管之间并且包括与所述第二晶体管的第二电极连接的第一电极和与所述第一晶体管的第二电极连接的第二电极。
2.根据权利要求1所述的级，其中，所述短路防止晶体管的栅电极连接到所述第三输入端子，并且所述短路防止晶体管根据所述第三输入信号而导通。
3.根据权利要求1所述的级，其中，所述第一晶体管的栅电极连接到所述第二输入端子，并且所述第一晶体管根据所述第二输入信号而导通。
4.根据权利要求3所述的级，其中，所述节点控制单元包括：
第三晶体管，所述第三晶体管包括与所述第二晶体管的所述第二电极连接的第一电极、连接到所述第三输入端子的第二电极和连接到所述第二控制节点的栅电极；
第四晶体管，所述第四晶体管包括与所述第二晶体管的栅电极连接的第一电极、连接到所述第二输入端子的第二电极和与所述第一晶体管的所述第二电极连接的栅电极；
第五晶体管，所述第五晶体管包括与所述第四晶体管的所述第一电极连接的第一电极、连接到所述第二电源端子的第二电极和连接到所述第二输入端子的栅电极；
第一耦合晶体管，所述第一耦合晶体管包括与所述第五晶体管的所述第一电极连接的第一电极，包括第二电极，并且包括连接到所述第二电源端子的栅电极；
第一耦合电容器，所述第一耦合电容器包括与所述第一耦合晶体管的所述第二电极连接的第一电极，并且包括第二电极；
第六晶体管，所述第六晶体管包括连接到所述第一控制节点的第一电极、与所述第一耦合电容器的所述第二电极连接的第二电极和连接到所述第三输入端子的栅电极；以及
第七晶体管，所述第七晶体管包括与所述第一耦合电容器的所述第二电极连接的第一电极、连接到所述第三输入端子的第二电极和与所述第一耦合电容器的所述第一电极连接的栅电极。
5.根据权利要求4所述的级，其中，所述节点控制单元还包括：
第二耦合电容器，所述第二耦合电容器包括与所述第二晶体管的所述第二电极连接的第一电极和与所述第三晶体管的所述栅电极连接的第二电极；以及
第二耦合晶体管，所述第二耦合晶体管连接在所述第一晶体管的所述第二电极与所述第二控制节点之间并且根据所述第二栅极电压而导通。
6.根据权利要求5所述的级，其中，所述节点维护单元包括：
第八晶体管，所述第八晶体管包括连接到所述第一电源端子的第一电极、连接到所述第一控制节点的第二电极和与所述第一晶体管的所述第二电极连接的栅电极；以及
第一电容器，所述第一电容器包括连接到所述第一电源端子的第一电极和连接到所述第一控制节点的第二电极。
7.根据权利要求1所述的级，其中，所述输出单元包括：
上拉晶体管，所述上拉晶体管包括连接到所述第一电源端子的第一电极、连接到所述输出端子的第二电极和连接到所述第一控制节点的栅电极；以及
下拉晶体管，所述下拉晶体管包括连接到所述输出端子的第一电极、连接到所述第二电源端子的第二电极和连接到所述第二控制节点的栅电极。
8.根据权利要求1所述的级，其中，所述第一栅极电压设置为栅极关断电压，并且所述第二栅极电压设置为栅极导通电压。
9.根据权利要求1所述的级，其中：
所述第一输入信号是起始脉冲或前一级的输出信号；并且
所述第二输入信号和所述第三输入信号分别是第一时钟信号和第二时钟信号。
10.根据权利要求9所述的级，其中：
所述第一时钟信号和所述第二时钟信号交替地具有栅极导通电压部分；并且
所述起始脉冲或所述前一级的所述输出信号被供给以与所述第一时钟信号的至少一个所述栅极导通电压部分重叠。
11.一种显示装置，包括：
像素，所述像素连接到扫描线、数据线和光发射控制线；
扫描驱动器，所述扫描驱动器向所述扫描线供给扫描信号；
数据驱动器，所述数据驱动器向所述数据线供给数据信号；以及
光发射控制驱动器，所述光发射控制驱动器包括多个级以向多个所述光发射控制线供给光发射控制信号，
其中，所述多个级中的每个包括：
节点控制单元，所述节点控制单元根据供给到第一输入端子的第一输入信号、供给到第二输入端子的第二输入信号和供给到第三输入端子的第三输入信号来控制第一控制节点的电压和第二控制节点的电压，并且包括第一晶体管、第二晶体管和短路防止晶体管，其中所述第一晶体管连接在所述第一输入端子与所述第二控制节点之间并且包括连接到所述第一输入端子的第一电极，所述第二晶体管连接在第一电源端子与所述第三输入端子之间并且包括连接到所述第一电源端子的第一电极，所述短路防止晶体管连接在所述第一晶体管与所述第二晶体管之间并且包括与所述第二晶体管的第二电极连接的第一电极和与所述第一晶体管的第二电极连接的第二电极；
节点维护单元，所述节点维护单元根据所述第二控制节点的所述电压将所述第一控制节点的所述电压保持为恒定；以及
输出单元，所述输出单元根据所述第一控制节点的所述电压和所述第二控制节点的所述电压，将供给到所述第一电源端子的第一栅极电压或供给到第二电源端子的第二栅极电压供给到输出端子。
12.根据权利要求11所述的显示装置，其中，所述短路防止晶体管的栅电极连接到所述第三输入端子，并且所述短路防止晶体管根据所述第三输入信号而导通。
13.根据权利要求11所述的显示装置，其中，所述第一晶体管的栅电极连接到所述第二输入端子，并且所述第一晶体管根据所述第二输入信号而导通。
14.根据权利要求13所述的显示装置，其中，所述节点控制单元包括：
第三晶体管，所述第三晶体管包括与所述第二晶体管的所述第二电极连接的第一电极、连接到所述第三输入端子的第二电极和连接到所述第二控制节点的栅电极；
第四晶体管，所述第四晶体管包括与所述第二晶体管的栅电极连接的第一电极、连接到所述第二输入端子的第二电极和与所述第一晶体管的所述第二电极连接的栅电极；
第五晶体管，所述第五晶体管包括与所述第四晶体管的所述第一电极连接的第一电极、连接到所述第二电源端子的第二电极和连接到所述第二输入端子的栅电极；
第一耦合晶体管，所述第一耦合晶体管包括与所述第五晶体管的所述第一电极连接的第一电极，包括第二电极，并且包括连接到所述第二电源端子的栅电极；
第一耦合电容器，所述第一耦合电容器包括与所述第一耦合晶体管的所述第二电极连接的第一电极，并且包括第二电极；
第六晶体管，所述第六晶体管包括连接到所述第一控制节点的第一电极、与所述第一耦合电容器的所述第二电极连接的第二电极和连接到所述第三输入端子的栅电极；以及
第七晶体管，所述第七晶体管包括与所述第一耦合电容器的所述第二电极连接的第一电极、连接到所述第三输入端子的第二电极和与所述第一耦合电容器的所述第一电极连接的栅电极。
15.根据权利要求14所述的显示装置，其中，所述节点控制单元还包括：
第二耦合电容器，所述第二耦合电容器包括与所述第二晶体管的所述第二电极连接的第一电极和与所述第三晶体管的所述栅电极连接的第二电极；以及
第二耦合晶体管，所述第二耦合晶体管连接在所述第一晶体管的所述第二电极与所述第二控制节点之间并且根据所述第二栅极电压而导通。
16.根据权利要求15所述的显示装置，其中，所述节点维护单元包括：
第八晶体管，所述第八晶体管包括连接到所述第一电源端子的第一电极、连接到所述第一控制节点的第二电极和与所述第一晶体管的所述第二电极连接的栅电极；以及
第一电容器，所述第一电容器包括连接到所述第一电源端子的第一电极和连接到所述第一控制节点的第二电极。
17.根据权利要求11所述的显示装置，其中，所述输出单元包括：
上拉晶体管，所述上拉晶体管包括连接到所述第一电源端子的第一电极、连接到所述输出端子的第二电极和连接到所述第一控制节点的栅电极；以及
下拉晶体管，所述下拉晶体管包括连接到所述输出端子的第一电极、连接到所述第二电源端子的第二电极和连接到所述第二控制节点的栅电极。
18.根据权利要求11所述的显示装置，其中，所述第一栅极电压设置为栅极关断电压，并且所述第二栅极电压设置为栅极导通电压。
19.根据权利要求11所述的显示装置，其中：
所述第一输入信号是起始脉冲或前一级的输出信号；并且
所述第二输入信号和所述第三输入信号分别是第一时钟信号和第二时钟信号。
20.根据权利要求19所述的显示装置，其中：
所述第一时钟信号和所述第二时钟信号交替地具有栅极导通电压部分；并且
所述起始脉冲或所述前一级的所述输出信号被供给以与所述第一时钟信号的至少一个所述栅极导通电压部分重叠。
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