CN113535213A - 一种可编程逻辑器件的固件更新方法及系统 - Google Patents
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Abstract
本发明公开了一种可编程逻辑器件的固件更新方法及系统，其中，所述方法包括：获得所述第一存储器的属性信息；判断所述第一存储器是否为外置存储器，获得第一判断结果；获得第一高电平CPU控制信号；根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；判断写入的所述固件更新数据是否完整，获得第一检测结果；如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。解决了现有技术中的基于增加额外的硬件外设以及拆机等方式，对可编程逻辑器件进行固件更新，使得对产品造成损耗的同时，更新效率低下的技术问题。
Description
技术领域
本发明涉及可编程逻辑器件领域，尤其涉及一种可编程逻辑器件的固件更新方法及系统。
背景技术
可编程逻辑器件，作为一种通用集成电路产生的，它的逻辑功能按照用户对器件编程来确定，一般的PLD的集成度很高，足以满足设计一般的数字系统的需要，但需要对其进行固件更新，确保芯片的正常工作。
但本申请发明人在实现本申请实施例中发明技术方案的过程中，发现上述技术至少存在如下技术问题：
现有技术中存在基于增加额外的硬件外设以及拆机等方式，对可编程逻辑器件进行固件更新，使得对产品造成损耗的同时，更新效率低下的技术问题。
发明内容
本申请实施例通过提供一种可编程逻辑器件的固件更新方法及系统，解决了现有技术中的基于增加额外的硬件外设以及拆机等方式，对可编程逻辑器件进行固件更新，使得对产品造成损耗的同时，更新效率低下的技术问题。通过根据存储器的属性来确定其存在方式，进而基于SPI通道，可使得存储器完成更新数据的写入，待到确保写入的固件更新数据完整，再对可编程逻辑器件进行固件更新，达到了无需额外增加硬件成本、无需拆机、确保良好的兼容性，即可实现对可编程逻辑器件的固件更新，提高更新效率，同时减少因拆机导致的产品损耗的技术效果。
本申请实施例提供一种可编程逻辑器件的固件更新方法，其中，所述方法应用于具有第一存储器和可编程逻辑器件的电路模块，所述方法包括：获得所述第一存储器的属性信息；根据所述第一存储器的属性信息，判断所述第一存储器是否为外置存储器，获得第一判断结果；根据所述第一判断结果，获得第一高电平CPU控制信号，其中，所述第一高电平CPU控制信号包括第一控制信号或第二控制信号；根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；判断写入的所述固件更新数据是否完整，获得第一检测结果；如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。
另一方面，本申请还提供了一种可编程逻辑器件的固件更新系统，其中，所述系统包括：第一获得单元：所述第一获得单元用于获得第一存储器的属性信息；第一判断单元：所述第一判断单元用于根据所述第一存储器的属性信息，判断所述第一存储器是否为外置存储器，获得第一判断结果；第二获得单元：所述第二获得单元用于根据所述第一判断结果，获得第一高电平CPU控制信号，其中，所述第一高电平CPU控制信号包括第一控制信号或第二控制信号；第一写入单元：所述第一写入单元用于根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；第二判断单元：所述第二判断单元用于判断写入的所述固件更新数据是否完整，获得第一检测结果；第一更新单元：所述第一更新单元用于如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。
本申请实施例中提供的一个或多个技术方案，至少具有如下技术效果或优点：
通过获得所述第一存储器的属性信息；根据所述第一存储器的属性信息，判断所述第一存储器是否为外置存储器，获得第一判断结果；根据所述第一判断结果，获得第一高电平CPU控制信号，其中，所述第一高电平CPU控制信号包括第一控制信号或第二控制信号；根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；判断写入的所述固件更新数据是否完整，获得第一检测结果；如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。达到了无需额外增加硬件成本、无需拆机、确保良好的兼容性，即可实现对可编程逻辑器件的固件更新，提高更新效率，同时减少因拆机导致的产品损耗的技术效果。
上述说明仅是本申请技术方案的概述，为了能够更清楚了解本申请的技术手段，而可依照说明书的内容予以实施，并且为了让本申请的上述和其它目的、特征和优点能够更明显易懂，以下特举本申请的具体实施方式。
附图说明
图1为本申请实施例一种可编程逻辑器件的固件更新方法的流程示意图；
图2为本申请实施例一种可编程逻辑器件的固件更新方法的判断写入的所述固件更新数据是否完整，获得第一检测结果之后的流程示意图；
图3为本申请实施例一种可编程逻辑器件的固件更新方法的通过所述切换开关将所述第一存储器切换到所述可编程逻辑器件的GPIO接口上的流程示意图；
图4为本申请实施例一种可编程逻辑器件的固件更新方法的控制所述第一存储器开启串行接口通道的流程示意图；
图5为本申请实施例一种可编程逻辑器件的固件更新方法的获得第一低电平CPU控制信号的流程示意图；
图6为本申请实施例一种可编程逻辑器件的固件更新方法的获得第二低电平CPU控制信号的流程示意图；
图7为本申请实施例一种可编程逻辑器件的固件更新系统的结构示意图；
图8为本申请实施例示例性电子设备的结构示意图。
附图标记说明：第一获得单元11，第一判断单元12，第二获得单元13，第一写入单元14，第二判断单元15，第一更新单元16，总线300，接收器301，处理器302，发送器303，存储器304，总线接口305。
具体实施方式
本申请实施例通过提供一种可编程逻辑器件的固件更新方法及系统，解决了现有技术中的基于增加额外的硬件外设以及拆机等方式，对可编程逻辑器件进行固件更新，使得对产品造成损耗的同时，更新效率低下的技术问题。通过根据存储器的属性来确定其存在方式，进而基于SPI通道，可使得存储器完成更新数据的写入，待到确保写入的固件更新数据完整，再对可编程逻辑器件进行固件更新，达到了无需额外增加硬件成本、无需拆机、确保良好的兼容性，即可实现对可编程逻辑器件的固件更新，提高更新效率，同时减少因拆机导致的产品损耗的技术效果。
下面，将参考附图详细的描述根据本申请的示例实施例。显然，所描述的实施例仅是本申请的一部分实施例，而不是本申请的全部实施例，应理解，本申请不受这里描述的示例实施例的限制。
申请概述
可编程逻辑器件，作为一种通用集成电路产生的，它的逻辑功能按照用户对器件编程来确定，一般的PLD的集成度很高，足以满足设计一般的数字系统的需要，但需要对其进行固件更新，确保芯片的正常工作。现有技术中存在基于增加额外的硬件外设以及拆机等方式，对可编程逻辑器件进行固件更新，使得对产品造成损耗的同时，更新效率低下的技术问题。
针对上述技术问题，本申请提供的技术方案总体思路如下：
本申请实施例提供一种可编程逻辑器件的固件更新方法，其中，所述方法应用于具有第一存储器和可编程逻辑器件的电路模块，所述方法包括：获得所述第一存储器的属性信息；根据所述第一存储器的属性信息，判断所述第一存储器是否为外置存储器，获得第一判断结果；根据所述第一判断结果，获得第一高电平CPU控制信号，其中，所述第一高电平CPU控制信号包括第一控制信号或第二控制信号；根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；判断写入的所述固件更新数据是否完整，获得第一检测结果；如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。
为了更好地理解上述技术方案，下面将结合说明书附图以及具体的实施方式对上述技术方案进行详细的说明。
实施例一
如图1所示，本申请实施例提供了一种可编程逻辑器件的固件更新方法，其中，所述方法应用于具有第一存储器和可编程逻辑器件的电路模块，所述方法包括：
步骤S100：获得所述第一存储器的属性信息；
具体而言，可编程逻辑器件(programmable logic device即PLD)，作为一种通用集成电路产生的，它的逻辑功能按照用户对器件编程来确定，一般的PLD的集成度很高，足以满足设计一般的数字系统的需要，但需要对其进行固件更新，确保芯片的正常工作。在本申请实施例中，为了提高可编程逻辑器件的固件更新效率，减少对产品的拆机损耗，可先获得所述第一存储器的属性信息，其中，所述第一存储器即为可编程逻辑器件，所述属性信息在此可理解为：可编程逻辑器件的连接方式，即是如何连接在SPI FLASH(即时钟同步串行通信接口)上的，一般来讲，可分为内置存储器的可编程逻辑器件(即CPLD)和外置存储器的可编程逻辑器件(即FPGA)。其中，支持内置存储器的可编程逻辑器件的固件保存在内置的SPI FLASH中，器件上电后，自动从内置的spi flash中加载固件，完成芯片初始化；支持外置存储器的可编程逻辑器件的固件保存在外挂的SPI FLASH中，外挂的spi flash与芯片指定的spi port连接，器件上电后，自动从外置的spi flash中加载固件，完成芯片初始化。
步骤S200：根据所述第一存储器的属性信息，判断所述第一存储器是否为外置存储器，获得第一判断结果；
具体而言，已知所述第一存储器的属性信息，可基于此，判断所述第一存储器是否为外置存储器，获得第一判断结果，因存在方式不同，使得对器件的更新方式存在不同，所述第一判断结果包括两种结果：即所述第一存储器为外置存储器以及所述第一存储器不是外置存储器(相反属于内置存储器)，判断结果的不同，使得更新方式存在不同。
步骤S300：根据所述第一判断结果，获得第一高电平CPU控制信号，其中，所述第一高电平CPU控制信号包括第一控制信号或第二控制信号；
步骤S400：根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；
具体而言，无论所述第一存储器是内置的存在方式或是外挂的存在方式，在对可编程逻辑器件的固件进行更新时，都需要获得第一高电平CPU控制信号，即gpio port控制CPLD使能SPI通道，通过基于CPU控制信号为高电平，使得开启SPI通道，基于SPI通道，可使得所述第一存储器完成更新数据的写入，进一步的，所述第一存储器是内置的存在方式或是外挂的存在方式，也影响着控制信号的不同，所述第一控制信号或所述第二控制信号对应着所述第一判断结果的不同情况。
步骤S500：判断写入的所述固件更新数据是否完整，获得第一检测结果；
步骤S600：如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。
具体而言，为了确保更新数据的写入完整，进而确保固件更新完成，可判断写入的所述固件更新数据是否完整，即所述固件更新数据是否写入完整，是否存在数据遗漏或延迟写入等情况，所述第一检测结果包含两种情况：所述固件更新数据写入完整以及所述固件更新数据写入不完整，如果如果所述第一检测结果为写入的所述固件更新数据完整，则说明更新数据写入完整，对可编程逻辑器件进行固件更新，进而确保固件更新完成。通过根据存储器的属性来确定其存在方式，进而基于SPI通道，可使得存储器完成更新数据的写入，待到确保写入的固件更新数据完整，再对可编程逻辑器件进行固件更新，达到了无需额外增加硬件成本、无需拆机、确保良好的兼容性，即可实现对可编程逻辑器件的固件更新，提高更新效率，同时减少因拆机导致的产品损耗的技术效果。
优选的，如图2所示，所述判断写入的所述固件更新数据是否完整，获得第一检测结果之后，步骤S500还包括：
步骤S510：如果所述第一检测结果为写入的所述固件更新数据不完整，获得第一写入信号；
步骤S520：根据所述第一写入信号，重新向所述第一存储器写入所述固件更新数据。
具体而言，在判断写入的所述固件更新数据是否完整时，如果所述第一检测结果为写入的所述固件更新数据不完整，则说明更新数据还未写入完整，无法可编程逻辑器件进行固件更新，可获得第一写入信号，即根据所述第一写入信号，重新向所述第一存储器写入所述固件更新数据，重复对写入的数据完整性检测的步骤，确保对更新数据写入完整，使得对可编程逻辑器件进行固件更新，进而确保固件更新完成。
优选的，如图3所示，所述根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据，所述电路模块还具有一串行接口的切换开关，步骤S400还包括：
步骤S410：如果所述第一判断结果为所述第一存储器为外置存储器，获得第一控制信号；
步骤S420：根据所述第一控制信号，通过所述切换开关将所述第一存储器切换到所述可编程逻辑器件的GPIO接口上，获得所述可编程逻辑器件的所述固件更新数据；
步骤S430：根据标准可编程逻辑器件写入协议，将所述固件更新数据写入所述第一存储器。
具体而言，如果所述第一存储器为外置存储器，在对所述第一存储器写入固件更新数据时，可基于所述切换开关进行写入操作，进一步的，硬件上添加spi port的切换开关，即可以通过控制信号选择外置spi flash是与固件专用port连还是与通用gpio port连，FPGA构建切换逻辑，使得CPU可以通过gpio来控制spi flash的切换开关，使得在CPU控制信号的控制下，切换开关按要求将spi flash映射到CPU的spi port上，这样电路板上的CPU则可以直接操作外置的spi Flash，固件升级软件则可以通过U盘获取FPGA的固件，然后通过标准的spi flash写入协议，将FPGA固件更新到FPGA外置的spi flash中，由此完成FPGA的固件更新，在不增加额外的PC机或是网络服务器，即可自身完成FPGA的固件更新，提高固件的更新效率。
优选的，如图4所示，所述根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据，本申请实施例还包括：
步骤S440：如果所述第一判断结果为所述第一存储器为内置存储器，获得第二控制信号；
步骤S450：根据所述第二控制信号，控制所述第一存储器开启串行接口通道，获得所述可编程逻辑器件的所述固件更新数据；
步骤S460：根据标准可编程逻辑器件写入协议，将所述固件更新数据写入所述第一存储器。
具体而言，如果所述第一存储器为内置存储器时，在对所述第一存储器写入固件更新数据时，可根据所述第二控制信号，控制所述第一存储器开启串行接口通道，CPLD通过内部逻辑，将内部SPI Flash的引脚映射逻辑开关上，在CPU控制信号的控制下，逻辑开关按要求将内部spi flash的引脚映射到外部CPU的spi port上，这样电路板上的CPU则可以直接操作CPLD的内部spi Flash。固件升级软件则可以通过U盘获取CPLD的固件，然后通过标准的spi flash写入协议，将CPLD固件更新到CPLD内部spi flash中，由此完成CPLD的固件更新，由此实现了对内置存储器的固件更新。
优选的，如图5所示，所述如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新之后，步骤S600还包括：
步骤S610：如果所述第一判断结果为所述第一存储器为外置存储器，获得第一低电平CPU控制信号；
步骤S620：根据所述第一低电平CPU控制信号，所述切换开关将所述第一存储器切换到所述可编程逻辑器件的专用串行接口上。
具体而言，如果所述第一存储器为外置存储器，在对外置存储器的可编程逻辑器件进行固件更新之后，可中断写入操作，即CPU将开始的高电平控制信号转变为低电平控制信号，使得所述切换开关将所述第一存储器切换到所述可编程逻辑器件的专用串行接口上，即中断可编程逻辑器件与通用gpio port的连接，进而结束对外置存储器的固件更新。
优选的，如图6所示，所述如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新之后，步骤S600还包括：
步骤S630：如果所述第一判断结果为所述第一存储器为内置存储器，获得第二低电平CPU控制信号；
步骤S640：根据所述第二低电平CPU控制信号，控制所述第一存储器关闭所述串行接口通道。
具体而言，如果所述第一存储器为内置存储器，在对内置存储器的可编程逻辑器件进行固件更新之后，可中断写入操作，进一步的，所述第二低电平CPU控制信号为CPU将高电平控制信号转换为低电平控制信号，进而根据所述第二低电平CPU控制信号，控制所述第一存储器关闭所述串行接口通道，即关闭spi通道，进而结束对内置存储器的固件更新。
综上所述，本申请实施例所提供的一种可编程逻辑器件的固件更新方法及系统具有如下技术效果：
1、通过获得所述第一存储器的属性信息；根据所述第一存储器的属性信息，判断所述第一存储器是否为外置存储器，获得第一判断结果；根据所述第一判断结果，获得第一高电平CPU控制信号，其中，所述第一高电平CPU控制信号包括第一控制信号或第二控制信号；根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；判断写入的所述固件更新数据是否完整，获得第一检测结果；如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。达到了无需额外增加硬件成本、无需拆机、确保良好的兼容性，即可实现对可编程逻辑器件的固件更新，提高更新效率，同时减少因拆机导致的产品损耗的技术效果。
2、基于CPLD进行固件的更新，可通过内部逻辑，将内部SPI Flash的引脚映射逻辑开关上，在CPU控制信号的控制下，逻辑开关按要求将内部spi flash的引脚映射到外部CPU的spi port上，这样电路板上的CPU则可以直接操作CPLD的内部spi Flash。固件升级软件则可以通过U盘获取CPLD的固件，然后通过标准的spi flash写入协议，将CPLD固件更新到CPLD内部spi flash中，由此完成CPLD的固件更新。
3、基于FPGA进行固件的更新，可在硬件上添加spi port的切换开关，即可以通过控制信号选择外置spi flash是与固件专用port连还是与通用gpio port连。FPGA构建切换逻辑，使得CPU可以通过gpio来控制spi flash的切换开关。这样，在CPU控制信号的控制下，切换开关按要求将spi flash映射到CPU的spi port上，这样电路板上的CPU则可以直接操作外置的spi Flash。固件升级软件则可以通过U盘获取FPGA的固件，然后通过标准的spiflash写入协议，将FPGA固件更新到FPGA外置的spi flash中，由此完成FPGA的固件更新。
实施例二
基于与前述实施例中一种可编程逻辑器件的固件更新方法同样发明构思，本发明还提供了一种可编程逻辑器件的固件更新系统，如图7所示，所述系统包括：
第一获得单元11：所述第一获得单元11用于获得第一存储器的属性信息；
第一判断单元12：所述第一判断单元12用于根据所述第一存储器的属性信息，判断所述第一存储器是否为外置存储器，获得第一判断结果；
第二获得单元13：所述第二获得单元13用于根据所述第一判断结果，获得第一高电平CPU控制信号，其中，所述第一高电平CPU控制信号包括第一控制信号或第二控制信号；
第一写入单元14：所述第一写入单元14用于根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；
第二判断单元15：所述第二判断单元15用于判断写入的所述固件更新数据是否完整，获得第一检测结果；
第一更新单元16：所述第一更新单元16用于如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。
进一步的，所述系统还包括：
第三获得单元：所述第三获得单元用于如果所述第一检测结果为写入的所述固件更新数据不完整，获得第一写入信号；
第二写入单元：所述第二写入单元用于根据所述第一写入信号，重新向所述第一存储器写入所述固件更新数据。
进一步的，所述系统还包括：
第四获得单元：所述第四获得单元用于如果所述第一判断结果为所述第一存储器为外置存储器，获得第一控制信号；
第一切换单元：所述第一切换单元用于根据所述第一控制信号，通过所述切换开关将所述第一存储器切换到所述可编程逻辑器件的GPIO接口上，获得所述可编程逻辑器件的所述固件更新数据；
第三写入单元：所述第三写入单元用于根据标准可编程逻辑器件写入协议，将所述固件更新数据写入所述第一存储器。
进一步的，所述系统还包括：
第五获得单元：所述第五获得单元用于如果所述第一判断结果为所述第一存储器为内置存储器，获得第二控制信号；
第一控制单元：所述第一控制单元用于根据所述第二控制信号，控制所述第一存储器开启串行接口通道，获得所述可编程逻辑器件的所述固件更新数据；
第四写入单元：所述第四写入单元用于根据标准可编程逻辑器件写入协议，将所述固件更新数据写入所述第一存储器。
进一步的，所述系统还包括：
第六获得单元：所述第六获得单元用于如果所述第一判断结果为所述第一存储器为外置存储器，获得第一低电平CPU控制信号；
第二切换单元：所述第二切换单元用于根据所述第一低电平CPU控制信号，所述切换开关将所述第一存储器切换到所述可编程逻辑器件的专用串行接口上。
进一步的，所述系统还包括：
第七获得单元：所述第七获得单元用于如果所述第一判断结果为所述第一存储器为内置存储器，获得第二低电平CPU控制信号；
第二控制单元：所述第二控制单元用于根据所述第二低电平CPU控制信号，控制所述第一存储器关闭所述串行接口通道。
前述图1实施例一中的一种可编程逻辑器件的固件更新方法的各种变化方式和具体实例同样适用于本实施例的一种可编程逻辑器件的固件更新系统，通过前述对一种可编程逻辑器件的固件更新方法的详细描述，本领域技术人员可以清楚的知道本实施例中一种可编程逻辑器件的固件更新系统的实施方法，所以为了说明书的简洁，再次不再详述。
实施例三
下面参考图8来描述本申请实施例的电子设备。
图8图示了根据本申请实施例的电子设备的结构示意图。
基于与前述实例施中一种可编程逻辑器件的固件更新方法的发明构思，本发明还提供一种可编程逻辑器件的固件更新系统，其上存储有计算机程序，该程序被处理器执行时实现前文所述一种可编程逻辑器件的固件更新系统的任一方法的步骤。
其中，在图8中，总线架构(用总线300来代表)，总线300可以包括任意数量的互联的总线和桥，总线300将包括由处理器302代表的一个或多个处理器和存储器304代表的存储器的各种电路链接在一起。总线300还可以将诸如外围设备、稳压器和功率管理电路等之类的各种其他电路链接在一起，这些都是本领域所公知的，因此，本文不再对其进行进一步描述。总线接口305在总线300和接收器301和发送器303之间提供接口。接收器301和发送器303可以是同一个元件，即收发机，提供用于在传输介质上与各种其他系统通信的单元。处理器302负责管理总线300和通常的处理，而存储器304可以被用于存储处理器302在执行操作时所使用的数据。
本申请实施例提供一种可编程逻辑器件的固件更新方法，其中，所述方法应用于具有第一存储器和可编程逻辑器件的电路模块，所述方法包括：获得所述第一存储器的属性信息；根据所述第一存储器的属性信息，判断所述第一存储器是否为外置存储器，获得第一判断结果；根据所述第一判断结果，获得第一高电平CPU控制信号，其中，所述第一高电平CPU控制信号包括第一控制信号或第二控制信号；根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；判断写入的所述固件更新数据是否完整，获得第一检测结果；如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。
本领域内的技术人员应明白，本发明的实施例可提供为方法、系统或计算机程序产品。因此，本发明可采用完全硬件实施例、完全软件实施例或结合软件和硬件方面的实施例的形式。而且，本发明可采用在一个或多个其中包含有计算机可用程序代码的计算机可用存储介质(包括但不限于磁盘存储器、CD-ROM、光学存储器等)上实施的计算机程序产品的形式。
本发明是参照根据本发明实施例的方法、设备(系统)、和计算机程序产品的流程图和/或方框图来描述的。应理解可由计算机程序指令实现流程图和/或方框图中的每一流程和/或方框、以及流程图和/或方框图中的流程和/或方框的结合。可提供这些计算机程序指令到通用计算机、专用计算机、嵌入式处理机或其他可编程数据处理设备的处理器以产生一个机器，使得通过计算机或其他可编程数据处理设备的处理器执行的指令产生用于实现在流程图一个流程或多个流程和/或方框图一个方框或多个方框中指定的功能的系统。
这些计算机程序指令也可存储在能引导计算机或其他可编程数据处理设备以特定方式工作的计算机可读存储器中，使得存储在该计算机可读存储器中的指令产生包括指令系统的制造品，该指令系统实现在流程图一个流程或多个流程和/或方框图一个方框或多个方框中指定的功能。
这些计算机程序指令也可装载到计算机或其他可编程数据处理设备上，使得在计算机或其他可编程设备上执行一系列操作步骤以产生计算机实现的处理，从而在计算机或其他可编程设备上执行的指令提供用于实现在流程图一个流程或多个流程和/或方框图一个方框或多个方框中指定的功能的步骤。
尽管已描述了本发明的优选实施例，但本领域内的技术人员一旦得知了基本创造性概念，则可对这些实施例作出另外的变更和修改。所以，所附权利要求意欲解释为包括优选实施例以及落入本发明范围的所有变更和修改。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。
Claims (8)
1.一种可编程逻辑器件的固件更新方法，其中，所述方法应用于具有第一存储器和可编程逻辑器件的电路模块，所述方法包括：
获得所述第一存储器的属性信息；
根据所述第一存储器的属性信息，判断所述第一存储器是否为外置存储器，获得第一判断结果；
根据所述第一判断结果，获得第一高电平CPU控制信号，其中，所述第一高电平CPU控制信号包括第一控制信号或第二控制信号；
根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；
判断写入的所述固件更新数据是否完整，获得第一检测结果；
如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。
2.如权利要求1所述的方法，其中，所述判断写入的所述固件更新数据是否完整，获得第一检测结果之后，包括：
如果所述第一检测结果为写入的所述固件更新数据不完整，获得第一写入信号；
根据所述第一写入信号，重新向所述第一存储器写入所述固件更新数据。
3.如权利要求1所述的方法，其中，所述根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据，所述电路模块还具有一串行接口的切换开关，所述方法包括：
如果所述第一判断结果为所述第一存储器为外置存储器，获得第一控制信号；
根据所述第一控制信号，通过所述切换开关将所述第一存储器切换到所述可编程逻辑器件的GPIO接口上，获得所述可编程逻辑器件的所述固件更新数据；
根据标准可编程逻辑器件写入协议，将所述固件更新数据写入所述第一存储器。
4.如权利要求1所述的方法，其中，所述根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据，包括：
如果所述第一判断结果为所述第一存储器为内置存储器，获得第二控制信号；
根据所述第二控制信号，控制所述第一存储器开启串行接口通道，获得所述可编程逻辑器件的所述固件更新数据；
根据标准可编程逻辑器件写入协议，将所述固件更新数据写入所述第一存储器。
5.如权利要求3所述的方法，其中，所述如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新之后，包括：
如果所述第一判断结果为所述第一存储器为外置存储器，获得第一低电平CPU控制信号；
根据所述第一低电平CPU控制信号，所述切换开关将所述第一存储器切换到所述可编程逻辑器件的专用串行接口上。
6.如权利要求4所述的方法，其中，所述如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新之后，包括：
如果所述第一判断结果为所述第一存储器为内置存储器，获得第二低电平CPU控制信号；
根据所述第二低电平CPU控制信号，控制所述第一存储器关闭所述串行接口通道。
7.一种可编程逻辑器件的固件更新系统，其中，所述系统包括：
第一获得单元：所述第一获得单元用于获得第一存储器的属性信息；
第一判断单元：所述第一判断单元用于根据所述第一存储器的属性信息，判断所述第一存储器是否为外置存储器，获得第一判断结果；
第二获得单元：所述第二获得单元用于根据所述第一判断结果，获得第一高电平CPU控制信号，其中，所述第一高电平CPU控制信号包括第一控制信号或第二控制信号；
第一写入单元：所述第一写入单元用于根据所述第一高电平CPU控制信号，向所述第一存储器写入固件更新数据；
第二判断单元：所述第二判断单元用于判断写入的所述固件更新数据是否完整，获得第一检测结果；
第一更新单元：所述第一更新单元用于如果所述第一检测结果为写入的所述固件更新数据完整，对可编程逻辑器件进行固件更新。
8.一种可编程逻辑器件的固件更新系统，包括存储器、处理器及存储在存储器上并可在处理器上运行的计算机程序，其中，所述处理器执行所述程序时实现权利要求1-6任一项所述方法的步骤。
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