CN113470577B - 显示面板及显示装置 - Google Patents

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Abstract

本申请涉及半导体器件技术领域，特别是涉及显示面板及显示装置，显示面板包括扫描线、数据线和像素驱动电路，扫描线和数据线交叉设置，数据线在延伸方向形成寄生电容；像素驱动电路连接扫描线和数据线；其中，像素驱动电路包括一重置单元，重置单元一端与扫描线连接，另一端与数据线连接，用于在像素驱动电路进行充电之前，对寄生电容进行放电。本申请实施例的显示面板通过在像素驱动电路中设置重置单元，使得重置单元所耗用的功耗较小，降低OLED显示面板的驱动电压，从而可以提高显示面板的发光效率。

Description

显示面板及显示装置
技术领域
本申请涉及半导体器件技术领域，特别是涉及显示面板及显示装置。
背景技术
随着显示技术的发展，有机发光二极管(Organic Light-Emitting Diode，OLED)具有自发光、全固态、宽视角、响应快等诸多优点而被认为在平板显示有着巨大的应用前景。为了提高OLED在平板显示中占有优势，OLED的驱动电压、发光效率等有待进一步改善。
发明内容
有鉴于此，本申请主要解决的技术问题是提供一种显示面板，以降低显示面板的功耗，降低显示面板的驱动电压，提高显示面板的发光效率。
为解决上述技术问题，本申请采用的一个技术方案是：一种显示面板，显示面板包括扫描线、数据线和像素驱动电路，扫描线和数据线交叉设置，数据线在延伸方向形成寄生电容；像素驱动电路连接扫描线和数据线；其中，像素驱动电路包括一重置单元，重置单元一端与扫描线连接，另一端与数据线连接，用于在像素驱动电路进行充电之前，对寄生电容进行放电。
其中，数据线向像素驱动电路写入数据信号之前，使得重置单元启动，对寄生电容进行放电。
其中，重置单元包括第一开关管，第一开关管的第一端连接数据线，第一开关管的控制端连接扫描线。
其中，第一开关管为P型晶体管，第一开关管的第二端连接扫描线。
其中，第一开关管的控制端连接首行像素单元对应的横向扫描线。
其中，第一开关管的控制端连接上一行像素单元对应的横向扫描线。
其中，像素驱动电路为驱动补偿电路，驱动补偿电路包括7T1C驱动电路。
其中，驱动补偿电路包括第一晶体管、第二晶体管、第三晶体管、第四晶体管、第五晶体管、第六晶体管、第七晶体管和存储电容，其中，第二晶体管的第一端与数据信号端连接，第二晶体管的第二端与第二扫描信号端连接，第二晶体管的第三端与第一晶体管的第一端连接；第一晶体管的第二端与第三晶体管的第一端连接，第一晶体管的第三端与第三晶体管的第三端连接；第三晶体管的第二端与第二扫描信号端连接；第四晶体管的第一端与第三晶体管的第一端连接，第四晶体管的第二端与第一扫描信号端连接，第四晶体管的第三端与参考电压端连接；第五晶体管的第一端与第一晶体管的第一端连接，第五晶体管的第二端与控制信号端连接，第五晶体管的第三端与驱动电压信号端连接；第六晶体管的第一端与发光器件连接，发光器件与低电平电压端连接，第六晶体管的第二端与控制信号端连接，第六晶体管的第三端与第一晶体管的第三端连接；第七晶体管的第一端与第六晶体管的第一端连接，第七晶体管的第二端与第三扫描信号端连接，第七晶体管的第三端与参考电压端连接；存储电容连接于驱动电压信号端和第一晶体管的第二端之间。
其中，第二扫描信号端与扫描线连接，第一扫描信号端与第一开关管的控制端连接；第一晶体管、第二晶体管、第三晶体管、第四晶体管、第五晶体管、第六晶体管、第七晶体管为PMOS晶体管。
其中，第一开关管的第一端连接于第二晶体管的第一端与数据信号端连接之间。
本申请还包括第二种技术方案，一种显示装置，包括显示面板驱动电路以及上述的显示面板，显示面板驱动电路与显示面板电连接，用于驱动显示面板。
本申请的有益效果是：区别于现有技术本申请实施例的显示面板通过在像素驱动电路中设置一重置单元，且重置单元通过扫描线给予信号，使得像素驱动电路在进行充电前可以对数据线所形成的寄生电容进行重置，使寄生电容放电，寄生电容小于再次写入的数据电压，以使得可以向像素驱动电路再次写入数据电压，不影响显面板的显示。本申请实施例中，重置单元所耗用的功耗较小，降低OLED显示面板的驱动电压，从而可以提高显示面板的发光效率。
附图说明
图1是本申请显示面板一实施例的结构示意图；
图2是本申请显示面板像素驱动电路一实施例的电路图；
图3是本申请显示面板一实施例的电路图；
图4是图2的像素驱动电路的对应工作时序图；
图5是是图4的T2阶段的局部放大图；
图6是是本申请显示装置一实施例的结构框图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。
如图1和图2所示，本申请实施例提供一种显示面板100(见图6)，显示面板100包括扫描线10、数据线20和像素驱动电路30，扫描线10和数据线20交叉设置，数据线20在延伸方向形成寄生电容21；像素驱动电路30连接扫描线10和数据线20；其中，像素驱动电路30包括一重置单元31，重置单元31连接扫描线10和数据线20，用于在像素驱动电路30进行充电之前，对寄生电容21进行放电。
其中，扫描线10的数量为多条，包括沿显示面板100宽度方向延伸的横向扫描线；数据线20为沿显示面板100长度方向延伸的数据线20(Data线)，数据线20为多条。显示面板100还包括电源信号线(图未示)，电源信号线与数据线20交叠设置，使得电源信号线与数据线20产生寄生电容21，寄生电容21会影响像素驱动电路30写入的数据电压，当寄生电容21大于像素驱动电路30写入的数据电压时，易造成像素驱动电路30的数据电压无法写入，影响显示面板100的显示。本申请实施例通过在像素驱动电路30中设置一重置单元31，且重置单元31通过扫描线10给予信号，使得像素驱动电路30在进行充电前可以对数据线20所形成的寄生电容21进行重置，使寄生电容21放电，寄生电容21小于再次写入的数据电压，以使得可以向像素驱动电路30再次写入数据电压，不影响显面板的显示。本申请实施例中，重置单元31所耗用的功耗较小，可以降低OLED显示面板100的驱动电压，可以提高显示面板100的发光效率。
本申请实施例中，在所述数据线20向所述像素驱动电路30写入数据信号之前，使得所述重置单元31启动，对所述寄生电容21进行放电。本申请实施例中，通过在向所述像素驱动电路30写入数据信号之前，对寄生电容21进行重置放电，使得其不影响数据线20向所述像素驱动电路30写入数据信号，不影响显示面板的显示效果。
本申请实施例中，继续如图1和2所示，重置单元31包括第一开关管311，第一开关管311的第一端连接数据线20，第一开关管311的控制端连接扫描线10。本申请实施例中，通过设置一个第一开关管311，在写入数据电压之前，向扫描线10输入扫描信号，以使得与扫描线10连接的第一开关管311导通，使得数据线20所形成的寄生电容21放电，从而使得寄生电容21减小，本申请实施例中，寄生电容21可以减小至小于像素驱动电路30写入的数据电压值。例如本申请实施例中，像素驱动电路30写入的数据电压值U0＝3V，数据线20所形成的寄生电容Uc＝5V，此时，由于寄生电容Uc＞像素驱动电路30写入的数据电压值U0，在未设置重置单元31的情况下，寄生电容Uc会输入至像素驱动电路30，造成像素驱动电路30无法写入数据电压；本申请实施例，通过在写入数据电压之前，向扫描线10输入低电平扫描信号，例如，本申请实施例中，向扫描线10输入-5V的扫描信号，使得数据线20形成的寄生电容21放电至Uc’＝0V，此时，放电后的寄生电容21的Uc’＜U0，可以向像素驱动电路30写入U0＝3V的数据电压。以上仅为举例，在其他实施例中，向扫描线10输入的扫描信号的电压值也可以为-3V或0V等。本申请实施例中，数据线20上所写入的电压一般在2V-7V，当上一行像素单元的像素驱动电路30写入的数据电压为6V时，数据线20所形成的寄生电容Uc＝6V，再次向当前行像素单元的像素驱动电路30写入的数据电压为U0＝4V时，在未设置重置单元31的情况下，寄生电容Uc会输入至像素驱动电路30，造成像素驱动电路30无法写入；本申请实施例，通过设置重置单元31，在写入数据电压之前，向扫描线10输入低电平扫描信号，使得寄生电容21放电，使寄生电容21的电压小于写入的数据电压为U0，使得U0＝4V的数据电压可以写入当前行像素单元的像素驱动电路30。
本申请实施例中，重置单元31通过设置一个第一开关管311，可以使得重置单元31在工作时，所耗用的功耗较小，进一步降低像素驱动电路30的功耗。本申请实施例中，不需要通过单独设置IC芯片以在每行充电时都要重置数据线20所形成的寄生电容21，因此不需要消耗过多的功耗。本申请实施例中，重置单元31所消耗的功耗小于预设功耗，预设功耗为单独设置IC芯片重置数据线20所形成的寄生电容21所消耗的功耗。
本申请实施例中，像素驱动电路30通过设置重置单元31，在写入数据电压时可以对数据线20所形成的寄生电容21放电，使得写入数据电压的值可以较小，因此，可以降低显示面板100的驱动电压，从而可以提高显示面板100的发光效率。
本申请实施例中，第一开关管311为P型晶体管，第一开关管311的第二端连接扫描线10。本申请实施例中，第一开关管311为P型晶体管，可以通过输入低电平信号导通第一开关管311。其中，第一开关管311的第一端为源极，第二端为漏极，控制端为栅极。在其他实施例中，第一开关管311也可以为N型晶体管，通过向扫描线10输入高电平信号，以使得第一开关管311导通，使得数据线20所形成的寄生电容21放电。
本申请实施例中，如图3所示，第一开关管311的控制端连接首行像素单元40对应的横向扫描线(SCAN1)。本申请实施例中，多条扫描线10和多条数据线20交叉设置将显示面板100划分成多个像素单元40，每个像素单元40连接一条对应的扫描线10和一条对应的数据线20，像素单元40包括像素驱动电路30，像素驱动电路30的第一开关管311的控制端接收首行像素单元40所对应的扫描线10所输出的扫描信号。本申请实施例中，像素单元40还包括发光器件41。本申请实施例中，通过逐行向横向扫描线输入扫描信号，像素驱动电路30进行逐行充电，以控制显示面板100的发光器件41发光，本申请实施例中，像素单元40包括发光器件41。本申请实施例中，在对首行像素单元40的像素驱动电路30进行充电时，像素电路可以写入数据电压，此时数据线20形成寄生电容21；当向第二行像素单元40及其他非首行的像素驱动电路30进行充电时，若冲入低电平，而此时若数据线20的寄生电容21所产生的电压较高时，易造成第二行像素单元40及其他非首行的像素驱动电路30无法写入数据电压。本申请实施例中，通过第一开关管311与首行像素单元40对应的横向扫描线(SCAN1)连接，可以使得在第二行像素单元40及其他非首行的像素驱动电路30进行充电时，首行像素单元40对应的横向扫描线(SCAN1)输入低电平扫描信号，以使得数据线20形成的寄生电容21放电，以便于第二行像素单元40及其他非首行的像素驱动电路30能够写入数据电压。
在本申请另一实施例中，第一开关管311的控制端连接上一行像素单元40对应的横向扫描线。多条扫描线10和多条数据线20交叉设置将显示面板100划分成多个像素单元40，每个像素单元40连接一条对应的扫描线10和一条对应的数据线20，像素单元40包括像素驱动电路30，像素驱动电路30的第一开关管311的控制端接收上一行像素单元40所对应的扫描线10所输出的扫描信号。本申请实施例中，像素单元40还包括发光器件41。本申请实施例中，在对非首行的像素驱动电路30写入数据电压低于数据线20形成的寄生电容21的电压时，使得非首行的像素驱动电路30无法写入数据电压，本申请实施例中，通过将第一开关管311的控制端连接上一行的像素对应的横向扫描线，在进行充电时，上一行像素单元40对应的横向扫描线输入低电平扫描信号，以使得数据线20形成的寄生电容21放电，以便于非首行的像素驱动电路30能够写入数据电压。具体地，本申请实施例中，在对第N行的像素驱动电路30写入数据电压时，第一开关管311的控制端连接第N-1行的像素单元40对应的横向扫描线，其中，N≥2。例如，在对第三行的像素驱动电路30写入数据电压时，第一开关管311的控制端连接第二行的像素单元40对应的横向扫描线(SCAN2)；在对第十行的像素驱动电路30写入数据电压时，第一开关管311的控制端连接第九行的像素单元40对应的横向扫描线。
本申请实施例中，像素驱动电路30包括驱动补偿电路，驱动补偿电路包括7T1C驱动电路。本申请实施例中，像素驱动电路30为驱动补偿电路时，能够补偿像素电压，驱动补偿电路不能够通过数据线20自动重置，易造成数据线20形成的寄生电容21影响驱动补偿电路的数据电压的写入。本申请实施例中，驱动补偿电路为7T1C驱动电路，在其他实施例中，驱动补偿电路也可以是6T1C驱动补偿电路。
本申请实施例中，7T1C驱动电路包括第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7和存储电容Cst。
其中，第二晶体管M2的第一端与数据信号端Data连接，第二晶体管M2的第二端与第二扫描信号端S2连接，第二晶体管M2的第三端与第一晶体管M1的第一端连接；
第一晶体管M1的第二端与第三晶体管M3的第一端连接，第一晶体管M1的第三端与第三晶体管M3的第三端连接；
第三晶体管M3的第二端与第二扫描信号端S2连接；
第四晶体管M4的第一端与第三晶体管M3的第一端连接，第四晶体管M4的第二端与第一扫描信号端S1连接，第四晶体管M4的第三端与参考电压端VREFN连接；
第五晶体管M5的第一端与第一晶体管M1的第一端连接，第五晶体管M5的第二端与控制信号端EM连接，第五晶体管M5的第三端与驱动电压信号端ELVDD连接；
第六晶体管M6的第一端与发光器件41连接，发光器件41与低电平电压端ELVSS连接，第六晶体管M6的第二端与控制信号端EM连接，第六晶体管M6的第三端与第一晶体管M1的第三端连接；
第七晶体管M7的第一端与第六晶体管M6的第一端连接，第七晶体管M7的第二端与第三扫描信号端S3连接，第七晶体管M7的第三端与参考电压端VREFN连接；
存储电容Cst连接于驱动电压信号端ELVDD和第一晶体管M1的第二端之间。
本申请实施例中，第二扫描信号端S2与横向扫描线连接，第一扫描信号端S1与第一开关管311的控制端连接；第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7为P型晶体管。本申请实施例中，第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7的第一端为源极，第二端为栅极，第三端为漏极。在其他实施例中，第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7也可以为N型晶体管。
本申请实施例中，第一开关管311的第一端连接于第二晶体管M2的第一端与数据信号端Data之间。
本申请实施例中，如图3所示，显示面板100中的外部设置集成电路(图未示)，集成电路与两根以上控制信号线分别连接，用于为两根以上控制信号线提供控制信号，本申请实施例中，控制信号线的数量为三根，分别为第一控制信号线SW1、第二控制信号线SW2和第三控制信号线SW3。在其他实施例中，集成电路也可以与四根或五根等控制信号线分别连接。
本申请实施例中，集成电路设置有数据端口(图未示)，一根数据线Data0通过该数据端口与集成电路连接，该数据线Data0分别与第一控制信号线SW1、第二控制信号线SW2和第三控制信号线SW3连接，第一控制信号线SW1与开关管M8连接，第二控制信号线SW2与开关管M9连接，第三控制信号线SW3与开关管M10连接，使得开关管M8、M9和M10分别连接显示面板的一个数据线，即分别与数据线Data1、数据线Data2和数据线Data3连接，实现集成电路的一个数据线端口连接三根数据线的效果，减少集成电路的数量的设置。
图4示出了图2中像素驱动电路30的时序图。图4所示的图例是以低电平导通为例进行说明的，在其他实施例中，也可以采用高电平导通的方式。
在T0阶段，控制信号端EM输出高电平信号，第一扫描信号端S1、第二扫描信号端S2、第三扫描信号端S3、第三竖向扫描信号端SW3、第二竖向扫描信号端SW2、第一控制信号线SW1均输出高电平信号。
在T1阶段，对第一晶体管M1的栅极初始化，同时对给数据线(Data线)初始化；控制信号端EM输出高电平信号，第二扫描信号端S2、第三扫描信号端S3、第三控制信号线SW3、第二控制信号线SW2、第一控制信号线SW1均输出高电平信号；第一扫描信号端S1输出低电平信号，第一开关管311导通，数据线20所产生的寄生电容21放电。
第一扫描信号端S1输出低电平信号至第四晶体管M4的栅极，第四晶体管M4导通，参考电压端VREFN的参考信号流入第四晶体管M4的漏极，从第四晶体管M4的源极流出至第一晶体管M1的栅极，以使得第一晶体管M1的栅极为低电平，实现M1的栅极初始化。
在T2阶段，即充电阶段，给第一晶体管M1的栅极充电；控制信号端EM输出高电平信号，第一扫描信号端S1输出高电平信号，第三扫描信号端S3输出高电平信号，第二扫描信号端S2输出低电平信号；如图4和图5所示，本申请实施例中，T2阶段依次包括T21阶段、T22阶段和T23阶段。
在T21阶段，第三控制信号线SW3输出低电平信号，第二控制信号线SW2、第一控制信号线SW1均输出高电平信号，数据信号端Data输出数据信号；第二晶体管M2、第一晶体管M1和第三晶体管M3导通，数据信号写入第一晶体管M1的源极，给第一晶体管M1的源极充电。
在T22阶段，第二控制信号线SW2输出低电平信号，第三控制信号线SW3、第一控制信号线SW1均输出高电平信号，数据信号端Data输出数据信号；第二晶体管M2、第一晶体管M1和第三晶体管M3导通，数据信号写入第一晶体管M1的源极，给第一晶体管M1的源极充电。
在T23阶段，第一控制信号线SW1输出低电平信号，第三控制信号线SW3、第二控制信号线SW2均输出高电平信号，数据信号端Data输出数据信号；第二晶体管M2、第一晶体管M1和第三晶体管M3导通，数据信号写入第一晶体管M1的源极，给第一三晶体管M1的源极充电。
驱动电压信号端ELVDD为高电平，第二扫描信号端S2为低电平，第二晶体管M2导通，数据信号依次流入第二晶体管M2的源极与第二晶体管M2的漏极，进入第一晶体管M1的源极，第二晶体管M1导通，第五晶体管M5不导通，从第二晶体管M1的漏极输出的信号通过第三晶体管M3流入第一晶体管M1的栅极，给第一晶体管M1的栅极充电，由于电容cst的两端电压不同，电容cst中存储有电量。
在T3阶段，初始化阶段，发光器件41的阳极复位；控制信号端EM输出高电平信号，第三扫描信号端S3输出低电平信号，参考电压端VREFN的参考信号流入第七晶体管M7的漏极，从第七晶体管M7的源极流出至发光器件41的阳极，将发光器件41的阳极电平拉低，实现发光器件41的阳极的初始化。
在T4阶段，发光阶段；控制信号端EM输出低电平信号，第五晶体管M5、第一晶体管M1、第六晶体管M6依次导通，第一扫描信号端S1、第二扫描信号端S2、第三扫描信号端S3均为均输出高电平信号，第二晶体管M2、第四晶体管M4、第三晶体管M3以及第七晶体管M7均不导通，由于电容cst中存储有在T2阶段收集的电量，在T4阶段，cst处于放电状态，第五晶体管M5的漏极接收两种信号：ELVDD以及Cst的放电信号，这两股信号从第五晶体管M5的源极流出，依次经过第一晶体管M1与第六晶体管M6流入发光器件41，使得发光器件41发出与T2阶段的数据信号相匹配的光。
本申请实施例中，可以不需要单独设置T0阶段以重置每一行的数据线20形成的寄生电容21，在T1阶段即可以实现数据线20所产生的寄生电容21的放电，使得不影响非首行像素单元40的像素驱动电路30的数据电压的写入。
本申请还包括第二种技术方案，如图6所示，一种显示装置，包括显示面板驱动电路200以及上述显示面板100。所述显示面板驱动电路200与所述显示面板100电连接，用于驱动显示面板100。
本申请实施例中的显示装置，在像素驱动电路30中设置一重置单元31，且本申请实施例中，重置单元31通过扫描线10给予信号，使得像素驱动电路30在进行充电前可以对数据线20所形成的寄生电容21进行重置，使寄生电容21放电，寄生电容21小于再次写入的数据电压，以使得可以向像素驱动电路30再次写入数据电压时，不影响显面板的显示。本申请实施例中，不需要再单独设置IC芯片以驱动以在非首行的像素单元40的像素驱动电路30写入数据电压时重置数据线20的电容，可以降低显示装置的功耗，提高显示装置的发光效率。
以上仅为本申请的实施方式，并非因此限制本申请的专利范围，凡是利用本申请说明书及附图内容所作的等效结构或等效流程变换，或直接或间接运用在其他相关的技术领域，均同理包括在本申请的专利保护范围内。

Claims (9)

1.一种显示面板，其特征在于，所述显示面板包括：
扫描线；
数据线，所述扫描线和所述数据线交叉设置，所述数据线在延伸方向形成寄生电容；
像素驱动电路，连接所述扫描线和所述数据线；
其中，所述像素驱动电路包括一重置单元，所述重置单元一端与所述扫描线连接，另一端与所述数据线连接，用于在所述像素驱动电路进行充电之前，对所述寄生电容进行放电；
所述重置单元包括：
第一开关管，所述第一开关管的第一端连接所述数据线，所述第一开关管的控制端连接所述扫描线。
2.根据权利要求1所述的显示面板，其特征在于，
在所述数据线向所述像素驱动电路写入数据信号之前，使得所述重置单元启动，对所述寄生电容进行放电。
3.根据权利要求1所述的显示面板，其特征在于，
所述第一开关管为P型晶体管，所述第一开关管的第二端连接所述扫描线。
4.根据权利要求1所述的显示面板，其特征在于，
所述第一开关管的控制端连接首行像素单元对应的横向扫描线。
5.根据权利要求1所述的显示面板，其特征在于，
所述第一开关管的控制端连接上一行像素单元对应的横向扫描线。
6.根据权利要求1所述的显示面板，其特征在于，所述像素驱动电路包括驱动补偿电路，所述驱动补偿电路包括7T1C驱动电路。
7.根据权利要求6所述的显示面板，所述驱动补偿电路包括第一晶体管、第二晶体管、第三晶体管、第四晶体管、第五晶体管、第六晶体管、第七晶体管和存储电容，
其中，所述第二晶体管的第一端与数据信号端连接，所述第二晶体管的第二端与第二扫描信号端连接，所述第二晶体管的第三端与第一晶体管的第一端连接；
所述第一晶体管的第二端与第三晶体管的第一端连接，所述第一晶体管的第三端与第三晶体管的第三端连接；
所述第三晶体管的第二端与第二扫描信号端连接；
所述第四晶体管的第一端与第三晶体管的第一端连接，所述第四晶体管的第二端与第一扫描信号端连接，所述第四晶体管的第三端与参考电压端连接；
所述第五晶体管的第一端与第一晶体管的第一端连接，所述第五晶体管的第二端与控制信号端连接，所述第五晶体管的第三端与驱动电压信号端连接；
所述第六晶体管的第一端与发光器件连接，所述发光器件与低电平电压端连接，所述第六晶体管的第二端与控制信号端连接，所述第六晶体管的第三端与第一晶体管的第三端连接；
所述第七晶体管的第一端与第六晶体管的第一端连接，所述第七晶体管的第二端与第三扫描信号端连接，所述第七晶体管的第三端与参考电压端连接；
所述存储电容连接于驱动电压信号端和第一晶体管的第二端之间。
8.根据权利要求7所述的显示面板，其特征在于，所述第二扫描信号端与所述扫描线连接，所述第一扫描信号端与所述第一开关管的控制端连接；
所述第一晶体管、第二晶体管、第三晶体管、第四晶体管、第五晶体管、第六晶体管、第七晶体管为PMOS晶体管。
9.一种显示装置，其特征在于，包括显示面板驱动电路以及权利要求1-8任意一项的显示面板，所述显示面板驱动电路与所述显示面板电连接，用于驱动显示面板。
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