CN112420922B - 一种基于钛银合金的低功耗cbram器件及其制备方法和应用 - Google Patents

一种基于钛银合金的低功耗cbram器件及其制备方法和应用 Download PDF

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Abstract

本发明提供了一种基于钛银合金的低功耗CBRAM器件及其制备方法和应用,该低功耗CBRAM器件包括:底电极;插入层,位于底电极一侧表面;阻变层,位于插入层远离所述底电极一侧表面;顶电极,位于阻变层远离所述底电极一侧表面;其中,插入层的材料为Ti、Ag合金材料。本申请制备得到的基于钛银合金的低功耗CBRAM器件,采用Ti、Ag合金代替传统的Ag制备的CBRAM器件,其高低阻态的电阻分布更加集中,进一步提高了器件性能的稳定性;本申请制备得到的基于钛银合金的低功耗CBRAM器件可以在更低的功耗下实现电导的连续调控,这为低功耗忆阻器阵列的搭建以及低功耗类脑神经形态芯片的研制提供了新的可能。

Description

一种基于钛银合金的低功耗CBRAM器件及其制备方法和应用
技术领域
本发明涉及信息存储技术领域,尤其涉及一种基于钛银合金的低功耗CBRAM器件及其制备方法和应用。
背景技术
随着5G时代的到来,人们对信息存储的要求越来越高,然而目前主流的闪存(Flash)存储器面临着操作电压大、操作速度慢、功耗高等一系列缺点,这严重限制了Flash在高科技领域的广泛应用。因此,研究者开始对下一代非挥发性存储器进行研究。
在近几年,阻变存储器(RRAM)由于其具有与互补金属氧化物(ComplementaryMetal Oxide Semiconductor,CMOS)工艺兼容、操作速度快、功耗低、结构简单、单元尺寸小、易于三维集成等一系列优点,被认为是下一代非挥发性存储器的候选者之一。其通过在薄膜材料上施加电压,引起器件的电阻发生变化,而储存数据。
被称为可编程金属化单元(PMC)的导电桥式随机存储器(Conducting BridgingRandom Access Memory,CBRAM)是一种非常有潜力的RRAM。传统的CBRAM一般为三明治结构,一个电极为活泼金属,如Cu或Ag;中间层一般为固态电解质,如Ag2S等;另一个电极为惰性金属,如Pt或Au。现在的CBRAM也可以通过在中间层掺杂活泼金属或者在电极和中间层之间加入含有活泼金属的插入层来制得。CBRAM的阻变机制一般被认为是金属阳离子在中间层中迁移导致连接底电极和顶电极的导电细丝形成或断裂,进而表现出低阻态或者高阻态。然而,传统的CBRAM在制备好之后需要施加一个很大的Forming电压(一般大于5V)才能使器件发生阻态的转变;在进行电阻转变时也需要施加1V左右的电压;同时器件的稳定性欠佳,这些缺点使得CBRAM很难大规模阵列中使用。同时,CBRAM作为一种非线性电阻,其电导值可以随着施加电压的不同而发生连续的变化并且能够在断电的情况下保持该变化,因此在神经突触仿生方面具有很大的潜力。然而,在人的大脑中,信息的传递、储存等过程所消耗的能量很低,这在实际器件中很难实现。因此,降低器件的功耗是必然选择。
基于目前CBRAM存在的技术缺陷,有必要对此进行改进。
发明内容
有鉴于此,本发明提出了一种基于钛银合金的低功耗CBRAM器件及其制备方法,以解决现有技术中存在的技术缺陷。
第一方面,本发明提供了一种基于钛银合金的低功耗CBRAM器件,包括:
底电极;
插入层,位于所述底电极一侧表面;
阻变层,位于所述插入层远离所述底电极一侧表面;
顶电极,位于所述阻变层远离所述底电极一侧表面;
其中,所述插入层的材料为Ti、Ag合金材料。
可选的,所述的基于钛银合金的低功耗CBRAM器件,所述底电极的材料为Ti、Pt、W或TiN中的一种;所述阻变层的材料为含氧碲化锗材料,所述顶电极的材料为Pt或Ti中的一种。
可选的,所述的基于钛银合金的低功耗CBRAM器件,所述底电极的厚度为150~200nm,所述插入层的厚度为20~50nm,所述阻变层的厚度为50~100nm,所述顶电极的厚度为80~120nm。
可选的,所述的基于钛银合金的低功耗CBRAM器件,所述顶电极的形状为矩形或圆形,所述矩形的边长为100~900μm,所述圆形的直径为100~900μm。
第二方面,本发明还提供了一种基于钛银合金的低功耗CBRAM器件的制备方法,包括以下步骤:
提供底电极;
在所述底电极表面制备插入层;
在所述插入层远离所述底电极一侧的表面制备阻变层;
在所述阻变层远离所述底电极一侧的表面制备顶电极;
其中,所述插入层的材料为Ti、Ag合金材料。
可选的,所述的基于钛银合金的低功耗CBRAM器件的制备方法,在所述底电极表面制备插入层具体包括:
以金属钛、金属银为靶材,利用磁控溅射法在所述底电极表面沉积得到钛、银合金即为插入层。
可选的,所述的基于钛银合金的低功耗CBRAM器件的制备方法,利用磁控溅射法在所述底电极表面沉积得到钛、银合金控制的工艺条件为:控制磁控溅射设备真空室内的压强为3~5×10-1Pa,金属钛靶材以及金属银靶材的溅射功率均为10~40W,金属钛靶材和金属银靶材同时溅射。
可选的,所述的基于钛银合金的低功耗CBRAM器件的制备方法,所述阻变层为含氧碲化锗材料,所述阻变层的制备方法具体为:控制磁控溅射设备真空室内的压强为3~5×10-1Pa,以碲化锗为靶材控制溅射功率为30~60W,利用磁控溅射法即可在插入层远离所述底电极一侧的表面制备得到阻变层。
可选的,所述的基于钛银合金的低功耗CBRAM器件的制备方法,所述顶电极的材料为钛,所述顶电极的制备方法为:控制磁控溅射设备真空室内的压强为3~5×10-1Pa,以金属钛为靶材控制溅射功率为30~60W,利用磁控溅射法即可在所述阻变层远离所述底电极一侧的表面制备得到顶电极。
第三方面,本发明还提供了所述的基于钛银合金的低功耗CBRAM器件或所述的制备方法制备得到的基于钛银合金的低功耗CBRAM器件在神经突触仿生器件中的应用。
本发明的一种基于钛银合金的低功耗CBRAM器件相对于现有技术具有以下有益效果:
(1)本申请制备得到的基于钛银合金的低功耗CBRAM器件,采用Ti、Ag合金代替传统的Ag制备的CBRAM器件,其高低阻态的电阻分布更加集中,进一步提高了器件性能的稳定性;本申请制备得到的基于钛银合金的低功耗CBRAM器件可以在更低的功耗下实现电导的连续调控,这为低功耗忆阻器阵列的搭建以及低功耗类脑神经形态芯片的研制提供了新的可能;
(2)本申请制备得到的基于钛银合金的低功耗CBRAM器件,相较于常规器件,可以在更低的功耗下进行STDP学习规则的模拟;
(3)本申请制备得到的基于钛银合金的低功耗CBRAM器件的set电压约为-0.2V,reset电压约为0.1V,而常规CBRAM器件的转变电压往往在1V左右,可以看出,本申请制备得到的基于钛银合金的低功耗CBRAM器件的转变电压相较于与传统的CBRAM器件降低了约一个数量级,这也会导致功耗的大幅度降低;
(4)本申请制备得到的基于钛银合金的低功耗CBRAM器件几乎不需要Forming过程,而常规的CBRAM器件的Forming电压往往大于1V。可以看出,当对得到的基于钛银合金的低功耗CBRAM器件的三维集成阵列进行测试时,相较于传统的CBRAM器件,操作将更加简单,能耗将进一步降低。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单的介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为本发明的基于钛银合金的低功耗CBRAM器件的结构示意图;
图2为本发明实施例1制备得到的基于钛银合金的低功耗CBRAM器件的FIB-SEM示意图;
图3为本发明的实施例1制备得到的基于钛银合金的低功耗CBRAM器件的I-V曲线图;
图4为本发明的实施例1制备得到的基于钛银合金的低功耗CBRAM器件的阻态分布图;
图5为对比例1制备得到的CBRAM器件的Forming曲线图;
图6为对比例1制备得到的CBRAM器件的I-V曲线图;
图7为对比例1制备得到的CBRAM器件的阻态分布图;
图8为本发明的实施例2制备得到的基于钛银合金的低功耗CBRAM器件的I-V曲线图;
图9为本发明的实施例3制备得到的基于钛银合金的低功耗CBRAM器件的I-V曲线图;
图10为本发明的实施例1制备得到的基于钛银合金的低功耗CBRAM器件在单个脉冲循环下的电导渐变曲线图;
图11为本发明的实施例1制备得到的基于钛银合金的低功耗CBRAM器件在多个脉冲循环下的电导渐变曲线图;
图12为本发明的实施例1制备得到的基于钛银合金的低功耗CBRAM器件在另一种单个脉冲循环下的电导渐变曲线图;
图13为本发明的实施例1制备得到的基于钛银合金的低功耗CBRAM器件在另一种多个脉冲循环下的电导渐变曲线图;
图14为施加在本发明实施例1中制备得到的CBRAM器件上的电压示意图;
图15为本发明实施例1中制备得到的CBRAM器件的STDP特性曲线图;
图16为另一种施加在本发明实施例1中制备得到的CBRAM器件上的电压示意图;
图17为本发明实施例1中制备得到的CBRAM器件的另一种STDP特性曲线图。
具体实施方式
下面将结合本发明实施方式,对本发明实施方式中的技术方案进行清楚、完整的描述,显然,所描述的实施方式仅仅是本发明一部分实施方式,而不是全部的实施方式。基于本发明中的实施方式,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施方式,都属于本发明保护的范围。
实施例1
如图1所示,本发明提供了一种基于钛银合金的低功耗CBRAM器件,包括:
底电极1;
插入层2,位于底电极1一侧表面;
阻变层3,位于插入层2远离底电极1一侧表面;
顶电极4,位于阻变层3远离底电极1一侧表面;
其中,插入层2的材料为Ti、Ag合金材料。
需要说明的是,本申请实施例中,底电极1的材料为Ti、Pt、W或TiN中的一种,阻变层3的材料为含氧碲化锗材料,含氧碲化锗材料为GeTeOx,顶电极4的材料为Pt或Ti中的一种;底电极1的厚度为150~200nm,插入层2的厚度为20~50nm,阻变层3的厚度为50~100nm,顶电极4的厚度为80~120nm;顶电极4的形状为矩形或圆形,矩形的边长为100~900μm,圆形的直径为100~900μm,实际中顶电极4可阵列设置在阻变层3上。
具体的,本申请实施例中,底电极1为Pt材料,厚度约为169nm,插入层2厚度约为39nm,阻变层厚度约为89nm,顶电极为钛材料,厚度约为91nm,顶电极4的形状为矩形,矩形边长约为600μm。图2显示了该CBRAM器件的FIB-SEM示意图。
基于,同一发明构思,本申请实施例还提供了上述基于钛银合金的低功耗CBRAM器件的制备方法,包括以下步骤:
S1、提供底电极;
S2、在底电极表面制备插入层;
S3、在插入层远离底电极一侧的表面制备阻变层;
S4、在阻变层远离底电极一侧的表面制备顶电极;
其中,插入层的材料为Ti、Ag合金材料。
具体的,S1包括:在Si/SiO2/Ti基底表面生长Pt即得底电极,具体的生长方法可为化学气相沉积、物理气相沉积等,本实施例中采用化学气相沉积生长Pt;
S2包括:对S1中生长有底电极Pt的衬底材料依次使用丙酮、乙醇、去离子水在超声仪中超声清洗30min,之后取出并将其吹干,然后在底电极的一侧边缘处贴绝缘胶,预留出底电极;在磁控溅射设备上安装金属钛靶和金属银靶,以氩气为惰性气体通入磁控溅射设备的真空室内,开启直流溅射电源,室温下控制真空室内的系统压强为4.1×10-1Pa,在钛靶溅射功率为30W和银靶溅射功率为30W的条件下,在底电极Pt层表面共溅射,溅射沉积时间为600s,沉积完毕后,关闭直流溅射电源,即得插入层;
S3包括:在磁控溅射设备上安装碲化锗靶,以氩气为惰性气体通入磁控溅射设备的真空室内,开启直流溅射电源,室温下控制真空室内的系统压强为4.1×10-1Pa,在碲化锗靶溅射功率为40W的条件下,在插入层表面溅射,溅射沉积时间为1800s,沉积完毕后,关闭直流溅射电源,即得GeTeOx薄膜阻变层,由于在制备过程中腔体内的真空度不够高,所以制备的碲化锗阻变层含氧;
S4包括:在磁控溅射设备上钛靶,以氩气为惰性气体通入磁控溅射设备的真空室内,开启直流溅射电源,室温下控制真空室内的系统压强为4.1×10-1Pa,在钛靶溅射功率为40W的条件下,在阻变层表面溅射,溅射沉积时间为1800s,沉积完毕后,关闭直流溅射电源,即得顶电极。
实施例2
本实施例的CBRAM器件,与实施例1中的CBRAM器件的结构和制备方法均相同,区别在于,本实施例中的制备插入层的步骤当中,银靶的溅射功率为20W,其他参数均与实施例1相同。
实施例3
本实施例的CBRAM器件,与实施例1中的CBRAM器件的结构和制备方法均相同,区别在于,本实施例中的制备插入层的步骤当中,银靶的溅射功率为40W,其他参数均与实施例1相同。
对比例1
本对比例的CBRAM器件,与实施例1中的CBRAM器件的结构和制备方法均相同,区别在于,本对比例中的制备插入层的步骤当中,钛靶的溅射功率为0W,其他参数均与实施例1相同,即制备得到的插入层为Ag。
性能测试
分别将实施例1~3中制备得到的CBRAM器件进行相应的性能测试,测试全都是在安捷伦B1500A半导体参数分析仪测试平台上进行的,这里主要对实施例1中CBRAM器件进行详细地说明。
首先,对实施例1中制备得到的CBRAM器件的阻变特性进行测试,在测试前,先去掉贴在阻变存储器上的绝缘胶带,使底电极暴露出来,然后将其置于探针台上,用两个探针分别接触器件的底电极和顶电极。在顶电极上施加-0.4V~0.5V的直流扫描电压,底电极接地,进行100次扫描电压循环测试,得到的I-V曲线如图3所示。
从图3中可以看出,该I-V曲线表现出明显的双极性电阻转变特性且一个扫描电压循环包括四个部分:首先从0V扫描到-0.4V,再从-0.4V扫描到0V,之后从0V扫描到0.5V,最后从0.5V扫描到0V,即完成一个扫描周期,每部分扫描步数均为101。为了防止测试过程中电流过大而把器件击穿,在施加负向电压时需要设定一个大小为100μA的限制电流。当电压从0V扫描到-0.4V时,可以看到流过器件的电流逐渐增加,当电压到-0.16V左右时器件电流突然增加,此时器件由高阻态转变成低阻态,该过程称为set过程;当电压从0扫描到0.5V时,流过器件的电流先增大,当电压达到0.07V左右时,流过器件的电流突然减小,此时器件从低阻态变回高阻态,该过程为reset过程。根据该I-V曲线可以看出,该CBRAM器件在测试时不需要Forming过程(Forming-free)并且器件的转变电压很小,在100μA的限流下也有稳定的电阻转变特性。在-0.1V的电压下读取实施例1中得到的CBRAM器件高阻态和低阻态的电阻值,得到该器件的电阻分布图,如图4所示。
在对比例1中制备得到的CBRAM器件的顶电极上施加一个从0V到-3V的扫描电压,并设置一个3mA的限流,可以观察到当电压扫描到-1.2V左右时电流达到限流,该过程即为Forming过程,如图5所示;在进行Forming过程之后,按照上述实施例1中同样的方法得到对比例1中制备得到的CBRAM器件的I-V曲线图和电阻分布图,结果分别如图6~7所示。通过对比可以发现,对比例1中制备得到的CBRAM器件在进行测试前需要一个Forming过程并且该器件的电阻分布、转变电压分布没有实施例1中制备得到的CBRAM器件稳定。
按照上述实施例1同样的方法分别得到实施例2~3中得到的CBRAM器件的I-V曲线图,结果分别如图8、图9所示,从图8、图9中可知,实施例2~3制备得到的CBRAM器件也具有Forming-free、转变电压低、稳定性高等一系列优点。
接下来对实施例中制备得到的CBRAM器件的忆阻特性进行测试。当给CBRAM器件的顶电极上施加负向脉冲时,器件的电导会逐渐增大;当在顶电极上施加正向脉冲时,器件的电导会逐渐减小。其中,负向脉冲的幅值为-0.2V~-1V,脉宽为100ns~10μs,延时为100ns~10μs;正向脉冲的幅值为0.2V~1V,脉宽为100ns~10μs,延时为100ns~10μs。这里以实施例1中制备得到的CBRAM器件为例,详细说明,测试结果如图10所示。可以发现,当对该CBRAM器件施加幅值为-0.42V,脉宽为100ns,延时为1μs的矩形波时,该CBRAM器件的电导逐渐增大;当对该CBRAM器件施加幅值为0.37V,脉宽为100ns,延时为1μs的矩形波时,器件的电导逐渐减小,这种CBRAM器件的电导在单个脉冲激励下逐渐增大或减小的特性可以用来模拟生物突触中的增强和抑制。
进一步对实施例1中制备得到的CBRAM器件重复施加上述单个脉冲后,可以得到该CBRAM器件的电导值在脉冲下连续可调的特性,如图11所示,这种特性可以用作对神经突触长时程可塑性(LTP)的模拟。
当对实施例1中制备得到的CBRAM器件施加幅值为-0.4V或0.33V,脉宽为100ns,延时为1μs的矩形波时,也可以得到相似的结果,结果如图12所示。从图12中可知,该CBRAM器件的电导在该脉冲下也可以逐渐增大或减小;进一步对实施例1中制备得到的CBRAM器件重复施加上述单个脉冲后,也可以得到该CBRAM器件的电导值在脉冲下连续可调的特性,如图13所示。
为了更加深入的探究实施例1中制备得到的CBRAM器件的忆阻特性,对生物神经学习规则STDP(脉冲时序依赖可塑性)也进行了模拟。对该CBRAM器件的顶电极和底电极同时施加脉冲,在顶电极上施加的脉冲相当于突触前刺激,在底电极上施加的脉冲相当于突触后刺激,定义电子突触的相对变化量为:Δω=(Iafter-Ibefore)/Ibefore,其中Δω被定义为突触权重,Ibefore和Iafter分别是突触前刺激和突触后刺激施加之前和之后对应的电流,突触前刺激与突触后刺激的相对时间差被定义为Δt=tpost-tpre。其中,突触前刺激是由8个幅值逐渐增大的负脉冲和8个幅值逐渐减小的正脉冲组成的,其中,负脉冲的幅值为0V~-0.3V;正脉冲的幅值为0V~0.3V,突触后刺激则是一个正脉冲或负脉冲,其中,正脉冲的幅值为0.1V~0.5V,负脉冲的幅值为-0.1V~-0.5V。所有脉冲的脉宽为100ns~10μs,两个脉冲之间的延时为100ns~10μs。在实际测试中,施加在CBRAM器件上的脉冲信号的幅值为突触前刺激的幅值减去突触后刺激的幅值,因此只有当突触前刺激和突触后刺激重叠时,才可以产生具有足够幅值的编程脉冲来调节CBRAM器件的电导。
图14为施加在实施例1中制备得到的CBRAM器件上的电压示意图,突触前刺激中负脉冲的幅值从-0.18V逐渐增加到-0.25V,每次增加-0.01V;正脉冲的幅值从0.25V逐渐减少到0.18V,每次减少0.01V,突触后刺激中脉冲的幅值为0.25V或-0.24V,对实施例1中得到的CBRAM器件施加如图14所示的电压,可以得到该器件的STDP特性,结果如图15所示。从图15中可知,当Δt较小时,Δω变化量较大;Δt较大时,Δω变化量较小,这对应生物神经突触中当两个事件发生的时间间隔较短时,突触权重变化量大;当两个事件发生的时间间隔较长时,突触权重变化量小,该测试结果表明突触权重的变化趋势符合STDP学习规则。
此外,当对实施例1中制备得到的CBRAM器件施加如图16所示的脉冲波形时,也可以得到类似的STDP特性,结果如图17所示。
通过上述性能测试可知,本申请制备得到的基于钛银合金的低功耗CBRAM器件具有以下优点:
1、对本申请制备得到的基于钛银合金的低功耗CBRAM器件施加幅值约为0.5V,脉宽为100ns左右的脉冲电压就可以实现电导的连续调控,而常规CBRAM器件往往需要施加幅值超过1V,脉宽超过100μs的脉冲电压才可以实现,可以看出,本申请制备得到的基于钛银合金的低功耗CBRAM器件可以在更低的功耗下实现电导的连续调控,这为低功耗忆阻器阵列的搭建以及低功耗类脑神经形态芯片的研制提供了新的可能。
2、对本申请制备得到的基于钛银合金的低功耗CBRAM器件施加幅值约为0.5V,脉宽为1μs左右的脉冲电压就可以模拟生物神经元间的连接桥梁——突触的脉冲时间依赖可塑性(spike-timing-dependent plasticity,STDP)学习规则,而常规CBRAM器件往往需要施加幅值超过1V,脉宽超过100μs的脉冲电压才可以实现。可以看出,本申请制备得到的基于钛银合金的低功耗CBRAM器件相较于常规器件,可以在更低的功耗下进行STDP学习规则的模拟。
3、本申请制备得到的基于钛银合金的低功耗CBRAM器件的set电压约为-0.2V,reset电压约为0.1V,而常规CBRAM器件的转变电压往往在1V左右,可以看出,本申请制备得到的基于钛银合金的低功耗CBRAM器件的转变电压相较于与传统的CBRAM器件降低了约一个数量级,这也会导致功耗的大幅度降低。
4、本申请制备得到的基于钛银合金的低功耗CBRAM器件几乎不需要Forming过程,而常规的CBRAM器件的Forming电压往往大于1V。可以看出,当对得到的基于钛银合金的低功耗CBRAM器件的三维集成阵列进行测试时,相较于传统的CBRAM器件,操作将更加简单,能耗将进一步降低。
5、本申请制备得到的基于钛银合金的低功耗CBRAM器件,采用Ti、Ag合金代替传统的Ag制备的CBRAM器件,其高低阻态的电阻分布更加集中,进一步提高了器件性能的稳定性。
以上所述仅为本发明的较佳实施方式而已,并不用以限制本发明,凡在本发明的精神和原则之内,所作的任何修改、等同替换、改进等,均应包含在本发明的保护范围之内。

Claims (6)

1.一种基于钛银合金的低功耗CBRAM器件的制备方法,其特征在于,所述基于钛银合金的低功耗CBRAM器件,包括:
底电极;
插入层,位于所述底电极一侧表面;
阻变层,位于所述插入层远离所述底电极一侧表面;
顶电极,位于所述阻变层远离所述底电极一侧表面;
其中,所述插入层的材料为Ti、Ag合金材料;
所述底电极的材料为Ti、Pt、W或TiN中的一种;
所述阻变层的材料为含氧碲化锗材料,所述顶电极的材料为Pt或Ti中的一种;
所述插入层的厚度为20~50nm;
所述基于钛银合金的低功耗CBRAM器件的制备方法,包括以下步骤:
提供底电极;
在所述底电极表面制备插入层;
在所述插入层远离所述底电极一侧的表面制备阻变层;
在所述阻变层远离所述底电极一侧的表面制备顶电极;
在所述底电极表面制备插入层具体包括:
以金属钛、金属银为靶材,利用磁控溅射法在所述底电极表面沉积得到钛、银合金即为插入层;
所述阻变层的制备方法具体为:控制磁控溅射设备真空室内的压强为3~5×10-1Pa,以碲化锗为靶材控制溅射功率为30~60W,利用磁控溅射法即可在插入层远离所述底电极一侧的表面制备得到阻变层。
2.如权利要求1所述的基于钛银合金的低功耗CBRAM器件的制备方法,其特征在于,所述底电极的厚度为150~200nm,所述阻变层的厚度为50~100nm,所述顶电极的厚度为80~120nm。
3.如权利要求1所述的基于钛银合金的低功耗CBRAM器件的制备方法,其特征在于,所述顶电极的形状为矩形或圆形,所述矩形的边长为100~900μm,所述圆形的直径为100~900μm。
4.如权利要求1所述的基于钛银合金的低功耗CBRAM器件的制备方法,其特征在于,利用磁控溅射法在所述底电极表面沉积得到钛、银合金控制的工艺条件为:控制磁控溅射设备真空室内的压强为3~5×10-1Pa,金属钛靶材以及金属银靶材的溅射功率均为10~40W,金属钛靶材和金属银靶材同时溅射。
5.如权利要求1所述的基于钛银合金的低功耗CBRAM器件的制备方法,其特征在于,所述顶电极的材料为钛,所述顶电极的制备方法为:控制磁控溅射设备真空室内的压强为3~5×10-1Pa,以金属钛为靶材控制溅射功率为30~60W,利用磁控溅射法即可在所述阻变层远离所述底电极一侧的表面制备得到顶电极。
6.一种如权利要求1~5任一所述的制备方法制备得到的基于钛银合金的低功耗CBRAM器件在神经突触仿生器件中的应用。
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