CN112311223B - 一种具有峰值延迟启动通知的dc-dc转换器 - Google Patents

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Abstract

本发明公开一种具有峰值延迟启动通知的DC‑DC转换器，包括逻辑电路、PWM电路、FET电路、切换器、峰值比较器、计数器和锁存器，电源VIN接入切换器，PWM电路输出信号分别连接计数器和切换器的输入端，切换器的可切换输出的两个输出端各自通过一峰值保持电路分别接入峰值比较器的两个输入口，计数器的输出端连接峰值比较器的电源端，计数器在达到计数周期时驱动峰值比较器输出比较结果至锁存器的使能端，逻辑电路的输出端连接锁存器的数据端，锁存器综合逻辑电路的输出信号和峰值比较器的输出结果控制锁存器的输出电位高低，锁存器的输出端连接三极管的基极，三极管的发射极接地，三极管的集电极作连接PGOOD引脚。本发明使DC/DC转换器依序启动并避免峰值电流的堆栈。

Description

一种具有峰值延迟启动通知的DC-DC转换器
技术领域
本发明涉及电路电子技术领域，尤其涉及一种具有峰值延迟启动通知的DC-DC转换器。
背景技术
如图1所示，现有技术中一个完整的显示屏系统通常由多个单元显示箱体组成。每个独立的显示箱体内部均有一个电源供应器，因应设计的不同电源供应器输出电压介于4V~5.2V之间。现有技术中4.2V~5V/200W~300W为普遍应用的电源供应器，由于属于低压大电流输出特性，因此可知其二次侧产生的热量较高、供货商较少、价格较贵、稳定性较差、效率较低等缺点。且在实际的应用中，由于LED显示屏多半为长时间开启24/7，电源供应器的输出经过长时间且高温的应用下，往往会出现衰退现象，尤其为了降低整机热损耗而刻意使用低电压输出的显示屏箱体，当电源供应器输出电压缓慢下降时，将导致电压无法顺利驱动LED灯或ICs而使显示屏异常。为此，业界有厂商推出建构多个DC/DC转换器在LED模块上的供电方式，DC/DC广域输入的特性可以避免电源供应器输出电压缓慢下降问题，但多组DC/DC Buck 转换器同时间启动时，电流启动突波恐导致电源供应器输出过电流保护而关闭。
如图2所示为市售常见DC/DC转换器内部功能方块图，其中EN脚位同时兼具启动命令和低电压关闭功能，FB脚位是输出回授，BST是提升准位驱动脚位，一般装设一个电容对SW端，SW是IC内部FET输出端，用以产生可承载功率的FET On/Off，PGOOD是DC/DC转换器自动产生的power good信号，在必要时通知系统转换器的输出电压已经准备完毕。
如图3所示，各节点动作波型图中，当VIN由电源供应器提供电话后，很快可以使OPA-1(T1)、OPA-2(T2)达到UVLO和EN判断，并驱使LOGIC和PWM动作(T3)，当PWM驱动内建的MOSFET后，DC/DC转换器外部的电感电流和电容电压开始建立(T3~T4)，并且在输出电压建立到一定点时(Vout*0.9)，PGOOD发送出一个power good信号通知系统。
假设一个LED显示屏中具有数量相当的DC/DC转换器时，假使全部的DC/DC转换器同一时间启动，从图三IL波型中可看出锯齿状电感电流平均化后会出现一个峰值电流T5，因此多个DC/DC转换器电流波型堆栈后将会导致前端电源供应器必须提供更高的电流突波能力。如果选用的电源供应器输出能力不足或因为长时间使用后导致的输出能力衰退，则将使电源供应器因OCP保护而关闭。
为了因应这个现象的出现，可以使用PGOOD信号做为通知下一级DC/DC转换器动作的依据信号，意即将PGOOD当作下一级DC/DC转换器的EN信号输入，但就如图2所示PGOOD信号图，该信号其实没有真正规避IL峰值电流，因此电源供应器仍必须乘载部分电流突波。
发明内容
本发明的目的在于提供一种具有峰值延迟启动通知的DC-DC转换器。
本发明采用的技术方案是：
一种具有峰值延迟启动通知的DC-DC转换器，包括逻辑电路、PWM电路和FET电路，逻辑电路接入使能引脚EN，逻辑电路的输出连接PWM电路，PWM电路接入输出回授引脚FB,PWM电路连接FET电路，FET电路连接电源VIN，FET电路包括提升准位驱动脚位BST和FET输出端SW，其特征在于：其还包括切换器、峰值比较器、计数器和锁存器，电源VIN的侦测信号IL-IN信号接入切换器，PWM电路输出信号分别连接计数器和切换器的输入端，切换器的可切换输出的两个输出端分别连接峰值保持电路A和峰值保持电路B，峰值保持电路A和峰值保持电路B对应接入峰值比较器的两个输入口，计数器的输出端连接峰值比较器的电源端，计数器在达到计数周期时驱动峰值比较器输出比较结果，峰值比较器的输出端连接锁存器的使能端，锁存器的数据端连接逻辑电路的输出端，锁存器综合逻辑电路的输出信号和峰值比较器的输出结果控制锁存器的输出电位高低，锁存器的输出端连接三极管的基极，三极管的发射极接地，三极管的集电极作连接PGOOD引脚。
进一步地，作为一种可行实施方式，使能引脚EN分别连接第一比较器和第二比较器的反向输入端，第一比较器的正向输入端接1.5V，第二比较器的正向输入端接0.5V，第一比较器和第二比较器的输出端接入逻辑电路。
进一步地，作为一种可行实施方式，输出回授引脚FB连接第三比较器的反向输入端，第三比较器的正向输入端连接参考电压VREF，第三比较器的输出端连接PWM电路。
进一步地，作为一种可行实施方式，FET输出端SW连接一电感的一端，电感的另一端通过电容CAP接地。
进一步地，作为一种可行实施方式，PGOOD引脚连接下一级DC/DC转换器并提供使能信号。
进一步地，作为一种可行实施方式，计数器的计数周期为两个PWM信号周期。
本发明采用以上技术方案，可使DC/DC转换器依序启动并避免峰值电流的堆栈，使前端的电源供应器不需承受过高的峰值电流和避免因过高峰值电流而关闭问题。本发明应用于需要多个DC/DC转换器提供电源的场合，尤其在LED显示屏应用中，大量使用DC/DC转换器导致启动瞬间PSU需要承担更高电流峰值的情形。
附图说明
以下结合附图和具体实施方式对本发明做进一步详细说明；
图1为现有市售LED显示屏幕系统配置图；
图2为现有技术的DC-DC转换器的电路原理示意图；
图3为现有技术的DC-DC转换器的各个节点动作波型图；
图4为本发明一种具有峰值延迟启动通知的DC-DC转换器的电路原理示意图；
图5为本发明的DC-DC转换器的各个节点动作波型图。
具体实施方式
为使本申请实施例的目的、技术方案和优点更加清楚，下面将结合本申请实施例中的附图对本申请实施例中的技术方案进行清楚、完整地描述。
如图4所示，本发明公开了一种具有峰值延迟启动通知的DC/DC转换器，包括逻辑电路、PWM电路和FET电路，逻辑电路接入使能引脚EN，逻辑电路的输出连接PWM电路，PWM电路接入输出回授引脚FB,PWM电路连接FET电路，FET电路连接电源VIN，FET电路包括提升准位驱动脚位BST和FET输出端SW，还包括切换器、峰值比较器、计数器和锁存器，电源VIN的侦测信号IL-IN信号接入切换器，PWM电路输出信号分别连接计数器和切换器的输入端，切换器的可切换输出的两个输出端分别连接峰值保持电路A和峰值保持电路B，峰值保持电路A和峰值保持电路B对应接入峰值比较器的两个输入口，计数器的输出端连接峰值比较器的电源端，计数器在达到计数周期时驱动峰值比较器输出比较结果，峰值比较器的输出端连接锁存器的使能端，锁存器的数据端连接逻辑电路的输出端，锁存器综合逻辑电路的输出信号和峰值比较器的输出结果控制锁存器的输出电位高低，锁存器的输出端连接三极管的基极，三极管的发射极接地，三极管的集电极作连接PGOOD引脚。
本发明利用电流侦测读取IL-In信号并送入一个切换器，切换器透过PWM输出的信号切换信号进入峰值保持电路Hold A、B，且PWM信号同时送入一个COUNT计数器，计数器以两周期循环一次，亦即每收到两个PWM信号后送出一个CLOCK且提供峰值比较器OPA-4动作使用。峰值保持电路Hold A、B根据前方切换器在两周期内取得两个峰值准位，CONUT计数后峰值比较器OPA-4比较峰值保持电路Hold-A、峰值保持电路Hold-B电压值，如果峰值保持电路Hold-A高于峰值保持电路Hold-B则输出高准位给锁存器电路Latch并使PGOOD输出高准位，锁存器电路Latch触发后如要关闭，则需要EN信号进入低准位后，Latch才会复归。由此可知，在多个DC/DC转换器应用场合中，PGOOD可以做为下一级EN信号输入，并在第一个DC/DC转换器动作完成后通知下一级DC/DC转换器动作，依序启动并避免启动过程中产生峰值电流。
如图5所示的动作波型图，T3前的动作与传统DC/DC转换器无差异，因此不在赘述。当PWM开始动作后，峰值保持电路Hold A、B在两个周期内各获得信号A、B。此时峰值比较器OPA-4因COUNT允许动作而进行比较，由于A准位低于B准位，因此峰值比较器OPA-4输出低准位信号至锁存器电路Latch，PGOOD输出低准位。数个周期PWM动作后，假设该周期内获得峰值电压C、D，则当峰值比较器OPA-4比较C准位高于D准位后，峰值比较器OPA-4输出高准位至锁存器电路Latch，PGOOD相应的输出高准位并且由锁存器电路Latch锁定输出状态，亦即接下来的周期如果出现峰值保持电路Hold-B大于峰值保持电路Hold-A时，尽管峰值比较器OPA-4输出低准位，锁存器电路Latch也不会改变PGOOD输出状态。除非EN信号达到关闭的侦测点且LATCH电路输出低准位时，锁存器电路Latch才会复归回低准位(T5)。在一系列的动作中可由波型图看出，PGOOD信号的产生会被延迟到IL峰值之后，因此PGOOD可做为一种峰值延迟通知的信号。
本发明采用以上技术方案，可使DC/DC转换器依序启动并避免峰值电流的堆栈，使前端的电源供应器不需承受过高的峰值电流和避免因过高峰值电流而关闭问题。本发明应用于需要多个DC/DC转换器提供电源的场合，尤其在LED显示屏应用中，大量使用DC/DC转换器导致启动瞬间PSU需要承担更高电流峰值的情形。
显然，所描述的实施例是本申请一部分实施例，而不是全部的实施例。在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互组合。通常在此处附图中描述和示出的本申请实施例的组件可以以各种不同的配置来布置和设计。因此，本申请的实施例的详细描述并非旨在限制要求保护的本申请的范围，而是仅仅表示本申请的选定实施例。基于本申请中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。

Claims (6)

1.一种具有峰值延迟启动通知的DC-DC转换器，包括逻辑电路、PWM电路和FET电路，逻辑电路接入使能引脚EN，逻辑电路的输出连接PWM电路，PWM电路接入输出回授引脚FB,PWM电路连接FET电路，FET电路连接电源VIN，FET电路包括提升准位驱动脚位BST和FET输出端SW，其特征在于：其还包括切换器、峰值比较器、计数器和锁存器，电源VIN的侦测信号IL-IN信号接入切换器，PWM电路输出信号分别连接计数器和切换器的输入端，切换器的可切换输出的两个输出端分别连接峰值保持电路A和峰值保持电路B，峰值保持电路A和峰值保持电路B对应接入峰值比较器的两个输入口，计数器的输出端连接峰值比较器的电源端，计数器在达到计数周期时驱动峰值比较器输出比较结果，峰值比较器的输出端连接锁存器的使能端，逻辑电路的输出端连接锁存器的数据端，锁存器综合逻辑电路的输出信号和峰值比较器的输出结果控制锁存器的输出电位高低，锁存器的输出端连接三极管的基极，三极管的发射极接地，三极管的集电极作连接PGOOD引脚。
2.根据权利要求1所述的一种具有峰值延迟启动通知的DC-DC转换器，其特征在于：使能引脚EN分别连接第一比较器和第二比较器的反向输入端，第一比较器的正向输入端接1.5V，第二比较器的正向输入端接0.5V，第一比较器和第二比较器的输出端接入逻辑电路。
3.根据权利要求1所述的一种具有峰值延迟启动通知的DC-DC转换器，其特征在于：输出回授引脚FB连接第三比较器的反向输入端，第三比较器的正向输入端连接参考电压VREF，第三比较器的输出端连接PWM电路。
4.根据权利要求1所述的一种具有峰值延迟启动通知的DC-DC转换器，其特征在于：FET输出端SW连接一电感的一端，电感的另一端通过电容CAP接地。
5.根据权利要求1所述的一种具有峰值延迟启动通知的DC-DC转换器，其特征在于：PGOOD引脚连接下一级DC/DC转换器并提供使能信号。
6.根据权利要求1所述的一种具有峰值延迟启动通知的DC-DC转换器，其特征在于：计数器的计数周期为两个PWM信号周期。
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