CN112086026B - 一种显示面板和显示装置 - Google Patents
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Abstract
本申请公开了一种显示面板及显示装置。显示面板包括一阵列基板，阵列基板上划分有一显示区和一非显示区；显示面板还包括：多条第一阵列上走线，设置于非显示区的第一端部，多条第一阵列上走线自非显示区引出，并相对排布于一第一覆晶薄膜的两侧。本申请通过改变阵列走线进入覆晶薄膜的方式，使得内延减半以及扇出区高度降低、源极侧边框减小、改善整机外观协调性、提升产品美观性。
Description
技术领域
本申请涉及显示技术领域，具体涉及一种显示面板和显示装置。
背景技术
因应市场的需求，大尺寸(Size)、高解析度的电视(TV)及超窄边框(Ultra NarrowBorder，简称UNB)成为市场的趋势。近年来广受市场关注的拼接屏，更是对TV产品极致窄的边宽技术提出了需求。拼接缝极致缩减，有效显示区(Active Area，简称AA)之间需求小于1mm已经成为未来的趋势。而栅极驱动电路(Gate Driver on Array，简称GOA)位于源极驱动侧(GOA in Source)的三窄一宽(指边框在源极驱动侧较宽而其他侧边较窄)的产品，近几年引起了业界的广泛关注。因为该产品可用于三边拼接，且相较覆晶薄膜(Chip On Flex或Chip On Film，简称COF)在栅极驱动侧的产品，有着不可忽视的价格优势。
请一并参阅图1和图2。其中，图1为现有的显示面板的结构示意图；图2为图1中A部分的放大示意图。如图1所示，显示面板包括阵列基板，阵列基板上划分有一显示区11和一非显示区12。非显示区12上设置有多颗覆晶薄膜14。其中，多条阵列上走线(Wire OnArray，简称WOA)13从位于非显示区12端部的覆晶薄膜14的一侧连接。
如图2所示，所述显示面板还包括：GOA电路23、多条数据线扇出引线(DataFanout)22以及多条绑定引线(Bounding Lead)21。所述GOA电路23设置于所述非显示区12靠近所述显示区11的一侧，且位于源极驱动侧；其中，阵列上走线13接入GOA电路21。所述数据线扇出引线22设置于所述非显示区12上，且位于所述GOA电路23远离所述显示区11的一侧；其中，所述阵列上走线13接入数据线扇出引线。所述绑定引线21电连接所述数据线扇出引线22以及所述GOA电路21。其中，所述数据线扇出引线22形成内延(Inside Extention)区域，将内延区域的高度记为H1。
现有的GOA位于源极驱动侧技术中，源极驱动侧的边框(Border)远大于非GOA位于源极驱动侧的产品。即，三窄一宽中“宽”侧的边框太宽。这个问题导致整机外观不协调，严重影响了产品的美观性。因而如何压缩的GOA位于源极驱动侧产品的源极侧边框，成为了设计者不可规避的问题。
发明内容
本申请目的在于提供一种显示面板和显示装置。通过改变阵列走线进入覆晶薄膜的方式，使得扇出区高度降低，从而减小源极侧边框、改善整机外观协调性、提升产品美观性。
为实现上述目的，本申请的技术方案是：
本申请的第一方面，提供一种显示面板，包括一阵列基板，所述阵列基板上划分有一显示区和一非显示区，所述显示面板还包括：多条第一阵列上走线，设置于所述非显示区的第一端部，多条所述第一阵列上走线自所述非显示区引出，并相对排布于一第一覆晶薄膜的两侧。
本申请的第二方面，提供一种显示装置，包括上述的显示面板。
本申请具有如下有益效果：
将常规设计中仅从面板两端覆晶薄膜单侧进入的阵列上走线，变更为从此两端覆晶薄膜的两侧进入。将原有WOA走线中的GOA信号以及公共电压信号尽可能地分为走线数量基本相等的两部分，降低了扇出高度，缩小了源极侧边框。从而使得内延减半，改善了整机外观的协调性，大大提升了产品的美观性。
附图说明
下面结合附图，通过对本申请的具体实施方式详细描述，将使本申请的技术方案及其它有益效果显而易见。
图1为现有的显示面板的结构示意图。
图2为图1中A部分的放大示意图。
图3为本申请显示面板的一实施例的结构示意图。
图4为图3中A部分的放大示意图。
图5为图3中B部分的放大示意图。
图6为本申请显示装置的一实施例的结构示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。在本申请的描述中，需要理解的是，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个所述特征。在本申请的描述中，“多个”的含义是两个或两个以上，除非另有明确具体的限定。
下文的公开提供了许多不同的实施方式或例子用来实现本申请的不同结构。为了简化本申请的公开，下文中对特定例子的部件和设置进行描述。当然，它们仅仅为示例，并且目的不在于限制本申请。
此外，本申请可以在不同例子中重复参考数字和/或参考字母，这种重复是为了简化和清楚的目的，其本身不指示所讨论各种实施方式和/或设置之间的关系。至始至终，相同的符号或字母，代表相同的数值或者组成部分。
经实践和研究发现，GOA位于源极驱动侧的技术中：绑定引线一般已设定为目前制程可行的极限；GOA电路则因为AA区负载(Loading)对比于常规产品较大，而需要更大GOA布线空间以实现正常的扫描功能。因此，本申请通过优化阵列上走线的走线布局，减小了数据线扇出引线的高度。
请参照图3，本申请显示面板的一实施例的结构示意图。如图3所示，本申请提供一种显示面板3，包括一阵列基板，所述阵列基板上划分有一显示区31和一非显示区32。所述显示面板3还包括：多条第一阵列上走线36，设置于所述非显示区32的第一端部321，多条所述第一阵列上走线36自所述非显示区32引出，并相对排布于一第一覆晶薄膜33的两侧。
优选地，排布于所述第一覆晶薄膜33的第一侧的所述第一阵列上走线36的走线数量，与排布于所述第一覆晶薄膜33的第二侧的所述第一阵列上走线36的走线数量基本相等。具体地，当所述第一阵列上走线36的总走线数量为偶数个时，排布于所述第一覆晶薄膜33的第一侧的所述第一阵列上走线36的走线数量，与排布于所述第一覆晶薄膜33的第二侧的所述第一阵列上走线36的走线数量相等；当所述第一阵列上走线36的总走线数量为奇数个时，排布于所述第一覆晶薄膜33的第一侧的所述第一阵列上走线36的走线数量，与排布于所述第一覆晶薄膜33的第二侧的所述第一阵列上走线36的走线数量相差1。
多条所述第一阵列上走线36包括多条时钟信号走线和多条电压信号走线。所述时钟信号走线和所述电压信号走线可分为走线数量基本相等的两部分，并分别排布于所述第一覆晶薄膜33的两侧。
优选地，所述时钟信号走线的走线数量和所述电压信号走线的走线数量基本相等。
同时，多条所述第一阵列上走线36在所述第一覆晶薄膜33的两侧均匀排布。具体地，相邻的每条第一阵列上走线36之间，间距大致相等。其中，如果某一侧同时具有所述时钟信号走线和所述电压信号走线，应适当地增加走线间距离，以避免耦合现象。
所述显示面板3还包括：多条第二阵列上走线37，设置于所述非显示区32的第二端部322，多条所述第二阵列上走线37自所述非显示区32引出，并相对排布于一第二覆晶薄膜34的两侧。其中，所述第一端部321与所述第二端部322为所述非显示区32的两个相对端部，多条所述第一阵列上走线36与多条所述第二阵列上走线37对称分布。如图3中所示，所述第一覆晶薄膜33位于所述非显示区32的右端，所述第二覆晶薄膜34位于所述非显示区32的左端。
需要说明的是，所述第一覆晶薄膜33和所述第二覆晶薄膜34之间设置有若干第三覆晶薄膜35。其中，所述第三覆晶薄膜35均设置在所述第一覆晶薄膜33和第二覆晶薄膜34所在的同一侧。相邻的两颗覆晶薄膜之间(第一覆晶薄膜33与第三覆晶薄膜35之间、相邻的两颗第三覆晶薄膜35之间、以及第二覆晶薄膜34与第三覆晶薄膜35之间)通过走线连接。
请参照图4，其为图3中A部分的放大示意图。如图4所示，所述显示面板3还包括：多条绑定引线391，多条数据线扇出引线392，以及GOA电路393。多条所述绑定引线391，电连接所述数据线扇出引线392以及所述GOA电路393。所述GOA电路393设置于所述非显示区32靠近所述显示区的31一侧；其中，所述第一阵列上走线36与所述第二阵列上走线37分别接入GOA电路393。多条所述数据线扇出引线392，设置于所述非显示区32上，且位于所述GOA电路393远离所述显示区31的一侧。其中，所述第一阵列上走线36与所述第二阵列上走线37接入对应的数据线扇出引线392。图4给出了第一阵列上走线36的接入示意图，对称地，第二阵列上走线37有类似的接入方式。
请一并参照图2和图4。如图4所示，本申请通过减小数据线扇出引线形成的内延区域的高度优化WOA走线。本申请的阵列上走线，由于从位于非显示区32端部的覆晶薄膜的两侧进入，降低了数据线扇出走线392形成的内延区域的高度。例如，对显示区32的第一端部321，第一阵列上走线36按图4所示从第一覆晶薄膜33的两侧进入，将所述内延区域的高度，从常规手段中一侧进入的第一高度H1，降低为现在的第二高度H2(H2＜H1)。位于显示区32的第二端部322的第二覆晶薄膜34，和第一覆晶薄膜33对称设置。第二阵列上走线37从第二覆晶薄膜34的两侧进入，因此同样可以减少对应的内延区域的高度。本申请减小了所述内延区域的高度，进而可以更好地实现窄边框。
请参考图5，其为图3中B部分的放大示意图。在所述非显示区32的一端部，自靠近所述显示区31的一侧起，依次设有GOA电路393、总线38以及所述第二阵列上走线37。多条所述第一阵列上走线36和所述第二阵列上走线37的分别接入相应的总线38。如图5所示，在所述非显示区32的第二端部322，多条所述第二阵列上走线37的分别接入相应的总线38。同时，部分所述第二阵列上走线37接入所述GOA电路393。其中，接入总线38的所述第二阵列上走线37主要为时钟信号走线，一般设置于所述第二覆晶薄膜34的第二侧。所述第二阵列上走线37和所述第一阵列上走线36在非显示区32两端对称设置。即，多条所述第一阵列上走线36分别接入相应的总线38；同时，部分第一阵列上走线36接入所述GOA电路393。
具体地，以8时钟信号(8CK)的电路为例。对于第一覆晶薄膜33，在第一覆晶薄膜33第一侧，可进行多条电压信号走线。例如：阵列基板公共电压信号走线(Acom)、彩膜基板公共电压信号走线(CFcom)、反馈电压信号走线(FB)、第一振荡电压信号走线(LC1)、第二振荡电压信号走线(LC2)、开启电压信号走线(ST)、源极直流电压信号走线(VSS)共7个电压信号走线。而在第一覆晶薄膜33第二侧，进行多条时钟信号走线。例如，可进行CK1～CK8共8个时钟信号走线，并且在走线末端接入横向的总线38。对于第二覆晶薄膜34，与第一覆晶薄膜33对称设置，具有类似的布线设置。
本申请将常规设计中仅从面板两端覆晶薄膜单侧进入的WOA走线变更为从此两颗覆晶薄膜的两侧进入。将原有WOA走线中的GOA信号以及公共电压信号尽可能地分为走线数量基本相等的两部分，从而达到降低扇出高度，缩小源极侧边框的目的。该设计通常可以使得内延区域减半、扇出高度降低、源极侧边框减小，改善了整机外观的协调性，大大提升了产品的美观性。
基于同一发明构思，本申请实施例还提供了一种显示装置。
请参阅图6，本申请显示装置的一实施例的结构示意图。如图6所示，本申请显示装置60包括一显示面板61，其中，所述显示面板采用如图3至图5所示的显示面板。
未在本实施例中详尽描述的技术细节可参见上述实施例，并且本实施例具备执行所述显示面板相同的有益效果。
以上对本申请实施例所提供的一种显示面板和显示装置进行了详细介绍，本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的技术方案及其核心思想；本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本申请各实施例的技术方案的范围。
Claims (7)
1.一种显示面板，包括一阵列基板，所述阵列基板上划分有一显示区和一非显示区，其特征在于，所述显示面板还包括：
多条第一阵列上走线，设置于所述非显示区的第一端部，多条所述第一阵列上走线自所述非显示区引出，并相对排布于一第一覆晶薄膜的两侧；
多条第二阵列上走线，设置于所述非显示区的第二端部，多条所述第二阵列上走线自所述非显示区引出，并相对排布于一第二覆晶薄膜的两侧；其中，所述第一端部与所述第二端部为所述非显示区的两相对端部，多条所述第一阵列上走线与多条所述第二阵列上走线对称分布；
GOA电路，设置于所述非显示区靠近所述显示区的一侧；其中，所述第一阵列上走线与所述第二阵列上走线分别接入GOA电路；
多条数据线扇出引线，设置于所述非显示区上，且位于所述GOA电路远离所述显示区的一侧；其中，所述第一阵列上走线与所述第二阵列上走线分别接入对应的数据线扇出引线；
多条绑定引线，电连接所述数据线扇出引线以及所述GOA电路。
2.如权利要求1所述的显示面板，其特征在于，排布于所述第一覆晶薄膜的第一侧的所述第一阵列上走线的走线数量，与排布于所述第一覆晶薄膜的第二侧的所述第一阵列上走线的走线数量基本相等。
3.如权利要求1所述的显示面板，其特征在于，多条所述第一阵列上走线在所述第一覆晶薄膜的两侧均匀排布。
4.如权利要求1所述的显示面板，其特征在于，多条所述第一阵列上走线的靠近所述显示区的一端分别接入相应的总线。
5.如权利要求1所述的显示面板，其特征在于，多条所述第一阵列上走线包括多条时钟信号走线和多条电压信号走线；所述时钟信号走线和所述电压信号走线分为走线数量基本相等的两部分，并分别排布于所述第一覆晶薄膜的两侧。
6.如权利要求5所述的显示面板，其特征在于，所述时钟信号走线的走线数量和所述电压信号走线的走线数量基本相等。
7.一种显示装置，其特征在于，包括如权利要求1-6任一项所述的显示面板。
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