CN110992885B - 像素驱动电路及其驱动方法和显示面板 - Google Patents

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Abstract

本发明公开了一种像素驱动电路及其驱动方法和显示面板，涉及显示技术领域，像素驱动电路包括至少两个并联的发光时长控制模块，各所述发光时长控制模块包括：驱动电流输入端，用于提供输入电流；发光控制信号输入端，不同的所述发光时长控制模块对应的发光控制信号输入端用于提供不同脉冲宽度的发光控制信号；控制子模块，所述控制子模块配置有一个控制输出端，所述控制输出端用于控制该控制子模块所在的发光时长控制模块的导通；驱动电流输出端，用于输出脉冲宽度等于发光控制信号脉冲宽度的驱动电流。如此实现了对显示面板中单个像素发光时长的独立控制及调节。

Description

像素驱动电路及其驱动方法和显示面板
技术领域
本发明涉及显示技术领域，更具体地，涉及一种像素驱动电路及其驱动方法和显示面板。
背景技术
有机发光显示装置具有自发光、驱动电压低、发光效率高、响应速度快、轻薄、对比度高等优点，被认为是下一代最具有发展潜力显示装置。
有机发光显示装置中的像素包括像素驱动电路，像素驱动电路中的驱动晶体管可产生驱动电流，像素响应该驱动电流而发光。现有技术中，像素驱动电路通过开关模块和发光控制线来控制像素发光。通常，一行像素对应一条发光控制线，发光控制信号控制开关模块的导通时长，以控制像素响应驱动电流的时长。因此，一行像素中各个像素的发光时间必须一致，不能单独调节一行像素中单个像素的发光时长。
发明内容
有鉴于此，本发明提供了一种像素驱动电路及其驱动方法和显示面板，引入了至少两个并联连接的发光时长控制模块，实现了对显示面板中单个像素发光时长的独立控制及调节。
第一方面，本申请提供一种像素驱动电路，包括至少两个并联的发光时长控制模块，各所述发光时长控制模块包括：
驱动电流输入端，用于提供输入电流；
发光控制信号输入端，不同的所述发光时长控制模块对应的发光控制信号输入端用于提供不同脉冲宽度的发光控制信号；
控制子模块，所述控制子模块配置有一个控制输出端，所述控制输出端用于控制该控制子模块所在的发光时长控制模块的导通；
驱动电流输出端，用于输出脉冲宽度等于发光控制信号脉冲宽度的驱动电流。
第二方面，本申请还提供一种像素电路的驱动方法，所述方法包括：
不同的所述发光时长控制模块对应的发光控制信号输入端提供脉冲宽度不同的发光控制信号；
同一时刻内，有且仅有一个发光时长控制模块导通，所述驱动电流的脉冲宽度等于该导通的发光时长控制模块中发光控制信号的脉冲宽度。
第三方面，本申请还提供一种显示面板，包括本申请所提供的像素驱动电路。
与现有技术相比，本发明提供的像素驱动电路及其驱动方法和显示面板，至少实现了如下的有益效果：
本申请所提供的像素驱动电路及其驱动方法和显示面板中，引入了至少两个并联的发光时长控制模块，各发光时长控制模块中分别配置有不同的发光控制信号输入端，用于提供不同脉冲宽度的发光控制信号。在控制子模块的控制下，可选择像素驱动电路中的一个发光时长控制模块导通，从而使得像素驱动电路输出脉冲宽度等于发光控制信号脉冲宽度的驱动电流。由于像素的发光时长与驱动电流的脉冲宽度相同，而由于驱动电流的脉冲宽度与发光控制信号的脉冲宽度相同，当发光控制信号脉冲宽度不同时，对应像素的发光时长也不同。本申请在同一像素驱动电路中引入脉冲宽度不同的发光时长控制模块，在同一时刻内，有且仅有一个发光时长控制模块导通，可根据发光时长的不同需求来选通对应的发光时长控制模块，从而实现了对显示面板上单个像素发光时长的灵活调节与控制，有利于提升显示面板的驱动灵活性。
当然，实施本发明的任一产品必不特定需要同时达到以上所述的所有技术效果。
通过以下参照附图对本发明的示例性实施例的详细描述，本发明的其它特征及其优点将会变得清楚。
附图说明
被结合在说明书中并构成说明书的一部分的附图示出了本发明的实施例，并且连同其说明一起用于解释本发明的原理。
图1所示为本申请所提供的一种像素驱动电路的一种模块结构图；
图2所示为本申请实施例所提供的一种像素驱动电路的另一种模块结构图；
图3所示为本申请实施例所提供的像素驱动电路的另一种模块结构图；
图4所示为同一像素驱动电路中与三个发光时长控制模块分别对应的发光控制信号的脉冲示意图；
图5所示为本申请实施例所提供的像素驱动电路的另一种模块结构图；
图6所示为本申请实施例所提供的像素驱动电路的一种驱动时序图；
图7所示为本申请实施例所提供的像素驱动电路的另一种模块结构图；
图8所示为本申请实施例所提供的像素驱动电路的另一种模块结构图；
图9所示为本申请所提供的像素驱动电路的驱动方法的一种流程图；
图10所示为本申请实施例所提供的显示面板的一种结构示意图。
具体实施方式
现在将参照附图来详细描述本发明的各种示例性实施例。应注意到：除非另外具体说明，否则在这些实施例中阐述的部件和步骤的相对布置、数字表达式和数值不限制本发明的范围。
以下对至少一个示例性实施例的描述实际上仅仅是说明性的，决不作为对本发明及其应用或使用的任何限制。
对于相关领域普通技术人员已知的技术、方法和设备可能不作详细讨论，但在适当情况下，所述技术、方法和设备应当被视为说明书的一部分。
在这里示出和讨论的所有例子中，任何具体值应被解释为仅仅是示例性的，而不是作为限制。因此，示例性实施例的其它例子可以具有不同的值。
应注意到：相似的标号和字母在下面的附图中表示类似项，因此，一旦某一项在一个附图中被定义，则在随后的附图中不需要对其进行进一步讨论。
图1所示为本申请所提供的一种像素驱动电路的一种模块结构图，图2所示为本申请实施例所提供的一种像素驱动电路的另一种模块结构图，请参见图1和图2，本申请提供一种像素驱动电路，包括至少两个并联的发光时长控制模块10，各所述发光时长控制模块10包括：
驱动电流输入端IN，用于提供输入电流；
发光控制信号输入端EM1/EM2/EM3，不同的所述发光时长控制模块10对应的发光控制信号输入端EM1/EM2/EM3用于提供不同脉冲宽度的发光控制信号；
控制子模块20，所述控制子模块20配置有一个控制输出端K1/K2/K3，所述控制输出端K1/K2/K3用于控制该控制子模块20所在的发光时长控制模块10的导通；
驱动电流输出端OUT，用于输出脉冲宽度等于发光控制信号脉冲宽度的驱动电流。可选地，驱动电流输出端OUT用于与像素电连接，向像素提供用以发光的驱动电流。当显示面板为有机发光电致显示面板时，对应的像素例如可以为有机发光二极管；当显示面板为Micro LED显示面板时，对应的像素例如可以为Micro LED，本申请对此不进行具体限定。
需要说明的是，图1示出了一个像素驱动电路包括两个并联的发光时长控制模块10的情形，图2示出了一个像素驱动电路包括三个并联的发光时长控制模块10的情形，在本申请的一些其他实时例中，一个像素驱动电路所包含的发光时长控制模块10的数量还可根据需要设置为三个以上，本申请对此不进行具体限定，以下将以一个像素驱动电路包括三个并联的发光时长控制模块10的情形为例进行说明。
具体地，继续参见图2，本申请实施例所提供的像素驱动电路中，引入了三个并联的发光时长控制模块10，各发光时长控制模块10中分别配置有不同的发光控制信号输入端EM1/EM2/EM3，用于提供不同脉冲宽度的发光控制信号。在控制子模块20的控制下，可选择像素驱动电路中的一个发光时长控制模块10导通，从而使得像素驱动电路输出脉冲宽度等于发光控制信号脉冲宽度的驱动电流。由于像素的发光时长与驱动电流的脉冲宽度相同，而由于驱动电流的脉冲宽度与发光控制信号的脉冲宽度相同，当发光控制信号脉冲宽度不同时，对应像素的发光时长也不同。本申请在同一像素驱动电路中引入脉冲宽度不同的发光时长控制模块10，在同一时刻内，有且仅有一个发光时长控制模块10导通，可根据发光时长的不同需求来选通对应的发光时长控制模块10，从而实现了对显示面板上单个像素发光时长的灵活调节与控制，有利于提升显示面板的驱动灵活性。
在本发明的一种可选实施例中，图3所示为本申请实施例所提供的像素驱动电路的另一种模块结构图，该实施例中具体示出了发光时长控制模块10包括第一开关晶体管M1和第二晶体管M2时的连接关系。
继续参见图3，发光时长控制模块10包括第一开关晶体管M1和第二晶体管M2，第一开关晶体管M1的栅极为发光控制信号输入端EM1/EM2/EM3，第一开关晶体管M1的第一极为驱动电流输入端IN，第一开关晶体管M1的第二极与第二晶体管M2的第一极电连接，第二晶体管M2的栅极与控制输出端K1/K2/K3电连接，第二晶体管M2的第二极为驱动电流输出端OUT。
具体地，图3所示实施例示出了第一开关晶体管M1和第二晶体管M2均为P型晶体管的情形，P型晶体管为PMOS管。当然，在本申请的一些其他实施例中，第一开关晶体管M1和第二晶体管M2还可体现为N型晶体管，N型晶体管为NMOS管或氧化物薄膜晶体管。一般P型晶体管在低电平信号的控制下导通，在高电平信号的控制下截止，一般N型晶体管在高电平信号的控制下导通，在低电平信号的控制下截止。本申请将以第一开关晶体管M1和第二晶体管M2均为P型晶体管为例进行说明。
当向第一开关晶体管M1的栅极即发光控制信号输入端EM1/EM2/EM3输入低电平的发光控制信号时，该第一开关晶体管M1将导通；当一个控制输出端K1/K2/K3向第二晶体管M2的栅极输入低电平信号时，第二晶体管M2也将导通。此时，驱动电流输入端IN输入的驱动电流将经由导通的第一开关晶体管M1和第二晶体管M2传输至驱动电流输出端OUT，驱动电流的脉冲宽度与导通的第一开关晶体管M1所接收到的发光控制信号的脉冲宽度相同。图4所示为同一像素驱动电路中与三个发光时长控制模块10分别对应的发光控制信号的脉冲示意图，三个脉冲分别代表向发光控制信号输入端EM1、EM2和EM3输入的发光控制信号，图4中，发光控制信号输入端EM1对应的发光控制信号的脉冲宽度最小，EM3对应的发光控制信号的脉冲宽度最大，EM3对应的发光控制信号的脉冲宽度居中。在本申请中，可通过控制子模块20的控制输出端K1/K2/K3来控制对应的第二晶体管M2的导通或截止，在同一时刻内控制一个第二晶体管管M2导通，从而控制对应发光时长控制模块10的导通。在不同的时刻，通过选通不同的第二晶体管M2，即可向驱动电流输出端OUT输出与对应发光控制信号脉冲宽度相同的驱动电流，从而得以实现对像素的发光时长进行灵活调节。
在本发明的一种可选实施例中，图5所示为本申请实施例所提供的像素驱动电路的另一种模块结构图，该实施例中具体示出了控制子模块20包括第一控制端S1和第一电平信号端DW1/DW2/DW3的情形。
继续参见图5本申请实施例所提供的像素驱动电路中，控制子模块20还包括：第一控制端S1，用于提供第一控制信号；
第一电平信号端DW1/DW2/DW3，每个发光时长控制模块10中第一电平信号端DW1/DW2/DW3不相同。
具体地，请参见图5，三个发光时长控制模块10中，对应的第一电平信号端分别为DW1、DW2和DW3。第一控制端S1分别用于控制不同的发光时长控制模块10中的第一电平信号向控制输出端K1/K2/K3的传输，第一电平信号端DW1/DW2/DW3输出的信号即为控制子模块20的控制输出端K1/K2/K3输出的信号。以第二晶体管M2为PMOS管为例，当控制子模块20的控制输出端K1/K2/K3中的任一向第二晶体管M2的栅极输入低电平信号时，对应的第二晶体管M2将导通，对应的发光时长控制模块10也将导通；当控制子模块20的控制输出端K1/K2/K3中的任一向第二晶体管M2的栅极输入高电平信号时，第二晶体管M2将截止，对应的发光时长控制模块10将截止。图6所示为本申请实施例所提供的像素驱动电路的一种驱动时序图，请参见图5和图6，在第一阶段T1，第一电平信号端DW1输出低电平信号DW2和DW3输出高电平信号时，与第一电平信号端DW1对应的发光时长控制模块10将导通，与第一电平信号端DW2和DW3对应的发光时长控制模块10将截止，此时，驱动电流输出端OUT将输出脉冲宽度等于发光控制信号输入端EM1输入的发光控制信号脉冲宽度的驱动电流。在第二阶段T2，第一电平信号输出端DW1和DW3输出高电平信号、DW2输出低电平信号时，与第一电平信号端DW2对应的发光时长控制模块10将导通，与第一电平信号端DW1和DW3对应的发光时长控制模块10将截止，此时，驱动电流输出端OUT将输出脉冲宽度等于发光控制信号输入端EM2输入的发光控制信号脉冲宽度的驱动电流。驱动电流输出的脉冲宽度与发光时长成正比，驱动电流输出的脉冲宽度越大，对应的发光时长越大。因此，通过本申请的像素驱动电路的结构可灵活调节各像素的发光时长，提高了像素驱动电路的驱动灵活性。
在本发明的一种可选实施例中，图7所示为本申请实施例所提供的像素驱动电路的另一种模块结构图，该实施例中具体示出了控制子模块20包括第三晶体管M3的情形。
继续参见图7，控制子模块20包括第三晶体管M3，第三晶体管M3的栅极为第一控制端S1，第三晶体管M3的第一极为第一电平信号端DW1/DW2/DW3，第二极为控制输出端K1/K2/K3。该实施例仅以第三晶体管M3为PMOS管为例进行说明，在本申请的一些其他实施例中，第三晶体管M3还可为NMOS管，本申请对此不进行具体限定。当第一控制端S1输入低电平信号时，第三晶体管M3导通，此时第一电平信号端DW1/DW2/DW3的信号将通过导通的第三晶体管M3传输至控制输出端K1/K2/K3，以控制第二晶体管M2的导通或截止，进而控制对应的发光时长控制模块10的导通或关闭。需要说明的是，在同一时刻内，仅有一个第二晶体管M2导通。采用第三晶体管M3作为控制子模块20的构成部分以实现对发光时长控制模块10的控制的方式，简单易行，控制信号可靠。
在本发明的一种可选实施例中，请继续参见图7，该实施例中示出了三个并联的发光时长控制模块10，各发光时长控制模块10中各第三晶体管M3的栅极连接至同一第一控制端S1。
具体地，继续参见图7，三个并联的发光时长控制模块10中，各第三晶体管M3的类型相同，均为PMOS管，本申请将各第三晶体管M3的栅极连接至同一第一控制端S1，由第一控制端S1同时向各第三晶体管M3发送控制信号，控制各第三晶体管M3同时导通或同时截止。当各第三晶体管M3均导通时，各控制子模块20中第一电平信号由导通的第三晶体管M3传输至控制输出端K1/K2/K3，同样能够控制对应发光时长控制模块10的导通或截止。因此，将各第三晶体管M3的栅极连接至同一第一控制端S1的方式，有利于减少像素驱动电路中控制端的数量，从而有利于简化像素驱动电路的电路复杂度。
在本发明的一种可选实施例中，图8所示为本申请实施例所提供的像素驱动电路的另一种模块结构图，该实施例中具体示出了控制子模块20包括第一电源信号端PVDD和第一电容C的情形。
请继续参见图8，控制子模块20还包括：
第一电源信号端PVDD，用于提供正性电源信号；
第一电容C，第一电容C的第一端与第二晶体管M2的栅极电连接，第一电容C的第二端连接至第一电源信号端PVDD。
具体地，请参见图8，控制子模块20中引入了第一电容C，第一电容C的第一端与第二晶体管M2的栅极和第三晶体管M3的第二极电连接，第一电容C的第二端连接到第一电源信号端PVDD，该第一电源信号端PVDD为第一电容C提供正性电源信号。当第一电平信号DW1、DW2和DW3中的一者为低电平信号时，该第一电容C的引入能够维持对应的控制输出端K1/K2/K3为低电平信号，有利于确保低电平信号能够将第二晶体管M2可靠开启。
需要说明的是，本申请所提供的实施例中，仅以各发光时长控制模块10中各晶体管均为PMOS管为例进行说明，在本申请的一些其他实施例中，各发光时长控制模块10中各晶体管还可均为N型晶体管。当将各发光时长控制模块10中的各晶体管的类型设置为相同时，各个晶体管在相同的制作工艺中即可制作完成，因而有利于简化像素驱动电路的制程。当然，在本申请的一些其他实施例中，发光时长控制模块10中的晶体管还可根据需求同时包含P型晶体管和N型晶体管，本申请对此不进行具体限定。
基于同一发明构思，本申请还提供一种本申请所提供的像素驱动电路的驱动方法，图9所示为本申请所提供的像素驱动电路的驱动方法的一种流程图，请结合图1、图2和图9，该方法包括：
步骤101、不同的发光时长控制模块10对应的发光控制信号输入端EM1/EM2/EM3提供脉冲宽度不同的发光控制信号。
步骤102、同一时刻内，有且仅有一个发光时长控制模块10导通，驱动电流的脉冲宽度等于该导通的发光时长控制模块10中发光控制信号的脉冲宽度。
具体地，由于本申请中的像素驱动电路中引入了两个并联的发光时长控制模块10，各发光时长控制模块10中分别配置有不同的发光控制信号输入端EM1/EM2/EM3，用于提供不同脉冲宽度的发光控制信号。在对上述像素驱动电路进行驱动时，不同的发光时长控制模块10对应的发光控制信号输入端EM1/EM2/EM3提供脉冲宽度不同的发光控制信号，在控制子模块20的控制下，可选择像素驱动电路中的一个发光时长控制模块10导通，从而使得像素驱动电路输出脉冲宽度等于发光控制信号脉冲宽度的驱动电流。由于像素的发光时长与驱动电流的脉冲宽度相同，而由于驱动电流的脉冲宽度与发光控制信号的脉冲宽度相同，当发光控制信号脉冲宽度不同时，对应像素的发光时长也不同。本申请在同一像素驱动电路中引入脉冲宽度不同的发光时长控制模块10，在同一时刻内，有且仅有一个发光时长控制模块10导通，可根据发光时长的不同需求来选通对应的发光时长控制模块10，从而实现了对显示面板上单个像素发光时长的灵活调节与控制，有利于提升显示面板的驱动灵活性。
在本发明的一种可选实施例中，请结合图3，像素驱动电路还包括第一开关晶体管M1和第二晶体管M2，第一开关晶体管M1的第二极与第二晶体管M2的第一极电连接。
第一开关晶体管M1的栅极接收发光控制信号，第一开关晶体管M1的第一极提供输入电流，同一时刻内，有且仅有一个第二晶体管M2的栅极提供第二开启信号，提供第一开启电压的第二晶体管M2的第二极输出脉冲宽度等于发光控制信号脉冲宽度的驱动电流。
具体地，请结合图3，图3所示实施例仅以第一开关晶体管M1和第二晶体管M2均为PMOS管为例进行说明。当向第一开关晶体管M1的栅极即发光控制信号输入端EM1/EM2/EM3输入低电平的发光控制信号时，该第一开关晶体管M1将导通，第一开关晶体管M1的第一极提供输入电流；当控制输出端K1/K2/K3向第二晶体管M2的栅极输入低电平信号时，该低电平信号为第二开启信号，第二晶体管M2也将导通，需要说明的是，同一时刻内，有且仅有一个第二晶体管M2的栅极提供第二开启信号，当第二晶体管M2为NMOS管或氧化物晶体管时，第二开启信号将体现为高电平信号。当某一发光时长控制模块10中的第一开关晶体管M1和第二晶体管M2导通时，驱动电路输入端输入的驱动电流将经由导通的第一开关晶体管M1和第二晶体管M2传输至驱动电流输出端OUT，驱动电流的脉冲宽度与导通的第一开关晶体管M1所接收到的发光控制信号的脉冲宽度相同。在本申请中，可通过控制子模块20的控制输出端K1/K2/K3来控制对应的第二晶体管M2的导通或截止，从而控制对应发光时长控制模块10的导通或截止。在不同时刻，通过选通不同的第二晶体管M2，即可向驱动电流输出端OUT输出与对应发光控制信号脉冲宽度相同的驱动电流，从而得以实现对像素的发光时长进行灵活调节。
在本发明的一种可选实施例中，请结合图7，像素驱动电路还包括第三晶体管M3，第三晶体管M3的第二极与第二晶体管M2的栅极电连接。
第三晶体管M3的栅极提供第一控制信号，第三晶体管M3的第一极提供第一电平信号，同一时刻内，有且仅有一个第一电平信号为第一开启信号。
具体地，图7实施例仅以第三晶体管M3为PMOS管为例进行说明，在本申请的一些其他实施例中，第三晶体管M3还可为NMOS管或氧化物晶体管，本申请对此不进行具体限定。当第一控制端S1提供的以控制信号为低电平信号时，第三晶体管M3导通，此时第一电平信号端DW1/DW2/DW3的信号将通过导通的第三晶体管M3传输至控制输出端K1/K2/K3，以控制第二晶体管M2的导通或截止，进而控制对应的发光时长控制模块10的导通或关闭。特别是，在同一时刻内，有且仅有一个第一电平信号为第一开启信号(当第二晶体管为PMOS管时，第一开启信号为低电平信号；当第二晶体管M2为NMOS管或氧化物晶体管时，第一开启信号为高电平信号)，这样使得在同一时刻内有且仅有一个发光时长控制模块10导通，使得由像素驱动电路输入像素的驱动电流的脉冲宽度与导通的发光时长控制模块10中发光控制信号的脉冲宽度相同。在不同的时刻，可以通过选通不同的发光时长控制模块10来改变像素的发光时长，从而使得单个像素的发光时长得以灵活调节。
基于同一发明构思，本申请还提供一种显示面板，图10所示为本申请实施例所提供的显示面板100的一种结构示意图，请参见图10，显示面板100包括本申请所提供的像素驱动电路。可以理解的是，本发明实施例提供的显示面板，可以应用到电脑、电视、车载显示装置等其他具有显示功能的显示装置中，本发明对此不作具体限制。本发明实施例提供的显示面板，具有本发明实施例提供的像素驱动电路的有益效果，具体可以参考上述各实施例对于像素驱动电路的具体说明，本实施例在此不再赘述。
通过上述实施例可知，本发明提供的像素驱动电路及其驱动方法和显示面板，至少实现了如下的有益效果：
本申请所提供的像素驱动电路及其驱动方法和显示面板中，引入了两个并联的发光时长控制模块，各发光时长控制模块中分别配置有不同的发光控制信号输入端，用于提供不同脉冲宽度的发光控制信号。在控制子模块的控制下，可选择像素驱动电路中的一个发光时长控制模块导通，从而使得像素驱动电路输出脉冲宽度等于发光控制信号脉冲宽度的驱动电流。由于像素的发光时长与驱动电流的脉冲宽度相同，而由于驱动电流的脉冲宽度与发光控制信号的脉冲宽度相同，当发光控制信号脉冲宽度不同时，对应像素的发光时长也不同。本申请在同一像素驱动电路中引入脉冲宽度不同的发光时长控制模块，在同一时刻内，有且仅有一个发光时长控制模块导通，可根据发光时长的不同需求来选通对应的发光时长控制模块，从而实现了对显示面板上单个像素发光时长的灵活调节与控制，有利于提升显示面板的驱动灵活性。
虽然已经通过例子对本发明的一些特定实施例进行了详细说明，但是本领域的技术人员应该理解，以上例子仅是为了进行说明，而不是为了限制本发明的范围。本领域的技术人员应该理解，可在不脱离本发明的范围和精神的情况下，对以上实施例进行修改。本发明的范围由所附权利要求来限定。

Claims (10)

1.一种像素驱动电路，其特征在于，包括至少两个并联的发光时长控制模块，各所述发光时长控制模块包括：
驱动电流输入端，用于提供输入电流；
发光控制信号输入端，不同的所述发光时长控制模块对应的发光控制信号输入端用于提供不同脉冲宽度的发光控制信号；
控制子模块，所述控制子模块配置有一个控制输出端，所述控制输出端用于控制该控制子模块所在的发光时长控制模块的导通；
驱动电流输出端，用于输出脉冲宽度等于发光控制信号脉冲宽度的驱动电流；
同一时刻内，有且仅有一个所述发光时长控制模块导通。
2.如权利要求1所述的像素驱动电路，其特征在于，所述发光时长控制模块包括第一开关晶体管和第二晶体管，所述第一开关晶体管的栅极为所述发光控制信号输入端，所述第一开关晶体管的第一极为驱动电流输入端，所述第一开关晶体管的第二极与所述第二晶体管的第一极电连接，所述第二晶体管的栅极与所述控制输出端电连接，所述第二晶体管的第二极为驱动电流输出端。
3.如权利要求2所述的像素驱动电路，其特征在于，所述控制子模块还包括：
第一控制端，用于提供第一控制信号；
第一电平信号端，每个所述发光时长控制模块中第一电平信号端不相同。
4.如权利要求3所述的像素驱动电路，其特征在于，所述控制子模块包括第三晶体管，第三晶体管的栅极为第一控制端，第三晶体管的第一极为第一电平信号端，第二极为控制输出端。
5.如权利要求4所述的像素驱动电路，其特征在于，各所述第三晶体管的栅极连接至同一所述第一控制端。
6.如权利要求4所述的像素驱动电路，其特征在于，所述控制子模块还包括：
第一电源信号端，用于提供正性电源信号；
第一电容，所述第一电容的第一端与所述第二晶体管的栅极电连接，所述第一电容的第二端连接至第一电源信号端。
7.一种如权利要求1所述的像素驱动电路的驱动方法，其特征在于，所述方法包括：
不同的所述发光时长控制模块对应的发光控制信号输入端提供脉冲宽度不同的发光控制信号；
同一时刻内，有且仅有一个发光时长控制模块导通，所述驱动电流的脉冲宽度等于该导通的发光时长控制模块中发光控制信号的脉冲宽度。
8.如权利要求7所述的驱动方法，其特征在于，所述像素驱动电路还包括第一开关晶体管和第二晶体管，所述第一开关晶体管的第二极与所述第二晶体管的第一极电连接，
所述第一开关晶体管的栅极接收所述发光控制信号，所述第一开关晶体管的第一极提供输入电流，
同一时刻内，有且仅有一个第二晶体管的栅极提供第二开启信号，提供第一开启电压的第二晶体管的第二极输出脉冲宽度等于发光控制信号脉冲宽度的驱动电流。
9.如权利要求8所述的驱动方法，其特征在于，所述像素驱动电路还包括第三晶体管，所述第三晶体管的第二极与所述第二晶体管的栅极电连接，
第三晶体管的栅极提供第一控制信号，第三晶体管的第一极提供第一电平信号，
同一时刻内，有且仅有一个第一电平信号为第一开启信号。
10.一种显示面板，其特征在于，所述显示面板包括权利要求1-6中任一项所述的像素驱动电路。
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