CN110992876A - 显示装置 - Google Patents

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Abstract

本发明涉及显示装置,该显示装置包括:沿第一方向布置在第一水平线上的第一点和第二点,第一点和第二点中的每一个包括第一像素至第四像素;开关单元,被配置为响应于第一控制信号和第二控制信号选择性地将第一输出线至第四输出线分别耦接至第一点和第二点中的每一个的第一像素至第四像素;以及数据驱动器,被配置为以分时共享方式将数据电压提供至第一输出线至第四输出线。数据驱动器可以包括:数据处理器,被配置为生成与第一输出线至第四输出线对应的数据信号;并且第一数字模拟转换器(DAC)至第四DAC,被配置为将数据信号转换为数据电压。第一DAC至第四DAC的每一个可以被提供有第一伽马电压至第四伽马电压中的对应一个。

Description

显示装置
相关申请的交叉引用
本申请要求2018年10月2日提交的第10-2018-0117788号韩国专利申请的优先权和权益,该申请出于所有目通过引用合并于此,如同在本文中充分地阐述一样。
技术领域
本发明的示例性实施例涉及一种显示装置。
背景技术
随着信息技术的发展,作为用户与信息之间的连接媒介的显示装置的重要性已经被强调。由于显示装置的重要性,诸如液晶显示(LCD)装置和有机发光显示装置的各种显示装置的使用已经增多。
有机发光显示装置使用通过电子和空穴的复合生成光的有机发光二极管来显示图像。有机发光显示装置的优点在于有机发光显示装置具有高响应速度并且能够显示清晰的图像。
这种有机发光显示装置包括像素、被配置为向像素提供数据电压的数据驱动器、被配置为向像素提供扫描信号的扫描驱动器、以及被配置为向像素提供发射控制信号的发射驱动器。
可以对具有不同颜色的相邻像素分组,并且每个组可以被定义为点。每个点可以通过颜色的组合来表示各种颜色。
这个背景技术部分中所公开的以上信息仅是为了本发明构思的背景的理解,并且因此,以上信息可以包含不构成现有技术的信息。
发明内容
根据本发明的示例性实施方式构造的装置能够提供一种能够防止或减少数据线之间串扰的显示装置。
本发明构思的额外特征将在以下说明书中阐述,并且将从说明书部分地变得明显,或者可以通过本发明构思的实践而习知。
根据本发明的一个或多个实施例,一种显示装置包括:沿第一方向布置在第一水平线上的第一点和第二点,第一点和第二点中的每一个包括沿第一方向依次布置的第一像素、第二像素、第三像素和第四像素;以及开关单元,被配置为响应于第一控制信号和第二控制信号而选择性地将第一输出线、第二输出线、第三输出线和第四输出线分别耦接至第一点和第二点中的每一个的第一像素、第二像素、第三像素和第四像素。在第一周期期间,响应于接收第一控制信号,开关单元可以被配置为将第一输出线耦接至第一点的第一像素,将第二输出线耦接至第一点的第二像素,将第三输出线耦接至第一点的第三像素,并且将第四输出线耦接至第一点的第四像素。在第二周期期间,响应于接收第二控制信号,开关单元可以被配置为将第一输出线耦接至第二点的第三像素,将第二输出线耦接至第二点的第二像素,将第三输出线耦接至第二点的第一像素,并且将第四输出线耦接至第二点的第四像素。
第一像素可以被配置为发出第一颜色的光,第二像素可以被配置为发出第二颜色的光,第三像素可以被配置为发出第三颜色的光,第四像素可以被配置为发出第四颜色的光,其中第一颜色、第二颜色、和第三颜色可以相互不同。
第一颜色可以是红色,第二颜色和第四颜色可以是绿色,并且第三颜色可以是蓝色。
显示装置可以进一步包括沿第一方向布置在第二水平线上的第三点和第四点,第三点和第四点中的每一个包括沿第一方向依次布置的第三像素、第四像素、第一像素和第二像素。第二水平线可以沿第二方向与第一水平线相邻,第二方向不同于第一方向。
在第三周期期间,响应于接收第三控制信号,开关单元可以被配置将第一输出线耦接至第三点的第一像素,将第二输出线耦接至相邻点的第二像素,将第三输出线耦接至第三点的第三像素,并且将第四输出线耦接至第三点的第四像素。在第四周期期间,响应于接收第四控制信号,开关单元可以被配置为将第一输出线耦接至第四点的第三像素,将第二输出线耦接至第三点的第二像素,将第三输出线耦接至第四点的第一像素,并且将第四输出线耦接至第四点的第四像素。相邻点可以沿第一方向与第三点相邻布置。
在第三周期期间,响应于接收第三控制信号,开关单元可以被配置为将第一输出线耦接至第三点的第一像素,将第二输出线耦接至第四点的第二像素,并且将第三输出线耦接至第三点的第三像素。在第四周期期间,响应于接收第四控制信号,开关单元可以被配置将第一输出线耦接至第四点的第三像素,将第二输出线耦接至第三点的第二像素,将第三输出线耦接至第四点的第一像素,并且将第四输出线耦接至第四点的第四像素。
显示装置可以进一步包括扫描驱动器,该扫描驱动器被配置为在第一写入周期期间将第一扫描信号提供至第一点和第二点,并且在第二写入周期期间将第二扫描信号提供至第三点和第四点。第一周期、第二周期、第一写入周期、第三周期、第四周期和第二写入周期可以顺序地进行。
第一水平线可以指示奇数号水平线,并且第二水平线可以指示偶数号水平线。
第二周期和第一写入周期可以部分地相互重叠。第四周期和第二写入周期可以部分地相互重叠。
显示装置可以进一步包括数据驱动器,该数据驱动器被配置为以分时共享方式将数据电压提供至第一输出线、第二输出线、第三输出线和第四输出线。
数据驱动器可以包括:数据处理器,被配置为基于第二数据生成与第一输出线、第二输出线、第三输出线和第四输出线对应的数据信号;以及第一数字模拟转换器(DAC)、第二DAC、第三DAC和第四DAC,被配置为将数据信号转换为数据电压。第一DAC至第四DAC中的每一个可以被提供有第一伽马电压至第四伽马电压中的对应一个。
在第一周期期间,第一DAC可以被配置为将待施加至第一点的第一像素的数据电压提供至第一输出线,第二DAC可以被配置为将待施加至第一点的第二像素的数据电压提供至第二输出线,第三DAC可以被配置为将待施加至第一点的第三像素的数据电压提供至第三输出线,并且第四DAC可以被配置为将待施加至第一点的第四像素的数据电压提供至第四输出线。在第二周期期间,第一DAC可以被配置为将待施加至第二点的第三像素的数据电压提供至第一输出线,第二DAC可以被配置为将待施加至第二点的第二像素的数据电压提供至第二输出线,第三DAC可以被配置为将待施加至第二点的第一像素的数据电压提供至第三输出线,并且第四DAC可以被配置为将待施加至第二点的第四像素的数据电压提供至第四输出线。
显示装置可以进一步包括被配置为将第一控制信号和第二控制信号提供至开关单元的时序控制器。
根据本发明的一个或多个实施例,一种显示装置包括:沿第一方向布置在第一水平线上的第一点和第二点,第一点和第二点中的每一个包括第一像素、第二像素、第三像素和第四像素;开关单元,被配置为响应于第一控制信号和第二控制信号而选择性地将第一输出线、第二输出线、第三输出线和第四输出线分别耦接至第一点和第二点中的每一个的第一像素、第二像素、第三像素和第四像素;以及数据驱动器,被配置为以分时共享方式将数据电压提供至第一输出线至第四输出线。数据驱动器可以包括:数据处理器,被配置为生成与第一输出线至第四输出线对应的数据信号;以及第一数字模拟转换器(DAC)、第二DAC、第三DAC和第四DAC,被配置为将数据信号转换为数据电压。第一DAC至第四DAC中的每一个可以被提供有第一伽马电压至第四伽马电压中的对应一个。
响应于在第一周期期间接收第一控制信号,第一DAC可以被配置为将待施加至第一点的第一像素的数据电压提供至第一输出线,第二DAC可以被配置为将待施加至第一点的第二像素的数据电压提供至第二输出线,第三DAC可以被配置为将待施加至第一点的第三像素的数据电压提供至第三输出线,并且第四DAC可以被配置为将待施加至第一点的第四像素的数据电压提供至第四输出线。
响应于在第二周期期间接收第二控制信号,第一DAC被配置为将待施加至第二点的第三像素的数据电压提供至第一输出线,第二DAC可以被配置为将待施加至第二点的第二像素的数据电压提供至第二输出线,第三DAC可以被配置为将待施加至第二点的第一像素的数据电压提供至第三输出线,并且第四DAC可以被配置为将待施加至第二点的第四像素的数据电压提供至第四输出线。
根据本发明的一个或多个实施例,一种显示装置包括:沿第一方向布置在第一水平线上的第一点和第二点,第一点和第二点中的每一个包括沿第一方向依次布置的第一像素、第二像素和第三像素;沿第一方向布置在第二水平线上的第三点和第四点,第三点和第四点中的每一个包括沿第一方向依次布置的第三像素、第一像素和第二像素;开关单元,被配置为响应于在第一周期期间提供的第一控制信号和在第二周期期间提供的第二控制信号而选择性地将第一输出线、第二输出线和第三输出线分别耦接至第一点和第二点中的每一个的第一像素、第二像素和第三像素;以及数据驱动器,被配置为以分时共享方式将数据电压提供至第一输出线至第三输出线。数据驱动器可以包括:数据处理器,被配置为生成与第一输出线至第三输出线对应的数据信号;以及第一数字模拟转换器(DAC)、第二DAC和第三DAC,被配置为将数据信号转换为数据电压。第一DAC至第三DAC中的每一个可以被提供有第一伽马电压至第三伽马电压中的对应一个。第二水平线可以沿第二方向与第一水平线相邻,第二方向不同于第一方向。第一像素可以被配置为发出第一颜色的光,第二像素可以被配置为发出第二颜色的光,第三像素可以被配置为发出第三颜色的光。第一颜色、第二颜色和第三颜色可以相互不同。
在第一周期期间,第一DAC可以配置为将待施加至第一点的第一像素的数据电压提供至第一输出线,第二DAC可以配置为将待施加至第一点的第二像素的数据电压提供至第二输出线,第三DAC可以配置为将待施加至第一点的第三像素的数据电压提供至第三输出线。开关可以配置为将第一输出线耦接至第一点的第一像素,将第二输出线耦接至第一点的第二像素,并且将第三输出线耦接至第一点的第三像素。
在第二周期期间,第一DAC可以被配置为将待施加至第二点的第三像素的数据电压提供至第一输出线,第二DAC可以被配置为将待施加至第二点的第二像素的数据电压提供至第二输出线,并且第三DAC可以被配置为将待施加至第二点的第一像素的数据电压提供至第三输出线。开关单元可以配置以将第一输出线耦接至第二点的第三像素,将第二输出线耦接至第二点的第二像素,并且将第三输出线耦接至第二点的第一像素。
在其中提供第三控制信号的第三周期期间,第一DAC可以被配置为将待施加至第三点的第一像素的数据电压提供至第一输出线,第二DAC可以被配置为将待施加至相邻点的第二像素的数据电压提供至第二输出线,并且第三DAC可以被配置为将待施加至第三点的第三像素的数据电压提供至第三输出线。开关单元可以被配置为将第一输出线耦接至第三点的第一像素,将第二输出线耦接至相邻点的第二像素,以及将第三输出线耦接至第三点的第三像素。相邻点可以沿第一方向与第三点相邻布置。
在其中提供第三控制信号的第三周期期间,第一DAC可以被配置为将待施加至第三点的第一像素的数据电压提供至第一输出线,第二DAC可以被配置为将待施加至第四点的第二像素的数据电压提供至第二输出线,并且第三DAC可以被配置为将待施加至第三点的第三像素的数据电压提供至第三输出线。开关单元可以被配置为将第一输出线耦接至第三点的第一像素,将第二输出线耦接至第四点的第二像素,并且将第三输出线耦接至第三点的第三像素。
根据示例性实施例,具有根据示例性实施例的其中两条数据线设置在两个相邻像素之间的结构的显示装置,可以防止或减小数据线之间的串扰。
要理解,之前的一般性描述和以下的详细描述是示例性和说明性的,并且旨在提供对如请求保护的本发明的进一步解释。
附图说明
被包括以提供本发明的进一步理解并且被并入在这个说明书中并且构成这个说明书的一部分的附图图示了本发明的示例性实施例,并与描述一起用于解释本发明构思。
图1是图示了根据示例性实施例的显示装置的框图。
图2是图示了根据示例性实施例的像素的等效电路图。
图3是图示了根据示例性实施例的驱动显示装置的方法的信号图。
图4A和图4B是图示了根据示例性实施例的开关单元的电路图。
图5A和图5B是图示了根据示例性实施例的驱动显示装置的方法的信号图。
图6是图示了根据示例性实施例的在第一周期期间驱动显示装置的方法的电路图。
图7是图示了根据示例性实施例的在第二周期期间驱动显示装置的方法的电路图。
图8A和图8B是图示了根据示例性实施例的在第三周期期间驱动显示装置的方法的电路图。
图9是图示了根据示例性实施例的在第四周期期间驱动显示装置的方法的电路图。
图10是图示了根据示例性实施例的数据驱动器的框图。
具体实施方式
在以下描述中,为了解释的目的,阐述许多具体细节以便提供本发明的各种示例性实施例或实施方式的全面理解。如本文所使用的“实施例”和“实施方式”是作为采用本文公开的本发明构思的一个或多个的装置或方法的非限定性示例的可互换词。然而,明显的是,可以不采用这些具体细节或者采用一个或多个等效布置而实践各种示例性实施例。在其他情形中,以框图形式示出了公知的结构和装置以便避免不必要地模糊各种示例性实施例。进一步,各种示例性实施例可以是不同的,但是不必是排他性的。例如,一示例性实施例的具体形状、配置和特性可以在另一示例性实施例中使用或实施而不脱离本发明构思。
除非另外规定,所示的示例性实施例要被理解为提供了实际中可以实施本发明构思的许多方式的变化细节的示例性特征。因此,除非另外规定,否则各种实施例的特征、部件、模块、层、薄膜、面板、区域和/或特征方面等(下文中独立地或共同地被称作“元件”)可以被另外组合、分离、交换和/或重新布置而不脱离本发明构思。
在附图中的交叉影线和/或阴影的使用通常被提供以阐明相邻元件之间的边界。因而,交叉影线或阴影的存在或缺失不传达或指示对所示元件之间的特定材料、材料特性、尺寸、比例、共同性、和/或元件的任何其他特征、属性、特性等的任何优选或需求,除非另外规定。进一步,在附图中,为了清楚和/或说明性目的可以夸大元件的大小和相对大小。当可以不同地实施示例性实施例时,可以与所描述的顺序不同地执行具体工艺顺序。例如,两个连续描述的工艺可以大体上同时执行或者以与所描述的顺序相反的顺序来执行。此外,相同的附图标记指代相同的元件。
当诸如层的元件被称作在另一元件或层“上”、“连接到”或“耦接到”另一元件或层时,该元件可以直接地在该另一元件或层上、连接到或耦接到该另一元件或层,或者可以存在介于中间的元件或层。然而,当元件或层被称作“直接地”在另一元件或层上、“直接地连接到”或“直接地耦接到”另一元件或层时,不存在介于中间的元件或层。为此,术语“连接”可以指的是具有或不具有介于中间的元件的物理、电学和/或流体连接。进一步,DR1方向和DR2方向可以不限于诸如x轴线和y轴线的直角坐标系的两个轴线,并且可以从更广泛的意义上解释。例如,DR1方向和DR2方向可以相互垂直,或者可以表示不相互垂直的不同方向。为了本公开的目的,“X、Y和Z中的至少一个”与“选自由X、Y和Z构成的组中的至少一个”可以被解释为仅X、仅Y、仅Z,或者X、Y和Z中的两个或多个的任意组合,诸如,例如XYZ、XYY、YZ和ZZ。如本文所使用的,术语“和/或”包括相关所列项的一个或多个的任意和全部组合。
尽管术语“第一”、“第二”等可以在本文被用于描述各种类型元件,但是这些元件不应受限于这些术语。这些术语用于区分一个元件与另一个元件。因此,以下讨论的第一元件可以称作第二元件而不脱离本公开的教导。
空间相对性术语,诸如“下方”、“下面”、“之下”、“低于”、“上面”、“上方”、“上”、“高于”、“侧面”(例如,如在“侧壁”中)等等,可以在本文被用于说明性目的,并且,因此用于描述如图中所示一个元件与另一个元件的关系。空间相对性术语旨在除了图中绘出的方位之外还涵盖设备在使用中、操作中和/或制造中的不同方位。例如,如果图中设备翻转,则描述为在其他元件或特征“下面”或“下方”的元件将随后定位为在其他元件或特征“上面”。因此,示例性术语“下面”可以包括上面和下面的两种朝向。此外,设备可以被另外定位(例如,旋转90度或以其他定位),并且因此本文使用的空间上相对的描述词作相应解释。
本文使用的术语是为了描述特定实施例的目的并不旨在限制。如本文所使用的,单数形式“一”和“该”旨在也包括复数形式,除非上下文明确给出相反指示。此外,当在这个说明书中使用时,术语“包括”和/或“包含”规定了所述特征、整数、步骤、操作、元件、部件和/或其组的存在,但是并未排除一个或多个其他特征、整数、步骤、操作、元件、部件和/或其组的存在或添加。还注意的是,如本文所使用的,术语“大致”、“大约”和其他类似术语被用作近似的术语而不作为程度的术语,并且因此被利用以考虑本领域的普通技术人员将意识到的在测量的、计算的和/或提供的值中的固有偏差。
作为本领域惯例,依据功能块、单元和/或模块在附图中描述并示出了一些示例性实施例。本领域技术人员将知晓,这些块、单元和/或模块由可以使用基于半导体的制造技术或其他制造技术形成的电子(或光学)电路(诸如逻辑电路、离散部件、微处理器、硬接线电路、存储器元件、布线连接等等)而物理地实施。在由微处理器或其他类似硬件来实施块、单元和/或模块的情形中,块、单元和/或模块可以使用软件(例如微代码)被编程并控制以执行本文所讨论的各种功能,且可以可选择地由固件和/或软件驱动。预期的是,每个块、单元和/或模块可以由专用硬件实施,或者作为用以执行一些功能的专用硬件与用以执行其他功能的处理器(例如,一个或多个编程微处理器和相关联电路)的组合。此外,一些示例性实施例的每个块、单元和/或模块可以物理地分离为两个或更多相互作用且离散的块、单元和/或模块而不脱离本发明构思的范围。进一步,一些示例性实施例的块、单元和/或模块可以物理地结合成更复杂的块、单元和/或模块而不脱离本发明构思的范围。
除非另外定义,本文使用的所有术语(包括技术术语和科学术语)具有与本公开所属的技术领域的普通技术人员所通常理解的含义相同的含义。诸如这些在通常使用的词典中定义的术语,应当解释为具有与它们在相关技术的语境中的含义一致的含义,并且不以理想化的或过于正式的意义来解释,除非在本文中明确这样定义。
要注意的是,本公开不限于示例性实施例而是可以以各种其他方式体现。在这个说明书中,“连接/耦接”不仅指的是一个部件直接地与另一部件耦接,而且还指的是一个部件通过中间部件间接地与另一部件耦接。现在应参照附图,在该附图中,遍及不同附图使用相同的附图标记以标出相同或类似的部件。
图1是图示了根据示例性实施例的显示装置100的框图。
参照图1,显示装置100可以包括时序控制器110、数据驱动器120、开关单元130、像素单元140、扫描驱动器150、以及发射驱动器160。
时序控制器110可以控制显示装置100的整体操作。
时序控制器110可以从外部装置接收第一数据IDAT1和外部控制信号。例如,第一数据IDAT1可以指的是从外部装置接收的图像。外部控制信号可以包括垂直同步信号、水平同步信号、主时钟信号、数据使能信号等等。
时序控制器110可以重新对准第一数据IDAT1。当需要时,时序控制器110可以基于补偿数据(例如退化数据或斑点数据(spot data))而补偿第一数据IDAT1。
时序控制器110可以通过重新对准或补偿第一数据IDAT1来生成第二数据IDAT2。时序控制器110可以基于第一数据IDAT1和外部控制信号中的至少一个来生成数据驱动控制信号DCS、扫描控制信号SCS、发射驱动控制信号ECS、以及控制信号CLA、CLB、CLC和CLD。
时序控制器110可以发送第二数据IDAT2和数据驱动控制信号DCS至数据驱动器120。例如,数据驱动控制信号DCS可以包括图像数据、帧控制信号以及时钟信号。
时序控制器110可以将控制信号CLA、CLB、CLC和CLD发送至开关单元130。例如,控制信号CLA、CLB、CLC和CLD可以导通或关断包括在开关单元130中的开关。在这个说明书中,控制信号CLA、CLB、CLC和CLD的提供可以指示控制信号CLA、CLB、CLC和CLD具有能够导通对应开关的栅极导通电压。
时序控制器110可以发送扫描控制信号SCS至扫描驱动器150。例如,扫描控制信号SCS可以包括扫描开始信号和至少一个扫描时钟信号。扫描开始信号可以控制扫描信号的提供时序,并且扫描时钟信号可以用于偏移扫描开始信号。
时序控制器110可以发送发射驱动控制信号ECS至发射驱动器160。例如,发射驱动控制信号ECS可以包括发射开始信号和时钟信号。发射开始信号可以控制发射控制信号的提供时序,并且时钟信号可以用于偏移发射开始信号。
数据驱动器120可以接收来自时序控制器110的第二数据IDAT2以及数据驱动控制信号DCS。
数据驱动器120可以基于第二数据IDAT2和数据驱动控制信号DCS而将数据电压提供至输出线B1至Bm(m是自然数)。在示例性实施例中,数据驱动器120可以在水平周期期间以分时共享方式将数据电压提供至输出线B1至Bm。例如,数据驱动器120可以将数据电压提供至输出线B1至Bm,使得数据电压与对应的扫描信号同步。在示例性实施例中,数据驱动器120可以包括多个数据驱动集成电路(IC)。
在这个说明书中,术语“数据电压”可以指示与数据信号对应的电压。
开关单元130可以从输出线B1至Bm接收数据电压。开关单元130可以接收控制信号CLA、CLB、CLC和CLD。
开关单元130可以在水平周期期间响应于控制信号CLA、CLB、CLC和CLD而将提供至输出线B1至Bm中的任意一个的数据电压提供至多个数据线组(DG1至DGm中的至少两个)。
在示例性实施例中,开关单元130可以意味着多路分配器。本文将在稍后参照图4A和图4B解释关于这点的细节。
像素单元140可以包括基底以及设置在基底上的像素PX。在示例性实施例中,像素单元140可以指示显示面板的显示区域。
像素PX可以耦接至对应的扫描线S0至Sn(n是自然数)、对应的发射控制线E1至En以及对应的数据线组DG1至DGm。可以以各种方式布置像素PX以与对应的扫描线S0至Sn、对应的发射控制线E1至En以及对应的数据线组DG1至DGm连接。可以通过扫描线S0至Sn为像素PX提供扫描信号。可以通过发射控制线E1至En为像素PX提供发射控制信号。可以通过数据线组DG1至DGm为像素PX提供数据电压。每个像素PX可以以与对应数据电压对应的灰度级而发光。
在示例性实施例中,输出线B1至Bm和数据线组DG1至DGm可以沿第二方向(例如,沿垂直方向的DR2)延伸。扫描线S0至Sn和发射控制线E1至En可以沿不同于第二方向的第一方向(例如,沿水平方向的DR1)延伸。在示例性实施例中,像素PX中的每个像素PX可以耦接至扫描线S0至Sn中的至少一个扫描线并且耦接至数据线组DG1至DGm中的至少一个数据线组。
扫描驱动器150可以从时序控制器110接收扫描控制信号SCS。扫描驱动器150可以基于扫描控制信号SCS将扫描信号提供至扫描线S0至Sn。例如,扫描驱动器150可以顺序地将扫描信号提供至扫描线S0至Sn。在示例性实施例中,每个扫描信号可以具有栅极导通电压。
发射驱动器160可以从时序控制器110接收发射驱动控制信号ECS。发射驱动器160可以基于发射驱动控制信号ECS将发射控制信号提供至发射控制线E1至En。例如,发射驱动器160可以顺序地提供发射控制信号至发射控制线E1至En。在示例性实施例中,每个发射控制信号可以具有栅极导通电压。
图1图示了n+1条扫描线S0至Sn以及n条发射控制线E1至En,但是本公开的示例性实施例不限于此。例如,可以额外地形成虚设扫描线和/或虚设发射控制线以确保操作的可靠性。
此外,图1图示了分离地提供时序控制器110、数据驱动器120、开关单元130、扫描驱动器150和发射驱动器160,但是前述部件中的至少一些可以根据需要相互集成。
时序控制器110、数据驱动器120、开关单元130、扫描驱动器150和发射驱动器160可以使用各种形式(例如,玻璃上芯片形式、塑料上芯片形式、载带封装形式和薄膜上芯片形式)中的任何一种被安装。
图2是图示了根据示例性实施例的像素PX的等效电路图。图2图示了根据示例性实施例的像素PX的电路,并且这个电路可以应用于图4A至图4B中所示的第一像素PX1、第二像素PX2、第三像素PX3和第四像素PX4中的每一个。尽管图2图示了像素PX的示例性电路结构,本公开的示例性实施例不限于此。
参照图2,像素PX可以包括像素电路PXC和有机发光二极管OLED。
有机发光二极管OLED的阳极电极可以耦接至像素电路PXC,并且有机发光二极管OLED的阴极电极可以耦接至第二电源ELVSS。有机发光二极管OLED可以发出具有与从像素电路PXC提供的驱动电流对应的预定亮度的光。第一电源ELVDD可以被设定为比第二电源ELVSS的电压更高的电压,以允许电流流至有机发光二极管OLED。
像素电路PXC可以响应于提供至对应数据线的数据电压DT而控制经由有机发光二极管OLED从第一电源ELVDD流至第二电源ELVSS的驱动电流。为此,像素电路PXC可以包括第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、发射控制晶体管(即第六晶体管T6和第七晶体管T7)以及存储电容器Cst。
在此,第一节点N1可以是耦接至第一晶体管T1的栅电极、存储电容器Cst、第三晶体管T3和第四晶体管T4的公共节点。
第二节点N2可以是耦接至第一晶体管T1、第二晶体管T2和第六晶体管T6的公共节点。
第一晶体管(驱动晶体管)T1的第一电极可以耦接至第二节点N2,并且第一晶体管T1的第二电极可以耦接至有机发光二极管OLED的阳极电极。第一晶体管T1的栅电极可以耦接至第一节点N1。第一晶体管T1可以响应于提供至第一节点N1的电压而控制经由有机发光二极管OLED从第一电源ELVDD流至第二电源ELVSS的驱动电流。
第二晶体管T2可以耦接在数据线和第二节点N2之间。第二晶体管T2的栅电极可以耦接至被提供有第一扫描信号GW的第一扫描线。当将第一扫描信号GW提供至第一扫描线时,第二晶体管T2可以被导通,使得数据线可以与第二节点N2耦接。因此,可以将数据电压DT提供至第二节点N2。第一扫描线可以是图1中所示的扫描线S0至Sn中的任一条。在示例性实施例中,第一扫描线可以是第i条扫描线(i是自然数)。
第三晶体管T3可以耦接在第一晶体管T1的第二电极和第一节点N1之间。第三晶体管T3的栅电极可以耦接至被提供有第一扫描信号GW的第一扫描线。当将第一扫描信号GW提供至第一扫描线时,第三晶体管T3可以被导通,使得第一晶体管T1可以以二极管的形式连接。因此,可以将提供至第二节点N2的数据电压提供至第一节点N1。在示例性实施例中,可以使用具有双栅极的晶体管来体现第三晶体管T3。
第四晶体管T4可以耦接在第三电源Vint和第一节点N1之间。第四晶体管T4的栅电极可以耦接至第二扫描线。当将第二扫描信号GI提供至第二扫描线时,第四晶体管T4可以被导通,使得可以向第一节点N1提供第三电源Vint的电压。在示例性实施例中,可以使用具有双栅极的晶体管来体现第四晶体管T4。第二扫描线可以是图1中所示的扫描线S0至Sn中的任意一条。在示例性实施例中,第二扫描线可以是第i-1条扫描线。
第五晶体管T5可以耦接在第三电源Vint和有机发光二极管OLED的阳极电极之间。第五晶体管T5的栅电极可以耦接至第三扫描线。当将第三扫描信号GB提供至第三扫描线时,第五晶体管T5可以被导通,使得可以将第三电源Vint的电压提供至有机发光二极管OLED的阳极电极。第三电源Vint的电压可以被设定为低于数据电压的电压。在示例性实施例中,第三扫描信号GB可以等于第一扫描信号GW或第二扫描信号GI。
第三扫描线可以是图1中所示的扫描线S0至Sn中的任意一个。在示例性实施例中,第三扫描线可以是第i条扫描线或第i+1条扫描线。
发射控制晶体管可以设置在驱动电流流经的路径上,并且可以响应于提供至发射控制线的发射控制信号而施加驱动电流。
例如,发射控制晶体管可以包括第六晶体管(第一发射控制晶体管)T6和第七晶体管(第二发射控制晶体管)T7。
第六晶体管T6可以耦接在第一电源ELVDD和第二节点N2之间。第六晶体管T6的栅电极可以耦接至发射控制线。当将发射控制信号EM提供至发射控制线时,第六晶体管T6可以被导通。
第七晶体管T7可以耦接在第一晶体管T1的第二电极和有机发光二极管OLED的阳极电极之间。第七晶体管T7的栅电极可以耦接至发射控制线。当将发射控制信号EM提供至发射控制线时,第七晶体管T7可以被导通。
存储电容器Cst可以耦接在第一电源ELVDD和第一节点N1之间。存储电容器Cst可以存储与数据电压和第一晶体管T1的阈值电压两者对应的电压。
在本公开中,有机发光二极管OLED可以响应于从驱动晶体管T1提供的电流的量而生成具有包括红色、绿色和蓝色的各种颜色的光,但是本公开的示例性实施例不限于此。例如,OLED可以取决于从驱动晶体管T1提供的电流的量而生成白色光。在该情形中,可以使用分离的滤色器等以体现彩色图像。
尽管图2图示了第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6和第七晶体管T7中的每一个晶体管是P型晶体管,即P沟道金属氧化物半导体(PMOS)晶体管,但是本公开的示例性实施例不限于此。在一些实施例中,第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6和第七晶体管T7中的至少一个晶体管可以被实施为N型晶体管或P型晶体管。
图3是图示了根据示例性实施例的驱动显示装置100(参照图1)的方法的信号图。
特别地,图3图示了在帧周期FP期间的第一扫描信号GW、第二扫描信号GI和发射控制信号EM。
图3图示了其中通过第i条扫描线Si(i是自然数)提供第一扫描信号GW以及通过第i-1条扫描线Si-1提供第二扫描信号GI的示例性实施例。然而,本公开不限于此。此外,为了说明的目的,因为第三扫描信号GB等同于第一扫描信号GW,所以图2的第三扫描信号GB并未分离地示出在图3中,但是本公开的示例性实施例不限于此。
参照图1、图2和图3,可以以帧周期FP为单位来驱动显示装置100。
帧周期FP可以包括非发射周期WP和发射周期EP。
在非发射周期WP期间,可以将扫描信号GI和GW顺序地提供至第i-1条扫描线Si-1和第i条扫描线Si。
在发射周期EP期间,可以将发射控制信号EM提供至第i条发射控制线Ei。
当将第二扫描信号GI提供至第i-1条扫描线Si-1时,第四晶体管T4可以被导通。
当第四晶体管T4被导通时,第一节点N1可以被初始化为第三电源Vint的电压。
此后,当将第一扫描信号GW提供至第i条扫描线Si时,第二晶体管T2、第三晶体管T3和第五晶体管T5可以被导通。
当第二晶体管T2被导通时,提供至数据线的数据电压DT可以被施加至第二节点N2。施加至第二节点N2的数据电压DT可以经由第一晶体管T1被施加至第一晶体管T1的第二电极。第一晶体管T1的阈值电压可以反映在数据电压DT中。例如,通过从数据电压DT减去第一晶体管T1的阈值电压而获得的电压可以被施加至第一晶体管T1的第二电极。
当第三晶体管T3被导通时,第一晶体管T1的第二电极的电压可以经由第三晶体管T3被施加至第一节点N1,并且存储电容器Cst可以存储第一节点N1的电压。
当第五晶体管T5被导通时,有机发光二极管OLED的阳极电极可以被初始化为第三电源Vint的电压。
在发射周期EP期间,当将发射控制信号EM提供至第i条发射控制线Ei时,第六晶体管T6和第七晶体管T7可以被导通。
如果第六晶体管T6和第七晶体管T7被导通,则驱动电流可以经由有机发光二极管OLED流动。在此,有机发光二极管OLED可以生成与驱动电流对应的光。因此,像素PX可以发光。
图4A和图4B是图示了根据示例性实施例的开关单元130的电路图。
为了说明的目的,图4A和图4B中的每一个代表性地图示了开关单元130的单位区域。因此,以下描述也可以适用于图4A和图4B中未示出的开关单元130的其他区域。
每个具有不同单个颜色的相邻像素可以被分组,并且每个组可以被定义为点。每个点可以通过不同颜色的组合来表示各种颜色。可以以点为基础来表示图像帧的图片、字符等。
参照图4A和图4B,第一点DOT1和第二点DOT2可以沿第一方向DR1布置在第一水平线上。第一水平线可以意味着第奇数条水平线。第一水平线可以对应于第一扫描线Sa。换言之,第二点DOT2可以沿第一方向DR1与第一点DOT1相邻。
第三点DOT3和第四点DOT4可以沿第一方向DR1布置在第二水平线上。第二水平线可以意味着第偶数条水平线。第二水平线可以对应于第二扫描线Sb。换言之,第四点DOT4可以沿第一方向DR1与第三点DOT3相邻。第二水平线可以沿不同于第一方向DR1的第二方向DR2而与第一水平线相邻。
第一点DOT1、第二点DOT2、第三点DOT3和第四点DOT4中的每一个可以包括第一像素PX1、第二像素PX2、第三像素PX3和第四像素PX4。
第一点DOT1的第一像素PX1、第二像素PX2、第三像素PX3和第四像素PX4可以沿第一方向DR1依次布置。
第二点DOT2的第一像素PX1、第二像素PX2、第三像素PX3和第四像素PX4可以沿第一方向DR1依次布置。
第三点DOT3的第三像素PX3、第四像素PX4、第一像素PX1和第二像素PX2可以沿第一方向DR1依次布置。
第四点DOT4的第三像素PX3、第四像素PX4、第一像素PX1和第二像素PX2可以沿第一方向DR1依次布置。
第一像素PX1可以发出第一颜色的光,第二像素PX2可以发出第二颜色的光,第三像素PX3可以发出第三颜色的光,并且第四像素PX4可以发出第四颜色的光。例如,第一颜色、第二颜色和第三颜色可以相互不同。第二颜色和第四颜色可以相互等同。在示例性实施例中,第一颜色可以是红色,第二颜色和第四颜色可以是绿色,并且第三颜色可以是蓝色。
开关单元130可以包括多个开关SW。
开关单元130可以耦接至第一输出线B1、第二输出线B2、第三输出线B3和第四输出线B4。开关单元130可以通过第一输出线B1、第二输出线B2、第三输出线B3和第四输出线B4接收对应的数据电压。
开关单元130可以接收第一控制信号CLA、第二控制信号CLB、第三控制信号CLC和第四控制信号CLD。
开关单元130可以基于第一控制信号CLA和第二控制信号CLB选择性地将第一输出线B1、第二输出线B2、第三输出线B3和第四输出线B4分别耦接至第一点DOT1和第二点DOT2中的每一个的第一像素PX1、第二像素PX2、第三像素PX3和第四像素PX4。
另外,开关单元130可以基于第三控制信号CLC和第四控制信号CLD选择性地将第一输出线B1、第二输出线B2、第三输出线B3和第四输出线B4分别耦接至第三点DOT3和第四点DOT3中的每一个的第三像素PX3、第四像素PX4、第一像素PX1和第二像素PX2。
具体地,在其中提供第一控制信号CLA的第一周期期间,开关单元130可以将第一输出线B1耦接至第一点DOT1的第一像素PX1,将第二输出线B2耦接至第一点DOT1的第二像素PX2,将第三输出线B3耦接至第一点DOT1的第三像素PX3,并且将第四输出线B4耦接至第一点DOT1的第四像素PX4。
在其中提供第二控制信号CLB的第二周期期间,开关单元130可以将第一输出线B1耦接至第二点DOT2的第三像素PX3,将第二输出线B2耦接至第二点DOT2的第二像素PX2,将第三输出线B3耦接至第二点DOT2的第一像素PX1,并且将第四输出线B4耦接至第二点DOT2的第四像素PX4。
根据图4A中所示的示例性实施例,在其中提供第三控制信号CLC的第三周期期间,开关单元130可以将第一输出线B1耦接至第三点DOT3的第一像素PX1,将第二输出线B2耦接至相邻点DOTA的第二像素PX2,将第三输出线B3耦接至第三点DOT3的第三像素PX3,将第四输出线B4耦接至第三点DOT3的第四像素PX4,并且将相邻输出线BA耦接至第四点DOT4的第二像素PX2。
在此,相邻输出线BA可以指的是沿第一方向DR1与第四输出线B4相邻设置的输出线。相邻点DOTA可以指的是设置在第二水平线上且与第三点DOT3相邻的点。第三点DOT3可以沿第一方向DR1与相邻点DOTA相邻。
根据图4B中所示的示例性实施例,在其中提供第三控制信号CLC的第三周期期间,开关单元130可以将第一输出线B1耦接至第三点DOT3的第一像素PX1,将第二输出线B2耦接至第四点DOT4的第二像素PX2,将第三输出线B3耦接至第三点DOT3的第三像素PX3,并且将第四输出线B4耦接至第三点DOT3的第四像素PX4。
根据图4A和图4B中所示的示例性实施例,在其中提供第四控制信号CLD的第四周期期间,开关单元130可以将第一输出线B1耦接至第四点DOT4的第三像素PX3,将第二输出线B2耦接至第三点DOT3的第二像素PX2,将第三输出线B3耦接至第四点DOT4的第一像素PX1,并且将第四输出线B4耦接至第四点DOT4的第四像素PX4。
除了以上描述的线条的连接关系以及与其相关的操作之外,图4A和图4B中所示的其他配置可以相互等同。
图5A和图5B是图示了根据示例性实施例的驱动显示装置的方法的信号图。图5A图示了根据图4A中所示的示例性实施例的驱动显示装置的方法,并且图5B图示了根据图4B中所示示例性实施例的驱动显示装置的方法。
参照图5A和图5B,第一水平周期HP1可以包括第一周期P1、第二周期P2和第一写入周期WP1,并且第二水平周期HP2可以包括第三周期P3、第四周期P4以及第二写入周期WP2。例如,第一周期P1、第二周期P2、第一写入周期WP1、第三周期P3、第四周期P4和第二写入周期WP2可以顺序地进行。
在示例性实施例中,第二周期P2和第一写入周期WP1可以部分地相互重叠,并且第四周期P4和第二写入周期WP2可以部分地相互重叠。
下文中,将参照图4A、图4B、图5A和图5B描述根据示例性实施例的驱动显示装置的方法。
在第一周期P1期间,第一控制信号CLA可以被提供。
在此,可以通过第一输出线B1将数据电压DT11提供至第一点DOT1的第一像素PX1。可以通过第二输出线B2将数据电压DT12提供至第一点DOT1的第二像素PX2。可以通过第三输出线B3将数据电压DT13提供至第一点DOT1的第三像素PX3。可以通过第四输出线B4将数据电压DT14提供至第一点DOT1的第四像素PX4。
在第二周期P2期间,第二控制信号CLB可以被提供。
在此,可以通过第一输出线B1将数据电压DT23提供至第二点DOT2的第三像素PX3。可以通过第二输出线B2将数据电压DT22提供至第二点DOT2的第二像素PX2。可以通过第三输出线B3将数据电压DT21提供至第二点DOT2的第一像素PX1。可以通过第四输出线B4将数据电压DT24提供至第二点DOT2的第四像素PX4。
在第一写入周期WP1期间,扫描信号可以被提供至第一扫描线Sa。
根据图5A中所示的示例性实施例,在第三周期P3期间,第三控制信号CLC可以被提供。
在此,可以通过第一输出线B1将数据电压DT31提供至第三点DOT3的第一像素PX1。可以通过第二输出线B2将数据电压DTA2提供至相邻点DOTA的第二像素PX2。可以通过第三输出线B3将数据电压DT33提供至第三点DOT3的第三像素PX3。可以通过第四输出线B4将数据电压DT34提供至第三点DOT3的第四像素PX4。可以通过相邻输出线BA将数据电压DT42提供至第四点DOT4的第二像素PX2。
根据图5B中所示的示例性实施例,在第三周期P3期间,第三控制信号CLC可以被提供。
在此,可以通过第一输出线B1将数据电压DT31提供至第三点DOT3的第一像素PX1。可以通过第二输出线B2将数据电压DT42提供至第四点DOT4的第二像素PX2。可以通过第三输出线B3将数据电压DT33提供至第三点DOT3的第三像素PX3。可以通过第四输出线B4将数据电压DT34提供至第三点DOT3的第四像素PX4。
根据图5A和图5B中所示的示例性实施例,在第四周期P4期间,第四控制信号CLD可以被提供。
在此,可以通过第一输出线B1将数据电压DT43提供至第四点DOT4的第三像素PX3。可以通过第二输出线B2将数据电压DT32提供至第三点DOT3的第二像素PX2。可以通过第三输出线B3将数据电压DT41提供至第四点DOT4的第一像素PX1。可以通过第四输出线B4将数据电压DT44提供至第四点DOT4的第四像素PX4。
在第二写入周期WP2期间,扫描信号可以被提供至第二扫描线Sb。
除了以上描述的操作之外,图5A和图5B中所示驱动显示装置的方法的其他操作可以相互等同。
图6是图示了根据示例性实施例的在第一周期期间驱动显示装置的方法的电路图。
参照图1、图2、图3、图4A、图4B、图5A、图5B和图6,在其中提供第一控制信号CLA的第一周期P1期间,开关单元130可以将第一输出线B1耦接至第一点DOT1的第一像素PX1,将第二输出线B2耦接至第一点DOT1的第二像素PX2,将第三输出线B3耦接至第一点DOT1的第三像素PX3,并且将第四输出线B4耦接至第一点DOT1的第四像素PX4。
在此,可以通过第一输出线B1将数据电压DT11提供至第一点DOT1的第一像素PX1。可以通过第二输出线B2将数据电压DT12提供至第一点DOT1的第二像素PX2。可以通过第三输出线B3将数据电压DT13提供至第一点DOT1的第三像素PX3。可以通过第四输出线B4将数据电压DT14提供至第一点DOT1的第四像素PX4。
图7是图示了根据示例性实施例的在第二周期期间驱动显示装置的方法的电路图。
参照图1、图2、图3、图4A、图4B、图5A、图5B和图7,在其中提供第二控制信号CLB的第二周期P2期间,开关单元130可以将第一输出线B1耦接至第二点DOT2的第三像素PX3,将第二输出线B2耦接至第二点DOT2的第二像素PX2,将第三输出线B3耦接至第二点DOT2的第一像素PX1,并且将第四输出线B4耦接至第二点DOT2的第四像素PX4。
在此,可以通过第一输出线B1将数据电压DT23提供至第二点DOT2的第三像素PX3。可以通过第二输出线B2将数据电压DT22提供至第二点DOT2的第二像素PX2。可以通过第三输出线B3将数据电压DT21提供至第二点DOT2的第一像素PX1。可以通过第四输出线B4将数据电压DT24提供至第二点DOT2的第四像素PX4。
图8A和图8B是图示了根据示例性实施例的在第三周期期间驱动显示装置的方法的电路图。图8A图示了根据图4A中所示示例性实施例在第三周期期间驱动显示装置的方法,并且图8B图示了根据图4B中所示示例性实施例在第三周期期间驱动显示装置的方法。
参照图1、图2、图3、图4A、图5A和图8A,在其中提供第三控制信号CLC的第三周期P3期间,开关单元130可以将第一输出线B1耦接至第三点DOT3的第一像素PX1,将第二输出线B2耦接至相邻点DOTA的第二像素,将第三输出线B3耦接至第三点DOT3的第三像素PX3,将第四输出线B4耦接至第三点DOT3的第四像素PX4,并且将相邻输出线BA耦接至第四点DOT4的第二像素PX2。
在此,可以通过第一输出线B1将数据电压DT31提供至第三点DOT3的第一像素PX1。可以通过第二输出线B2将数据电压DTA2提供至相邻点DOTA的第二像素PX2。可以通过第三输出线B3将数据电压DT33提供至第三点DOT3的第三像素PX3。可以通过第四输出线B4将数据电压DT34提供至第三点DOT3的第四像素PX4。可以通过相邻输出线BA将数据电压DT42提供至第四点DOT4的第二像素PX2。
参照图1、图2、图3、图4B、图5B和图8B,在其中提供第三控制信号CLC的第三周期P3期间,开关单元130可以将第一输出线B1耦接至第三点DOT3的第一像素PX1,将第二输出线B2耦接至第四点DOT4的第二像素PX2,将第三输出线B3耦接至第三点DOT3的第三像素PX3,并且将第四输出线B4耦接至第三点DOT3的第四像素PX4。
在此,可以通过第一输出线B1将数据电压DT31提供至第三点DOT3的第一像素PX1。可以通过第二输出线B2将数据电压DT42提供至第四点DOT4的第二像素PX2。可以通过第三输出线B3将数据电压DT33提供至第三点DOT3的第三像素PX3。可以通过第四输出线B4将数据电压DT34提供至第三点DOT3的第四像素PX4。
图9是图示了根据示例性实施例的在第四周期期间驱动显示装置的方法的电路图。
参照图1、图2、图3、图4A、图4B、图5A、图5B和图9,在其中提供第四控制信号CLD的第四周期P4期间,开关单元130可以将第一输出线B1耦接至第四点DOT4的第三像素PX3,将第二输出线B2耦接至第三点DOT3的第二像素PX2,将第三输出线B3耦接至第四点DOT4的第一像素PX1,并且将第四输出线B4耦接至第四点DOT4的第四像素PX4。
在此,可以通过第一输出线B1将数据电压DT43提供至第四点DOT4的第三像素PX3。可以通过第二输出线B2将数据电压DT32提供至第三点DOT3的第二像素PX2。可以通过第三输出线B3将数据电压DT41提供至第四点DOT4的第一像素PX1。可以通过第四输出线B4将数据电压DT44提供至第四点DOT4的第四像素PX4。
图10是图示了根据示例性实施例的数据驱动器120的框图。
参照图1、图2、图3、图4A、图4B、图5A、图5B、图6、图7、图8A、图8B、图9和图10,数据驱动器120可以包括数据处理单元DPU,第一数字模拟转换器(DAC)121、第二DAC 122、第三DAC 123和第四DAC 124,以及输出缓冲器OB。
数据处理单元(也称作数据处理器)DPU可以接收第二数据IDAT2。数据处理单元DPU可以并行处理第二数据IDAT2,并将并行处理的第二数据IDAT2分配至第一输出线B1、第二输出线B2、第三输出线B3和第四输出线B4。
第一DAC 121、第二DAC 122、第三DAC 123和第四DAC 124可以将并行处理的数字数据信号转换为模拟数据电压。
第一DAC 121、第二DAC 122、第三DAC 123和第四DAC 124中的每一个可以被提供有第一伽马电压至第四伽马电压中的对应一个。在此,第一伽马电压可以对应于第一颜色,第二伽马电压可以对应于第二颜色,第三伽马电压可以对应于第三颜色,并且第四伽马电压可以对应于第四颜色。
具体地,第一DAC 121可以使用第一伽马电压将数据信号转换为数据电压。第二DAC 122可以使用第二伽马电压将数据信号转换为数据电压。第三DAC 123可以使用第三伽马电压将数据信号转换为数据电压。第四DAC 124可以使用第四伽马电压将数据信号转换为数据电压。
例如,在第一周期P1期间,第一DAC 121可以将待施加至第一点DOT1的第一像素PX1的数据电压DT11提供至第一输出线B1。第二DAC 122可以将待施加至第一点DOT1的第二像素PX2的数据电压DT12提供至第二输出线B2。第三DAC 123可以将待施加至第一点DOT1的第三像素PX3的数据电压DT13提供至第三输出线B3。第四DAC 124可以将待施加至第一点DOT1的第四像素PX4的数据电压DT14提供至第四输出线B4。
在第二周期P2期间,第一DAC 121可以将待施加至第二点DOT2的第三像素PX3的数据电压DT23提供至第一输出线B1。第二DAC 122可以将待施加至第二点DOT2的第二像素PX2的数据电压DT22提供至第二输出线B2。第三DAC 123可以将待施加至第二点DOT2的第一像素PX1的数据电压DT21提供至第三输出线B3。第四DAC 124可以将待施加至第二点DOT2的第四像素PX4的数据电压DT24提供至第四输出线B4。
在第三周期P3期间,第一DAC 121可以将待施加至第三点DOT3的第一像素PX1的数据电压DT31提供至第一输出线B1。第二DAC 122可以将待施加至相邻点DOTA的第二像素PX2(参照图4A)的数据电压DTA2提供至第二输出线B2,或者将待施加至第四点DOT4的第二像素PX2(参照图4B)的数据电压DT42提供至第二输出线B2。第三DAC 123可以将待施加至第三点DOT3的第三像素PX3的数据电压DT33提供至第三输出线B3。第四DAC 124可以将待施加至第三点DOT3的第四像素PX4的数据电压DT34提供至第四输出线B4。
在第四周期P4期间,第一DAC 121可以将待施加至第四点DOT4的第三像素PX3的数据电压DT43提供至第一输出线B1。第二DAC 122可以将待施加至第三点DOT3的第二像素PX2的数据电压DT32提供至第二输出线B2。第三DAC 123可以将待施加至第四点DOT4的第一像素PX1的数据电压DT41提供至第三输出线B3。第四DAC 124可以将待施加至第四点DOT4的第四像素PX4的数据电压DT44提供至第四输出线B4。
输出缓冲器OB可以接收数据电压并所接收的电压施加至第一输出线B1、第二输出线B2、第三输出线B3和第四输出线B4。例如,输出缓冲器OB可以按比例放大数据电压,并将按比例放大的数据电压施加至第一输出线B1、第二输出线B2、第三输出线B3和第四输出线B4。
因为数据驱动器120以上述方式被驱动,所以适用于各自像素的颜色的数据电压可以被分配至第一输出线B1、第二输出线B2、第三输出线B3和第四输出线B4。
根据示例性实施例的包括以五格型结构布置的像素PX的显示装置100的第一DAC121、第二DAC 122、第三DAC 123和第四DAC 124中的每一个可以关于对应的单个颜色而使用伽马电压连续地执行数字-模拟转换操作。因此,无需分离的伽马电压切换操作,由此可以减小功耗,并且可以简化逻辑。
此外,在根据示例性实施例的具有其中两条数据线设置在两个相邻像素之间的结构的显示装置中,可以防止数据线之间串扰或者或减小数据线之间串扰的生成。
尽管已经在本文描述了某些示例性实施例和实施方式,但是其他实施例和修改将从这个描述变得明显。因此,本发明构思不限于这些实施例,而是由所附权利要求的更宽范围以及对于本领域普通技术人员明显的各种显而易见的修改和等效布置来限定。

Claims (20)

1.一种显示装置,包括:
第一点和第二点,沿第一方向布置在第一水平线上,所述第一点和所述第二点中的每一个包括沿所述第一方向依次布置的第一像素、第二像素、第三像素和第四像素;以及
开关单元,被配置为响应于第一控制信号和第二控制信号而选择性地将第一输出线、第二输出线、第三输出线和第四输出线分别耦接至所述第一点和所述第二点中的每一个的所述第一像素、所述第二像素、所述第三像素和所述第四像素,
其中,在第一周期期间,响应于接收所述第一控制信号,所述开关单元被配置为:将所述第一输出线耦接至所述第一点的所述第一像素;将所述第二输出线耦接至所述第一点的所述第二像素;将所述第三输出线耦接至所述第一点的所述第三像素;并且将所述第四输出线耦接至所述第一点的所述第四像素,并且
其中,在第二周期期间,响应于接收所述第二控制信号,所述开关单元被配置为:将所述第一输出线耦接至所述第二点的所述第三像素;将所述第二输出线耦接至所述第二点的所述第二像素;将所述第三输出线耦接至所述第二点的所述第一像素;并且将所述第四输出线耦接至所述第二点的所述第四像素。
2.根据权利要求1所述的显示装置,其中,所述第一像素被配置为发出第一颜色的光,所述第二像素被配置为发出第二颜色的光,所述第三像素被配置为发出第三颜色的光,所述第四像素被配置为发出第四颜色光,并且
其中所述第一颜色、所述第二颜色和所述第三颜色相互不同。
3.根据权利要求2所述的显示装置,其中,所述第一颜色是红色,所述第二颜色和所述第四颜色是绿色,并且所述第三颜色是蓝色。
4.根据权利要求1所述的显示装置,进一步包括:沿所述第一方向布置在第二水平线上的第三点第四点,所述第三点和所述第四点中的每一个包括沿所述第一方向依次布置的所述第三像素、所述第四像素、所述第一像素和所述第二像素,
其中所述第二水平线沿第二方向与所述第一水平线相邻,所述第二方向不同于所述第一方向。
5.根据权利要求4所述的显示装置,
其中,在第三周期期间,响应于接收第三控制信号,所述开关单元被配置为:将所述第一输出线耦接至所述第三点的所述第一像素;将所述第二输出线耦接至相邻点的第二像素;将所述第三输出线耦接至所述第三点的所述第三像素;并且将所述第四输出线耦接至所述第三点的所述第四像素,
其中,在第四周期期间,响应于接收第四控制信号,所述开关单元被配置为:将所述第一输出线耦接至所述第四点的所述第三像素;将所述第二输出线耦接至所述第三点的所述第二像素;将所述第三输出线耦接至所述第四点的所述第一像素;并且将所述第四输出线耦接至所述第四点的所述第四像素,并且
其中,所述相邻点沿所述第一方向与所述第三点相邻布置。
6.根据权利要求4所述的显示装置,
其中,在第三周期期间,响应于接收第三控制信号,所述开关单元被配置为:将所述第一输出线耦接至所述第三点的所述第一像素;将所述第二输出线耦接至所述第四点的所述第二像素;并且将所述第三输出线耦接至所述第三点的所述第三像素,并且
其中,在第四周期期间,响应于接收第四控制信号,所述开关单元被配置为将所述第一输出线耦接至所述第四点的所述第三像素;将所述第二输出线耦接至所述第三点的所述第二像素;将所述第三输出线耦接至所述第四点的所述第一像素;并且将所述第四输出线耦接至所述第四点的所述第四像素。
7.根据权利要求6所述的显示装置,进一步包括:扫描驱动器,所述扫描驱动器被配置为:在第一写入周期期间将第一扫描信号提供至所述第一点和所述第二点;并且在第二写入周期期间将第二扫描信号提供至所述第三点和所述第四点,
其中所述第一周期、所述第二周期、所述第一写入周期、所述第三周期、所述第四周期和所述第二写入周期顺序地进行。
8.根据权利要求7所述的显示装置,
其中所述第二周期和第一写入周期部分地相互重叠,并且
其中所述第四周期和第二写入周期部分地相互重叠。
9.根据权利要求1所述的显示装置,进一步包括:数据驱动器,所述数据驱动器被配置为以分时共享方式将数据电压提供至所述第一输出线、所述第二输出线、所述第三输出线和所述第四输出线。
10.根据权利要求9所述的显示装置,其中,所述数据驱动器包括:
数据处理器,被配置为基于第二数据生成与所述第一输出线、所述第二输出线、所述第三输出线和所述第四输出线对应的数据信号;以及
第一数字模拟转换器DAC、第二DAC、第三DAC和第四DAC,被配置为将所述数据信号转换为数据电压,
其中所述第一DAC至所述第四DAC中的每一个被提供有第一伽马电压至第四伽马电压中的对应一个。
11.根据权利要求10所述的显示装置,其中,在所述第一周期期间,所述第一DAC被配置为将待施加至所述第一点的所述第一像素的数据电压提供至所述第一输出线,所述第二DAC被配置为将待施加至所述第一点的所述第二像素的数据电压提供至所述第二输出线,所述第三DAC被配置为将待施加至所述第一点的所述第三像素的数据电压提供至所述第三输出线,并且所述第四DAC被配置为将待施加至所述第一点的所述第四像素的数据电压提供至所述第四输出线,并且
其中,在所述第二周期期间,所述第一DAC被配置为将待施加至所述第二点的所述第三像素的数据电压提供至所述第一输出线,所述第二DAC被配置为将待施加至所述第二点的所述第二像素的数据电压提供至所述第二输出线,所述第三DAC被配置为将待施加至所述第二点的所述第一像素的数据电压提供至所述第三输出线,并且所述第四DAC被配置为将待施加至所述第二点的第四像素的数据电压提供至所述第四输出线。
12.根据权利要求1所述的显示装置,进一步包括时序控制器,所述时序控制器被配置为将所述第一控制信号和所述第二控制信号提供至所述开关单元。
13.一种显示装置,包括:
第一点和第二点,沿第一方向布置在第一水平线上,所述第一点和所述第二点中的每一个包括第一像素、第二像素、第三像素和第四像素;
开关单元,被配置为响应于第一控制信号和第二控制信号而选择性地将第一输出线、第二输出线、第三输出线和第四输出线分别耦接至所述第一点和所述第二点中的每一个的所述第一像素、所述第二像素、所述第三像素和所述第四像素;以及
数据驱动器,被配置为以分时共享方式将数据电压提供至所述第一输出线至所述第四输出线,
其中所述数据驱动器包括:
数据处理器,被配置为生成与所述第一输出线至所述第四输出线对应的数据信号;以及
第一数字模拟转换器DAC、第二DAC、第三DAC和第四DAC,被配置为将所述数据信号转换为所述数据电压,
其中所述第一DAC至所述第四DAC中的每一个被提供有第一伽马电压至第四伽马电压中的对应一个。
14.根据权利要求13所述的显示装置,其中,响应于在第一周期期间接收所述第一控制信号,
所述第一DAC被配置为将待施加至所述第一点的所述第一像素的数据电压提供至所述第一输出线,
所述第二DAC被配置为将待施加至所述第一点的所述第二像素的数据电压提供至所述第二输出线,
所述第三DAC被配置为将待施加至所述第一点的所述第三像素的数据电压提供至所述第三输出线,并且
所述第四DAC被配置为将待施加至所述第一点的所述第四像素的数据电压提供至所述第四输出线。
15.根据权利要求14所述的显示装置,其中,响应于在第二周期期间接收所述第二控制信号,
所述第一DAC被配置为将待施加至所述第二点的所述第三像素的数据电压提供至所述第一输出线,
所述第二DAC被配置为将待施加至所述第二点的所述第二像素的数据电压提供至所述第二输出线,
所述第三DAC被配置为将待施加至所述第二点的所述第一像素的数据电压提供至所述第三输出线,并且
所述第四DAC被配置为将待施加至所述第二点的所述第四像素的数据电压提供至所述第四输出线。
16.一种显示装置,包括:
第一点和第二点,沿第一方向布置在第一水平线上,所述第一点和第二点中的每一个包括沿所述第一方向依次布置的第一像素、第二像素和第三像素;
第三点和第四点,沿所述第一方向布置在第二水平线上,所述第三点和第四点中的每一个包括沿所述第一方向依次布置的所述第三像素、所述第一像素和所述第二像素;
开关单元,被配置为响应于在第一周期期间所提供的第一控制信号和在第二周期期间所提供的第二控制信号而选择性地将第一输出线、第二输出线和第三输出线分别耦接至所述第一点和所述第二点中的每一个的所述第一像素、所述第二像素和所述第三像素;以及
数据驱动器,被配置为以分时共享方式提供数据电压至所述第一输出线至所述第三输出线,所述数据驱动器包括:
数据处理器,被配置为生成与所述第一输出线至所述第三输出线对应的数据信号;以及
第一数字模拟转换器DAC、第二DAC和第三DAC,被配置为将所述数据信号转换为所述数据电压,
其中所述第一DAC至所述第三DAC中的每一个被提供有第一伽马电压至第三伽马电压中的对应一个,
其中所述第二水平线沿第二方向与所述第一水平线相邻,所述第二方向不同于所述第一方向,
其中所述第一像素被配置为发出第一颜色的光,所述第二像素被配置为发出第二颜色的光,所述第三像素被配置为发出第三颜色的光,
并且其中所述第一颜色、所述第二颜色和所述第三颜色相互不同。
17.根据权利要求16所述的显示装置,其中,在所述第一周期期间,所述第一DAC被配置为将待施加至所述第一点的所述第一像素的数据电压提供至所述第一输出线,所述第二DAC被配置为将待施加至所述第一点的所述第二像素的数据电压提供至所述第二输出线,并且所述第三DAC被配置为将待施加至所述第一点的所述第三像素的数据电压提供至所述第三输出线,并且
其中所述开关单元被配置为将所述第一输出线耦接至所述第一点的所述第一像素,将所述第二输出线耦接至所述第一点的所述第二像素,并且将所述第三输出线耦接至所述第一点的所述第三像素。
18.根据权利要求17所述的显示装置,其中,在所述第二周期期间,所述第一DAC被配置为将待施加至所述第二点的所述第三像素的数据电压提供至所述第一输出线,所述第二DAC被配置为将待施加至所述第二点的所述第二像素的数据电压提供至所述第二输出线,并且所述第三DAC被配置为将待施加至所述第二点的所述第一像素的数据电压提供至所述第三输出线,并且
其中所述开关单元被配置为将所述第一输出线耦接至所述第二点的所述第三像素,将所述第二输出线耦接至所述第二点的所述第二像素,并且将所述第三输出线耦接至所述第二点的所述第一像素。
19.根据权利要求18所述的显示装置,其中,在其中提供第三控制信号的第三周期期间,所述第一DAC被配置为将待施加至所述第三点的所述第一像素的数据电压提供至所述第一输出线,所述第二DAC被配置为将待施加至相邻点的第二像素的数据电压提供所述第二输出线,并且所述第三DAC被配置为将待施加至所述第三点的所述第三像素的数据电压提供至所述第三输出线,
其中所述开关单元被配置为将所述第一输出线耦接至所述第三点的所述第一像素,将所述第二输出线耦接至所述相邻点的所述第二像素,并且将所述第三输出线耦接至所述第三点的所述第三像素,并且
其中所述相邻点沿所述第一方向与所述第三点相邻布置。
20.根据权利要求18所述的显示装置,其中,在其中提供第三控制信号的第三周期期间,所述第一DAC被配置为将待施加至所述第三点的所述第一像素的数据电压提供至所述第一输出线,所述第二DAC被配置为将待施加至所述第四点的所述第二像素的数据电压提供至所述第二输出线,并且所述第三DAC被配置为将待施加至所述第三点的所述第三像素的数据电压提供至所述第三输出线,并且
其中所述开关单元被配置为将所述第一输出线耦接至所述第三点的所述第一像素,将所述第二输出线耦接至所述第四点的所述第二像素,并且将所述第三输出线耦接至所述第三点的所述第三像素。
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