CN110827763B - 像素电路及其驱动方法、显示装置 - Google Patents

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Abstract

本发明提供一种像素电路及其驱动方法、显示装置，通过通过设计一种像素结构和侦测时序，在显示装置关机期间可侦测和储存驱动晶体管的初始阈值电压，根据侦测结果在下一开机期间读取对驱动晶体管的实际阈值电压进行实时内部补偿，并对驱动晶体管的迁移率进行侦测和储存，能够改善显示不均现象。

Description

像素电路及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素电路及其驱动方法、显示装置。
背景技术
有机发光二极管(organic light emitting diode，OLED)显示装置，是一种利用有机发光材料在电场驱动下发生载流子注入和复合而发光的显示装置，具有自发光、广视角、高对比度、低耗电、高反应速度等优点，然而，由于制造工艺和特性漂移的影响，每个像素的驱动晶体管(thin film transistor，TFT)的电气特性存在差异，而驱动晶体管在空间上电气特性差异和时间上的特性漂移都会造成OLED显示装置出现显示不均的现象。
目前现有技术中对驱动晶体管阈值电压漂移常用的补偿方法有两种：内部补偿和外部补偿，然而，外部补偿方法只能在OLED显示装置关机期间补偿驱动晶体管的电气特性，而在OLED显示装置工作过程中，对驱动晶体管阈值电压漂移无法进行实时补偿。
综上所述，需要提供一种新的像素电路及其驱动方法、显示装置，来解决上述技术问题。
发明内容
本发明提供一种像素电路及其驱动方法、显示装置，解决了现有的像素电路及其驱动方法在显示装置开机期间无法对驱动晶体管阈值电压漂移进行实时补偿，从而导致显示不均的技术问题。
为解决上述问题，本发明提供的技术方案如下：
本发明实施例提供一种像素电路，所述像素电路与外部补偿单元连接；
所述外部补偿单元用于侦测和储存所述像素电路的驱动晶体管的初始阈值电压；
所述初始阈值电压与所述像素电路的显示数据信号进行叠加以得到叠加数据信号，并将所述叠加数据信号输入至所述像素电路中，所述像素电路根据所述叠加数据信号对所述驱动晶体管的实际阈值电压进行内部补偿，并进行侦测和储存所述驱动晶体管的迁移率。
根据本发明实施例提供的像素电路，所述像素电路包括所述驱动晶体管、第一晶体管、第二晶体管、第三晶体管、第四晶体管、存储电容以及发光元件；
所述驱动晶体管的控制端连接所述第一晶体管的第二端和所述第三晶体管的第一端，所述驱动晶体管的第一端连接所述第二晶体管的第一端，所述驱动晶体管的第二端连接所述第三晶体管的第二端和所述第四晶体管的第一端；所述第一晶体管的控制端连接第一扫描信号，所述第一晶体管的第一端连接数据线；所述第二晶体管的控制端连接第二扫描信号，所述第二晶体管的第二端连接感测线；所述第三晶体管的控制端连接第三扫描信号；所述第四晶体管的控制端连接第四扫描信号，所述第四晶体管的第二端连接第一电源信号；所述存储电容的第一端连接所述驱动晶体管的控制端，所述存储电容的第二端连接所述第二晶体管的第一端；所述发光元件的阳极端连接所述驱动晶体管的第一端，所述发光元件的阴极端连接第二电源信号；
其中，所述感测线的第一端连接初始电压信号和所述外部补偿单元，所述感测线的第二端连接所述第二晶体管的第二端。
根据本发明实施例提供的像素电路，所述像素电路还包括第一开关和第二开关，所述第一开关的第一端连接所述初始电压信号，所述第一开关的第二端连接所述感测线；所述第二开关的第一端连接所述外部补偿单元，所述第二开关的第二端连接所述感测线。
根据本发明实施例提供的像素电路，所述驱动晶体管、所述第一晶体管、所述第二晶体管、所述第三晶体管以及所述第四晶体管均为N型薄膜晶体管。
本发明实施例提供一种显示装置，包括上述像素电路。
本发明实施例提供一种像素电路的驱动方法，包括以下步骤：
步骤S10：在关机段，所述外部补偿单元侦测和储存所述驱动晶体管的初始阈值电压；以及
步骤S20：在开机段，将所述初始阈值电压与所述像素电路的显示数据信号进行叠加以得到一叠加数据信号，并将所述叠加信号输入至所述像素电路中，在每一帧时间内，所述像素电路根据所述叠加数据信号对所述驱动晶体管的实际阈值电压进行内部补偿，并进行侦测和储存所述驱动晶体管的迁移率。
根据本发明实施例提供的像素电路的驱动方法，步骤S20中，所述像素电路对所述驱动晶体管的所述实际阈值电压进行内部补偿，包括复位阶段、侦测阶段、电压写入阶段以及发光阶段。
根据本发明实施例提供的像素电路的驱动方法，所述复位阶段：所述第一扫描信号和所述第二扫描信号提供高电平，所述第三扫描信号和所述第四扫描信号提供低电平，初始电压信号接入所述感测线，所述数据线接入参考电压信号，所述驱动晶体管、所述第一晶体管以及所述第二晶体管打开，所述第三晶体管和所述第四晶体管关闭；
所述侦测阶段：所述第一扫描信号和所述第三扫描信号提供高电平，所述第二扫描信号和所述第四扫描信号提供低电平，所述数据线接入所述参考电压信号，所述驱动晶体管、所述第一晶体管以及所述第三晶体管打开，所述第二晶体管和所述第四晶体管关闭；
所述电压写入阶段：所述第一扫描信号和所述第四扫描信号提供高电平，所述第二扫描信号和所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号和所述初始阈值电压进行叠加后得到的所述叠加数据信号，所述驱动晶体管、所述第一晶体管以及所述第四晶体管打开，所述第二晶体管和所述第三晶体管关闭；以及
所述发光阶段：所述第四扫描信号提供高电平，所述第一扫描信号、所述第二扫描信号以及所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号，所述驱动晶体管和所述第四晶体管打开，所述第一晶体管、所述第二晶体管以及所述第三晶体管关闭，所述驱动晶体管驱动所述发光元件发光。
根据本发明实施例提供的像素电路的驱动方法，步骤S20中，侦测和储存所述驱动晶体管的迁移率，包括第一迁移率侦测阶段、第二迁移率侦测阶段以及第三迁移率侦测阶段，其中：
所述第一迁移率侦测阶段：所述第一扫描信号、所述第二扫描信号以及所述第四扫描信号提供高电平，所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号和所述初始阈值电压进行叠加后得到的所述叠加数据信号，初始电压信号接入感测线，所述驱动晶体管、所述第一晶体管、所述第二晶体管以及所述第四晶体管打开，所述第三晶体管关闭；
所述第二迁移率侦测阶段：所述第二扫描信号和所述第四扫描信号提供高电平，所述第一扫描信号和所述第三扫描信号提供低电平，数据线接入所述参考电压信号，所述驱动晶体管、所述第二晶体管以及所述第四晶体管打开，所述第一晶体管和所述第三晶体管关闭；以及
所述第三迁移率侦测阶段：所述第二扫描信号和所述第四扫描信号提供高电平，所述第一扫描信号和所述第三扫描信号提供低电平，所述数据线接入所述初始电压信号，所述外部补偿单元接入所述感测线，所述驱动晶体管、所述第二晶体管以及所述第四晶体管打开，所述第一晶体管和所述第三晶体管关闭。
根据本发明实施例提供的像素电路的驱动方法，步骤S10中，所述外部补偿单元侦测和储存所述驱动晶体管的阈值电压，包括第一初始阈值电压侦测阶段、第二初始阈值电压侦测阶段以及第三初始阈值电压侦测阶段，其中：
所述第一初始阈值电压侦测阶段：所述第二扫描信号和所述第四扫描信号提供高电平，所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号，初始电压信号接入所述感测线，所述驱动晶体管、所述第一晶体管、所述第二晶体管以及所述第四晶体管打开，所述第三晶体管关闭；
所述第二初始阈值电压侦测阶段：所述第二扫描信号和所述第四扫描信号提供高电平，所述第一扫描信号和所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号，所述驱动晶体管、所述第二晶体管以及所述第四晶体管打开，所述第一晶体管和所述第三晶体管关闭；以及
所述第三初始阈值电压侦测阶段：所述第二扫描信号和所述第四扫描信号提供高电平，所述第一扫描信号和所述第三扫描信号提供低电平，所述数据线接入显示数据信号，所述外部补偿单元接入所述感测线，所述驱动晶体管、所述第二晶体管以及所述第四晶体管打开，所述第一晶体管和所述第三晶体管关闭。
本发明的有益效果为：本发明提供的像素电路及其驱动方法、显示装置，通过设计一种像素结构和侦测时序，在显示装置关机期间可侦测和储存驱动晶体管的初始阈值电压，根据侦测结果在下一开机期间读取对驱动晶体管的实际阈值电压进行实时内部补偿，并对驱动晶体管的迁移率进行侦测和储存，能够改善显示不均现象。
附图说明
为了更清楚地说明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单介绍，显而易见地，下面描述中的附图仅仅是发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明实施例提供的一种像素电路的结构示意图；
图2为本发明实施例提供的一种像素电路的驱动方法的流程图；
图3为本发明实施例提供的一种像素电路的时序图；
图4A为本发明实施例提供的一种像素电路复位阶段的结构示意图；
图4B为本发明实施例提供的一种像素电路侦测阶段的结构示意图；
图4C为本发明实施例提供的一种像素电路电压写入阶段的结构示意图；
图4D为本发明实施例提供的一种像素电路发光阶段的结构示意图。
具体实施方式
以下各实施例的说明是参考附加的图示，用以例示本发明可用以实施的特定实施例。本发明所提到的方向用语，例如[上]、[下]、[前]、[后]、[左]、[右]、[内]、[外]、[侧面]等，仅是参考附加图式的方向。因此，使用的方向用语是用以说明及理解本发明，而非用以限制本发明。在图中，结构相似的单元是用以相同标号表示。
本发明针对现有技术的像素电路及其驱动方法、显示装置，在显示装置开机期间对驱动晶体管阈值电压漂移无法进行实时补偿，从而导致显示不均，本实施例能够解决该缺陷。
如图1所示，本发明实施例提供的像素电路与外部补偿单元连接，所述外部补偿单元用于侦测和储存所述像素电路的驱动晶体管DT的初始阈值电压Vth0；所述初始阈值电压Vth0与所述像素电路的显示数据信号Vdata进行叠加以得到一叠加数据信号，并将所述叠加数据信号输入至所述像素电路中，所述像素电路根据所述叠加数据信号对所述驱动晶体管DT的实际阈值电压Vth进行内部补偿，并进行侦测和储存所述驱动晶体管DT的迁移率。
具体地，所述像素电路包括驱动晶体管DT、第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、存储电容Cst以及发光元件：所述驱动晶体管DT的控制端连接所述第一晶体管T1的第二端和所述第三晶体管T3的第一端，所述驱动晶体管DT的第一端连接所述第二晶体管T2的第一端，所述驱动晶体管DT的第二端连接所述第三晶体管T3的第二端和所述第四晶体管T4的第一端；所述第一晶体管T1的控制端连接第一扫描信号S1，所述第一晶体管T1的第一端连接数据线data；所述第二晶体管T2的控制端连接第二扫描信号S2，所述第二晶体管T2的第二端连接感测线sense；所述第三晶体管T3的控制端连接第三扫描信号S3；所述第四晶体管T4的控制端连接第四扫描信号S4，所述第四晶体管T4的第二端连接第一电源信号VDD；所述存储电容Cst的第一端连接所述驱动晶体管DT的控制端，所述存储电容Cst的第二端连接所述第二晶体管T2的第一端；所述发光元件的阳极端连接所述驱动晶体管DT的第一端，所述发光元件的阴极端连接第二电源信号VSS；所述感测线sense的第一端连接初始电压信号Vini和外部补偿单元，所述感测线sense的第二端连接所述第二晶体管T2的第二端。
需要说明的是，本发明实施例中的晶体管的控制端、第一端以及第二端分别为晶体管的栅极、源极和漏极，且第一端和第二端可以互换；在所述驱动晶体管DT的控制端形成第一节点G，在所述驱动晶体管DT的第一端形成第二节点S。
在本发明实施例中，所述发光元件为有机发光二极管。
可选的，所述像素电路还包括第一开关S1和第二开关S2，所述第一开关S1的第一端连接所述初始电压信号Vini，所述第一开关S1的第二端连接所述感测线sense；所述第二开关S2的第一端连接所述外部补偿单元，所述第二开关S2的第二端连接所述感测线sense，可通过控制所述第一开关和所述第二开关的闭合和断开，控制所述像素电路与所述初始电压信号Vini或所述外部补偿单元连接。
可选地，所述外部补偿单元包括依次连接的模数转换器、电流比较器、控制模块、存储器以及数模转换器，所述模数转换器的输入端连接所述感测线，所述数模转换器的输出端连接所述第一晶体管T1的第一端，以连接所述数据线data，其中，所述模数转换器用于将所述感测线sense上的模拟信号转换为数字信号；所述存储器用于存储补偿数据；所述数模转换器用于将所述补偿数据转换为模拟补偿信号，并将所述模拟补偿信号补偿到数据线data中。
具体地，所述驱动晶体管DT、第一晶体管T1、第二晶体管T2、第三晶体管T3以及第四晶体管T4均为N型薄膜晶体管。
具体地，所述第一扫描信号S1、第二扫描信号S2、第三扫描信号S3以及第四扫描信号S4均由外部时序控制器提供。
如图2、图3所示，本发明实施例的所述像素电路的驱动方法，应用于上述像素电路，可以理解的是，应用所述像素电路的显示装置包括多个由关机段和有开机段组成的循环周期，所述像素电路的驱动方法包括以下步骤：
步骤S10：在关机段，所述外部补偿单元侦测和储存所述驱动晶体管DT的初始阈值电压Vth0；
步骤S20：将所述初始阈值电压Vth0与所述像素电路的显示数据信号Vdata进行叠加以得到一叠加数据信号，并将所述叠加信号输入至所述像素电路中，在每一帧时间内，所述像素电路根据所述叠加数据信号对所述驱动晶体管DT的实际阈值电压Vth进行内部补偿，并进行侦测和储存所述驱动晶体管DT的迁移率K。
具体地，步骤S20中，在每一帧时间内，所述像素电路根据所述叠加数据信号对所述驱动晶体管DT的实际阈值电压Vth进行内部补偿的工作过程均包括复位阶段、侦测阶段、电压写入阶段以及发光阶段，其中：
所述复位阶段：结合图3、图4A所示，在t1时间段，第一扫描信号S1和第二扫描信号S2提供高电平，第三扫描信号S3和第四扫描信号S4提供低电平，所述第一开关S1闭合，所述第二开关S2断开，以使所述初始电压信号Vini接入所述感测线sense，数据线data接入参考电压信号Vref，驱动晶体管DT、第一晶体管T1和第二晶体管T2打开，第三晶体管T3和第四晶体管T4关闭，第一节点G写入参考电压信号Vref，第二节点S写入初始电压信号Vini。
所述侦测阶段：结合图3、图4B所示，在t2时间段，第一扫描信号S1和第三扫描信号S3提供高电平，第二扫描信号S2和第四扫描信号S4提供低电平，数据线data接入参考电压信号Vref，驱动晶体管DT、第一晶体管T1和第三晶体管T3打开，第二晶体管T2和第四晶体管T4关闭，第一节点G写入参考电压信号Vref，储存电容Cst通过所述第四晶体管放电，第二节点S的电位抬升，因此第二节点S的电压转变为Vref-Vth，其中Vth为开机段的所述驱动晶体管DT的所述实际阈值电压。
所述电压写入阶段：结合图3、图4C所示，在t3时间段，第一扫描信号S1和第四扫描信号S4提供高电平，第二扫描信号S2和第三扫描信号S3提供低电平，数据线data接入所述显示数据信号Vdata和所述初始阈值电压Vth0进行叠加后得到的所述叠加数据信号，驱动晶体管DT、第一晶体管T1和第四晶体管T4打开，第二晶体管T2和第三晶体管T3关闭，第一节点G写入Vdata+Vth0，第二节点S的电压保持不变，为Vref-Vth，所述驱动晶体管DT的栅极与源极之间的电压即为第一节点G和第二节点S的电压差，为Vgs＝Vdata-Vref+Vth+Vth0，其中，Vth0为关机段侦测到的所述驱动晶体管DT的所述初始阈值电压Vth0。
具体地，所述参考电压信号Vref的高电位低于所述显示数据信号Vdata的高电位。
所述发光阶段：结合图3、图4D所示，在t4时间段，第四扫描信号S4提供高电平，第一扫描信号S1、第二扫描信号S2和第三扫描信号S3提供低电平，数据线data接入所述显示数据电压Vdata，驱动晶体管DT和第四晶体管T4打开，第一晶体管T1、第二晶体管T2和第三晶体管T3关闭，所述驱动晶体管DT驱动所述发光元件发光。
已知的，计算流经所述发光元件的电流的公式为IOLED＝k(Vgs–Vth)^2＝k(Vdata-Vref+Vth0)^2。
由此可见，流经所述发光元件的电流与所述驱动晶体管DT在开机段的实际阈值电压Vth无关，能够有效实时补偿驱动晶体管DT的阈值电压变化，且由于内部补偿方式，补偿速度快，能够保证所述发光元件的发光亮度均匀，改善画面的显示效果。
具体地，步骤S20中，所述驱动晶体管DT的实际阈值电压Vth进行内部补偿之后，对所述驱动晶体管DT的迁移率k进行侦测和储存，包括第一侦测k值阶段、第二k值侦测阶段以及第三k值侦测阶段，其中：
所述第一k值侦测阶段：第一扫描信号S1、第二扫描信号S2以及第四扫描信号S4提供高电平，第三扫描信号S3提供低电平，数据线data接入所述显示数据信号Vdata和所述初始阈值电压Vth0进行叠加后得到的所述叠加数据信号，第一开关S1闭合，第二开关S2断开，以使初始电压信号Vini接入感测线sense，驱动晶体管DT、第一晶体管T1、第二晶体管T2和第四晶体管T4打开，第三晶体管T3关闭，第一节点G的电位Vdata+Vth0，第二节点S写入初始电压信号Vini。
所述第二k值侦测阶段：第二扫描信号S2和第四扫描信号S4提供高电平，第一扫描信号S1和第三扫描信号S3提供低电平，数据线data接入参考电压信号Vref，驱动晶体管DT、第二晶体管T2和第四晶体管T4打开，第一晶体管T1和第三晶体管T3关闭。
所述第三k值侦测阶段：第二扫描信号S2和第四扫描信号S4提供高电平，第一扫描信号S1和第三扫描信号S3提供低电平，数据线data接入初始电压信号Vini，第一开关S1断开，第二开关S2闭合，以使外部补偿单元接入所述感测线sense，驱动晶体管DT、第二晶体管T2和第四晶体管T4打开，第一晶体管T1和第三晶体管T3关闭，外部控制单元可以获取所述感测线sense的充电电压，并根据充电电压获取迁移率k，并进行储存。
具体地，步骤S10中，所述外部补偿单元侦测和储存所述驱动晶体管DT的初始阈值电压Vth0，包括第一初始阈值电压Vth0侦测阶段、第二初始阈值电压Vth0侦测阶段以及第三初始阈值电压Vth0侦测阶段，其中：
所述第一初始阈值电压Vth0侦测阶段：第二扫描信号S2以及第四扫描信号S4提供高电平，第三扫描信号S3提供低电平，数据线data接入所述显示数据电压Vdata，初始电压信号Vini接入感测线sense，驱动晶体管DT、第一晶体管T1、第二晶体管T2和第四晶体管T4打开，第三晶体管T3关闭；
所述第二初始阈值电压Vth0侦测阶段：第二扫描信号S2和第四扫描信号S4提供高电平，第一扫描信号S1和第三扫描信号S3提供低电平，数据线data接入显示数据电压Vdata，驱动晶体管DT、第二晶体管T2和第四晶体管T4打开，第一晶体管T1和第三晶体管T3关闭；以及
所述第三初始阈值电压Vth0侦测阶段：第二扫描信号S2和第四扫描信号S4提供高电平，第一扫描信号S1和第三扫描信号S3提供低电平，数据线data接入显示数据电压Vdata，外部补偿单元接入所述感测线sense，驱动晶体管DT、第二晶体管T2和第四晶体管T4打开，第一晶体管T1和第三晶体管T3关闭，将初始阈值电压Vth0储存至所述外部补偿单元中的存储器中。
本发明实施例还提供一种显示装置，所述显示装置包括上述像素电路，所述显示装置可以为手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
有益效果为：本发明实施例提供的像素电路及其驱动方法、显示装置，通过设计一种像素结构和侦测时序，在显示装置关机期间可侦测和储存驱动晶体管的初始阈值电压，根据侦测结果在下一开机期间读取对驱动晶体管的实际阈值电压进行实时内部补偿，并对驱动晶体管的迁移率进行侦测和储存，能够改善显示不均现象。
综上所述，虽然本发明已以优选实施例揭露如上，但上述优选实施例并非用以限制本发明，本领域的普通技术人员，在不脱离本发明的精神和范围内，均可作各种更动与润饰，因此本发明的保护范围以权利要求界定的范围为准。

Claims (7)

1.一种像素电路，其特征在于，所述像素电路与外部补偿单元连接，所述像素电路包括驱动晶体管、第一晶体管、第二晶体管、第三晶体管、第四晶体管、存储电容以及发光元件；
所述驱动晶体管的控制端连接所述第一晶体管的第二端和所述第三晶体管的第一端，所述驱动晶体管的第一端连接所述第二晶体管的第一端，所述驱动晶体管的第二端连接所述第三晶体管的第二端和所述第四晶体管的第一端；所述第一晶体管的控制端连接第一扫描信号，所述第一晶体管的第一端连接数据线；所述第二晶体管的控制端连接第二扫描信号，所述第二晶体管的第二端连接感测线；所述第三晶体管的控制端连接第三扫描信号；所述第四晶体管的控制端连接第四扫描信号，所述第四晶体管的第二端连接第一电源信号；所述存储电容的第一端连接所述驱动晶体管的控制端，所述存储电容的第二端连接所述第二晶体管的第一端；所述发光元件的阳极端连接所述驱动晶体管的第一端，所述发光元件的阴极端连接第二电源信号；其中，所述感测线的第一端连接初始电压信号和所述外部补偿单元，所述感测线的第二端连接所述第二晶体管的第二端；所述外部补偿单元用于侦测和储存所述像素电路的所述驱动晶体管的初始阈值电压；
在开机段，将所述初始阈值电压与所述像素电路的显示数据信号进行叠加以得到叠加数据信号，并将所述叠加数据信号输入至所述像素电路中，所述像素电路根据所述叠加数据信号对所述驱动晶体管的实际阈值电压进行内部补偿，并进行侦测和储存所述驱动晶体管的迁移率；
所述内部补偿包括复位阶段、侦测阶段、电压写入阶段以及发光阶段；其中，所述复位阶段：第一扫描信号和第二扫描信号提供高电平，第三扫描信号和第四扫描信号提供低电平，初始电压信号接入感测线，数据线接入参考电压信号，所述驱动晶体管、第一晶体管以及第二晶体管打开，第三晶体管和第四晶体管关闭；
所述侦测阶段：所述第一扫描信号和所述第三扫描信号提供高电平，所述第二扫描信号和所述第四扫描信号提供低电平，所述数据线接入所述参考电压信号，所述驱动晶体管、所述第一晶体管以及所述第三晶体管打开，所述第二晶体管和所述第四晶体管关闭；
所述电压写入阶段：所述第一扫描信号和所述第四扫描信号提供高电平，所述第二扫描信号和所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号和所述初始阈值电压进行叠加后得到的所述叠加数据信号，所述驱动晶体管、所述第一晶体管以及所述第四晶体管打开，所述第二晶体管和所述第三晶体管关闭；以及
所述发光阶段：所述第四扫描信号提供高电平，所述第一扫描信号、所述第二扫描信号以及所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号，所述驱动晶体管和所述第四晶体管打开，所述第一晶体管、所述第二晶体管以及所述第三晶体管关闭，所述驱动晶体管驱动发光元件发光。
2.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括第一开关和第二开关，所述第一开关的第一端连接所述初始电压信号，所述第一开关的第二端连接所述感测线；所述第二开关的第一端连接所述外部补偿单元，所述第二开关的第二端连接所述感测线。
3.根据权利要求1所述的像素电路，其特征在于，所述驱动晶体管、所述第一晶体管、所述第二晶体管、所述第三晶体管以及所述第四晶体管均为N型薄膜晶体管。
4.一种显示装置，其特征在于，包括权利要求1-3任一项所述的像素电路。
5.一种像素电路的驱动方法，其特征在于，包括以下步骤：
步骤S10：在关机段，外部补偿单元侦测和储存驱动晶体管的初始阈值电压；以及
步骤S20：在开机段，将所述初始阈值电压与所述像素电路的显示数据信号进行叠加以得到一叠加数据信号，并将所述叠加数据信号输入至所述像素电路中，每一帧时间内，所述像素电路根据所述叠加数据信号对所述驱动晶体管的实际阈值电压进行内部补偿，并进行侦测和储存所述驱动晶体管的迁移率，所述内部补偿包括复位阶段、侦测阶段、电压写入阶段以及发光阶段；其中，
所述复位阶段：第一扫描信号和第二扫描信号提供高电平，第三扫描信号和第四扫描信号提供低电平，初始电压信号接入感测线，数据线接入参考电压信号，所述驱动晶体管、第一晶体管以及第二晶体管打开，第三晶体管和第四晶体管关闭；
所述侦测阶段：所述第一扫描信号和所述第三扫描信号提供高电平，所述第二扫描信号和所述第四扫描信号提供低电平，所述数据线接入所述参考电压信号，所述驱动晶体管、所述第一晶体管以及所述第三晶体管打开，所述第二晶体管和所述第四晶体管关闭；
所述电压写入阶段：所述第一扫描信号和所述第四扫描信号提供高电平，所述第二扫描信号和所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号和所述初始阈值电压进行叠加后得到的所述叠加数据信号，所述驱动晶体管、所述第一晶体管以及所述第四晶体管打开，所述第二晶体管和所述第三晶体管关闭；以及
所述发光阶段：所述第四扫描信号提供高电平，所述第一扫描信号、所述第二扫描信号以及所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号，所述驱动晶体管和所述第四晶体管打开，所述第一晶体管、所述第二晶体管以及所述第三晶体管关闭，所述驱动晶体管驱动发光元件发光。
6.根据权利要求5所述的像素电路的驱动方法，其特征在于，步骤S20中，侦测和储存所述驱动晶体管的迁移率，包括第一迁移率侦测阶段、第二迁移率侦测阶段以及第三迁移率侦测阶段，其中：
所述第一迁移率侦测阶段：所述第一扫描信号、所述第二扫描信号以及所述第四扫描信号提供高电平，所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号和所述初始阈值电压进行叠加后得到的所述叠加数据信号，初始电压信号接入感测线，所述驱动晶体管、所述第一晶体管、所述第二晶体管以及所述第四晶体管打开，所述第三晶体管关闭；
所述第二迁移率侦测阶段：所述第二扫描信号和所述第四扫描信号提供高电平，所述第一扫描信号和所述第三扫描信号提供低电平，数据线接入所述参考电压信号，所述驱动晶体管、所述第二晶体管以及所述第四晶体管打开，所述第一晶体管和所述第三晶体管关闭；以及
所述第三迁移率侦测阶段：所述第二扫描信号和所述第四扫描信号提供高电平，所述第一扫描信号和所述第三扫描信号提供低电平，所述数据线接入所述初始电压信号，所述外部补偿单元接入所述感测线，所述驱动晶体管、所述第二晶体管以及所述第四晶体管打开，所述第一晶体管和所述第三晶体管关闭。
7.根据权利要求5所述的像素电路的驱动方法，其特征在于，步骤S10中，所述外部补偿单元侦测和储存所述驱动晶体管的阈值电压，包括第一初始阈值电压侦测阶段、第二初始阈值电压侦测阶段以及第三初始阈值电压侦测阶段，其中：
所述第一初始阈值电压侦测阶段：所述第二扫描信号和所述第四扫描信号提供高电平，所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号，初始电压信号接入所述感测线，所述驱动晶体管、所述第一晶体管、所述第二晶体管以及所述第四晶体管打开，所述第三晶体管关闭；
所述第二初始阈值电压侦测阶段：所述第二扫描信号和所述第四扫描信号提供高电平，所述第一扫描信号和所述第三扫描信号提供低电平，所述数据线接入所述显示数据信号，所述驱动晶体管、所述第二晶体管以及所述第四晶体管打开，所述第一晶体管和所述第三晶体管关闭；以及
所述第三初始阈值电压侦测阶段：所述第二扫描信号和所述第四扫描信号提供高电平，所述第一扫描信号和所述第三扫描信号提供低电平，所述数据线接入显示数据信号，所述外部补偿单元接入所述感测线，所述驱动晶体管、所述第二晶体管以及所述第四晶体管打开，所述第一晶体管和所述第三晶体管关闭。
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