CN110767188A - 显示面板驱动系统 - Google Patents

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Abstract

本发明提供一种显示面板驱动系统，包括第一IIC总线和第二IIC总线、控制板和机芯版，控制板设置有时序控制芯片和驱动芯片，时序控制芯片包括第一主机接口和第一从机接口，驱动芯片包括第二从机接口，第一主机接口通过第一IIC总线与第二从机接口连接；机芯版设置有系统级芯片，系统级芯片包括第二主机接口，第二主机接口通过第二IIC总线与第一从机接口连接。通过设置相互独立的第一IIC总线和第二IIC总线，可实现时序控制芯片与系统级芯片间的信息单独传递、以及时序控制芯片和驱动芯片间的信息单独传递，解决了IIC总线冲突的技术问题。

Description

显示面板驱动系统
技术领域
本发明涉及显示技术领域，尤其涉及一种显示面板驱动系统。
背景技术
由于IIC总线(Inter-Integrated Circuit，集成电路总线)具有信号线少、体积小等优势，在液晶面板显示面板驱动系统中被广泛应用。
如图1所示，现有液晶面板显示面板驱动系统中，包括控制板11、机芯版12和IIC总线13。控制板11中设置有时序控制芯片(TCON)101、可编程伽玛校对缓冲电路芯片(P-gammaIC)102和电源管理芯片(Power manage IC，PMIC)103，机芯版12中设置有系统级芯片(System on Chip，SOC)104和IIC设备105。时序控制芯片101包括用于发送信号的时序主机接口1011和用于接收信号的时序从机接口1012，系统级芯片104包括用于发送信号的系统级主机接口1041。由于时序控制芯片101向可编程伽玛校对缓冲电路芯片102和电源管理芯片103配置数据、以及系统级芯片104向时序控制芯片101配置数据均使用同一条IIC总线，易出现多个数据发送端对应一个数据接收端的情况，造成IIC总线冲突，进而导致时序控制芯片101和系统级芯片104无法正常工作。
因此，现有液晶面板显示面板驱动系统存在IIC总线易冲突的技术问题，需要改进。
发明内容
本发明提供一种显示面板驱动系统，以缓解现有液晶面板显示面板驱动系统存在的IIC总线易冲突的技术问题。
为解决上述问题，本发明提供的技术方案如下：
本发明提供一种显示面板驱动系统，包括：
第一IIC总线和第二IIC总线；
控制板，设置有时序控制芯片和驱动芯片，所述时序控制芯片包括第一主机接口和第一从机接口，所述驱动芯片包括第二从机接口，所述第一主机接口通过所述第一IIC总线与所述第二从机接口连接；
机芯版，设置有系统级芯片，所述系统级芯片包括第二主机接口，所述第二主机接口通过所述第二IIC总线与所述第一从机接口连接。
在本发明的显示面板驱动系统中，所述驱动芯片包括可编程伽玛校对缓冲电路芯片、电源管理芯片和电平转换芯片中的至少一种。
在本发明的显示面板驱动系统中，所述机芯版还设置有IIC设备，所述IIC设备通过所述第二IIC总线和所述第二主机接口连接。
在本发明的显示面板驱动系统中，所述IIC设备的设备地址与所述第一从机接口的设备地址不同。
在本发明的显示面板驱动系统中，所述时序控制芯片还包括存储器，所述存储器用于存储所述第二主机接口和所述第一从机接口输送的数据。
在本发明的显示面板驱动系统中，所述时序控制芯片还用于校对所述驱动芯片的烧写数据是否正确，所述时序控制芯片包括：
待烧写数据获取单元，用于获取待烧写数据；
写入单元，用于向所述驱动芯片的寄存器写入待烧写数据；
校验单元，用于检验所述待烧写数据是否成功写入所述寄存器中。
在本发明的显示面板驱动系统中，所述检验单元包括读取单元和比较单元，所述读取单元用于读取所述寄存器中的实际烧写数据，所述比较单元用于比较所述实际烧写数据和所述待烧写数据是否一致。
在本发明的显示面板驱动系统中，所述显示面板驱动系统还包括与所述时序控制芯片连接的闪存，所述待烧写数据获取单元用于从所述闪存中获取待烧写数据。
在本发明的显示面板驱动系统中，所述检验单元在所述实际烧写数据和所述待烧写数据一致时，结束检验；在所述实际烧写数据和所述待烧写数据不一致时，触发所述写入单元重新向所述驱动芯片的寄存器写入待烧写数据。
在本发明的显示面板驱动系统中，所述时序控制芯片还包括计数单元，所述计数单元用于计算写入单元向所述驱动芯片的寄存器写入待烧写数据的次数，并在所述次数大于阈值时，触发所述写入单元停止向所述驱动芯片的寄存器写入待烧写数据。
本发明的有益效果为：本发明提供一种显示面板驱动系统，包括第一IIC总线和第二IIC总线、控制板和机芯版，控制板设置有时序控制芯片和驱动芯片，所述时序控制芯片包括第一主机接口和第一从机接口，所述驱动芯片包括第二从机接口，所述第一主机接口通过所述第一IIC总线与所述第二从机接口连接；机芯版设置有系统级芯片，所述系统级芯片包括第二主机接口，所述第二主机接口通过所述第二IIC总线与所述第一从机接口连接。通过设置相互独立的第一IIC总线和第二IIC总线，一条连接时序控制芯片的第一主机接口和驱动芯片的第二从机接口，另一条连接时序控制芯片的第一从机接口和系统级芯片的第二主机接口，可实现时序控制芯片与系统级芯片间的信息单独传递、以及时序控制芯片和驱动芯片间的信息单独传递，解决了IIC总线冲突的技术问题。
附图说明
为了更清楚地说明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单介绍，显而易见地，下面描述中的附图仅仅是发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为现有技术中的显示面板驱动系统的结构示意图；
图2为本发明实施例提供的显示面板驱动系统的结构示意图；
图3为本发明实施例提供的显示面板驱动系统中校正模块的结构示意图；
图4为本发明实施例提供的显示面板驱动系统中校对模块的校对流程示意图。
具体实施方式
以下各实施例的说明是参考附加的图示，用以例示本发明可用以实施的特定实施例。本发明所提到的方向用语，例如[上]、[下]、[前]、[后]、[左]、[右]、[内]、[外]、[侧面]等，仅是参考附加图式的方向。因此，使用的方向用语是用以说明及理解本发明，而非用以限制本发明。在图中，结构相近的单元是用以相同标号表示。
本发明提供一种显示面板驱动系统，以缓解现有液晶面板显示面板驱动系统存在的IIC总线易冲突的技术问题。
现有液晶面板显示面板驱动系统中，如图1所示，包括控制板(Printed CircuitBoard，PCB)11、机芯版12和IIC总线13。控制板11中设置有时序控制芯片(TCON)101、可编程伽玛校对缓冲电路芯片(P-gamma IC)102和电源管理芯片(Power manage IC，PMIC)103，机芯版12中设置有系统级芯片(System on Chip，SOC)104和IIC设备105。时序控制芯片101包括用于发送信号的时序主机接口1011和用于接收信号的时序从机接口1012.系统级芯片104包括用于发送信号的系统级主机接口1041。
时序控制芯片101在上电初始化时，时序主机接口1011会通过IIC总线13向可编程伽玛校对缓冲电路芯片102和电源管理芯片103配置数据，如果此时IIC设备105需要操作，则系统级芯片104的系统级主机接口1041也需要通过IIC总线13向IIC设备105输送信号，此时，由于时序控制芯片101和系统级芯片104均为发送端，可编程伽玛校对缓冲电路芯片102、电源管理芯片103以及IIC设备105均为接收端，IIC总线13同时传输两种数据，会造成IIC总线13冲突，可编程伽玛校对缓冲电路芯片102和电源管理芯片103会同时收到时序控制芯片101和系统级芯片104的信号，IIC设备105也会同时收到时序控制芯片101和系统级芯片104的信号，导致时序控制芯片101和系统级芯片104无法正常工作。
此外，在正常工作时，系统级芯片104的系统级主机接口1041发送信号，通过IIC总线13传输至时序控制芯片101的时序从机接口1012，时序控制芯片101再将信号转换成液晶面板显示所需信号。在此状态下，若厂家需对可编程伽玛校对缓冲电路芯片102的内部设置进行改动，则需要时序控制芯片101通过IIC总线13向可编程伽玛校对缓冲电路芯片102发送信号。此时，系统级芯片104和时序控制芯片101均为发送端，可编程伽玛校对缓冲电路芯片102为接收端，可编程伽玛校对缓冲电路芯片102也会同时收到时序控制芯片101和系统级芯片104的信号，造成IIC总线13冲突，导致时序控制芯片101和系统级芯片104无法正常工作。
因此，现有液晶面板显示面板驱动系统存在IIC总线易冲突的技术问题，需要改进。
如图2所示，本发明提供一种显示面板驱动系统，包括第一IIC总线241和第二IIC总线242、控制板21和机芯版22。
控制板21设置有时序控制芯片210和驱动芯片230，时序控制芯片210包括第一主机接口211和第一从机接口212，驱动芯片230包括第二从机接口231，第一主机接口211通过第一IIC总线241与第二从机接口231连接。
机芯版22设置有系统级芯片220，系统级芯片220包括第二主机接口221，第二主机接口221通过第二IIC总线242与第一从机接口212连接。
机芯版22是以系统级芯片(System on Chip，SOC)220为核心的电路板，具备不同接口视频信号模数转换、视频格式解码、视频后期处理、图像OSD引擎等多种功能。机芯版22用于发送数据信号，通常为V-By-One、LVDS、EDP等格式。
时序控制芯片210设置在控制板21中，时序控制芯片210将机芯版22中的系统级芯片220发出的V-By-One、LVDS、EDP格式的数据信号，转化为液晶显示面板能识别的Mini-LVDS、RSDS、TTL等格式的数据信号。
时序控制芯片210将从机芯版22中接收的数据信号、控制信号以及时钟信号转换成适合于数据驱动集成电路(S-IC)和扫描驱动集成电路(G-IC)的数据信号、控制信号、时序信号后，将信号传输给数据驱动集成电路和扫描驱动集成电路，然后，扫描驱动集成电路向扫描线提供扫描信号，数据驱动集成电路向数据线提供数据信号，最终实现机芯版22发送的图像数据能被液晶显示面板正确地显示。
驱动芯片230也设置在控制板21中，驱动芯片230包括可编程伽玛校对缓冲电路芯片2301、电源管理芯片2302和电平转换芯片2303中的至少一种。
可编程伽玛校对缓冲电路芯片2301主要用于产生伽马参考电压。
电源管理芯片2302的作用是产生液晶显示面板工作所需要的各种电压，如提供给各芯片的数字工作电压(DVDD)、提供给可编程伽玛校对缓冲电路芯片2301和VCOM电路的模拟电压(AVDD)、提供给扫描驱动集成电路的栅开启电压(Vgh或Von)和关闭电压(Vgl或Voff)等。
电平转换芯片2303用于对信号进行电平转换。
IIC总线(Inter-Integrated Circuit，集成电路总线)具有信号线少、体积小等优势，在液晶面板显示面板驱动系统中被广泛应用。IIC总线是同步通信的一种，用于连接微控制器及其外围设备。
在本实施例中，第一IIC总线241用于连接时序控制芯片210和驱动芯片230，第二IIC总线242用于连接时序控制芯片210和系统级芯片220。
时序控制芯片210包括第一主机接口211和第一从机接口212，系统级芯片220包括第二主机接口221，驱动芯片230包括第二从机接口231。主机接口、从机接口之间可以通过通讯的办法进行数据交互。
在时序控制芯片210上电初始化时，时序控制芯片210会通过第一IIC总线241向驱动芯片230配置数据，信号由第一主机接口211发出，第二从机接口231接收信号。
在时序控制芯片210正常工作时，系统级芯片220上的控制管脚(WPN)为H，系统级芯片220要控制时序控制芯片210，信号由第二主机接口221发出，第一从机接口212接收信号。
第一IIC总线241与第一主机接口211和第二从机接口231连接，用于完成时序控制芯片210和驱动芯片230之间的信号传输；第二IIC总线242与第一从机接口212和第二主机接口221连接，用于完成时序控制芯片210和系统级芯片220之间的信号传输。第一IIC总线241和第二IIC总线242之间相互独立，即时序控制芯片210和驱动芯片230之间的信号传输、以及时序控制芯片210和系统级芯片220之间的信号传输也相互独立。
在一种实施例中，机芯版22还设置有IIC设备25，IIC设备25通过第二IIC总线242和第二主机接口221连接。IIC设备25可以是电可擦除寄存器(EEPROM)，也可以是其他设备。
IIC设备25的设备地址与第一从机接口212的设备地址不同。由于，第一从机接口212和IIC设备25均通过第二IIC总线242与第二主机接口221连接，在工作状态，系统级芯片220通过第二主机接口221向时序控制芯片210的第一从机接口212发送信号，若此时IIC设备25也需要操作，则第二主机接口221还需要传递信号给IIC设备。将IIC设备25的设备地址与第一从机接口212的设备地址设备为不同，第二主机接口221通过唯一的地址，可以准确地实现对IIC设备25和第一从机接口212的控制，不会出现信号输送错误的情况，简单高效。
在本发明中，在时序控制芯片210的上电初始化过程中，时序控制芯片210的第一主机接口211通过第一IIC总线241向驱动芯片230的第二从机接口231配置数据，如果此时IIC设备25也需要操作，则系统级芯片220的第二主机接口221通过第二IIC总线242向IIC设备25输送信号，此时，由于第一IIC总线241和第二IIC总线242相互独立，第二从机接口231仅对应第一主机接口211这一个发送端，IIC设备25也仅对应第二主机接口221这一个发送端，则驱动芯片230仅接受时序控制芯片210配置的数据，IIC设备25也仅接受系统级芯片220配置的数据，两者之间不会发生总线冲突，从而保证了数据传输的准确性。
在时序控制芯片210正常工作状态下，系统级芯片220的第二主机接口221发送信号，通过第二IIC总线242传输至时序控制芯片210的第一从机接口212，时序控制芯片210再将信号转换成液晶面板显示所需信号。当厂家需对驱动芯片230的内部设置进行改动，则时序控制芯片210可通过第一IIC总线241向驱动芯片230发送信号。此时，由于第一IIC总线241和第二IIC总线242相互独立，第一从机接口212仅对应第二主机接口221这一个发送端，第二从机接口231也仅对应第一主机接口211这一个发送端，则时序控制芯片210仅接受系统级芯片220配置的数据，驱动芯片230也仅接受时序控制芯片210配置的数据，两者之间不会发生总线冲突，从而保证了数据传输的准确性。
本发明通过设置相互独立的第二IIC总线242和第一IIC总线241，一条连接时序控制芯片210的第一主机接口211和驱动芯片230的第二从机接口231，另一条连接时序控制芯片210的第一从机接口212和系统级芯片220的第二主机接口221，可实现时序控制芯片210与系统级芯片220间的信息单独传递、以及时序控制芯片210和驱动芯片230间的信息单独传递，解决了IIC总线冲突的技术问题。
驱动芯片230包括可编程伽玛校对缓冲电路芯片2301、电源管理芯片2302和电平转换芯片2303中的至少一种。在本实施例中，驱动芯片230为可编程伽玛校对缓冲电路芯片2301、电源管理芯片2302和电平转换芯片2303集成的三合一芯片。
在现有技术中，可编程伽玛校对缓冲电路芯片2301、电源管理芯片2302和电平转换芯片2303是分立的元件，占用了大量的控制板的空间，本发明将三种芯片集成为一体，减小了控制板21的空间占用，节省了成本。
在一种实施例中，时序控制芯片210还包括存储器，存储器用于存储第二主机接口221和第一从机接口212输送的数据。存储器为时序控制芯片210内部开出的一个内存空间，时序控制芯片210上电初始运行时，存储器可以存储系统级芯片220的第二主机接口221对应的读指令，读操作返回的数据，写指令及数据，以及内存空间的存储状态。
在一种实施例中，如图3所示，时序控制芯片210用于对驱动芯片230中烧写数据是否正确进行检验，时序控制芯片210包括待烧写数据获取单元31、写入单元32和检验单元33。
待烧写数据获取单元31用于获取待烧写数据。
写入单元32用于向驱动芯片230的寄存器写入待烧写数据。
校验单元33用于检验待烧写数据是否成功写入寄存器中。
在一种实施例中，校验单元33包括读取单元331和比较单元332。读取单元331用于读取寄存器中的实际烧写数据，比较单元332用于比较实际烧写数据和待烧写数据是否一致。
检验单元33在实际烧写数据和待烧写数据一致时，结束检验；在实际烧写数据和待烧写数据不一致时，触发写入单元32重新向驱动芯片230的寄存器写入待烧写数据。
时序控制芯片210还包括计数单元(图未示出)，计数单元用于计算写入单元32向驱动芯片230的寄存器写入待烧写数据的次数，并在次数大于阈值时，触发写入单元32停止向驱动芯片230的寄存器写入待烧写数据。
在液晶显示装置中，驱动芯片230要正常工作，首先需要向驱动芯片230中烧写数据，如果烧写数据出现误码，则对后续的显示会造成影响。因此，本发明的时序控制芯片210在向驱动芯片230烧写数据后，会对其烧写结果进行检验，防止后续显示不正常。
时序控制芯片210的校正流程如图4所示，具体步骤包括：
S1：时序控制芯片210上电初始化成功，并获取驱动芯片230的待烧写数据。
显示面板驱动系统包括与时序控制芯片210连接的闪存(Flash)(图未示出)，闪存通常用于存储时序控制芯片210的配置代码，在本实施例中，驱动芯片230的待烧写数据存储在闪存中，待烧写数据获取单元31从闪存中获取待烧写数据。
S1中待烧写数据即理想状态下驱动芯片230中烧写的数据，也是时序控制芯片210正常工作时所需要的烧写数据。由于驱动芯片230主要向时序控制芯片210提供电压值，待烧写数据通常也为电压值。
由于驱动芯片230为三合一芯片，待烧写数据包括对应可编程伽玛校对缓冲电路芯片2301的第一待烧写数据、对应电源管理芯片2302的第二待烧写数据、以及对应电平转换芯片2303的第三待烧写数据。
待烧写数据获取单元31获取待烧写数据时，可以依次获取每种芯片对应的待烧写数据，逐一进行校对。当然，也可以同时获取所有芯片的待烧写数据，一次校对。
S2：时序控制芯片210对驱动芯片230中寄存器进行写操作。
驱动芯片230中各芯片均包括寄存器，寄存器用于存储电压配置值。时序控制芯片210中的写入单元32对驱动芯片230中寄存器进行写操作，即将待烧写数据配置给驱动芯片230中的寄存器。
在一种实施例中，时序控制芯片210还包括计数单元，计数单元用于计算写入单元32写操作的次数，即写入单元32每进行一次写操作，计数单元就计一次数，次数用CNT表示。
S3：时序控制芯片对驱动芯片中寄存器进行读操作。
对驱动芯片230中的寄存器写入待烧写数据后，读取单元331再对寄存器中的烧写数据进行读取，得到实际烧写数据。
写入单元32和读取单元331相互传输的数据，同样可以存储在时序控制芯片210中的存储器中。
S4：检查实际烧写数据与时序控制芯片210内部的待烧写数据是否一致。
在理想状态下，写入单元32写入的待烧写数据与读取单元331读取的实际烧写数据应该一致，但由于种种原因，烧写数据在传输过程中不可避免地会产生差错，例如在传输过程中受到外界的干扰,或在通信系统内部由于各个组成部分的质量不够理想而使传送的信号发生畸变等。当受到的干扰或信号畸变达到一定程度时,就会产生差错，导致误码，此时则会出现实际烧写数据与待烧写数据不一致的情况。
比较单元332将实际烧写数据与时序控制芯片210内部的待烧写数据进行对比，当对比结果为实际烧写数据和待烧写数据一致时，说明实际烧录过程中，驱动芯片230中的烧录数据完全正确，此时直接进入S8步骤，结束工作。
当实际烧写数据和待烧写数据不一致时，需进行S5步骤。
S5：时序控制芯片210对驱动芯片230中寄存器进行写操作。
实际烧写数据和待烧写数据不一致，说明此次写入不成功，需要再重复一次写入操作，然后再次进行校对。此时写入单元32被触发，重新向驱动芯片230的寄存器写入待烧写数据。
S6：初始化写操作计数：CNT＝CNT+1。
由于时序控制芯片210包括计数单元，当再重复一次写入操作时，计数单元的本次计数需在上次计数的基础上加一，即为本次计数。
S7：CNT＜＝M。
M为一整数阈值，M的数值可根据需要制定。计数单元在写入单元32向驱动芯片230的寄存器写入待烧写数据的次数大于阈值M时，触发写入单元32停止向驱动芯片230的寄存器写入待烧写数据。此时进入S8，结束工作。
当总的写入操作的次数小于或等于M次时，每进行写入操作一次，需重复S3中的读取操作和S4中的比较操作。若出现实际烧写数据和待烧写数据一致时，说明实际烧录过程中，驱动芯片230中的烧录数据正确，此时可结束工作。
若直到M次写操作后，实际烧写数据和待烧写数据仍然不一致，则进行S8步骤。
S8：结束。
此时经过M次的写入与读取工作后，驱动芯片230中的烧录数据依然不正确，则该驱动芯片230不能正常使用，需及时进行处理，防止后续因使用误码的驱动芯片230而造成影响。
通过上述步骤，对三合一驱动芯片230进行了校对，防止其产生误码，对后续正常工作产生影响。
根据上述实施例可知：
本发明提供一种显示面板驱动系统，包括第一IIC总线和第二IIC总线、控制板和机芯版，控制板设置有时序控制芯片和驱动芯片，时序控制芯片包括第一主机接口和第一从机接口，驱动芯片包括第二从机接口，第一主机接口通过第一IIC总线与第二从机接口连接；机芯版设置有系统级芯片，系统级芯片包括第二主机接口，第二主机接口通过第二IIC总线与第一从机接口连接。通过设置相互独立的第一IIC总线和第二IIC总线，一条连接时序控制芯片的第一主机接口和驱动芯片的第二从机接口，另一条连接时序控制芯片的第一从机接口和系统级芯片的第二主机接口，可实现时序控制芯片与系统级芯片间的信息单独传递、以及时序控制芯片和驱动芯片间的信息单独传递，解决了IIC总线冲突的技术问题。
综上所述，虽然本发明已以优选实施例揭露如上，但上述优选实施例并非用以限制本发明，本领域的普通技术人员，在不脱离本发明的精神和范围内，均可作各种更动与润饰，因此本发明的保护范围以权利要求界定的范围为准。

Claims (10)

1.一种显示面板驱动系统，其特征在于，包括：
第一IIC总线和第二IIC总线；
控制板，设置有时序控制芯片和驱动芯片，所述时序控制芯片包括第一主机接口和第一从机接口，所述驱动芯片包括第二从机接口，所述第一主机接口通过所述第一IIC总线与所述第二从机接口连接；
机芯版，设置有系统级芯片，所述系统级芯片包括第二主机接口，所述第二主机接口通过所述第二IIC总线与所述第一从机接口连接。
2.如权利要求1所述的显示面板驱动系统，其特征在于，所述驱动芯片包括可编程伽玛校对缓冲电路芯片、电源管理芯片和电平转换芯片中的至少一种。
3.如权利要求2所述的显示面板驱动系统，其特征在于，所述机芯版还设置有IIC设备，所述IIC设备通过所述第二IIC总线和所述第二主机接口连接。
4.如权利要求3所述的显示面板驱动系统，其特征在于，所述IIC设备的设备地址与所述第一从机接口的设备地址不同。
5.如权利要求1所述的显示面板驱动系统，其特征在于，所述时序控制芯片还包括存储器，所述存储器用于存储所述第二主机接口和所述第一从机接口输送的数据。
6.如权利要求2所述的显示面板驱动系统，其特征在于，所述时序控制芯片还用于校对所述驱动芯片的烧写数据是否正确，所述时序控制芯片包括：
待烧写数据获取单元，用于获取待烧写数据；
写入单元，用于向所述驱动芯片的寄存器写入待烧写数据；
校验单元，用于检验所述待烧写数据是否成功写入所述寄存器中。
7.如权利要求6所述的显示面板驱动系统，其特征在于，所述检验单元包括读取单元和比较单元，所述读取单元用于读取所述寄存器中的实际烧写数据，所述比较单元用于比较所述实际烧写数据和所述待烧写数据是否一致。
8.如权利要求6所述的显示面板驱动系统，其特征在于，所述显示面板驱动系统还包括与所述时序控制芯片连接的闪存，所述待烧写数据获取单元用于从所述闪存中获取待烧写数据。
9.如权利要求6所述的显示面板驱动系统，其特征在于，所述检验单元在所述实际烧写数据和所述待烧写数据一致时，结束检验；在所述实际烧写数据和所述待烧写数据不一致时，触发所述写入单元重新向所述驱动芯片的寄存器写入待烧写数据。
10.如权利要求6所述的显示面板驱动系统，其特征在于，所述时序控制芯片还包括计数单元，所述计数单元用于计算写入单元向所述驱动芯片的寄存器写入待烧写数据的次数，并在所述次数大于阈值时，触发所述写入单元停止向所述驱动芯片的寄存器写入待烧写数据。
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