CN111477154B - 显示面板的通信架构与显示面板 - Google Patents
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Abstract
一种显示面板的通信架构，通过延时电路的设置，使得写入保护信号可以在流经所述延时电路后延迟对总线开关的开启，直到校验电源管理集成电路中的代码的过程结束，确保时序控制器在进行校验时不会开启所述总线开关，从而避免存储器被校验的通讯内容改写。
Description
技术领域
本发明涉及显示技术领域，尤其涉及一种显示面板的通信架构与显示面版。
背景技术
在显示面板上电后，为了防止电源管理集成电路中的代码在运行的过程中被改写，时序控制器通常会每隔一段时间对其进行校验。但是当所述时序控制器正在执行校验时，如果校验的通讯地址又刚好与存储有显示信息(例如屏幕类别信息)的存储器的地址匹配，所述存储器的内容会被改写(例如屏幕类别信息被改写)，导致例如屏幕类别信息无法被正确识别，使得所述显示面板的画面产生异常。
因此，有必要提出一种显示面板的通信架构与显示面版，以解决现有技术中的技术问题。
发明内容
本发明的目的在于提供一种显示面板的通信架构与显示面版，以解决现有技术存在的问题。
为实现上述目的，本发明第一方面提供一种显示面板的通信架构，包括有所述通讯架构包括与串行总线电连接的片上系统、时序控制器、电源管理集成电路、总线开关、以及存储器，所述片上系统上的写入保护端分别电连接所述时序控制器、所述总线开关、以及所述存储器，通过所述写入保护端输出写入保护信号，以对所述时序控制器、所述总线开关、以及所述存储器的工作状态进行控制，所述时序控制器以预设的时间通过所述串行总线对所述电源管理集成电路中的代码进行校验，所述总线开关设置于所述片上系统与所述存储器一侧以及所述时序控制器与所述电源管理集成电路一侧之间；
其中，所述写入保护信号通过反相器传送至所述存储器，同时通过延时电路传送至所述总线开关，当具有高电平信号的所述写入保护信号输出时，所述存储器为可读写状态，并且所述写入保护信号在流经所述延时电路后延迟对所述总线开关的开启，直到校验所述电源管理集成电路中的代码的过程结束。
进一步地，所述串行总线为内部集成电路总线(inter-integrated circuit，I2C)。
进一步地，所述存储器为电可擦可编程只读存储器(electrically erasableprogrammable read only memory，EEPROM)。
进一步地，所述时序控制器在每一帧的空闲(blanking)时间里执行校验。
进一步地，所述延时电路包括电阻器与电容器，所述电阻器的第一端接收所述写入保护信号，第二端电连接所述总线开关以及所述电容器的第一端，并且所述电容器的第二端连接相较于所述写入保护信号低的电平信号。
进一步地，所述总线开关包括有薄膜晶体管(thin film transistor,TFT)，并且通过将所述写入保护信号传送到所述薄膜晶体管的栅极端来实现所述总线开关的开与关。
进一步地，当具有低电平信号的所述写入保护信号输出时，所述时序控制器处于正常工作模式，正常输出用于驱动所述显示面板的各种控制信号。
进一步地，所述片上系统还通过所述串行总线输出串行信号至所述时序控制器，用以对所述时序控制器进行显示控制。
进一步地，所述存储器存储有屏幕类别信息，所述片上系统通过读取所述屏幕类别信息来判断所述显示面板的显示状态。
本发明第二方面提供一种显示面板，其包括上述任一项所述的显示面板的通信架构。
本发明通过所述延时电路的设置，使得所述写入保护信号可以在流经所述延时电路后延迟对所述总线开关的开启，直到校验所述电源管理集成电路中的代码的过程结束，确保所述时序控制器在进行校验时不会开启所述总线开关，从而避免所述存储器被校验的通讯内容改写。
附图说明
图1为根据本发明实施例的显示面板的通信架构示意图。
具体实施方式
为使本发明的目的、技术方案及效果更加清楚、明确，以下参照附图并对本发明作进一步地详细说明。应当理解，此处所描述的具体实施例仅用以解释本发明，并不用于限定本发明。
以下各实施例的说明是参考附加的图示，用以例示本发明可用以实施的实施例。本发明所提到的方向用语仅是参考附加图式的方向。因此，使用的方向用语是用以说明及理解本发明，而非用以限制本发明。
请参照图1，图1为根据本发明实施例的显示面板的通信架构示意图。所述通信架构包括与串行总线(未标示)电连接的片上系统(system-on-chip,SoC)11、时序控制器(timing controller,TCON)12、电源管理集成电路(power management IC,PMIC)13、总线开关14、以及存储器15，并且所述总线开关14设置于所述片上系统11与所述存储器15以及所述时序控制器12与所述电源管理集成电路13之间。如图1所示，所述片上系统11与所述存储器15设置于所述总线开关14的左侧，所述时序控制器12与所述电源管理集成电路13设置于所述总线开关14的右侧，通过所述总线开关14来控制所述片上系统11一侧与所述时序控制器12一侧之间的通讯开关。
在本实施例中，所述串行总线为包括有串行数据线(SDA)以及串行时钟线(SCL)的内部集成电路总线(inter-integrated circuit，I2C)，所述存储器15为电子可擦可编程只读存储器(electrically erasable programmable read only memory，EEPROM)。可以理解的是，所述内部集成电路总线与所述电子可擦可编程只读存储器的功能与作用为本领域技术人员所熟知，在此不加以赘述。
在本实施例中，所述片上系统11通过所述串行总线输出串行信号至所述时序控制器12，使得所述时序控制器12可以进行分辨率转换、图像数据调制、以及驱动频率转换等显示控制。所述存储器15存储有屏幕类别信息，所述片上系统11可以通过读取所述存储器15中的所述屏幕类别信息来判断显示面板的显示状态。为了更加清楚解释本发明，下文将以存储有屏幕类别信息的所述存储器15来作说明，但不应将此解释为对本发明的限制。
在本实施例中，所述片上系统11还用以输出写入保护信号(write protection,WP)，以控制所述时序控制器12、所述总线开关14、以及所述存储器15的工作状态，并且所述写入保护信号会同时分别通过反相器151以及延时电路141传送至所述存储器15以及所述总线开关14。具体地，所述片上系统11上用以输出所述写入保护信号的写入保护端111分别电连接所述时序控制器12、所述总线开关14、以及所述存储器15。当所述时序控制器12接收到具有低电平的所述写入保护信号时，所述时序控制器12处于正常工作模式(即正常输出用于驱动显示面板的各种控制信号)，此时所述总线开关14为关闭状态，并且所述存储器15会通过所述反相器151接收到具有高电平的所述写入保护信号，使其为可读不可写的状态，而当所述时序控制器12接收到具有高电平的所述写入保护信号时，所述时序控制器12处于调试模式(即所述片上系统11可以通过所述串行总线对所述时序控制器12进行显示控制)，此时所述总线开关14为开启状态，并且所述存储器15会通过所述反相器151接收到具有低电平的所述写入保护信号，使其为可读可写的状态。于一实施例中，所述总线开关14可以包括有薄膜晶体管(thin film transistor,TFT)及其它电子元件，通过将所述写入保护信号传送到所述薄膜晶体管的栅极端来实现所述总线开关14的开与关。
进一步地，为了防止存储在所述电源管理集成电路13中的代码(可以存储在非易失存储器或是快闪式存储器中)在显示面板运行的过程中被改写，所述时序控制器12会以预设的时间间隔通过所述串行总线对所述电源管理集成电路13中的代码进行校验，例如在每一帧的空闲(blanking)时间里执行循环冗余校验(cyclic redundancy check，CRC)。
由于在执行校验的过程中会占用到所述串行总线，同时若所述时序控制器12接收到具有高电平的所述写入保护信号时，所述时序控制器12不会立即切换到调试模式，即所述片上系统11无法立即通过所述串行总线对所述时序控制器12进行控制，会先等待校验过程结束后才会进行切换。然而，由于此时所述时序控制器12不是处于调试模式，但所述写入保护信号为高电平信号，所述总线开关14为开启状态并且所述存储器15为可读可写的状态，此时若校验的通讯地址恰好又与存储有屏幕类别信息的所述存储器15的通讯地址匹配时，校验的通讯内容会因此而写入到所述存储器15中，造成所述存储器15的内容(屏幕类别信息)被改写，导致屏幕类别信息无法被正确识别，使得显示面板的显示画面异常。
本发明通过所述延时电路141的设置，使得所述写入保护信号可以在流经所述延时电路141后延迟对所述总线开关14的开启，直到校验所述电源管理集成电路13中的代码的过程结束，确保所述时序控制器12在进行校验时不会开启所述总线开关14，从而避免所述存储器15被校验的通讯内容改写。如此一来，所述片上系统11可以读取到正确的存储于所述存储器15的屏幕类别信息，并且正确地识别出屏幕的类别或是显示状态，进而使所述显示面板正常工作而显示出正确的显示画面。
优选地，所述延时电路包括有一电阻器1411与一电容器1412，所述电阻器1411的第一端接收所述写入保护信号，第二端与所述总线开关14以及所述电容器1412的第一端电连接，所述电容器1412的第二端连接相较于所述写入保护信号低的电平信号(例如接地)，此时所述延时电路141为电阻电容延时电路(RC delay circuit)。
本发明所提供的显示面板的通信架构可以适用于任何类型的显示面板，例如液晶显示面板(liquid crystal display panel)、有机发光二极管显示面板(organic light-emitting diode display panel)、量子显示面板(quantum display panel)等。
本发明并提供一种显示面板，所述显示面板包括上述的显示面板的通信架构，所述显示面板的通信架构已描述如上文，不再赘述。
虽然本发明已以优选实施例揭露如上，但上述优选实施例并非用以限制本发明，本领域的普通技术人员，在不脱离本申请的范围内，均可作各种更动与润饰，因此本申请的保护范围以权利要求界定的范围为准。
Claims (10)
1.一种显示面板的通信架构，其特征在于：所述通信架构包括与串行总线电连接的片上系统、时序控制器、电源管理集成电路、总线开关、以及存储器，所述片上系统上的写入保护端分别电连接所述时序控制器、所述总线开关、以及所述存储器，通过所述写入保护端输出写入保护信号，以对所述时序控制器、所述总线开关、以及所述存储器的工作状态进行控制，所述时序控制器以预设的时间通过所述串行总线对所述电源管理集成电路中的代码进行校验，所述总线开关设置于所述片上系统与所述存储器一侧以及所述时序控制器与所述电源管理集成电路一侧之间；
其中，所述写入保护信号通过反相器传送至所述存储器，同时通过延时电路传送至所述总线开关，当所述时序控制器接收到具有低电平的所述写入保护信号时，所述时序控制器处于正常工作模式，所述总线开关为关闭状态，并且所述存储器通过所述反相器接收到具有高电平的所述写入保护信号，使所述存储器为可读不可写的状态；
当所述时序控制器接收到具有高电平的所述写入保护信号时，所述时序控制器处于调试模式，所述总线开关为开启状态，并且所述存储器通过所述反相器接收到具有低电平的所述写入保护信号，使所述存储器为可读可写的状态；
当具有高电平信号的所述写入保护信号输出，且所述串行总线在校验过程中被占用时，所述时序控制器未处于所述调试模式，所述存储器为可读写状态，并且所述写入保护信号在流经所述延时电路后延迟对所述总线开关的开启，直到校验所述电源管理集成电路中的代码的过程结束。
2.根据权利要求1所述的通信架构，其特征在于：所述串行总线为内部集成电路总线(inter-integrated circuit，I2C)。
3.根据权利要求1所述的通信架构，其特征在于：所述存储器为电可擦可编程只读存储器(electrically erasable programmable read only memory，EEPROM)。
4.根据权利要求1所述的通信架构，其特征在于：所述时序控制器在每一帧的空闲(blanking)时间里执行校验。
5.根据权利要求1所述的通信架构，其特征在于：所述延时电路包括电阻器与电容器，所述电阻器的第一端接收所述写入保护信号，第二端电连接所述总线开关以及所述电容器的第一端，并且所述电容器的第二端连接相较于所述写入保护信号低的电平信号。
6.根据权利要求1所述的通信架构，其特征在于：所述总线开关包括有薄膜晶体管(thin film transistor,TFT)，并且通过将所述写入保护信号传送到所述薄膜晶体管的栅极端来实现所述总线开关的开与关。
7.根据权利要求1所述的通信架构，其特征在于：所述正常工作模式包括：正常输出用于驱动所述显示面板的各种控制信号。
8.根据权利要求1所述的通信架构，其特征在于：所述片上系统还通过所述串行总线输出串行信号至所述时序控制器，用以对所述时序控制器进行显示控制。
9.根据权利要求1所述的通信架构，其特征在于：所述存储器存储有屏幕类别信息，所述片上系统通过读取所述屏幕类别信息来判断所述显示面板的显示状态。
10.一种显示面板，其包括如权利要求1-9任一项所述的显示面板的通信架构。
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