CN110085190B - 阵列基板以及显示面板 - Google Patents

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Abstract

本申请涉及一种阵列基板以及显示面板。同行各子像素区域内的第一走线通过第一连接线相互连接。第一连接线与数据线绝缘且交叠，进而与数据线形成电容负载。第n+(x‑1)行子像素区域与第n+x行子像素区域的各基本单元中的第x个子像素区域内均设有第二走线。并且，同列的第x个子像素区域内的第二走线通过第二连接线相互连接。第二连接线与扫描线绝缘且交叠，进而扫描线形成电容负载。因此，本实施例中，扫描线与数据线上均形成了电容负载，在扫描信号与数据信号的传递过程中均存在电阻‑电容延迟效应，从而减小扫描信号与数据信号的时间差，即增加扫描信号与数据信号的同步性，从而有效提高显示均匀性。

Description

阵列基板以及显示面板
技术领域
本申请涉及显示技术领域，特别是涉及一种阵列基板以及显示面板。
背景技术
随着显示技术的发展，出现了应用于手机、电视、笔记本、显示器等各类电子产品的显示面板。显示面板的阵列基板上设有多条扫描线与多条数据线，多条扫描线与多条数据线交叉排列而限定出多个子像素区域。同时，为了形成与像素电极形成存储电容或阻止子像素漏光，阵列基板上还设有公共走线。
传统技术中，公共走线与扫描线平行，而与数据线交叠。因此，公共走线与数据线之间形成电容负载，导致数据线上的信号传递存在电阻-电容延迟效应，进而导致显示不均。
发明内容
基于此，有必要针对上述技术问题，提供一种能够提高显示均匀性的阵列基板以及显示面板。
一种阵列基板，包括：
多条扫描线，排列成多行，用于提供扫描信号；
多条数据线，排列成多列，用于提供数据信号，且与多条扫描线交叉排列而限定出多个呈多行多列排布的子像素区域，所述子像素区域用于设置子像素；
多个像素电极，位于各所述子像素区域内，用于接收所述数据信号；
多条公共走线，用于与各所述子像素区域内的所述像素电极形成存储电容，包括第一走线与第二走线；
每行所述子像素区域的各子像素区域内均设有第一走线，且同行各子像素区域内的第一走线通过第一连接线相互连接，所述第一连接线与所述数据线绝缘且交叠；
每行子像素区域均具有多个基本单元，各所述基本单元均包括m个子像素区域，m为大于1的正整数；设定x为从1一直取值到m的正整数变量，第n+(x-1)行子像素区域与第n+x行子像素区域的各基本单元中的第x个子像素区域内均设有第二走线，且同列第x个子像素区域内的第二走线通过第二连接线相互连接，所述第二连接线与所述扫描线绝缘且交叠，n为正整数。
在其中一个实施例中，所述第一走线与所述第二走线均与所述扫描线同层设置。
在其中一个实施例中，所述第二连接线与所述像素电极同层设置。
在其中一个实施例中，相邻两行子像素区域的同列子像素区域之间均设置有第一电极与第二电极，且需要第二走线相互连接的相邻两行子像素区域的同列子像素区域内的第二走线分别连接二者之间的第一电极与第二电极，并通过第一电极与第二电极与所述第二连接线连接。
在其中一个实施例中，相邻两行子像素区域的同列子像素区域之间均设置有与第一电极与第二电极均连接的第二连接线。
在其中一个实施例中，每行所述子像素区域的第一走线贯穿各所述子像素区域。
在其中一个实施例中，所述第一走线与所述扫描线同层设置，所述第二走线与所述数据线同层设置，每行所述子像素区域的第一走线贯穿各所述子像素区域，相邻两行同列子像素区域内相连的第二走线贯穿该相邻两行同列子像素区域。
在其中一个实施例中，像素电极包括主干、分支以及边框，所述边框包围所述主干与所述分支，所述分支由所述主干延伸至所述边框，所述公共走线与所述边框和/或主干相对设置而形成存储电容。
在其中一个实施例中，每个所述基本单元的各子像素区域内的子像素均构成一个像素单元。
一种显示面板，包括上述任一项所述的阵列基板。
上述阵列基板，同行各子像素区域内的第一走线通过第一连接线相互连接。第一连接线与数据线绝缘且交叠，进而与数据线形成电容负载。第n+(x-1)行子像素区域与第n+x行子像素区域的各基本单元中的第x个子像素区域内均设有第二走线。并且，同列的第x个子像素区域内的第二走线通过第二连接线相互连接。第二连接线与扫描线绝缘且交叠，进而扫描线形成电容负载。因此，本实施例中，扫描线与数据线上均形成了电容负载，在扫描信号与数据信号的传递过程中均存在电阻-电容延迟效应，从而减小扫描信号与数据信号的时间差，即增加扫描信号与数据信号的同步性，从而有效提高显示均匀性。
附图说明
图1为一个实施例中显示面板剖面示意图；
图2为一个实施例中阵列基板局部平面示意图；
图3为一个实施例中阵列基板局部剖面示意图；
图4为另一个实施例中像素电极示意图。
具体实施方式
为了使本申请的目的、技术方案及优点更加清楚明白，以下结合附图及实施例，对本申请进行进一步详细说明。应当理解，此处描述的具体实施例仅仅用以解释本申请，并不用于限定本申请。
本申请提供的显示面板可以应用于手机、电视、笔记本、显示器等各类电子信息产品上，其可以但不限于为液晶显示面板。
在一个实施例中，参考图1以及图2，提供了一种显示面板，包括阵列基板100。阵列基板100包括多条扫描线110、多条数据线120、多个像素电极130、以及多条公共走线140。
本实施例显示面板可以为液晶显示面板。此时，参考图1，显示面板还包括彩膜基板200以及液晶层300。彩膜基板200与阵列基板100相对设置。液晶层300位于彩膜基板200与阵列基板100之间。
参考图2，多条扫描线110与多条数据线120交叉排列而限定出多个子像素区域100a，进而可以在各子像素区域100a内设置各种子像素(例如红色子像素R、绿色子像素G、蓝色子像素B等)。多条扫描线110排列成多行。多条数据线120排列成多列。因此，多个子像素区域100a呈多行多列排布，进而使得各子像素呈多行多列排布。每条扫描线110均为相对应的一行子像素提供扫描信号。每条数据线120均为相对应的一列子像素提供数据信号。
各像素电极130分别位于各子像素区域140内，作为各子像素的阳极。像素电极130接收相应的数据信号作为相应子像素的阳极电压。公共走线140与各子像素区域100a内的像素电极130形成存储电容，进而维持各子像素在一帧内具有持续的阳极电压。
公共走线140包括第一走线141与第二走线142。每行子像素区域的各子像素区域100a内均设有第一走线141。并且，同行各子像素区域100a内的第一走线141通过第一连接线141a相互连接。第一连接线141a与数据线120绝缘且交叠，进而与数据线120形成电容负载。
同时，本实施例中，设置每行子像素区域均具有多个基本单元100b。各基本单元100b均包括m个子像素区域100a，m为大于1的正整数。即各基本单元100b包括至少两个子像素区域100a。
设定x为从1一直取值到m的正整数变量。第n+(x-1)行子像素区域与第n+x行子像素区域的各基本单元100b中的第x个子像素区域内均设有第二走线。并且，同列的第x个子像素区域100a内的第二走线142通过第二连接线142a相互连接(如图2中虚线框里所示)。
例如，m可以取3，即各基本单元100b均包括3个子像素区域100a。此时，x为从1一直取值到3的正整数变量。所以，第n+(1-1)行(即第n行)子像素区域与第n+1行子像素区域的各基本单元100b中的第1个子像素区域100a内均设有第二走线142。并且，同列的第1个子像素区域100a内的第二走线142通过第二连接线142a相互连接。第n+(2-1)行(即第n+1行)子像素区域与第n+2行子像素区域的各基本单元100b中的第2个子像素区域100a内均设有第二走线142。并且，同列的第2个子像素区域100a内的第二走线142通过第二连接线142a相互连接。第n+(3-1)行(即第n+2行)子像素区域与第n+3行子像素区域的各基本单元100b中的第3个子像素区域100a内均设有第二走线142。并且，同列的第3个子像素区域100a内的第二走线142通过第二连接线142a相互连接。
第二连接线142a与扫描线110绝缘且交叠，进而扫描线110形成电容负载，n为正整数。因此，本实施例中，扫描线110与数据线120上均形成了电容负载，在扫描信号与数据信号的传递过程中均存在电阻-电容延迟效应，从而减小扫描信号与数据信号的时间差，即增加扫描信号与数据信号的同步性，从而有效提高显示均匀性。
同时，本实施例每个基本单元100b中只有m分之一的子像素区域100a中的公共走线140(具体为第二走线142)的第二连接线142a与扫描线110交叠而形成电容负载，进而使得显示面板的负载不至于过大，从有效控制显示面板的耗电量。
并且，本实施例在不同行的子像素区域，选择各基本单元100b的不同的子像素区域100a内的第二走线142与相邻行同列子像素区域100a内的第二走线142通过第二连接线142a相互连接，进而使得扫描线110上的电容负载在显示面板上有规律的分布，进而提高显示均匀性。
在一个实施例中，第一走线141与第二走线142均与扫描线110同层设置，进而简化公共走线140的形成过程。此时，可以设置每行子像素区域的第一走线141贯穿各子像素区域100a。即同行各子像素区域100a内的第一走线141以及连接各子像素区域100a内第一走线141的第一连接线141a共线(参考图2)。
同时，参考图3，由于连接相邻两行同列子像素区域内的第二走线142的第二连接线142a是与扫描线110绝缘的，因此第二走线142与第二连接线142a是位于不同层的，二者之间具有绝缘层150。此时，可以通过在二者之间的绝缘层150中设有通孔150a的方式，使得二者连接。
当然，此时连接同行各子像素区域100a内第一走线141的第一连接线141a也可以与第一走线141位于不同层，本申请对此没有限制。
显示面板形成过程中通常为依次在衬底基板上形成扫描线110(同时形成第二走线142)、第一绝缘层、数据线120、第二绝缘层以及像素电极130。因此可以设置第二连接线142a与像素电极130同层设置，进而使得第二连接线142a可以电性连接相邻两行同列子像素区域内的第二走线142，并且不增加显示面板的厚度。
在一个实施例中，参考图2，第一走线141与第二走线142均与扫描线110同层设置时，相邻两行子像素区域的同列子像素区域100a之间均设置有第一电极143与第二电极144。并且，需要第二走线142相互连接的相邻两行子像素区域的同列子像素区域100a内的第二走线142分别连接二者之间的第一电极143与第二电极144，并通过第一电极143与第二电极144与第二连接线142a连接。
此时，需要第二走线142相互连接的相邻两行子像素区域的同列子像素区域100a(例如图中，位于第n行子像素区域以及第n+1行子像素区域的各基本单元100b中的第1个子像素区域100a)之间设置有第一电极143与第二电极144使得第二走线142可以方便地与第二连接线142a连接。同时，本实施例还设置不需要第二走线142相互连接的相邻两行子像素区域的同列子像素区域100a(位于第n行子像素区域以及第n+1行子像素区域的各基本单元100b中的第2个子像素区域100a)之间也设置有第一电极143与第二电极144，进而使得各子像素区域100a的周围环境一致，进而使得各子像素区域100a内的子像素可以均匀显示。
进一步地，为了进一步使得各子像素区域100a的周围环境一致，还可以在相邻两行子像素区域的同列子像素区域100a之间均设置有与第一电极143与第二电极144均连接的第二连接线142。
本申请实施例中，第一走线141与第二走线142也可以不均与扫描线110同层设置。例如，在另一个实施例中，第一走线141与扫描线110同层设置。第二走线142与数据线142同层设置。每行子像素区域100a的第一走线141贯穿各子像素区域100a，相邻两行同列子像素区域100a内相连的第二走线142贯穿该相邻两行同列子像素区域100a。即，同行各子像素区域100a内的第一走线141以及连接各子像素区域100a内第一走线141的第一连接线141a共线。同时，相邻两行同列子像素区域100a内相连的第二走线142与连接第二走线142的第二连接线142a共线。此时，第二走线142于第二连接线142a不再需要进行打孔连接，进而省去打孔工艺。
本申请实施例中，显示面板为液晶显示面板时，参考图4，像素电极130可以包括主干131、分支132以及边框133。边框133包围主干131与分支132。分支132由主干131延伸至边框133。此时实现了显示多畴化，进而对广视野角实现良好的显示。
此时，可是设置公共走线140与边框133相对设置而形成存储电容。或者，也可以设置公共走线140与主干131相对设置而形成存储电容。或者，也可以设置公共走线140同时与边框133以及主干131相对设置而形成存储电容。
在一个实施例中，参考图2，每个基本单元100b的各子像素区域100a内的子像素均构成一个像素单元，进而使得基本单元100b便于设计。当然，每个基本单元100b的各子像素区域100a内的子像素还可以可以构成多个像素单元，或者也可以不构成像素单元，本申请对此并没有限制。
以上实施例的各技术特征可以进行任意的组合，为使描述简洁，未对上述实施例中的各个技术特征所有可能的组合都进行描述，然而，只要这些技术特征的组合不存在矛盾，都应当认为是本说明书记载的范围。
以上所述实施例仅表达了本申请的几种实施方式，其描述较为具体和详细，但并不能因此而理解为对发明专利范围的限制。应当指出的是，对于本领域的普通技术人员来说，在不脱离本申请构思的前提下，还可以做出若干变形和改进，这些都属于本申请的保护范围。因此，本申请专利的保护范围应以所附权利要求为准。

Claims (10)

1.一种阵列基板，其特征在于，包括：
多条扫描线，排列成多行，用于提供扫描信号；
多条数据线，排列成多列，用于提供数据信号，且与多条扫描线交叉排列而限定出多个呈多行多列排布的子像素区域，所述子像素区域用于设置子像素；
多个像素电极，位于各所述子像素区域内，用于接收所述数据信号；
多条公共走线，用于与各所述子像素区域内的所述像素电极形成存储电容，包括第一走线与第二走线；
每行所述子像素区域的各子像素区域内均设有第一走线，且同行各子像素区域内的第一走线通过第一连接线相互连接，所述第一连接线与所述数据线绝缘且交叠；
每行子像素区域均具有多个基本单元，各所述基本单元均包括m个子像素区域，m为大于1的正整数；设定x为从1一直取值到m的正整数变量，第n+(x-1)行子像素区域与第n+x行子像素区域的各基本单元中的第x个子像素区域内均设有第二走线，且同列第x个子像素区域内的第二走线通过第二连接线相互连接，所述第二连接线与所述扫描线绝缘且交叠，n为正整数。
2.根据权利要求1所述的阵列基板，其特征在于，所述第一走线与所述第二走线均与所述扫描线同层设置。
3.根据权利要求2所述的阵列基板，其特征在于，所述第二连接线与所述像素电极同层设置。
4.根据权利要求2所述的阵列基板，其特征在于，相邻两行子像素区域的同列子像素区域之间均设置有第一电极与第二电极，且需要第二走线相互连接的相邻两行子像素区域的同列子像素区域内的第二走线分别连接二者之间的第一电极与第二电极，并通过第一电极与第二电极与所述第二连接线连接。
5.根据权利要求4所述的阵列基板，其特征在于，相邻两行子像素区域的同列子像素区域之间均设置有与二者之间的第一电极与第二电极均连接的第二连接线。
6.根据权利要求2所述的阵列基板，其特征在于，每行所述子像素区域的第一走线贯穿各所述子像素区域。
7.根据权利要求1所述的阵列基板，其特征在于，所述第一走线与所述扫描线同层设置，所述第二走线与所述数据线同层设置，每行所述子像素区域的第一走线贯穿各所述子像素区域，相邻两行同列子像素区域内相连的第二走线贯穿该相邻两行同列子像素区域。
8.根据权利要求1-7任一项所述的阵列基板，其特征在于，像素电极包括主干、分支以及边框，所述边框包围所述主干与所述分支，所述分支由所述主干延伸至所述边框，所述公共走线与所述边框和/或主干相对设置而形成存储电容。
9.根据权利要求1-7任一项所述的阵列基板，其特征在于，每个所述基本单元的各子像素区域内的子像素均构成一个像素单元。
10.一种显示面板，其特征在于，包括权利要求1-9任一项所述的阵列基板。
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