CN109891758A - 全双工传输的虚拟混合 - Google Patents

全双工传输的虚拟混合 Download PDF

Info

Publication number
CN109891758A
CN109891758A CN201780064596.3A CN201780064596A CN109891758A CN 109891758 A CN109891758 A CN 109891758A CN 201780064596 A CN201780064596 A CN 201780064596A CN 109891758 A CN109891758 A CN 109891758A
Authority
CN
China
Prior art keywords
feedback resistor
group
transistor
circuit
circuit according
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
CN201780064596.3A
Other languages
English (en)
Other versions
CN109891758B (zh
Inventor
D·斯图卡
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Microsemi Storage Solutions Inc
Original Assignee
Microsemi Storage Solutions Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Microsemi Storage Solutions Inc filed Critical Microsemi Storage Solutions Inc
Publication of CN109891758A publication Critical patent/CN109891758A/zh
Application granted granted Critical
Publication of CN109891758B publication Critical patent/CN109891758B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F7/00Methods or arrangements for processing data by operating upon the order or content of the data handled
    • G06F7/38Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation
    • G06F7/48Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation using non-contact-making devices, e.g. tube, solid state device; using unspecified devices
    • G06F7/50Adding; Subtracting
    • G06F7/501Half or full adders, i.e. basic adder cells for one denomination
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F5/00Methods or arrangements for data conversion without changing the order or content of the data handled
    • G06F5/01Methods or arrangements for data conversion without changing the order or content of the data handled for shifting, e.g. justifying, scaling, normalising
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K17/00Electronic switching or gating, i.e. not by contact-making and –breaking
    • H03K17/51Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
    • H03K17/56Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
    • H03K17/687Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being field-effect transistors
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04BTRANSMISSION
    • H04B3/00Line transmission systems
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04BTRANSMISSION
    • H04B3/00Line transmission systems
    • H04B3/02Details
    • H04B3/20Reducing echo effects or singing; Opening or closing transmitting path; Conditioning for transmission in one direction or the other
    • H04B3/23Reducing echo effects or singing; Opening or closing transmitting path; Conditioning for transmission in one direction or the other using a replica of transmitted signal in the time domain, e.g. echo cancellers
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L5/00Arrangements affording multiple use of the transmission path
    • H04L5/14Two-way operation using the same type of signal, i.e. duplex
    • H04L5/1461Suppression of signals in the return path, i.e. bidirectional control circuits
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04MTELEPHONIC COMMUNICATION
    • H04M9/00Arrangements for interconnection not involving centralised switching
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04BTRANSMISSION
    • H04B1/00Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
    • H04B1/06Receivers
    • H04B1/16Circuits

Landscapes

  • Engineering & Computer Science (AREA)
  • Signal Processing (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Theoretical Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • Computational Mathematics (AREA)
  • Mathematical Analysis (AREA)
  • Pure & Applied Mathematics (AREA)
  • Computing Systems (AREA)
  • Mathematical Optimization (AREA)
  • Amplifiers (AREA)
  • Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
  • Dc Digital Transmission (AREA)

Abstract

本发明公开了各种传输系统,所述传输系统可受益于改善所述传输的所述质量的技术。例如,某些全双工传输系统可以包括虚拟混合耦合器。电路可以包括第一反馈电阻器。所述电路还可包括第二反馈电阻器,所述第二反馈电阻器耦接到所述第一反馈电阻器。所述电路还可以包括第一组M个晶体管,所述第一组M个晶体管耦接到所述第一反馈电阻器。所述电路附加包括第二组N个晶体管,所述第二组N个晶体管耦接到所述第二反馈电阻器和所述第一组M个晶体管。所述电路可以被配置为基于所述第一反馈电阻器和所述第二反馈电阻器的电阻值的比率并且基于M与N的比率来消除接收器输入处的传输信号。

Description

全双工传输的虚拟混合
相关申请的交叉引用
本专利申请要求2016年10月19日提交的名称为“VIRTUAL HYBRID FOR FULLDUPLEX TRANSMISSION”的美国临时专利申请号62/410,254的全部权益和优先权,其公开内容通过引用的方式并入本文以用于所有目的。
背景技术:
技术领域:
各种传输系统可受益于改善传输质量的技术。例如,某些全双工传输系统可以包括虚拟混合耦合器。
相关技术描述
各种通信系统采用全双工通信。例如,全双工通信可以在铜(Cu)线上发生。例如,在物理层(PHY),全双工通信可以包括1000BT、2.5G、5G和10G以太网。
在铜线上的全双工通信中,传输和接收信号可以同时在同一传输线对上发送。由于传输和接收信号同时在同一传输线对上,因此可能需要一种机制在设备接收路径上移除或最小化来自设备的传输信号。
常规的,解决该问题的解决方案是使用电阻桥式混合耦合器在全双工传输中抵消来自接收器的输入的传输信号。为此,至少一个内部节点摆动超过线幅值。通常,该内部节点处的电压摆幅大约是所需线幅值的两倍。
纳米CMOS技术的低压功率源现在低于必要的电压摆幅。例如,28纳米技术的典型功率源为1.8V,1000BT速度下必要的电压摆幅为2V.实际上,这意味着标准电阻桥式架构不能在纳米互补金属氧化物半导体(CMOS)技术的低功率源约束下使用。
另一种选择是采用基于变换的混合解决方案。这种方法依赖于磁技术。然而,这种方法很少用于千兆位速度。主要原因是此方法体积庞大、昂贵,并提供了平庸的取消。
发明内容:
根据某些实施方案,电路可以包括第一反馈电阻器。电路还可包括第二反馈电阻器,该第二反馈电阻器耦接到第一反馈电阻器。电路还可以包括第一组M个晶体管,该第一组M个晶体管耦接到第一反馈电阻器。电路可以附加包括第二组N个晶体管,该第二组N个晶体管耦接到第二反馈电阻器和第一组M个晶体管。电路可以被配置为基于第一反馈电阻器和第二反馈电阻器的电阻值的比率并且基于M与N的比率来消除接收器输入处的传输信号。
在某些实施方案中,一种方法可包括接收传输信号。该方法还可包括使用第一反馈电阻器和晶体管组的比率匹配接收线的线性电阻。该方法还可包括使用第二反馈电阻器与第一反馈电阻器的比率来消除接收线上的传输信号。
附图说明:
为了正确理解本发明,应参考附图,其中:
图1示出了根据本发明某些实施方案的虚拟混合的简化示意图。
图2示出了根据本发明某些实施方案的方法。
具体实施方式:
本发明的某些实施方案提供了一种电路架构,该电路架构可以将标准兼容信号生成到传输线中,并且可以在与现代纳米CMOS技术相关联的低功率源约束下抵消接收器输入处的传输信号。
例如,根据本发明的某些实施方案,不需要内部节点摆动超过标准规范要求的最大幅值到传输线中。因此,本发明的某些实施方案可以提供可在低电压要求下工作的电路架构。低电压要求可以是例如大约2V或任何其他所需电压。
图1示出了根据本发明某些实施方案的虚拟混合的简化示意图。它是单端的,只有N实现。根据本专利申请,可以实现仅P、推挽和/或差动版本。
在图1中,A为放大器。放大器可以是运算跨导放大器(OTA)、运算放大器(OpAmp)或任何其他所需的放大器。M1和M2可以是分别使用M和N单元晶体管并联构建的金属氧化物半导体(MOS)晶体管。
而且,在图1中,RF1和RF2是两个反馈电阻器。RL是与传输线和接收伙伴相关联的特征阻抗。VCM共模偏压。
在图1中,iTX是传输信号,通常是常规数模转换器(DAC)的输出。接收的信号可以是VRX。电路k是缩放系数为k的缩放电路。大写字母sigma(∑)是一个求和电路。
使用标准电路分析技术,节点Out1、Rout的输出电阻可以用公式1表示。
现在,如果公式2成立,则输出电阻被设置为特征电阻R1的值,如公式3所示。
Rout=RL
公式3
以这种方式,电路的输出电阻可以匹配线性电阻,这可能是高速传输系统中的强制条件。
节点Out1和Out2处的电压可分别表示为公式4和公式5。
节点输出处的输出电压vout由公式6给出。
vout=vout1-kvout2
公式6
当将公式4和公式5引入公式6时,可以看出,如果公式7成立且k=1,则vout由公式8描述。
公式8表明,在上述条件下,可以获得传输信号的完美消除。因为k=1,iTX在Out2处产生的传输信号幅值等于Out1处的幅值。换句话讲,对于k=1,至接收路径的输入的信号仅与接收信号VRX成比例。
而且,如果公式3成立,则输出电压表达式可以如公式9中那样简化。
鉴于以上所述,本发明的某些实施方案可以包括电路,诸如图1中所示的电路。该电路可以包括第一反馈电阻器,诸如RF1。该电路的电阻器可以实现为单个元件、元件网络或任何其他期望的方式。因此,对电阻器的引用可以理解为还包括对具有等效电阻的电阻器集合的引用。例如,每个具有所需电阻的两倍的两个电阻器可以并联连接,并且可以被视为具有所需电阻的电阻器。
电路还可包括第二反馈电阻器,诸如RF2,该第二反馈电阻器耦接到第一反馈电阻器。电路还可以包括第一组M个晶体管,诸如M1,该第一组M个晶体管耦接到第一反馈电阻器。在某些实施方案中,晶体管组可包括一个或多个晶体管。电路附加包括第二组N个晶体管,诸如M2,该第二组N个晶体管耦接到第二反馈电阻器和第一组M个晶体管。
电路可以被配置为基于第一反馈电阻器和第二反馈电阻器的电阻值的比率并且基于M与N的比率来消除接收器输入处的传输信号。这可以如上所述完成,例如,在公式1至9中。而且,电路可以被配置为防止所有内部节点摆动超过预先确定的最大幅值。
电路还可包括缩放电路,诸如k,该缩放电路被配置为缩放第二反馈电阻器和第二组N个晶体管的输出。缩放电路可以被配置为减小或增加第二反馈电阻器的输出。如果需要单位缩放,则可以任选地省略缩放电路。
电路还可包括加法器,诸如∑,该加法器被配置为将缩放电路的输出与第一反馈电阻器和第一组M个晶体管的输出结合。加法器可以结合两个输出的幅值。
在该电路中,第一组M个晶体管的栅极可以直接耦接到第二组N个晶体管的栅极。因此,可以同步所有晶体管的操作。至栅极的信号可以基于传输的信号。
第一反馈电阻器可以直接耦接到第一组M个晶体管。相似地,第二反馈电阻器可以直接耦接到第二组N个晶体管。第一反馈电阻器可以直接耦接到第二反馈电阻器。
电路可以附加包括驱动器,诸如A,该驱动器被配置为基于传输的信号来驱动第一组M个晶体管的栅极和第二组N个晶体管的栅极。例如,驱动器可以是或包括运算放大器、运算跨导放大器或任何其他期望的放大器。
在该电路中,第一组M个晶体管可以彼此并联连接。相似地,第二组N个晶体管可以彼此并联连接。
图2示出了根据本发明某些实施方案的方法。图2的方法可以由图1的示例性电路及其等同物执行。
如图2所示,该方法可以包括在210处接收传输信号。该方法还可包括在220处使用第一反馈电阻器和晶体管组的比率匹配接收线的线性电阻。该方法还可包括在230处使用第二反馈电阻器与第一反馈电阻器的比率来消除接收线上的传输信号。该方法可以附加包括在240处基于传输信号切换晶体管组的栅极。
该方法可以附加包括在232处缩放第二反馈电阻器的输出。该缩放可以作为取消的一部分来执行。该方法还可以包括在234处将第二反馈电阻器的缩放输出与第一反馈电阻器的输出相加。该相加可以作为取消的一部分来执行。
本发明的某些实施方案可适用于以28纳米CMOS技术在1000BT和2.5G速度下的PHY接口。例如,可以在开关中采用此类接口。然而,本发明的某些实施方案可以应用于执行全双工线传输的任何设备。
本领域普通技术人员将容易理解,如上所讨论的本发明可以以不同顺序的步骤和/或使用与所公开的配置不同的配置中的硬件元件来实践。因此,尽管已经基于这些公开的实施方案描述了本发明,但是对于本领域技术人员显而易见的是,某些修改、变型和另选构造将是显而易见的,同时保持在本发明的实质和范围内。

Claims (16)

1.一种电路,包括:
第一反馈电阻器;
第二反馈电阻器,所述第二反馈电阻器耦接到所述第一反馈电阻器;
第一组M个晶体管,所述第一组M个晶体管耦接到所述第一反馈电阻器;和
第二组N个晶体管,所述第二组N个晶体管耦接到所述第二反馈电阻器和所述第一组M个晶体管;
其中所述电路被配置为基于所述第一反馈电阻器和所述第二反馈电阻器的电阻值的比率并且基于M与N的比率来消除接收器输入处的传输信号。
2.根据权利要求1所述的电路,其中所述电路被配置为防止所有内部节点摆动超过预先确定的最大幅值。
3.根据权利要求1所述的电路,还包括:
缩放电路,所述缩放电路被配置为缩放所述第二反馈电阻器和所述第二组N个晶体管的输出。
4.根据权利要求3所述的电路,还包括:
加法器,所述加法器被配置为将所述缩放电路的输出与所述第一反馈电阻器和所述第一组M个晶体管的输出结合。
5.根据权利要求1所述的电路,其中所述第一组M个晶体管的栅极直接耦接到所述第二组N个晶体管的栅极。
6.根据权利要求1所述的电路,其中所述第一反馈电阻器直接耦接到所述第一组M个晶体管。
7.根据权利要求1所述的电路,其中所述第二反馈电阻器直接耦接到所述第二组N个晶体管。
8.根据权利要求1所述的电路,其中所述第一反馈电阻器直接耦接到所述第二反馈电阻器。
9.根据权利要求1所述的电路,还包括:
驱动器,所述驱动器被配置为基于所述传输的信号来驱动所述第一组M个晶体管的栅极和所述第二组N个晶体管的栅极。
10.根据权利要求9所述的电路,其中所述驱动器包括运算放大器或运算跨导放大器中的至少一个。
11.根据权利要求1所述的电路,其中所述第一组M个晶体管彼此并联连接。
12.根据权利要求1所述的电路,其中所述第二组N个晶体管彼此并联连接。
13.一种方法,包括:
接收传输信号;
使用第一反馈电阻器和晶体管组的比率匹配接收线的线性电阻;以及
使用第二反馈电阻器与所述第一反馈电阻器的比率来消除所述接收线上的所述传输信号。
14.根据权利要求13所述的方法,还包括:
缩放所述第二反馈电阻器的输出,其中所述缩放作为所述消除的一部分来执行。
15.根据权利要求14所述的方法,还包括:
将所述第二反馈电阻器的所述缩放输出与所述第一反馈电阻器的输出相加,其中所述求和作为所述消除的一部分来执行。
16.根据权利要求13所述的方法,还包括:
基于所述传输信号切换所述晶体管组的栅极。
CN201780064596.3A 2016-10-19 2017-10-16 用于全双工传输的虚拟混合的电路和方法 Active CN109891758B (zh)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
US201662410254P 2016-10-19 2016-10-19
US62/410,254 2016-10-19
PCT/US2017/056815 WO2018075411A1 (en) 2016-10-19 2017-10-16 Virtual hybrid for full duplex transmission

Publications (2)

Publication Number Publication Date
CN109891758A true CN109891758A (zh) 2019-06-14
CN109891758B CN109891758B (zh) 2021-02-05

Family

ID=60201677

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201780064596.3A Active CN109891758B (zh) 2016-10-19 2017-10-16 用于全双工传输的虚拟混合的电路和方法

Country Status (5)

Country Link
US (1) US10528324B2 (zh)
CN (1) CN109891758B (zh)
DE (1) DE112017005338T5 (zh)
TW (1) TWI729230B (zh)
WO (1) WO2018075411A1 (zh)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US11422203B1 (en) * 2019-02-15 2022-08-23 Maxim Integrated Products, Inc. Current sensing line fault detector

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1655468A (zh) * 2004-02-09 2005-08-17 瑞昱半导体股份有限公司 用于全双工通信系统的可调式回音消除装置
US20060035611A1 (en) * 2004-08-13 2006-02-16 Connell Lawrence E High linearity and low noise CMOS mixer and signal mixing method
US20070205806A1 (en) * 2006-03-01 2007-09-06 Elpida Memory, Inc. Open-drain output circuit
US20130003616A1 (en) * 1998-11-11 2013-01-03 Broadcom Corporation Adaptive Electronic Transmission Signal Cancellation Apparatus for Full Duplex Communication

Family Cites Families (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4551636A (en) * 1983-05-25 1985-11-05 Tektronix, Inc. Wide bandwidth signal coupling circuit having a variable voltage-level shift from input to output
US5963638A (en) * 1996-09-04 1999-10-05 Teltrend, Inc. Adjustable hybrid having improved biasing configuration
US5726563A (en) * 1996-11-12 1998-03-10 Motorola, Inc. Supply tracking temperature independent reference voltage generator
US6343024B1 (en) * 2000-06-20 2002-01-29 Stmicroelectronics, Inc. Self-adjustable impedance line driver with hybrid
EP1633164B1 (en) * 2004-02-13 2010-09-08 Mitsubishi Denki Kabushiki Kaisha Method, system and apparatus for controlling the establishment of a dedicated channel in a Multimedia Broadcast Multicast Service system
US7265620B2 (en) * 2005-07-06 2007-09-04 Pericom Semiconductor Corp. Wide-band high-gain limiting amplifier with parallel resistor-transistor source loads
JP4807074B2 (ja) * 2005-12-28 2011-11-02 Tdk株式会社 温度検出回路及び温度検出方法
US7957522B2 (en) * 2006-03-06 2011-06-07 Winbond Electronics Corporation Programmable plain old telephone line impedance matching circuits
CN100492244C (zh) * 2007-03-21 2009-05-27 北京中星微电子有限公司 一种低压差的电压调节器
US8686698B2 (en) * 2008-04-16 2014-04-01 Enpirion, Inc. Power converter with controller operable in selected modes of operation
US9246390B2 (en) * 2008-04-16 2016-01-26 Enpirion, Inc. Power converter with controller operable in selected modes of operation
US8120390B1 (en) * 2009-03-19 2012-02-21 Qualcomm Atheros, Inc. Configurable low drop out regulator circuit
US9722552B2 (en) * 2014-07-10 2017-08-01 Qorvo Us, Inc. Linear FET feedback amplifier
KR102576541B1 (ko) * 2016-10-13 2023-09-11 엘지디스플레이 주식회사 터치 디스플레이 장치 및 그 구동 방법과, 구동 회로, 데이터 구동 회로 및 게이트 구동 회로

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20130003616A1 (en) * 1998-11-11 2013-01-03 Broadcom Corporation Adaptive Electronic Transmission Signal Cancellation Apparatus for Full Duplex Communication
CN1655468A (zh) * 2004-02-09 2005-08-17 瑞昱半导体股份有限公司 用于全双工通信系统的可调式回音消除装置
US20060035611A1 (en) * 2004-08-13 2006-02-16 Connell Lawrence E High linearity and low noise CMOS mixer and signal mixing method
US20070205806A1 (en) * 2006-03-01 2007-09-06 Elpida Memory, Inc. Open-drain output circuit

Also Published As

Publication number Publication date
CN109891758B (zh) 2021-02-05
TW201820797A (zh) 2018-06-01
DE112017005338T5 (de) 2019-07-11
TWI729230B (zh) 2021-06-01
US10528324B2 (en) 2020-01-07
US20180107452A1 (en) 2018-04-19
WO2018075411A1 (en) 2018-04-26

Similar Documents

Publication Publication Date Title
CN107070824B (zh) 通信接收器均衡器
US7626424B2 (en) Wireline transmission circuit
US8514992B2 (en) Adaptive electronic transmission signal cancellation apparatus for full duplex communication
US8598906B2 (en) Low-power ethernet transmitter
US7778209B2 (en) Passive echo cancellation device and signal transmission method thereof
US10673606B1 (en) High-speed full-duplex transceiver and method thereof
US6665347B2 (en) Output driver for high speed Ethernet transceiver
JP2009153097A (ja) 差動駆動回路および通信装置
US7889752B2 (en) Dual ported network physical layer
US20020060587A1 (en) Output driver for a 10baset/100basetx ethernet physical layer line interface
US7224189B1 (en) AC/DC coupling input network with low-power common-mode correction for current-mode-logic drivers
TW202038562A (zh) 傳送器、接收器及混合式傳送接收器
CN109891758B (zh) 用于全双工传输的虚拟混合的电路和方法
JP4706043B2 (ja) イコライザ回路
TWI779981B (zh) 傳送端電路
US6792105B1 (en) Current-mode differential active hybrid circuit
CN105897183B (zh) 具有消除确定性噪声功能之电路及放大器
JP5578070B2 (ja) 全二重伝送回路、及び電子機器
US6445220B1 (en) Method and apparatus for fully-differential half-circulator for bi-directional small-signal signaling
US9048934B1 (en) Voltage mode driver with enhanced transmit hybrid circuit
US10897252B1 (en) Methods and apparatus for an auxiliary channel
WO2024007794A1 (zh) 一种驱动电路及电子设备
US20150303907A1 (en) Cm clamping methods and circuits for wired communication applications
Stiurca A fully differential line driver with on-chip calibrated source termination for gigabit and fast Ethernet in a standard 0.13/spl mu/CMOS process
Badiey et al. Single-ended impedance-modulation equalization for low-power differential voltage-mode drivers

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant