CN109375180A - 一种基于间歇采样转发的雷达超前干扰fpga实现方法 - Google Patents

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赵忠凯
王少丹
蒋伊琳
张继娜
郜丽鹏
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Abstract

本发明属于有源自卫干扰领域，具体涉及一种基于间歇采样转发的雷达超前干扰FPGA实现方法。利用数字射频存储技术完成对雷达信号的无失真间歇采样、相干存储及转发，得到与雷达信号具有相干性的超前干扰信号，干扰信号在雷达接收端经过匹配滤波后可以得到很高的相干处理增益。本发明包括收发天线、射频接收与发射模块、ADC采样模块、数字信号处理模块、DAC模数转换模块、串口通信模块以及电源模块，本发明主要目的是当干扰机与目标共平台时，产生超前干扰信号，对抗采用抗干扰技术的雷达，对目标进行有效保护。

Description

一种基于间歇采样转发的雷达超前干扰FPGA实现方法
技术领域
本发明属于有源自卫干扰领域，针对干扰机与目标共平台的情况，提出了一种基于间歇采样转发的雷达超前干扰FPGA实现方法。
背景技术
针对采用相干处理技术的雷达，干扰机设计时采用数字射频存储技术，DRFM，对雷达信号进行无失真采样、相干存储以及转发，得到与雷达信号具有相干性的干扰信号，干扰信号在雷达接收端经过匹配滤波后可以得到很高的相干处理增益。但是，转发干扰存在着处理时延，当雷达采用抗干扰技术时，如脉冲前沿跟踪技术，则干扰机发射的干扰信号不能够有效的保护目标。
全脉冲存储转发干扰对干扰机天线隔离度要求较高，实际应用中很难实现，而间歇采样转发干扰不仅能够降低对天线隔离度的要求，还能够产生一组与雷达信号相干的假目标群信号。现有的雷达超前干扰方法主要有两种：其一，采用重频跟踪技术实现超前干扰，该方法不能有效的干扰重频变化的雷达；其二，采用移频干扰技术实现超前干扰，该方法对雷达信号的先验信息要求较高，实现难度较大。综上所述，目前尚没有一种可行性较高的雷达超前干扰方法，因此，本发明具有重要的实际应用价值。
发明内容
本发明的目的在于提供一种基于间歇采样转发的雷达超前干扰FPGA实现方法。
该方法在FPGA系统上实现，该系统由发射天线模块1、接收天线模块2、射频接收与发射模块3、ADC采样模块4、DAC数模转换模块5、数字信号处理模块6、串口通信模块7、电源模块8和上位机模块9组成，该方法包括以下步骤：
①FPGA检测到雷达信号的检波之后，对信号进行频率测量；
②根据频率测量结果，输出前沿频率；
③通过前沿测频结果与已有频点进行比较，判断是否为新频点；
(3.1)如果前沿测频结果与已有频点都不相同，则判定为新信号，有新频点，并计算频点个数：
(3.1.1)根据所计算的频点个数，判断所计算的频点个数是否达到上限N；
(3.1.2)判断结束后，存储模块将采样后的信号存储到随机存取存储器RAM中直至脉冲结束；
(3.2)若前沿测频结果与任一已有频点相同，则判定为没有新频点，此信号为旧信号，并将输入信号进行脉内间歇采样转发；
④无论是新信号还是旧信号，均进行脉外间歇转发，直至脉冲结束，并输出基于间歇采样转发雷达超前干扰信号；
⑤脉冲结束后，若发现新的信号，则重复步骤①到步骤④。
超前干扰信号主要由ADC采样模块4、DAC数模转换模块5、数字信号处理模块6、串口通信模块7、电源模块8组成的数字信号处理板产生，数字信号处理板由窄带信号处理模块和宽带数字信号处理模块组成，其中窄带数字信号处理模块以XC5VSX95T为主控芯片；宽带信号处理模块以XC6VSX315T为主控芯片，ADC采样模块4采用芯片ADC08D1500，DAC数模转换模块5采用芯片AD9739，串口通信模块7采用芯片RS422。
预先设定N个频点，同时设立N个存储空间与N个计数器，如果所述步骤(3.1.1)判断已有N个频点，则进行信号替换，选择重复频率最小的信号进行替换，同时将频率信息、存储信息进行更新；如果所述步骤(3.1.1)判断频点数量小于N，则直接写入新频点频率信息。如果步骤(3.2)所述的旧信号已经存在于存储模块，则只刷新重复频率计数器，信号存储以及频率信息不更替。步骤④所述基于间歇采样转发雷达超前干扰信号为：
式中，ys(t-iT)为每一个完整的假目标群信号，i为接收到目标回波信号后转发完整周期的次数，T为脉宽，fs为采样频率，Ts为采样时间，每一个完整的假目标群信号ys(t-iT)为：
所述步骤①由接收天线模块2接收信号，将接收的信号作为输入信号送到射频接收与发射模块3，射频接收与发射模块3经过下变频处理得到中频模拟信号，所述步骤(3.1.1)判断频点数量若小于N，则直接写入新频点频率信息，并利用ADC采样模块4F以1.3GHz的采样率对信号进行采样，数字信号处理模块6对ADC采样模块4输出的中频数字信号进行测频处理，利用数字信号处理模块6对中频数字信号完成步骤③和④所述识别、存储、转发操作，得到步骤⑤所述基于间歇采样转发雷达数字超前干扰信号，DAC数模转换模块5对数字信号处理模块6输出的数字超前干扰信号进行数模转换得到模拟超前干扰信号，DAC数模转换模块5输出的模拟超前干扰信号经过射频接收与发射模块3的上变频处理得到射频模拟超前干扰信号，最后通过发射天线模块1发出，串口通信模块7连接数字信号处理模块6和上位机模块9，电源模块8为系统供电。
数字信号处理模块6由测频模块、存储模块、主控模块、干扰模块组成，检测到信号检波之后，数字信号处理模块6读取ADC采样模块4的采样数据，利用测频模块采用相位差分法进行测频，对ADC采样模块4输出的8路8比特数据，利用CORDIC算法求取8路数据的相位值，然后进行差分，求得相位差，并进行解卷积处理，求出输入信号的频率，存储模块完成雷达目标信号的无失真存储，存储时对ADC采样模块4输出的8路8比特信号ADC_I和ADC_Q合成为一个128位的数据存储在RAM中，主控模块通过对信号的脉冲描述字进行比较，控制信号是否存储到RAM中，并控制干扰模块生成特定的干扰信号，干扰模块利用FPGA内部的FIFO与加法器，通过级联方式形成欺骗或压制干扰效果。
本发明的有益效果在于：
1、本发明采用了基于DRFM的间歇采样转发方法
基于DRFM技术，利用间歇采样转发方法生成的干扰信号与雷达信号具有相干性，干扰信号经过匹配滤波后得到的脉冲压缩信号与真实回波信号经过匹配滤波后的信号形式相同，只是间歇采样转发信号形成的假目标信号幅度小于真实目标回波信号幅度，假目标信号幅度可通过调节干扰机发射功率来进行调整。其中次假目标是将真实目标回波信号频谱搬移到各次谐波处，并且次假目标群的假目标信号幅度均低于主假目标信号幅度。由于干扰信号的信号形式与雷达真实回波信号形式相同，所以可以起到很好的欺骗干扰效果；由于出现了假目标群，该干扰还具有很好的压制干扰效果。
脉内采用间歇采样转发方法，能够解决全脉冲存储方法存在的脉内不干扰问题；脉外采用间歇侦察转发方法，能够及时的检测到雷达信号，提高干扰机的信号侦察概率。间歇采样转发方法还降低了对干扰机收发天线隔离度的要求。
2、采用了间歇循环转发方法实现雷达超前干扰
移频干扰需要知道雷达的先验信息并且存在功率损失，而本发明的雷达超前干扰方法较采用移频干扰的超前干扰方法而言，约束条件更少，适用环境更广，功率损失更小。
对于利用重频跟踪技术实现雷达超前干扰的方法，当重频不断变化时，可能导致预测波门内发射的干扰信号没有产生超前效果，而本发明方法对于重频变化的雷达信号也具有很好的干扰效果。
采用间歇循环转发方法不仅能够持续的对雷达进行干扰，而且能够有效对抗采用抗干扰技术的雷达。同时，间歇采样循环转发能够实时的开窗侦察，侦察干扰实时性较好。
附图说明
图1基于间歇采样转发雷达超前干扰系统结构框图。
图2(a)基于间歇采样转发雷达超前干扰总体示意图。
图2(b)脉内间歇采样转发示意图。
图2(c)基于间歇采样转发脉外超前干扰示意图。
图3基于间歇采样转发的雷达超前干扰效果图。
图4基于间歇采样转发的雷达超前干扰MATLAB仿真图。
图5基于间歇采样转发雷达超前干扰硬件设计图。
图6干扰机侦察干扰工作流程图。
图7基于间歇采样转发的雷达超前干扰ModelSim仿真图。
具体实施方式
下面结合附图和实例对本发明做更详细地描述。
本发明的目的在于利用FPGA实现基于间歇采样转发的雷达超前干扰方法，完成对雷达信号的无失真间歇采样、相干存储以及转发，形成雷达超前干扰信号，有效的对抗采用抗干扰技术的雷达。实现本发明的技术方案为：一种基于间歇采样转发的雷达超前干扰FPGA实现方法。系统包括收发天线、射频接收与发射模块3、ADC采样模块4、数字信号处理模块6、DAC数模转换模块5、串口通信模块7以及电源模块8。
基于本发明的实现方法为：接收天线将雷达信号传输给射频接收与发射模块3，经过下变频处理得到中频信号，高速ADC对中频信号进行采样，得到8路8比特数字信号，FPGA对信号进行瞬时测频，得到信号的载频、带宽等信息，用于信号分选操作，同时对数字信号进行间歇采样存储转发，在脉冲结束后进行间歇侦察转发直至检测到下一个脉冲。转发产生的干扰信号经过高速DAC后转换为模拟信号，经过射频接收与射频发射模块后上变频转换为模拟信号，通过发射天线发出。
基于间歇采样转发的雷达超前干扰方法在脉内进行间歇采样转发干扰，脉外进行超前干扰，具体步骤如下：
(1)在检测到雷达信号后，在雷达脉冲信号内利用间歇采样转发方法对其行处理，直至脉冲结束；
(2)在脉外进行间歇转发干扰，在此阶段，干扰机将脉内间歇采样存储的信号采取开窗侦察与转发交替进行的方式将信号转发出去，直至再次检测到雷达信号；
(3)基于间歇采样转发的雷达超前干扰方法，其产生的干扰信号就是间歇采样直接转发信号每隔脉宽T进行一次转发所产生的信号，基于间歇采样转发雷达超前干扰信号为：
式中，i为接收到目标回波信号后转发完整周期的次数。每一个完整的假目标群信号为：
如图1所示，本发明硬件由天线、微波前端与数字信号处理板等部分组成，具体包括收发天线、射频接收与发射模块3、ADC采样模块4、数字信号处理模块6、DAC数模转换模块5、串口通信模块7以及电源模块8等。
图2是基于间歇采样转发的雷达超前干扰示意图，基于间歇采样转发的雷达超前干扰方法在脉内进行间歇采样转发干扰，脉间进行间歇侦察转发干扰。在检测到雷达信号后，在雷达信号脉冲内利用间歇采样转发方法对其进行处理，直至脉冲结束。在脉外进行间歇侦察转发干扰，在此阶段，干扰机将脉内间歇采样存储的信号采取开窗侦察与转发交替相结合的方式进行转发，直至再次检测到雷达信号。
图3为基于间歇采样转发的雷达超前干扰效果图，首先，在脉冲信号内，基于间歇采样转发的雷达超前干扰形成的干扰信号在脉内进行间歇采样转发，而基于全脉冲存储的雷达超前干扰形成的干扰信号在脉内只采样不转发；其次，在脉外超前干扰段，基于间歇采样的雷达超前干扰信号是间歇转发，侦察时长与干扰时长均是τ，而基于全脉冲存储的侦察时长为脉宽T。可以发现，干扰机在目标回波信号内也能形成干扰信号。其中雷达信号在脉外间歇侦察干扰的任何一个周期内到达，都可以被侦察到，最大侦察时延为τ，因此目标回波前产生的干扰信号只是雷达信号的前端部分间歇信号，导致其匹配滤波后的幅度会略小于其他干扰信号，但是不影响雷达超前干扰的效果。
由图4可以看出，基于间歇采样转发形成的干扰信号经匹配滤波后，形成假目标群，而不是孤立的一个假目标信号，但是假目标群信号幅度低于基于全脉冲存储转发的雷达超前干扰方法产生的假目标信号幅度，表明该方法会在目标回波前产生多组假目标群，可以实现部分超前效果。
图5是基于间歇采样转发雷达超前干扰硬件设计图，雷达超前干扰系统的数字信号处理板由窄带信号处理模块和宽带数字信号处理模块6两部分组成，其中窄带数字信号处理模块6以XC5VSX95T为主控器件，高速ADC芯片ADC08D500实现对两路中频信号的采样，AD9516进行时钟管理，SN74LVC16T245进行缓冲隔离，实现对FPGA芯片的保护，通过RS422与外部进行通信；宽带信号处理模块以XC6VSX315T为主控器件，其中高速ADC芯片ADC08D1500实现对两路中频信号的采样，DAC芯片AD9739对信号进行数模转换，ADF4360进行时钟管理。
图6是干扰机侦察干扰工作流程图，FPGA检测到雷达信号后，对信号进行前沿测频，干扰机预先设定频点个数为N，同时设立N个存储空间与N个计数器，在检测到信号之后，通过前沿测频与已有频点进行比较，如果都不相同，则判定为新信号，查询信号个数，如果频点数量小于N，则写入新频点频率信息，利用高速ADC以1.3GHz的采样率对信号进行采样，FPGA将采样后的信号存储到RAM中，该信号的重频计数器开始计数；如果已有N个频点，则需要进行信号替换，考虑到雷达信号到达概率以及雷达信号是否不再发射等因素的影响，选择重频最小的信号进行替换，包括频率信息、信号存储以及重频计数器更新。如果信号为已有旧信号，则只刷新重频计数器重新测量，信号存储以及频率信息不更替，利用高速ADC以1.3GHz的采样率对信号进行间歇采样转发。无论是新信号还是旧信号，脉外均采用间歇侦察转发方式。
图7是基于间歇采样转发的雷达超前干扰ModelSim仿真图，利用MATLAB生成信号，通过ISE编写激励文件然后将这些参数导入ModelSim仿真环境中。仿真中只设立一部信号，仿真时钟为6ns。本发明中，干扰机最多可以侦察8部雷达信号，对应的在FPGA内设置8段存储空间以及8个频率寄存器，分别对应仿真中的add_start、add_stop以及fre，其中add_start、add_stop以及fre均进行了初始化。
通过观察图7中pulse信号，可以发现到达了3个脉冲信号，脉冲到达时间分别对应100us、633us与1166us，图中fre_measured为信号描述字，包括信号的频率信息、本振信息、通道信息，fre_measured只在脉内cnt_fre达到130时对数组fre进行赋值操作，通过比较可以发现数组fre只进行了一次赋值，并且频点数量num_max为4’b0001，表明只有一个频点。并且可以看出，在pulse的第二个脉冲与第三个脉冲前，均有信号在发射，表明在目标回波前有干扰信号产生，达到了超前干扰的效果。考虑到干扰机连续长时间工作功耗较大的因素，干扰机在脉外间歇转发之后，增加300us的停止期，此阶段仅侦察信号，不发射干扰信号，这样能够降低干扰机的功耗。
基于间歇采样转发的雷达超前干扰FPGA实现系统，由发射天线模块1、接收天线模块2、射频接收与发射模块3、ADC采样模块4、DAC数模转换模块5、数字信号处理模块6、串口通信模块7、电源模块8和上位机模块9组成，由接收天线模块2产生输入信号经过接收后送到射频接收与发射模块3，射频接收与发射模块3经过下变频处理得到中频模拟信号，ADC采样模块4对射频接收与发射模块3输出的中频模拟信号进行采样，得到8路8比特的中频数字信号，数字信号处理模块6对ADC采样模块4输出的中频数字信号进行测频处理，计算出信号的载频、带宽等信息，用于信号的分选操作，同时数字信号处理模块6对中频数字信号进行识别、存储、转发操作生成数字超前干扰信号，DAC数模转换模块5对数字信号处理模块6输出的数字超前干扰信号进行数模转换得到模拟超前干扰信号，DAC数模转换模块5输出的模拟超前干扰信号经过射频接收与发射模块3的上变频处理得到射频模拟超前干扰信号，最后通过发射天线模块1发出，串口通信模块7连接数字信号处理模块6和上位机模块9，实现干扰参数设置，电源模块8为系统供电。
超前干扰信号主要由ADC采样模块4、DAC数模转换模块5、数字信号处理模块6、串口通信模块7、电源模块8组成的数字信号处理板产生，数字信号处理板由窄带信号处理模块和宽带数字信号处理模块6组成，其中窄带信号处理板控制接收天线模块21、发射天线模块12、射频接收与发射模块3以及串口通信，宽带信号处理板主要完成对雷达信号的精测频、信号存储以及转发，最终形成雷达超前干扰信号，其中窄带数字信号处理模块6以XC5VSX95T为主控芯片；宽带信号处理模块以XC6VSX315T为主控芯片，ADC采样模块4采用芯片ADC08D1500实现对两路中频I/Q信号的采样，其单路最高采样率为1.5GSPS，DAC数模转换模块5采用芯片AD9739对信号进行数模转换，转换率高达2500MSPS，串口通信模块7采用芯片RS422实现数字信号处理模块6与上位机模块9通信。
数字信号处理模块6由测频模块、存储模块、主控模块、干扰模块组成，检测到信号检波之后，数字信号处理模块6读取ADC采样模块4的采样数据，利用测频模块采用相位差分法进行测频，对ADC采样模块4输出的8路8比特数据，利用CORDIC算法求取8路数据的相位值，然后进行差分，求得相位差，并进行解卷积处理，求出输入信号的频率，存储模块完成雷达目标信号的无失真存储，存储时对ADC采样模块4输出的8路8比特信号ADC_I和ADC_Q合成为一个128位的数据存储在RAM中，主控模块通过对信号的脉冲描述字进行比较，控制信号是否存储到RAM中，并控制干扰模块生成特定的干扰信号，干扰模块利用FPGA内部的FIFO与加法器，通过级联方式形成欺骗或压制干扰效果。
基于间歇采样转发的雷达超前干扰FPGA实现方法，包括以下步骤：
1在检测到雷达信号后，在雷达脉冲信号内利用间歇采样转发方法对其行处理，直至脉冲结束；
2脉冲结束后，在脉外进行间歇转发干扰，在此阶段，干扰机将脉内间歇采样存储的信号采取开窗侦察与转发交替进行的方式将信号转发出去，直至再次检测到雷达信号，并重复步骤1到2。
基于间歇采样转发雷达超前干扰信号为：
式中，ys(t-iT)为每一个完整的假目标群信号，i为接收到目标回波信号后转发完整周期的次数，T为脉宽，fs为采样频率，Ts为采样时间，每一个完整的假目标群信号ys(t-iT)为：
式中，i为接收到目标回波信号后转发完整周期的次数，T为脉宽，fs为采样频率，Ts为采样时间。
FPGA检测到雷达信号的检波之后，对信号进行前沿测频，干扰机预先设定N个频点，同时设立N个存储空间与N个计数器，通过前沿测频与已有频点进行比较，如果都不相同，则判定为新信号，并计算频点个数，如果频点数量小于N，则写入新频点频率信息，利用ADC采样模块4以1.3GHz的采样率对信号进行采样，存储模块将采样后的信号存储到RAM中；如果已有N个频点，则需要进行信号替换，选择重频最小的信号进行替换，同时将频率信息、存储信息进行更新。如果存储模块已有旧信号，则只刷新重频计数器，信号存储以及频率信息不更替，无论是新信号还是旧信号，脉外均采用间歇侦察转发干扰方式。

Claims (7)

1.一种基于间歇采样转发的雷达超前干扰FPGA实现方法，其特征在于：该方法在FPGA系统上实现，该系统由发射天线模块(1)、接收天线模块(2)、射频接收与发射模块(3)、ADC采样模块(4)、DAC数模转换模块(5)、数字信号处理模块(6)、串口通信模块(7)、电源模块(8)和上位机模块(9)组成，该方法包括以下步骤：
①FPGA检测到雷达信号的检波之后，对信号进行频率测量；
②根据频率测量结果，输出前沿频率；
③通过前沿测频结果与已有频点进行比较，判断是否为新频点；
(3.1)如果前沿测频结果与已有频点都不相同，则判定为新信号，有新频点，并计算频点个数：
(3.1.1)根据所计算的频点个数，判断所计算的频点个数是否达到上限N；
(3.1.2)判断结束后，存储模块将采样后的信号存储到随机存取存储器RAM中直至脉冲结束；
(3.2)若前沿测频结果与任一已有频点相同，则判定为没有新频点，此信号为旧信号，并将输入信号进行脉内间歇采样转发；
④无论是新信号还是旧信号，均进行脉外间歇转发，直至脉冲结束，并输出基于间歇采样转发雷达超前干扰信号；
⑤脉冲结束后，若发现新的信号，则重复步骤①到步骤④。
2.根据权利要求1所述的一种基于间歇采样转发的雷达超前干扰FPGA实现方法，其特征在于：超前干扰信号主要由ADC采样模块(4)、DAC数模转换模块(5)、数字信号处理模块(6)、串口通信模块(7)、电源模块(8)组成的数字信号处理板产生，数字信号处理板由窄带信号处理模块和宽带数字信号处理模块组成，其中窄带数字信号处理模块以XC5VSX95T为主控芯片；宽带信号处理模块以XC6VSX315T为主控芯片，ADC采样模块(4)采用芯片ADC08D1500，DAC数模转换模块(5)采用芯片AD9739，串口通信模块(7)采用芯片RS422。
3.根据权利要求1所述的一种基于间歇采样转发的雷达超前干扰FPGA实现方法，其特征在于：预先设定N个频点，同时设立N个存储空间与N个计数器，如果所述步骤(3.1.1)判断已有N个频点，则进行信号替换，选择重复频率最小的信号进行替换，同时将频率信息、存储信息进行更新；如果所述步骤(3.1.1)判断频点数量小于N，则直接写入新频点频率信息。
4.根据权利要求1所述的一种基于间歇采样转发的雷达超前干扰FPGA实现方法，其特征在于：如果步骤(3.2)所述的旧信号已经存在于存储模块，则只刷新重复频率计数器，信号存储以及频率信息不更替。
5.根据权利要求4所述的一种基于间歇采样转发的雷达超前干扰FPGA实现方法，其特征在于，步骤④所述基于间歇采样转发雷达超前干扰信号为：
式中，ys(t-iT)为每一个完整的假目标群信号，i为接收到目标回波信号后转发完整周期的次数，T为脉宽，fs为采样频率，Ts为采样时间，每一个完整的假目标群信号ys(t-iT)为：
6.根据权利要求1所述的一种基于间歇采样转发的雷达超前干扰FPGA实现方法，其特征在于：所述步骤①由接收天线模块(2)接收信号，将接收的信号作为输入信号送到射频接收与发射模块(3)，射频接收与发射模块(3)经过下变频处理得到中频模拟信号，所述步骤(3.1.1)判断频点数量若小于N，则直接写入新频点频率信息，并利用ADC采样模块(4)以1.3GHz的采样率对信号进行采样，数字信号处理模块(6)对ADC采样模块(4)输出的中频数字信号进行测频处理，利用数字信号处理模块(6)对中频数字信号完成步骤③和④所述识别、存储、转发操作，得到步骤⑤所述基于间歇采样转发雷达数字超前干扰信号，DAC数模转换模块(5)对数字信号处理模块(6)输出的数字超前干扰信号进行数模转换得到模拟超前干扰信号，DAC数模转换模块(5)输出的模拟超前干扰信号经过射频接收与发射模块(3)的上变频处理得到射频模拟超前干扰信号，最后通过发射天线模块(1)发出，串口通信模块(7)连接数字信号处理模块(6)和上位机模块(9)，电源模块(8)为系统供电。
7.根据权利要求6所述的一种基于间歇采样转发的雷达超前干扰FPGA实现方法，其特征在于：数字信号处理模块(6)由测频模块、存储模块、主控模块、干扰模块组成，检测到信号检波之后，数字信号处理模块(6)读取ADC采样模块(4)的采样数据，利用测频模块采用相位差分法进行测频，对ADC采样模块(4)输出的8路8比特数据，利用CORDIC算法求取8路数据的相位值，然后进行差分，求得相位差，并进行解卷积处理，求出输入信号的频率，存储模块完成雷达目标信号的无失真存储，存储时对ADC采样模块(4)输出的8路8比特信号ADC_I和ADC_Q合成为一个128位的数据存储在RAM中，主控模块通过对信号的脉冲描述字进行比较，控制信号是否存储到RAM中，并控制干扰模块生成特定的干扰信号，干扰模块利用FPGA内部的FIFO与加法器，通过级联方式形成欺骗或压制干扰效果。
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