CN109002375A - 一种应用于服务器的上电时序信号监测系统及方法 - Google Patents
一种应用于服务器的上电时序信号监测系统及方法 Download PDFInfo
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Abstract
本发明公开了一种应用于服务器的上电时序信号监测系统及方法,该方法通过信号解析装置对主板的上电时序信号引脚的信号进行解析得到每个上电时序信号对应的状态数据,并按照预设的存储方式将状态数据进行存储以便显示驱动装置读取,显示驱动装置依据状态数据控制显示模块显示存储地址。由于存储地址与上电时序信号具有唯一对应关系,因此,通过显示模块显示的存储地址,可以确定对应的上电时序信号进而确定该信号所在的引脚。由此可见,通过本发明所提供的实施方式当出现宕机时,可以根据显示模块显示的信息快速确定每个引脚输出的上电时序信号,不需要用户逐个排查,提高了故障定位的效率。此外,通过显示模块的显示方式更加直观。
Description
技术领域
本发明涉及上电时序信号技术领域,特别是涉及一种应用于服务器的上电时序信号监测系统及方法。
背景技术
随着服务器的功能日益强大,其应用范围也越来越广泛。在应用过程中,服务器的性能是一项重要的参数,但是除了性能外,用户对于使用过程中的人性化操作和应用直观化的要求也越来越高。例如,从操作者和使用者的角度来说,直观的显示服务器的运行状态是一项迫切的要求。
现有技术中,服务器的常规设计是外部面板添加有用于显示开机、关机复位、工作状态等信号的LED。具体是将主板内的Power on/off、Reset、Status等信号接到外部面板的LED,通过观察LED的亮灭来判断服务器是否开机,工作状态是否正常,上电时序是否完成等。
虽然,现有技术中可以通过观察外部面板的LED亮灭来判断服务器是否正常,但是其并不能直观有效的反应服务器宕机时是出现了什么问题,也不能显示服务器的宕机位置与宕机时的上电时序阶段状况,导致用户在遇到宕机问题时必须去排查每个阶段点。很显然,这样的监测方式没有针对性,不仅增加了人力成本,更会降低排查问题的效率,最终极大的影响了服务器的稳定性,增加了后期维护成本。
由此可见,在出现宕机时如何快速实现对故障的定位是本领域技术人员亟待解决的问题。
发明内容
本发明的目的是提供一种应用于服务器的上电时序信号监测系统及方法,用于在出现宕机时快速实现对故障的定位。
为解决上述技术问题,本发明提供一种应用于服务器的上电时序信号监测系统,包括:
与主板的各上电时序信号引脚连接的信号解析装置,用于将接收到的各上电时序信号进行解析得到各所述上电时序信号对应的状态数据,并按照预设的存储地址存储各所述状态数据;
与所述信号解析装置连接的显示驱动装置,用于读取各所述存储地址存储的所述状态数据,并依据各所述状态数据控制显示模块显示对应的存储地址;
其中,各所述存储地址与各所述上电时序信号具有唯一对应关系。
优选地,所述信号解析装置具体包括:信号侦测装置和数据寄存装置;
所述信号侦测装置与各所述上电时序信号引脚连接,用于侦测各所述上电时序信号的电平变化得到各所述状态数据;
所述数据寄存装置,具体包括与所述信号侦测装置的输出端连接的串/并信号转换器件,用于将所述状态数据转换成对应的并行信号;和与所述串/并信号转换器件连接的数据寄存器,用于按照预设的存储地址存储各所述状态数据。
优选地,所述信号侦测装置具体为CPLD,所述串/并信号转换器件具体为STPC器件。
优选地,还包括设置于所述CPLD与所述STPC器件之间的连接器。
优选地,各所述上电时序信号具体为SLP_S3#、SLP_S4#、P12V_PWRGD、P5V_PWRGD、P3V3_PWRGD、PVPP_PWRGD、PVDDQ_PWRGD、PVTT_PWRGD、DRAM_PWRGD、PVVIO_PWRGD、PVCCIN_PWRGD、PVVSA_PWRGD、PCH_PWROK、CPU_PWRGOOD。
优选地,所述存储地址具体为0x01h-0x0Eh,对应的,所述显示模块显示的信息具体为01-0E。
优选地,所述显示模块为一个,用于循环显示所述存储地址。
优选地,所述显示模块的相邻两次显示的时间间隔为0.25秒。
优选地,还包括与所述信号解析装置连接的蜂鸣器,用于在所述状态数据缺失时,报警提示。
为解决上述技术问题,本发明还提供一种应用于服务器的上电时序信号监测方法,包括:
对接收到的主板的各上电时序信号引脚输出的各上电时序信号进行解析以得到各所述上电时序信号对应的状态数据,并按照预设的存储地址存储各所述状态数据;
读取各所述存储地址存储的所述状态数据,并依据各所述状态数据控制显示模块显示对应的存储地址;
其中,各所述存储地址与各所述上电时序信号具有唯一对应关系。
本发明所提供的应用于服务器的上电时序信号监测系统,通过信号解析装置对主板的上电时序信号引脚的信号进行解析得到每个上电时序信号对应的状态数据,并按照预设的存储方式将状态数据进行存储以便显示驱动装置读取,显示驱动装置依据状态数据控制显示模块显示存储地址。由于存储地址与上电时序信号具有唯一对应关系,因此,通过显示模块显示的存储地址,可以确定对应的上电时序信号进而确定该信号所在的引脚。由此可见,通过本发明所提供的实施方式当出现宕机时,可以根据显示模块显示的信息快速确定每个引脚输出的上电时序信号,不需要用户逐个排查,提高了故障定位的效率。此外,通过显示模块的显示方式更加直观。
另外,本发明所提供的应用于服务器的上电时序信号监测方法与上述系统相对应,同样具有上述有益效果。
附图说明
为了更清楚地说明本发明实施例,下面将对实施例中所需要使用的附图做简单的介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为本发明实施例提供的一种应用于服务器的上电时序信号监测系统的结构图;
图2为本发明实施例提供的另一种应用于服务器的上电时序信号监测系统的结构图;
图3为本发明实施例提供的另一种应用于服务器的上电时序信号监测方法的流程图。
具体实施方式
下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明一部分实施例,而不是全部实施例。基于本发明中的实施例,本领域普通技术人员在没有做出创造性劳动前提下,所获得的所有其他实施例,都属于本发明保护范围。
本发明的核心是提供一种应用于服务器的上电时序信号监测系统及方法,用于在出现宕机时快速实现对故障的定位。
为了使本技术领域的人员更好地理解本发明方案,下面结合附图和具体实施方式对本发明作进一步的详细说明。
图1为本发明实施例提供的一种应用于服务器的上电时序信号监测系统的结构图。如图1所示,该系统包括:
与主板10的各上电时序信号引脚连接的信号解析装置11,用于将接收到的各上电时序信号进行解析得到各上电时序信号对应的状态数据,并按照预设的存储地址存储各状态数据。
与信号解析装置11连接的显示驱动装置12,用于读取各存储地址存储的状态数据,并依据各状态数据控制显示模块13显示对应的存储地址。
其中,各存储地址与各上电时序信号具有唯一对应关系。
在具体实施中,当服务器出现宕机时,其主板10上的上电时序信号能够准确的反应宕机状态。需要说明的是,信号解析装置11具有多个输入端,每个输入端分别与主板10的一个上电时序信号引脚连接,也就是说信号解析装置11能够同时得到主板11的全部上电时序信号。可以理解的是,主板11的上电时序信号有多种,对应的上电时序信号引脚就有多个,本实施例中对于上电时序信号的类型不作限定,数量也不作限定,通常情况下,数量都是多个。
对于信号解析装置11来说,其作用是解析每个上电时序信号对应的状态数据,需要说明的是,这里的状态数据可以是对电平信号的分析结果,例如是高电平还是低电平,或者是是否有信号。例如状态数据可以通过0或1分别表示无信号或有信号,当出现0表示无电信号,当出现1表示有上电信号。将得到的状态数据按照预设的存储地址进行存储,需要说明的是,每个存储地址仅存储有一个状态数据。
显示驱动装置12是依据状态数据控制显示模块13显示对应的存储地址,例如,状态数据表示无信号或有信号时,则显示驱动装置12读取到某一个存储地址中状态数据表示无信号时,则可以控制显示模块13显示该存储地址。当以这种方式进行显示时,用户可以通过显示模块13显示的存储地址确定出对应的上电时序信号是否出现故障,从而快速确定故障的位置。
需要说明的是,显示驱动装置12如何控制显示模块13的显示方式可以依据状态数据所表征的实际内容来确定,本实施例不作限定。
在一种具体实施方式中,显示模块13的数量可以是一个地址对应一个显示模块13,或者全部地址对应一个显示模块13。如果是全部地址都通过一个显示模块13显示的话,则可以采用循环显示的方式显示。
本实施例提供的应用于服务器的上电时序信号监测系统,通过信号解析装置对主板的上电时序信号引脚的信号进行解析得到每个上电时序信号对应的状态数据,并按照预设的存储方式将状态数据进行存储以便显示驱动装置读取,显示驱动装置依据状态数据控制显示模块显示存储地址。由于存储地址与上电时序信号具有唯一对应关系,因此,通过显示模块显示的存储地址,可以确定对应的上电时序信号进而确定该信号所在的引脚。由此可见,通过本发明所提供的实施方式当出现宕机时,可以根据显示模块显示的信息快速确定每个引脚输出的上电时序信号,不需要用户逐个排查,提高了故障定位的效率。此外,通过显示模块的显示方式更加直观。
图2为本发明实施例提供的另一种应用于服务器的上电时序信号监测系统的结构图。在上述实施例的基础上,作为优选地实施方式,信号解析装置11具体包括:信号侦测装置110和数据寄存装置111;
信号侦测装置110与各上电时序信号引脚连接,用于侦测各上电时序信号的电平变化得到各状态数据。
作为优选地实施方式,各上电时序信号具体为SLP_S3#、SLP_S4#、P12V_PWRGD、P5V_PWRGD、P3V3_PWRGD、PVPP_PWRGD、PVDDQ_PWRGD、PVTT_PWRGD、DRAM_PWRGD、PVVIO_PWRGD、PVCCIN_PWRGD、PVVSA_PWRGD、PCH_PWROK、CPU_PWRGOOD。需要说明的是,除了上述几种类型的上电时序信号外,还可以包括其它类型的信号,例如,SYS_PWROK、PLT_RST#、PE_RST#等,本发明不作赘述。对于信号侦测装置10来说,其作用是侦测每个引脚输出的上电时序信号的电平变化,从而得到各上电时序信号对应的状态数据。对于信号侦测装置10来说,接收到的上电时序信号是串行信号,其输出的状态数据也是串行信号。
数据寄存装置111,具体包括与信号侦测装置110的输出端连接的串/并信号转换器件,用于将状态数据转换成对应的并行信号;和与串/并信号转换器件连接的数据寄存器,用于按照预设的存储地址存储各状态数据。
需要说明的是,数据寄存器中的存储地址的个数不小于上电时序信号的个数,为了方便后续使用,通常情况下,数据寄存器中的存储地址需要设置的足够多。
作为优选地实施方式,信号侦测装置110具体为CPLD,如图2所示,串/并信号转换器件具体为STPC器件。
在具体实施中,CPLD通过侦测上电时序信号的电平变化,读取到每个上电时序信号的状态数据,并将其状态数据记录下来,内部做串行数据转换处理成SGPIO信号,然后通过CPLD的5个输出SGPIO脚位(图中分别是SGPIO1、SGPIO2、SGPIO3、SGPIO4、SGPIO5)输出至STPC器件的输入端。如图2所示,在一种具体实施方式中,数据寄存器包括4个输出端,分别为Data0、Data1、Data2、Data3,4个输出端分别与显示驱动装置12的输入端连接。需要说明的是,由于STPC器件将状态数据转换成对应的并行信号,因此,数据存储器得到的并行信号,显示驱动装置得到也是并行信号,显示驱动装置12读取数据寄存器中的存储地址中的状态数据,从而控制显示模块13显示。在一种具体实施方式中,显示驱动装置12可以包括3个输出端,分别是Display0、Display1、Display2。
需要说明的是,数据寄存器包括4个输出端,显示驱动装置12包括3个输出端仅仅是一种具体应用场景,并不代表只能是4个或3个。
作为优选地实施方式,还包括设置于CPLD与STPC器件之间的连接器14。
在具体实施中,为了方便查看显示模块13的显示信息,需要通过连接器14将相应的信号引出。连接器14的作用是将输出的SGPIO信号输送给数据寄存装置111,并且方便插拔。至于连接器14的型号可以根据具体应用场景选取,本实施例不作限定。
作为优选地实施方式,存储地址具体为0x01h-0x0Eh,对应的,显示模块13显示的信息具体为01-0E。表1为本发明实施例提供的上电时序信号、存储地址以及显示信息的对应关系表。
表1
上电时序信号 | 存储地址 | 显示信息 |
SLP_S3# | 0x01h | 01 |
SLP_S4# | 0x02h | 02 |
P12V_PWRGD | 0x03h | 03 |
P5V_PWRGD | 0x04h | 04 |
P3V3_PWRGD | 0x05h | 05 |
PVPP_PWRGD | 0x06h | 06 |
PVDDQ_PWRGD | 0x07h | 07 |
PVTT_PWRGD | 0x08h | 08 |
DRAM_PWRGD | 0x09h | 09 |
PVVIO_PWRGD | 0x0Ah | 0A |
PVCCIN_PWRGD | 0x0Bh | 0B |
PVVSA_PWRGD | 0x0Ch | 0C |
PCH_PWROK | 0x0Dh | 0D |
CPU_PWRGOOD | 0x0Eh | 0E |
需要说明的是,虽然显示模块13显示的是存储地址,但是事实上存储地址其实是一种地址位。另外,显示模块13虽然能够显示表1中的显示信息,但是并不代表每次均会显示,是要根据状态数据而定。
在上述实施例的基础上,显示模块13为一个,用于循环显示存储地址。
如图2所示,显示模块13为一个,具体包括两个数码显示管,可以理解的是,数码显示管的个数需要依据上电时序信号的个数确定。而显示模块13采用一个,可以节约硬件成本。另外,显示模块13除了是数码显示管外,还可以是LED显示屏,选取何种显示器件需要依据显示信息的数量而定,本实施例不作限定。
优选地,显示模块13的相邻两次显示的时间间隔为0.25秒。
具体实施方式如下:显示驱动装置12依据每个上电时序信号对应的状态数据按间隔0.25秒驱动数码显示管,数码显示管收到相应的驱动信号,然后显示出来。显示驱动装置12读取数据寄存器的各存储地址,若数据寄存器的Ox01h~Ox11h地址中有状态数据,就输出一个其对应的地址位号,然后间隔0.25秒再输出下一个地址位号。若寄存器Ox01h~Ox11h地址中某一地址没有状态数据,就不再输出此地址号,而保持停留在上一个地址号。例如,Ox07h地址位有状态数据,就控制数码显示管显示07,依次类推;若0x07h地址位没有状态数据,就保持输出上一个地址位号,即控制数码显示管保持06。
针对这一的实施方式,若数码显示管显示08,就可判断数据寄存器中的0x09对应的DRAM_PWRGD出现了问题,则用户可以重点检查DRAM_PWRGD相关信号,实现故障快速定位。
在上述实施例的基础上,还包括与信号解析装置11连接的蜂鸣器,用于在状态数据缺失时,报警提示。
由于显示模块13是以显示的方式呈现给用户,需要用户不断查看才能进行实时监测,容易引起视觉疲劳。本实施例中,通过蜂鸣器,用户可以解放双眼,在蜂鸣器报警提示时再观看显示模块13的显示信息。
上述实施例中对于应用于服务器的上电时序信号监测系统进行了详细描述,本发明还提供一种与该系统对应的应用于服务器的上电时序信号监测方法。如图3所示,该监测方法包括:
S10:对接收到的主板的各上电时序信号引脚输出的各上电时序信号进行解析以得到各上电时序信号对应的状态数据,并按照预设的存储地址存储各状态数据。
S11:读取各存储地址存储的状态数据,并依据各状态数据控制显示模块显示对应的存储地址。
其中,各存储地址与各上电时序信号具有唯一对应关系。
由于方法部分的实施例与系统部分的实施例相互对应,因此方法部分的实施例请参见系统部分的实施例的描述,这里暂不赘述。
本实施例提供的应用于服务器的上电时序信号监测方法,通过对主板的上电时序信号引脚的信号进行解析得到每个上电时序信号对应的状态数据,并按照预设的存储方式将状态数据进行存储以便显示驱动装置读取,然后依据状态数据控制显示模块显示存储地址。由于存储地址与上电时序信号具有唯一对应关系,因此,通过显示模块显示的存储地址,可以确定对应的上电时序信号进而确定该信号所在的引脚。由此可见,通过本发明所提供的实施方式当出现宕机时,可以根据显示模块显示的信息快速确定每个引脚输出的上电时序信号,不需要用户逐个排查,提高了故障定位的效率。此外,通过显示模块的显示方式更加直观。
以上对本发明所提供的应用于服务器的上电时序信号监测系统及方法进行了详细介绍。说明书中各个实施例采用递进的方式描述,每个实施例重点说明的都是与其他实施例的不同之处,各个实施例之间相同相似部分互相参见即可。对于实施例公开的装置而言,由于其与实施例公开的方法相对应,所以描述的比较简单,相关之处参见方法部分说明即可。应当指出,对于本技术领域的普通技术人员来说,在不脱离本发明原理的前提下,还可以对本发明进行若干改进和修饰,这些改进和修饰也落入本发明权利要求的保护范围内。
还需要说明的是,在本说明书中,诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来,而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且,术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含,从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素,而且还包括没有明确列出的其他要素,或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下,由语句“包括一个……”限定的要素,并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。
Claims (10)
1.一种应用于服务器的上电时序信号监测系统,其特征在于,包括:
与主板的各上电时序信号引脚连接的信号解析装置,用于将接收到的各上电时序信号进行解析得到各所述上电时序信号对应的状态数据,并按照预设的存储地址存储各所述状态数据;
与所述信号解析装置连接的显示驱动装置,用于读取各所述存储地址存储的所述状态数据,并依据各所述状态数据控制显示模块显示对应的存储地址;
其中,各所述存储地址与各所述上电时序信号具有唯一对应关系。
2.根据权利要求1所述的应用于服务器的上电时序信号监测系统,其特征在于,所述信号解析装置具体包括:信号侦测装置和数据寄存装置;
所述信号侦测装置与各所述上电时序信号引脚连接,用于侦测各所述上电时序信号的电平变化得到各所述状态数据;
所述数据寄存装置,具体包括与所述信号侦测装置的输出端连接的串/并信号转换器件,用于将所述状态数据转换成对应的并行信号;和与所述串/并信号转换器件连接的数据寄存器,用于按照预设的存储地址存储各所述状态数据。
3.根据权利要求2所述的应用于服务器的上电时序信号监测系统,其特征在于,所述信号侦测装置具体为CPLD,所述串/并信号转换器件具体为STPC器件。
4.根据权利要求3所述的应用于服务器的上电时序信号监测系统,其特征在于,还包括设置于所述CPLD与所述STPC器件之间的连接器。
5.根据权利要求1-4任意一项所述的应用于服务器的上电时序信号监测系统,其特征在于,各所述上电时序信号具体为SLP_S3#、SLP_S4#、P12V_PWRGD、P5V_PWRGD、P3V3_PWRGD、PVPP_PWRGD、PVDDQ_PWRGD、PVTT_PWRGD、DRAM_PWRGD、PVVIO_PWRGD、PVCCIN_PWRGD、PVVSA_PWRGD、PCH_PWROK、CPU_PWRGOOD。
6.根据权利要求5所述的应用于服务器的上电时序信号监测系统,其特征在于,所述存储地址具体为0x01h-0x0Eh,对应的,所述显示模块显示的信息具体为01-0E。
7.根据权利要求1所述的应用于服务器的上电时序信号监测系统,其特征在于,所述显示模块为一个,用于循环显示所述存储地址。
8.根据权利要求7所述的应用于服务器的上电时序信号监测系统,其特征在于,所述显示模块的相邻两次显示的时间间隔为0.25秒。
9.根据权利要求1所述的应用于服务器的上电时序信号监测系统,其特征在于,还包括与所述信号解析装置连接的蜂鸣器,用于在所述状态数据缺失时,报警提示。
10.一种应用于服务器的上电时序信号监测方法,其特征在于,包括:
对接收到的主板的各上电时序信号引脚输出的各上电时序信号进行解析以得到各所述上电时序信号对应的状态数据,并按照预设的存储地址存储各所述状态数据;
读取各所述存储地址存储的所述状态数据,并依据各所述状态数据控制显示模块显示对应的存储地址;
其中,各所述存储地址与各所述上电时序信号具有唯一对应关系。
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