CN107610647A - 像素电路的驱动模组、方法和显示装置 - Google Patents

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Abstract

本发明提供一种像素电路的驱动模组、方法和显示装置。所述像素电路的驱动模组包括：信号生成单元，将读取控制信号传送至相应行读取控制线，将栅极驱动控制信号传送至栅极驱动电路；所述栅极驱动电路用于根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭；一所述栅极驱动信号对应于一行所述栅线。本发明解决现有技术中不能避免栅线与数据线时序对光电模块的影响的问题。

Description

像素电路的驱动模组、方法和显示装置
技术领域
本发明涉及，尤其涉及一种像素电路的驱动模组、方法和显示装置。
背景技术
现有的基于OLED(有机发光二极管)显示的像素补偿单元包括：光感模块，用于将所述像素单元发出的光信号转换为相应的电信号；读取控制模块，用于在相应行读取控制线上的读取控制信号的控制下控制在读取时间段将所述电信号传送至相应列读取线；以及，数据电压补偿模块，用于根据所述电信号对相应列数据线上的数据电压进行补偿。然而现有的像素补偿单元不能避免栅线与数据线时序对光电模块的影响，并且不能动态调节积分时间，使得补偿结果不准确。
如图1A所示，现有的像素补偿单元包括读取控制晶体管MS、光敏二极管DS，MS的栅极与相应的读取控制线Sense连接，MS的源极与读取线RL连接，光敏二极管的阳极与低电平输入端VSS连接，光敏二极管的阴极与MS的漏极连接。
发明内容
本发明的主要目的在于提供一种像素电路的驱动模组、方法和显示装置，解决现有技术中不能避免栅线与数据线时序对光电模块的影响的问题。
为了达到上述目的，本发明提供了一种像素电路的驱动模组，所述像素电路包括多行栅线、多行读取控制线和多行多列像素单元电路；所述像素单元电路包括像素补偿单元；所述像素补偿单元与相应行读取控制线连接；所述驱动模组包括与所述多行栅线连接的栅极驱动电路；所述驱动模组还包括：
信号生成单元，与所述栅极驱动电路和所述像素补偿单元连接，用于生成读取控制信号和栅极驱动控制信号，将所述读取控制信号传送至相应行读取控制线，将所述栅极驱动控制信号传送至所述栅极驱动电路；
所述栅极驱动电路用于根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在所述读取时间段所述多行栅线都关闭。
实施时，所述像素补偿单元包括：光感模块，用于将所述像素单元发出的光信号转换为相应的电信号；所述信号生成单元具体用于根据所述电信号生成所述读取控制信号。
实施时，所述像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；所述电信号为电荷信号，所述信号生成单元具体用于根据所述电荷信号指示的电荷量来确定相应的积分时间，并根据该积分时间生成相应的读取控制信号；
所述积分时间为所述读取控制信号控制读取控制模块开始将所述电信号传送至相应列读取线的第一时刻与第二时刻之间间隔的时间；
所述第二时刻为在所述读取时间段结束后所述读取控制信号相邻下一次控制所述读取控制模块开始将所述电信号传送至相应列读取线的时刻。
本发明还提供了一种像素电路的驱动方法，采用上述的像素电路的驱动模组以驱动像素电路，所述像素电路的驱动方法包括：
信号生成单元生成读取控制信号和栅极驱动控制信号，将所述读取控制信号传送至相应行读取控制线，将所述栅极驱动控制信号传送至栅极驱动电路；
栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭。
实施时，所述信号生成单元生成读取控制信号步骤具体包括：所述信号生成单元根据所述电信号生成所述读取控制信号；所述电信号为像素补偿单元包括的光感模块对像素单元发出的光信号进行转换得到的电信号。
实施时，像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；所述电信号为电荷信号，所述信号生成单元根据所述电信号生成所述读取控制信号步骤具体包括：所述信号生成单元根据所述电荷信号指示的电荷量来确定相应的积分时间，并根据该积分时间生成相应的读取控制信号；
所述积分时间为所述读取控制信号控制所述读取控制模块开始将所述电信号传送至相应列读取线的第一时刻与第二时刻之间间隔的时间；
所述第二时刻为在所述读取时间段结束后所述读取控制信号相邻下一次控制所述读取控制模块开始将所述电信号传送至相应列读取线的时刻。
实施时，第一电荷信号指示的第一电荷量大于第二电荷信号指示的第二电荷量，所述信号生成单元根据所述第一电荷量确定的第一积分时间小于所述信号生成单元根据所述第二电荷量确定的第二积分时间。
实施时，所述像素补偿单元包括光感模块；像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；在一驱动周期内，在第n行栅线打开的时间段和第n+1行栅线打开的时间段之间设置有第n读取时间段；在相邻的两驱动周期内设置有第N读取时间段；N为所述像素电路包括的栅线的行数；N为正整数；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：
所述信号生成单元控制向第n行读取控制线输出相应的读取控制信号，以使得在所述第n读取时间段，所述像素电路包括的位于第n行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第n行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述信号生成单元控制向第N行读取控制线输出相应的读取控制信号，以使得在所述第N读取时间段，所述像素电路包括的位于第N行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第N行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在所述第n读取时间段和所述第N读取时间段，所述像素电路包括的所有栅线都关闭；n为正整数，n+1小于或等于N。
实施时，所述像素补偿单元包括光感模块；像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；在一驱动周期内，在第n行栅线打开的时间段和第n+1行栅线打开的时间段之间设置有第n读取时间段，在第n+1行栅线打开的时间段和第n+2行栅线打开的时间段之间设置有第n+1读取时间段；在相邻的两驱动周期内设置有第N读取时间段；N为所述像素电路包括的栅线的行数；N为正整数；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：
所述信号生成单元向第n行读取控制线输出相应的读取控制信号，以使得在所述第n读取时间段和所述第n+1读取时间段，所述像素电路包括的位于第n行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第n行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述信号生成单元向第N行读取控制线输出相应的读取控制信号，以使得在所述第N读取时间段和第一读取时间段，所述像素电路包括的位于第N行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第N行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在所述第n读取时间段和所述第N读取时间段，所述像素电路包括的所有栅线都关闭；
n为正整数，n+1小于或等于N。
实施时，所述像素补偿单元包括光感模块；像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；在两个相邻的显示阶段之间设置有一空白阶段；所述空白阶段包括依次设置的M个读取时间段；M为所述像素电路包括的读取控制线的行数；M为正整数；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制控制在所述空白阶段内所述像素电路包括的所有栅线都关闭；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：所述信号生成单元向第a行读取控制线输出相应的读取控制信号，以使得在所述空白阶段包括的第a读取时间段，所述像素电路包括的位于第a行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第a行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
a为小于或等于M的正整数。
实施时，所述像素补偿单元包括光感模块；像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；在两相邻显示周期之间设置有一空白周期；
所述空白周期包括依次设置的M个读取时间段；M为所述像素电路包括的读取控制线的行数；M为正整数；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制控制在所述空白周期内所述像素电路包括的所有栅线都关闭；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：
所述信号生成单元向第b行读取控制线输出相应的读取控制信号，以使得在所述空白周期包括的第b行读取时间段，所述像素电路包括的位于第b行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第b行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
b为小于或等于M的正整数。
本发明还提供了一种显示装置，包括像素电路，还包括上述的像素电路的驱动模组
与现有技术相比，本发明所述的像素电路的驱动模组、方法和显示装置采用信号生成单元，该信号生成单元生成的读取控制信号和栅极驱动控制信号能够使得显示驱动和基于像素单元的发光亮度的补偿不同时进行，从而能够避免栅线与数据线时序对光电模块的影响。
附图说明
图1A是现有的像素补偿单元的电路图；
图1B是本发明实施例所述的像素电路的驱动模组的结构图；
图2是本发明实施例所述的像素电路的驱动方法的流程图；
图3是本发明所述的像素电路的驱动方法的第一具体实施例对应的时序图；
图4是本发明所述的像素电路的驱动方法的第二具体实施例对应的时序图；
图5是本发明所述的像素电路的驱动方法的第三具体实施例对应的时序图；
图6是本发明所述的像素电路的驱动方法的第四具体实施例对应的时序图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
本发明所有实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件。在本发明实施例中，为区分晶体管除栅极之外的两极，将其中一极称为第一极，另一极称为第二极。在实际操作时，所述第一极可以为漏极，所述第二极可以为源极；或者，所述第一极可以为源极，所述第二极可以为漏极。
本发明实施例所述的像素电路的驱动模组用于驱动像素电路，所述像素电路包括多行栅线、多行读取控制线和多行多列像素单元电路；所述像素单元电路包括像素补偿单元；所述驱动模组包括与所述多行栅线连接的栅极驱动电路；所述驱动模组还包括：
信号生成单元，与所述栅极驱动电路和所述像素补偿单元连接，用于生成读取控制信号和栅极驱动控制信号，将所述读取控制信号传送至相应行读取控制线，将所述栅极驱动控制信号传送至所述栅极驱动电路；
所述栅极驱动电路用于根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在所述读取时间段所述多行栅线都关闭。
本发明实施例所述的像素电路的驱动模组包括信号生成单元，该信号生成单元生成的读取控制信号和栅极驱动控制信号能够使得显示驱动和基于像素单元的发光亮度的补偿不同时进行，从而能够避免栅线与数据线时序对光电模块的影响。
在具体实施时，所述像素电路包括多行栅线、多列数据线、多行读取控制线、多列读取线和多行多列像素单元电路；位于同一行的像素单元电路与同一行栅线和同一行读取控制线连接；位于同一列的像素单元电路与同一列数据线和同一列读取线连接；
所述像素单元电路包括一像素补偿单元和一像素单元；
所述像素补偿单元包括：光感模块，用于将所述像素单元发出的光信号转换为相应的电信号；读取控制模块，用于在相应行读取控制线上的读取控制信号的控制下控制在读取时间段将所述电信号传送至相应列读取线；以及，数据电压补偿模块；
如图1B所示，本发明实施例所述的像素电路的驱动模组包括与所述多行栅线连接的栅极驱动电路11；所述驱动模组还包括：
信号生成单元12，与所述栅极驱动电路11和像素补偿单元13连接，用于生成读取控制信号SW和栅极驱动控制信号SGC，将所述读取控制信号SW传送至所述像素补偿单元13包括的相应行读取控制线，将所述栅极驱动控制信号SGC传送至所述栅极驱动电路11；
所述栅极驱动电路11用于根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在所述读取时间段所述多行栅线都关闭；
一所述栅极驱动信号对应于一行所述栅线。
本发明实施例所述的像素电路的驱动模组包括信号生成单元，该信号生成单元生成的读取控制信号和栅极驱动控制信号能够使得显示驱动和基于像素单元的发光亮度的补偿不同时进行，从而能够避免栅线与数据线时序对光电模块的影响。
在实际操作时，所述信号生成单元具体用于根据所述电信号生成所述读取控制信号。
在具体实施时，所述电信号可以为电荷信号，所述信号生成单元具体用于根据所述电荷信号指示的电荷量来确定相应的积分时间，并根据该积分时间生成相应的读取控制信号；
所述积分时间为所述读取控制信号控制所述读取控制模块开始将所述电信号传送至相应列读取线的第一时刻与第二时刻之间间隔的时间；
所述第二时刻为在所述读取时间段结束后所述读取控制信号相邻下一次控制所述读取控制模块开始将所述电信号传送至相应列读取线的时刻。
本发明实施例所述的像素电路的驱动模组可以通过电荷量大小来确定积分时间，当所述电荷量大时积分时间短，当电荷量小时积分时间长，这样可以根据电荷量大小动态调节积分时间，以适应大动态范围的光强检测。
在实际操作时，光感模块感应相应的像素单元发出的光信号，并将该光信号转换为电流信号，所述电荷信号指示的电荷量即为存储于寄生电容(当所述光感模块为光敏二极管时，所述寄生电容为光敏二极管的阴极与该光敏二极管的阳极之间的寄生电容)中的电荷量，当读取控制信号控制读取控制模块导通光感模块与读取线之间的连接时，存储于所述寄生电容中的电荷传送至所述读取线上。
本发明实施例所述的像素电路的驱动方法，采用上述的像素电路的驱动模组以驱动像素电路，如图2所示，所述像素电路的驱动方法包括：
S1:信号生成单元生成读取控制信号和栅极驱动控制信号，将所述读取控制信号传送至相应行读取控制线，将所述栅极驱动控制信号传送至栅极驱动电路；
S2:栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭。
本发明实施例所述的像素电路的驱动方法通过信号生成单元生成读取控制信号和栅极驱动控制信号，能够使得显示驱动和基于像素单元的发光亮度的补偿不同时进行，从而能够避免栅线与数据线时序对光电模块的影响。
在实际操作时，所述像素电路包括多行栅线、多列数据线、多行读取控制线、多列读取线和多行多列像素单元电路；位于同一行的像素单元电路与同一行栅线和同一行读取控制线连接；位于同一列的像素单元电路与同一列数据线和同一列读取线连接；
所述像素单元电路包括一像素补偿单元和一像素单元；
所述像素补偿单元包括：光感模块，用于将所述像素单元发出的光信号转换为相应的电信号；读取控制模块，与相应行读取控制线和相应列读取线连接，用于在相应行读取控制线上的读取控制信号的控制下控制在读取时间段将所述电信号传送至相应列读取线；以及，数据电压补偿模块。
具体的，所述信号生成单元生成读取控制信号步骤具体包括：所述信号生成单元根据所述电信号生成所述读取控制信号。
在实际操作时，所述电信号可以为电荷信号，所述信号生成单元根据所述电信号生成所述读取控制信号步骤可以具体包括：所述信号生成单元根据所述电荷信号指示的电荷量来确定相应的积分时间，并根据该积分时间生成相应的读取控制信号；
所述积分时间为所述读取控制信号控制所述读取控制模块开始将所述电信号传送至相应列读取线的第一时刻与第二时刻之间间隔的时间；
所述第二时刻为在所述读取时间段结束后所述读取控制信号相邻下一次控制所述读取控制模块开始将所述电信号传送至相应列读取线的时刻。
在优选情况下，第一电荷信号指示的第一电荷量大于第二电荷信号指示的第二电荷量，所述信号生成单元根据所述第一电荷量确定的第一积分时间小于所述信号生成单元根据所述第二电荷量确定的第二积分时间。
本发明实施例所述的像素电路的驱动方法可以通过电荷量大小来确定积分时间，当所述电荷量大时积分时间短，当电荷量小时积分时间长，这样可以根据电荷量大小动态调节积分时间，以适应大动态范围的光强检测。
在本发明所述的像素电路的驱动方法的第一具体实施例中，在一驱动周期内，在第n行栅线打开的时间段和第n+1行栅线打开的时间段之间设置有第n读取时间段；在相邻的两驱动周期内设置有第N读取时间段；N为所述像素电路包括的栅线的行数；N为正整数；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：
所述信号生成单元控制向第n行读取控制线输出相应的读取控制信号，以使得在所述第n读取时间段，所述像素电路包括的位于第n行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第n行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述信号生成单元控制向第N行读取控制线输出相应的读取控制信号，以使得在所述第N读取时间段，所述像素电路包括的位于第N行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第N行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在所述第n读取时间段和所述第N读取时间段，所述像素电路包括的所有栅线都关闭；n为正整数，n+1小于或等于N。
本发明所述的像素电路的驱动方法的第一具体实施例即为单行空闲检测模式；如图3所示，在第一驱动周期T1(当栅极驱动电路包括N级移位寄存器单元，用于驱动N行栅线时，一驱动周期即为扫描完该N行栅线的时间，N为大于3的整数)内，
在第一行栅线Gate1打开的时间段(也即用于驱动Gate1的栅极驱动信号的电位为高电平的时间段)和第二行栅线Gate2打开的时间段(也即用于驱动Gate2的栅极驱动信号的电位为高电平的时间段)之间设置有第一驱动周期T1内的第一读取时间段t11(也即第一行读取控制线Sense1输出高电平的时间段)；
在第二行栅线Gate2打开的时间段(也即用于驱动Gate2的栅极驱动信号的电位为高电平的时间段)和第三行栅线Gate3打开的时间段(也即用于驱动Gate3的栅极驱动信号的电位为高电平的时间段)之间设置有第一驱动周期T1内的第二读取时间段(也即第二行读取控制线Sense2输出高电平的时间段)；
在图3中，标号为GateN的为第N行栅线，与GateN对应的波形为驱动GateN的栅极驱动信号的波形；
在第二驱动周期T2内，在第一行栅线Gate1打开的时间段(也即用于驱动Gate1的栅极驱动信号的电位为高电平的时间段)和第二行栅线Gate2打开的时间段(也即用于驱动Gate2的栅极驱动信号的电位为高电平的时间段)之间设置有第二驱动周期T2内的第一读取时间段t21(也即第一行读取控制线Sense1输出高电平的时间段)；
在第二行栅线Gate2打开的时间段(也即用于驱动Gate2的栅极驱动信号的电位为高电平的时间段)和第三行栅线Gate3打开的时间段(也即用于驱动Gate3的栅极驱动信号的电位为高电平的时间段)之间设置有第二驱动周期T2内的第二读取时间段(也即第二行读取控制线Sense2输出高电平的时间段)；
在图3所示的本发明所述的像素电路的驱动方法的第一具体实施例中，积分时间TI为t11结束的时刻与t21开始的时刻时间的时间间隔，也即等于1帧时间(也即一个驱动周期持续的时间)。
在图3所示的本发明所述的像素电路的驱动方法的第一具体实施例中，在每两行栅线扫描的时间间隙来进行电荷读取，为了适应大动态范围的检测(OLED发光时的灰阶电压在0到255之间，可能变化巨大)，需要根据读取数值动态调节曝光时间。如果读取到的电荷量过小就要增加积分时间，如果读取到的电荷量过大乃至饱和，那么就要降低积分时间。
在本发明所述的像素电路的驱动方法的第二具体实施例中，在一驱动周期内，在第n行栅线打开的时间段和第n+1行栅线打开的时间段之间设置有第n读取时间段，在第n+1行栅线打开的时间段和第n+2行栅线打开的时间段之间设置有第n+1读取时间段；在相邻的两驱动周期内设置有第N读取时间段；N为所述像素电路包括的栅线的行数；N为正整数；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：
所述信号生成单元向第n行读取控制线输出相应的读取控制信号，以使得在所述第n读取时间段和所述第n+1读取时间段，所述像素电路包括的位于第n行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第n行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述信号生成单元向第N行读取控制线输出相应的读取控制信号，以使得在所述第N读取时间段和第一读取时间段，所述像素电路包括的位于第N行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第N行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在所述第n读取时间段和所述第N读取时间段，所述像素电路包括的所有栅线都关闭；
n为正整数，n+1小于或等于N。
本发明所述的像素电路的驱动方法的第二具体实施例为另一种单行空闲检测模式；如图4所示，在第一驱动周期T1(当栅极驱动电路包括N级移位寄存器单元，用于驱动N行栅线时，一驱动周期即为扫描完该N行栅线的时间，N为大于3的整数)内，
在第一行栅线Gate1打开的时间段和第二行栅线Gate2打开的时间段之间设置有第一驱动周期T1内的第一读取时间段t1，在第二行栅线Gate2打开的时间段和第三行栅线Gate3打开的时间段之间设置有第一驱动周期T1内的第二读取时间段t12；
在t11和t12内，第一行读取控制线Sense1输出高电平；
在图4所示的第二具体实施例中，积分时间TI为t11结束的时间段到t12开始的时间段，也即一行时间。
在本发明所述的像素电路的驱动方法的第三具体实施例中，在两个相邻的显示阶段之间设置有一空白阶段；所述空白阶段包括依次设置的M个读取时间段；M为所述像素电路包括的读取控制线的行数；M为正整数；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制控制在所述空白阶段内所述像素电路包括的所有栅线都关闭；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：所述信号生成单元向第a行读取控制线输出相应的读取控制信号，以使得在所述空白阶段包括的第a读取时间段，所述像素电路包括的位于第a行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第a行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
a为小于或等于M的正整数。
在实际操作时，在一个显示阶段内，所述栅极驱动电路依次扫描多行栅线。
本发明所述的像素电路的驱动方法的第三具体实施例为多行空闲检测模式；如图5所示，
在两个相邻的显示阶段之间设置有一空白阶段；所述空白阶段包括依次设置的M个读取时间段；M为所述像素电路包括的读取控制线的行数；
在图5中仅示出的一驱动周期包括的两个显示阶段和两个空白阶段；
在第一显示阶段T11、依次驱动第一行栅线Gate1、第二行栅线Gate2、…第m行栅线Gatem(m为大于2的整数)；
在第一空白阶段TB1、M行读取控制线依次打开(也即各行读取控制线依次输出高电平，以依次控制相应的读取控制模块导通相应的光感模块与相应的读取线之间的连接)；在图5中，Sense1为第一行读取控制线，Sense2为第二行读取控制线，SenseM为第M行读取控制线；
在第二显示阶段T12，依次驱动第m+1行栅线Gatem+1、第m+2行栅线Gatem+2、…、第N行栅线GateN(N为像素电路包括的栅线的条数)，然后重新依次驱动第一行栅线Gate1、第二行栅线Gate2、…第m行栅线Gatem(m为大于2的整数)；
在第二空白阶段，M行读取控制线依次打开(也即各行读取控制线依次输出高电平，以依次控制相应的读取控制模块导通相应的光感模块与相应的读取线之间的连接)。
在图5中，Sense1第一次输出高电平的时间段为第一读取时间段t11，Sense1第二次输出高电平的时间段为第二读取时间段t12，积分时间TI等于t11结束的时刻与t12开始的时刻之间间隔的时间。
图5所示的驱动方法的第三具体实施例为long H blank(长H空白)方式，也即在多行栅线驱动后插入用于读取数据的读取时间段。
在本发明所述的像素电路的驱动方法的第四具体实施例中，在两相邻显示周期之间设置有一空白周期；
所述空白周期包括依次设置的M个读取时间段；M为所述像素电路包括的读取控制线的行数；M为正整数；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制控制在所述空白周期内所述像素电路包括的所有栅线都关闭；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：
所述信号生成单元向第b行读取控制线输出相应的读取控制信号，以使得在所述空白周期包括的第b行读取时间段，所述像素电路包括的位于第b行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第b行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
b为小于或等于M的正整数。
本发明所述的像素电路的驱动方法的第四具体实施例为多帧空闲检测模式；如图6所示，在两相邻显示周期之间设置有一空白周期；
所述空白周期包括依次设置的M个读取时间段；M为所述像素电路包括的读取控制线的行数；M为整数；
在本发明所述的第四具体实施例中，在一所述显示周期内，依次驱动所述像素电路包括的所有行栅线，在一所述空白周期内，所述像素电路包括的所有行读取控制线依次输出高电平；一所述显示周期也可以为一帧显示时间，在两相邻帧显示时间之间设置一空白周期；
如图6所示，在第一显示周期T61内，第一行栅线Gate1、第二行栅线Gate2、…、第N行栅线GateN依次输出高电平，在第一空白周期TBC1内，第一行读取控制线Sense1、第二行读取控制线Sense2、…、第M行读取控制线SenseM依次输出高电平；
在第二显示周期T62内，第一行栅线Gate1、第二行栅线Gate2、…、第N行栅线GateN依次输出高电平，在第二空白周期TBC2内，第一行读取控制线Sense1、第二行读取控制线Sense2、…、第M行读取控制线SenseM依次输出高电平；
在第一空白周期TBC1内，Sense1输出高电平的时间段为第一读取时间段t11，在第二空白周期TBC2内，Sense1输出高电平的时间段为第二读取时间段t12；积分时间TI为t11结束的时刻与t12开始的时刻之间间隔的时间。
在本发明实施例中，最多的积分时间可以很长，达到一帧甚至数帧时间。
本发明实施例所述的显示装置，包括像素电路，还包括上述的像素电路的驱动模组。
以上所述是本发明的优选实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本发明所述原理的前提下，还可以作出若干改进和润饰，这些改进和润饰也应视为本发明的保护范围。

Claims (12)

1.一种像素电路的驱动模组，所述像素电路包括多行栅线、多行读取控制线和多行多列像素单元电路；所述像素单元电路包括像素补偿单元；所述像素补偿单元与相应行读取控制线连接；所述驱动模组包括与所述多行栅线连接的栅极驱动电路；其特征在于，所述驱动模组还包括：
信号生成单元，与所述栅极驱动电路和所述像素补偿单元连接，用于生成读取控制信号和栅极驱动控制信号，将所述读取控制信号传送至相应行读取控制线，将所述栅极驱动控制信号传送至所述栅极驱动电路；
所述栅极驱动电路用于根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在所述读取时间段所述多行栅线都关闭。
2.如权利要求1所述的像素电路的驱动模组，其特征在于，所述像素补偿单元包括：光感模块，用于将所述像素单元发出的光信号转换为相应的电信号；所述信号生成单元具体用于根据所述电信号生成所述读取控制信号。
3.如权利要求2所述的像素电路的驱动模组，其特征在于，所述像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；所述电信号为电荷信号，所述信号生成单元具体用于根据所述电荷信号指示的电荷量来确定相应的积分时间，并根据该积分时间生成相应的读取控制信号；
所述积分时间为所述读取控制信号控制读取控制模块开始将所述电信号传送至相应列读取线的第一时刻与第二时刻之间间隔的时间；
所述第二时刻为在所述读取时间段结束后所述读取控制信号相邻下一次控制所述读取控制模块开始将所述电信号传送至相应列读取线的时刻。
4.一种像素电路的驱动方法，采用如权利要求1至3中任一权利要求所述的像素电路的驱动模组以驱动像素电路，其特征在于，所述像素电路的驱动方法包括：
信号生成单元生成读取控制信号和栅极驱动控制信号，将所述读取控制信号传送至相应行读取控制线，将所述栅极驱动控制信号传送至栅极驱动电路；
栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭。
5.如权利要求4所述的像素电路的驱动方法，其特征在于，所述信号生成单元生成读取控制信号步骤具体包括：所述信号生成单元根据所述电信号生成所述读取控制信号；所述电信号为像素补偿单元包括的光感模块对像素单元发出的光信号进行转换得到的电信号。
6.如权利要求5所述的像素电路的驱动方法，其特征在于，像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；所述电信号为电荷信号，所述信号生成单元根据所述电信号生成所述读取控制信号步骤具体包括：所述信号生成单元根据所述电荷信号指示的电荷量来确定相应的积分时间，并根据该积分时间生成相应的读取控制信号；
所述积分时间为所述读取控制信号控制所述读取控制模块开始将所述电信号传送至相应列读取线的第一时刻与第二时刻之间间隔的时间；
所述第二时刻为在所述读取时间段结束后所述读取控制信号相邻下一次控制所述读取控制模块开始将所述电信号传送至相应列读取线的时刻。
7.如权利要求6所述的像素电路的驱动方法，其特征在于，第一电荷信号指示的第一电荷量大于第二电荷信号指示的第二电荷量，所述信号生成单元根据所述第一电荷量确定的第一积分时间小于所述信号生成单元根据所述第二电荷量确定的第二积分时间。
8.如权利要求4至7中任一权利要求所述的像素电路的驱动方法，其特征在于，所述像素补偿单元包括光感模块；像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；在一驱动周期内，在第n行栅线打开的时间段和第n+1行栅线打开的时间段之间设置有第n读取时间段；在相邻的两驱动周期内设置有第N读取时间段；N为所述像素电路包括的栅线的行数；N为正整数；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：
所述信号生成单元控制向第n行读取控制线输出相应的读取控制信号，以使得在所述第n读取时间段，所述像素电路包括的位于第n行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第n行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述信号生成单元控制向第N行读取控制线输出相应的读取控制信号，以使得在所述第N读取时间段，所述像素电路包括的位于第N行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第N行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在所述第n读取时间段和所述第N读取时间段，所述像素电路包括的所有栅线都关闭；n为正整数，n+1小于或等于N。
9.如权利要求4至7中任一权利要求所述的像素电路的驱动方法，其特征在于，所述像素补偿单元包括光感模块；像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；在一驱动周期内，在第n行栅线打开的时间段和第n+1行栅线打开的时间段之间设置有第n读取时间段，在第n+1行栅线打开的时间段和第n+2行栅线打开的时间段之间设置有第n+1读取时间段；在相邻的两驱动周期内设置有第N读取时间段；N为所述像素电路包括的栅线的行数；N为正整数；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：
所述信号生成单元向第n行读取控制线输出相应的读取控制信号，以使得在所述第n读取时间段和所述第n+1读取时间段，所述像素电路包括的位于第n行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第n行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述信号生成单元向第N行读取控制线输出相应的读取控制信号，以使得在所述第N读取时间段和第一读取时间段，所述像素电路包括的位于第N行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第N行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在所述第n读取时间段和所述第N读取时间段，所述像素电路包括的所有栅线都关闭；
n为正整数，n+1小于或等于N。
10.如权利要求4至7中任一权利要求所述的像素电路的驱动方法，其特征在于，所述像素补偿单元包括光感模块；像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；在两个相邻的显示阶段之间设置有一空白阶段；所述空白阶段包括依次设置的M个读取时间段；M为所述像素电路包括的读取控制线的行数；M为正整数；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制控制在所述空白阶段内所述像素电路包括的所有栅线都关闭；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：所述信号生成单元向第a行读取控制线输出相应的读取控制信号，以使得在所述空白阶段包括的第a读取时间段，所述像素电路包括的位于第a行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第a行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
a为小于或等于M的正整数。
11.如权利要求4至7中任一权利要求所述的像素电路的驱动方法，其特征在于，所述像素补偿单元包括光感模块；像素补偿单元包括读取控制模块；所述像素电路包括多列读取线；该读取控制模块与相应列读取线连接；在两相邻显示周期之间设置有一空白周期；
所述空白周期包括依次设置的M个读取时间段；M为所述像素电路包括的读取控制线的行数；M为正整数；
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制在读取时间段多行栅线都关闭步骤具体包括：
所述栅极驱动电路根据所述栅极驱动控制信号生成多个栅极驱动信号，以控制控制在所述空白周期内所述像素电路包括的所有栅线都关闭；
所述信号生成单元将所述读取控制信号传送至相应行读取控制线步骤具体包括：
所述信号生成单元向第b行读取控制线输出相应的读取控制信号，以使得在所述空白周期包括的第b行读取时间段，所述像素电路包括的位于第b行的所有像素补偿单元包括的读取控制模块都打开，以导通位于第b行的所述像素补偿单元包括的光感模块与相应列读取线之间的连接；
b为小于或等于M的正整数。
12.一种显示装置，包括像素电路，其特征在于，还包括如权利要求1至3中任一权利要求所述的像素电路的驱动模组。
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