CN107093401B - 像素驱动电路 - Google Patents

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Abstract

本发明公开了一种像素驱动电路，所述像素驱动电路包括级联的多个像素驱动单元，每一像素驱动单元包括第一复位电路，连接第一像素，接收输入电压并对第一像素进行复位；第二复位电路，连接第二像素，接收输入电压并对第二像素进行复位；第一控制电路，连接第一及第二复位电路，接收参考电压并提供给第一及第二复位电路；第二控制电路，连接第一及第二复位电路，接收数据电压并提供给第一及第二复位电路，以同时驱动第一及第二像素，来达到节省电晶体数量的目的，同时实现了电路中阈值电压补偿，避免了像素闪烁问题。

Description

像素驱动电路
技术领域
本发明涉及显示技术领域，特别是涉及一种像素驱动电路。
背景技术
随着高清显示屏的发展，人们追求更大屏，更高的分辨率，更刺激的视觉效果，广视角、高色域、高PPI显示技术的开发已经成为了行业的趋势。OLED屏高对比度、宽视角、高饱和度、低能耗等优势，无疑将其推向显示市场发展前沿。然而OLED显示驱动技术的像素驱动电路属于电流型，需要GOA(gate on array)供给扫描信号，同时，为了较佳的显示效果和阈值电压补偿效果，需要额外为像素驱动电路提供多重信号。其次，为了实现较高画面均匀和舒适的画面体验感，2T1C的OLED像素驱动电路已经逐渐退出大众视野，市面上所用的OLED像素驱动电路中包含很多功能性的薄膜晶体管(TFT)，例如可以补偿驱动晶体管阈值电压的6T1C/7T1C像素驱动电路，多重晶体管的使用使得电路设计复杂而且会增加成本。
发明内容
本发明主要解决的技术问题是提供一种像素驱动电路，以使用较少的薄膜晶体管来简化电路并降低成本。
为解决上述技术问题，本发明采用的一个技术方案是：提供一种像素驱动电路，所述像素驱动电路包括级联的多个像素驱动单元，每一所述像素驱动单元包括：
第一复位电路，连接第一像素，用于接收输入电压并对所述第一像素进行复位；
第二复位电路，连接第二像素，用于接收输入电压并对所述第二像素进行复位；
第一控制电路，连接所述第一及第二复位电路，用于接收参考电压并提供给所述第一及第二复位电路；及
第二控制电路，连接所述第一及第二复位电路，用于接收数据电压并提供给所述第一及第二复位电路，以同时驱动所述第一及第二像素。
其中，所述第一控制电路包括参考可控开关，所述参考可控开关的控制端接收发光信号，所述参考可控开关的第一端接收所述参考电压，所述参考可控开关的第二端连接所述第二控制电路、第一及第二复位电路。
其中，所述第一复位电路包括第一至第三可控开关及第一电容，所述第一可控开关的第一端接收所述输入电压，所述第一可控开关的控制端连接所述第一电容的第一端，所述第一电容的第二端连接所述参考可控开关的第二端、所述第二复位电路及所述第二控制电路，所述第一可控开关的第二端连接所述第二可控开关的第一端及所述第三可控开关的第一端，所述第二可控开关的控制端接收第一扫描信号，所述第二可控开关的第二端连接所述第一电容的第一端及所述第一可控开关的控制端，所述第三可控开关的控制端接收所述发光信号，所述第三可控开关的第二端连接所述第一像素的阳极，所述第一像素的阴极接地；
所述第二复位电路包括第四至第六可控开关及第二电容，所述第四可控开关的第一端接收所述输入电压，所述第四可控开关的控制端连接所述第二电容的第一端，所述第二电容的第二端连接所述第一电容的第二端、所述参考可控开关的第二端及所述第二控制电路，所述第四可控开关的第二端连接所述第五可控开关的第一端及所述第六可控开关的第一端，所述第五可控开关的控制端接收第二扫描信号，所述第五可控开关的第二端连接所述第二电容的第一端及所述第四可控开关的控制端，所述第六可控开关的控制端接收所述发光信号，所述第六可控开关的第二端连接所述第二像素的阳极，所述第二像素的阴极接地。
其中，所述第一复位电路或所述第二复位电路还包括第七可控开关，所述第七可控开关的控制端接收复位信号，所述第七可控开关的第一端接收输入电压，所述第七可控开关的第二端连接所述第一可控开关的第一端及所述第四可控开关的第一端。
其中，所述第一至第七可控开关及所述参考可控开关均为P型薄膜晶体管，所述第一至第七可控开关及所述参考可控开关的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
其中，所述第一复位电路还包括第七可控开关，所述第七可控开关的控制端接收复位信号，所述第七可控开关的第一端接收初始信号，所述第七可控开关的第二端连接所述第一可控开关的控制端及所述第一电容的第一端；
所述第二复位电路还包括第八可控开关，所述第八可控开关的控制端接收所述复位信号，所述第八可控开关的第一端接收所述初始信号，所述第八可控开关的第二端连接所述第四可控开关的控制端及所述第二电容的第一端。
其中，所述第一复位电路还包括第九可控开关，所述第九可控开关的控制端接收所述复位信号，所述第九可控开关的第一端连接所述第三可控开关的第二端，所述第九可控开关的第二端接收所述初始信号；
所述第二复位电路还包括第十可控开关，所述第十可控开关的控制端接收所述复位信号，所述第十可控开关的第一端连接所述第六可控开关的第二端，所述第十可控开关的第二端接收所述初始信号。
其中，所述第一至第十可控开关均为P型薄膜晶体管，所述第一至第十可控开关的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
其中，所述第二控制电路包括数据可控开关，所述数据可控开关的控制端接收扫描复位信号，所述数据可控开关的第一端接收所述数据电压，所述数据可控开关的第二端连接所述第一电容的第二端及所述第二电容的第二端，所述数据可控开关为P型薄膜晶体管，所述数据可控开关的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
其中，所述第二控制电路包括数据可控开关，所述数据可控开关的控制端接收所述发光信号，所述数据可控开关的第一端接收所述数据电压，所述数据可控开关的第二端连接所述第一电容的第二端及所述第二电容的第二端，所述数据可控开关为N型薄膜晶体管，所述数据可控开关的控制端、第一端及第二端分别对应所述N型薄膜晶体管的栅极、漏极及源极。
本发明的有益效果是：区别于现有技术的情况，本发明的所述像素驱动电路将简单的单矩形脉冲级传信号作为驱动控制信号，把两行由第一及第二扫描信号控制的像素驱动电路合并，来达到节省电晶体数目的目的，同时实现了电路中阈值电压补偿，避免了像素闪烁问题。
附图说明
图1是本发明的像素驱动电路的一个像素驱动单元的第一实施例的结构示意图；
图2是图1的一种时间波形图；
图3是图1的另一种时间波形图；
图4是图1的模拟结果波形图；
图5是本发明的像素驱动电路的一个扫描驱动单元的第二实施例的结构示意图；
图6是图5的时间波形图；
图7是本发明的像素驱动电路的一个扫描驱动单元的第三实施例的结构示意图；
图8是图7的时间波形图；
图9是图7的模拟结果波形图；
图10是本发明的像素驱动电路的一个扫描驱动单元的第四实施例的结构示意图；
图11是图10的时间波形图；
图12是本发明的像素驱动电路的一个扫描驱动单元的第五实施例的结构示意图；
图13是图10的时间波形图；
图14是本发明的像素驱动电路的一个扫描驱动单元的第六实施例的结构示意图；
图15是图14的时间波形图；
图16是本发明的像素驱动电路的一个扫描驱动单元的第七实施例的结构示意图；
图17是图16的时间波形图；
图18是本发明的像素驱动电路的一个扫描驱动单元的第八实施例的结构示意图；
图19是图18的时间波形图；
图20是图18的模拟结果波形图。
具体实施方式
请参阅图1至图4，是本发明的像素驱动电路的一个像素驱动单元的第一实施例的结构示意图。所述像素驱动电路包括级联的多个像素驱动单元，每一所述像素驱动单元包括：
第一复位电路10，连接第一像素OLED1，用于接收输入电压VDD并对所述第一像素OLED1进行复位；
第二复位电路20，连接第二像素，用OLED2于接收输入电压VDD并对所述第二像素OLED2进行复位；
第一控制电路30，连接所述第一及第二复位电路10、20，用于接收参考电压Vref并提供给所述第一及第二复位电路10、20；及
第二控制电路40，连接所述第一及第二复位电路10、20，用于接收数据电压Vdata并提供给所述第一及第二复位电路10、20，以同时驱动所述第一及第二像素OLED1、OLED2。
具体地，所述第一控制电路30包括参考可控开关T11，所述参考可控开关T11的控制端接收发光信号EM，所述参考可控开关T11的第一端接收所述参考电压Vref，所述参考可控开关T11的第二端连接所述第二控制电路40、第一及第二复位电路10、20。
所述第一复位电路10包括第一至第三可控开关T1-T3及第一电容C1，所述第一可控开关T1的第一端接收所述输入电压VDD，所述第一可控开关T1的控制端连接所述第一电容C1的第一端，所述第一电容C1的第二端连接所述参考可控开关T11的第二端、所述第二复位电路20及所述第二控制电路40，所述第一可控开关T1的第二端连接所述第二可控开关T2的第一端及所述第三可控开关T3的第一端，所述第二可控开关T2的控制端接收第一扫描信号SG1，所述第二可控开关T2的第二端连接所述第一电容C1的第一端及所述第一可控开关T1的控制端，所述第三可控开关T3的控制端接收所述发光信号EM，所述第三可控开关T3的第二端连接所述第一像素OLED1的阳极，所述第一像素OLED1的阴极接地；
所述第二复位电路20包括第四至第六可控开关T4-T6及第二电容C2，所述第四可控开关T4的第一端接收所述输入电压VDD，所述第四可控开T4的控制端连接所述第二电容C2的第一端，所述第二电容C2的第二端连接所述第一电容C1的第二端、所述参考可控开关T11的第二端及所述第二控制电路40，所述第四可控开关T4的第二端连接所述第五可控开关T5的第一端及所述第六可控开关T6的第一端，所述第五可控开关T5的控制端接收第二扫描信号SG2，所述第五可控开关T5的第二端连接所述第二电容C2的第一端及所述第四可控开关T4的控制端，所述第六可控开关T6的控制端接收所述发光信号EM，所述第六可控开关T6的第二端连接所述第二像素OLED2的阳极，所述第二像素OLED2的阴极接地。
所述第二控制电路40包括数据可控开关T12，所述数据可控开关T12的控制端接收扫描复位信号SG，所述数据可控开关T12的第一端接收所述数据电压Vdata，所述数据可控开关T12的第二端连接所述第一电容C1的第二端及所述第二电容C2的第二端，所述数据可控开关T12为P型薄膜晶体管，所述数据可控开关T12的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
在本实施例中，所述第一至第六可控开关T1-T6及所述参考可控开关T11均为P型薄膜晶体管，所述第一至第六可控开关T1-T6及所述参考可控开关T11的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
以下对所述像素驱动电路的第一实施例的工作原理进行详细描述：
第一阶段：所述第二及第三可控开关T2和T3导通，所述第一可控开关T1的控制端通过放电进行复位，为写入第一阈值电压Vth1做准备；
第二阶段：所述数据可控开关T12及所述第二可控开关T2均导通，所述参考可控开关T11及所述第三可控开关T3均截止，此时写入第一数据信号Vdata1，获取所述第一可控开关T1的阈值电压Vth1，此时所述第一电容C1两端的电压分别为VDD-Vth1和Vdata1，其中VDD为输入电压；
第三阶段：所述第五及第六可控开关T5和T6均导通，所述第四可控开关T4的控制端通过放电进行复位，为写入第二阈值电压Vth2做准备；
第四阶段：所述数据可控开关T12及所述第五可控开关T5均导通，所述参考可控开关T11及所述第六可控开关T6均截止，此时写入第二数据信号Vdata2，获取所述第四可控开关T4的阈值电压Vth2，此时所述第二电容C2两端的电压分别为VDD-Vth2和Vdata2；
第五阶段：所述发光信号EM为低电平时，所述第一电容C1由于耦合作用两端电位分别为VDD-Vth1-Vdata1+Vref和Vref；所述第二电容C2由于耦合作用两端电位分别为VDD-Vth2-Vdata2+Vref和Vref；其中，Vref为参考电压，此时第一及第二像素OLED1、OLED2通过的电流分别为
IOLED1＝K(VGS1-Vth)＝K(Vdata1-Vref)2
IOLED2＝K(VGS2-Vth)＝K(Vdata2-Vref)2
以此实现通过所述像素驱动单元同时驱动第一及第二像素OLED1及OLED2，并且实现阈值电压Vth补偿。
请参阅图3，由于复位时会使通过第一及第二像素OLED1、OLED2的电流瞬间变大，产生屏幕闪烁，所以输入电压VDD采用高低电平交替信号以防止出现闪烁问题。
请参阅图5及图6，是本发明的像素驱动电路的一个像素驱动单元的第二实施例的结构示意图。所述像素驱动单元的第二实施例与所述像素驱动单元的第一实施例的区别之处在于：所述第二控制电路40包括数据可控开关T12，所述数据可控开关T12的控制端接收所述发光信号EM，所述数据可控开关T12的第一端接收所述数据电压Vdata，所述数据可控开关T12的第二端连接所述第一电容C1的第二端及所述第二电容C2的第二端，所述数据可控开关T12为N型薄膜晶体管，所述数据可控开关T12的控制端、第一端及第二端分别对应所述N型薄膜晶体管的栅极、漏极及源极。
在本实施例中，所述像素驱动电路的数据可控开关T12的控制端接收发光信号EM，以此来减少驱动信号数量，其工作原理与上述像素驱动电路的第一实施例的工作原理相同，在此不再赘述。
请参阅图7至图9，是本发明的像素驱动电路的一个像素驱动单元的第三实施例的结构示意图。所述像素驱动单元的第三实施例与所述像素驱动单元的第一实施例的区别之处在于：所述第一复位电路10或所述第二复位电路20还包括第七可控开关T7，所述第七可控开关T7的控制端接收复位信号Reset，所述第七可控开关T7的第一端接收输入电压VDD，所述第七可控开关T7的第二端连接所述第一可控开关T1的第一端及所述第四可控开关T4的第一端。
在本实施例中，所述第七可控开关T7为P型薄膜晶体管，所述第七可控开关T7的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
以下对所述像素驱动电路的第三实施例的工作原理进行详细描述：
第一阶段：第二及第三可控开关T2和T3导通，所述第六可控开关T6截止，所述第一可控开关T1的控制端通过放电进行复位，为写入阈值电压Vth1做准备，同时所述输入电压VDD被截断，所述第一像素OLED1通过的电流不会突变；
第二阶段：所述第六可控开关T6、所述数据可控开关T12及所述第二可控开关T2均导通，所述参考可控开关T11及所述第三可控开关T3均截止，此时写入数据信号Vdata1，获取所述第一可控开关T1的阈值电压Vth 1，第一电容C1两端的电压分别为VDD-Vth1和Vdata1；
第三阶段：所述第五及第六可控开关T5和T6均导通，所述第六可控开关T6截止，所述第四可控开关T4的控制端通过放电进行复位，为写入阈值电压Vth2做准备，所述第二像素OLED2通过的电流不会突变；
第四阶段：所述第六可控开关T6、所述数据可控开关T12及所述第五可控开关T5均导通，所述参考可控开关T11及所述第六可控开关T6均截止，此时写入数据信号Vdata2，获取所述第四可控开关T4的阈值电压Vth2，所述第二电容C2两端的电压分别为VDD-Vth2和Vdata2；
第五阶段：所述发光信号EM为低电平时，所述第一电容C1由于耦合作用两端电位分别为VDD-Vth1-Vdata1+Vref和Vref；所述第二电容C2由于耦合作用两端电位分别为VDD-Vth2-Vdata2+Vref和Vref；此时第一及第二像素OLED1及OLED2通过的电流分别为：
IOLED1＝K(VGS1-Vth)＝K(Vdata1-Vref)2
IOLED2＝K(VGS2-Vth)＝K(Vdata2-Vref)2
以此实现通过所述像素驱动单元同时驱动第一及第二像素OLED1及OLED2，并且实现阈值电压Vth补偿，避免了复位阶段第一及第二像素OLED1、OLED2的闪烁问题。
请参阅图10及图11，是本发明的像素驱动电路的一个像素驱动单元的第四实施例的结构示意图。所述像素驱动单元的第四实施例与所述像素驱动单元的第三实施例的区别之处在于：所述第二控制电路40包括数据可控开关T12，所述数据可控开关T12的控制端接收所述发光信号EM，所述数据可控开关T12的第一端接收所述数据电压Vdata，所述数据可控开关T12的第二端连接所述第一电容C1的第二端及所述第二电容C2的第二端，所述数据可控开关T12为N型薄膜晶体管，所述数据可控开关T12的控制端、第一端及第二端分别对应所述N型薄膜晶体管的栅极、漏极及源极。
在本实施例中，所述像素驱动电路的数据可控开关T12的控制端接收发光信号EM，以此来减少驱动信号数量，其工作原理与上述像素驱动电路的第三实施例的工作原理相同，在此不再赘述。
请参阅图12及图13，是本发明的像素驱动电路的一个像素驱动单元的第五实施例的结构示意图。所述像素驱动单元的第五实施例与所述像素驱动单元的第一实施例的区别之处在于：所述第一复位电路10还包括第七可控开关T7，所述第七可控开关T7的控制端接收复位信号Reset，所述第七可控开关T7的第一端接收初始信号VI，所述第七可控开关T7的第二端连接所述第一可控开关T1的控制端及所述第一电容C1的第一端；
所述第二复位电路20还包括第八可控开关T8，所述第八可控开关T8的控制端接收所述复位信号Reset，所述第八可控开关T8的第一端接收所述初始信号VI，所述第八可控开关T8的第二端连接所述第四可控开关T4的控制端及所述第二电容C2的第一端。
在本实施例中，所述第七及第八可控开关T7、T8均为P型薄膜晶体管，所述第七及第八可控开关T7、T8的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
以下对所述像素驱动电路的第五实施例的工作原理进行详细描述：
第一阶段：所述第七及第八可控开关T7和T8均导通，所述第一及第四可控开关T1、T4通过初始讯号VI进行复位，为写入阈值电压Vth1及Vth2做准备；此时第一及第二电容C1、C2两端电位均为VI和Vref；
第二阶段：所述数据可控开关T12及所述第二可控开关T2均导通，此时写入数据信号Vdata1，获取所述第一可控开关T1的阈值电压Vth1，所述第一电容C1两端的电压分别为VDD-Vth1和Vdata1；
第三阶段：所述数据可控开关T12及所述第五可控开关T5均导通，此时写入数据信号Vdata2，获取所述第四可控开关T4的阈值电压Vth2，所述第二电容C2两端的电压分别为VDD-Vth2和Vdata2；
第四阶段：所述发光信号EM为低电平时，所述第一电容C1由于耦合作用两端电位分别为VDD-Vth1-Vdata1+Vref和Vref；所述第二电容C2由于耦合作用两端电位分别为VDD-Vth2-Vdata2+Vref和Vref；此时所述第一及第二像素OLED1、OLED2通过的电流分别为：
IOLED1＝K(VGS1-Vth)＝K(Vdata1-Vref)2
IOLED2＝K(VGS2-Vth)＝K(Vdata2-Vref)2
以此实现通过所述像素驱动单元同时驱动第一及第二像素OLED1及OLED2，并且实现阈值电压Vth补偿。
请参阅图14及图15，是本发明的像素驱动电路的一个像素驱动单元的第六实施例的结构示意图。所述像素驱动单元的第六实施例与所述像素驱动单元的第五实施例的区别之处在于：所述第二控制电路40包括数据可控开关T12，所述数据可控开关T12的控制端接收所述发光信号EM，所述数据可控开关T12的第一端接收所述数据电压Vdata，所述数据可控开关T12的第二端连接所述第一电容C1的第二端及所述第二电容C2的第二端，所述数据可控开关T12为N型薄膜晶体管，所述数据可控开关T12的控制端、第一端及第二端分别对应所述N型薄膜晶体管的栅极、漏极及源极。
在本实施例中，所述像素驱动电路的数据可控开关T12的控制端接收发光信号EM，以此来减少驱动信号数量，其工作原理与上述像素驱动电路的第五实施例的工作原理相同，在此不再赘述。
请参阅图16及图17，是本发明的像素驱动电路的一个像素驱动单元的第七实施例的结构示意图。所述像素驱动单元的第七实施例与所述像素驱动单元的第五实施例的区别之处在于：所述第一复位电路10还包括第九可控开关T9，所述第九可控开关T9的控制端接收所述复位信号Reset，所述第九可控开关T9的第一端连接所述第三可控开关T3的第二端，所述第九可控开关T9的第二端接收所述初始信号VI；
所述第二复位电路20还包括第十可控开关T10，所述第十可控开关T10的控制端接收所述复位信号Reset，所述第十可控开关T10的第一端连接所述第六可控开关T6的第二端，所述第十可控开关T10的第二端接收所述初始信号VI。
在本实施例中，所述第九及第十可控开关T9、T10均为P型薄膜晶体管，所述第九及第十可控开关T9、T10的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
以下对所述像素驱动电路的第七实施例的工作原理进行详细描述：
第一阶段：所述第七可控开关T7、所述第八可控开关T8、所述第九可控开关T9及所述第十可控开关T10均导通，所述第一可控开关T1和所述第四可控开关T4均通过初始讯号VI进行复位，为写入阈值电压Vth1及Vth2做准备；此时第一及第二电容C1和C2两端电位均为VI和Vref；同时所述第一及第二像素OLED1及OLED2的阳极通过所述第九及第十可控开关T9、T10进行复位；
第二阶段：所述数据可控开关T12及所述第二可控开关T2均导通，此时写入数据信号Vdata1，获取所述第一可控开关T1的阈值电压Vth1，所述第一电容C1两端的电压分别为VDD-Vth1和Vdata1；
第三阶段：所述数据可控开关T12及所述第五可控开关T5均导通，此时写入数据信号Vdata2，获取所述第四可控开关T4的阈值电压Vth2，所述第二电容C2两端的电压分别为VDD-Vth2和Vdata2；
第四阶段：所述发光信号EM为低电平时，所述第一电容C1由于耦合作用两端电位分别为VDD-Vth1-Vdata1+Vref和Vref；所述第二电容C2由于耦合作用两端电位分别为VDD-Vth2-Vdata2+Vref和Vref；此时所述第一及第二像素OLED1、OLED2通过的电流分别为：
IOLED1＝K(VGS1-Vth)＝K(Vdata1-Vref)2
IOLED2＝K(VGS2-Vth)＝K(Vdata2-Vref)2
以此实现通过所述像素驱动单元同时驱动第一及第二像素OLED1及OLED2，并且实现阈值电压Vth补偿。
请参阅图18至图20，是本发明的像素驱动电路的一个像素驱动单元的第八实施例的结构示意图。所述像素驱动单元的第八实施例与所述像素驱动单元的第七实施例的区别之处在于：所述第二控制电路40包括数据可控开关T12，所述数据可控开关T12的控制端接收所述发光信号EM，所述数据可控开关T12的第一端接收所述数据电压Vdata，所述数据可控开关T12的第二端连接所述第一电容C1的第二端及所述第二电容C2的第二端，所述数据可控开关T12为N型薄膜晶体管，所述数据可控开关T12的控制端、第一端及第二端分别对应所述N型薄膜晶体管的栅极、漏极及源极。
在本实施例中，所述像素驱动电路的数据可控开关T12的控制端接收发光信号EM，以此来减少驱动信号数量，其工作原理与上述像素驱动电路的第七实施例的工作原理相同，在此不再赘述。
所述像素驱动电路将简单的单矩形脉冲级传信号作为驱动控制信号，把两行由第一及第二扫描信号控制的像素驱动电路合并，来达到节省电晶体数目的目的，同时实现了电路中阈值电压补偿，避免了像素闪烁问题。
以上所述仅为本发明的实施方式，并非因此限制本发明的专利范围，凡是利用本发明说明书及附图内容所作的等效结构或等效流程变换，或直接或间接运用在其他相关的技术领域，均同理包括在本发明的专利保护范围内。

Claims (10)

1.一种像素驱动电路，其特征在于，所述像素驱动电路包括级联的多个像素驱动单元，每一所述像素驱动单元包括：
第一复位电路，连接第一像素，用于接收输入电压并对所述第一像素进行复位；
第二复位电路，连接第二像素，用于接收输入电压并对所述第二像素进行复位；
第一控制电路，连接所述第一及第二复位电路，用于接收参考电压并提供给所述第一及第二复位电路；及
第二控制电路，连接所述第一及第二复位电路，用于接收数据电压并提供给所述第一及第二复位电路，以同时驱动所述第一及第二像素；
所述第一复位电路包括第一至第三可控开关及第一电容，所述第一可控开关的第一端接收所述输入电压，所述第一可控开关的控制端连接所述第一电容的第一端，所述第一电容的第二端连接所述第一控制电路、所述第二复位电路及所述第二控制电路，所述第一可控开关的第二端连接所述第二可控开关的第一端及所述第三可控开关的第一端，所述第二可控开关的控制端接收第一扫描信号，所述第二可控开关的第二端连接所述第一电容的第一端及所述第一可控开关的控制端，所述第三可控开关的控制端接收发光信号，所述第三可控开关的第二端连接所述第一像素的阳极，所述第一像素的阴极接地。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述第一控制电路包括参考可控开关，所述参考可控开关的控制端接收所述发光信号，所述参考可控开关的第一端接收所述参考电压，所述参考可控开关的第二端连接所述第一复位电路中所述第一电容的第二端、第一及第二复位电路。
3.根据权利要求2所述的像素驱动电路，其特征在于，
所述第二复位电路包括第四至第六可控开关及第二电容，所述第四可控开关的第一端接收所述输入电压，所述第四可控开关的控制端连接所述第二电容的第一端，所述第二电容的第二端连接所述第一电容的第二端、所述参考可控开关的第二端及所述第二控制电路，所述第四可控开关的第二端连接所述第五可控开关的第一端及所述第六可控开关的第一端，所述第五可控开关的控制端接收第二扫描信号，所述第五可控开关的第二端连接所述第二电容的第一端及所述第四可控开关的控制端，所述第六可控开关的控制端接收所述发光信号，所述第六可控开关的第二端连接所述第二像素的阳极，所述第二像素的阴极接地。
4.根据权利要求3所述的像素驱动电路，其特征在于，所述第一复位电路或所述第二复位电路还包括第七可控开关，所述第七可控开关的控制端接收复位信号，所述第七可控开关的第一端接收输入电压，所述第七可控开关的第二端连接所述第一可控开关的第一端及所述第四可控开关的第一端。
5.根据权利要求4所述的像素驱动电路，其特征在于，所述第一至第七可控开关及所述参考可控开关均为P型薄膜晶体管，所述第一至第七可控开关及所述参考可控开关的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
6.根据权利要求3所述的像素驱动电路，其特征在于，所述第一复位电路还包括第七可控开关，所述第七可控开关的控制端接收复位信号，所述第七可控开关的第一端接收初始信号，所述第七可控开关的第二端连接所述第一可控开关的控制端及所述第一电容的第一端；
所述第二复位电路还包括第八可控开关，所述第八可控开关的控制端接收所述复位信号，所述第八可控开关的第一端接收所述初始信号，所述第八可控开关的第二端连接所述第四可控开关的控制端及所述第二电容的第一端。
7.根据权利要求6所述的像素驱动电路，其特征在于，所述第一复位电路还包括第九可控开关，所述第九可控开关的控制端接收所述复位信号，所述第九可控开关的第一端连接所述第三可控开关的第二端，所述第九可控开关的第二端接收所述初始信号；
所述第二复位电路还包括第十可控开关，所述第十可控开关的控制端接收所述复位信号，所述第十可控开关的第一端连接所述第六可控开关的第二端，所述第十可控开关的第二端接收所述初始信号。
8.根据权利要求7所述的像素驱动电路，其特征在于，所述第一至第十可控开关均为P型薄膜晶体管，所述第一至第十可控开关的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
9.根据权利要求3或4或6或7所述的像素驱动电路，其特征在于，所述第二控制电路包括数据可控开关，所述数据可控开关的控制端接收扫描复位信号，所述数据可控开关的第一端接收所述数据电压，所述数据可控开关的第二端连接所述第一电容的第二端及所述第二电容的第二端，所述数据可控开关为P型薄膜晶体管，所述数据可控开关的控制端、第一端及第二端分别对应所述P型薄膜晶体管的栅极、漏极及源极。
10.根据权利要求3或4或6或7所述的像素驱动电路，其特征在于，所述第二控制电路包括数据可控开关，所述数据可控开关的控制端接收所述发光信号，所述数据可控开关的第一端接收所述数据电压，所述数据可控开关的第二端连接所述第一电容的第二端及所述第二电容的第二端，所述数据可控开关为N型薄膜晶体管，所述数据可控开关的控制端、第一端及第二端分别对应所述N型薄膜晶体管的栅极、漏极及源极。
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