CN106406751B - 基于多通道lvds接口的高速大容量i/q数据记录仪 - Google Patents

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Abstract

本发明涉及I/Q数据记录仪，具体是一种基于多通道LVDS接口的高速大容量I/Q数据记录仪。本发明解决了现有I/Q数据记录仪通用性差、记录速率低、存储容量不足的问题。基于多通道LVDS接口的高速大容量I/Q数据记录仪，包括I/Q数据记录控制模块、嵌入式计算机主板、大容量存储模块、触摸显示器、电源管理模块；所述I/Q数据记录控制模块包括触发信号管理模块、数据接收模块、主控制模块；所述嵌入式计算机主板包括USB接口、PCI‑E接口、网口、VGA接口、微处理器、主板内存；所述大容量存储模块包括固态硬盘。本发明适用于雷达、导航、军用通信、电子对抗装备系统检测等领域。

Description

基于多通道LVDS接口的高速大容量I/Q数据记录仪
技术领域
本发明涉及I/Q数据记录仪，具体是一种基于多通道LVDS接口的高速大容量I/Q数据记录仪。
背景技术
I/Q数据记录仪广泛应用于雷达、导航、军用通信、电子对抗装备系统检测等领域，其作用是对探测装备输出的大量I/Q数据进行记录和存储。实践表明，现有的I/Q数据记录仪由于自身结构所限，普遍存在通用性差、记录速率低、存储容量不足的问题，因此其无法满足高精度探测装备的长时间探测需求。为此有必要发明一种全新的I/Q数据记录仪，以解决现有I/Q数据记录仪通用性差、记录速率低、存储容量不足的问题。
发明内容
本发明为了解决现有I/Q数据记录仪通用性差、记录速率低、存储容量不足的问题，提供了一种基于多通道LVDS接口的高速大容量I/Q数据记录仪。
本发明是采用如下技术方案实现的：
基于多通道LVDS接口的高速大容量I/Q数据记录仪，包括I/Q数据记录控制模块、嵌入式计算机主板、大容量存储模块、触摸显示器、电源管理模块；所述I/Q数据记录控制模块包括触发信号管理模块、数据接收模块、主控制模块；所述触发信号管理模块包括触发选择单元、触发条件判定单元、控制信号产生单元；所述数据接收模块包括多通道LVDS接收芯片、缓存FIFO；所述主控制模块包括SATA控制器、DDR3缓存器；所述嵌入式计算机主板包括USB接口、PCI-E接口、网口、VGA接口、微处理器、主板内存；所述大容量存储模块包括固态硬盘；
其中，触发选择单元的输出端与触发条件判定单元的输入端连接；触发条件判定单元的输出端与控制信号产生单元的输入端连接；控制信号产生单元的输出端与SATA控制器的输入端连接；SATA控制器分别与DDR3缓存器、固态硬盘双向连接；多通道LVDS接收芯片与缓存FIFO双向连接；缓存FIFO与DDR3缓存器双向连接；DDR3缓存器分别与USB接口、PCI-E接口、网口、VGA接口双向连接；USB接口、PCI-E接口、网口、VGA接口均与微处理器双向连接；微处理器与主板内存双向连接；主板内存与触摸显示器双向连接；主板内存的供电输入端与电源管理模块的供电输出端连接。
具体工作过程如下：来自外部的触发信号传输至触发选择单元。触发选择单元对触发信号进行选取，然后将选取的触发信号传输至触发条件判定单元。触发条件判定单元判定触发信号是否满足触发条件，然后根据判定结果触发控制信号产生单元，使得控制信号产生触发响应信号。触发响应信号依次经SATA控制器、DDR3缓存器、缓存FIFO传输至多通道LVDS接收芯片，由此触发多通道LVDS接收芯片，多通道LVDS接收芯片由此开始接收来自探测装备的随路时钟，并根据随路时钟开始采集来自探测装备的I/Q数据，然后将I/Q数据传输至缓存FIFO。缓存FIFO对I/Q数据进行缓存和位宽转换，然后将I/Q数据传输至DDR3缓存器。DDR3缓存器对I/Q数据进行缓存，然后一方面经SATA控制器将I/Q数据传输至固态硬盘进行存储，另一方面经USB接口/PCI-E接口/网口/VGA接口将I/Q数据传输至微处理器。微处理器对I/Q数据进行处理，然后将I/Q数据传输至主板内存。主板内存一方面对I/Q数据进行存储，另一方面将I/Q数据传输至触摸显示器进行显示，由此实现大量I/Q数据的记录和存储。在此过程中，电源管理模块对主板内存进行供电，以保证主板内存正常工作。用户可以通过触摸显示器向主板内存输入参数配置信息。基于上述过程，本发明所述的基于多通道LVDS接口的高速大容量I/Q数据记录仪通过采用全新结构，实现了I/Q数据的高速记录和大容量存储，由此显著增强了通用性、显著提高了记录速率、显著增大了存储容量（试验表明，本发明的记录速率可达300MB/s，存储容量可达2TB），从而完全满足了高精度探测装备的长时间探测需求。
本发明有效解决了现有I/Q数据记录仪通用性差、记录速率低、存储容量不足的问题，适用于雷达、导航、军用通信、电子对抗装备系统检测等领域。
附图说明
图1是本发明的结构示意图。
具体实施方式
基于多通道LVDS接口的高速大容量I/Q数据记录仪，包括I/Q数据记录控制模块、嵌入式计算机主板、大容量存储模块、触摸显示器、电源管理模块；所述I/Q数据记录控制模块包括触发信号管理模块、数据接收模块、主控制模块；所述触发信号管理模块包括触发选择单元、触发条件判定单元、控制信号产生单元；所述数据接收模块包括多通道LVDS接收芯片、缓存FIFO；所述主控制模块包括SATA控制器、DDR3缓存器；所述嵌入式计算机主板包括USB接口、PCI-E接口、网口、VGA接口、微处理器、主板内存；所述大容量存储模块包括固态硬盘；
其中，触发选择单元的输出端与触发条件判定单元的输入端连接；触发条件判定单元的输出端与控制信号产生单元的输入端连接；控制信号产生单元的输出端与SATA控制器的输入端连接；SATA控制器分别与DDR3缓存器、固态硬盘双向连接；多通道LVDS接收芯片与缓存FIFO双向连接；缓存FIFO与DDR3缓存器双向连接；DDR3缓存器分别与USB接口、PCI-E接口、网口、VGA接口双向连接；USB接口、PCI-E接口、网口、VGA接口均与微处理器双向连接；微处理器与主板内存双向连接；主板内存与触摸显示器双向连接；主板内存的供电输入端与电源管理模块的供电输出端连接。
具体实施时，所述多通道LVDS接收芯片为DS90CR484A型LVDS信号转换芯片；所述DDR3缓存器的存储容量为2GB；所述固态硬盘采用双硬盘结构，其存储容量为2TB。

Claims (2)

1.一种基于多通道LVDS接口的I/Q数据记录仪，其特征在于：包括I/Q数据记录控制模块、嵌入式计算机主板、大容量存储模块、触摸显示器、电源管理模块；所述I/Q数据记录控制模块包括触发信号管理模块、数据接收模块、主控制模块；所述触发信号管理模块包括触发选择单元、触发条件判定单元、控制信号产生单元；所述数据接收模块包括多通道LVDS接收芯片、缓存FIFO；所述主控制模块包括SATA控制器、DDR3缓存器；所述嵌入式计算机主板包括USB接口、PCI-E接口、网口、VGA接口、微处理器、主板内存；所述大容量存储模块包括固态硬盘；
其中，触发选择单元的输出端与触发条件判定单元的输入端连接；触发条件判定单元的输出端与控制信号产生单元的输入端连接；控制信号产生单元的输出端与SATA控制器的输入端连接；SATA控制器分别与DDR3缓存器、固态硬盘双向连接；多通道LVDS接收芯片与缓存FIFO双向连接；缓存FIFO与DDR3缓存器双向连接；DDR3缓存器分别与USB接口、PCI-E接口、网口、VGA接口双向连接；USB接口、PCI-E接口、网口、VGA接口均与微处理器双向连接；微处理器与主板内存双向连接；主板内存与触摸显示器双向连接；主板内存的供电输入端与电源管理模块的供电输出端连接。
2.根据权利要求1所述的基于多通道LVDS接口的I/Q数据记录仪，其特征在于：所述多通道LVDS接收芯片为DS90CR484A型LVDS信号转换芯片；所述DDR3缓存器的存储容量为2GB；所述固态硬盘采用双硬盘结构，其存储容量为2TB。
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