CN105336305A - 一种用于薄膜晶体管液晶显示器的goa电路 - Google Patents

一种用于薄膜晶体管液晶显示器的goa电路 Download PDF

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CN105336305A CN201510943488.6A CN201510943488A CN105336305A CN 105336305 A CN105336305 A CN 105336305A CN 201510943488 A CN201510943488 A CN 201510943488A CN 105336305 A CN105336305 A CN 105336305A
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Abstract

本发明提供了一种用于薄膜晶体管液晶显示器的GOA电路，包括：第一开关，其控制端与第一端电性耦接且接收信号HC(n-2)；第二开关，其第一端电性耦接至信号G(n-1)；第三开关，其第一端接收信号HC(n)，其第二端输出第N级栅极控制信号G(n)；以及第四开关，其控制端用于接收第N级栅极控制信号G(n)，第四开关的第二端电性耦接至一接地电压。相比于现有技术，本发明提出了一种“4+2”薄膜晶体管构成的GOA电路，透过4个薄膜晶体管之间的电路连接来产生基本的栅极控制信号，并利用另外的2个薄膜晶体管形成栅极下拉电路以优化上述栅极控制信号，从而可大幅减少GOA电路中的薄膜晶体管的使用数量，以缩减GOA电路在边框宽度方向上的尺寸。

Description

一种用于薄膜晶体管液晶显示器的GOA电路
技术领域
本发明涉及一种液晶显示装置的信号驱动技术，尤其涉及一种用于薄膜晶体管液晶显示器的GOA电路。
背景技术
液晶显示器具有机身薄、省电、无辐射等诸多优点，因而得到了广泛的应用。现有市场上的液晶显示器大部分为背光型液晶显示器，其包括液晶面板(liquidcrystalpanel)及背光模组(backlightmodule)。液晶面板的工作原理是在两片平行的玻璃基板中放置液晶分子，并在两片玻璃基板上施加驱动电压来控制液晶分子的旋转方向，以将背光模组的光线折射出来产生画面。
另一方面，在目前的液晶面板设计中，将栅极驱动器(gatedriver)整合于玻璃基板是未来研发的主流趋势，即，阵列基板行驱动(GateDriveronArray，GOA)技术。GOA技术可以运用面板原有的制程工艺将扫描线(scanline)的驱动电路制作在显示区周围的基板上，使之能替代外接IC完成扫描线的驱动。该设计可减少外接IC的绑定(bonding)工序，降低产品成本，而且可以使面板更适合制作窄边框或无边框的显示产品。与此同时，GOA技术需要有高压差的频率讯号输入至玻璃基板内，加上寄生电容(parasiticcapacitor)比传统的栅极驱动器要大许多，因此将栅极驱动器整合在玻璃基板上的技术也会使得整体功耗上升。例如，在大尺寸的液晶显示产品应用时，若功耗过高，将造成控制电路板上的组件烧毁；在笔记本电脑应用时，功耗过高将明显缩短续航时间。
在现有技术中，GOA电路通常包括级联的多个GOA单元，每级GOA单元对应地驱动一级水平扫描线。然而，当前的GOA单元往往采用数量较多的薄膜晶体管进行电路架构，以产生所需的栅极控制信号，而这将严重影响显示装置的窄边框(slimborder)设计趋势。例如，在面板厂商的某一机种中，边框的宽度到达2500微米之后便无法继续往下降，因其GOA电路在边框宽度方向上已占据了1200微米，对应的占比高达48％。
有鉴于此，如何设计一种新的GOA电路或对现有的GOA电路予以改进，尽可能地减少GOA电路在边框宽度方向上的所占比重，进而减小边框的宽度，以克服现有技术中的上述缺陷或不足，是业内相关技术人员亟待解决的一项课题。
发明内容
针对现有技术中的GOA电路在面板窄边框化时所存在的上述缺陷，本发明提供了一种用于薄膜晶体管液晶显示器的GOA电路，透过减少薄膜晶体管的使用数量来减小GOA电路的宽度，进而达到窄边框化的目的。
依据本发明的一个方面，提供了一种用于薄膜晶体管液晶显示器的GOA电路，包括：
一第一开关，具有一第一端、一第二端以及一控制端，所述第一开关的控制端与第一端电性耦接且用于接收第(N-2)级高频时钟信号HC(n-2)；
一第二开关，具有一第一端、一第二端以及一控制端，所述第二开关的控制端电性耦接至所述第一开关的第二端，所述第二开关的第一端电性耦接至第(N-1)级栅极控制信号G(n-1)；
一第三开关，具有一第一端、一第二端以及一控制端，所述第三开关的控制端电性耦接至所述第二开关的第二端，所述第三开关的第一端用以接收第N级高频时钟信号HC(n)，所述第三开关的第二端用于输出第N级栅极控制信号G(n)；以及
一第四开关，具有一第一端、一第二端以及一控制端，所述第四开关的控制端用于接收第N级栅极控制信号G(n)，所述第四开关的第一端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第四开关的第二端电性耦接至一接地电压。
在其中的一实施例，所述GOA电路还包括一栅极下拉电路，所述栅极下拉电路具有：一第五开关，具有一第一端、一第二端以及一控制端，所述第五开关的控制端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第五开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第五开关的第二端电性耦接至所述接地电压；以及一第六开关，具有一第一端、一第二端以及一控制端，所述第六开关的控制端用于接收第(N+2)级高频时钟信号HC(n+2)，第六开关的第一端电性耦接至第N级栅极控制信号G(n)，第六开关的第二端电性耦接至所述接地电压。
在其中的一实施例，所述GOA电路还包括一栅极下拉电路，所述栅极下拉电路具有：一第五开关，具有一第一端、一第二端以及一控制端，所述第五开关的控制端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第五开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第五开关的第二端电性耦接至所述接地电压；以及一第六开关，具有一第一端、一第二端以及一控制端，所述第六开关的控制端用以接收第(N+2)级栅极控制信号G(n+2)，第六开关的第一端电性耦接至第N级栅极控制信号G(n)，第六开关的第二端电性耦接至所述接地电压。
在其中的一实施例，所述GOA电路还包括：一第七开关，具有一第一端、一第二端以及一控制端，所述第七开关的控制端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第七开关的第一端电性耦接至第(N+2)级高频时钟信号HC(n+2)，所述第七开关的第二端电性耦接至所述接地电压。
在其中的一实施例，所述薄膜晶体管液晶显示器为一窄边框显示器。
依据本发明的另一个方面，提供了一种用于薄膜晶体管液晶显示器的GOA电路，包括：
一第一开关，具有一第一端、一第二端以及一控制端，所述第一开关的控制端与第一端电性耦接且用于接收第(N-3)级高频时钟信号HC(n-3)；
一第二开关，具有一第一端、一第二端以及一控制端，所述第二开关的控制端电性耦接至所述第一开关的第二端，所述第二开关的第一端电性耦接至第(N-2)级栅极控制信号G(n-2)；
一第三开关，具有一第一端、一第二端以及一控制端，所述第三开关的控制端电性耦接至所述第二开关的第二端，所述第三开关的第一端用于接收第N级高频时钟信号HC(n)，所述第三开关的第二端用于输出第N级栅极控制信号G(n)；以及
一第四开关，具有一第一端、一第二端以及一控制端，所述第四开关的控制端用于接收第N级栅极控制信号G(n)，所述第四开关的第一端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第四开关的第二端电性耦接至一接地电压。
在其中的一实施例，所述GOA电路还包括一栅极下拉电路，所述栅极下拉电路具有：一第五开关，具有一第一端、一第二端以及一控制端，所述第五开关的控制端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第五开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第五开关的第二端电性耦接至所述接地电压；以及一第六开关，具有一第一端、一第二端以及一控制端，所述第六开关的控制端用于接收第(N+3)级高频时钟信号HC(n+3)，第六开关的第一端电性耦接至第N级栅极控制信号G(n)，第六开关的第二端电性耦接至所述接地电压。
在其中的一实施例，所述GOA电路还包括一栅极下拉电路，所述栅极下拉电路具有：一第五开关，具有一第一端、一第二端以及一控制端，所述第五开关的控制端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第五开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第五开关的第二端电性耦接至所述接地电压；以及一第六开关，具有一第一端、一第二端以及一控制端，所述第六开关的控制端用于接收第(N+3)级栅极控制信号G(n+3)，第六开关的第一端电性耦接至第N级栅极控制信号G(n)，第六开关的第二端电性耦接至所述接地电压。
在其中的一实施例，所述第一开关、所述第二开关、所述第三开关以及所述第四开关均为N型薄膜晶体管。
在其中的一实施例，所述薄膜晶体管液晶显示器为一窄边框显示器。
采用本发明的用于薄膜晶体管液晶显示器的GOA电路，其第一开关的控制端与第一端电性耦接且用于接收第(N-2)级高频时钟信号HC(n-2)，第二开关的控制端电性耦接至第一开关的第二端，第二开关的第一端电性耦接至第(N-1)级栅极控制信号G(n-1)，第三开关的控制端电性耦接至第二开关的第二端，第三开关的第一端用以接收第N级高频时钟信号HC(n)，第三开关的第二端用于输出第N级栅极控制信号G(n)，第四开关的控制端用于接收第N级栅极控制信号G(n)，第四开关的第一端电性耦接至第一开关的第二端以及第二开关的控制端，第四开关的第二端电性耦接至一接地电压。相比于现有技术，本发明提出了一种“4+2”薄膜晶体管构成的GOA电路，透过4个薄膜晶体管之间的电路连接来产生基本的栅极控制信号，并利用另外的2个薄膜晶体管形成栅极下拉电路以优化上述栅极控制信号，从而可大幅减少GOA电路中的薄膜晶体管的使用数量，以缩减GOA电路在边框宽度方向上的尺寸。经实验测试证明，现有某一机种的最小边框宽度为2500微米时，采用了本发明的GOA电路设计之后，边框宽度可降至1600微米，降幅高达36％(900/2500)。
附图说明
读者在参照附图阅读了本发明的具体实施方式以后，将会更清楚地了解本发明的各个方面。其中，
图1示出现有技术中的一种用于薄膜晶体管液晶显示器的GOA电路的原理示意图；
图2示出依据本发明的一实施方式，用于薄膜晶体管液晶显示器的GOA电路的原理示意图；
图3A至图3E分别示出在图2的GOA电路中，各个关键信号在不同期间的时序波形图；
图4示出图2的GOA电路的一可替换实施例；
图5示出依据本发明的另一实施方式，用于薄膜晶体管液晶显示器的GOA电路的原理示意图；
图6示出图4的GOA电路的一可替换实施例；以及
图7示出依据本发明的再一实施方式，用于薄膜晶体管液晶显示器的GOA电路的原理示意图。
具体实施方式
为了使本申请所揭示的技术内容更加详尽与完备，可参照附图以及本发明的下述各种具体实施例，附图中相同的标记代表相同或相似的组件。然而，本领域的普通技术人员应当理解，下文中所提供的实施例并非用来限制本发明所涵盖的范围。此外，附图仅仅用于示意性地加以说明，并未依照其原尺寸进行绘制。
下面参照附图，对本发明各个方面的具体实施方式作进一步的详细描述。
图1示出现有技术中的一种用于薄膜晶体管液晶显示器的GOA电路的原理示意图。
参照图1，现有的GOA电路包括一主电路(maincircuit)10、一纹波下拉电路(ripplepulldowncircuit)12以及一栅极下拉电路(gatepulldowncircuit)14。其中，主电路10包括三个薄膜晶体管T1、T2和T3；纹波下拉电路12包括十二个薄膜晶体管T6～T17；栅极下拉电路14包括两个薄膜晶体管T4和T5。如此一来，上述GOA电路包括17个薄膜晶体管，数量较多。此外，现有的另一GOA电路包括15个薄膜晶体管，其主要是在纹波下拉电路的设计上稍微有些区别，主电路与栅极下拉电路均未发生改变。
如背景技术部分所述，上述GOA电路采用了数量较多(多达17个)的薄膜晶体管，难以减小面板边框的尺寸。尽管采用15个薄膜晶体管的GOA电路相比于采用17个薄膜晶体管的GOA电路减少两个，仍然难以在窄边框上有实质性的突破。例如，在面板厂商的某一机种中，边框的宽度到达2500微米之后便无法继续往下降，因其GOA电路在边框宽度方向上已占据了1200微米，对应的占比高达48％。
为了解决现有技术中的上述缺陷或不足，本申请揭露了一种新颖的GOA电路架构。其中，图2示出依据本发明的一实施方式，用于薄膜晶体管液晶显示器的GOA电路的原理示意图。图3A至图3E分别示出在图2的GOA电路中，各个关键信号在不同期间的时序波形图。
参照图2，在该实施方式中，本发明的GOA电路至少包括一基本电路20。该基本电路20具有四个薄膜晶体管开关，用来产生第N级栅极控制信号G(n)。相比于现有技术，本发明透过4个薄膜晶体管(即，TFT1～TFT4)之间的电路连接来产生基本的栅极控制信号，因而可大幅减少GOA电路中的薄膜晶体管的使用数量，缩减GOA电路在边框宽度方向上的尺寸，有利于窄边框化。例如，该GOA电路应用于窄边框的薄膜晶体管液晶显示器。
具体而言，第一开关TFT1的栅极与漏极电性耦接在一起，它们用于接收第(N-3)级高频时钟信号HC(n-3)。第二开关TFT2的栅极电性耦接至第一开关TFT1的源极。第二开关TFT2的漏极电性耦接至第(N-2)级栅极控制信号G(n-2)。第二开关TFT2的栅极与第一开关TFT1的源极相连接的公共节点为P，对应的信号可标记为P(n)。
第三开关TFT3的栅极电性耦接至第二开关TFT2的源极。第三开关TFT3的漏极用于接收第N级高频时钟信号HC(n)。第三开关TFT3的源极用于输出第N级栅极控制信号G(n)。第三开关TFT3的栅极与第二开关TFT2的源极相连接的公共节点为Q，对应的信号可标记为Q(n)。第四开关TFT4的栅极电性耦接至第三开关TFT3的源极，亦即，第四开关TFT4的栅极用于接收第N级栅极控制信号G(n)。第四开关TFT4的漏极电性耦接至第一开关TFT1的源极以及第二开关TFT2的栅极。第四开关TFT4的源极电性耦接至一接地电压VSS。
由上述GOA电路的各薄膜晶体管的连接关系可知，本发明藉由第(N-3)级高频时钟信号HC(n-3)搭配薄膜晶体管TFT1来产生类直流讯号，再藉由薄膜晶体管TFT4去下拉本级讯号，就可利用薄膜晶体管TFT2来下拉中间信号Q(n)，且不用额外增加关掉信号Q(n)、G(n)的薄膜晶体管。此外，薄膜晶体管TFT2还可取代现有GOA电路中的纹波下拉电路，同样能够实现信号Q(n)与G(n)的纹波下拉电路的功能。
在一具体实施例，GOA电路还包括一栅极下拉电路22，用于对栅极控制信号G(n)进行优化。如图2所示，该栅极下拉电路22包括薄膜晶体管TFT5和TFT6。详细而言，第五开关TFT5的栅极电性耦接至第一开关TFT1的源极以及第二开关TFT2的栅极，亦即，第五开关TFT5的栅极用以接收中间信号P(n)。第五开关TFT5的漏极电性耦接至第N级栅极控制信号G(n)。第五开关TFT5的源极电性耦接至接地电压VSS。第六开关TFT6的栅极用于接收第(N+3)级高频时钟信号HC(n+3)。第六开关TFT6的漏极电性耦接至第N级栅极控制信号G(n)。第六开关TFT6的源极同样电性耦接至接地电压VSS。
在一具体实施例，第一开关TFT1、第二开关TFT2、第三开关TFT3以及第四开关TFT4均为N型薄膜晶体管。
参照图3A，在时间期间t1中，当第(N-3)级高频时钟信号HC(n-3)从低电平跳变为高电平时，中间信号P(n)会藉由薄膜晶体管TFT1进行下拉。此时第(N-2)级栅极控制信号G(n-2)还没有讯号，即，处于低电平状态。
参照图3B，在时间期间t2中，当第(N-2)级栅极控制信号从低电平跳变为高电平时，中间信号P(n)会被耦合且电位电压超越20V。当薄膜晶体管TFT2打开后，使得中间信号Q(n)的电位电压也迅速上升达到20V。
参照图3C，在时间期间t3中，当第N级高频时钟信号HC(n)从低电平跳变为高电平(即，讯号开始)时，中间信号Q(n)会被耦合且电位电压超越20V。当薄膜晶体管TFT3打开后，使得第N级栅极控制信号G(n)电压上升，且G(n)会由薄膜晶体管TFT4去将中间信号P(n)往下拉，但此时中间信号P(n)并不会去下拉中间信号Q(n)。
参照图3D，在时间期间t4中，当第(N+3)级高频时钟信号HC(n+3)从低电平跳变为高电平时，可由栅极下拉电路中的薄膜晶体管TFT6去缩短第N级栅极控制信号G(n)的下降时间。
参照图3E，在时间期间t5中，当第(N-3)级高频时钟信号HC(n-3)讯号再次开始时，由于已经没有第N级栅极控制信号G(n)去下拉，所以藉由薄膜晶体管TFT2去关掉G(n)的讯号。与此同时，由于其处于高电压的准位，可持续藉由薄膜晶体管TFT2去消除Q点的电压纹波。
图4示出图2的GOA电路的一可替换实施例。将图4与图2进行比较，其主要区别是在于，第六开关TFT6的栅极用于接收第(N+3)级栅极控制信号G(n+3)，而并非第(N+3)级高频时钟信号HC(n+3)。实验表明，图4改用G(n+3)驱动薄膜晶体管TFT6可节约20％的功耗。
图5示出依据本发明的另一实施方式，用于薄膜晶体管液晶显示器的GOA电路的原理示意图。
将图5与图2进行比较，其主要区别是在于，图5的GOA电路的薄膜晶体管TFT1、薄膜晶体管TFT2和薄膜晶体管TFT6的部分连接发生了变化。具体而言，基本电路30中的第一开关TFT1的栅极与漏极用于接收第(N-2)级高频时钟信号HC(n-2)。第二开关TFT2的漏极电性耦接至第(N-1)级栅极控制信号G(n-1)。当采用栅极下拉电路32之后，第六开关TFT6的栅极用于接收第(N+2)级高频时钟信号HC(n+2)。
图6示出图5的GOA电路的一可替换实施例。
将图6与图5进行比较，其主要区别是在于，第六开关TFT6的栅极用于接收第(N+2)级栅极控制信号G(n+2)，而并非第(N+2)级高频时钟信号HC(n+2)。实验表明，图4改用G(n+2)驱动薄膜晶体管TFT6可节约20％的功耗。
图7示出依据本发明的再一实施方式，用于薄膜晶体管液晶显示器的GOA电路的原理示意图。
将图7与图5进行比较，其主要区别是在于，本发明的GOA电路还包括一第七开关TFT7。具体而言，第七开关TFT7的栅极电性耦接至第一开关TFT1的源极以及第二开关TFT2的栅极。第七开关TFT7的漏极电性耦接至第(N+2)级高频时钟信号HC(n+2)。第七开关TFT7的源极电性耦接至接地电压VSS。这是因为，图5中的公共节点P为类直流信号，对于薄膜晶体管TFT2可能会存在直流应力的问题。在加入了薄膜晶体管TFT7之后，可一定程度上改善P点所带来的直流应力。
采用本发明的用于薄膜晶体管液晶显示器的GOA电路，其第一开关的控制端与第一端电性耦接且用于接收第(N-2)级高频时钟信号HC(n-2)，第二开关的控制端电性耦接至第一开关的第二端，第二开关的第一端电性耦接至第(N-1)级栅极控制信号G(n-1)，第三开关的控制端电性耦接至第二开关的第二端，第三开关的第一端用以接收第N级高频时钟信号HC(n)，第三开关的第二端用于输出第N级栅极控制信号G(n)，第四开关的控制端用于接收第N级栅极控制信号G(n)，第四开关的第一端电性耦接至第一开关的第二端以及第二开关的控制端，第四开关的第二端电性耦接至一接地电压。相比于现有技术，本发明提出了一种“4+2”薄膜晶体管构成的GOA电路，透过4个薄膜晶体管之间的电路连接来产生基本的栅极控制信号，并利用另外的2个薄膜晶体管形成栅极下拉电路以优化上述栅极控制信号，从而可大幅减少GOA电路中的薄膜晶体管的使用数量，以缩减GOA电路在边框宽度方向上的尺寸。经实验测试证明，现有某一机种的最小边框宽度为2500微米时，采用了本发明的GOA电路设计之后，边框宽度可降至1600微米，降幅高达36％。
上文中，参照附图描述了本发明的具体实施方式。但是，本领域中的普通技术人员能够理解，在不偏离本发明的精神和范围的情况下，还可以对本发明的具体实施方式作各种变更和替换。这些变更和替换都落在本发明权利要求书所限定的范围内。

Claims (10)

1.一种用于薄膜晶体管液晶显示器的阵列基板行驱动(GatedriverOnArray，GOA)电路，其特征在于，所述GOA电路包括：
一第一开关，具有一第一端、一第二端以及一控制端，所述第一开关的控制端与第一端电性耦接且用于接收第(N-2)级高频时钟信号HC(n-2)；
一第二开关，具有一第一端、一第二端以及一控制端，所述第二开关的控制端电性耦接至所述第一开关的第二端，所述第二开关的第一端电性耦接至第(N-1)级栅极控制信号G(n-1)；
一第三开关，具有一第一端、一第二端以及一控制端，所述第三开关的控制端电性耦接至所述第二开关的第二端，所述第三开关的第一端用以接收第N级高频时钟信号HC(n)，所述第三开关的第二端用于输出第N级栅极控制信号G(n)；以及
一第四开关，具有一第一端、一第二端以及一控制端，所述第四开关的控制端用于接收第N级栅极控制信号G(n)，所述第四开关的第一端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第四开关的第二端电性耦接至一接地电压。
2.根据权利要求1所述的GOA电路，其特征在于，所述GOA电路还包括一栅极下拉电路，所述栅极下拉电路具有：
一第五开关，具有一第一端、一第二端以及一控制端，所述第五开关的控制端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第五开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第五开关的第二端电性耦接至所述接地电压；以及
一第六开关，具有一第一端、一第二端以及一控制端，所述第六开关的控制端用于接收第(N+2)级高频时钟信号HC(n+2)，所述第六开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第六开关的第二端电性耦接至所述接地电压。
3.根据权利要求1所述的GOA电路，其特征在于，所述GOA电路还包括一栅极下拉电路，所述栅极下拉电路具有：
一第五开关，具有一第一端、一第二端以及一控制端，所述第五开关的控制端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第五开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第五开关的第二端电性耦接至所述接地电压；以及
一第六开关，具有一第一端、一第二端以及一控制端，所述第六开关的控制端用以接收第(N+2)级栅极控制信号G(n+2)，所述第六开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第六开关的第二端电性耦接至所述接地电压。
4.根据权利要求1至3中任意一项所述的GOA电路，其特征在于，所述GOA电路还包括：
一第七开关，具有一第一端、一第二端以及一控制端，所述第七开关的控制端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第七开关的第一端电性耦接至第(N+2)级高频时钟信号HC(n+2)，所述第七开关的第二端电性耦接至所述接地电压。
5.根据权利要求1所述的GOA电路，其特征在于，所述薄膜晶体管液晶显示器为一窄边框显示器。
6.一种用于薄膜晶体管液晶显示器的阵列基板行驱动(GatedriverOnArray，GOA)电路，其特征在于，所述GOA电路包括：
一第一开关，具有一第一端、一第二端以及一控制端，所述第一开关的控制端与第一端电性耦接且用于接收第(N-3)级高频时钟信号HC(n-3)；
一第二开关，具有一第一端、一第二端以及一控制端，所述第二开关的控制端电性耦接至所述第一开关的第二端，所述第二开关的第一端电性耦接至第(N-2)级栅极控制信号G(n-2)；
一第三开关，具有一第一端、一第二端以及一控制端，所述第三开关的控制端电性耦接至所述第二开关的第二端，所述第三开关的第一端用于接收第N级高频时钟信号HC(n)，所述第三开关的第二端用于输出第N级栅极控制信号G(n)；以及
一第四开关，具有一第一端、一第二端以及一控制端，所述第四开关的控制端用于接收第N级栅极控制信号G(n)，所述第四开关的第一端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第四开关的第二端电性耦接至一接地电压。
7.根据权利要求6所述的GOA电路，其特征在于，所述GOA电路还包括一栅极下拉电路，所述栅极下拉电路具有：
一第五开关，具有一第一端、一第二端以及一控制端，所述第五开关的控制端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第五开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第五开关的第二端电性耦接至所述接地电压；以及
一第六开关，具有一第一端、一第二端以及一控制端，所述第六开关的控制端用于接收第(N+3)级高频时钟信号HC(n+3)，所述第六开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第六开关的第二端电性耦接至所述接地电压。
8.根据权利要求6所述的GOA电路，其特征在于，所述GOA电路还包括一栅极下拉电路，所述栅极下拉电路具有：
一第五开关，具有一第一端、一第二端以及一控制端，所述第五开关的控制端电性耦接至所述第一开关的第二端以及所述第二开关的控制端，所述第五开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第五开关的第二端电性耦接至所述接地电压；以及
一第六开关，具有一第一端、一第二端以及一控制端，所述第六开关的控制端用于接收第(N+3)级栅极控制信号G(n+3)，所述第六开关的第一端电性耦接至第N级栅极控制信号G(n)，所述第六开关的第二端电性耦接至所述接地电压。
9.根据权利要求6所述的GOA电路，其特征在于，所述第一开关、所述第二开关、所述第三开关以及所述第四开关均为N型薄膜晶体管。
10.根据权利要求6所述的GOA电路，其特征在于，所述薄膜晶体管液晶显示器为一窄边框显示器。
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