CN103915056B - 显示面板及其解多工器电路 - Google Patents

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Abstract

一种显示面板及其解多工器电路。上述解多工器电路包括第1至第P开关单元。第1至第P开关单元分别电性耦接显示面板的第1至第P数据线，且共同接收数据电压，并依序导通以将数据电压提供给对应的数据线，且将数据电压依序提供给第1至第P数据线的期间定义为数据传送期间。当开关单元导通时，N个晶体管根据多个控制信号同时导通。在开关单元断开时，N个晶体管中至少一晶体管根据对应的控制信号而截止。

Description

显示面板及其解多工器电路
【技术领域】
本发明是有关于一种平面显示技术，且特别是有关于一种显示面板及其解多工器电路。
【背景技术】
随着半导体制造技术的进步，目前各种电子产品的体积也逐渐朝向轻薄化来发展。为了符合电子产品小型化的需求，平面显示器因具有空间利用效率佳、高画质、低消耗功率、无辐射等优越特性的而被广为使用。一般而言，平面显示器包括背光模块以及显示面板等构件。其中，显示面板是由像素阵列所构成，源极驱动器会经由多条数据线传送像素阵列所需要的数据电压。
为了解决因显示面板解析度的提升，数据线的数量也随的增加而造成源极驱动器中集成电路(Integrated Circuit，IC)芯片脚位数量增加的问题，通常会在显示面板与源极驱动器之间配置解多工器(Demultiplexer)电路。解多工器电路通常是由多个薄膜晶体管(Thin-Film-Transistor，TFT)所组成，以N型TFT而言，当TFT长时间施加负偏压时容易产生劣化情形。另一方面，为了精确的控制信号电位，TFT通道的宽长比(Width/Length，W/L)都很大，以致于TFT劣化的速度也越快。因此，如何减缓解多工器电路中TFT的劣化速度则成为设计解多工器电路的一个重点。
【发明内容】
本发明的实施例提供一种显示面板及其解多工器电路，可减少解多工器电路中晶体管处于截止的时间，来减缓晶体管的劣化速度。
本发明实施例的解多工器电路，适于传送源极驱动器提供的数据电压至显示面板的第1至第P数据线。上述的解多工器电路包括第1至第P开关单元。第1至第P开关单元分别电性耦接显示面板的第1至第P数据线，且用以共同接收数据电压，并依序导通以将数据电压提供给对应的数据线，且将数据电压依序提供给第1至第P数据线的期间定义为数据传送期间。每一开关单元包括第1至第N晶体管。N个晶体管相互串接，并用以接收多个控制信号，并且用以当开关单元导通时，该N个晶体管还用以根据多个控制信号同时导通以传送数据电压至对应的数据线。在开关单元断开时，该N个晶体管中至少一晶体管还用以根据对应的控制信号而截止，N等于P-1，P为大于2的整数。其中在数据传送期间中，每一个控制信号为第一电压的时间大于或等于控制信号为第二电压的时间，且第一电压大于第二电压。
在本发明实施例的一实施例中，上述的第1至第P开关单元用以共同接收数据电压，并依序导通以将数据电压提供给对应的数据线是为每一开关单元用以将数据电压依序经由第1至第N晶体管传输，再提供给对应的数据线。
在本发明的一实施例中，上述的第P开关单元在数据传送期间中，第1至第N晶体管依照第1至第N的顺序截止。
在本发明实施例的一实施例中，上述的多个控制信号包括第1至第P控制信号。第1至第P控制信号预设为第一电压且在数据传送期间中依序设定为第二电压，并且第1至第P控制信号为第二电压的期间互不重叠。
在本发明实施例的一实施例中，上述的第i开关单元的第j晶体管接收第k控制信号，当i+j除以P后的余数不等于零时，k等于i+j除以P后的余数。当i+j除以P后的余数等于零时，k等于P，其中i、j、k为正整数。
在本发明实施例的一实施例中，上述的P等于3，N等于2。上述的第1开关单元的第1及第2晶体管分别接收第2及第3控制信号。第2开关单元的第1及第2晶体管分别接收第3及第1控制信号。第3开关单元的第1及第2晶体管分别接收第1及第2控制信号。
在本发明实施例的一实施例中，上述的P等于6，N等于5。上述的第1开关单元的第1至第5晶体管分别接收第2至第6控制信号。第2开关单元的第1至第5晶体管分别接收第3至第6及第1控制信号。第3开关单元的第1至第5晶体管分别接收第4至第6及第1至第2控制信号。第4开关单元的第1至第5晶体管分别接收第5至第6及第1至第3控制信号。第5开关单元的第1至第5晶体管分别接收第6及第1至第4控制信号。第6开关单元的第1至第5晶体管依序接收第1至第5控制信号。
本发明实施例的显示面板包括多个像素、多个数据线以及控制单元。多个数据线电性耦接多个像素。本发明的任一种解多工器电路电性耦接多个数据线。控制单元用以产生多个控制信号。
基于上述，本发明实施例的显示面板及其解多工器电路，其重新设计控制信号为第一电压或为第二电压的时间，并且对应地重新设计解多工器电路的电路结构，使得解多工器电路中晶体管导通的时间大于或等于解多工器电路中晶体管截止的时间。如此一来，可减缓解多工器电路中晶体管因长时间处于截止的状态而产生的劣化。
本发明实施例的另一种解多工器电路适于传送一源极驱动器提供的一数据电压至一显示面板的第1至第P数据线，包括：第1至第P开关单元，分别电性耦接显示面板的第1至第P数据线，且用以共同接收数据电压，并依序导通以将数据电压提供给对应的数据线，且将数据电压依序提供给第1至第P数据线的期间定义为一数据传送期间；每一开关单元包括第1至第N晶体管，第1至第N晶体管个晶体管由源极驱动器相互串接至对应的数据线，并用以接收多个控制信号，并且用以当开关单元导通时，N个晶体管还用以根据控制信号同时导通以传送数据电压至对应的数据线，在开关单元断开时，N个晶体管中至少一晶体管还用以根据对应的控制信号而截止，N等于P-1，P为一大于2的整数；其中第1开关单元在数据传送期间中，第1至第N晶体管依照第1至第N的顺序截止。
本发明实施例的另一种显示面板，包括：多个像素；多个数据线，电性耦接该多个像素；上述的解多工器电路，电性耦接该多个数据线；以及一控制单元，用以产生该多个控制信号。
基于上述，上述解多工器电路的第1开关单元的第1至第N晶体管开关顺序被妥善的配置，避免在后续其他开关单元的操作中，错误的提供第1开关单元所电性耦接的数据线错误的信号。
为让本发明的上述特征和优点能更明显易懂，下文特举实施例，并配合所附图式作详细说明如下。
【附图说明】
图1A绘示本发明一实施例的显示面板的电路示意图。
图1B绘示图1A的解多工器电路的驱动波形示意图。
图2A绘示本发明另一实施例的显示面板的电路示意图。
图2B绘示图2A的解多工器电路的驱动波形示意图。
图2C绘示图2A的解多工器电路的另一驱动波形示意图。
图3A绘示本发明又一实施例的显示面板的电路示意图。
图3B绘示图3A的解多工器电路的驱动波形示意图。
【符号说明】
100、200、300：显示面板
110、210、310：解多工器电路
10、30、50：源极驱动器
120、220、230：控制单元
111-1～111-P、211-1～211-3、311-1～311-6：开关单元
C1～C3、SW1～SWP、W1～W6：控制信号
E1～E6、D1～D3、L1～LP：数据线
Data_in、Data_1～Data_N、V1、V2：数据电压
PX：像素
Q11～QPN、M11～M32、B11～B65：晶体管
T：数据传送期间
V0：补偿期间
V11～V13、V21～V26：期间
Vref：参考电压
【具体实施方式】
图1A绘示本发明一实施例的显示面板的电路示意图。图1B绘示图1A的解多工器电路的驱动波形示意图。以下说明请同时参照图1A与图1B。在本实施例中，显示面板100包括多个像素PX、多条数据线L1～LP、解多工器电路110以及控制单元120。数据线L1～LP分别电性耦接多个对应的像素PX，解多工器电路110电性耦接数据线L1～LP。解多工器电路110用于传送源极驱动器10所提供的数据电压Data_in至数据线L1～LP，并且控制单元120用以产生多个控制信号SW1～SWP(对应第1至第P控制信号)以控制解多工器电路110的传送状态。显示面板100可以是液晶显示(Liquid Crystal Display，LCD)面板或是有机发光二极管(Organic Light-Emitting Diode，OLED)显示面板，但本发明实施例不以此为限。
解多工器电路110包括第1至第P开关单元111-1～111-P。开关单元111-1～111-P分别电性耦接显示面板100的数据线L1～LP，共同接收源极驱动器10所提供的数据电压Data_in。开关单元111-1～111-P会依序导通以将数据电压Data_in提供给数据线L1～LP中对应的数据线，且将数据电压依序提供给该第1至第P数据线的期间定义为数据传送期间T。除此之外，在此实施例中只绘示出一个数据电压Data_in来做示范性的说明，但本发明并不局限数据电压Data_in的数量，在其他实施例中，源极驱动器10可传送多个数据电压Data_in至解多工器电路110。
开关单元111-1～111-P中的每一个开关单元包括第1至第N晶体管(如Q11～Q1N、…、QP1～QPN)，N个晶体管相互串接且分别接收多个控制信号SW1～SWP。开关单元111-1～101-P中的每一个开关单元的第N晶体管(如Q1N、Q2N、…、QPN)的第一端电性耦接至对应的数据线，开关单元111-1～111-P中的每一个开关单元的第N晶体管的第二端电性耦接第1至第N晶体管中除第N晶体管的其他晶体管(如Q11～Q1N-1、…、QP1～QPN-1)。并且，上述的晶体管可以是N型或P型的氧化物晶体管，本发明实施例并不受限于此。其中，以开关单元111-1举例来说，在数据传送期间T中，Q11～Q1N会依照第1至第N的顺序截止(对应于图1B中，在数据传送期间T，控制信号SW1～SWP依序设定为第二电压)。
进一步来说，开关单元111-1中包括晶体管Q11～Q1N，开关单元111-2中包括晶体管Q21～Q2N，开关单元111-3中包括晶体管Q31～Q3N，以此类推，开关单元111-P中包括晶体管QP1～QPN。以第一开关单元111-1而言，其中，的第N个晶体管为晶体管Q1N，晶体管Q1N的第一端电性耦接至数据线L1，晶体管Q1N的第二端电性耦接串接的晶体管Q1N-1～Q11，并通过上述晶体管Q1N-1～Q11电性耦接源极驱动器10。开关单元111-1～111-P共同接收数据电压Data_in后，数据电压Data_in会经由开关单元111-1～111-P中第1至第N晶体管传输至数据线L1～LP中对应的数据线。
当开关单元111-1～111-P为导通时，位于导通的开关单元(如111-1～111-P)中的N个晶体管会分别根据控制信号SW1～SWP同时导通以传送数据电压Data_in至对应的数据线(如L1～LP)。反之，当开关单元101-1～101-P断开时，位于断开的开关单元(如111-1～111-P)中的N个晶体管中至少一个晶体管会根据对应的控制信号而截止。其中，N等于P-1，P为大于2的整数。当开关单元111-1～111-P中的晶体管为N型氧化物晶体管时，在解多工器电路110的数据传送期间，各个控制信号SW1～SWP中为第一电压的时间大于或等于为第二电压的时间，且第一电压大于该第二电压，第一电压用以导通N型氧化物晶体管，第二电压用以截止N型氧化物晶体管，第一电压例如为一正电压，第二电压例如为一零电压或者负电压。另一方面，当开关单元101-1～101-P中的晶体管为P型氧化物晶体管时，在解多工器电路110的数据传送期间，各个控制信号SW1～SWP为第二电压的时间大于或等于为第一电压的时间，且第一电压大于该第二电压，第一电压用以截止P型氧化物晶体管，第二电压用以导通P型氧化物晶体管，第一电压例如为一正电压或者零电压，第二电压例如为负电压。
以下将详细说明解多工器电路110的作动过程，请同时参考图1A与图1B。当晶体管Q11～Q1N为N型氧化物晶体管时，控制信号SW1～SWP预设为第一电压且在数据传送期间依序设定为第二电压，并且控制信号SW1～SWP为第二电压的期间互不重叠。在开关单元111-1～111-P中，第i开关单元的第j晶体管会接收第k控制信号。当i+j除以P后的余数不等于零时，k等于i+j除以P后的余数，当i+j除以P后的余数等于零时，k等于P，其中i、j、k为正整数。
举例来说，假设N等于P-1，第1个开关单元111-1中，第1个晶体管Q11(i＝1,j＝1)会接收第2个控制信号SW2(亦即(1+1)/P余2,k＝2)，第2个晶体管Q12(i＝1,j＝2)会接收第3个控制信号SW3(亦即(1+2)/P余3)，其余则以此类推，并且第N个晶体管Q1N(i＝1,j＝P-1)会接收第P个控制信号SWP(亦即(1+P-1)/P余0)；在第2个开关单元111-2中，第1个晶体管Q21(i＝2,j＝1)会接收第3个控制信号SW3(亦即(2+1)/P余3)，第2个晶体管Q22(i＝2,j＝2)会接收第4个控制信号SW4(亦即(2+2)/P余4)，其余则以此类推，并且第N-1个晶体管Q2N-1(i＝2,j＝P-1-1)会接收第P个控制信号SWP(亦即(2+P-1-1)/P余0)，第N个晶体管Q2N(i＝2,j＝P-1)会接收第1个控制信号SW1(亦即(2+P-1)/P余1)；其余可参照图1A所示理解，在此则不再赘述。
在开关单元111-1中，晶体管Q11～Q1N的控制端依序接收控制信号SW2～SWN。换句话说，开关单元111-1中的晶体管Q11～Q1N并未接收控制信号SW1。并且，开关单元111-2中的晶体管Q21～Q2N并未接收控制信号SW2，其余可参照图1A所示，在此则不再赘述。其中，数据电压Data_in可依序为数据电压Data_1～Data_N，数据电压Data_1～Data_N的电压电位高低可依照实际需求来设计，本发明并不对此限制。
举例来说，当解多工器电路110要传送数据电压Data_1至数据线L1时，由于控制信号SW1设定为第二电压且控制信号SW2～SWP皆设定为第一电压，因此开关单元111-1中的晶体管Q11～Q1N全部导通，以致于数据电压Data_1会经由开关单元111-1传送至数据线L1。此时，开关单元111-2中的晶体管Q21～Q2N-1为导通，但晶体管Q2N会受控于控制信号SW1而不导通。
接着，当解多工器电路110要传送数据电压Data_2至数据线L2时，由于控制信号SW2设定为第二电压，控制信号SW1、SW3～SWP皆设定为第一电压，因此开关单元111-2中的晶体管Q21～Q2N全部导通，以致于数据电压Data_2经由开关单元111-2传送至数据线L2。
此外，由于开关单元111-2中的晶体管Q2N的控制端接收控制信号SW1，所以此时晶体管Q11是截止的，但是晶体管Q21～Q2N-1是导通的。因此，数据电压Data_1及Data_3～Data_p不会被储存于开关单元111-2中，因此可避免写入错误的数据电压。以此类推，当解多工器电路110要传送数据电压Data_P至数据线LP时，由于控制信号SWP设定为第二电压，控制信号SW1～SWP-1皆设定为第一电压。因此，开关单元111-P中的晶体管QP1～QPN全部导通，而数据电压Data_P经由开关单元111-P传送至数据线LP。
另一方面，当开关单元111-1～111-P中的晶体管为P型氧化物晶体管时，控制信号SW1～SWP可预设为第二电压且在数据传送期间依序设定为第一电压，并且控制信号SW1～SWP为第二电压的期间互不重叠，作动方式相似于上述，因此不在此赘述。由上述说明可知，本发明的解多工器电路110在传送数据电压Data_in期间，开关单元111-1～111-P中的晶体管(如Q11～Q1N、…、QP1～QPN)的导通时间会大于或等于截止的时间。因此，可减缓解多工器电路110中晶体管在截止状态下所产生劣化的情形。
图2A绘示本发明另一实施例的显示面板的电路示意图。请参照图1A及图2A，其中相同或相似元件使用相同或相似标号。在本实施例中，显示面板200包括多个像素PX、多条数据线D1～D3、解多工器电路210以及控制单元220。数据线D1～D3分别电性耦接多个对应的像素PX，解多工器电路210电性耦接数据线D1～D3。解多工器电路210用于传送源极驱动器30所提供的数据电压V1至数据线D1～D3，并且控制单元220用以产生多个控制信号C1～C3(对应第1至第3控制信号)以控制解多工器电路210的传送状态。解多工器电路210包括第1至第3开关单元211-1～211-3。开关单元211-1～211-3分别电性耦接数据线D1～D3，且共同接收源极驱动器30所提供的数据电压V1。开关单元211-1～211-3并在数据传送期间依序导通以将数据电压V1依序提供给数据线D1～D3。
各个开关单元211-1～211-3分别包括2个相互串接的晶体管(如M11～M12、M21～M22、M31～M32)，上述晶体管分别接收控制信号C1～C3。其中，开关单元211-1的晶体管M11与M12分别接收控制信号C2及C3。开关单元211-2的晶体管M21与M22分别接收控制信号C3及C1。开关单元211-3的晶体管M31与M32分别接收控制信号C1及C2。上述晶体管皆以N型氧化物晶体管来说明，但在其他实施例中上述晶体管可用P型氧化物晶体管来实施，本发明并不对此限制。除此之外，解多工器电路210可视为将图1A中的解多工器电路110设定在P等于3以及N等于2的情况下。
图2B绘示图2A的解多工器电路的驱动波形示意图。以下将详细说明解多工器电路200的作动过程，请同时参考图2A与图2B。除此之外，图2B中的扫描信号SC在数据传送期间为高电位以开启显示面板200中的对应的像素。当解多工器电路210要传送数据电压V1对应第一期间V11的电压电位至数据线D1时，由于控制信号C1设定为第二电压，控制信号C2、C3皆设定为第一电压。因此，开关单元211-1中的晶体管M11～M12全部导通，因此第一期间V11的电压电位经由开关单元211-1传送至数据线D1。接着，当解多工器电路210要传送数据电压V1对应第二期间V12的电压电位至数据线D2时，由于控制信号C2设定为第二电压，控制信号C1、C3皆设定为第一电压。因此，开关单元211-2中的晶体管M21～M22全部导通，对应第二期间V12的电压电位经由开关单元211-2传送至。最后，当解多工器电路210要传送数据电压V1对应第三期间V13的电压电位至数据线D3时，由于控制信号C3设定为第二电压，控制信号C1、C2皆设定为第一电压。因此，开关单元211-3中的晶体管M31～M32全部导通，对应第三期间V13的电压电位经由开关单元211-3传送至数据线D3。除此之外，在此实施例中，数据电压V1的电压电位的设定只是一示范性说明，本发明并不对此限制。
在图2A中，显示面板200可为液晶显示面板。在其他实施例中，显示面板200也可为有机发光二极管显示面板。因此，图2C绘示图2A的解多工器电路用于有机发光二极管显示面板时的驱动波形示意图。请同时参考图2A与图2C，其中，控制信号C1～C3在数据电压V1的补偿期间V0皆为第一电压，用以写入参考电压Vref以补偿晶体管的临界电压(ThresholdVoltage，Vth)。接着，控制信号C1～C3分别在数据电压V1进行数据写入的第一至第三期间V11～V13依序设定为第二电压。因此，开关单元211-1～211-3会依序导通以分别将数据电压V1对应第一至第三期间V11～V13的数据电压传送至数据线D1～D3。由上述说明可知，本发明的解多工器电路210在传送数据电压V1期间，开关单元211-1～211-3中的晶体管的导通时间会大于或等于截止的时间。因此，可减缓解多工器电路210中晶体管(如M11～M12、M21～M22、M31～M32)在截止状态下所产生劣化的情形。
在显示面板200中，各个晶体管M11～M12、M21～M22、M31～M32的端点皆可视为一等效电容，亦即具有储存电荷的功能。以开关单元211-1而言，若晶体管M11～M12未依序截止(亦即若晶体管M11接收控制信号C3、而晶体管M12接收控制信号C2)，虽然数据电压V11仍可以在数据传送期间的第一个时段(开关单元211-1导通而开关单元211-2、211-3截止时)提供给数据线D1，然而在数据传送期间的第二个时段(开关单元211-2导通而开关单元211-1、211-3截止时)，因为晶体管M11为导通，数据电压V12会传输到晶体管M11与晶体管M12之间的杂散电容而储存，当在数据传送期间的第三个时段(开关单元211-3导通而开关单元211-1、211-2截止时)，原本储存于晶体管M11与晶体管M12之间的杂散电容的数据电压V12会因为晶体管M12导通而传递给数据线D1，因此，在本实施例中，各开关单元211-1的晶体管(如M11～M12)会依据控制信号C2、C3而依序截止，以避免错误的数据电压V12写入错误不相对应的像素。
图3A绘示本发明又一实施例的显示面板的电路图。请参照图1A及图3A，其中相同或相似元件使用相同或相似标号。在本实施例中，显示面板300包括多个像素PX、多条数据线E1～E6、解多工器电路310以及控制单元320。数据线E1～E6分别电性耦接多个对应的像素PX，解多工器电路310电性耦接数据线L1～LP。解多工器电路310用于传送源极驱动器50所提供的数据电压V2至数据线E1～E6，并且控制单元320用以产生多个控制信号W1～W6(对应第1至第6控制信号)以控制解多工器电路310的传送状态。解多工器电路310包括第1至第6开关单元311-1～311-6。开关单元311-1～311-6分别电性耦接数据线E1～E6，且共同接收源极驱动器50所提供的数据电压V2。开关单元311-1～311-6在数据传送期间依序导通以将数据电压V2依序提供给数据线E1～E6。
各个开关单元311-1～311-6包括5个相互串接的晶体管(如B11～B15、…、B61～B65)，并且上述晶体管分别接收控制信号W1～W6。其中，开关单元311-1的晶体管B11～B15依序接收控制信号W2～W6。开关单元311-2的晶体管B21～B25依序接收控制信号W3～W6及第1控制信号W1。开关单元311-3的晶体管B31～B35依序接收控制信号W4～W6及W1～W2。开关单元311-4的晶体管B41～B45依序接收控制信号W5～W6及W1～W3。开关单元311-5的晶体管B51～B55依序接收控制信号W6及W1～W4。开关单元311-6的晶体管B61～B65依序接收控制信号W1～W5。除此之外，解多工器电路310可视为将图1A中的解多工器电路110设定在P等于6以及N等于5的情况下。
图3B绘示图3A的解多工器电路的驱动波形示意图。以下将详细说明解多工器电路300的作动过程，请同时参考图3A与图3B。当解多工器电路310要传送数据电压V2对应第一期间V21的电压电位至数据线E1时，由于控制信号W1设定为第二电压，控制信号W2～W6皆设定为第一电压。因此，开关单元311-1中的晶体管B11～B15全部导通，对应第一期间V21的电压电位经由开关单元311-1传送至数据线E1。以此类推，当解多工器电路310要传送数据电压V2对应第六期间V26的电压电位时，由于控制信号W6设定为第二电压，控制信号W1～W5皆设定为第一电压。因此，开关单元311-6中的晶体管B61～B65全部导通，对应第六期间V26的电压电位经由开关单元311-6传送至数据线E6。除此之外，在此实施例中，数据电压V2的电压准只是一示范性说明，本发明并不对此限制。由上述说明可知，本发明的解多工器电路310在传送数据电压V2期间，开关单元311-1～311-6中的晶体管(如B11～B15、…、B61～B65)的导通时间会大于或等于截止的时间。因此，可减缓解多工器电路310中晶体管在截止状态下所产生劣化的情形。
在显示面板300中，各个晶体管B11～B15、B21～B25、B31～B35、B41～B55、B51～B55、B61～B65的端点皆可视为一等效电容，亦即具有储存电荷的功能。以开关单元311-1而言，若晶体管B11～B15未依序截止，则开关单元311-1可能会储存非对应的期间(如V22～V26)所传送的数据电压V2，以致于错误的数据电压V2会传送到数据线E1。因此，在本实施例中，各开关单元311-1～311-6的晶体管(如B11～B15、…、B61～B65)会依据控制信号W1-W6而依序截止，以避免错误的数据电压V2被储存于开关单元311-1～311-6中，进而可避免写入错误的数据电压V2至对应的数据线(如E1～E6)。
综上所述，本发明实施例的显示面板及其解多工器电路，其重新设计控制信号为第一电压或为第二电压的时间，并且对应地重新设计解多工器电路的电路结构，使得解多工器电路中晶体管导通的时间大于或等于解多工器电路中晶体管截止的时间。如此一来，可减缓解多工器电路中晶体管因长时间处于截止的状态而产生的劣化。另一方面，本发明实施例的显示面板及其解多工器电路可大幅减少源极驱动器中的IC芯片脚位数量，以降低IC芯片的制作成本及体积。
虽然本发明已以实施例揭露如上，然其并非用以限定本发明，任何所属技术领域中具有通常知识者，在不脱离本发明的精神和范围内，当可作些许的更动与润饰，故本发明的保护范围当视后附的申请专利范围所界定者为准。

Claims (10)

1.一种解多工器电路，适于传送一源极驱动器提供的一数据电压至一显示面板的第1至第P数据线，其特征在于，包括：
第1至第P开关单元，分别电性耦接该显示面板的该第1至第P数据线，且用以共同接收该数据电压，并依序导通以将该数据电压提供给对应的数据线，且将数据电压依序提供给该第1至第P数据线的期间定义为一数据传送期间；
每一该多个开关单元包括第1至第N晶体管，该N个晶体管相互串接，并用以接收多个控制信号，且用以当该开关单元导通时，该N个晶体管还用以根据该多个控制信号同时导通以传送该数据电压至对应的数据线，在该开关单元断开时，该N个晶体管中至少一晶体管还用以根据对应的控制信号而截止，N等于P-1，P为一大于2的整数；
其中在该数据传送期间中，每一该多个控制信号为一第一电压的时间大于或等于该控制信号为一第二电压的时间，且该第一电压大于该第二电压。
2.如权利要求1所述的解多工器电路，其特征在于，该第1至第P开关单元用以共同接收该数据电压，并依序导通以将该数据电压提供给对应的数据线是为每一开关单元用以将该数据电压依序经由该第1至第N晶体管传输，再提供给对应的数据线。
3.如权利要求2所述的解多工器电路，其特征在于，该第1开关单元在该数据传送期间中，该第1至第N晶体管依照第1至第N的顺序截止。
4.如权利要求2或3所述的解多工器电路，其特征在于，每一该多个开关单元用以接收的该多个控制信号包括第1至第P控制信号，该第1至第P控制信号预设为该第一电压且在该数据传送期间中依序设定为第二电压，并且该第1至第P控制信号为第二电压的期间互不重叠。
5.如权利要求4所述的解多工器电路，其特征在于，第i开关单元的第j晶体管用以接收第k控制信号，当i+j除以P后的余数不等于零时，k等于i+j除以P后的余数，当i+j除以P后的余数等于零时，k等于P，其中i、j、k为一正整数。
6.如权利要求5所述的解多工器电路，其特征在于，P等于3，N等于2；其中第1开关单元的第1及第2晶体管分别接收第2及第3控制信号；
第2开关单元的第1及第2晶体管分别接收第3及第1控制信号；
第3开关单元的第1及第2晶体管分别接收第1及第2控制信号。
7.如权利要求5所述的解多工器电路，其特征在于，P等于6，N等于5；其中第1开关单元的第1至第5晶体管分别接收第2至第6控制信号；
第2开关单元的第1至第5晶体管分别接收第3至第6及第1控制信号；
第3开关单元的第1至第5晶体管分别接收第4至第6及第1至第2控制信号；
第4开关单元的第1至第5晶体管分别接收第5至第6及第1至第3控制信号；
第5开关单元的第1至第5晶体管分别接收第6及第1至第4控制信号；
第6开关单元的第1至第5晶体管依序接收第1至第5控制信号。
8.一种显示面板，其特征在于，包括：
多个像素；
多个数据线，电性耦接该多个像素；
如权利要求1至7任一所述的解多工器电路，电性耦接该多个数据线；以及
一控制单元，用以产生该多个控制信号。
9.一种解多工器电路，适于传送一源极驱动器提供的一数据电压至一显示面板的第1至第P数据线，包括：
第1至第P开关单元，分别电性耦接该显示面板的该第1至第P数据线，且用以共同接收该数据电压，并依序导通以将该数据电压提供给对应的数据线，且将该数据电压依序提供给该第1至第P数据线的期间定义为一数据传送期间；
每一该多个开关单元包括第1至第N晶体管，该第1至第N晶体管由该源极驱动器相互串接至对应的数据线，并用以接收多个控制信号，并且用以当该开关单元导通时，该N个晶体管还用以根据该多个控制信号同时导通以传送该数据电压至对应的数据线，在该开关单元断开时，该N个晶体管中至少一晶体管还用以根据对应的控制信号而截止，N等于P-1，P为一大于2的整数；
其中该第1开关单元在该数据传送期间中，该第1至第N晶体管依照第1至第N的顺序截止。
10.如权利要求9所述的解多工器电路，其特征在于，每一该多个开关单元用以接收的该多个控制信号包括第1至第P控制信号，该第1至第P控制信号预设为一第一电压且在该数据传送期间中依序设定为一第二电压，并且该第1至第P控制信号为该第二电压的期间互不重叠。
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