CN103904630A - 放电电路 - Google Patents

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周海清
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    • HELECTRICITY
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    • H02J1/082Plural DC voltage, e.g. DC supply voltage with at least two different DC voltage levels

Abstract

一种放电电路,用于控制设置于主板上的PWM芯片的放电操作,其中当电源供应器存在一电压未输出时,该PWM芯片接收低电平的控制信号,当该电源供应器输出所有的电压时,该PWM芯片接收高电平的控制信号,该放电电路包括第一电子开关、第二电子开关、第一电阻及一第二电阻,该第一电子开关的第一端用于接收该PWM芯片输出的控制信号,该第一电子开关的第二端接地,该第一电子开关的第三端通过该第一电阻与一待机电压相连,还与该第二电子开关的第一端相连,该第二电子开关的第二端接地,该第二电子开关的第三端通过该第二电阻与该PWM芯片的相位输出引脚相连。本发明放电电路可有效减少能量的浪费。

Description

放电电路
技术领域
[0001] 本发明涉及一种放电电路。
背景技术
[0002] 主板漏电主要是由于待机电压正常输出时而系统电压还未被输出,从而导致了主板上电时序的紊乱,此时则可能存在主机漏电的情况。为了满足主板上电压时序要求,大部分设计人员就是加一个放电电阻,以进行放电操作。然而,放电电阻一直存在,主板工作时,放电电阻上仍会有电流流过,此时该放电电阻就有功耗产生,如此导致了能量的浪费,进而影响电源效率。
发明内容
[0003] 鉴于以上内容,有必要提供一种可减少能量浪费的放电电路。
[0004] 一种放电电路,用于控制一设置于主板上的PWM芯片的放电操作,其中当一电源供应器存在一电压未输出时,该PWM芯片的使能引脚及控制引脚接收一低电平的控制信号,当该电源供应器输出所有的电压时,该PWM芯片使能引脚及控制引脚接收一高电平的控制信号,该放电电路包括一第一电子开关、一第二电子开关、一第一电阻及一第二电阻,该第一电子开关的第一端用于接收该PWM芯片输出的控制信号,该第一电子开关的第二端接地,该第一电子开关的第三端通过该第一电阻与一待机电压相连,该第一电子开关的第三端还与该第二电子开关的第一端相连,该第二电子开关的第二端接地,该第二电子开关的第三端通过该第二电阻与该PWM芯片的相位输出引脚相连;当主板上的系统电压未输出而待机电压输出时,该PWM芯片的相位输出引脚输出漏电电压,该第一电子开关的第二端与第一电子开关的第三端截止,该第二电子开关的第二端与第三端连通,使得由PWM芯片的相位输出引脚所输出的漏电电压经由第二电阻及第二电子开关接地;当主板上的系统电压与待机电压均输出时,该PWM芯片无漏电电压输出,该第一电子开关的第二端与第三端连通,该第二电子开关的第二端与第三端截止,所述第二电阻上无电流流过。
[0005] 上述放电电路在电源供应器未输出所有电压时通过该第二电子开关进行放电操作,在电源供应器输出所有电压时,控制该第二电阻无电源通过,如此达到了减少能量浪费的目的。
附图说明
[0006] 图1是本发明放电电路的第一实施方式的电路图。
[0007] 图2是本发明放电电路的第二实施方式的电路图。
[0008] 主要元件符号说明
Figure CN103904630AD00031
Figure CN103904630AD00041
如下具体实施方式将结合上述附图进一步说明本发明。
具体实施方式
[0009] 请参考图1,本发明放电电路的第一较佳实施方式包括五个电阻R3-R7及两个场效应管Q3与Q4。
[0010] 该场效应管Q3的栅极G与一 PWM芯片Ul的使能引脚En及控制引脚PG相连,以接收对应的控制信号。该场效应管Q3的栅极G还通过该电阻R3与一系统电源Vcc相连,该场效应管Q3的栅极G还通过该电阻R4接地。该场效应管Q3的源极S接地,漏极D通过该电阻R5与一待机电源5VSB相连,该场效应管Q3的漏极D还直接与该场效应管Q4的栅极G相连。该场效应管Q4的源极S接地,漏极D通过该电阻R6与一电感LI的第一端相连,所述电感LI的第二端连接于该PWM芯片Ul的相位输出引脚Phase。该电阻R7与该电阻R6并联连接。
[0011] 本实施方式中,该PWM芯片Ul的电压引脚Vc与该系统电源Vcc相连,该PWM芯片Ul的使能引脚En用于接收外部的使能信号Enable,该PWM芯片Ul的接地引脚GND接地。该PWM芯片Ul的高电平输出引脚Hgate与一场效应管Ql的栅极G相连,该场效应管Ql的漏极D与一电源VIN相连,该电源VIN还通过一电容Cl接地,一电容C2与电容Cl并联连接。该场效应管Ql的源极S与该PWM芯片Ul的相位输出引脚Phase相连。该PWM芯片Ul的低电平输出引脚Lgate与一场效应管Q2的栅极G相连,该场效应管Q2的漏极D与该PWM芯片Ul的相位输出引脚Phase相连,该场效应管Q2的源极S接地。该PWM芯片Ul的电压输出引脚FB通过一电阻R2接地,还通过一电阻Rl与该电感LI的第一端相连。该电感LI的第一端还分别通过电容C3、C4接地。该PWM芯片的控制引脚PG用于接收外部的电源好信号 PWR_GD。
[0012] 本实施方式中,该场效应管Q3的栅极G接收的控制信号包括该使能信号及该电源好信号。开机时,当电源供应器中存在一电源(比如系统电源)未输出时,该电源好信号为低电平,该使能信号亦为低电平,该场效应管Q3的栅极G接收到的控制信号为低电平。此时,若主板存在漏电情况,该PWM芯片Ul的相位输出引脚Phase则会输出该漏电电压。该场效应管Q3的栅极G为低电平,该场效应管Q3的源极S与漏极D之间的连接截止,该场效应管Q4的栅极G为高电平,该场效应管Q4的漏极S与漏极G之间的连接导通,该PWM芯片Ul的相位输出引脚Phase输出的漏电电压则会通过该电阻R6及R7接地,进而达到了放电的目的。
[0013] 当电源供应器内所有的电源均输出之后,该电源好信号将变为高电平,该使能信号亦为高电平,该场效应管Q3的栅极G接收到了高电平的控制信号。此时,该场效应管Q3的漏极D与源极S之间的连接导通,该场效应管Q4的栅极G变为低电平,该场效应管Q4的漏极D与源极S之间的连接断开。该电阻R6与R7上均无电流通过,从而避免了在主板正常工作时放电电阻R6、R7消耗的能源,有利于提高电源的效率及减少浪费。
[0014] 在其他实施方式中,该控制信号亦可只包括该使能信号或该电源好信号中的一个。
[0015] 请参考图2,本发明放电电路的第二实施方式的电路图,其与第一实施方式的区别在于:该场效应管Q5 (相当于第一实施方式中的场效应管Q3)与Q6 (相当于第一实施方式中的场效应管Q4)之间还包括一延时电路100。该延时电路100包括一电容C5、一电阻R8及一二极管Dl。该场效应管Q5的漏极D依次通过该电阻R8及该电容C5接地,该二极管Dl的阳极连接于电阻R8与电容C5之间的节点,还与该场效应管Q6的栅极G相连。该二极管Dl的阴极与场效应管Q5的漏极D相连。当电源供应器中存在一电源(比如系统电压)未输出时,该电源好信号为低电平,该使能信号亦为低电平,该场效应管Q5的栅极G接收到的控制信号为低电平。此时,若主板存在漏电情况,该PWM芯片Ul的相位输出引脚Phase则会输出该漏电电压。该场效应管Q5的栅极G为低电平,该场效应管Q5的源极S与漏极D之间的连接截止,该电源5VSB通过该电阻R8对该电容C5进行充电,当该电容C5的充电电压达到该场效应管Q6的开启电压后,该场效应管Q6的源极S与漏极D之间的连接导通,该PWM芯片Ul的相位输出引脚Phase输出的漏电电压则会通过该电阻R12及R13接地,进而达到了放电的目的。
[0016] 当电源供应器内所有的电源均输出之后,该电源好信号变为高电平,该使能信号亦为高电平,该场效应管Q5的栅极G接收到了高电平的的控制信号。此时,该场效应管Q5的漏极D与源极S之间的连接导通,该电容C5通过该电阻R8进行放电,进行使得该场效应管Q6的栅极G变为低电平,该场效应管Q6的漏极D与源极S之间的连接断开。该电阻R12与R13上均无电流通过,从而避免了在主板正常工作时放电电阻R12、R13消耗能源,有利于提高电源的效率。本实施方式中,该场效应管Q5、Q6均为N沟道场效应管。
[0017] 由上述的描述可知,场效应管Q3、Q4、Q5及Q6均起到了电子开关的作用。在其他实施方式中,该场效应管Q3、Q4、Q5及Q6可使用其他类型的电子开关来代替,如NPN三极管。NPN三极管的基极、发射极及集电极分别相当于场效应管Q3、Q4、Q5及Q6的栅极、源极及漏极。

Claims (5)

1.一种放电电路,用于控制一设置于主板上的PWM芯片的放电操作,其中当一电源供应器存在一电压未输出时,该PWM芯片的使能引脚及控制引脚接收一低电平的控制信号,当该电源供应器输出所有的电压时,该PWM芯片使能引脚及控制引脚接收一高电平的控制信号,该放电电路包括一第一电子开关、一第二电子开关、一第一电阻及一第二电阻,该第一电子开关的第一端用于接收该PWM芯片输出的控制信号,该第一电子开关的第二端接地,该第一电子开关的第三端通过该第一电阻与一待机电压相连,该第一电子开关的第三端还与该第二电子开关的第一端相连,该第二电子开关的第二端接地,该第二电子开关的第三端通过该第二电阻与该PWM芯片的相位输出引脚相连;当主板上的系统电压未输出而待机电压输出时,该PWM芯片的相位输出引脚输出漏电电压,该第一电子开关的第二端与第一电子开关的第三端截止,该第二电子开关的第二端与第三端连通,使得由PWM芯片的相位输出引脚所输出的漏电电压经由第二电阻及第二电子开关接地;当主板上的系统电压与待机电压均输出时,该PWM芯片无漏电电压输出,该第一电子开关的第二端与第三端连通,该第二电子开关的第二端与第三端截止,所述第二电阻上无电流流过。
2.如权利要求1所述的放电电路,其特征在于:该放电电路还包括一第三电阻、一第四电阻及一第五电阻,该第一电子开关的第一端通过该第三电阻与一电源相连,还通过该第四电阻接地,该第二电子开关的第三端还通过该第五电阻与该相位输出引脚相连。
3.如权利要求2所述的放电电路,其特征在于:该放电电路还包括一第六电阻、一二极管及一电容,该第一电子开关的第三端通过该第六电阻及该电容接地,该第二电子开关的第一端连接于该第六电阻与该电容的节点处,该二极管的阴极与该第一电子开关的第三端相连,阳极与该第二电子开关的第一端相连。
4.如权利要求3所述的放电电路,其特征在于:该第一及第二电子开关为N沟道场效应管,该第一及第二电子开关的第一端、第二端及第三端分别相当于N沟道场效应管的栅极、源极及漏极。
5.如权利要求3所述的放电电路,其特征在于:该第一及第二电子开关为NPN型三极管,该第一及第二电子开关的第一端、第二端及第三端分别相当于NPN型三极管的基极、发射极及集电极。
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