CN103631327B - 体积小且易连接的主控板 - Google Patents

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Abstract

本发明公开了一种体积小且易连接的主控板，包括处理中心、第一连接器和第二连接器，所述的处理中心包括CPU模块、网卡芯片、存储芯片和CPLD，所述的存储芯片、CPLD和CPU模块都连接到60X总线上，60X总线还通过一缓冲器连接到一条Local总线，该Local总线连接到第一连接器，所述的网卡芯片连接到CPU模块上的MII接口上，网卡芯片连接到第二连接器。本发明的有益效果：采用两个连接器代替原来的多接口模式，使得主板的尺寸大大减小，而且还使得原来复杂的接口显得有序，能够更好地安装于设备上。

Description

体积小且易连接的主控板
技术领域
本发明涉及到一种计算机主板，特别是涉及到一种体积小且易连接的主控板。
背景技术
信息时代，数字时代使得嵌入式产品获得了巨大的发展契机，目前嵌入式系统广泛应用于国防、交通、通信、工业控制等领域。
现有的嵌入式计算机主板的尺寸都比较大，功耗高，难以满足手持设备的要求，并且现有很多主板的接口都不适合手持设备。
发明内容
本发明的目的在于克服上述现有技术的缺点和不足，提供一种体积小且易连接的主控板，解决现有嵌入式主板尺寸过大，接口复杂，从而不适合手持设备的缺点。
本发明的目的通过下述技术方案实现：体积小且易连接的主控板，包括处理中心、第一连接器和第二连接器，所述的处理中心包括CPU模块、网卡芯片、存储芯片和CPLD，所述的存储芯片、CPLD和CPU模块都连接到60X总线上，60X总线还通过一缓冲器连接到一条Local总线，该Local总线连接到第一连接器，所述的网卡芯片连接到CPU模块上的MII接口上，网卡芯片连接到第二连接器。
所述的CPU模块提供有4个UART串口，所述的UART串口连接到第二连接器。
所述的UART串口包括两个RS232串口和两个TTL电平串口。
所述的CPLD上连接有一个复位模块。
所述的存储芯片包括程序存储芯片，该程序存储芯片为Flash芯片。
本发明的有益效果是：采用两个连接器代替原来的多接口模式，使得主板的尺寸大大减小，而且还使得原来复杂的接口显得有序，能够更好地安装于设备上。
附图说明
图1 为本发明的结构框图。
具体实施方式
下面结合实施例对本发明作进一步的详细说明，但是本发明的结构不仅限于以下实施例：
【实施例】
如图1所示，体积小且易连接的主控板，包括处理中心、第一连接器和第二连接器，所述的处理中心包括CPU模块、网卡芯片、存储芯片和CPLD，所述的存储芯片、CPLD和CPU模块都连接到60X总线上，60X总线还通过一缓冲器连接到一条Local总线，该Local总线连接到第一连接器，所述的网卡芯片连接到CPU模块上的MII接口上，网卡芯片连接到第二连接器。
所述的CPU模块提供有4个UART串口，所述的UART串口连接到第二连接器。
所述的UART串口包括两个RS232串口和两个TTL电平串口。
所述的CPLD上连接有一个复位模块。
所述的存储芯片包括程序存储芯片，该程序存储芯片为Flash芯片，60X总线上还连接有一个SDRAM存储器。
本实施例的CPU模块采用MPC8547型号的芯片，是基于Freescale（飞思卡尔）的PowerPC架构的PowerQuicc II处理器，强大的处理能力特别适合于高速低时延的处理；网卡芯片采用Marvell的88E8001，提供了10/100/1000M速率的以太网接口；CPLD模块为复杂可编程逻辑器件，采用Altera EPM7128S芯片，主要用于为Local总线提供时序支持，并且通过连接在CPLD模块上的复位模块为处理中心通过复位功能。

Claims (2)

1.体积小且易连接的主控板，其特征在于，包括处理中心、第一连接器和第二连接器，所述的处理中心包括CPU模块、网卡芯片、存储芯片和CPLD，所述的存储芯片、CPLD和CPU模块都连接到60X总线上，60X总线还通过一缓冲器连接到一条Local总线，该Local总线连接到第一连接器，所述的网卡芯片连接到CPU模块上的MII接口上，网卡芯片连接到第二连接器；
所述的CPU模块提供有4个UART串口，所述的UART串口连接到第二连接器；
所述的UART串口包括两个RS232串口和两个TTL电平串口；
所述的CPLD上连接有一个复位模块。
2.根据权利要求1所述的体积小且易连接的主控板，其特征在于，所述的存储芯片包括程序存储芯片，该程序存储芯片为Flash芯片。
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