CN102790670B - 一种基于hspa+的hs-dsch接收方法及装置 - Google Patents
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Abstract
本发明公开了一种基于HSPA+的HS‑DSCH接收方法及装置，该方法通过读取时隙中待解码HS‑DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器，针对每个传输时间间隔TTI包含的数据，从第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、并进行HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器，读取第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验。
Description
技术领域
本发明涉及通信技术领域，尤其涉及一种基于增强型高速分组接入(HighSpeed Downlink Packet Access Plus，HSPA+)的高速下行共享信道(High-Speed Physical Downlink Shared Channel，HS-DSCH)接收方法及装置。
背景技术
时分同步码分多址(Time Division-Synchronous Code Division MultipleAccess，TD-SCDMA)系统在Release 8标准中引入了HSPA+技术，HSPA+技术针对HSDPA技术作了进一步的增强，使得HSDPA传输速率最高可以支持4.2Mbps。为了达到支持4.2Mbps的峰值速率，只能将HS-DSCH的外接收机的各功能模块都采用硬件实现方式，才可以满足上述数据量的传输需求。
由于HSPA+技术是一种较新的技术，因此现有的HS-DSCH的外接收机还无法满足上述传输速率的要求。而现有技术中提出了一种混合自动重传请求的信道译码的方法，通过对HS-DSCH上接收的一个传输时间间隔(TransmissionTime Interval，TTI)数据，依次进行比特分离和解第二级速率匹配，得到第一数据；之后对各个Turbo译码块数据逐个进行解第一级速率匹配和比特收集操作；数据缓存后，将译码块发送到译码模块进行译码，得到下行传送数据块。该方法中译码块的数量最多为3块，而HSPA+技术中存在5块译码数据的要求，因此该数据译码接收的方法无法适用于HSPA+技术。
现有技术中还存在另一用于宽带码分多址(Wideband Code Division Multiple Access，WCDMA)协议中的HSDPA混合自动重传请求的接收方法，在该方法中依据WCDMA协议包括了比特收集、去二次速率匹配、HARQ存储、去一次速率匹配四个模块，并且在处理的过程中，采用并行处理的方式处理系统比特、第一校验比特以及第二校验比特，从而提高处理速率。但是该方法硬件资源开销过大，而且是基于WCDMA协议的，因此该方法也无法应用到TD-SCDMA系统中。
发明内容
有鉴于此，本发明提供一种基于HSPA+的HS-DSCH接收方法及装置，用以解决现有技术中HSPA+技术的引入，导致接收方法无法满足大数据量的处理需求。
本发明提供一种基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收方法，该接收方法包括如下步骤：
读取当前隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器；
针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器；
读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验。
本发明提供一种基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收装置，所述接收装置包括：
第一处理单元，用于读取当前时隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器；
第二处理单元，用于针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器；
第三处理单元，用于读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验。
本发明实施例提供了一种基于HSPA+的HS-DSCH接收方法及装置，该接收方法中通过读取时隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器，针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器，读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验，由于本发明实施例中整个接收过程只需要两个缓存器，从而有效地节省了硬件资源。
附图说明
此处所说明的附图用来提供对本发明的进一步理解，构成本发明的一部分，本发明的示意性实施例及其说明用于解释本发明，并不构成对本发明的不当限定。在附图中：
图1为本发明实施例提供的基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH的接收过程；
图2为本发明实施例提供的基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收的详细过程；
图3为本发明实施例提供的基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收的另一详细过程；
图4为本发明实施例提供的一种基于HSPA+的HS-DSCH接收的较详细实施过程；
图5为本发明实施例提供的基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收装置的结构示意图。
具体实施方式
为了使本发明所要解决的技术问题、技术方案及有益效果更加清楚、明白，以下结合附图和实施例，对本发明进行进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
本发明实施例为了节省硬件资源，提供了一种基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收方法及装置。
图1为本发明实施例提供的基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH的接收过程，该接收过程包括以下几个步骤：
S101：读取当前时隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器。
根据协议TD-SCDMA系统中，HS-DSCH解码处理过程包括九个步骤，分别为：软解调、星座图解重排、解交织、比特解扰、混合自动重传请求(HARQ)逆处理、Turbo译码、码块级联、CRC校验。其中软解调、星座图解重排、解交织在上述步骤中实现。
并且，上述过程是以时隙数据为单位进行处理的。
另外，在本发明实施例中该第一缓存器的容量可以为任意值，较佳的该第一缓存器的容量为大于一个TTI最大容量值的任意值，为了有效地节省硬件资源，在本发明中第一缓存器的容量根据一个TTI包含的最大数据量确定。
S102：针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器。
该过程以TTI数据为处理对象，进行比特解扰、HARQ解合并、HARQ解第二级速率匹配及递增冗余合并处理。
其中该第二缓存器的容量可以为任意值，较佳的该第二缓存器的容量可以根据接收装置支持的能力等级确定。
S103：读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验。
该过程也是以TTI数据为处理对象，进行HARQ解第一级速率匹配、Turbo译码、码块级联及CRC校验处理。
另外，在本发明实施例中为进一步了节省硬件资源，在读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，将处理后的数发送给译码器据进行译码时，采用一个或两个译码器，并根据多次复用的方法，将处理后的数据进行译码。
以具体的例子进行说明：HS-DSCH的TTI为5ms，在支持HSPA+峰值4.2Mbps速率的时候，一个TTI最多需要对5块数据进行Turbo译码，由Turbo译码器的特性可知，在支持多次迭代的情况下，译码处理时间较长，如果采用5个Turbo译码器同时并行译码，处理时间较短，但硬件开销较大，因此本发明实施例中提供的采用一个或两个译码器，并根据多次复用的方法，既能保证处理时间，又有效地节省硬件资源。
在本发明实施例中译码器对处理后的数据进行译码时，当译码器对译码块译码结束后，对该译码器输出的译码结果进行校验，同时将下一个处理后的译码块发送给译码器进行译码，重复以上操作，直至所有数据译码结束。
另外，在本发明实施例中当对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器后，该接收方法还包括：
判断该TTI包含的数据是否需要进行递增冗余合并处理；
当确定需要进行递增冗余合并处理时，从所述第二缓存器中读取该TTI对应的进程的数据，并与当前从第一缓存器中读取的数据进行递增冗余合并处理，并将处理后的数据保存至第二缓存器。
即在针对每个TTI数据进行处理的过程中，根据是否需要该TTI数据进行递增冗余合并处理进行判断，根据判断的结果采用相应的处理方式。
图2为本发明实施例提供的基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收的详细过程，该过程包括以下几个步骤：
S201：读取当前时隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器。
S202：针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器。
S203：判断该TTI包含的数据是否需要进行递增冗余合并处理，当判定结果为是时，进行步骤S204，否则，进行步骤S206。
S204：从所述第二缓存器中读取该TTI对应的进程的数据，并与当前从第一缓存器中读取的数据进行递增冗余合并处理。
S205：将递增冗余合并处理后的数据保存至第二缓存器。
S206：读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验。
另外，为了进一步节省硬件资源，在本发明实施例中第一缓存器的容量根据一个TTI包含的最大数据量确定，采用一个或两个译码器，并根据多次复用的方法，将处理后的数据进行译码，当译码器对译码块译码结束后，对该译码器输出的译码结果进行校验。
在本发明实施例中为了实现连续TTI符号数据流水处理要求，在从所述第一缓存器中读取该TTI包含的数据之前，该接收方法还包括：判断是否对当前TTI包含的符号数据所有的时隙处理结束，并判断第二缓存器中的上一个TTI包含的数据是否处理结束；
当确定第一缓存器对当前TTI包含的符号数据所有的时隙处理结束，且第二缓存器中的上一个TTI包含的数据也处理结束时，进行后续步骤，否则等待，直至第一缓存器对当前TTI包含的符号数据所有的时隙处理结束，且第二缓存器中的上一个TTI包含的数据处理结束。
即需要判断当前TTI包含的符号数据所有的时隙处理是否结束，并判断第二缓存器中的上一个TTI包含的数据是否处理结束，具体的当确定当前TTI包含的符号数据所在的时隙处理结束时，且第二缓存器中的上一个TTI包含的数据也处理结束时，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器，否则，等待至该TTI包含的符号数据所有的时隙处理结束，且第二缓存器中的上一个TTI包含的数据处理结束。
图3为本发明实施例提供的基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收的另一详细过程，该过程包括以下几个步骤：
S301：读取当前时隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器。
S302：判断是否对当前TTI包含的符号数据所有的时隙处理结束，且第二缓存器中的上一个TTI包含的数据也处理结束，当判断结果均为是时，进行步骤S303，否则，只要判断中至少一个判断为否时，进行步骤S302。
S303：针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器。
S304：读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验。
另外，该对当前TTI包含的符号数据所有的时隙处理结束，与递增冗余合并处理判断的过程也可以结合进行，图4为本发明实施例提供的一种基于HSPA+的HS-DSCH接收的较详细实施过程，该过程包括以下步骤：
S401：判断当前时隙中是否含有HS-DSCH符号数据，当判定结果为是时，进行步骤S402，否则，进行步骤S401。
S402：读取当前时隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器。
具体的读取当前时隙中的HS-DSCH符号数据，读取的过程中，根据物理信道解映射的规律，控制读取地址，同时对读取到的数据进行软调节和星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将重排处理后的数据恢复到交织前的比特序列，并存储至第一缓存器中，其中第一缓存器的容量根据一个TTI包含的最大数据量确定，采用单口RAM设计。
S403：判断是否对当前TTI包含的符号数据所有的时隙处理结束，且第二缓存器中的上一TTI包含的数据也处理结束，当判定结果均为是时，进行步骤S404，否则，只要判断中至少一判断为否时，进行步骤S403。
S404：针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器。
S405：判断该TTI包含的数据是否需要进行递增冗余合并处理，当判定结果为是时，进行步骤S406，否则，进行步骤S408。
S406：从所述第二缓存器中读取该TTI对应的进程的数据，并与当前从第一缓存器中读取的数据进行递增冗余合并处理。
S407：将处理后的数据保存至第二缓存器。
S408：读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验。
在本发明实施例中由于该整个的数据接收过程采用两个缓存器进行数据的缓存和接收，从而有效的节省了硬件资源。
图5为本发明实施例提供的基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收装置的结构示意图，所述装置包括：
第一处理单元51，用于读取当前时隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器。
第二处理单元52，用于针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器。
第三处理单元53，用于读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验。
所述第三处理单元53，具体用于采用一个或两个译码器，并根据多次复用的方法，将处理后的数据进行译码。
所述第三处理单元53，具体用于当译码器对译码块译码结束后，对该译码器输出的译码结果进行校验。
所述接收装置还包括：
控制单元54，用于判断该TTI包含的数据是否需要进行递增冗余合并处理；当确定需要进行递增冗余合并处理时，从所述第二缓存器中读取该TTI对应的进程的数据，并与当前从第一缓存器中读取的数据进行递增冗余合并处理，并将处理后的数据保存至第二缓存器。
所述接收装置还包括：
控制单元54，用于判断是否对当前TTI包含的符号数据所有的时隙处理结束，并判断第二缓存器中的上一个TTI包含的数据是否处理结束；当确定第一缓存器对当前TTI包含的符号数据所有的时隙处理结束，且第二缓存器中的上一个TTI包含的数据也处理结束时，进行后续步骤，否则等待，直至第一缓存器对当前TTI包含的符号数据所有的时隙处理结束，且第二缓存器中的上一个TTI包含的数据处理结束。
本发明实施例提供了一种基于HSPA+的HS-DSCH接收方法及装置，该接收方法中通过读取时隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器，针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器，读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验，由于本发明实施例中整个接收过程只需要两个缓存器，从而有效地节省了硬件资源。
上述说明示出并描述了本发明的优选实施例，但如前所述，应当理解本发明并非局限于本文所披露的形式，不应看作是对其他实施例的排除，而可用于各种其他组合、修改和环境，并能够在本文所述发明构想范围内，通过上述教导或相关领域的技术或知识进行改动。而本领域人员所进行的改动和变化不脱离本发明的精神和范围，则都应在本发明所附权利要求的保护范围内。
Claims (12)
1.一种基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收方法，应用在基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收装置中，其特征在于，该接收方法包括如下步骤：
读取当前时隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器；
针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器；
读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验。
2.如权利要求1所述的方法，其特征在于，所述将匹配后的数据进行译码包括：
采用一个或两个译码器，并根据多次复用的方法，将匹配后的数据进行译码。
3.如权利要求2所述的方法，其特征在于，将匹配后的数据进行校验包括：
当译码器对译码块译码结束后，对该译码器输出的译码结果进行校验。
4.如权利要求1所述的方法，其特征在于，所述第一缓存器的容量根据一个TTI包含的最大数据量确定。
5.如权利要求1所述的方法，其特征在于，所述第二缓存器的容量根据接收装置支持的能力等级确定。
6.如权利要求1所述的方法，其特征在于，所述对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器后，所述方法还包括：
判断该TTI包含的数据是否需要进行递增冗余合并处理；
当确定需要进行递增冗余合并处理时，从所述第二缓存器中读取该TTI对应的进程的数据，并与当前从第一缓存器中读取的数据进行递增冗余合并处理，并将处理后的数据保存至第二缓存器。
7.如权利要求1或6所述的方法，其特征在于，所述从所述第一缓存器中读取该TTI包含的数据之前，所述方法还包括：
判断当前TTI包含的符号数据所有的时隙是否处理结束，并判断第二缓存器中的上一个TTI包含的数据是否处理结束；
当确定第一缓存器对当前TTI包含的符号数据所有的时隙处理结束，且第二缓存器中的上一个TTI包含的数据也处理结束时，进行后续步骤，否则等待，直至第一缓存器对当前TTI包含的符号数据所有的时隙处理结束，且第二缓存器中的上一个TTI包含的数据处理结束。
8.一种基于增强型高速分组接入HSPA+的高速下行共享信道HS-DSCH接收装置，其特征在于，所述接收装置包括：
第一处理单元，用于读取当前时隙中待解码HS-DSCH符号数据，对读取的符号数据进行软解调及星座图解重排处理，并根据解重排处理后的数据的解交织的规律，将该数据恢复到交织前的比特序列，并存储至第一缓存器；
第二处理单元，用于针对每个传输时间间隔TTI包含的数据，根据混合自动重传请求逆处理的HARQ解合并以及HARQ解第二级速率匹配的规律，从所述第一缓存器中读取该TTI包含的数据，并对读取的数据进行比特解扰、HARQ解第二级速率匹配及解HARQ合并，并保存至第二缓存器；
第三处理单元，用于读取所述第二缓存器中的数据并进行HARQ解第一级速率匹配，并将处理后的数据进行译码校验。
9.如权利要求8所述的接收装置，其特征在于，所述第三处理单元，具体用于采用一个或两个译码器，并根据多次复用的方法，将处理后的数据进行译码。
10.如权利要求9所述的接收装置，其特征在于，所述第三处理单元，具体用于当译码器对译码块译码结束后，对该译码器输出的译码结果进行校验。
11.如权利要求8所述的接收装置，其特征在于，所述接收装置还包括：
控制单元，用于判断该TTI包含的数据是否需要进行递增冗余合并处理；当确定需要进行递增冗余合并处理时，从所述第二缓存器中读取该TTI对应的进程的数据，并与当前从第一缓存器中读取的数据进行递增冗余合并处理，并将处理后的数据保存至第二缓存器。
12.如权利要求8所述的接收装置，其特征在于，所述接收装置还包括：
控制单元，用于判断当前TTI包含的符号数据所有的时隙是否处理结束，并判断第二缓存器中的上一个TTI包含的数据是否处理结束；当确定第一缓存器对当前TTI包含的符号数据所有的时隙处理结束且第二缓存器中的上一个TTI包含的数据也处理结束时，进行后续步骤，否则，当第一缓存器对当前TTI包含的符号数据所有的时隙处理尚未结束时，等待至该TTI包含的符号数据所有的时隙处理结束；当第一缓存器对当前TTI包含的符号数据所有的时隙处理结束，但第二缓存器中的上一个TTI包含的数据处理尚未结束时，等待至第二缓存器中的上一个TTI包含的数据处理结束。
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| C06 | Publication | ||
| PB01 | Publication | ||
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| SE01 | Entry into force of request for substantive examination | ||
| C41 | Transfer of patent application or patent right or utility model | ||
| TA01 | Transfer of patent application right |
Effective date of registration: 20151030 Address after: Dameisha Yantian District of Shenzhen City, Guangdong province 518085 Building No. 1 Applicant after: SHENZHEN ZTE MICROELECTRONICS TECHNOLOGY CO., LTD. Address before: 518057 Nanshan District Guangdong high tech Industrial Park, South Road, science and technology, ZTE building, Ministry of Justice Applicant before: ZTE Corporation |
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| C14 | Grant of patent or utility model | ||
| GR01 | Patent grant | ||
| EE01 | Entry into force of recordation of patent licensing contract | ||
| EE01 | Entry into force of recordation of patent licensing contract |
Application publication date: 20121121 Assignee: Xi'an Chris Semiconductor Technology Co. Ltd. Assignor: SHENZHEN ZTE MICROELECTRONICS TECHNOLOGY CO., LTD. Contract record no.: 2019440020036 Denomination of invention: HS-DSCH (high-speed downlink shared channel) receiving method and device based on HSPA+ (high speed downlink packet access) Granted publication date: 20160831 License type: Common License Record date: 20190619 |