CN102193607B - 供电电路 - Google Patents

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Abstract

一种供电电路，包括一内存供电电路及一CPU供电电路。所述内存供电电路与一第一电源及一内存插槽均相连，以将所述第一电源的电压转换为所述内存插槽的工作电压。所述CPU供电电路与所述内存供电电路及一CPU均相连，以将所述内存供电电路输出的电压转换为所述CPU的工作电压，从而同时为所述内存插槽及CPU供电。

Description

供电电路
技术领域
本发明涉及一种供电电路。
背景技术
在传统的主板上，由于内存插槽的供电电压是2.5V而CPU的供电电压是1.5V，因此内存插槽的供电电路和CPU的供电电路是分开设计的。如此造成主板制造成本较高。
发明内容
鉴于以上内容，有必要提供一种可同时为内存插槽及CPU供电的供电电路。
一种供电电路，包括：
一内存供电电路，包括一第一运算放大器及一第一分压元件，所述第一运算放大器的同相输入端通过一第一电阻与一第一电源相连，还通过一第二电阻接地，所述第一运算放大器的反相输入端通过一第一电容接地，所述第一运算放大器的输出端通过一第三电阻与所述第一电容相连，所述第一分压元件的第一端与所述第一电源相连，第二端与所述第一运算放大器的输出端相连，第三端连接于所述第三电阻与第一电容之间的第一节点，所述第一节点用于与一内存插槽的电源引脚相连；及
一CPU供电电路，包括一第二运算放大器及一第二分压元件，所述第二运算放大器的同相输入端通过一第四电阻与所述第一电源相连，还通过一第五电阻接地，所述第二运算放大器的反相输入端通过一第二电容接地，所述第二运算放大器的输出端通过一第六电阻与第二电容相连，所述第二分压元件的第一端与所述第一节点相连，第二端与所述第二运算放大器的输出端相连，第三端连接于所述第六电阻与第二电容之间的第二节点，所述第二节点用于与一CPU的电源引脚相连。
上述供电电路通过所述内存供电电路给所述内存插槽供电，所述CPU供电电路给所述CPU供电，从而同时为所述内存插槽及CPU供电，使得主板的制造成本降低。
附图说明
图1是本发明供电电路的较佳实施方式的电路图。
主要元件符号说明
第一运算放大器          U1
第二运算放大器          U2
第一场效应管            Q1
第二场效应管            Q2
电阻                    R1～R6
电容                    C1～C5
第一电源                Vcc1
第二电源                Vcc2
节点                    A、B
具体实施方式
下面结合附图及较佳实施方式对本发明作进一步详细描述：
请参考图1，本发明供电电路包括一内存供电电路100及一CPU供电电路200。
所述内存供电电路100包括一第一运算放大器U1、一第一分压元件、电阻R1～R3，以及电容C1～C3。本实施方式中，所述第一分压元件为一第一场效应管Q1。
所述第一运算放大器U1的同相输入端通过所述电阻R1与一电压为3.3V的第一电源Vcc1相连，还分别通过所述电阻R2及电容C1接地。所述第一运算放大器U1的反相输入端通过所述电容C2接地。所述第一运算放大器U1的输出端通过所述电阻R3与电容C2相连。所述第一运算放大器U1的电源端与一第二电源Vcc2相连，接地端接地。
所述第一场效应管Q1的漏极与所述第一电源Vcc1相连并通过所述电容C3接地，栅极与所述第一运算放大器U1的输出端相连，源极连接于所述电阻R3与电容C2之间的节点A。所述电阻R3与电容C2之间的节点A用于与一内存插槽的电源引脚相连。
所述第一运算放大器U1与所述电阻R3组成一电压负反馈电路，使得所述第一运算放大器U1的输出端的电压V-out1等于其正相输入端输入的电压值，即V-out1＝Vcc1×R2/(R1+R2)。选择具有一定阻值的电阻R1、R2，使得所述第一运算放大器U1的输出端输出一高电平，该高电平使得所述第一场效应管Q1导通。
当所述供电电路工作时，所述第一电源Vcc1的电压为3.3V，根据场效应管的工作特性可知此时所述第一场效应管Q1工作于可变电阻区，即所述第一场效应管Q1相当于一可变电阻，根据工作于可变电阻区的场效应管的电阻与电压关系可知，此时第一场效应管Q1的压降为0.8V。即此时所述节点A的电压为2.5V，所述内存供电电路100即为所述内存插槽提供工作电压。
所述CPU供电电路200包括一第二运算放大器U2、一第二分压元件、电阻R4～R6，及电容C4～C5。本实施方式中，所述第二分压元件为一第二场效应管Q2。
所述第二运算放大器U2的同相输入端通过所述电阻R4与所述第一电源Vcc1相连，还分别通过所述电阻R5及电容C4接地。所述第二运算放大器U2的反相输入端通过所述电容C5接地。所述第二运算放大器U2的输出端通过所述电阻R6与所述电容C5相连。所述第二运算放大器U2的电源端与所述第二电源Vcc2相连，接地端接地。
所述第二场效应管Q2的漏极与所述节点A相连，栅极与所述第二运算放大器U2的输出端相连，源极连接于所述电阻R6及电容C5之间的节点B。所述电阻R6及电容C5之间的节点B用于与一CPU的电源引脚相连。
所述第二运算放大器U2与所述电阻R6组成一电压负反馈电路，使得所述第二运算放大器U2的输出端的电压V-out2等于其正相输入端输入的电压值，即V-out2＝Vcc1×R5/(R4+R5)。选择具有一定阻值的电阻R4、R5，使得所述第二运算放大器U2的输出端输出一高电平，该高电平使得所述第二场效应管Q2导通。
由于所述第二场效应管Q2的漏极与所述节点A相连，因此所述第二场效应管Q2的漏极电压为2.5V。根据场效应管的工作特性可知此所述第二场效应管Q2工作于可变电阻区，即所述第二场效应管Q2也相当于一可变电阻，根据工作于可变电阻区的场效应管的电阻与电压关系可知，此时第二场效应管Q2的压降为1V。此时所述节点B的电压为1.5V，所述CPU供电电路200即为所述CPU提供工作电压。

Claims (6)

1.一种供电电路，包括：
一内存供电电路，包括一第一运算放大器及一第一分压元件，所述第一运算放大器的同相输入端通过一第一电阻与一第一电源相连，还通过一第二电阻接地，所述第一运算放大器的反相输入端通过一第一电容接地，所述第一运算放大器的输出端通过一第三电阻与所述第一电容相连，所述第一分压元件的第一端与所述第一电源相连，第二端与所述第一运算放大器的输出端相连，第三端连接于所述第三电阻与第一电容之间的第一节点，所述第一节点用于与一内存插槽的电源引脚相连；及
一CPU供电电路，包括一第二运算放大器及一第二分压元件，所述第二运算放大器的同相输入端通过一第四电阻与所述第一电源相连，还通过一第五电阻接地，所述第二运算放大器的反相输入端通过一第二电容接地，所述第二运算放大器的输出端通过一第六电阻与第二电容相连，所述第二分压元件的第一端与所述第一节点相连，第二端与所述第二运算放大器的输出端相连，第三端连接于所述第六电阻与第二电容之间的第二节点，所述第二节点用于与一CPU的电源引脚相连。
2.如权利要求1所述的供电电路，其特征在于：所述第一分压元件为一场效应管。
3.如权利要求1或2所述的供电电路，其特征在于：所述第二分压元件为一场效应管。
4.如权利要求1或2所述的供电电路，其特征在于：所述内存供电电路还包括一第三电容，所述第一运算放大器的同相输入端还通过所述第三电容接地。
5.如权利要求1或2所述的供电电路，其特征在于：所述内存供电电路还包括一第三电容，所述第一分压元件的第一端通过所述第三电容接地。
6.如权利要求1或2所述的供电电路，其特征在于：所述CPU供电电路还包括一第三电容，所述第二运算放大器的同相输入端还通过所述第三电容接地。
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