CN101840908A - 大输入电压范围零漏电流的输入上拉电路 - Google Patents
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Abstract
大输入电压范围零漏电流的输入上拉电路,属于微电子领域。现有技术存在漏电流、阻值不易控制等问题,本发明的开关MOS管的电流输出极通过一可控阻值元件与芯片的信号输入电平相连,开关MOS管的栅极为上拉信号输入端,开关MOS管的电流输入极通过一反向截至电路与芯片的最高输入电位相连,当芯片的信号输入电平高于最高输入电位时,该反向截至电路截止。采用动态改变上拉MOS管衬底偏置,并加设二极管的方法,来实现上拉,同时避免在输入电平高于芯片最高电压时的漏电流。
Description
技术领域
本项发明属于微电子领域,具体是一种具有大输入电压范围的零漏电流输入上拉电路。
背景技术
一些芯片的管脚在悬空时必须保持在高电位,才能保证芯片内部电路正常工作,这一目的通常是采用一个专门的输入上拉电路来实现。
现有的输入上拉电路如图1所示,MOS管的源漏极分别接输入信号和芯片最高输入电位VDDPST,MOS管的衬底与源极相连。当芯片管脚悬空即无输入信号时,MOS管导通,使管脚保持在高电位。当管脚上有输入信号时,MOS的栅极接芯片最高电位以关断上拉电路,使管脚接收输入信号电平。
这种结构的上拉电路中,当输入信号的电平高于芯片的最高电位时,通过上拉电路的漏电就会发生。即使采用像PMOS管这样的开关来关断上拉电阻,由于在输入信号的电平高于供电最高点位时,PMOS管的源漏的极性反向,衬底的电位比源端更低,这样同样会从源端到衬底的漏电也不可避免。
为了解决输入信号过大情况下的漏电问题,US-5117274的美国专利提出了采用NMOS管作为上拉管来解决输入信号更高时的漏电流的问题;然而这种方法的问题是NMOS的阈值电压限制了上拉的最高电压和速度。同时上拉电阻的阻值不好控制。
而US-5150186的美国专利(图2)采用NativeNMOS管的方法来解决上拉NMOS管的阈值问题,用PMOS管并串联一个NativeNMOS管来实现上拉和输入高电压时的零漏电。然而这种方法不能完全解决这个问题,因为NativeNMOS管的阈值虽然较小,但是也不是为0。同时这种方法带来了同样的阻值不易控制,速度受限等问题。
发明内容
为了解决现有技术中存在的问题,本发明提供一种大输入电压范围零漏电流的输入上拉电路,采用动态改变上拉MOS管衬底偏置,并加设二极管的方法,来实现上拉,同时避免在输入电平高于芯片最高电压时的漏电流。
为此,本发明采用以下技术方案:大输入电压范围零漏电流的输入上拉电路,包括一开关MOS管,其特征在于:所述的开关MOS管的电流输出极通过一可控阻值元件与芯片的信号输入电平相连,开关MOS管的栅极为上拉信号输入端,开关MOS管的电流输入极通过一反向截至电路与芯片的最高输入电位相连,当芯片的信号输入电平高于最高输入电位时,该反向截至电路截止,所述的反向截至电路包括:
反向截止MOS管,其电流输入端与芯片的最高输入电位相连,其电流输出端与开关MOS管的电流输入端相连,其栅极与电流输入端相连,其衬底与开关MOS管的衬底相连;
第一防漏电二极管,其两端分别与反向截止MOS管的电流输入端和衬底相连,自电流输入端至衬底方向单向导通。
可控阻值元件能保证上拉电路在上拉状态时,有一个比较固定的阻值。当输入信号电平比芯片的最高输入电位更高时,由于两个MOS管的衬底都通过反向截止的防漏电二极管连接到电路,所以不会发生漏电流。
作为对上述技术方案的完善和补充,本发明进一步采取如下技术措施或是这些措施的任意组合:
所述反向截止MOS管的衬底与电流输出端通过一第二防漏电二极管相连,自电流输出端至衬底方向单向导通。这样,无论反向截止MOS管的源极和漏极的电位哪个高,都不会出现衬底与源漏极之间的漏电流。
所述的开关MOS管和反向截止MOS管为PMOS管,其源极为电流输入端,其漏极为电流输出端。
所述的开关MOS管和反向截止MOS管为NMOS管,其漏极为电流输入端,其源极为电流输出端。
所述的开关MOS管和反向截止MOS管为耗尽型MOS管。上拉时,MOS管完全导通,上拉电压与最高输入电位相同,上拉动作也不存在因阈值而带来的延迟。
所述的可控阻值元件为电阻。
有益效果:本发明电路解决了输入信号电位较高时产生的漏电流问题;电路在上拉状态时,其上拉电阻可以由可控的电阻来决定,便于控制;上拉时,MOS管处于完全导通状态,可以充分的上拉而与工艺温度等无关。
附图说明
图1为现有的输入上拉电路示意图;
图2为现有的用PMOS管并串联一个NativeNMOS管来实现上拉的电路示意图;
图3为本发明的输入上拉电路示意图;
具体实施方式
如图3所示的大输入电压范围零漏电流的输入上拉电路,开关MOS管M2的和反向截止MOS管M1选用耗尽型的PMOS管,M2的漏极通过电阻R与芯片输入信号Vin相连,M2的源极、M1的漏极和M1的栅极相连。
M1的衬底电极通过两个二极管(第一防漏电二极管D1和第二防漏电二极管分D2)分别连接M1的源极和漏极。M1的作用是起到一个反向截至的功能,这样,可以保证M1在当作二极管应用时,无论源和漏的点位哪个高,其功能都是正常的,而且没有漏电。M2的衬底电极也是接在M1的衬底上,这样也保证M2在各个情况下没有衬底漏电流。
M1的漏极连接芯片的最高输入电位VDDPST。
M2的栅极接上拉信号PULL_UP。
在没有输入信号的情况下,M1、M2完全导通,上拉电路的阻值就为电阻R的阻值,易于控制。
有输入信号时,M2关断,芯片的相应管教接收输入信号。
产生本方案的M2栅极所接上拉信号的电路可参照US-5600271美国专利的内容,也可由技术人员根据领域常识自己设计。
本方案所采用的MOS管的类型(PMOS或NMOS)及参数等,可根据前文所述内容结合公知常识变换,在能实现发明目的的前提下自由选取。
应当指出,本实施例仅列示性说明本发明的原理及功效,而非用于限制本发明。任何熟悉此项技术的人员均可在不违背本发明的精神及范围下,对上述实施例进行修改。因此,本发明的权利保护范围,应如权利要求书所列。
Claims (6)
1.大输入电压范围零漏电流的输入上拉电路,包括一开关MOS管,其特征在于:所述的开关MOS管的电流输出极通过一可控阻值元件与芯片的信号输入电平相连,开关MOS管的栅极为上拉信号输入端,开关MOS管的电流输入极通过一反向截至电路与芯片的最高输入电位相连,当芯片的信号输入电平高于最高输入电位时,该反向截至电路截止,所述的反向截至电路包括:
反向截止MOS管,其电流输入端与芯片的最高输入电位相连,其电流输出端与开关MOS管的电流输入端相连,其栅极与电流输入端相连,其衬底与开关MOS管的衬底相连;
第一防漏电二极管,其两端分别与反向截止MOS管的电流输入端和衬底相连,自电流输入端至衬底方向单向导通。
2.根据权利要求1所述的大输入电压范围零漏电流的输入上拉电路,其特征在于:所述反向截止MOS管的衬底与电流输出端通过一第二防漏电二极管相连,自电流输出端至衬底方向单向导通。
3.根据权利要求2所述的大输入电压范围零漏电流的输入上拉电路,其特征在于:所述的开关MOS管和反向截止MOS管为PMOS管,其源极为电流输入端,其漏极为电流输出端。
4.根据权利要求2所述的大输入电压范围零漏电流的输入上拉电路,其特征在于:所述的开关MOS管和反向截止MOS管为NMOS管,其漏极为电流输入端,其源极为电流输出端。
5.根据权利要求2所述的大输入电压范围零漏电流的输入上拉电路,其特征在于:所述的开关MOS管和反向截止MOS管为耗尽型MOS管。
6.根据权利要求1至5任一项所述的大输入电压范围零漏电流的输入上拉电路,其特征在于:所述的可控阻值元件为电阻。
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