CN101251691A - 液晶显示器和具有集成数据存储器的显示面板 - Google Patents

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CN101251691A CNA2007101612753A CN200710161275A CN101251691A CN 101251691 A CN101251691 A CN 101251691A CN A2007101612753 A CNA2007101612753 A CN A2007101612753A CN 200710161275 A CN200710161275 A CN 200710161275A CN 101251691 A CN101251691 A CN 101251691A
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Abstract

一种液晶显示器包括具有数据存储单元的显示面板，该数据存储单元包括集成在所述显示面板中的晶体管。该数据存储单元的数据存储晶体管可以形成在与显示面板上的TFT像素晶体管相同的薄膜(层)中。所述数据存储单元的多个晶体管的每一个包括根据存储的数据的位而连接到第一电压或第二电压之一的输入电极、和公共连接到数据存储单元的数据输出端的输出电极。数据存储单元还包括串入并出移位寄存器，该移位寄存器被提供有复位以及第一和第二时钟信号，并且分别被连接到所述晶体管的输入电极。

Description

液晶显示器和具有集成数据存储器的显示面板
技术领域
本发明涉及液晶显示器，更具体地讲，涉及一种具有集成数据存储单元的显示面板。
背景技术
典型的液晶显示器(LCD)包括具有像素电极(隶属具体像素)和公共电极(所有像素公用)的两个相对的面板，以及插入其间的具有介电各向异性(dielectric anisotropy)的液晶层。像素电极被排列在矩阵中，并连接到诸如薄膜晶体管(TFT)的开关器件。数据电压被顺序地逐行施加到像素。公共电极被设置在一个面板的整个表面上，并向矩阵中的所有像素施加公共电压。所述像素电极、公共电极以及插入其间的液晶层组成了液晶电容器。液晶电容器与连接到液晶电容器的开关元件(例如，TFT)一起成为了像素的单元。在LCD中，电压被施加到连接每个像素的两个电极，以便生成穿过(across)液晶层的电场，并且该电场的强度受到控制，以便控制通过液晶层的光的透射率，由此获得所期望的图像。在这种情况下，为了防止退化，所生成的电场被长时间交替地、以一个方向施加到液晶层然后以相反方向施加。相对于公共电压，数据电压的极性按帧、按行、或按像素被反转(invert)。
小尺寸的LCD显示设备被典型地用于移动电话等，并且具有外侧和内侧显示面板的双显示设备也正在被积极地开发。
双显示设备包括安装在内侧的主显示单元、安装在外侧的副显示单元、具有从外部设备传输信号的电线(wire)的驱动FPC(flexible printed circuitfilm，柔性印制电路薄膜)、设置在驱动FPC和主显示面板之间的主FPC、设置在主显示面板和副显示面板之间的副FPC、以及控制上述元件的集成芯片。
所述集成芯片为主显示面板和副显示面板生成控制信号和驱动信号，并且典型地通过将芯片固定于玻璃上(chip-on-glass，COG)的技术安装在主显示设备上。由于驱动FPC连接外部设备和LCD，该驱动FPC还被称为接口FPC。
利用诸如只读存储器(ROM)的数据存储元件将关于制造商、制造年份、或者简单的显示面板信息的数据存储在LCD中。
在作为独立IC(集成电路)被制造之后，数据存储元件通过COG技术像集成芯片一样被安装在主显示单元上。或者，数据存储元件嵌入在集成芯片中。
但是，当数据存储元件被作为IC制造时，LCD的制造成本会增加，并且还需要独立的驱动电压来驱动IC。
此外，当数据存储元件被嵌入集成芯片中时，芯片的尺寸也会增加。
发明内容
本发明的第一方面提供一种制造具有集成数据存储器(data-storage)的液晶显示器的方法。该方法包括：提供第一显示面板，并在第一显示面板上的薄膜中形成多个第一晶体管和多个第二晶体管，其中，所述多个第一晶体管是排列在矩阵中的像素晶体管，而所述多个第二晶体管执行数据存储。数据存储单元的多个第二晶体管包括对应于待存储的N位数据的N个晶体管，其中N是自然数。N个晶体管中的每一个被配置来根据对应的一位数据而将其输入端(电极)连接到第一电压和第二电压之一。N个晶体管中的每一个具有公共地连接到数据存储单元的数据输出端的输出端(电极)。数据存储单元的多个第二晶体管还包括相互连接的晶体管，以便形成串入并出(serial-inparallel-out)移位寄存器，该移位寄存器的输出被连接到所述N个晶体管的输入端。
本发明的另一个方面提供一种液晶显示器，其包括具有多个像素的显示器面板，以及集成在显示器面板中的数据存储单元。数据存储单元包括多个晶体管，每个晶体管具有连接到第一电压或第二电压的输入端和连接到数据输出端的输出端，以及由多个串联的寄存器(触发器)组成的串入并出(Serial-In，Parallel-Out，SIPO)移位寄存器，并且被提供有复位以及第一和第二时钟信号，并分别连接到所述晶体管的输入端。
数据存储单元可以包括接收复位信号的第一引脚(pin)和连接到数据输出端的第二引脚。
第一和第二时钟信号可以基于用在SPI(串行外围接口)中的时钟信号来生成，或者可以基于用在CPUI/F中的写/读信号来生成。
液晶显示器还可以包括栅极驱动器，用于将栅极信号提供给像素，并提供第三和第四时钟信号。第一和第二时钟信号可以基于第三和第四时钟信号来生成。
显示面板可以包括第一显示面板和小于该第一显示面板的第二显示面板，并且数据存储单元可以被集成在第一显示面板中。
第一和第二时钟信号可以具有彼此相反的相位。
根据本发明的另一个实施例，显示面板包括多条栅极线、多条数据线、连接到所述栅极线和数据线的多个像素、以及数据存储单元，其中，该数据存储单元包括多个晶体管，每个晶体管具有连接到第一电压或第二电压的输入端。所述数据存储单元的多个晶体管中的每一个具有连接到数据输出端的输出端，以及由多个寄存器(触发器)组成的移位寄存器，这些移位寄存器被提供有复位信号和至少两个时钟信号并且分别被连接到所述晶体管的输入端。
以下将参考示出本发明的示范实施例的附图更加全面地描述本发明。但是，本发明可以以许多不同的形式来实现，而不应当限制在这里所述的示范实施例。相同的标号总是指代相同元件。应当理解，当诸如层、薄膜、区域、基底、或面板的元件被称为在另一个元件“之上”时，其可以是直接在其它元件上，或者也可以存在插入的元件。相反，当元件被称为“直接”在另一个元件“之上”时，不存在插入的元件。如这里所使用的，术语“和/或”包括一个或多个相关联的列出项目的任意和全部组合。应当理解，虽然术语第一、第二、第三等可以在这里用于描述各种元件、组件、区域、层、和/或部分，但是这些元件、组件、区域、层、和/或部分不应当被这些术语所限制。这些术语指示仅仅被用来区分一个元件、组件、区域、层、或部分与另一个元件、组件、区域、层、或部分。因此，下面所讨论的第一元件、组件、区域、层、或部分也可以被称为第二元件、组件、区域、层、或部分，而不脱离本发明的教导。
这里所使用的术语仅仅是为了描述特定的实施例，而不是为了限定本发明。如这里所用的，单数形式“一”、“该”和“所述”也包括多数形式，除非上下文中清楚地表述了相反的意思。除非另有定义，这里所使用的所有术语(包括技术和科学术语)具有本发明所属领域的普通技术人员所通常理解的含义。还应当理解比如在通常使用的词典中的那些术语应当被解释为具有与它们在相关领域以及本发明的公开的上下文中的含义相一致的含义，而不应当被解释为被理想化的或过于形式化的意义，除非在这里明确地定义为如此。本发明的实施例在这里参考了作为本发明的理想化的实施例的示意例示的横截面例示来描述。同样，作为例如制造技术和/或公差的结果的所例示形状的变化也是可以预期的。因此，本发明的实施例不应当被解释为限定这里所例示的区域的特定形状，而应当包括作为例如制造结果的形状偏差。作为例子，被例示或描述为平坦的区域可以典型地具有粗糙和/或非线性的特征。此外，所例示的锐角可以是圆滑的。因此，在附图中例示的区域本质上是示意性的，它们的形状不是为了例示区域的精确的形状，也不是为了限定本发明的保护范围。
附图说明
为了清楚地理解本发明的优点，将参考附图详细描述本发明的示范实施例，附图中：
图1是根据本发明的示范实施例的LCD的框图；
图2是图1的LCD的像素的等效电路图；
图3A和3B是根据本发明的示范实施例的LCD的示意图；
图4是根据本发明的示范实施例的数据存储单元的框图；以及
图5是被施加到图4的数据存储单元的信号的时序图。
具体实施方式
现在将参考图1、2、3A和3B详细描述根据本发明的示范实施例的LCD。
图1是根据本发明的示范实施例的LCD的框图，图2是图1的LCD的像素的等效电路图，而图3A和3B是根据本发明的示范实施例的LCD的示意图。
参考图1，LCD包括液晶(LC)面板部件(assembly)300、与面板部件300耦合的栅极驱动器400和数据驱动器500、与数据驱动器500耦合的灰度电压生成器800、以及控制上述元件的信号控制器600。
面板部件300包括：多条信号线G1-Gn、D1-Dm和S1-S3，连接到信号线G1-Gn和D1-Dm、并基本上排列在矩阵中的多个像素PX，以及连接到信号线S1和S2的数据存储单元710。像素矩阵被包含在由黑色矩阵定义(限界)的显示区域中。
在图2所示的结构图中，面板部件300包括：彼此面对的下部面板100和上部面板200，以及插入在面板100和200之间的LC层3。信号线包括传输栅极信号(以下也称为“扫描信号”)的多条栅极线G1-Gn以及传输数据电压的多条数据线D1-Dm。信号线还包括：接收复位信号的复位信号输入线S1，输出数据的数据输出线S2，以及将控制信号和数据传输到信号控制器600的多条信号线S3等。栅极线G1-Gn基本上沿行方向延伸，并基本上彼此平行，而数据线D1-Dm基本上沿列方向延伸，并基本上彼此平行。
参考图2，每个像素PX，例如连接到第i条栅极线Gi(i＝1，2，...，n)和第j条数据线Dj(j＝1，2，...，m)的像素PX，包括连接到信号线Gi和Dj的开关元件Q，以及连接到开关元件Q的LC电容器Clc和存储电容器Cst。存储电容器Cst可以被省略。
开关元件Q被设置在下部面板100上，并且具有三个端子，即，连接到栅极线Gi的控制端、连接到数据线Dj的输入端、以及连接到LC电容器Clc和存储电容器Cst的输出端。
LC电容器Clc包括设置在下部面板100上的像素电极191和设置在上部面板200上公共电极270作为两个端子。设置在两个电极191和270之间的LC层3用作LC电容器Clc的电介质。像素电极191连接到开关元件Q。公共电极270被提供有公共电压Vcom，并覆盖上部面板200的整个表面。作为替换，不同于图2所示，公共电极270也可以提供在下部面板100上，并且电极191和270中的至少一个具有条形或带形。
存储电容器Cst是用于LC电容器Clc的辅助电容器。存储电容器Cst包括像素电极191和分离的信号线，该信号线提供在下部面板100上，通过绝缘体相分离地覆盖在像素电极191上，并被提供有诸如公共电压Vcom的预定电压。作为替换，存储电容器Cst包括像素电极191和称为在前(previous)栅极线的相邻栅极线，该栅极线通过绝缘体相分离地覆盖在像素电极191上。
数据存储单元710基于通过复位信号输入线S1传输的复位信号来操作，并且通过数据输出线S2将存储在其中的数字数据输出到外部。在这个示范实施例中，数据存储单元710可以为ROM(只读存储器)。
在彩色显示器中，每个像素唯一地代表三原色之一(即，空间分割)或者每个像素顺序地代表三原色中的每一个(即，时间分割)，使得所述原色的空间或时间总和被识别为期望的颜色。一组原色的例子包括红色、绿色和蓝色。图2示出了空间分割型像素的例子，其中每个像素包括在面向像素电极191的上部面板200的区域中代表原色之一的滤色镜230。作为替换，滤色镜230被提供在下部面板100上的像素电极191的上面或下面。
一个或多个偏光器(未示出)被附到面板部件300。同时，参考图3A和3B，根据这个实施例的LCD包括两个显示面板：主显示面板300M和副显示面板300S。显示面板300M和300S的每一个包括定义显示区域310M和310S的黑色矩阵320M和320S。像素PX被设置在显示区域310M和310S中，并且连接到信号线G1-Gn、D1-Dm(未示出)。在主显示面板300M和副显示面板300S的每一个中，上部面板200小于下部面板100，并且下部面板100的区域被暴露。数据线D1-Dm通过下部面板100的暴露区域延伸，以连接到数据驱动器500(见图1)。
主显示面板300M和副显示面板300S通过辅助FPC 680S彼此连接。主FPC 680M被附到主显示面板300M的底部，并且还被附到驱动FPC 650上。
主FPC 680M包括连接到复位信号输入线S1的复位信号输入电线L1、连接到数据输出线S2的数据输出电线L2、以及连接到信号线S3的多条信号线电线L3。
形成在主FPC 680M上的电线L1-L3分别通过触点C1、C2和C3连接到复位信号输入线S1、数据输出线S2、以及信号线S3。复位信号输入线S1、数据输出线S2和信号线S3的末端，以及复位信号输入电线L1、数据输出电线L2和信号线电线L3的末端分别具有焊盘(pad)，而所述触点C1-C3通过连接所述焊盘形成。
在图3B中，驱动FPC 650被称为接口FPC，并且包括传输信号的电线(未示出)和在电线末端上的焊盘(未示出)。如上所述，主FPC 680M和副FPC 680S接触驱动FPC 650的焊盘，并且显示面板300M和300S的每一个都具有焊盘。驱动FPC 650包括开口(opening)690，在装配期间将副显示面板300S放在其上。
驱动FPC 650的焊盘、主FPC 680M和副FPC 680S的焊盘、以及显示面板300M和300S的每一个的焊盘通过ACF(各向异性导电薄膜)或通过焊接彼此电连接。
再次参考图1，灰度电压生成器800生成与像素PX的透射率相关的全部数量(full number of)的灰度电压或限制数量的灰度电压(以下称为“参考灰度电压”)。一半(参考)灰度电压具有相对于公共电压Vcom的正极性，而另一半(参考)灰度电压具有相对于公共电压Vcom的负极性。
栅极驱动器400是包括级联排列的多级(未示出)的移位寄存器，并且每一级连接到栅极线G1-Gn的一部分。栅极驱动器400接收扫描开始信号STV、多个时钟信号、以及gate-off电压Voff，并且合成gate-on电压Von和gate-off电压Voff以生成用于施加到栅极线G1-Gn的栅极信号。
数据驱动器500被连接到面板部件300的数据线D1-Dm并且提供数据电压到数据线D1-Dm，所述数据电压是在从灰度电压生成器800提供的灰度电压中选择的。作为替换，灰度电压生成器800只生成少量参考灰度电压，而不是全部灰度电压，而数据驱动器500可以划分参考灰度电压以便从被提供的参考灰度电压中生成数据电压。
信号控制器600控制栅极驱动器400、数据驱动器500等。
如图3A所示，信号控制器600、栅极驱动器400、数据驱动器500、以及灰度电压生成器800被实施为通过COG技术安装在主显示面板300M上的集成芯片700。
集成芯片700通过输入部分660(图3B)接收外部信号，并且将处理后的信号通过在驱动FPC 650上所形成的电线提供给主显示面板300M和副显示面板300S。
现在将详细描述上述LCD的操作。
信号控制器600被从外部图形控制器(未示出)提供有输入图像信号R、G和B，以及用于控制器显示的输入控制信号。输入图像信号R、G和B含有像素PX的亮度信息，并且所述亮度具有预定数量的灰度，例如1024(＝210)、256(＝28)、或64(＝26)灰度。输入控制信号包括垂直同步信号Vsync、水平同步信号Hsync、主时钟信号MCLK、以及数据使能信号DE。
基于输入控制信号和输入图像信号R、G和B，信号控制器600生成栅极控制信号CONT1和数据控制信号CONT2，并将图像信号R、G和B处理为适于面板部件300和数据驱动器500的操作。信号控制器600将栅极控制信号CONT1发送到栅极驱动器400，并且将处理后的图像信号DAT和数据控制信号CONT2发送到数据驱动器500。
栅极控制信号CONT1包括用于指示栅极驱动器400开始扫描的扫描开始信号STV，以及用于控制gate-on电压Von的输出周期的至少一个时钟信号。栅极控制信号CONT1可以包括用于定义gate-on电压Von的持续时间的输出使能信号OE。
数据控制信号CONT2包括用于启动用于像素PX行的数据传输的开始的水平同步开始信号STH、用于将数据电压施加到数据线D1-Dm的负载信号LOAD、以及数据时钟信号HCLK。数据控制信号CONT2还可以包括用于反相(inversing)数据电压的极性(相对于公共电压Vcom)的反相信号(inversionsignal)RVS。
响应于来自信号控制器600的数据控制信号CONT2，数据驱动器500从信号控制器600接收用于像素PX行的数字图像信号DAT的分组，将数字图像信号DAT转换为从灰度电压中选择的模拟数据电压，并将模拟数据电压施加到数据线D1-Dm。
栅极驱动器400响应于来自信号控制器600的栅极控制信号CONT1将gate-on电压Von施加到栅极线G1-Gn，由此将连接到栅极驱动器400的开关晶体管Q导通。然后，施加到数据线D1-Dm的数据电压通过激活的(ON)开关晶体管Q被提供到像素PX。
施加到像素PX的数据电压和公共电压Vcom之间的差被表示为像素PX的LC电容器Clc上的电压，该电压被称为像素电压。LC电容器Clc中的LC分子(molecule)呈现(assume)由像素电压的幅度控制的方向，而分子方向(molecular orientation)确定了穿过LC层3的光的极化。偏光器将光的极化转换为光透射率，使得像素PX具有由数据电压指示的灰度级所代表的亮度。
通过在每个单元的水平周期(也称为“1H”，并且等于水平同步信号Hsync和数据使能信号DE的一个周期)重复这个过程，全部栅极线G1-Gn被顺序地施加gate-on电压Von，由此将数据电压施加到全部像素PX以便显示一帧的图像。
当在一帧结束之后开始另一帧时，控制施加到数据驱动器500的反相信号RVS，以便使数据电压的极性反相(被称为“帧反相”)。反相信号RVS还可以被控制为，使流过数据线的数据电压的极性在一帧期间周期性地反相(例如，行反相和点反相)，或者反相一个分组中的数据电压的极性(例如，列反相和点反相)。
存储在数据存储单元710中的数据被所连接的设备(未示出)读取。
参考图4和图5，现在详细描述这个实施例的数据存储单元710。
图4是根据本发明的示范实施例的数据存储单元的框图，而图5是施加到图4所示的数据存储单元的信号的时序图。
参考图4，数据存储单元710包括多个晶体管Tr和多个寄存器SR，它们排列并彼此连接以形成串入并出(Serial-In，Parallel-Out，SIPO)移位寄存器，每个寄存器SR具有连接到相应的一个晶体管Tr的输出端。
晶体管Tr是诸如TFT(薄膜晶体管)的三端元件，具有连接到相应寄存器SR的输出端的控制端(晶体管栅极)、根据一位存储的数据连接到第一电压VCC或第二电压VSS的输入端、以及连接到数据输出端RDO的输出端。晶体管Tr的输入端与电压VCC或VSS之间的连接的顺序定义了数据存储单元710中的存储的数据。换句话说，存储的数据被编码(硬连线)为晶体管Tr的输入端与电压VCC或VSS之间的连接。第一电压VCC的幅度大于第二电压VSS的幅度，第一电压VCC是高电平电压，并且对应于逻辑值“1”，而第二电压VSS是低电平电压，并且对应于逻辑值“0”。
第一电压VCC和第二电压VSS可以是在集成芯片700中所使用的电压，而不从外部施加独立的电压。
每一个寄存器SR包括时钟端CK、输入端IN、以及(非反相)输出端Q1和Q2。除了第一个和最后一个寄存器SR，剩余寄存器SR的连接是相同的。因此，在中间的寄存器SR中，输入端IN分别连接到前一个寄存器SR的输出端Q2，时钟端CK分别连接到第一时钟信号RCK和第二时钟信号RCKB中的一个，而输出端Q1分别连接到相应的晶体管Tr的输入端。如图4所示，奇数寄存器SR的时钟端CK连接到第一时钟信号RCK，而偶数寄存器SR的时钟端CK连接到第二时钟信号RCKB，不过，可以在各种替代实施例中对这点进行修改。
但是，第一寄存器SR的输入端IN连接到复位信号RST，最后一个寄存器SR的输出端Q2不被连接。除了第一和最后一个寄存器SR的上述连接，第一和最后一个寄存器SR的CK、Q1和Q2端的连接与中间寄存器SR的相同。
晶体管Tr和寄存器SR可以与TFT开关元件Q一起集成在LC面板部件300中(例如，在相同薄膜层上)。
参考图4，第一时钟信号RCK和第二时钟信号RCKB中的每一个具有高电平电压h1和低电平电压11，并且高电平电压h1和低电平电压11的相位彼此相反。复位信号RST还具有高电平电压h2和低电平电压12。
当LCD使用SPI(串行外围接口)时，第一时钟信号RCK和第二时钟信号RCKB可以基于施加到SPI的时钟信号来生成。串行外围接口总线或SPI总线是由Motorola，Inc.设计的、在全双工模式下操作的同步串行数据链接标准。在主/从模式下通信的设备中主设备启动数据帧。作为替换，当LCD使用CPUI/F(中央处理器接口)时，第一时钟信号RCK和第二时钟信号RCKB可以基于写/读(W/R)信号生成。
此外，第一时钟信号RCK和第二时钟信号RCKB可以使用施加到栅极驱动器400用于生成栅极信号的时钟信号来生成。结果，由于用在数据存储单元710中的第一时钟信号RCK和第二时钟信号RCKB可以使用LCD的内部信号来生成，而不需要从外部施加独立的信号，数据存储单元710通过复位信号输入线S1接收复位信号RST，并且通过连接到数据输出端RDO的数据输出线S2输出数据。因此，数据存储单元710只需要两个引脚，一个用于复位信号输入线S1，另一个用于数据输出线S2。
现在将描述上述数据存储单元710的操作。
如图5所示，当高电平电压h2的复位信号RST被施加到第一寄存器SR的输入端IN时，第一寄存器SR操作。因此，当第一时钟信号RCK的电平为高电平电压h1时，第一寄存器SR分别通过输出端Q1和Q2将高电平电压输出到相应的晶体管Tr和下一个(例如，第二)寄存器SR的输入端IN。输出到输出端Q1和Q2的高电平电压的持续时间基本上与时钟信号RCK和RCKB的脉宽相同。
因此，第一晶体管Tr被导通，并且被施加到第一晶体管Tr的输入端的相应的电压(例如，第一电压VCC)被传输到数据输出端RDO以输出逻辑值(例如，“1”)。
如上所述，来自第一寄存器SR的输出端Q2的高电平电压被施加到下一级的第二寄存器SR的输入端IN，并用作进位信号。
与该进位信号同步，第二寄存器SR操作以便在第二时钟信号RCKB输出高电平电压h1的期间输出高电平电压到输出端Q1和Q2，由此相应的第二晶体管Tr被导通。通过导通第二晶体管Tr，相应的电压(例如，第二电压VSS)被传输到数据输出端RDO以便输出逻辑值(例如，“0”)。
多个寄存器SR(第一寄存器SR到最后一个寄存器SR)被顺序地激活(即，顺序地输出逻辑高“1”电压)，由此相应的晶体管Tr被顺序地导通。施加到每个导通的晶体管Tr的输入端的第一电压VCC或第二电压VSS被顺序地输出到数据输出端RDO。
在图4中，输出到数据输出端RDO的数据为“1011...01”，因此“1011...01”是存储在数据存储单元710中的数据。
此时，为了防止数据由于下一个相邻寄存器SR的操作重叠而被不正确地输出到数据输出端RDO，数据存储单元710只可以在与数据使能信号DE同步时输出数据。
根据本发明的示范实施例，当关于制造商、制造日期的数据或者关于显示面板的信息被存储在LCD中时，数据存储单元被集成在LC面板部件中(例如，在与TFT相同的层上)。由于驱动数据存储单元所需的时钟信号是基于已经提供并用在LCD面板中的信号来生成的，从而减少了用于输入/输出信号的引脚数量。
由于不需要制造或在LC面板部件中安装或在集成芯片中建立分离的数据存储单元，制造成本降低，而集成芯片的尺寸没有增加。
虽然已经结合所展示的被认为是最实用的示范实施例对本发明进行了描述，但是应当理解本发明并不限于所公开的实施例，而是相反地意欲覆盖包括在所附权利要求书的精神和范围内的各种修改和等效配置。

Claims (18)

1.一种液晶显示器，包括：
第一显示面板，其具有多个像素；以及
数据存储单元，其被集成在所述第一显示面板中并存储数据，其中，所述数据存储单元包括多个晶体管，每个晶体管被配置为根据所述数据的相应位将其输入电极连接到第一电压和第二电压中的一个，并且
其输出电极被连接到公共数据输出端。
2.如权利要求1所述的液晶显示器，其中，所述数据存储单元还包括移位寄存器，该移位寄存器被提供有复位信号以及第一和第二时钟信号，并且分别被连接到所述晶体管的栅极电极。
3.如权利要求2所述的液晶显示器，其中，所述第一和第二时钟信号是基于用在SPI(串行外围接口)中的时钟信号来生成的。
4.如权利要求2所述的液晶显示器，其中，所述第一和第二时钟信号是基于用在CPUI/F中的写/读信号来生成的。
5.如权利要求2所述的液晶显示器，还包括栅极驱动器，该栅极驱动器被配置为将栅极信号施加到所述像素，并被提供有第三和第四时钟信号，并且所述第一和第二时钟信号是基于所述第三和第四时钟信号来生成的。
6.如权利要求2所述的液晶显示器，其中，所述第一和第二时钟信号具有彼此相反的相位。
7.如权利要求1所述的液晶显示器，还包括小于所述第一显示面板的第二显示面板。
8.如权利要求1所述的液晶显示器，其中，所述数据存储单元包括：被配置为接收所述复位信号的第一引脚，以及被连接到所述数据输出端的第二引脚。
9.如权利要求1所述的液晶显示器，其中，每个像素包括薄膜晶体管，并且多个TFT被形成在所述第一显示面板上的薄膜层中；以及
其中所述数据存储单元的多个晶体管被形成在所述第一显示面板上的相同薄膜层上。
10.一种显示面板，包括：
多条栅极线；
多条数据线；
多个像素，其被连接到所述栅极线和数据线；以及
数据存储单元，其被配置来存储数据，
其中，每个像素包括薄膜晶体管(TFT)，并且多个TFT被形成在第一显示面板上的薄膜层中；并且所述数据存储单元包括形成在所述第一显示面板上的相同薄膜层上的多个晶体管，每个晶体管具有根据所述数据连接到第一电压和第二电压之一的输入电极。
11.如权利要求10所述的显示面板，其中，所述数据存储单元还包括移位寄存器，其被连接到所述数据存储单元的多个晶体管的输入电极。
12.如权利要求11所述的显示面板，其中，所述移位寄存器被提供有复位信号和两个互补的时钟信号。
13.如权利要求10所述的显示面板，其中，所述数据存储单元的多个晶体管的每一个具有输出电极，该输出电极被公共连接到所述数据存储单元的数据输出端。
14.一种制作包括数据存储单元的液晶显示器的方法，该方法包括：
提供第一显示面板，
在所述第一显示面板上的薄膜中形成多个第一晶体管和多个第二晶体管，其中，所述多个第一晶体管是排列在矩阵中的像素晶体管，而所述多个第二晶体管包括数据存储单元。
15.如权利要求14所述的方法，其中，所述数据存储单元的多个第二晶体管包括对应于N位待存储的数据的N个晶体管，其中N为自然数。
16.如权利要求15所述的方法，其中，所述N个晶体管中的每一个被配置为根据所述数据的相应的一位将其输入电极连接到第一电压和第二电压之一。
17.如权利要求16所述的方法，其中，所述N个晶体管中的每一个还具有公共连接到所述数据存储单元的数据输出端的输出电极。
18.如权利要求14所述的方法，其中，所述数据存储单元的多个第二晶体管还包括相互连接以形成串入并出移位寄存器的晶体管，所述移位寄存器的输出被连接到N个晶体管的输入电极。
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