BR112019015640A2 - Método de transmissão, e, dispositivo de recepção. - Google Patents

Método de transmissão, e, dispositivo de recepção. Download PDF

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Shinohara Yuji
Yamamoto Makiko
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Abstract

a presente invenção refere-se a um método de transmissão e a um dispositivo de recepção que tornam possível garantir a excelente qualidade de comunicação na transferência de dados usando os códigos ldpc. em intercalação grupo a grupo, um código ldpc que tem um comprimento de código n de 69.120 bits é intercalado em uma base de grupo de bits de 360 bits por grupo. em desintercalação grupo a grupo, a ordem do código ldpc intercalado é restaurada para a ordem original. esta invenção pode ser aplicada, por exemplo, na transferência de dados e semelhantes usando os códigos ldpc.

Description

1/233
MÉTODO DE TRANSMISSÃO, E, DISPOSITIVO DE RECEPÇÃO Campo Técnico [001] A presente tecnologia refere-se a um método de transmissão e a um dispositivo de recepção e, mais particularmente, por exemplo, a um método de transmissão e a um dispositivo de recepção para garantir a qualidade de comunicação favorável na transmissão de dados usando um código LDPC.
Fundamentos da Invenção [002] Os códigos de verificação de paridade em baixa densidade (LDPC) têm alta capacidade de correção de erro e são, nos últimos anos, amplamente adotados nos sistemas de transmissão para difusão digital ou semelhantes, tais como a difusão de digital vídeo (DVB)-S.2 na Europa e semelhantes, DVB-T.2, DVB-C.2, e o comitê dos sistemas de televisão avançados (ATSC) 3.0 nos Estados Unidos e semelhantes, por exemplo, (veja, por exemplo, o Documento Não Patente 1).
[003] Com as pesquisas recentes, foi descoberto que os códigos
LDPC podem obter desempenho próximo do limite de Shannon à medida que o comprimento de código aumenta, similarmente aos códigos turbo e semelhantes. Além do mais, os códigos LDPC têm uma propriedade em que a mínima distância é proporcional ao comprimento de código e, assim, tem uma boa característica da probabilidade do erro de bloco, como características. Além do mais, um assim denominado fenômeno de piso de erro observado nas características de decodificação de códigos turbo e semelhantes dificilmente ocorre, o que também é uma vantagem.
Lista de Citação
Documento Não Patente [004] Documento Não Patente 1: ATSC Standard: Physical Layer
Protocol (A/322), 7 de setembro de 2016.
Sumário da Invenção
Petição 870190072829, de 30/07/2019, pág. 10/479
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Problemas a ser Resolvidos pela Invenção [005] Na transmissão de dados usando um código LDPC, por exemplo, o código LDPC é um símbolo (simbolizado) de modulação por quadratura (modulação digital), tal como modulação de quadratura por deslocamento de fase (QPSK), e o símbolo é mapeado em um ponto de sinal da modulação por quadratura e é enviado.
[006] A transmissão de dados usando um código LDPC está se espalhando melo mundo e é exigida para garantir a qualidade de comunicação (transmissão) favorável.
[007] A presente tecnologia foi feita em vista de uma situação como esta, e visa a garantir a qualidade de comunicação favorável na transmissão de dados usando um código LDPC.
Soluções para os Problemas [008] Um primeiro método de transmissão da presente tecnologia é um método de transmissão que inclui uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 3/16, uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
154, 106, 99, 177, 191, 55, 189, 181, 22, 62, 80, 114, 110, 141, 83, 103, 169, 156, 130, 186, 92, 45, 68, 126, 112, 185, 160, 158, 17, 145, 162, 127, 152, 174, 134, 18, 157, 120, 3, 29, 13, 135, 173, 86, 73, 150, 46, 153, 33, 61, 142,
Petição 870190072829, de 30/07/2019, pág. 11/479 /233
102, 171, 168, 78, 77, 139, 85, 176, 163, 128, 101, 42, 2, 14, 38, 10, 125, 90, 30, 63, 172, 47, 108, 89, 0, 32, 94, 23, 34, 59, 35, 129, 12, 146, 8, 60, 27, 147, 180, 100, 87, 184, 167, 36, 79, 138, 4, 95, 148, 72, 54, 91, 182, 28, 133, 164, 175, 123, 107, 137, 88, 44, 116, 69, 7, 31, 124, 144, 105, 170, 6, 165, 15, 161, 24, 58, 70, 11, 56, 143, 111, 104, 74, 67, 109, 82, 21, 52, 9, 71, 48, 26, 117, 50, 149, 140, 20, 57, 136, 113, 64, 151, 190, 131, 19, 51, 96, 76, 1, 97, 40, 53, 84, 166, 75, 159, 98, 81, 49, 66, 188, 118, 39, 132, 187, 25, 119, 41, 122, 16, 5, 93, 115, 178, 65, 121, 37, 155, 183, 43, 179, a matriz de verificação de paridade inclui uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 1.800, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
126 1125 1373 4698 5254 17832 23701 31126 33867 46596 46794 48392 49352 51151 52100 55162
794 1435 1552 4483 14668 16919 21871 36755 42132 43323
46650 47676 50412 53484 54886 55333
698 1356 1519 5555 6877 8407 8414 14248 17811 22998
28378 40695 46542 52817 53284 55968
457 493 1080 2261 4637 5314 9670 11171 12679 29201
Petição 870190072829, de 30/07/2019, pág. 12/479
4/233
43792 44337 47131 49880 55301
467 721 1484 5326 8676 11727 15221 17477 21390 22224
28845 37670 38917 40996 43851
305 389 526 9156 11091 12367 13337 14299 22072 25367
30710 37688 44321 48351 54663
342 1426 5889 7362 8213 8512 10655 14549 15486 26010
32196 36341 37705 45137
123 429 485 4093 6933 11291 11639 12558 20096 22292
32438 34615 38061 40659 51577
920 1086 1257 8839 10010 13126 14367 18612 23252 23777
32982 35684 40534 53318 55947
579 937 1593 2549 12702 17659 19393 20047 25145 27792
33311 39737 42052 50294 53363
116 883 1067 9847 10660 12052 18157 20519 21191 24139
27643 30745 33852 37692 37724
915 1154 1698 5197 5249 13741 25043 29802 31354 32707
36856 39887 41245 42065 50240
317 1304 1770 12854 14018 14061 16657 24029 24408 34493
35755 38593 47428 53811 55008
163 216 719 5541 13996 18754 19287 24293 38575 39520
43395 45390 46665 50706 55269
415 1326 2553 7963 14878 17850 21757 22166 32986
39267 46154 46790 52877 53780
593 1511 1515 13942 14258 14432 24537 38229 38251 40975
43490 44880 45278 46574 51442
219 262 955 1978 10654 13021 16873 23340 27412 32762
42723 45976 46603 47761 54095
632 944 1598 12924 17942 18478 26487 28036 42462 43513
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5/233
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34589 35808 43692 45126 49527
612 854 1521 13045 14525 15821 21096 23774 24274 25855
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25940 30677 44811 50590 52018
332 496 6421 19082 19665 25460 27377 27378 31086
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28672 31892 39559 50438 50453
517 946 1043 2563 3416 6620 8572 10920 31906 32685
40521 46898 48369 48700 49210
1325 1424 1741 11692 11761 19152 19732 28863 30563
42394 44802 49339 54524 55731
664 1340 1437 9442 10378 12176 18760 19872 21648 34682
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6/233
37784 40545 44808 47558 53061
378 705 1356 16007 16336 19543 21682 28716 30262 34500
40335 44238 48274 50341 52887
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41441 42542 52517 54945 56157
247 384 1270 6610 10335 24421 25984 27761 38728 41010
46216 46892 47392 48394 51471
10091 10124 12187 13741 18018 20438 21412 24163 35862 36925 37532 46234
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43603 53476 53737
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53622 55875 55888
3825 11292 11723 13819 26483 28571 33319 33721 34911
37766 47843 48667
10114 10336 14710 15586 19531 22471 27945 28397 45637 46131 47760 52375.
[009] Um primeiro dispositivo de recepção da presente tecnologia é um dispositivo de recepção que inclui uma unidade de desintercalação grupo a grupo configurada para retornar a sequência do código LDPC depois da intercalação grupo a grupo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 3/16, uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos
Petição 870190072829, de 30/07/2019, pág. 15/479 /233 de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
154, 106, 99, 177, 191, 55, 189, 181, 22, 62, 80, 114, 110, 141, 83, 103, 169, 156, 130, 186, 92, 45, 68, 126, 112, 185, 160, 158, 17, 145, 162, 127, 152, 174, 134, 18, 157, 120, 3, 29, 13, 135, 173, 86, 73, 150, 46, 153, 33, 61, 142, 102, 171, 168, 78, 77, 139, 85, 176, 163, 128, 101, 42, 2, 14, 38, 10, 125, 90, 30, 63, 172, 47, 108, 89, 0, 32, 94, 23, 34, 59, 35, 129, 12, 146, 8, 60, 27, 147, 180, 100, 87, 184, 167, 36, 79, 138, 4, 95, 148, 72, 54, 91, 182, 28, 133, 164, 175, 123, 107, 137, 88, 44, 116, 69, 7, 31, 124, 144, 105, 170, 6, 165, 15, 161, 24, 58, 70, 11, 56, 143, 111, 104, 74, 67, 109, 82, 21, 52, 9, 71, 48, 26, 117, 50, 149, 140, 20, 57, 136, 113, 64, 151, 190, 131, 19, 51, 96, 76, 1, 97, 40, 53, 84, 166, 75, 159, 98, 81, 49, 66, 188, 118, 39, 132, 187, 25, 119, 41, 122, 16, 5, 93, 115, 178, 65, 121, 37, 155, 183, 43, 179, a matriz de verificação de paridade inclui uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 1.800, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é
Petição 870190072829, de 30/07/2019, pág. 16/479
8/233 uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
126 1125 1373 4698 5254 17832 23701 31126 33867 46596
46794 48392 49352 51151 52100 55162
794 1435 1552 4483 14668 16919 21871 36755 42132 43323
46650 47676 50412 53484 54886 55333
698 1356 1519 5555 6877 8407 8414 14248 17811 22998
28378 40695 46542 52817 53284 55968
457 493 1080 2261 4637 5314 9670 11171 12679 29201
35980 43792 44337 47131 49880 55301
467 721 1484 5326 8676 11727 15221 17477 21390 22224
27074 28845 37670 38917 40996 43851
305 389 526 9156 11091 12367 13337 14299 22072 25367
29827 30710 37688 44321 48351 54663
342 1426 5889 7362 8213 8512 10655 14549 15486 26010
30403 32196 36341 37705 45137
123 429 485 4093 6933 11291 11639 12558 20096 22292
24696 32438 34615 38061 40659 51577
920 1086 1257 8839 10010 13126 14367 18612 23252 23777
32883 32982 35684 40534 53318 55947
579 937 1593 2549 12702 17659 19393 20047 25145 27792
30322 33311 39737 42052 50294 53363
116 883 1067 9847 10660 12052 18157 20519 21191 24139
27132 27643 30745 33852 37692 37724
915 1154 1698 5197 5249 13741 25043 29802 31354 32707
33804 36856 39887 41245 42065 50240
317 1304 1770 12854 14018 14061 16657 24029 24408 34493
35322 35755 38593 47428 53811 55008
163 216 719 5541 13996 18754 19287 24293 38575 39520
Petição 870190072829, de 30/07/2019, pág. 17/479
9/233
43395 45390 46665 50706 55269
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219 262 955 1978 10654 13021 16873 23340 27412 32762
42723 45976 46603 47761 54095
632 944 1598 12924 17942 18478 26487 28036 42462 43513
44584 48245 53274 54343 55453
501 912 1656 2009 6339 15581 20597 26886 32241 34471
43009 45977 46587 46821 51187
610 713 1619 5176 6122 6445 8044 12220 14126 32911
40715 45111 47872 50111 55027
258 445 1137 4517 5846 7644 15604 16606 16969 17622
34589 35808 43692 45126 49527
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469 918 1212 3912 10712 13084 13906 14000 16602 18040
25940 30677 44811 50590 52018
332 496 6421 19082 19665 25460 27377 27378 31086
37104 37236 37771 38622 40678
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10/233
142 1668 2102 3421 10462 13086 13671 24889 36914
37586 40166 42935 49052 49205 52170
294 616 840 2360 5386 7278 10202 15133 24149 24629
27338 28672 31892 39559 50438 50453
517 946 1043 2563 3416 6620 8572 10920 31906 32685
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378 705 1356 16007 16336 19543 21682 28716 30262 34500
40335 44238 48274 50341 52887
999 1202 1328 10688 11514 11724 15674 21039 35182 36272
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247 384 1270 6610 10335 24421 25984 27761 38728 41010
46216 46892 47392 48394 51471
10091 10124 12187 13741 18018 20438 21412 24163 35862
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7860 8123 8712 17553 20624 29410 29697 29853 43483
43603 53476 53737
11547 11741 19045 20400 23052 28251 32038 44283 50596
53622 55875 55888
3825 11292 11723 13819 26483 28571 33319 33721 34911
37766 47843 48667
10114 10336 14710 15586 19531 22471 27945 28397 45637
46131 47760 52375.
[0010] Um segundo método de transmissão da presente tecnologia é um método de transmissão que inclui uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de
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11/233 um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 5/16, uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
1, 182, 125, 0, 121, 47, 63, 154, 76, 99, 82, 163, 102, 166, 28, 189, 56, 67, 54, 39, 40, 185, 184, 65, 179, 4, 91, 87, 137, 170, 98, 71, 169, 49, 73, 37, 11, 143, 150, 123, 93, 62, 3, 50, 26, 140, 178, 95, 183, 33, 21, 53, 112, 128, 118, 120, 106, 139, 32, 130, 173, 132, 156, 119, 83, 176, 159, 13, 145, 36, 30, 113, 2, 41, 147, 174, 94, 88, 92, 60, 165, 59, 25, 161, 100, 85, 81, 61, 138, 48, 177, 77, 6, 22, 16, 43, 115, 23, 12, 66, 70, 9, 164, 122, 58, 105, 69, 42, 38, 19, 24, 180, 175, 74, 160, 34, 101, 72, 114, 142, 20, 8, 15, 190, 144,
104, 79, 172, 148, 31, 168, 10, 107, 14, 35, 52, 134, 126, 167, 149, 116,186,
17, 162, 151, 5, 136, 55, 44, 110, 158, 46, 191, 29, 153, 155, 117, 188,131,
97, 146, 103, 78, 109, 129, 57, 111, 45, 68, 157, 84, 141, 89, 64, 7, 108,152,
75, 18, 96, 133, 171, 86, 181, 127, 27, 124, 187, 135, 80, 51, 90, a matriz de verificação de paridade inclui uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da
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12/233 matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 1.800, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
152 1634 7484 23081 24142 26799 33620 40989 41902 44319 44378 45067
140 701 5137 7313 12672 16929 20359 27052 30236 33846
36254 46973
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31518 34124
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466 851 3669 7119 32748 32845 41914 4259542600
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213 1597 2771 4694 4923 17101 17212 19347 22002
1339 1544 1610 13522 14840 15355 29399 30125 33685
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[0011] Um segundo dispositivo de recepção da presente tecnologia é um dispositivo de recepção que inclui uma unidade de desintercalação grupo a grupo configurada para retornar a sequência do código LDPC depois da intercalação grupo a grupo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 5/16, uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma
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17/233 sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
1, 182, 125, 0, 121, 47, 63, 154, 76, 99, 82, 163, 102, 166, 28, 189, 56, 67, 54, 39, 40, 185, 184, 65, 179, 4, 91, 87, 137, 170, 98, 71, 169, 49, 73, 37, 11, 143, 150, 123, 93, 62, 3, 50, 26, 140, 178, 95, 183, 33, 21, 53, 112, 128, 118, 120, 106, 139, 32, 130, 173, 132, 156, 119, 83, 176, 159, 13, 145, 36, 30, 113, 2, 41, 147, 174, 94, 88, 92, 60, 165, 59, 25, 161, 100, 85, 81, 61, 138, 48, 177, 77, 6, 22, 16, 43, 115, 23, 12, 66, 70, 9, 164, 122, 58, 105, 69, 42, 38, 19, 24, 180, 175, 74, 160, 34, 101, 72, 114, 142, 20, 8, 15, 190, 144,
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17, 162, 151, 5, 136, 55, 44, 110, 158, 46, 191, 29, 153, 155, 117, 188,131,
97, 146, 103, 78, 109, 129, 57, 111, 45, 68, 157, 84, 141, 89, 64, 7, 108,152,
75, 18, 96, 133, 171, 86, 181, 127, 27, 124, 187, 135, 80, 51, 90, a matriz de verificação de paridade inclui uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 1.800, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
152 1634 7484 23081 24142 26799 33620 40989 41902 44319
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140 701 5137 7313 12672 16929 20359 27052 30236 33846
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19/233
179 528 1472 2481 5589 15696 20148 28040 29690 32370
122 144 681 6613 11230 20862 26396 27737 35928 39396
934 1256 1420 3881 4487 5830 7897 9587 17940 40333
622 1458 1490 16541 18443 19401 24860 26981 28157 32875
1017 1143 1511 2169 17322 24662 25971 29149 31450 31670
935 1084 1534 2918 10596 11534 17476 27269 30344 31104
173 532 1766 8001 10483 17002 19002 26759 31006 43466
221 610 1795 9197 11770 12793 14875 30177 30610 42274
188 439 1332 7030 9246 15150 26060 26541 27190 28259
812 1643 1750 7446 7888 7995 18804 21646 28995 30727
481 555 5618 9621 9873 19182 22059 42510 45343 46058
156 532 1799 6258 18733 19988 23237 27657 30835 34738
1128 1553 1790 8372 11543 13764 17062 28627 38502 40796
564 777 1286 3446 5566 12105 16038 18918 21802 25954
1167 1178 1770 4151 11422 11833 16823 17799 19188 22517
Petição 870190072829, de 30/07/2019, pág. 28/479
20/233
576 638 1364 12257 22028 24243 24297 31788 36398 38409
334 592 940 2865 12075 12708 21452 31961 32150 35723
1205 1267 1721 9293 18685 18917 23490 27678 37645 40114
189 628 821 17066 19218 21462 25452 26858 38408 38941
190 951 1019 5572 7135 15647 32613 33863 33981 35670
1003 1597 12597 15567 21221 21891 23151 23964 24816
756 1262 1345 6694 6893 9300 9497 17950 19082 35668
848 948 1560 6591 12529 12535 20567 23882 34481 46531
504 631 777 10585 12330 13822 15388 23332 27688 35955
676 1484 1575 2215 5830 6049 13558 25034 33602 35663
1298 1427 1732 13930 15611 19462 20975 23200 30460
34883
1491 1593 1615 4289 7010 10264 21047 26704 27024 29658
969 1730 1748 2217 7181 7623 15860 21332 28133 28998
302 1216 1374 5177 6849 7239 10255 34952 37908 39911
220 362 1491 5235 5439 22708 29228 29481 33272 36831
Petição 870190072829, de 30/07/2019, pág. 29/479
21/233
728 1279 4579 8325 8505 27604 31437 33574 41716 45082
472 735 1558 4454 6957 14867 18307 22437 38304 42054
466 851 3669 7119 32748 32845 41914 42595 42600
553 824 2994 4569 12505 24738 33258 37121 43381
495 1553 7684 8908 12412 15563 16461 17872 29292
254 1057 1481 9971 18408 19815 28569 29164 39281 42723
1213 1614 4352 8091 8847 10022 24394 35661 43800
395 750 888 2582 3772 4151 26025 36367 42326 42673
862 1379 1441 6413 25621 28378 34869 35491 41774 44165
213 1597 2771 4694 4923 17101 17212 19347 22002
1339 1544 1610 13522 14840 15355 29399 30125 33685
37672
251 1162 1260 9766 13137 34769 36646 43313 43736 43828
214 1002 1688 5357 19091 19213 24460 28843 32869 35013
646 733 1735 11175 11336 12043 22962 33892 35646 37116
293 927 1064 4818 5842 10983 12871 17804 33127 41604
Petição 870190072829, de 30/07/2019, pág. 30/479 / 233
46588
10927 15514 22748 34850 37645 40669 41583 44090
3329 7548 8092 11659 16832 35304 46738 46888 3510 5915 9603 30333 37198 42866 44361 46416 2575 5311 9421 13410 15375 34017 37136 43990 12468 14492 24417 26394 38565 38936 41899 45593.
[0012] Um terceiro método de transmissão da presente tecnologia é um método de transmissão que inclui uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 7/16, uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
35, 75, 166, 145, 143, 184, 62, 96, 54, 63, 157, 103, 32, 43, 126, 187, 144, 91, 78, 44, 39, 109, 185, 102, 10, 68, 29, 42, 149, 83, 133, 94, 130, 27, 171, 19, 51, 165, 148, 28, 36, 33, 173, 136, 87, 82, 100, 49, 120, 152, 161, 162, 147, 71, 137, 57, 8, 53, 132, 151, 163, 123, 47, 92, 90, 60, 99, 79, 59, 108, 115, 72, 0, 12, 140, 160, 61, 180, 74, 37, 86, 117, 191, 101, 52, 15, 80, 156, 127, 81, 131, 141, 142, 31, 95, 4, 73, 64, 16, 18, 146, 70, 181, 7, 89, 124, 77, 67, 116, 21, 34, 41, 105, 113, 97, 2, 6, 55, 17, 65, 38, 48, 158, 159, 179, 5, 30, 183, 170, 135, 125, 20, 106, 186, 182, 188, 114, 1, 14, 3, 134, 178, 189, 167, 40, 119, 22, 190, 58, 23, 155, 138, 98, 84, 11, 110, 88, 46, 177, 175, 25, 150, 118, 121, 129, 168, 13, 128, 104, 69, 112, 169, 9, 45, 174, 93, 26, 56,
Petição 870190072829, de 30/07/2019, pág. 31/479 / 233
76, 50, 154, 139, 66, 85, 153, 107, 111, 172, 176, 164, 24, 122, a matriz de verificação de paridade inclui uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 4.680, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
1012 3997 5398 5796 21940 23609 25002 28007 32214 33822 38194
1110 4016 5752 10837 15440 15952 17802 27468 32933 33191 35420
1953 6554 11381 12839 12880 22901 26742 26910 27621 37825
1146 2232 5658 13131 13785 16771 17466 20561 29400 32962 36879
2023 3420 5107 10789 12303 13316 14428 24912 35363 36348 38787
3283 3637 12474 14376 20459 22584 23093 28876 31485 31742 34849
1807 3890 4865 7562 9091 13778 18361 21934 24548 34267
Petição 870190072829, de 30/07/2019, pág. 32/479 / 233
1613 3620 10165 11464 14071 20675 20803 26814 27593
36485
849 3946 8585 9208 9939 14676 14990 19276 23459 30577
1890 2583 5951 6003 11943 13641 16319 18379 22957 24644
1936 3939 5267 6314 12665 19626 20457 22010 27958 30238
2153 4318 6782 13048 17730 17923 24137 24741 25594
33209
1869 4262 6616 13522 19266 19384 22769 28883 30389
36019
3037 3116 7478 7841 10627 10908 14060 14163 2377227946
1668 3125 7485 8525 14659 22834 24080 24838 3089033391
1623 2836 6776 8549 11448 23281 32033 32729 3365034069
101 1420 5172 7475 11673 18807 21367 23095 2636830888
3874 3940 4823 16485 21601 21655 21885 25541 30177 35067
592 643 4847 6870 7671 10412 25081 33412 33478 33495
2578 2677 12592 17140 17185 21962 23206 23838 27624
34828
3058 3443 4959 21179 22411 24033 26004 26489 26775
36694
Petição 870190072829, de 30/07/2019, pág. 33/479 / 233
2998 10137 11957 12444 22330 24300 26008 26441 26521
889 1840 8881 10228 12495 18162 22259 23385 25687 35853
1332 3031 13482 14262 15897 23112 25954 28035 34898
36991
2505 2599 10980 15245 20084 20114 24496 26309 31139
37258
599 1778 8935 16154 19546 23537 24938 32059 32406 35564
392 1777 4793 8050 10543 10668 14823 25252 32922 36658
1680 2630 7190 7880 10894 20675 27523 33460 33733 34000
532 3750 5075 10603 12466 19838 24231 24998 27647 35111
1786 3066 11367 12452 13896 15346 24646 25509 26109
37392
1027 1659 6483 16919 17636 18905 19741 30579 35934
37617
2064 2354 14085 16460 21378 21719 22981 23329 31701
32640
2009 4421 7595 8790 12803 17649 18527 24246 27584 28757
364 646 9398 13898 17486 17709 20911 31493 31810 32019
2246 3760 4911 19338 25792 27511 28689 30634 31928
36605
3178 3544 8858 9336 9602 12290 16521 27872 28391 28422
Petição 870190072829, de 30/07/2019, pág. 34/479 / 233
36105
1981 2209 12718 20656 21253 22574 28653 29967 33692
36759 37871 787 1545 7652 8376 9628 9995 10289 16260 17606 22673
34564 795 4580 12749 16670 18727 19131 19449 26152 29165
30820 31678 1577 2980 8659 12301 13813 14838 20782 23068 30185
34308 34676 84 434 13572 21777 24581 28397 28490 32547 33282 34655
37579 2927 4440 8979 14992 19009 20435 23558 26280 31320
35106 37704 1974 2712 6552 8585 10051 14848 15186 22968 24285 25878
36054 585 1990 3457 5010 8808 9 2792 4678 22666 32922 342 507 861 18844 32947 554 3395 4094 8147 34616 356 2061 2801 20330 38214 425 2432 4573 7323 28157 73 1192 2618 7812 17947 842 1053 4088 10818 24053 1234 1249 4171 6645 37350 1498 2113 4175 6432 17014 524 2135 2205 6311 7502 191 954 3166 28938 31869 548 586 4101 12129 25819 127 2352 3215 6791 13523
Petição 870190072829, de 30/07/2019, pág. 35/479 / 233
286 4262 4423 14087 38061
1645 3551 4209 14083 15827
719 1087 2813 32857 34499
651 2752 4548 25139 25514
1702 4186 4478 10785 33263
3157 4196 5811 36555
643 649 1524 6587 27246
291 836 1036 18936 19201
1099 4174 18305 36119
3083 3173 4667 27349 32057
3449 4090 4339 18334 24596
503 3816 4465 29204 35316
102 1693 1799 17180 35877
288 324 1237 16167 33970
224 2831 3571 17861 28530
1202 2803 2834 4943 31485
1112 2196 3027 29308 37101
4242 4291 4503 16344 28769
1020 1927 3349 9686 33845
3179 3304 3891 8448 37247
1076 2319 4512 17010 18781
987 1391 3781 12318 35710
2268 3467 3619 15764 25608
764 1135 2224 8647 17486
2091 4081 4648 8101 33818
471 3668 4069 14925 36242
932 2140 3428 12523 33270
5840 8959 12039 15972 38496
5960 7759 10493 31160 38054
Petição 870190072829, de 30/07/2019, pág. 36/479 / 233
10380 14835 26024 35399 36517
5260 7306 13419 28804 31112
12747 23075 32458 36239 37437
14096 16976 21598 32228 34672
5024 5769 21798 22675 25316
8617 14189 17874 22776 29780
7628 13623 16676 30019 33213
14090 14254 18987 21720 38550
17306 17709 19135 22995 28597 13137 18028 23943 27468 37156 7704 8171 10815 28138 29526.
[0013] Um terceiro dispositivo de recepção da presente tecnologia é um dispositivo de recepção que inclui uma unidade de desintercalação grupo a grupo configurada para retornar a sequência do código LDPC depois da intercalação grupo a grupo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 7/16, uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
35, 75, 166, 145, 143, 184, 62, 96, 54, 63, 157, 103, 32, 43,
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126, 187, 144, 91, 78, 44, 39, 109, 185, 102, 10, 68, 29, 42, 149, 83, 133, 94, 130, 27, 171, 19, 51, 165, 148, 28, 36, 33, 173, 136, 87, 82, 100, 49, 120, 152, 161, 162, 147, 71, 137, 57, 8, 53, 132, 151, 163, 123, 47, 92, 90, 60, 99, 79, 59, 108, 115, 72, 0, 12, 140, 160, 61, 180, 74, 37, 86, 117, 191, 101, 52, 15, 80, 156, 127, 81, 131, 141, 142, 31, 95, 4, 73, 64, 16, 18, 146, 70, 181, 7, 89, 124, 77, 67, 116, 21, 34, 41, 105, 113, 97, 2, 6, 55, 17, 65, 38, 48, 158, 159, 179, 5, 30, 183, 170, 135, 125, 20, 106, 186, 182, 188, 114, 1, 14, 3, 134, 178, 189, 167, 40, 119, 22, 190, 58, 23, 155, 138, 98, 84, 11, 110, 88, 46, 177, 175, 25, 150, 118, 121, 129, 168, 13, 128, 104, 69, 112, 169, 9, 45, 174, 93, 26, 56, 76, 50, 154, 139, 66, 85, 153, 107, 111, 172, 176, 164, 24, 122, a matriz de verificação de paridade inclui uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 4.680, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
1012 3997 5398 5796 21940 23609 25002 28007 32214 33822 38194
1110 4016 5752 10837 15440 15952 17802 27468 32933 33191 35420
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30/233
1953 6554 11381 12839 12880 22901 26742 26910 27621
1146 2232 5658 13131 13785 16771 17466 20561 29400
36879
2023 3420 5107 10789 12303 13316 14428 24912 35363
38787
3283 3637 12474 14376 20459 22584 23093 28876 31485
34849
1807 3890 4865 7562 9091 13778 18361 21934 24548 34267
1613 3620 10165 11464 14071 20675 20803 26814 27593
36485
849 3946 8585 9208 9939 14676 14990 19276 23459 30577
1890 2583 5951 6003 11943 13641 16319 18379 22957 24644
1936 3939 5267 6314 12665 19626 20457 22010 27958 30238
2153 4318 6782 13048 17730 17923 24137 24741 25594
33209
1869 4262 6616 13522 19266 19384 22769 28883 30389
36019
3037 3116 7478 7841 10627 10908 14060 14163 2377227946
1668 3125 7485 8525 14659 22834 24080 24838 3089033391
1623 2836 6776 8549 11448 23281 32033 32729 3365034069
101 1420 5172 7475 11673 18807 21367 23095 2636830888
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31/233
3874 3940 4823 16485 21601 21655 21885 25541 30177
35067
592 643 4847 6870 7671 10412 25081 33412 33478 33495
2578 2677 12592 17140 17185 21962 23206 23838 27624
34828
3058 3443 4959 21179 22411 24033 26004 26489 26775
36694
2998 10137 11957 12444 22330 24300 26008 26441 26521
889 1840 8881 10228 12495 18162 22259 23385 25687 35853
1332 3031 13482 14262 15897 23112 25954 28035 34898
36991
2505 2599 10980 15245 20084 20114 24496 26309 31139
37258
599 1778 8935 16154 19546 23537 24938 32059 32406 35564
392 1777 4793 8050 10543 10668 14823 25252 32922 36658
1680 2630 7190 7880 10894 20675 27523 33460 33733 34000
532 3750 5075 10603 12466 19838 24231 24998 27647 35111
1786 3066 11367 12452 13896 15346 24646 25509 26109
37392
1027 1659 6483 16919 17636 18905 19741 30579 35934
37617
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32/233
2064 2354 14085 16460 21378 21719 22981 23329 31701 32640
2009 4421 7595 8790 12803 17649 18527 24246 27584 28757
364 646 9398 13898 17486 17709 20911 31493 31810 32019
2246 3760 4911 19338 25792 27511 28689 30634 31928 36605
3178 3544 8858 9336 9602 12290 16521 27872 28391 28422
1981 2209 12718 20656 21253 22574 28653 29967 33692 37871
787 1545 7652 8376 9628 9995 10289 16260 17606 22673
795 4580 12749 16670 18727 19131 19449 26152 29165 31678
1577 2980 8659 12301 13813 14838 20782 23068 30185
34676
434 13572 21777 24581 28397 28490 32547 33282 34655
2927 4440 8979 14992 19009 20435 23558 26280 31320 37704
1974 2712 6552 8585 10051 14848 15186 22968 24285 25878
585 1990 3457 5010 8808
2792 4678 22666 32922
342 507 861 18844 32947
554 3395 4094 8147 34616
356 2061 2801 20330 38214
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33/233
425 2432 4573 7323 28157
1192 2618 7812 17947
842 1053 4088 10818 24053
1234 1249 4171 6645 37350
1498 2113 4175 6432 17014
524 2135 2205 6311 7502
191 954 3166 28938 31869
548 586 4101 12129 25819
127 2352 3215 6791 13523
286 4262 4423 14087 38061
1645 3551 4209 14083 15827
719 1087 2813 32857 34499
651 2752 4548 25139 25514
1702 4186 4478 10785 33263
3157 4196 5811 36555
643 649 1524 6587 27246
291 836 1036 18936 19201
1099 4174 18305 36119
3083 3173 4667 27349 32057
3449 4090 4339 18334 24596
503 3816 4465 29204 35316
102 1693 1799 17180 35877
288 324 1237 16167 33970
224 2831 3571 17861 28530
1202 2803 2834 4943 31485
1112 2196 3027 29308 37101
4242 4291 4503 16344 28769
1020 1927 3349 9686 33845
3179 3304 3891 8448 37247
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34/233
1076 2319 4512 17010 18781
987 1391 3781 12318 35710
2268 3467 3619 15764 25608
764 1135 2224 8647 17486
2091 4081 4648 8101 33818
471 3668 4069 14925 36242
932 2140 3428 12523 33270
5840 8959 12039 15972 38496
5960 7759 10493 31160 38054
10380 14835 26024 35399 36517
5260 7306 13419 28804 31112
12747 23075 32458 36239 37437
14096 16976 21598 32228 34672
5024 5769 21798 22675 25316
8617 14189 17874 22776 29780
7628 13623 16676 30019 33213
14090 14254 18987 21720 38550
17306 17709 19135 22995 28597
13137 18028 23943 27468 37156
7704 8171 10815 28138 29526.
[0014] Um quarto método de transmissão da presente tecnologia é um método de transmissão que inclui uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 9/16, uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação
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35/233 grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
155, 188, 123, 132, 15, 79, 59, 119, 66, 68, 41, 175, 184, 78, 142, 32, 54, 111, 139, 134, 95, 34, 161, 150, 58, 141, 74, 112, 121, 99, 178, 179, 57, 90, 80, 21, 11, 29, 67, 104, 52, 87, 38, 81, 181, 160, 176, 16, 71, 13, 186, 171, 9, 170, 2, 177, 0, 88, 149, 190, 69, 33, 183, 146, 61, 117, 113, 6, 96, 120, 162, 23, 53, 140, 91, 128, 46, 93, 174, 126, 159, 133, 8, 152, 103, 102, 151, 143, 100, 4, 180, 166, 55, 164, 18, 49, 62, 20, 83, 7, 187, 153, 64, 37, 144, 185, 19, 114, 25, 116, 12, 173, 122, 127, 89, 115, 75, 101, 189, 124, 157, 108, 28, 165, 163, 65, 168, 77, 82, 27, 137, 86, 22, 110, 63, 148, 158, 97, 31, 105, 135, 98, 44, 70, 182, 191, 17, 156, 129, 39, 136, 169, 3, 145, 154, 109, 76, 5, 10, 106, 35, 94, 172, 45, 51, 60, 42, 50, 72, 85, 40, 118, 36, 14, 130, 131, 138, 43, 48, 125, 84, 24, 26, 1, 56, 107, 92, 147, 47, 30, 73, 167, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da matriz de informação para cada 360 colunas, e é
110 3064 6740 7801 10228 13445 17599 17891 17979 18044 19923 21848 23262 25585 25968 30124
1578 8914 9141 9731 10605 11690 12824 18127 18458 24648 24950 25150 26323 26514 27385 27460
3054 3640 3923 7332 10770 12215 14455 14849 15619 20870 22033 26427 28067 28560 29777 29780
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36/233
1348 4248 5479 8902 9101 9356 10581 11614 12813 21554
23701 24099 24575 24786 27370
3266 8358 16544 16689 16693 16823 17565 18543 19229
23799 24981 25423 28997 29808 30202
320 1198 1549 5407 6080 8542 9352 12418 13391 14736
18328 19398 23391 28117 28793
2114 3294 3770 5225 5556 5991 7075 7889 11145 11386
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3689 4839 7971 8419 10500 12308 13435 14487 16502 16622
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38/233
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39/233
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40/233
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11735 13710 22611
5347 21681 22906
6912 12045 15866
713 15429 23281
7133 17440 28982
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7658 11158 29885
17610 18755 28852
7680 16212 30111
8812 10144 15718.
[0015] Um quarto dispositivo de recepção da presente tecnologia é um dispositivo de recepção que inclui uma unidade de desintercalação grupo a grupo configurada para retornar a sequência do código LDPC depois da intercalação grupo a grupo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 9/16, uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
155, 188, 123, 132, 15, 79, 59, 119, 66, 68, 41, 175, 184, 78,
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41/233
142, 32, 54, 111, 139, 134, 95, 34, 161, 150, 58, 141, 74, 112, 121, 99, 178, 179, 57, 90, 80, 21, 11, 29, 67, 104, 52, 87, 38, 81, 181, 160, 176, 16, 71, 13, 186, 171, 9, 170, 2, 177, 0, 88, 149, 190, 69, 33, 183, 146, 61, 117, 113, 6, 96, 120, 162, 23, 53, 140, 91, 128, 46, 93, 174, 126, 159, 133, 8, 152, 103, 102, 151, 143, 100, 4, 180, 166, 55, 164, 18, 49, 62, 20, 83, 7, 187, 153, 64, 37, 144, 185, 19, 114, 25, 116, 12, 173, 122, 127, 89, 115, 75, 101, 189, 124, 157, 108, 28, 165, 163, 65, 168, 77, 82, 27, 137, 86, 22, 110, 63, 148, 158, 97, 31, 105, 135, 98, 44, 70, 182, 191, 17, 156, 129, 39, 136, 169, 3, 145, 154, 109,
76, 5, 10, 106, 35, 94, 172, 45, 51, 60, 42, 50, 72, 85, 40, 118, 36, 14, 130,
131, 138, 43, 48, 125, 84, 24, 26, 1, 56, 107, 92, 147, 47, 30, 73, 167, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da matriz de informação para cada 360 colunas, e é
110 3064 6740 7801 10228 13445 17599 17891 17979 18044 19923 21848 23262 25585 25968 30124
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Petição 870190072829, de 30/07/2019, pág. 51/479 / 233
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Petição 870190072829, de 30/07/2019, pág. 52/479 / 233
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Petição 870190072829, de 30/07/2019, pág. 53/479 / 233
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5485 11743 15165
21021 21798 30209
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3377 7398 28867
2430 24650 29426
3364 13409 22914
6838 13491 16229
18393 20764 28078
289 20279 24906
4732 6162 13569
8993 17053 29387
2210 5024 24030
22976 24053
12359 15499 28251
4640 11480 24391
1083 7965 16573
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13556 20450 24679
3911 16778 29952
11735 13710 22611
5347 21681 22906
6912 12045 15866
713 15429 23281
Petição 870190072829, de 30/07/2019, pág. 54/479 / 233
7133 17440 28982
12355 17564 28059
7658 11158 29885
17610 18755 28852
7680 16212 30111
8812 10144 15718.
[0016] Um quinto método de transmissão da presente tecnologia é um método de transmissão que inclui uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 11/16, uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
152, 87, 170, 33, 48, 95, 2, 184, 145, 51, 94, 164, 38, 90, 158, 70, 124, 128, 66, 111, 79, 42, 45, 141, 83, 73, 57, 119, 20, 67, 31, 179, 123, 183, 26, 188, 15, 163, 1, 133, 105, 72, 81, 153, 69, 182, 101, 180, 185, 190,
77, 6, 127, 138, 75, 59, 24, 175, 30, 186, 139, 56, 100, 176, 147, 189, 116, 131, 25, 5, 16, 117, 74, 50, 171, 114, 76, 44, 107, 135, 71, 181, 13, 43, 122,
78, 4, 58, 35, 63, 187, 98, 37, 169, 148, 7, 10, 49, 80, 161, 167, 28, 142, 46, 97, 92, 121, 112, 88, 102, 106, 173, 19, 27, 41, 172, 91, 191, 34, 118, 108, 136, 166, 155, 96, 3, 165, 103, 84, 109, 104, 53, 23, 0, 178, 17, 86, 9, 168, 134, 110, 18, 32, 146, 129, 159, 55, 154, 126, 40, 151, 174, 60, 52, 22, 149, 156, 113, 143, 11, 93, 62, 177, 64, 61, 160, 150, 65, 130, 82, 29, 115, 137, 36,
Petição 870190072829, de 30/07/2019, pág. 55/479 / 233
8, 157, 54, 89, 99, 120, 68, 21, 140, 14, 39, 132, 125, 12, 85, 162, 47, 144, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da matriz de informação para cada 360 colunas, e é
983 2226 4091 5418 5824 6483 6914 8239 8364 10220 10322 15658 16928 17307 18061
1584 5655 6787 7213 7270 8585 8995 9294 9832 9982 11185 12221 12889 17573 19096
319 1077 1796 2421 6574 11763 13465 14527 15147 15218 16000 18284 20199 21095 21194
767 1018 3780 3826 4288 4855 7169 7431 9151 10097 10919 12050 13261 19816 20932
173 692 3552 5046 6523 6784 9542 10482 14658 14663 15168 16153 16410 17546 20989
2214 2286 2445 2856 3562 3615 3970 6065 7117 7989 8180 15971 20253 21312 21428 532 1361 1905 3577 5147 10409 11348
11660 15230 17283 18724 20190 20542 21159 21282
3242 5061 7587 7677 8614 8834 9130 9135 9331 13480 13544 14263 15438 20548 21174
1507 4159 4946 5215 5653 6385 7131 8049 10198 10499 12215 14105 16118 17016 21371
212 1856 1981 2056 6766 8123 10128 10957 11159 11237 12893 14064 17760 18933 19009
329 5552 5948 6484 10108 10127 10816 13210 14985 15110
Petição 870190072829, de 30/07/2019, pág. 56/479 / 233
15969 17136 18504 20818
4753 5744 6511 7062 7355 8379 8817 13503 13650 14014
15640 18127 18595 20426
1152 1707 4013 5932 8540 9077 11521 11923 11954 12529
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216 1722 2750 3809 6210 8233 9183 10734 11339 12321
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1560 1718 1757 2292 2349 3992 6943 7369 7806 10282
13624 14608 17087 18011
1375 1640 2015 2539 2691 2967 4344 7125 9176 9435 12378
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309 1587 3118 5472 10035 13988 15019 15322 16373 17580
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984 991 1203 3159 4303 5734 8850 9626 12217 17227 17269
18854 19580 19684
2429 6165 6828 7761 9761 9899 9942 10151 11198 11271
14026 14560 18962 20570
876 1074 5177 5185 6415 6451 10856 11603 14590 14658
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557 607 2473 5002 6601 9876 10284 10809 13563 14849
16798 17509 18927 21306
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19673 20328 21068 21258
2802 3312 5015 6041 6943 7606 9375 12116 12868 12964
13594 14978 16125 18621
Petição 870190072829, de 30/07/2019, pág. 57/479 / 233
3002 6512 6965 6967 8504 10777 11217 11931 12647 12686
12740 12900 12958 13870 17860
151 3874 4228 7837 10244 10589 14530 15323 16462 17711
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1249 2946 2959 3330 4264 7797 10652 11845 12987 15974
16536 17520 19851 20150 20172
4769 11033 14937
1431 2870 15158
9416 14905 20800
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1116 1179 20743
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2717 11613
2787 9015 15081
3718 7305 11822
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1208 4586 10578
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10580 15127 20614
4439 15646 19861
5255 12337 14649
2532 7552 10813
1591 7781 13020
7264 8634 17208
7462 10069 17710
1320 3382 6439
4057 9762 11401
1618 7604 19881
Petição 870190072829, de 30/07/2019, pág. 58/479
50/233
3858 16826 17768 6158 11759 19274 3767 11872 15137 2111 5563 16776 1888 15452 17925 2840 15375 16376 3695 11232 16970 10181 16329 17920 9743 13974 17724 29 16450 20509 2393 17877 19591 1827 15175 15366 3771 14716 18363 5585 14762 19813 7186 8104 12067 2554 12025 15873 2208 5739 6150 2816 12745 17143 9363 11582 17976 5834 8178 12517 3546 15667 19511 5211 10685 20833 3399 7774 16435 3767 4542 8775 4404 6349 19426 4812 11088 16761 5761 11289 17985 9989 11488 15986 10200 16710 20899
Petição 870190072829, de 30/07/2019, pág. 59/479
51/233
6970 12774 20558
1304 2495 3507
5236 7678 10437
4493 10472 19880
1883 14768 21100
352 18797 20570
1411 3221 4379
3304 11013 18382
14864 16951 18782
2887 15658 17633
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4293 12990 13934
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2955 15500 20140
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5088 19940
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52/233
16910 20686 21206
10662 11610 17578
3378 4579 12849
5947 19300 19762
2545 10686 12579
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677 18652 18992
190 11377 12987
4183 6801 20025
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6990 9168 17589
7920 11548 20786
10533 14361 19577.
[0017] Um quinto dispositivo de recepção da presente tecnologia é um dispositivo de recepção que inclui uma unidade de desintercalação grupo a grupo configurada para retornar a sequência do código LDPC depois da intercalação grupo a grupo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação
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53/233
LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 11/16, uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
152, 87, 170, 33, 48, 95, 2, 184, 145, 51, 94, 164, 38, 90, 158, 70, 124, 128, 66, 111, 79, 42, 45, 141, 83, 73, 57, 119, 20, 67, 31, 179, 123, 183, 26, 188, 15, 163, 1, 133, 105, 72, 81, 153, 69, 182, 101, 180, 185, 190,
77, 6, 127, 138, 75, 59, 24, 175, 30, 186, 139, 56, 100, 176, 147, 189, 116, 131, 25, 5, 16, 117, 74, 50, 171, 114, 76, 44, 107, 135, 71, 181, 13, 43, 122,
78, 4, 58, 35, 63, 187, 98, 37, 169, 148, 7, 10, 49, 80, 161, 167, 28, 142, 46, 97, 92, 121, 112, 88, 102, 106, 173, 19, 27, 41, 172, 91, 191, 34, 118, 108, 136, 166, 155, 96, 3, 165, 103, 84, 109, 104, 53, 23, 0, 178, 17, 86, 9, 168, 134, 110, 18, 32, 146, 129, 159, 55, 154, 126, 40, 151, 174, 60, 52, 22, 149, 156, 113, 143, 11, 93, 62, 177, 64, 61, 160, 150, 65, 130, 82, 29, 115, 137, 36, 8, 157, 54, 89, 99, 120, 68, 21, 140, 14, 39, 132, 125, 12, 85, 162, 47, 144, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da
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54/233 unidade da matriz de informação para cada 360 colunas, e é
983 2226 4091 5418 5824 6483 6914 8239 8364 10220 10322 15658 16928 17307 18061
1584 5655 6787 7213 7270 8585 8995 9294 9832 9982 11185
12221 12889 17573 19096
319 1077 1796 2421 6574 11763 13465 14527 15147 15218 16000 18284 20199 21095 21194
767 1018 3780 3826 4288 4855 7169 7431 9151 10097 10919 12050 13261 19816 20932
173 692 3552 5046 6523 6784 9542 10482 14658 14663 15168 16153 16410 17546 20989
2214 2286 2445 2856 3562 3615 3970 6065 7117 7989 8180
15971 20253 21312 21428 532 1361 1905 3577 5147 10409 11348
11660 15230 17283 18724 20190 20542 21159 21282
3242 5061 7587 7677 8614 8834 9130 9135 9331 13480 13544 14263 15438 20548 21174
1507 4159 4946 5215 5653 6385 7131 8049 10198 10499
12215 14105 16118 17016 21371
212 1856 1981 2056 6766 8123 10128 10957 11159 11237
12893 14064 17760 18933 19009
329 5552 5948 6484 10108 10127 10816 13210 14985 15110
15565 15969 17136 18504 20818
4753 5744 6511 7062 7355 8379 8817 13503 13650 14014
15393 15640 18127 18595 20426
1152 1707 4013 5932 8540 9077 11521 11923 11954 12529
13519 15641 16262 17874 19386
858 2355 2511 3125 5531 6472 8146 11423 11558 11760
13556 15194 20782 20988 21261
216 1722 2750 3809 6210 8233 9183 10734 11339 12321
Petição 870190072829, de 30/07/2019, pág. 63/479
55/233
15902 17437 19085 21588
1560 1718 1757 2292 2349 3992 6943 7369 7806 10282
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3002 6512 6965 6967 8504 10777 11217 11931 12647 12686
12900 12958 13870 17860
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19363 19376 19540 20641
1249 2946 2959 3330 4264 7797 10652 11845 12987 15974
17520 19851 20150 20172
4769 11033 14937
1431 2870 15158
Petição 870190072829, de 30/07/2019, pág. 64/479
56/233
9416 14905 20800
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2787 9015 15081
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10181 16329 17920
Petição 870190072829, de 30/07/2019, pág. 65/479 / 233
9743 13974 17724 29 16450 20509 2393 17877 19591 1827 15175 15366 3771 14716 18363 5585 14762 19813 7186 8104 12067 2554 12025 15873 2208 5739 6150 2816 12745 17143 9363 11582 17976 5834 8178 12517 3546 15667 19511 5211 10685 20833 3399 7774 16435 3767 4542 8775 4404 6349 19426 4812 11088 16761 5761 11289 17985 9989 11488 15986 10200 16710 20899 6970 12774 20558 1304 2495 3507 5236 7678 10437 4493 10472 19880 1883 14768 21100 352 18797 20570 1411 3221 4379 3304 11013 18382
Petição 870190072829, de 30/07/2019, pág. 66/479
58/233
14864 16951 18782
2887 15658 17633
7109 7383 19956
4293 12990 13934
9890 15206 15786
2987 5455 8787
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736 1961 10441
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190 11377 12987
Petição 870190072829, de 30/07/2019, pág. 67/479
59/233
4183 6801 20025
6944 8321 15868
3311 6049 14757
7155 11435 16353
4778 5674 15973
1889 3361 7563
467 5999 10103
7613 11096 19536
2244 4442 6000
9055 13516 15414
4831 6111 10744
3792 8258 15106
6990 9168 17589
7920 11548 20786
10533 14361 19577.
[0018] Um sexto método de transmissão da presente tecnologia é um método de transmissão que inclui uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 13/16, uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
140, 8, 176, 13, 41, 165, 27, 109, 121, 153, 58, 181, 143, 164,
Petição 870190072829, de 30/07/2019, pág. 68/479
60/233
103, 115, 91, 66, 60, 189, 101, 4, 14, 102, 45, 124, 104, 159, 130, 133, 135, 77, 25, 59, 180, 141, 144, 62, 114, 182, 134, 148, 11, 20, 125, 83, 162, 75,
126, 67, 9, 178, 171, 152, 166, 69, 174, 15, 80, 168, 131, 95, 56, 48, 63, 82, 147, 51, 108, 52, 30, 139, 22, 37, 173, 112, 191, 98, 116, 149, 167, 142, 29, 154, 92, 94, 71, 117, 79, 122, 129, 24, 81, 105, 97, 137, 128, 1, 113, 170, 119, 7, 158, 76, 19, 183, 68, 31, 50, 118, 33, 72, 55, 65, 146, 185, 111, 145, 28, 21, 177, 160, 32, 61, 70, 106, 156, 78, 132, 88, 184, 35, 5, 53, 138, 47, 100, 10, 42, 36, 175, 93, 120, 190, 16, 123, 87, 54, 186, 18, 57, 84, 99, 12, 163, 157, 188, 64, 38, 26, 2, 136, 40, 169, 90, 107, 46, 172, 49, 6, 39, 44, 150, 85, 0, 17,
127, 155, 110, 34, 96, 74, 86, 187, 89, 151, 43, 179, 161, 73, 23, 3, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da matriz de informação para cada 360 colunas, e é
1031 4123 6253 6610 8007 8656 9181 9404 9596 11501 11654 11710 11994 12177
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11202 11399 12795
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804 1177 1414 3765 4745 7594 9126 9230 9251 10299 10336
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61/233
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9937 10184
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62/233
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11472 12325
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1038 1463 1472 2944 3202 5742 5793 6972 7853 8919 9808
10549 12619
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12031 12588
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2863 5308
10467 11711
3412 6909
Petição 870190072829, de 30/07/2019, pág. 71/479 / 233
450 3919
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298 4323
397 10223
4424 9051
2038 2376
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2581 4118 8142
5165 9328 11386
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6711 11224 11737
Petição 870190072829, de 30/07/2019, pág. 72/479
64/233
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Petição 870190072829, de 30/07/2019, pág. 73/479 / 233
317 742 8017
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5782 9780 9869
Petição 870190072829, de 30/07/2019, pág. 74/479 / 233
4728 10395
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99 7615
1722 6386 11112
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4164 6731 12121
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222 6050 12711
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1556 4667 7990
2536 9712 9932
4104 7040 9983
6365 11604 12457
Petição 870190072829, de 30/07/2019, pág. 75/479 / 233
3393 10323 10743
724 2237 5455
108 1705 6151.
[0019] Um sexto dispositivo de recepção da presente tecnologia é um dispositivo de recepção que inclui uma unidade de desintercalação grupo a grupo configurada para retomar a sequência do código LDPC depois da intercalação grupo a grupo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 13/16, uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits, e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
140, 8, 176, 13, 41, 165, 27, 109, 121, 153, 58, 181, 143, 164, 103, 115, 91, 66, 60, 189, 101, 4, 14, 102, 45, 124, 104, 159, 130, 133, 135, 77, 25, 59, 180, 141, 144, 62, 114, 182, 134, 148, 11, 20, 125, 83, 162, 75, 126, 67, 9, 178, 171, 152, 166, 69, 174, 15, 80, 168, 131, 95, 56, 48, 63, 82, 147, 51, 108, 52, 30, 139, 22, 37, 173, 112, 191, 98, 116, 149, 167, 142, 29, 154, 92, 94, 71, 117, 79, 122, 129, 24, 81, 105, 97, 137, 128, 1, 113, 170, 119, 7, 158, 76, 19, 183, 68, 31, 50, 118, 33, 72, 55, 65, 146, 185, 111, 145, 28, 21, 177, 160, 32, 61, 70, 106, 156, 78, 132, 88, 184, 35, 5, 53, 138, 47, 100, 10, 42, 36, 175, 93, 120, 190, 16, 123, 87, 54, 186, 18, 57, 84, 99, 12, 163, 157,
Petição 870190072829, de 30/07/2019, pág. 76/479 / 233
188, 64, 38, 26, 2, 136, 40, 169, 90, 107, 46, 172, 49, 6, 39, 44, 150, 85, 0, 17, 127, 155, 110, 34, 96, 74, 86, 187, 89, 151, 43, 179, 161, 73, 23, 3, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da matriz de informação para cada 360 colunas, e é
1031 4123 6253 6610 8007 8656 9181 9404 9596 11501 11654 11710 11994 12177
399 553 1442 2820 4402 4823 5011 5493 7070 8340 8500 9054 11201 11387
201 607 1428 2354 5358 5524 6617 6785 7708 10220 11970 12268 12339 12537
992 1930 4525 5837 6283 6887 7284 7489 7550 10329 11202 11399 12795
589 1564 1747 2960 3833 4502 7491 7746 8196 9567 9574 10187 10591 12947
804 1177 1414 3765 4745 7594 9126 9230 9251 10299 10336 11563 11844 12209
2774 2830 3918 4148 4963 5356 7125 7645 7868 8137 9119 9189 9206 12363
448 947 3622 5139 8115 9364 9548 9609 9750 10212 10937 11044 12668
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1583 2059 3398 3619 4277 6896 7484 7525 8284 9318 9817
Petição 870190072829, de 30/07/2019, pág. 77/479 / 233
10227 11636 12204
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11467 11507 12902
861 1054 1177 1201 1383 2538 4563 6451 6800 10540 11222
11757 12240 12732
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10240 10796 11100
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10274 12683 12702
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9937 10184
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11507 12700
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9488 10119
Petição 870190072829, de 30/07/2019, pág. 78/479
70/233
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11660 12021
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Petição 870190072829, de 30/07/2019, pág. 79/479
71/233
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Petição 870190072829, de 30/07/2019, pág. 80/479
72/233
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Petição 870190072829, de 30/07/2019, pág. 81/479
73/233
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Petição 870190072829, de 30/07/2019, pág. 82/479 / 233
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2536 9712 9932
4104 7040 9983
6365 11604 12457
3393 10323 10743
724 2237 5455
108 1705 6151.
[0020] No primeiro método de transmissão da presente tecnologia, a codificação LDPC é realizada com base na matriz de verificação de paridade do código LDPC que tem o comprimento de código N de 69.120 bits e a taxa de codificação r de 3/16, e a intercalação grupo a grupo para intercalar o código LDPC em unidades de grupos de bits de 360 bits é realizada. Então, o
Petição 870190072829, de 30/07/2019, pág. 83/479 / 233 código LDPC é mapeado para qualquer um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits. Na intercalação grupo a grupo, o (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como o grupo de bits i, e a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada na sequência de grupos de bits
154, 106, 99, 177, 191, 55, 189, 181, 22, 62, 80, 114, 110, 141, 83, 103, 169, 156, 130, 186, 92, 45, 68, 126, 112, 185, 160, 158, 17, 145, 162, 127, 152, 174, 134, 18, 157, 120, 3, 29, 13, 135, 173, 86, 73, 150, 46, 153, 33, 61, 142, 102, 171, 168, 78, 77, 139, 85, 176, 163, 128, 101, 42, 2, 14, 38, 10, 125, 90, 30, 63, 172, 47, 108, 89, 0, 32, 94, 23, 34, 59, 35, 129, 12, 146, 8, 60, 27, 147, 180, 100, 87, 184, 167, 36, 79, 138, 4, 95, 148, 72, 54, 91, 182, 28, 133, 164, 175, 123, 107, 137, 88, 44, 116, 69, 7, 31, 124, 144, 105, 170, 6, 165, 15, 161, 24, 58, 70, 11, 56, 143, 111, 104, 74, 67, 109, 82, 21, 52, 9, 71, 48, 26, 117, 50, 149, 140, 20, 57, 136, 113, 64, 151, 190, 131, 19, 51, 96, 76, 1, 97, 40, 53, 84, 166, 75, 159, 98, 81, 49, 66, 188, 118, 39, 132, 187, 25, 119, 41, 122, 16, 5, 93, 115, 178, 65, 121, 37, 155, 183, 43, 179. A tabela de valor inicial da matriz de verificação de paridade que define a matriz de verificação de paridade é como exposto.
[0021] No primeiro dispositivo de recepção da presente tecnologia, a sequência do código LDPC depois da intercalação grupo a grupo obtida a partir dos dados transmitidos a partir do dispositivo de transmissão que implementa o primeiro método de transmissão é retornada para a sequência original.
[0022] No segundo método de transmissão da presente tecnologia, a codificação LDPC é realizada com base na matriz de verificação de paridade do código LDPC que tem o comprimento de código N de 69.120 bits e a taxa de codificação r de 5/16, e a intercalação grupo a grupo para intercalar o código LDPC em unidades de grupos de bits de 360 bits é realizada. Então, o
Petição 870190072829, de 30/07/2019, pág. 84/479 / 233 código LDPC é mapeado para qualquer um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits. Na intercalação grupo a grupo, o (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como o grupo de bits i, e a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada na sequência de grupos de bits
1, 182, 125, 0, 121, 47, 63, 154, 76, 99, 82, 163, 102, 166, 28, 189, 56, 67, 54, 39, 40, 185, 184, 65, 179, 4, 91, 87, 137, 170, 98, 71, 169, 49, 73, 37, 11, 143, 150, 123, 93, 62, 3, 50, 26, 140, 178, 95, 183, 33, 21, 53, 112, 128, 118, 120, 106, 139, 32, 130, 173, 132, 156, 119, 83, 176, 159, 13, 145, 36, 30, 113, 2, 41, 147, 174, 94, 88, 92, 60, 165, 59, 25, 161, 100, 85, 81, 61, 138, 48, 177, 77, 6, 22, 16, 43, 115, 23, 12, 66, 70, 9, 164, 122, 58, 105, 69, 42, 38, 19, 24, 180, 175, 74, 160, 34, 101, 72, 114, 142, 20, 8, 15, 190, 144, 104, 79, 172, 148, 31, 168, 10, 107, 14, 35, 52, 134, 126, 167, 149, 116, 186,
17, 162, 151, 5, 136, 55, 44, 110, 158, 46, 191, 29, 153, 155, 117, 188, 131,
97, 146, 103, 78, 109, 129, 57, 111, 45, 68, 157, 84, 141, 89, 64, 7, 108, 152,
75, 18, 96, 133, 171, 86, 181, 127, 27, 124, 187, 135, 80, 51, 90. A tabela de valor inicial da matriz de verificação de paridade que define a matriz de verificação de paridade é como exposto.
[0023] No segundo dispositivo de recepção da presente tecnologia, a sequência do código LDPC depois da intercalação grupo a grupo obtida a partir dos dados transmitidos a partir do dispositivo de transmissão que implementa o segundo método de transmissão é retomada para a sequência original.
[0024] No terceiro método de transmissão da presente tecnologia, a codificação LDPC é realizada com base na matriz de verificação de paridade do código LDPC que tem o comprimento de código N de 69.120 bits e a taxa de codificação r de 7/16, e a intercalação grupo a grupo para intercalar o código LDPC em unidades de grupos de bits de 360 bits é realizada. Então, o
Petição 870190072829, de 30/07/2019, pág. 85/479 / 233 código LDPC é mapeado para qualquer um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits. Na intercalação grupo a grupo, o (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como o grupo de bits i, e a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada na sequência de grupos de bits
35, 75, 166, 145, 143, 184, 62, 96, 54, 63, 157, 103, 32, 43, 126, 187, 144, 91, 78, 44, 39, 109, 185, 102, 10, 68, 29, 42, 149, 83, 133, 94, 130, 27, 171, 19, 51, 165, 148, 28, 36, 33, 173, 136, 87, 82, 100, 49, 120, 152, 161, 162, 147, 71, 137, 57, 8, 53, 132, 151, 163, 123, 47, 92, 90, 60, 99, 79, 59, 108, 115, 72, 0, 12, 140, 160, 61, 180, 74, 37, 86, 117, 191, 101, 52, 15, 80, 156, 127, 81, 131, 141, 142, 31, 95, 4, 73, 64, 16, 18, 146, 70, 181, 7, 89, 124, 77, 67, 116, 21, 34, 41, 105, 113, 97, 2, 6, 55, 17, 65, 38, 48, 158, 159, 179, 5, 30, 183, 170, 135, 125, 20, 106, 186, 182, 188, 114, 1, 14, 3, 134, 178, 189, 167, 40, 119, 22, 190, 58, 23, 155, 138, 98, 84, 11, 110, 88, 46, 177, 175, 25, 150, 118, 121, 129, 168, 13, 128, 104, 69, 112, 169, 9, 45, 174, 93, 26, 56, 76, 50, 154, 139, 66, 85, 153, 107, 111, 172, 176, 164, 24, 122. A tabela de valor inicial da matriz de verificação de paridade que define a matriz de verificação de paridade é como exposto.
[0025] No terceiro dispositivo de recepção da presente tecnologia, a sequência do código LDPC depois da intercalação grupo a grupo obtida a partir dos dados transmitidos a partir do dispositivo de transmissão que implementa o terceiro método de transmissão é retomada para a sequência original.
[0026] No quarto método de transmissão da presente tecnologia, a codificação LDPC é realizada com base na matriz de verificação de paridade do código LDPC que tem o comprimento de código N de 69.120 bits e a taxa de codificação r de 9/16, e a intercalação grupo a grupo para intercalar o código LDPC em unidades de grupos de bits de 360 bits é realizada. Então, o
Petição 870190072829, de 30/07/2019, pág. 86/479
78/233 código LDPC é mapeado para qualquer um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits. Na intercalação grupo a grupo, o (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como o grupo de bits i, e a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada na sequência de grupos de bits
155, 188, 123, 132, 15, 79, 59, 119, 66, 68, 41, 175, 184, 78, 142, 32, 54, 111, 139, 134, 95, 34, 161, 150, 58, 141, 74, 112, 121, 99, 178, 179, 57, 90, 80, 21, 11, 29, 67, 104, 52, 87, 38, 81, 181, 160, 176, 16, 71, 13, 186, 171, 9, 170, 2, 177, 0, 88, 149, 190, 69, 33, 183, 146, 61, 117, 113, 6, 96, 120, 162, 23, 53, 140, 91, 128, 46, 93, 174, 126, 159, 133, 8, 152, 103, 102, 151, 143, 100, 4, 180, 166, 55, 164, 18, 49, 62, 20, 83, 7, 187, 153, 64, 37, 144, 185, 19, 114, 25, 116, 12, 173, 122, 127, 89, 115, 75, 101, 189, 124, 157, 108, 28, 165, 163, 65, 168, 77, 82, 27, 137, 86, 22, 110, 63, 148, 158, 97, 31, 105, 135, 98, 44, 70, 182, 191, 17, 156, 129, 39, 136, 169, 3, 145, 154, 109, 76, 5, 10, 106, 35, 94, 172, 45, 51, 60, 42, 50, 72, 85, 40, 118, 36, 14, 130, 131, 138, 43, 48, 125, 84, 24, 26, 1, 56, 107, 92, 147, 47, 30, 73, 167. A tabela de valor inicial da matriz de verificação de paridade que define a matriz de verificação de paridade é como exposto.
[0027] No quarto dispositivo de recepção da presente tecnologia, a sequência do código LDPC depois da intercalação grupo a grupo obtida a partir dos dados transmitidos a partir do dispositivo de transmissão que implementa o quarto método de transmissão é retomada para a sequência original.
[0028] No quinto método de transmissão da presente tecnologia, a codificação LDPC é realizada com base na matriz de verificação de paridade do código LDPC que tem o comprimento de código N de 69.120 bits e a taxa de codificação r de 11/16, e a intercalação grupo a grupo para intercalar o código LDPC em unidades de grupos de bits de 360 bits é realizada. Então, o
Petição 870190072829, de 30/07/2019, pág. 87/479 / 233 código LDPC é mapeado para qualquer um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits. Na intercalação grupo a grupo, o (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como o grupo de bits i, e a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada na sequência de grupos de bits
152, 87, 170, 33, 48, 95, 2, 184, 145, 51, 94, 164, 38, 90, 158, 70, 124, 128, 66, 111, 79, 42, 45, 141, 83, 73, 57, 119, 20, 67, 31, 179, 123, 183, 26, 188, 15, 163, 1, 133, 105, 72, 81, 153, 69, 182, 101, 180, 185, 190,
77, 6, 127, 138, 75, 59, 24, 175, 30, 186, 139, 56, 100, 176, 147, 189, 116, 131, 25, 5, 16, 117, 74, 50, 171, 114, 76, 44, 107, 135, 71, 181, 13, 43, 122,
78, 4, 58, 35, 63, 187, 98, 37, 169, 148, 7, 10, 49, 80, 161, 167, 28, 142, 46, 97, 92, 121, 112, 88, 102, 106, 173, 19, 27, 41, 172, 91, 191, 34, 118, 108, 136, 166, 155, 96, 3, 165, 103, 84, 109, 104, 53, 23, 0, 178, 17, 86, 9, 168, 134, 110, 18, 32, 146, 129, 159, 55, 154, 126, 40, 151, 174, 60, 52, 22, 149, 156, 113, 143, 11, 93, 62, 177, 64, 61, 160, 150, 65, 130, 82, 29, 115, 137, 36, 8, 157, 54, 89, 99, 120, 68, 21, 140, 14, 39, 132, 125, 12, 85, 162, 47, 144. A tabela de valor inicial da matriz de verificação de paridade que define a matriz de verificação de paridade é como exposto.
[0029] No quinto dispositivo de recepção da presente tecnologia, a sequência do código LDPC depois da intercalação grupo a grupo obtida a partir dos dados transmitidos a partir do dispositivo de transmissão que implementa o quinto método de transmissão é retomada para a sequência original.
[0030] No sexto método de transmissão da presente tecnologia, a codificação LDPC é realizada com base na matriz de verificação de paridade do código LDPC que tem o comprimento de código N de 69.120 bits e a taxa de codificação r de 13/16, e a intercalação grupo a grupo para intercalar o código LDPC em unidades de grupos de bits de 360 bits é realizada. Então, o
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80/233 código LDPC é mapeado para qualquer um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits. Na intercalação grupo a grupo, o (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como o grupo de bits i, e a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada na sequência de grupos de bits
140, 8, 176, 13, 41, 165, 27, 109, 121, 153, 58, 181, 143, 164, 103, 115, 91, 66, 60, 189, 101, 4, 14, 102, 45, 124, 104, 159, 130, 133, 135, 77, 25, 59, 180, 141, 144, 62, 114, 182, 134, 148, 11, 20, 125, 83, 162, 75,
126, 67, 9, 178, 171, 152, 166, 69, 174, 15, 80, 168, 131, 95, 56, 48, 63, 82, 147, 51, 108, 52, 30, 139, 22, 37, 173, 112, 191, 98, 116, 149, 167, 142, 29, 154, 92, 94, 71, 117, 79, 122, 129, 24, 81, 105, 97, 137, 128, 1, 113, 170, 119, 7, 158, 76, 19, 183, 68, 31, 50, 118, 33, 72, 55, 65, 146, 185, 111, 145, 28, 21, 177, 160, 32, 61, 70, 106, 156, 78, 132, 88, 184, 35, 5, 53, 138, 47, 100, 10, 42, 36, 175, 93, 120, 190, 16, 123, 87, 54, 186, 18, 57, 84, 99, 12, 163, 157, 188, 64, 38, 26, 2, 136, 40, 169, 90, 107, 46, 172, 49, 6, 39, 44, 150, 85, 0, 17,
127, 155, 110, 34, 96, 74, 86, 187, 89, 151, 43, 179, 161, 73, 23, 3. A tabela de valor inicial da matriz de verificação de paridade que define a matriz de verificação de paridade é como exposto.
[0031] No sexto dispositivo de recepção da presente tecnologia, a sequência do código LDPC depois da intercalação grupo a grupo obtida a partir dos dados transmitidos a partir do dispositivo de transmissão que implementa o sexto método de transmissão é retomada para a sequência original.
[0032] Note que o dispositivo de recepção pode ser um dispositivo independente ou pode compreender os blocos internos que configuram um dispositivo.
Efeitos da Invenção [0033] De acordo com a presente tecnologia, a qualidade de
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81/233 comunicação favorável pode ser garantida na transmissão de dados usando um código LDPC.
[0034] Note que os efeitos aqui descritos não são necessariamente limitados, e qualquer um dos efeitos descritos na presente descrição pode ser exercido.
Breve Descrição dos Desenhos [0035] A figura 1 é um diagrama para descrever uma matriz de verificação de paridade H de um código LDPC.
[0036] A figura 2 é um fluxograma que ilustra um procedimento de decodificação de um código LDPC.
[0037] A figura 3 é um diagrama que ilustra um exemplo de uma matriz de verificação de paridade de um código LDPC.
[0038] A figura 4 é um diagrama que ilustra um exemplo de um gráfico de Tanner de uma matriz de verificação de paridade.
[0039] A figura 5 é um diagrama que ilustra um exemplo de um nó variável.
[0040] A figura 6 é um diagrama que ilustra um exemplo de um nó de verificação.
[0041] A figura 7 é um diagrama que ilustra um exemplo de configuração de uma modalidade de um sistema de transmissão no qual a presente tecnologia é aplicada.
[0042] A figura 8 é um diagrama de blocos que ilustra um exemplo de configuração de um dispositivo de transmissão 11.
[0043] A figura 9 é um diagrama de blocos que ilustra um exemplo de configuração de um intercalador de bit 116.
[0044] A figura 10 é um diagrama que ilustra um exemplo de uma matriz de verificação de paridade.
[0045] A figura 11 é um diagrama que ilustra um exemplo de uma matriz de paridade.
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82/233 [0046] A figura 12 é um diagrama para descrever uma matriz de verificação de paridade de um código LDPC definido no padrão DVB-T.2.
[0047] A figura 13 é um diagrama para descrever uma matriz de verificação de paridade de um código LDPC definido no padrão DVB-T.2.
[0048] A figura 14 é um diagrama que ilustra um exemplo de um gráfico de Tanner para a decodificação de um código LDPC.
[0049] A figura 15 é um diagrama que ilustra um exemplo de uma matriz de paridade Ht que tem uma estrutura de degrau e um gráfico de Tanner correspondente à matriz de paridade Ht.
[0050] A figura 16 é um diagrama que ilustra um exemplo de uma matriz de paridade Ht de uma matriz de verificação de paridade H correspondente a um código LDPC depois da intercalação de paridade.
[0051] A figura 17 é um fluxograma para descrever um exemplo do processamento realizado pelo intercalador de bit 116 e por um mapeador 117.
[0052] A figura 18 é um diagrama de blocos que ilustra um exemplo de configuração de um codificador de LDPC 115.
[0053] A figura 19 é um fluxograma para descrever um exemplo do processamento do codificador de LDPC 115.
[0054] A figura 20 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade com uma taxa de codificação de 1/4 e um comprimento de código de 16.200.
[0055] A figura 21 é um diagrama para descrever um método de obtenção de uma matriz de verificação de paridade H a partir de uma tabela de valor inicial da matriz de verificação de paridade.
[0056] A figura 22 é um diagrama que ilustra uma estrutura de uma matriz de verificação de paridade.
[0057] A figura 23 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade.
[0058] A figura 24 é um diagrama para descrever uma matriz A
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83/233 gerada a partir de uma tabela de valor inicial da matriz de verificação de paridade.
[0059] A figura 25 é um diagrama para descrever a intercalação de paridade de uma matriz B.
[0060] A figura 26 é um diagrama para descrever uma matriz C gerada a partir de uma tabela de valor inicial da matriz de verificação de paridade.
[0061] A figura 27 é um diagrama para descrever a intercalação de paridade de uma matriz D.
[0062] A figura 28 é um diagrama que ilustra uma matriz de verificação de paridade na qual a permuta de coluna é realizada como a desintercalação de paridade para restaurar a intercalação de paridade para uma matriz de verificação de paridade.
[0063] A figura 29 é um diagrama que ilustra uma matriz de verificação de paridade transformada obtida pela realização da permuta de linha para uma matriz de verificação de paridade.
[0064] A figura 30 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 2/16.
[0065] A figura 31 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 3/16.
[0066] A figura 32 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 3/16.
[0067] A figura 33 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 4/16.
[0068] A figura 34 é um diagrama que ilustra um exemplo de uma
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84/233 tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 5/16.
[0069] A figura 35 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 5/16.
[0070] A figura 36 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 6/16.
[0071] A figura 37 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 6/16.
[0072] A figura 38 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 7/16.
[0073] A figura 39 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 7/16.
[0074] A figura 40 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 8/16.
[0075] A figura 41 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo A que tem N = 69.120 bits e r = 8/16.
[0076] A figura 42 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 7/16.
[0077] A figura 43 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 7/16.
Petição 870190072829, de 30/07/2019, pág. 93/479 / 233 [0078] A figura 44 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 7/16.
[0079] A figura 45 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 7/16.
[0080] A figura 46 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 8/16.
[0081] A figura 47 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 8/16.
[0082] A figura 48 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 8/16.
[0083] A figura 49 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 8/16.
[0084] A figura 50 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 9/16.
[0085] A figura 51 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 9/16.
[0086] A figura 52 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 9/16.
[0087] A figura 53 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código
Petição 870190072829, de 30/07/2019, pág. 94/479 / 233 tipo B que tem N = 69.120 bits e r = 9/16.
[0088] A figura 54 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 9/16.
[0089] A figura 55 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 9/16.
[0090] A figura 56 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 10/16.
[0091] A figura 57 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 10/16.
[0092] A figura 58 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 10/16.
[0093] A figura 59 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 10/16.
[0094] A figura 60 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 10/16.
[0095] A figura 61 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 10/16.
[0096] A figura 62 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 11/16.
[0097] A figura 63 é um diagrama que ilustra o exemplo de uma
Petição 870190072829, de 30/07/2019, pág. 95/479 / 233 tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 11/16.
[0098] A figura 64 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 11/16.
[0099] A figura 65 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 11/16.
[00100] A figura 66 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 11/16.
[00101] A figura 67 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 11/16.
[00102] A figura 68 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 12/16.
[00103] A figura 69 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 12/16.
[00104] A figura 70 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 12/16.
[00105] A figura 71 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 12/16.
[00106] A figura 72 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 12/16.
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88/233 [00107] A figura 73 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 12/16.
[00108] A figura 74 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 13/16.
[00109] A figura 75 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 13/16.
[00110] A figura 76 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 13/16.
[00111] A figura 77 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 13/16.
[00112] A figura 78 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 13/16.
[00113] A figura 79 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 13/16.
[00114] A figura 80 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 14/16.
[00115] A figura 81 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 14/16.
[00116] A figura 82 é um diagrama que ilustra o exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo
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B que tem N = 69.120 bits e r = 14/16.
[00117] A figura 83 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 14/16.
[00118] A figura 84 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 14/16.
[00119] A figura 85 é um diagrama que ilustra um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade de um código tipo B que tem N = 69.120 bits e r = 14/16.
[00120] A figura 86 é um diagrama que ilustra um exemplo de um gráfico de Tanner de um ajuntamento de sequência de graus com um peso de coluna de 3 e um peso de linha de 6.
[00121] A figura 87 é um diagrama que ilustra um exemplo de um gráfico de Tanner de um ajuntamento tipo multibordas.
[00122] A figura 88 é um diagrama para verificação de paridade por um método tipo A.
[00123] A figura 89 é um diagrama para verificação de paridade por um método tipo A.
[00124] A figura 90 é um diagrama para verificação de paridade por um método tipo B.
[00125] A figura 91 é um diagrama para verificação de paridade por um método tipo B.
[00126] A figura 92 é um diagrama que ilustra um exemplo das coordenadas de um ponto de sinal de UC em um caso em que um método de modulação for QPSK.
[00127] A figura 93 é um diagrama que ilustra um exemplo das coordenadas de um ponto de sinal de NUC 2D em um caso em que um método de modulação for 16QAM.
descrever matriz uma de descrever matriz uma de descrever matriz uma de descrever matriz uma de
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90/233 [00128] A figura 94 é um diagrama que ilustra um exemplo das coordenadas de um ponto de sinal de NUC 1D em um caso em que um método de modulação for 1024QAM.
[00129] A figura 95 é um diagrama que ilustra o relacionamento entre um símbolo y de 1024QAM e cada uma da parte real Re (zs) e da parte imaginária Im (zs) de um número complexo como as coordenadas do ponto de sinal zs NUC 1D correspondente ao símbolo y.
[00130] A figura 96 é um diagrama que ilustra um exemplodas coordenadas zq de um ponto de sinal de QPSK-UC.
[00131] A figura 97 é um diagrama que ilustra um exemplodas coordenadas zq de um ponto de sinal de QPSK-UC.
[00132] A figura 98 é um diagrama que ilustra um exemplodas coordenadas zq de um ponto de sinal de 16QAM-UC.
[00133] A figura 99 é um diagrama que ilustra um exemplo das coordenadas zq de um ponto de sinal de 16QAM-UC.
[00134] A figura 100 é um diagrama que ilustra um exemplo das coordenadas zq de um ponto de sinal de 64QAM-UC.
[00135] A figura 101 é um diagrama que ilustra um exemplo das coordenadas zq de um ponto de sinal de 64QAM-UC.
[00136] A figura 102 é um diagrama que ilustra um exemplo das coordenadas zq de um ponto de sinal de 256QAM-UC.
[00137] A figura 103 é um diagrama que ilustra um exemplo das coordenadas zq de um ponto de sinal de 256QAM-UC.
[00138] A figura 104 é um diagrama que ilustra um exemplo das coordenadas zq de um ponto de sinal de 1024QAM-UC.
[00139] A figura 105 é um diagrama que ilustra um exemplo das coordenadas zq de um ponto de sinal de 1024QAM-UC.
[00140] A figura 106 é um diagrama que ilustra um exemplo das coordenadas zq de um ponto de sinal de 4096QAM-UC.
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91/233 [00141] A figura 107 é um diagrama que ilustra um exemplo das coordenadas zq de um ponto de sinal de 4096QAM-UC.
[00142] A figura 108 é um diagrama para descrever a intercalação de bloco realizada por um intercalador de bloco 25.
[00143] A figura 109 é um diagrama para descrever a intercalação de bloco realizada pelo intercalador de bloco 25.
[00144] A figura 110 é um diagrama para descrever a intercalação grupo a grupo realizada por um intercalador grupo a grupo 24.
[00145] A figura 111 é um diagrama que ilustra um primeiro exemplo de um padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00146] A figura 112 é um diagrama que ilustra um segundo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00147] A figura 113 é um diagrama que ilustra um terceiro exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00148] A figura 114 é um diagrama que ilustra um quarto exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00149] A figura 115 é um diagrama que ilustra um quinto exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00150] A figura 116 é um diagrama que ilustra um sexto exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00151] A figura 117 é um diagrama que ilustra um sétimo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
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92/233 [00152] A figura 118 é um diagrama que ilustra um oitavo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00153] A figura 119 é um diagrama que ilustra um nono exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00154] A figura 120 é um diagrama que ilustra um décimo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00155] A figura 121 é um diagrama que ilustra um décimo primeiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00156] A figura 122 é um diagrama que ilustra um décimo segundo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00157] A figura 123 é um diagrama que ilustra um décimo terceiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00158] A figura 124 é um diagrama que ilustra um décimo quarto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00159] A figura 125 é um diagrama que ilustra um décimo quinto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00160] A figura 126 é um diagrama que ilustra um décimo sexto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00161] A figura 127 é um diagrama que ilustra um décimo sétimo exemplo do padrão GW para um código LDPC com um comprimento de
Petição 870190072829, de 30/07/2019, pág. 101/479 / 233 código N de 69.120 bits.
[00162] A figura 128 é um diagrama que ilustra um décimo oitavo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00163] A figura 129 é um diagrama que ilustra um décimo nono exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00164] A figura 130 é um diagrama que ilustra o vigésimo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00165] A figura 131 é um diagrama que ilustra um vigésimo primeiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00166] A figura 132 é um diagrama que ilustra um vigésimo segundo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00167] A figura 133 é um diagrama que ilustra um vigésimo terceiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00168] A figura 134 é um diagrama que ilustra um vigésimo quarto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00169] A figura 135 é um diagrama que ilustra um vigésimo quinto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00170] A figura 136 é um diagrama que ilustra um vigésimo sexto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00171] A figura 137 é um diagrama que ilustra um vigésimo sétimo
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94/233 exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00172] A figura 138 é um diagrama que ilustra um vigésimo oitavo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00173] A figura 139 é um diagrama que ilustra um vigésimo nono exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00174] A figura 140 é um diagrama que ilustra trigésimo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00175] A figura 141 é um diagrama que ilustra um trigésimo primeiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00176] A figura 142 é um diagrama que ilustra um trigésimo segundo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00177] A figura 143 é um diagrama que ilustra um trigésimo terceiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00178] A figura 144 é um diagrama que ilustra um trigésimo quarto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00179] A figura 145 é uma figura que ilustra um trigésimo quinto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00180] A figura 146 é um diagrama que ilustra um trigésimo sexto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
Petição 870190072829, de 30/07/2019, pág. 103/479 / 233 [00181] A figura 147 é um diagrama que ilustra um trigésimo sétimo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00182] A figura 148 é um diagrama que ilustra um trigésimo oitavo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00183] A figura 149 é um diagrama que ilustra um trigésimo nono exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00184] A figura 150 é um diagrama que ilustra um quadragésimo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00185] A figura 151 é um diagrama que ilustra um quadragésimo primeiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00186] A figura 152 é um diagrama que ilustra um quadragésimo segundo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00187] A figura 153 é um diagrama que ilustra um quadragésimo terceiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00188] A figura 154 é um diagrama que ilustra um quadragésimo quarto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00189] A figura 155 é um diagrama que ilustra um quadragésimo quinto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00190] A figura 156 é um diagrama de blocos que ilustra um exemplo de configuração de um dispositivo de recepção 12.
Petição 870190072829, de 30/07/2019, pág. 104/479 / 233 [00191] A figura 157 é um diagrama de blocos que ilustra um exemplo de configuração de um desintercalador de bit 165.
[00192] A figura 158 é um fluxograma para descrever um exemplo do processamento realizado por um desmapeador 164, pelo desintercalador de bit 165 e por um decodificador de LDPC 166.
[00193] A figura 159 é um diagrama que ilustra um exemplo de uma matriz de verificação de paridade de um código LDPC.
[00194] A figura 160 é um diagrama que ilustra um exemplo de uma matriz (matriz de verificação de paridade transformada) obtida pela realização da permuta de linha e da permuta de coluna para uma matriz de verificação de paridade.
[00195] A figura 161 é um diagrama que ilustra um exemplo de uma matriz de verificação de paridade transformada dividida em unidades 5x5.
[00196] A figura 162 é um diagrama de blocos que ilustra um exemplo de configuração de um dispositivo de decodificação que realiza coletivamente P operações de nó.
[00197] A figura 163 é um diagrama de blocos que ilustra um exemplo de configuração do decodificador de LDPC 166.
[00198] A figura 164 é um diagrama para descrever a desintercalação de bloco realizada por um desintercalador de bloco 54.
[00199] A figura 165 é um diagrama de blocos que ilustra um outro exemplo de configuração do desintercalador de bit 165.
[00200] A figura 166 é um diagrama de blocos que ilustra um primeiro exemplo de configuração de um sistema de recepção no qual o dispositivo de recepção 12 é aplicável.
[00201] A figura 167 é um diagrama de blocos que ilustra um segundo exemplo de configuração do sistema de recepção no qual o dispositivo de recepção 12 é aplicável.
[00202] A figura 168 é um diagrama de blocos que ilustra um terceiro
Petição 870190072829, de 30/07/2019, pág. 105/479 / 233 exemplo de configuração do sistema de recepção no qual o dispositivo de recepção 12 é aplicável.
[00203] A figura 169 é um diagrama de blocos que ilustra um exemplo de configuração de uma modalidade de um computador no qual a presente tecnologia é aplicada.
Modo para Realizar a Invenção [00204] A seguir, as modalidades da presente tecnologia serão descritas. Antes da descrição das modalidades, um código LDPC será descrito.
<Código LDPC>
[00205] Note que o código LDPC é um código linear e não necessariamente é binário. Entretanto, a descrição será dada na consideração de que o código LDPC é binário.
[00206] Um código LDPC é mais caracterizado em que uma matriz de verificação de paridade que define o código LDPC é esparsa. Aqui, uma matriz esparsa é uma matriz na qual o número de “l”s de elementos de matriz é muito pequeno (uma matriz na qual a maioria dos elementos é 0).
[00207] A figura 1 é um diagrama que ilustra uma matriz de verificação de paridade H do código LDPC.
[00208] Na matriz de verificação de paridade H na figura 1, um peso (peso de coluna) (número de “l”s) (peso) de cada coluna é “3”, e um peso (peso de linha) de cada linha é “6”.
[00209] Na codificação (codificação LDPC) com um código LDPC, por exemplo, uma palavra código (código LDPC) é gerada pela geração de uma matriz geradora G com base na matriz de verificação de paridade H e pela multiplicação dos bits de informação binários pela matriz geradora G.
[00210] Especificamente, um dispositivo de codificação para realizar a codificação LDPC, primeiro, calcula a matriz geradora G que mantém uma equação GHT = 0 com uma matriz transposta Ht da matriz de verificação de
Petição 870190072829, de 30/07/2019, pág. 106/479 / 233 paridade H. Aqui, em um caso em que a matriz geradora G for uma matriz K x N, o dispositivo de codificação multiplica a matriz geradora G por uma sequência de bits (vetor u) dos bits de informação que incluem K bits e gera uma palavra código c (= uG) que inclui N bits. A palavra código (código LDPC) gerada pelo dispositivo de codificação é recebida em um lado de recepção por meio de um caminho de comunicação predeterminado.
[00211] A decodificação do código LDPC pode ser realizada por um algoritmo chamado de decodificação probabilística proposto por Gallager, que é um algoritmo de passagem de mensagem de acordo com a propagação de crença em um assim denominado gráfico de Tanner que inclui um nó variável (também chamado de nó de mensagem) e um nó de verificação. Aqui, conforme apropriado, o nó variável e o nó de verificação também são, a seguir, simplesmente referidos como nós.
[00212] A figura 2 é um fluxograma que ilustra um procedimento de decodificação de um código LDPC.
[00213] Note que, a seguir, um valor real (LLR recebido) que expressa “0” probabilidade de um valor de um i-ésimo bit de código do código LDPC (1 palavra código) recebido no lado de recepção usando uma razão de probabilidade logarítmica também é referido como um valor recebido uoí conforme apropriado. Além do mais, uma mensagem transmitida a partir do nó de verificação é Uj e uma mensagem transmitida a partir do nó variável é Vi.
[00214] Primeiro, na decodificação do código LDPC, da forma ilustrada na figura 2, na etapa Sll, o código LDPC é recebido, uma mensagem (mensagem do nó de verificação) Uj é inicializada em “0”, uma variável k, que é um número inteiro como um contador para o processamento repetido, é inicializada em “0”, e o processamento prossegue para a etapa S12. Na etapa SI2, uma mensagem (mensagem do nó variável) Vi é obtida pela realização de uma operação (operação do nó variável) ilustrada na
Petição 870190072829, de 30/07/2019, pág. 107/479 / 233 expressão (1) com base no valor recebido uoí obtido pela recepção do código LDPC e, além do mais, uma mensagem Uj é obtida pela realização de uma operação (operação do nó de verificação) ilustrada na expressão (2) com base na mensagem Vj.
[Expressão 1] dv-1 v i=υθ j + y u j j=1 ...(1) [Expressão 2] tanh Hy-) = Π tanh (Λη \ Z / i=1 \ Z / ... (2) [00215] Aqui, d...v e dc nas expressões (1) e (2) são parâmetros arbitrariamente selecionáveis que indicam, respectivamente, os números de “l”s em um direção vertical (coluna) e uma direção transversal (linha) da matriz de verificação de paridade H. Por exemplo, no caso do código LDPC (código LDPC (3, 6)) para a matriz de verificação de paridade H com o peso de coluna de 3 e o peso de linha de 6, da forma ilustrada na figura 1, dv = 3 e dc = 6.
[00216] Note que, em cada uma da operação do nó variável na expressão (1) e da operação do nó de verificação em (2), uma mensagem inserida a partir de uma borda (uma linha que conecta o nó variável e o nó de verificação) para transmitir uma mensagem não é um objeto para a operação. Portanto, uma faixa de operação é 1 a dv-l ou 1 a dc-l. Além do mais, a operação do nó de verificação na expressão (2) é realizada, na prática, pela criação de uma tabela de uma função R (vi, v...2) ilustrada na expressão (3) definida por uma saída para duas entradas vi e v...2, em antecipação, e usando a tabela continuamente (recursivamente), da forma ilustrada na expressão (4). [Expressão 3] x=2tanh~1 [tanh (v!/2) tanh (v2/2)} =R (vi, v2) [Expressão 4]
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100/233
Uj=R(vi,R(v2, R(v3. RCv^-í, v^-i)))) (4) [00217] Na etapa SI2, a variável k é adicionalmente incrementada em “1”, e o processamento prossegue para a etapa S13. Na etapa S13, se a variável k é maior do que um número predeterminado de decodificações iterativas C ou não é determinado. Em um caso em que for determinado que a variável k não é maior do que C na etapa SI3, o processamento retorna para a etapa S12 e, a seguir, um processamento similar é repetido.
[00218] Além do mais, em um caso em que for determinado que a variável k é maior do que C na etapa SI3, o processamento prossegue para a etapa SI4, a operação ilustrada na expressão (5) é realizada para obter a mensagem ví como um resultado da decodificação a ser finalmente transmitido e a mensagem ví é transmitida, e o processamento de decodificação para o código LDPC é terminado.
[Expressão 5] dv
Vi=UOj+ Σ Uj j=1 ...(5) [00219] Aqui, a operação na expressão (5) é realizada usando as mensagens Uj provenientes de todas as bordas conectadas no nó variável, diferente da operação do nó variável na expressão (1).
[00220] A figura 3 é um diagrama que ilustra um exemplo da matriz de verificação de paridade H de um código LDPC (3, 6) (uma taxa de codificação de 1/2 e um comprimento de código de 12).
[00221] Na matriz de verificação de paridade H na figura 3, como na figura 1, o peso de coluna é 3 e o peso de linha é 6.
[00222] A figura 4 é um diagrama que ilustra um gráfico de Tanner da matriz de verificação de paridade H na figura 3.
[00223] Aqui, na figura 4, o nó de verificação é representado por mais “+”, e o nó variável é representado por igual “=”. O nó de verificação e o nó variável correspondem a uma linha e uma coluna da matriz de verificação de
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101/233 paridade H, respectivamente. Uma conexão entre o nó de verificação e o nó variável é uma borda e corresponde a “1” de um elemento da matriz de verificação de paridade.
[00224] Em outras palavras, em um caso em que o elemento da j-ésima linha e da i-ésima coluna da matriz de verificação de paridade for 1, o i-ésimo nó variável a partir do topo (nó “=”) e o j-ésimo nó de verificação a partir do topo (nó “+”) são conectados por uma borda na figura 4. A borda indica que um bit de código correspondente ao nó variável tem uma restrição correspondente ao nó de verificação.
[00225] Em um algoritmo de soma-produto, que é um método de decodificação de um código LDPC, a operação do nó variável e a operação do nó de verificação são repetidamente realizadas.
[00226] A figura 5 é um diagrama que ilustra a operação do nó variável realizada no nó variável.
[00227] No nó variável, a mensagem ví correspondente à borda a ser calculada é obtida pela operação do nó variável na expressão (1) usando as mensagens ui e U2 e o valor recebido uoí das bordas restantes conectadas no nó variável. As mensagens correspondentes a outras bordas são similarmente obtidas.
[00228] A figura 6 é um diagrama que ilustra a operação do nó de verificação realizada no nó de verificação.
[00229] Aqui, a operação do nó de verificação na expressão (2) pode ser rescrita na expressão (6), usando um relacionamento de uma expressão a x b = exp {In(lal) + In(lbl)} x sign (a) x sign (b). Note que sign (x) é 1 quando x > 0 e -1 quando x < 0.
[Expressão 6]
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102/233 /“c 1 / V; >
Uj=2tanh_1 Π tanh \ i =1 \ £ J
2tanh 1 expj Σ In tanh
Vi =2tanh 1 expV ( Hvil Σ - In tanh —5— i=1 \ Z dc-1 x π sign(Vj) i=1 -(6) [00230] Quando a função φ(χ) for definida como uma expressão φ(χ) = ln(tan h(x/2)) quando x > 0, uma expressão φ-1(χ) = 2tan h-l(e-x) se mantém e, assim, a expressão (6) pode ser deformada na expressão (7).
[Expressão 7] /dc-1 \ dc-1
Ui = 0_1 Z0(|vj|) x Π sign(Vj) \i=1 / i=1 ...(7) [00231] No nó de verificação, a operação do nó de verificação na expressão (2) é realizada de acordo com a expressão (7).
[00232] Em outras palavras, no nó de verificação, a mensagem Uj correspondente à borda a ser calculada é obtida pela operação do nó de verificação na expressão (7) usando as mensagens vi, v2, v3, v4, e v5 provenientes das bordas restantes conectadas no nó de verificação, da forma ilustrada na figura 6. As mensagens correspondentes a outras bordas são similarmente obtidas.
[00233] Note que a função φ(χ) na expressão (7) pode ser expressada pela expressão φ(χ) = ln((ex + l)/(ex - 1)), e φ(χ) = φ-1(χ) se mantém quando x > 0. Quando as funções φ(χ) e φ-1(χ) forem implementadas em hardware, as funções podem ser implementadas usando as tabelas de pesquisa (LUTs), e as LUTs são as mesmas.
<Exemplo de configuração do sistema de transmissão no qual a presente tecnologia é aplicada>
[00234] A figura 7 é um diagrama que ilustra um exemplo de configuração de uma modalidade de um sistema de transmissão (um sistema é um grupo de uma pluralidade de dispositivos logicamente reunidos, e se os
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103/233 dispositivos de configurações estão ou não no mesmo invólucro é irrelevante) nos quais a presente tecnologia é aplicada.
[00235] O sistema de transmissão na figura 7 é configurado por um dispositivo de transmissão lie um dispositivo de recepção 12.
[00236] O dispositivo de transmissão 11 realiza a transmissão (difusão) de, por exemplo, um programa de difusão por televisão ou semelhantes. Em outras palavras, o dispositivo de transmissão 11 codifica os dados alvos que serão transmitidos, tais como dados de imagem e dados de áudio como um programa, em um código LDPC, e transmite o código LDPC por meio de um caminho de comunicação 13, tais como uma linha de satélite, uma onda terrestre, ou um cabo (linha com fios), por exemplo.
[00237] O dispositivo de recepção 12 recebe o código LDPC transmitido a partir do dispositivo de transmissão 11 por meio do caminho de comunicação 13, decodifica o código LDPC nos dados alvos, e transmite os dados.
[00238] Aqui, é conhecido que o código LDPC usado no sistema de transmissão na figura 7 exibe capacidade extremamente alta em um caminho de comunicação com ruído Gaussiano branco aditivo (AWGN).
[00239] Neste ínterim, no caminho de comunicação 13, erros de surto e apagamentos podem ocorrer. Por exemplo, em particular, em um caso em que o caminho de comunicação 13 for uma onda terrestre, a potência de um certo símbolo toma-se zero (apagamento) em alguns casos de acordo com um atraso de um eco (um caminho diferente de um caminho principal) em um ambiente multicaminhos em que uma razão de desejado por indesejado (D/U) é 0 dB (potência de indesejado = eco é igual a potência de desejado = caminho principal) em um sistema de multiplexação por divisão de frequência ortogonal (OFDM).
[00240] Também, a potência da íntegra dos símbolos de OFDM em um tempo específico pode se tomar zero (apagamento) devido a uma frequência
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104/233 de Doppler no caso em que D/U for 0 dB em uma distorção tipo flutter (um caminho de comunicação no qual um atraso é 0 e no qual um eco com frequência de Doppler é adicionado).
[00241] Além do mais, um erro de surto pode ocorrer devido a uma condição de fiação de uma unidade de recepção (não ilustrada) no lado do dispositivo de recepção 12, tal como uma antena que recebe um sinal a partir do dispositivo de transmissão 11 para o dispositivo de recepção 12, e à instabilidade do suprimento de energia do dispositivo de recepção 12.
[00242] Neste ínterim, na decodificação do código LDPC, a operação do nó variável na expressão (1) com a adição do (o valor recebido uoí do) bit de código do código LDPC é realizada, da forma ilustrada na figura 5, em uma coluna da matriz de verificação de paridade H e, assim, em um nó variável correspondente ao bit de código do código LDPC. Portanto, se um erro ocorrer no bit de código usado na operação do nó variável, a precisão de uma mensagem obtida diminui.
[00243] Então, na decodificação do código LDPC, o cálculo pelo nó de verificação da expressão (7) é realizado usando uma mensagem obtida pelo nó variável conectado no nó de verificação no nó de verificação, então, se o número de nós de verificação nos quais (os bits de código do código LDPC correspondente a) uma pluralidade de nós variáveis conectados simultaneamente causam erros (incluindo apagamentos) aumentar, o desempenho da decodificação é degradado.
[00244] Em outras palavras, por exemplo, se dois ou mais dos nós variáveis conectados no nó de verificação se tomarem apagamentos ao mesmo tempo, o nó de verificação retoma uma mensagem em que a probabilidade do valor de 0 e a probabilidade do valor de 1 são iguais para todos os nós variáveis. Neste caso, o nó de verificação que retoma a mensagem de probabilidade igual não irá contribuir para um processamento de decodificação (um conjunto de operação do nó variável e operação do nó
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105/233 de verificação). Em decorrência disto, um grande número de repetições do processamento de decodificação é exigido. Como resultado, o desempenho da decodificação é degradado, e o consumo de energia do dispositivo de recepção 12 que decodifica o código LDPC aumenta.
[00245] Portanto, no sistema de transmissão na figura 7, a melhoria da resistência aos erros de surto e ao apagamento é possível, ao mesmo tempo em que se mantém o desempenho no caminho de comunicação de AWGN (canal de AWGN).
<Exemplo de configuração do dispositivo de transmissão 11>
[00246] A figura 8 é um diagrama de blocos que ilustra um exemplo de configuração do dispositivo de transmissão 11 na figura 7.
[00247] No dispositivo de transmissão 11, um ou mais fluxos contínuos de entrada como os dados alvos são supridos para uma adaptação de modo/multiplexador 111.
[00248] A adaptação de modo/multiplexador 111 realiza o processamento, tais como seleção de modo e multiplexação dos um ou mais fluxos contínuos de entrada supridos para o mesmo, conforme necessário, e supre os dados resultantes para um preenchedor 112.
[00249] O preenchedor 112 realiza o preenchimento de zero necessário (inserção de nulo) nos dados provenientes da adaptação de modo/multiplexador 111, e supre os dados resultantes para um embaralhador de banda base (BB) 113.
[00250] O embaralhador de BB 113 aplica embaralhamento de BB nos dados provenientes do preenchedor 112, e supre os dados resultantes para um codificador de BCH 114.
[00251] O codificador de BCH 114 BCH codifica os dados provenientes do embaralhador de BB 113, e supre os dados resultantes para um codificador de LDPC 115 como dados LDPC alvos que serão sujeitos a codificação LDPC.
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106/233 [00252] O codificador de LDPC 115 realiza, para os dados LDPC alvos provenientes do codificador de BCH 114, a codificação LDPC de acordo com uma matriz de verificação de paridade na qual uma matriz de paridade que é uma parte correspondente aos bits de paridade do código LDPC tem uma estrutura de degrau (diagonal dual) ou semelhantes, por exemplo, e transmite o código LDPC que tem os dados LDPC alvos como os bits de informação.
[00253] Em outras palavras, o codificador de LDPC 115 realiza a codificação LDPC para a codificação dos dados LDPC alvos para um código LDPC (correspondente à matriz de verificação de paridade) definido em um padrão predeterminado, tais como DVB-S.2, DVB-T.2, DVB-C.2, ou ATSC 3.0, ou um outro código LDPC, por exemplo, e transmite um código LDPC resultante.
[00254] Aqui, o código LDPC definido no padrão DVB-S.2 ou ATSC 3.0 e o código LDPC a ser adotado em ATSC 3.0 é um código de acúmulo de repetição irregular (IRA), e (uma parte de ou toda) uma matriz de paridade na matriz de verificação de paridade do código LDPC tem uma estrutura de degrau. A matriz de paridade e a estrutura de degrau serão descritas a seguir. Além do mais, o código IRA é descrito, por exemplo, em “Irregular RepeatAccumulate Codes ', H. Jin, A. Khandekar, and R. J. McEliece, in Proceedings of 2nd International Symposium on Turbo codes and Related Topics, páginas 1-8, setembro de 2000.
[00255] O código LDPC transmitido pelo codificador de LDPC 115 é suprido para um intercalador de bit 116.
[00256] O intercalador de bit 116 realiza a intercalação de bits descrita a seguir para o código LDPC proveniente do codificador de LDPC 115, e supre o código LDPC depois da intercalação de bits para um mapeador (Mapeador) 117.
[00257] O mapeador 117 mapeia o código LDPC proveniente do intercalador de bit 116 em pontos de sinal que representam um símbolo de
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107/233 modulação por quadratura em unidades de um ou mais bits de código (unidades de símbolo) do código LDPC e realiza a modulação por quadratura (modulação de múltiplos valores).
[00258] Em outras palavras, o mapeador 117 mapeia o código LDPC proveniente do intercalador de bit 116 em pontos de sinal determinados por um método de modulação para realizar a modulação por quadratura do código LDPC, em uma constelação que é um plano IQ definido com um eixo geométrico I que representa um componente I em fase com uma portadora e um eixo geométrico Q que representa um componente Q ortogonal à portadora, e realiza a modulação por quadratura.
[00259] Em um caso em que o número de pontos de sinal de constelação usados no método de modulação da modulação por quadratura realizado pelo mapeador 117 é 2m, o mapeador 117 mapeia o código LDPC proveniente do intercalador de bit 116 em pontos de sinal que representam símbolos, dos 2m pontos de sinal em unidades de símbolo, em que os bits de código de m bits do código LDPC compreendem um símbolo (um símbolo).
[00260] Aqui, os exemplos do método de modulação da modulação por quadratura realizado pelo mapeador 117 incluem o método de modulação definido no padrão, tais como DVB-S.2 ou ATSC 3.0, e outros métodos de modulação, tais como modulação por deslocamento de fase binária (BPSK), modulação de quadratura por deslocamento de fase (QPSK), modulação por deslocamento de fase (8PSK), modulação por deslocamento de amplitude e fase (16APSK), 32APSK, modulação por amplitude de quadratura (16QAM), 16QAM, 64QAM, 256QAM, 1024QAM, 4096QAM e modulação de amplitude de pulso (4PAM), por exemplo. Qual método de modulação da modulação por quadratura é usado no mapeador 117 é definido em antecipação de acordo com uma operação de um operador do dispositivo de transmissão 11, ou semelhantes, por exemplo.
[00261] Os dados obtidos pelo processamento no mapeador 117 (o
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108/233 resultado de mapeamento do mapeamento dos símbolos para os pontos de sinal) são supridos para um intercalador de tempo 118.
[00262] O intercalador de tempo 118 realiza a intercalação de tempo (intercalação em uma direção do tempo) em unidades de símbolo para os dados do mapeador 117, e supre os dados resultantes para um codificador tipo entrada única - saída única/múltiplas entradas - saída única (codificador SISO/MISO) 119.
[00263] O codificador SISO/MISO 119 aplica codificação de espaçotempo nos dados provenientes do intercalador de tempo 118, e supre os dados para um intercalador de frequência 120.
[00264] O intercalador de frequência 120 realiza, para os dados provenientes do codificador SISO/MISO 119, a intercalação de frequência (intercalação em uma direção da frequência) em unidades de símbolo, e supre os dados para um construtor de quadro/unidade de alocação de recurso 131.
[00265] Neste ínterim, os dados de controle (sinalização) para o controle de transmissão, tal como sinalização de banda base (BB) (cabeçalho de BB) são supridos para um codificador de BCH 121, por exemplo.
[00266] O codificador de BCH 121 realiza a codificação de BCH para os dados de controle supridos para o mesmo similarmente ao codificador de BCH 114, e supre os dados resultantes para um codificador de LDPC 122.
[00267] O codificador de LDPC 122 realiza a codificação LDPC para os dados provenientes do codificador de BCH 121 como os dados LDPC alvos, similarmente ao codificador de LDPC 115, e supre um código LDPC resultante para um mapeador 123.
[00268] O mapeador 123 mapeia o código LDPC proveniente do codificador de LDPC 122 em pontos de sinal que representam um símbolo de modulação por quadratura em unidades de um ou mais bits de código (unidades de símbolo) provenientes do código LDPC e realiza a modulação por quadratura, similarmente ao mapeador 117, e supre os dados resultantes
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109/233 para um intercalador de frequência 124.
[00269] O intercalador de frequência 124 realiza a intercalação de frequência em unidades de símbolo para os dados provenientes do mapeador 123, similarmente ao intercalador de frequência 120, e supre os dados resultantes para o construtor de quadro/unidade de alocação de recurso 131.
[00270] O construtor de quadro/unidade de alocação de recurso 131 insere os símbolos pilotos em posições necessárias dos dados (símbolos) provenientes dos intercaladores de frequência 120 e 124, e configura um quadro por um número predeterminado de símbolos (por exemplo, um quadro de camada física (PL), um quadro T2, um quadro C2 ou semelhantes) provenientes dos dados resultantes (símbolos), e supre o quadro para uma unidade de geração de OFDM 132.
[00271] A unidade de geração de OFDM 132 gera um sinal OFDM correspondente ao quadro a partir do construtor de quadro/unidade de alocação de recurso 131, e transmite o sinal OFDM por meio do caminho de comunicação 13 (figura 7).
[00272] Note que o dispositivo de transmissão 11 pode ser configurado sem incluir parte dos blocos ilustrados na figura 8, tais como o intercalador de tempo 118, o codificador SISO/MISO 119, o intercalador de frequência 120, e o intercalador de frequência 124.
<Exemplo de configuração do intercalador de bit 116>
[00273] A figura 9 é um diagrama de blocos que ilustra um exemplo de configuração do intercalador de bit 116.
[00274] O intercalador de bit 116 tem uma função para intercalar os dados, e é configurado por um intercalador de paridade 23, um intercalador grupo a grupo 24, e um intercalador de bloco 25.
[00275] O intercalador de paridade 23 realiza a intercalação de paridade para intercalar os bits de paridade do código LDPC proveniente do codificador de LDPC 115 com posições de outros bits de paridade, e supre o
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110/233 código LDPC depois da intercalação de paridade para o intercalador grupo a grupo 24.
[00276] O intercalador grupo a grupo 24 realiza a intercalação grupo a grupo para o código LDPC proveniente do intercalador de paridade 23, e supre o código LDPC depois da intercalação grupo a grupo para o intercalador de bloco 25.
[00277] Aqui, na intercalação grupo a grupo, o código LDPC proveniente do intercalador de paridade 23 é intercalado em unidades de grupos de bits, em que uma seção de 360 bits é definida como um grupo de bits, a uma seção de 360 bits sendo obtida pela divisão do código LDPC de um código em unidades de 360 bits, a unidade sendo igual a um tamanho de unidade P descrito a seguir, a partir da cabeça do código LDPC, e tomando uma das seções como a uma seção.
[00278] Em um caso de realização da intercalação grupo a grupo, a taxa de erro pode ser melhorada, se comparada com um caso de não realização da intercalação grupo a grupo. Em decorrência disto, a qualidade de comunicação favorável pode ser garantida na transmissão de dados.
[00279] O intercalador de bloco 25 realiza a intercalação de bloco para demultiplexar o código LDPC proveniente do intercalador grupo a grupo 24 para simbolizar o código LDPC de um código em símbolos de m bits, os m bits sendo a unidade de mapeamento, e supre os símbolos para o mapeador 117 (figura 8).
[00280] Aqui, na intercalação de bloco, por exemplo, o código LDPC proveniente do intercalador grupo a grupo 24 é gravado em uma direção da coluna (vertical) e é lido em uma direção da linha (transversal) em relação a uma área de armazenamento na qual as colunas como as áreas de armazenamento, cada qual armazenando um comprimento de bit predeterminado na direção da coluna, são arranjadas na direção da linha pelo número de comprimento de bit m de símbolos, de acordo com o que, o código
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LDPC é simbolizado nos símbolos de m bits.
<Matriz de verificação de paridade do código LDPC>
[00281] A figura 10 é um diagrama que ilustra um exemplo da matriz de verificação de paridade H usada para a codificação LDPC no codificador de LDPC 115 na figura 8.
[00282] A matriz de verificação de paridade H tem uma estrutura da matriz de geração de baixa densidade (LDGM) e é expressada por uma matriz de informação Ha de uma parte correspondente aos bits de informação e uma matriz de paridade Ht correspondente aos bits de paridade, do bits de código do código LDPC, como uma expressão H = [HaIHt] (os elementos da matriz de informação Ha são os elementos no lado esquerdo e os elementos da matriz de verificação de paridade Ht são os elementos no lado direito).
[00283] Aqui, o comprimento de bit dos bits de informação e o comprimento de bit dos bits de paridade, dos bits de código do código LDPC de um código (uma palavra código), são respectivamente referidos como um comprimento da informação K e um comprimento de paridade M, e o comprimento de bit dos bits de código de um (uma palavra código) código LDPC é referido como o comprimento de código N (= K + M).
[00284] O comprimento da informação K e o comprimento de paridade M de um código LDPC de um dado comprimento de código N são determinados por uma taxa de codificação. Além do mais, a matriz de verificação de paridade H é uma matriz de Μ x N em linhas x colunas (matriz de M linhas e N colunas). Então, a matriz de informação Ha é uma matriz M x K, e a matriz de paridade Ht é uma matriz Μ x M.
[00285] A figura 11 é um diagrama que ilustra um exemplo da matriz de paridade Ht da matriz de verificação de paridade H usada para a codificação LDPC no codificador de LDPC 115 na figura 8.
[00286] Como a matriz de paridade Ht da matriz de verificação de paridade H usada para a codificação LDPC no codificador de LDPC 115, uma
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112/233 matriz de paridade Ητ similar à matriz de verificação de paridade H do código LDPC definido no padrão, tal como DVB-T.2, pode ser adotada, por exemplo. [00287] A matriz de paridade Ητ da matriz de verificação de paridade H do código LDPC definido no padrão, tal como DVB-T.2, é uma matriz que tem uma estrutura de degrau (matriz bidiagonal inferior) na qual os elementos de 1 são arranjados de uma maneira tipo degrau, da forma ilustrada na figura
11.0 peso de linha da matriz de paridade Ητ é 1 na Ia linha e 2 em todas as linhas restantes. Além do mais, o peso de coluna é 1 na última coluna e 2 em todas as colunas restantes.
[00288] Da forma supradescrita, o código LDPC da matriz de verificação de paridade H que tem a matriz de paridade Ητ em uma estrutura de degrau pode ser facilmente gerado usando a matriz de verificação de paridade H.
[00289] Em outras palavras, o código LDPC (uma palavra código) é representado por um vetor de linha c, e um vetor de coluna obtido pela transposição do vetor de linha é representado como cT. Além do mais, uma parte dos bits de informação, do vetor de linha c, que é o código LDPC, é representada por um vetor de linha A, e uma parte dos bits de paridade, do vetor de linha c, é representada por um vetor de linha T.
[00290] Neste caso, o vetor de linha c pode ser expressado por uma expressão c = [AIT] (os elementos do vetor de linha A são os elementos no lado esquerdo e os elementos do vetor de linha T são os elementos no lado direito) usando o vetor de linha A como os bits de informação e o vetor de linha T como os bits de paridade.
[00291] A matriz de verificação de paridade H e o vetor de linha c = [AIT] como o código LDPC precisa satisfazer uma expressão HcT = 0 e o vetor de linha T como os bits de paridade que constituem o vetor de linha c = [AIT] que satisfaz a expressão HcT = 0 podem ser sequencialmente obtidos (em ordem) pela definição sequencial do elemento de cada linha em 0 a partir
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113/233 do elemento na Ia linha do vetor de coluna HcT na expressão HcT = 0 em um caso em que a matriz de paridade Ht da matriz de verificação de paridade H = [HaIHt] tiver a estrutura de degrau ilustrada na figura 11.
[00292] A figura 12 é um diagrama para descrever a matriz de verificação de paridade H do código LDPC definido no padrão, tal como DVB-T.2.
[00293] O peso de coluna da matriz de verificação de paridade H do código LDPC definido no padrão, tal como DVB-T.2, é X em KX colunas a partir da Ia coluna, 3 nas seguintes K3 colunas, e 2 nas seguintes M-1 colunas, e 1 na última coluna.
[00294] Aqui, KX + K3+M-l + lé igual ao comprimento de código N.
[00295] A figura 13 é um diagrama que ilustra o número de colunas KX, K3, e M e o peso de coluna X para cada taxa de codificação r do código LDPC definido no padrão, tal como DVB-T.2.
[00296] No padrão, tal como DVB-T.2, os códigos LDPC que têm comprimentos de código N de 64.800 bits e 16.200 bits são definidos.
[00297] Então, onze taxas de codificação (taxas nominais) de 1/4, 1/3, 2/5, 1/2, 3/5, 2/3, 3/4, 4/5, 5/6, 8/9, e 9/10 são definidas para o código LDPC com o comprimento de código N de 64.800 bits. Dez taxas de codificação de 1/4, 1/3, 2/5, 1/2, 3/5, 2/3, 3/4, 4/5, 5/6, e 8/9 são definidas para o código LDPC com o comprimento de código N de 16.200 bits.
[00298] Aqui, o comprimento de código N de 64.800 bits também é referido como 64 kbits e o comprimento de código N de 16.200 bits também é referido como 16 kbits.
[00299] Em relação ao código LDPC, os bits de código correspondentes a uma coluna que tem um maior peso de coluna da matriz de verificação de paridade H tendem a ter uma taxa de erro inferior.
[00300] Na matriz de verificação de paridade H definida no padrão, tal
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114/233 como DVB-T.2, ilustrada nas figuras 12 e 13, o peso de coluna tende a ser maior nas colunas no lado da cabeça (lado esquerdo) e, portanto, os bits de código no lado da cabeça são mais resistentes a erros e os últimos bits de código são mais suscetíveis a erros no código LDPC correspondente à matriz de verificação de paridade H.
<Intercalação de paridado [00301] A intercalação de paridade pelo intercalador de paridade 23 na figura 9 será descrita em relação às figuras 14 a 16.
[00302] A figura 14 é um diagrama que ilustra um exemplo de (um parte de) um gráfico de Tanner da matriz de verificação de paridade do código LDPC.
[00303] Da forma ilustrada na figura 14, quando dois ou mais dos (os bits de código correspondentes aos) nós variáveis conectados no nó de verificação se tomarem erros, tais como apagamentos ao mesmo tempo, por exemplo, o nó de verificação retoma uma mensagem em que a probabilidade do valor de 0 e a probabilidade do valor de 1 são iguais para todos os nós variáveis conectados no nó de verificação. Portanto, se uma pluralidade de nós variáveis conectados no mesmo nó de verificação simultaneamente se tomarem apagamentos ou semelhantes, o desempenho da decodificação irá deteriorar.
[00304] A propósito, o código LDPC transmitido a partir do codificador de LDPC 115 na figura 8 é um código IRA, similarmente ao código LDPC definido no padrão, tal como DVB-T.2, por exemplo, e a matriz de paridade Ht da matriz de verificação de paridade H tem uma estrutura de degrau, da forma ilustrada na figura 11.
[00305] A figura 15 é um diagrama que ilustra os exemplos da matriz de paridade Ht que tem a estmtura de degrau, da forma ilustrada na figura 11, e o gráfico de Tanner correspondente à matriz de paridade Ht.
[00306] A na figura 15 ilustra um exemplo da matriz de paridade Ht
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115/233 que tem uma estrutura de degrau, e B na figura 15 ilustra um gráfico de Tanner correspondente à matriz de paridade Ht em A na figura 15.
[00307] Na matriz de paridade Ht que tem uma estrutura de degrau, os elementos de 1 são adjacentes (exceto a Ia linha) em linhas. Portanto, no gráfico de Tanner da matriz de paridade Ht, dois nós variáveis adjacentes correspondentes às colunas dos dois elementos adjacentes nos quais os valores da matriz de paridade Ht são 1 são conectados no mesmo nó de verificação.
[00308] Portanto, quando os bits de paridade correspondentes aos dois nós variáveis adjacentes expostos se tornarem erros ao mesmo tempo devido a erros de surto, apagamentos ou semelhantes, o nó de verificação conectado nos dois nós variáveis correspondentes aos dois erro bits de paridade (nós variáveis que buscam uma mensagem usando os bits de paridade) retoma a mensagem em que a probabilidade do valor de 0 e a probabilidade do valor de 1 são iguais para os nós variáveis conectados no nó de verificação. Portanto, o desempenho da decodificação é degradado. Então, quando um comprimento do surto (o comprimento de bit dos bits de paridade que se tornam um erro em sucessão) ficar grande, o número de nós de verificação que retomam a mensagem de probabilidade igual aumenta, e o desempenho da decodificação é adicionalmente degradado.
[00309] Portanto, o intercalador de paridade 23 (figura 9) realiza a intercalação de paridade na qual os bits de paridade do código LDPC proveniente do codificador de LDPC 115 são intercalados nas posições de outros bits de paridade a fim de impedir a degradação no desempenho da decodificação supradescrita.
[00310] A figura 16 é um diagrama que ilustra a matriz de paridade Ht da matriz de verificação de paridade H correspondente ao código LDPC depois da intercalação de paridade realizada pelo intercalador de paridade 23 na figura 9.
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116/233 [00311] Aqui, a matriz de informação Ha da matriz de verificação de paridade H correspondente ao código LDPC transmitido a partir do codificador de LDPC 115 tem uma estrutura cíclica, similarmente à matriz de informação da matriz de verificação de paridade H correspondente ao código LDPC definido no padrão, tal como DVB-T.2.
[00312] A estrutura cíclica é uma estrutura na qual uma certa coluna corresponde a uma outra coluna ciclicamente deslocada, e inclui, por exemplo, uma estrutura na qual, para cada P colunas, as posições de 1 das linhas das P colunas tomam-se posições ciclicamente deslocadas na direção da coluna em um valor predeterminado, tal como um valor proporcional a um valor q obtido pela divisão da primeira coluna das P colunas pelo comprimento de paridade Μ. A seguir, as P colunas na estrutura cíclica são referidas como um tamanho de unidade, conforme apropriado.
[00313] Como o código LDPC definido no padrão, tal como DVB-T.2, há dois tipos de códigos LDPC com os comprimentos de código N de 64.800 bits e 16.200 bits, da forma descrita nas figuras 12 e 13. Para qualquer um dos dois tipos de códigos LDPC, o tamanho de unidade P é definido em 360, que é um dos divisores do comprimento de paridade M, exceto 1 e M.
[00314] Além do mais, o comprimento de paridade M é um valor diferente de um número primo representado por uma expressão M = q x P = q x 360, usando um valor q que varia dependendo da taxa de codificação. Portanto, similarmente ao tamanho de unidade P, o valor q também é um outro dos divisores do comprimento de paridade M, exceto 1 e M, e é obtido pela divisão do comprimento de paridade M pelo tamanho de unidade P (o produto de P e q, que são os divisores do comprimento de paridade M, tomase o comprimento de paridade M).
[00315] Da forma supradescrita, o intercalador de paridade 23 intercala o (K + qx + y + l)-ésimo bit de código, dos bits de código do código LDPC de N bits, para a posição do (K + Py + x + l)-ésimo bit de código, como a
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117/233 intercalação de paridade, com a definição do comprimento da informação de K, um número inteiro x de 0 a P, exclusive P, e um número inteiro y de 0 a q, exclusive q.
[00316] Já que o (K + qx + y + l)-ésimo bit de código e o (K + Py + x + l)-ésimo bit de código são, ambos, bits de código do (K + l)-ésimo ou subsequente bits de código e, assim, são bits de paridade, a posição do bit de paridade do código LDPC é movida de acordo com a intercalação de paridade.
[00317] De acordo com tal intercalação de paridade, os (os bits de paridade correspondente aos) nós variáveis conectados no mesmo nó de verificação são separados pelo tamanho de unidade P, em outras palavras, 360 bits. Portanto, em um caso em que o comprimento do surto for menor do que 360 bits, é possível evitar uma situação em que uma pluralidade de nós variáveis conectados no mesmo nó de verificação se tomam erro ao mesmo tempo e, em decorrência disto, a resistência aos erros de surto pode ser melhorada.
[00318] Note que o código LDPC depois da intercalação de paridade para intercalar o (K + qx + y + l)-ésimo bit de código para a posição do (K + Py + x + l)-ésimo bit de código corresponde ao código LDPC da matriz de verificação de paridade (a seguir, também referido como a matriz de verificação de paridade transformada) que é obtido pela realização da permuta de coluna para permutar a (K + qx + y + l)-ésima coluna da matriz de verificação de paridade H original para a (K + Py + x + l)-ésima coluna.
[00319] Além do mais, uma estrutura pseudocíclica que tem P colunas (360 colunas na figura 16) como unidades aparece na matriz de paridade da matriz de verificação de paridade transformada, da forma ilustrada na figura
16.
[00320] Aqui, a estrutura pseudocíclica significa uma estrutura que tem uma estrutura cíclica que exclui uma parte.
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118/233 [00321] Uma matriz de verificação de paridade transformada obtida pela aplicação da permuta de coluna correspondente à intercalação de paridade em uma matriz de verificação de paridade de um código LDPC definido no padrão, tal como DVB-T.2, carece de um elemento de 1 (o um elemento de 1 é o elemento de 0 aqui) em uma parte (matriz de deslocamento a ser descrita a seguir) das 360 linhas x 360 colunas em uma parte do canto superior direito da matriz de verificação de paridade transformada e, assim, tem uma assim denominada estrutura pseudocíclica, em vez de uma estrutura cíclica (completa), neste ponto.
[00322] Uma matriz de verificação de paridade transformada em relação à matriz de verificação de paridade do código LDPC transmitido pelo codificador de LDPC 115 tem uma estrutura pseudocíclica, similarmente à matriz de verificação de paridade transformada em relação à matriz de verificação de paridade do código LDPC definido no padrão, tal como DVBT.2, por exemplo.
[00323] Note que a matriz de verificação de paridade transformada na figura 16 é uma matriz obtida pela aplicação da permuta de coluna correspondente à intercalação de paridade na matriz de verificação de paridade H original, e pela aplicação da permuta para as linhas (permuta de linha), de forma que a matriz de verificação de paridade transformada seja configurada em matrizes de configuração que serão descritas a seguir.
[00324] A figura 17 é um fluxograma para descrever o processamento realizado pelo codificador de LDPC 115, pelo intercalador de bit 116 e por um mapeador 117 na figura 8.
[00325] O codificador de LDPC 115 espera pelo suprimento dos dados LDPC alvos a partir do codificador de BCH 114. Na etapa S101, o codificador de LDPC 115 codifica os dados LDPC alvos no código LDPC, e supre o código LDPC para o intercalador de bit 116. O processamento prossegue para a etapa S102.
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119/233 [00326] Na etapa S102, o intercalador de bit 116 realiza a intercalação de bits para o código LDPC a partir do codificador de LDPC 115, e supre um símbolo obtido pela intercalação de bits para o mapeador 117. O processamento prossegue para a etapa S103.
[00327] Em outras palavras, na etapa S102, no intercalador de bit 116 (figura 9), o intercalador de paridade 23 realiza a intercalação de paridade para o código LDPC proveniente do codificador de LDPC 115, e supre o código LDPC depois da intercalação de paridade para o intercalador grupo a grupo 24.
[00328] O intercalador grupo a grupo 24 realiza a intercalação grupo a grupo para o código LDPC proveniente do intercalador de paridade 23, e supre o código LDPC para o intercalador de bloco 25.
[00329] O intercalador de bloco 25 realiza a intercalação de bloco para o código LDPC depois da intercalação grupo a grupo pelo intercalador grupo a grupo 24, e supre um símbolo de m bits resultante para o mapeador 117.
[00330] Na etapa S103, o mapeador 117 mapeia o símbolo proveniente do intercalador de bloco 25 para qualquer um de 2m pontos de sinal determinados pelo método de modulação da modulação por quadratura realizada pelo mapeador 117 e realiza a modulação por quadratura, e supre os dados resultantes para o intercalador de tempo 118.
[00331] Da forma supradescrita, pela realização da intercalação de paridade e da intercalação grupo a grupo, a taxa de erro de um caso em que uma pluralidade de bits de código do código LDPC é transmitida como um símbolo pode ser melhorada.
[00332] Aqui, na figura 9, por conveniência de descrição, o intercalador de paridade 23 como um bloco para realizar a intercalação de paridade e o intercalador grupo a grupo 24 como um bloco para realizar a intercalação grupo a grupo são separadamente configurados. Entretanto, o intercalador de paridade 23 e o intercalador grupo a grupo 24 podem ser
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120/233 integralmente configurados.
[00333] Em outras palavras, tanto a intercalação de paridade quanto a intercalação grupo a grupo podem ser realizadas pela gravação e leitura dos bits de código em relação à memória, e podem ser representadas por uma matriz para converter um endereço para gravar os bits de código (endereço de gravação) em um endereço para ler os bits de código (endereço de leitura).
[00334] Portanto, pela obtenção de uma matriz obtida pela multiplicação de uma matriz que representa a intercalação de paridade e uma matriz que representa a intercalação grupo a grupo, a intercalação de paridade é realizada pela conversão dos bits de código por estas matrizes e, adicionalmente, a intercalação grupo a grupo é realizada para o código LDPC depois da intercalação de paridade, de acordo com o que, um resultado pode ser obtido.
[00335] Além do mais, o intercalador de bloco 25 também pode ser integralmente configurado, além do intercalador de paridade 23 e do intercalador grupo a grupo 24.
[00336] Em outras palavras, a intercalação de bloco realizada pelo intercalador de bloco 25 também pode ser representada pela matriz que converte o endereço de gravação da memória para armazenar o código LDPC no endereço de leitura.
[00337] Portanto, pela obtenção de uma matriz obtida pela multiplicação da matriz que representa a intercalação de paridade, da matriz que representa a intercalação grupo a grupo e de uma matriz que representa a intercalação de bloco, a intercalação de paridade, a intercalação grupo a grupo e a intercalação de bloco podem ser realizadas coletivamente pelas matrizes.
[00338] Note que uma ou a quantidade da intercalação de paridade e da intercalação grupo a grupo podem não ser realizadas.
<Exemplo de configuração do codificador de LDPC 115>
[00339] A figura 18 é um diagrama de blocos que ilustra um exemplo
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121/233 de configuração do codificador de LDPC 115 na figura 8.
[00340] Note que o codificador de LDPC 122 na figura 8 é similarmente configurado.
[00341] Da forma descrita nas figuras 12 e 13, no padrão, tal como DVB-T.2, os códigos LDPC que têm dois tipos de comprimentos de código N de 64.800 bits e 16.200 bits são definidos.
[00342] Então, as onze taxas de codificação de 1/4, 1/3, 2/5, 1/2, 3/5, 2/3, 3/4, 4/5, 5/6, 8/9, e 9/10 são definidas para o código LDPC com o comprimento de código N de 64.800 bits, e as dez taxas de codificação de 1/4, 1/3, 2/5, 1/2, 3/5, 2/3, 3/4, 4/5, 5/6, e 8/9 são definidas para o código LDPC com o comprimento de código N de 16.200 bits (figuras 12 e 13).
[00343] O codificador de LDPC 115 pode realizar, por exemplo, tal codificação (codificação de correção de erro) pelos códigos LDPC com as taxas de codificação dos comprimentos de código N de 64.800 bits e 16.200 bits de acordo com a matriz de verificação de paridade H preparada para cada comprimento de código N e cada taxa de codificação.
[00344] Além disto, o codificador de LDPC 115 pode realizar a codificação LDPC de acordo com a matriz de verificação de paridade H de um código LDPC com um comprimento de código N arbitrário e uma taxa de codificação r arbitrária.
[00345] O codificador de LDPC 115 é configurado por uma unidade de processamento de codificação 601 e uma unidade de armazenamento 602.
[00346] A unidade de processamento de codificação 601 é configurada por uma unidade de definição da taxa de codificação 611, uma unidade de leitura da tabela de valor inicial 612, uma unidade de geração da matriz de verificação de paridade 613, uma unidade de leitura do bit de informação 614, uma unidade de operação da paridade codificada 615, e uma unidade de controle 616. A unidade de processamento de codificação 601 realiza a codificação LDPC para os dados LDPC alvos supridos para o codificador de
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LDPC 115, e supre um código LDPC resultante para o intercalador de bit 116 (figura 8).
[00347] Em outras palavras, a unidade de definição da taxa de codificação 611 define o comprimento de código N e a taxa de codificação r do código LDPC e, além do mais, a informação específica que especifica o código LDPC, de acordo com a operação do operador ou semelhantes, por exemplo.
[00348] A unidade de leitura da tabela de valor inicial 612 lê, a partir da unidade de armazenamento 602, uma tabela de valor inicial da matriz de verificação de paridade, que é descrita a seguir, que representa a matriz de verificação de paridade do código LDPC especificado pela informação específica definida pela unidade de definição da taxa de codificação 611.
[00349] A unidade de geração da matriz de verificação de paridade 613 gera a matriz de verificação de paridade H com base na tabela de valor inicial da matriz de verificação de paridade lida pela unidade de leitura da tabela de valor inicial 612, e armazena a matriz de verificação de paridade H na unidade de armazenamento 602. Por exemplo, a unidade de geração da matriz de verificação de paridade 613 arranja o elemento de 1 da matriz de informação Ha correspondente ao comprimento da informação K (= o comprimento de código N - o comprimento de paridade M) de acordo com o comprimento de código N e a taxa de codificação r definidos pela unidade de definição da taxa de codificação 611 com um período de cada 360 colunas (tamanho de unidade P) na direção da coluna para gerar a matriz de verificação de paridade H, e armazenar a matriz de verificação de paridade H na unidade de armazenamento 602.
[00350] A unidade de leitura do bit de informação 614 lê (extrai) os bits de informação do comprimento da informação K a partir dos dados LDPC alvos supridos para o codificador de LDPC 115.
[00351] A unidade de operação da paridade codificada 615 lê a matriz
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123/233 de verificação de paridade H gerada pela unidade de geração da matriz de verificação de paridade 613 a partir da unidade de armazenamento 602, e calcula os bits de paridade para os bits de informação lidos pela unidade de leitura do bit de informação 614 com base em uma expressão predeterminada usando a matriz de verificação de paridade H, desse modo, gerando a palavra código (código LDPC).
[00352] A unidade de controle 616 controla os blocos que constituem a unidade de processamento de codificação 601.
[00353] A unidade de armazenamento 602 armazena uma pluralidade de tabelas de valor inicial da matriz de verificação de paridade e semelhantes respectivamente correspondentes à pluralidade de taxas de codificação e semelhantes ilustrados nas figuras 12 e 13 para os comprimentos de código N de 64.800 bits e 16.200 bits e semelhantes, por exemplo. Além do mais, a unidade de armazenamento 602 armazena temporariamente os dados necessários para o processamento da unidade de processamento de codificação 601.
[00354] A figura 19 é um fluxograma para descrever um exemplo do processamento do codificador de LDPC 115 na figura 18.
[00355] Na etapa S201, a unidade de definição da taxa de codificação
611 define o comprimento de código N e a taxa de codificação r para realizar a codificação LDPC e, além do mais, a informação específica que especifica um outro código LDPC.
[00356] Na etapa S202, a unidade de leitura da tabela de valor inicial
612 lê, a partir da unidade de armazenamento 602, a tabela de valor inicial da matriz de verificação de paridade predeterminada especificada pelo comprimento de código N, a taxa de codificação r e semelhantes como a informação específica definida pela unidade de definição da taxa de codificação 611.
[00357] Na etapa S203, a unidade de geração da matriz de verificação
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124/233 de paridade 613 obtém (gera) a matriz de verificação de paridade H do código LDPC com o comprimento de código N e a taxa de codificação r definida pela unidade de definição da taxa de codificação 611, usando a tabela de valor inicial da matriz de verificação de paridade lida a partir da unidade de armazenamento 602 pela unidade de leitura da tabela de valor inicial 612, e supre e armazena a matriz de verificação de paridade H na unidade de armazenamento 602.
[00358] Na etapa S204, a unidade de leitura do bit de informação 614 lê os bits de informação do comprimento da informação K (= N x r) correspondente ao comprimento de código N e à taxa de codificação r definida pela unidade de definição da taxa de codificação 611 a partir dos dados LDPC alvos supridos para o codificador de LDPC 115, e lê a matriz de verificação de paridade H obtida pela unidade de geração da matriz de verificação de paridade 613 a partir da unidade de armazenamento 602, e supre os bits de informação e a matriz de verificação de paridade H para a unidade de operação da paridade codificada 615.
[00359] Na etapa S205, a unidade de operação da paridade codificada 615 opera sequencialmente o bit de paridade da palavra código c que satisfaz a expressão (8), usando os bits de informação e a matriz de verificação de paridade H provenientes da unidade de leitura do bit de informação 614.
HcT = 0 ... (8) [00360] Na expressão (8), c representa o vetor de linha como a palavra código (código LDPC), e cT representa a transposição do vetor de linha c.
[00361] Aqui, como exposto, no caso de representação da parte dos bits de informação, do vetor de linha c como o código LDPC (uma palavra código), pelo vetor de linha A, e da parte dos bits de paridade, do vetor de linha c, pelo vetor de linha T, o vetor de linha c pode ser expressado pela expressão c = [AIT] pelo vetor de linha A como os bits de informação e o vetor de linha T como os bits de paridade.
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125/233 [00362] A matriz de verificação de paridade H e o vetor de linha c = [AIT] como o código LDPC precisam satisfazer uma expressão HcT = 0, e o vetor de linha T como os bits de paridade que constituem o vetor de linha c = [AIT] que satisfaz a expressão HcT = 0 pode ser sequencialmente obtido pela definição sequencial do elemento de cada linha em 0 a partir do elemento na Ia linha do vetor de coluna HcT na expressão HcT = 0 em um caso em que a matriz de paridade Ητ da matriz de verificação de paridade H = [HaIHt] tem a estrutura de degrau ilustrada na figura 11.
[00363] A unidade de operação da paridade codificada 615 obtém os bits de paridade T para os bits de informação A provenientes da unidade de leitura do bit de informação 614, e transmite a palavra código c = [AIT] expressada pelos bits de informação A e pelos bits de paridade T como um resultado da codificação LDPC dos bits de informação A.
[00364] Posteriormente, na etapa S206, a unidade de controle 616 determina se termina-se a codificação LDPC. Em um caso em que for determinado, na etapa S206, que a codificação LDPC não é terminada, em outras palavras, em um caso em que ainda houver dados LDPC alvos a ser codificados em LDPC, o processamento retoma para a etapa S201 (ou etapa S204), e, a seguir, o processamento da etapa S201 (ou etapa S204) até a etapa S206 é repetido.
[00365] Além do mais, na etapa S206, em um caso em que for determinado que a codificação LDPC é terminada, em outras palavras, por exemplo, em um caso em que não houver dados LDPC alvos a ser codificados em LDPC, o codificador de LDPC 115 termina o processamento.
[00366] Em relação ao codificador de LDPC 115, uma tabela de valor inicial da matriz de verificação de paridade (que representa uma matriz de verificação de paridade) dos códigos LDPC com vários comprimentos de código N e taxas de codificação r pode ser preparada em antecipação. O codificador de LDPC 115 pode realizar a codificação LDPC para os códigos
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LDPC com vários comprimentos de código N e taxas de codificação r, usando a matriz de verificação de paridade H gerada a partir da tabela de valor inicial da matriz de verificação de paridade preparada em antecipação.
<Exemplo da tabela de valor inicial da matriz de verificação de paridade> [00367] A tabela de valor inicial da matriz de verificação de paridade é, por exemplo, uma tabela que representa as posições dos elementos de 1 da matriz de informação Ha (figura 10) correspondente ao comprimento da informação K de acordo com o comprimento de código N e a taxa de codificação r do código LDPC (o código LDPC definido pela matriz de verificação de paridade H) da matriz de verificação de paridade H, em cada 360 colunas (tamanho de unidade P), e é criada em antecipação para cada matriz de verificação de paridade H de cada comprimento de código N e cada taxa de codificação r.
[00368] Em outras palavras, a tabela de valor inicial da matriz de verificação de paridade indica pelo menos a posição dos elementos de 1 da matriz de informação Ha em cada 360 colunas (tamanho de unidade P).
[00369] Além do mais, como a matriz de verificação de paridade H, há uma matriz de verificação de paridade na qual toda a matriz de paridade Ht tem a estrutura de degrau, e uma matriz de verificação de paridade na qual uma parte da matriz de paridade Ht tem a estrutura de degrau e a parte restante é uma matriz diagonal (matriz unidade).
[00370] A seguir, o método de expressão da tabela de valor inicial da matriz de verificação de paridade que indica a matriz de verificação de paridade na qual uma parte da matriz de paridade Ht tem a estrutura de degrau e a parte restante é uma matriz diagonal também é referido como um método tipo A. Além do mais, o método de expressão da tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade na qual toda a matriz de paridade Ht tem a estrutura de degrau também é referido como um método tipo B.
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127/233 [00371] Além do mais, o código LDPC para a matriz de verificação de paridade representada pela tabela de valor inicial da matriz de verificação de paridade pelo método tipo A também é referido como um código tipo A, e o código LDPC para a matriz de verificação de paridade representada pela tabela de valor inicial da matriz de verificação de paridade pelo método tipo B também é referido como um código tipo B.
[00372] As designações “tipo A” e “tipo B” são as designações de acordo com o padrão de ATSC 3.0. Por exemplo, em ATSC 3.0, tanto o código tipo A quanto o código tipo B são adotados.
[00373] Note que, em DVB-T. 2 e semelhantes, o código tipo B é adotado.
[00374] A figura 20 é um diagrama que ilustra um exemplo da tabela de valor inicial da matriz de verificação de paridade pelo método tipo B.
[00375] Em outras palavras, a figura 20 ilustra a tabela de valor inicial da matriz de verificação de paridade (que representa a matriz de verificação de paridade H) do código tipo B com o comprimento de código N de 16.200 bits e a taxa de codificação (taxa de codificação na notação de DVB-T.2) r de 1/4 definida no padrão de DVB-T.2.
[00376] A unidade de geração da matriz de verificação de paridade 613 (figura 18) obtém a matriz de verificação de paridade H como segue usando a tabela de valor inicial da matriz de verificação de paridade pelo método tipo B.
[00377] A figura 21 é um diagrama para descrever um método de obtenção da matriz de verificação de paridade H a partir da tabela de valor inicial da matriz de verificação de paridade pelo método tipo B.
[00378] Em outras palavras, a figura 21 ilustra a tabela de valor inicial da matriz de verificação de paridade do código tipo B com o comprimento de código N de 16.200 bits e a taxa de codificação r de 2/3 definidos no padrão de DVB-T.2.
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128/233 [00379] A tabela de valor inicial da matriz de verificação de paridade pelo método tipo B é uma tabela que representa as posições dos elementos de 1 da íntegra da matriz de informação Ha correspondente ao comprimento da informação K de acordo com o comprimento de código N e a taxa de codificação r do código LDPC em cada 360 colunas (tamanho de unidade P). Na i-ésima linha, observam-se os números de linha dos elementos de 1 da (1 + 360 x (i - l))-ésima coluna da matriz de verificação de paridade H (o número de linha quando o número de linha da Ia linha da matriz de verificação de paridade H for contado como 0) pelo número do peso de coluna da (1 + 360 x (i - l))-ésima coluna.
[00380] Aqui, já que a matriz de paridade Ht (figura 10) correspondente ao comprimento de paridade M, da matriz de verificação de paridade H pelo método tipo B, tem a estrutura de degrau, da forma ilustrada na figura 15, a matriz de verificação de paridade H pode ser obtida se a matriz de informação Ha (figura 10) correspondente ao comprimento da informação K puder ser obtida de acordo com a tabela de valor inicial da matriz de verificação de paridade.
[00381] O número de linhas k + 1 da tabela de valor inicial da matriz de verificação de paridade pelo método tipo B difere dependendo do comprimento da informação K.
[00382] O relacionamento da expressão (9) se mantém entre o comprimento da informação K e o número de linhas k + 1 da tabela de valor inicial da matriz de verificação de paridade.
K = (k + l)x360 ... (9) [00383] Aqui, 360 na expressão (9) é o tamanho de unidade P descrito na figura 16.
[00384] Na tabela de valor inicial da matriz de verificação de paridade na figura 21, treze valores numéricos são arranjados nas Ia a 3a linhas, e três valores numéricos são arranjados nas 4a a (k + l)-ésima linhas (30a linha na
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129/233 figura 21).
[00385] Portanto, o peso de coluna da matriz de verificação de paridade H obtido a partir da tabela de valor inicial da matriz de verificação de paridade na figura 21 é 13 da Ia a (1 + 360 x (3 - 1) - l)-ésima colunas, e 3 da (1 + 360 x (3 - l))-ésima a K-ésima colunas.
[00386] A Ia linha da tabela de valor inicial da matriz de verificação de paridade na figura 21 é 0, 2084, 1613, 1548, 1286, 1460, 3196, 4297, 2481, 3369, 3451, 4620, e 2622, que representa que, na Ia coluna da matriz de verificação de paridade H, os elementos das linhas com os números de linha de 0, 2084, 1613, 1548, 1286, 1460, 3196, 4297, 2481, 3369, 3451, 4620, e 2622 são 1 (e os outros elementos são 0).
[00387] Além do mais, a 2a linha da tabela de valor inicial da matriz de verificação de paridade na figura 21 é 1, 122, 1516, 3448, 2880, 1407, 1847, 3799, 3529, 373, 971, 4358, e 3108, que representa que, na 361 (= 1 + 360 x (2 - l))a coluna da matriz de verificação de paridade H, os elementos das linhas com os números de linha de 1, 122, 1516, 3448, 2880, 1407, 1847, 3799, 3529, 373, 971, 4358, e 3108 são 1.
[00388] Da forma supradescrita, a tabela de valor inicial da matriz de verificação de paridade representa as posições dos elementos de 1 da matriz de informação Ha da matriz de verificação de paridade H em cada 360 colunas.
[00389] As colunas diferentes da (1 + 360 x (i - l))-ésima coluna da matriz de verificação de paridade H, em outras palavras, a (2 + 360 x (i - 1)ésima a (360 x i)-ésima colunas, são arranjadas pelo deslocamento cíclico dos elementos de 1 da (1 + 360 x (i - l))-ésima coluna determinada pela tabela de valor inicial da matriz de verificação de paridade para baixo (para baixo das colunas) de acordo com o comprimento de paridade M.
[00390] Em outras palavras, por exemplo, a (2 + 360 x (i - l))-ésima coluna é obtida pelo deslocamento cíclico da (1 + 360 x (i - l))-ésima coluna
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130/233 para baixo em M/360 (= q). A próxima (3 + 360 x (i - l))-ésima coluna é obtida pelo deslocamento cíclico da (1 + 360 x (i - l))-ésima coluna para baixo em 2 x M/360 (= 2 x q) (pelo deslocamento cíclico da (2 + 360 x (i l))-ésima coluna para baixo em M/360 (= q)).
[00391] Agora, em um caso em que o valor numérico da j-ésima coluna (j-ésima a partir da esquerda) na i-ésima linha (i-ésima a partir do topo) da tabela de valor inicial da matriz de verificação de paridade for denotado como hij e o número de linha do elemento do j-ésimo 1 da w-ésima coluna da matriz de verificação de paridade H é denotado como Hw-j, o número de linha Hw-j do elemento de 1 da w-ésima coluna, que é uma coluna diferente da (1 + 360 x (i - l)-ésima coluna da matriz de verificação de paridade H, pode ser obtido pela expressão (10).
Hw-j = mod{hij + mod((w - 1), P) x q, M) ... (10) [00392] Aqui, mod (x, y) significa o restante da divisão x por y.
[00393] Além do mais, P é o supradescrito tamanho de unidade e, na presente modalidade, P é 360 como em DVB-T.2 ou semelhantes e no padrão de ATSC 3.0, por exemplo. Além do mais, q é um valor M/360 obtido pela divisão do comprimento de paridade M pelo tamanho de unidade P (= 360).
[00394] A unidade de geração da matriz de verificação de paridade 613 (figura 18) especifica o número de linha do elemento de 1 na (1 + 360 x (i l))-ésima coluna da matriz de verificação de paridade H usando a tabela de valor inicial da matriz de verificação de paridade.
[00395] Adicionalmente, a unidade de geração da matriz de verificação de paridade 613 (figura 18) calcula o número de linha Hw-j do elemento de 1 na w-ésima coluna, que é uma coluna diferente da (1 + 360 x (i - l))-ésima coluna da matriz de verificação de paridade H pela expressão (10), e gera a matriz de verificação de paridade H na qual os elementos dos números de linha obtidos da forma supradescrita são 1.
[00396] A figura 22 é um diagrama que ilustra uma estrutura da matriz
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131/233 de verificação de paridade H pelo método tipo A.
[00397] A matriz de verificação de paridade pelo método tipo A é configurada por uma matriz A, uma matriz B, uma matriz C, uma matriz D, e uma matriz Z.
[00398] A matriz A é uma matriz superior esquerda na matriz de verificação de paridade H, de Ml linhas e K colunas, representada por um valor Ml predeterminado e pelo comprimento da informação K = o comprimento de código N x a taxa de codificação r do código LDPC.
[00399] A matriz B é uma matriz de Ml linhas e Ml colunas que tem uma estrutura de degrau adjacente à direita da matriz A.
[00400] A matriz C é uma matriz de N - K - Ml linhas e K + Ml colunas adjacente a abaixo da matriz A e da matriz B.
[00401] A matriz D é uma matriz identidade de N - K - Ml linhas e N K - Ml colunas adjacente à direita da matriz C.
[00402] A matriz Z é uma matriz zero (matriz 0) de Ml linhas e N - K -Ml colunas adjacente à direita da matriz B.
[00403] Na matriz de verificação de paridade H pelo método tipo A configurado pelas matriz A até matriz D e matriz Z expostas, a matriz A e uma parte da matriz C constituem a matriz de informação, e a matriz B, o resto da matriz C, a matriz D, e a matriz Z constituem a matriz de paridade.
[00404] Note que, já que a matriz B é uma matriz com uma estrutura de degrau e a matriz D é uma matriz identidade, uma parte (a parte da matriz B) da matriz de paridade da matriz de verificação de paridade H pelo método tipo A tem a estrutura de degrau e a parte restante (a parte da matriz D) é a matriz diagonal (matriz identidade).
[00405] A matriz A e a matriz C têm uma estrutura cíclica de cada uma das colunas P em tamanho de unidade (por exemplo, 360 colunas), similarmente à matriz de informação da matriz de verificação de paridade H pelo método tipo B, e a tabela de valor inicial da matriz de verificação de
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132/233 paridade pelo método tipo A representa as posições dos elementos de 1 da matriz A e da matriz C em cada 360 colunas.
[00406] Aqui, como exposto, já que a matriz A e uma parte da matriz C constituem uma matriz de informação, pode-se dizer que a tabela de valor inicial da matriz de verificação de paridade pelo método tipo A que representa as posições dos elementos de 1 da matriz A e da matriz C em cada 360 colunas representa pelo menos as posições dos elementos de 1 da matriz de informação em cada 360 colunas.
[00407] Note que, já que a tabela de valor inicial da matriz de verificação de paridade pelo método tipo A representa as posições dos elementos de 1 da matriz A e da matriz C em cada 360 colunas, também pode-se dizer que a tabela de valor inicial da matriz de verificação de paridade representa as posições dos elementos de 1 de uma parte (a parte restante da matriz C) da matriz de verificação de paridade em cada 360 colunas.
[00408] A figura 23 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade por um método tipo A.
[00409] Em outras palavras, a figura 23 ilustra um exemplo da tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H com o comprimento de código N de 35 bits e a taxa de codificação r de 2/7.
[00410] A tabela de valor inicial da matriz de verificação de paridade pelo método tipo A é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C em cada tamanho de unidade P. Na i-ésima linha, os números de linha dos elementos de 1 da (1 + P x (i - l))-ésima coluna da matriz de verificação de paridade H (o número de linha quando o número de linha da Ia linha da matriz de verificação de paridade H for contado como 0) pelo número do peso de coluna da (1 + P x (i - l))-ésima coluna.
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133 /233 [00411] Note que, aqui, para simplificar a descrição, o tamanho de unidade P é 5, por exemplo.
[00412] A matriz de verificação de paridade H pelo método tipo A tem Ml, M2, QI, e Q2, como os parâmetros.
[00413] Ml (figura 22) é um parâmetro para determinar o tamanho da matriz B, e toma um valor que é um múltiplo do tamanho de unidade P. Pelo ajuste de Ml, o desempenho do código LDPC muda, e Ml é ajustado para um valor predeterminado durante a determinação da matriz de verificação de paridade H. Aqui, considera-se que 15, que é três vezes o tamanho de unidade P = 5, é adotado como Ml.
[00414] M2 (figura 22) toma um valor M - Ml obtido pela subtração de Ml do comprimento de paridade M.
[00415] Aqui, já que o comprimento da informação K é N x r = 35 x 2/7 = 10 e o comprimento de paridade M é N - K = 35 - 10 = 25, M2 é M M1 = 25 - 15 = 10.
[00416] Q1 é obtido de acordo com a expressão Ql = Ml/P, e representa o número de deslocamentos (o número de linhas) do deslocamento cíclico na matriz A.
[00417] Em outras palavras, as colunas diferentes da (1 + P x (i - 1))ésima coluna da matriz A da matriz de verificação de paridade H pelo método tipo A, em outras palavras, as (2 + P x (i - l))-ésima até (P x i)-ésima colunas são arranjados pelo deslocamento cíclico dos elementos de 1 da (1 + P x (i l))-ésima coluna determinados pela tabela de valor inicial da matriz de verificação de paridade para baixo (para baixo das colunas), e Ql representa o número de deslocamentos do deslocamento cíclico na matriz A.
[00418] Q2 é obtido de acordo com a expressão Q2 = M2/P, e representa o número de deslocamentos (o número de linhas) do deslocamento cíclico na matriz C.
[00419] Em outras palavras, as colunas diferentes da (1 + P x (i - 1))
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134/233 ésima coluna da matriz C da matriz de verificação de paridade H pelo método tipo A, em outras palavras, as (2 + P x (i - l))-ésima até (P x i)-ésima colunas são arranjados pelo deslocamento cíclico dos elementos de 1 da (1 + P x (i l))-ésima coluna determinados pela tabela de valor inicial da matriz de verificação de paridade para baixo (para baixo das colunas), e Q2 representa o número de deslocamentos do deslocamento cíclico na matriz C.
[00420] Aqui, Q1 é Ml/P = 15/5 = 3, e Q2 é M2/P = 10/5 = 2.
[00421] Na tabela de valor inicial da matriz de verificação de paridade na figura 23, três valores numéricos são arranjados nas Ia e 2a linhas, e um valor numérico é arranjado nas 3a até 5a linhas. De acordo com a sequência dos valores numéricos, os pesos de coluna da matriz A e da matriz C da matriz de verificação de paridade H obtidos a partir da tabela de valor inicial da matriz de verificação de paridade na figura 23 são 3dal = (l+5x(l1 ))a até 10 = (5 x 2)-ésima colunas, eldall = (l + 5x(3- l))-ésima até a 25 = (5 x 5)-ésima colunas.
[00422] Em outras palavras, a Ia linha da tabela de valor inicial da matriz de verificação de paridade na figura 23 é 2, 6, e 18, o que representa que, na Ia coluna da matriz de verificação de paridade H, os elementos das linhas com os números de linha de 2, 6, e 18 são 1 (e os outros elementos são 0).
[00423] Aqui, neste caso, já que a matriz A (figura 22) é uma matriz de 15 linhas por 10 colunas (Ml linhas por K colunas), e a matriz C (figura 22) é uma matriz de 10 linhas por 25 colunas (N - K - Ml linhas por K + Ml colunas), as linhas com os números de linha 0 a 14 da matriz de verificação de paridade H são as linhas da matriz A, e as linhas com os números de linha 15 a 24 da matriz de verificação de paridade H são as linhas da matriz C.
[00424] Portanto, as linhas n° 2 e n° 6 das linhas com os números de linha 2, 6, e 18 (a seguir descritas como as linhas n° 2, n° 6, e n° 18) são as linhas da matriz A, e a linha n° 18 é uma linha da matriz C.
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135 /233 [00425] A 2a linha da tabela de valor inicial da matriz de verificação de paridade na figura 23 é 2, 10, e 19, o que representa que, na 6 (= I + 5 x (2 l))-ésima coluna da matriz de verificação de paridade H, os elementos das linhas n° 2, n° 10, e n° 19 são 1.
[00426] Aqui, na 6 (= (1 + 5 x (2 - l))-ésima coluna da matriz de verificação de paridade H, as linhas n° 2 e n° 10 das linhas n° 2, n° 10, e n° 19 são as linhas da matriz A, e a linha n° 19 é uma linha da matriz C.
[00427] A 3a linha da tabela de valor inicial da matriz de verificação de paridade na figura 23 é 22, o que representa que, na 11 (= 1 + 5 x (3 - 1))ésima coluna da matriz de verificação de paridade Η, o elemento da linha n° 22 é 1.
[00428] Aqui, a linha n° 22 é uma linha da matriz C na 11 (= I + 5 x (3 - l))-ésima coluna da matriz de verificação de paridade H.
[00429] Similarmente, 19 na 4a linha da tabela de valor inicial da matriz de verificação de paridade na figura 23 indica que o elemento da linha n° 19 é I na 16 (= I + 5 x (4 - l))-ésima coluna da matriz de verificação de paridade H. 15 na quinta linha da tabela de valor inicial da matriz de verificação de paridade na figura 23 indica que o elemento da linha n° 15 é 1 na 21 (= 1 + 5 x (5 - l))a coluna da matriz de verificação de paridade H.
[00430] Da forma supradescrita, a tabela de valor inicial da matriz de verificação de paridade representa as posições dos elementos de 1 da matriz A e da matriz C da matriz de verificação de paridade H em cada tamanho de unidade P = 5 colunas.
[00431] As colunas diferentes da (1 + 5 x (i - l))-ésima coluna da matriz A e da matriz C da matriz de verificação de paridade H, em outras palavras, a (2 + 5 x (i - l))-ésima até (5 x i)-ésima colunas são arranjadas pelo deslocamento cíclico dos elementos de 1 da (1 + 5 x (i - l))-ésima coluna determinada pela tabela de valor inicial da matriz de verificação de paridade para baixo (para baixo das colunas) de acordo com os parâmetros QI e Q2.
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136/233 [00432] Em outras palavras, por exemplo, a (2 + 5 x (i - l))-ésima coluna da matriz A é obtida pelo deslocamento cíclico da (1 + 5 x (i - 1))ésima coluna para baixo em Ql (= 3). A próxima (3 + 5 x (i - l))-ésima coluna é obtida pelo deslocamento cíclico da (1 + 5 x (i - l))-ésima coluna para baixo em 2 x Ql (= 2x3) (pelo deslocamento cíclico da (2 + 5 x (i - 1))ésima coluna para baixo em Ql).
[00433] Além do mais, por exemplo, a (2 + 5 x (i - l))-ésima coluna da matriz C é obtida pelo deslocamento cíclico da (1 + 5 x (i - l))-ésima coluna para baixo em Q2 (= 2). A próxima (3 + 5 x (i - l))-ésima coluna é obtida pelo deslocamento cíclico da (1 + 5 x (i - l))-ésima coluna para baixo em 2 x Q2 (= 2 x 2) (pelo deslocamento cíclico da (2 + 5 x (i - l))-ésima coluna para baixo em Q2).
[00434] A figura 24 é um diagrama que ilustra uma matriz A gerada a partir de uma tabela de valor inicial da matriz de verificação de paridade na figura 23.
[00435] Na matriz A da figura 24, os elementos das linhas n° 2 e n° 6 da 1 (= 1 + 5 x (1 - l))a coluna são 1 de acordo com a Ia linha da tabela de valor inicial da matriz de verificação de paridade na figura 23.
[00436] Então, a 2 (= (2 + 5 x (1 - l))a até a 5 (= (5 + 5 x (1 - l))-ésima colunas são obtidas pelo deslocamento cíclico da coluna prévia para baixo em Ql = 3.
[00437] Além do mais, na matriz A na figura 24, os elementos das linhas n° 2 e n° 10 da 6 (= 1 + 5 x (2 - l))-ésima coluna são 1 de acordo com a 2a linha da tabela de valor inicial da matriz de verificação de paridade na figura 23.
[00438] Então, a7(=2 + 5x(2- l))-ésima até a 10 (= 5 + 5 x (2 - 1))ésima colunas são obtidas pelo deslocamento cíclico da coluna prévia para baixo em Ql = 3.
[00439] A figura 25 é um diagrama que ilustra a intercalação de
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137/233 paridade da matriz B.
[00440] A unidade de geração da matriz de verificação de paridade 613 (figura 18) gera a matriz A usando a tabela de valor inicial da matriz de verificação de paridade, e arranja a matriz B que tem uma estrutura de degrau adjacente à direita da matriz A. Então, a unidade de geração da matriz de verificação de paridade 613 trata a matriz B como uma matriz de paridade, e realiza a intercalação de paridade de maneira tal que os elementos adjacentes de 1 da matriz B que tem estrutura de degrau sejam separados na direção da linha pelo tamanho de unidade P = 5.
[00441] A figura 25 ilustra a matriz A e a matriz B depois da intercalação de paridade da matriz B na figura 24.
[00442] A figura 26 é um diagrama que ilustra a matriz C gerada a partir da tabela de valor inicial da matriz de verificação de paridade na figura 23.
[00443] Na matriz C na figura 26, o elemento da linha n° 18 da 1 (= 1 + 5 x (1 - l))a coluna da matriz de verificação de paridade H é 1 de acordo com a Ia linha da tabela de valor inicial da matriz de verificação de paridade na figura 23.
[00444] Então, as 2 (= 2 + 5 x (1 - l))-ésima até 5 (= 5 + 5 x (1 - 1))ésima colunas são obtidas pelo deslocamento cíclico da coluna anterior para baixo em Q2 = 2.
[00445] Além do mais, na matriz C da figura 26, de acordo com as 2a a 5a linhas da tabela de valor inicial da matriz de verificação de paridade da figura 23, os elementos da linha n° 19 da 6 (= 1 + 5 x (2 - l))-ésima coluna da matriz de verificação de paridade H, da linha n° 22 da 11 (= 1 + 5 x (3 - 1))ésima coluna, da linha n° 19 da 16 (= 1 + 5 x (4 - l))-ésima coluna, e da linha n° 15 na 21 (= 1 + 5 x (5 - l))a coluna são 1.
[00446] Então, as 7 (= 2 + 5 x (2 - -l))-ésima a 10 (= 5 + 5 x (2 - 1))ésima colunas, as 12 (= 2 + 5 x (3 - l))-ésima a 15 (= 5 + 5 x (3 - l))-ésima
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138/233 colunas, as 17 (= 2 + 5 x (4 - l))-ésima a 20 (= 5 + 5 x (4 - l))-ésima colunas, e as 22 (= 2 + 5 x (5 - l))a a 25a (= 5 + 5 x (5 - l))a colunas são obtidas pelo deslocamento cíclico das colunas prévias para baixo em Q2 = 2.
[00447] A unidade de geração da matriz de verificação de paridade 613 (figura 18) gera a matriz C usando a tabela de valor inicial da matriz de verificação de paridade e arranja a matriz C abaixo da matriz A e da matriz B (depois da intercalação de paridade).
[00448] Além do mais, a unidade de geração da matriz de verificação de paridade 613 arranja a matriz Z adjacente à direita da matriz B e arranja a matriz D adjacente à direita da matriz C para gerar a matriz de verificação de paridade H ilustrada na figura 26.
[00449] A figura 27 é um diagrama para descrever a intercalação de paridade da matriz D.
[00450] A unidade de geração da matriz de verificação de paridade 613 trata a matriz D depois da geração da matriz de verificação de paridade H na figura 26 como uma matriz de paridade, e realiza a intercalação de paridade (apenas da matriz D) de maneira tal que os elementos de 1 das linhas ímpares e das próximas linhas pares da matriz D como uma matriz identidade são separados pelo tamanho de unidade P = 5 na direção da linha.
[00451] A figura 27 ilustra a matriz de verificação de paridade H depois da intercalação de paridade da matriz D, para a matriz de verificação de paridade H na figura 26.
[00452] O (a unidade de operação da paridade codificada 615 (figura 18) do) codificador de LDPC 115 realiza a codificação LDPC (gera um código LDPC) usando a matriz de verificação de paridade H na figura 27, por exemplo.
[00453] Aqui, o código LDPC gerado usando a matriz de verificação de paridade H na figura 27 é um código LDPC para o qual a intercalação de paridade foi realizada. Portanto, não é necessário realizar a intercalação de
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139/233 paridade no intercalador de paridade 23 (figura 9), para o código LDPC gerado usando a matriz de verificação de paridade H na figura 27. Em outras palavras, o código LDPC gerado usando a matriz de verificação de paridade H depois que a intercalação de paridade da matriz D for realizada é o código LDPC para o qual a intercalação de paridade foi realizada. Portanto, a intercalação de paridade no intercalador de paridade 23 é ignorada para o código LDPC.
[00454] A figura 28 ilustra uma matriz de verificação de paridade H na qual a permuta de coluna como a desintercalação de paridade para restaurar a intercalação de paridade é realizada para a matriz B, uma parte da matriz C (uma parte da matriz C arranjada abaixo da matriz B), e a matriz D da matriz de verificação de paridade H na figura 27.
[00455] O codificador de LDPC 115 pode realizar a codificação LDPC (gerar um código LDPC) usando a matriz de verificação de paridade H na figura 28.
[00456] Em um caso de realização da codificação LDPC usando a matriz de verificação de paridade H na figura 28, um código LDPC para o qual a intercalação de paridade não é realizada pode ser obtido de acordo com a codificação LDPC. Portanto, em um caso de realização da codificação LDPC usando a matriz de verificação de paridade H na figura 28, a intercalação de paridade é realizada no intercalador de paridade 23 (figura 9).
[00457] A figura 29 é um diagrama que ilustra uma matriz de verificação de paridade transformada H obtida pela realização da permuta de linha para a matriz de verificação de paridade H na figura 27.
[00458] A matriz de verificação de paridade transformada é, da forma descrita a seguir, uma matriz representada por uma combinação de uma matriz identidade P x P, uma matriz quase identidade na qual um ou mais de 1 na matriz identidade é 0, uma matriz de deslocamento na qual a matriz identidade ou a matriz quase identidade é ciclicamente deslocada, uma matriz
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140/233 de soma que é uma soma de duas ou mais da matriz identidade, da matriz quase identidade e da matriz de deslocamento, e uma matriz zero P x P. [00459] Pelo uso da matriz de verificação de paridade transformada para a decodificação do código LDPC, a arquitetura da realização de P operações no nó de verificação e operações no nó variável ao mesmo tempo pode ser adotada na decodificação do código LDPC, da forma descrita a seguir.
<Novo código LDPC>
[00460] Um dos métodos de garantir a qualidade de comunicação favorável na transmissão de dados usando um código LDPC, é um método que usa um código LDPC com alto desempenho.
[00461] A seguir, um novo código LDPC com alto desempenho (a seguir, também referido como um novo código LDPC) será descrito.
[00462] Como o novo código LDPC, por exemplo, o código tipo A ou o código tipo B correspondentes à matriz de verificação de paridade H que tem uma estrutura cíclica com o tamanho de unidade P de 360, que é similar a DVB-T.2, ATSC 3.0, ou semelhantes, podem ser adotados.
[00463] O codificador de LDPC 115 (figuras 8 e 18) pode realizar a codificação LDPC para obter o novo código LDPC, usando (uma matriz de verificação de paridade H obtida a partir de) uma tabela de valor inicial da matriz de verificação de paridade do novo código LDPC com o comprimento de código N de 69.120 bits, por exemplo, que é mais longo do que 64 kbits, e a taxa de codificação r de qualquer um de 2/16, 3/16, 4/16, 5/16, 6/16, 7/16, 8/16, 9/16, 10/16, 11/16, 12/16, 13/16, ou 14/16, por exemplo.
[00464] Neste caso, uma tabela de valor inicial da matriz de verificação de paridade do novo código LDPC é armazenada na unidade de armazenamento 602 do codificador de LDPC 115 (figura 8).
[00465] A figura 30 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade (do método tipo A)
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141/233 que representa a matriz de verificação de paridade H do código tipo A (a seguir, também referido como o código tipo A com r = 2/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 2/16.
[00466] As figuras 31 e 32 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo A (a seguir, também referido como o código tipo A com r = 3/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 3/16.
[00467] Note que a figura 32 é um diagrama seguinte à figura 31.
[00468] A figura 33 é um diagrama que ilustra um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo A (a seguir, também referido como o código tipo A com r = 4/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 4/16.
[00469] As figuras 34 e 35 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo A (a seguir, também referido como o código tipo A com r = 5/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 5/16.
[00470] Note que a figura 35 é um diagrama seguinte à figura 34.
[00471] As figuras 36 e 37 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo A (a seguir, também referido como o código tipo A com r = 6/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação
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142/233 r de 6/16.
[00472] Note que a figura 37 é um diagrama seguinte à figura 36.
[00473] As figuras 38 e 39 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo A (a seguir, também referido como o código tipo A com r = 7/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 7/16.
[00474] Note que a figura 39 é um diagrama seguinte à figura 38.
[00475] As figuras 40 e 41 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo A (a seguir, também referido como o código tipo A com r = 8/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 8/16.
[00476] Note que a figura 41 é um diagrama seguinte à figura 40.
[00477] As figuras 42 e 43 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade (do método tipo B) que representa a matriz de verificação de paridade H do código tipo B (a seguir, também referido como o código tipo B com r = 7/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 7/16.
[00478] Note que a figura 43 é um diagrama seguinte à figura 42.
[00479] As figuras 44 e 45 são os diagramas que ilustram um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B com r = 7/16.
[00480] Note que a figura 45 é um diagrama seguinte à figura 44. O código tipo B com r = 7/16 obtido a partir da (matriz de verificação de
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143/233 paridade H representada pela) tabela de valor inicial da matriz de verificação de paridade nas figuras 44 e 45 também será referido a seguir como um outro código tipo B com r = 7/16.
[00481] As figuras 46 e 47 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B (a seguir, também referido como o código tipo B com r = 8/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 8/16.
[00482] Note que a figura 47 é um diagrama seguinte à figura 46.
[00483] As figuras 48 e 49 são os diagramas que ilustram um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B com r = 8/16.
[00484] Note que a figura 49 é um diagrama seguinte à figura 48. O código tipo B com r = 8/16 obtido a partir da tabela de valor inicial da matriz de verificação de paridade nas figuras 48 e 49 também será referido a seguir como um outro código tipo B com r = 8/16.
[00485] As figuras 50, 51, e 52 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B (a seguir, também referido como o código tipo B com r = 9/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 9/16.
[00486] Note que a figura 51 é um diagrama seguinte à figura 50 e a figura 52 é um diagrama seguinte à figura 51.
[00487] As figuras 53, 54, e 55 são os diagramas que ilustram um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B com r =
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144/233
9/16.
[00488] Note que a figura 54 é um diagrama seguinte à figura 53 e a figura 55 é um diagrama seguinte à figura 54. O código tipo B com r = 9/16 obtido a partir da tabela de valor inicial da matriz de verificação de paridade nas figuras 53 a 55 também será referido a seguir como um outro código tipo B com r = 9/16.
[00489] As figuras 56, 57, e 58 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B (a seguir, também referido como o código tipo B com r = 10/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 10/16.
[00490] Note que a figura 57 é um diagrama seguinte à figura 56 e a figura 58 é um diagrama seguinte à figura 57.
[00491] As figuras 59, 60, e 61 são os diagramas que ilustram um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B com r = 10/16.
[00492] Note que a figura 60 é um diagrama seguinte à figura 59 e a figura 61 é um diagrama seguinte à figura 60. O código tipo B com r = 10/16 obtido a partir da tabela de valor inicial da matriz de verificação de paridade nas figuras 59 a 61 também será referido a seguir como um outro código tipo B com r = 10/16.
[00493] As figuras 62, 63, e 64 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B (a seguir, também referido como o código tipo B com r = 11/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 11/16.
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145/233 [00494] Note que a figura 63 é um diagrama seguinte à figura 62 e a figura 64 é um diagrama seguinte à figura 63.
[00495] As figuras 65, 66, e 67 são os diagramas que ilustram um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B com r = 11/16.
[00496] Note que a figura 66 é um diagrama seguinte à figura 65 e a figura 67 é um diagrama seguinte à figura 66. O código tipo B com r = 11/16 obtido a partir da tabela de valor inicial da matriz de verificação de paridade nas figuras 65 a 67 também será referido a seguir como um outro código tipo B comr = 11/16.
[00497] As figuras 68, 69, e 70 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B (a seguir, também referido como o código tipo B com r = 12/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 12/16.
[00498] Note que a figura 69 é um diagrama seguinte à figura 68 e a figura 70 é um diagrama seguinte à figura 69.
[00499] As figuras 71, 72, e 73 são os diagramas que ilustram um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B com r = 12/16.
[00500] Note que a figura 72 é um diagrama seguinte à figura 71 e a figura 73 é um diagrama seguinte à figura 72. O código tipo B com r = 12/16 obtido a partir da tabela de valor inicial da matriz de verificação de paridade nas figuras 71 a 73 também será referido a seguir como um outro código tipo B com r = 12/16.
[00501] As figuras 74, 75, e 76 são os diagramas que ilustram um
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146/233 exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B (a seguir, também referido como o código tipo B com r = 13/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 13/16.
[00502] Note que a figura 75 é um diagrama seguinte à figura 74 e a figura 76 é um diagrama seguinte à figura 75.
[00503] As figuras 77, 78, e 79 são os diagramas que ilustram um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B com r = 13/16.
[00504] Note que a figura78 é um diagrama seguinte à figura 77 e a figura 79 é um diagrama seguinte à figura 78. O código tipo B com r = 13/16 obtido a partir da tabela de valor inicial da matriz de verificação de paridade nas figuras 77 a 79 também será referido a seguir como um outro código tipo B com r = 13/16.
[00505] As figuras 80, 81, e 82 são os diagramas que ilustram um exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B (a seguir, também referido como o código tipo B com r = 14/16) como um novo código LDPC com o comprimento de código N de 69.120 bits e a taxa de codificação r de 14/16.
[00506] Note que a figura 81 é um diagrama seguinte à figura 80 e a figura 82 é um diagrama seguinte à figura 81.
[00507] As figuras 83, 84, e 85 são os diagramas que ilustram um outro exemplo de uma tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade H do código tipo B com r = 14/16.
[00508] Note que a figura 84 é um diagrama seguinte à figura 83 e a
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147/233 figura 85 é um diagrama seguinte à figura 84. O código tipo B com r = 14/16 obtido a partir da tabela de valor inicial da matriz de verificação de paridade nas figuras 83 a 85 também será referido a seguir como um outro código tipo B com r = 14/16.
[00509] O novo código LDPC se tomou um código LDPC com alto desempenho.
[00510] Aqui, o código LDPC com alto desempenho é um código LDPC obtido a partir de uma matriz de verificação de paridade H apropriada.
[00511] A matriz de verificação de paridade H apropriada é, por exemplo, uma matriz de verificação de paridade que satisfaz uma condição predeterminada que toma uma taxa de erro de bit (BER) (e uma taxa de erro de quadro (FER)) menor quando um código LDPC obtido a partir de uma matriz de verificação de paridade H for transmitido em baixos Es/No ou Eb/No (razão de potência do sinal por potência do ruído por bit).
[00512] A matriz de verificação de paridade H apropriada pode ser obtida, por exemplo, pela realização de uma simulação para medir a BER quando um código LDPC obtido a partir de várias matrizes de verificação de paridade que satisfazem a condição predeterminada for transmitido em baixa Es/No.
[00513] Os exemplos da condição predeterminada a ser satisfeita pela matriz de verificação de paridade H apropriada incluem um bom resultado de análise obtido por um método de análise de desempenho do código chamado de evolução de densidade, e a ausência de um laço dos elementos de 1, chamado de ciclo 4.
[00514] Aqui, é conhecido que o desempenho da decodificação do código LDPC é degradado se os elementos de 1 forem densamente embalados na matriz de informação Ha como no ciclo 4 e, portanto, a ausência do ciclo 4 é desejável na matriz de verificação de paridade H.
[00515] Na matriz de verificação de paridade Η, o mínimo valor de um
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148/233 comprimento de laço configurado pelos elementos de 1 é chamado perímetro. A ausência do ciclo 4 significa que o perímetro é maior do que 4.
[00516] Note que a condição predeterminada a ser satisfeita pela matriz de verificação de paridade H apropriada pode ser apropriadamente determinada a partir dos pontos de vista da melhoria do desempenho da decodificação do código LDPC, da facilitação (simplificação) do processamento de decodificação para o código LDPC e semelhantes.
[00517] As figuras 86 e 87 são os diagramas para descrever a evolução de densidade na qual um resultado de análise, como a condição predeterminada a ser satisfeita pela matriz de verificação de paridade H apropriada, pode ser obtido.
[00518] A evolução de densidade é um método de análise de código de calcular um valor esperado de uma probabilidade de erro para a íntegra do código LDPC (ajuntamento) com o comprimento de código N de ω caracterizado por uma sequência de graus a ser descrita a seguir.
[00519] Por exemplo, durante o aumento de uma variância de ruído a partir de 0 em um canal de AWGN, o valor esperado da probabilidade de erro de um ajuntamento é inicialmente 0, mas o valor esperado torna-se não 0 quando a variância de ruído se tomar um certo limite ou maior.
[00520] De acordo com a evolução de densidade, o desempenho do ajuntamento (adequação da matriz de verificação de paridade) pode ser determinado pela comparação do limite da variância do ruído (a seguir, também referido como limite de desempenho) no qual o valor esperado da probabilidade de erro toma-se não 0.
[00521] Note que, para um código LDPC específico, um ajuntamento ao qual o código LDPC pertence é determinado, e a evolução de densidade é realizada para o ajuntamento, de acordo com o que, o desempenho grosseiro do código LDPC pode ser previsto.
[00522] Portanto, se um ajuntamento com alto desempenho for
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149/233 descoberto, o código LDPC com alto desempenho pode ser encontrado a partir de códigos LDPC que pertencem ao ajuntamento.
[00523] Aqui, a supradescrita sequência de graus indica em qual razão os nós variáveis e os nós de verificação que têm pesos de respectivos valores existem para o comprimento de código N do código LDPC.
[00524] Por exemplo, um código LDPC (3, 6) regular com a taxa de codificação de 1/2 pertence a um ajuntamento caracterizado pela sequência de graus em que o peso (peso de coluna) de todos os nós variáveis é 3 e o peso (peso de linha) de todos os nós de verificação é 6.
[00525] A figura 86 mostra um gráfico de Tanner de um ajuntamento como este.
[00526] Na simulação de Tanner da figura 86, N nós variáveis ilustrados pelos círculos (o) na figura 86 existem, o número N sendo igual ao comprimento de código N, e N/2 nós de verificação ilustrados pelos quadrados (□) na figura 86 existem, o número N/2 sendo igual a um valor de multiplicação obtido pela multiplicação do comprimento de código N pela taxa de codificação 1/2.
[00527] Três bordas com um peso de coluna igual são conectadas em cada nó variável. Portanto, há um total de 3N bordas conectadas nos N nós variáveis.
[00528] Além do mais, seis bordas com um peso de linha igual são conectadas em cada nó de verificação. Portanto, há um total de 3N bordas conectadas nos N/2 nós de verificação.
[00529] Além do mais, no gráfico de Tanner da figura 86, há um intercalador.
[00530] O intercalador rearranja randomicamente as 3N bordas conectadas nos N nós variáveis e conecta cada borda depois do rearranjo em qualquer uma das 3N bordas conectadas nos N/2 nós de verificação.
[00531] O número de padrões para rearranjar as 3N bordas conectadas
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150/233 nos N nós variáveis no intercalador é (3N)! (= (3N) x (3N - 1) x ... x 1). Portanto, o ajuntamento caracterizado pela sequência de graus em que o peso de todos os nós variáveis é 3 e o peso de todos os nós de verificação é 6 é um conjunto de (3N)! códigos LDPC.
[00532] Na simulação para descobrir o código LDPC com alto desempenho (matriz de verificação de paridade apropriada), um ajuntamento tipo multibordas foi usado na evolução de densidade.
[00533] No ajuntamento tipo multibordas, o intercalador através do qual as bordas conectadas nos nós variáveis e as bordas conectadas nos nós de verificação passam é dividido em múltiplas bordas, de acordo com o que, a caracterização pelo ajuntamento é mais estritamente realizada.
[00534] A figura 87 é um diagrama que ilustra um exemplo de um gráfico de Tanner de um ajuntamento tipo multibordas.
[00535] No gráfico de Tanner na figura 87, há dois intercaladores de um primeiro intercalador e um segundo intercalador.
[00536] Além do mais, no gráfico de Tanner na figura 87, vl nós variáveis, cada qual conectado com uma borda conectada no primeiro intercalador e 0 borda conectada no segundo intercalador, v2 nós variáveis, cada qual conectado com uma borda conectada no primeiro intercalador e duas bordas conectadas no segundo intercalador, e v3 nós variáveis, cada qual conectado com 0 borda conectada no primeiro intercalador e duas bordas conectadas no segundo intercalador existem.
[00537] Além do mais, no gráfico de Tanner na figura 87, cl nós de verificação, cada qual conectado com duas bordas conectadas no primeiro intercalador e 0 borda conectada no segundo intercalador, c2 nós de verificação, cada qual conectado com duas bordas conectadas no primeiro intercalador e duas bordas conectadas no segundo intercalador, e c3 nós de verificação, cada qual conectado com 0 borda conectada no primeiro intercalador e três bordas conectadas no segundo intercalador existem.
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151/233 [00538] Aqui, a evolução de densidade e sua implementação são descritas, por exemplo, em “On the Design of Low-Density Parity-Check Codes within 0.0045 dB of the Shannon Limit”, S. Y. Chung, G. D. Forney, T. J. Richardson, R. Urbanke, IEEE Communications Leggers, VOL. 5, NO. 2, Feb 2001.
[00539] Na simulação para descobrir o (a matriz de verificação de paridade do) novo código LDPC, um ajuntamento no qual o limite de desempenho que é Eb/No (razão de potência do sinal por potência do ruído por bit) na qual a BER começa a cair (começa a ficar pequena) toma-se um valor predeterminado ou menor é descoberto pela evolução de densidade tipo multibordas, e o código LDPC que toma a BER pequena em um caso de uso uma ou mais modulações de quadratura, tal como QPSK, é selecionado a partir dos códigos LDPC que pertencem ao ajuntamento como o código LDPC com alto desempenho.
[00540] O (a tabela de valor inicial da matriz de verificação de paridade que representa a matriz de verificação de paridade do) novo código LDPC foi obtido pela simulação exposta.
[00541] Portanto, de acordo com o novo código LDPC, a qualidade de comunicação favorável pode ser garantida na transmissão de dados.
[00542] A figura 88 é um diagrama para descrever os pesos de coluna de uma matriz de verificação de paridade H do código tipo A como o novo código LDPC.
[00543] Considera-se que, em relação à matriz de verificação de paridade H do código tipo A, da forma ilustrada na figura 88, os pesos de coluna de Kl colunas da Ia coluna da matriz A são representados como Yl, os pesos de coluna das seguintes K2 colunas da matriz A são representados como Y2, os pesos de coluna de Kl colunas a partir da Ia coluna da matriz C são representados como XI, os pesos de coluna das seguintes K2 colunas da matriz C são representados como X2, e os pesos de coluna das seguintes Ml
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152/233 colunas adicionais da matriz C são representados como X3.
[00544] Note que Kl + K2 é igual ao comprimento da informação K, e Ml + M2 é igual ao comprimento de paridade M. Portanto, Kl + K2 + Ml + M2 é igual ao comprimento de código N = 69.120 bits.
[00545] Além do mais, em relação à matriz de verificação de paridade H do código tipo A, os pesos de coluna de Ml - 1 colunas da Ia coluna da matriz B são 2, e o peso de coluna da Ml-ésima coluna (última coluna) da matriz B é 1. Além do mais, o peso de coluna da matriz D é 1 e o peso de coluna da matriz Z é 0.
[00546] A figura 89 é um diagrama que ilustra os parâmetros das matrizes de verificação de paridade H dos códigos tipo A (representados pelas tabelas de valor inicial da matriz de verificação de paridade) nas figuras 30 a
41.
[00547] Xl, Yl, Kl, X2, Y2, K2, X3, Ml, e M2 como os parâmetros e os limites de desempenho das matrizes de verificação de paridade H dos códigos tipo A com r = 2/16, 3/16, 4/16, 5/16, 6/16, 7/16, e 8/16 são da forma ilustrada na figura 89.
[00548] Os parâmetros Xl, Yl, Kl (ou K2), X2, Y2, X3, e Ml (ou M2) são definidos para melhorar adicionalmente o desempenho (por exemplo, a taxa de erro ou semelhantes) dos códigos LDPC.
[00549] A figura 90 é um diagrama para descrever os pesos de coluna da matriz de verificação de paridade H do código tipo B como o novo código LDPC.
[00550] Considera-se que, em relação à matriz de verificação de paridade H do código tipo B, da forma ilustrada na figura 90, os pesos de coluna de KX1 colunas a partir da Ia coluna são representados como Xl, os pesos de coluna das seguintes KX2 colunas são representados como X2, os pesos de coluna das seguintes KY1 colunas são representados como Yl, e os pesos de coluna das seguintes KY2 colunas são representados como Y2.
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153 /233 [00551] Note que KX1 + KX2 + KYI + KY2 é igual ao comprimento da informação K, e KX1 + KX2 + KYI + KY2 + M é igual ao comprimento de código N = 69.120 bits.
[00552] Além do mais, em relação à matriz de verificação de paridade H do código tipo B, os pesos de coluna de M - 1 colunas excluindo a última coluna, das últimas M colunas, são 2, e o peso de coluna da última uma coluna é 1.
[00553] A figura 91 é um diagrama que ilustra os parâmetros das matrizes de verificação de paridade H dos códigos tipo B (representados pelas tabelas de valor inicial da matriz de verificação de paridade) nas figuras 42 a 85.
[00554] XI, KX1, X2, KX2, Yl, KY1, Y2, KY2, e M como os parâmetros e os limites de desempenho das matrizes de verificação de paridade H dos códigos tipo B e um outro código tipo B com r = 7/16, 8/16, 9/16, 10/16, 11/16, 12/16, 13/16, e 14/16 são da forma ilustrada na figura 91.
[00555] Os parâmetros XI, KX1, X2, KX2, Yl, KYI, Y2, e KY2 são definidos para melhorar adicionalmente o desempenho dos códigos LDPC.
[00556] De acordo com o novo código LDPC, BER/FER favoráveis são realizadas, e uma capacidade (capacidade de canal) próxima do limite de Shannon é realizada.
<Constelação>
[00557] As figuras 92 a 107 ilustram os diagramas que ilustram os exemplos de constelações adaptáveis no sistema de transmissão na figura 7.
[00558] No sistema de transmissão na figura 7, uma constelação usada em MODCOD pode ser definida para o MODCOD que é uma combinação de um método de modulação (Modulação) e do código LDPC (Código).
[00559] Uma ou mais constelações podem ser definidas em um MODCOD.
[00560] Como a constelação, há uma constelação uniforme (UC) na
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154/233 qual o arranjo dos pontos de sinal é uniforme e uma constelação não uniforme (NUC) na qual o arranjo de pontos de sinal é não uniforme.
[00561] Além do mais, como a NUC, há a constelação chamada de constelação unidimensional M2-QAM não uniforme (NUC 1D), uma constelação chamada constelação bidimensional QQAM não uniforme (NUC 2D) e semelhantes.
[00562] No geral, a BER é adicionalmente melhorada na NUC 1D em relação à UC e, além do mais, a BER é adicionalmente melhorada na NUC 2D do que na NUC 1D.
[00563] A constelação com o método de modulação de QPSK é a UC. Por exemplo, a UC ou a NUC 2D podem ser adotadas como uma constelação para o método de modulação de 16QAM, 64QAM, 256QAM, ou semelhantes. Por exemplo, a UC ou a NUC 1D podem ser adotadas como uma constelação para o método de modulação de 1024QAM, 4096QAM, ou semelhantes.
[00564] No sistema de transmissão na figura 7, por exemplo, as constelações definidas em ATSC 3.0, DVB-C.2 ou semelhantes, e várias outras constelações podem ser usadas.
[00565] Em outras palavras, em um caso em que o método de modulação for QPSK, por exemplo, a mesma UC pode ser usada para as taxas de codificação r dos códigos LDPC.
[00566] Além do mais, em um caso em que o método de modulação for 16QAM, 64QAM, ou 256QAM, por exemplo, a mesma UC pode ser usada para as taxas de codificação r dos códigos LDPC. Além do mais, em um caso em que o método de modulação for 16QAM, 64QAM, ou 256QAM, por exemplo, diferentes NUCs 2D podem ser usadas para as taxas de codificação r dos códigos LDPC, respectivamente.
[00567] Além do mais, em um caso em que o método de modulação for 1024QAM ou 4096QAM, por exemplo, a mesma UC pode ser usada para as taxas de codificação r dos códigos LDPC. Além do mais, em um caso em que
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155/233 o método de modulação for 1024QAM ou 4096QAM, por exemplo, diferentes NUCs 1D podem ser usados para as taxas de codificação r dos códigos LDPC, respectivamente.
[00568] Aqui, a UC de QPSK também é descrita como QPSK-UC, e a UC de 2mQAM também é descrita como 2mQAM-UC. Além do mais, a NUC ID e a NUC 2D de 2mQAM também são descritas como 2mQAM-NUC 1D e 2mQAM-NUC 2D, respectivamente.
[00569] A seguir, algumas das constelações definidas em ATSC 3.0 serão descritas.
[00570] A figura 92 é um diagrama que ilustra as coordenadas dos pontos de sinal de QPSK-UC usados para todas as taxas de codificação de códigos LDPC definidas em ATSC 3.0 em um caso em que o método de modulação for QPSK.
[00571] Na figura 92, a “célula dos Dados de Entrada y” representa um símbolo de 2 bits a ser mapeado para QPSK-UC, e o “ponto de Constelação zs” representa as coordenadas de um ponto de sinal zs. Note que um índice s do ponto de sinal zs (um índice q de um ponto de sinal zq, da forma descrita a seguir é similar) representa o tempo discreto do símbolo (um intervalo de tempo entre um símbolo e o próximo símbolo).
[00572] Na figura 92, as coordenadas do ponto de sinal zs são representadas na forma de um número complexo, e j representa uma unidade imaginária (/(-1)).
[00573] A figura 93 é um diagrama que ilustra as coordenadas dos pontos de sinal 16QAM-NUC 2D usados para as taxas de codificação r (CR) = 2/15, 3/15, 4/15, 5/15, 6/15, 7/15, 8/15, 9/15, 10/15, 11/15, 12, 15, e 13/15 dos códigos LDPC definidos em ATSC 3.0, em um caso em que o método de modulação for 16QAM.
[00574] Na figura 93, as coordenadas do ponto de sinal zs são representadas na forma de um número complexo, e j representa uma unidade
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156/233 imaginária, similarmente à figura 92.
[00575] Na figura 93, w#k representa as coordenadas de um ponto de sinal no primeiro quadrante da constelação.
[00576] Na NUC 2D, um ponto de sinal no segundo quadrante da constelação é arranjado em uma posição obtida pelo movimento simetricamente de um ponto de sinal no primeiro quadrante em relação a um eixo geométrico Q, e um ponto de sinal no terceiro quadrante da constelação é arranjado em uma posição obtida pelo movimento simetricamente de um ponto de sinal no primeiro quadrante em relação à origem. Então, um ponto de sinal no quarto quadrante da constelação é arranjado em uma posição obtida pelo movimento simetricamente de um ponto de sinal no primeiro quadrante em relação a um eixo geométrico I.
[00577] Aqui, em um caso em que o método de modulação for 2mQAM, m bits são considerados como um símbolo, e o um símbolo é mapeado para o ponto de sinal correspondente ao símbolo.
[00578] O símbolo de m bits pode ser expressado, por exemplo, por um valor integral de 0 a 2m - 1. Agora, os símbolos y(0), y(l), ..., y(2m - 1) representados pelos valores integrais de 0 a 2m - 1, em que b = 2m/4 pode ser classificado em quatro: símbolos y(0) a y(b - 1), y(b) a y(2b - 1), y(2b) a y(3b - 1), e y(3b) a y(4b - 1).
[00579] Na figura 93, o sufixo k de w#k toma um valor integral em uma faixa de 0 a b - 1, e w#k representa as coordenadas de um ponto de sinal correspondente a um símbolo y(k) em uma faixa de símbolos y(0) a y(b - 1).
[00580] Então, as coordenadas de um ponto de sinal correspondente a um símbolo y(k + b) em uma faixa de símbolos y(b) a y(2b - 1) são representadas como -conj(w#k), e as coordenadas de um ponto de sinal correspondente a um símbolo y(k + 2b) em uma faixa de símbolos y(2b) a y(3b - 1) são representadas como conj(w#k). Além do mais, as coordenadas de um ponto de sinal correspondente a um símbolo y(k + 3b) em uma faixa de
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157/233 símbolos y(3b) a y(4b - 1) são representadas por -w#k.
[00581] Aqui, o conj(w#k) representa um conjugado complexo de w#k. [00582] Por exemplo, em um caso em que o método de modulação for 16QAM, os símbolos y(0), y(l), ..., e y(l5) de m = 4 bits, em que b = 24/4 = 4 são classificados em quatro: símbolos y(0) a y(3), y(4) a y(7), y(8) a y(l 1), e y(12)ay(15).
[00583] Então, por exemplo, o símbolo y(12), dos símbolos y(0) a y(15), é um símbolo y(k + 3b) = y(0 + 3 x 4) na faixa de símbolos y(3b) a y(4b - 1)) e k = 0 e, portanto, as coordenadas do ponto de sinal correspondentes ao símbolo y(l 2) são -w#k = -wO.
[00584] Agora, considerando que a taxa de codificação r (CR) do código LDPC é, por exemplo, 9/15, wO em um caso em que o método de modulação for 16QAM e a taxa de codificação r for 9/15 é 0,2386 + j0,5296 de acordo com a figura 93 e, portanto, as coordenadas -wO do ponto de sinal correspondente ao símbolo y(12) é -(0,2386 + j0,5296).
[00585] A figura 94 é um diagrama que ilustra um exemplo das coordenadas dos pontos de sinal 1024QAM-NUC 1D usados para as taxas de codificação r (CR) = 2/15, 3/15, 4/15, 5/15, 6/15, 7/15, 8/15, 9/15, 10/15, 11/15, 12, 15, e 13/15 dos códigos LDPC definidos em ATSC 3.0, em um caso em que o método de modulação for 1024QAM.
[00586] Na figura 94, u#k representa uma parte real Re(zs) e uma parte imaginária Im(zs) do número complexo como as coordenadas do ponto de sinal zs de NUC 1D.
[00587] A figura 95 é um diagrama que ilustra um relacionamento entre o símbolo y de 1024QAM, e u#k como a parte real Re(zs) e a parte imaginária Im(zs) do número complexo que representa as coordenadas do ponto de sinal zs da NUC 1D correspondente ao símbolo y.
[00588] Agora, considera-se que o símbolo y de 10 bits de 1024QAM é representado como, a partir do bit lead (bit mais significativo), yo,s, yi,s, y2,s,
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Y3.s, Y4.s, Y5,s, Y6,s, Y7,s, Y8,s, 0 Y9,s· [00589] A na figura 95 ilustra uma correspondência entre os 5 bits de número par yi,s, y3,s, ys,s, y?,s, e y9,s do símbolo y, e u#k que representa a parte real Re(zs) (as coordenadas) do ponto de sinal zs correspondente ao símbolo y. [00590] B na figura 95 ilustra uma correspondência entre os 5 bits de número ímpar y0,s, y2,s, Y4,s, Yó,s e ys,s do símbolo y, e u#k que representa a parte imaginária Im(zs) do ponto de sinal zs correspondente ao símbolo y.
[00591] Em um caso em que o símbolo y de 10 bits = (yo,s, yi,s, y2,s, Y3,s, y4,s, Y5.S, Y6,s, Y7,s, Y8,s, e y9,s) de 1024QAM for (0, 0, 1, 0, 0, 1, 1, 1,0, 0), por exemplo, os 5 bits de número ímpar y0,s, y2,s, y4,s, Yó,s, e ys,s são (0, 1,0, 1, 0) e os 5 bits de número par yi,s, y3,s, ys,s, y?,s, e y9,s são (0, 0, 1, 1, 0).
[00592] Em A na figura 95, os 5 bits de número par (0, 0, 1, 1, 0) são associados com ull e, portanto, a parte real Re(zs) do ponto de sinal zs correspondente ao símbolo y = (0, 0, 1, 0, 0, 1, 1, 1, 0, 0) é ul 1.
[00593] Em B na figura 95, os 5 bits de número ímpar (0, 1,0, 1, 0) são associados com u3 e, portanto, a parte imaginária Im(zs) do ponto de sinal zs correspondente ao símbolo y = (0, 0, 1, 0, 0, 1, 1, 1, 0, 0) é u3.
[00594] Neste ínterim, quando a taxa de codificação r do código LDPC for 6/15, por exemplo, em relação à NUC 1D usada em um caso em que o método de modulação for 1024QAM e a taxa de codificação r (CR) do código LDPC = 6/15, u3 é 0,1295 e ul 1 é 0,7196, de acordo com a figura 94.
[00595] Portanto, a parte real Re(zs) do ponto de sinal zs correspondente ao símbolo y = (0, 0, 1, 0, 0, 1, 1, 1, 0, 0) é ull = 0,7196 e a parte imaginária Im(zs) é u3 = 0,1295. Em decorrência disto, as coordenadas do ponto de sinal zs correspondente ao símbolo y = (0, 0, 1, 0, 0, 1, 1, 1, 0, 0) são expressadas por 0,7196 + jO, 1295.
[00596] Note que os pontos de sinal da NUC 1D são arranjados em uma treliça em uma linha reta paralela ao eixo geométrico I e uma linha reta paralela ao eixo geométrico Q na constelação. Entretanto, o intervalo entre os
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159/233 pontos de sinal não é constante. Além do mais, a potência média dos pontos de sinal na constelação pode ser normalizada na transmissão dos (dados mapeados para) os pontos de sinal. A normalização pode ser realizada por, quando a raiz quadrada média dos valores absolutos de todos os (as coordenadas dos) pontos de sinal na constelação for Pave, multiplicando cada ponto de sinal zs na constelação por uma recíproca l/(x/Pave) da raiz quadrada %/Pave do valor da raiz quadrada média Pave.
[00597] O sistema de transmissão na figura 7 pode usar a constelação definida em ATSC 3.0, como exposto.
[00598] As figuras 96 a 107 ilustram as coordenadas de um ponto de sinal de UC definida em DVB-C.2.
[00599] Em outras palavras, a figura 96 é um diagrama que ilustra uma parte real Re(zq) da coordenada zq de um ponto de sinal de QPSK-UC (UC em QPSK) definido em DVB-C.2. A figura 97 é um diagrama que ilustra uma parte imaginária Im(zq) das coordenadas zq de um ponto de sinal de QPSKUC definida em DVB-C.2.
[00600] A figura 98 é um diagrama que ilustra uma parte real Re(zq) das coordenadas zq de um ponto de sinal de 16QAM-UC (UC de 16QAM) definido em DVB-C.2. A figura 99 é um diagrama que ilustra uma parte imaginária Im(zq) das coordenadas zq de um ponto de sinal de 16QAM-UC definida em DVB-C.2.
[00601] A figura 100 é um diagrama que ilustra uma parte real Re(zq) das coordenadas zq de um ponto de sinal de 64QAM-UC (UC de 64QAM) definido em DVB-C.2. A figura 101 é um diagrama que ilustra uma parte imaginária Im(zq) das coordenadas zq de um ponto de sinal de 64QAM-UC definida em DVB-C.2.
[00602] A figura 102 é um diagrama que ilustra uma parte real Re(zq) das coordenadas zq de um ponto de sinal de 256QAM-UC (UC de 256QAM) definido em DVB-C.2. A figura 103 é um diagrama que ilustra uma parte
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160/233 imaginária Im(zq) das coordenadas zq de um ponto de sinal de 256QAM-UC definida em DVB-C.2.
[00603] A figura 104 é um diagrama que ilustra uma parte real Re(zq) das coordenadas zq de um ponto de sinal de 1024QAM-UC (UC de 1024QAM) definido em DVB-C.2. A figura 105 é um diagrama que ilustra uma parte imaginária Im(zq) das coordenadas zq de um ponto de sinal de 1024QAM-UC especificado em DVB-C.2.
[00604] A figura 106 é um diagrama que ilustra uma parte real Re(zq) das coordenadas zq de um ponto de sinal de 4096QAM-UC (UC de 4096QAM) definido em DVB-C.2. A figura 107 é um diagrama que ilustra uma parte imaginária Im(zq) de coordenadas zq de um ponto de sinal de 4096QAM-UC definida em DVB-C.2.
[00605] Note que, nas figuras 96 a 107, yi,q representa o (i + l)-ésimo bit a partir da cabeça do símbolo de m bits (por exemplo, símbolo de 2 bits em QPSK) de 2mQAM. Além do mais, a potência média dos pontos de sinal na constelação pode ser normalizada na transmissão dos (dados mapeados para os) pontos de sinal da UC. A normalização pode ser realizada por, quando a raiz quadrada média dos valores absolutos de todos os (as coordenadas dos) pontos de sinal na constelação for Pave, multiplicando cada ponto de sinal zq na constelação por uma recíproca l/(%/Pave) da raiz quadrada %/Pave do valor da raiz quadrada média Pave.
[00606] No sistema de transmissão na figura 7, a UC definida em DVB-C.2 da forma supradescrita pode ser usada.
[00607] Em outras palavras, as UCs ilustradas nas figuras 96 a 107 podem ser usadas para os novos códigos LDPC correspondentes ao (às tabelas de valor inicial da matriz de verificação de paridade com o) comprimento de código N de 69.120 bits e às taxas de codificação r de 2/16, 3/16, 4/16, 5/16, 6/16, 7/16, 8/16, 9/16, 10/16, 11/16, 12/16, 13/16, e 14/16 nas figuras 30 a 85. <Intercalador de bloco 25 >
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161/233 [00608] A figura 108 é um diagrama para descrever a intercalação de bloco realizada pelo intercalador de bloco 25 na figura 9.
[00609] A intercalação de bloco é realizada pela divisão do código LDPC de uma palavra código em uma parte chamada de parte 1 e uma parte chamada de parte 2 da cabeça do código LDPC.
[00610] Npart 1 + Npart 2 é igual ao comprimento de código N, em que o comprimento (comprimento de bit) da parte 1 é Npart 1 e o comprimento da parte 2 é Npart 2.
[00611] Conceitualmente, na intercalação de bloco, as colunas como as áreas de armazenamento, cada qual armazenando Npartl/m bits em uma direção da coluna (vertical), como uma direção são arranjadas em uma direção da linha ortogonal à direção da coluna pelo número m igual ao comprimento de bit m do símbolo, e cada coluna é dividida a partir do topo em uma pequena unidade de 360 bits, que é o tamanho de unidade P. Esta pequena unidade de coluna também é chamada de unidade de coluna.
[00612] Na intercalação de bloco, da forma ilustrada na figura 108, a parte de gravação 1 do código LDPC de uma palavra código a partir do topo da primeira unidade de coluna do coluna para baixo (na direção da coluna) é realizada nas colunas a partir de uma direção da esquerda para a direita.
[00613] Então, quando a gravação na primeira unidade de coluna da coluna mais à direita for concluída, a gravação retoma para a coluna mais à esquerda, e a gravação para baixo a partir do topo da segunda unidade de coluna da coluna é realizada nas colunas a partir da direção da esquerda para a direita, da forma ilustrada na figura 108. A seguir, a parte de gravação 1 do código LDPC de uma palavra código é similarmente realizada.
[00614] Quando a parte de gravação 1 do código LDPC de uma palavra código for concluída, a parte 1 do código LDPC é lida em unidades de m bits na direção da linha a partir da primeira coluna de todas as m colunas, da forma ilustrada na figura 108.
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162/233 [00615] A unidade de m bits da parte 1 é suprida a partir do intercalador de bloco 25 para o mapeador 117 (figura 8) como o símbolo de m bits.
[00616] A leitura da parte 1 em unidades de m bits é sequencialmente realizada na direção das linhas inferiores das m colunas. Quando a leitura da parte 1 for concluída, a parte 2 é dividida em unidades de m bits a partir do topo, e a unidade de m bits é suprida do intercalador de bloco 25 para o mapeador 117 como o símbolo de m bits.
[00617] Portanto, a parte 1 é simbolizada enquanto estiver sendo intercalada, e a parte 2 é simbolizada pela divisão sequencial em m bits sem ser intercalada.
[00618] Npartl/m como o comprimento da coluna é um múltiplo de 360 como o tamanho de unidade P, e o código LDPC de uma palavra código é dividido em parte 1 e parte 2, de forma que Npartl/m torne-se um múltiplo de 360.
[00619] A figura 109 é um diagrama que ilustra os exemplos de parte 1 e parte 2 do código LDPC com o comprimento de código N de 69.120 bits em um caso em que o método de modulação for QPSK, 16QAM, 64QAM, 256QAM, 1024QAM, e 4096QAM.
[00620] Na figura 109, a parte 1 tem 68.400 bits e a parte 2 tem 720 bits em um caso em que o método de modulação for 1024QAM, e a parte 1 tem 69.120 bits e a parte 2 tem 0 bit nos casos em que os métodos de modulação forem QPSK, 16QAM, 64QAM, 256QAM, e 4096QAM. <Intercalação grupo a grupo>
[00621] A figura 110 é um diagrama para descrever a intercalação grupo a grupo realizada por um intercalador grupo a grupo 24 na figura 9.
[00622] Na intercalação grupo a grupo, da forma ilustrada na figura 110, o código LDPC de uma palavra código é intercalado em unidades de grupos de bits de acordo com um padrão predeterminado (a seguir, também
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163/233 referido como padrão GW), em que uma seção de 360 bits é definida como um grupo de bits, a uma seção de 360 bits sendo obtida pela divisão do código LDPC de um código em unidades de 360 bits, a unidade sendo igual a um tamanho de unidade P, da cabeça do código LDPC.
[00623] Aqui, o (i + l)-ésimo grupo de bits da cabeça quando o código LDPC de uma palavra código for dividido em grupos de bits também é, a seguir, descrito como o grupo de bits i.
[00624] Em um caso em que o tamanho de unidade P for 360, por exemplo, um código LDPC com o comprimento de código N de 1.800 bits é dividido em 5 (= 1.800/360) grupos de bits dos grupos de bits 0, 1, 2, 3, e 4. Além do mais, por exemplo, um código LDPC com o comprimento de código N de 69.120 bits é dividido em 192 (= 69.120/360) grupos de bits dos grupos de bits 0, 1,..., 191.
[00625] Além do mais, a seguir, o padrão GW é representado por uma sequência de números que representa um grupo de bits. Por exemplo, em relação ao código LDPC com o comprimento de código N de 1.800 bits, os padrões de GW 4, 2, 0, 3, e 1 indicam a sequência de intercalação (rearranjo) dos grupos de bits 0, 1, 2, 3, e 4 na sequência dos grupos de bits 4, 2, 0, 3, e 1. [00626] Por exemplo, agora, considera-se que o (i + l)-ésimo bit de código a partir da cabeça do código LDPC com o comprimento de código N de 1.800 bits é representado por Xj.
[00627] Neste caso, de acordo com a intercalação grupo a grupo dos padrões de GW 4, 2, 0, 3, e 1, o código LDPC {xo, xi, ..., X1799} de 1.800 bits é intercalado em sequência de {xwo, X1441, ···, X1799}, {X720, X721, ···, X1079}, {xo, Xl, ..., X359}, {X1080, X1081, , X1439}, C {X36O, X361, , X719}· [00628] O padrão GW pode ser definido em cada comprimento de código N do código LDPC, cada taxa de codificação r, cada método de modulação, cada constelação, ou cada combinação de dois ou mais do comprimento de código N, da taxa de codificação r, do método de modulação,
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164/233 e da constelação.
<Exemplos dos padrões de GW para os códigos LDPC>
[00629] A figura 111 é um diagrama que ilustra um primeiro exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00630] De acordo com o padrão GW na figura 111, uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
12, 8, 132, 26, 3, 18, 19, 98, 37, 190, 123, 81, 95, 167, 76, 66, 27, 46, 105, 28, 29, 170, 20, 96, 35, 177, 24, 86, 114, 63, 52, 80, 119, 153, 121, 107, 97, 129, 57, 38, 15, 91, 122, 14, 104, 175, 150, 1, 124, 72, 90, 32, 161, 78, 44, 73, 134, 162, 5, 11, 179, 93, 6, 152, 180, 68, 36, 103, 160, 100, 138, 146, 9, 82, 187, 147, 7, 87, 17, 102, 69, 110, 130, 42, 16, 71, 2, 169, 58, 33, 136, 106, 140, 84, 79, 143, 156, 139, 55, 116, 4, 21, 144, 64, 70, 158, 48, 118, 184, 50, 181, 120, 174, 133, 115, 53, 127, 74, 25, 49, 88, 22, 89, 34, 126, 61, 94, 172, 131, 39, 99, 183, 163, 111, 155, 51, 191, 31, 128, 149, 56, 85, 109, 10, 151, 188, 40, 83, 41, 47, 178, 186, 43, 54, 164, 13, 142, 117, 92, 113, 182, 168, 165, 101, 171, 159, 60, 166, 77, 30, 67, 23, 0, 65, 141, 185, 112, 145, 135, 108, 176, 45, 148, 137, 125, 62, 75, 189, 59, 173, 154, 157.
[00631] A figura 112 é um diagrama que ilustra um segundo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00632] De acordo com o padrão GW na figura 112, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
14, 119, 182, 5, 127, 21, 152, 11, 39, 164, 25, 69, 59, 140, 73, 9, 104, 148, 77, 44, 138, 89, 184, 35, 112, 150, 178, 26, 123, 133, 91, 76, 70, 0, 176, 118, 22, 147, 96, 108, 109, 139, 18, 157, 181, 126, 174, 179, 116, 38, 45, 158, 106, 168, 10, 97, 114, 129, 180, 52, 7, 67, 43, 50, 120, 122, 3, 13, 72,
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165/233
185, 34, 83, 124, 105, 162, 87, 131, 155, 135, 42, 64, 165, 41, 71, 189, 159, 143, 102, 153, 17, 24, 30, 66, 137, 62, 55, 48, 98, 110, 40, 121, 187, 74, 92, 60, 101, 57, 33, 130, 173, 32, 166, 128, 54, 99, 111, 100, 16, 84, 132, 161, 4, 190, 49, 95, 141, 28, 85, 61, 53, 183, 6, 68, 2, 163, 37, 103, 186, 154, 171, 170, 78, 117, 93, 8, 145, 51, 56, 191, 90, 82, 151, 115, 175, 1, 125, 79, 20, 80, 36, 169, 46, 167, 63, 177, 149, 81, 12, 156, 142, 31, 47, 88, 65, 134, 94, 86, 160, 172, 19, 23, 136, 58, 146, 15, 75, 107, 188, 29, 113, 144, 27.
[00633] A figura 113 é um diagrama que ilustra um terceiro exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00634] De acordo com o padrão GW na figura 113, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
121, 28, 49, 4, 21, 191, 90, 101, 188, 126, 8, 131, 81, 150, 141, 152, 17, 82, 61, 119, 125, 145, 153, 45, 108, 22, 94, 48, 29, 12, 59, 140, 75, 169, 183, 157, 142, 158, 113, 79, 89, 186, 112, 80, 56, 120, 166, 15, 43, 2, 62, 115, 38, 123, 73, 179, 155, 171, 185, 5, 168, 172, 190, 106, 174, 96, 116, 91, 30, 147, 19, 149, 37, 175, 124, 156, 14, 144, 86, 110, 40, 68, 162, 66, 130, 74, 165, 180, 13, 177, 122, 23, 109, 95, 42, 117, 65, 3, 111, 18, 32, 52, 97, 184, 54, 46, 167, 136, 1, 134, 189, 187, 16, 36, 84, 132, 170, 34, 57, 24, 137, 100, 39, 127, 6, 102, 10, 25, 114, 146, 53, 99, 85, 35, 78, 148, 9, 143, 139, 92, 173, 27, 11, 26, 104, 176, 98, 129, 51, 103, 160, 71, 154, 118, 67, 33, 181, 87, 77, 47, 159, 178, 83, 70, 164, 44, 69, 88, 63, 161, 182, 133, 20, 41, 64, 76, 31, 50, 128, 105, 0, 135, 55, 72, 93, 151, 107, 163, 60, 138, 7, 58.
[00635] A figura 114 é um diagrama que ilustra um quarto exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00636] De acordo com o padrão GW na figura 114, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma
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166/233 sequência de grupos de bits
99, 59, 95, 50, 122, 15, 144, 6, 129, 36, 175, 159, 165, 35, 182, 181, 189, 29, 2, 115, 91, 41, 60, 160, 51, 106, 168, 173, 20, 138, 183, 70, 24, 127, 47, 5, 119, 171, 102, 135, 116, 156, 120, 105, 117, 136, 149, 128, 85, 46, 186, 113, 73, 103, 52, 82, 89, 184, 22, 185, 155, 125, 133, 37, 27, 10, 137, 76, 12, 98, 148, 109, 42, 16, 190, 84, 94, 97, 25, 11, 88, 166, 131, 48, 161, 65, 9, 8, 58, 56, 124, 68, 54, 3, 169, 146, 87, 108, 110, 121, 163, 57, 90, 100, 66, 49, 61, 178, 18, 7, 28, 67, 13, 32, 34, 86, 153, 112, 63, 43, 164, 132, 118, 93, 38, 39, 17, 154, 170, 81, 141, 191, 152, 111, 188, 147, 180, 75, 72, 26, 177, 126, 179, 55, 1, 143, 45, 21, 40, 123, 23, 162, 77, 62, 134, 158, 176, 31, 69, 114, 142, 19, 96, 101, 71, 30, 140, 187, 92, 80, 79, 0, 104, 53, 145, 139, 14, 33, 74, 157, 150, 44, 172, 151, 64, 78, 130, 83, 167, 4, 107, 174.
[00637] A figura 115 é um diagrama que ilustra um quinto exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00638] De acordo com o padrão GW na figura 115, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
170, 45, 67, 94, 110, 153, 19, 38, 112, 176, 49, 138, 35, 114, 184, 159, 17, 41, 47, 189, 65, 125, 154, 57, 83, 6, 97, 167, 51, 59, 23, 81, 54, 46, 168, 178, 148, 5, 122, 129, 155, 179, 95, 102, 8, 119, 29, 113, 14, 60, 43, 66, 55, 103, 111, 88, 56, 7, 118, 63, 134, 108, 61, 187, 124, 31, 133, 22, 79, 52, 36, 144, 89, 177, 40, 116, 121, 135, 163, 92, 117, 162, 149, 106, 173, 181, 11, 164, 185, 99, 18, 158, 16, 12, 48, 9, 123, 147, 145, 169, 130, 183, 28, 151, 71, 126, 69, 165, 21, 13, 15, 62, 80, 182, 76, 90, 180, 50, 127, 131, 109, 3, 115, 120, 161, 82, 34, 78, 128, 142, 136, 75, 86, 137, 26, 25, 44, 91, 42, 73,
140, 146, 152, 27, 101, 93, 20, 166, 171, 100, 70, 84, 53, 186, 24, 98, 4, 37,
141, 190, 68, 150, 1, 72, 39, 87, 188, 191, 156, 33, 30, 160, 143, 64, 132, 77, 0, 58, 174, 157, 105, 175, 10, 172, 104, 2, 96, 139, 32, 85, 107, 74.
Petição 870190072829, de 30/07/2019, pág. 175/479
167/233 [00639] A figura 116 é um diagrama que ilustra um sexto exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00640] De acordo com o padrão GW na figura 116, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
111, 156, 189, 11, 132, 114, 100, 154, 77, 79, 95, 161, 47, 142, 36, 98, 3, 125, 159, 120, 40, 160, 29, 153, 16, 39, 101, 58, 191, 46, 76, 4, 183, 176, 62, 60, 74, 7, 37, 127, 19, 186, 71, 50, 139, 27, 188, 113, 38, 130, 124, 26, 146, 131, 102, 110, 105, 147, 86, 150, 94, 162, 175, 88, 104, 55, 89, 181, 34, 69, 22, 92, 133, 1, 25, 0, 158, 10, 24, 116, 164, 165, 112, 72, 106, 129, 81, 66, 54, 49, 136, 118, 83, 41, 2, 56, 145, 28, 177, 168, 117, 9, 157, 173, 115, 149, 42, 103, 14, 84, 155, 187, 99, 6, 43, 70, 140, 73, 32, 78, 75, 167, 148, 48, 134, 178, 59, 15, 63, 91, 82, 33, 135, 166, 190, 152, 96, 137, 12, 182, 61, 107, 128, 119, 179, 45, 184, 65, 172, 138, 31, 57, 174, 17, 180, 5, 30, 170, 23, 85, 185, 35, 44, 123, 90, 20, 122, 8, 64, 141, 169, 121, 97, 108, 80, 171, 18, 13, 87, 163, 109, 52, 51, 21, 93, 67, 126, 68, 53, 143, 144, 151.
[00641] A figura 117 é um diagrama que ilustra um sétimo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00642] De acordo com o padrão GW na figura 117, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
0, 1, 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17, 18, 19, 20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31, 32, 33, 34, 35, 36, 37, 38, 39,40,
41, 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60,61,
62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77, 78, 79, 80, 81,82,
83, 84, 85, 86, 87, 88, 89, 90, 91, 92, 93, 94, 95, 96, 97, 98, 99, 100, 101, 102,
103, 104, 105, 106, 107, 108, 109, 110, 111, 112, 113, 114, 115, 116, 117,
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168/233
118, 119, 120, 121, 122, 123, 124, 125, 126, 127, 128, 129, 130, 131,132,
133, 134, 135, 136, 137, 138, 139, 140, 141, 142, 143, 144, 145, 146,147,
148, 149, 150, 151, 152, 153, 154, 155, 156, 157, 158, 159, 160, 161,162,
163, 164, 165, 166, 167, 168, 169, 170, 171, 172, 173, 174, 175, 176,177,
178, 179, 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191.
[00643] A figura 118 é um diagrama que ilustra um oitavo exemplo de um padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00644] De acordo com o padrão GW na figura 118, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
0, 1, 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17, 18, 19, 20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31, 32, 33, 34, 35, 36, 37, 38, 39, 40,
41, 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61,
62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77, 78, 79, 80, 81, 82,
83, 84, 85, 86, 87, 88, 89, 90, 91, 92, 93, 94, 95, 96, 97, 98, 99, 100, 101, 102,
103, 104, 105, 106, 107, 108, 109, 110, 111, 112, 113, 114, 115, 116,117,
118, 119, 120, 121, 122, 123, 124, 125, 126, 127, 128, 129, 130, 131,132,
133, 134, 135, 136, 137, 138, 139, 140, 141, 142, 143, 144, 145, 146,147,
148, 149, 150, 151, 152, 153, 154, 155, 156, 157, 158, 159, 160, 161,162,
163, 164, 165, 166, 167, 168, 169, 170, 171, 172, 173, 174, 175, 176,177,
178, 179, 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191.
[00645] A figura 119 é um diagrama que ilustra um nono exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00646] De acordo com o padrão GW na figura 119, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
0, 1, 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17, 18, 19,
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169/233
20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31, 32, 33, 34, 35, 36, 37, 38, 39, 40,
41, 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61,
62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77, 78, 79, 80, 81, 82,
83, 84, 85, 86, 87, 88, 89, 90, 91, 92, 93, 94, 95, 96, 97, 98, 99, 100, 101, 102,
103, 104, 105, 106, 107, 108, 109, 110, 111, 112, 113, 114, 115, 116,117,
118, 119, 120, 121, 122, 123, 124, 125, 126, 127, 128, 129, 130, 131,132,
133, 134, 135, 136, 137, 138, 139, 140, 141, 142, 143, 144, 145, 146,147,
148, 149, 150, 151, 152, 153, 154, 155, 156, 157, 158, 159, 160, 161,162,
163, 164, 165, 166, 167, 168, 169, 170, 171, 172, 173, 174, 175, 176,177,
178, 179, 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191.
[00647] A figura 120 é um diagrama que ilustra um décimo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00648] De acordo com o padrão GW na figura 120, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
0, 1, 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17, 18, 19, 20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31, 32, 33, 34, 35, 36, 37, 38, 39, 40,
41, 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61,
62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77, 78, 79, 80, 81, 82,
83, 84, 85, 86, 87, 88, 89, 90, 91, 92, 93, 94, 95, 96, 97, 98, 99, 100, 101, 102,
103, 104, 105, 106, 107, 108, 109, 110, 111, 112, 113, 114, 115, 116,117,
118, 119, 120, 121, 122, 123, 124, 125, 126, 127, 128, 129, 130, 131,132,
133, 134, 135, 136, 137, 138, 139, 140, 141, 142, 143, 144, 145, 146,147,
148, 149, 150, 151, 152, 153, 154, 155, 156, 157, 158, 159, 160, 161,162,
163, 164, 165, 166, 167, 168, 169, 170, 171, 172, 173, 174, 175, 176,177,
178, 179, 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191.
[00649] A figura 121 é um diagrama que ilustra um décimo primeiro exemplo do padrão GW para um código LDPC com um comprimento de
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170/233 código N de 69.120 bits.
[00650] De acordo com o padrão GW na figura 121, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
0, 1, 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17, 18, 19, 20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31, 32, 33, 34, 35, 36, 37, 38, 39, 40,
41, 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61,
62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77, 78, 79, 80, 81, 82,
83, 84, 85, 86, 87, 88, 89, 90, 91, 92, 93, 94, 95, 96, 97, 98, 99, 100, 101, 102,
103, 104, 105, 106, 107, 108, 109, 110, 111, 112, 113, 114, 115, 116,117,
118, 119, 120, 121, 122, 123, 124, 125, 126, 127, 128, 129, 130, 131,132,
133, 134, 135, 136, 137, 138, 139, 140, 141, 142, 143, 144, 145, 146,147,
148, 149, 150, 151, 152, 153, 154, 155, 156, 157, 158, 159, 160, 161,162,
163, 164, 165, 166, 167, 168, 169, 170, 171, 172, 173, 174, 175, 176,177,
178, 179, 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191.
[00651] A figura 122 é um diagrama que ilustra um décimo segundo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00652] De acordo com o padrão GW na figura 122, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
0, 1, 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17, 18, 19,
20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31, 32, 33, 34, 35, 36, 37, 38, 39, 40,
41, 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60, 61,
62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77, 78, 79, 80, 81, 82,
83, 84, 85, 86, 87, 88, 89, 90, 91, 92, 93, 94, 95, 96, 97, 98, 99, 100, 101,102,
103, 104, 105, 106, 107, 108, 109, 110, 111, 112, 113, 114, 115, 116,117,
118, 119, 120, 121, 122, 123, 124, 125, 126, 127, 128, 129, 130, 131,132,
133, 134, 135, 136, 137, 138, 139, 140, 141, 142, 143, 144, 145, 146,147,
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148, 149, 150, 151, 152, 153, 154, 155, 156, 157, 158, 159, 160, 161, 162, 163, 164, 165, 166, 167, 168, 169, 170, 171, 172, 173, 174, 175, 176, 177, 178, 179, 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191.
[00653] A figura 123 é um diagrama que ilustra um décimo terceiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00654] De acordo com o padrão GW na figura 123, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
0, 1, 2, 3, 4, 5, 6, 7, 8, 9, 10, 11, 12, 13, 14, 15, 16, 17, 18, 19, 20, 21, 22, 23, 24, 25, 26, 27, 28, 29, 30, 31, 32, 33, 34, 35, 36, 37, 38, 39,40,
41, 42, 43, 44, 45, 46, 47, 48, 49, 50, 51, 52, 53, 54, 55, 56, 57, 58, 59, 60,61,
62, 63, 64, 65, 66, 67, 68, 69, 70, 71, 72, 73, 74, 75, 76, 77, 78, 79, 80, 81,82,
83, 84, 85, 86, 87, 88, 89, 90, 91, 92, 93, 94, 95, 96, 97, 98, 99, 100, 101, 102,
103, 104, 105, 106, 107, 108, 109, 110, 111, 112, 113, 114, 115, 116,117,
118, 119, 120, 121, 122, 123, 124, 125, 126, 127, 128, 129, 130, 131,132,
133, 134, 135, 136, 137, 138, 139, 140, 141, 142, 143, 144, 145, 146,147,
148, 149, 150, 151, 152, 153, 154, 155, 156, 157, 158, 159, 160, 161,162,
163, 164, 165, 166, 167, 168, 169, 170, 171, 172, 173, 174, 175, 176,177,
178, 179, 180, 181, 182, 183, 184, 185, 186, 187, 188, 189, 190, 191.
[00655] A figura 124 é um diagrama que ilustra um décimo quarto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00656] De acordo com o padrão GW na figura 124, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
154, 106, 99, 177, 191, 55, 189, 181, 22, 62, 80, 114, 110, 141, 83, 103, 169, 156, 130, 186, 92, 45, 68, 126, 112, 185, 160, 158, 17, 145, 162,
127, 152, 174, 134, 18, 157, 120, 3, 29, 13, 135, 173, 86, 73, 150, 46, 153, 33,
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172/233
61, 142, 102, 171, 168, 78, 77, 139, 85, 176, 163, 128, 101, 42, 2, 14, 38, 10, 125, 90, 30, 63, 172, 47, 108, 89, 0, 32, 94, 23, 34, 59, 35, 129, 12, 146, 8, 60, 27, 147, 180, 100, 87, 184, 167, 36, 79, 138, 4, 95, 148, 72, 54, 91, 182, 28, 133, 164, 175, 123, 107, 137, 88, 44, 116, 69, 7, 31, 124, 144, 105, 170, 6, 165, 15, 161, 24, 58, 70, 11, 56, 143, 111, 104, 74, 67, 109, 82, 21, 52, 9, 71, 48, 26, 117, 50, 149, 140, 20, 57, 136, 113, 64, 151, 190, 131, 19, 51, 96, 76, 1, 97, 40, 53, 84, 166, 75, 159, 98, 81, 49, 66, 188, 118, 39, 132, 187, 25, 119,
41, 122, 16, 5, 93, 115, 178, 65, 121, 37, 155, 183, 43, 179.
[00657] A figura 125 é um diagrama que ilustra um décimo quinto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00658] De acordo com o padrão GW na figura 125, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
1, 182, 125, 0, 121, 47, 63, 154, 76, 99, 82, 163, 102, 166, 28, 189, 56, 67, 54, 39, 40, 185, 184, 65, 179, 4, 91, 87, 137, 170, 98, 71, 169, 49, 73, 37, 11, 143, 150, 123, 93, 62, 3, 50, 26, 140, 178, 95, 183, 33, 21, 53, 112, 128, 118, 120, 106, 139, 32, 130, 173, 132, 156, 119, 83, 176, 159, 13, 145, 36, 30, 113, 2, 41, 147, 174, 94, 88, 92, 60, 165, 59, 25, 161, 100, 85, 81, 61, 138, 48, 177, 77, 6, 22, 16, 43, 115, 23, 12, 66, 70, 9, 164, 122, 58, 105, 69,
42, 38, 19, 24, 180, 175, 74, 160, 34, 101, 72, 114, 142, 20, 8, 15, 190,144,
104, 79, 172, 148, 31, 168, 10, 107, 14, 35, 52, 134, 126, 167, 149, 116,186,
17, 162, 151, 5, 136, 55, 44, 110, 158, 46, 191, 29, 153, 155, 117, 188,131,
97, 146, 103, 78, 109, 129, 57, 111, 45, 68, 157, 84, 141, 89, 64, 7, 108,152,
75, 18, 96, 133, 171, 86, 181, 127, 27, 124, 187, 135, 80, 51, 90.
[00659] A figura 126 é um diagrama que ilustra um décimo sexto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00660] De acordo com o padrão GW na figura 126, a sequência de
Petição 870190072829, de 30/07/2019, pág. 181/479
173/233 grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
35, 75, 166, 145, 143, 184, 62, 96, 54, 63, 157, 103, 32, 43, 126, 187, 144, 91, 78, 44, 39, 109, 185, 102, 10, 68, 29, 42, 149, 83, 133, 94, 130, 27, 171, 19, 51, 165, 148, 28, 36, 33, 173, 136, 87, 82, 100, 49, 120, 152, 161, 162, 147, 71, 137, 57, 8, 53, 132, 151, 163, 123, 47, 92, 90, 60, 99, 79, 59, 108, 115, 72, 0, 12, 140, 160, 61, 180, 74, 37, 86, 117, 191, 101, 52, 15, 80, 156, 127, 81, 131, 141, 142, 31, 95, 4, 73, 64, 16, 18, 146, 70, 181, 7, 89, 124, 77, 67, 116, 21, 34, 41, 105, 113, 97, 2, 6, 55, 17, 65, 38, 48, 158, 159, 179, 5, 30, 183, 170, 135, 125, 20, 106, 186, 182, 188, 114, 1, 14, 3, 134, 178, 189, 167, 40, 119, 22, 190, 58, 23, 155, 138, 98, 84, 11, 110, 88, 46, 177, 175, 25, 150, 118, 121, 129, 168, 13, 128, 104, 69, 112, 169, 9, 45, 174, 93, 26, 56, 76, 50, 154, 139, 66, 85, 153, 107, 111, 172, 176, 164, 24, 122.
[00661] A figura 127 é um diagrama que ilustra um décimo sétimo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00662] De acordo com o padrão GW na figura 127, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
155, 188, 123, 132, 15, 79, 59, 119, 66, 68, 41, 175, 184, 78, 142, 32, 54, 111, 139, 134, 95, 34, 161, 150, 58, 141, 74, 112, 121, 99, 178, 179, 57, 90, 80, 21, 11, 29, 67, 104, 52, 87, 38, 81, 181, 160, 176, 16, 71, 13, 186, 171, 9, 170, 2, 177, 0, 88, 149, 190, 69, 33, 183, 146, 61, 117, 113, 6, 96, 120, 162, 23, 53, 140, 91, 128, 46, 93, 174, 126, 159, 133, 8, 152, 103, 102, 151, 143, 100, 4, 180, 166, 55, 164, 18, 49, 62, 20, 83, 7, 187, 153, 64, 37, 144, 185, 19, 114, 25, 116, 12, 173, 122, 127, 89, 115, 75, 101, 189, 124, 157, 108, 28, 165, 163, 65, 168, 77, 82, 27, 137, 86, 22, 110, 63, 148, 158, 97, 31, 105, 135, 98, 44, 70, 182, 191, 17, 156, 129, 39, 136, 169, 3, 145, 154, 109, 76, 5, 10, 106, 35, 94, 172, 45, 51, 60, 42, 50, 72, 85, 40, 118, 36, 14, 130,
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174/233
131, 138, 43, 48, 125, 84, 24, 26, 1, 56, 107, 92, 147, 47, 30, 73, 167.
[00663] A figura 128 é um diagrama que ilustra um décimo oitavo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00664] De acordo com o padrão GW na figura 128, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
152, 87, 170, 33, 48, 95, 2, 184, 145, 51, 94, 164, 38, 90, 158, 70, 124, 128, 66, 111, 79, 42, 45, 141, 83, 73, 57, 119, 20, 67, 31, 179, 123, 183, 26, 188, 15, 163, 1, 133, 105, 72, 81, 153, 69, 182, 101, 180, 185, 190,
77, 6, 127, 138, 75, 59, 24, 175, 30, 186, 139, 56, 100, 176, 147, 189, 116, 131, 25, 5, 16, 117, 74, 50, 171, 114, 76, 44, 107, 135, 71, 181, 13, 43, 122,
78, 4, 58, 35, 63, 187, 98, 37, 169, 148, 7, 10, 49, 80, 161, 167, 28, 142, 46, 97, 92, 121, 112, 88, 102, 106, 173, 19, 27, 41, 172, 91, 191, 34, 118, 108, 136, 166, 155, 96, 3, 165, 103, 84, 109, 104, 53, 23, 0, 178, 17, 86, 9, 168, 134, 110, 18, 32, 146, 129, 159, 55, 154, 126, 40, 151, 174, 60, 52, 22, 149, 156, 113, 143, 11, 93, 62, 177, 64, 61, 160, 150, 65, 130, 82, 29, 115, 137, 36, 8, 157, 54, 89, 99, 120, 68, 21, 140, 14, 39, 132, 125, 12, 85, 162, 47, 144. [00665] A figura 129 é um diagrama que ilustra um décimo nono exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00666] De acordo com o padrão GW na figura 129, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
140, 8, 176, 13, 41, 165, 27, 109, 121, 153, 58, 181, 143, 164, 103, 115, 91, 66, 60, 189, 101, 4, 14, 102, 45, 124, 104, 159, 130, 133, 135, 77, 25, 59, 180, 141, 144, 62, 114, 182, 134, 148, 11, 20, 125, 83, 162, 75, 126, 67, 9, 178, 171, 152, 166, 69, 174, 15, 80, 168, 131, 95, 56, 48, 63, 82, 147, 51, 108, 52, 30, 139, 22, 37, 173, 112, 191, 98, 116, 149, 167, 142, 29,
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175/233
154, 92, 94, 71, 117, 79, 122, 129, 24, 81, 105, 97, 137, 128, 1, 113, 170, 119, 7, 158, 76, 19, 183, 68, 31, 50, 118, 33, 72, 55, 65, 146, 185, 111, 145, 28, 21, 177, 160, 32, 61, 70, 106, 156, 78, 132, 88, 184, 35, 5, 53, 138, 47, 100, 10, 42, 36, 175, 93, 120, 190, 16, 123, 87, 54, 186, 18, 57, 84, 99, 12, 163, 157, 188, 64, 38, 26, 2, 136, 40, 169, 90, 107, 46, 172, 49, 6, 39, 44, 150, 85, 0, 17, 127, 155, 110, 34, 96, 74, 86, 187, 89, 151, 43, 179, 161, 73, 23, 3.
[00667] A figura 130 é um diagrama que ilustra um vigésimo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00668] De acordo com o padrão GW na figura 130, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
10, 61, 30, 88, 33, 60, 1, 102, 45, 103, 119, 181, 82, 112, 12, 67, 69, 171, 108, 26, 145, 156, 81, 152, 8, 16, 68, 13, 99, 183, 146, 27, 158, 147, 132, 118, 180, 120, 173, 59, 186, 49, 7, 17, 35, 104, 129, 75, 54, 72, 18, 48, 15, 177, 191, 51, 24, 93, 106, 22, 71, 29, 141, 32, 143, 128, 175, 86, 190, 74, 36, 43, 144, 46, 63, 65, 133, 31, 87, 44, 20, 117, 76, 187, 80, 101, 151, 47, 130, 116, 162, 127, 153, 100, 94, 2, 41, 138, 125, 131, 11, 50, 40, 21, 184, 167, 172, 85, 160, 105, 73, 38, 157, 53, 39, 97, 107, 165, 168, 89, 148, 126, 3, 4, 114, 161, 155, 182, 136, 149, 111, 98, 113, 139, 92, 109, 174, 185, 95, 56, 135, 37, 163, 154, 0, 96, 78, 122, 5, 179, 140, 83, 123, 77, 9, 19, 66, 42, 137, 14, 23, 159, 189, 110, 142, 84, 169, 166, 52, 91, 164, 28, 124, 121, 70, 115, 90, 170, 58, 6, 178, 176, 64, 188, 57, 34, 79, 62, 25, 134, 150, 55.
[00669] A figura 131 é um diagrama que ilustra um vigésimo primeiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00670] De acordo com o padrão GW na figura 131, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
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8, 165, 180, 182, 189, 61, 7, 140, 105, 78, 86, 75, 15, 28, 82, 1, 136, 130, 35, 24, 70, 152, 121, 11, 36, 66, 83, 57, 164, 111, 137, 128, 175, 156, 151, 48, 44, 147, 18, 64, 184, 42, 159, 3, 6, 162, 170, 98, 101, 29, 102, 21, 188, 79, 138, 45, 124, 118, 155, 125, 34, 27, 5, 97, 109, 145, 54, 56, 126, 187, 16, 149, 160, 178, 23, 141, 30, 117, 25, 69, 116, 131, 94, 65, 191, 99, 181, 185, 115, 67, 93, 106, 38, 71, 76, 113, 132, 172, 103, 95, 92, 107, 4, 163, 139, 72, 157, 0, 12, 52, 68, 88, 161, 183, 39, 14, 32, 49, 19, 77, 174, 47, 154, 17, 134, 133, 51, 120, 74, 177, 41, 108, 142, 143, 13, 26, 59, 100, 123, 55, 158, 62, 104, 148, 135, 9, 179, 53, 176, 33, 169, 129, 186, 43, 167, 87, 119, 84, 90, 150, 20, 10, 122, 114, 80, 50, 146, 144, 96, 171, 40, 73, 81, 168, 112, 190, 37, 173, 46, 110, 60, 85, 153, 2, 63, 91, 127, 89, 31, 58, 22, 166.
[00671] A figura 132 é um diagrama que ilustra um vigésimo segundo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00672] De acordo com o padrão GW na figura 132, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
17, 84, 125, 70, 134, 63, 68, 162, 61, 31, 74, 137, 7, 138, 5, 60, 76, 105, 160, 12, 114, 81, 155, 112, 153, 191, 82, 148, 118, 108, 58, 159, 43, 161, 149, 96, 71, 30, 145, 174, 67, 77, 47, 94, 48, 156, 151, 141, 131, 176, 183, 41, 35, 83, 164, 55, 169, 98, 187, 124, 100, 54, 104, 40, 2, 72, 8, 85, 182, 103, 6, 37, 107, 39, 42, 123, 57, 106, 13, 150, 129, 46, 109, 188, 45, 113, 44, 90, 20, 165, 142, 110, 22, 28, 173, 38, 52, 16, 34, 0, 3, 144, 27, 49, 139, 177, 132, 184, 25, 87, 152, 119, 158, 78, 186, 167, 97, 24, 99, 69, 120, 122, 133, 163, 21, 51, 101, 185, 111, 26, 18, 10, 33, 170, 95, 65, 14, 130, 157, 59, 115, 127, 92, 56, 1, 80, 66, 126, 178, 147, 75, 179, 171, 53, 146, 88, 4, 128, 121, 86, 117, 19, 23, 168, 181, 11, 102, 93, 73, 140, 89, 136, 9, 180, 62, 36, 79, 91, 190, 143, 29, 154, 32, 64, 166, 116, 15, 189, 175, 50, 135, 172.
[00673] A figura 133 é um diagrama que ilustra um vigésimo terceiro
Petição 870190072829, de 30/07/2019, pág. 185/479
177/233 exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00674] De acordo com o padrão GW na figura 133, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
157, 20, 116, 115, 49, 178, 148, 152, 174, 130, 171, 81, 60, 146, 182, 72, 46, 22, 93, 101, 9, 55, 40, 163, 118, 30, 52, 181, 151, 31, 87, 117, 120, 82, 95, 190, 23, 36, 67, 62, 14, 167, 80, 27, 24, 43, 94, 0, 63, 5, 74, 78, 158, 88, 84, 109, 147, 112, 124, 110, 21, 47, 45, 68, 184, 70, 1, 66, 149, 105, 140, 170, 56, 98, 135, 61, 79, 123, 166, 185, 41, 108, 122, 92, 16, 26, 37, 177, 173, 113, 136, 89, 162, 85, 54, 39, 73, 58, 131, 134, 188, 127, 3, 164, 13, 132, 129, 179, 25, 18, 57, 32, 119, 111, 53, 155, 28, 107, 133, 144, 19, 160, 71, 186, 153, 103, 2, 12, 91, 106, 64, 175, 75, 189, 128, 142, 187, 76, 180, 34, 59, 169, 90, 11, 172, 97, 141, 38, 191, 17, 114, 126, 145, 83, 143, 125, 121, 10, 44, 137, 86, 29, 104, 154, 168, 65, 159, 15, 99, 35, 50, 48, 138, 96, 100, 102, 7, 42, 156, 8, 4, 69, 183, 51, 165, 6, 150, 77, 161, 33, 176, 139.
[00675] A figura 134 é um diagrama que ilustra um vigésimo quarto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00676] De acordo com o padrão GW na figura 134, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
42, 168, 36, 37, 152, 118, 14, 83, 105, 131, 26, 120, 92, 130, 158, 132, 49, 72, 137, 100, 88, 24, 53, 142, 110, 102, 74, 188, 113, 121, 12, 173, 5, 126, 127, 3, 93, 46, 164, 109, 151, 2, 98, 153, 116, 89, 101, 136, 35, 80, 0, 133, 183, 162, 185, 56, 17, 87, 117, 184, 54, 70, 176, 91, 134, 51, 38, 73, 165, 99, 169, 43, 167, 86, 11, 144, 78, 58, 64, 13, 119, 33, 166, 6, 75, 31, 15, 28, 125, 148, 27, 114, 82, 45, 55, 191, 160, 115, 1, 69, 187, 122, 177, 32, 172, 52, 112, 171, 124, 180, 85, 150, 7, 57, 60, 94, 181, 29, 97, 128, 19, 149,
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178/233
175, 50, 140, 10, 174, 68, 59, 39, 106, 44, 62, 71, 18, 107, 156, 159, 146, 48,
81, 111, 96, 103, 34, 161, 141, 154, 76, 61, 135, 20, 84, 77, 108, 23, 145, 182, 170, 139, 157, 47, 9, 63, 123, 138, 155, 79, 4, 30, 143, 25, 90, 66, 147, 186, 179, 129, 21, 65, 41, 95, 67, 22, 163, 190, 16, 8, 104, 189, 40, 178.
[00677] A figura 135 é um diagrama que ilustra um vigésimo quinto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00678] De acordo com o padrão GW na figura 135, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
92, 132, 39, 44, 190, 21, 70, 146, 48, 13, 17, 187, 119, 43, 94, 157, 150, 98, 96, 47, 86, 63, 152, 158, 84, 170, 81, 7, 62, 191, 174, 99, 116, 10, 85, 113, 135, 28, 53, 122, 83, 141, 77, 23, 131, 4, 40, 168, 129, 109, 51, 130, 188, 147, 29, 50, 26, 78, 148, 164, 167, 103, 36, 134, 2, 177, 20, 123, 27, 90, 176, 5, 33, 133, 189, 138, 76, 41, 89, 35, 72, 139, 32, 73, 68, 67, 101, 166, 93, 54, 52, 42, 110, 59, 8, 179, 34, 171, 143, 137, 9, 126, 155, 108, 142, 120, 163, 12, 3, 75, 159, 107, 65, 128, 87, 6, 22, 57, 100, 24, 64, 106, 117, 19, 58, 95, 74, 180, 125, 136, 186, 154, 121, 161, 88, 37, 114, 102, 105, 160, 80, 185,
82, 124, 184, 15, 16, 18, 118, 173, 151, 11, 91, 79, 46, 140, 127, 1, 169, 0, 61, 66, 45, 162, 149, 115, 144, 30, 25, 175, 153, 183, 60, 38, 31, 111, 182, 49, 55, 145, 56, 181, 104, 14, 71, 178, 112, 172, 165, 69, 97, 156.
[00679] A figura 136 é um diagrama que ilustra um vigésimo sexto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00680] De acordo com o padrão GW na figura 136, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
133, 96, 46, 148, 78, 109, 149, 161, 55, 39, 183, 54, 186, 73, 150, 180, 189, 190, 22, 135, 12, 80, 42, 130, 164, 70, 126, 107, 57, 67, 15,
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157, 52, 88, 5, 23, 123, 66, 53, 147, 177, 60, 131, 108, 171, 191, 44, 140, 98, 154, 37, 118, 176, 92, 124, 138, 132, 167, 173, 13, 79, 32, 145, 14, 113, 30, 2, 0, 165, 182, 153, 24, 144, 87, 82, 75, 141, 89, 137, 33, 100, 106, 128, 168, 29, 36, 172, 11, 111, 68, 16, 10, 34, 188, 35, 160, 77, 83, 178, 58, 59, 7, 56, 110, 104, 61, 76, 85, 121, 93, 19, 134, 179, 155, 163, 115, 185, 125, 112, 71, 8, 119, 18, 47, 151, 26, 103, 122, 9, 170, 146, 99, 49, 72, 102, 31, 40, 43, 158, 142, 4, 69, 139, 28, 174, 101, 84, 129, 156, 74, 62, 91, 159, 41, 38, 45, 136, 169, 21, 51, 181, 97, 166, 175, 90, 27, 86, 65, 105, 143, 127, 17, 6, 116, 94, 117, 48, 50, 25, 64, 95, 63, 184, 152, 120, 1, 187, 162, 114, 3, 81, 20.
[00681] A figura 137 é um diagrama que ilustra um vigésimo sétimo exemplo de um padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00682] De acordo com o padrão GW na figura 137, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
59, 34, 129, 18, 137, 6, 83, 139, 47, 148, 147, 110, 11, 98, 62, 149, 158, 14, 42, 180, 23, 128, 99, 181, 54, 176, 35, 130, 53, 179, 39, 152, 32, 52, 69, 82, 84, 113, 79, 21, 95, 7, 126, 191, 86, 169, 111, 12, 55, 27, 182, 120,
123, 88, 107, 50, 144, 49, 38, 165, 0, 159, 10, 43, 114, 187, 150, 19, 65, 48,
124, 8, 141, 171, 173, 17, 167, 92, 74, 170, 184, 67, 33, 172, 16, 119, 66, 57, 89, 106, 26, 78, 178, 109, 70, 2, 157, 15, 105, 22, 174, 127, 100, 71, 97, 163, 9, 77, 87, 41, 183, 117, 46, 40, 131, 85, 136, 72, 122, 1, 45, 13, 44, 56, 61, 146, 25, 132, 177, 76, 121, 160, 112, 5, 134, 73, 91, 135, 68, 3, 80, 90, 190, 60, 75, 145, 115, 81, 161, 156, 116, 166, 96, 28, 138, 94, 162, 140, 102, 4, 133, 30, 155, 189, 143, 64, 185, 164, 104, 142, 154, 118, 24, 31, 153, 103, 51, 108, 29, 37, 58, 186, 175, 36, 151, 63, 93, 188, 125, 101, 20, 168.
[00683] A figura 138 é um diagrama que ilustra um vigésimo oitavo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
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180/233 [00684] De acordo com o padrão GW na figura 138, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
61, 110, 123, 127, 148, 162, 131, 71, 176, 22, 157, 0, 151, 155, 112, 189, 36, 181, 10, 46, 133, 75, 80, 88, 6, 165, 97, 54, 31, 174, 49, 139, 98, 4, 170, 26, 50, 16, 141, 187, 13, 109, 106, 120, 72, 32, 63, 59, 79, 172, 83, 100, 92, 24, 56, 130, 167, 81, 103, 111, 158, 159, 153, 175, 8, 41, 136, 70, 33, 45, 84, 150, 39, 166, 164, 99, 126, 190, 134, 40, 87, 64, 154, 140, 116, 184, 115, 183, 30, 35, 7, 42, 146, 86, 58, 12, 14, 149, 89, 179, 128, 160, 95, 171, 74, 25, 29, 119, 143, 178, 28, 21, 23, 90, 188, 96, 173, 93, 147, 191, 18, 62, 2, 132, 20, 11, 17, 135, 152, 67, 73, 108, 76, 91, 156, 104, 48, 121, 94, 125, 38,
65, 177, 68, 37, 124, 78, 118, 186, 34, 185, 113, 169, 9, 69, 82, 163, 114, 145, 168, 44, 52, 105, 51, 137, 1, 161, 3, 55, 182, 101, 57, 43, 77, 5, 47, 144, 180,
66, 53, 19, 117, 60, 138, 142, 107, 122, 85, 27, 129, 15, 102.
[00685] A figura 139 é um diagrama que ilustra um vigésimo nono exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00686] De acordo com o padrão GW na figura 139, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
8, 174, 121, 46, 70, 106, 183, 9, 96, 109, 72, 130, 47, 168, 1, 190, 18, 90, 103, 135, 105, 112, 23, 33, 185, 31, 171, 111, 0, 115, 4, 159, 25, 65, 134, 146, 26, 37, 16, 169, 167, 74, 67, 155, 154, 83, 117, 53, 19, 161, 76, 12, 7, 131, 59, 51, 189, 42, 114, 142, 126, 66, 164, 191, 55, 132, 35, 153, 137, 87, 5, 100, 122, 150, 2, 49, 32, 172, 149, 177, 15, 82, 98, 34, 140, 170, 56, 78, 188, 57, 118, 186, 181, 52, 71, 24, 81, 22, 11, 156, 86, 148, 97, 38, 48, 64, 40, 165, 180, 125, 127, 143, 88, 43, 61, 158, 28, 162, 187, 110, 84, 157, 27, 41, 39, 124, 85, 58, 20, 44, 102, 36, 77, 147, 120, 179, 21, 60, 92, 138, 119, 173, 160, 144, 91, 99, 107, 101, 145, 184, 108, 95, 69, 63, 3, 89, 128, 136, 94, 129,
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181/233
50, 79, 68, 151, 104, 163, 123, 182, 93, 29, 133, 152, 178, 80, 62, 54, 14, 141, 166, 176, 45, 30, 10, 6, 75, 73, 116, 175, 17, 113, 139, 13.
[00687] A figura 140 é um diagrama que ilustra um trigésimo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00688] De acordo com o padrão GW na figura 140, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
179, 91, 101, 128, 169, 69, 185, 35, 156, 168, 132, 163, 46, 28, 5, 41, 162, 112, 108, 130, 153, 79, 118, 102, 125, 176, 71, 20, 115, 98, 124, 75, 103, 21, 164, 173, 9, 36, 56, 134, 24, 16, 159, 34, 15, 42, 104, 54, 120, 76, 60, 33, 127, 88, 133, 137, 61, 19, 3, 170, 87, 190, 13, 141, 188, 106, 113, 67, 145, 146, 111, 74, 89, 62, 175, 49, 32, 99, 93, 107, 171, 66, 80, 155, 100, 152, 4, 10, 126, 109, 181, 154, 105, 48, 136, 161, 183, 97, 31, 12, 8, 184, 47, 142, 18, 14, 117, 73, 84, 70, 68, 0, 23, 96, 165, 29, 122, 81, 17, 131, 44, 157, 26, 25, 189, 83, 178, 37, 123, 82, 191, 39, 7, 72, 160, 64, 143, 149, 138, 65, 58, 119, 63, 166, 114, 95, 172, 43, 140, 57, 158, 186, 86, 174, 92, 45, 139, 144, 147, 148, 151, 59, 30, 85, 40, 51, 187, 78, 38, 150, 129, 121, 27, 94, 52, 177, 110, 182, 55, 22, 167, 90, 77, 6, 11, 1, 116, 53, 2, 50, 135, 180.
[00689] A figura 141 é um diagrama que ilustra um trigésimo primeiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00690] De acordo com o padrão GW na figura 141, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
99, 59, 95, 50, 122, 15, 144, 6, 129, 36, 175, 159, 165, 35, 182, 181, 189, 29, 2, 115, 91, 41, 60, 160, 51, 106, 168, 173, 20, 138, 183, 70, 24, 127, 47, 5, 119, 171, 102, 135, 116, 156, 120, 105, 117, 136, 149, 128, 85, 46, 186, 113, 73, 103, 52, 82, 89, 184, 22, 185, 155, 125, 133, 37, 27, 10, 137, 76,
Petição 870190072829, de 30/07/2019, pág. 190/479
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12, 98, 148, 109, 42, 16, 190, 84, 94, 97, 25, 11, 88, 166, 131, 48, 161, 65, 9, 8, 58, 56, 124, 68, 54, 3, 169, 146, 87, 108, 110, 121, 163, 57, 90, 100, 66, 49, 61, 178, 18, 7, 28, 67, 13, 32, 34, 86, 153, 112, 63, 43, 164, 132, 118, 93, 38, 39, 17, 154, 170, 81, 141, 191, 152, 111, 188, 147, 180, 75, 72, 26, 177, 126, 179, 55, 1, 143, 45, 21, 40, 123, 23, 162, 77, 62, 134, 158, 176, 31, 69, 114, 142, 19, 96, 101, 71, 30, 140, 187, 92, 80, 79, 0, 104, 53, 145, 139, 14, 33, 74, 157, 150, 44, 172, 151, 64, 78, 130, 83, 167, 4, 107, 174.
[00691] A figura 142 é um diagrama que ilustra um trigésimo segundo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00692] De acordo com o padrão GW na figura 142, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
16, 133, 14, 114, 145, 191, 53, 80, 166, 68, 21, 184, 73, 165, 147, 89, 180, 55, 135, 94, 189, 78, 103, 115, 72, 24, 105, 188, 84, 148, 85, 32,
I, 131, 34, 134, 41, 167, 81, 54, 142, 141, 75, 155, 122, 140, 13, 17, 8, 23, 61, 49, 51, 74, 181, 162, 143, 42, 71, 123, 161, 177, 110, 149, 126, 0, 63, 178, 35, 175, 186, 52, 43, 139, 112, 10, 40, 150, 182, 164, 64, 83, 174, 38, 47, 30, 2,
116, 25, 128, 160, 144, 99, 5, 187, 176, 82, 60, 18, 185, 104, 169, 39, 183,
137, 22, 109, 96, 151, 46, 33, 29, 65, 132, 95, 31, 136, 159, 170, 168, 67, 79, 93, 111, 90, 97, 113, 92, 76, 58, 127, 26, 27, 156, 3, 6, 28, 77, 125, 173, 98,
138, 172, 86, 45, 118, 171, 62, 179, 100, 19, 163, 50, 57, 56, 36, 102, 121,
117, 154, 119, 66, 20, 91, 130, 69, 44, 70, 153, 152, 158, 88, 108, 12, 59, 4,
II, 120, 87, 101, 37, 129, 146, 9, 106, 48, 7, 15, 124, 190, 107, 157.
[00693] A figura 143 é um diagrama que ilustra um trigésimo terceiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00694] De acordo com o padrão GW na figura 143, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma
Petição 870190072829, de 30/07/2019, pág. 191/479
183 /233 sequência de grupos de bits
178, 39, 54, 68, 122, 20, 86, 137, 156, 55, 52, 72, 130, 152, 147, 12, 69, 48, 107, 44, 88, 23, 181, 174, 124, 81, 59, 93, 22, 46, 82, 110, 3, 99, 75, 36, 38, 119, 131, 51, 115, 78, 84, 33, 163, 11, 2, 188, 161, 34, 89, 50, 8, 90, 109, 136, 77, 103, 67, 41, 149, 176, 134, 189, 159, 184, 153, 53, 129, 63, 160, 139, 150, 169, 148, 127, 25, 175, 142, 98, 56, 144, 102, 94, 101, 85, 132, 76, 5, 177, 0, 128, 45, 162, 92, 62, 133, 30, 17, 9, 61, 70, 154, 4, 146, 24, 135, 104, 13, 185, 79, 138, 31, 112, 1, 49, 113, 106, 100, 65, 10, 83, 73, 26, 58, 114, 66, 126, 117, 96, 186, 14, 40, 164, 158, 118, 29, 121, 151, 168, 183, 179, 16, 105, 125, 190, 116, 165, 80, 64, 170, 140, 171, 173, 97, 60, 43, 123, 71, 182, 167, 95, 145, 141, 187, 166, 87, 143, 15, 74, 111, 157, 32, 172, 18, 57, 35, 191, 27, 47, 21, 6, 19, 155, 42, 120, 180, 37, 28, 91, 108, 7.
[00695] A figura 144 é um diagrama que ilustra um trigésimo quarto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00696] De acordo com o padrão GW na figura 144, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
139, 112, 159, 99, 87, 70, 175, 161, 51, 56, 174, 143, 12, 36, 77, 60, 155, 167, 160, 73, 127, 82, 123, 145, 8, 76, 164, 178, 144, 86, 7, 124, 27, 187, 130, 162, 191, 182, 16, 106, 141, 38, 72, 179, 111, 29, 59, 183, 66, 52, 43, 121, 20, 11, 190, 92, 55, 166, 94, 138, 1, 122, 171, 119, 109, 58, 23, 31, 163, 53, 13, 188, 100, 158, 156, 136, 34, 118, 185, 10, 25, 126, 104, 30, 83, 47, 146, 63, 134, 39, 21, 44, 151, 28, 22, 79, 110, 71, 90, 2, 103, 42, 35, 5, 57, 4, 0, 107, 37, 54, 18, 128, 148, 129, 26, 75, 120, 19, 116, 117, 147, 114, 48, 96, 61, 46, 88, 67, 135, 65, 180, 9, 74, 176, 6, 149, 49, 50, 125, 64, 169, 168, 157, 153, 24, 108, 89, 98, 33, 132, 93, 40, 154, 62, 142, 41, 69, 105, 189, 115, 152, 45, 133, 3, 95, 17, 186, 184, 85, 165, 32, 173, 113, 172, 78, 181, 150, 170, 102, 97, 140, 81, 91, 15, 137, 101, 80, 68, 14, 177, 131, 84.
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184/233 [00697] A figura 145 é um diagrama que ilustra um trigésimo quinto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00698] De acordo com o padrão GW na figura 145, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
21, 20, 172, 86, 178, 25, 104, 133, 17, 106, 191, 68, 80, 190, 129, 29, 125, 108, 147, 23, 94, 167, 27, 61, 12, 166, 131, 120, 159, 28, 7, 62,
134, 59, 78, 0, 121, 149, 6, 5, 143, 171, 153, 161, 186, 35, 92, 113, 55, 163, 16, 54, 93, 79, 37, 44, 75, 182, 127, 148, 179, 95, 169, 141, 38, 168, 128, 56, 31, 57, 175, 140, 164, 24, 177, 88, 51, 112, 49, 185, 170, 87, 32, 60, 65, 77, 89, 3, 18, 116, 184, 45, 109, 53, 160, 9, 100, 8, 111, 69, 189, 36, 173, 33, 72, 144, 183, 115, 137, 98, 90, 142, 30, 154, 180, 122, 155, 130, 83, 138, 14, 41, 150, 132, 70, 152, 117, 11, 4, 124, 15, 42, 181, 58, 10, 22, 145, 99, 126, 107, 66, 174, 39, 13, 97, 63, 123, 84, 85, 67, 76, 158, 71, 46, 118, 81, 162, 146,
135, 2, 73, 50, 114, 82, 103, 188, 74, 101, 157, 151, 91, 119, 102, 48, 1, 40, 43, 64, 156, 34, 110, 52, 96, 136, 139, 165, 19, 176, 187, 47, 26, 105.
[00699] A figura 146 é um diagrama de um trigésimo sexto exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00700] De acordo com o padrão GW na figura 146, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
160, 7, 29, 39, 110, 189, 140, 143, 163, 130, 173, 71, 191, 106, 60, 62, 149, 135, 9, 147, 124, 152, 55, 116, 85, 112, 14, 20, 79, 103, 156, 167, 19, 45, 73, 26, 159, 44, 86, 76, 56, 12, 109, 117, 128, 67, 150, 151, 31, 27, 133, 17, 120, 153, 108, 180, 52, 187, 98, 63, 176, 186, 179, 113, 161, 32, 24, 111, 41, 95, 38, 10, 154, 97, 141, 2, 127, 40, 105, 34, 11, 185, 155, 61, 114, 74, 158, 162, 5, 177, 43, 51, 148, 137, 28, 181, 171, 13, 104, 42, 168, 93, 172,
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185/233
144, 80, 123, 89, 81, 68, 75, 78, 121, 53, 65, 122, 142, 157, 107, 136, 66, 90, 23, 8, 1, 77, 54, 125, 174, 35, 88, 82, 134, 101, 131, 33, 50, 87, 36, 15, 47, 83, 18, 6, 21, 30, 94, 72, 145, 138, 184, 69, 84, 58, 49, 16, 48, 70, 183, 3, 92, 25, 115, 0, 182, 139, 91, 146, 102, 96, 100, 119, 129, 178, 46, 37, 57, 118, 126, 59, 165, 170, 190, 188, 175, 166, 99, 4, 22, 132, 164, 64, 169.
[00701] A figura 147 é um diagrama de um trigésimo sétimo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00702] De acordo com o padrão GW na figura 147, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
167, 97, 86, 166, 11, 57, 187, 169, 104, 102, 108, 63, 12, 181, 1, 71, 134, 152, 45, 144, 124, 22, 0, 51, 100, 150, 179, 54, 66, 79, 25, 172, 59, 48, 23, 55, 64, 185, 164, 123, 56, 80, 153, 9, 177, 176, 81, 17, 14, 43, 76, 27, 175, 60, 133, 91, 61, 41, 111, 163, 72, 95, 84, 67, 129, 52, 88, 121, 7, 49, 168, 154, 74, 138, 142, 158, 132, 127, 40, 139, 20, 44, 6, 128, 75, 114, 119, 2, 8, 157, 98, 118, 89, 46, 160, 190, 5, 165, 28, 68, 189, 161, 112, 173, 148, 183, 33, 131, 105, 186, 156, 70, 117, 170, 174, 36, 19, 135, 125, 122, 50, 113, 141, 37, 38, 31, 94, 149, 78, 32, 178, 34, 107, 13, 182, 146, 93, 10, 106, 109, 4, 77, 87, 3, 184, 83, 30, 180, 96, 15, 155, 110, 145, 191, 151, 101, 65, 99, 115, 140, 26, 147, 42, 136, 137, 18, 53, 116, 171, 16, 21, 92, 162, 130, 85, 69, 47, 35, 82, 120, 24, 73, 39, 58, 62, 126, 29, 90, 143, 159, 188, 103.
[00703] A figura 148 é um diagrama de um trigésimo oitavo exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00704] De acordo com o padrão GW na figura 148, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
74, 151, 79, 49, 174, 180, 133, 106, 116, 16, 163, 62, 164, 45,
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187, 128, 176, 2, 126, 136, 63, 28, 118, 173, 19, 46, 93, 121, 162, 88, Ο, 147, 131, 54, 117, 138, 69, 182, 68, 143, 78, 15, 7, 59, 109, 32, 10, 179, 165, 90, 73, 71, 171, 135, 123, 125, 31, 22, 70, 185, 155, 60, 120, 113, 41, 154, 177, 85, 64, 55, 26, 129, 84, 38, 166, 44, 30, 183, 189, 191, 124, 77, 80, 98, 190, 167, 140, 52, 153, 43, 25, 188, 103, 152, 137, 76, 149, 34, 172, 122, 40, 168,
141, 96, 142, 58, 110, 65, 9, 36, 42, 50, 184, 105, 156, 127, 8, 61, 146, 169, 181, 5, 87, 150, 91, 17, 18, 24, 112, 81, 170, 95, 29, 100, 130, 48, 159, 72, 75, 160, 27, 108, 148, 66, 144, 97, 57, 115, 114, 1, 132, 4, 21, 92, 11, 107, 175, 67, 145, 14, 186, 20, 51, 39, 3, 86, 89, 47, 53, 102, 82, 139, 23, 104, 157, 99, 158, 12, 161, 35, 178, 37, 134, 83, 94, 101, 111, 119, 6, 33, 13, 56.
[00705] A figura 149 é um diagrama de um trigésimo nono exemplo do padrão GW para um código LDPC com um comprimento de código N de
69.120 bits.
[00706] De acordo com o padrão GW na figura 149, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
20, 118, 185, 106, 82, 53, 41, 40, 121, 180, 45, 10, 145, 175, 191, 160, 177, 172, 13, 29, 133, 42, 89, 51, 141, 99, 7, 134, 52, 48, 169,162,
124, 25, 165, 128, 95, 148, 98, 171, 14, 75, 59, 26, 76, 47, 34, 122, 69,131,
105, 60, 132, 63, 81, 109, 43, 189, 19, 186, 79, 62, 85, 54, 16, 46, 27, 44, 139, 113, 11, 102, 130, 184, 119, 1, 152, 146, 37, 178, 61, 150, 32, 163, 92,166,
142, 67, 140, 157, 188, 18, 87, 149, 65, 183, 161, 5, 31, 71, 173, 73, 15,138,
156, 28, 66, 170, 179, 135, 86, 39, 104, 17, 154, 174, 56, 153, 0, 97, 9, 72, 23, 167, 190, 80, 3, 38, 120, 4, 24, 159, 12, 103, 22, 125, 83, 50, 6, 77, 168, 74, 93, 49, 57, 147, 2, 155, 181, 96, 114, 107, 110, 30, 117, 127, 101, 94, 129, 35, 58, 70, 126, 182, 151, 111, 91, 64, 88, 144, 137, 143, 176, 84, 136, 8, 112, 123, 164, 115, 78, 36, 90, 100, 55, 108, 21, 158, 68, 33, 116, 187.
[00707] A figura 150 é um diagrama de um quadragésimo exemplo do padrão GW para um código LDPC com um comprimento de código N de
Petição 870190072829, de 30/07/2019, pág. 195/479
187/233
69.120 bits.
[00708] De acordo com o padrão GW na figura 150, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
42, 43, 190, 119, 183, 103, 51, 28, 171, 20, 18, 25, 85, 22, 157, 99, 174, 5, 53, 62, 150, 128, 38, 153, 37, 148, 39, 24, 118, 102, 184, 49, 111, 48, 87, 76, 81, 40, 55, 82, 70, 105, 66, 115, 14, 86, 88, 135, 168, 139, 56, 80, 93, 95, 165, 13, 4, 100, 29, 104, 11, 72, 116, 83, 112, 67, 186, 169, 8, 57, 44, 17, 164, 31, 96, 84, 2, 125, 59, 3, 6, 173, 149, 78, 27, 160, 156, 187, 34, 129, 154, 79, 52, 117, 110, 0, 7, 113, 137, 26, 47, 12, 178, 46, 136, 97, 15, 188, 101, 58, 35, 71, 32, 16, 109, 163, 134, 75, 68, 98, 132, 90, 124, 189, 121, 123, 170, 158, 159, 77, 108, 63, 180, 36, 74, 127, 21, 146, 147, 54, 155, 10, 144,
130, 60, 1, 141, 23, 177, 133, 50, 126, 167, 151, 161, 191, 91, 114, 162, 30,
181, 182, 9, 94, 69, 176, 65, 142, 152, 175, 73, 140, 41, 179, 172, 145, 64, 19,
138, 131, 166, 33, 107, 185, 106, 122, 120, 92, 45, 143, 61, 89.
[00709] A figura 151 é um diagrama de um quadragésimo primeiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00710] De acordo com o padrão GW na figura 151, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
111, 33, 21, 133, 18, 30, 73, 139, 125, 35, 77, 105, 122, 91, 41, 86, 11, 8, 55, 71, 151, 107, 45, 12, 168, 51, 50, 59, 7, 132, 144, 16, 190, 31, 108, 89, 124, 110, 94, 67, 159, 46, 140, 87, 54, 142, 185, 85, 84, 120, 178, 101, 180, 20, 174, 47, 28, 145, 70, 24, 131, 4, 83, 56, 79, 37, 27, 109, 92, 52, 96, 177, 141, 188, 155, 38, 156, 169, 136, 81, 137, 112, 95, 93, 106, 149, 138, 15, 39, 170, 146, 103, 184, 43, 5, 9, 189, 34, 19, 63, 90, 36, 23, 78, 100, 75, 162, 42, 161, 119, 64, 65, 152, 62, 173, 104, 88, 118, 48, 44, 40, 60, 102, 61, 74, 99, 53, 10, 6, 172, 186, 163, 134, 14, 148, 3, 26, 1, 157, 150, 25, 123, 115,
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116, 57, 175, 127, 82, 117, 114, 160, 164, 153, 176, 76, 13, 181, 68, 128, 0, 183, 49, 22, 166, 17, 191, 135, 165, 72, 158, 130, 154, 167, 66, 2, 147, 69, 58, 98, 97, 143, 32, 29, 179, 113, 80, 182, 129, 126, 171, 121, 187.
[00711] A figura 152 é um diagrama de um quadragésimo segundo exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00712] De acordo com o padrão GW na figura 152, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
148, 32, 94, 31, 146, 15, 41, 7, 79, 58, 52, 167, 154, 4, 161, 38, 64, 127, 131, 78, 34, 125, 171, 173, 133, 122, 50, 95, 129, 57, 71, 37, 137, 69, 82, 107, 26, 10, 140, 156, 47, 178, 163, 117, 139, 174, 143, 138, 111, 11, 166,
43, 141, 114, 45, 39, 177, 103, 96, 123, 63, 23, 18, 20, 187, 27, 66, 130, 65, 142, 5, 135, 113, 90, 121, 54, 190, 134, 153, 147, 92, 157, 3, 97, 102, 106, 172, 91, 46, 89, 56, 184, 115, 99, 62, 93, 100, 88, 152, 109, 124, 182, 70, 74, 159, 165, 60, 183, 185, 164, 175, 108, 176, 2, 118, 72, 151, 0, 51, 33, 28, 80, 14, 128, 179, 84, 77, 42, 55, 160, 119, 110, 86, 22, 101, 13, 170, 36, 104, 189, 191, 169, 112, 12, 29, 30, 162, 136, 24, 68, 9, 81, 120, 145, 180, 144, 73, 21,
44, 1, 16, 67, 19, 158, 188, 181, 61, 35, 8, 53, 168, 150, 105, 59, 87, 6, 126, 75, 85, 17, 83, 98, 48, 132, 40, 76, 49, 25, 149, 186, 155, 116.
[00713] A figura 153 é um diagrama que ilustra um quadragésimo terceiro exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00714] De acordo com o padrão GW na figura 153, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
161, 38, 41, 138, 20, 24, 14, 35, 32, 179, 68, 97, 94, 142, 43, 53, 22, 28, 44, 81, 148, 187, 169, 89, 115, 144, 75, 40, 31, 152, 30, 124, 80, 135, 160, 8, 129, 147, 60, 112, 171, 0, 133, 100, 156, 180, 77, 110, 151, 69,
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95, 25, 117, 127, 154, 64, 146, 143, 29, 168, 177, 183, 126, 10, 26, 3, 50, 92, 164, 163, 11, 109, 21, 37, 84, 122, 49, 71, 52, 15, 88, 149, 86, 61, 90, 155, 162, 9, 153, 67, 119, 189, 82, 131, 190, 4, 46, 118, 47, 178, 59, 150, 186, 123,
18, 79, 57, 120, 70, 62, 137, 23, 185, 167, 175, 16, 134, 73, 139, 166, 55, 165, 116, 76, 99, 182, 78, 93, 141, 33, 176, 101, 130, 58, 12, 17, 132, 45, 102, 7,
19, 145, 54, 91, 113, 36, 27, 114, 174, 39, 83, 140, 191, 74, 56, 87, 48, 158, 121, 159, 136, 63, 181, 34, 173, 103, 42, 125, 104, 107, 96, 65, 1, 13, 157, 184, 170, 105, 188, 108, 6, 2, 98, 72, 5, 66, 128, 106, 172, 111, 85, 51.
[00715] A figura 154 é um diagrama de um quadragésimo quarto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00716] De acordo com o padrão GW na figura 154, a sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
57, 73, 173, 63, 179, 186, 148, 181, 160, 163, 4, 109, 137, 99, 118, 15, 5, 115, 44, 153, 185, 40, 12, 169, 2, 37, 188, 97, 65, 67, 117, 90, 66, 135, 154, 159, 146, 86, 61, 182, 59, 83, 91, 175, 58, 138, 93, 43, 98, 22, 152,
96, 45, 120, 180, 10, 116, 170, 162, 68, 3, 13, 41, 131, 21, 172, 55, 24, 1, 79, 106, 189, 52, 184, 112, 53, 136, 166, 29, 62, 107, 128, 71, 111, 187, 161, 101, 49, 155, 28, 94, 70, 48, 0, 33, 157, 151, 25, 89, 88, 114, 134, 75, 87, 142, 6, 27, 64, 69, 19, 150, 38, 35, 130, 127, 76, 102, 123, 158, 129, 133, 110, 141, 95, 7, 126, 85, 108, 174, 190, 165, 156, 171, 54, 17, 121, 103, 14, 36, 105, 82, 8, 178, 51, 23, 84, 167, 30, 100, 42, 72, 149, 92, 77, 104, 183, 39, 125, 80, 143, 144, 56, 119, 16, 132, 139, 191, 50, 164, 122, 46, 140, 31, 176, 60, 26, 32, 11, 177, 124, 74, 145, 20, 34, 18, 81, 168, 9, 78, 113, 147, 47.
[00717] A figura 155 é um diagrama de um quadragésimo quinto exemplo do padrão GW para um código LDPC com um comprimento de código N de 69.120 bits.
[00718] De acordo com o padrão GW na figura 155, a sequência de
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190/233 grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
89, 123, 13, 47, 178, 159, 1, 190, 53, 12, 57, 109, 115, 19, 36, 143, 82, 96, 163, 66, 154, 173, 49, 65, 131, 2, 78, 15, 155, 90, 38, 130, 63, 188, 138, 184, 166, 102, 139, 28, 50, 186, 17, 20, 112, 41, 11, 8, 59, 79, 45, 162, 146, 40, 43, 129, 119, 18, 157, 37, 126, 124, 110, 191, 85, 165, 60, 142, 135, 74, 187, 179, 141, 164, 34, 69, 26, 33, 113, 120, 95, 169, 30, 0, 175, 70, 91, 104, 140, 25, 132, 23, 105, 158, 171, 6, 121, 56, 22, 127, 54, 68, 107, 133, 84, 81, 150, 99, 73, 185, 67, 29, 151, 87, 10, 167, 148, 72, 147, 5, 31, 125, 145, 4, 52, 44, 134, 83, 46, 75, 152, 62, 7, 86, 172, 180, 111, 61, 9, 58, 14, 116, 92, 170, 93, 77, 88, 42, 21, 106, 97, 144, 182, 108, 55, 94, 122, 114, 153, 64, 24, 80, 117, 3, 177, 149, 76, 128, 136, 39, 181, 160, 103, 174, 156, 27, 183, 16, 137, 101, 161, 176, 35, 118, 98, 168, 48, 100, 71, 189, 32, 51.
[00719] Os primeiro até quadragésimo quinto exemplos do padrão GW para o código LDPC com o comprimento de código N de 69.120 bits podem ser aplicados em qualquer combinação do código LDPC com o comprimento de código N de 69.120 bits e uma taxa de codificação r arbitrária, um método de modulação arbitrário e uma constelação arbitrária.
[00720] Note que, quanto à intercalação grupo a grupo, o padrão GW aplicado é definido para cada combinação do comprimento de código N do código LDPC, da taxa de codificação r do código LDPC, do método de modulação e da constelação, de acordo com o que, a taxa de erro pode ser adicionalmente melhorada para cada combinação.
[00721] O padrão GW na figura 111 é aplicado, por exemplo, em uma combinação do código LDPC (correspondente à tabela de valor inicial da matriz de verificação de paridade) com N = 69.120 e r = 2/16 na figura 30 (o código LDPC com o comprimento de código N de 69.120 e a taxa de codificação r de 2/16), QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
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191/233 [00722] O padrão GW na figura 112 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 3/16 nas figuras 31 e 32, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00723] O padrão GW na figura 113 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 4/16 na figura 33, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00724] O padrão GW na figura 114 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 5/16 nas figuras 34 e 35, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00725] O padrão GW na figura 115 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 6/16 nas figuras 36 e 37, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00726] O padrão GW na figura 116 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 7/16 nas figuras 38 e 39, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00727] O padrão GW na figura 117 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 8/16 nas figuras 46 e 47, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00728] O padrão GW na figura 118 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 9/16 nas figuras 50 a 52, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00729] O padrão GW na figura 119 é aplicado, por exemplo, em uma
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192/233 combinação do código LDPC com N = 69.120 e r = 10/16 nas figuras 56 a 58, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00730] O padrão GW na figura 120 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 11/16 nas figuras 62 a 64, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00731] O padrão GW na figura 121 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 12/16 nas figuras 68 a 70, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00732] O padrão GW na figura 122 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 13/16 nas figuras 74 a 76, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00733] O padrão GW na figura 123 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 14/16 nas figuras 80 a 82, QPSK, e QPSK-UC nas figuras 96 e 97, desse modo, alcançando uma taxa de erro particularmente favorável.
[00734] O padrão GW na figura 124 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 3/16 nas figuras 31 e 32, 16QAM, e 16QAM-UC nas figuras 98 e 99, desse modo, alcançando uma taxa de erro particularmente favorável.
[00735] O padrão GW na figura 125 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 5/16 nas figuras 34 e 35, 16QAM, e 16QAM-UC nas figuras 98 e 99, desse modo, alcançando uma taxa de erro particularmente favorável.
[00736] O padrão GW na figura 126 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 7/16 nas figuras 38 e 39,
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16QAM, e 16QAM-UC nas figuras 98 e 99, desse modo, alcançando uma taxa de erro particularmente favorável.
[00737] O padrão GW na figura 127 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 9/16 nas figuras 50 a 52, 16QAM, e 16QAM-UC nas figuras 98 e 99, desse modo, alcançando uma taxa de erro particularmente favorável.
[00738] O padrão GW na figura 128 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 11/16 nas figuras 62 a 64, 16QAM, e 16QAM-UC nas figuras 98 e 99, desse modo, alcançando uma taxa de erro particularmente favorável.
[00739] O padrão GW na figura 129 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 13/16 nas figuras 74 a 76, 16QAM, e 16QAM-UC nas figuras 98 e 99, desse modo, alcançando uma taxa de erro particularmente favorável.
[00740] O padrão GW na figura 130 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 2/16 na figura 30, 64QAM, e 64QAM-UC nas figuras 100 e 101, desse modo, alcançando uma taxa de erro particularmente favorável.
[00741] O padrão GW na figura 131 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 4/16 na figura 33, 64QAM, e 64QAM-UC nas figuras 100 e 101, desse modo, alcançando uma taxa de erro particularmente favorável.
[00742] O padrão GW na figura 132 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 6/16 nas figuras 36 e 37, 64QAM, e 64QAM-UC nas figuras 100 e 101, desse modo, alcançando uma taxa de erro particularmente favorável.
[00743] O padrão GW na figura 133 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 8/16 nas figuras 46 e 47, 64QAM, e 64QAM-UC nas figuras 100 e 101, desse modo, alcançando uma
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194/233 taxa de erro particularmente favorável.
[00744] O padrão GW na figura 134 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 10/16 nas figuras 56 a 58, 64QAM, e 64QAM-UC nas figuras 100 e 101, desse modo, alcançando uma taxa de erro particularmente favorável.
[00745] O padrão GW na figura 135 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 12/16 nas figuras 68 a 70, 64QAM, e 64QAM-UC nas figuras 100 e 101, desse modo, alcançando uma taxa de erro particularmente favorável.
[00746] O padrão GW na figura 136 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 14/16 nas figuras 80 a 82, 64QAM, e 64QAM-UC nas figuras 100 e 101, desse modo, alcançando uma taxa de erro particularmente favorável.
[00747] O padrão GW na figura 137 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 3/16 nas figuras 31 e 32, 256QAM, e 256QAM-UC nas figuras 102 e 103, desse modo, alcançando uma taxa de erro particularmente favorável.
[00748] O padrão GW na figura 138 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 5/16 nas figuras 34 e 35, 256QAM, e 256QAM-UC nas figuras 102 e 103, desse modo, alcançando uma taxa de erro particularmente favorável.
[00749] O padrão GW na figura 139 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 7/16 nas figuras 38 e 39, 256QAM, e 256QAM-UC nas figuras 102 e 103, desse modo, alcançando uma taxa de erro particularmente favorável.
[00750] O padrão GW na figura 140 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 9/16 nas figuras 50 a 52, 256QAM, e 256QAM-UC nas figuras 102 e 103, desse modo, alcançando uma taxa de erro particularmente favorável.
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195/233 [00751] O padrão GW na figura 141 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 11/16 nas figuras 62 e 64, 256QAM, e 256QAM-UC nas figuras 102 e 103, desse modo, alcançando uma taxa de erro particularmente favorável.
[00752] O padrão GW na figura 142 é aplicado, por exemplo, em uma combinação do código LDPC comN = 69.120er = 13/16 nas figuras 74 a76, 256QAM, e 256QAM-UC nas figuras 102 e 103, desse modo, alcançando uma taxa de erro particularmente favorável.
[00753] O padrão GW na figura 143 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 2/16 na figura 30, 1024QAM, e 1024QAM-UC nas figuras 104 e 105, desse modo, alcançando uma taxa de erro particularmente favorável.
[00754] O padrão GW na figura 144 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 4/16 na figura 33, 1024QAM, e 1024QAM-UC nas figuras 104 e 105, desse modo, alcançando uma taxa de erro particularmente favorável.
[00755] O padrão GW na figura 145 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 6/16 nas figuras 36 e 37, 1024QAM, e 1024QAM-UC nas figuras 104 e 105, desse modo, alcançando uma taxa de erro particularmente favorável.
[00756] O padrão GW na figura 146 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 8/16 nas figuras 46 e 47, 1024QAM, e 1024QAM-UC nas figuras 104 e 105, desse modo, alcançando uma taxa de erro particularmente favorável.
[00757] O padrão GW na figura 147 é aplicado, por exemplo, em uma combinação do código LDPC comN = 69.120er = 10/16 nas figuras 56 a58, 1024QAM, e 1024QAM-UC nas figuras 104 e 105, desse modo, alcançando uma taxa de erro particularmente favorável.
[00758] O padrão GW na figura 148 é aplicado, por exemplo, em uma
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196/233 combinação do código LDPC com N = 69.120 e r = 12/16 nas figuras 68 a 70, 1024QAM, e 1024QAM-UC nas figuras 104 e 105, desse modo, alcançando uma taxa de erro particularmente favorável.
[00759] O padrão GW na figura 149 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 14/16 na figura 80 a 82, 1024QAM, e 1024QAM-UC nas figuras 104 e 105, desse modo, alcançando uma taxa de erro particularmente favorável.
[00760] O padrão GW na figura 150 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 3/16 nas figuras 31 e 32, 4096QAM, e 4096QAM-UC nas figuras 106 e 107, desse modo, alcançando uma taxa de erro particularmente favorável.
[00761] O padrão GW na figura 151 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 5/16 nas figuras 34 e 35, 4096QAM, e 4096QAM-UC nas figuras 106 e 107, desse modo, alcançando uma taxa de erro particularmente favorável.
[00762] O padrão GW na figura 152 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 7/16 nas figuras 38 e 39, 4096QAM, e 4096QAM-UC nas figuras 106 e 107, desse modo, alcançando uma taxa de erro particularmente favorável.
[00763] O padrão GW na figura 153 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 9/16 nas figuras 50 a 52, 4096QAM, e 4096QAM-UC nas figuras 106 e 107, desse modo, alcançando uma taxa de erro particularmente favorável.
[00764] O padrão GW na figura 154 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 11/16 nas figuras 62 a 64, 4096QAM, e 4096QAM-UC nas figuras 106 e 107, desse modo, alcançando uma taxa de erro particularmente favorável.
[00765] O padrão GW na figura 155 é aplicado, por exemplo, em uma combinação do código LDPC com N = 69.120 e r = 13/16 nas figuras 74 a 76,
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4096QAM, e 4096QAM-UC nas figuras 106 e 107, desse modo, alcançando uma taxa de erro particularmente favorável.
<Exemplo de configuração do dispositivo de recepção 12>
[00766] A figura 156 é um diagrama de blocos que ilustra um exemplo de configuração do dispositivo de recepção 12 na figura 7.
[00767] Uma unidade de processamento de OFDM (operação OFDM) 151 recebe um sinal OFDM a partir do dispositivo de transmissão 11 (figura 7) e realiza processamento de sinal para o sinal OFDM. Os dados obtidos pela realização do processamento de sinal pela unidade de processamento de OFDM 151 são supridos para uma unidade de gerenciamento de quadro 152.
[00768] A unidade de gerenciamento de quadro 152 processa (interpreta os quadros) um quadro configurado pelos dados supridos a partir da unidade de processamento de OFDM 151, e supre um sinal dos dados alvos resultantes e um sinal dos dados de controle para os desintercaladores de frequência 161 e 153, respectivamente.
[00769] O desintercalador de frequência 153 realiza a desintercalação de frequência em unidades de símbolo para os dados provenientes da unidade de gerenciamento de quadro 152, e supre os dados para um desmapeador 154. [00770] O desmapeador 154 realiza o desmapeamento (decodificação de arranjo do ponto de sinal) e demodulação de quadratura para os dados (dados na constelação) provenientes do desintercalador de frequência 153 com base no arranjo (constelação) dos pontos de sinal determinados pela modulação por quadratura realizada no lado do dispositivo de transmissão 11, e supre os dados resultantes ((probabilidade) do código LDPC) para um decodificador de LDPC 155.
[00771] O decodificador de LDPC 155 realiza a decodificação LDPC para o código LDPC proveniente do desmapeador 154, e supre os dados LDPC alvos resultantes (aqui, código BCH) para um decodificador de BCH
156.
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198/233 [00772] O decodificador de BCH 156 realiza a decodificação de BCH para os dados LDPC alvos provenientes do decodificador de LDPC 155, e transmite os dados de controle resultantes (sinalização).
[00773] Neste ínterim, o desintercalador de frequência 161 realiza a desintercalação de frequência em unidades de símbolo para os dados provenientes da unidade de gerenciamento de quadro 152, e supre os dados para o decodificador de SISO/MISO 162.
[00774] O decodificador de SISO/MISO 162 realiza a decodificação de espaço-tempo dos dados provenientes do desintercalador de frequência 161 e supre os dados para um desintercalador de tempo 163.
[00775] O desintercalador de tempo 163 desintercala os dados provenientes do decodificador de SISO/MISO 162 em unidades de símbolo e supre os dados para um desmapeador 164.
[00776] O desmapeador 164 realiza o desmapeamento (decodificação de arranjo do ponto de sinal) e a demodulação de quadratura para os dados (dados na constelação) provenientes do desintercalador de tempo 163 com base no arranjo (constelação) dos pontos de sinal determinados pela modulação por quadratura realizada no lado do dispositivo de transmissão 11, e supre os dados resultantes para um desintercalador de bit 165.
[00777] O desintercalador de bit 165 realiza a desintercalação de bit para os dados provenientes do desmapeador 164, e supre (probabilidade do) o código LDPC, que são os dados depois da desintercalação de bit, para o decodificador de LDPC 166.
[00778] O decodificador de LDPC 166 realiza a decodificação LDPC para o código LDPC proveniente do desintercalador de bit 165, e supre os dados LDPC alvos resultantes (aqui, o código BCH) para o decodificador de BCH 167.
[00779] O decodificador de BCH 167 realiza a decodificação de BCH para os dados LDPC alvos provenientes do decodificador de LDPC 155, e
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199/233 supre os dados resultantes para um desembaralhador de BB 168.
[00780] O desembaralhador de BB 168 aplica o desembaralhamento de BB nos dados provenientes do decodificador de BCH 167, e supre os dados resultantes para uma unidade de deleção de nulo 169.
[00781] A unidade de deleção de nulo 169 deleta o nulo inserido pelo preenchedor 112 na figura 8 dos dados provenientes do desembaralhador de BB 168, e supre os dados para o demultiplexador 170.
[00782] O demultiplexador 170 demultiplexa cada um de um ou mais fluxos contínuos (dados alvos) multiplexados nos dados provenientes da unidade de deleção de nulo 169, aplica o processamento necessário, e transmite um resultado como um fluxo contínuo de saída.
[00783] Note que o dispositivo de recepção 12 pode ser configurado sem incluir uma parte dos blocos ilustrados na figura 156. Em outras palavras, em um caso em que o dispositivo de transmissão 11 (figura 8) for configurado sem incluir o intercalador de tempo 118, o codificador SISO/MISO 119, o intercalador de frequência 120 e o intercalador de frequência 124, por exemplo, o dispositivo de recepção 12 pode ser configurado sem incluir o desintercalador de tempo 163, o decodificador de SISO/MISO 162, o desintercalador de frequência 161 e o desintercalador de frequência 153, que são os blocos respectivamente correspondentes ao intercalador de tempo 118, ao codificador SISO/MISO 119, ao intercalador de frequência 120 e ao intercalador de frequência 124 do dispositivo de transmissão 11.
<Exemplo de configuração do desintercalador de bit 165 >
[00784] A figura 157 é um diagrama de blocos que ilustra um exemplo de configuração do desintercalador de bit 165 na figura 156.
[00785] O desintercalador de bit 165 é configurado pelo desintercalador de bloco 54 e pelo desintercalador grupo a grupo 55, e realiza desintercalação (bit) de um bit de símbolo de um símbolo que compreende os dados provenientes do desmapeador 164 (figura 156).
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200/233 [00786] Em outras palavras, o desintercalador de bloco 54 realiza, para o bit de símbolo do símbolo proveniente do desmapeador 164, a desintercalação de bloco correspondente à intercalação de bloco realizada pelo intercalador de bloco 25 na figura 9 (processamento reverso à intercalação de bloco), em outras palavras, a desintercalação de bloco de retorno das posições dos (a probabilidade dos) bits de código do código LDPC permutado pela intercalação de bloco para as posições originais, e supre um código LDPC resultante para o desintercalador grupo a grupo 55.
[00787] O desintercalador grupo a grupo 55 realiza, por exemplo, para o código LDPC proveniente do desintercalador de bloco 54, a desintercalação grupo a grupo correspondente à intercalação grupo a grupo realizada pelo intercalador grupo a grupo 24 na figura 9 (processamento reverso à intercalação grupo a grupo), em outras palavras, a desintercalação grupo a grupo de rearranjo, em unidades de grupos de bits, da sequência dos bits de código do código LDPC mudado em unidades de grupos de bits pela intercalação grupo a grupo descrita na figura 110 para retomar para a sequência original.
[00788] Aqui, em um caso em que a intercalação de paridade, a intercalação grupo a grupo e a intercalação de bloco foram aplicadas no código LDPC a ser suprido do desmapeador 164 para o desintercalador de bit 165, o desintercalador de bit 165 pode realizar todas da desintercalação de paridade correspondente à intercalação de paridade (processamento reverso à intercalação de paridade, em outras palavras, a desintercalação de paridade de retorno da sequência dos bits de código do código LDPC mudado pela intercalação de paridade para a sequência original, da desintercalação de bloco correspondente à intercalação de bloco, e da desintercalação grupo a grupo correspondente à intercalação grupo a grupo.
[00789] Note que o desintercalador de bit 165 na figura 157 é provido com o desintercalador de bloco 54 para realizar a desintercalação de bloco
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201 /233 correspondente à intercalação de bloco, e o desintercalador grupo a grupo 55 para realizar a desintercalação grupo a grupo correspondente à intercalação grupo a grupo, mas o desintercalador de bit 165 não é provido com um bloco para realizar a desintercalação de paridade correspondente à intercalação de paridade, e não realiza a desintercalação de paridade.
[00790] Portanto, o código LDPC para o qual a desintercalação de bloco e a desintercalação grupo a grupo são realizadas e a desintercalação de paridade não é realizada é suprido do (o desintercalador grupo a grupo 55 do) desintercalador de bit 165 para o decodificador de LDPC 166.
[00791] O decodificador de LDPC 166 realiza a decodificação LDPC para o código LDPC proveniente do desintercalador de bit 165, usando uma matriz de verificação de paridade transformada obtida pela realização pelo menos da permuta de coluna correspondente à intercalação de paridade para a matriz de verificação de paridade H pelo método tipo B usado para a codificação LDPC pelo codificador de LDPC 115 na figura 8, ou uma matriz de verificação de paridade transformada (figura 29) obtida pela realização da permuta de linha para a matriz de verificação de paridade (figura 27) pelo método tipo A, e transmite os dados resultantes como um resultado da decodificação dos dados LDPC alvos.
[00792] A figura 158 é um fluxograma para descrever o processamento realizado pelo desmapeador 164, pelo desintercalador de bit 165 e pelo decodificador de LDPC 166 na figura 157.
[00793] Na etapa S111, o desmapeador 164 realiza o desmapeamento e a demodulação de quadratura para os dados provenientes do desintercalador de tempo 163 (os dados na constelação mapeados para os pontos de sinal) e supre os dados para o desintercalador de bit 165. O processamento prossegue para a etapa SI 12.
[00794] Na etapa SI 12, o desintercalador de bit 165 desintercala (desintercalação de bits) os dados provenientes do desmapeador 164. O
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202/233 processo prossegue para a etapa SI 13.
[00795] Em outras palavras, na etapa SI 12, no desintercalador de bit
165, o bloco do desintercalador de bloco 54 desintercala os dados (símbolo) provenientes do desmapeador 164, e supre os bits de código de um código LDPC resultante para o desintercalador grupo a grupo 55.
[00796] O desintercalador grupo a grupo 55 desintercala grupo a grupo o código LDPC proveniente do desintercalador de bloco 54, e supre o (a probabilidade do) código LDPC resultante para o decodificador de LDPC
166.
[00797] Na etapa SI 13, o decodificador de LDPC 166 realiza a decodificação LDPC para o código LDPC proveniente do desintercalador grupo a grupo 55 usando a matriz de verificação de paridade H usada para a codificação LDPC pelo codificador de LDPC 115 na figura 8, em outras palavras, a matriz de verificação de paridade transformada obtida a partir da matriz de verificação de paridade H, por exemplo, e supre os dados resultantes como um resultado da decodificação dos dados LDPC alvos para o decodificador de BCH 167.
[00798] Note que, mesmo na figura 157, o desintercalador de bloco 54 para realizar a desintercalação de bloco e o desintercalador grupo a grupo 55 para realizar a desintercalação grupo a grupo são separadamente configurados, como no caso da figura 9, por conveniência de descrição. Entretanto, o desintercalador de bloco 54 e o desintercalador grupo a grupo 55 podem ser integralmente configurados.
[00799] Além do mais, em um caso em que a intercalação grupo a grupo não for realizada no dispositivo de transmissão 11, o dispositivo de recepção 12 pode ser configurado sem incluir o desintercalador grupo a grupo 55 para realizar a desintercalação grupo a grupo.
<Decodificação LDPC>
[00800] A decodificação LDPC realizada pelo decodificador de LDPC
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166 na figura 156 será adicionalmente descrita.
[00801] O decodificador de LDPC 166 na figura 156 realiza a decodificação LDPC para o código LDPC proveniente do desintercalador grupo a grupo 55, para o qual a desintercalação de bloco e a desintercalação grupo a grupo foram realizadas e a desintercalação de paridade não foi realizada, usando uma matriz de verificação de paridade transformada obtida pela realização pelo menos da permuta de coluna correspondente à intercalação de paridade para a matriz de verificação de paridade H pelo método tipo B usado para a codificação LDPC pelo codificador de LDPC 115 na figura 8, ou a matriz de verificação de paridade transformada (figura 29) obtida pela realização da permuta de linha para a matriz de verificação de paridade (figura 27) pelo método tipo A.
[00802] Aqui, a decodificação LDPC para habilitar a supressão de uma escala de circuito e a supressão de uma frequência de operação em uma faixa suficientemente factível por ser realizada usando uma matriz de verificação de paridade transformada foi previamente proposta (por exemplo, veja a Patente 4224777).
[00803] Portanto, primeiro, a decodificação LDPC que usa uma matriz de verificação de paridade transformada, que foi previamente proposta, será descrita em relação às figuras 159 a 162.
[00804] A figura 159 é um diagrama que ilustra um exemplo de uma matriz de verificação de paridade H de um código LDPC com um comprimento de código N de 90 e uma taxa de codificação de 2/3.
[00805] Note que, na figura 159 (similarmente realizada nas figuras 160 e 161 descritas a seguir), 0 é representado por um ponto (.).
[00806] Na matriz de verificação de paridade H na figura 159, a matriz de paridade tem uma estrutura de degrau.
[00807] A figura 160 é um diagrama que ilustra uma matriz de verificação de paridade H' obtida pela aplicação da permuta de linha da
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204/233 expressão (11) e da permuta de coluna da expressão (12) para a matriz de verificação de paridade H na figura 159.
Permuta de linha: (6s + t + l)-ésima linha —»(5t + s + l)-ésima linha ... (11) Permuta de coluna: (6x + y + 61)-ésima coluna (5y + x + 61)-ésima coluna - (12) [00808] Note que, nas expressões (11) e (12), s, t, x, e y são números inteiros nas faixas de 0 < s < 5, 0 < t < 6, 0 < x < 5, e 0 < t < 6, respectivamente.
[00809] De acordo com a permuta de linha da expressão (11), a permuta é realizada de uma maneira tal que as 1,7, 13, 19e 25a linhas em que o restante se toma 1 quando são divididas por 6 sejam respectivamente permutadas para as 1, 2, 3, 4, e 5a linhas, e as 2, 8, 14, 20, e 26a linhas em que o restante toma-se 2 quando são divididas por 6 sejam respectivamente permutadas para as 6, 7, 8, 9, e 10a linhas.
[00810] Além do mais, de acordo com a permuta de coluna da expressão (12), a permuta é realizada para a 61a coluna e as subsequentes colunas (matriz de paridade) de uma maneira tal que as 61, 67, 73, 79, e 85a colunas em que o restante toma-se 1 quando são divididas por 6 sejam respectivamente permutadas para as 61, 62, 63, 64, e 65a colunas, e as 62, 68, 74, 80, e 86a colunas em que o restante toma-se 2 quando são divididas por 6 sejam respectivamente permutadas para a 66, 67, 68, 69, e 70a colunas.
[00811] Uma matriz obtida pela realização da permuta de linha e de coluna para a matriz de verificação de paridade H na figura 159 é a matriz de verificação de paridade H' na figura 160.
[00812] Aqui, a permuta de linha da matriz de verificação de paridade H não afeta a sequência dos bits de código do código LDPC.
[00813] Além do mais, a permuta de coluna da expressão (12) corresponde à intercalação de paridade com o comprimento da informação K de 60, o tamanho de unidade P de 5, e o divisor q (= M/P) do comprimento de
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205/233 paridade Μ (30, aqui) de 6, da intercalação de paridade da intercalação do (K + qx + y + l)-ésimo bit de código em uma posição do (K + Py + x + l)-ésimo bit de código.
[00814] Portanto, a matriz de verificação de paridade H' na figura 160 é uma matriz de verificação de paridade transformada obtida pela realização pelo menos da permuta de coluna de permuta da (K + qx + y + l)-ésima coluna para a (K + Py + x + l)-ésima coluna, da matriz de verificação de paridade (a seguir referida como matriz de verificação de paridade original conforme apropriado) H na figura 159.
[00815] Pela multiplicação da matriz de verificação de paridade transformada H’ na figura 160 por um resultante obtido pela realização da mesma permuta da expressão (12) para o código LDPC da matriz de verificação de paridade H original na figura 159, um vetor 0 é transmitido. Em outras palavras, considerando que um vetor de linha obtido pela aplicação da permuta de coluna da expressão (12) para o vetor de linha c como o código LDPC (uma palavra código) da matriz de verificação de paridade H original é representado por c’, H’c'T naturalmente toma-se um vetor 0 em virtude de HcT se tomar um vetor 0 a partir da natureza da matriz de verificação de paridade.
[00816] A partir do exposto, a matriz de verificação de paridade transformada H' na figura 160 é uma matriz de verificação de paridade do código LDPC c' obtido pela realização da permuta de coluna da expressão (12) para o código LDPC c da matriz de verificação de paridade H original.
[00817] Portanto, um resultado da decodificação similar ao caso da decodificação do código LDPC da matriz de verificação de paridade H original usando a matriz de verificação de paridade H pode ser obtido pela realização da permuta de coluna da expressão (12) para o código LDPC c da matriz de verificação de paridade H original, da decodificação (decodificação LDPC) do código LDPC c’ depois da permuta de coluna usando a matriz de verificação de paridade transformada H’ na figura 160, e da aplicação da
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206/233 permuta reversa na permuta de coluna da expressão (12) no resultado da decodificação.
[00818] A figura 161 é um diagrama que ilustra a matriz de verificação de paridade transformada H' na figura 160, que é separada em unidades de matriz 5x5.
[00819] Na figura 161, a matriz de verificação de paridade transformada H' é representada por uma combinação de uma matriz identidade de 5 x 5 (= P x P) como o tamanho de unidade P, uma matriz em que um ou mais de Is na matriz identidade tornam-se 0 (a seguir, a matriz é referida como a matriz quase identidade), uma matriz obtida pelo deslocamento cíclico da matriz identidade ou da matriz quase identidade (a seguir, a matriz é referida como a matriz de deslocamento conforme apropriado), e uma soma de duas ou mais da matriz identidade, da matriz quase identidade e da matriz de deslocamento (a seguir, a matriz é referida como matriz de soma conforme apropriado), e uma matriz zero 5x5.
[00820] Pode ser dito que a matriz de verificação de paridade transformada H' na figura 161 é configurada pela matriz identidade 5x5, pela matriz quase identidade, pela matriz de deslocamento, pela matriz de soma e pela matriz 0. Portanto, estas matrizes 5 x 5 (a matriz identidade, a matriz quase identidade, a matriz de deslocamento, a matriz de soma, e a matriz 0) que constituem a matriz de verificação de paridade transformada H' são a seguir referidas como as matrizes de configuração conforme apropriado.
[00821] Para a decodificação de um código LDPC de uma matriz de verificação de paridade representada por matrizes de configuração P x P, uma arquitetura que realiza simultaneamente P operações no nó de verificação e operações no nó variável pode ser usada.
[00822] A figura 162 é um diagrama de blocos que ilustra um exemplo de configuração de um dispositivo de decodificação que realiza tal decodificação.
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207/233 [00823] Em outras palavras, a figura 162 ilustra um exemplo de configuração de um dispositivo de decodificação que decodifica o código LDPC usando a matriz de verificação de paridade transformada H’ na figura 161 obtida pela realização pelo menos da permuta de coluna da expressão (12) para a matriz de verificação de paridade H original na figura 159.
[00824] O dispositivo de decodificação na figura 162 inclui uma memória de armazenamento dos dados de borda 300 que inclui seis PILOs 300i a 300ô, um seletor 301 para selecionar os PILOs 300i a 300ô, uma unidade de cálculo do nó de verificação 302, dois circuitos de deslocamento cíclico 303 e 308, uma memória de armazenamento dos dados de borda 304 que inclui dezoito PILOs 304i a 30418, um seletor 305 para selecionar os PILOs 304i a 30418, uma memória de dados recebidos 306 para armazenar dados recebidos, uma unidade de cálculo do nó variável 307, uma unidade de cálculo de palavra decodificada 309, uma unidade de rearranjo dos dados recebidos 310, e uma unidade de rearranjo dos dados decodificados 311.
[00825] Primeiro, um método de armazenamento de dados nas memórias de armazenamento de dados de borda 300 e 304 será descrito.
[00826] A memória de armazenamento dos dados de borda 300 é configurada pelos seis PILOs 300i a 300ô, o seis correspondendo a um número obtido pela divisão do número de linhas de 30 da matriz de verificação de paridade transformada H’ na figura 161 pelo número de linhas (tamanho de unidade P) de 5 da matriz de configuração. O PIPO 300y (y = 1,
2,..., 6) inclui as áreas de armazenamento de uma pluralidade de estágios, e as mensagens correspondentes a cinco bordas, o cinco correspondente ao número de linhas e ao número de colunas (tamanho de unidade P) da matriz de configuração, podem ser lidas e gravadas ao mesmo tempo em relação às áreas de armazenamento dos respectivos estágios. Além do mais, o número de estágios das áreas de armazenamento do PIPO 300y é nove, que é o valor máximo do número de Is (pesos de Hamming) na direção da linha da matriz
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208/233 de verificação de paridade transformada na figura 161.
[00827] No FIFO 300i, os dados (mensagem ví proveniente do nó variável) correspondentes às posições de 1 das Ia a 5a linhas da matriz de verificação de paridade transformada H' na figura 161 são armazenados próximos uns dos outros (ignorando 0) para cada linha na direção transversal. Em outras palavras, os dados correspondentes às posições de 1 da matriz identidade 5 x 5 de (1, 1) a (5, 5) da matriz de verificação de paridade transformada H’ são armazenados na área de armazenamento do primeiro estágio do FIFO 300i, em que j linhas por i colunas são representadas por (j, i). Os dados correspondentes às posições de 1 da matriz de deslocamento de (1, 21) a (5, 25) da matriz de verificação de paridade transformada H' (a matriz de deslocamento obtida pelo deslocamento cíclico da matriz identidade 5 x 5 em três na direção direita) são armazenados na área de armazenamento do segundo estágio. Os dados são armazenados em associação com a matriz de verificação de paridade transformada H’, similarmente nas áreas de armazenamento dos terceiro ao oitavo estágios. Então, os dados correspondentes às posições de 1 da matriz de deslocamento de (1, 86) a (5, 90) da matriz de verificação de paridade transformada H’ (a matriz de deslocamento obtida pela substituição de 1 na Ia linha da matriz identidade 5 x 5 por 0 e pelo deslocamento cíclico da matriz identidade por 1 na direção esquerda) são armazenados na área de armazenamento do nono estágio.
[00828] Os dados correspondentes às posições de 1 de das 6a a 10a linhas da matriz de verificação de paridade transformada H' na figura 161 são armazenados no FIFO 3002. Em outras palavras, os dados correspondentes às posições de 1 de uma primeira matriz de deslocamento que constitui a matriz de soma de (6, 1) a (10, 5) da matriz de verificação de paridade transformada H’ (a matriz de soma que é uma soma da primeira matriz de deslocamento obtida pelo deslocamento cíclico da matriz identidade 5 x 5 em 1 para a direita e uma segunda matriz de deslocamento obtida pelo deslocamento
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209/233 cíclico da matriz identidade 5 x 5 em 2 para a direita) são armazenados na área de armazenamento do primeiro estágio do FIFO 3002. Além do mais, os dados correspondentes às posições de 1 da segunda matriz de deslocamento que constitui a matriz de soma de (6, 1) a (10, 5) da matriz de verificação de paridade transformada H’ são armazenados na área de armazenamento do segundo estágio.
[00829] Em outras palavras, em relação à matriz de configuração com o peso de 2 ou mais, quando a matriz de configuração for expressada em uma forma de uma soma de algumas matrizes de uma matriz identidade P x P com o peso de 1, uma matriz quase identidade na qual um ou mais dos elementos de 1 da matriz identidade são 0, e uma matriz de deslocamento obtida pelo deslocamento cíclico da matriz identidade ou da matriz quase identidade, os dados (mensagem correspondente a uma borda que pertence à matriz identidade, à matriz quase identidade ou à matriz de deslocamento) correspondentes a uma posição de 1 da matriz identidade com o peso de 1, da matriz quase identidade ou da matriz de deslocamento são armazenados no mesmo endereço (o mesmo FIFO dos FIFOs 300i a 300ô).
[00830] A seguir, os dados são armazenados em associação com a matriz de verificação de paridade transformada H’, similarmente nas áreas de armazenamento dos terceiro ao nono estágios.
[00831] Os dados são similarmente armazenados nos FIFOs 3OO3 a 300ô em associação com a matriz de verificação de paridade transformada H’.
[00832] A memória de armazenamento dos dados de borda 304 é configurada pelos dezoito FIFOs 304i a 30418, os dezoito correspondendo a um número obtido pela divisão do número de colunas de 90 da matriz de verificação de paridade transformada H’ pelo número de colunas (tamanho de unidade P) de 5 da matriz de configuração. O FIFO 304x (x = 1, 2,..., 18) inclui as áreas de armazenamento de uma pluralidade de estágios, e as mensagens correspondentes a cinco bordas, as cinco correspondendo ao
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210/233 número de linhas e ao número de colunas (tamanho de unidade P) da matriz de configuração, podem ser lidas e gravadas ao mesmo tempo em relação às áreas de armazenamento dos respectivos estágios.
[00833] No FIFO 304i, os dados (mensagem Uj proveniente do nó de verificação) correspondentes às posições de 1 das Ia à 5a colunas da matriz de verificação de paridade transformada H' na figura 161 são armazenados próximos uns dos outros (ignorando 0) para cada coluna na direção vertical. Em outras palavras, os dados correspondentes às posições de 1 da matriz identidade 5 x 5 de (1, 1) a (5, 5) da matriz de verificação de paridade transformada H’ são armazenados na área de armazenamento do primeiro estágio do FIFO 304i. Os dados correspondentes às posições de 1 de uma primeira matriz de deslocamento que constitui a matriz de soma de (6, 1) a (10, 5) da matriz de verificação de paridade transformada H’ (a matriz de soma que é uma soma da primeira matriz de deslocamento obtida pelo deslocamento cíclico da matriz identidade 5 x 5 em 1 para a direita e uma segunda matriz de deslocamento obtida pelo deslocamento cíclico da matriz identidade 5x5 em 2 para a direita) são armazenados na área de armazenamento do segundo estágio. Além do mais, os dados correspondentes às posições de 1 da segunda matriz de deslocamento que constitui a matriz de soma de (6, 1) a (10, 5) da matriz de verificação de paridade transformada H’ são armazenados na área de armazenamento do terceiro estágio.
[00834] Em outras palavras, em relação à matriz de configuração com o peso de 2 ou mais, quando a matriz de configuração for expressada em uma forma de uma soma de algumas matrizes de uma matriz identidade P x P com o peso de 1, uma matriz quase identidade na qual um ou mais dos elementos de 1 da matriz identidade são 0, e uma matriz de deslocamento obtida pelo deslocamento cíclico da matriz identidade ou da matriz quase identidade, os dados (mensagem correspondente a uma borda que pertence à matriz identidade, à matriz quase identidade ou à matriz de deslocamento)
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211/233 correspondentes à posição de 1 da matriz identidade com o peso de 1, da matriz quase identidade ou da matriz de deslocamento são armazenados no mesmo endereço (o mesmo FIFO dos FIFOs 304i a 304is).
[00835] A seguir, os dados são armazenados em associação com a matriz de verificação de paridade transformada H’, similarmente nas áreas de armazenamento dos quarto e quinto estágios. O número de estágios das áreas de armazenamento do FIFO 304i é cinco, que é o máximo valor do número de Is (pesos de Hamming) na direção da linha nas Ia à 5a colunas da matriz de verificação de paridade transformada H’.
[00836] Os dados são similarmente armazenados nos FIFOs 3042 e 304s em associação com a matriz de verificação de paridade transformada H’, e os respectivos comprimentos (estágios) são cinco. Os dados são similarmente armazenados nos FIFOs 304g e 30412 em associação com a matriz de verificação de paridade transformada H’, e os respectivos comprimentos são três. Os dados são similarmente armazenados nos FIFOs 30413 e 30418 em associação com a matriz de verificação de paridade transformada H’, e os respectivos comprimentos são dois.
[00837] A seguir, a operação do dispositivo de decodificação na figura 162 será descrita.
[00838] A memória de armazenamento dos dados de borda 300 inclui seis FIFOs 300i a 300ô, e seleciona o FIFO para armazenar os dados dentre os seis FIFOs 300i a 300ô de acordo com a informação (dados da Matriz) D312 que indica a qual linha da matriz de verificação de paridade transformada H’ na figura 161 cinco mensagens D311 supridas a partir do circuito de deslocamento cíclico anterior 308 pertencem, e armazena coletivamente as cinco mensagens D311 no FIFO selecionado em ordem. Além do mais, na leitura de dados, a memória de armazenamento dos dados de borda 300 lê sequencialmente as cinco mensagens D300i a partir do FIFO 300i e supre as mensagens lidas para o seletor do próximo estágio 301. A memória de
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212/233 armazenamento dos dados de borda 300 lê sequencialmente as mensagens a partir dos FIFOs 3002 a 300ô depois da conclusão da leitura da mensagem a partir do FIFO 300i, e supre as mensagens para o seletor 301.
[00839] O seletor 301 seleciona as cinco mensagens a partir do FIFO que está sendo atualmente lido, dos FIFOs 300i a 300ô, de acordo com um sinal de seleção D301, e supre as mensagens como a mensagem D302 para a unidade de cálculo do nó de verificação 302.
[00840] A unidade de cálculo do nó de verificação 302 inclui cinco calculadoras do nó de verificação 302i a 302s, e realiza a operação do nó de verificação de acordo com a expressão (7), usando a mensagem D302 (D302i a D302s) (a mensagem ví da expressão (7)) suprida através do seletor 301, e supre as cinco mensagens D3O3 (D3O31 a D3O3s) obtidas em decorrência da operação do nó de verificação (mensagem Uj da expressão (7)) para o circuito de deslocamento cíclico 303.
[00841] O circuito de deslocamento cíclico 303 desloca ciclicamente as cinco mensagens D3O31 a D3O3s obtidas pela unidade de cálculo do nó de verificação 302, com base na informação (dados da Matriz) D305 que indica quantas matrizes identidades (ou matrizes quase identidade), que são a base da matriz de verificação de paridade transformada H’, foram ciclicamente deslocadas para a correspondente borda, e supre um resultado como uma mensagem D304 para a memória de armazenamento dos dados de borda 304.
[00842] A memória de armazenamento dos dados de borda 304 inclui dezoito FIFOs 304i a 30418, e seleciona o FIFO para armazenar os dados dentre os FIFOs 304i a 30418 de acordo com a informação D305 que indica a qual linha da matriz de verificação de paridade transformada H’ as cinco mensagens D304 supridas a partir do circuito de deslocamento cíclico anterior 303 pertencem, e armazena coletivamente as cinco mensagens D304 no FIFO selecionado em ordem. Além do mais, na leitura dos dados, a memória de armazenamento dos dados de borda 304 lê sequencialmente as cinco
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213/233 mensagens D306i a partir do FIFO 304i e supre as mensagens lidas para o seletor do próximo estágio 305. A memória de armazenamento dos dados de borda 304 lê sequencialmente as mensagens a partir dos FIFOs 3042 a 30418 depois da conclusão da leitura da mensagem a partir do FIFO 304i, e supre as mensagens para o seletor 305.
[00843] O seletor 305 seleciona as cinco mensagens a partir do FIFO que está sendo atualmente lidos, dos FIFOs 304i a 30418, de acordo com um sinal de seleção D307, e supre as mensagens como mensagem D308 para a unidade de cálculo do nó variável 307 e a unidade de cálculo de palavra decodificada 309.
[00844] Neste ínterim, a unidade de rearranjo dos dados recebidos 310 rearranja o código LDPC D313 correspondente à matriz de verificação de paridade H na figura 159, que foi recebido por meio do caminho de comunicação 13, pela realização da permuta de coluna da expressão (12), e supre os dados como os dados recebidos D314 para a memória de dados recebidos 306. A memória de dados recebidos 306 calcula e armazena a LLR (razão de probabilidade logarítmica) recebida a partir dos dados recebidos D314 supridos a partir da unidade de rearranjo dos dados recebidos 310, e agrupa cinco LLRs recebidas e supre coletivamente as cinco LLRs recebidas como um valor recebido D309 para a unidade de cálculo do nó variável 307 e a unidade de cálculo de palavra decodificada 309.
[00845] A unidade de cálculo do nó variável 307 inclui cinco calculadoras de nó variável 3071 a 307s, e realiza a operação do nó variável de acordo com a expressão (1), usando a mensagem D308 (D308i a D308s) (mensagem Uj da expressão (1)) suprida por meio do seletor 305, e os cinco valores recebidos D309 (valor recebido uoí da expressão (1))) supridos a partir da memória de dados recebidos 306, e supre uma mensagem D310 (D310i a D310s) (mensagem ví da expressão (1))) obtida em decorrência da operação para o circuito de deslocamento cíclico 308.
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214/233 [00846] O circuito de deslocamento cíclico 308 desloca ciclicamente as mensagens D310i a D310s calculadas pela unidade de cálculo do nó variável 307, com base na informação que indica quantas matrizes identidades (ou matrizes quase identidade), que são a base da matriz de verificação de paridade transformada H’, foram ciclicamente deslocadas para a correspondente borda, e supre um resultado como uma mensagem D311 para a memória de armazenamento dos dados de borda 300.
[00847] Por uma rodada da operação exposta, uma decodificação (operação do nó variável e operação do nó de verificação) do código LDPC pode ser realizada. Depois da decodificação do código LDPC um número predeterminado de vezes, o dispositivo de decodificação na figura 162 obtém e transmite um resultado da decodificação final na unidade de cálculo de palavra decodificada 309 e na unidade de rearranjo dos dados decodificados 311.
[00848] Em outras palavras, a unidade de cálculo de palavra decodificada 309 inclui cinco calculadoras de palavra decodificada 3091 até 309s e, como um estágio final da pluralidade de vezes de decodificação, calcula o resultado da decodificação (palavra decodificada) com base na expressão (5), usando as cinco mensagens D308 (D308i a D3O85) (mensagem Uj da expressão (5)) transmitidas pelo seletor 305, e os cinco valores recebidos D309 (valor recebido uoí da expressão (5)) supridos a partir da memória de dados recebidos 306, e supre os dados decodificados resultantes D315 para a unidade de rearranjo dos dados decodificados 311.
[00849] A unidade de rearranjo dos dados decodificados 311 rearranja os dados decodificados D315 supridos a partir da unidade de cálculo de palavra decodificada 309 pela realização da permuta reversa à permuta de coluna da expressão (12), e transmite um resultado da decodificação final D316.
[00850] Da forma supradescrita, pela aplicação pelo menos de uma ou
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215/233 de ambas da permuta de linha e da permuta de coluna na matriz de verificação de paridade (matriz de verificação de paridade original) para converter a matriz de verificação de paridade em uma matriz de verificação de paridade (matriz de verificação de paridade transformada) que pode ser representada por uma combinação de uma matriz identidade P x P, uma matriz quase identidade na qual um ou mais dos elementos de 1 na matriz identidade são 0, uma matriz de deslocamento na qual a matriz identidade ou a matriz quase identidade é ciclicamente deslocada, uma matriz de soma que é uma soma de duas ou mais da matriz identidade, da matriz quase identidade e da matriz de deslocamento, e uma matriz zero P x P, em outras palavras, por uma combinação das matrizes de configuração, uma arquitetura para realizar P operações no nó de verificação e operações no nó variável ao mesmo tempo para a decodificação do código LDPC, o P sendo um número menor do que o número de linhas e o número de colunas da matriz de verificação de paridade, pode ser adotada. No caso de adoção da arquitetura para realizar P operações de nó (operações no nó de verificação e operações no nó variável) ao mesmo tempo, o P sendo o número menor do que o número de linhas e o número de colunas da matriz de verificação de paridade, um grande número de decodificações repetitivas pode ser realizado ao mesmo tempo em que suprime a frequência de operação para a faixa factível, se comparado com um caso de realização do número de operações de nó ao mesmo tempo, o número sendo igual ao número de linhas e ao número de colunas da matriz de verificação de paridade.
[00851] O decodificador de LDPC 166 que configura o dispositivo de recepção 12 na figura 156 realiza as P operações no nó de verificação e operações no nó variável ao mesmo tempo, por exemplo, similarmente ao dispositivo de decodificação na figura 162, desse modo, realizando a decodificação LDPC.
[00852] Em outras palavras, para simplificar a descrição, considerando
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216/233 que a matriz de verificação de paridade do código LDPC transmitido pelo codificador de LDPC 115 que configura o dispositivo de transmissão 11 na figura 8 é a matriz de verificação de paridade H com a matriz de paridade que tem uma estrutura de degrau, da forma ilustrada na figura 159, por exemplo, o intercalador de paridade 23 do dispositivo de transmissão 11 realiza a intercalação de paridade na qual o (K + qx + y + l)-ésimo bit de código é intercalado na posição do (K + Py + x + l)-ésimo bit de código, com a definição do comprimento da informação K de 60, o tamanho de unidade P de 5, o divisor q (= M/P) do comprimento de paridade M de 6.
[00853] Já que esta intercalação de paridade corresponde à permuta de coluna da expressão (12), como exposto, o decodificador de LDPC 166 não precisa realizar a permuta de coluna da expressão (12).
[00854] Portanto, o dispositivo de recepção 12 na figura 156 realiza o processamento similar ao dispositivo de decodificação na figura 162, exceto em que o código LDPC para o qual a desintercalação de paridade não foi realizada, em outras palavras, o código LDPC no estado em que a permuta de coluna pela expressão (12) foi realizada é suprido do desintercalador grupo a grupo 55 para o decodificador de LDPC 166, como exposto, e o decodificador de LDPC 166 não realiza a permuta de coluna da expressão (12).
[00855] Em outras palavras, a figura 163 é um diagrama que ilustra um exemplo de configuração do decodificador de LDPC 166 na figura 156.
[00856] Na figura 163, o decodificador de LDPC 166 é similarmente configurado para o dispositivo de decodificação na figura 162, exceto em que a unidade de rearranjo dos dados recebidos 310 na figura 162 não é provida, e realiza o processamento similar ao dispositivo de decodificação na figura 162, exceto em que a permuta de coluna da expressão (12) não é realizada. Portanto, a descrição é omitida.
[00857] Da forma supradescrita, já que o decodificador de LDPC 166 pode ser configurado sem prover a unidade de rearranjo dos dados recebidos
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310, a escala pode ser reduzida, se comparada com o dispositivo de decodificação na figura 162.
[00858] Note que, nas figuras 159 a 163, para simplificar a descrição, o código LDPC foi definido no comprimento de código N de 90, no comprimento da informação K de 60, no tamanho de unidade (o números de linhas e colunas da matriz de configuração) P de 5, e o divisor q (= M/P) do comprimento de paridade M de 6. Entretanto, o comprimento de código N, o comprimento da informação K, o tamanho de unidade P e o divisor q (= M/P) não são limitados aos valores supradescritos.
[00859] Em outras palavras, no dispositivo de transmissão 11 na figura 8, o que o codificador de LDPC 115 transmite são os códigos LDPC com os comprimentos de código N de 64.800, 16.200, 69.120 e semelhantes, por exemplo, o comprimento da informação K de N - Pq(= N - Μ), o tamanho de unidade P de 360, e o divisor q de M/P. Entretanto, o decodificador de LDPC 166 na figura 163 pode ser aplicado em um caso de realização da decodificação LDPC pela realização das P operações no nó de verificação e das operações no nó variável ao mesmo tempo para um código LDPC como este.
[00860] Além do mais, depois da decodificação do código LDPC no decodificador de LDPC 166, a parte de paridade do resultado da decodificação é desnecessária e, em um caso de transmissão apenas do bit de informação do resultado da decodificação, o decodificador de LDPC 166 pode ser configurado sem a unidade de rearranjo dos dados decodificados
311.
<Exemplo de configuração do desintercalador de bloco 54>
[00861] A figura 164 é um diagrama para descrever a desintercalação de bloco realizada pelo desintercalador de bloco 54 na figura 157.
[00862] Na desintercalação de bloco, o processamento reverso à intercalação de bloco pelo intercalador de bloco 25 descrito na figura 108 é
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218/233 realizado para retomar (restaurar) a sequência dos bits de código do código LDPC para a sequência original.
[00863] Em outras palavras, na desintercalação de bloco, por exemplo, como na intercalação de bloco, o código LDPC é gravado e lido em relação a m colunas, o m sendo igual ao comprimento de bit m do símbolo, de acordo com o que, a sequência dos bits de código do código LDPC é retomada para a sequência original.
[00864] Note que, na desintercalação de bloco, a gravação do código LDPC é realizada na ordem de leitura do código LDPC na intercalação de bloco. Além do mais, na desintercalação de bloco, a leitura do código LDPC é realizada na ordem da gravação do código LDPC na intercalação de bloco.
[00865] Em outras palavras, em relação à parte 1 do código LDPC, a parte 1 do código LDPC em unidades de símbolo de m bits é gravada na direção da linha da Ia linha de todas as m colunas, da forma ilustrada na figura 164. Em outras palavras, o bit de código do código LDPC, que é o símbolo de m bits, é gravado na direção da linha.
[00866] A gravação da parte 1 em unidades de m bits é sequencialmente realizada na direção das linhas inferiores das m colunas, e quando a gravação da parte 1 for concluída, da forma ilustrada na figura 164, a leitura da parte 1 para baixo a partir do topo da primeira unidade de coluna da coluna é realizada nas colunas a partir da direção da esquerda para a direita.
[00867] Quando a leitura até a coluna mais à direita for concluída, da forma ilustrada na figura 164, a leitura retoma para a coluna mais à esquerda, e a leitura da parte 1 para baixo a partir do topo da segunda unidade de coluna da coluna é realizada nas colunas a partir da direção da esquerda para a direita. A seguir, a leitura da parte 1 do código LDPC de uma palavra código é similarmente realizada.
[00868] Quando a leitura da parte 1 do código LDPC de uma palavra
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219/233 código for concluída, em relação à parte 2 em unidades de símbolo de m bits, as unidades de símbolo de m bits são sequencialmente concatenadas depois da parte 1, de acordo com o que, o código LDPC em unidades de símbolo é retornado para a sequência de bits de código do código LDPC (o código LDCP antes da intercalação de bloco) da uma palavra código original.
<Um outro exemplo de configuração do desintercalador de bit 165 >
[00869] A figura 165 é um diagrama de blocos que ilustra um outro exemplo de configuração do desintercalador de bit 165 na figura 156.
[00870] Note que, na figura, às partes correspondentes ao caso da figura 157 são dados os mesmos números de referência e, a seguir, a descrição das partes é apropriadamente omitida.
[00871] Em outras palavras, o desintercalador de bit 165 na figura 165 é configurado de uma maneira similar, como o caso na figura 157, exceto em que um desintercalador de paridade 1011 é inovadoramente provido.
[00872] Na figura 165, o desintercalador de bit 165 é configurado pelo desintercalador de bloco 54, pelo desintercalador grupo a grupo 55 e pelo desintercalador de paridade 1011, e realiza a desintercalação de bit do bit de código do código LDPC proveniente do desmapeador 164.
[00873] Em outras palavras, o desintercalador de bloco 54 realiza, para o código LDPC proveniente do desmapeador 164, a desintercalação de bloco correspondente à intercalação de bloco realizada pelo intercalador de bloco 25 do dispositivo de transmissão 11 (processamento reverso à intercalação de bloco), em outras palavras, a desintercalação de bloco de retomo das posições dos bits de código permutados pela intercalação de bloco para as posições originais, e supre um código LDPC resultante para o desintercalador grupo a grupo 55.
[00874] O desintercalador grupo a grupo 55 realiza, para o código LDPC proveniente do desintercalador de bloco 54, a desintercalação grupo a grupo correspondente à intercalação grupo a grupo como o processamento de
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220/233 rearranjo realizado pelo intercalador grupo a grupo 24 do dispositivo de transmissão 11.
[00875] O código LDPC obtido em decorrência da desintercalação grupo a grupo é suprido do desintercalador grupo a grupo 55 para o desintercalador de paridade 1011.
[00876] O desintercalador de paridade 1011 realiza, para o código de bit depois da desintercalação grupo a grupo no desintercalador grupo a grupo 55, a desintercalação de paridade correspondente à intercalação de paridade realizada pelo intercalador de paridade 23 do dispositivo de transmissão 11 (processamento reverso à intercalação de paridade), em outras palavras, a desintercalação de paridade de retomo da sequência dos bits de código do código LDPC mudado pela intercalação de paridade para a sequência original. [00877] O código LDPC obtido em decorrência da desintercalação de paridade é suprido do desintercalador de paridade 1011 para o decodificador de LDPC 166.
[00878] Portanto, no desintercalador de bit 165 na figura 165, o código LDPC para o qual a desintercalação de bloco, a desintercalação gmpo a grupo e a desintercalação de paridade foram realizadas, em outras palavras, o código LDPC obtido pela codificação LDPC de acordo com a matriz de verificação de paridade H, é suprido para o decodificador de LDPC 166.
[00879] O decodificador de LDPC 166 realiza a decodificação LDPC do código LDPC proveniente do desintercalador de bit 165 usando a matriz de verificação de paridade H usada para a codificação LDPC pelo codificador de LDPC 115 do dispositivo de transmissão 11.
[00880] Em outras palavras, como o método tipo B, o decodificador de LDPC 166 realiza, para o código LDPC proveniente do desintercalador de bit 165, a decodificação LDPC usando a própria matriz de verificação de paridade H (do método tipo B) usada para a codificação LDPC pelo codificador de LDPC 115 do dispositivo de transmissão 11 ou usando a
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221 /233 matriz de verificação de paridade transformada obtida pela realização pelo menos da permuta de coluna correspondente à intercalação de paridade para a matriz de verificação de paridade H. Além do mais, como o método tipo A, o decodificador de LDPC 166 realiza, para o código LDPC proveniente do desintercalador de bit 165, a decodificação LDPC usando a matriz de verificação de paridade (figura 28) obtida pela aplicação da permuta de coluna na matriz de verificação de paridade (figura 27) (do método tipo A) usada para a codificação LDPC pelo codificador de LDPC 115 do dispositivo de transmissão 11 ou usando a matriz de verificação de paridade transformada (figura 29) obtida pela aplicação da permuta de linha na matriz de verificação de paridade (figura 27) usada para a codificação LDPC.
[00881] Aqui, na figura 165, já que o código LDPC obtido pela codificação LDPC de acordo com a matriz de verificação de paridade H é suprido a partir do (o desintercalador de paridade 1011 do) desintercalador de bit 165 para o decodificador de LDPC 166, em um caso de realização da decodificação LDPC do código LDPC usando a própria matriz de verificação de paridade H pelo método tipo B usado para a codificação LDPC pelo codificador de LDPC 115 do dispositivo de transmissão 11 ou usando a matriz de verificação de paridade (figura 28) obtida pela aplicação da permuta de coluna na matriz de verificação de paridade (figura 27) pelo método tipo A usado para a codificação LDPC, o decodificador de LDPC 166 pode ser configurado como um dispositivo de decodificação para realizar a decodificação LDPC por um método de decodificação serial completo no qual as operações das mensagens (uma mensagem do nó de verificação e uma mensagem do nó variável) são sequencialmente realizadas em um nó de cada vez ou um dispositivo de decodificação para realizar a decodificação LDPC por um método de decodificação paralelo completo no qual as operações das mensagens são realizadas simultaneamente (paralelamente) para todos os nós, por exemplo.
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222/233 [00882] Além do mais, no decodificador de LDPC 166, em um caso de realização da decodificação LDPC do código LDPC usando a matriz de verificação de paridade transformada obtida pela aplicação pelo menos da permuta de coluna correspondente à intercalação de paridade na matriz de verificação de paridade H pelo método tipo B usado para a codificação LDPC pelo codificador de LDPC 115 do dispositivo de transmissão 11 ou usando a matriz de verificação de paridade transformada (figura 29) obtida pela aplicação da permuta de linha na matriz de verificação de paridade (figura 27) pelo método tipo A usado para a codificação LDPC, o decodificador de LDPC 166 pode ser configurado como um dispositivo de decodificação de arquitetura para realizar simultaneamente a operação do nó de verificação e a operação do nó variável para P nós (ou divisores de P diferentes de 1), o dispositivo de decodificação de arquitetura sendo também um dispositivo de decodificação (figura 162) que inclui uma unidade de rearranjo dos dados recebidos 310 para rearranjar os bits de código do código LDPC pela aplicação da permuta de coluna similar à permuta de coluna (intercalação de paridade) para obter a matriz de verificação de paridade transformada para o código LDPC.
[00883] Note que, na figura 165, por conveniência de descrição, o desintercalador de bloco 54 para realizar a desintercalação de bloco, o desintercalador grupo a grupo 55 para realizar a desintercalação grupo a grupo, e o desintercalador de paridade 1011 para realizar a desintercalação de paridade são separadamente configurados. Entretanto, dois ou mais do desintercalador de bloco 54, do desintercalador grupo a grupo 55 e do desintercalador de paridade 1011 podem ser integralmente configurados similarmente ao intercalador de paridade 23, ao intercalador grupo a grupo 24 e ao intercalador de bloco 25 do dispositivo de transmissão 11.
<Exemplo de configuração do sistema de recepção>
[00884] A figura 166 é um diagrama de blocos que ilustra um primeiro
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223/233 exemplo de configuração do sistema de recepção no qual o dispositivo de recepção 12 é aplicável.
[00885] Na figura 166, o sistema de recepção inclui uma unidade de aquisição 1101, uma unidade de processamento de decodificação do caminho de transmissão 1102 e uma unidade de processamento de decodificação da fonte de informação 1103.
[00886] A unidade de aquisição 1101 adquire um sinal que inclui o código LDPC obtido pela realização pelo menos da codificação LDPC para os dados LDPC alvos, tais como os dados de imagem e os dados de áudio de um programa ou semelhantes, por meio de um caminho de transmissão (caminho de comunicação, não ilustrado), tais como, por exemplo, difusão digital terrestre, difusão digital via satélite, uma rede de televisão a cabo (CATV), a Internet, ou uma outra rede, e supre o sinal para a unidade de processamento de decodificação do caminho de transmissão 1102.
[00887] Aqui, em um caso em que o sinal adquirido pela unidade de aquisição 1101 for difundido, por exemplo, a partir de uma estação de difusão por meio de ondas terrestres, ondas via satélite, redes de televisão a cabo (CATV) ou semelhantes, a unidade de aquisição 1101 é configurada por um sintonizador, um receptor / decodificador integrado (STB) ou semelhantes. Além do mais, em um caso em que o sinal adquirido pela unidade de aquisição 1101 for transmitido a partir de um servidor da Internet por difusão seletiva, como uma televisão por protocolo da Internet (IPTV), por exemplo, a unidade de aquisição 1101 é configurada, por exemplo, por uma interface de rede (I/F), tal como um cartão da interface de rede (NIC).
[00888] A unidade de processamento de decodificação do caminho de transmissão 1102 corresponde ao dispositivo de recepção 12. A unidade de processamento de decodificação do caminho de transmissão 1102 aplica o processamento de decodificação do caminho de transmissão que inclui pelo menos o processamento de correção de um erro que ocorre no caminho de
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224/233 transmissão no sinal adquirido pela unidade de aquisição 1101 por meio do caminho de transmissão, e supre um sinal resultante para a unidade de processamento de decodificação da fonte de informação 1103.
[00889] Em outras palavras, o sinal adquirido pela unidade de aquisição 1101 por meio do caminho de transmissão é um sinal obtido pela realização pelo menos da codificação de correção de erro para corrigir um erro que ocorre no caminho de transmissão, e a unidade de processamento de decodificação do caminho de transmissão 1102 aplica o processamento de decodificação do caminho de transmissão, tal como o processamento de correção de erro, em um sinal como este, por exemplo.
[00890] Aqui, os exemplos da codificação de correção de erro incluem a codificação LDPC, a codificação de BCH e semelhantes. Aqui, pelo menos a codificação LDPC é realizada como a codificação de correção de erro.
[00891] Além do mais, o processamento de decodificação do caminho de transmissão pode incluir a demodulação de um sinal modulado e semelhantes.
[00892] A unidade de processamento de decodificação da fonte de informação 1103 aplica o processamento de decodificação da fonte de informação que inclui pelo menos o processamento de descompressão da informação comprimida na informação original no sinal no qual o processamento de decodificação do caminho de transmissão foi aplicado.
[00893] Em outras palavras, codificação de compressão para comprimir a informação é algumas vezes aplicada no sinal adquirido pela unidade de aquisição 1101 por meio do caminho de transmissão a fim de reduzir a quantidade de dados, tais como imagem e som, como a informação. Neste caso, a unidade de processamento de decodificação da fonte de informação 1103 aplica o processamento de decodificação da fonte de informação, tal como o processamento de descompressão da informação comprimida na informação original (processamento de descompressão), no
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225/233 sinal no qual o processamento de decodificação do caminho de transmissão foi aplicado.
[00894] Note que, em um caso em que a codificação de compressão não tiver sido aplicada no sinal adquirido pela unidade de aquisição 1101 por meio do caminho de transmissão, a unidade de processamento de decodificação da fonte de informação 1103 não realiza o processamento de descompressão da informação comprimida na informação original.
[00895] Aqui, um exemplo do processamento de descompressão inclui a decodificação MPEG e semelhantes. Além do mais, o processamento de decodificação do caminho de transmissão pode incluir o desembaralhamento ou semelhantes, além do processamento de descompressão.
[00896] No sistema de recepção configurado como exposto, a unidade de aquisição 1101 adquire o sinal por meio do caminho de transmissão e supre o sinal adquirido para a unidade de processamento de decodificação do caminho de transmissão 1102, o sinal sendo obtido pela aplicação da codificação de compressão, tal como codificação MPEG, nos dados, tais como imagem e som, por exemplo, e pela aplicação adicional da codificação de correção de erro, tal como a codificação LDPC, nos dados comprimidos.
[00897] A unidade de processamento de decodificação do caminho de transmissão 1102 aplica o processamento similar ao processamento realizado pelo dispositivo de recepção 12 ou semelhantes, por exemplo, no sinal proveniente da unidade de aquisição 1101 como o processamento de decodificação do caminho de transmissão, e supre o sinal resultante para a unidade de processamento de decodificação da fonte de informação 1103.
[00898] A unidade de processamento de decodificação da fonte de informação 1103 aplica o processamento de decodificação da fonte de informação, tal como decodificação MPEG, no sinal proveniente da unidade de processamento de decodificação do caminho de transmissão 1102, e transmite a imagem ou o som resultantes.
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226/233 [00899] O sistema de recepção na figura 166, da forma supradescrita, pode ser aplicado, por exemplo, em um sintonizador de televisão para receber a difusão de televisão como a difusão digital e semelhantes.
[00900] Note que a unidade de aquisição 1101, a unidade de processamento de decodificação do caminho de transmissão 1102 e a unidade de processamento de decodificação da fonte de informação 1103 podem ser configuradas como dispositivos independentes (módulos de hardware (circuitos integrados (ICs) ou semelhantes) ou de software), respectivamente.
[00901] Além do mais, a unidade de aquisição 1101, a unidade de processamento de decodificação do caminho de transmissão 1102 e a unidade de processamento de decodificação da fonte de informação 1103 podem ser configuradas como um conjunto da unidade de aquisição 1101 e da unidade de processamento de decodificação do caminho de transmissão 1102, um conjunto da unidade de processamento de decodificação do caminho de transmissão 1102 e da unidade de processamento de decodificação da fonte de informação 1103, ou um conjunto da unidade de aquisição 1101, da unidade de processamento de decodificação do caminho de transmissão 1102 e da unidade de processamento de decodificação da fonte de informação 1103, como um dispositivo independente.
[00902] A figura 167 é um diagrama de blocos que ilustra um segundo exemplo de configuração do sistema de recepção no qual o dispositivo de recepção 12 é aplicável.
[00903] Note que, na figura, às partes correspondentes ao caso da figura 166 são dados os mesmos números de referência e, a seguir, a descrição das partes é apropriadamente omitida.
[00904] O sistema de recepção na figura 167 é comum ao caso na figura 166 na inclusão da unidade de aquisição 1101, da unidade de processamento de decodificação do caminho de transmissão 1102 e da unidade de processamento de decodificação da fonte de informação 1103,
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227 /233 mas é diferente do caso na figura 166 na inovadora inclusão de uma unidade de saída 1111.
[00905] A unidade de saída 1111 é, por exemplo, um dispositivo de exibição para exibir uma imagem ou um alto-falante para emitir um som, e transmite uma imagem, um som ou semelhantes como um sinal emitido a partir da unidade de processamento de decodificação da fonte de informação 1103. Em outras palavras, a unidade de saída 1111 exibe uma imagem ou emite um som.
[00906] O sistema de recepção na figura 167, da forma supradescrita, pode ser aplicado, por exemplo, em um receptor de televisão (TV) para receber a difusão de televisão como a difusão digital, um receptor de rádio para receber a difusão de rádio, ou semelhantes.
[00907] Note que, em um caso em que a codificação de compressão não tiver sido aplicada no sinal adquirido pela unidade de aquisição 1101, o sinal emitido pela unidade de processamento de decodificação do caminho de transmissão 1102 é suprido para a unidade de saída 1111.
[00908] A figura 168 é um diagrama de blocos que ilustra um terceiro exemplo de configuração do sistema de recepção no qual o dispositivo de recepção 12 é aplicável.
[00909] Note que, na figura, às partes correspondentes ao caso da figura 166 são dados os mesmos números de referência, e, a seguir, a descrição das partes é apropriadamente omitida.
[00910] O sistema de recepção na figura 168 é comum ao caso na figura 166 na inclusão da unidade de aquisição 1101 e da unidade de processamento de decodificação do caminho de transmissão 1102.
[00911] Entretanto, o sistema de recepção na figura 168 é diferente do caso na figura 166 na não inclusão da unidade de processamento de decodificação da fonte de informação 1103 e na inclusão inovadora de uma unidade de gravação 1121.
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228/233 [00912] A unidade de gravação 1121 grava o sinal (por exemplo, um pacote TS de TS de MPEG) emitido pela unidade de processamento de decodificação do caminho de transmissão 1102 em uma mídia de gravação (armazenamento), tais como um disco óptico, um disco rígido (disco magnético) ou uma memória flash.
[00913] O sistema de recepção na figura 168, da forma supradescrita, pode ser aplicado em um gravador para a gravação da difusão de televisão ou semelhantes.
[00914] Note que, na figura 168, o sistema de recepção inclui a unidade de processamento de decodificação da fonte de informação 1103, e a unidade de processamento de decodificação da fonte de informação 1103 pode gravar o sinal no qual o processamento de decodificação da fonte de informação foi aplicado, em outras palavras, a imagem ou o som obtidos pela decodificação, na unidade de gravação 1121.
<Uma modalidade de computador>
[00915] A seguir, a supradescrita série de processamento pode ser realizada por hardware ou software. Em um caso de execução da série de processamento por software, um programa que configura o software é instalado em um computador de uso geral ou semelhantes.
[00916] Portanto, a figura 169 ilustra um exemplo de configuração de uma modalidade de um computador no qual um programa para executar a supradescrita série de processamento é instalado.
[00917] O programa pode ser gravado em antecipação em um disco rígido 705 ou uma memória exclusiva de leitura (ROM) 703 como uma mídia de gravação construída no computador.
[00918] Altemativamente, o programa pode ser temporariamente ou permanentemente armazenado (gravado) em uma mídia de gravação removível 711, tais como um disco flexível, uma memória exclusiva de leitura em disco compacto (CD-ROM), um disco magneto-óptico (MO), um
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229/233 disco versátil digital (DVD), um disco magnético ou uma memória semicondutora. Uma mídia de gravação removível 711 como esta pode ser provida como assim denominado pacote de software.
[00919] Note que o programa pode ser transferido sem fio de um local de transferência para um computador por meio de um satélite artificial para uma difusão por satélite digital ou pode ser transferido por meio com fios para um computador por meio de uma rede, tais como uma rede de área local (LAN) ou a Internet, diferentemente de ser instalado a partir da mídia de gravação removível 711, da forma supradescrita, em um computador. O computador recebe o programa assim transferido por uma unidade de comunicação 708 e pode instalar o programa no disco rígido incorporado 705. [00920] O computador tem uma unidade de processamento central (CPU) 702 incorporada. Uma interface de entrada / saída 710 é conectada na CPU 702 por meio de um barramento 701. Quando um comando for inserido por meio da interface de entrada / saída 710 à medida que o usuário opera uma unidade de entrada 707 configurada por um teclado, um mouse, um microfone ou semelhantes, por exemplo, a CPU 702 executa o programa armazenado na ROM 703 de acordo com o comando. Alternativamente, a CPU 702 carrega o programa em uma memória de acesso aleatório (RAM) 704 e executa o programa, que é armazenado no disco rígido 705, transferido a partir do satélite ou da rede e recebido pela unidade de comunicação 708 e instalado no disco rígido 705, ou lido a partir da mídia de gravação removível 711 montada em uma unidade 709 e instalado no disco rígido 705. Em decorrência disto, a CPU 702 realiza o processamento de acordo com os supradescritos fluxogramas ou processamento realizados pelas configurações dos supradescritos diagramas de blocos. Então, a CPU 702 faz com que uma unidade de saída 706 configurada por uma tela de cristal líquido (LCD), um alto-falante ou semelhantes emitam o resultado do processamento, a unidade de comunicação 708 transmita o resultado do processamento, e o disco rígido
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705 grave o resultado do processamento, por meio da interface de entrada / saída 710, conforme necessário, por exemplo.
[00921] Aqui, na presente especificação, as etapas de processamento para descrever o programa para fazer com que um computador realize os vários tipos de processamento não necessariamente precisam ser processados cronologicamente na ordem descrita como fluxogramas, e incluem o processamento executado em paralelo ou individualmente (por exemplo, processamento em paralelo ou processamento por um objeto).
[00922] Além do mais, o programa pode ser processado por um computador ou pode ser processado de uma maneira distribuída por uma pluralidade de computadores. Além do mais, o programa pode ser transferido para um computador remoto e executado.
[00923] Note que as modalidades da presente tecnologia não são limitadas às supradescritas modalidades, e várias modificações podem ser feitas sem fugir da essência da presente tecnologia.
[00924] Por exemplo, o (a tabela de valor inicial da matriz de verificação de paridade do) novo código LDPC e o padrão GW supradescritos podem ser usados para um canal por satélite, uma onda terrestre, um cabo (canal com fios) e um outro caminho de comunicação 13 (figura 7). Além do mais, o novo código LDPC e o padrão GW podem ser usados para a transmissão de dados diferente de difusão digital.
[00925] Note que os efeitos descritos na presente especificação são meramente exemplos e não são limitados, e outros efeitos podem ser exibidos. LISTA DOS SINAIS DE REFERÊNCIA
Dispositivo de transmissão
Dispositivo de recepção
Intercalador de paridade
Intercalador grupo a grupo
Intercalador de bloco
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Desintercalador de bloco
Desintercalador grupo a grupo
111 Adaptação de modo/multiplexador
112 Preenchedor
113 Embaralhador de BB
114 Codificador de BCH
115 Codificador de LDPC
116 Intercalador de bit
117 Mapeador
118 Intercalador de tempo
119 Codificador SISO/MISO
120 Intercalador de frequência
121 Codificador de BCH
122 Codificador de LDPC
123 Mapeador
124 Intercalador de frequência
131 Construtor de quadro/unidade de alocação de recurso
132 Unidade de geração de OFDM
151 Unidade de processamento de OFDM
152 Unidade de gerenciamento de quadro
153 Desintercalador de frequência
154 Desmapeador
155 Decodificador de LDPC
156 Decodificador de BCH
161 Desintercalador de frequência
162 Decodificador de SISO/MISO
163 Desintercalador de tempo
164 Desmapeador
165 Desintercalador de bit
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Decodificador de LDPC
Decodificador de BCH
Desembaralhador de BB
Unidade de deleção de nulo
Demultiplexador
Memória de armazenamento dos dados de borda
Seletor
Unidade de cálculo do nó de verificação
Circuito de deslocamento cíclico
Memória de armazenamento dos dados de borda
Seletor
Memória de dados recebidos
Unidade de cálculo do nó variável
Circuito de deslocamento cíclico
Unidade de cálculo de palavra decodificada
Unidade de rearranjo dos dados recebidos
Unidade de rearranjo dos dados decodificados
Unidade de processamento de codificação
Unidade de armazenamento
Unidade de definição da taxa de codificação
Unidade de leitura da tabela de valor inicial
Unidade de geração da matriz de verificação de paridade
Unidade de leitura do bit de informação
Unidade de operação da paridade codificada
Unidade de controle
Barramento
CPU
ROM
RAM
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705 disco rígido
706 Unidade de saída
707 Unidade de entrada
708 Unidade de comunicação
709 Unidade
710 Interface de entrada / saída
711 Mídia de gravação removível
1001 Unidade de permuta reversa
1002 Memória
1011 Desintercalador de paridade
1101 Unidade de aquisição
1102 Unidade de processamento de decodificação do caminho de transmissão
1103 Unidade de processamento de decodificação da fonte de informação
1111 Unidade de saída
1121 Unidade de gravação

Claims (15)

  1. REIVINDICAÇÕES
    1. Método de transmissão, caracterizado pelo fato de que compreende:
    uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 3/16;
    uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal de constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    154, 106, 99, 177, 191, 55, 189, 181, 22, 62, 80, 114, 110, 141, 83, 103, 169, 156, 130, 186, 92, 45, 68, 126, 112, 185, 160, 158, 17, 145, 162, 127, 152, 174, 134, 18, 157, 120, 3, 29, 13, 135, 173, 86, 73, 150, 46, 153, 33, 61, 142, 102, 171, 168, 78, 77, 139, 85, 176, 163, 128, 101, 42, 2, 14, 38, 10, 125, 90, 30, 63, 172, 47, 108, 89, 0, 32, 94, 23, 34, 59, 35, 129, 12, 146, 8, 60, 27, 147, 180, 100, 87, 184, 167, 36, 79, 138, 4, 95, 148, 72, 54, 91, 182, 28, 133, 164, 175, 123, 107, 137, 88, 44, 116, 69, 7, 31, 124, 144, 105, 170, 6, 165, 15, 161, 24, 58, 70, 11, 56, 143, 111, 104, 74, 67, 109, 82, 21, 52, 9, 71, 48, 26, 117, 50, 149, 140, 20, 57, 136, 113, 64, 151, 190, 131, 19, 51, 96, 76, 1, 97, 40, 53, 84, 166, 75, 159, 98, 81, 49, 66, 188, 118, 39, 132, 187, 25, 119, 41, 122, 16, 5, 93, 115, 178, 65, 121, 37, 155, 183, 43, 179, a matriz de verificação de paridade inclui
    Petição 870190072829, de 30/07/2019, pág. 243/479
  2. 2Π6 uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 1.800, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
    126 1125 1373 4698 5254 17832 23701 31126 33867 46596 46794 48392 49352 51151 52100 55162
    794 1435 1552 4483 14668 16919 21871 36755 42132 43323
    46650 47676 50412 53484 54886 55333
    698 1356 1519 5555 6877 8407 8414 14248 17811 22998
    28378 40695 46542 52817 53284 55968
    457 493 1080 2261 4637 5314 9670 11171 12679 29201
    35980 43792 44337 47131 49880 55301
    467 721 1484 5326 8676 11727 15221 17477 21390 22224
    27074 28845 37670 38917 40996 43851
    305 389 526 9156 11091 12367 13337 14299 22072 25367
    Petição 870190072829, de 30/07/2019, pág. 244/479
  3. 3/76
    30710 37688 44321 48351 54663
    23 342 1426 5889 7362 8213 8512 10655 14549 15486 26010
    32196 36341 37705 45137
    123 429 485 4093 6933 11291 11639 12558 20096 22292
    32438 34615 38061 40659 51577
    920 1086 1257 8839 10010 13126 14367 18612 23252 23777
    32982 35684 40534 53318 55947
    579 937 1593 2549 12702 17659 19393 20047 25145 27792
    33311 39737 42052 50294 53363
    116 883 1067 9847 10660 12052 18157 20519 21191 24139
    27643 30745 33852 37692 37724
    915 1154 1698 5197 5249 13741 25043 29802 31354 32707
    36856 39887 41245 42065 50240
    317 1304 1770 12854 14018 14061 16657 24029 24408 34493
    35755 38593 47428 53811 55008
    163 216 719 5541 13996 18754 19287 24293 38575 39520
    43395 45390 46665 50706 55269
    42 415 1326 2553 7963 14878 17850 21757 22166 32986
    39267 46154 46790 52877 53780
    593 1511 1515 13942 14258 14432 24537 38229 38251 40975
    43490 44880 45278 46574 51442
    219 262 955 1978 10654 13021 16873 23340 27412 32762
    42723 45976 46603 47761 54095
    632 944 1598 12924 17942 18478 26487 28036 42462 43513
    44584 48245 53274 54343 55453
    501 912 1656 2009 6339 15581 20597 26886 32241 34471
    43009 45977 46587 46821 51187
    610 713 1619 5176 6122 6445 8044 12220 14126 32911
    40715 45111 47872 50111 55027
    Petição 870190072829, de 30/07/2019, pág. 245/479
  4. 4/76
    258 445 1137 4517 5846 7644 15604 16606 16969 17622
    34589 35808 43692 45126 49527
    612 854 1521 13045 14525 15821 21096 23774 24274 25855
    27296 30033 40847 44681 46072
    714 876 1365 5836 10004 15778 17044 22417 26397 31508
    37917 42049 50828 50947 54052
    1338 1595 1718 4722 4981 12275 13632 15276 15547 17668
    26616 29044 39417 39669 53539
    687 721 1054 5918 10421 13356 15941 17657 20704 21564
    35798 36475 46109 46414 49845
    734 1635 1666 9737 23679 24394 24784 26917 27334 28772
    35246 35512 37169 39638 44309
    469 918 1212 3912 10712 13084 13906 14000 16602 18040
    25940 30677 44811 50590 52018
    70 332 496 6421 19082 19665 25460 27377 27378 31086
    37104 37236 37771 38622 40678
    48 142 1668 2102 3421 10462 13086 13671 24889 36914
    40166 42935 49052 49205 52170
    294 616 840 2360 5386 7278 10202 15133 24149 24629
    28672 31892 39559 50438 50453
    517 946 1043 2563 3416 6620 8572 10920 31906 32685
    40521 46898 48369 48700 49210
    1325 1424 1741 11692 11761 19152 19732 28863 30563
    42394 44802 49339 54524 55731
    664 1340 1437 9442 10378 12176 18760 19872 21648 34682
    40545 44808 47558 53061
    378 705 1356 16007 16336 19543 21682 28716 30262 34500
    44238 48274 50341 52887
    999 1202 1328 10688 11514 11724 15674 21039 35182 36272
    Petição 870190072829, de 30/07/2019, pág. 246/479
  5. 5/76
    41441 42542 52517 54945 56157
    247 384 1270 6610 10335 24421 25984 27761 38728 41010 46216 46892 47392 48394 51471
    10091 10124 12187 13741 18018 20438 21412 24163 35862 36925 37532 46234
    7860 8123 8712 17553 20624 29410 29697 29853 43483 43603 53476 53737
    11547 11741 19045 20400 23052 28251 32038 44283 50596 53622 55875 55888
    3825 11292 11723 13819 26483 28571 33319 33721 34911 37766 47843 48667
    10114 10336 14710 15586 19531 22471 27945 28397 45637 46131 47760 52375.
    2. Dispositivo de recepção, caracterizado pelo fato de que compreende:
    uma unidade de desintercalação grupo a grupo configurada para retomar a sequência do código LDPC depois da intercalação grupo a grupo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 3/16, uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC)
    Petição 870190072829, de 30/07/2019, pág. 247/479
  6. 6/76 em 16QAM em uma base de 4 bits, em que na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    154, 106, 99, 177, 191, 55, 189, 181, 22, 62, 80, 114, 110, 141, 83, 103, 169, 156, 130, 186, 92, 45, 68, 126, 112, 185, 160, 158, 17, 145, 162, 127, 152, 174, 134, 18, 157, 120, 3, 29, 13, 135, 173, 86, 73, 150, 46, 153, 33, 61, 142, 102, 171, 168, 78, 77, 139, 85, 176, 163, 128, 101, 42, 2, 14, 38, 10, 125, 90, 30, 63, 172, 47, 108, 89, 0, 32, 94, 23, 34, 59, 35, 129, 12, 146, 8, 60, 27, 147, 180, 100, 87, 184, 167, 36, 79, 138, 4, 95, 148, 72, 54, 91, 182, 28, 133, 164, 175, 123, 107, 137, 88, 44, 116, 69, 7, 31, 124, 144, 105, 170, 6, 165, 15, 161, 24, 58, 70, 11, 56, 143, 111, 104, 74, 67, 109, 82, 21, 52, 9, 71, 48, 26, 117, 50, 149, 140, 20, 57, 136, 113, 64, 151, 190, 131, 19, 51, 96, 76, 1, 97, 40, 53, 84, 166, 75, 159, 98, 81, 49, 66, 188, 118, 39, 132, 187, 25, 119, 41, 122, 16, 5, 93, 115, 178, 65, 121, 37, 155, 183, 43, 179, a matriz de verificação de paridade inclui uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C,
    Petição 870190072829, de 30/07/2019, pág. 248/479
  7. 7/76 o valor Ml predeterminado é 1.800, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
    126 1125 1373 4698 5254 17832 23701 31126 33867 46596 46794 48392 49352 51151 52100 55162
    794 1435 1552 4483 14668 16919 21871 36755 42132 43323
    46650 47676 50412 53484 54886 55333
    698 1356 1519 5555 6877 8407 8414 14248 17811 22998
    28378 40695 46542 52817 53284 55968
    457 493 1080 2261 4637 5314 9670 11171 12679 29201
    35980 43792 44337 47131 49880 55301
    467 721 1484 5326 8676 11727 15221 17477 21390 22224
    27074 28845 37670 38917 40996 43851
    305 389 526 9156 11091 12367 13337 14299 22072 25367 29827 30710 37688 44321 48351 54663
    23 342 1426 5889 7362 8213 8512 10655 14549 15486 26010 30403 32196 36341 37705 45137
    123 429 485 4093 6933 11291 11639 12558 20096 22292 24696 32438 34615 38061 40659 51577
    920 1086 1257 8839 10010 13126 14367 18612 23252 23777
    32883 32982 35684 40534 53318 55947
    579 937 1593 2549 12702 17659 19393 20047 25145 27792
    30322 33311 39737 42052 50294 53363
    116 883 1067 9847 10660 12052 18157 20519 21191 24139
    27132 27643 30745 33852 37692 37724
    915 1154 1698 5197 5249 13741 25043 29802 31354 32707
    Petição 870190072829, de 30/07/2019, pág. 249/479
  8. 8/76
    36856 39887 41245 42065 50240
    317 1304 1770 12854 14018 14061 16657 24029 24408 34493
    35755 38593 47428 53811 55008
    163 216 719 5541 13996 18754 19287 24293 38575 39520
    43395 45390 46665 50706 55269
    42 415 1326 2553 7963 14878 17850 21757 22166 32986
    39267 46154 46790 52877 53780
    593 1511 1515 13942 14258 14432 24537 38229 38251 40975
    43490 44880 45278 46574 51442
    219 262 955 1978 10654 13021 16873 23340 27412 32762
    42723 45976 46603 47761 54095
    632 944 1598 12924 17942 18478 26487 28036 42462 43513
    44584 48245 53274 54343 55453
    501 912 1656 2009 6339 15581 20597 26886 32241 34471
    43009 45977 46587 46821 51187
    610 713 1619 5176 6122 6445 8044 12220 14126 32911
    40715 45111 47872 50111 55027
    258 445 1137 4517 5846 7644 15604 16606 16969 17622
    34589 35808 43692 45126 49527
    612 854 1521 13045 14525 15821 21096 23774 24274 25855
    27296 30033 40847 44681 46072
    714 876 1365 5836 10004 15778 17044 22417 26397 31508
    37917 42049 50828 50947 54052
    1338 1595 1718 4722 4981 12275 13632 15276 15547 17668
    26616 29044 39417 39669 53539
    687 721 1054 5918 10421 13356 15941 17657 20704 21564
    35798 36475 46109 46414 49845
    734 1635 1666 9737 23679 24394 24784 26917 27334 28772
    35246 35512 37169 39638 44309
    Petição 870190072829, de 30/07/2019, pág. 250/479
  9. 9/76
    469 918 1212 3912 10712 13084 13906 14000 16602 18040
    25940 30677 44811 50590 52018
    70 332 496 6421 19082 19665 25460 27377 27378 31086
    37104 37236 37771 38622 40678
    48 142 1668 2102 3421 10462 13086 13671 24889 36914
    40166 42935 49052 49205 52170
    294 616 840 2360 5386 7278 10202 15133 24149 24629
    28672 31892 39559 50438 50453
    517 946 1043 2563 3416 6620 8572 10920 31906 32685
    40521 46898 48369 48700 49210
    1325 1424 1741 11692 11761 19152 19732 28863 30563
    42394 44802 49339 54524 55731
    664 1340 1437 9442 10378 12176 18760 19872 21648 34682
    40545 44808 47558 53061
    378 705 1356 16007 16336 19543 21682 28716 30262 34500
    44238 48274 50341 52887
    999 1202 1328 10688 11514 11724 15674 21039 35182 36272
    42542 52517 54945 56157
    247 384 1270 6610 10335 24421 25984 27761 38728 41010
    46892 47392 48394 51471
    10091 10124 12187 13741 18018 20438 21412 24163 35862
    37532 46234
    7860 8123 8712 17553 20624 29410 29697 29853 43483
    53476 53737
    11547 11741 19045 20400 23052 28251 32038 44283 50596
    55875 55888
    3825 11292 11723 13819 26483 28571 33319 33721 34911
    47843 48667
    10114 10336 14710 15586 19531 22471 27945 28397 45637
    Petição 870190072829, de 30/07/2019, pág. 251/479
  10. 10/76
    46131 47760 52375.
    3. Método de transmissão, caracterizado pelo fato de que compreende:
    uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 5/16;
    uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    1, 182, 125, 0, 121, 47, 63, 154, 76, 99, 82, 163, 102, 166, 28, 189, 56, 67, 54, 39, 40, 185, 184, 65, 179, 4, 91, 87, 137, 170, 98, 71, 169, 49, 73, 37, 11, 143, 150, 123, 93, 62, 3, 50, 26, 140, 178, 95, 183, 33, 21, 53, 112, 128, 118, 120, 106, 139, 32, 130, 173, 132, 156, 119, 83, 176, 159, 13, 145, 36, 30, 113, 2, 41, 147, 174, 94, 88, 92, 60, 165, 59, 25, 161, 100, 85, 81, 61, 138, 48, 177, 77, 6, 22, 16, 43, 115, 23, 12, 66, 70, 9, 164, 122, 58, 105, 69, 42, 38, 19, 24, 180, 175, 74, 160, 34, 101, 72, 114, 142, 20, 8, 15, 190, 144,
    104, 79, 172, 148, 31, 168, 10, 107, 14, 35, 52, 134, 126, 167, 149, 116,186,
    17, 162, 151, 5, 136, 55, 44, 110, 158, 46, 191, 29, 153, 155, 117, 188,131,
    97, 146, 103, 78, 109, 129, 57, 111, 45, 68, 157, 84, 141, 89, 64, 7, 108,152,
    75, 18, 96, 133, 171, 86, 181, 127, 27, 124, 187, 135, 80, 51, 90, a matriz de verificação de paridade inclui
    Petição 870190072829, de 30/07/2019, pág. 252/479
  11. 11/76 uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 1.800, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
    152 1634 7484 23081 24142 26799 33620 40989 41902 44319 44378 45067
    140 701 5137 7313 12672 16929 20359 27052 30236 33846 36254 46973
    748 769 2891 7812 9964 15629 19104 20551 25796 28144
    31518 34124
    542 976 2279 18904 20877 24190 25903 28129 36804 41152
    41957 46888
    173 960 2926 11682 12304 13284 18037 22702 30255 33718
    34073 37152
    78 1487 4898 7472 8033 10631 11732 19334 24577 34586
    Petição 870190072829, de 30/07/2019, pág. 253/479 η/Ίβ
    38651 43639
    594 1095 1857 2368 8909 17295 17546 21865 23257 31273
    37013 41454
    72 419 1596 7849 16093 23167 26923 31883 36092 40348
    44500
    866 1120 1568 1986 3532 20094 21663 26664 26970 33542
    42578
    868 917 1216 12018 15402 20691 24736 33133 36692 40276
    46616
    955 1070 1749 7988 10235 19174 22733 24283 27985 38200
    44029
    613 1729 1787 19542 21227 21376 31057 36104 36874 38078
    42445
    86 1555 1644 4633 14402 14997 25724 31382 31911 32224
    43900
    353 1132 1246 5544 7248 17887 25769 27008 28773 33188
    44663
    600 958 1376 6417 6814 17587 20680 25376 29522 31396
    40526
    179 528 1472 2481 5589 15696 20148 28040 29690 32370
    42163
    122 144 681 6613 11230 20862 26396 27737 35928 39396
    42713
    934 1256 1420 3881 4487 5830 7897 9587 17940 40333
    41925
    622 1458 1490 16541 18443 19401 24860 26981 28157 32875
    38755
    1017 1143 1511 2169 17322 24662 25971 29149 31450 31670
    34779
    Petição 870190072829, de 30/07/2019, pág. 254/479
    13/76
    935 1084 1534 2918 10596 11534 17476 27269 30344 31104
    173 532 1766 8001 10483 17002 19002 26759 31006 43466
    221 610 1795 9197 11770 12793 14875 30177 30610 42274
    188 439 1332 7030 9246 15150 26060 26541 27190 28259
    812 1643 1750 7446 7888 7995 18804 21646 28995 30727
    44 481 555 5618 9621 9873 19182 22059 42510 45343 46058
    156 532 1799 6258 18733 19988 23237 27657 30835 34738 1128 1553 1790 8372 11543 13764 17062 28627 38502 40796
    564 777 1286 3446 5566 12105 16038 18918 21802 25954
    1167 1178 1770 4151 11422 11833 16823 17799 19188 22517
    576 638 1364 12257 22028 24243 24297 31788 36398 38409
    334 592 940 2865 12075 12708 21452 31961 32150 35723 1205 1267 1721 9293 18685 18917 23490 27678 37645 40114
    189 628 821 17066 19218 21462 25452 26858 38408 38941
    190 951 1019 5572 7135 15647 32613 33863 33981 35670
    Petição 870190072829, de 30/07/2019, pág. 255/479
    14/76
    46178
    38447
    46541
    38051
    41025
    30682 34883
    46766
    36077
    41738
    46487
    45307
    45101
    44753
    30619
    84 1003 1597 12597 15567 21221 21891 23151 23964 24816
    756 1262 1345 6694 6893 9300 9497 17950 19082 35668
    848 948 1560 6591 12529 12535 20567 23882 34481 46531
    504 631 777 10585 12330 13822 15388 23332 27688 35955
    676 1484 1575 2215 5830 6049 13558 25034 33602 35663
    1298 1427 1732 13930 15611 19462 20975 23200 30460
    1491 1593 1615 4289 7010 10264 21047 26704 27024 29658
    969 1730 1748 2217 7181 7623 15860 21332 28133 28998
    302 1216 1374 5177 6849 7239 10255 34952 37908 39911
    220 362 1491 5235 5439 22708 29228 29481 33272 36831
    4 728 1279 4579 8325 8505 27604 31437 33574 41716 45082
    472 735 1558 4454 6957 14867 18307 22437 3830442054
    85 466 851 3669 7119 32748 32845 41914 4259542600
    52 553 824 2994 4569 12505 24738 33258 3712143381
    37 495 1553 7684 8908 12412 15563 16461 1787229292
    Petição 870190072829, de 30/07/2019, pág. 256/479
    15/76
    254 1057 1481 9971 18408 19815 28569 29164 39281 42723
    45604
    16 1213 1614 4352 8091 8847 10022 24394 35661 43800
    44362
    395 750 888 2582 3772 4151 26025 36367 42326 42673
    47393
    862 1379 1441 6413 25621 28378 34869 35491 41774 44165
    45411
    46 213 1597 2771 4694 4923 17101 17212 19347 22002
    43226
    1339 1544 1610 13522 14840 15355 29399 30125 33685
    36350 37672
    251 1162 1260 9766 13137 34769 36646 43313 43736 43828
    45151
    214 1002 1688 5357 19091 19213 24460 28843 32869 35013
    39791
    646 733 1735 11175 11336 12043 22962 33892 35646 37116
    38655
    293 927 1064 4818 5842 10983 12871 17804 33127 41604
    46588
    10927 15514 22748 34850 37645 40669 41583 44090
    3329 7548 8092 11659 16832 35304 46738 46888
    3510 5915 9603 30333 37198 42866 44361 46416
    2575 5311 9421 13410 15375 34017 37136 43990
    12468 14492 24417 26394 38565 38936 41899 45593.
    4. Dispositivo de recepção, caracterizado pelo fato de que compreende:
    uma unidade de desintercalação grupo a grupo configurada para retomar a sequência do código LDPC depois da intercalação grupo a
    Petição 870190072829, de 30/07/2019, pág. 257/479
    16/76 grupo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 5/16, uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    1, 182, 125, 0, 121, 47, 63, 154, 76, 99, 82, 163, 102, 166, 28, 189, 56, 67, 54, 39, 40, 185, 184, 65, 179, 4, 91, 87, 137, 170, 98, 71, 169, 49, 73, 37, 11, 143, 150, 123, 93, 62, 3, 50, 26, 140, 178, 95, 183, 33, 21, 53, 112, 128, 118, 120, 106, 139, 32, 130, 173, 132, 156, 119, 83, 176, 159, 13, 145, 36, 30, 113, 2, 41, 147, 174, 94, 88, 92, 60, 165, 59, 25, 161, 100, 85, 81, 61, 138, 48, 177, 77, 6, 22, 16, 43, 115, 23, 12, 66, 70, 9, 164, 122, 58, 105, 69, 42, 38, 19, 24, 180, 175, 74, 160, 34, 101, 72, 114, 142, 20, 8, 15, 190, 144,
    104, 79, 172, 148, 31, 168, 10, 107, 14, 35, 52, 134, 126, 167, 149, 116,186,
    17, 162, 151, 5, 136, 55, 44, 110, 158, 46, 191, 29, 153, 155, 117, 188,131,
    97, 146, 103, 78, 109, 129, 57, 111, 45, 68, 157, 84, 141, 89, 64, 7, 108,152,
    75, 18, 96, 133, 171, 86, 181, 127, 27, 124, 187, 135, 80, 51, 90, a matriz de verificação de paridade inclui
    Petição 870190072829, de 30/07/2019, pág. 258/479
    17/76 uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 1.800, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
    152 1634 7484 23081 24142 26799 33620 40989 41902 44319 44378 45067
    140 701 5137 7313 12672 16929 20359 27052 30236 33846 36254 46973
    748 769 2891 7812 9964 15629 19104 20551 25796 28144
    31518 34124
    542 976 2279 18904 20877 24190 25903 28129 36804 41152
    41957 46888
    173 960 2926 11682 12304 13284 18037 22702 30255 33718
    34073 37152
    78 1487 4898 7472 8033 10631 11732 19334 24577 34586
    Petição 870190072829, de 30/07/2019, pág. 259/479
    18/76
    38651 43639
    594 1095 1857 2368 8909 17295 17546 21865 23257 31273
    37013 41454
    72 419 1596 7849 16093 23167 26923 31883 36092 40348
    44500
    866 1120 1568 1986 3532 20094 21663 26664 26970 33542
    42578
    868 917 1216 12018 15402 20691 24736 33133 36692 40276
    46616
    955 1070 1749 7988 10235 19174 22733 24283 27985 38200
    44029
    613 1729 1787 19542 21227 21376 31057 36104 36874 38078
    42445
    86 1555 1644 4633 14402 14997 25724 31382 31911 32224
    43900
    353 1132 1246 5544 7248 17887 25769 27008 28773 33188
    44663
    600 958 1376 6417 6814 17587 20680 25376 29522 31396
    40526
    179 528 1472 2481 5589 15696 20148 28040 29690 32370
    42163
    122 144 681 6613 11230 20862 26396 27737 35928 39396
    42713
    934 1256 1420 3881 4487 5830 7897 9587 17940 40333
    41925
    622 1458 1490 16541 18443 19401 24860 26981 28157 32875
    38755
    1017 1143 1511 2169 17322 24662 25971 29149 31450 31670
    34779
    Petição 870190072829, de 30/07/2019, pág. 260/479
    19/76
    935 1084 1534 2918 10596 11534 17476 27269 30344 31104
    173 532 1766 8001 10483 17002 19002 26759 31006 43466
    221 610 1795 9197 11770 12793 14875 30177 30610 42274
    188 439 1332 7030 9246 15150 26060 26541 27190 28259
    812 1643 1750 7446 7888 7995 18804 21646 28995 30727
    44 481 555 5618 9621 9873 19182 22059 42510 45343 46058
    156 532 1799 6258 18733 19988 23237 27657 30835 34738 1128 1553 1790 8372 11543 13764 17062 28627 38502 40796
    564 777 1286 3446 5566 12105 16038 18918 21802 25954
    1167 1178 1770 4151 11422 11833 16823 17799 19188 22517
    576 638 1364 12257 22028 24243 24297 31788 36398 38409
    334 592 940 2865 12075 12708 21452 31961 32150 35723 1205 1267 1721 9293 18685 18917 23490 27678 37645 40114
    189 628 821 17066 19218 21462 25452 26858 38408 38941
    190 951 1019 5572 7135 15647 32613 33863 33981 35670
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    20/76
    46178
    38447
    46541
    38051
    41025
    30682 34883
    46766
    36077
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    46487
    45307
    45101
    44753
    30619
    84 1003 1597 12597 15567 21221 21891 23151 23964 24816
    756 1262 1345 6694 6893 9300 9497 17950 19082 35668
    848 948 1560 6591 12529 12535 20567 23882 34481 46531
    504 631 777 10585 12330 13822 15388 23332 27688 35955
    676 1484 1575 2215 5830 6049 13558 25034 33602 35663
    1298 1427 1732 13930 15611 19462 20975 23200 30460
    1491 1593 1615 4289 7010 10264 21047 26704 27024 29658
    969 1730 1748 2217 7181 7623 15860 21332 28133 28998
    302 1216 1374 5177 6849 7239 10255 34952 37908 39911
    220 362 1491 5235 5439 22708 29228 29481 33272 36831
    4 728 1279 4579 8325 8505 27604 31437 33574 41716 45082
    472 735 1558 4454 6957 14867 18307 22437 3830442054
    85 466 851 3669 7119 32748 32845 41914 4259542600
    52 553 824 2994 4569 12505 24738 33258 3712143381
    37 495 1553 7684 8908 12412 15563 16461 1787229292
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    21/76
    254 1057 1481 9971 18408 19815 28569 29164 39281 42723
    45604
    16 1213 1614 4352 8091 8847 10022 24394 35661 43800
    44362
    395 750 888 2582 3772 4151 26025 36367 42326 42673
    47393
    862 1379 1441 6413 25621 28378 34869 35491 41774 44165
    45411
    46 213 1597 2771 4694 4923 17101 17212 19347 22002
    43226
    1339 1544 1610 13522 14840 15355 29399 30125 33685
    36350 37672
    251 1162 1260 9766 13137 34769 36646 43313 43736 43828
    45151
    214 1002 1688 5357 19091 19213 24460 28843 32869 35013
    39791
    646 733 1735 11175 11336 12043 22962 33892 35646 37116
    38655
    293 927 1064 4818 5842 10983 12871 17804 33127 41604
    46588
    10927 15514 22748 34850 37645 40669 41583 44090
    3329 7548 8092 11659 16832 35304 46738 46888
    3510 5915 9603 30333 37198 42866 44361 46416
    2575 5311 9421 13410 15375 34017 37136 43990
    12468 14492 24417 26394 38565 38936 41899 45593.
    5. Método de transmissão, caracterizado pelo fato de que compreende:
    uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que
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    22/76 tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 7/16;
    uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    35, 75, 166, 145, 143, 184, 62, 96, 54, 63, 157, 103, 32, 43, 126, 187, 144, 91, 78, 44, 39, 109, 185, 102, 10, 68, 29, 42, 149, 83, 133, 94, 130, 27, 171, 19, 51, 165, 148, 28, 36, 33, 173, 136, 87, 82, 100, 49, 120, 152, 161, 162, 147, 71, 137, 57, 8, 53, 132, 151, 163, 123, 47, 92, 90, 60, 99, 79, 59, 108, 115, 72, 0, 12, 140, 160, 61, 180, 74, 37, 86, 117, 191, 101, 52, 15, 80, 156, 127, 81, 131, 141, 142, 31, 95, 4, 73, 64, 16, 18, 146, 70, 181, 7, 89, 124, 77, 67, 116, 21, 34, 41, 105, 113, 97, 2, 6, 55, 17, 65, 38, 48, 158, 159, 179, 5, 30, 183, 170, 135, 125, 20, 106, 186, 182, 188, 114, 1, 14, 3, 134, 178, 189, 167, 40, 119, 22, 190, 58, 23, 155, 138, 98, 84, 11, 110, 88, 46, 177, 175, 25, 150, 118, 121, 129, 168, 13, 128, 104, 69, 112, 169, 9, 45, 174, 93, 26, 56, 76, 50, 154, 139, 66, 85, 153, 107, 111, 172, 176, 164, 24, 122, a matriz de verificação de paridade inclui uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma
    Petição 870190072829, de 30/07/2019, pág. 264/479
    23 /76 estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 4.680, o matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da matriz C para cada 360 colunas, e é
    1012 3997 5398 5796 21940 23609 25002 28007 32214 33822 38194
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    Petição 870190072829, de 30/07/2019, pág. 265/479
    24/76
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    Petição 870190072829, de 30/07/2019, pág. 266/479
    25/76
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    Petição 870190072829, de 30/07/2019, pág. 268/479
    27/76
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    Petição 870190072829, de 30/07/2019, pág. 269/479
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    14096 16976 21598 32228 34672
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    7704 8171 10815 28138 29526.
    6. Dispositivo de recepção, caracterizado pelo fato de que compreende:
    uma unidade de desintercalação grupo a grupo configurada para retomar a sequência do código LDPC depois da intercalação gmpo a gmpo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 7/16, uma unidade de intercalação gmpo a gmpo configurada para realizar a intercalação gmpo a gmpo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um gmpo de bits i, e uma sequência de gmpos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    Petição 870190072829, de 30/07/2019, pág. 270/479
    29/76
    35, 75, 166, 145, 143, 184, 62, 96, 54, 63, 157, 103, 32, 43,
    126, 187, 144, 91, 78, 44, 39, 109, 185, 102, 10, 68, 29, 42, 149, 83, 133, 94, 130, 27, 171, 19, 51, 165, 148, 28, 36, 33, 173, 136, 87, 82, 100, 49, 120, 152, 161, 162, 147, 71, 137, 57, 8, 53, 132, 151, 163, 123, 47, 92, 90, 60, 99, 79, 59, 108, 115, 72, 0, 12, 140, 160, 61, 180, 74, 37, 86, 117, 191, 101, 52, 15, 80, 156, 127, 81, 131, 141, 142, 31, 95, 4, 73, 64, 16, 18, 146, 70, 181, 7, 89, 124, 77, 67, 116, 21, 34, 41, 105, 113, 97, 2, 6, 55, 17, 65, 38, 48, 158, 159, 179, 5, 30, 183, 170, 135, 125, 20, 106, 186, 182, 188, 114, 1, 14, 3, 134, 178, 189, 167, 40, 119, 22, 190, 58, 23, 155, 138, 98, 84, 11, 110, 88, 46, 177, 175, 25, 150, 118, 121, 129, 168, 13, 128, 104, 69, 112, 169, 9, 45, 174, 93, 26, 56, 76, 50, 154, 139, 66, 85, 153, 107, 111, 172, 176, 164, 24, 122, a matriz de verificação de paridade inclui uma matriz A de Ml linhas e K colunas representada por um valor Ml predeterminado e um comprimento da informação K = N x r do código LDPC, a matriz A sendo uma matriz superior esquerda da matriz de verificação de paridade, uma matriz B de Ml linhas e Ml colunas, que tem uma estrutura de degrau adjacente à direita da matriz A, uma matriz Z de Ml linhas e N-K-Ml colunas, a matriz Z sendo uma matriz zero adjacente à direita da matriz B, uma matriz C de N-K-Ml linhas e K + Ml colunas, adjacente a abaixo da matriz A e da matriz B, e uma matriz D de N-K-Ml linhas e N-K-Ml colunas, a matriz D sendo uma matriz identidade adjacente à direita da matriz C, o valor Ml predeterminado é 4.680, a matriz A e a matriz C são representadas por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa as posições dos elementos de 1 da matriz A e da
    Petição 870190072829, de 30/07/2019, pág. 271/479
    30/76 matriz C para cada 360 colunas, e é
    1012 3997 5398 5796 21940 23609 25002 28007 32214 33822
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    37835
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    31/76
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    37258
    599 1778 8935 16154 19546 23537 24938 32059 32406 35564
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    532 3750 5075 10603 12466 19838 24231 24998 27647 35111
    Petição 870190072829, de 30/07/2019, pág. 273/479
    32/76
    37392
    37617
    32640
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    37704
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    Petição 870190072829, de 30/07/2019, pág. 274/479
    33/76
    585 1990 3457 5010 8808
    9 2792 4678 22666 32922
    342 507 861 18844 32947
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    356 2061 2801 20330 38214
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    842 1053 4088 10818 24053
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    1498 2113 4175 6432 17014
    524 2135 2205 6311 7502
    191 954 3166 28938 31869
    548 586 4101 12129 25819
    127 2352 3215 6791 13523
    286 4262 4423 14087 38061
    1645 3551 4209 14083 15827
    719 1087 2813 32857 34499
    651 2752 4548 25139 25514
    1702 4186 4478 10785 33263
    34 3157 4196 5811 36555
    643 649 1524 6587 27246
    291 836 1036 18936 19201
    78 1099 4174 18305 36119
    3083 3173 4667 27349 32057
    3449 4090 4339 18334 24596
    503 3816 4465 29204 35316
    102 1693 1799 17180 35877
    288 324 1237 16167 33970
    224 2831 3571 17861 28530
    Petição 870190072829, de 30/07/2019, pág. 275/479
    34 /76
    1202 2803 2834 4943 31485
    1112 2196 3027 29308 37101
    4242 4291 4503 16344 28769
    1020 1927 3349 9686 33845
    3179 3304 3891 8448 37247
    1076 2319 4512 17010 18781
    987 1391 3781 12318 35710
    2268 3467 3619 15764 25608
    764 1135 2224 8647 17486
    2091 4081 4648 8101 33818
    471 3668 4069 14925 36242
    932 2140 3428 12523 33270
    5840 8959 12039 15972 38496
    5960 7759 10493 31160 38054
    10380 14835 26024 35399 36517
    5260 7306 13419 28804 31112
    12747 23075 32458 36239 37437
    14096 16976 21598 32228 34672
    5024 5769 21798 22675 25316
    8617 14189 17874 22776 29780
    7628 13623 16676 30019 33213
    14090 14254 18987 21720 38550
    17306 17709 19135 22995 28597
    13137 18028 23943 27468 37156
    7704 8171 10815 28138 29526.
    7. Método de transmissão, caracterizado pelo fato de que compreende:
    uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que
    Petição 870190072829, de 30/07/2019, pág. 276/479
    35/76 tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 9/16;
    uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    155, 188, 123, 132, 15, 79, 59, 119, 66, 68, 41, 175, 184, 78, 142, 32, 54, 111, 139, 134, 95, 34, 161, 150, 58, 141, 74, 112, 121, 99, 178, 179, 57, 90, 80, 21, 11, 29, 67, 104, 52, 87, 38, 81, 181, 160, 176, 16, 71, 13, 186, 171, 9, 170, 2, 177, 0, 88, 149, 190, 69, 33, 183, 146, 61, 117, 113, 6, 96, 120, 162, 23, 53, 140, 91, 128, 46, 93, 174, 126, 159, 133, 8, 152, 103, 102, 151, 143, 100, 4, 180, 166, 55, 164, 18, 49, 62, 20, 83, 7, 187, 153, 64, 37, 144, 185, 19, 114, 25, 116, 12, 173, 122, 127, 89, 115, 75, 101, 189, 124, 157, 108, 28, 165, 163, 65, 168, 77, 82, 27, 137, 86, 22, 110, 63, 148, 158, 97, 31, 105, 135, 98, 44, 70, 182, 191, 17, 156, 129, 39, 136, 169, 3, 145, 154, 109,
    76, 5, 10, 106, 35, 94, 172, 45, 51, 60, 42, 50, 72, 85, 40, 118, 36, 14, 130,
    131, 138, 43, 48, 125, 84, 24, 26, 1, 56, 107, 92, 147, 47, 30, 73, 167, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma
    Petição 870190072829, de 30/07/2019, pág. 277/479
    36/76 tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da matriz de informação para cada 360 colunas, e é
    110 3064 6740 7801 10228 13445 17599 17891 17979 18044 19923 21848 23262 25585 25968 30124
    1578 8914 9141 9731 10605 11690 12824 18127 18458 24648 24950 25150 26323 26514 27385 27460
    3054 3640 3923 7332 10770 12215 14455 14849 15619 20870 22033 26427 28067 28560 29777 29780
    1348 4248 5479 8902 9101 9356 10581 11614 12813 21554 22985 23701 24099 24575 24786 27370
    3266 8358 16544 16689 16693 16823 17565 18543 19229 21121 23799 24981 25423 28997 29808 30202
    320 1198 1549 5407 6080 8542 9352 12418 13391 14736 15012 18328 19398 23391 28117 28793
    2114 3294 3770 5225 5556 5991 7075 7889 11145 11386 16561 18956 19034 23605 26085 27132
    3623 4011 4225 5249 5489 5711 7240 9831 10458 14697 15420 16015 17782 23244 24215 24386
    2624 2750 3871 8247 11135 13702 19290 22209 22975 23811
    23931 24872 25154 25165 28375 30200
    1060 1240 2040 2382 7723 9165 9656 10398 14517 16653 21241 22348 23476 27203 28443 28445
    1070 1233 3416 6633 11736 12808 15454 16505 18720 20162 21425 21874 26069 26855 27292 27978
    420 5524 10279 11218 12500 12913 15389 15824 19414 19588 21138 23846 26621 27907 28594 28781
    151 1356 2323 3289 4501 10573 13667 14642 16127 17040
    Petição 870190072829, de 30/07/2019, pág. 278/479
    37 /76
    17475 18055 24061 26204 26567 29277
    1410 3656 4080 6963 8834 10527 17490 17584 18065 19234
    22211 22338 23746 24662 29863 30227
    1924 2694 3285 8761 9693 11005 17592 21259 21322 21546
    21555 24044 24173 26988 27640 28506
    1069 6483 6554 9027 11655 12453 16595 17877 18350 18995
    21304 21442 23836 25468 28820 29453
    149 1621 2199 3141 8403 11974 14969 16197 18844 21027
    21921 22266 22399 22691 25727 27721
    3689 4839 7971 8419 10500 12308 13435 14487 16502 16622
    17229 17468 22710 23904 25074 28508
    1270 7007 9830 12698 14204 16075 17613 19391 21362
    21726 21816 23014 23651 26419 26748 27195
    96 1953 2456 2712 2809 3196 5939 10634 21828 24606
    26169 26801 27391 28578 29725 30142
    832 3394 4145 5375 6199 7122 7405 7706 10136 10792
    15058 15860 21881 23908 25174 25837
    730 1735 2917 4106 5004 5849 8194 8943 9136 17599 18456
    20191 22798 27935 29559
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    21897 22590 24020 29578 29644
    407 2138 4493 7979 8225 9467 11956 12940 15566 15809
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    15176 16377 16644 22732
    12463 12711 18341
    Petição 870190072829, de 30/07/2019, pág. 279/479
    38/76
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    Petição 870190072829, de 30/07/2019, pág. 280/479
    39/76
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    4732 6162 13569
    8993 17053 29387
    2210 5024 24030
    Petição 870190072829, de 30/07/2019, pág. 281/479
    40/76
    21 22976 24053
    12359 15499 28251
    4640 11480 24391
    1083 7965 16573
    13116 23916 24421
    10129 16284 23855
    1758 3843 21163
    5626 13543 26708
    14918 17713 21718
    13556 20450 24679
    3911 16778 29952
    11735 13710 22611
    5347 21681 22906
    6912 12045 15866
    713 15429 23281
    7133 17440 28982
    12355 17564 28059
    7658 11158 29885
    17610 18755 28852
    7680 16212 30111
    8812 10144 15718.
    8. Dispositivo de recepção, caracterizado pelo fato de que compreende:
    uma unidade de desintercalação grupo a grupo configurada para retomar a sequência do código LDPC depois da intercalação gmpo a gmpo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a
    Petição 870190072829, de 30/07/2019, pág. 282/479
    41/76 codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 9/16;
    uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    155, 188, 123, 132, 15, 79, 59, 119, 66, 68, 41, 175, 184, 78, 142, 32, 54, 111, 139, 134, 95, 34, 161, 150, 58, 141, 74, 112, 121, 99, 178, 179, 57, 90, 80, 21, 11, 29, 67, 104, 52, 87, 38, 81, 181, 160, 176, 16, 71, 13, 186, 171, 9, 170, 2, 177, 0, 88, 149, 190, 69, 33, 183, 146, 61, 117, 113, 6, 96, 120, 162, 23, 53, 140, 91, 128, 46, 93, 174, 126, 159, 133, 8, 152, 103, 102, 151, 143, 100, 4, 180, 166, 55, 164, 18, 49, 62, 20, 83, 7, 187, 153, 64, 37, 144, 185, 19, 114, 25, 116, 12, 173, 122, 127, 89, 115, 75, 101, 189, 124, 157, 108, 28, 165, 163, 65, 168, 77, 82, 27, 137, 86, 22, 110, 63, 148, 158, 97, 31, 105, 135, 98, 44, 70, 182, 191, 17, 156, 129, 39, 136, 169, 3, 145, 154, 109, 76, 5, 10, 106, 35, 94, 172, 45, 51, 60, 42, 50, 72, 85, 40, 118, 36, 14, 130, 131, 138, 43, 48, 125, 84, 24, 26, 1, 56, 107, 92, 147, 47, 30, 73, 167, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade,
    Petição 870190072829, de 30/07/2019, pág. 283/479
    42/76 a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da matriz de informação para cada 360 colunas, e é
    110 3064 6740 7801 10228 13445 17599 17891 17979 18044 19923 21848 23262 25585 25968 30124
    1578 8914 9141 9731 10605 11690 12824 18127 18458 24648 24950 25150 26323 26514 27385 27460
    3054 3640 3923 7332 10770 12215 14455 14849 15619 20870 22033 26427 28067 28560 29777 29780
    1348 4248 5479 8902 9101 9356 10581 11614 12813 21554 22985 23701 24099 24575 24786 27370
    3266 8358 16544 16689 16693 16823 17565 18543 19229 21121 23799 24981 25423 28997 29808 30202
    320 1198 1549 5407 6080 8542 9352 12418 13391 14736 15012 18328 19398 23391 28117 28793
    2114 3294 3770 5225 5556 5991 7075 7889 11145 11386 16561 18956 19034 23605 26085 27132
    3623 4011 4225 5249 5489 5711 7240 9831 10458 14697 15420 16015 17782 23244 24215 24386
    2624 2750 3871 8247 11135 13702 19290 22209 22975 23811
    23931 24872 25154 25165 28375 30200
    1060 1240 2040 2382 7723 9165 9656 10398 14517 16653 21241 22348 23476 27203 28443 28445
    1070 1233 3416 6633 11736 12808 15454 16505 18720 20162 21425 21874 26069 26855 27292 27978
    420 5524 10279 11218 12500 12913 15389 15824 19414
    19588 21138 23846 26621 27907 28594 28781
    Petição 870190072829, de 30/07/2019, pág. 284/479
    43/76
    151 1356 2323 3289 4501 10573 13667 14642 16127 17040
    17475 18055 24061 26204 26567 29277
    1410 3656 4080 6963 8834 10527 17490 17584 18065 19234
    22211 22338 23746 24662 29863 30227
    1924 2694 3285 8761 9693 11005 17592 21259 21322 21546
    21555 24044 24173 26988 27640 28506
    1069 6483 6554 9027 11655 12453 16595 17877 18350 18995
    21304 21442 23836 25468 28820 29453
    149 1621 2199 3141 8403 11974 14969 16197 18844 21027
    21921 22266 22399 22691 25727 27721
    3689 4839 7971 8419 10500 12308 13435 14487 16502 16622
    17229 17468 22710 23904 25074 28508
    1270 7007 9830 12698 14204 16075 17613 19391 21362
    21726 21816 23014 23651 26419 26748 27195
    96 1953 2456 2712 2809 3196 5939 10634 21828 24606
    26169 26801 27391 28578 29725 30142
    832 3394 4145 5375 6199 7122 7405 7706 10136 10792
    15058 15860 21881 23908 25174 25837
    730 1735 2917 4106 5004 5849 8194 8943 9136 17599 18456
    20191 22798 27935 29559
    6238 6776 6799 9142 11199 11867 15979 16830 18110 18396
    21897 22590 24020 29578 29644
    407 2138 4493 7979 8225 9467 11956 12940 15566 15809
    16058 18211 22073 28314 28713
    957 1552 1869 4388 7642 7904 13408 13453 16431 19327 21444 22188 25719 28511 29192
    3617 8663 22378 28704
    8598 12647 19278 22416
    15176 16377 16644 22732
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    44/76
    12463 12711 18341 11079 13446 29071 2446 4068 8542 10838 11660 27428 16403 21750 23199 9181 16572 18381 7227 18770 21858 7379 9316 16247 8923 14861 29618 6531 24652 26817 5564 8875 18025 8019 14642 21169 16683 17257 29298 4078 6023 8853 13942 15217 15501 7484 8302 27199 671 14966 20886 1240 11897 14925 12800 25474 28603 3576 5308 11168 13430 15265 18232 3439 5544 21849 3257 16996 23750 1865 14153 22669 7640 15098 17364 6137 19401 24836 5986 9035 11444 4799 20865 29150 8360 23554 29246
    Petição 870190072829, de 30/07/2019, pág. 286/479
    45/76
    2002 18215 22258
    9679 11951 26583
    2844 12330 18156
    3744 6949 14754
    8262 10288 27142
    1087 16563 22815
    1328 13273 21749
    2092 9191 28045
    3250 10549 18252
    13975 15172 17135
    2520 26310 28787
    4395 8961 26753
    6413 15437 19520
    5809 10936 17089
    1670 13574 25125
    5865 6175 21175
    8391 11680 22660
    5485 11743 15165
    21021 21798 30209
    12519 13402 26300
    3472 25935 26412
    3377 7398 28867
    2430 24650 29426
    3364 13409 22914
    6838 13491 16229
    18393 20764 28078
    289 20279 24906
    4732 6162 13569
    8993 17053 29387
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    46 /76
    2210 5024 24030
    21 22976 24053
    12359 15499 28251
    4640 11480 24391
    1083 7965 16573
    13116 23916 24421
    10129 16284 23855
    1758 3843 21163
    5626 13543 26708
    14918 17713 21718
    13556 20450 24679
    3911 16778 29952
    11735 13710 22611
    5347 21681 22906
    6912 12045 15866
    713 15429 23281
    7133 17440 28982
    12355 17564 28059
    7658 11158 29885
    17610 18755 28852
    7680 16212 30111
    8812 10144 15718.
    9. Método de transmissão, caracterizado pelo fato de que compreende:
    uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 11/16;
    uma etapa de intercalação grupo a grupo de realização da
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    47 /76 intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    152, 87, 170, 33, 48, 95, 2, 184, 145, 51, 94, 164, 38, 90, 158, 70, 124, 128, 66, 111, 79, 42, 45, 141, 83, 73, 57, 119, 20, 67, 31, 179, 123, 183, 26, 188, 15, 163, 1, 133, 105, 72, 81, 153, 69, 182, 101, 180, 185, 190,
    77, 6, 127, 138, 75, 59, 24, 175, 30, 186, 139, 56, 100, 176, 147, 189, 116, 131, 25, 5, 16, 117, 74, 50, 171, 114, 76, 44, 107, 135, 71, 181, 13, 43, 122,
    78, 4, 58, 35, 63, 187, 98, 37, 169, 148, 7, 10, 49, 80, 161, 167, 28, 142, 46, 97, 92, 121, 112, 88, 102, 106, 173, 19, 27, 41, 172, 91, 191, 34, 118, 108, 136, 166, 155, 96, 3, 165, 103, 84, 109, 104, 53, 23, 0, 178, 17, 86, 9, 168, 134, 110, 18, 32, 146, 129, 159, 55, 154, 126, 40, 151, 174, 60, 52, 22, 149, 156, 113, 143, 11, 93, 62, 177, 64, 61, 160, 150, 65, 130, 82, 29, 115, 137, 36, 8, 157, 54, 89, 99, 120, 68, 21, 140, 14, 39, 132, 125, 12, 85, 162, 47, 144, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da
    Petição 870190072829, de 30/07/2019, pág. 289/479
    48 /76 matriz de informação para cada 360 colunas, e é
    983 2226 4091 5418 5824 6483 6914 8239 8364 10220 10322 15658 16928 17307 18061
    1584 5655 6787 7213 7270 8585 8995 9294 9832 9982 11185
    12221 12889 17573 19096
    319 1077 1796 2421 6574 11763 13465 14527 15147 15218 16000 18284 20199 21095 21194
    767 1018 3780 3826 4288 4855 7169 7431 9151 10097 10919 12050 13261 19816 20932
    173 692 3552 5046 6523 6784 9542 10482 14658 14663 15168 16153 16410 17546 20989
    2214 2286 2445 2856 3562 3615 3970 6065 7117 7989 8180
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    1507 4159 4946 5215 5653 6385 7131 8049 10198 10499
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    Petição 870190072829, de 30/07/2019, pág. 290/479
    49/76
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    Petição 870190072829, de 30/07/2019, pág. 291/479
    50/76
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    Petição 870190072829, de 30/07/2019, pág. 292/479
    51/76
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    Petição 870190072829, de 30/07/2019, pág. 293/479
    52/76
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    Petição 870190072829, de 30/07/2019, pág. 294/479
    53/76
    4183 6801 20025
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    7613 11096 19536
    2244 4442 6000
    9055 13516 15414
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    3792 8258 15106
    6990 9168 17589
    7920 11548 20786
    10533 14361 19577.
    10. Dispositivo de recepção, caracterizado pelo fato de que compreende:
    uma unidade de desintercalação grupo a grupo configurada para retomar a sequência do código LDPC depois da intercalação grupo a grupo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 11/16;
    uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e
    Petição 870190072829, de 30/07/2019, pág. 295/479
    54/76 uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    152, 87, 170, 33, 48, 95, 2, 184, 145, 51, 94, 164, 38, 90, 158, 70, 124, 128, 66, 111, 79, 42, 45, 141, 83, 73, 57, 119, 20, 67, 31, 179, 123, 183, 26, 188, 15, 163, 1, 133, 105, 72, 81, 153, 69, 182, 101, 180, 185, 190,
    77, 6, 127, 138, 75, 59, 24, 175, 30, 186, 139, 56, 100, 176, 147, 189, 116, 131, 25, 5, 16, 117, 74, 50, 171, 114, 76, 44, 107, 135, 71, 181, 13, 43, 122,
    78, 4, 58, 35, 63, 187, 98, 37, 169, 148, 7, 10, 49, 80, 161, 167, 28, 142, 46, 97, 92, 121, 112, 88, 102, 106, 173, 19, 27, 41, 172, 91, 191, 34, 118, 108, 136, 166, 155, 96, 3, 165, 103, 84, 109, 104, 53, 23, 0, 178, 17, 86, 9, 168, 134, 110, 18, 32, 146, 129, 159, 55, 154, 126, 40, 151, 174, 60, 52, 22, 149, 156, 113, 143, 11, 93, 62, 177, 64, 61, 160, 150, 65, 130, 82, 29, 115, 137, 36, 8, 157, 54, 89, 99, 120, 68, 21, 140, 14, 39, 132, 125, 12, 85, 162, 47, 144, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da matriz de informação para cada 360 colunas, e é
    983 2226 4091 5418 5824 6483 6914 8239 8364 10220 10322
    Petição 870190072829, de 30/07/2019, pág. 296/479
    55/76
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    Petição 870190072829, de 30/07/2019, pág. 297/479
    56/76
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    Petição 870190072829, de 30/07/2019, pág. 298/479
    57/76
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    Petição 870190072829, de 30/07/2019, pág. 299/479
    58/76
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    Petição 870190072829, de 30/07/2019, pág. 300/479
    59/76
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    4183 6801 20025
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    Petição 870190072829, de 30/07/2019, pág. 301/479
    60/76
    3311 6049 14757
    7155 11435 16353
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    1889 3361 7563
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    2244 4442 6000
    9055 13516 15414
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    3792 8258 15106
    6990 9168 17589
    7920 11548 20786
    10533 14361 19577.
    11. Método de transmissão, caracterizado pelo fato de que compreende:
    uma etapa de codificação de realização de codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de 13/16;
    uma etapa de intercalação grupo a grupo de realização da intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma etapa de mapeamento, de mapeamento do código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    Petição 870190072829, de 30/07/2019, pág. 302/479
    61/76
    140, 8, 176, 13, 41, 165, 27, 109, 121, 153, 58, 181, 143, 164,
    103, 115, 91, 66, 60, 189, 101, 4, 14, 102, 45, 124, 104, 159, 130, 133, 135, 77, 25, 59, 180, 141, 144, 62, 114, 182, 134, 148, 11, 20, 125, 83, 162, 75,
    126, 67, 9, 178, 171, 152, 166, 69, 174, 15, 80, 168, 131, 95, 56, 48, 63, 82, 147, 51, 108, 52, 30, 139, 22, 37, 173, 112, 191, 98, 116, 149, 167, 142, 29, 154, 92, 94, 71, 117, 79, 122, 129, 24, 81, 105, 97, 137, 128, 1, 113, 170, 119, 7, 158, 76, 19, 183, 68, 31, 50, 118, 33, 72, 55, 65, 146, 185, 111, 145, 28, 21, 177, 160, 32, 61, 70, 106, 156, 78, 132, 88, 184, 35, 5, 53, 138, 47, 100, 10, 42, 36, 175, 93, 120, 190, 16, 123, 87, 54, 186, 18, 57, 84, 99, 12, 163, 157, 188, 64, 38, 26, 2, 136, 40, 169, 90, 107, 46, 172, 49, 6, 39, 44, 150, 85, 0, 17,
    127, 155, 110, 34, 96, 74, 86, 187, 89, 151, 43, 179, 161, 73, 23, 3, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da matriz de informação para cada 360 colunas, e é
    1031 4123 6253 6610 8007 8656 9181 9404 9596 11501
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    Petição 870190072829, de 30/07/2019, pág. 303/479
    62/76
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    11467 11507 12902
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    Petição 870190072829, de 30/07/2019, pág. 304/479
    63/76
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    Petição 870190072829, de 30/07/2019, pág. 305/479
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    Petição 870190072829, de 30/07/2019, pág. 306/479
    65/76
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    Petição 870190072829, de 30/07/2019, pág. 307/479
    66/76
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    1071 10601 11106
    3069 6943 11015
    5555 8088 9537
    85 2810 3100
    1249 8418 8684
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    4902 6310 8368
    4976 10047 11299
    Petição 870190072829, de 30/07/2019, pág. 308/479
    67 /76
    7325 8228 11092
    4942 6974 8533
    5782 9780 9869
    15 4728 10395
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    1900 3666 8968
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    1722 6386 11112
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    222 6050 12711
    3154 7149 7557
    1556 4667 7990
    Petição 870190072829, de 30/07/2019, pág. 309/479
    68/76
    2536 9712 9932
    4104 7040 9983
    6365 11604 12457
    3393 10323 10743
    724 2237 5455
    108 1705 6151.
  12. 12. Dispositivo de recepção, caracterizado pelo fato de que compreende:
    uma unidade de desintercalação grupo a grupo configurada para retomar a sequência do código LDPC depois da intercalação grupo a grupo para a sequência original, a sequência sendo obtida a partir dos dados transmitidos a partir de um dispositivo de transmissão que inclui uma unidade de codificação configurada para realizar a codificação LDPC com base em uma matriz de verificação de paridade de um código LDPC que tem um comprimento de código N de 69.120 bits e uma taxa de codificação r de
  13. 13/16;
    uma unidade de intercalação grupo a grupo configurada para realizar a intercalação grupo a grupo na qual o código LDPC é intercalado em unidades de grupos de bits de 360 bits; e uma unidade de mapeamento configurada para mapear o código LDPC para um dos 16 pontos de sinal da constelação uniforme (UC) em 16QAM em uma base de 4 bits, em que, na intercalação grupo a grupo, um (i + l)-ésimo grupo de bits a partir de uma cabeça do código LDPC é definido como um grupo de bits i, e uma sequência de grupos de bits 0 a 191 do código LDPC de 69.120 bits é intercalada em uma sequência de grupos de bits
    140, 8, 176, 13, 41, 165, 27, 109, 121, 153, 58, 181, 143, 164,
    103, 115, 91, 66, 60, 189, 101, 4,
  14. 14, 102, 45, 124, 104, 159, 130, 133, 135,
    Petição 870190072829, de 30/07/2019, pág. 310/479
    69/76
    77, 25, 59, 180, 141, 144, 62, 114, 182, 134, 148, 11, 20, 125, 83, 162, 75,
    126, 67, 9, 178, 171, 152, 166, 69, 174, 15, 80, 168, 131, 95, 56, 48, 63, 82, 147, 51, 108, 52, 30, 139, 22, 37, 173, 112, 191, 98, 116, 149, 167, 142, 29, 154, 92, 94, 71, 117, 79, 122, 129, 24, 81, 105, 97, 137, 128, 1, 113, 170, 119, 7, 158, 76, 19, 183, 68, 31, 50, 118, 33, 72, 55, 65, 146, 185, 111, 145, 28, 21, 177, 160, 32, 61, 70, 106, 156, 78, 132, 88, 184, 35, 5, 53, 138, 47, 100, 10, 42, 36, 175, 93, 120, 190, 16, 123, 87, 54, 186, 18, 57, 84, 99, 12, 163, 157, 188, 64, 38, 26, 2, 136, 40, 169, 90, 107, 46, 172, 49, 6, 39, 44, 150, 85, 0, 17,
    127, 155, 110, 34, 96, 74, 86, 187, 89, 151, 43, 179, 161, 73, 23, 3, o código LDPC inclui os bits de informação e os bits de paridade, a matriz de verificação de paridade inclui uma unidade da matriz de informação correspondente aos bits de informação e uma unidade da matriz de paridade correspondente aos bits de paridade, a unidade da matriz de informação é representada por uma tabela de valor inicial da matriz de verificação de paridade, e a tabela de valor inicial da matriz de verificação de paridade é uma tabela que representa uma posição de um elemento de 1 da unidade da matriz de informação para cada 360 colunas, e é
    1031 4123 6253 6610 8007 8656 9181 9404 9596 11501 11654 11710 11994 12177
    399 553 1442 2820 4402 4823 5011 5493 7070 8340 8500 9054 11201 11387
    201 607 1428 2354 5358 5524 6617 6785 7708 10220 11970 12268 12339 12537
    36 992 1930 4525 5837 6283 6887 7284 7489 7550 10329
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    Petição 870190072829, de 30/07/2019, pág. 311/479
    70/76
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    53 549 3010 5441 6090 9175 9336 9358 9839 10117 11307
    11467 11507 12902
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    Petição 870190072829, de 30/07/2019, pág. 312/479
    71/76
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    Petição 870190072829, de 30/07/2019, pág. 313/479
    72 / 76
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    Petição 870190072829, de 30/07/2019, pág. 314/479
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    Petição 870190072829, de 30/07/2019, pág. 315/479
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    Petição 870190072829, de 30/07/2019, pág. 316/479
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    Petição 870190072829, de 30/07/2019, pág. 317/479
    76/76
    6365 11604 12457
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    108 1705 6151.
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