KR19980064637A - 확산스펙트럼 수신기 - Google Patents

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KR19980064637A
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Abstract

안테나에 의해 수시된 고주파수 신호는 무선회로에서 주파수변환과 직각검출을 통해 기저대신호를 변환된다. 타이밍 제어회로에서 기저대신호의 검색프로세싱을 통해, 다수경로에 대한 타이밍들이 검출되어, 제1 및 제2복제코드 타이밍 지시신호, 타이밍펄스 및 제1 및 제2지연시간 지시신호들이 발생된다. 제1 및 제2복제코드 발생기에서, 제1 및 제2복제코드 타이밍 지시신호에 의해 지시된 타이밍에서 제1 및 제2복제코드가 발생된다. 제1 및 제2상관기에서, 기저대신호와 제1복제코드의 상관값과 기저대신호와 제2복제코드의 상관값이 각각 결정된다. 제1 및 제2동기검출기에서, 제1 및 제2상관기의 출력신호가 동기검출을 행하여, 제1 및 제2심볼신호가 출력된다. 제1 및 제2타이밍 조정버퍼에서, 타이밍펄스에 응해 제1 및 제2심볼신호들이 각각 래치되고, 그리고 래치된 제1 및 제2심볼신호들은 제1 및 제2지연시간 지시신호에 의해 지시된 지연시간으로 각각 출력된다. 제1 및 제2타이밍 조정버퍼로부터의 출력신호들은 RAKE결합회로에 의해 함께 결합된다.

Description

확산스펙트럼 수신기
본 발명은 이동 디지탈-셀룰러전화장치와 같은 이동 통신시스템에 사용되는 코드-분한 다중액세스방법(이후부터, CDMA방법 또는 CDMA통신시스템으로 언급함)의 통신시스템을 위한 확산스펙트럼 수신기에 관한 것이다. 특히, 본 발명은 경로 지연된 하나의 심볼주기 또는 그 이상의 경로 지연된 심볼주기에 신호를 RAKE결합시킬 수 있도록 하기 위해, 경로간의 타이밍 차이에 상응하는 타이밍신호를 사용할 수 있도록 함으로써 타이밍 조정버퍼의 지연시간을 조정하도록 구성되는 확산스펙트럼 수신기에 관련된다.
이동 디지탈-셀룰러전화통신 등과 같은 이동통신에 채택되는 CDMA방법에 따라, 동일한 주파수가 동시에 다수의 채널에 의해 사용될 수 있다. 이를 위해, 송신기측에서, 송신심볼데이터들이 채널마다 상이한 확산코드로 승산되어, 이에 의해 송신될 송신신호가 발생된다. 이와 관련해, 상기에서 언급된 바와 같이 확산코드로 송신심볼데이터를 승산하기 위한 프로세스는 확산프로세싱으로 언급되는 한편, 발생된 송신신호(즉, 송신을 위한 신호)는 확산스펙트럼신호로서 언급된다. 확산코드로서, 송신심볼데이터의 속도보다 수십배 내지 수백배 정도 높은 속도에서 발생된 일련의 코드가 채용된다. 삽입구로서, 확산코드의 최소유닛 또는 요소는 칩(chip)으로서 언급된다.
CDMA통신시스템용 확산스펙트럼 수신기는 기지국으로부터 송신된 송신신호를 수신하기에 적합하다. 확산스펙트럼 수신기에서, 수신된 신호는 동기화된 타이밍에서 수신기에 할당된 복제코드(또한 역확산코드로서 언급되고 또한 송신기측에서 사용된 확산코드와 실제로 동일하다)로 승산되고, 여기서 승산으로 발생된 신호는 심볼단위(symbol-by-symbol basis)로 통합된다. 이 프로세싱은 상관프로세싱 또는 역확산프로세싱으로 언급되는 한편, 획득된 통합값은 상관값으로 언급된다. 부수적으로, 상관프로세싱을 실행하기 위한 회로는 상관기로 언급된다. 상관 프로세싱에서, 수신기에서 사용된 복제코드는 수신기측에서 사용된 확산코드와 동일하고, 커다란 상관값이 획득될 수 있다. 이 경우에, 획득된 상관값은 송신심볼데이터에 대등성을 유지한다. 반대로, 수신기측에서 사용된 복제코드가 송신기측에서 사용된 확산코드와 상이하면, 상관값을 도출할 수 없게 된다. 따라서, 다수 채널의 송신신호의 단순한 부가로 기인되는 다중 송신신호의 수신시에, 수신된 다수 신호와 관련 채널에 할당된 확산코드에 상관프로세싱을 실행함으로써 관련 채널의 송신심볼데이터만을 도출할 수 있다. 이는 CDMA통신시스템에서, 개별적인 채널에 대한 확산스펙트럼신호의 복조의 기초가 되는 원리이다.
확산스펙트럼신호를 복조하기 위하여, 수신된 신호에 포함된 확산코드의 타이밍은 수신기에서 사용되는 복제코드의 타이밍과 일치되어야 한다. 확산코드의 타이밍으로부터 복제코드의 타이밍의 단지 한 칩의 벗어남은 완전히 부적절한 복제코드에 의한 수신신호의 승산의 결과와 동일한 결과를 초래하여, 커다란 상관값을 얻는 것을 불가능하게 만든다. 이러한 이유 때문에, CDMA통신시스템에서, 상당히 높은 정확도의 타이밍 동기화가 확산코드와 복제코드간에 필요하다.
CDMA통신시스템에서 주파수활용 효율성을 저하시키거나 또는 낮추는 주 원인중 하나는 사용자 장치간의 간섭이다. 송신출력이 모든 사용자의 장치에서 낮아지게 되면, 상호간 간섭이 완화되거나 또는 억제될 수 있다. 그러나, 사용자의 장치에서 통신품질이 나빠지게 된다. 이러한 상황하에서, 낮은 수신출력레벨에서 높은 통신품질을 보장할 수 있는 기술의 필요성이 대두되었다. 비록, 높은 통신품질을 보장하기 위한 다수의 기술이 제안되고 개발되었다 하더라도, 이들 기술들은 확산코드와 복제코드의 동기화가 확립되지 않는다면 고유의 특성을 발휘할 수 없다. 따라서, 확산코드의 동기화상태가 CDMA통신의 성능을 지배한다고 말할 수 있다.
이러한 시점에서, 육상이동통신은 빌딩 및 산악지역에서 무선파의 반사와 회절로 인해 상이한 지연을 가지는 다수의 전파경로를 수반한다고 말할 수 있다. 지금까지 공지된 통상적인 협대역(narrow-band) 통신시스템에서, 일시적으로 선행하는 심볼이 일시적으로 후행하는 심볼 무선파에 간섭을 끼칠 수 있어서(심볼간 간섭으로 공지됨), 통신특성에 현저한 저하를 야기시킨다. 그러한 심볼간 간섭을 억제하거나 또는 방지하기 위하여, 적응 등화기(adaptive equalizer) 등의 사용을 필요로 하는데, 그러나 이는 시스템 구성을 훨씬 더 복잡하고 또한 비싸게 만들게 된다는 커다란 단점이 있다.
반대로, 확산스펙트럼 통신시스템의 경우에, 복제코드의 타이밍은 다수의 경로중 하나만의 신호와 정합될 수 있는 반면, 복제코드의 타이밍은 다른 경로의 신호와 정합되지 않는다. 따라서, 관련된 한 경로의 신호만이 복제후에 획득된 신호에 나타나게 되어, 근본적으로 다른 경로상의 신호에 영향을 미치는 것을 피할 수 없다. 상기에서 명확히 알 수 있는 바와 같이, 다수경로의 존재에도 불구하고 심볼간 간섭의 매우 낮은 발생가능성 때문에, 확산스펙트럼 통신시스템은 높은 일시적인 분해력을 보장할 수 있다.
다수의 경로로부터 수신된 신호를 복조하기 위하여, 먼저 다수의 경로 각각으로부터의 신호의 타이밍을 독립적으로 측정 또는 결정하는 것이 필요하다. 이러한 측정은 수신된 신호와 복제신호에 대해 상관 프로세싱을 실행하는 한편, 복제코드의 타이밍을 시프트시킴으로써 실현될 수 있다. 개별적인 타이밍에서 상관값들이 좌표를 따라 구해지는 동안 횡좌표를 따라 구해지는 복제코드의 타이밍으로 상관값을 플로팅함으로써, 지연 프로파일로서 언급되는 그래프가 구해질 수 있다(도 4b 및 4c를 보라). 이 시점에서, 횡좌표를 따라 구해진 값(T)은 실시간을 나타내지 않고, 복제코드의 시프트를 나타낸다고 말 할 수 있다.
지연 프로파일에서, 개별적인 경로의 신호들은 독립적인 또는 이산(離散) 펄스파형으로 각각 표시된다. 따라서, 지연 프로파일은 실질적으로 전파경로의 임펄스 응답에 상응한다. 이러한 이유 때문에, 다수의 복제코드 발생기와 상응하는 수의 상관기가 채용되는데, 구성은 개별적인 복제코드의 타이밍들이 서로 독립적으로 설정될 수 있도록 만들어진다. 그런 다음, 다수 복제코드의 타이밍들은 지연 프로파일로부터 독출된 상응하는 수의 경로의 타이밍들과 각각 정합되게 된다. 이러한 방식으로, 개별적인 경로의 신호들은 상호간섭을 야기시키지 않는 상태에서 서로 독립적으로 복조될 수 있다. 이들 복조된 다수 신호들은 동일한 정보를 반송하기 때문에, 복조된 신호를 합성시킴으로써 향상된 수신품질이 실현될 수 있다. 이는 경로 다이버시티 효과로 알려져 있다. 상기에서 언급된 절차는, 신호들이 개별적인 경로에서부터 함께 취합되는 점에서 레이크의 기능(function of rake)와 비슷하기 때문에, RAKE방법으로 불린다. RAKE방법 또는 기능은 본질적으로 확산스펙트럼 통신시스템 덕분에, 다중 전파환경에서 조우하는 장애를 역이용하여, 따라서 RAKE방법은 확산스펙트럼 통신시스템에서 통신의 고품질을 보장하기 위해 필요 불가결하다.
이러한 점에 있어서, 한 경로상의 신호를 복제하기 위해 채용된 한 세트의 복제코드 발생기, 상관기 및 동기검출기는 레이크의 핑커에 비유하여 핑거(finger)로서 언급된다. 따라서,n경로상의 신호의 복조와 RAKE결합을 구현하기 위하여,n핑거가 필요하다. 즉, 각각 복제코드 발생기, 상관기 및 동기검출기로 구성된n세트를 필요로 한다. 삽입구로서, 주어진 경로상의 신호의 타이밍에 복제코드의 타이밍을 정합시키는 것은 핑거 할당으로 언급된다.
RAKE방법의 장점적인 특징을 가장 잘 이용하기 위하여, 높은 수신레벨에서 낮은 수신레벨의 순으로 연속적으로 핑거에 개별적인 경로상의 신호의 타이밍을 할당함으로써 실패없이 동기화를 신뢰성있게 실현하기 위해, 각 경로상의 수신레벨뿐만 아니라 각 경로상의 신호의 타이밍을 결정할 필요가 있다. 이 시퀀스는 검색(search)으로 언급된다. 검색프로세싱을 실행함으로써, CDMA통신시스템의 확산스펙트럼 수신기에서 동기화가 이루어질 수 있다.
본 발명의 기본적인 개념을 보다 잘 이해하기 위하여, 이의 기술적인 배경이 약간 상세히 고찰하게 된다. 첨부도면중 도 1은 세-핑거 RAKE방법에 따른 통상적인 확산스펙트럼 수신기의 구조를 보여주는 블록도이다. 도면을 참조하여 보면, 안테나(1)에 의해 수신된 고주파수 신호는 무선회로(2)에서 주파수변환과 직각검출(quadrature detection)되어 기저대신호(base-band signal)로 변환되고, 그런 다음 동기 검색프로세싱을 통해 제1 내지 제3경로에 대한 타이밍을 결정하기 위한 타이밍 제어회로(3)에 입력된다. 제1경로에 대응하는 제1타이밍신호가 제1복제코드 발생기(41)와 제1상관기(51)에 입력되고, 제2경로에 대응하는 제2타이밍신호는 제2복제코드 발생기(42)와 제2상관기(52)에 입력되며, 그리고 제3경로에 대응하는 제3타이밍신호는 제3복제코드 발생기(43)와 제3상관기(53)에 입력된다. 제1 내지 제3복제코드 발생기(41내지 43)에서, 각각이 송신기측에서 실행된 확산프로세스에 사용된 확산코드와 동일한 코드들이 제1 내지 제3복제코드(또한 역확산코드로서 언급된다)로서 발생된다. 제1 내지 제3복제코드들은 제1 내지 제3타이밍신호에 의해 주어진 타이밍에서 제1 내지 제3복제코드 발생기(41내지 43)에서 제1 내지 제3상관기(51내지 53)로 공급된다. 제1상관기(51)에서, 무선회로(2)에서 입력된 기저대신호는 제1복제코드에 의해 승산되는데, 여기서 심볼단위로 제1상관값을 구하기 위하여 승산으로부터 야기된 적신호(product signal)가 적분된다. 제1상관값은 제1동기검출기(61)에서 동기검출되어 제1심볼신호로 변환되게 된다. 그런 다음, 제1심볼신호는 타이밍 제어회로(3)에서 공급된 심볼 타이밍펄스에 따라 타이밍 조정버퍼로서 역할하는 제1래치회로(71)에 의해 래치된다. 제2상관기(52)에서, 기저대신호는 제2복제코드로 승산되는데, 여기서 심볼단위로 제2상관값을 얻기 위하여 승산으로부터 발생된 적신호가 적분된다. 제2상관값은 제2동기검출기(62)에서 동기검출되어 제2심볼신호로 변환되게 된다. 제2심볼신호는 심볼 타이밍펄스에 따라 타이밍 조정버퍼로서 역할하는 제2래치회로(72)에 의해 래치된다. 제3상관기(53)에서, 기저대신호는 제3복제코드로 승산되는데, 여기서 심볼단위로 제3상관값을 얻기 위하여 승산으로부터 발생된 적신호가 적분된다. 제3상관값은 제3동기검출기(63)에서 동기검출되어 제3심볼신호로 변환되게 된다. 제3심볼신호는 심볼 타이밍펄스에 따라 타이밍 조정버퍼로서 역할하는 제3래치회로(73)에 의해 래치된다. 제1 내지 제3래치회로(71내지 73)의 출력신호들은 RAKE결합회로(8)에 의해 동기화되거나 또는 함께 결합되어 복조된 신호로서 출력되게 된다.
도 2에서 알 수 있는 바와 같이, 심볼신호(a1, b1 및 c1)들은 제1핑거(제1복제코드 발생기(41), 제1상관기(51) 및 제1동기검출기(61)로 구성됨)에서부터 연속적으로 출력되고, 심볼신호(a2, b2 및 c2)들은 심볼신호(a1, b1 및 c1)에 대해 약간 지연된 타이밍에서 제2핑거(제2복제코드 발생기(42), 제2상관기(52) 및 제2동기검출기(62)로 구성됨)로부터 연속적으로 출력되고, 그리고 심볼신호(a3, b3 및 c3)들은 심볼신호(a2, b2 및 c2)에 대해 약간 지연된 타이밍에서 제3핑거(제3복제코드 발생기(43), 제3상관기(53) 및 제3동기검출기(63)로 구성됨)에서부터 연속적으로 출력된다. 따라서, 제일 앞쪽의 경로에서 모든 심볼주기의 경계 바로전에 타이밍 제어회로(3)로부터 연속적으로 심볼 타이밍펄스(ta, tb 및 tc)를 발생시켜 제1 내지 제3핑거의 출력신호가 심볼 타이밍펄스(ta, ta 및 tc)에 따라 제1 내지 제3래치회로(71내지 73)에 의해 래치되도록 함으로써, 심볼신호(a1, a2 및 a3)들은 심볼 타이밍펄스(ta)에 응해 동일 타이밍에서 제1 내지 제3래치회로(71내지 73)에 의해 래치되고, 심볼신호(b1, b2 및 b3)는 심볼 타이밍펄스(tb)에 응해 동일 타이밍에서 제1 내지 제3래치회로(71내지 73)에 의해 래치되고, 그리고 심볼신호(c1, c2 및 c3)들은 심볼 타이밍펄스(tc)에 응해 동일 타이밍에서 제1 내지 제3래치회로(71내지 73)에 의해 래치된다. 이러한 방식으로, 대응하는 심볼신호들이 제1 내지 제3래치회로(71내지 73)에 의해 래치되기 때문에, RAKE결합회로(8)로 제1 내지 제3래치회로(71내지 73)의 출력신호들을 결합 또는 합성시킴으로써 복조된 신호(a, b 및 c)가 도출될 수 있다.
그러나, CDMA통신시스템의 통상적인 확산스펙트럼 수신기는, 핑거와 RAKE결합회로 사이에 타이밍 조정버퍼로서 역할하는 한 단의 래치회로만이 제공되기 때문에, 타이밍에서 최상위에 있는 경로에 대해 한 심볼주기 또는 그 이상의 심볼주기에 상응하는 지연을 보이는 경로상의 심볼신호가 다른 경로상의 신호로 동시에 래치될 수 없다는 단점이 있다. 달리 말하면, 한 심볼주기보다 적은 지연을 나타내는 경로상의 신호들만이 RAKE결합회로에 의해 합성될 수 있는데, 이는 RAKE결합을 받을 수 있는 펄스들이 제한된다는 것을 의미한다. 따라서, 핑거의 수가 증가되더라도 확산스펙트럼 수신기의 수신레벨이 효율적으로 증가될 수 없어서, CDMA통신시스템의 통신품질을 개선시키는데 어려움이 있게 된다.
상기에서 설명된 최신기술의 견지에서 보아, 본 발명의 목적은, 최상위 타이밍의 경로에 대해 한 심볼주기 또는 그 이상의 심볼주기에 상응하는 지연을 나타내는 경로상의 신호에 대해 RAKE결합을 실행할 수 있어서 개선된 통신품질을 보장하는 한편 CDMA통신시스템이 증가된 수의 사용자 장치를 수용하도록 하기 위해 간섭을 가능한 최소로 억제할 수 있는 확산스펙트럼 수신기를 제공하는 것이다.
설명이 진행됨에 따라 보다 명확히 알 수 있게 되는 상기 및 다른 목적의 관점에서 보아, 본 발명의 전반적인 특징에 따라 제공되는 확산스펙트럼 수신기는 :
안테나에 의해 수신된 고주파수 신호를 주파수변환과 직각검출을 통해 기저대신호로 변환시키기 위한 무선회로,
상기 기저대신호의 검색프로세싱을 통해 다수경로상의 타이밍을 검출하여 제1 및 제2복제코드 타이밍 지시신호, 타이밍펄스 및 제1 및 제2지연시간 지시신호를 발생시키는 타이밍 제어회로,
타이밍 제어회로에서 공급된 제1복제코드 타이밍 지시신호에 의해 지시되는 타이밍에서 제1복제코드를 발생시키기 위한 제1복제코드 발생기,
타이밍 제어회로에서 공급된 제2복제코드 타이밍 지시신호에 의해 지시되는 타이밍에서 제2복제코드를 발생시키기 위한 제2복제코드 발생기,
제1복제코드 발생기에서 공급된 제1복제코드와 기저대신호의 상관값을 결정하기 위한 제1상관기,
제2복제코드 발생기에서 공급된 제2복제코드와 기저대신호의 상관값을 결정하기 위한 제2상관기,
제1상관기의 출력신호의 동기검출을 통해 제1심볼신호를 출력시키기 위한 제1동기검출기,
제2상관기의 출력신호의 동기검출을 통해 제2심볼신호를 출력시키기 위한 제2동기검출기,
타이밍 제어회로에서 공급된 타이밍펄스에 응해 제1동기검출기에서 출력된 제1심볼신호를 래칭시키고, 또한 타이밍 제어회로에서 출력된 제1 지연시간 지시신호로 지시되는 지연시간으로 래치된 제1심볼신호를 출력시키기 위한 제1타이밍 조정버퍼,
타이밍 제어회로에서 공급된 타이밍펄스에 응해 제2동기검출기에서 출력된 제2심볼신호를 래칭시키고, 또한 타이밍 제어회로에서 출력된 제2지연시간 지시신호로 지시되는 지연시간으로 래치된 제2심볼신호를 출력시키기 위한 제1타이밍 조정버퍼, 및
제1타이밍 조정버퍼와 제2타이밍 조정버퍼로부터의 출력신호를 합성시키기 위한 RAKE결합회로를 포함한다.
본 발명을 수행하기 위한 바람직한 방법에서, 제1 및 제2지연시간 지시신호는 칩주기 단위로 또는 심볼주기 단위로 제1 및 제2타이밍 조정버퍼에 대해 지연시간을 지시하도록 준비될 수 있다.
본 발명을 수행하기 위한 다른 바람직한 방법에서, 제1타이밍 조정버퍼는 제1동기검출기와 RAKE결합회로 사이에 배설된 다단의 제1래치회로, 및 다단의 제1래치회로의 출력단자와 RAKE결합회로 사이에 배설되고 또한 제1 지연시간 지시신호의 제어하에서 턴온/턴오프되는 다수의 제1스위치를 포함한다. 비슷하게, 제2타이밍 조정버퍼는 제2동기검출기와 RAKE결합회로 사이에 배설된 다단의 제2래치회로, 및 다단의 제2래치회로의 출력단자와 RAKE결합회로 사이에 배설되고, 또한 제2지연시간 지시신호의 제어하에서 턴온/턴오프되는 다수의 제2스위치를 포함한다.
본 발명의 수행하기 위한 또 다른 바람직한 방법에서, 상기 언급된 타이밍 제어회로는 한 심볼주기보다 긴 길이코드를 사용하여 획득된 지연프로파일을 기초로 제1 및 제2지연시간 지시신호를 발생시키도록 구성될 수 있다.
본 발명의 상기 목적과 다른 목적 및 특징들은 첨부도면과 관련해 단지 예로서 이루어진 바람직한 실시예의 다음 설명을 읽음으로써 보다 잘 이해될 수 있을 것이다.
다음의 명세서에서, 참조번호가 도면에 이루어졌다.
도 1은 통상적인 확산스펙트럼 수신기의 구조를 보여주는 블록도.
도 2는 통상적인 확산스펙트럼 수신기에서 심볼신호의 타이밍을 매칭시키기 위한 방법을 설명하는 도면.
도 3은 본 발명의 제1실시예에 따른 확산스펙트럼 수신기의 구조를 보여주는 블록도.
도 4a 내지 4c는 다수의 경로에 대한 지연 프로파일을 얻기 위한 방법을 설명하는 그래프도.
도 5는 도 3에 도시된 확산스펙트럼 수신기에서 RAKE조합의 방법을 설명하는 도면.
도 6은 본 발명의 제2실시예에 따른 확산스펙트럼 수신기의 구조를 설명하는 블록도.
도 7a 내지 7d는 도 6에 도시된 확산스펙트럼 수신기에서 RAKE조합을 설명하는 도면.
본 발명은 도면을 참조하여, 바람직하거나 또는 전형적인 것으로 여겨지는 실시예로 상세히 설명된다.
예1
본 발명의 제1 실시예에 따른 확산스펙트럼 수신기는, 다수의 핑거로부터 출력된 심볼신호의 지연이 후에 RAKE결합회로에 의해 함께 합성 또는 결합되는 심볼신호의 타이밍을 정합시키기 위해 칩주기 단위로 지연시간을 조정할 수 있는 시프트 레지스터의 사용으로 조정되도록 구성된다.
특히, 도 3을 참조하여 보면, 제1 실시예에 따른 확산스펙트럼 수신기는 제1동기검출기(161)와 RAKE결합회로(18) 사이에 설치되어, 앞서 언급된 제1래치회로(71) 대신에 타이밍 조정버퍼로서 역할하고, 또한 칩주기 단위로 지연시간을 조정할 수 있도록 설계된 제1시프트 레지스터(171), 제2동기검출기(162)와 RAKE결합회로(18) 사이에 설치되어 제2래치회로(72) 대신에 타이밍 조정버퍼로서 역할하고 또한 칩주기 단위로 지연시간을 조정할 수 있도록 설계되는 제1시프트 레지시터(172), 및 제3동기검출기(163)와 RAKE결합회로(18) 사이에 설치되어 제3래치회로(73) 대신에 타이밍 조정버퍼로서 역할하고 또한 칩주기 단위로 지연시간을 조정할 수 있도록 설계되는 제3시프트 레지스터(173)를 포함한다. 따라서, 제1실시예에 따른 확산스펙트럼 수신기는, 래치회로 대신에 시프트 레지스터가 사용된다는 점에서 도 1에 도시된 통상적인 확산스펙트럼 수신기와 상이하다. 지금부터, 시프트 레지스터의 구조에 대해 상세히 설명된다. 제1시프트 레지스터(171)는 타이밍 제어회로(13)에서부터 출력된 타이밍펄스에 응해 제1동기검출기(161)의 출력신호를 연속적으로 래치시키기 위해 제공된 여덟 단의 제1래치회로(2111내지 2118), RAKE결합회로(18)와 제1래치회로(2111내지 2118)의 출력단 사이에 각각 설치되고 또한 타이밍 제어회로(13)로부터 출력된 제1타이밍신호에 응해 턴 온/오프가 되도록 제어되는 여덟 단의 제1스위치(2211내지 2218)로 구성된다. 제2시프트 레지스터(172)는 타이밍 제어회로(13)로부터 출력된 타이밍펄스에 응해 제2동기검출기(162)의 출력신호를 연속적으로 래치시키도록 배열된 여덟 단의 제2래치회로(2121내지 2128), 및 RAKE결합회로(18)와 제2래치회로(2121내지 2128)의 출력단 사이에 설치되고, 또한 타이밍 제어회로(13)로부터 출력된 제2타이밍신호에 응해 턴 온/오프되도록 제어되는 여덟 단의 제2스위치(2221내지 2228)로 구성된다. 제3시프트 레지스터(173)는 타이밍 제어회로(13)로부터 출력된 타이밍펄스에 응해 제3동기검출기(163)의 출력신호를 연속적으로 래치시키기 위해 배열된 여덟 단의 제3래치회로(2131내지 2138) 및 RAKE결합회로(18)와 제3래치회로(2131내지 2138)의 출력단 사이에 설치되고 또한 타이밍 제어회로(13)로부터 출력된 제3타이밍신호에 응해 턴 온/오프되도록 제어되는 여덟 단의 제3스위치(2231내지 2238)로 구성된다.
제1실시예에 따른 확산스펙트럼 수신기에 있어서, 기지국으로부터 전송된 무선파는 안테나(11)에 의해 수신된다. 안테나(11)에 의해 수신된 고주파수 신호는 무선회로(12)에서 주파수변환과 검출되어 기저대신호로 변환되게 되고, 그리고 기저대신호는 이전에 설명된 검색프로세싱을 통해 제1 내지 제3경로에 대한 타이밍을 결정하기 위한 타이밍 제어회로(13)에 입력된다. 제1경로에 대응하는 제1타이밍신호는 제1복제코드 발생기(141), 제1상관기(151) 및 제1시프트 레지스터(171)에 입력된다. 제2경로에 대응하는 제2타이밍신호는 제2복제코드 발생기(142), 제2상관기(152) 및 제2시프트 레지스터(172)에 입력된다. 제3경로에 대응하는 제3타이밍신호는 제3복제코드 발생기(143), 제3상관기(153) 및 제3시프트 레지스터(173)에 입력된다. 제1 내지 제3복제코드 발생기(141내지 143)에서, 송신기측에서 실행된 확산프로세스에 사용된 확산코드와 동일한 확산코드가 제1 내지 제3복제코드(역확산 코드)로서 발생된다. 제1 내지 제3복제코드들은 제1 내지 제3타이밍신호에 의해 주어진 타이밍에서 제1 내지 제3상관기(151내지 153)에 공급된다. 제1상관기(151)에서, 무선회로(12)로부터 입력된 기저대신호는 제1복제코드에 의해 승산되는데, 여기서 승산의 결과로 발생한 최종 신호는 심볼단위로 제1상관값을 구하기 위하여 적분된다. 제1상관값은 제1동기검출기(161)에서 동기검출되어, 제1심볼신호로 변환되게 된다. 그런 다음, 제1심볼신호는 타이밍 제어회로(13)로부터 출력된 타이밍펄스에 응해 제1시프트 레지스터(171)의 여덟 단의 제1래치회로(2111내지 2118)에 의해 연속적으로 래치된다. 제2상관기(152)에서, 기저대신호는 제2복제코드로 승산되는데, 여기서 승산의 결과로 발생한 최종 신호는 심볼단위로 제2상관값을 구하기 위하여 적분된다. 제2상관값은 제2동기검출기(162)에서 동기검출되어 제2심볼신호로 변환되게 된다. 제2심볼신호는 타이밍펄스에 응해 제2시프트 레지스터(172)의 여덟 단의 제2래치회로(2121내지 2128)에 의해 연속적으로 래치된다. 제3상관기(153)에서, 기저대신호는 제3복제코드로 승산되는데, 여기서 승산의 결과로 발생한 최종신호는 심볼단위로 제3상관값을 구하기 위하여 적분된다. 제3상관값은 제3동기검출기(163)에서 동기검출되어 제3심볼신호로 변환되게 된다. 제3심볼신호는 타이밍펄스에 응해 제3시프트 레지스터(173)의 여덟 단의 제3래치회로(2131내지 3138)에 의해 연속적으로 래치된다. 제1 내지 제3시프트 레지스터(171내지 173)의 출력신호는 최대속도 동기방법에 따라 RAKE결합회로(18)에 의해 합성 또는 결합되어 복조된 신호로서 연속적으로 출력되게 된다.
지금부터 도 4a 내지 도 4b를 참조하여 타이밍 제어회로(13)의 작동이 상세히 설명된다.
제1 내지 제3경로에 대응하는 심볼신호(즉, 제1 내지 제3핑거로부터 출력된 제1 내지 제3심볼신호(a1 내지 a3)) 도 4a에 도시된 바와 같이 타이밍관계로 서로간에 유지된다고 가정한다. 이러한 경우에, 한 심볼주기에 상응하는 주기를 가지는 짧은 코드를 사용하여 상관이 결정되면, 도 4b에 도시된 바와 같이 모든 심볼주기에서 동일한 패턴을 보이는 지연 프로파일을 구하게 된다. 그러한 지연 프로파일로부터 한 심볼주기보다 긴 심볼주기를 보이는 경로에 대한 타이밍을 결정할 수 없다. 한편, 한 심볼주기보다 훨씬 더 긴 주기를 가지는 긴 코드를 사용하여 상관이 결정되면, 도 4c에서 알 수 있듯이 경로들의 지연시간에 상응하는 지연 프로파일을 구할 수 있다. 따라서, 긴 코드를 사용하여 구해진 지연 프로파일의 피크값(P1 내지 P3)을 토대로 제일 앞쪽의 제1경로에 대한 제2 및 제3경로에서 지연의 크기를 칩의 수로서 결정할 수 있다.
다시, 제1 내지 제3핑거의 심볼신호(a1 내지 a3)가 타이밍(t1 내지 t3)에서 각각 나타나고, 제1 및 제2심볼신호(a1 및 a2)가 제일 지연된 제3핑거의 심볼신호(a3)를 t3∼t1 과 t3∼t2로써 앞선다고 가정한다. 따라서, 제1핑거의 제1심볼신호(a1)를 t3∼t1으로 지연시키고, 또한 제2핑거의 심볼신호(a2)를 t3∼t2로서 지연시킴으로써, 제1 내지 제3핑거의 심볼신호(a1 내지 a3)의 타이밍이 서로 정합될 수 있다.
특히, 칩단위로 지연시간을 나타내는 제1타이밍신호(즉, 제1지연시간 지시신호)가 타이밍 제어회로(13)에서 제1시프트 레지스터(171)로 출력되어, 이에 의해 제1타이밍신호에 의해 지시되는 지연시간에 대응하는 여덟 단의 제1스위치(2211내지 2218)중 하나만이 폐쇄된다. 또한 칩단위로 지연시간을 나타내는 제2타이밍신호(즉, 제2지연시간 지시신호)가 타이밍 제어회로(13)에서 제2시프트 레지스터(172)로 출력되어, 이에 의해 제2타이밍신호에 의해 지시되는 지연시간에 대응하는 여덟 단의 제2스위치(2221내지 2228)중 두 번째의 것만이 폐쇄된다. 또한, 칩단위로 지연을 나타내는 제3타이밍신호(즉, 제3지연시간 지시신호)가 타이밍 제어회로(13)에서 제3시프트 레지스터(173)로 출력되어, 이에 의해 제3타이밍신호에 의해 지시되는 지연시간에 대응하는 여덟 단의 제3스위치(2231내지 2238)중 세 번째 것만이 폐쇄된다. 예로써, 제1 및 제2핑거의 심볼신호(a1 및 a2)가 제3핑거의 제3심볼신호(a3)를 각각 6칩과 3칩을 앞선다고 가정하자. 이러한 경우에, 제1시프트 레지스터(171)에서, 6칩의 지연시간을 지시하는 제1타이밍신호에 대응하는 제7단의 제1스위치(2217)만이 폐쇄되는 한편, 제2시프트 레지스터(172)에서, 3칩의 지연시간을 지시하는 제2타이밍신호에 대응하는 제4단의 제2스위치(2224)만이 폐쇄된다. 다른 한편, 제3시프트 레지스터(173)에서, 지연을 지시하지 않는 제3타이밍신호에 대응하는 제1단의 제3스위치(2231)만이 폐쇄된다.
상기에서 설명된 구성으로, 심볼신호들은 동일한 타이밍에서 제1 내지 제3시프트 레지스터(171내지 173)에서 출력된다. 따라서, RAKE결합회로(18)로 이들 심볼신호들을 함께 합성 또는 결합시킴으로써, 경로상의 지연이 한 심볼주기 보다 짧거나 또는 더 길거나에 상관없이 효율적으로 강화된 수신레벨을 가지는 복조신호가 획득될 수 있다.
제1 내지 제3시프트 레지스터(171내지 173) 각각은 도 3에 설명된 확산스펙트럼 수신기의 여덟 단에서 실현된다. 그러나, 제1 내지 제3시프트 레지스터(171내지 173) 각각은 실제 응용에서 경로상의 지연에 대응하는 단의 수로 실현된다는 것을 인식하여야만 한다.
예 2
본 발명의 제2실시예에 따른 확산스펙트럼 수신기는, 다수의 핑거로부터 출력된 심볼신호들의 지연 양이, 후에 RAKE방법에 따라 함께 합성 또는 결합되는 심볼신호들의 타이밍을 정합시키기 위해 심볼주기 단위로 지연시간을 조정할 수 있는 시프트 레지스터의 사용으로 조정되도록 구성된다.
특히, 도 6을 참조하여 보면, 본 실시예에 따른 확산스펙트럼 수신기는 칩주기 단위로 지연시간을 조정할 수 있는 상기의 제1시프트 레지스터(171) 대신에, RAKE결합회로(38)와 제1동기검출기(361) 사이에 설치되고 또한 심볼주기 단위로 지연시간을 조정할 수 있도록 설계되는 제1시프트 레지스터(371), 칩주기 단위로 지연시간을 조정할 수 있는 상기 제2시프트 레지스터(172) 대신에, RAKE결합회로(38)와 제2동기검출기(362) 사이에 설치되고 또한 심볼주기 단위로 지연시간을 조정할 수 있도록 설계되는 제2시프트 레지스터(372), 및 칩주기 단위로 지연시간을 조정할 수 있는 상기 제3시프트 레지스터(173) 대신에, RAKE결합회로(38)와 제3동기검출기(363) 사이에 설치되고, 또한 심볼주기 단위로 지연시간을 조정할 수 있도록 설계되는 제3시프트 레지스터(373)를 포함한다. 따라서, 제2실시예에 따른 확산스펙트럼 수신기는, 심볼주기 단위로 지연시간을 조정할 수 있는 시프트 레지스터가 칩주기 단위로 지연을 조정할 수 있는 시프트 레지스터 대신에 사용된다는 점에서 도 3에 도시된 제1실시예에 따른 확산스펙트럼 수신기와 상이하다. 특히, 제1시프트 레지스터(371)는 타이밍 제어회로(33)에서부터 출력된 심볼 타이밍펄스에 응해 제1동기검출기(361)의 출력신호를 연속적으로 래치하기 위해 제공된 삼 단의 제1래치회로(4111내지 4113)와, RAKE결합회로(38)와 제1래치회로(4111내지 4113)의 출력단 사이에 설치되고 또한 타이밍 제어회로(33)로부터 출력된 제1타이밍신호에 응해 턴 온/오프되도록 제어되는 삼 단의 제1스위치(4211내지 4213)로 구성된다. 제2시프트 레지스터(372)는 타이밍 제어회로(33)에서부터 출력된 심볼 타이밍펄스에 응해 제2동기검출기(362)의 출력신호를 연속적으로 래치하기 위해 제공된 삼 단의 제2래치회로(4121내지 4123)와, RAKE결합회로(38)와 제2래치회로(4121내지 4123)의 출력단 사이에 설치되고, 또한 타이밍 제어회로(33)로부터 출력된 제2타이밍신호에 응해 턴 온/오프되도록 제어되는 삼 단의 제2스위치(4221내지 4223)로 구성된다. 제3시프트 레지스터(373)는 타이밍 제어회로(33)에서부터 출력된 심볼 타이밍펄스에 응해 제3동기검출기(363)의 출력신호를 연속적으로 래치하기 위해 제공된 삼 단의 제3래치회로(4131내지 4133)와, RAKE결합회로(38)와 제3래치회로(4131내지 4133)의 출력단 사이에 설치되고, 또한 타이밍 제어회로(33)로부터 출력된 제3타이밍신호에 응해 턴 온/오프되도록 제어되는 삼 단의 제3스위치(4231내지 4233)로 구성된다.
제2실시예에 따른 확산스펙트럼 수신기에 있어서, 안테나(31), 무선회로(32), 제1 내지 제3복제코드 발생기(341내지 343), 제1 내지 제3상관기(351내지 353) 및 제1 내지 제3동기검출기(361내지 363)는 상기에서 설명된 제1실시예의 안테나(12), 제1 내지 제3복제코드 발생기(141내지 143), 제1 내지 제3상관기(151내지 153) 및 제1 내지 제3동기검출기(161내지 163)와 비슷하게 작동한다.
지금부터, 도 7a내지 7d를 참조하여 타이밍 제어회로(33), 제1 내지 제3시프트 레지스터(371내지 373) 및 RAKE결합회로(38)의 동작이 상세히 설명된다.
제1 내지 제3경로에 대응하는 심볼신호(즉, 제1 내지 제3핑거로부터 출력된 제1 내지 제3심볼신호(a1 내지 a3)는 도 7a에 도시된 바와 같은 타이밍관계로 상호간에 유진된다. 이 경우에, 제1심볼신호(a1)는 제1핑거의 제1심볼신호(a1)의 심볼주기의 끝 바로 직전에(도 7c를 참조하라) 타이밍 제어회로(33)에서부터 출력된 심볼 타이밍펄스(t1)(도 7b를 참조하라)에 응해 제1시프트 레지스터(371)의 제1단을 구성하는 제1래치회로(4111)에 의해 래치된다. 계속해서, 제1핑거의 연속하는 심볼주기의 끝 바로 직전에 타이밍 제어회로(33)에서 출력된 심볼 타이밍펄스(t2)(도 7b를 참조하라)에 응해, 제1시프트 레지스터(371)의 제1단을 구성하는 제1래치회로(4411)에 의해 래치된 제1심볼신호(a1)는 제2단의 제1래치회로(4112)에 의해 래치되고, 그리고 동시에 제2심볼신호(a2)는 제2시프트 레지스터(372)의 제1단의 제2래치회로(4121)에 의해 래치된다(도 7c를 참조하라). 계속해서, 제1핑거의 연속하는 심볼주기의 끝 바로 직전에 타이밍 제어회로(33)로부터 출력된 심볼 타이밍펄스(도 7b를 참조하라)에 응해, 제1시프트 레지스터(371)의 제2단을 구성하는 제1래치회로(4412)에 의해 래치된 제1심볼신호(a1)는 제3단의 제1래치회로(4113)에 의해 래치되고, 그리고 동시에 제2시프트 레지스터(372)의 제1단의 제2래치회로(4121)에 의해 래치된 제2심볼신호(a2)가 제2단의 제2래치회로(4222)에 의해 래치되는 한편, 제3심볼신호(a3)는 제3시프트 레지스터(373)의 제1단을 구성하는 제3래치회로(4131)에 의해 래치된다(도 7c를 참조하라).
따라서, 타이밍 제어회로(33)에서 출력되는 제1 내지 제3타이밍신호(제1 내지 제3지연시간 지시신호)에 응해, 제1시프트 레지스터(371)의 제3단에 설치된 제1스위치(4213), 제2시프트 레지스터(372)의 제2단에 설치된 제2스위치(4222), 및 제3시프트 레지스터(373)의 제1단에 설치된 제3스위치(4231)만을 각각 폐쇄시킴으로써, RAKE결합회로(38)에 입력되게 되는 제1 내지 제3심볼신호(a1 내지 a3)의 타이밍을 정합시킬 수 있다(도 7d를 참조하라).
예컨대, 제3심볼신호(3a)가 제1심볼신호(a1)에 대해 150칩에 상응하는 시간주기로 지연되는 한편, 제3심볼신호가 80칩에 상응하는 주기로 제2심볼신호(a2)에 대해 지연된다고 가정하자. 이러한 경우에, 심볼주기가 64칩에 대응하고, 지연단의 수가 심볼주기로 지연 칩주기의 분할로부터 발생되는 몫과 동일하게 되도록 결정된다고 가정한다. 특히, 제1심볼신호(a1)는 2, 150을 64로 분할한 몫에 의해 제3심볼주기(a3)에 대해 지연될 수 있는 반면, 제2심볼신호(a2)는 1, 80을 64로 분할한 몫으로 제3심볼신호(a3)에 대해 지연될 수 있다. 이 경우, 타이밍 제어회로(33)에서부터 출력되는 제1 내지 제3타이밍신호에 응해, 제1시프트 레지스터(371)의 제3단에 설치된 제1스위치(4213), 제2시프트 레지스터(372)의 제2단에 설치된 설치된 제2스위치(4222) 및 제3시프트 레지스터(373)의 제1 단에 설치된 제3스위치(4231)만을 폐쇄시킴으로써, RAKE결합회로(38)에 입력되게 되는 제1 내지 제3심볼신호(a1 내지 a3)의 타이밍을 정합시킬 수 있다. 이러한 방식에서, 심볼주기 단위로 심볼신호를 지연시키기 위해 제1 내지 제3시프트 레지스터(371내지 373)를 사용함으로써, 한 심볼주기 또는 더 이상의 심볼주기에 상응하는 지연이 발생할 때, 비교적 작은 수의 시프트 레지스터로 경로간의 동기화를 이룰수가 있다.
상기에서 설명된 구성으로, 심볼신호들은 동일한 타이밍에서 제1 내지 제3시프트 레지스터(371내지 373)에서부터 출력된다. 최대비율 합성방법에 따라 RAKE결합회로(38)로 이들 심볼신호들은 함께 합성 또는 결합시킴으로써, 경로상의 지연이 한 심볼주기 보다 짧거나 또는 더 길거나에 상관없이 효율적으로 강화된 수신레벨을 가지는 복조신호를 구할 수가 있다.
제1 내지 제3시프트 레지스터(371내지 373)들은 도 6에 설명된 확산스펙트럼 수신기내 삼 단에 구현된다. 그러나, 제1 내지 제3시프트 레지스터(371내지 373) 각각은 실제 응용에서 경로상의 지연시간에 대응하는 단의 수로 구현된다는 것을 인식해야만 한다.
상기 설명에서부터 명확히 알 수 있는 바와 같이, 본 발명에 따른 확산스펙트럼 수신기에 있어서, RAKE결합회로가 한 심볼 또는 더 이상의 심볼에 대응하는 지연을 야기시키는 경로에도 불구하고 구현될 수 있다. 즉 달리 말하면, 본 발명에 따른 확산스펙트럼 수신기로, 복조프로세싱이 증가된 수의 경로에 대한 심볼신호를 합성 또는 결합시키기 위해 실행될 수 있다. 이는 본 발명에 따른 확산스펙트럼 수신기가 개선된 항간섭 특성을 가질 수 있다는 것을 의미한다. 이외에도, 상대적으로 낮은 송신출력과 그리고 이에 따른 다른 사용자의 장치에 대한 작은 간섭 때문에, 점점 증가하는 많은 수의 사용자를 수용할 수 있는 통신시스템을 구현할 수 있다. 부가적으로, 시프트 레지스터가 심볼주기 단위로 심볼신호를 지연시키기 위한 타이밍 조정버퍼로서 사용되기 때문에, 다수 심볼신호의 타이밍 정합이 간략한 회로구조로 이루어질 수 있다.
본 발명의 수 많은 변형과 수정이 본 발명의 범위내에서 이루어질 수 있다. 따라서, 첨부된 청구항의 범위내에서, 본 발명이 설명된 실시예외의 다른 식으로 구현될 수 있다는 것을 명심해야 한다.

Claims (7)

  1. 안테나에 의해 수신된 고주파수 신호를 주파수변환과 직각검출을 통해 기저대신호로 변환시키기 위한 무선회로 ;
    제1 및 제2복제코드 타이밍 지시신호, 타이밍펄스, 및 제1 및 제2지연시간 지시신호를 발생시키기 위해 검색프로세싱을 통해 다수경로상의 타이밍을 검출하기 위한 타이밍 제어회로 ;
    상기 타이밍 제어회로에서부터 공급된 상기 제1복제코드 타이밍 지시신호에 의해 지시된 타이밍에서 제1복제코드를 발생시키기 위한 제1복제코드 발생기 ;
    상기 타이밍 제어회로에서부터 공급된 상기 제2복제코드 타이밍 지시신호에 의해 지시된 타이밍에서 상기 제1복제코드와 동일한 제2복제코드를 발생시키기 위한 제2복제코드 발생기 ;
    상기 제1복제코드 발생기에서부터 공급된 상기 제1복제코드와 상기 기저대신호의 상관값을 결정하기 위한 제1상관기 ;
    상기 제2복제코드 발생기에서부터 공급된 상기 제2복제코드와 상기 기저대신호의 상관값을 결정하기 위한 제2상관기 ;
    상기 제1상관기의 출력신호의 동기검출을 통해 제1심볼신호를 출력시키기 위한 제1동기검출기 ;
    상기 제2상관기의 출력신호의 동기검출을 통해 제2심볼신호를 출력시키기 위한 제2동기검출기 ;
    상기 타이밍 제어회로에서부터 공급된 상기 타이밍펄스에 응해 상기 제1동기검출기에서부터 출력된 상기 제1심볼신호를 래칭시키고 또한 상기 타이밍 제어회로에서부터 출력된 상기 제1 지연시간 지시신호에 의해 지시된 지연시간으로 래치될 때 상기 제1심볼신호를 출력시키기 위한 제1타이밍 조정버퍼 ;
    상기 타이밍 제어회로에서부터 공급된 상기 타이밍펄스에 응해 상기 제2동기검출기에서부터 출력된 상기 제2심볼신호를 래칭시키고 또한 상기 타이밍 제어회로에서부터 출력된 상기 제2지연시간 지시신호에 의해 지시된 지연시간으로 래치될 때 상기 제2심볼신호를 출력시키기 위한 제2타이밍 조정버퍼 ; 및
    상기 제1타이밍 조정버퍼와 상기 제2타이밍 조정버퍼로부터의 출력신호를 합성시키기 위한 RAKE결합회로를 포함하는 것이 특징인, 코드분한 다중 액세스 통신시스템용 확산스펙트럼 수신기.
  2. 제1항에 있어서, 상기 제1 및 제2지연시간 지시신호들은 상기 제1 및 제2타이밍 조정버퍼에 대한 지연시간을 칩주기 단위로 지시하는 것이 특징인 수신기.
  3. 제2항에 있어서, 상기 제1타이밍 조정버퍼는 :
    상기 제1동기검출기와 상기 RAKE결합회로 사이에 설치된 다수 단의 제1래치회로 ; 및
    상기 다수 단의 제1래치회로의 출력단과 상기 RAKE결합회로 사이에 설치되어, 상기 제1지연시간 지시신호의 제어하에서 턴 온/오프되는 다수의 제1스위치를 포함하고 ;
    상기 제2타이밍 조정버퍼는 :
    상기 제2동기검출기와 상기 RAKE결합회로 사이에 설치된 다수 단의 제2래치회로 ; 및
    상기 다수 단의 제2래치회로의 출력단과 상기 RAKE결합회로 사이에 설치되어, 상기 제2지연시간 지시신호의 제어하에서 턴 온/오프되는 다수의 제2스위치를 포함하는 것이 특징인 수신기.
  4. 제2항에 있어서, 상기 타이밍 제어회로는 한 심볼주기 보다 긴 코드를 사용하여 구해진 지연 프로파일을 토대로 상기 제1 및 제2지연시간 지시신호를 발생시키는 것이 특징인 수신기.
  5. 제1항에 있어서, 상기 타이밍펄스는 심볼주기와 동일한 주기를 가지고, 또한
    상기 제1 및 제2지연시간 지시신호는 상기 제1 및 제2타이밍 조정버퍼에 대한 지연시간을 심볼주기 단위로 지시하는 것이 특징인 수신기.
  6. 제5항에 있어서, 상기 제1타이밍 조정버퍼는 :
    상기 제1동기검출기와 상기 RAKE결합회로 사이에 설치된 다수 단의 제1래치회로 ; 및
    상기 다수 단의 제1래치회로의 출력단과 상기 RAKE결합회로 사이에 설치되고, 또한 상기 제1지연시간 지시신호의 제어하에서 턴 온/오프되는 다수의 제1스위치를 포함하고,
    상기 제2타이밍 조정버퍼는 :
    상기 제2동기검출기와 상기 RAKE결합회로 사이에 설치된 다수 단의 제2래치회로 ; 및
    상기 다수 단의 제2래치회로의 출력단과 상기 RAKE결합회로 사이에 설치되고, 또한 상기 제2지연시간 지시신호의 제어하에서 턴 온/오프되는 다수의 제2스위치를 포함하는 것이 특징인 수신기.
  7. 제5항에 있어서, 상기 타이밍 제어회로는 한 심볼주기보다 긴 코드를 사용하여 구하여진 지연 프로파일을 토대로 상기 제1 및 제2지연시간 지시신호를 발생시키는 것이 특징인 수신기.
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