JP3360844B2 - ディジタル画像信号の伝送装置およびフレーム化方法 - Google Patents

ディジタル画像信号の伝送装置およびフレーム化方法

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Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】この発明は、高能率符号化として
例えばＤＣＴを使用するディジタル画像信号の伝送装置
およびフレーム化方法に関する。
【０００２】
【従来の技術】ディジタルビデオ信号を例えば回転ヘッ
ドにより磁気テープに記録するディジタルＶＴＲが知ら
れている。ディジタルビデオ信号の情報量が多いので、
その伝送データ量を圧縮するための高能率符号化が採用
されることが多い。種々の高能率符号化の中でも、ＤＣ
Ｔ（Discrete Cosine Transform)の実用化が進んでい
る。
【０００３】ＤＣＴは、１フレームの画像を例えば（８
×８）のブロック構造に変換し、このブロックを直交変
換の一種であるコサイン変換処理するものである。その
結果、（８×８）の係数データが発生する。このような
係数データは、ランレングス符号、ハフマン符号等の可
変長符号化の処理を受けてから伝送される。伝送時に
は、再生側でのデータ処理を容易とするために、符号化
出力であるコード信号を一定長のシンクブロックのデー
タエリア内に挿入し、コード信号に対して同期信号、Ｉ
Ｄ信号が付加されたシンクブロックを構成するフレーム
化がなされる。
【０００４】磁気テープを使用するディジタルＶＴＲ、
ディスク状記録媒体を使用するディスク記録装置等で
は、１フィールドあるいは１フレームのビデオデータが
複数個のトラックに記録されるのが普通である。しかし
ながら、上述のＤＣＴのように、可変長出力が形成され
る時には、これらの所定期間のデータ量が変動する。こ
のため、所定期間のデータ量を目標値以下とするための
バッファリング処理が必要とされる。
【０００５】一例として、１フィールドあるいは１フレ
ームより短い所定期間（バッファリング単位と称する）
のデータ量を制御し、１フィールドあるいは１フレーム
期間の全体でも、結果的にデータ量を目標値以下とする
バッファリング処理が提案されている。バッファリング
処理は、ＤＣＴで発生した交流分の係数データを適切な
量子化ステップで再量子化して、伝送データ量を目標値
以下に抑える処理である。伝送データ内には、量子化ス
テップあるいはこれを示す量子化番号のコードが符号化
データとともに、挿入される。
【０００６】可変長符号化出力では、エラーが発生する
と、それ以降のコード信号の区切りが分からなくなり、
可変長符号の復号ができなくなる問題、すなわち、エラ
ー伝搬の問題が生じる。エラー伝搬に比較的強いデータ
構成として、図１９Ａに示すものが考えられている。
【０００７】図１９Ａは、バイト幅の１シンクブロック
のデータ構成を示し、先頭から同期信号、ＩＤ信号が順
次位置し、そのデータエリア内には、量子化番号ＱＮＯ
が最初に位置し、次にコード信号が位置している。この
コード信号の中で、直流分ＤＣ（９ビット固定長）がシ
ンクブロック内で一定の間隔で挿入される。図１９Ａに
おいて、Ｙ０、Ｙ１、Ｙ２、・・・は、（Ｙ：Ｕ：Ｖ＝
４：１：１）のコンポーネント信号中の輝度信号Ｙのコ
ード信号のエリアを表し、Ｃ０、・・・は、色差信号Ｃ
のコード信号のエリアを表す。
【０００８】直流分ＤＣは、固定長であるが、交流分の
コード信号は、可変長であり、各ＤＣＴブロックに対応
するもののデータ量は、等しいと限らない。従って、図
１９Ｂにその一例を示すように、与えられたエリア内に
交流分のコードＣＣ０、ＣＣ１、・・・を前から詰め、
そのエリアからはみ出したコードは、他のエリアに生じ
た斜線で示す空きエリアに詰められる。図１９Ｂの例で
は、Ｙ０、Ｙ１、Ｙ３、Ｃ０のエリアには、空きエリア
が生じており、一方、Ｙ２、Ｙｎのエリアは、コード信
号を詰めるのに不足している。Ｙ２、Ｙｎのエリアから
はみ出したコード信号は、上述の空きエリアに順に前か
ら詰め込まれる。なお、ＥＯＢは、そのＤＣＴブロック
のコード信号の終わりを示すコードである。
【０００９】ＤＣＴ変換で発生した係数データは、直流
分を先頭に交流分の低域のものからジグザク走査で出力
される。従って、交流分のコード信号で、上述のよう
に、割当てエリアからはみ出すのは、比較的、高域のも
のである。この意味で、空きエリアを可変ＡＣ−Ｈエリ
アと称し、高域分のコード信号をＡＣ−Ｈと称する。交
流分の比較的低域のコード信号をＡＣ−Ｌ、これが配置
されるエリアをＡＣ−Ｌエリアと称する。
【００１０】図１９Ｂの例で、エリアＹ０には、エリア
Ｙ２からはみ出したＡＣ−Ｈが詰められる。しかしなが
ら、図１９Ｂに示すコード信号のデータ量は、一例であ
って、絵柄によっては、エリアＹ０の可変ＡＣ−Ｈエリ
アの長さも変化し、０となる場合もありうる。然も、こ
のＹ０の可変ＡＣ−Ｈエリア内に詰められたＡＣ−Ｈが
エリアＹ２からはみ出したものとは、限らない。
【００１１】
【発明が解決しようとする課題】このように、直流分お
よびＡＣ−Ｌが規則的に配置されているので、これらが
エラー伝搬によって、エラーとなることを防止できる。
しかしながら、ＡＣ−Ｈは、以下に述べるように、エラ
ー伝搬に弱い問題があり、直流分とＡＣ−Ｌが再生でき
たとしても、再生画像がモザイク状となる問題がある。
【００１２】図１９Ｃに示すように、エリアＹ０のＡＣ
−Ｌエリアの可変長コードＣＣ１の位置にエラーが発生
すると、このＡＣ−Ｌエリアに存在しているＥＯＢを検
出することができない。従って、エリアＹ０内の可変Ａ
Ｃ−Ｈエリアの場所が規定することができない。その結
果、図１９Ｃに示すように、１シンクブロックの斜線で
示す可変ＡＣ−Ｈエリアの全体にわたる伝搬エラーが発
生し、このシンクブロック内の全てのＡＣ−Ｈのコード
がエラーとなる。また、図１９Ｄに示すように、Ｙ１の
可変ＡＣ−Ｈエリア内でエラーが発生した時でも、同様
に、それ以降の可変ＡＣ−Ｈエリアに伝搬エラーが発生
する。
【００１３】また、図１９のフォーマットでは、可変Ａ
Ｃ−ＨエリアにどこのＹあるいはＣのＡＣ−Ｈ成分が詰
められているのかが規定されてないので、記録時より速
いテープ速度で再生を行う変速再生時には、可変ＡＣ−
Ｈエリアのコード信号を利用できず、再生画像の画質が
モザイク状になる問題が生じる。変速再生時には、シン
クブロックの単位で、再生データを有効データとして扱
い、連続するシンクブロックが有効データとして得られ
るとは、限らないからである。
【００１４】さらに、コンポーネント信号（Ｙ、Ｕ、
Ｖ）をＤＣＴ符号化する時に、マクロブロックと称され
る単位を導入している。（４：１：１）の方式では、図
２０Ａに示すように、横方向に連続する４個のＤＣＴブ
ロック（ＹＹＹＹ）と、これらと空間的に同一位置の２
個のＤＣＴブロックＵ、Ｖとによって、マクロブロック
が構成される。（４：２：０）の方式では、図２０Ｂに
示すように、（２×２）の４個のＤＣＴブロック（ＹＹ
ＹＹ）と、これらと空間的に同一位置の２個のＤＣＴブ
ロックＵ、Ｖとによって、マクロブロックが構成され
る。
【００１５】これらの時間系列は、図２０Ｃに示すもの
であり、太い実線で区切られたデータが上述のマクロブ
ロックを構成する。コンポーネント方式のディジタルＶ
ＴＲにおいて、再生画像のデータとして利用できるの
は、マクロブロック単位で再生されたものである。従っ
て、図２０Ｄに枠で囲んで概念的に示すように、それぞ
れが異なるマクロブロックに含まれる色差データＵ、Ｖ
と輝度データＹとを再生できても、再生画像を構成でき
ない。
【００１６】図１９Ａに示す従来のシンクブロックの構
成では、１シンクブロック内に含まれるコード信号とマ
クロブロックとの関係が規定されていないために、１シ
ンクブロックのコード信号を全て再生できても、マクロ
ブロック単位で見ると、必ずしも全てが有効なデータと
して扱うことができない。このことは、シンクブロック
単位で再生データを取り出す変速再生時に問題となる。
【００１７】従って、この発明の目的は、変速再生時
に、なるべくマクロブロック単位でコンポーネントデー
タを再生可能なディジタル画像信号の伝送装置を提供す
ることにある。
【００１８】この発明の他の目的は、伝搬エラーを最小
限にくいとめることができるディジタル画像信号の伝送
装置を提供することにある。
【００１９】この発明のさらに他の目的は、符号化出力
中の直流成分、交流成分の低域成分のみならず、高域成
分をも可能な限り再現し、再生画像中のモザイク部を最
小とするディジタル画像信号の伝送装置を提供すること
にある。
【００２０】この発明のよりさらに他の目的は、所定期
間のデータ量を一定とするバッファリングを行う時に、
バッファリング単位内のエラーの影響が少ない位置に画
面の中央部のマクロブロックを配することによって、エ
ラーの影響が低減されたディジタル画像信号の伝送装置
を提供することにある。
【００２１】
【課題を解決するための手段】請求項１の発明は、ディ
ジタル画像信号を直交変換および可変長符号により符号
化し、符号化出力を伝送するようにしたディジタル画像
信号の伝送装置において、その各々がディジタル画像信
号の複数のコンポーネント（ＹＹＹＹＵＶ）を含むマク
ロブロックの複数個を単位として、符号化出力のデータ
量を所定値以下に制御するためのバッファリング回路
と、バッファリング回路からの符号化出力であって、略
１個のマクロブロックに対応するものが一定長のシンク
ブロックのデータエリア内に配され、データエリア内に
マクロブロックの各直交変換ブロックの直流分ＤＣが分
散して決められたエリアに配置され、直流分ＤＣの直ぐ
後に同一の直交変換ブロックの交流成分の低域成分ＡＣ
−Ｌがそれぞれ配置されるエリアが設けられたデータ構
成を形成するための回路とからなることを特徴とするデ
ィジタル画像信号の伝送装置である。
【００２２】請求項２の発明は、ディジタル画像信号を
直交変換および可変長符号により符号化し、符号化出力
を伝送するようにしたディジタル画像信号の伝送装置に
おいて、その各々がディジタル画像信号の複数のコンポ
ーネント（ＹＹＹＹＵＶ）を含むマクロブロックの複数
個を単位として、符号化出力のデータ量を所定値以下に
制御するためのバッファリング回路と、バッファリング
回路からの符号化出力であって、略１個のマクロブロッ
クに対応するものが一定長のシンクブロックのデータエ
リア内に配され、データエリア内にマクロブロックの各
直交変換ブロックの直流分ＤＣが分散して決められたエ
リアに配置され、直流分ＤＣの直ぐ後に同一の直交変換
ブロックの交流成分の低域成分ＡＣ−Ｌがそれぞれ配置
されるエリアが設けられ、データエリア内の一端付近に
符号化出力の交流分の高域成分ＡＣ−Ｈを挿入するため
の固定長のエリアを有するデータ構成を形成するための
回路とからなることを特徴とするディジタル画像信号の
伝送装置である。
【００２３】
【００２４】請求項３の発明は、ディジタル画像信号を
直交変換および可変長符号により符号化し、その各々が
ディジタル画像信号の複数のコンポーネントを含むマク
ロブロックの複数個を単位として、符号化出力のデータ
量を所定値以下に制御するためのバッファリング手段
と、略１個のマクロブロックに対応するものが一定長の
シンクブロックのデータエリア内に配され、データエリ
ア内にマクロブロックの各直交変換ブロックの直流分Ｄ
Ｃが分散して決められたエリアに配置され、直流分ＤＣ
の直ぐ後に同一の直交変換ブロックの交流成分の低域成
分ＡＣ−Ｌがそれぞれ配置されるエリアが設けられ、デ
ータエリア内の一端付近に符号化出力の交流分の高域成
分ＡＣ−Ｈを挿入するための固定長のエリアを有するデ
ータ構成を形成するための手段とを有するディジタル画
像信号の伝送装置におけるフレーム化方法であって、符
号化出力の交流成分を直交変換ブロック毎に低域成分Ａ
Ｃ−Ｌのエリアに詰め込み、はみ出した成分を記憶する
第１のステップと、対応するシンクブロック内の高域成
分ＡＣ−Ｈの固定長のエリアおよび低域成分ＡＣ−Ｌの
エリアに生じた空きエリアに、第１のステップで発生し
たはみ出した成分を所定の順序で詰め込み、はみ出した
成分を記憶する第２のステップと、バッファリング手段
の処理単位内の他のシンクブロック内に残っている空き
エリアに、第２のステップで発生したはみ出した成分を
順に詰め込む第３のステップとからなることを特徴とす
るディジタル画像信号の伝送装置におけるフレーム化方
法である。
【００２５】
【作用】１マクロブロック（６ＤＣＴブロック）のコー
ド信号が１シンクブロック内に配置されるので、マクロ
ブロック単位で再生データを得ることができる。固定長
の高域成分ＡＣ−Ｈエリアが先頭付近に設けられている
ので、ＡＣ−Ｈ成分が他のシンクブロックにまたがるお
それを低減できる。高域成分ＡＣ−Ｈのエリアが分散し
ているので、ＡＣ−Ｈのエラー伝搬距離を短くできる。
シャフリングされた複数のマクロブロックを複数のシン
クブロック内に配するときに、他のシンクブロックのエ
ラーの影響が最小の先頭のシンクブロックに画面の中央
部のマクロブロックを配することによって、エラーの影
響を少なくできる。ＡＣ−Ｌのエリアからはみ出した成
分を順に前から詰めることによって、ＡＣ−Ｈがアドレ
ス情報を持つことができる。
【００２６】
【実施例】以下、この発明の一実施例について図面を参
照して説明する。図１は、ディジタルＶＴＲの記録側に
設けられるビデオデータの処理回路の構成を示す。図１
において、１で示す入力端子には、ディジタル化された
ビデオデータが供給される。このビデオデータがブロッ
ク化回路２に供給される。ブロック化回路２では、ラス
ター走査の順序のビデオデータが図２Ａに例示のような
（８×８）のＤＣＴブロックの構造のデータに変換され
る。
【００２７】ブロック化回路２の出力がシャフリング回
路３に供給される。シャフリング回路３では、エラーが
集中し、画質の劣化が目立つのを防止するように、例え
ば１フレーム内で、１あるいは複数のマクロブロックを
単位として、空間的な位置を元のものと異ならせる処
理、すなわち、シャフリングがなされる。この例では、
シャフリング単位とバッファリング単位とを等しくして
いる。シャフリング回路３の出力がＤＣＴ（コサイン変
換）回路４に供給される。ＤＣＴ回路４からは、図２Ｂ
に示すように、直流分ＤＣ、交流分ＡＣ１〜ＡＣ６３の
係数データが発生する。
【００２８】マクロブロックは、ＤＣＴブロック当りの
（８×８）の係数データを複数ブロック集めたものであ
る。例えばコンポーネント方式の（Ｙ：Ｕ：Ｖ＝４：
１：１）のビデオデータの場合には、１フレーム内の同
一位置の、４個のＹブロックと１個のＵブロックと１個
のＶブロックとの計６ブロックが１マクロブロックを構
成する。ＮＴＳＣシステムのような５２５／６０システ
ムの例では、サンプリング周波数が４ｆsc（ｆsc：カラ
ーサブキャリア周波数）の場合では、１フレームの画像
が（９１０サンプル×５２５ライン）であり、その内の
有効データが（７２０サンプル×４８０ライン）とされ
る。上述のコンポーネント方式の場合には、１フレーム
の全ブロック数は、（７２０×６／４）×４８０÷（８
×８）＝８１００として求められる。従って、８１００
÷６＝１３５０が１フレーム内のマクロブロックの個数
である。
【００２９】図３が１フレーム内のマクロブロックの
（３０×４５）の２次元配列を示す。各マクロブロック
は、ＭＢ〔ｉ，ｊ〕で特定される。（ｉ＝０，１，２，
・・・２９，ｊ＝０，１，２，・・・４４）である。Ｐ
ＡＬシステムのような６２５／５０システムの例では、
（３６×４５）の２次元配列となる。従って、（ｉ＝
０，１，２，・・・３５，ｊ＝０，１，２，・・・４
４）である。シャフリング回路３は、１フレーム内でマ
クロブロックを単位とするシャフリングを行う。
【００３０】図４は、このシャフリングの一例である。
２次元配列が水平方向に９マクロブロックの間隔で等分
割され、３個のサブエリアが形成される。各サブエリア
から下記の規則で従って収集された５個のマクロブロッ
クによって、１バッファリングユニットＢＵ〔ｍ，ｎ〕
が形成される。図４は、５２５／６０システムにおける
ＢＵ〔０，０〕を構成する５マクロブロックを示す。
【００３１】 ５２５／６０システム（ｍ＝０〜２９，ｎ＝０〜８） ＢＵ〔ｍ，ｎ〕＝ＭＢ〔（ｍ）mod.30，ｎ〕 ＭＢ〔（ｍ＋１８）mod.30，ｎ＋９〕 ＭＢ〔（ｍ＋６）mod.30，ｎ＋１８〕 ＭＢ〔（ｍ＋２４）mod.30，ｎ＋２７〕 ＭＢ〔（ｍ＋１２）mod.30，ｎ＋３６〕
【００３２】 ６２５／５０システム（ｍ＝０〜３５，ｎ＝０〜８） ＢＵ〔ｍ，ｎ〕＝ＭＢ〔（ｍ）mod.36，ｎ〕 ＭＢ〔（ｍ＋２１）mod.36，ｎ＋９〕 ＭＢ〔（ｍ＋６）mod.36，ｎ＋１８〕 ＭＢ〔（ｍ＋２７）mod.36，ｎ＋２７〕 ＭＢ〔（ｍ＋１２）mod.36，ｎ＋３６〕
【００３３】ＤＣＴ回路４で発生した（８×８）の係数
データの内の直流分ＤＣがパッキング回路１０に供給さ
れ、その内の６３個の交流分ＡＣ１〜ＡＣ６３が遅延回
路５を介して量子化回路６に供給される。交流分の係数
データは、図２Ｂに示すように、ジグザク走査の順で次
数が低い交流分からこれが高いものに向かって順に伝送
される。また、この交流分の係数データが見積り器７お
よびアクティビィティ検出回路８にも供給される。遅延
回路５は、見積り器７で適切な量子化番号ＱＮＯが決定
されるのに必要な時間と対応する遅延量を有している。
見積り器７からの量子化番号ＱＮＯは、量子化回路６、
パッキング回路１０に供給される。
【００３４】量子化回路６では、係数データ内の交流分
ＡＣ１〜ＡＣ６３が再量子化される。すなわち、適切な
量子化ステップで交流分の係数データが割算され、その
商が整数化される。この量子化ステップが見積り器７か
らの量子化番号ＱＮＯによって決定される。ディジタル
ＶＴＲの場合では、編集等の処理が１フィールドあるい
は１フレーム単位でなされるので、１フィールドあるい
は１フレーム当りの発生データ量が目標値以下となる必
要がある。ＤＣＴおよび可変長符号化で発生するデータ
量は、符号化の対象の絵柄によって変化するので、１フ
ィールドあるいは１フレーム期間より短いバッファリン
グ単位の発生データ量を目標値以下とするためのバッフ
ァリング処理がなされる。バッファリング単位を短くす
るのは、バッファリングのためのメモリ容量を低減する
など、バッファリング回路の簡略化のためである。この
例では、５マクロブロックがバッファリング単位とされ
ている。
【００３５】また、アクティビィティ検出回路８は、後
述のように、ＤＣＴブロック毎に交流成分の量を調べ、
そのＤＣＴブロックのアクティビィティを示す２ビット
のアクティビィティコードＡＴを発生する。アクティビ
ィティは、絵柄の細かさを意味している。絵柄が細かい
時には、粗い量子化を行っても、それによる画像の劣化
が目立たないことを利用している。アクティビィティコ
ードＡＴは、見積り器７およびパッキング回路１０に供
給される。
【００３６】量子化回路６の出力が可変長符号化回路９
に供給され、ランレングス符号化、ハフマン符号化等が
なされる。例えばコードの係数データの“０”の連続数
であるゼロランと、係数データの値とをＲＯＭ内に格納
されたハフマンテーブルに与え、可変長コード（符号化
出力）を発生する２次元ハフマン符号化が採用される。
可変長符号化回路９からのコード信号がパッキング回路
１０に供給される。パッキング回路１０は、コード信号
をバイト幅のデータに変換する。パッキング回路１０の
出力がフレーム化回路１１に供給される。フレーム化回
路１０は、後述の規則に従ってコード信号およびアクテ
ィビィティコードＡＴが配されたデータを形成する。
【００３７】フレーム化回路１１では、パッキング回路
１０の出力に対して、さらに同期信号、量子化番号ＱＮ
Ｏ、ＩＤ信号、補助コードＡＵＸを付加する。そして、
フレーム化回路１１からは、シンクブロック構成のデー
タが現れる。このフレーム化回路１１の出力がパリティ
発生回路１２に供給され、エラー訂正符号の符号化がな
される。
【００３８】エラー訂正符号として、積符号が使用さ
れ、その水平方向および垂直方向のデータに対して、リ
ード・ソロモン符号の符号化がそれぞれなされる。水平
方向のエラー訂正符号が内符号と称され、垂直方向のエ
ラー訂正符号が外符号と称される。内符号は、１シンク
ブロックのデータエリアに含まれるデータに対してなさ
れ、水平パリティＰＴが生成される。垂直パリティのみ
を含むシンクブロックもありうる。変速再生時では、シ
ンクブロックとして切り出されたデータが有効として扱
われ、内符号を使用したエラー訂正がなされる。
【００３９】パリティ発生回路１２の出力が出力端子１
３に取り出される。図示しないが、この記録データは、
チャンネル符号化回路、記録アンプを介して２個の回転
ヘッドに供給され、磁気テープ上に記録される。
【００４０】見積り器７は、バッファリング単位（５マ
クロブロック）の発生データ量を目標値以下とすること
ができ、且つなるべく小さい値の量子化ステップを決定
する。さらに、アクティビィティコードＡＴを参照し
て、ＤＣＴブロック毎に適切な量子化ステップを決定す
る。図５は、見積り器７の一例を示す。ｎ個の量子化回
路２０1 、２０2 、・・・、２０n に対して、ＤＣＴ回
路４からの係数データが供給される。これらの量子化回
路２０1 〜２０n には、量子化ステップ発生回路２１か
ら互いに異なる量子化ステップΔ１、Δ２、・・・、Δ
ｎがそれぞれ供給される。アクティビィティコードＡＴ
は、量子化ステップ発生回路２１に供給される。
【００４１】各量子化ステップで割算され、整数化され
た出力が可変長符号化回路２２1 〜２２n にそれぞれ供
給される。これらの可変長符号化回路２２1 〜２２
n は、実際に可変長コードを発生する可変長符号化回路
９と異なり、可変長符号化出力のコード長のデータを発
生する。このコード長のデータが累算回路２３1 〜２３
nにそれぞれ供給される。累算回路２３1 〜２３n に
は、端子２４からリセットパルスが供給される。累算回
路２３1 〜２３n は、バッファリング単位で発生したコ
ード信号の量を求めるもので、この例では、５マクロブ
ロック毎にリセットパルスが発生する。累算回路２３1
〜２３n の累算出力が判定回路２５に供給される。
【００４２】判定回路２５には、端子２６からの目標値
Ａｍが供給される。累算回路２３1〜２３n の出力と目
標値Ａｍとが比較され、目標値Ａｍを超えない範囲で最
も目標値Ａｍと近い量子化ステップが判定される。この
判定出力により量子化番号ＱＮＯが決定され、出力端子
２８に取り出される。この量子化番号ＱＮＯが量子化回
路６に供給される。量子化回路６には、量子化番号を量
子化ステップに変換するＲＯＭが備えられている。
【００４３】見積り器７としては、図５に示す構成に限
られず、異なる量子化ステップで順次量子化を行う方式
等、種々の構成のものを採用できる。また、全ての次数
の交流分の係数データに対して、共通の量子化ステップ
を適用するのに限らず、その次数に応じた量子化ステッ
プを使用しても良い。つまり、交流分の係数データを次
数に応じて、複数のグループに分割し、量子化ステップ
として、複数のグループのそれぞれに対するものを用意
する。そして、量子化ステップを異ならせる場合、複数
のグループに対する量子化ステップの組を複数個準備
し、複数の量子化ステップの組で量子化を行い、その結
果を参照して最適な量子化ステップが決定される。
【００４４】図６は、アクティビィティ検出回路８の一
例を示す。入力端子３１には、交流分の係数データＡＣ
１〜ＡＣ６３が順に供給され、絶対値化回路３２で絶対
値に変換される。絶対値化回路３２の出力が比較回路３
３に供給され、端子３４からのしきい値Ｔｈ例えば５と
比較される。比較回路３３は、交流分の係数データの絶
対値がしきい値Ｔｈより大きい時に、“１”（ハイレベ
ル）の出力を発生する。比較回路３３の比較出力がカウ
ンタ３５のイネーブル端子に供給される。
【００４５】カウンタ３５には、クロックＣＫが供給さ
れ、そのクリア端子にタイミング信号ＤＣＳＬが供給さ
れる。タイミングＤＣＳＬによって、一つのＤＣＴブロ
ックの直流分ＤＣのタイミングでカウンタ３５がクリア
される。カウンタ３５は、その絶対値がしきい値より大
きい交流分の係数データに応答して、その内容が＋１さ
れる。従って、カウンタ３５の出力の６ビットは、（０
〜６３）の計数値を表す。カウンタ３５の計数値がデコ
ーダ３６に供給される。デコーダ３６は、２ビットのア
クティビィティコードＡＴを出力端子３７に発生する。
【００４６】一例として、デコーダ３６は、下記のアク
ティビィティコードＡＴを発生するように、クラス分け
を行う。 計数値が（０〜１０） ：（００） 計数値が（１１〜１８）：（０１） 計数値が（１９〜２５）：（１０） 計数値が（２６〜６３）：（１１）
【００４７】カウンタ３５の計数値は、そのＤＣＴブロ
ックの交流分の量の目安を表す。従って、発生データ量
を制御するためには、ＡＴ＝０１を例えば基準として、
ＡＴ＝００で、交流分が少ない時には、量子化ステップ
を小さくする必要があり、ＡＴ＝１０で、交流分が多い
時には、量子化ステップを大きくする必要があり、さら
に、ＡＴ＝１１で、交流分がより多い時には、量子化ス
テップをより大きくする必要がある。前述の見積り器７
の量子化ステップ発生回路２１は、アクティビィティコ
ードＡＴを受け取って、量子化ステップの調整を行って
いる。このように、量子化ステップを調整するために、
アクティビィティが利用される。
【００４８】この例では、図７に示すように、５シンク
ブロックのデータエリア内に、５マクロブロックのコー
ド信号が配置されるように、バッファリングがなされ
る。言い換えれば、バッファリング単位（５マクロブロ
ック）のデータ量が５個のシンクブロックＳＢ１〜ＳＢ
５のデータエリア内に収まるように制御される。また、
各シンクブロック内に、略整数個例えば略１個のマクロ
ブロックのコード信号が配される。各シンクブロックの
データエリアの具体的な長さは、かかる点を考慮して規
定されている。
【００４９】さらに、磁気テープ上には、２本のトラッ
クが二つの近接して配された回転ヘッドによって同時に
形成され、ＮＴＳＣ方式の場合には、１０本のトラック
Ｔ０〜Ｔ９に１フレームのデータが分割して記録され
る。なお、ＰＣＭオーディオ信号は、エラー訂正符号化
され、ビデオデータと混在して記録されるか、あるいは
１トラック内に設けられたオーディオデータ記録区間に
記録される。
【００５０】１フレームが１３５０個のマクロブロック
であるので、１トラック当りで、１３５マクロブロック
が記録される。バッファリング単位を５マクロブロック
としているので、１トラックには、２７個のバッファリ
ング単位が記録される。上述のように、各ビデオグルー
プのデータ量が目標値Ａｍと等しいか、それよりやや少
ないものに制御されるので、一定の長さの各トラックに
１３５マクロブロックのデータを記録することができ
る。
【００５１】図８は、この一実施例における１シンクブ
ロックのデータ配列を示す。１シンクブロックの長さ
は、例えば９０バイトである。シンクブロックの先頭に
ブロック同期信号ＳＹＮＣ（２バイト）が位置し、その
後に、ＩＤ信号が位置する。このＩＤ信号は、２バイト
のＩＤ信号（ＩＤ０、ＩＤ１）およびＩＤ信号に対する
パリティＩＤＰ（１バイト）からなる。残りの８５バイ
トの内の７７バイトがデータエリアであって、最後の８
バイトが積符号の内符号のパリティである。データエリ
アの先頭に、量子化ステップを識別するための１バイト
の量子化番号ＱＮＯおよび補助コードＡＵＸが位置す
る。その後の７５バイトがデータ（可変長コードあるい
は外符号化のパリティ）である。
【００５２】１シンクブロックには、１マクロブロック
（ＹＹＹＹ、Ｕ、Ｖ）に関するコード信号および各ＤＣ
Ｔブロックに関してのアクティビィティコードＡＴおよ
び動きフラグＭが挿入される。動きフラグＭは、ＤＣＴ
ブロック毎に検出された動きの有無を示す１ビットのフ
ラグである。図１では、簡単のため、動き検出回路は、
省略されている。ＤＣＴブロックを直交変換する時に、
動きがないものは、フレーム内ＤＣＴを行い、動きがあ
るものは、フィールド内ＤＣＴを行うために、動きフラ
グＭが利用される。
【００５３】７５バイトのエリアがそれぞれがｄ（例え
ば１８バイト）の長さの４個のエリアと、端数の先頭の
エリアとに分割される。このｄ毎に、１マクロブロック
の４個のＤＣＴブロックで発生した直流成分（９ビッ
ト）を配置し、その後に、動きフラグＭおよびアクティ
ビィティコードＡＴを配置する。ｄの長さの各エリアが
ａ（例えば１２バイト）およびｄ／２（６バイト）のエ
リアにそれぞれ分割される。この結果、８個のエリアが
形成される。
【００５４】先頭のエリアが固定のＡＣ−Ｈエリアとさ
れる。直流分を含む次のａの長さのエリアがＹのＡＣ−
Ｌエリアとされ、ａ／２の長さのエリアが固定ＡＣ−Ｈ
エリアとされる。次のｄの長さのエリアには、ＹのＡＣ
−Ｌエリアと、Ｃ（例えばＵ）の直流分、動きフラグ
Ｍ、アクティビィティコードＡＴ、ＡＣ−Ｌのためのエ
リアとが含まれる。さらに、次のｄの長さのエリアがＹ
のＡＣ−Ｌエリア、固定ＡＣ−Ｈエリアとされ、最後の
ｄの長さのエリアがＹのＡＣ−Ｌエリアと、Ｃ（例えば
Ｖ）の直流分、動きフラグＭ、アクティビィティコード
ＡＴ、ＡＣ−Ｌのためのエリアとされる。各ＡＣ−Ｌエ
リアからはみ出したＡＣ−Ｈ成分が先頭のＡＣ−Ｈエリ
アから順に詰め込まれる。ＡＣ−Ｌエリア内に空きエリ
ア、すなわち、可変ＡＣエリアが存在すれば、ここに
も、はみ出したＡＣ−Ｈ成分が詰められる。
【００５５】ＩＤ信号は、フレームＩＤ、フォーマット
識別ビット、記録データの種類を示す２ビット、シンク
ブロックアドレス、パリティバイトＩＤＰを含む。フレ
ームＩＤは、フレーム毎に反転する。識別ビットは、こ
の実施例のディジタルＶＴＲ用のフォーマットとそれ以
外のフォーマット、例えばデータ記憶装置のフォーマッ
トとを識別する。これが“１”の時は、ディジタルＶＴ
Ｒ用のフォーマットを意味し、これが“０”の時は、他
のフォーマットを意味する。記録データ識別ビットは、
記録データの種類（ビデオ、オーディオ等）を表す。さ
らに、シンクブロックアドレスは、１フレームのデータ
を含み、複数本のトラックに分割して記録される全シン
クブロックに対して、通番で付されたアドレスである。
【００５６】さらに、データエリア内の補助コードＡＵ
Ｘも、一種のＩＤ信号であって、ビデオ信号の放送形
式、オーディオのモード等の情報が有している。データ
エリア内に量子化番号ＱＮＯ、補助コードＡＵＸを記録
しているのは、ＩＤ信号のエラー訂正符号よりも、デー
タエリア内のデータに関するエラー訂正符号の方がより
訂正能力が高いからである。
【００５７】図８Ｂは、この発明の規則性を有するシン
クブロックの他の例を示す。すなわち、１マクロブロッ
クを構成する６個のＤＣＴブロックのコード信号のエリ
アと二つのＡＣ−Ｈエリアとの８個のエリアをｄ´の間
隔で設けたものである。従って、この例では、１シンク
ブロックのデータエリアが８ｄ´＋２バイトである。先
頭に、ＡＣ−Ｈエリアの一つが位置し、各ＤＣＴブロッ
クの直流分が規則的に配されるのは、図６Ａの例と同様
である。一般的に、ＹのＤＣＴブロックで発生するコー
ド信号の量は、Ｃのそれで発生するものより少ないの
で、図８Ａの構成では、ＹのエリアをＣのエリアの２倍
の大きさとしている。
【００５８】図９は、より具体的なこの発明によるデー
タ構成を示す。図９では、１バッファリング単位を構成
する５マクロブロックが配置された５シンクブロックＳ
Ｂ１〜ＳＢ５を縦に重ねて示している。図９の配置は、
図８Ａと類似している。すなわち、図８Ａとの関係で
は、（ｄ＝１８、ａ＝１２）としたものである。但し、
図８Ａに示されるものとの間には、ＡＣ−Ｈエリアが最
後のパリティの前に配置されていること、並びに圧縮符
号化されたディジタルオーディオ信号の記録エリアがＩ
Ｄエリアの後に設けられいてることが相違している。
【００５９】上述の図８Ａ、図８Ｂおよび図９のデータ
構成は、以下の点で改良されている。第１に、１シンク
ブロック内に、略１マクロブロックのコード信号が存在
するので、変速再生時のように、１シンクブロックの単
位で再生されたデータを有効に利用できる。第２に、Ａ
Ｃ−Ｈエリアとして、固定のエリアが設けられ、然も、
これらが分散されているので、ＡＣ−Ｈ成分が伝搬エラ
ーでエラーとなる割合を低減できる。第３に、図８Ａお
よび図８Ｂの構成では、固定のＡＣ−Ｈエリアが最初の
直流分より前に設けられている。従って、そのシンクブ
ロックからはみ出したＡＣ−Ｈ成分が前の方に詰められ
ることになり、他のシンクブロックにまたがる可能性を
低くすることができる。第４に、そのシンクブロックか
らはみ出したＡＣ−Ｈ成分を固定ＡＣ−Ｈエリアの先頭
から詰めているので、ＡＣ−Ｈ成分がアドレス情報を持
つことになる。その結果、前のシンクブロックにエラー
があっても、次のシンクブロックでリフレッシュでき
る。
【００６０】さらに、１マクロブロックのコード信号を
１シンクブロック内に配置する方法として、図８Ｃに示
すものも可能である。これは、上述の第１の利点を有す
るが、図８Ａと比較して、ＡＣ−Ｈエリアが二つに分け
られていないこと、ＡＣ−Ｈエリアが最後にまとめて位
置している。その結果、上述の第２、第３および第４の
利点を得ることができない問題がある。
【００６１】図８Ａのデータ構成を生成するためのフレ
ーム化回路１１の一例を図１０に示す。図１０では、フ
レーム化回路１１の前段のパッキング回路１０も示され
ている。パッキング回路１０には、可変長符号化回路９
からのＡＣ成分のコード信号と、可変長コード符号化回
路４１からのコード信号の長さ情報と、直流成分の係数
データと、アクティビィティコードＡＴとが供給され
る。パッキング回路１０からは、バイト幅に変換された
コード信号が入力セレクタ４４に供給される。４２は、
ＡＣ成分のコード信号のブロック毎の区切りに挿入され
たＥＯＢの検出回路である。検出回路４２の出力信号が
ＲＡＭの読み出し／書き込みコントローラ４３に供給さ
れる。
【００６２】入力セレクタ４４は、５個の出力端子ａ、
ｂ、ｃ、ｄ、ｅを有し、これらに対してＲＡＭ、ＦＩＦ
Ｏ、コントローラ４５ａ〜４５ｅが接続されている。Ｒ
ＡＭ、ＦＩＦＯ、コントローラ４５ａ〜４５ｅのそれぞ
れは、１バッファリング単位と対応する５個のシンクブ
ロックのデータを形成する。これらのＲＡＭ、ＦＩＦ
Ｏ、コントローラ４５ａ〜４５ｅによって、図８Ａに示
すデータエリアの構成を有するデータが形成され、各デ
ータが出力セレクタ４６の入力端子ａ、ｂ、ｃ、ｄ、ｅ
にそれぞれ供給される。
【００６３】パッキング回路１０、入力セレクタ４４、
ＲＡＭ、ＦＩＦＯ、コントローラ４５ａ〜４５ｅに対す
る制御信号、アドレス信号、あるいはタイミング信号
は、ＲＡＭの読み出し／書き込みコントローラ４３から
与えられる。出力セレクタ４６は、フレーミングコント
ローラ４７からの制御信号で制御される。出力セレクタ
４６の出力が付加回路４８に供給され、コントローラ４
７の制御の下で、同期信号、ＩＤ信号、量子化番号ＱＮ
Ｏ、補助コードＡＵＸが所定の位置に付加される。この
付加回路４８の出力に、図８Ａに示す構成のデータが得
られる。
【００６４】ＲＡＭ、ＦＩＦＯ、コントローラ４５ａ〜
４５ｅは、互いに同一の構成であって、図１０では、Ｒ
ＡＭ、ＦＩＦＯ、コントローラ４５ａの構成が示されて
いる。これは、セレクタ５１、ＲＡＭ５２、ＦＩＦＯ５
３、データ合成回路５４、バレルシフタ５５、およびＦ
ＩＦＯ、バレルシフタコントローラ５６を含む。
【００６５】セレクタ５１によって、各ＤＣＴブロック
で発生した交流分のコード信号を対応するＡＣ−Ｌエリ
アに詰める時には、出力端子ｆを通じてコード信号がＲ
ＡＭ５２に書き込み、そこに収まらないコード信号が出
力端子ｇを通じてＦＩＦＯ５３に供給される。ＲＡＭ５
２は、７５バイトのデータ記憶用の容量と、フラグＷ
Ｆ、ＲＢ用の容量とを有している。フラグＷＦは、各バ
イトに関して書き込み済みか、あるいは未書き込みかを
示す書き込みフラグであり、（１ビット×７５）のデー
タである。（ＷＦ＝０）であれば、未書き込みを示し、
（ＷＦ＝１）であれば、書き込み済みを示す。フラグＲ
Ｂは、各バイトに関して、未書き込みのビット数（１〜
８）を示す残りビットフラグであり、（３ビット×７
５）のデータである。
【００６６】ＦＩＦＯ５３の容量は、ＡＣ−Ｌエリアの
大きさ等と関連するが、通常の画像に関して、ＡＣ−Ｌ
エリアからはみ出したコード信号を格納できる程度のも
の例えば２４バイトに選定されている。このＦＩＦＯ５
３には、データ記憶用と別にフラグＥＦが記憶される。
フラグＥＦは、ＦＩＦＯ５３内の書き込みデータがある
か、これが空であるかを示すもので、１ビットのもので
ある。（ＥＦ＝０）であれば、書き込みデータがあるこ
とを示し、（ＥＦ＝１）であれば、ＦＩＦＯが空である
ことを示す。
【００６７】コントローラ５６には、上述のフラグＷ
Ｆ、ＲＢ、ＥＦが供給され、ＲＡＭ５２の空きエリアに
ＦＩＦＯ５３に貯えられているコード信号を詰め込むた
めの制御がコントローラ５６によってなされる。具体的
には、バレルシフタ５５のビットずらしの動作をコント
ローラ５６が制御し、バレルシフタ５５の出力がデータ
合成回路５４において、ＲＡＭ５２の読み出しデータに
対して合成される。このデータ合成回路５４の出力デー
タがＲＡＭ５２の同一のアドレスに書き込まれる。すな
わち、ＲＡＭ５２は、リードアフタライトの動作を行
う。さらに、ＲＡＭ５２の読み出しデータが出力セレク
タ４６の入力端子ａに供給される。
【００６８】ＲＡＭ、ＦＩＦＯ、コントローラ４５ｂ〜
４５ｅは、上述のＲＡＭ、ＦＩＦＯ、コントローラ４５
ａと同一の構成である。フレーム化の処理としては、第
１、第２および第３のステップが存在する。第１のステ
ップは、コード信号を指定されたＡＣ−Ｌエリアに順次
詰め込むことである。第２のステップは、第１のステッ
プで各シンクブロックからはみ出したＡＣ−Ｈ成分をそ
のシンクブロック内の空きエリア（固定ＡＣ−Ｈエリア
および可変ＡＣ−Ｈエリア）に詰め込む処理である。
【００６９】これらの第１および第２のステップの処理
は、シンクブロックが他のシンクブロックへまたがるこ
とがない処理である。しかしながら、第２のステップの
後でも、はみ出したＡＣ−Ｈ成分が存在する時には、こ
れを他のシンクブロックに存在する空きエリアに詰め込
む必要がある。この処理を行うのが第３のステップであ
る。第３のステップを実行するために、ＲＡＭ、ＦＩＦ
Ｏ、コントローラ４５ａ〜４５ｅ間のＦＩＦＯ同士を結
合するバス５７が設けられており、このバス５７を介し
てのデータの授受がコントローラ５６によって制御され
る。
【００７０】上述のフレーム化回路１１の理解のため
に、その動作の一例を図１１および図１２を参照して説
明する。図１１および図１２は、シンクブロックＳＹＮ
Ｃ１〜ＳＹＮＣ５に対応するコントローラ４５ａ〜４５
ｅのＲＡＭ１〜ＲＡＭ５およびＦＩＦＯ１〜ＦＩＦＯ５
の状態を示している。図１１は、第１ステップが終了し
た時の状態を示している。すなわち、パッキング回路１
０からの交流分のコード信号を対応するＡＣ−Ｌエリア
に詰め込んだ状態を示している。図１１のＲＡＭ１〜Ｒ
ＡＭ５の斜線で示すエリアがデータが未書き込みのエリ
アであり、ＦＩＦＯ１〜ＦＩＦＯ５には、各ＡＣ−Ｌエ
リアからはみ出したコード信号が格納されている。
【００７１】例えばＲＡＭ４の先頭のＡＣ−Ｈエリアお
よびＹのＡＣ−Ｌエリアの部分を拡大して示す図１３Ａ
において、斜線で示すように、先頭のＡＣ−Ｈエリア
と、ＹのＡＣ−Ｌエリアの１２バイトの内の第１０バイ
トの５ビット、第１１バイトおよび第１２バイトとが空
きエリアである。従って、第１〜第９バイトでは、（Ｗ
Ｆ＝１、ＲＢ＝０）であり、第１０バイトでは、（ＷＦ
＝１、ＲＢ＝５）であり、第１１および第１２バイトで
は、（ＷＦ＝０、ＲＢ＝８）である。
【００７２】次の第２ステップでは、ＦＩＦＯ内のはみ
出したコード信号がそのシンクブロックのＲＡＭの空き
エリアに先頭のＡＣ−Ｈエリアから詰め込まれる。この
第２ステップの処理がなされた後では、ＲＡＭ１〜ＲＡ
Ｍ５およびＦＩＦＯ１〜ＦＩＦＯ５の内容が図１２に例
示するものとなる。ＳＹＮＣ１、ＳＹＮＣ３の場合で
は、ＦＩＦＯ１、ＦＩＦＯ３のコード信号が空きエリア
に詰め込むことができず、ＦＩＦＯ１、ＦＩＦＯ３にコ
ード信号が残っており、（ＥＦ＝０）である。
【００７３】一方、ＳＹＮＣ２、ＳＹＮＣ４およびＳＹ
ＮＣ５の場合では、ＦＩＦＯ２、ＦＩＦＯ４およびＦＩ
ＦＯ５のコード信号が空きエリアに詰め込むことがで
き、ＦＩＦＯ２、ＦＩＦＯ４およびＦＩＦＯ５にコード
信号が残ってなく、（ＥＦ＝１）である。さらに、これ
らのＳＹＮＣ２、ＳＹＮＣ４およびＳＹＮＣ５に関し
て、ＲＡＭ２、ＲＡＭ４およびＲＡＭ５には、斜線で示
すように、空きエリアが未だ残っている。図１３Ｂに示
すように、第２ステップの処理の後では、先頭のＡＣ−
ＨエリアおよびＹのＡＣ−Ｌエリアの第１０バイトの５
ビットがＦＩＦＯ４からのＡＣ−Ｈ成分で埋められてい
る。
【００７４】第３ステップでは、ＦＩＦＯ１およびＦＩ
ＦＯ３に残っているＡＣ−Ｈ成分が他のＳＹＮＣの空き
エリアに詰め込まれる。例えばＦＩＦＯ１に残っている
ＡＣ−Ｈ成分がＲＡＭ２の斜線で示す可変ＡＣ−Ｈエリ
ア内に詰め込まれる。例えば図１３Ｃに示すように、Ｒ
ＡＭ４のＹの可変ＡＣ−Ｈエリアの第１１バイトの６ビ
ットが他のＦＩＦＯからの可変ＡＣ−Ｈ成分で埋められ
た状態を示す。この第３ステップが終了すると、５シン
クブロックに関してのフレーム化の処理が完了する。
【００７５】図９に示すデータ構成の場合も、第１、第
２および第３のステップによって、順にデータが詰め込
まれる。この処理は、上述と同一である必要はない。変
形された処理を説明すると、第１ステップでは、ＡＣ−
Ｌエリアを一杯とするように、交流分のデータを詰め込
む。この場合、そのＡＣ−Ｌエリア内の残りのエリアが
１６ビットより少ないならば、一杯とする処理を停止す
る。１６ビットは、この例における可変長コードの最大
ビット長であり、一つの可変長コードが二つのエリアに
個別に存在することが避けられる。
【００７６】第２のステップでは、ＡＣ−Ｌエリア内の
空きエリアとＡＣ−Ｈエリアに対して、第１のステップ
でオーバーフローしたデータを詰め込む。この場合、図
１４において、番号を付した順序で各エリアが一杯とさ
れる。図１４では、第１のステップの後の空きエリアが
斜線で示されている。そして、第３のステップは、第２
のステップでオーバーフローしたデータが残りの空きエ
リアに順番に詰め込まれる。
【００７７】以上の実施例では、シャフリングされた後
に、５マクロブロックによって１バッファリングユニッ
トが構成され、この１バッファリングユニットのデータ
が５シンクブロックに配されている。ここで、５シンク
ブロックＳＢ１〜ＳＢ５は、エラーによって受ける影響
が同じではない。この点を考慮した順序で、５マクロブ
ロックを５シンクブロック内に配することも、好まし
い。
【００７８】上述の第１、第２および第３のステップに
よって、５マクロブロックのデータを５シンクブロック
内に詰め込む場合、第３のステップでは、第１および第
２のステップでオーバーフローしたデータを残っている
空きエリアに詰め込まれる。ここで、二つの場合を考え
る。第１の場合は、一つのマクロブロックのデータが１
シンクブロックのデータエリアの長さを超えない場合で
あり、第２の場合は、一つのマクロブロックのデータが
１シンクブロックのデータエリアを超える場合である。
【００７９】第１の場合では、他のシンクブロックで発
生したエラーがそのシンクブロックに対して、何ら影響
しない。第２の場合では、上述の第３のステップによっ
て、他のシンクブロックに配されるので、他のシンクブ
ロックで発生したエラーがそのシンクブロックに対して
影響する。他のシンクブロック内の空いているエリアに
対して、シンクブロックＳＢ１のデータから順番に詰め
込まれる。この詰め込まれたデータは、それより前に配
されたデータにエラーがあると、可変長コードの区切り
が分からなくなり、復号できなくなる。従って、第２の
場合では、シンクブロックＳＢ１〜ＳＢ５の中で、相対
的に後のシンクブロックになるほど、他のシンクブロッ
クの影響が波及することになる。
【００８０】図１５に示すように、１フレームの画面か
らシャフリング処理で取り出された５マクロブロックＭ
Ｂ０〜ＭＢ４が５シンクブロックに配される。この図１
５は、図４と同様であり、５個のマクロブロックの番号
付けを表している。この番号は、画面の分割エリアとの
対応を表している。図１６に示すように、５２５／６０
システムでは、各マクロブロックに含まれるＤＣＴブロ
ックのデータに対して参照符号が付される。６２５／５
０システムにおける各マクロブロックのＤＣＴブロック
のデータに対する参照符号は、図１７に示すものであ
る。
【００８１】図１５から分かるように、０および４の参
照数字が付されたマクロブロックＭＢ０およびＭＢ４
は、１画面の両側のエリアに含まれており、２の参照数
字が付されたマクロブロックＭＢ２が画面の中央部に含
まれており、１および３の参照数が付されたマクロブロ
ックＭＢ１およびＭＢ３が中央と端との間の部分に含ま
れている。１画面内で、画像の主要部が中央部分に生じ
るのが普通であり、画面を見る者の注意も画面の中央部
に対して多く払われる。従って、エラーが発生した時
に、目立ちやすいのは、画面の中央部分の画像である。
【００８２】上述のように、５マクロブロックが配され
るシンクブロックでは、先頭のシンクブロックほど、他
のシンクブロックのエラーの影響が少ない。従って、図
１８に示すように、エラーの影響が最も少ないシンクブ
ロックＳＢ１に対して、画面中央部のマクロブロックＭ
Ｂ２のデータを配する。以下、シンクブロックＳＢ２、
ＳＢ３、ＳＢ４およびＳＢ５に対して、マクロブロック
ＭＢ１、ＭＢ３、ＭＢ０、ＭＢ４のデータをそれぞれ配
する。かかるマクロブロックとシンクブロックとの間の
関係によって、画面の中央部のデータは、エラーの影響
を確率的に最も受けにくいものとできる。
【００８３】なお、この発明は、ディジタルＶＴＲに限
らず、ディスク記録／再生装置、ディジタル画像信号を
通信路を介して伝送する場合等にも適用できる。
【００８４】
【発明の効果】この発明によれば、１シンクブロック内
に、略整数個のマクロブロックのコード信号が存在する
ので、変速再生時のように、１シンクブロックの単位で
再生されたデータを有効に利用できる。また、この発明
は、ＡＣ−Ｈエリアとして、固定のエリアが設けられ、
然も、これらが分散されているので、ＡＣ−Ｈ成分の伝
搬エラーの距離を短くできる。さらに、この発明は、固
定のＡＣ−Ｈエリアが最初の直流分より前に設けられて
いる。従って、そのシンクブロックからはみ出したＡＣ
−Ｈ成分が前の方に詰められることになり、他のシンク
ブロックにまたがる可能性を低くすることができる。よ
りさらに、この発明は、そのシンクブロックからはみ出
したＡＣ−Ｈ成分を固定ＡＣ−Ｈエリアの先頭から詰め
ているので、ＡＣ−Ｈ成分がアドレス情報を持つことに
なる。その結果、前のシンクブロックにエラーがあって
も、次のシンクブロックでリフレッシュできる。然も、
複数のシンクブロックの内で他のシンクブロックのエラ
ーの影響が最小の先頭シンクブロックに画面中央部のマ
クロブロックを配しているので、エラーの影響が復元画
像中で目立たないものとできる。
【図面の簡単な説明】
【図１】この発明が適用されたディジタルＶＴＲの記録
データ処理回路のブロック図である。
【図２】ＤＣＴの説明に用いる略線図である。
【図３】マクロブロックの説明に用いる略線図である。
【図４】シャフリングの説明に用いる略線図である。
【図５】見積り器の一例のブロック図である。
【図６】アクティビィティ検出回路の一例のブロック図
である。
【図７】バッファリング単位を示す略線図である。
【図８】シンクブロックの例を示す略線図である。
【図９】シンクブロックの他の例を示す略線図である。
【図１０】フレーム化回路の一例のブロック図である。
【図１１】フレーム化回路の動作説明のための略線図で
ある。
【図１２】フレーム化回路の動作説明のための略線図で
ある。
【図１３】フレーム化回路の動作説明のための略線図で
ある。
【図１４】フレーム化回路の動作説明のための略線図で
ある。
【図１５】シャフリングの説明のための略線図である。
【図１６】マクロブロックを構成するＤＣＴブロックの
説明のための略線図である。
【図１７】マクロブロックを構成するＤＣＴブロックの
説明のための略線図である。
【図１８】複数のシンクブロックに対するマクロブロッ
クの配置の関係を示す略線図である。
【図１９】先に提案されているシンクブロックの構成お
よびその伝搬エラーを示す略線図である。
【図２０】先に提案されているフレーム化方法が有する
問題点を説明するための略線図である。
【符号の説明】
４ ＤＣＴ回路 ６ 量子化回路 ７ 見積り器 １１ フレーム化回路
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平４−10879（ＪＰ，Ａ) 特開 平４−61523（ＪＰ，Ａ) 特開 平４−160990（ＪＰ，Ａ) 特開 平４−178086（ＪＰ，Ａ) 特開 平４−298802（ＪＰ，Ａ) 特開 平４−304074（ＪＰ，Ａ)

Claims (3)

    (57)【特許請求の範囲】
  1. 【請求項１】 ディジタル画像信号を直交変換および可
    変長符号により符号化し、上記符号化出力を伝送するよ
    うにしたディジタル画像信号の伝送装置において、 その各々が上記ディジタル画像信号の複数のコンポーネ
    ントを含むマクロブロックの複数個を単位として、上記
    符号化出力のデータ量を所定値以下に制御するためのバ
    ッファリング手段と、 上記バッファリング手段からの上記符号化出力であっ
    て、略１個のマクロブロックに対応するものが一定長の
    シンクブロックのデータエリア内に配され、上記データ
    エリア内に上記マクロブロックの各直交変換ブロックの
    直流分が分散して決められたエリアに配置され、上記直
    流分の直ぐ後に同一の上記直交変換ブロックの交流成分
    の低域成分がそれぞれ配置されるエリアが設けられたデ
    ータ構成を形成するための手段とからなることを特徴と
    するディジタル画像信号の伝送装置。
  2. 【請求項２】 ディジタル画像信号を直交変換および可
    変長符号により符号化し、上記符号化出力を伝送するよ
    うにしたディジタル画像信号の伝送装置において、 その各々が上記ディジタル画像信号の複数のコンポーネ
    ントを含むマクロブロックの複数個を単位として、上記
    符号化出力のデータ量を所定値以下に制御するためのバ
    ッファリング手段と、 上記バッファリング手段からの上記符号化出力であっ
    て、略１個のマクロブロックに対応するものが一定長の
    シンクブロックのデータエリア内に配され、上記データ
    エリア内に上記マクロブロックの各直交変換ブロックの
    直流分が分散して決められたエリアに配置され、上記直
    流分の直ぐ後に同一の上記直交変換ブロックの交流成分
    の低域成分がそれぞれ配置されるエリアが設けられ、上
    記データエリア内の一端付近に上記符号化出力の交流分
    の高域成分を挿入するための固定長のエリアを有するデ
    ータ構成を形成するための手段とからなることを特徴と
    するディジタル画像信号の伝送装置。
  3. 【請求項３】 ディジタル画像信号を直交変換および可
    変長符号により符号化し、その各々が上記ディジタル画
    像信号の複数のコンポーネントを含むマクロブロックの
    複数個を単位として、符号化出力のデータ量を所定値以
    下に制御するためのバッファリング手段と、略１個のマ
    クロブロックに対応するものが一定長のシンクブロック
    のデータエリア内に配され、上記データエリア内に上記
    マクロブロックの各直交変換ブロックの直流分が分散し
    て決められたエリアに配置され、上記直流分の直ぐ後に
    同一の上記直交変換ブロックの交流成分の低域成分がそ
    れぞれ配置されるエリアが設けられ、上記データエリア
    内の一端付近に上記符号化出力の交流分の高域成分を挿
    入するための固定長のエリアを有するデータ構成を形成
    するための手段とを有するディジタル画像信号の伝送装
    置におけるフレーム化方法であって、 上記符号化出力の交流成分を上記直交変換ブロック毎に
    上記低域成分のエリアに詰め込み、はみ出した成分を記
    憶する第１のステップと、 対応するシンクブロック内の上記高域成分の上記固定長
    のエリアおよび上記低域成分のエリアに生じた空きエリ
    アに、上記第１のステップで発生した上記はみ出した成
    分を所定の順序で詰め込み、はみ出した成分を記憶する
    第２のステップと、 上記バッファリング手段の処理単位内の他のシンクブロ
    ック内に残っている空きエリアに、上記第２のステップ
    で発生した上記はみ出した成分を順に詰め込む第３のス
    テップとからなることを特徴とするディジタル画像信号
    の伝送装置におけるフレーム化方法。
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