JP2579456B2 - 復号器 - Google Patents

復号器

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JP2579456B2
JP2579456B2 JP59252806A JP25280684A JP2579456B2 JP 2579456 B2 JP2579456 B2 JP 2579456B2 JP 59252806 A JP59252806 A JP 59252806A JP 25280684 A JP25280684 A JP 25280684A JP 2579456 B2 JP2579456 B2 JP 2579456B2
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Description

【発明の詳細な説明】 この発明はテレテキスト信号用の復号器に関する。
〔発明の背景〕
テレテキストまたはビデオテックスは文字または図形
の原稿の情報をデジタル符号化することにより伝送する
手段である。この符号化の態様は使用する方式や標準に
よって若干変わることがあり、テレテキストデジタル伝
送ではデレビジョン信号中にデジタルコードが編入さ
れ、ビデオテックス伝送では公用切換式電話回線により
伝送される信号にデジタルコードが編入される。この明
細書および請求範囲において用いる「テレテキスト状」
という語は、テレテキストおよびビデオテックスの一般
化用語である。
テレテキストでは、デジタル２進表示で符号化された
文字や図形の情報を放送するためにテレビジョン走査線
を用いる。テレテキストは他の画像情報が送られない垂
直ブランキング期間中に送ればよい。テレテキストの２
進情報はデータブロックに直列的に組成された制御およ
び表示情報を含んでいるが、放送信号中のこの２進情報
の組織は放送局の用いる標準によって決まる。ここでア
ール・シー・エー・エンジニアリング（RCA Engineerin
g）1983年９〜10月号掲載のアストル（B.Astle）の論文
「北米におけるテレテキスト標準（Teletext Standard
in North America）」記載の北米放送テレテキスト仕様
書（以下NABTSと呼ぶ）を例示の目的だけで引用する。
NABTSではテレテキストデータを含む各水平線をデー
タ線と呼び、これがデータパケットを含んでいる。この
パケット中の２進データはそれぞれ８つの２進単位（ビ
ット）を含むバイトに分割され、各パケットの最初の８
つのバイトを一纒めにしてパケットヘッダと呼ぶ。この
パケットヘッダの３つのバイトがチャンネル番号を定
め、各チャンネルがいくつかのページに組織され、各ペ
ージが多数のパケットで構成される。
ビデオデータに含まれるデジタルデータはテレビジョ
ン受像機で受信された後、テレテキスト復号器で処理さ
れる。このときデジタルデータはデータスライサにより
映像信号から抽出され、データプロセッサ（前置プロセ
ッサと呼ぶこともある）にビットの流れを供給する。デ
ータプロセッサは表示すべき情報を指定する利用者から
の指令を受け、表示のため選ばれたテレテキストチャン
ネルに含まれるデータを緩衝記憶装置に記憶する。緩衝
されたデータは処理されて表示用信号を出力する表示プ
ロセッサに供給される。画像表示装置としてテレビジョ
ン映像管（CRT）を用いるときは、表示プロセッサは周
期的に表示用信号を出力し、テレビジョン表示面上の画
像を維持する必要がある。
〔発明の概要〕
この発明の復号器を、参考までに各構成素子毎に後程
説明する図示の実施例中で使用されている参照番号を付
して示すと、この発明の復号器は、制御情報（例えばデ
ータスライサ22から供給されるクロック）と、画像表示
装置（例えば49）により表示するための画像情報（例え
ばデータスライサ22から供給されるデジタルデータ）と
を含むテレテキスト状信号を復号するためのものであっ
て、（イ）タイミング信号を発生するタイミング装置
（29）と、（ロ）上記テレテキスト状信号に応答して、
この信号から２進データワードを生成するデータプロセ
ッサ（24）と、（ハ）上記タイミング装置から供給され
るタイミング信号により制御されて上記データプロセッ
サから供給される上記２進データワードを記憶するため
の第１の複数個の記憶位置（例えば201）と、上記２進
データワードに基づいて生成された画素データワードを
記憶する第２の複数の記憶位置（例えば203）とを有す
る記憶装置（28）と、（ニ）上記復号器の動作を制御す
るマイクロコンピュータ（25）とを有している。このマ
イクロコンピュータ（25）は、上記タイミング装置から
供給されるタイミング信号により制御されて上記記憶装
置の上記第１の複数個の記憶位置（201）に記憶された
上記２進データワードを読出し、読出された上記２進デ
ータワードを処理して画像情報を含む画素データワード
を生成し、この画素データワードを上記タイミング装置
から供給されるタイミング信号により制御されて、上記
記憶装置の上記第２の複数の記憶位置（例えば203）に
記憶させる。
この発明の復号器は、さらに、（ホ）対応する画素か
らなる上記画像情報を上記画像表示装置（49）に表示さ
せるために、上記タイミング装置から供給されるタイミ
ング信号により制御されて上記記憶装置（28）の上記第
２の複数の記憶位置（203）から上記画像情報を含む画
素データワードを読出す表示プロセッサ（43）と、
（ヘ）スイッチ（50）とを有しており、上記表示プロセ
ッサ（43）は、上記第２の複数の記憶位置から読出され
た画素データワードが有する所定のビットの組合わせに
応じて、レジスタの配列（501）中の対応するレジスタ
の色コードアドレスを指定し、指定された色コードアド
レスに対応する色コード（Ｒ、Ｇ、Ｂ）とこれと共存す
る透明度コード（TR）とを選択する。また、上記スイッ
チ（50）は、上記画素データワードによって決定される
画素毎に上記透明度コード（TR）に応答して動作し、上
記画像表示装置（49）を上記表示プロセッサ（43）に結
合するように動作する。この発明の復号器では、上記の
各コードは、上記画素データワードの所定のビットの組
合わせに関連する上記色コードと透明度コードの双方が
上記レジスタ（501）の配列中の同じ対応するレジスタ
（例えばＮ番目のレジスタＮ）に含まれるように画素に
ついての表示情報を与える。
〔詳細な説明〕
第１図のテレテキスト復号器はテレビジョンプロセッ
サ21の入力20に映像変調信号を受信する。プロセッサ21
は同調器、中間周波数増幅器、映像検波器のような公知
のテレビジョン受像機段を含んでいる。データスライサ
22はこのテレビジョンプロセッサ21から検波された映像
信号を受信してテレテキスト２進データの検知分離を行
い、信号線路Ｈ、Ｖにそれぞれ入来合成映像信号に同期
した水平、垂直の各同期信号を発生すると共に、また線
路70を介してテレテキスト復号器の通常の前置プロセッ
サのようなデータプロセッサ24に直列のデータストリー
ムと再構成されたクロック信号を供給する。再構成クロ
ック信号は、データプロセッサ24によって生成されて復
号器内の各段に分配されるテレテキスト系のクロックの
同期に用いられる。利用者の発した指令はマイクロコン
ピュータ25を介してデータプロセッサ24に印加される。
利用者はキーボード26を操作して表示すべき雑誌および
ページ番号を選択する。マイクロコンピュータ25はキー
ボード26から信号線路42を介して利用者の選択したデー
タを受信し、選択線路47を介してデータプロセッサ24に
12ビットワードを供給する。このワードは所要のNABTS
規定のパケットアドレスを表わす。
水平周期信号の発生後、データプロセッサ24はデータ
スライサ22から受信した直列データストリーム流中のNA
BTS規定のフレーミングコードの有無を探査し、有効な
フレーミングコードを生ずると、直列データストリーム
をバイトと呼ぶ８ビット単位に区切り始める。データプ
ロセッサ24は次の３バイトを処理してパケットアドレス
を得る。マイクロコンピュータ25は線路47を介してデー
タプロセッサ24に所要のパケットアドレスを指定する12
ビットワードを供給する。所要のパケットアドレスと入
来テレテキストデータのパケットアドレスが一致する
と、データプロセッサ24はNABTSの規定のデータパケッ
トに含まれる後続バイトを全部タイミング制御装置29で
制御される時間区間において複数個の記憶位置に転送し
始める。第１図の復号器ではこの複数個の記憶位置は記
憶装置28に含まれる。
記憶装置28はマイクロコンピュータ25、データプロセ
ッサ24および表示プロセッサ43に対して時分割的に結合
される。この記憶装置28の時分割はタイミング装置29に
よって行なわれる。そのタイミング装置29は共通の記憶
装置に対するそれらの各呼出しのための時間区間を割当
てる。
表示プロセッサ43に対する時間区間はタイミング装置
29により所定の割合で供給されるが、データプロセッサ
24とマイクロコンピュータ25に対する時間区間はタイミ
ング装置29の持っている優先順位に従って供給され、デ
ータプロセッサ24はマイクロコンピュータ25より優先順
序が高い。このため表示プロセッサ43はその常に使用す
る時間区間において最高の優先順位を持つ。
データワードは１時間区間内で行なわれる２段過程を
用いてデータプロセッサ24から記憶装置28に転送され
る。データプロセッサ・リクエスト線59はタイミング装
置29に対してデータプロセッサ24が記憶装置28の呼出し
の準備を完了していることを示す。第１段階でアドレス
ワードがデータプロセッサ24のアドレス出力30から線路
31を介してスイッチ32の端子Ｅに転送される。タイミン
グ装置29はこの制御スイッチ32にタイミング信号54を供
給してスイッチ線路Ｓを接点Ｅに接続し、アドレスワー
ドを端子Ｇから母線33に転送する。母線33は16ビット母
線を構成する16本の線路から成り、この母線からアドレ
スワードが線路36を介してアドレスラッチ35の入力端子
34に転送される。アドレスワードはアドレスラッチ35に
記憶されると共に、出力端子37から記憶装置28のアドレ
ス入力38に転送されて、テレテキストワードを転送すべ
き記憶装置28の位置を選択する。
第２段階では、データワードがデータプロセッサ24の
出力39から線路40を介してスイッチ32の端子Ｆに転送さ
れる。タイミング装置29はスイッチ線路Ｓを制御してデ
ータを同じ母線33に転送し、母線33はそのデータを記憶
装置のデータ入力41に送る。ここでデータワードはアド
レスラッチ35に記憶されたアドレスワードにより選択さ
れた記憶装置28の位置に記憶される。
マイクロコンピュータ25と記憶装置28の間の実際のデ
ータワード転送もまた２段過程で行なわれる。マイクロ
コンピュータ・リクエスト線58はタイミング装置29にマ
イクロコンピュータ25が共通の記憶装置28を呼出す準備
ができていることを示す。第１段階では、アドレスワー
ドがマイクロコンピュータ25のアドレス端子45から線路
46を介してスイッチ32の端子Ａに転逆され、さらに母線
33から線路36を介してアドレスラッチ35の入力端子34に
転送され、ここに記憶される。第２段階では、マイクロ
コンピュータ25が記憶装置28へまたは記憶装置28からの
転送を行う。記憶装置への転送が必要なら、データワー
ドがマイクロコンピュータ25のデータ端子48から線路47
を介してスイッチ32の端子Ｂに転送され、記憶装置28か
らの転送が必要なら、データワードがタイミング装置29
の制御の下に記憶装置のデータ端子41から母線33に、さ
らにここからスイッチ32の端子Ｂに転送され、さらに線
路47を介してマイクロコンピュータのデータ端子48に転
送される。
タイミング装置29と記憶装置28の動作は同一発明者お
よび出願人による同日の出願（特開60−134685対応）に
詳細に記憶されている。
データプロセッサ24は各後続のデータワードを連続す
る記憶アドレスに記憶する。これによって第１図の記憶
装置28の第２図の概要構成に示すようなデータプロセッ
サ緩衝器201が生成する。このデータ緩衝器はマイクロ
コンピュータ25により読取られてさらに処理される。マ
イクロコンピュータ25は読取り線路によりデータプロセ
ッサ24がどれほど多くのデータワードを記憶装置28に転
送したかを確かめて緩衝器201が満杯でデータ転送が完
了したときを確認する。マイクロコンピュータ25は記憶
装置28内に設けられたデータプロセッサ緩衝器201を読
取り、読取ったデータワードをそのままの形で異なる記
憶位置群すなわち第１図の記憶装置28内の第２図のペー
ジ記憶緩衝器202に転送する。
ページ記憶緩衝器202は利用者が要求する可能性が最
も高いページに対応するテレテキストデータを記憶す
る。例えば、前のページは利用者に要求される可能性が
高いとすると、これを記憶することにより、その前ペー
ジは、利用者がその要求を始めるときすでに緩衝器202
に記憶されているため、復号器は前ページに対する利用
者の要求に速やかに応じられる。マイクロコンピュータ
25は、データプロセッサ緩衝器201のテレテキストデー
タをページ記憶緩衝器202に転送した後、そのページ記
憶緩衝器202を処理してその結果を複数個の記憶位置に
記憶する。第１図の復号器ではその図の記憶装置28の第
２図の概要構成に示された表示ビットマップ203に複数
個の記憶位置が含まれている。表示ビットマップ203内
の記憶位置には表示プロセッサ43の構成を簡単化し得る
簡単な濃縮フォーマットに組織された表示情報を含んで
いる。この利点はマイクロコンピュータ25にテレテキス
トデータワードの処理をさせることにより得られる。表
示プロセッサ43はマップ203内の簡単化フォーマットの
データを呼出す。なお、第２図中のスクラッチパッド20
4は、マイクロコンピュータ25が処理したデータを必要
に応じて一時点に記憶するためのものである。
記憶装置28から表示プロセッサ43へのデータワードの
転送は記憶装置28からマイクロコンピュータ25への転送
と同様で、この場合は第１図に示すように、アドレスワ
ードが表示プロセッサ43のアドレス端子83から供給さ
れ、データワードがデータ端子81に受入れられる。アド
レスワードはスイッチ32の端子Ｃに供給され、データワ
ードは端子Ｄから供給される。タイミング装置29からの
タイミング信号56は表示プロセッサ43の動作を制御す
る。データ転送は記憶装置28からマイクロコンピュータ
25への転送に用いられた２段過程と同様の方法で行われ
る。
表示プロセッサ43は記憶装置28を読取って、第３図に
ついて述べるように第１図の表示器49で表示するための
アナログの赤、緑、青の信号を生成する。表示器49は例
えばテレビジョン映像管を表示装置として含む。
表示された各走査線は画素と呼ばれる画像素子に分割
され、各画素の画像情報はマイクロコンピュータ25によ
り記憶装置28の第２図の表示ビットマップ203に例えば
４ビット画素ワードとして記憶される。画素ワードの各
ビットの与えられた組合せがその画素ワードで決まる画
素の与えられた表示情報に相当する。表示プロセッサ43
は表示ビットマップ203を順次読取る。
第１図のテレテキスト復号器は16ビット幅の記憶装置
28を有し、１つの記憶アドレスに１以上の画素ワードを
記憶し得るから、記憶装置が呼出されるたびに複数個の
画素ワードが表示プロセッサ43に供給されて順位処理さ
れるという利点がある。
第３図は第１図に示すテレテキスト復号器用の表示プ
ロセッサ43の１実施例を示す。この２つの図面で同じ数
字は同機能または同数を表わす。第３図において、第１
図の記憶装置28から画素ワードを読取るためにアドレス
端子83に生成されるアドレスワードは、タイミング信号
56の線路56Aの制御により表示プロセッサ43の制御段520
によって供給される。
所定の読取り動作により記憶装置28から得られる複数
個の画ワードの順次処理は第３図のシフトレジスタ510
を用いて行われる。シフトレジスタ510はタイミング信
号56のクロック線路56Bの制御の下に端子81から得られ
た16ビットのデータワードをそれぞれ分解して４ビット
画素ワード４つにする。この４ビットワードはそれぞれ
共通母線500を介して順次テーブルルックアップ配列501
に送られる。
テーブルルックアップ配列501は16×10レジスタ配列
すなわちそれぞれ10ビット幅のレジスタ16個の配列で構
成することができ、その第Ｎ番目のレジスタを第３図に
示す。
与えられた４ビットの画素ワードが16個の２進組合せ
の与えられた１つを決定するから、その画素ワードは配
列501の対応するレジストのアドレスを指定する。各レ
ジスタの10ビットはそれぞれ３ビット幅の３つの色コー
ド群Ｒ、Ｇ、Ｂと１ビットの透明度コードTRとに分割さ
れている。色コードの与えらえた値により対応する色の
濃度が決まる。
表示ワードの群Ｒは母線511に供給され、デジタル・
アナログ（DA）変換器503を駆動して線路504にアナログ
赤信号を発生する。同様にして群Ｇ、Ｂをそれぞれ母線
512、513を介してDA変換器に供給することにより、線路
505、506にそれぞれアナログ緑信号とアナログ青信号を
生成する。この３つのアナログ信号はＲ、Ｇ、Ｂの各母
線を介して第１図のスイッチ50のテレテキスト端子に供
給される。
スイッチ50はこのアナログ赤、緑、青の各信号を表示
器49に供給してその表示器内の映像管を駆動する。表示
器49に供給される信号源の形式すなわちテレテキスト映
像信号か普通の映像信号かはスイッチ50の位置によって
決まり、その位置は透明度線路51に生ずる透明度コード
TRによって制御される。
すなわち透明度コードTRが第１の論理状態のときはス
イッチ50はテレビ端子を表示器49に結合して通常の輝度
色度回路52からの赤、緑、青のアナログ情報が表示器49
に転送されるようにするが、透明度コードが他の論理状
態のときはスイッチ50はテレテキスト端子を表示器に結
合する。
第３図の配列501内の16個の表示ワードのそれぞれが
色コードと透明度コードとの双方を含んでいる構成は、
特に有利なものである。例えば、この構成は透明度線路
51にテレテキスト情報または非テレテキスト情報を各画
素ごとに簡単に制御する能力を与える。この能力は例え
ば字幕付けに利用することができる。
以上説明したこの発明の実施例では、マイクロコンピ
ュータ25がデータプロセッサ24から得られて緩衝テレテ
キストデータワードを処理して表示プロセッサ43で使用
する画素ワードマップを発生する。この画素ワードマッ
プは画素データワードを含んでいる。各画素ワードは１
つの画素の表示情報を決定するもので、画素を特徴付け
る表示ワードを選択することができる。画素ワードが選
択し得る可能な表示ワードの数はその画素ワードの最大
２進値に等しい。表示プロセッサ43は画素ワードマップ
から画素データワードを順次読取ってその画素を特徴付
ける信号で表示を行う。この表示プロセッサ43が画素ワ
ードマップを備えた構成は文字発生器を不要にし、表示
器の設計を簡単ならしめる。
マイクロコンピュータ25は実際上汎用のマイクロコン
ピュータであるため、テレテキスト信号の復号と無関係
な仕事を行うこともできる。このような仕事を行うた
め、マイクロコンピュータ25は第２図に示すように記憶
装置28のスクラッチパッド204の記憶スペースを用いる
ことがある。マイクロコンピュータ25はさらにキーボー
ドから受信した信号を処理することもできる。
この実施例では表示ワードが色コードと別の透明度コ
ードを含んでいる。透明度コードを用いて映像管の赤、
緑、青の駆動回路に結合される信号源を選択することも
できる。透明度コードが与えらえた値のときは、表示ワ
ードに付随する色コードを供給する表示プロセッサ43は
信号源情報を与えるが、透明度コードが第２の値のとき
はテレテキスト信号源以外の信号源が画像情報を与え
る。このような他の情報源はテレテキスト映像信号が送
られていないとき画像信号を送るものである。
色コードと共存する透明度コードを利用する１つの利
点は、簡単化された画素ワードを表示ワードに変換する
ために用いられる回路が比較的簡単なことである。この
回路は画素ワードによりアドレス指定されるレジスタの
配列から構成され、画素ワードによって選択されたレジ
スタが色コードと共存する透明度コードとを含む。
同じ表示ワード中に色コードと共存する透明度コード
を含む表示ワードを利用する今１つの利点は利用者が透
明度コードに優先することができることである。このよ
うな場合表示ワードの色コードが画素の特徴を決定す
る。
【図面の簡単な説明】
第１図はこの発明を実施したテレテキスト復号器の１例
のブロック回路図、第２図は第１図の復号器の記憶装置
の記憶割当ての１例を示す略図、第３図は第１図の復号
器の表示プロセッサの１実施例のブロック回路図であ
る。 22、24、26……データ取出し手段、25……処理手段、43
……表示プロセッサ、201……第１の記憶位置、203……
第２の記憶位置。
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｎ 7/035 7/167 (56)参考文献 特開 昭57−196677（ＪＰ，Ａ) 特開 昭57−201391（ＪＰ，Ａ) 特開 昭58−85683（ＪＰ，Ａ) 特公 昭57−44042（ＪＰ，Ｂ２)

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項１】制御情報と、画像表示装置により表示する
    ための画像情報とを含むテレテキスト状信号のための復
    号器であって、 タイミング信号を発生するタイミング装置と、 上記テレテキスト状信号に応答して、この信号から２進
    データワードを生成するデータプロセッサと、 上記タイミング装置から供給されるタイミング信号によ
    り制御されて上記データプロセッサから供給される上記
    ２進データワードを記憶するための第１の複数個の記憶
    位置と、上記２進データワードに基づいて生成された画
    素データワードを記憶する第２の複数の記憶位置とを有
    する記憶装置と、 上記復号器の動作を制御するマイクロコンピュータであ
    って、上記タイミング装置から供給されるタイミング信
    号により制御されて上記記憶装置の上記第１の複数個の
    記憶位置に記憶された上記２進データワードを読出し、
    読出された上記２進データワードを処理して画像情報を
    含む画素データワードを生成し、この画素データワード
    を上記タイミング装置から供給されるタイミング信号に
    より制御されて上記記憶装置の上記第２の複数の記憶位
    置に記憶させる上記マイクロコンピュータと、 対応する画素からなる上記画像情報を上記画像表示装置
    に表示させるために、上記タイミング装置から供給され
    るタイミング信号により制御されて上記記憶装置の上記
    第２の複数の記憶位置から上記画像情報を含む画素デー
    タワードを読出す表示プロセッサであって、読出された
    画素データワードが有する所定のビットの組合わせに応
    じて、レジスタの配列中の対応するレジスタの色コード
    アドレスとこれと共存する透明度コードアドレスを指定
    し、指定された色コードアドレスに対応する色コード
    と、これと共存する透明度コードとを発生する上記表示
    プロセッサと、 上記画素データワードによって決定される画素毎に上記
    透明度コードに応答して動作し、上記画像表示装置を上
    記表示プロセッサに結合するスイッチと、を具備し、 上記各コードは、上記画素データワードの所定のビット
    の組合わせに関連する上記色コードと透明度コードの双
    方が上記レジスタの配列中の同じ対応するレジスタに含
    まれるように画素についての表示情報を与えるものであ
    る、 復号器。
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