WO2021157894A1 - 표시 영역에 따른 감마 전압 운용 방법 및 이를 지원하는 전자 장치 - Google Patents

표시 영역에 따른 감마 전압 운용 방법 및 이를 지원하는 전자 장치 Download PDF

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WO2021157894A1
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gamma
display
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electronic device
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배종곤
이재성
이태웅
김동휘
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삼성전자 주식회사
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Definitions

  • Various embodiments of the present specification relate to operation of a gamma voltage according to a display area.
  • the electronic device includes a display for displaying information. Recently, the focus has been on a method to expand the display area. Accordingly, research is being conducted on a method in which a camera or sensor disposed on the front side is disposed under the display. However, when the camera is disposed under the display, the signal transmitted to the camera may be lost while passing through the display. Due to this, there is a problem in that the camera disposed under the display cannot provide a resolution higher than a certain size. In order to solve this problem, a method of configuring the pixel arrangement density of the area in which the camera is arranged to be different from that of other areas is applied.
  • various embodiments of the present specification provide a method of operating a gamma voltage according to a display area capable of displaying the same or similar image even though pixel arrangement densities are different by varying the gamma voltage applied to each display area, and an electronic supporting the same. device can be provided.
  • an electronic device includes a display panel including a first display area and a second display area, wherein the first display area includes sub-pixels distributed at a first density, and the second display area includes the first display area. including sub-pixels distributed with a second density lower than the density; and a display driving circuit related to driving the display panel, wherein the display driving circuit supplies a gamma signal to source lines disposed in the first display area.
  • a gamma signal set to emit a luminance value relatively higher than that of the gamma signal may be configured to be supplied to the second display area.
  • the display driving circuit receives display data from a processor, and the display driving circuit is arranged at a first pixel arrangement density in the display panel. While supplying the first gamma signal set to display the luminance of the first size to the displayed first display area, the second display area having a second pixel arrangement density lower than the first pixel arrangement density is larger than the first size.
  • the method may include supplying a second gamma signal set to display a luminance of a second magnitude.
  • image display may be appropriately performed by selectively operating a gamma voltage according to a display area.
  • FIG. 1 is a diagram schematically illustrating a configuration of an electronic device including a display driving circuit according to an exemplary embodiment.
  • FIG. 2 illustrates a pixel arrangement in display areas of a display panel according to an exemplary embodiment.
  • FIG. 3 is a diagram illustrating a display driving circuit according to an exemplary embodiment.
  • FIG. 4 is a diagram illustrating an example of a partial configuration of a display panel and a display driving circuit according to an embodiment.
  • FIG. 5 is a diagram illustrating an example of a partial configuration of a display panel and a display driving circuit according to an embodiment.
  • FIG. 6 is a diagram illustrating an example of a partial configuration of a display panel and a display driving circuit according to an embodiment.
  • FIG. 7 is a diagram illustrating an example of a partial configuration of a display driving circuit according to an embodiment.
  • FIG. 8 is a diagram illustrating another example of a partial configuration of a display driving circuit according to an exemplary embodiment.
  • FIG. 9 is a diagram illustrating an example of an output of a source driver according to an embodiment.
  • FIG. 10 is a diagram illustrating an example of a display panel including various shapes of a second display area according to an exemplary embodiment.
  • FIG. 11 is a diagram illustrating an example in which an additional gamma driver is disposed on the left side of a display driving circuit according to an exemplary embodiment.
  • FIG. 12 is a diagram illustrating an example in which an additional gamma driver is disposed at the center in a display driving circuit according to an exemplary embodiment.
  • FIG. 13 is a diagram illustrating an example in which an additional gamma driver is disposed on a right side in a display driving circuit according to an exemplary embodiment.
  • FIG. 14 is a diagram illustrating an example in which an additional gamma driver is disposed at various positions in a display driving circuit according to an exemplary embodiment.
  • 15 is a diagram illustrating an example of driving a display panel according to an exemplary embodiment.
  • 16 is a block diagram of an electronic device 1601 in a network environment 1600, according to various embodiments.
  • expressions such as “has,” “may have,” “includes,” or “may include” refer to the presence of a corresponding characteristic (eg, a numerical value, function, operation, or component such as a part). and does not exclude the presence of additional features.
  • expressions such as “A or B,” “at least one of A or/and B,” or “one or more of A or/and B” may include all possible combinations of the items listed together.
  • “A or B,” “at least one of A and B,” or “at least one of A or B” means (1) includes at least one A, (2) includes at least one B; Or (3) it may refer to all cases including both at least one A and at least one B.
  • first may be named as a second component, and similarly, the second component may also be renamed as a first component.
  • a component eg, a first component is "coupled with/to (operatively or communicatively)" to another component (eg, a second component);
  • another component eg, a second component
  • the certain element may be directly connected to the other element or may be connected through another element (eg, a third element).
  • a component eg, a first component
  • another component eg, a second component
  • the expression “configured to (or configured to)” depends on the context, for example, “suitable for,” “having the capacity to ,” “designed to,” “adapted to,” “made to,” or “capable of.”
  • the term “configured (or configured to)” may not necessarily mean only “specifically designed to” in hardware. Instead, in some circumstances, the expression “a device configured to” may mean that the device is “capable of” with other devices or parts.
  • the phrase “a processor configured (or configured to perform) A, B, and C” refers to a dedicated processor (eg, an embedded processor) for performing the operations, or by executing one or more software programs stored in a memory device. , may mean a generic-purpose processor (eg, a CPU or an application processor) capable of performing corresponding operations.
  • the electronic device may include, for example, a smartphone, a tablet personal computer, a mobile phone, a video phone, an e-book reader, desktop personal computer, laptop personal computer, netbook computer, workstation, server, personal digital assistant, PMP (portable multimedia player), MP3 player, mobile medical It may include at least one of a device, a camera, and a wearable device.
  • the wearable device is an accessory type (eg, a watch, a ring, a bracelet, an anklet, a necklace, glasses, contact lenses, or a head-mounted-device (HMD)), a fabric or an integrated clothing ( It may include at least one of: electronic clothing), body attachable (eg skin pad or tattoo), or bioimplantable (eg implantable circuit).
  • accessory type eg, a watch, a ring, a bracelet, an anklet, a necklace, glasses, contact lenses, or a head-mounted-device (HMD)
  • HMD head-mounted-device
  • a fabric or an integrated clothing It may include at least one of: electronic clothing), body attachable (eg skin pad or tattoo), or bioimplantable (eg implantable circuit).
  • the electronic device may be a home appliance.
  • Home appliances are, for example, televisions, digital video disk (DVD) players, audio, refrigerators, air conditioners, vacuum cleaners, ovens, microwave ovens, washing machines, air purifiers, set-top boxes, home automation controls.
  • panel home automation control panel
  • security control panel security control panel
  • TV box eg Samsung HomeSync TM , Apple TV TM , or Google TV TM
  • game console eg Xbox TM , PlayStation TM
  • electronic dictionary e.g an electronic key, a camcorder, or an electronic picture frame.
  • the electronic device may include various medical devices (eg, various portable medical devices (eg, a blood glucose monitor, a heart rate monitor, a blood pressure monitor, or a body temperature monitor), magnetic resonance angiography (MRA), magnetic resonance imaging (MRI), Computed tomography (CT), imager, or ultrasound machine, etc.), navigation devices, global navigation satellite system (GNSS), event data recorder (EDR), flight data recorder (FDR), automotive infotainment ) devices, ship electronic equipment (e.g. ship navigation systems, gyro compasses, etc.), avionics, security devices, vehicle head units, industrial or domestic robots, and automatic teller's machines (ATMs) in financial institutions.
  • various medical devices eg, various portable medical devices (eg, a blood glucose monitor, a heart rate monitor, a blood pressure monitor, or a body temperature monitor), magnetic resonance angiography (MRA), magnetic resonance imaging (MRI), Computed tomography (CT), imager, or ultrasound machine, etc.
  • point of sales (POS) in stores may include at least one.
  • POS point of sales
  • internet of things e.g. light bulbs, sensors, electricity or gas meters, sprinkler devices, smoke alarms, thermostats, street lights, toasters
  • exercise equipment hot water tank, heater, boiler, etc.
  • the electronic device is a piece of furniture or a building/structure, an electronic board, an electronic signature receiving device, a projector, or various measuring devices (eg, water, electricity, gas, or a radio wave measuring device).
  • the electronic device may be a combination of one or more of the various devices described above.
  • the electronic device according to an embodiment may be a flexible electronic device.
  • the electronic device according to the embodiment of the present document is not limited to the above-described devices, and may include a new electronic device according to technological development.
  • the term user may refer to a person who uses an electronic device or a device (eg, an artificial intelligence electronic device) using the electronic device.
  • FIG. 1 is a diagram schematically illustrating a configuration of an electronic device including a display driving circuit according to an exemplary embodiment
  • FIG. 2 illustrates a pixel arrangement of display areas of a display panel according to an exemplary embodiment.
  • the electronic device 100 includes a processor 140 (eg, an application processor (AP)), a display driver IC (DDI) 200 , and a display panel 160 .
  • a processor 140 eg, an application processor (AP)
  • AP application processor
  • DPI display driver IC
  • the electronic device 100 may be implemented as, for example, a portable electronic device.
  • the display driving circuit 200 and the display panel 160 may be implemented as a separate (or external) display device (or display module) other than the processor 140 .
  • the display panel 160 includes display regions having different pixel (or pixel) arrangement densities, and supplies different gamma voltages (or gamma tap voltages) depending on the display regions. Even if the pixel arrangement density is different, it can support to display an image of the same color or the same luminance as an adjacent area.
  • the display panel 160 may display display data by the display driving circuit 200 .
  • the display panel 160 is a thin film transistor-liquid crystal display (TFT-LCD) panel, a light emitting diode (LED) display panel, an organic LED (OLED) display panel, and an active matrix OLED (AMOLED) display panel. , or a flexible display panel.
  • TFT-LCD thin film transistor-liquid crystal display
  • LED light emitting diode
  • OLED organic LED
  • AMOLED active matrix OLED
  • gate lines and source lines may be intersected in a matrix form.
  • a gate signal may be supplied to the gate lines.
  • a gate signal may be sequentially supplied to the gate lines.
  • a first gate signal may be supplied to odd-numbered gate lines among the gate lines, and a second gate signal may be supplied to even-numbered gate lines.
  • the first gate signal and the second gate signal may include signals alternately supplied with each other.
  • the second gate signal may be sequentially supplied from the start line to the end line of the even gate lines.
  • Signals corresponding to display data may be supplied to the source lines.
  • a signal corresponding to the display data may be supplied from a source driver under control of a timing controller of a logic circuit.
  • the display panel 160 may include a first display area 161 and a second display area 162 having different pixel arrangement densities.
  • the first display area 161 is a region in which pixels are continuously arranged in neighboring pixel arrangement partial regions (or a region in which pixels are continuously arranged in matrix-shaped partial regions, or certain pixel groups (eg, : a region in which RGB (red, green, blue) or RGB (RGGB) is disposed in each of the matrix-shaped partial regions).
  • pixel groups eg, : a region in which RGB (red, green, blue) or RGB (RGGB) is disposed in each of the matrix-shaped partial regions.
  • pentile-shaped sub-pixels are arranged in one pixel arrangement partial area (eg, one rectangular partial area) or RGB layout type sub-pixels are arranged according to the characteristics of the display panel 160 .
  • the sub-pixels may be arranged in one pixel arrangement partial area.
  • the second display area 162 may have a pixel arrangement density different from that of the first display area 161 .
  • pixels may be disposed at a predetermined distance from pixel arrangement partial areas in a matrix form.
  • the second display area 162 includes a plurality of pixel arrangement partial areas, and pixels are intermittently arranged in the plurality of pixel arrangement partial areas irregularly (or randomly) or according to a specified pattern.
  • the second display area 162 may include, for example, an area having a size corresponding to at least one sensor area disposed on the front surface of the electronic device 100 .
  • the second display area 162 is an area in which a camera is disposed under the display panel 160 (eg, an area corresponding to the size of the camera, or an image sensor unit that receives a signal related to an image among the cameras). corresponding region).
  • the second display area 162 may include a size of at least a partial area corresponding to an area in which structures such as a fingerprint sensor, an iris sensor, a microphone, and a speaker are disposed under the display panel 160 .
  • At least one second display area 162 may exist in various areas of the display panel 160 .
  • the second display area 162 may be formed in areas such as upper right, upper center, upper left, lower right, lower center, and lower left of the display panel 160 .
  • the pattern of the sub-pixels disposed in the first display area 161 and the second display area 162 may be the same, but may be configured differently.
  • the sub-pixels when the sub-pixels are disposed in the RGBG pattern in the first display area 161 , the sub-pixels may also be disposed in the second display area 162 in the RGBG pattern.
  • sub-pixels of the RGBG pattern may be disposed in some pixel arrangement partial areas among the plurality of pixel arrangement partial areas.
  • the subpixels when the subpixels are arranged in an RGBG (or RGB) pattern in the first display area 161 , the subpixels may also be arranged in an RGB (or RGBG) pattern in the second display area 162 .
  • sub-pixels of the RGB pattern in some pixel arrangement partial areas among the plurality of pixel arrangement partial areas.
  • the processor 140 may control the overall operation of the electronic device 100 .
  • the processor 140 may be implemented as an integrated circuit, a system on a chip, or a mobile AP.
  • the processor 140 may transmit data to be displayed (eg, image data, video data, or still image data as display data) to the display driving circuit 200 .
  • the display data may be divided into line data units corresponding to horizontal lines (or vertical lines) of the display panel 160 .
  • the processor 140 may transmit to the display driving circuit 200 a control signal for differently controlling the operation form of the gamma generator of the display panel 160 according to the display area.
  • the processor 140 may transmit a control signal for controlling the operation of gamma generators designed to supply different gamma voltages to the display area for each display area to the display driving circuit 200 .
  • the processor 140 is configured to be supplied to the first display area 161 (eg, an area in which pixels are adjacent and arranged in a matrix form) and the second display area 162 of the display panel 160 . It is possible to control the supply of the gamma voltage (or the gamma tap voltage). For example, in relation to display data of content output to the first display area 161 and the second display area 162 , the processor 140 may generate a screen in the second display area 162 having a relatively low pixel arrangement density. The display may be controlled to be performed in the same manner as in the first display area 161 .
  • the first display The display form of the content output to the area 161 and the display form of the content output to the second display area 162 may be different.
  • the processor 140 considers the pixel arrangement density of the first display area 161 and the second display area 162 so that content (or an image, or an object) having the same color and luminance is equal to that of the first display area 161 and the first display area 161 .
  • Adjustment of a gamma signal (eg, at least one of an analog gamma voltage and a digital gamma voltage) of display data corresponding to the content output to the second display area 162 is controlled to be displayed over the second display area 162 .
  • the processor 140 adjusts the gamma signal (eg, adjusts only the analog gamma voltage or both the analog gamma voltage and the digital gamma voltage) according to the gray level of the content to be output to the second display area 162 .
  • the display driving circuit 200 may change the data transmitted from the processor 140 into a form that can be transmitted to the display panel 160 , and transmit the changed data to the display panel 160 .
  • the change data may be supplied in units of pixels (or units of sub-pixels).
  • a pixel has a structure in which sub-pixels Red, Green, and Blue are arranged adjacent to each other in relation to a designated color display, and one pixel includes RGB sub-pixels (RGB stripe layout structure) or RGBG sub-pixels (Pentile layout structure) )can do.
  • the arrangement structure of the RGBG sub-pixels may be replaced with the arrangement structure of the RGBG sub-pixels.
  • the pixel may be replaced with an RGBW sub-pixel arrangement structure.
  • the display driving circuit 200 may process display data supplied to the display panel 160 in units of pixels according to a display area. For example, in response to the control of the processor 140 , the display driving circuit 200 provides a general gamma generator to supply a gamma tap voltage to the first display area 161 and a gamma tap voltage to the second display area 162 . An additional gamma generator may be included, and signal generation of each gamma generator may be controlled.
  • the display driving circuit 200 uses some gamma generators among general gamma generators that supply a gamma tap voltage to the first display area 161 to sub-pixels disposed in the second display area 162 . It is possible to generate a gamma voltage (or gamma tap voltage) to supply the devices. In this case, the display driving circuit 200 may differently control the gamma voltage generation of a specific gamma generator among general gamma generators.
  • FIG. 3 is a diagram illustrating a display driving circuit according to an exemplary embodiment.
  • the display driving circuit 200 includes an interface circuit 201 (interface circuit), a logic circuit 202 (logic circuit), a graphic memory 203 (graphic memory), and a data latch 205 . ) (data latch) (or shift register), source driver 206 (source driver), gate driver 207 (gate driver), general gamma generator 208 (Gamma generator) and additional gamma generator 209 may include.
  • the interface circuit 201 may interface signals or data exchanged between the processor 140 and the display driving circuit 200 .
  • the interface circuit 201 may interface line data transmitted from the processor 140 and transmit it to a graphic memory write controller of the logic circuit 202 .
  • the interface circuit 201 may include a mobile industry processor interface (MIPI®) (MIPI®), a mobile display digital interface (MDDI), a displayport, or an embedded displayPort (eDP). It may be an interface related to the same serial interface.
  • MIPI® mobile industry processor interface
  • MDDI mobile display digital interface
  • eDP embedded displayPort
  • the logic circuit 202 includes a graphic memory write controller, a timing controller, a graphic memory read controller, an image processing unit, a source shift register controller ( It may include a source shift register controller and a data shift register.
  • the graphic memory write controller of the logic circuit 202 may receive line data transmitted from the interface circuit 201 and control an operation of writing the received line data to the graphic memory 203 .
  • the timing controller may supply a synchronizing signal and/or a clock signal to each component (eg, a graphic memory read controller) of the display driving circuit 200 . Also, the timing controller may transmit a read command (RCMD) for controlling a read operation of the graphic memory 203 to the graphic memory read controller.
  • the timing controller may control supply of display data to the source driver 206 .
  • the timing controller may control a gate signal output of the gate driver 207 .
  • the timing controller may control the gate driver 207 to sequentially supply gate signals to the gate signal lines of the display panel 160 .
  • the timing controller may control the gate driver 207 to output a gate signal by distinguishing odd lines from even lines among the gate signal lines of the display panel 160 .
  • the timing controller may control generation and transmission of a digital gamma voltage according to the display area.
  • the timing controller may control signal generation of the general gamma generator 208 to generate a gamma voltage to be supplied to the first display area 161 .
  • the timing controller may control signal generation of the additional gamma generator 209 to generate a gamma voltage (or a gamma tap voltage) to be supplied to the second display area 162 .
  • the timing controller controls the source amplifier and the general gamma generator 208 and the additional gamma generator 209 so that the gamma voltage to be supplied to the corresponding sub-pixel is supplied to the decoder associated with the corresponding sub-pixel.
  • the output timing of the amplifier can be controlled (eg time-division driving).
  • the processor 140 or the timing controller generates a gamma voltage based on circuit elements corresponding to a sub-pixel designated by the general gamma generator 208 and transmits the generated gamma voltage to the decoder.
  • the supply timing of digital gamma voltages related to each sub-pixel may be controlled.
  • the processor 140 or the timing controller may control the gamma voltage generated in response to a designated sub-pixel at a designated timing to be transmitted to the source amplifiers through respective decoders.
  • the timing controller controls the output timing of the source amplifier by time division to generate an output of the source amplifier based on a digital gamma voltage corresponding to display data for each sub-pixel, and the generated output is supplied to the corresponding sub-pixel can be controlled as much as possible.
  • the graphic memory read controller may perform a read operation on line data stored in the graphic memory 203 .
  • the graphic memory read controller may perform a read operation on all or part of the line data stored in the graphic memory 203 based on a read command RCMD for the line data.
  • the graphic memory read controller may transmit all of the line data read from the graphic memory 203 or a part of the line data to the image processing unit.
  • the graphic memory write controller and the graphic memory read controller are separately described for convenience of description, they may be implemented as one graphic memory controller.
  • the image processing unit may process all of the line data or part of the line data transmitted from the graphic memory read controller to improve image quality.
  • the display data with improved image quality is transmitted to the timing controller, and the timing controller may transmit the display data to the source driver 206 through the data latch 205 .
  • the image processing unit may include a first gamma voltage table for driving the first display area 161 and a second gamma voltage table for driving the second display area 162 .
  • the timing controller may include a first gamma voltage table for driving the first display area 161 and a second gamma voltage table for driving the second display area 162 .
  • the source shift register controller may control a data shifting operation of the data shift register. According to an embodiment, the source shift register controller may control writing line data of the graphic memory 203 and image preprocessing of the image processing unit in response to a command received from the processor 140 .
  • the data shift register may shift the display data transmitted through the source shift register controller under the control of the source shift register controller.
  • the data shift register may sequentially transmit shifted display data to the data latch 205 .
  • the graphic memory 203 may store line data input through the graphic memory write controller under the control of the graphic memory write controller.
  • the graphic memory 203 may operate as a buffer memory in the display driving circuit 200 .
  • the graphic memory 203 may include a graphic random access memory (GRAM).
  • the data latch 205 may store display data sequentially transferred from the data shift register.
  • the data latch 205 may transmit the stored display data to the source driver 206 in units of horizontal lines of the display panel 160 .
  • the source driver 206 may transmit line data transmitted from the data latch 205 to the display panel 160 .
  • the source driver 206 may include a plurality of source amplifiers connected to sub-pixels (or for each channel corresponding to the sub-pixels).
  • the source amplifiers included in the source driver 206 may operate in time division to supply signals to respective sub-pixels.
  • the source amplifiers included in the source driver 206 may be connected to a plurality of sub-pixels of the same or different types.
  • the source driver 206 may include source amplifiers connected for each sub-pixel (eg, R sub-pixel, G sub-pixel, and B sub-pixel).
  • the source driver 206 may include a plurality of decoders connected to input terminals of source amplifiers to which sub-pixels are connected.
  • the decoder is connected to the output terminal of the general gamma generation unit 208 and the additional gamma generation unit 209 and the logic circuit 202 , and includes display data transferred from the logic circuit 202 and the normal gamma generation unit 208 and the addition unit.
  • the gamma voltage provided by the gamma generator 209 may be decoded (or multiplied). Each decoder output may be coupled to respective source amplifiers.
  • the decoder connected to the source amplifiers allocated to the first display area 161 has a first number of grayscales (eg, 256 when the display data consists of 8 bits).
  • a gamma voltage corresponding to one of the grayscale values may be selected.
  • a second number (eg, a number greater than the first number) of decoders connected to source amplifiers arranged to supply signals to the second display area 162 .
  • a gamma voltage corresponding to one of the grayscale values may be selected.
  • a decoder connected to source amplifiers arranged to supply signals to the second display region 162 may be connected to the first display region 161 disposed below on the same plane as the second display region 162 .
  • One of 256 grayscale values to be supplied and a predetermined number of grayscale values to be supplied to the second display area 162 may be selected.
  • a predetermined number of grayscale values to be supplied to the second display area 162 have, for example, a smaller number of grayscale values than the 256 grayscale values, but have different sizes from the 256 grayscale values to be supplied to the first display area 161 . It can have a gamma voltage of Alternatively, a gamma voltage different from the gamma voltage supplied to the sub-pixel of the first display area 161 may be supplied to the sub-pixel of the second display area 162 .
  • the level of the first gamma voltage of 256 gradations that is the highest brightness value of the signal (eg, any one of R, G, and B) to be supplied to the first display area 161 and the signal to be supplied to the second display area 162 may be different from each other.
  • the second gamma voltage level may be N times the first gamma voltage level (where N is a real number, float).
  • the first gamma voltage level and the second gamma voltage level may be different according to a difference between the pixel arrangement density of the second display area 162 and the pixel arrangement density of the first display area 161 .
  • the first gamma voltage to be supplied to the first display area 161 and the second gamma to be supplied to the second display area 162 in a relatively low low grayscale region may be the same or similar.
  • a first gamma voltage to be supplied to the first display area 161 and a second gamma voltage to be supplied to the second display area 162 in a relatively high grayscale region eg, a grayscale value of 101 or more
  • the magnitude may be set differently (eg, the magnitude of the second gamma voltage in the high grayscale region is set to be greater than the magnitude of the first gamma voltage).
  • a difference between the magnitude of the first gamma voltage and the magnitude of the second gamma voltage may be different according to ambient illuminance.
  • a lookup table or a gamma voltage table corresponding to a gamma voltage curve disposed in at least one of the timing controller or the image processing unit (basically, a first gamma voltage table to be applied to the first display area 161 ; 2 In the second gamma voltage table to be applied to the display area 162), a plurality (eg, tables corresponding to different gamma voltage curves for each display area and for each external illuminance) may be stored in a predetermined external illuminance unit. there is.
  • the processor 140 may determine which gamma voltage table to use according to the external illuminance, and may supply a corresponding control signal to the display driving circuit 200 .
  • the gate driver 207 may drive gate lines of the display panel 160 .
  • the gate driver 207 may sequentially supply gate signals to the gate lines of the display panel 160 under the control of the logic circuit 202 .
  • the gate driver 207 may divide the gate lines of the display panel 160 into odd lines or even lines according to the control of the logic circuit 202 , and supply gate signals to the divided lines, respectively.
  • the gate driver 207 may include a plurality of gate drivers (eg, a left gate driver and a right gate driver). As described above, as the operation of pixels implemented in the display panel 160 is controlled by the source driver 206 and the gate driver 207 , the display data input from the processor 140 (or corresponding to the display data) image) may be displayed on the display panel 160 .
  • the general gamma generator 208 may generate and supply a gamma voltage (or gamma tap voltage) related to brightness control of the display panel 160 based on circuit elements for each sub-pixel.
  • the general gamma generator 208 generates a gamma signal, eg, an analog gamma voltage, corresponding to at least one of a first color (eg, red), a second color (eg, green), and a third color (eg, blue). and the generated analog gamma voltage may be supplied to the source driver 206 .
  • the analog gamma voltage may be generated based on the stored first gamma voltage curve corresponding to the specified color.
  • the general gamma generator 208 may generate an analog gamma voltage to be supplied to the first display area 161 based on the first gamma voltage curve, and may supply the generated analog gamma voltage to decoders. .
  • the general gamma generator 208 generates a gamma voltage for each sub-pixel to be supplied to the first display area 161 in a time-division form in response to the control of the logic circuit 202 and sends it to the source driver 206 .
  • the general gamma generator 208 generates a gamma voltage to be supplied to each sub-pixel disposed in the first display area 161 every one horizontal synchronization (Hsync) period, and applies the generated gamma voltage to the source driver 206 . ) can be supplied.
  • the length of one horizontal synchronization (Hsync) period may vary depending on the driving frequency value of the display panel.
  • the additional gamma generator 209 may generate and supply a gamma voltage (or gamma tap voltage) related to luminance control of the display panel 160 based on circuit elements for each sub-pixel disposed in the second display area 162 . there is.
  • the additional gamma generator 209 may generate a common analog gamma voltage to be supplied to the second display area 162 irrespective of a color and supply it to the source driver 206 .
  • the analog gamma voltage generated by the additional gamma generator 209 may be generated based on the stored second gamma voltage curve corresponding to the designated color.
  • the additional gamma generator 209 may generate an analog gamma voltage to be supplied to the second display area 162 based on the second gamma voltage curve, and may supply the generated analog gamma voltage to decoders. .
  • the additional gamma generator 209 generates a gamma voltage for each sub-pixel to be supplied to the second display area 162 in a time-division form in response to the control of the logic circuit 202 and supplies it to the source driver 206 .
  • the analog gamma voltage to be supplied to the second display area 162 may be generated and supplied by a gamma generator related to any one sub-pixel of the general gamma generator 208 .
  • FIG. 4 is a diagram illustrating an example of a partial configuration of a display panel and a display driving circuit according to an embodiment.
  • some components of the electronic device 100 include a first display area 161 and a second display area 162 of a pantile layout (or type), a source driver 206 , and a general gamma generator ( 208 , an additional gamma generator 209 , a first logic circuit 202a and a second logic circuit 202b .
  • the pantile-type first display area 161 has, for example, a plurality of gate lines (Gn, Gn+1, Gn+2) and four source lines (Sn, Sn+1, Sn+2, Sn+). 3) may include an intersecting display area.
  • the display panel 160 is a first source supplying display data to the gate lines (Gn, Gn+1, Gn+2) and the source lines (Sn, Sn+1, Sn+2, Sn+3). It may further include a non-display area on which the driver 206a and the gate driver 207 for supplying the gate signal are mounted. Alternatively, the above-described display driving circuit 200 may be disposed in a non-display area of the display panel 160 .
  • the gate lines Gn, Gn+1, and Gn+2 of the first display area 161 include, for example, odd gate lines Gn and Gn+2 and even gate lines Gn+1. can do.
  • the odd gate lines Gn and Gn+2 and the even gate lines Gn+1 may be alternately supplied with gate signals.
  • RGBG sub-pixels may be repeatedly disposed on the odd-numbered gate lines Gn and Gn+2 to form one pixel.
  • BGRG sub-pixels may be repeatedly disposed on the even-numbered gate lines Gn+1 to form one pixel (or one sub-pixel group).
  • the above-described RGBG order has substantially the same pattern as the BGRG, but may be arranged in a different start order or end order.
  • the source lines Sn, Sn+1, Sn+2, Sn+3 are a first channel Sn in which red sub-pixels and blue sub-pixels are alternately disposed, and a second channel in which first green sub-pixels are disposed. It may include a channel Sn+1, a third channel Sn+2 in which blue sub-pixels and red sub-pixels are alternately disposed, and a fourth channel Sn+3 in which second green sub-pixels are disposed. .
  • the above-described source lines Sn, Sn+1, Sn+2, and Sn+3 may include a group of four sub-pixels included in one pixel.
  • a pad connected to the output terminals of the amplifiers of the first source driver 206a can be placed.
  • the source driver 206 includes a first source driver 206a that supplies signals to channels of the first display area 161 and a second source driver 206a that supplies signals to channels of the second display area 162 . 206b).
  • the first source driver 206a and the second source driver 206b are integrated in one source driver 206, are disposed in one body, and may be classified differently depending on a region to which a source signal is supplied.
  • the first source driver 206a may include source driver elements that supply a source signal only to the first display area 161
  • the second source driver 206b may include the first display area 161 and the second display area 161 . It may include source driver elements that supply a source signal to the display area 162 .
  • the first source driver 206a includes, for example, a first amplifier 311 for supplying a signal to a first channel Sn among the source lines Sn, Sn+1, Sn+2, and Sn+3, a second
  • the second amplifier 312 supplies a signal to the channel Sn+1
  • the third amplifier 313 supplies a signal to the third channel Sn+2, and supplies a signal to the fourth channel Sn+3.
  • a fourth amplifier 314 may be included.
  • the first source driver 206a includes a first switch 301 connected to an output terminal of the first amplifier 311 , a second switch 302 connected to an output terminal of the second amplifier 312 , and a third It may include a third switch 303 connected to the output terminal of the amplifier 313 and a fourth switch 304 connected to the output terminal of the fourth amplifier 314 .
  • a control signal of each of the switches may be provided from, for example, a timing controller that has received a control signal of the processor 140 .
  • the first source driver 206a includes a first decoder 321 disposed at the input end of the first amplifier 311 , a second decoder 322 disposed at the input end of the second amplifier 312 , and a third amplifier ( It may include a third decoder 323 disposed at the input terminal of the 313 , and a fourth decoder 324 disposed at the input terminal of the fourth amplifier 314 .
  • the first to fourth decoders 321 , 322 , 323 , and 324 may receive display data and a digital gamma value associated with driving the first display area 161 from the first logic circuit 202a. Also, the first to fourth decoders 321 , 322 , 323 , and 324 may receive the output of the general gamma generator 208 .
  • the general gamma generator 208 includes, for example, a first gamma generator 208a that generates an analog gamma value related to a color of a first sub-pixel (eg, a red sub-pixel) and supplies it to the first decoder 321 ;
  • the second gamma generator 208c generates analog gamma values related to the colors of the second and fourth sub-pixels (eg, Green sub-pixels) and supplies them to the second decoder 322 and the fourth decoder 324 )
  • a third gamma generator 208b that generates an analog gamma value related to a color of a third sub-pixel (eg, a blue sub-pixel) and supplies the generated analog gamma value to the third decoder 323 .
  • the logic circuit 202 may include a first logic circuit 202a and a second logic circuit 202b. Meanwhile, the first logic circuit 202a and the second logic circuit 202b are divided into a first display area 161 and a second display area 162 for supplying display data and a digital gamma value. It may be composed of an integrated circuit or may be composed of two logic circuits.
  • the first logic circuit 202a is configured to provide display data to be supplied to each of the source lines Sn, Sn+1, Sn+2, and Sn+3 by first to fourth decoders 321 and 322 arranged for each channel. , 323, 324) can be supplied. In the above description, one pixel (eg, a group of RGBG sub-pixels) has been described as an example. In the first display area 161 in which a plurality of pixels are disposed, the first logic circuit 202a corresponds to each pixel. display data may be supplied to the source lines.
  • the second display area 162 has, for example, a plurality of gate lines Gn, Gn+1, Gn+2 and source lines Sm, Sm+1, Sm+2, and Sm+3 intersecting each other. It may include a display area.
  • the display panel 160 is a second source that supplies display data to the gate lines Gn, Gn+1, Gn+2 and the source lines Sm, Sm+1, Sm+2, and Sm+3. It may further include a non-display area on which the driver 206b and the gate driver 207 for supplying the gate signal are mounted. Alternatively, the above-described display driving circuit 200 may be disposed in a non-display area of the display panel 160 .
  • One logic circuit in which the first source driver 206a and the second source driver 206b are integrated may be disposed in a non-display area of the display panel 160 . Also, a first gate driver for driving odd-numbered gate lines and a second gate driver for driving even-numbered gate lines may be disposed in a non-display area of the display panel 160 .
  • the gate lines Gn, Gn+1, and Gn+2 of the second display area 162 are identical to the first display area 161, for example, the odd gate lines Gn and the even gate lines (Gn). Gn+1). Similarly to the first display area 161 , gate signals may be alternately supplied to the odd gate lines Gn and the even gate lines Gn+1.
  • RGBG sub-pixels may be repeatedly disposed on the odd gate lines Gn (or even gate lines Gn+1) to form one pixel. can That is, a separate pixel may not be disposed on some gate lines in the second display area 162 .
  • separate pixels may not be disposed on some source lines.
  • some source lines and some gate lines may include areas not alternately disposed in pixels.
  • the source lines Sm, Sm+1, Sm+2, and Sm+3 are a fifth channel Sm in which red subpixels are alternately disposed, and a sixth channel Sm+ in which first green subpixels are disposed. 1), a seventh channel (Sm+2) in which the blue sub-pixels are disposed, and an eighth channel (Sm+3) in which the second green sub-pixels are disposed.
  • some sub-pixels may not be disposed in the second display area 162 among the source lines Sm, Sm+1, Sm+2, and Sm+3, and may be disposed below (or below) the second display area 162 .
  • sub-pixels may be disposed in a matrix form.
  • Pads connected to output terminals of amplifiers of the second source driver 206b may be disposed at channel ends of the source lines Sm, Sm+1, Sm+2, and Sm+3. Some of the source lines Sm, Sm+1, Sm+2, and Sm+3 may be disposed in the second display area 162 , and the remaining portions may be disposed in the first display area 161 .
  • the second source driver 206b includes, for example, a fifth amplifier 315 and a sixth supplying signal to a fifth channel Sm among the source lines Sm, Sm+1, Sm+2, and Sm+3.
  • the sixth amplifier 316 supplies a signal to the channel Sm+1
  • the seventh amplifier 317 supplies a signal to the seventh channel Sm+2
  • the eighth channel Sm+3 supplies a signal.
  • An eighth amplifier 318 may be included.
  • the second source driver 206b includes a fifth switch 305 connected to an output terminal of the fifth amplifier 315 , a sixth switch 306 connected to an output terminal of the sixth amplifier 316 , and a seventh switch 306 connected to the output terminal of the sixth amplifier 316 .
  • a seventh switch 307 connected to the output terminal of the amplifier 317 and an eighth switch 308 connected to the output terminal of the eighth amplifier 318 may be included.
  • a control signal of each of the switches may be provided from, for example, a timing controller that has received a control signal of the processor 140 .
  • the second source driver 206b includes a fifth decoder 325 disposed at the input end of the fifth amplifier 315, a sixth decoder 326 disposed at the input end of the sixth amplifier 316, and a seventh amplifier ( It may include a seventh decoder 327 disposed at the input terminal of the 317 , and an eighth decoder 328 disposed at the input terminal of the eighth amplifier 318 .
  • the fifth to eighth decoders 325 , 326 , 327 , and 328 provide display data from the second logic circuit 202b and digital gamma associated with driving the first display region 161 and the second display region 162 . value can be received. Also, the fifth to eighth decoders 325 , 326 , 327 , and 328 may receive the output of the normal gamma generator 208 and the output of the additional gamma generator 209 .
  • the additional gamma generator 209 generates, for example, analog gamma values (or analog gamma voltages) related to colors of sub-pixels disposed in the second display area 162 , in common to the fifth to eighth decoders 325 . , 326, 327, 328).
  • the analog gamma value supplied by the additional gamma generator 209 may include a gamma value set such that the brightness of the second display area 162 is the same as or similar to that of the surrounding first display area 161 . there is.
  • the second logic circuit 202b applies display data to be supplied to each of the source lines Sm, Sm+1, Sm+2, and Sm+3 and digital gamma values to fifth decoders to eighth decoders arranged for each channel. (325, 326, 327, 328) can be supplied.
  • the second logic circuit 202b may generate display data and digital gamma values to be supplied to the second display region 162 at a timing when a gate signal related to driving of the second display region 162 is supplied to a fifth decoder arranged for each channel.
  • to eighth decoders 325 , 326 , 327 , and 328 may be supplied.
  • the second logic circuit 202b has a first display disposed under the second display area 162 at a timing when a gate signal related to driving of the first display area 161 disposed under the second display area 162 is supplied.
  • Display data and digital gamma values for driving the region 161 may be supplied to the fifth to eighth decoders 325 , 326 , 327 , and 328 arranged for each channel.
  • the digital gamma value related to driving the second display area 162 and the digital gamma value related to driving the first display area 161 may be different even for the same source channels.
  • the fifth to eighth decoders 325 , 326 , 327 , and 328 include an input terminal capable of receiving 8-bit grayscale values supplied from the general gamma generator 208 and supplied from the additional gamma generator 209 . It has an input terminal capable of receiving a predetermined number of grayscale values, and can output one of the received grayscale values to the amplifiers.
  • the additional gamma generator 209 may provide, for example, 256 grayscale values to the fifth to eighth decoders 325 , 326 , 327 , and 328 in the same manner as the general gamma generator 208 .
  • the general gamma generator 208 may supply only a predetermined number, for example, 128 grayscale values, to the fifth to eighth decoders 325 , 326 , 327 , and 328 in common.
  • the analog gamma value generated by the general gamma generator 208 may be generated based on the first gamma curve region G1 of the illustrated graph.
  • the analog gamma value generated by the additional gamma generator 209 may be generated based on the second gamma curve region G2 of the illustrated graph.
  • switches may be disposed at the output terminal of the general gamma generator 208 .
  • first to third gamma output control switches 331 , 332 , and 333 may be respectively disposed at output terminals of the first to third gamma generators 208a , 208b and 208c .
  • a fourth gamma output control switch 334 may be disposed at an output terminal of the additional gamma generator 209 .
  • the first to fourth gamma output control switches 331 , 332 , 333 , and 334 may be controlled by a timing controller.
  • the first to third gamma output control switches 331 , 332 , and 333 may be turned off, and the fourth gamma output control switch 334 may be turned on.
  • the first display area 161 is driven, the first to third gamma output control switches 331 , 332 , and 333 may be turned on, and the fourth gamma output control switch 334 may be turned off.
  • FIG. 5 is a diagram illustrating an example of a partial configuration of a display panel and a display driving circuit according to an embodiment.
  • some components of the electronic device 100 include a first display area 161 and a second display area 162 , a source driver 206 , a general gamma generator 208 , It may include an additional gamma generator 209 , a first logic circuit 202a and a second logic circuit 202b.
  • the first display area 161 , the second display area 162 , the source driver 206 , the general gamma generator 208 , the first logic circuit 202a , and the second logic circuit 202b may have substantially the same configuration as each configuration described with reference to FIG. 4 .
  • the source driver 206 includes a first source driver 206a that receives display data and a digital gamma value from the first logic circuit 202a and a second source driver 206a that receives display data and a digital gamma value from the second logic circuit 202b. It may include a source driver 206b.
  • the first source driver 206a includes decoders and amplifiers that supply signals to source lines disposed only in the first display area 161
  • the second source driver 206b includes the second display area 162 .
  • decoders and amplifiers that supply signals to source lines disposed in the first display area 161 .
  • the display panel 160 of the electronic device 100 may include, for example, a first display area 161 having a first pixel arrangement density and a second display area 162 having a second pixel arrangement density. .
  • the first display area 161 may be disposed in an area adjacent to the second display area 162 .
  • the at least one gate line and the at least one source line disposed in the second display area 162 may include some of the gate lines and source lines disposed in the first display area 161 and It can be connected to some source lines.
  • the second display area 162 and the first display area 161 may be disposed on the source lines Sm, Sm+1, Sm+2, and Sm+3.
  • the additional gamma generator 209 is configured to generate a fifth channel Sm in which a red sub-pixel is disposed among the source lines Sm, Sm+1, Sm+2, and Sm+3 disposed in the second display area 162 .
  • a first additional gamma generator 209a supplying an analog gamma value to the fifth decoder 325 connected to
  • a second additional gamma generator 209c for supplying analog gamma values to the sixth decoder 326 and the eighth decoder 328 respectively connected to the eighth channel (Sm+3), the seventh channel on which the blue sub-pixel is disposed
  • a third additional gamma generator 209b may be included to supply an analog gamma value to the seventh decoder 327 connected to (Sm+2).
  • sub-pixels may not be disposed in the second display area 162 among the source lines Sm, Sm+1, Sm+2, and Sm+3, and may be disposed below (or below) the second display area 162 .
  • sub-pixels may be disposed in a matrix form.
  • Pads connected to output terminals of amplifiers of the second source driver 206b may be disposed at channel ends of the source lines (or source channels) Sm, Sm+1, Sm+2, and Sm+3. .
  • the first additional gamma generator 209a generates an analog gamma value related to driving of sub-pixels disposed in the second display area 162 of the fifth channel Sm, and the second display area 162 drives the second display area 162 .
  • the analog gamma value may be supplied to the fifth decoder 325 at a timing when the gate signal is supplied to the second display area 162 .
  • the second additional gamma generator 209c generates an analog gamma value related to driving of sub-pixels disposed in the second display area 162 among the sixth channel Sm+1 and the eighth channel Sm+3. can do.
  • the second additional gamma generator 209c may supply the generated analog gamma value to the sixth decoder 326 and the eighth decoder 328 at the timing when the gate signal is supplied to the second display area 162 .
  • the third additional gamma generator 209b may generate an analog gamma value related to driving of sub-pixels disposed in the second display area 162 of the seventh channel Sm+2.
  • the third additional gamma generator 209b may supply the generated analog gamma value to the seventh decoder 327 at a timing when the gate signal is supplied to the second display area 162 .
  • the analog gamma values generated by the first to third additional gamma generators 209a, 209c, and 209b are higher than the analog gamma values generated by the first to third additional gamma generators 208a, 208c, and 208b.
  • a value capable of generating a relatively high luminance may be generated.
  • the analog gamma value supplied by the additional gamma generator 209 indicates that the brightness of the second display area 162 of the area displaying the same content is the same as or similar to the brightness of the surrounding first display area 161 . It may include a gamma value set to have.
  • Outputs of the first gamma generator 208a and the first additional gamma generator 209a of the general gamma generator 208 may be supplied to the fifth decoder 325 .
  • the second logic circuit 202b supplies the display data to be supplied to the source lines Sm, Sm+1, Sm+2, and Sm+3 to the fifth to eighth decoders 325 , 326 , 327 , and 328 .
  • the second logic circuit 202b includes a digital gamma value for driving the second display area 162 of the fifth channel Sm, and second of the sixth channel Sm+1 and the eighth channel Sm+3.
  • the digital gamma value for driving the display region 162 and the digital gamma value for driving the second display region 162 of the seventh channel (Sm+2) are obtained by the fifth to eighth decoders 325, 326, 327, respectively. 328) can be supplied.
  • the second logic circuit 202b includes a digital gamma value for driving the first display area 161 of the fifth channel Sm, and a digital gamma value of the sixth channel Sm+1 and the eighth channel Sm+3.
  • the digital gamma value for driving the first display region 161 and the digital gamma value for driving the first display region 161 of the seventh channel (Sm+2) are obtained by the fifth to eighth decoders 325 and 326, respectively.
  • the digital gamma value supplied to each channel of the second display area 162 and the digital gamma value supplied to each channel of the first display area 161 may be set to different values for the same content.
  • a digital gamma value supplied to each channel of the second display area 162 is set to display the same content brighter than a digital gamma value supplied to each channel of the first display area 161 . may include.
  • the second logic circuit 202b for driving is separated from each other as an example, the present invention is not limited thereto.
  • the logic circuit may be physically provided as one configuration, and may generate and supply signals required for each area of each display panel 160 .
  • the digital gamma value related to driving the second display area 162 and the digital gamma value related to driving the first display area 161 may be different even for the same source channels.
  • switches are provided between the output terminals of the first to third additional gamma generators 209a , 209c , and 209b and the fifth to eighth decoders 325 , 326 , 327 , and 328 . can be placed. Also, switches may be disposed between the output terminal of the general gamma generator 208 and the fifth to eighth decoders 325 , 326 , 327 , and 328 . The switches disposed between the gamma generators and the decoders may operate separately in relation to driving the first display area 161 and driving the second display area 162 .
  • a switch disposed between the output terminal of the general gamma generator 208 and the fifth to eighth decoders 325 , 326 , 327 , and 328 according to timing controller control are in a turn-off state, and switches disposed between the output terminal of the additional gamma generator 209 and the fifth to eighth decoders 325 , 326 , 327 , and 328 may have a turn-on state.
  • switches disposed between the output terminal of the general gamma generator 208 and the fifth to eighth decoders 325 , 326 , 327 , and 328 turn according to timing controller control. Switches disposed between the output terminal of the additional gamma generator 209 and the fifth to eighth decoders 325 , 326 , 327 , and 328 may have a turn-off state.
  • FIG. 6 is a diagram illustrating an example of a partial configuration of a display panel and a display driving circuit according to an embodiment.
  • some components of the electronic device 100 include a first display area 161 and a second display area 162 , a source driver 206 , a gamma generator 208_1 , and a second display area 162 . It may include a first logic circuit 202a and a second logic circuit 202b.
  • the first display area 161 , the second display area 162 , the source driver 206 , the first logic circuit 202a , and the second logic circuit 202b have the respective configurations described with reference to FIG. 4 . and may have substantially the same configuration.
  • the source driver 206 includes a first source driver 206a and a second display area 162 and a first display area 161 disposed between the first display area 161 and the first logic circuit 202a; and a second source driver 206b disposed between the second logic circuit 202b. Meanwhile, the first source driver 206a and the second source driver 206b are divided by regions, and may be implemented by being integrated into one source driver.
  • the display panel 160 of the electronic device 100 may include, for example, a first display area 161 having a first pixel arrangement density and a second display area 162 having a second pixel arrangement density.
  • source lines Sn, Sn+1, Sn+2, and Sn+3 are disposed in the first display area 161
  • the second display area 162 and the first display area 161 are vertically disposed.
  • the first display area 161 is disposed under the second display area 162 based on the y-axis of the display panel 160, and the second display area 162 is the first display area ( 161 , and the first display area 161 and the second display area 162 are disposed on the same plane) are the source lines Sm, Sm+1, Sm+2, Sm+3 ) can be placed.
  • the gamma generator 208_1 may include a first gamma generator 208a, a second gamma generator 208c, and an additional gamma generator 208E.
  • the first gamma generating unit 208a and the second gamma generating unit 208c may include the source lines Sn, Sn+1, Sn+2, Sn+3 and the second display area disposed in the first display area 161 .
  • An analog gamma voltage may be applied to the source lines Sm, Sm+1, Sm+2, and Sm+3 disposed in the region 162 and the first display region 161 , respectively.
  • the first gamma generator 208a generates an analog gamma voltage to be supplied to the red sub-pixel and the blue sub-pixel disposed in the first display area 161 , and applies the generated analog gamma voltage to the red sub-pixel and the blue sub-pixel.
  • Each of the decoders (eg, the first decoder 321 and the third decoder 323 ) connected to the sub-pixel may be supplied.
  • the second gamma generator 208c generates an analog gamma voltage to be supplied to the first green subpixel and the second green subpixel disposed in the first display area 161 , and applies the generated analog gamma voltage to the first green subpixel and decoders (eg, the second decoder 322 and the fourth decoder 324 ) connected to the second Green sub-pixel, respectively.
  • a switch may be included.
  • a switch may be disposed between the output terminal of the first gamma generator 208a and the third decoder 323 .
  • the additional gamma generator 208E applies analog gamma voltages to the source lines Sm, Sm+1, Sm+2, and Sm+3 disposed in the second display area 162 and the first display area 161, respectively.
  • the additional gamma generator 208E may include decoders (eg, fifth to eighth decoders 325 , 326 , 327 , 328 ) connected to sub-pixels disposed in the second display area 162 , respectively.
  • a common analog gamma voltage to be supplied to the controllers may be generated, and the generated common analog gamma voltage may be supplied to the fifth to eighth decoders 325 , 326 , 327 , and 328 .
  • the source driver 206 may include a plurality of switches.
  • the source driver 206 includes a switch disposed between the output terminal of the first gamma generator 208a and the fifth decoder 325 , the output terminal of the first gamma generator 208a and the seventh decoder 327 .
  • the source driver 206 may further include a switch disposed at an output terminal of the additional gamma generator 208E.
  • the switches may be turned on or off according to the control of the timing controller.
  • the switches connected to the output terminal of the first gamma generator 208a and the output terminal of the second gamma generator 208c at the timing when the analog gamma voltage is supplied to the second display area 162 have a turn-off state
  • a switch disposed at the output terminal of the additional gamma generator 208E may have a turn-on state.
  • the switches connected to the output terminal of the first gamma generator 208a and the output terminal of the second gamma generator 208c are turned on at the timing when the analog gamma voltage is supplied to the first display area 161 .
  • a switch disposed at the output terminal of the additional gamma generator 208E may have a turn-off state.
  • the fifth to eighth decoders 325 , 326 , 327 , and 328 receive the output of the logic circuit 202 (eg, the second logic circuit 202b ) and the output of the gamma generator 208_1 as inputs, , can supply a signal to each of the amplifiers.
  • the fifth decoder 325 and the seventh decoder 327 include the analog gamma voltages of the first gamma generator 208a and the additional gamma generator 208E and the second logic circuit 202b. Display data supplied and a digital gamma value for driving the corresponding sub-pixel may be received.
  • the sixth decoder 326 and the eighth decoder 328 provide the analog gamma voltage of the second gamma generator 208c and the additional gamma generator 208E, the display data supplied by the second logic circuit 202b and the corresponding display data.
  • a digital gamma value for driving a sub-pixel may be received.
  • FIG. 7 is a diagram illustrating an example of a partial configuration of a display driving circuit according to an embodiment.
  • some components of the display driving circuit 200 include a general gamma generator 208 , an additional gamma generator 209 , a decoder 320 , a logic circuit 202 , and an amplifier ( 310) may be included.
  • the amplifier 310 may include at least one amplifier disposed in a source driver. The output of the amplifier 310 may be supplied to the display panel 160 through a pad. The amplifier 310 may receive the output of the decoder 320 , amplify the received output at a specified ratio, and then supply it to the display panel 160 .
  • the logic circuit 202 may supply display data and a digital gamma value to the decoder 320 and a control signal for controlling an output of the decoder 320 . According to an embodiment, the logic circuit 202 may supply a control signal of 8 bits or more to the decoder 320 .
  • the decoder 320 receives the output of the logic circuit 202 and the output of the general gamma generator 208 or the output of the additional gamma generator 209 , and outputs a specified signal value based on the received output to the amplifier 310 . ) can be printed. According to an embodiment, the decoder 320 may receive, for example, an output (eg, V0, V1, V2, ..., V255) of the general gamma generator 208 as an input. Also, the decoder 320 may receive an output (eg, Vm, ..., Vm+1) of the additional gamma generator 209 as an input.
  • the decoder 320 may be any one of decoders disposed in the source driver and connected for each sub-pixel.
  • the general gamma generator 208 may generate an analog gamma voltage corresponding to a specified grayscale value and supply the generated analog gamma voltage to the decoder 320 .
  • the general gamma generator 208 supplies 256 grayscale values to the decoder 320 with an analog gamma voltage corresponding to 256 grayscale values.
  • the additional gamma generator 209 may generate an analog gamma voltage supply to the sub-pixels disposed in the second display area 162 of the display panel, and supply the generated analog gamma voltage to the decoder 320 .
  • the number of grayscale values of the analog gamma voltage generated by the additional gamma generator 209 may vary according to a setting.
  • the additional gamma generator 209 may generate any one analog gamma voltage among 256 analog gamma voltages in the same way as the general gamma generator 208 .
  • the magnitude of the analog gamma value generated by the additional gamma generator 209 may be different from the analog gamma value generated by the general gamma generator 208 .
  • the magnitude of the analog gamma value generated by the additional gamma generator 209 may be greater (eg, twice or more) than the analog gamma value generated by the general gamma generator 208 .
  • the number of grayscale values generated by the additional gamma generator 209 may be less than 256, for example, 128.
  • the 128 grayscale values may include, for example, relatively high grayscale values. Accordingly, the additional gamma generator 209 generates an analog gamma voltage when it is necessary to express a grayscale value (eg, an analog gamma voltage greater than or equal to 128 grayscales) specified in the second display area 162 under the control of the processor 140 .
  • the general gamma generator 208 is controlled by the processor 140 . ) may generate an analog gamma voltage and supply the signal to the decoder 320 .
  • FIG. 8 is a diagram illustrating another example of a partial configuration of a display driving circuit according to an exemplary embodiment.
  • some components of the display driving circuit 200 include a general gamma generator 208 , an additional gamma generator 209 , a decoder 320 , a logic circuit 202 , and an amplifier ( 310) may be included.
  • the amplifier 310 may include at least one amplifier for each sub-pixel disposed in the source driver.
  • the output of the amplifier 310 may be supplied to the display panel 160 through a pad.
  • the amplifier 310 may receive the output of the decoder 320 , amplify the received output at a specified ratio, and then supply it to the display panel 160 .
  • the logic circuit 202 may supply display data and a digital gamma value to the decoder 320 and a control signal for controlling an output of the decoder 320 .
  • the logic circuit 202 may supply an 8-bit control signal to the decoder 320 .
  • the logic circuit 202 controls the signal generated by the additional gamma generator 209 to be supplied at a timing when the signal is supplied to the second display region 162 , and controls the signal to be supplied to the first display region 161 . It is possible to control the timing so that the signal generated by the general gamma generator 208 is supplied.
  • the decoder 320 receives the output of the logic circuit 202 and the output of the general gamma generator 208 or the output of the additional gamma generator 209 , and outputs a specified signal value based on the received output to the amplifier 310 . ) can be printed. According to an embodiment, the decoder 320 receives, for example, an output (eg, V0, V1, V2, ..., Vn, Vn+1, Vn_2, ..., V255) of the general gamma generator 208 as an input. can do. Also, the decoder 320 may receive an output (eg, Vn′, Vn+1′, Vn+2′, ..., V255) of the additional gamma generator 209 as an input.
  • an output eg, Vn′, Vn+1′, Vn+2′, ..., V255
  • the decoder 320 may be any one of decoders disposed in the source driver and connected for each sub-pixel. Some of the inputs from the normal gamma generation unit 208 of the decoder 320 overlap with the inputs from the additional gamma generation unit 209 , and one of the normal gamma generation unit 208 and the additional gamma generation unit 209 . Any one signal may be supplied as an input of the decoder 320 . In this regard, a portion of the output of the general gamma generator 208 may be connected to the output of the additional gamma generator 209 through a Mux (or a switch). The Mux(Mn, Mn+1, Mn+2, ..., M255) may have a number corresponding to the number of outputs of the additional gamma generator 209 .
  • the general gamma generator 208 may generate an analog gamma voltage corresponding to a specified grayscale value and supply the generated analog gamma voltage to the decoder 320 .
  • the general gamma generator 208 supplies 256 grayscale values to the decoder 320 with an analog gamma voltage corresponding to 256 grayscale values.
  • the additional gamma generator 209 may generate an analog gamma voltage supply to the sub-pixels disposed in the second display area 162 of the display panel, and supply the generated analog gamma voltage to the decoder 320 .
  • the output of the additional gamma generator 209 overlaps with some outputs of the general gamma generator 208, and any one of the outputs is selected through Mux(Mn, Mn+1, Mn+2, ..., M255).
  • the output may be supplied to a decoder 320 .
  • the number of grayscales generated by the additional gamma generator 209 may vary according to a set value.
  • the additional gamma generator 209 may generate any one of analog gamma values (eg, more than 128 grayscales) corresponding to grayscale values of relatively high grayscale and supply it to the decoder 320 . Even when the same grayscale is displayed, the magnitude of the analog gamma value generated by the additional gamma generator 209 may be different from the analog gamma value generated by the general gamma generator 208 .
  • FIG. 9 is a diagram illustrating an example of an output of a source driver according to an embodiment.
  • the source driver 206 may supply signals to the display panel 160 according to a plurality of horizontal synchronization signals during one vertical synchronization signal.
  • the R, G, and B gamma sets of the source driver 206 may maintain a turned-on state for a predetermined number of horizontal synchronization signals.
  • Source signals corresponding to Rn Source Output, Gn Source Output, and Bn Source Output may be supplied to the first display area 161 .
  • the output amplitude of the source signal supplied to the first display area 161 may have, for example, a first magnitude 901 .
  • Source signals corresponding to Rn′ Source Output, Gn′ Source Output, and Bn′ Source Output may be supplied to the second display area 162 .
  • the output amplitude of the source signal supplied to the second display area 162 may have, for example, a second magnitude 902 greater than the first magnitude 901 .
  • a difference between the first size 901 and the second size 902 may vary depending on the arrangement density of pixels disposed in the second display area 162 .
  • the difference between the first size 901 and the second size 902 may vary according to the brightness of the displayed content.
  • the difference between the first size 901 and the second size 902 may vary according to external illumination.
  • the difference between the first size 901 and the second size 902 may be larger when displaying relatively bright content or high grayscale content than when displaying relatively dark content or low grayscale content. there is.
  • FIG. 10 is a diagram illustrating an example of a display panel including various shapes of a second display area according to an exemplary embodiment.
  • the display panel 160 may include a first display area 161 and a second display area 162_1 including a predetermined size in the upper center, as in state 1001 .
  • the second display area 162_1 includes, for example, a first width T1 in a horizontal direction (eg, an x-axis direction) based on the illustrated drawing, and has a predetermined length in a vertical direction (eg, a y-axis direction). can have At least a portion of the second display area 162_1 may include a portion of an upper edge of the display panel 160 .
  • a lower portion eg, z-axis direction
  • at least one sensor eg, at least one of a camera sensor, a fingerprint sensor, a roughness sensor, and an iris sensor
  • the second display area 162_1 may be rounded except for the portion 1001 adjacent to the edge portion of the display panel 160 .
  • the second display area 162_1 may be disposed such that the remaining area except for the portion 1001 adjacent to the edge of the display panel 160 is surrounded by the first display area 161 .
  • the display panel 160 may include a first display area 161 and a second display area 162_2 having a predetermined size in the upper center, as in the state 1002 .
  • An upper portion of the second display area 162_2 may include a portion of an upper edge of the display panel 160 .
  • a portion of the upper edge of the second display area 162_2 may be included, and may be formed in a rectangular shape as a whole.
  • the display panel 160 may include a first display area 161 and a second display area 162_3 having a predetermined size in the upper center, as in the state 1003 .
  • An upper portion of the second display area 162_3 may include a portion of an upper edge of the display panel 160 .
  • a portion of an upper edge of the second display area 162_3 may have a second width T2 .
  • the second display area 162_3 may be formed in a rectangular shape as a whole and may be rounded.
  • the display panel 160 includes a first display area 161 and a 21st display area 162_4a and a 22nd display area 162_4b including a predetermined size in the upper center as in the 1004 state. can do.
  • Each of the twenty-first display area 162_4a and the twenty-second display area 162_4b may have a circular shape of a predetermined size.
  • the twenty-first display area 162_4a and the twenty-second display area may be disposed to be surrounded by the first display area 161 .
  • the twenty-first display area 162_4a and the twenty-second display area 162_4b may be arranged at regular intervals. Sensors may be respectively disposed under each of the twenty-first display area 162_4a and the twenty-second display area 162_4b (in the z-axis direction).
  • the display panel 160 may include a first display area 161 and a second display area 162_5 having a predetermined size on the upper right side, as in the state 1005 .
  • the second display area 162_5 may be provided in an elliptical shape with an x-axis longer than a y-axis or a rectangular shape with rounded corners.
  • a plurality of sensors may be disposed under the second display area 162_5 (in the z-axis direction). For example, a fingerprint sensor and a camera may be respectively disposed under the second display area 162_5 . Alternatively, the iris sensor and the RGB camera may be respectively disposed under the second display area 162_5 .
  • FIG. 11 is a diagram illustrating an example in which an additional gamma driver is disposed on the left side of a display driving circuit according to an exemplary embodiment.
  • the display driving circuit 200 includes a logic circuit 202 , a source driver 206 , a gate driver 207 , and a graphics memory 203 .
  • the display panel 160 includes, for example, an area in which the second display area 162 having a relatively smaller pixel arrangement density and the first display area 161 having a relatively higher pixel arrangement density share the same source line; , an area including only the first display area 161 may be included.
  • a shape in which the second display area 162 and the first display area 161 are disposed on the left area of the display panel 160 is shown.
  • the additional gamma generator 209 may be disposed biased to the left.
  • the analog gamma voltage generated by the additional gamma generator 209 may be supplied to decoders of a source driver associated with the second display area 162 at a timing when a signal is supplied to the second display area 162 .
  • the general gamma generator 208 may be disposed in the center of the display driving circuit 200 and may generate and supply analog gamma voltages to decoders related to the first display area 161 evenly arranged from left to right. .
  • At least one sensor may be disposed under the second display area 162 (eg, in a direction opposite to the direction in which light is emitted from the display panel 160 ).
  • the first display area 161 of the display panel 160 may be evenly disposed over the entire display panel 160 , and at least a portion of the second display area 162 may be disposed within the first display area 161 . Accordingly, at least a portion of the second display area 162 may be disposed to be surrounded by the first display area 161 .
  • FIG. 12 is a diagram illustrating an example in which an additional gamma driver is disposed at the center in a display driving circuit according to an exemplary embodiment.
  • the display driving circuit 200 includes a logic circuit 202 , a source driver 206 , a gate driver 207 , and a graphic memory 203 .
  • the display panel 160 includes, for example, an area in which the second display area 162 having a relatively smaller pixel arrangement density and the first display area 161 having a relatively higher pixel arrangement density share the same source line; , an area including only the first display area 161 may be included.
  • a shape in which the second display area 162 and the first display area 161 are disposed in the central area of the display panel 160 is illustrated.
  • the display driving circuit 200 includes an additional gamma generator 209 to supply the analog gamma voltage to the second display area 162 disposed in the center of the display panel 160 in order to optimize the supply route of the analog gamma voltage. It can be placed in the center.
  • the analog gamma voltage generated by the additional gamma generator 209 may be supplied to decoders of a source driver associated with the second display area 162 at a timing when a signal is supplied to the second display area 162 .
  • the general gamma generator 208 may be disposed in the center of the display driving circuit 200 and may generate and supply analog gamma voltages to decoders related to the first display area 161 evenly arranged from left to right. .
  • the normal gamma generator 208 and the additional gamma generator 209 may be arranged side by side in the center.
  • a camera may be disposed under the second display area 162 (eg, in a direction opposite to the direction in which light is emitted from the display panel 160 ), and the second display area 162 is a display panel It may be arranged to be biased toward the upper end of 160 .
  • FIG. 13 is a diagram illustrating an example in which an additional gamma driver is disposed on a right side in a display driving circuit according to an exemplary embodiment.
  • the display driving circuit 200 includes a logic circuit 202 , a source driver 206 , a gate driver 207 , and a graphics memory 203 .
  • the display panel 160 may include a first display area 161 having a first pixel arrangement density and a second display area 162 having a second pixel arrangement density lower than the first pixel arrangement density.
  • Some of the source lines supplying the source signal may be disposed only in the first display area 161 , and the remaining portions may be disposed in the first display area 161 and the second display area 162 .
  • a shape in which the second display area 162 and the first display area 161 are disposed on the right area of the display panel 160 is shown.
  • the display driving circuit 200 includes an additional gamma generator 209 to supply the analog gamma voltage to the second display area 162 disposed on the right side of the display panel 160 in order to optimize the supply route of the analog gamma voltage. It may be placed on the right.
  • the analog gamma voltage generated by the additional gamma generator 209 may be supplied to decoders of a source driver associated with the second display area 162 at a timing when a signal is supplied to the second display area 162 .
  • the general gamma generator 208 may be disposed in the center of the display driving circuit 200 and may generate and supply analog gamma voltages to decoders related to the first display area 161 evenly arranged from left to right. .
  • an iris sensor or an RGB camera may be disposed below the second display area 162 (eg, in a direction opposite to the direction in which light is emitted from the display panel 160 ), and the second display area 162 . ) may be disposed to be biased toward the upper right of the display panel 160 .
  • FIG. 14 is a diagram illustrating an example in which an additional gamma driver is disposed at various positions in a display driving circuit according to an exemplary embodiment.
  • the display driving circuit 200 includes a logic circuit 202 , a source driver 206 , a gate driver 207 , and a graphics memory 203 as described above, and in the illustrated figure For convenience of description, only some components including the general gamma generator 208 and the additional gamma generator 209 are illustrated.
  • the display panel 160 includes a first display area 161 having a first pixel arrangement density and twenty-first to twenty-third display areas 162a, 162b, and 162c having a second pixel arrangement density lower than the first pixel arrangement density. ) may be included.
  • the pixel arrangement densities of the twenty-first to twenty-third display regions 162a, 162b, and 162c may be different.
  • the pixel arrangement density of the display area in which the RGB camera is disposed is relatively low and the pixel arrangement density of the display area in which the illuminance sensor or the proximity sensor is disposed may be formed to be relatively high.
  • a 21st display area 162a is disposed on the left area of the display panel 160
  • a 22nd display area 162b is disposed on the center area
  • a 23rd display area 162c is disposed on the right area of the display panel 160 . It shows the arranged shape.
  • the source is provided in the twenty-first to twenty-third display regions 162a, 162b, and 162c.
  • Source lines for supplying signals may be disposed to supply source signals to the twenty-first to twenty-third display regions 162a , 162b , and 162c through the first display region 161 .
  • the 22nd display area 162b may be disposed to be biased under the display panel 160 .
  • the additional gamma generators 209_1 , 209_2 , and 209_3 correspond to the corresponding twenty-first to twenty-third display regions 162a , 162b , and 162c in order to optimize the supply route of the analog gamma voltage. It may be disposed in the display driving circuit 200 of the position.
  • the first additional gamma generator 209_1 corresponding to the twenty-first display area 162a is disposed to the left of the display driving circuit 200
  • the second additional gamma generator 209_1 corresponding to the twenty-second display area 162b is disposed.
  • the part 209_2 may be disposed at the center of the display driving circuit 200 , and the third additional gamma generator 209_3 corresponding to the twenty-third display area 162c may be disposed biased toward the right side of the display driving circuit 200 .
  • the analog gamma voltages generated by the first to third additional gamma generators 209_1 , 209_2 , and 209_3 may be set to different values according to the type or characteristic of a sensor to be operated. For example, in the 22nd display area 162b on which the fingerprint sensor is disposed, when the fingerprint is sensed, content having a relatively higher luminance than that of the content displayed on the first display area 161 is displayed. It may be set to supply an analog gamma voltage.
  • analog gamma voltages are supplied differently correspondingly (for example, even the same grayscale value has different sizes).
  • voltage can be supplied).
  • the electronic device includes gamma correction tables (eg, the 21st display area) for driving the first display area 161 and the 21st display area 162a to the 23rd display area 162c, respectively.
  • a first gamma correction table for driving 162a , a second gamma correction table for driving the 22nd display region 162b , a third gamma correction table for driving the 23rd display region 162c , and a first display region 161 may include a gamma correction table for driving).
  • a gamma correction table for driving may include a gamma correction table for driving.
  • between the first display area 161 and the 21st display area 162a between the first display area 161 and the 22nd display area 162b , or the first display area 161 .
  • a pixel arrangement density between the pixel and the twenty-third display area 162c may be different from a neighboring pixel arrangement density.
  • the pixel density may gradually decrease from the first display area 161 to the twenty-first display area 162a, the 22nd display area 162b, or the 23rd display area 162c.
  • the pixel density may gradually decrease from the 21st display area 162a , the 22nd display area 162b , or the 23rd display area 162c to the first display area 161 .
  • the electronic device may provide a gradation effect in which a gradation value is gradually changed at the boundary of at least one of the twenty-first display region 162a, the twenty-second display region 162b, and the twenty-third display region 162c.
  • the display driving circuit 200 is disposed between the first display area 161 and the twenty-first display area 162a, or between the first display area 161 and the twenty-second display area 162b, or the second display area 162b.
  • At least one gamma correction table corresponding to a pixel arrangement density in at least one boundary area among boundary areas between the first display area 161 and the 23rd display area 162c is generated and operated in correspondence to the pixel arrangement density can do.
  • the boundary areas eg, between the first display area 161 and the 21st display area 162a , between the first display area 161 and the 22nd display area 162b , or the first display area
  • At least one gamma correction table for a gradual screen change in may be generated or stored in advance, and pixel driving in the corresponding boundary area may be processed based on this.
  • the at least one gamma correction table may be stored in a memory disposed in the display driving circuit 200 or disposed in a memory accessible by an application processor.
  • the electronic device drives the first gamma value for driving the first display area 161 and the second gamma value (or the 22nd display area 162b) for driving the 21st display area 162a.
  • the intermediate gamma value of the second gamma value for driving the twenty-third display area 162c or the second gamma value for driving the twenty-third display area 162c) may be calculated, and pixel driving in the boundary area may be performed based on the calculated value.
  • the electronic device may provide a gradation effect by software-generating a gradation mask in which a color is gradually changed in a boundary area and applying it to the boundary area.
  • 15 is a diagram illustrating an example of driving a display panel according to an exemplary embodiment.
  • the second display area 162 of the display panel 160 may have a pan-tile type sub-pixel arrangement as described above.
  • the second display area 162 of the display panel 160 may have a stripe-type sub-pixel arrangement as illustrated.
  • pixels may be disposed in some of the pixel disposable areas divided in a matrix form, and pixels may not be disposed in the remaining pixel disposable areas.
  • the second display area 162 may have a lower pixel arrangement density than that of the first display area in which pixels (or sub-pixels) are arranged in a matrix form without an empty area.
  • the display panel 160 drives the source once every two horizontal synchronization periods (horizontal time) to ensure that the scan on time of the OLED is maintained, and complete content display can be realized through time division driving.
  • the physical number of the gamma generators 209 can be reduced by half.
  • the first display area 161 RGBG sub-pixels in which odd-numbered gate lines and even-numbered gate lines are alternately driven may be driven for each line.
  • the second display area 162 the red and blue subpixels are driven while the even-numbered gate line and the even-numbered source line are driven, and the two green subpixels are driven while the odd-numbered gate line and the odd-numbered source line are driven.
  • the additional gamma generator 209 supplies an analog gamma voltage for driving control of some sub-pixels while the source line and the gate line are controlled to be alternately driven. It can be driven using a driving unit.
  • an electronic device includes a display panel including a first display area and a second display area, the first display area including sub-pixels distributed at a first density, and the a second display area includes sub-pixels distributed at a second density lower than the first density; and a display driving circuit related to driving the display panel, wherein the display driving circuit includes a source disposed in the first display area a general gamma generator for supplying a gamma signal to the lines; A gamma signal set to emit a relatively higher luminance value than a gamma signal supplied to the first display area may be set to be supplied to the second display area.
  • At least one sensor when looking down at the display panel (or looking down at the upper surface of the display panel), at least one sensor is located below the second display area in a direction looking down on the display panel. Some may be placed.
  • the at least one sensor may include an RGB camera.
  • the at least one sensor may include a fingerprint sensor.
  • the first display area may be disposed to surround at least one surface of the second display area (or at least a portion of the periphery of the second display area).
  • the additional gamma generator may be configured to supply a common gamma voltage signal having the same size to each of the subpixels disposed in the second display area.
  • the additional gamma generator includes a first additional gamma generator configured to generate a red gamma signal set to display a luminance relatively higher than that of the red sub-pixels disposed in the first display area, the first display area a second additional gamma generator generating a green gamma signal set to display a luminance relatively higher than that of the green sub-pixel disposed in A third additional gamma generator for generating a blue gamma signal may be included.
  • the general gamma generator includes a first gamma generator that supplies gamma signals to the red sub-pixel and the blue sub-pixel disposed in the first display area, and the green sub-pixels disposed in the first display area.
  • a second gamma generator for supplying a gamma signal to the gamma generator; It may be set to supply a gamma signal in common to .
  • the general gamma generator is disposed at the center of the display driving circuit, and the additional gamma generator is positioned at a position in the display driving circuit corresponding to a position of a signal line that supplies a signal to the second display area. can be placed.
  • a position of the additional gamma generator in the display driving circuit may correspond to a position of a signal line supplying a signal to the second display area.
  • the second display area may be disposed on at least one of a left edge, a center, and a right edge of the display panel, and the additional gamma generator may include at least one of a left edge, a center, and a right edge of the display driving circuit. can be placed anywhere.
  • the second display area when the display panel is a polygon (eg, a rectangle) or a circle, the second display area may be disposed on at least one of a left edge, a center, and a right edge around the center of the display panel.
  • the additional gamma generator may also be adjacent to the second display area and be disposed at at least one of a left edge, a center, and a right edge.
  • the display driving circuit may alternately operate an odd-numbered gate line, an odd-numbered source line, and an even-numbered gate line and an even-numbered gate line, respectively, of the second display area.
  • the display driving circuit includes source lines supplying signals to the first display area and the second display area, amplifiers connected to the source lines, and decoders connected to the amplifiers,
  • the decoders may receive grayscale values of the normal gamma generator and the additional gamma generator as inputs, and output any one of the received grayscale values to the amplifier.
  • the display driving circuit may include source lines supplying signals to the first display area and the second display area, amplifiers connected to the source lines, decoders connected to the amplifiers, and the general
  • the apparatus may further include a plurality of muxes for muxing a partial output of the gamma generator and an output of the additional gamma generator and supplying the gamma signal of the general gamma generator or the gamma signal of the additional gamma generator to the decoders according to control.
  • the first magnitude of the output of the source signal of the first display area may be different from the second magnitude of the output of the source signal of the second display area.
  • the difference between the first size and the second size may correspond to a difference between the densities of the sub-pixels of the first display area and the densities of the sub-pixels of the second display area.
  • the difference between the first size and the second size is large, the difference between the densities of the sub-pixels of the first display area and the densities of the sub-pixels of the second display area is large, and the first size and the When the difference between the second sizes is small, the difference between the densities of the sub-pixels of the first display area and the densities of the sub-pixels of the second display area may be small.
  • This setting is an example, and may be set in the reverse case (eg, when the difference in density is large, the difference in size is small, and when the difference in density is small, the difference in size is large).
  • the display driving circuit may be configured such that the output size of the source signal of the second display area is equal to or similar to the color and luminance of the same content output to the first display area and the second display area. can be controlled
  • the display driving circuit receives display data from a processor, and the display driving circuit is arranged at a first pixel arrangement density in the display panel. While supplying the first gamma signal set to display the luminance of the first size to the displayed first display area, the second display area having a second pixel arrangement density lower than the first pixel arrangement density is larger than the first size.
  • the method may include supplying a second gamma signal set to display a luminance of a second magnitude.
  • the supplying of the second gamma signal may include supplying a second gamma signal having the same voltage to the red sub-pixel, the green sub-pixel, and the blue sub-pixel disposed in the second display area in common. may include the step of
  • the supplying of the second gamma signal includes generating a second gamma signal for each sub-pixel disposed in the second display area, and applying the generated second gamma signal for each sub-pixel to the corresponding sub-pixel. and supplying source lines connected to the pixel.
  • the supplying of the second gamma signal may include alternating odd-numbered gate lines, odd-numbered source lines, even-numbered gate lines, and even-numbered source lines disposed in the second display area. and supplying the second gamma signal to
  • 16 is a block diagram of an electronic device 1601 in a network environment 1600, according to various embodiments.
  • the electronic device 1601 communicates with the electronic device 1602 through a first network 1698 (eg, a short-range wireless communication network) or a second network 1699 . It may communicate with the electronic device 1604 or the server 1608 through (eg, a long-distance wireless communication network). According to an embodiment, the electronic device 1601 may communicate with the electronic device 1604 through the server 1608 .
  • the electronic device 1601 includes a processor 1620 , a memory 1630 , an input device 1650 , a sound output device 1655 , a display device 1660 , an audio module 1670 , and a sensor module ( 1676 , interface 1677 , haptic module 1679 , camera module 1680 , power management module 1688 , battery 1689 , communication module 1690 , subscriber identification module 1696 , or antenna module 1697 ) ) may be included.
  • at least one of these components eg, the display device 1660 or the camera module 1680
  • some of these components may be implemented as one integrated circuit.
  • the sensor module 1676 eg, a fingerprint sensor, an iris sensor, or an illuminance sensor
  • the display device 1660 eg, a display.
  • the processor 1620 for example, executes software (eg, a program 1640) to execute at least one other component (eg, hardware or software component) of the electronic device 1601 connected to the processor 1620. It can control and perform various data processing or operations. According to one embodiment, as at least part of data processing or computation, the processor 1620 converts commands or data received from other components (eg, the sensor module 1676 or the communication module 1690) to the volatile memory 1632 . may be loaded into the volatile memory 1632 , process commands or data stored in the volatile memory 1632 , and store the resulting data in the non-volatile memory 1634 .
  • software eg, a program 1640
  • the processor 1620 converts commands or data received from other components (eg, the sensor module 1676 or the communication module 1690) to the volatile memory 1632 .
  • the volatile memory 1632 may be loaded into the volatile memory 1632 , process commands or data stored in the volatile memory 1632 , and store the resulting data in the non-volatile memory 1634 .
  • the processor 1620 includes a main processor 1621 (eg, a central processing unit or an application processor), and a secondary processor 1623 (eg, a graphics processing unit, an image signal processor) that can operate independently or in conjunction with the main processor 1621 (eg, a graphics processing unit or an image signal processor). , a sensor hub processor, or a communication processor). Additionally or alternatively, the auxiliary processor 1623 may be configured to use less power than the main processor 1621 or to specialize in a designated function. The coprocessor 1623 may be implemented separately from or as part of the main processor 1621 .
  • a main processor 1621 eg, a central processing unit or an application processor
  • a secondary processor 1623 eg, a graphics processing unit, an image signal processor
  • the auxiliary processor 1623 may be configured to use less power than the main processor 1621 or to specialize in a designated function.
  • the coprocessor 1623 may be implemented separately from or as part of the main processor 1621 .
  • the coprocessor 1623 may, for example, act on behalf of the main processor 1621 while the main processor 1621 is in an inactive (eg, sleep) state, or when the main processor 1621 is active (eg, executing an application). ), together with the main processor 1621, at least one of the components of the electronic device 1601 (eg, the display device 1660, the sensor module 1676, or the communication module 1690) It is possible to control at least some of the related functions or states.
  • the coprocessor 1623 eg, image signal processor or communication processor
  • may be implemented as part of another functionally related component eg, camera module 1680 or communication module 1690. there is.
  • the memory 1630 may store various data used by at least one component of the electronic device 1601 (eg, the processor 1620 or the sensor module 1676 ).
  • the data may include, for example, input data or output data for software (eg, a program 1640 ) and instructions related thereto.
  • the memory 1630 may include a volatile memory 1632 or a non-volatile memory 1634 .
  • the program 1640 may be stored as software in the memory 1630 , and may include, for example, an operating system 1642 , middleware 1644 , or an application 1646 .
  • the input device 1650 may receive a command or data to be used by a component (eg, the processor 1620 ) of the electronic device 1601 from the outside (eg, a user) of the electronic device 1601 .
  • the input device 1650 may include, for example, a microphone, a mouse, a keyboard, or a digital pen (eg, a stylus pen).
  • the sound output device 1655 may output a sound signal to the outside of the electronic device 1601 .
  • the sound output device 1655 may include, for example, a speaker or a receiver.
  • the speaker can be used for general purposes such as multimedia playback or recording playback, and the receiver can be used to receive incoming calls. According to one embodiment, the receiver may be implemented separately from or as part of the speaker.
  • the display device 1660 may visually provide information to the outside (eg, a user) of the electronic device 1601 .
  • the display device 1660 may include, for example, a display, a hologram device, or a projector and a control circuit for controlling the corresponding device.
  • the display device 1660 may include a touch circuitry configured to sense a touch or a sensor circuit (eg, a pressure sensor) configured to measure the intensity of a force generated by the touch. there is.
  • the audio module 1670 may convert a sound into an electric signal or, conversely, convert an electric signal into a sound. According to an embodiment, the audio module 1670 acquires a sound through the input device 1650 , or an external electronic device (eg, a sound output device 1655 ) directly or wirelessly connected to the electronic device 1601 .
  • the electronic device 1602) eg, a speaker or headphones
  • the sensor module 1676 detects an operating state (eg, power or temperature) of the electronic device 1601 or an external environmental state (eg, a user state), and generates an electrical signal or data value corresponding to the sensed state. can do.
  • the sensor module 1676 may include, for example, a gesture sensor, a gyro sensor, a barometric pressure sensor, a magnetic sensor, an acceleration sensor, a grip sensor, a proximity sensor, a color sensor, an IR (infrared) sensor, a biometric sensor, It may include a temperature sensor, a humidity sensor, or an illuminance sensor.
  • the interface 1677 may support one or more specified protocols that may be used for the electronic device 1601 to directly or wirelessly connect with an external electronic device (eg, the electronic device 1602 ).
  • the interface 1677 may include, for example, a high definition multimedia interface (HDMI), a universal serial bus (USB) interface, an SD card interface, or an audio interface.
  • HDMI high definition multimedia interface
  • USB universal serial bus
  • SD card interface Secure Digital Card
  • connection terminal 1678 may include a connector through which the electronic device 1601 can be physically connected to an external electronic device (eg, the electronic device 1602 ).
  • the connection terminal 1678 may include, for example, an HDMI connector, a USB connector, an SD card connector, or an audio connector (eg, a headphone connector).
  • the haptic module 1679 may convert an electrical signal into a mechanical stimulus (eg, vibration or movement) or an electrical stimulus that the user can perceive through tactile or kinesthetic sense.
  • the haptic module 1679 may include, for example, a motor, a piezoelectric element, or an electrical stimulation device.
  • the camera module 1680 may capture still images and moving images. According to one embodiment, the camera module 1680 may include one or more lenses, image sensors, image signal processors, or flashes.
  • the power management module 1688 may manage power supplied to the electronic device 1601 .
  • the power management module 1688 may be implemented as, for example, at least a part of a power management integrated circuit (PMIC).
  • PMIC power management integrated circuit
  • the battery 1689 may supply power to at least one component of the electronic device 1601 .
  • battery 1689 may include, for example, a non-rechargeable primary cell, a rechargeable secondary cell, or a fuel cell.
  • the communication module 1690 is a direct (eg, wired) communication channel or a wireless communication channel between the electronic device 1601 and an external electronic device (eg, the electronic device 1602, the electronic device 1604, or the server 1608). It can support establishment and communication through the established communication channel.
  • the communication module 1690 operates independently of the processor 1620 (eg, an application processor) and may include one or more communication processors supporting direct (eg, wired) communication or wireless communication.
  • the communication module 1690 is a wireless communication module 1692 (eg, a cellular communication module, a short-range wireless communication module, or a global navigation satellite system (GNSS) communication module) or a wired communication module 1694 (eg, : It may include a local area network (LAN) communication module, or a power line communication module).
  • a wireless communication module 1692 eg, a cellular communication module, a short-range wireless communication module, or a global navigation satellite system (GNSS) communication module
  • GNSS global navigation satellite system
  • wired communication module 1694 eg, : It may include a local area network (LAN) communication module, or a power line communication module.
  • a corresponding communication module among these communication modules is a first network 1698 (eg, a short-range communication network such as Bluetooth, WiFi direct, or IrDA (infrared data association)) or a second network 1699 (eg, a cellular network, the Internet, Alternatively, it may communicate with the external electronic device 1604 through a computer network (eg, a telecommunication network such as a LAN or WAN).
  • a first network 1698 eg, a short-range communication network such as Bluetooth, WiFi direct, or IrDA (infrared data association)
  • a second network 1699 eg, a cellular network, the Internet
  • a computer network eg, a telecommunication network such as a LAN or WAN.
  • These various types of communication modules may be integrated into one component (eg, a single chip) or may be implemented as a plurality of components (eg, multiple chips) separate from each other.
  • the wireless communication module 1692 uses subscriber information (eg, International Mobile Subscriber Identifier (IMSI)) stored in the subscriber identification module 1696 within a communication network, such as the first network 1698 or the second network 1699 .
  • subscriber information eg, International Mobile Subscriber Identifier (IMSI)
  • IMSI International Mobile Subscriber Identifier
  • the electronic device 1601 may be identified and authenticated.
  • the antenna module 1697 may transmit or receive a signal or power to the outside (eg, an external electronic device).
  • the antenna module 1697 may include one antenna including a conductor formed on a substrate (eg, a PCB) or a radiator formed of a conductive pattern.
  • the antenna module 1697 may include a plurality of antennas. In this case, at least one antenna suitable for a communication scheme used in a communication network such as the first network 1698 or the second network 1699 is connected from the plurality of antennas by, for example, the communication module 1690 . can be selected. A signal or power may be transmitted or received between the communication module 1690 and an external electronic device through the selected at least one antenna.
  • other components eg, RFIC
  • other than the radiator may be additionally formed as a part of the antenna module 1697 .
  • peripheral devices eg, a bus, general purpose input and output (GPIO), serial peripheral interface (SPI), or mobile industry processor interface (MIPI)
  • GPIO general purpose input and output
  • SPI serial peripheral interface
  • MIPI mobile industry processor interface
  • the command or data may be transmitted or received between the electronic device 1601 and the external electronic device 1604 through the server 1608 connected to the second network 1699 .
  • Each of the external electronic devices 1602 and 1604 may be the same as or different from the electronic device 1601 .
  • all or part of the operations performed by the electronic device 1601 may be executed by one or more of the external electronic devices 1602 , 1604 , or 1608 .
  • the electronic device 1601 may perform the function or service itself instead of executing the function or service itself.
  • one or more external electronic devices may be requested to perform at least a part of the function or the service.
  • the one or more external electronic devices that have received the request may execute at least a part of the requested function or service, or an additional function or service related to the request, and transmit a result of the execution to the electronic device 1601 .
  • the electronic device 1601 may process the result as it is or additionally and provide it as at least a part of a response to the request.
  • cloud computing, distributed computing, or client-server computing technology may be used.
  • the electronic device may have various types of devices.
  • the electronic device may include, for example, a portable communication device (eg, a smart phone), a computer device, a portable multimedia device, a portable medical device, a camera, a wearable device, or a home appliance device.
  • a portable communication device eg, a smart phone
  • a computer device e.g., a smart phone
  • a portable multimedia device e.g., a portable medical device
  • a camera e.g., a portable medical device
  • a camera e.g., a portable medical device
  • a camera e.g., a portable medical device
  • a wearable device e.g., a smart bracelet
  • a home appliance device e.g., a home appliance
  • a or B at least one of A and B, “at least one of A or B”, “A, B or C”, “at least one of A, B and C” and “A;
  • Each of the phrases “at least one of B, or C” may include any one of, or all possible combinations of, items listed together in the corresponding one of the phrases.
  • Terms such as “first”, “second”, or “first” or “second” may simply be used to distinguish the component from other components in question, and may refer to components in other aspects (e.g., importance or order) is not limited. It is said that one (eg, first) component is “coupled” or “connected” to another (eg, second) component, with or without the terms “functionally” or “communicatively”. When referenced, it means that one component can be connected to the other component directly (eg by wire), wirelessly, or through a third component.
  • module may include a unit implemented in hardware, software, or firmware, and may be used interchangeably with terms such as, for example, logic, logic block, component, or circuit.
  • a module may be an integrally formed part or a minimum unit or a part of the part that performs one or more functions.
  • the module may be implemented in the form of an application-specific integrated circuit (ASIC).
  • ASIC application-specific integrated circuit
  • Various embodiments of the present document include one or more instructions stored in a storage medium (eg, internal memory 1636 or external memory 1638) readable by a machine (eg, electronic device 1601). may be implemented as software (eg, a program 1640) including
  • a processor eg, processor 1620
  • a device eg, electronic device 1601
  • the one or more instructions may include code generated by a compiler or code executable by an interpreter.
  • the device-readable storage medium may be provided in the form of a non-transitory storage medium.
  • 'non-transitory storage medium' is a tangible device and only means that it does not contain a signal (eg, electromagnetic wave). It does not distinguish the case where it is stored as
  • the 'non-transitory storage medium' may include a buffer in which data is temporarily stored.
  • the method according to various embodiments disclosed in this document may be provided as included in a computer program product.
  • Computer program products may be traded between sellers and buyers as commodities.
  • the (Play Store jjye example) via or two user devices a computer program product is stored which can be read by the device media (eg, compact disc read only memory (CD- ROM)) or distributed in the form, or the application store It can be distributed (eg downloaded or uploaded) directly, online between smartphones (eg: smartphones).
  • the computer program product eg, a downloadable app
  • a machine-readable storage medium such as a memory of a manufacturer's server, a server of an application store, or a relay server. It may be temporarily stored or temporarily created.
  • each component eg, a module or a program of the above-described components may include a singular or a plurality of entities.
  • one or more components or operations among the above-described corresponding components may be omitted, or one or more other components or operations may be added.
  • a plurality of components eg, a module or a program
  • the integrated component may perform one or more functions of each component of the plurality of components identically or similarly to those performed by the corresponding component among the plurality of components prior to the integration. .
  • operations performed by a module, program, or other component are executed sequentially, in parallel, repeatedly, or heuristically, or one or more of the operations are executed in a different order, or omitted. or one or more other operations may be added.
  • a module or a program module may include at least one or more of the aforementioned components, some may be omitted, or may further include other components. According to various embodiments, operations performed by a module, program module, or other component are sequentially, parallelly, repetitively or heuristically executed, or at least some operations are executed in a different order, are omitted, or other operations are added.

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Abstract

본 문서에 개시된 실시 예는 디스플레이 구동 회로가 프로세서로부터 표시 데이터를 수신하는 단계, 상기 디스플레이 구동 회로가 디스플레이 패널에서 제1 픽셀 배치 밀도로 배치된 제1 표시 영역에 제1 크기의 휘도를 표시하도록 설정된 제1 감마 신호를 공급하는 동안, 상기 제1 픽셀 배치 밀도보다 낮은 제2 픽셀 배치 밀도를 가지는 제2 표시 영역에 상기 제1 크기보다 큰 제2 크기의 휘도를 표시하도록 설정된 제2 감마 신호를 공급하는 단계를 포함하는 장치 운용 방법 및 이를 지원하는 전자 장치를 개시한다. 이 외에도 명세서를 통해 파악되는 다양한 실시 예가 가능하다.

Description

표시 영역에 따른 감마 전압 운용 방법 및 이를 지원하는 전자 장치
본 명세서의 다양한 실시 예들은 표시 영역에 따른 감마 전압 운용에 관한 것이다.
전자 장치는 정보를 표시 하기 위한 디스플레이를 포함하고 있다. 최근에는 디스플레이 영역을 확대하는 방안에 대해 집중하고 있다. 이에 따라, 전면에 배치된 카메라 또는 센서가 디스플레이 하부에 배치되는 방안에 대해 연구되고 있다. 그런데, 카메라가 디스플레이 하부에 배치될 경우, 카메라에 전달된 신호는, 디스플레이를 관통하는 동안 손실이 발생할 수 있다. 이로 인하여 디스플레이 하부에 배치된 카메라는 일정 크기 이상의 해상도를 제공하지 못하는 문제가 있다. 이를 해소하기 위하여, 카메라가 배치된 영역의 픽셀 배치 밀도를 다른 영역과 다르게 구성하는 방안이 적용되고 있다.
카메라와 같은 센서가 디스플레이 아래에 배치된 표시 영역의 픽셀 배치 밀도가 인접된 다른 영역의 픽셀 배치 밀도와 다른 경우, 동일한 영상을 표시할 때 시각적인 차이가 발생하는 문제가 있다.
이에 따라, 본 명세서의 다양한 실시 예들은, 표시 영역에 따라 적용되는 감마 전압을 다르게 함으로써 픽셀 배치 밀도가 다르더라도 동일 또는 유사한 이미지를 표시할 수 있는 표시 영역에 따른 감마 전압 운용 방법 및 이를 지원하는 전자 장치를 제공할 수 있다.
다양한 실시 예에 따른 전자 장치는 제1 표시 영역 및 제2 표시 영역을 포함하는 디스플레이 패널, 상기 제1 표시 영역은 제1 밀도로 분포된 서브 픽셀들을 포함하고, 상기 제2 표시 영역은 상기 제1 밀도보다 낮은 제2 밀도로 분포된 서브 픽셀들을 포함함, 상기 디스플레이 패널 구동과 관련한 디스플레이 구동 회로를 포함하고, 상기 디스플레이 구동 회로는 상기 제1 표시 영역에 배치된 소스 라인들에 감마 신호를 공급하는 일반 감마 생성부, 상기 제2 표시 영역 및 상기 제1 표시 영역에 공통으로 배치된 소스 라인들에 감마 신호를 공급하는 추가 감마 생성부를 포함하고, 상기 추가 감마 생성부는 상기 제1 표시 영역에 공급되는 감마 신호에 비하여 상대적으로 높은 휘도 값을 내도록 설정된 감마 신호를 상기 제2 표시 영역에 공급하도록 설정될 수 있다.
상술한 다양한 실시 예에 따르면, 한 실시 예에 따른 표시 영역에 따른 감마 전압 운용 방법은 디스플레이 구동 회로가 프로세서로부터 표시 데이터를 수신하는 단계, 상기 디스플레이 구동 회로가 디스플레이 패널에서 제1 픽셀 배치 밀도로 배치된 제1 표시 영역에 제1 크기의 휘도를 표시하도록 설정된 제1 감마 신호를 공급하는 동안, 상기 제1 픽셀 배치 밀도보다 낮은 제2 픽셀 배치 밀도를 가지는 제2 표시 영역에 상기 제1 크기보다 큰 제2 크기의 휘도를 표시하도록 설정된 제2 감마 신호를 공급하는 단계를 포함할 수 있다.
본 발명의 다양한 실시 예에 따르면, 다양한 실시 예는 표시 영역에 따라 선택적으로 감마 전압을 운용함으로써, 이미지 표시를 적절하게 수행할 수 있다.
기타, 다른 발명의 효과는 발명의 상세한 설명과 함께 예시될 수 있다.
도 1은 한 실시 예에 따른 디스플레이 구동 회로를 포함하는 전자 장치 구성을 개략적으로 나타낸 도면이다.
도 2는 한 실시 예에 따른 디스플레이 패널의 표시 영역들의 픽셀 배치 형태를 예시한 것이다.
도 3은 한 실시 예에 따른 디스플레이 구동 회로를 나타낸 도면이다.
도 4는 한 실시 예에 따른 디스플레이 패널 및 디스플레이 구동 회로의 일부 구성의 한 예를 나타낸 도면이다.
도 5는 한 실시 예에 따른 디스플레이 패널 및 디스플레이 구동 회로의 일부 구성의 한 예를 나타낸 도면이다.
도 6은 한 실시 예에 따른 디스플레이 패널 및 디스플레이 구동 회로의 일부 구성의 한 예를 나타낸 도면이다.
도 7은 한 실시 예에 따른 디스플레이 구동 회로의 일부 구성의 한 예를 나타낸 도면이다.
도 8은 한 실시 예에 따른 디스플레이 구동 회로의 일부 구성의 다른 예를 나타낸 도면이다.
도 9는 한 실시 예에 다른 소스 드라이버의 출력의 한 예를 나타낸 도면이다.
도 10은 한 실시 예에 따른 제2 표시 영역의 다양한 형태를 포함하는 디스플레이 패널의 예를 나타낸 도면이다.
도 11은 한 실시 예에 따른 디스플레이 구동 회로에서의 추가 감마 구동부가 좌측에 배치되는 예를 나타낸 도면이다.
도 12는 한 실시 예에 따른 디스플레이 구동 회로에서의 추가 감마 구동부가 중앙에 배치되는 예를 나타낸 도면이다.
도 13은 한 실시 예에 따른 디스플레이 구동 회로에서의 추가 감마 구동부가 우측에 배치되는 예를 나타낸 도면이다.
도 14는 한 실시 예에 따른 디스플레이 구동 회로에서의 추가 감마 구동부가 다양한 위치에 배치된 예를 나타낸 도면이다.
도 15는 한 실시 예에 따른 디스플레이 패널의 구동의 한 예를 나타낸 도면이다.
도 16은, 다양한 실시예들에 따른, 네트워크 환경(1600) 내의 전자 장치(1601)의 블럭도이다.
이하, 본 문서의 다양한 실시 예가 첨부된 도면을 참조하여 기재된다. 그러나, 이는 본 문서에 기재된 기술을 특정한 실시 형태에 대해 한정하려는 것이 아니며, 본 문서의 실시 예의 다양한 변경(modifications), 균등물(equivalents), 및/또는 대체물(alternatives)을 포함하는 것으로 이해되어야 한다. 도면의 설명과 관련하여, 유사한 구성요소에 대해서는 유사한 참조 부호가 사용될 수 있다.
본 문서에서, "가진다," "가질 수 있다," "포함한다," 또는 "포함할 수 있다" 등의 표현은 해당 특징(예: 수치, 기능, 동작, 또는 부품 등의 구성요소)의 존재를 가리키며, 추가적인 특징의 존재를 배제하지 않는다.
본 문서에서, "A 또는 B," "A 또는/및 B 중 적어도 하나," 또는 "A 또는/및 B 중 하나 또는 그 이상"등의 표현은 함께 나열된 항목들의 모든 가능한 조합을 포함할 수 있다. 예를 들면, "A 또는 B," "A 및 B 중 적어도 하나," 또는 "A 또는 B 중 적어도 하나"는, (1) 적어도 하나의 A를 포함, (2) 적어도 하나의 B를 포함, 또는 (3) 적어도 하나의 A 및 적어도 하나의 B 모두를 포함하는 경우를 모두 지칭할 수 있다.
본 문서에서 사용된 "제 1," "제 2," "첫째," 또는 "둘째,"등의 표현들은 다양한 구성요소들을, 순서 및/또는 중요도에 상관없이 수식할 수 있고, 한 구성요소를 다른 구성요소와 구분하기 위해 사용될 뿐 해당 구성요소들을 한정하지 않는다. 예를 들면, 제 1 사용자 기기와 제 2 사용자 기기는, 순서 또는 중요도와 무관하게, 서로 다른 사용자 기기를 나타낼 수 있다. 예를 들면, 본 문서에 기재된 권리 범위를 벗어나지 않으면서 제 1 구성요소는 제 2 구성요소로 명명될 수 있고, 유사하게 제 2 구성요소도 제 1 구성요소로 바꾸어 명명될 수 있다.
어떤 구성요소(예: 제 1 구성요소)가 다른 구성요소(예: 제 2 구성요소)에 "(기능적으로 또는 통신적으로) 연결되어((operatively or communicatively) coupled with/to)" 있다거나 "접속되어(connected to)" 있다고 언급된 때에는, 상기 어떤 구성요소가 상기 다른 구성요소에 직접적으로 연결되거나, 다른 구성요소(예: 제 3 구성요소)를 통하여 연결될 수 있다고 이해되어야 할 것이다. 반면에, 어떤 구성요소(예: 제 1 구성요소)가 다른 구성요소(예: 제 2 구성요소)에 "직접 연결되어" 있다거나 "직접 접속되어" 있다고 언급된 때에는, 상기 어떤 구성요소와 상기 다른 구성요소 사이에 다른 구성요소(예: 제 3 구성요소)가 존재하지 않는 것으로 이해될 수 있다.
본 문서에서 사용된 표현 "~하도록 구성된(또는 설정된)(configured to)"은 상황에 따라, 예를 들면, "~에 적합한(suitable for)," "~하는 능력을 가지는(having the capacity to)," "~하도록 설계된(designed to)," "~하도록 변경된(adapted to)," "~하도록 만들어진(made to)," 또는 "~를 할 수 있는(capable of)"과 바꾸어 사용될 수 있다. 용어 "~하도록 구성된(또는 설정된)"은 하드웨어적으로 "특별히 설계된(specifically designed to)" 것만을 반드시 의미하지 않을 수 있다. 대신, 어떤 상황에서는, "~하도록 구성된 장치"라는 표현은, 그 장치가 다른 장치 또는 부품들과 함께 "~할 수 있는" 것을 의미할 수 있다. 예를 들면, 문구 "A, B, 및 C를 수행하도록 구성된(또는 설정된) 프로세서"는 해당 동작을 수행하기 위한 전용 프로세서(예: 임베디드 프로세서), 또는 메모리 장치에 저장된 하나 이상의 소프트웨어 프로그램들을 실행함으로써, 해당 동작들을 수행할 수 있는 범용 프로세서(generic-purpose processor)(예: CPU 또는 application processor)를 의미할 수 있다.
본 문서에서 사용된 용어들은 단지 특정한 실시 예를 설명하기 위해 사용된 것으로, 다른 실시 예의 범위를 한정하려는 의도가 아닐 수 있다. 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함할 수 있다. 기술적이거나 과학적인 용어를 포함해서 여기서 사용되는 용어들은 본 문서에 기재된 기술 분야에서 통상의 지식을 가진 자에 의해 일반적으로 이해되는 것과 동일한 의미를 가질 수 있다. 본 문서에 사용된 용어들 중 일반적인 사전에 정의된 용어들은, 관련 기술의 문맥상 가지는 의미와 동일 또는 유사한 의미로 해석될 수 있으며, 본 문서에서 명백하게 정의되지 않는 한, 이상적이거나 과도하게 형식적인 의미로 해석되지 않는다. 경우에 따라서, 본 문서에서 정의된 용어일지라도 본 문서의 실시 예들을 배제하도록 해석될 수 없다.
본 문서의 다양한 실시 예들에 따른 전자 장치는, 예를 들면, 스마트폰(smartphone), 태블릿 PC(tablet personal computer), 이동 전화기(mobile phone), 영상 전화기, 전자책 리더기(e-book reader), 데스크탑 PC(desktop personal computer), 랩탑 PC(laptop personal computer), 넷북 컴퓨터(netbook computer), 워크스테이션(workstation), 서버, PDA(personal digital assistant), PMP(portable multimedia player), MP3 플레이어, 모바일 의료기기, 카메라(camera), 또는 웨어러블 장치(wearable device) 중 적어도 하나를 포함할 수 있다. 다양한 실시 예에 따르면, 웨어러블 장치는 액세서리형(예: 시계, 반지, 팔찌, 발찌, 목걸이, 안경, 콘택트 렌즈, 또는 머리 착용형 장치(head-mounted-device(HMD)), 직물 또는 의류 일체형(예: 전자 의복), 신체 부착형(예: 스킨 패드(skin pad) 또는 문신), 또는 생체 이식형(예: implantable circuit) 중 적어도 하나를 포함할 수 있다.
어떤 실시 예들에서, 전자 장치는 가전 제품(home appliance)일 수 있다. 가전 제품은, 예를 들면, 텔레비전, DVD(digital video disk) 플레이어, 오디오, 냉장고, 에어컨, 청소기, 오븐, 전자레인지, 세탁기, 공기 청정기, 셋톱 박스(set-top box), 홈 오토매이션 컨트롤 패널(home automation control panel), 보안 컨트롤 패널(security control panel), TV 박스(예: 삼성 HomeSyncTM, 애플TVTM, 또는 구글 TVTM), 게임 콘솔(예: XboxTM, PlayStationTM), 전자 사전, 전자 키, 캠코더(camcorder), 또는 전자 액자 중 적어도 하나를 포함할 수 있다.
다른 실시 예에서, 전자 장치는, 각종 의료기기(예: 각종 휴대용 의료측정기기(혈당 측정기, 심박 측정기, 혈압 측정기, 또는 체온 측정기 등), MRA(magnetic resonance angiography), MRI(magnetic resonance imaging), CT(computed tomography), 촬영기, 또는 초음파기 등), 네비게이션(navigation) 장치, 위성 항법 시스템(GNSS(global navigation satellite system)), EDR(event data recorder), FDR(flight data recorder), 자동차 인포테인먼트(infotainment) 장치, 선박용 전자 장비(예: 선박용 항법 장치, 자이로 콤파스 등), 항공 전자기기(avionics), 보안 기기, 차량용 헤드 유닛(head unit), 산업용 또는 가정용 로봇, 금융 기관의 ATM(automatic teller's machine), 상점의 POS(point of sales), 또는 사물 인터넷 장치(internet of things)(예: 전구, 각종 센서, 전기 또는 가스 미터기, 스프링클러 장치, 화재경보기, 온도조절기(thermostat), 가로등, 토스터(toaster), 운동기구, 온수탱크, 히터, 보일러 등) 중 적어도 하나를 포함할 수 있다.
어떤 실시 예에 따르면, 전자 장치는 가구(furniture) 또는 건물/구조물의 일부, 전자 보드(electronic board), 전자 사인 수신 장치(electronic signature receiving device), 프로젝터(projector), 또는 각종 계측 기기(예: 수도, 전기, 가스, 또는 전파 계측 기기 등) 중 적어도 하나를 포함할 수 있다. 다양한 실시 예에서, 전자 장치는 전술한 다양한 장치들 중 하나 또는 그 이상의 조합일 수 있다. 어떤 실시 예에 따른 전자 장치는 플렉서블 전자 장치일 수 있다. 또한, 본 문서의 실시 예에 따른 전자 장치는 전술한 기기들에 한정되지 않으며, 기술 발전에 따른 새로운 전자 장치를 포함할 수 있다.
이하, 첨부 도면을 참조하여, 다양한 실시 예에 따른 전자 장치가 설명된다. 본 문서에서, 사용자라는 용어는 전자 장치를 사용하는 사람 또는 전자 장치를 사용하는 장치(예: 인공지능 전자 장치)를 지칭할 수 있다.
도 1은 한 실시 예에 따른 디스플레이 구동 회로를 포함하는 전자 장치 구성을 개략적으로 나타낸 도면이며, 도 2는 한 실시 예에 따른 디스플레이 패널의 표시 영역들의 픽셀 배치 형태를 예시한 것이다.
도 1을 참조하면, 전자 장치(100)는 프로세서(140)(예: 어플리케이션 프로세서(application processor(AP))), 디스플레이 구동 회로(display driver IC(DDI), 200), 및 디스플레이 패널(160)(display panel)을 포함할 수 있다. 상기 전자 장치(100)는 예컨대, 휴대용 전자 장치로 구현될 수 있다. 다양한 실시 예에 따르면, 디스플레이 구동 회로(200)와 디스플레이 패널(160)은 프로세서(140)를 제외한 별도의(또는 외부) 디스플레이 장치(또는 디스플레이 모듈)로 구현될 수도 있다. 상술한 구성의 전자 장치(100)는 디스플레이 패널(160)이 픽셀(또는 화소) 배치 밀도가 다른 표시 영역들을 포함하고, 표시 영역에 따라 서로 다른 감마 전압을(또는 감마 탭 전압)을 공급함으로써, 픽셀 배치 밀도가 다르더라도 인접된 영역과 동일 색상 또는 동일 휘도의 이미지를 표시할 수 있도록 지원할 수 있다.
디스플레이 패널(160)은 디스플레이 구동 회로(200)에 의해 표시 데이터를 표시할 수 있다. 실시 예들에 따라, 디스플레이 패널(160)은 TFT-LCD(thin film transistor-liquid crystal display) 패널, LED(light emitting diode) 디스플레이 패널, OLED(organic LED) 디스플레이 패널, AMOLED(active matrix OLED) 디스플레이 패널, 또는 플렉서블(flexible) 디스플레이 패널로 구현될 수 있다.
상기 디스플레이 패널(160)은 예컨대, 게이트 라인들과 소스 라인들이 매트릭스 형태로 교차 배치될 수 있다. 상기 게이트 라인들에는 게이트 신호가 공급될 수 있다. 한 실시 예에 따르면, 게이트 라인들에 순차적으로 게이트 신호가 공급될 수 있다. 다양한 실시 예에 따르면, 게이트 라인들 중 홀수 게이트 라인들에 제1 게이트 신호가 공급되고, 짝수 게이트 라인들에 제2 게이트 신호가 공급될 수 있다. 제1 게이트 신호와 제2 게이트 신호는 서로 교번되게 공급되는 신호를 포함할 수 있다. 또는, 제1 게이트 신호가 홀수 게이트 라인들의 시작 라인부터 끝 라인까지 순차적으로 공급된 이후, 제2 게이트 신호가 짝수 게이트 라인들의 시작 라인부터 끝 라인까지 순차적으로 공급될 수 있다. 상기 소스 라인들에는 표시 데이터에 대응하는 신호가 공급될 수 있다. 상기 표시 데이터에 대응하는 신호는 로직 회로의 타이밍 컨트롤러의 제어에 따라 소스 드라이버로부터 공급될 수 있다.
도 2를 참조하면, 상기 디스플레이 패널(160)은 픽셀 배치 밀도가 다른 제1 표시 영역(161) 및 제2 표시 영역(162)을 포함할 수 있다. 예컨대, 상기 제1 표시 영역(161)은 픽셀들이 이웃하는 픽셀 배치 부분 영역들에 연속적으로 배치된 영역(또는 픽셀들이 매트릭스 형태의 부분 영역들에 연속적으로 배치된 영역, 또는 일정 픽셀 그룹들(예: RGB(red, green, blue) 또는 RGGB)이 매트릭스 형태의 부분 영역들 각각에 모두 배치된 영역)을 포함할 수 있다. 상기 제1 표시 영역(161)은 디스플레이 패널(160) 특성에 따라 펜타일(Pentile) 형태의 서브 픽셀들이 하나의 픽셀 배치 부분 영역(예: 하나의 사각형 부분 영역)에 배치되거나 또는 RGB Layout 형태의 서브 픽셀들이 하나의 픽셀 배치 부분 영역에 배치될 수 있다. 제2 표시 영역(162)은 제1 표시 영역(161)과 다른 픽셀 배치 밀도를 가질 수 있다. 예컨대, 제2 표시 영역(162)은 매트릭스 형태의 픽셀 배치 부분 영역들에 일정 거리를 가지며 픽셀들이 배치될 수 있다. 예컨대, 4개의 픽셀 배치 부분 영역들마다 하나의 픽셀 배치 부분 영역에 픽셀(예: RGBG 또는 RGB(Red, Green, Blue))이 배치되고 나머지 3개의 픽셀 배치 부분 영역들에는 픽셀이 배치되지 않고 비어 있을 수 있다. 다양한 실시 예에 따르면, 제2 표시 영역(162)은 복수개의 픽셀 배치 부분 영역들을 포함하고, 상기 복수개의 픽셀 배치 부분 영역들에는 불규칙하게 (또는 랜덤하게) 또는 지정된 패턴에 따라 픽셀들이 간헐적으로 배치될 수 있다. 상기 제2 표시 영역(162)은 예컨대, 전자 장치(100)의 전면에 배치되는 적어도 하나의 센서 영역에 대응되는 크기의 영역을 포함할 수 있다. 한 실시 예에 따르면, 제2 표시 영역(162)은 디스플레이 패널(160) 하부에 카메라가 배치된 영역 (예: 카메라 크기에 대응하는 영역, 또는 카메라 중 이미지와 관련한 신호를 수신하는 이미지 센서부에 대응하는 영역)을 포함할 수 있다. 또는, 제2 표시 영역(162)은 디스플레이 패널(160) 하부에 지문 센서 또는 홍채 센서, 마이크, 스피커와 같은 구조물이 배치된 영역에 대응하는 적어도 일부 영역의 크기를 포함할 수도 있다. 상기 제2 표시 영역(162)은 디스플레이 패널(160)의 다양한 영역에 적어도 하나가 존재할 수 있다. 예컨대, 제2 표시 영역(162)은 디스플레이 패널(160)의 우상측, 상측 중앙, 좌상측, 우하측, 하측 중앙, 좌하측과 같은 영역에 형성될 수 있다. 다양한 실시 예에 따르면, 상기 제1 표시 영역(161)과 제2 표시 영역(162)에 배치되는 서브 픽셀들의 패턴은 동일하게 구성될 수 있으나, 서로 다르게 구성될 수도 있다. 예컨대, 제1 표시 영역(161)에 서브픽셀들이 RGBG 패턴으로 배치된 경우, 제2 표시 영역(162)에도 서브픽셀들이 RGBG 패턴으로 배치될 수 있다. 이 상태에서, 제2 표시 영역(162)은 복수의 픽셀 배치 부분 영역들 중 일부 픽셀 배치 부분 영역에 RGBG 패턴의 서브 픽셀들이 배치될 수 있다. 또는, 제1 표시 영역(161)에 서브픽셀들이 RGBG(또는 RGB) 패턴으로 배치된 경우, 제2 표시 영역(162)에도 서브픽셀들이 RGB(또는 RGBG) 패턴으로 배치될 수 있다. 이 상태에서, 제2 표시 영역(162)은 복수의 픽셀 배치 부분 영역들 중 일부 픽셀 배치 부분 영역에 RGB 패턴의 서브 픽셀들이 배치될 수 있다.
프로세서(140)는 전자 장치(100)의 전반적인 동작을 제어할 수 있다. 한 실시 예에 따르면, 프로세서(140)는 집적 회로, 시스템 온 칩, 또는 모바일 AP로 구현될 수 있다. 상기 프로세서(140)는 표시하고자 하는 데이터(예컨대, 표시 데이터로서, 이미지 데이터, 동영상 데이터, 또는 정지 영상 데이터)를 디스플레이 구동 회로(200)로 전송할 수 있다. 한 실시 예에 따르면, 상기 표시 데이터는 디스플레이 패널(160)의 수평 라인(또는 수직 라인)에 상응하는 라인 데이터 단위로 구분될 수 있다. 상기 프로세서(140)는 표시 영역에 따라 디스플레이 패널(160)의 감마 생성부의 운용 형태를 다르게 제어하는 제어 신호를 디스플레이 구동 회로(200)에 전달할 수 있다. 또는, 상기 프로세서(140)는 표시 영역에 다른 감마 전압을 공급하도록 설계된 감마 생성부들의 운용을 표시 영역별로 제어하는 제어 신호를 디스플레이 구동 회로(200)에 전달할 수 있다.
다양한 실시 예에 따르면, 상기 프로세서(140)는 디스플레이 패널(160)의 제1 표시 영역(161)(예: 픽셀들이 이웃하면서 매트릭스 형태로 배치된 영역) 및 제2 표시 영역(162)에 공급될 감마 전압(또는 감마 탭 전압)의 공급을 제어할 수 있다. 예컨대, 프로세서(140)는 제1 표시 영역(161) 및 제2 표시 영역(162)에 출력된 컨텐츠의 표시 데이터와 관련하여, 상대적으로 픽셀 배치 밀도가 낮은 제2 표시 영역(162)에서의 화면 표시가 제1 표시 영역(161)과 동일하게 수행되도록 제어할 수 있다. 예를 들어, 동일한 색상 및 휘도의 컨텐츠(또는 이미지, 또는 객체)가 제1 표시 영역(161)과 제2 표시 영역(162)에 걸쳐 표시되어야 하는 경우, 픽셀 배치 밀도가 다르기 때문에, 제1 표시 영역(161)에 출력되는 컨텐츠의 표시 형태와 제2 표시 영역(162)에 출력되는 컨텐츠의 표시 형태가 다를 수 있다. 프로세서(140)는 제1 표시 영역(161)과 제2 표시 영역(162)의 픽셀 배치 밀도를 고려하여, 동일한 색상 및 휘도의 컨텐츠(또는 이미지, 또는 객체)가 제1 표시 영역(161)과 제2 표시 영역(162)에 걸쳐 표시되도록, 제2 표시 영역(162)에 출력된 컨텐츠에 대응하는 표시 데이터의 감마 신호(예: 아날로그 감마 전압 및 디지털 감마 전압 중 적어도 하나)의 조절을 제어할 수 있다. 여기서, 상기 프로세서(140)는 제2 표시 영역(162)에 출력될 컨텐츠의 계조 레벨에 따라 감마 신호를 조절(예: 아날로그 감마 전압만을 조절하거나 또는 아날로그 감마 전압과 디지털 감마 전압을 함께 조절)하도록 제어할 수 있다.
디스플레이 구동 회로(200)는 프로세서(140)로부터 전송된 데이터를 디스플레이 패널(160)에 전송할 수 있는 형태로 변경하고, 변경된 데이터를 디스플레이 패널(160)로 전송할 수 있다. 변경 데이터는 픽셀 단위(또는 서브 픽셀 단위)로 공급될 수 있다. 여기서 픽셀은 지정된 색 표시와 관련하여, 서브 픽셀 Red, Green, Blue가 인접 배치된 구조로서, 하나의 픽셀은 RGB 서브 픽셀을 포함하거나(RGB stripe layout 구조) 또는 RGBG 서브 픽셀들을 포함(Pentile layout 구조)할 수 있다. 여기서 RGBG 서브 픽셀들의 배치 구조는, RGGB 서브 픽셀 배치 구조로 대체될 수 있다. 또는, 상기 픽셀은 RGBW 서브 픽셀 배치 구조로 대체될 수 있다.
한 실시 예에 따르면, 디스플레이 구동 회로(200)는 표시 영역에 따라, 디스플레이 패널(160)에 공급되는 표시 데이터들을 픽셀 단위로 처리할 수 있다. 예컨대, 상기 디스플레이 구동 회로(200)는 프로세서(140)의 제어에 대응하여 제1 표시 영역(161)에 감마 탭 전압을 공급할 일반 감마 생성부 및 제2 표시 영역(162)에 감마 탭 전압을 공급할 추가 감마 생성부를 포함하고, 각 감마 생성부의 신호 생성을 제어할 수 있다.
다양한 실시 예에 따르면, 디스플레이 구동 회로(200)는 제1 표시 영역(161)에 감마 탭 전압을 공급하는 일반 감마 생성부 중 일부 감마 생성부를 이용하여 제2 표시 영역(162)에 배치된 서브 픽셀들에 공급할 감마 전압(또는 감마 탭 전압)을 생성할 수 있다. 이 경우, 디스플레이 구동 회로(200)는 일반 감마 생성부 중 특정 감마 생성부의 감마 전압 생성을 다르게 제어할 수 있다.
도 3은 한 실시 예에 따른 디스플레이 구동 회로를 나타낸 도면이다.
도 1 내지 도 3을 참조하면, 디스플레이 구동 회로(200)는 인터페이스 회로(201)(interface circuit), 로직 회로(202)(logic circuit), 그래픽 메모리(203)(graphic memory), 데이터 래치(205)(data latch)(또는 shift register), 소스 드라이버(206)(source driver), 게이트 드라이버(207)(gate driver), 일반 감마 생성부(208)(Gamma generator) 및 추가 감마 생성부(209)를 포함할 수 있다.
상기 인터페이스 회로(201)는 프로세서(140)와 디스플레이 구동 회로(200) 사이에 주고받는 신호들 또는 데이터를 인터페이싱(interfacing)할 수 있다. 인터페이스 회로(201)는 프로세서(140) 로부터 전송된 라인 데이터(line data)를 인터페이싱하여 로직 회로(202)의 그래픽 메모리 라이트 컨트롤러(graphic memory write controller)로 전송할 수 있다. 한 실시 예에 따르면, 인터페이스 회로(201)는 MIPI(mobile industry processor interface(MIPI®)), MDDI(mobile display digital interface), 디스플레이포트 (displayport), 또는 임베디드 디스플레이포트(embedded displayPort(eDP))와 같은 직렬 인터페이스(serial interface)와 관련한 인터페이스일 수 있다.
상기 로직 회로(202)는 그래픽 메모리 라이트 컨트롤러(graphic memory write controller), 타이밍 컨트롤러(timing controller), 그래픽 메모리 리드 컨트롤러(graphic memory read controller), 이미지 프로세싱 유닛(image processing unit), 소스 쉬프트 레지스터 컨트롤러(source shift register controller), 데이터 쉬프트 레지스터(data shift register)를 포함할 수 있다.
상기 로직 회로(202)의 그래픽 메모리 라이트 컨트롤러는 인터페이스 회로(201)로부터 전송된 라인 데이터를 수신하고, 수신된 라인 데이터를 그래픽 메모리(203)에 쓰는 동작을 제어할 수 있다.
타이밍 컨트롤러는 디스플레이 구동 회로(200)의 각 구성 요소(예컨대, 그래픽 메모리 리드 컨트롤러)로 동기 신호(synchronizing signal) 및/또는 클럭 신호(clock signal)를 공급할 수 있다. 또한, 타이밍 컨트롤러는 그래픽 메모리(203)의 리드 동작을 제어하기 위한 리드 명령(read command(RCMD))를 그래픽 메모리 리드 컨트롤러로 전송할 수 있다. 상기 타이밍 컨트롤러는 상기 소스 드라이버(206)의 표시 데이터 공급을 제어할 수 있다. 또한, 상기 타이밍 컨트롤러는 상기 게이트 드라이버(207)의 게이트 신호 출력을 제어할 수 있다. 예컨대, 상기 타이밍 컨트롤러는 디스플레이 패널(160)의 게이트 신호라인들에 순차적으로 게이트 신호를 공급하도록 게이트 드라이버(207)를 제어할 수 있다. 또는 상기 타이밍 컨트롤러는 디스플레이 패널(160)의 게이트 신호라인들 중 홀수 라인들과 짝수 라인들을 구분하여 게이트 신호를 출력하도록 게이트 드라이버(207)를 제어할 수 있다.
한 실시 예에 따르면, 타이밍 컨트롤러는 표시 영역에 따라 디지털 감마 전압 생성 및 전달을 제어할 수 있다. 예컨대, 타이밍 컨트롤러는 제1 표시 영역(161)에 공급할 감마 전압 생성을 위해 일반 감마 생성부(208)의 신호 생성을 제어할 수 있다. 또는, 타이밍 컨트롤러는 제2 표시 영역(162)에 공급할 감마 전압(또는 감마 탭 전압) 생성을 위해 추가 감마 생성부(209)의 신호 생성을 제어할 수 있다. 상술한 동작에서, 타이밍 컨트롤러는 소스 증폭기 및 일반 감마 생성부(208) 및 추가 감마 생성부(209)를 제어하고, 해당 서브 픽셀에 공급되어야 할 감마 전압이 해당 서브 픽셀과 관련한 디코더에 공급되도록 소스 증폭기의 출력 타이밍을 제어(예: 시분할 구동)할 수 있다.
한 실시 예에 따르면, 상기 프로세서(140) 또는 타이밍 컨트롤러는 상기 일반 감마 생성부(208)에서 지정된 서브 픽셀에 대응하는 회로 소자들을 기반으로 감마 전압을 생성하고, 생성된 감마 전압을 디코더에 전달하는 과정에서, 각 서브 픽셀들과 관련한 디지털 감마 전압들의 공급 타이밍을 제어할 수 있다. 또는, 상기 프로세서(140) 또는 타이밍 컨트롤러는 지정된 타이밍에 지정된 서브 픽셀에 대응하여 생성된 감마 전압을 각각의 디코더들을 통해 소스 증폭기들에 전달되도록 제어할 수 있다. 이 동작에서, 타이밍 컨트롤러는 소스 증폭기의 출력 타이밍을 시분할로 제어함으로써, 서브 픽셀 별 표시 데이터에 해당하는 디지털 감마 전압을 기반으로, 소스 증폭기의 출력을 생성하고, 생성된 출력이 해당 서브 픽셀에 공급되도록 제어할 수 있다.
그래픽 메모리 리드 컨트롤러는 그래픽 메모리(203)에 저장된 라인 데이터에 대해 리드(read) 동작을 수행할 수 있다. 한 실시 예에 따르면, 그래픽 메모리 리드 컨트롤러는, 라인 데이터에 대한 리드 명령(RCMD)에 기초하여, 그래픽 메모리(203)에 저장된 상기 라인 데이터의 전부 또는 일부에 대한 리드 동작을 수행할 수 있다. 그래픽 메모리 리드 컨트롤러는 그래픽 메모리(203)로부터 리드된 라인 데이터의 전부 또는 라인 데이터의 일부를 이미지 프로세싱 유닛으로 전송할 수 있다. 그래픽 메모리 라이트 컨트롤러와 그래픽 메모리 리드 컨트롤러는 설명의 편의를 위해 구분해서 설명하지만, 하나의 그래픽 메모리 컨트롤러로 구현될 수 있다.
이미지 프로세싱 유닛은 그래픽 메모리 리드 컨트롤러로부터 전송된 라인 데이터의 전부 또는 라인 데이터의 일부를 처리하여 화질(image quality)을 개선할 수 있다. 화질이 개선된 표시 데이터는 타이밍 컨트롤러에 전달되고, 타이밍 컨트롤러는 상기 표시 데이터를 데이터 래치(205)를 통해 소스 드라이버(206)에 전달할 수 있다. 상기 이미지 프로세싱 유닛은 제1 표시 영역(161) 구동을 위한 제1 감마 전압 테이블, 제2 표시 영역(162) 구동을 위한 제2 감마 전압 테이블을 포함할 수 있다. 또는, 상기 타이밍 컨트롤러는 제1 표시 영역(161) 구동을 위한 제1 감마 전압 테이블, 제2 표시 영역(162) 구동을 위한 제2 감마 전압 테이블을 포함할 수 있다.
소스 쉬프트 레지스터 컨트롤러는 데이터 쉬프트 레지스터의 데이터 쉬프팅(data shifting) 동작을 제어할 수 있다. 한 실시 예에 따르면, 소스 쉬프트 레지스터 컨트롤러는 프로세서(140)로부터 수신된 명령어에 대응하여 그래픽 메모리(203)의 라인 데이터 쓰기, 이미지 프로세싱 유닛의 영상 전처리 등의 제어를 수행할 수 있다.
데이터 쉬프트 레지스터는, 소스 쉬프트 레지스터 컨트롤러의 제어에 따라, 소스 쉬프트 레지스터 컨트롤러를 통하여 전송된 표시 데이터를 쉬프팅할 수 있다. 데이터 쉬프트 레지스터는 쉬프트된 표시 데이터를 순차적으로 데이터 래치(205)로 전송할 수 있다.
그래픽 메모리(203)는, 그래픽 메모리 라이트 컨트롤러의 제어에 따라, 그래픽 메모리 라이트 컨트롤러를 통해 입력된 라인 데이터를 저장할 수 있다. 그래픽 메모리(203)는 디스플레이 구동 회로(200) 내에서 버퍼 메모리(buffer memory)로써 동작할 수 있다. 한 실시 예에 따르면, 그래픽 메모리(203)는 GRAM(graphic random access memory)을 포함할 수 있다.
데이터 래치(205)는 데이터 쉬프트 레지스터로부터 순차적으로 전송된 표시 데이터를 저장할 수 있다. 데이터 래치(205)는 저장된 표시 데이터를 디스플레이 패널(160)의 수평 라인 단위로 소스 드라이버(206)으로 전송할 수 있다.
소스 드라이버(206)는 데이터 래치(205)로부터 전송된 라인 데이터를 디스플레이 패널(160)로 전송할 수 있다. 한 실시 예에 따르면, 소스 드라이버(206)는 서브 픽셀들(또는 서브 픽셀에 대응하는 채널별)로 연결된 복수의 소스 증폭기를 포함할 수 있다. 소스 드라이버(206)에 포함된 소스 증폭기들은 각각의 서브 픽셀들에 신호를 공급하기 위해 시분할로 동작할 수 있다. 한 실시 예에 따르면, 소스 드라이버(206)에 포함된 소스 증폭기들은 동일 또는 다른 종류의 복수의 서브 픽셀들과 연결될 수 있다. RGB 픽셀을 포함하는 디스플레이 패널(160) 구조에서, 소스 드라이버(206)는 각 서브 픽셀(예: R 서브 픽셀, G 서브 픽셀, B 서브 픽셀)별로 연결된 소스 증폭기들을 포함할 수 있다.
상기 소스 드라이버(206)는 서브 픽셀들이 연결된 소스 증폭기들의 입력단과 연결되는 복수개의 디코더를 포함할 수 있다. 상기 디코더는 일반 감마 생성부(208) 및 추가 감마 생성부(209)와 로직 회로(202)의 출력단에 연결되고, 로직 회로(202)로부터 전달된 표시 데이터와 일반 감마 생성부(208) 및 추가 감마 생성부(209)가 제공한 감마 전압을 디코딩(또는 곱셈)할 수 있다. 각각의 디코더 출력은 각각의 소스 증폭기들에 연결될 수 있다. 상기 소스 드라이버(206)에 포함된 복수개의 디코더 중 제1 표시 영역(161)에 할당된 소스 증폭기들과 연결되는 디코더는 제1 개수(예: 표시 데이터가 8비트로 구성된 경우, 256개)의 계조 값들 중 하나의 계조 값에 해당하는 감마 전압을 선택할 수 있다.
상기 소스 드라이버(206)에 포함된 복수개의 디코더 중 제2 표시 영역(162)에 신호를 공급하도록 배치된 소스 증폭기들과 연결되는 디코더는 제2 개수(예: 상기 제1 개수보다 많은 개수)의 계조 값들 중 하나의 계조 값에 해당하는 감마 전압을 선택할 수 있다. 예를 들어, 제2 표시 영역(162)에 신호를 공급하도록 배치된 소스 증폭기들과 연결되는 디코더는 상기 제2 표시 영역(162)과 같은 평면 상에서 아래에 배치된 제1 표시 영역(161)에 공급될 수 있는 256 계조 값들 및 제2 표시 영역(162)에 공급될 일정 개수의 계조 값들 중 하나를 선택할 수 있다.
상기 제2 표시 영역(162)에 공급될 일정 개수의 계조 값들은 예컨대, 256 개의 계조 값들보다 작은 개수의 계조 값들을 가지되, 상기 제1 표시 영역(161)에 공급될 256 계조 값들과 다른 크기의 감마 전압을 가질 수 있다. 또는 제2 표시 영역(162)의 서브 픽셀에는 제1 표시 영역(161)의 서브 픽셀에 공급되는 감마 전압과 다른 크기의 감마 전압이 공급될 수 있다. 예를 들어, 제1 표시 영역(161)에 공급할 신호(예: R, G, B 중 어느 하나)의 최고 밝기 값인 256 계조의 제1 감마 전압 크기와 제2 표시 영역(162)에 공급할 신호(예: R, G, B 중 어느 하나)의 최고 밝기 값인 256 계조의 제2 감마 전압 크기는 서로 다를 수 있다. 한 실시 예에 따르면, 제2 감마 전압 크기는 제1 감마 전압 크기의 N배(상기 N은 실수, float)일 수 있다. 또는 제2 표시 영역(162)의 픽셀 배치 밀도와 제1 표시 영역(161)의 픽셀 배치 밀도의 차이에 따라 상기 제1 감마 전압 크기와 제2 감마 전압 크기는 다를 수 있다.
다양한 실시 예에 따르면, 상대적으로 낮은 저계조 영역(예: 1~100 계조 값)에서의 제1 표시 영역(161)에 공급할 제1 감마 전압 크기와 제2 표시 영역(162)에 공급할 제2 감마 전압 크기는 동일 또는 유사할 수 있다. 한 실시 예에 따르면, 상대적으로 높은 고계조 영역(예: 101 이상의 계조 값)에서의 제1 표시 영역(161)에 공급할 제1 감마 전압 크기와 제2 표시 영역(162)에 공급할 제2 감마 전압 크기는 다르게 설정(예: 고계조 영역에서의 제2 감마 전압 크기가 제1 감마 전압 크기보다 크게 설정)될 수 있다.
다양한 실시 예에 따르면, 주변 조도에 따라, 상기 제1 감마 전압의 크기와 상기 제2 감마 전압 크기의 차이가 다를 수 있다. 이와 관련하여, 상기 타이밍 컨트롤러 또는 이미지 프로세싱 유닛 중 적어도 하나에 배치되는 감마 전압 곡선에 해당하는 룩업 테이블 또는 감마 전압 테이블(기본적으로 제1 표시 영역(161)에 적용할 제1 감마 전압 테이블과, 제2 표시 영역(162)에 적용할 제2 감마 전압 테이블을 포함하며)은 일정 외부 조도 단위로 복수개(예: 각 표시 영역별 및 외부 조도 별로 다른 감마 전압 곡선에 해당하는 테이블들)가 저장될 수 있다. 프로세서(140)는 외부 조도에 따라, 어떠한 감마 전압 테이블을 사용할지를 결정하고, 그에 따른 제어 신호를 디스플레이 구동 회로(200)에 공급할 수 있다.
게이트 드라이버(207)는 디스플레이 패널(160)의 게이트 라인들을 구동할 수 있다. 상기 게이트 드라이버(207)는 로직 회로(202)의 제어에 따라 디스플레이 패널(160)의 게이트 라인들에 순차적으로 게이트 신호를 공급할 수 있다. 또는, 상기 게이트 드라이버(207)는 로직 회로(202)의 제어에 따라 디스플레이 패널(160)의 게이트 라인들을 홀수 라인들 또는 짝수 라인들로 구분하고, 구분된 라인들에 게이트 신호를 각각 공급할 수 있다. 이와 관련하여, 상기 게이트 드라이버(207)는 복수개의 게이트 드라이버(예: 좌측 게이트 드라이버 및 우측 게이트 드라이버)를 포함할 수 있다. 상술한 바와 같이, 소스 드라이버(206)와 게이트 드라이버(207)에 의해 디스플레이 패널(160)에 구현된 픽셀들의 동작이 제어됨에 따라, 프로세서(140)로부터 입력된 표시 데이터(또는, 표시 데이터에 상응하는 이미지)가 디스플레이 패널(160)에 표시될 수 있다.
상기 일반 감마 생성부(208)는 서브 픽셀별 회로 소자들을 기반으로 디스플레이 패널(160)의 휘도 조절과 관련한 감마 전압(또는 감마 탭 전압)을 생성하여 공급할 수 있다. 상기 일반 감마 생성부(208)는 제1 색상(예: Red), 제2 색상(예: Green), 제3 색상(예: Blue) 중 적어도 하나에 대응하는 감마 신호 예컨대, 아날로그 감마 전압을 생성하고, 생성된 아날로그 감마 전압을 소스 드라이버(206)에 공급할 수 있다. 아날로그 감마 전압은 지정된 색상에 대응하여 저장된 제1 감마 전압 곡선을 기반으로 생성될 수 있다. 한 실시 예에 따르면, 일반 감마 생성부(208)는 제1 표시 영역(161)에 공급할 아날로그 감마 전압을 제1 감마 전압 곡선을 기반으로 생성하고, 생성된 아날로그 감마 전압을 디코더들에 공급할 수 있다. 이와 관련하여, 상기 일반 감마 생성부(208)는 로직 회로(202)의 제어에 대응하여 시분할 형태로 제1 표시 영역(161)에 공급할 각 서브 픽셀별 감마 전압을 생성하여 소스 드라이버(206)에 공급할 수 있다. 예컨대, 상기 일반 감마 생성부(208)는 하나의 수평 동기화(Hsync) 주기마다 제1 표시 영역(161)에 배치된 각 서브 픽셀에 공급할 감마 전압을 생성하고, 생성된 감마 전압을 소스 드라이버(206)에 공급할 수 있다. 하나의 수평 동기화(Hsync) 주기의 길이는 디스플레이 패널의 구동 주파수 값에 따라 달라질 수 있다.
상기 추가 감마 생성부(209)는 제2 표시 영역(162)에 배치된 서브 픽셀별 회로 소자들을 기반으로 디스플레이 패널(160)의 휘도 조절과 관련한 감마 전압(또는 감마 탭 전압)을 생성하여 공급할 수 있다. 또는, 상기 추가 감마 생성부(209)는 색상에 관계 없이 제2 표시 영역(162)에 공급할 공통 아날로그 감마 전압을 생성하고, 이를 소스 드라이버(206)에 공급할 수 있다. 이때, 추가 감마 생성부(209)에 의해 생성되는 아날로그 감마 전압은 지정된 색상에 대응하여 저장된 제2 감마 전압 곡선을 기반으로 생성될 수 있다. 한 실시 예에 따르면, 추가 감마 생성부(209)는 제2 표시 영역(162)에 공급할 아날로그 감마 전압을 제2 감마 전압 곡선을 기반으로 생성하고, 생성된 아날로그 감마 전압을 디코더들에 공급할 수 있다. 이 과정에서, 추가 감마 생성부(209)는 로직 회로(202)의 제어에 대응하여 시분할 형태로 제2 표시 영역(162)에 공급할 각 서브 픽셀별 감마 전압을 생성하여 소스 드라이버(206)에 공급할 수 있다. 다양한 실시 예에 따르면, 제2 표시 영역(162)에 공급할 아날로그 감마 전압은 상기 일반 감마 생성부(208) 중 어느 하나의 서브 픽셀과 관련한 감마 생성부가 생성하여 공급하도록 구성될 수도 있다.
도 4는 한 실시 예에 따른 디스플레이 패널 및 디스플레이 구동 회로의 일부 구성의 한 예를 나타낸 도면이다.
도 4를 참조하면, 전자 장치(100)의 일부 구성은 팬타일 레이아웃(또는 타입)의 제1 표시 영역(161) 및 제2 표시 영역(162), 소스 드라이버(206), 일반 감마 생성부(208), 추가 감마 생성부(209), 제1 로직 회로(202a) 및 제2 로직 회로(202b)를 포함할 수 있다.
상기 팬타일 타입의 제1 표시 영역(161)은 예컨대, 복수개의 게이트 라인들(Gn, Gn+1, Gn+2)과 4개의 소스 라인들(Sn, Sn+1, Sn+2, Sn+3)이 교차 배치되는 표시 영역을 포함할 수 있다. 상기 디스플레이 패널(160)은 상기 게이트 라인들(Gn, Gn+1, Gn+2) 및 소스 라인들(Sn, Sn+1, Sn+2, Sn+3)에 표시 데이터를 공급하는 제1 소스 드라이버(206a) 및 게이트 신호를 공급하는 게이트 드라이버(207)가 실장되는 비표시 영역을 더 포함할 수 있다. 또는, 상기 디스플레이 패널(160)의 비표시 영역에는 상술한 디스플레이 구동 회로(200)가 배치될 수도 있다.
상기 제1 표시 영역(161)의 상기 게이트 라인들(Gn, Gn+1, Gn+2)은 예컨대, 홀수 게이트 라인들(Gn, Gn+2) 및 짝수 게이트 라인들(Gn+1)을 포함할 수 있다. 홀수 게이트 라인들(Gn, Gn+2) 및 짝수 게이트 라인들(Gn+1)은 교번적으로 게이트 신호가 공급될 수 있다. 한 실시 예에 따르면, 상기 홀수 게이트 라인들(Gn, Gn+2)에는 RGBG 서브 픽셀들이 하나의 픽셀을 형성하며 반복적으로 배치될 수 있다. 상기 짝수 게이트 라인들(Gn+1)에는 BGRG 서브 픽셀들이 하나의 픽셀 (또는 하나의 서브 픽셀 그룹)을 형성하며 반복적으로 배치될 수 있다. 상술한 RGBG 순서는 실질적으로 BGRG와 동일한 패턴을 가지되, 시작 순서 또는 마지막 순서가 다르게 배치될 수 있다.
상기 소스 라인들(Sn, Sn+1, Sn+2, Sn+3)은 Red 서브 픽셀과 Blue 서브 픽셀이 교번적으로 배치되는 제1 채널(Sn), 제1 Green 서브 픽셀들이 배치되는 제2 채널(Sn+1), Blue 서브 픽셀과 Red 서브 픽셀이 교번적으로 배치되는 제3 채널(Sn+2), 제2 Green 서브 픽셀들이 배치되는 제4 채널(Sn+3)을 포함할 수 있다. 상술한 소스 라인들(Sn, Sn+1, Sn+2, Sn+3)은 하나의 픽셀에 포함되는 4개의 서브 픽셀들의 그룹을 포함할 수 있다. 상기 제1 표시 영역(161)의 일측 예컨대, 소스 라인들(Sn, Sn+1, Sn+2, Sn+3)의 각 채널 끝단에는 제1 소스 드라이버(206a)의 증폭기들의 출력단과 연결되는 패드들이 배치될 수 있다.
상기 소스 드라이버(206)는 제1 표시 영역(161)의 채널들에 신호를 공급하는 제1 소스 드라이버(206a) 및 제2 표시 영역(162)의 채널들에 신호를 공급하는 제2 소스 드라이버(206b)를 포함할 수 있다. 여기서, 상기 제1 소스 드라이버(206a) 및 제2 소스 드라이버(206b)는 하나의 소스 드라이버(206) 내에 집적되는 것으로, 하나의 몸체에 배치되데 소스 신호를 공급하는 영역에 따라 다르게 구분될 수 있다. 예컨대, 제1 소스 드라이버(206a)는 제1 표시 영역(161)에만 소스 신호를 공급하는 소스 드라이버 요소들을 포함할 수 있으며, 제2 소스 드라이버(206b)는 제1 표시 영역(161)과 제2 표시 영역(162)에 소스 신호를 공급하는 소스 드라이버 요소들을 포함할 수 있다.
상기 제1 소스 드라이버(206a)는 예컨대, 소스 라인들(Sn, Sn+1, Sn+2, Sn+3) 중 제1 채널(Sn)에 신호를 공급하는 제1 증폭기(311), 제2 채널(Sn+1)에 신호를 공급하는 제2 증폭기(312), 제3 채널(Sn+2)에 신호를 공급하는 제3 증폭기(313), 제4 채널(Sn+3)에 신호를 공급하는 제4 증폭기(314)를 포함할 수 있다. 또한, 상기 제1 소스 드라이버(206a)는 상기 제1 증폭기(311)의 출력단에 연결되는 제1 스위치(301), 제2 증폭기(312)의 출력단에 연결되는 제2 스위치(302), 제3 증폭기(313)의 출력단에 연결되는 제3 스위치(303), 제4 증폭기(314)의 출력단에 연결되는 제4 스위치(304)를 포함할 수 있다. 각각의 스위치들의 제어 신호는 예컨대, 프로세서(140)의 제어 신호를 수신한 타이밍 컨트롤러로부터 제공될 수 있다. 상기 제1 소스 드라이버(206a)는 상기 제1 증폭기(311)의 입력단에 배치되는 제1 디코더(321), 제2 증폭기(312)의 입력단에 배치되는 제2 디코더(322), 제3 증폭기(313)의 입력단에 배치되는 제3 디코더(323), 제4 증폭기(314)의 입력단에 배치되는 제4 디코더(324)를 포함할 수 있다.
상기 제1 디코더 내지 제4 디코더들(321, 322, 323, 324)은 제1 로직 회로(202a)로부터 표시 데이터 및 제1 표시 영역(161) 구동과 관련한 디지털 감마 값을 수신할 수 있다. 또한, 상기 제1 디코더 내지 제4 디코더들(321, 322, 323, 324)은 일반 감마 생성부(208)의 출력을 수신할 수 있다.
상기 일반 감마 생성부(208)는 예컨대, 제1 서브 픽셀(예: Red 서브 픽셀)의 색상과 관련한 아날로그 감마 값을 생성하여 제1 디코더(321)에 공급하는 제1 감마 생성부(208a), 제2 서브 픽셀 및 제4 서브 픽셀(예: Green 서브 픽셀)의 색상과 관련한 아날로그 감마 값을 생성하여 제2 디코더(322) 및 제4 디코더(324)에 공급하는 제2 감마 생성부(208c), 제3 서브 픽셀(예: Blue 서브 픽셀)의 색상과 관련한 아날로그 감마 값을 생성하여 제3 디코더(323)에 공급하는 제3 감마 생성부(208b)를 포함할 수 있다.
로직 회로(202)는 제1 로직 회로(202a) 및 제2 로직 회로(202b)를 포함할 수 있다. 한편, 상기 제1 로직 회로(202a) 및 제2 로직 회로(202b)는 표시 데이터 및 디지털 감마 값을 공급하는 제1 표시 영역(161) 및 제2 표시 영역(162) 별로 구분한 것으로, 하나의 집적 회로로 구성되거나, 2개의 로직 회로로 구성될 수도 있다. 상기 제1 로직 회로(202a)는 각각의 소스 라인들(Sn, Sn+1, Sn+2, Sn+3)에 공급할 표시 데이터를 채널별로 배치된 제1 디코더 내지 제4 디코더들(321, 322, 323, 324)에 공급할 수 있다. 상술한 설명에서는 하나의 픽셀(예: RGBG 서브 픽셀들의 그룹)을 예시하여 설명한 것으로, 복수개의 픽셀들이 배치된 제1 표시 영역(161)에서, 제1 로직 회로(202a)는 각 픽셀들에 대응하는 소스 라인들에 표시 데이터를 공급할 수 있다.
상기 제2 표시 영역(162)은 예컨대, 복수개의 게이트 라인들(Gn, Gn+1, Gn+2)과 소스 라인들(Sm, Sm+1, Sm+2, Sm+3)이 교차 배치되는 표시 영역을 포함할 수 있다. 상기 디스플레이 패널(160)은 상기 게이트 라인들(Gn, Gn+1, Gn+2) 및 소스 라인들(Sm, Sm+1, Sm+2, Sm+3)에 표시 데이터를 공급하는 제2 소스 드라이버(206b) 및 게이트 신호를 공급하는 게이트 드라이버(207)가 실장되는 비표시 영역을 더 포함할 수 있다. 또는, 상기 디스플레이 패널(160)의 비표시 영역에는 상술한 디스플레이 구동 회로(200)가 배치될 수도 있다. 상기 디스플레이 패널(160)의 비표시 영역에는 상기 제1 소스 드라이버(206a)와 상기 제2 소스 드라이버(206b)가 통합된 하나의 로직 회로가 배치될 수 있다. 또한, 상기 디스플레이 패널(160)의 비표시 영역에는 홀수 번째 게이트 라인들 구동을 위한 제1 게이트 드라이버와, 짝수 번째 게이트 라인들 구동을 위한 제2 게이트 드라이버가 배치될 수도 있다.
상기 제2 표시 영역(162)의 상기 게이트 라인들(Gn, Gn+1, Gn+2)은 제1 표시 영역(161)과 동일하게 예컨대, 홀수 게이트 라인들(Gn) 및 짝수 게이트 라인들(Gn+1)을 포함할 수 있다. 제1 표시 영역(161)과 동일하게 홀수 게이트 라인들(Gn) 및 짝수 게이트 라인들(Gn+1)은 교번적으로 게이트 신호가 공급될 수 있다. 한 실시 예에 따르면, 제2 표시 영역(162)에는 상기 홀수 게이트 라인들(Gn)(또는 짝수번째 게이트 라인들(Gn+1))에 RGBG 서브 픽셀들이 하나의 픽셀을 형성하며 반복적으로 배치될 수 있다. 즉, 제2 표시 영역(162)에는 일부 게이트 라인들에는 별도의 픽셀이 배치되지 않을 수 있다. 다양한 실시 예에 따르면, 제2 표시 영역(162)에서, 일부 소스 라인들에는 별도의 픽셀이 배치되지 않을 수 있다. 다양한 실시 예에 따르면, 제2 표시 영역(162)에서 일부 소스 라인들 및 일부 게이트 라인들에는 교번적으로 픽셀에 배치지 않은 영역이 포함될 수 있다.
상기 소스 라인들(Sm, Sm+1, Sm+2, Sm+3)은 Red 서브 픽셀이 교번적으로 배치되는 제5 채널(Sm), 제1 Green 서브 픽셀들이 배치되는 제6 채널(Sm+1), Blue 서브 픽셀이 배치되는 제7 채널(Sm+2), 제2 Green 서브 픽셀들이 배치되는 제8 채널(Sm+3)을 포함할 수 있다. 여기서, 상기 소스 라인들(Sm, Sm+1, Sm+2, Sm+3) 중 제2 표시 영역(162)에는 일부 서브 픽셀들이 배치되지 않을 수 있으며, 제2 표시 영역(162) 아래(또는 위에) 배치된 제1 표시 영역(161)에는 서브 픽셀들이 매트릭스 형태로 배치될 수 있다. 상기 소스 라인들(Sm, Sm+1, Sm+2, Sm+3)의 각 채널 끝단에는 제2 소스 드라이버(206b)의 증폭기들의 출력단과 연결되는 패드들이 배치될 수 있다. 상기 소스 라인들(Sm, Sm+1, Sm+2, Sm+3) 중 일부는 제2 표시 영역(162)에 배치되고, 나머지 일부는 제1 표시 영역(161)에 배치될 수 있다.
상기 제2 소스 드라이버(206b)는 예컨대, 소스 라인들(Sm, Sm+1, Sm+2, Sm+3) 중 제5 채널(Sm)에 신호를 공급하는 제5 증폭기(315), 제6 채널(Sm+1)에 신호를 공급하는 제6 증폭기(316), 제7 채널(Sm+2)에 신호를 공급하는 제7 증폭기(317), 제8 채널(Sm+3)에 신호를 공급하는 제8 증폭기(318)를 포함할 수 있다. 또한, 상기 제2 소스 드라이버(206b)는 상기 제5 증폭기(315)의 출력단에 연결되는 제5 스위치(305), 제6 증폭기(316)의 출력단에 연결되는 제6 스위치(306), 제7 증폭기(317)의 출력단에 연결되는 제7 스위치(307), 제8 증폭기(318)의 출력단에 연결되는 제8 스위치(308)를 포함할 수 있다. 각각의 스위치들의 제어 신호는 예컨대, 프로세서(140)의 제어 신호를 수신한 타이밍 컨트롤러로부터 제공될 수 있다. 상기 제2 소스 드라이버(206b)는 상기 제5 증폭기(315)의 입력단에 배치되는 제5 디코더(325), 제6 증폭기(316)의 입력단에 배치되는 제6 디코더(326), 제7 증폭기(317)의 입력단에 배치되는 제7 디코더(327), 제8 증폭기(318)의 입력단에 배치되는 제8 디코더(328)를 포함할 수 있다.
상기 제5 디코더 내지 제8 디코더들(325, 326, 327, 328)은 제2 로직 회로(202b)로부터 표시 데이터 및 제1 표시 영역(161)과 제2 표시 영역(162) 구동과 관련한 디지털 감마 값을 수신할 수 있다. 또한, 상기 제5 디코더 내지 제8 디코더들(325, 326, 327, 328)은 일반 감마 생성부(208)의 출력 및 추가 감마 생성부(209)의 출력을 수신할 수 있다.
상기 추가 감마 생성부(209)는 예컨대, 제2 표시 영역(162)에 배치된 서브 픽셀들의 색상과 관련한 아날로그 감마 값(또는 아날로그 감마 전압)을 생성하여 공통으로 제5 내지 제8 디코더들(325, 326, 327, 328)에 공급한다. 상기 추가 감마 생성부(209)가 공급하는 아날로그 감마 값은 제2 표시 영역(162)의 밝기가 주변 제1 표시 영역(161)의 밝기와 동일 또는 유사한 밝기를 가지도록 설정된 감마 값을 포함할 수 있다.
상기 제2 로직 회로(202b)는 각각의 소스 라인들(Sm, Sm+1, Sm+2, Sm+3)에 공급할 표시 데이터 및 디지털 감마 값을 채널별로 배치된 제5 디코더 내지 제8 디코더들(325, 326, 327, 328)에 공급할 수 있다. 예컨대, 제2 로직 회로(202b)는 제2 표시 영역(162) 구동과 관련한 게이트 신호가 공급되는 타이밍에 제2 표시 영역(162)에 공급할 표시 데이터 및 디지털 감마 값을 채널별로 배치된 제5 디코더 내지 제8 디코더들(325, 326, 327, 328)에 공급할 수 있다. 제2 로직 회로(202b)는 제2 표시 영역(162) 하부에 배치된 제1 표시 영역(161) 구동과 관련한 게이트 신호가 공급되는 타이밍에는 제2 표시 영역(162) 하부에 배치된 제1 표시 영역(161) 구동을 위한 표시 데이터 및 디지털 감마 값을 채널별로 배치된 제5 내지 제8 디코더들(325, 326, 327, 328)에 공급할 수 있다. 제2 표시 영역(162) 구동과 관련한 디지털 감마 값과 제1 표시 영역(161) 구동과 관련한 디지털 감마 값은 동일 소스 채널들이라 하더라도 다를 수 있다.
상기 제5 디코더 내지 제8 디코더들(325, 326, 327, 328)은 일반 감마 생성부(208)로부터 공급되는 8비트 계조 값들을 수신할 수 있는 입력단과, 추가 감마 생성부(209)로부터 공급되는 일정 개수의 계조 값들을 수신할 수 있는 입력단을 가지며, 수신된 계조 값들 중 하나를 증폭기들에 출력할 수 있다. 상기 추가 감마 생성부(209)는 예컨대, 일반 감마 생성부(208)와 동일하게 256개의 계조 값들을 제5 디코더 내지 제8 디코더들(325, 326, 327, 328)에 공통으로 공급할 수 있다. 또는, 일반 감마 생성부(208)는 일정 개수 예컨대, 128개수의 계조 값들만을 제5 디코더 내지 제8 디코더들(325, 326, 327, 328)에 공통으로 공급할 수 있다. 일반 감마 생성부(208)에서 생성되는 아날로그 감마 값은 도시된 그래프 중 제1 감마 곡선 영역(G1)에 기반하여 생성될 수 있다. 추가 감마 생성부(209)에서 생성되는 아날로그 감마 값은 도시된 그래프 중 제2 감마 곡선 영역(G2)에 기반하여 생성될 수 있다.
다양한 실시 예에 따르면, 일반 감마 생성부(208)의 출력단에는 스위치들이 배치될 수 있다. 예컨대, 각 제1 감마 생성부 내지 제3 감마 생성부(208a, 208b, 208c)의 출력단에 각각 제1 내지 제3 감마 출력 제어 스위치들(331, 332, 333)이 배치될 수 있다. 추가 감마 생성부(209)의 출력단에는 제4 감마 출력 제어 스위치(334)가 배치될 수 있다. 상기 제1 내지 제4 감마 출력 제어 스위치들(331, 332, 333, 334)은 타이밍 컨트롤러에 의해 제어될 수 있다. 예컨대, 제2 표시 영역(162) 구동 시에 제1 내지 제3 감마 출력 제어 스위치들(331, 332, 333)이 턴-오프되고, 제4 감마 출력 제어 스위치(334)가 턴온될 수 있다. 제1 표시 영역(161) 구동 시에 제1 내지 제3 감마 출력 제어 스위치들(331, 332, 333)이 턴-온되고, 제4 감마 출력 제어 스위치(334)는 턴-오프될 수 있다.
도 5는 한 실시 예에 따른 디스플레이 패널 및 디스플레이 구동 회로의 일부 구성의 한 예를 나타낸 도면이다.
도 5를 참조하면, 한 실시 예에 따른 전자 장치(100)의 일부 구성은 제1 표시 영역(161) 및 제2 표시 영역(162), 소스 드라이버(206), 일반 감마 생성부(208), 추가 감마 생성부(209), 제1 로직 회로(202a) 및 제2 로직 회로(202b)를 포함할 수 있다. 상술한 구성에서, 제1 표시 영역(161), 제2 표시 영역(162), 소스 드라이버(206), 일반 감마 생성부(208), 제1 로직 회로(202a), 제2 로직 회로(202b)는 도 4에서 설명한 각 구성들과 실질적으로 동일한 구성일 수 있다. 소스 드라이버(206)는 제1 로직 회로(202a)로부터 표시 데이터 및 디지털 감마 값을 수신하는 제1 소스 드라이버(206a) 및 제2 로직 회로(202b)로부터 표시 데이터 및 디지털 감마 값을 수신하는 제2 소스 드라이버(206b)를 포함할 수 있다. 또는, 제1 소스 드라이버(206a)는 제1 표시 영역(161)에만 배치된 소스 라인들에 신호를 공급하는 디코더들과 증폭기들을 포함하고, 제2 소스 드라이버(206b)는 제2 표시 영역(162) 및 제1 표시 영역(161)에 배치된 소스 라인들에 신호를 공급하는 디코더들과 증폭들을 포함할 수 있다.
상기 전자 장치(100)의 디스플레이 패널(160)은 예컨대, 제1 픽셀 배치 밀도를 가지는 제1 표시 영역(161)과, 제2 픽셀 배치 밀도를 가지는 제2 표시 영역(162)을 포함할 수 있다. 상기 제1 표시 영역(161)은 예컨대, 상기 제2 표시 영역(162)의 인접된 영역에 배치될 수 있다. 한 실시 예에 따르면, 제2 표시 영역(162)에 배치된 적어도 하나의 게이트 라인 및 적어도 하나의 소스 라인은 제1 표시 영역(161)에 배치된 게이트 라인들 및 소스 라인들 중 일부 게이트 라인 및 일부 소스 라인과 연결될 수 있다. 예를 들어, 소스 라인들(Sm, Sm+1, Sm+2, Sm+3)에는 제2 표시 영역(162)과 제1 표시 영역(161)이 배치될 수 있다.
상기 추가 감마 생성부(209)는 제2 표시 영역(162)에 배치된 소스 라인들(Sm, Sm+1, Sm+2, Sm+3) 중 Red 서브 픽셀이 배치되는 제5 채널(Sm)에 연결된 제5 디코더(325)에 아날로그 감마 값을 공급하는 제1 추가 감마 생성부(209a), 제1 Green 서브 픽셀들이 배치되는 제6 채널(Sm+1) 및 제2 Green 서브 픽셀들이 배치되는 제8 채널(Sm+3)에 각각 연결된 제6 디코더(326) 및 제8 디코더(328)에 아날로그 감마 값을 공급하는 제2 추가 감마 생성부(209c), Blue 서브 픽셀이 배치되는 제7 채널(Sm+2)에 연결된 제7 디코더(327)에 아날로그 감마 값을 공급하는 제3 추가 감마 생성부(209b)를 포함할 수 있다. 여기서, 상기 소스 라인들(Sm, Sm+1, Sm+2, Sm+3) 중 제2 표시 영역(162)에는 일부 서브 픽셀들이 배치되지 않을 수 있으며, 제2 표시 영역(162) 아래(또는 위에) 배치된 제1 표시 영역(161)에는 서브 픽셀들이 매트릭스 형태로 배치될 수 있다. 상기 소스 라인들(또는 소스 채널들)(Sm, Sm+1, Sm+2, Sm+3)의 각 채널 끝단에는 제2 소스 드라이버(206b)의 증폭기들의 출력단과 연결되는 패드들이 배치될 수 있다.
상기 제1 추가 감마 생성부(209a)는 제5 채널(Sm) 중 제2 표시 영역(162)에 배치된 서브 픽셀들의 구동과 관련한 아날로그 감마 값을 생성하고, 제2 표시 영역(162)이 구동되는 타이밍 예컨대, 제2 표시 영역(162)에 게이트 신호가 공급되는 타이밍에 상기 아날로그 감마 값을 제5 디코더(325)에 공급할 수 있다. 상기 제2 추가 감마 생성부(209c)는 제6 채널(Sm+1) 및 제8 채널(Sm+3) 중 제2 표시 영역(162)에 배치된 서브 픽셀들의 구동과 관련한 아날로그 감마 값을 생성할 수 있다. 제2 추가 감마 생성부(209c)는 생성된 아날로그 감마 값을 제2 표시 영역(162)에 게이트 신호가 공급되는 타이밍에 제6 디코더(326) 및 제8 디코더(328)에 공급할 수 있다. 상기 제3 추가 감마 생성부(209b)는 제7 채널(Sm+2) 중 제2 표시 영역(162)에 배치된 서브 픽셀들의 구동과 관련한 아날로그 감마 값을 생성할 수 있다. 제3 추가 감마 생성부(209b)는 생성된 아날로그 감마 값을 제2 표시 영역(162)에 게이트 신호가 공급되는 타이밍에 제7 디코더(327)에 공급할 수 있다. 제1 내지 제3 추가 감마 생성부들(209a, 209c, 209b)에서 생성된 아날로그 감마 값들은 제1 내지 제3 감마 생성부들(208a, 208c, 208b)에서 생성된 아날로그 감마 값들에 비하여, 특정 픽셀이 상대적으로 높은 휘도를 낼 수 있는 값을 생성할 수 있다. 예컨대, 상기 추가 감마 생성부(209)가 공급하는 아날로그 감마 값은, 동일 컨텐츠를 표시하는 영역 제2 표시 영역(162)의 밝기가 주변 제1 표시 영역(161)의 밝기와 동일 또는 유사한 밝기를 가지도록 설정된 감마 값을 포함할 수 있다.
상기 제5 디코더(325)에는 일반 감마 생성부(208) 중 제1 감마 생성부(208a) 및 제1 추가 감마 생성부(209a)의 출력이 공급될 수 있다. 또한, 제2 로직 회로(202b)는 소스 라인들(Sm, Sm+1, Sm+2, Sm+3)에 공급할 표시 데이터를 제5 내지 제8 디코더들(325, 326, 327, 328)에 공급할 수 있다. 상기 제2 로직 회로(202b)는 제5 채널(Sm)의 제2 표시 영역(162) 구동을 위한 디지털 감마 값, 제6 채널(Sm+1) 및 제8 채널(Sm+3)의 제2 표시 영역(162) 구동을 위한 디지털 감마 값, 제7 채널(Sm+2)의 제2 표시 영역(162) 구동을 위한 디지털 감마 값을 각각 제5 내지 제8 디코더들(325, 326, 327, 328)에 공급할 수 있다. 또한, 상기 제2 로직 회로(202b)는 제5 채널(Sm)의 제1 표시 영역(161) 구동을 위한 디지털 감마 값, 제6 채널(Sm+1) 및 제8 채널(Sm+3)의 제1 표시 영역(161) 구동을 위한 디지털 감마 값, 제7 채널(Sm+2)의 제1 표시 영역(161) 구동을 위한 디지털 감마 값을 각각 제5 내지 제8 디코더들(325, 326, 327, 328)에 공급할 수 있다. 여기서, 제2 표시 영역(162)의 각 채널에 공급되는 디지털 감마 값과, 제1 표시 영역(161)의 각 채널에 공급되는 디지털 감마 값은 동일 컨텐츠에 대해서 다른 값으로 설정될 수 있다. 예컨대, 제2 표시 영역(162)의 각 채널에 공급되는 디지털 감마 값이, 제1 표시 영역(161)의 각 채널에 공급되는 디지털 감마 값에 비하여 상대적으로 동일 컨텐츠에 대해 더 밝게 표시하도록 설정된 값을 포함할 수 있다.
한편, 상술한 설명에서는 제1 표시 영역(161)만 배치된 디스플레이 패널 구동을 위한 제1 로직 회로(202a)와, 제1 표시 영역(161) 및 제2 표시 영역(162)이 배치된 디스플레이 패널 구동을 위한 제2 로직 회로(202b)가 각각 분리된 형태를 예로 하여 설명하였으나, 본 발명이 이에 한정되는 것은 아니다. 예컨대, 로직 회로는 물리적으로 하나의 구성으로 마련되고, 각 디스플레이 패널(160)의 영역별로 요구되는 신호들을 생성하여 공급할 수도 있다. 제2 표시 영역(162) 구동과 관련한 디지털 감마 값과 제1 표시 영역(161) 구동과 관련한 디지털 감마 값은 동일 소스 채널들이라 하더라도 다를 수 있다.
다양한 실시 예에 따르면, 추가적으로 또는 대체적으로, 제1 내지 제3 추가 감마 생성부들(209a, 209c, 209b)의 출력단과 제5 내지 제8 디코더들(325, 326, 327, 328) 사이에는 스위치들이 배치될 수 있다. 또한, 일반 감마 생성부(208)의 출력단과 제5 내지 제8 디코더들(325, 326, 327, 328) 사이에도 스위치들이 배치될 수 있다. 상기 감마 생성부들과 디코더들 사이에 배치된 스위치들은 제1 표시 영역(161) 구동 및 제2 표시 영역(162) 구동과 관련하여 구분되게 동작할 수 있다. 예컨대, 제2 표시 영역(162) 구동과 관련하여, 타이밍 컨트롤러 제어에 따라 일반 감마 생성부(208)의 출력단과 제5 내지 제8 디코더들(325, 326, 327, 328) 사이에 배치된 스위치들은 턴-오프 상태를 가지며, 추가 감마 생성부(209)의 출력단과 제5 내지 제8 디코더들(325, 326, 327, 328) 사이에 배치된 스위치들은 턴-온 상태를 가질 수 있다. 제1 표시 영역(161) 구동과 관련하여, 타이밍 컨트롤러 제어에 따라 일반 감마 생성부(208)의 출력단과 제5 내지 제8 디코더들(325, 326, 327, 328) 사이에 배치된 스위치들은 턴-온 상태를 가지며, 추가 감마 생성부(209)의 출력단과 제5 내지 제8 디코더들(325, 326, 327, 328) 사이에 배치된 스위치들은 턴-오프 상태를 가질 수 있다.
도 6은 한 실시 예에 따른 디스플레이 패널 및 디스플레이 구동 회로의 일부 구성의 한 예를 나타낸 도면이다.
도 6을 참조하면, 한 실시 예에 따른 전자 장치(100)의 일부 구성은 제1 표시 영역(161) 및 제2 표시 영역(162), 소스 드라이버(206), 감마 생성부(208_1), 제1 로직 회로(202a) 및 제2 로직 회로(202b)를 포함할 수 있다. 상술한 구성에서, 제1 표시 영역(161), 제2 표시 영역(162), 소스 드라이버(206), 제1 로직 회로(202a), 제2 로직 회로(202b)는 도 4에서 설명한 각 구성들과 실질적으로 동일한 구성일 수 있다. 상기 소스 드라이버(206)는 제1 표시 영역(161) 및 제1 로직 회로(202a) 사이에 배치되는 제1 소스 드라이버(206a) 및 제2 표시 영역(162)과 제1 표시 영역(161) 및 제2 로직 회로(202b) 사이에 배치되는 제2 소스 드라이버(206b)를 포함할 수 있다. 한편, 상기 제1 소스 드라이버(206a) 및 제2 소스 드라이버(206b)는 영역별로 구분한 것으로, 하나의 소스 드라이버에 통합되어 구현될 수 있다.
상기 전자 장치(100)의 디스플레이 패널(160)은 예컨대, 제1 픽셀 배치 밀도를 가지는 제1 표시 영역(161)과, 제2 픽셀 배치 밀도를 가지는 제2 표시 영역(162)을 포함할 수 있다. 예컨대, 제1 표시 영역(161)에는 소스 라인들(Sn, Sn+1, Sn+2, Sn+3)이 배치되고, 제2 표시 영역(162) 및 제1 표시 영역(161)이 상하로 배치된 영역(디스플레이 패널(160)의 y축을 기준으로 상기 제1 표시 영역(161)은 제2 표시 영역(162) 하부에 배치되며, 상기 제2 표시 영역(162)은 상기 제1 표시 영역(161)보다 상부에 배치될 수 있으며, 제1 표시 영역(161) 및 제2 표시 영역(162)은 동일 평면 상에 배치됨)은 소스 라인들(Sm, Sm+1, Sm+2, Sm+3)이 배치될 수 있다.
상기 감마 생성부(208_1)는 제1 감마 생성부(208a), 제2 감마 생성부(208c) 및 추가 감마 생성부(208E)를 포함할 수 있다.
제1 감마 생성부(208a) 및 제2 감마 생성부(208c)는 제1 표시 영역(161)에 배치된 소스 라인들(Sn, Sn+1, Sn+2, Sn+3) 및 제2 표시 영역(162)과 제1 표시 영역(161)에 배치된 소스 라인들(Sm, Sm+1, Sm+2, Sm+3)에 각각 아날로그 감마 전압을 공급할 수 있다. 예를 들어, 제1 감마 생성부(208a)는 제1 표시 영역(161)에 배치된 Red 서브 픽셀과 Blue 서브 픽셀에 공급할 아날로그 감마 전압을 생성하고, 생성된 아날로그 감마 전압을 Red 서브 픽셀 및 Blue 서브 픽셀과 연결되는 디코더들(예: 제1 디코더(321) 및 제3 디코더(323))에 각각 공급될 수 있다. 제2 감마 생성부(208c)는 제1 표시 영역(161)에 배치된 제1 Green 서브 픽셀과 제2 Green 서브 픽셀에 공급할 아날로그 감마 전압을 생성하고, 생성된 아날로그 감마 전압을 제1 Green 서브 픽셀 및 제2 Green 서브 픽셀에 연결된 디코더들(예: 제2 디코더(322) 및 제4 디코더(324))에 각각 공급될 수 있다. 상기 제1 감마 생성부(208a)의 아날로그 감마 전압 공급과 관련하여, 스위치를 포함할 수 있다. 예컨대, 제1 감마 생성부(208a)의 출력단과 제3 디코더(323) 사이에 스위치가 배치될 수 있다.
상기 추가 감마 생성부(208E)는 제2 표시 영역(162)과 제1 표시 영역(161)에 배치된 소스 라인들(Sm, Sm+1, Sm+2, Sm+3)에 각각 아날로그 감마 전압을 공급할 수 있다. 예를 들어, 추가 감마 생성부(208E)는 제2 표시 영역(162)에 배치된 서브 픽셀들에 연결된 디코더들(예: 제5 내지 제8 디코더들(325, 326, 327, 328)) 각각에 공급할 공통 아날로그 감마 전압을 생성하고, 생성된 공통 아날로그 감마 전압을 제5 내지 제8 디코더들(325, 326, 327, 328)에 공급할 수 있다.
상기 감마 생성부(208_1)의 감마 전압 공급 제어와 관련하여, 소스 드라이버(206)는 복수의 스위치들을 포함할 수 있다. 예를 들어, 소스 드라이버(206)는 제1 감마 생성부(208a)의 출력단과 제5 디코더(325) 사이에 배치되는 스위치, 제1 감마 생성부(208a)의 출력단과 제7 디코더(327) 사이에 배치되는 스위치, 제2 감마 생성부(208c)의 출력단과 제6 디코더(326) 사이에 배치되는 스위치, 제2 감마 생성부(208c)의 출력단과 제8 디코더(328) 사이에 배치되는 스위치를 더 포함할 수 있다. 또한, 상기 소스 드라이버(206)는 추가 감마 생성부(208E)의 출력단에 배치되는 스위치를 더 포함할 수 있다. 상기 스위치들은 타이밍 컨트롤러의 제어에 따라 턴-온 또는 턴-오프될 수 있다. 예컨대, 제2 표시 영역(162)에 아날로그 감마 전압이 공급되는 타이밍에 제1 감마 생성부(208a)의 출력단 및 제2 감마 생성부(208c)의 출력단에 연결된 스위치들은 턴-오프 상태를 가지며, 추가 감마 생성부(208E)의 출력단에 배치되는 스위치는 턴-온 상태를 가질 수 있다. 한 실시 예에 따르면, 제1 표시 영역(161)에 아날로그 감마 전압이 공급되는 타이밍에 제1 감마 생성부(208a)의 출력단 및 제2 감마 생성부(208c)의 출력단에 연결된 스위치들은 턴-온 상태를 가지며, 추가 감마 생성부(208E)의 출력단에 배치되는 스위치는 턴-오프 상태를 가질 수 있다.
제5 내지 제8 디코더들(325, 326, 327, 328)은 로직 회로(202)(예: 제2 로직 회로(202b))의 출력과, 감마 생성부(208_1)의 출력을 입력으로 수신하고, 증폭기들 각각에 신호를 공급할 수 있다. 한 실시 예에 따르면, 제5 디코더(325) 및 제7 디코더(327)는 제1 감마 생성부(208a) 및 추가 감마 생성부(208E)의 아날로그 감마 전압과, 제2 로직 회로(202b)가 공급하는 표시 데이터 및 해당 서브 픽셀 구동을 위한 디지털 감마 값 수신할 수 있다. 제6 디코더(326) 및 제8 디코더(328)는 제2 감마 생성부(208c) 및 추가 감마 생성부(208E)의 아날로그 감마 전압과, 제2 로직 회로(202b)가 공급하는 표시 데이터 및 해당 서브 픽셀 구동을 위한 디지털 감마 값 수신할 수 있다.
도 7은 한 실시 예에 따른 디스플레이 구동 회로의 일부 구성의 한 예를 나타낸 도면이다.
도 7을 참조하면, 한 실시 예에 따른 디스플레이 구동 회로(200)의 일부 구성은 일반 감마 생성부(208), 추가 감마 생성부(209), 디코더(320), 로직 회로(202) 및 증폭기(310)를 포함할 수 있다.
상기 증폭기(310)는 소스 드라이버에 배치된 적어도 하나의 증폭기를 포함할 수 있다. 상기 증폭기(310)의 출력은 패드(pad)를 거쳐 디스플레이 패널(160)에 공급될 수 있다. 상기 증폭기(310)는 디코더(320)의 출력을 수신하고, 수신된 출력을 지정된 비율로 증폭한 후, 디스플레이 패널(160)에 공급할 수 있다.
상기 로직 회로(202)는 상기 디코더(320)에 표시 데이터 및 디지털 감마 값을 공급함과 아울러, 상기 디코더(320)의 출력을 제어하는 제어 신호를 공급할 수 있다. 한 실시 예에 따르면, 로직 회로(202)는 디코더(320)에 8비트 이상의 제어 신호를 공급할 수 있다.
상기 디코더(320)는 로직 회로(202)의 출력 및 일반 감마 생성부(208)의 출력 또는 추가 감마 생성부(209)의 출력을 수신하고, 수신된 출력에 기반하여 지정된 신호 값을 증폭기(310)에 출력할 수 있다. 한 실시 예에 따르면, 상기 디코더(320)는 예컨대, 일반 감마 생성부(208)의 출력(예: V0, V1, V2, …, V255)을 입력으로 수신할 수 있다. 또한, 상기 디코더(320)는 추가 감마 생성부(209)의 출력(예: Vm, …, Vm+1)을 입력으로 수신할 수 있다. 상기 디코더(320)는 소스 드라이버에 배치되어 서브 픽셀별로 연결된 디코더들 중 어느 하나일 수 있다.
상기 일반 감마 생성부(208)는 지정된 계조 값에 해당하는 아날로그 감마 전압을 생성하고, 생성된 아날로그 감마 전압을 디코더(320)에 공급할 수 있다. 예컨대, 디스플레이 패널(160)이 256개의 계조 값을 적용하도록 설정된 경우, 일반 감마 생성부(208)는 256개의 계조 값에 해당하는 아날로그 감마 전압을 디코더(320)에 공급하기 위하여, 256개의 신호 라인들을 포함할 수 있다.
상기 추가 감마 생성부(209)는 디스플레이 패널 중 제2 표시 영역(162)에 배치된 서브 픽셀들의 아날로그 감마 전압 공급을 생성하고, 생성된 아날로그 감마 전압을 디코더(320)에 공급할 수 있다. 상기 추가 감마 생성부(209)가 생성하는 아날로그 감마 전압의 계조 값 개수는 설정에 따라 다를 수 있다. 예컨대, 상기 추가 감마 생성부(209)는 일반 감마 생성부(208)와 동일하게 256개의 아날로그 감마 전압 중 어느 하나의 아날로그 감마 전압을 생성할 수 있다. 여기서, 추가 감마 생성부(209)가 생성한 아날로그 감마 값의 크기는 일반 감마 생성부(208)가 생성한 아날로그 감마 값과 다를 수 있다. 예를 들어, 추가 감마 생성부(209)가 생성한 아날로그 감마 값의 크기가 일반 감마 생성부(208)가 생성한 아날로그 감마 값보다 클(예: 2배 이상) 수 있다. 다양한 실시 예에 따르면, 추가 감마 생성부(209)가 생성하는 계조 값의 개수는 256개보다 작은 개수 예컨대, 128개일 수 있다. 상기 128개의 계조 값은 예컨대, 상대적으로 고계조의 계조 값들을 포함할 수 있다. 이에 따라, 추가 감마 생성부(209)는 프로세서(140) 제어에 따라 제2 표시 영역(162)에 지정된 크기 이상의 계조 값 표현(예: 128계조 이상의 아날로그 감마 전압)이 필요한 경우, 아날로그 감마 전압을 생성하여 디코더(320)에 공급할 수 있다. 한 실시 예에 따르면, 제2 표시 영역(162)에 지정된 크기 미만의 계조 값 표현(예: 127계조 이하의 아날로그 감마 전압)이 필요한 경우, 프로세서(140) 제어에 따라, 일반 감마 생성부(208)가 신호를 아날로그 감마 전압을 생성하여 디코더(320)에 공급할 수 있다.
도 8은 한 실시 예에 따른 디스플레이 구동 회로의 일부 구성의 다른 예를 나타낸 도면이다.
도 8을 참조하면, 한 실시 예에 따른 디스플레이 구동 회로(200)의 일부 구성은 일반 감마 생성부(208), 추가 감마 생성부(209), 디코더(320), 로직 회로(202) 및 증폭기(310)를 포함할 수 있다.
상기 증폭기(310)는 소스 드라이버에 배치된 서브 픽셀별 적어도 하나의 증폭기를 포함할 수 있다. 상기 증폭기(310)의 출력은 패드(pad)를 거쳐 디스플레이 패널(160)에 공급될 수 있다. 상기 증폭기(310)는 디코더(320)의 출력을 수신하고, 수신된 출력을 지정된 비율로 증폭한 후, 디스플레이 패널(160)에 공급할 수 있다.
상기 로직 회로(202)는 상기 디코더(320)에 표시 데이터 및 디지털 감마 값을 공급함과 아울러, 상기 디코더(320)의 출력을 제어하는 제어 신호를 공급할 수 있다. 한 실시 예에 따르면, 로직 회로(202)는 디코더(320)에 8비트의 제어 신호를 공급할 수 있다. 상기 로직 회로(202)는 제2 표시 영역(162)에 신호가 공급되는 타이밍에 추가 감마 생성부(209)에서 생성한 신호가 공급되도록 제어하고, 제1 표시 영역(161)에 신호가 공급되는 타이밍에 일반 감마 생성부(208)에서 생성한 신호가 공급되도록 제어할 수 있다.
상기 디코더(320)는 로직 회로(202)의 출력 및 일반 감마 생성부(208)의 출력 또는 추가 감마 생성부(209)의 출력을 수신하고, 수신된 출력에 기반하여 지정된 신호 값을 증폭기(310)에 출력할 수 있다. 한 실시 예에 따르면, 상기 디코더(320)는 예컨대, 일반 감마 생성부(208)의 출력(예: V0, V1, V2, …, Vn, Vn+1, Vn_2, …, V255)을 입력으로 수신할 수 있다. 또한, 상기 디코더(320)는 추가 감마 생성부(209)의 출력(예: Vn`, Vn+1`, Vn+2`, …, V255)을 입력으로 수신할 수 있다. 상기 디코더(320)는 소스 드라이버에 배치되어 서브 픽셀별로 연결된 디코더들 중 어느 하나일 수 있다. 상기 디코더(320)의 일반 감마 생성부(208)로부터의 입력 중 일부는 상기 추가 감마 생성부(209)로부터의 입력과 중첩되고, 일반 감마 생성부(208) 및 추가 감마 생성부(209) 중 어느 하나의 신호가 디코더(320)의 입력으로 공급될 수 있다. 이와 관련하여, 일반 감마 생성부(208)의 출력 중 일부는 추가 감마 생성부(209)의 출력과 Mux(또는 스위치)로 연결될 수 있다. 상기 Mux(Mn, Mn+1, Mn+2, …, M255)는 추가 감마 생성부(209)의 출력 개수에 대응하는 개수를 가질 수 있다.
상기 일반 감마 생성부(208)는 지정된 계조 값에 해당하는 아날로그 감마 전압을 생성하고, 생성된 아날로그 감마 전압을 디코더(320)에 공급할 수 있다. 예컨대, 디스플레이 패널(160)이 256개의 계조 값을 적용하도록 설정된 경우, 일반 감마 생성부(208)는 256개의 계조 값에 해당하는 아날로그 감마 전압을 디코더(320)에 공급하기 위하여, 256개의 신호 라인들을 포함할 수 있다.
상기 추가 감마 생성부(209)는 디스플레이 패널 중 제2 표시 영역(162)에 배치된 서브 픽셀들의 아날로그 감마 전압 공급을 생성하고, 생성된 아날로그 감마 전압을 디코더(320)에 공급할 수 있다. 이때, 상기 추가 감마 생성부(209)의 출력은 일반 감마 생성부(208)의 일부 출력과 중첩되고, Mux(Mn, Mn+1, Mn+2, ..., M255)를 통해 어느 하나의 출력이 디코더(320)에 공급될 수 있다. 상기 추가 감마 생성부(209)가 생성한 계조의 수는 설정 값에 따라 달라질 수 있다. 예컨대, 추가 감마 생성부(209)는 상대적으로 고 계조의 계조 값들에 해당하는 아날로그 감마 값들(예: 128계조 이상) 중 어느 하나를 생성하여 디코더(320)에 공급할 수 있다. 동일한 계조로 표시되더라도, 추가 감마 생성부(209)가 생성한 아날로그 감마 값의 크기는 일반 감마 생성부(208)가 생성한 아날로그 감마 값과 다를 수 있다.
도 9는 한 실시 예에 다른 소스 드라이버의 출력의 한 예를 나타낸 도면이다.
도 9를 참조하면, 소스 드라이버(206)는 하나의 수직 동기 신호 동안 복수의 수평 동기 신호에 따라 신호를 디스플레이 패널(160)에 공급할 수 있다. 소스 드라이버(206)의 R, G, B 감마 셋은 일정 개수의 수평 동기 신호 동안 턴-온 상태를 유지할 수 있다. 제1 표시 영역(161)에는 Rn Source Output, Gn Source Output, Bn Source Output에 해당하는 소스 신호가 공급될 수 있다. 상기 제1 표시 영역(161)에 공급되는 소스 신호의 출력 진폭은 예컨대, 제1 크기(901)를 가질 수 있다. 제2 표시 영역(162)에는 Rn` Source Output, Gn` Source Output, Bn` Source Output에 해당하는 소스 신호가 공급될 수 있다. 상기 제2 표시 영역(162)에 공급되는 소스 신호의 출력 진폭은 예컨대, 상기 제1 크기(901)보다 큰 제2 크기(902)를 가질 수 있다. 상기 제1 크기(901)와 제2 크기(902)의 차이는 상기 제2 표시 영역(162)에 배치되는 픽셀 배치 밀도에 따라 달라질 수 있다. 또는, 상기 제1 크기(901) 및 제2 크기(902)의 차이는 표시되는 컨텐츠의 밝기에 따라 달라질 수 있다. 또는, 제1 크기(901) 및 제2 크기(902)의 차이는 외부 조도에 따라 다를 수 있다. 예컨대, 상대적으로 어두운 컨텐츠 또는 저계조의 컨텐츠를 표시할 경우에 비하여 상대적으로 밝은 컨텐츠 또는 고계조의 컨텐츠를 표시할 경우의 제1 크기(901) 및 제2 크기(902)의 차이가 더 클 수 있다.
도 10은 한 실시 예에 따른 제2 표시 영역의 다양한 형태를 포함하는 디스플레이 패널의 예를 나타낸 도면이다.
도 10을 참조하면, 한 실시 예에 따른 디스플레이 패널(160)은 1001 상태에서와 같이, 제1 표시 영역(161) 및 상단 중앙에 일정 크기를 포함하는 제2 표시 영역(162_1)을 포함할 수 있다. 상기 제2 표시 영역(162_1)은 예컨대, 도시된 도면을 기준으로 수평 방향(예: x축 방향)으로 제1 폭(T1)을 포함하며, 수직 방향(예: y축 방향)으로 일정 길이를 가질 수 있다. 제2 표시 영역(162_1)의 적어도 일부는 디스플레이 패널(160)의 상측 가장자리 일부를 포함할 수 있다. 상기 제2 표시 영역(162_1)의 하부(예: z축 방향)에는 예컨대, 전자 장치(100)의 적어도 하나의 센서(예: 카메라 센서, 지문 센서, 근조도 센서, 홍채 센서 중 적어도 하나)가 배치될 수 있다. 상기 제2 표시 영역(162_1)은 디스플레이 패널(160)의 가장자리 부분에 인접된 부분(1001)을 제외하고 다른 부분은 라운딩될 수 있다. 상기 제2 표시 영역(162_1)은 디스플레이 패널(160)의 가장자리 인접 부분(1001)을 제외하고 나머지 영역이 제1 표시 영역(161)에 의해 감싸지도록 배치될 수 있다.
한 실시 예에 따른 디스플레이 패널(160)은 1002 상태에서와 같이, 제1 표시 영역(161) 및 상단 중앙에 일정 크기를 포함하는 제2 표시 영역(162_2)을 포함할 수 있다. 상기 제2 표시 영역(162_2)의 상단 일부는 디스플레이 패널(160)의 상측 가장자리 일부를 포함할 수 있다. 상기 제2 표시 영역(162_2)의 상단 가장자리 일부 영역을 포함하고, 전체적으로 사각형의 형상으로 형성될 수 있다.
한 실시 예에 따른 디스플레이 패널(160)은 1003 상태에서와 같이, 제1 표시 영역(161) 및 상단 중앙에 일정 크기를 포함하는 제2 표시 영역(162_3)을 포함할 수 있다. 상기 제2 표시 영역(162_3)의 상단 일부는 디스플레이 패널(160)의 상측 가장자리 일부를 포함할 수 있다. 상기 제2 표시 영역(162_3)의 상단 가장자리 일부 영역은 제2 폭(T2)으로 형성될 수 있다. 제2 표시 영역(162_3)은 전체적으로 사각형의 형상으로 형성될 수 있으며, 라운딩될 수 있다.
한 실시 예에 따른 디스플레이 패널(160)은 1004 상태에서와 같이, 제1 표시 영역(161) 및 상단 중앙에 일정 크기를 포함하는 제21 표시 영역(162_4a) 및 제22 표시 영역(162_4b)을 포함할 수 있다. 상기 제21 표시 영역(162_4a) 및 제22 표시 영역(162_4b)은 각각 일정 크기의 원형 형태를 가질 수 있다. 상기 제21 표시 영역(162_4a) 및 상기 제22 표시 영역은 제1 표시 영역(161)에 의해 둘러싸이도록 배치될 수 있다. 제21 표시 영역(162_4a) 및 상기 제22 표시 영역(162_4b)은 일정 간격으로 배치될 수 있다. 상기 제21 표시 영역(162_4a) 및 상기 제22 표시 영역(162_4b) 각각의 하부(z축 방향)에는 센서들이 각각 배치될 수 있다.
한 실시 예에 따른 디스플레이 패널(160)은 1005 상태에서와 같이, 제1 표시 영역(161) 및 상단 우측에 일정 크기를 포함하는 제2 표시 영역(162_5)을 포함할 수 있다. 상기 제2 표시 영역(162_5)은 x축이 y축보다 더 긴 일정 크기의 타원 형상 또는 모서리가 라운딩된 사각형 형상으로 마련될 수 있다. 제2 표시 영역(162_5) 하부(z축 방향)에는 복수개의 센서가 배치될 수 있다. 예컨대, 제2 표시 영역(162_5) 하부에 지문 센서 및 카메라가 각각 배치될 수 있다. 또는, 제2 표시 영역(162_5) 하부에 홍채 센서 및 RGB 카메라가 각각 배치될 수 있다.
도 11은 한 실시 예에 따른 디스플레이 구동 회로에서의 추가 감마 구동부가 좌측에 배치되는 예를 나타낸 도면이다.
도 11을 참조하면, 디스플레이 구동 회로(200)는 앞서 언급한 바와 같이, 로직 회로(202), 소스 드라이버(206), 게이트 드라이버(207), 그래픽 메모리(203)를 포함하며, 도시된 도면에서는 설명의 편의를 위하여, 일반 감마 생성부(208) 및 추가 감마 생성부(209)를 포함하는 일부 구성만을 도시한 것이다. 디스플레이 패널(160)은 예컨대, 상대적으로 더 적은 픽셀 배치 밀도를 가지는 제2 표시 영역(162)과 상대적으로 더 많은 픽셀 배치 밀도를 가지는 제1 표시 영역(161)이 동일한 소스 라인을 공유하는 영역과, 제1 표시 영역(161)만을 포함하는 영역을 포함할 수 있다. 도시된 도면에서는, 디스플레이 패널(160)의 좌측 영역에 제2 표시 영역(162)과 제1 표시 영역(161)이 배치된 형상을 나타낸 것이다.
디스플레이 구동 회로(200)는 아날로그 감마 전압의 공급 루트를 최적화하기 위하여, 추가 감마 생성부(209)가 좌측에 치우쳐 배치될 수 있다. 추가 감마 생성부(209)가 생성한 아날로그 감마 전압은 제2 표시 영역(162)에 신호가 공급되는 타이밍에 제2 표시 영역(162)과 관련한 소스 드라이버의 디코더들에게 공급될 수 있다. 일반 감마 생성부(208)는 예컨대, 디스플레이 구동 회로(200)의 중심부에 배치되어, 좌측에서부터 우측까지 고르게 배치된 제1 표시 영역(161)과 관련한 디코더들에 아날로그 감마 전압을 생성하여 공급할 수 있다. 상기 제2 표시 영역(162)의 하부(예: 디스플레이 패널(160)로부터 광이 조사되는 방향과 반대된 방향)에는 적어도 하나의 센서가 배치될 수 있다. 디스플레이 패널(160)의 제1 표시 영역(161)은 디스플레이 패널(160) 전체에 고르게 배치되고, 제2 표시 영역(162)은 제1 표시 영역(161) 내에 적어도 일부가 배치될 수 있다. 이에 따라, 제2 표시 영역(162)의 적어도 일부는 제1 표시 영역(161)에 의해 감싸지도록 배치될 수 있다.
도 12는 한 실시 예에 따른 디스플레이 구동 회로에서의 추가 감마 구동부가 중앙에 배치되는 예를 나타낸 도면이다.
도 12를 참조하면, 디스플레이 구동 회로(200)는 앞서 언급한 바와 같이, 로직 회로(202), 소스 드라이버(206), 게이트 드라이버(207), 그래픽 메모리(203)를 포함하며, 도시된 도면에서는 설명의 편의를 위하여, 일반 감마 생성부(208) 및 추가 감마 생성부(209)를 포함하는 일부 구성만을 도시한 것이다. 디스플레이 패널(160)은 예컨대, 상대적으로 더 적은 픽셀 배치 밀도를 가지는 제2 표시 영역(162)과 상대적으로 더 많은 픽셀 배치 밀도를 가지는 제1 표시 영역(161)이 동일한 소스 라인을 공유하는 영역과, 제1 표시 영역(161)만을 포함하는 영역을 포함할 수 있다. 도시된 도면에서는, 디스플레이 패널(160)의 중앙 영역에 제2 표시 영역(162)과 제1 표시 영역(161)이 배치된 형상을 나타낸 것이다.
디스플레이 구동 회로(200)는 아날로그 감마 전압의 공급 루트를 최적화하기 위하여, 디스플레이 패널(160)의 중앙에 배치된 제2 표시 영역(162)에 아날로그 감마 전압을 공급하도록 추가 감마 생성부(209)가 중앙에 배치될 수 있다. 추가 감마 생성부(209)가 생성한 아날로그 감마 전압은 제2 표시 영역(162)에 신호가 공급되는 타이밍에 제2 표시 영역(162)과 관련한 소스 드라이버의 디코더들에게 공급될 수 있다. 일반 감마 생성부(208)는 예컨대, 디스플레이 구동 회로(200)의 중앙에 배치되어, 좌측에서부터 우측까지 고르게 배치된 제1 표시 영역(161)과 관련한 디코더들에 아날로그 감마 전압을 생성하여 공급할 수 있다. 이에 따라, 일반 감마 생성부(208) 및 추가 감마 생성부(209)가 중앙에 나란히 배치될 수 있다. 상기 제2 표시 영역(162)의 하부(예: 디스플레이 패널(160)로부터 광이 조사되는 방향과 반대된 방향)에는 예컨대, 카메라가 배치될 수 있으며, 상기 제2 표시 영역(162)은 디스플레이 패널(160)의 상단에 치우쳐 배치될 수 있다.
도 13은 한 실시 예에 따른 디스플레이 구동 회로에서의 추가 감마 구동부가 우측에 배치되는 예를 나타낸 도면이다.
도 13을 참조하면, 디스플레이 구동 회로(200)는 앞서 언급한 바와 같이, 로직 회로(202), 소스 드라이버(206), 게이트 드라이버(207), 그래픽 메모리(203)를 포함하며, 도시된 도면에서는 설명의 편의를 위하여, 일반 감마 생성부(208) 및 추가 감마 생성부(209)를 포함하는 일부 구성만을 도시한 것이다. 디스플레이 패널(160)은 제1 픽셀 배치 밀도를 가지는 제1 표시 영역(161) 및 상기 제1 픽셀 배치 밀도보다 낮은 제2 픽셀 배치 밀도를 가지는 제2 표시 영역(162)을 포함할 수 있다. 소스 신호를 공급하는 소스 라인들 중 일부는 제1 표시 영역(161)에만 배치되고, 나머지 일부는 제1 표시 영역(161) 및 제2 표시 영역(162)에 배치될 수 있다. 도시된 도면에서는, 디스플레이 패널(160)의 우측 영역에 제2 표시 영역(162)과 제1 표시 영역(161)이 배치된 형상을 나타낸 것이다.
디스플레이 구동 회로(200)는 아날로그 감마 전압의 공급 루트를 최적화하기 위하여, 디스플레이 패널(160)의 우측에 배치된 제2 표시 영역(162)에 아날로그 감마 전압을 공급하도록 추가 감마 생성부(209)가 우측에 배치될 수 있다. 추가 감마 생성부(209)가 생성한 아날로그 감마 전압은 제2 표시 영역(162)에 신호가 공급되는 타이밍에 제2 표시 영역(162)과 관련한 소스 드라이버의 디코더들에게 공급될 수 있다. 일반 감마 생성부(208)는 예컨대, 디스플레이 구동 회로(200)의 중앙에 배치되어, 좌측에서부터 우측까지 고르게 배치된 제1 표시 영역(161)과 관련한 디코더들에 아날로그 감마 전압을 생성하여 공급할 수 있다. 상기 제2 표시 영역(162)의 하부(예: 디스플레이 패널(160)로부터 광이 조사되는 방향과 반대된 방향)에는 예컨대, 홍채 센서 또는 RGB 카메라가 배치될 수 있으며, 상기 제2 표시 영역(162)은 디스플레이 패널(160)의 우측 상단에 치우쳐 배치될 수 있다.
도 14는 한 실시 예에 따른 디스플레이 구동 회로에서의 추가 감마 구동부가 다양한 위치에 배치된 예를 나타낸 도면이다.
도 14를 참조하면, 디스플레이 구동 회로(200)는 앞서 언급한 바와 같이, 로직 회로(202), 소스 드라이버(206), 게이트 드라이버(207), 그래픽 메모리(203)를 포함하며, 도시된 도면에서는 설명의 편의를 위하여, 일반 감마 생성부(208) 및 추가 감마 생성부(209)를 포함하는 일부 구성만을 도시한 것이다. 디스플레이 패널(160)은 제1 픽셀 배치 밀도를 가지는 제1 표시 영역(161) 및 상기 제1 픽셀 배치 밀도보다 낮은 제2 픽셀 배치 밀도를 가지는 제21 내지 제23 표시 영역들(162a, 162b, 162c)을 포함할 수 있다. 상기 제21 내지 제23 표시 영역들(162a, 162b, 162c)의 픽셀 배치 밀도는 다르게 형성될 수도 있다. 예컨대, RGB 카메라가 하부에 배치되는 표시 영역의 픽셀 배치 밀도가 상대적으로 가장 낮고, 조도 센서 또는 근접 센서가 하부에 배치되는 표시 영역의 픽셀 배치 밀도가 상대적으로 가장 높게 형성될 수 있다. 도시된 도면에서는, 디스플레이 패널(160)의 좌측 영역에 제21 표시 영역(162a)이 배치되고, 중앙 영역에 제22 표시 영역(162b)이 배치되고, 우측 영역에 제23 표시 영역(162c)이 배치된 형상을 나타낸 것이다. 각각의 제21 내지 제23 표시 영역들(162a, 162b, 162c)의 인접 영역에 제1 표시 영역(161)이 배치됨에 따라, 제21 내지 제23 표시 영역들(162a, 162b, 162c)에 소스 신호를 공급하는 소스 라인들은 제1 표시 영역(161)을 거쳐 제21 내지 제23 표시 영역들(162a, 162b, 162c)에 소스 신호를 공급하도록 배치될 수 있다. 다양한 실시 예에 따르면, 제22 표시 영역(162b)은 디스플레이 패널(160)의 하부에 치우쳐 배치될 수 있다.
디스플레이 구동 회로(200)에서 추가 감마 생성부들(209_1, 209_2, 209_3)은 아날로그 감마 전압의 공급 루트를 최적화하기 위하여, 대응되는 제21 내지 제23 표시 영역들(162a, 162b, 162c)에 대응되는 위치의 디스플레이 구동 회로(200)에 배치될 수 있다. 예컨대, 제21 표시 영역(162a)에 대응하는 제1 추가 감마 생성부(209_1)는 디스플레이 구동 회로(200)에서 좌측으로 치우쳐 배치되고, 제22 표시 영역(162b)에 대응하는 제2 추가 감마 생성부(209_2)는 디스플레이 구동 회로(200)에서 중앙에 배치되고, 제23 표시 영역(162c)에 대응하는 제3 추가 감마 생성부(209_3)는 디스플레이 구동 회로(200)에서 우측에 치우쳐 배치될 수 있다. 상기 제1 내지 제3 추가 감마 생성부들(209_1, 209_2, 209_3)이 생성하는 아날로그 감마 전압은 운용하는 센서의 종류 또는 특성에 따라 서로 다른 값으로 설정될 수 있다. 예를 들어, 지문 센서가 하부에 배치되는 제22 표시 영역(162b)에서, 지문 센싱 시, 제1 표시 영역(161)에 표시되는 컨텐츠의 휘도보다 상대적으로 높은 휘도의 컨텐츠가 표시되도록 상대적으로 높은 아날로그 감마 전압이 공급되도록 설정될 수 있다. 다양한 실시 예에 따르면, 제21 표시 영역(162a) 및 제23 표시 영역(162c)의 픽셀 배치 밀도가 다르게 구성될 경우, 그에 대응하여 아날로그 감마 전압이 다르게 공급(예: 동일한 계조 값이라도 다른 크기의 전압이 공급)될 수 있다. 예컨대, 표시 영역의 밀도가 상대적으로 낮을수록 높은 크기의 아날로그 감마 전압이 공급될 수 있다. 다양한 실시 예에 따르면, 전자 장치는 제1 표시 영역(161), 상기 제21 표시 영역(162a) 내지 제23 표시 영역(162c)을 각각 구동하기 위한, 감마 보정 테이블들(예: 제21 표시 영역(162a) 구동을 위한 제1 감마 보정 테이블, 제22 표시 영역(162b) 구동을 위한 제2 감마 보정 테이블, 제23 표시 영역(162c) 구동을 위한 제3 감마 보정 테이블, 제1 표시 영역(161) 구동을 위한 감마 보정 테이블)을 포함할 수 있다. 다양한 실시 예에 따르면, 상기 제1 표시 영역(161)과 제21 표시 영역(162a) 사이, 상기 제1 표시 영역(161)과 제22 표시 영역(162b) 사이 또는 상기 제1 표시 영역(161)과 제23 표시 영역(162c) 사이의 픽셀 배치 밀도는 주변 픽셀 배치 밀도와 다를 수 있다. 예를 들어, 상기 제1 표시 영역(161)에서 제21 표시 영역(162a) 또는 제22 표시 영역(162b), 또는 제23 표시 영역(162c)로 갈수록 픽셀 밀도가 점진적으로 감소할 수 있다. 또는, 제21 표시 영역(162a), 제22 표시 영역(162b), 또는 제23 표시 영역(162c)에서 제1 표시 영역(161)으로 갈수록 픽셀 밀도가 점진적으로 감소할 수 있다. 이에 따라, 전자 장치는 제21 표시 영역(162a), 제22 표시 영역(162b) 및 제23 표시 영역(162c) 중 적어도 하나의 표시 영역의 경계에서 점진적으로 계조 값이 변경되는 그라데이션 효과를 제공할 수 있다. 이와 관련하여, 상기 디스플레이 구동 회로(200)는 제1 표시 영역(161)과 상기 제21 표시 영역(162a) 사이, 또는 제1 표시 영역(161)과 제22 표시 영역(162b) 사이, 또는 제1 표시 영역(161)과 제23 표시 영역(162c) 사이의 경계 영역들 중 적어도 하나의 경계 영역에서의 픽셀 배치 밀도에 대응하는 적어도 하나의 감마 보정 테이블을 해당 픽셀 배치 밀도에 대응하여 생성하여 운용할 수 있다. 또는, 전자 장치는 상기 경계 영역들(예; 제1 표시 영역(161)과 제21 표시 영역(162a) 사이, 제1 표시 영역(161)과 제22 표시 영역(162b) 사이 또는 제1 표시 영역(161)과 제23 표시 영역(162c) 사이)에서의 점진적인 화면 변화를 위한 적어도 하나의 감마 보정 테이블을 사전에 생성 또는 저장하고, 이를 기반으로 해당 경계 영역에서의 픽셀 구동을 처리할 수 있다. 상기 적어도 하나의 감마 보정 테이블은 예컨대, 상기 디스플레이 구동 회로(200) 내에 배치된 메모리에 저장되거나 또는 어플리케이션 프로세서가 접근 가능한 메모리에 배치될 수 있다. 다양한 실시 예에 따르면, 상기 전자 장치는 제1 표시 영역(161) 구동을 위한 제1 감마 값과 제21 표시 영역(162a) 구동을 위한 제2 감마 값(또는 제22 표시 영역(162b) 구동을 위한 제2 감마 값, 또는 제23 표시 영역(162c) 구동을 위한 제2 감마 값)의 중간 감마 값을 산출하고, 이를 기반으로 경계 영역에서의 픽셀 구동을 수행할 수도 있다. 다양한 실시 예에 따르면, 상기 전자 장치는 경계 영역에 점진적으로 색상이 변경되는 그라데이션 마스크를 소프트웨어적으로 생성하고, 이를 해당 경계 영역에 적용하여 그라데이션 효과를 제공할 수도 있다.
도 15는 한 실시 예에 따른 디스플레이 패널의 구동의 한 예를 나타낸 도면이다.
도 15를 참조하면, 디스플레이 패널(160)의 제2 표시 영역(162)은 앞서 설명한 바와 같이 팬 타일 타입의 서브 픽셀 배치를 가질 수 있다. 다양한 실시 예에 따르면, 디스플레이 패널(160)의 제2 표시 영역(162)은 도시된 바와 같이 스트라입 타입의 서브 픽셀 배치를 가질 수 있다. 제2 표시 영역(162)은 매트릭스 형태로 구분된 픽셀 배치 가능 영역들 중 일부 픽셀 배치 가능 영역에 픽셀들이 배치되고, 나머지 픽셀 배치 가능 영역에는 픽셀들이 배치되지 않을 수 있다. 예컨대, 제2 표시 영역(162)은 픽셀(또는 서브 픽셀들)이 빈 영역 없이 매트릭스 형태로 배치된 제1 표시 영역에 비하여 상대적으로 낮은 픽셀 배치 밀도를 가질 수 있다. 이에 따라, 상기 제2 표시 영역(162)의 하부(예: 디스플레이 패널(160)의 광이 조사되는 방향과 반대된 방향의 아래)에 센서가 배치되더라도, 지정된 크기 이상의 해상도의 이미지 획득이 가능할 수 있다. 상기 픽셀들은 예컨대, 1/4, 3/8, 1/2과 같이 배치될 수 있다. 이 경우, 디스플레이 패널(160)은 2 수평 동기 구간(Horizontal 시간)마다 1회 소스 구동을 하여, OLED의 Scan on Time 유지를 보장하면서, 시분할 구동을 통해 온전한 컨텐츠 표시를 구현할 수 있다. 제2 표시 영역(162)(또는 카메라 등이 디스플레이 하부에 배치된 영역)의 구동과 관련하여, 시분할되는 소스 신호 및 시분할되는 감마 전압 구동(또는 생성 및 공급)을 통해 소스 드라이버(206)의 추가 감마 생성부(209)의 물리적 개수를 절반으로 줄일 수 있다. 예컨대, 도시된 바와 같이, 제1 표시 영역(161)은 각각 홀수 번째 게이트 라인과 짝수번째 게이트 라인이 번갈아 가면서 구동되는 RGBG 서브 픽셀들이 각 라인별로 구동될 수 있다. 제2 표시 영역(162)은 짝수 번째 게이트 라인 및 짝수 번째 소스 라인이 구동되는 동안 Red 및 Blue 서브 픽셀이 구동되고, 홀수 번째 게이트 라인 및 홀수 번째 소스 라인이 구동되는 동안 두 개의 Green 서브 픽셀이 구동될 수 있다. 이에 따라, 추가 감마 생성부(209)는 소스 라인 및 게이트 라인이 교번적으로 구동되도록 제어되는 동안 일부 서브 픽셀들의 구동 제어를 위한 아날로그 감마 전압을 공급함에 따라, 순차 구동에 비하여 절반 개수의 추가 감마 구동부를 이용하여 구동할 수 있다.
상술한 다양한 실시 예에 따르면, 한 실시 예에 따른 전자 장치는 제1 표시 영역 및 제2 표시 영역을 포함하는 디스플레이 패널, 상기 제1 표시 영역은 제1 밀도로 분포된 서브 픽셀들을 포함하고, 상기 제2 표시 영역은 상기 제1 밀도보다 낮은 제2 밀도로 분포된 서브 픽셀들을 포함함, 상기 디스플레이 패널 구동과 관련한 디스플레이 구동 회로를 포함하고, 상기 디스플레이 구동 회로는 상기 제1 표시 영역에 배치된 소스 라인들에 감마 신호를 공급하는 일반 감마 생성부, 상기 제2 표시 영역 및 상기 제1 표시 영역에 공통으로 배치된 소스 라인들에 감마 신호를 공급하는 추가 감마 생성부를 포함하고, 상기 추가 감마 생성부는 상기 제1 표시 영역에 공급되는 감마 신호에 비하여 상대적으로 높은 휘도 값을 내도록 설정된 감마 신호를 상기 제2 표시 영역에 공급하도록 설정될 수 있다.
다양한 실시 예에 따르면, 상기 디스플레이 패널을 내려다 보았을 때 (또는 상기 디스플레이 패널의 상부면을 내려다 볼 때), 상기 디스플레이 패널을 내려다보는 방향으로, 상기 제2 표시 영역의 아래에는 적어도 하나의 센서의 적어도 일부가 배치될 수 있다.
다양한 실시 예에 따르면, 상기 적어도 하나의 센서는 RGB 카메라를 포함할 수 있다.
다양한 실시 예에 따르면, 상기 적어도 하나의 센서는 지문 센서를 포함할 수 있다.
다양한 실시 예에 따르면, 상기 제1 표시 영역은 상기 제2 표시 영역의 적어도 일면 (또는 제2 표시 영역의 주변 적어도 일부)을 둘러싸도록 배치될 수 있다.
다양한 실시 예에 따르면, 상기 추가 감마 생성부는 상기 제2 표시 영역에 배치된 각 서브픽셀들에 동일한 크기의 공통 감마 전압 신호를 공급하도록 설정될 수 있다.
다양한 실시 예에 따르면, 상기 추가 감마 생성부는 상기 제1 표시 영역에 배치된 Red 서브 픽셀에 비하여 상대적으로 높은 휘도를 표시하도록 설정된 Red 감마 신호를 생성하는 제1 추가 감마 생성부, 상기 제1 표시 영역에 배치된 Green 서브 픽셀에 비하여 상대적으로 높은 휘도를 표시하도록 설정된 Green 감마 신호를 생성하는 제2 추가 감마 생성부, 상기 제1 표시 영역에 배치된 Blue 서브 픽셀에 비하여 상대적으로 높은 휘도를 표시하도록 설정된 Blue 감마 신호를 생성하는 제3 추가 감마 생성부를 포함할 수 있다.
다양한 실시 예에 따르면, 상기 일반 감마 생성부는 상기 제1 표시 영역에 배치된 Red 서브 픽셀 및 Blue 서브 픽셀에 감마 신호를 공급하는 제1 감마 생성부, 상기 제1 표시 영역에 배치된 Green 서브 픽셀들에 감마 신호를 공급하는 제2 감마 생성부를 포함하고, 상기 추가 감마 생성부는 상기 일반 감마 생성부에 인접되게 배치되고, 상기 제2 표시 영역에 배치된 Red 서브 픽셀, Green 서브 픽셀, Blue 서브 픽셀들에 공통으로 감마 신호를 공급하도록 설정될 수 있다.
다양한 실시 예에 따르면, 상기 일반 감마 생성부는 상기 디스플레이 구동회로의 중앙에 배치되고, 상기 추가 감마 생성부는 상기 제2 표시 영역에 신호를 공급하는 신호 라인의 위치에 대응하는 디스플레이 구동 회로에서의 위치에 배치될 수 있다. 또는, 추가 감마 생성부의 상기 디스플레이 구동 회로에서의 위치는 상기 제2 표시 영역에 신호를 공급하는 신호 라인의 위치에 대응할 수 있다.
다양한 실시 예에 따르면, 상기 제2 표시 영역은 상기 디스플레이 패널의 좌측 가장자리, 중앙 및 우측 가장자리 중 적어도 한 곳에 배치되고, 상기 추가 감마 생성부는 상기 디스플레이 구동 회로의 좌측 가장자리, 중앙 및 우측 가장자리 중 적어도 한 곳에 배치될 수 있다. 다양한 실시 예에 따르면, 상기 디스플레이 패널이 다각형(예: 사각형) 또는 원형인 경우, 상기 디스플레이 패널의 중앙을 중심으로, 좌측 가장자리, 중앙 및 우측 가장자리 중 적어도 한 곳에 상기 제2 표시 영역이 배치될 수 있다. 상기 추가 감마 생성부도 상기 제2 표시 영역에 인접되며 좌측 가장자리, 중앙 및 우측 가장자리 중 적어도 한 곳에 배치될 수 있다.
다양한 실시 예에 따르면, 상기 디스플레이 구동 회로는 상기 제2 표시 영역의 홀수 번째 게이트 라인과 홀수 번째 소스 라인 및 짝수 번째 게이트 라인과 짝수 번째 게이트 라인을 각각 교번적으로 운용할 수 있다.
다양한 실시 예에 따르면, 상기 디스플레이 구동 회로는 상기 제1 표시 영역과 상기 제2 표시 영역에 신호를 공급하는 소스 라인들, 상기 소스 라인들에 연결된 증폭기들, 상기 증폭기들에 연결된 디코더들을 포함하고, 상기 디코더들은 상기 일반 감마 생성부 및 상기 추가 감마 생성부의 계조 값들을 입력으로 수신하고, 수신된 계조 값들 중 어느 하나를 상기 증폭기에 출력할 수 있다.
다양한 실시 예에 따르면, 상기 디스플레이 구동 회로는 상기 제1 표시 영역과 상기 제2 표시 영역에 신호를 공급하는 소스 라인들, 상기 소스 라인들에 연결된 증폭기들, 상기 증폭기들에 연결된 디코더들, 상기 일반 감마 생성부의 일부 출력과 상기 추가 감마 생성부의 출력을 먹싱하고 제어에 따라 상기 일반 감마 생성부의 감마 신호 또는 상기 추가 감마 생성부의 감마 신호를 상기 디코더들에 공급하는 복수의 먹스들을 더 포함할 수 있다.
다양한 실시 예에 따르면, 상기 제1 표시 영역의 소스 신호의 출력의 제1 크기와 상기 제2 표시 영역의 소스 신호 출력의 제2 크기는 서로 다를 수 있다.
다양한 실시 예에 따르면, 상기 제1 크기와 상기 제2 크기의 차이는 상기 제1 표시 영역의 서브 픽셀들의 밀도와 상기 제2 표시 영역의 서브 픽셀들의 밀도 차이에 대응될 수 있다. 다양한 실시 예에 따르면, 상기 제1 크기와 상기 제2 크기의 차이는 크면, 상기 제1 표시 영역의 서브 픽셀들의 밀도와 상기 제2 표시 영역의 서브 픽셀들의 밀도 차이가 크고, 상기 제1 크기와 상기 제2 크기의 차이가 작으면, 상기 제1 표시 영역의 서브 픽셀들의 밀도와 상기 제2 표시 영역의 서브 픽셀들의 밀도 차이가 작을 수 있다. 이러한 설정은 한 예로서, 반대의 경우(예: 밀도 차이가 크면 크기 차이가 작고, 밀도 차이가 작으면, 크기 차이가 커짐)로 설정될 수도 있다.
다양한 실시 예에 따르면, 상기 디스플레이 구동 회로는 상기 제2 표시 영역의 소스 신호의 출력 크기가 상기 제1 표시 영역과 상기 제2 표시 영역에 출력되는 동일 컨텐츠의 색상과 휘도가 동일 또는 유사하게 보여지도록 제어할 수 있다.
상술한 다양한 실시 예에 따르면, 한 실시 예에 따른 표시 영역에 따른 감마 전압 운용 방법은 디스플레이 구동 회로가 프로세서로부터 표시 데이터를 수신하는 단계, 상기 디스플레이 구동 회로가 디스플레이 패널에서 제1 픽셀 배치 밀도로 배치된 제1 표시 영역에 제1 크기의 휘도를 표시하도록 설정된 제1 감마 신호를 공급하는 동안, 상기 제1 픽셀 배치 밀도보다 낮은 제2 픽셀 배치 밀도를 가지는 제2 표시 영역에 상기 제1 크기보다 큰 제2 크기의 휘도를 표시하도록 설정된 제2 감마 신호를 공급하는 단계를 포함할 수 있다.
다양한 실시 예에 따르면, 상기 제2 감마 신호를 공급하는 단계는 상기 제2 표시 영역에 배치된 Red 서브 픽셀, Green 서브 픽셀 및 Blue 서브 픽셀에 동일한 크기의 전압을 가지는 제2 감마 신호를 공통으로 공급하는 단계를 포함할 수 있다.
다양한 실시 예에 따르면, 상기 제2 감마 신호를 공급하는 단계는 상기 제2 표시 영역에 배치된 각 서브 픽셀별 제2 감마 신호를 생성하는 단계, 생성된 각 서브 픽셀별 제2 감마 신호를 해당 서브 픽셀에 연결된 소스 라인들에 공급하는 단계를 포함할 수 있다.
다양한 실시 예에 따르면, 상기 제2 감마 신호를 공급하는 단계는 상기 제2 표시 영역에 배치된 홀수 번째 게이트 라인들과 홀수 번째 소스 라인들 및 짝수 번째 게이트 라인들과 짝수 번째 소스 라인들에 교번적으로 상기 제2 감마 신호를 공급하는 단계를 포함할 수 있다.
도 16은, 다양한 실시예들에 따른, 네트워크 환경(1600) 내의 전자 장치(1601)의 블럭도이다.
도 16을 참조하면, 네트워크 환경(1600)에서 전자 장치(1601)는 제 1 네트워크(1698)(예: 근거리 무선 통신 네트워크)를 통하여 전자 장치(1602)와 통신하거나, 또는 제 2 네트워크(1699)(예: 원거리 무선 통신 네트워크)를 통하여 전자 장치(1604) 또는 서버(1608)와 통신할 수 있다. 일실시예에 따르면, 전자 장치(1601)는 서버(1608)를 통하여 전자 장치(1604)와 통신할 수 있다. 일실시예에 따르면, 전자 장치(1601)는 프로세서(1620), 메모리(1630), 입력 장치(1650), 음향 출력 장치(1655), 표시 장치(1660), 오디오 모듈(1670), 센서 모듈(1676), 인터페이스(1677), 햅틱 모듈(1679), 카메라 모듈(1680), 전력 관리 모듈(1688), 배터리(1689), 통신 모듈(1690), 가입자 식별 모듈(1696), 또는 안테나 모듈(1697)을 포함할 수 있다. 어떤 실시예에서는, 전자 장치(1601)에는, 이 구성요소들 중 적어도 하나(예: 표시 장치(1660) 또는 카메라 모듈(1680))가 생략되거나, 하나 이상의 다른 구성요소가 추가될 수 있다. 어떤 실시예에서는, 이 구성요소들 중 일부들은 하나의 통합된 회로로 구현될 수 있다. 예를 들면, 센서 모듈(1676)(예: 지문 센서, 홍채 센서, 또는 조도 센서)은 표시 장치(1660)(예: 디스플레이)에 임베디드된 채 구현될 수 있다
프로세서(1620)는, 예를 들면, 소프트웨어(예: 프로그램(1640))를 실행하여 프로세서(1620)에 연결된 전자 장치(1601)의 적어도 하나의 다른 구성요소(예: 하드웨어 또는 소프트웨어 구성요소)를 제어할 수 있고, 다양한 데이터 처리 또는 연산을 수행할 수 있다. 일실시예에 따르면, 데이터 처리 또는 연산의 적어도 일부로서, 프로세서(1620)는 다른 구성요소(예: 센서 모듈(1676) 또는 통신 모듈(1690))로부터 수신된 명령 또는 데이터를 휘발성 메모리(1632)에 로드하고, 휘발성 메모리(1632)에 저장된 명령 또는 데이터를 처리하고, 결과 데이터를 비휘발성 메모리(1634)에 저장할 수 있다. 일실시예에 따르면, 프로세서(1620)는 메인 프로세서(1621)(예: 중앙 처리 장치 또는 어플리케이션 프로세서), 및 이와는 독립적으로 또는 함께 운영 가능한 보조 프로세서(1623)(예: 그래픽 처리 장치, 이미지 시그널 프로세서, 센서 허브 프로세서, 또는 커뮤니케이션 프로세서)를 포함할 수 있다. 추가적으로 또는 대체적으로, 보조 프로세서(1623)는 메인 프로세서(1621)보다 저전력을 사용하거나, 또는 지정된 기능에 특화되도록 설정될 수 있다. 보조 프로세서(1623)는 메인 프로세서(1621)와 별개로, 또는 그 일부로서 구현될 수 있다.
보조 프로세서(1623)는, 예를 들면, 메인 프로세서(1621)가 인액티브(예: 슬립) 상태에 있는 동안 메인 프로세서(1621)를 대신하여, 또는 메인 프로세서(1621)가 액티브(예: 어플리케이션 실행) 상태에 있는 동안 메인 프로세서(1621)와 함께, 전자 장치(1601)의 구성요소들 중 적어도 하나의 구성요소(예: 표시 장치(1660), 센서 모듈(1676), 또는 통신 모듈(1690))와 관련된 기능 또는 상태들의 적어도 일부를 제어할 수 있다. 일실시예에 따르면, 보조 프로세서(1623)(예: 이미지 시그널 프로세서 또는 커뮤니케이션 프로세서)는 기능적으로 관련 있는 다른 구성 요소(예: 카메라 모듈(1680) 또는 통신 모듈(1690))의 일부로서 구현될 수 있다.
메모리(1630)는, 전자 장치(1601)의 적어도 하나의 구성요소(예: 프로세서(1620) 또는 센서모듈(1676))에 의해 사용되는 다양한 데이터를 저장할 수 있다. 데이터는, 예를 들어, 소프트웨어(예: 프로그램(1640)) 및, 이와 관련된 명령에 대한 입력 데이터 또는 출력 데이터를 포함할 수 있다. 메모리(1630)는, 휘발성 메모리(1632) 또는 비휘발성 메모리(1634)를 포함할 수 있다.
프로그램(1640)은 메모리(1630)에 소프트웨어로서 저장될 수 있으며, 예를 들면, 운영 체제(1642), 미들 웨어(1644) 또는 어플리케이션(1646)을 포함할 수 있다.
입력 장치(1650)는, 전자 장치(1601)의 구성요소(예: 프로세서(1620))에 사용될 명령 또는 데이터를 전자 장치(1601)의 외부(예: 사용자)로부터 수신할 수 있다. 입력 장치(1650)는, 예를 들면, 마이크, 마우스, 키보드, 또는 디지털 펜(예: 스타일러스 펜)을 포함할 수 있다.
음향 출력 장치(1655)는 음향 신호를 전자 장치(1601)의 외부로 출력할 수 있다. 음향 출력 장치(1655)는, 예를 들면, 스피커 또는 리시버를 포함할 수 있다. 스피커는 멀티미디어 재생 또는 녹음 재생과 같이 일반적인 용도로 사용될 수 있고, 리시버는 착신 전화를 수신하기 위해 사용될 수 있다. 일실시예에 따르면, 리시버는 스피커와 별개로, 또는 그 일부로서 구현될 수 있다.
표시 장치(1660)는 전자 장치(1601)의 외부(예: 사용자)로 정보를 시각적으로 제공할 수 있다. 표시 장치(1660)는, 예를 들면, 디스플레이, 홀로그램 장치, 또는 프로젝터 및 해당 장치를 제어하기 위한 제어 회로를 포함할 수 있다. 일실시예에 따르면, 표시 장치(1660)는 터치를 감지하도록 설정된 터치 회로(touch circuitry), 또는 상기 터치에 의해 발생되는 힘의 세기를 측정하도록 설정된 센서 회로(예: 압력 센서)를 포함할 수 있다.
오디오 모듈(1670)은 소리를 전기 신호로 변환시키거나, 반대로 전기 신호를 소리로 변환시킬 수 있다. 일실시예에 따르면, 오디오 모듈(1670)은, 입력 장치(1650)를 통해 소리를 획득하거나, 음향 출력 장치(1655), 또는 전자 장치(1601)와 직접 또는 무선으로 연결된 외부 전자 장치(예: 전자 장치(1602))(예: 스피커 또는 헤드폰)를 통해 소리를 출력할 수 있다.
센서 모듈(1676)은 전자 장치(1601)의 작동 상태(예: 전력 또는 온도), 또는 외부의 환경 상태(예: 사용자 상태)를 감지하고, 감지된 상태에 대응하는 전기 신호 또는 데이터 값을 생성할 수 있다. 일실시예에 따르면, 센서 모듈(1676)은, 예를 들면, 제스처 센서, 자이로 센서, 기압 센서, 마그네틱 센서, 가속도 센서, 그립 센서, 근접 센서, 컬러 센서, IR(infrared) 센서, 생체 센서, 온도 센서, 습도 센서, 또는 조도 센서를 포함할 수 있다.
인터페이스(1677)는 전자 장치(1601)가 외부 전자 장치(예: 전자 장치(1602))와 직접 또는 무선으로 연결되기 위해 사용될 수 있는 하나 이상의 지정된 프로토콜들을 지원할 수 있다. 일실시예에 따르면, 인터페이스(1677)는, 예를 들면, HDMI(high definition multimedia interface), USB(universal serial bus) 인터페이스, SD카드 인터페이스, 또는 오디오 인터페이스를 포함할 수 있다.
연결 단자(1678)는, 그를 통해서 전자 장치(1601)가 외부 전자 장치(예: 전자 장치(1602))와 물리적으로 연결될 수 있는 커넥터를 포함할 수 있다. 일실시예에 따르면, 연결 단자(1678)는, 예를 들면, HDMI 커넥터, USB 커넥터, SD 카드 커넥터, 또는 오디오 커넥터(예: 헤드폰 커넥터)를 포함할 수 있다.
햅틱 모듈(1679)은 전기적 신호를 사용자가 촉각 또는 운동 감각을 통해서 인지할 수 있는 기계적인 자극(예: 진동 또는 움직임) 또는 전기적인 자극으로 변환할 수 있다. 일실시예에 따르면, 햅틱 모듈(1679)은, 예를 들면, 모터, 압전 소자, 또는 전기 자극 장치를 포함할 수 있다.
카메라 모듈(1680)은 정지 영상 및 동영상을 촬영할 수 있다. 일실시예에 따르면, 카메라 모듈(1680)은 하나 이상의 렌즈들, 이미지 센서들, 이미지 시그널 프로세서들, 또는 플래시들을 포함할 수 있다.
전력 관리 모듈(1688)은 전자 장치(1601)에 공급되는 전력을 관리할 수 있다. 일실시예에 따르면, 전력 관리 모듈(1688)은, 예를 들면, PMIC(power management integrated circuit)의 적어도 일부로서 구현될 수 있다.
배터리(1689)는 전자 장치(1601)의 적어도 하나의 구성요소에 전력을 공급할 수 있다. 일실시예에 따르면, 배터리(1689)는, 예를 들면, 재충전 불가능한 1차 전지, 재충전 가능한 2차 전지 또는 연료 전지를 포함할 수 있다.
통신 모듈(1690)은 전자 장치(1601)와 외부 전자 장치(예: 전자 장치(1602), 전자 장치(1604), 또는 서버(1608))간의 직접(예: 유선) 통신 채널 또는 무선 통신 채널의 수립, 및 수립된 통신 채널을 통한 통신 수행을 지원할 수 있다. 통신 모듈(1690)은 프로세서(1620)(예: 어플리케이션 프로세서)와 독립적으로 운영되고, 직접(예: 유선) 통신 또는 무선 통신을 지원하는 하나 이상의 커뮤니케이션 프로세서를 포함할 수 있다. 일실시예에 따르면, 통신 모듈(1690)은 무선 통신 모듈(1692)(예: 셀룰러 통신 모듈, 근거리 무선 통신 모듈, 또는 GNSS(global navigation satellite system) 통신 모듈) 또는 유선 통신 모듈(1694)(예: LAN(local area network) 통신 모듈, 또는 전력선 통신 모듈)을 포함할 수 있다. 이들 통신 모듈 중 해당하는 통신 모듈은 제 1 네트워크(1698)(예: 블루투스, WiFi direct 또는 IrDA(infrared data association)와 같은 근거리 통신 네트워크) 또는 제 2 네트워크(1699)(예: 셀룰러 네트워크, 인터넷, 또는 컴퓨터 네트워크(예: LAN 또는 WAN)와 같은 원거리 통신 네트워크)를 통하여 외부 전자 장치(1604)와 통신할 수 있다. 이런 여러 종류의 통신 모듈들은 하나의 구성요소(예: 단일 칩)로 통합되거나, 또는 서로 별도의 복수의 구성요소들(예: 복수 칩들)로 구현될 수 있다. 무선 통신 모듈(1692)은 가입자 식별 모듈(1696)에 저장된 가입자 정보(예: 국제 모바일 가입자 식별자(IMSI))를 이용하여 제 1 네트워크(1698) 또는 제 2 네트워크(1699)와 같은 통신 네트워크 내에서 전자 장치(1601)를 확인 및 인증할 수 있다.
안테나 모듈(1697)은 신호 또는 전력을 외부(예: 외부 전자 장치)로 송신하거나 외부로부터 수신할 수 있다. 일실시예에 따르면, 안테나 모듈(1697)은 서브스트레이트(예: PCB) 위에 형성된 도전체 또는 도전성 패턴으로 이루어진 방사체를 포함하는 하나의 안테나를 포함할 수 있다. 일실시예에 따르면, 안테나 모듈(1697)은 복수의 안테나들을 포함할 수 있다. 이런 경우, 제 1 네트워크(1698) 또는 제 2 네트워크(1699)와 같은 통신 네트워크에서 사용되는 통신 방식에 적합한 적어도 하나의 안테나가, 예를 들면, 통신 모듈(1690)에 의하여 상기 복수의 안테나들로부터 선택될 수 있다. 신호 또는 전력은 상기 선택된 적어도 하나의 안테나를 통하여 통신 모듈(1690)과 외부 전자 장치 간에 송신되거나 수신될 수 있다. 어떤 실시예에 따르면, 방사체 이외에 다른 부품(예: RFIC)이 추가로 안테나 모듈(1697)의 일부로 형성될 수 있다.
상기 구성요소들 중 적어도 일부는 주변 기기들간 통신 방식(예: 버스, GPIO(general purpose input and output), SPI(serial peripheral interface), 또는 MIPI(mobile industry processor interface))을 통해 서로 연결되고 신호(예: 명령 또는 데이터)를 상호간에 교환할 수 있다.
일실시예에 따르면, 명령 또는 데이터는 제 2 네트워크(1699)에 연결된 서버(1608)를 통해서 전자 장치(1601)와 외부의 전자 장치(1604)간에 송신 또는 수신될 수 있다. 외부 전자 장치(1602, 1604) 각각은 전자 장치(1601)와 동일한 또는 다른 종류의 장치일 수 있다. 일실시예에 따르면, 전자 장치(1601)에서 실행되는 동작들의 전부 또는 일부는 외부 전자 장치들(1602, 1604, 또는 1608) 중 하나 이상의 외부 전자 장치들에서 실행될 수 있다. 예를 들면, 전자 장치(1601)가 어떤 기능이나 서비스를 자동으로, 또는 사용자 또는 다른 장치로부터의 요청에 반응하여 수행해야 할 경우에, 전자 장치(1601)는 기능 또는 서비스를 자체적으로 실행시키는 대신에 또는 추가적으로, 하나 이상의 외부 전자 장치들에게 그 기능 또는 그 서비스의 적어도 일부를 수행하라고 요청할 수 있다. 상기 요청을 수신한 하나 이상의 외부 전자 장치들은 요청된 기능 또는 서비스의 적어도 일부, 또는 상기 요청과 관련된 추가 기능 또는 서비스를 실행하고, 그 실행의 결과를 전자 장치(1601)로 전달할 수 있다. 전자 장치(1601)는 상기 결과를, 그대로 또는 추가적으로 처리하여, 상기 요청에 대한 응답의 적어도 일부로서 제공할 수 있다. 이를 위하여, 예를 들면, 클라우드 컴퓨팅, 분산 컴퓨팅, 또는 클라이언트-서버 컴퓨팅 기술이 이용될 수 있다.
본 문서에 개시된 다양한 실시예들에 따른 전자 장치는 다양한 형태의 장치가 될 수 있다. 전자 장치는, 예를 들면, 휴대용 통신 장치 (예: 스마트폰), 컴퓨터 장치, 휴대용 멀티미디어 장치, 휴대용 의료 기기, 카메라, 웨어러블 장치, 또는 가전 장치를 포함할 수 있다. 본 문서의 실시예에 따른 전자 장치는 전술한 기기들에 한정되지 않는다.
본 문서의 다양한 실시예들 및 이에 사용된 용어들은 본 문서에 기재된 기술적 특징들을 특정한 실시예들로 한정하려는 것이 아니며, 해당 실시예의 다양한 변경, 균등물, 또는 대체물을 포함하는 것으로 이해되어야 한다. 도면의 설명과 관련하여, 유사한 또는 관련된 구성요소에 대해서는 유사한 참조 부호가 사용될 수 있다. 아이템에 대응하는 명사의 단수 형은 관련된 문맥상 명백하게 다르게 지시하지 않는 한, 상기 아이템 한 개 또는 복수 개를 포함할 수 있다. 본 문서에서, "A 또는 B", "A 및 B 중 적어도 하나","A 또는 B 중 적어도 하나", "A, B 또는 C", "A, B 및 C 중 적어도 하나" 및 "A, B, 또는 C 중 적어도 하나"와 같은 문구들 각각은 그 문구들 중 해당하는 문구에 함께 나열된 항목들 중 어느 하나, 또는 그들의 모든 가능한 조합을 포함할 수 있다. "제 1", "제 2", 또는 "첫째" 또는 "둘째"와 같은 용어들은 단순히 해당 구성요소를 다른 해당 구성요소와 구분하기 위해 사용될 수 있으며, 해당 구성요소들을 다른 측면(예: 중요성 또는 순서)에서 한정하지 않는다. 어떤(예: 제 1) 구성요소가 다른(예: 제 2) 구성요소에, "기능적으로" 또는 "통신적으로"라는 용어와 함께 또는 이런 용어 없이, "커플드" 또는 "커넥티드"라고 언급된 경우, 그것은 상기 어떤 구성요소가 상기 다른 구성요소에 직접적으로(예: 유선으로), 무선으로, 또는 제 3 구성요소를 통하여 연결될 수 있다는 것을 의미한다.
본 문서에서 사용된 용어 "모듈"은 하드웨어, 소프트웨어 또는 펌웨어로 구현된 유닛을 포함할 수 있으며, 예를 들면, 로직, 논리 블록, 부품, 또는 회로와 같은 용어와 상호 호환적으로 사용될 수 있다. 모듈은, 일체로 구성된 부품 또는 하나 또는 그 이상의 기능을 수행하는, 상기 부품의 최소 단위 또는 그 일부가 될 수 있다. 예를 들면, 일실시예에 따르면, 모듈은 ASIC(application-specific integrated circuit)의 형태로 구현될 수 있다.
본 문서의 다양한 실시예들은 기기(machine)(예: 전자 장치(1601)) 의해 읽을 수 있는 저장 매체(storage medium)(예: 내장 메모리(1636) 또는 외장 메모리(1638))에 저장된 하나 이상의 명령어들을 포함하는 소프트웨어(예: 프로그램(1640))로서 구현될 수 있다. 예를 들면, 기기(예: 전자 장치(1601))의 프로세서(예: 프로세서(1620))는, 저장 매체로부터 저장된 하나 이상의 명령어들 중 적어도 하나의 명령을 호출하고, 그것을 실행할 수 있다. 이것은 기기가 상기 호출된 적어도 하나의 명령어에 따라 적어도 하나의 기능을 수행하도록 운영되는 것을 가능하게 한다. 상기 하나 이상의 명령어들은 컴파일러에 의해 생성된 코드 또는 인터프리터에 의해 실행될 수 있는 코드를 포함할 수 있다. 기기로 읽을 수 있는 저장 매체는, 비일시적(non-transitory) 저장 매체의 형태로 제공될 수 있다. 여기서, '비일시적 저장매체'는 실재(tangible)하는 장치이고, 신호(signal)(예: 전자기파)를 포함하지 않는다는 것을 의미할 뿐이며, 이 용어는 데이터가 저장 매체에 반영구적으로 저장되는 경우와 임시적으로 저장되는 경우를 구분하지 않는다. 예로, '비일시적 저장매체'는 데이터가 임시적으로 저장되는 버퍼를 포함할 수 있다.
일 실시예에 따르면, 본 문서에 개시된 다양한 실시예들에 따른 방법은 컴퓨터 프로그램 제품(computer program product)에 포함되어 제공될 수 있다. 컴퓨터 프로그램 제품은 상품으로서 판매자 및 구매자 간에 거래될 수 있다. 컴퓨터 프로그램 제품은 기기로 읽을 수 있는 저장 매체(예: compact disc read only memory(CD-ROM))의 형태로 배포되거나, 또는 어플리케이션 스토어(예: 플레이 스토어쪠)를 통해 또는 두 개의 사용자 장치들(예: 스마트폰들) 간에 직접, 온라인으로 배포(예: 다운로드 또는 업로드)될 수 있다. 온라인 배포의 경우에, 컴퓨터 프로그램 제품(예: 다운로더블 앱(downloadable app))의 적어도 일부는 제조사의 서버, 어플리케이션 스토어의 서버, 또는 중계 서버의 메모리와 같은 기기로 읽을 수 있는 저장 매체에 적어도 일시 저장되거나, 임시적으로 생성될 수 있다.
다양한 실시예들에 따르면, 상기 기술한 구성요소들의 각각의 구성요소(예: 모듈 또는 프로그램)는 단수 또는 복수의 개체를 포함할 수 있다. 다양한 실시예들에 따르면, 전술한 해당 구성요소들 중 하나 이상의 구성요소들 또는 동작들이 생략되거나, 또는 하나 이상의 다른 구성요소들 또는 동작들이 추가될 수 있다. 대체적으로 또는 추가적으로, 복수의 구성요소들(예: 모듈 또는 프로그램)은 하나의 구성요소로 통합될 수 있다. 이런 경우, 통합된 구성요소는 상기 복수의 구성요소들 각각의 구성요소의 하나 이상의 기능들을 상기 통합 이전에 상기 복수의 구성요소들 중 해당 구성요소에 의해 수행되는 것과 동일 또는 유사하게 수행할 수 있다. 다양한 실시예들에 따르면, 모듈, 프로그램 또는 다른 구성요소에 의해 수행되는 동작들은 순차적으로, 병렬적으로, 반복적으로, 또는 휴리스틱하게 실행되거나, 상기 동작들 중 하나 이상이 다른 순서로 실행되거나, 생략되거나, 또는 하나 이상의 다른 동작들이 추가될 수 있다.
다양한 실시 예에 따른 모듈 또는 프로그램 모듈은 전술한 구성요소들 중 적어도 하나 이상을 포함하거나, 일부가 생략되거나, 또는 다른 구성요소를 더 포함할 수 있다. 다양한 실시 예에 따른, 모듈, 프로그램 모듈 또는 다른 구성요소에 의해 수행되는 동작들은 순차적, 병렬적, 반복적 또는 휴리스틱하게 실행되거나, 적어도 일부 동작이 다른 순서로 실행되거나, 생략되거나, 또는 다른 동작이 추가될 수 있다.

Claims (15)

  1. 적어도 제1 표시 영역 및 제2 표시 영역을 포함하는 디스플레이 패널 - 상기 제1 표시 영역은 제1 밀도로 분포된 서브 픽셀들을 포함하고, 상기 제2 표시 영역은 상기 제1 밀도보다 낮은 제2 밀도로 분포된 서브 픽셀들을 포함함 -,
    상기 디스플레이 패널 구동과 관련한 디스플레이 구동 회로;를 포함하고,
    상기 디스플레이 구동 회로는
    상기 제1 표시 영역 구동과 관련하여 배치된 소스 라인들에 감마 신호를 공급하는 일반 감마 생성부;
    상기 제2 표시 영역 및 상기 제1 표시 영역 구동과 관련하여 배치된 소스 라인들에 감마 신호를 공급하는 추가 감마 생성부;를 포함하고,
    상기 추가 감마 생성부는
    상기 제1 표시 영역에 공급되는 감마 신호에 비하여 상대적으로 높은 휘도 값을 내도록 설정된 감마 신호를 상기 제2 표시 영역에 공급하도록 설정된 전자 장치.
  2. 제1항에 있어서,
    상기 디스플레이 패널 상부면을 바라볼 때, 상기 디스플레이 패널을 내려다보는 방향으로, 상기 제2 표시 영역의 아래에는
    적어도 하나의 센서의 적어도 일부가 배치되는 것을 특징으로 하는 전자 장치.
  3. 제2항에 있어서,
    상기 적어도 하나의 센서는
    RGB 카메라를 포함하는 것을 특징으로 하는 전자 장치.
  4. 제2항에 있어서,
    상기 적어도 하나의 센서는
    지문 센서를 포함하는 것을 특징으로 하는 전자 장치.
  5. 제2항에 있어서,
    상기 제1 표시 영역은 상기 제2 표시 영역의 적어도 일면 또는 상기 제2 표시 영역의 주변 적어도 일부를 둘러싸도록 배치된 것을 특징으로 하는 전자 장치.
  6. 제1항에 있어서,
    상기 추가 감마 생성부는
    상기 제2 표시 영역에 배치된 각 서브픽셀들에 동일한 크기의 공통 감마 전압 신호를 공급하도록 설정된 것을 특징으로 하는 전자 장치.
  7. 제1항에 있어서,
    상기 추가 감마 생성부는
    상기 제1 표시 영역에 배치된 Red 서브 픽셀에 비하여 상대적으로 높은 휘도를 표시하도록 설정된 Red 감마 신호를 생성하는 제1 추가 감마 생성부;
    상기 제1 표시 영역에 배치된 Green 서브 픽셀에 비하여 상대적으로 높은 휘도를 표시하도록 설정된 Green 감마 신호를 생성하는 제2 추가 감마 생성부;
    상기 제1 표시 영역에 배치된 Blue 서브 픽셀에 비하여 상대적으로 높은 휘도를 표시하도록 설정된 Blue 감마 신호를 생성하는 제3 추가 감마 생성부;를 포함하는 전자 장치.
  8. 제1항에 있어서,
    상기 일반 감마 생성부는
    상기 제1 표시 영역에 배치된 Red 서브 픽셀 및 Blue 서브 픽셀에 감마 신호를 공급하는 제1 감마 생성부;
    상기 제1 표시 영역에 배치된 Green 서브 픽셀들에 감마 신호를 공급하는 제2 감마 생성부;를 포함하고,
    상기 추가 감마 생성부는
    상기 일반 감마 생성부에 인접되게 배치되고, 상기 제2 표시 영역에 배치된 Red 서브 픽셀, Green 서브 픽셀, Blue 서브 픽셀들에 공통으로 감마 신호를 공급하도록 설정된 것을 특징으로 하는 전자 장치.
  9. 제1항에 있어서,
    상기 일반 감마 생성부는
    상기 디스플레이 구동회로의 중앙에 배치되고,
    상기 추가 감마 생성부는
    상기 제2 표시 영역에 신호를 공급하는 신호 라인의 위치에 대응하는 디스플레이 구동 회로에서의 위치에 배치되는 것을 특징으로 하는 전자 장치.
  10. 제1항에 있어서,
    상기 디스플레이 구동 회로는
    상기 제2 표시 영역의 홀수 번째 게이트 라인과 홀수 번째 소스 라인 및 짝수 번째 게이트 라인과 짝수 번째 게이트 라인을 각각 교번적으로 운용하는 전자 장치.
  11. 제1항에 있어서,
    상기 디스플레이 구동 회로는
    상기 제1 표시 영역과 상기 제2 표시 영역에 신호를 공급하는 소스 라인들;
    상기 소스 라인들에 연결된 증폭기들;
    상기 증폭기들에 연결된 디코더들;을 포함하고,
    상기 디코더들은
    상기 일반 감마 생성부 및 상기 추가 감마 생성부의 계조 값들을 입력으로 수신하고, 수신된 계조 값들 중 어느 하나를 상기 증폭기에 출력하는 전자 장치.
  12. 제1항에 있어서,
    상기 디스플레이 구동 회로는
    상기 제1 표시 영역과 상기 제2 표시 영역에 신호를 공급하는 소스 라인들;
    상기 소스 라인들에 연결된 증폭기들;
    상기 증폭기들에 연결된 디코더들;
    상기 일반 감마 생성부의 일부 출력과 상기 추가 감마 생성부의 출력을 먹싱하고 제어에 따라 상기 일반 감마 생성부의 감마 신호 또는 상기 추가 감마 생성부의 감마 신호를 상기 디코더들에 공급하는 복수의 먹스들;을 포함하는 전자 장치.
  13. 제1항에 있어서,
    상기 제1 표시 영역의 소스 신호의 출력의 제1 크기와 상기 제2 표시 영역의 소스 신호 출력의 제2 크기는 서로 다른 것을 특징으로 하는 전자 장치.
  14. 제1항에 있어서,
    상기 제1 크기와 상기 제2 크기의 차이는
    상기 제1 표시 영역의 서브 픽셀들의 밀도와 상기 제2 표시 영역의 서브 픽셀들의 밀도 차이에 대응되는 전자 장치.
  15. 제1항에 있어서,
    상기 디스플레이 구동 회로는
    상기 제2 표시 영역의 소스 신호의 출력 크기가
    상기 제1 표시 영역과 상기 제2 표시 영역에 출력되는 동일 컨텐츠의 색상과 휘도가 동일 또는 유사하게 보여지도록 제어하는 전자 장치.
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