WO1983000591A1 - Drive circuit for power switching transistor - Google Patents

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WO1983000591A1
WO1983000591A1 PCT/JP1982/000308 JP8200308W WO8300591A1 WO 1983000591 A1 WO1983000591 A1 WO 1983000591A1 JP 8200308 W JP8200308 W JP 8200308W WO 8300591 A1 WO8300591 A1 WO 8300591A1
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switching transistor
transistor
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PCT/JP1982/000308
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Ltd Fanuc
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Hattori, Masayuki
Nakamura, Shigeo
Yairo, Osamu
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    • H03K—PULSE TECHNIQUE
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    • H—ELECTRICITY
    • H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
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    • H02M3/10—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
    • H02M3/145—Conversion of dc power input into dc power output without intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal
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    • H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
    • H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
    • H03K17/60—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors
    • H03K17/601—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors using transformer coupling

Definitions

  • the present invention relates to a driving circuit of a power switching transistor, and more particularly, to a reduction in power loss during turn-on, turn-over, and power saving,
  • the present invention relates to a driving circuit of a power switching transistor capable of shortening a range time.
  • the driving circuit of the power switching transistor which is used for a switching power supply such as a switching power supply with a variable pulse width, has a smaller power supply.
  • the need for higher switching frequency has arisen from the requirements of the above.
  • the power switching transistor due to the necessity of increasing the frequency, only the power switching transistor is required. Increasing the number of on-z off-returns increases power loss during switching.
  • the power switching transistor has an operation delay (storage time), and the control is not performed during this storage time. become unable. In other words, there is a control dead time, and when the switching speed is increased, this time is constant. And the control range due to the pulse width change becomes narrower.
  • FIG. 1 is a circuit diagram of a drive circuit in a conventional power switching transistor.
  • ⁇ ⁇ ⁇ receives a pulse signal P i, which is a control signal, amplifies the current, and supplies a no-pulse current to the primary coil of the ball trans- lation described later.
  • P i is the power switching transistor
  • QL is the power switching transistor
  • BSC is the power switching transistor.
  • Circuit, PT is a brim: a pulse strain that electromagnetically couples between the PAP and the base circuit BSC.
  • the preamplifier PAP receives the pulse signal Pi and amplifies the current, and the pulse PAL is applied to the primary coil of the PT. Provide the pulse compress IP.
  • the base circuit BSC is connected to the pulse transistor IP by the pulse current I s generated in the secondary coil corresponding to the pulse current IP.
  • the Baker Crane Diode DB has a power switching transistor ⁇ 3 ⁇ 4L At that time, the QL is clamped to a state just before the harmony and has a setting to prevent overdrive. After that, when the pulse signal P i disappears, the pulse current IP is interrupted, and the energy stored in the primary coil of the pulse transformer PT is released. Is released as a pulse voltage, and the voltage up to the pulse
  • a reverse voltage is generated in the secondary coil, and QL is biased.
  • the charge stored in the capacitor CB is also indicated by a dotted arrow. Released at the indicated route, the Baker Clamp Diode; shortening the storage time of the QL, and turning on the Z Speeds off operation.
  • the storage time can be considerably shortened as compared with the previous one, but the effect was not sufficient. .
  • the present invention provides a novel drive circuit which can sufficiently shorten the storage time and reduce the power loss at the time of turning off the Z.
  • the present invention provides a base circuit that presses a power-sinking transistor for interrupting power supply to a load, and a secondary circuit connected to an input terminal of the base circuit.
  • the pulse transformer to which the coil is connected and the current flowing through the primary coil of the pulse transformer are renewed according to the input signal, and the pulse Connected in series with the primary coil of the
  • a preamplifier provided with a low impedance circuit that forms a current circuit with the other primary coil with respect to the flyback voltage generated in the secondary coil. And a power switching transistor connected to a base circuit output ⁇ ⁇ based on an input signal input to the preamplifier. It is configured to be up-to-date.
  • the low impedance circuit has an on-state transistor and a diode provided at the input of the preamplifier. Configure The low impedance circuit is activated when the secondary coil of the pulse transformer is subjected to a flash or a high pressure. It is configured to carry current by being connected to the primary coil of the lance.
  • the primary coil of the pulse transformer may use the above-mentioned primary coil for interrupting the current, and may be provided outside the primary coil. Other primary coils are acceptable.
  • Fig. 1 shows the conventional switching transistor drive times.
  • FIGS. 2 to 5 are circuit diagrams of a switching transistor drive circuit according to the present invention.
  • FIG. 2 shows a driving circuit of a high-voltage switching transistor according to the present invention.
  • the base circuit BSC has the same configuration as the conventional circuit shown in FIG. 1, the internal description of the circuit is omitted, and the circuit is shown by a block.
  • the same reference numerals are given to the conventional apparatus and the same 3 ⁇ 45 minutes, its explanation is omitted Ru _ 3 o
  • the preamplifier has the following configuration. O That is, the input signal at which the pulse signal Pi, which is the input signal, turns on at the noise level.
  • Drive and pulse transformer One of the PT's primary coils has an emitter and a collector connected to one of the primary coils, respectively.
  • the other end of the wheel has a collector and a drive transistor Q3 to which an emitter is connected.
  • the base of the drain transistor Q2 is connected to the collector of the transistor Q1 via the diodes D and D, and The base of drive transistor Q 3 is connected directly to the collector of transistor Q 1 and the drive transistor Q 2
  • a diode D1 is connected between the collector and the emitter of the transistor, and a diode is connected between the base and the emitter of the drive transistor ⁇ 3 ⁇ 43.
  • Diode D 2 is connected.
  • the current closure shown by the line is a power switch, because it operates as a steady-state impedance circuit when the bridge 3 ⁇ A is in the active state.
  • the base circuit BSC is stably held in the off state of the long-range transistor ⁇ 3 ⁇ 4L.
  • FIG. 3 is a circuit diagram showing another embodiment of the present invention.
  • O In the case of o «—, pulse trans; PT, drive
  • a primary coil CL13 is provided separately from the primary coil CLii, and a low impedance circuit (diode D5, Low resistance H, a series circuit consisting of transistor 1) are connected.
  • the drive transistor Q2 is turned on and the route indicated by the execution arrow is turned on.
  • the pulse current IP flows, and the pulse switching transistor (3 ⁇ 4L conducts while the base circuit BSC opens) in the same manner as described in FIG.
  • the drive transistor Q2 is turned off. Is turned on, a dotted arrow indicates “3
  • the series circuit including the diode D5, the low resistance R, and the transistor Q1, which are connected in series with CLi3 and still form a short path at the dotted line, has a low impedance. This indicates that the reverse switching current of the burst switching transistor QL generated in the secondary coil C L2 is generated. ⁇ o3 ⁇ 4ff
  • One-swing switching transistor (3 ⁇ 4 Speeds up the turn-off operation of L and shortens storage time.)
  • the closed circuit acts as a stationary low impedance circuit when the preamplifier PAP is off, and the power switching transistor is turned off. Keep the base circuit stable by setting the QL to the required state.
  • FIG. 4 is a circuit diagram of yet another embodiment of the present invention, which is different from the drive circuit of FIG. 3 in that a diode D 4 is newly added. Only different.
  • FIG. 5 is a circuit diagram showing another embodiment of the power switching transistor drive circuit according to the present invention, and is basically different from the circuit shown in FIG. ,
  • the drive transistor Q2 When the transistor ⁇ 3 ⁇ 41 is turned off, the drive transistor Q2 is turned on and the rule indicated by the solid arrow is turned on.
  • the pulse current I PI flows through the primary coil CL ii for the drive, and the pulse current IS 1 changes to the power switching transistor QL.
  • the current flows into the base, and the switching transistor QL conducts.
  • the storage time of a switching transistor can be shortened, and power loss can be reduced.
  • it since it is possible to perform highly localized switching, it can be applied to a switching type stabilized power supply.
  • the size can be reduced.

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Electronic Switches (AREA)
  • Power Conversion In General (AREA)

Description

明 細 ， 書
パ ワ ー ス イ ッ チ ン グ ト ラ ン ジ ス タ の ド ラ イ ブ回路
技 術 分 野
本発明はパ ワ ー ス ィ ツ チ ン グ ト ラ ン ジ ス タ の ド ラ イ ブ 回路に係 り 、 特に タ ー ン オ ン 、 タ ー ン 才、フ時の電力損失 の軽減、 ス ト レー ジ タ イ ム の短縮が可能なパ ワ ー ス ィ ッ チ ン グ ト ラ ン ジ ス タ の ド ラ イ ブ回路に関する。
背 景 技 術
パ ル ス幅変靄による ス ィ ツ チ ン グ方式安定化電源な ど に用レ、ら れる バワ ー ス ィ ツ チ ン グ ト ラ ン ジ ス タ の ド ラ イ ブ回路は電源の小型化の要求から ス ィ ッ チ ン グ周波数 を 高周波にする必要が生じている o しか しながら 、 か ^ る 高周波化の必要控から単にパ ワ ー ス ィ ッ チ ン グ ト ラ ン ジ ス タ の オ ン z オ フ の耪返回数を多 く する と ス ィ ッ チ ン グ 時の電力損失が大き く なる。 又、 パ ワ ー ス イ ッ チ ン グ ト ラ ン ジ ス タ に は動作遅れ （ ス ト レ ー ジ タ イ ム ） が存在し、 こ の ス ト レ ー ジ タ イ ム の間は制御ができな く なる。 即ち、 制御のデ ッ ト タ イ ム が存在し、 ス イ ッ チ ン グ速度を上昇 さ せ て ゆ く と こ の デ ク ト タ イ ム は 一定で あ る た め 、 そ の 時間的割合が上昇しパ ル ス幅変篛に よ る制御範囲が狭 く な る 。 こ の た め高局波化を実現する ためにはバワ ー ス ィ ツ チ ン グ ト ラ ン ジ ス タ の タ ー ン オ ン タ ー ン オ フ時の電 力損失の軽減、 並びに ス ト レ ー ジ タ イ ム の短縮の追求が 課題にな ってお り 、 氇々の Hi路が提案され実用化さ れて いる o 第 1 図は か る ^来の バ ワ ー ス ィ ツ チ ン グ ト ラ ン ジ ス 夕 の ドラ イ ブ回路の回路図である。 図中： Ρ Α Ρは制御信 号である パル ス信号 P i を入力されてこれを電流増幅 し、 後述するバル ス ト ラ ン ス の 1 次コ イ ル に ノ、 ·ル ス電流を供 給する プ リ ア ン プ、 Q L はバ ヮ ー ス イ ッ チ ン グ ト ラ ン ジ ス タ 、 B S C はパ ワ ー ス イ ッ チ ン グ ト ラ ン ジ ス タ Q L を 懕動する ベー ス回路、 P Tは ブ リ ア ン ブ ： P A P と ベ ー ス 回路 B S C間を電磁的に結合する パ ル ス ト ラ ン ス で あ る。
こ の ド ラ イ ブ画路にお いては 、 プ リ ア ン プ P A Pは パ ル ス信号 P i を受けて電流増幅を行ない、 パ ル ス ト ラ ン ス ； P Tの 1 次コ イ ル に パ ル ス罨流 I P を供耠する。 一方、 ベー ス回路 B S Cはパ ル ス電流 I P に対応して 2 次コ ィ ル に発生する パ ル ス電流 I s によ り パ ヮ 丁 ト ラ ン ジ ス タ
Q L を導通させる が、 こ の時ベー ス回路の ス ビー ドア ツ ブ コ ン デン サ C B への充電 々流がベー ス電流と し て加算 されているためベー ス電流が一時的に増大し Q L の タ ー ン オ ン タ イ ム が短か く なる o 尚、 ベ ー カ ク ラ ン ブダイ ォ 一 ド D B はバ ワ ー ス ィ ツ チ ン グ ト ラ ン ジ ス タ <¾ L がオ ン 時、 該 Q L を麁和寸前の状態に ク ラ ン プ し 、 オーバ ドラ イ ブを防止する置'きを有している。 その後、 パル ス信号 P i が消失する と パル ス電流 I P が途^え、 パ ル ス ト ラ ン ス P Tの 1 次 コ イ ル に蓄え られた ^気エ ネ ル ギが フ ラ ィ バ ッ ク電圧と して放出され、 該パ ル ス ト ラ ン ス ま で の
2 次コ イ ル に逆電圧が発生し、 Q L は造バ イ ア ス される。 の時コ ン デン サ C B に蓄え られていた電荷も点籙矢印で 示すル ー ト で放出 さ れ ベ ー カ ク ラ ン プ ダ イ 才 ー ド； D B の 果と 栢ま っ て Q L の ス ト レ ー ジ タ イ ム を短縮 し 、 且つ タ ー ン オ ン Z オ フ の動作を早める 。
以上の よ う に第 1 図の ド ラ ィ ブ回路に よ ればそれ 前 の も の に比べかな り ス ト レ ー ジ タ イ ム を短縮でき る が、 その ¾果は十分でなか つ た。
従 っ て、 本発明は.ス ト レ 一 ジ タ イ ムを十分に短綜でき、 又 タ ー ン 才 ン Zオ フ時の電力損失を軽滅でき る 新規な ド ラ イ ブ回路、 特に ブ リ ア ン ブを提供する こ と を 目 的 と す る o
発 明 の 開 示
し の発明は、 負荷に供給する 電源 を断続せ し める パ ヮ ー ス ィ ク チ ン グ ト ラ ン ジ ス タ を壓動する ベー ス 回路 と 、 該ベー ス回路の入力端に 2 次 コ イ ル を接続 し た パ ル ス ト ラ ン ス と 、 パ ル ス ト ラ ン ス の 1 次 コ イ ル に流れ る 電流を 入力信号に従っ て新続せ し め 、 かつパル ス ト ラ ン ス の 1 次 コ イ ル に直列に接続 さ れる と と も にパル ス ト ラ ン ス の
2 次 コ イ ル に発生する フ ラ イ バ ッ ク 電圧に対 し 前記他の 1 次 コ イ ル と で電流閉路 を形成する 低イ ン ビ ー ダ ン ス 回 路を設けた プ リ ア ン プ と を有 し、 プ リ ア ン プ に入力 さ れ る入力信号に基ずいて ベー ス 回路出力媢に接続 さ れ てい る前記バ ワ ー ス ィ ッ チ ン グ ト ラ ン ジ ス タ を 新続 す る よ う に構成さ れている 。 そ し て こ の発明に お いて、 低ィ ン ビ 一 ダ ン ス 回路は、 プ リ ア ン プ の入力 に設け た ォ ン 状態の ト ラ ン ジ ス 夕 と ダ イ 才 ー ドを も っ て構成する こ が で き 、 パ ル ス ト ラ ン ス の 2 次 コ イ ル に フ ラ イ ノ、 ッ ク 圧が発生した と き、 こ の低イ ン ピ ー ダ ン ス回路がノ、·ル ス ト ラ ン ス の 1 次コ ィ ルに接続されて電流を流す よ う に構 成されている。 なお、 ノヽ ·ル ス ト ラ ン ス の 1 次コ イ ルは、 電流を断続せ しめる上記 1 次コ イ ルを用いても よ く 、 ま た こ の 1 次 コ イ ルの外に設けた他の 1 次コ イ ル でも よレ、。
図面の簡単な説明
第 1 図は ¾来のス イ ッ チ ン グ ト ラ ン ジ ス タ ド ラ イ ブ回
-J
路の回路図、 第 2 図乃至第 5 図はそれぞれ本発明に係る ス イ ッ チ ン グ ト ラ ン ジ ス タ ド ラ イ ブ回路の回路図である。
癸明を実施する ための最良の彭態
本発明を よ り 詳 ^に説明する ために、 以下添付図面に 徒っ て説明する。
第 2 図は本発明に係る バ ヮ — ス ィ ク チ ン グ ト ラ ン ジ ス 夕 の ド ラ ィ ブ回路である。 該本発明回路において、 ベー ス回路 B S C は第 1 図示の ¾来の回路と 同様な構成を有 する ので 、 回路の内部説明は省略 し、 ブ n ッ ク にて示す。 また、 従来装置と 同一 ¾5分には同一符号を付し、 その説 明は省略 _3 る o
本発萌において 、 プ リ ア ン プ ： は次の よ う な構成 を有する o すなわち、 入力信号である パ ル ス信号 P i が ノヽ ィ レ べ ルの と ぎオ ンする入力用の ト ラ ン ジ ス タ と、 一 B電源と パ ル ス ト ラ ン ス ] P T の 1 次 コ イ ル の一方餾に それぞれェ ミ ッ タ 、 コ レ ク タ を接続した ド ラ イ ブ ト ラ ン ジ ス タ Q 2 と 、 + B電源とパ ル ス ト ラ ン ス ： P T の 1 次コ ィ ル の他方鲻にそれぞれ コ レ ク タ 、 ェ ミ ッ タ を 接続 した ド ラ イ ブ ト ラ ン ジス タ Q 3 と を有する 。 そ し て、 ド ラ イ プ ト ラ ン ジ ス タ Q 2 の ベー ス は ダ イ ォ ー ド D ， D を介 し て ト ラ ン ジ ス タ Q 1 の コ レ ク タ に接続さ れ、 ド ラ イ ブ ト ラ ン ジ ス タ Q 3 の ベー ス は直接 ト ラ ン ジ ス タ Q 1 の コ レ ク タ に接続さ れ、 さ ら に ド ラ イ ブ ト ラ ン ジ ス タ Q 2 の コ レ ク タ 、 ェ ミ ッ タ 間には ダイ オ ー ド D 1 が接続 さ れ、 ド ラ イ ブ ト ラ ン ジ ス タ <¾ 3 の ベ ー ス 、 エ ミ ッ タ 間に は ダ イ ォ ー ド D 2 が接较されている 。
こ の 回路にぉレ、ては プ リ ア ン プ ； P A P の ト ラ ン ジ ス タ Q 1 が オ フ になる と 、 ド ラ イ ブ ト ラ ン ジ ス タ Q 2 ， Q δ が才 ン し、実籙矢印で示すル ー ト でバル ス電流 I P が流れ、 第 1 図において説明 した と 同様に ベー ス 回路 B S C の機 能でパ ワ ー ス ィ ッ チ ン グ ト ラ ン ジ ス タ Q L が導通する 。 —方、 パ ル ス信号 P i に よ り ト ラ ン ジ ス タ Q 1 がオ ン す る と ド ラ イ ブ ト ラ ン ジ ス タ Q 2 , Q 5 が オ フ す る 。 ド ラ イ ブ ト ラ ン ジ ス タ Q 2 ， がオ フ する と 、 点籙矢印に 示す電流閉路、 節ち 、 ダイ オ ー ド ： D 1 → 1 次 コ イ ル→ ダ ィ 才 ー ド D 2 ト ラ ン ジ ス タ Q 1 の電流パ ス が形成さ れ る 。 尚、 前記点線の電流パ ス を形成する ダ イ ォ ー ド IH , D 2 、 ト ラ ン ジ ス タ Q 1 よ り な る 直列回路 は泜 イ ン ピ ー ダ ン ス を示 し、 2 次コ イ ル に発生する バ ヮ 一 ス ィ ッ チ ン グ ト ラ ン ジ ス タ Q L の逆バ イ ア ス 電流を増加さ せ る 。 こ の結果、 パ ワ ー ス イ ッ チ ン グ ト ラ ン ジ ス タ Q L の タ ー ン オ フ動作を早め、 ス ト レ ー ジ タ イ ム を短綰す る 。 ま た点
OM 線で示す電流閉路は 、 ブ リ ア ン ブ 3Ρ A Ρ が 才 フ 態にあ る と き定常的な イ ン ビ ー ダ ン ス 回路 と し て動作する た め 、 パ ワ ー ス イ ッ チ ン グ ト ラ ン ジ ス タ <¾ L の オ フ状態に おいてベー ス 回路 B S C を安定に保持する 。
第 3 図は本発明の別の実施 ^ を示す回路 図 あ る o «— の実旌 に お い て は パ ル ス ト ラ ン ス ； P Tに、 ド ラ イ ブ用
1 次 コ イ ル CL i i と別に 1 次 コ イ ル C L 13を設け、 該別 に設けた 1 次 コ イ ル CL i3 に低 ィ ン ビ ー ダ ン ス 回路 （ ダ ィ オ ー ド D 5 、 低挖抗 H、 ト ラ ン ジ ス タ ¾ 1 よ り な る 直 列回路） を 接続 し ている 。
さ て 、 ブ リ ア ン ブ の ト ラ ン ジ ス タ Q 1 が オ フ に なる と 、 ド ラ イ ブ ト ラ ン ジ ス タ Q 2 が オ ン し 、 実籙矢印 で示すル ー ト でパル ス電流 I P が流れ、 苐 1 図において 説明 した と 同様にベ ー ス 回路 B S C の 鹭きでパ ヮ 一 ス ィ ツ チ ン グ ト ラ ン ジ ス タ （¾ L が導通する 。 一方ヽ パ ル ス 信 号 P i に よ り ト ラ ン ジ ス タ Q 1 が ォ ン する と ド ラ イ ブ ト ラ ン ジ ス タ Q 2 が オ フ す る 。 ブ ト ラ ン ジ ス タ <¾ 2 がオ ン する と 、 点線矢印に示 "3 ¾流閉路 ち ダ イ オ ー ド
D 3 → 1 次 コ ィ ル CL l3 →低抵抗 R— ト ラ ン ジ ス タ <¾ 1 よ り な る 電流パ ス が形成さ れ る o 尚 、 こ の 1 次 コ イ ル
CLi3 に直列に接続され、 し か も 前記点線に不 し 流 パ ス を形成する ダイ ォ ー ド D 5 、 低抵抗 R、 ト ラ ン ジ ス タ Q 1 を含む直列回路は低 ィ ン ビ ー ダ ン ス を示 し 、 2 次 コ イ ル C L2 に発生する バ ヮ ー ス ィ ツ チ ン グ ト ラ ン ジ ス タ Q L の逆パ イ 了 ス電流を ϋ さ せ る o こ の结果ヽ パ ヮ o¾ffし
、 一 ス ィ.ツ チ ン グ ト ラ ン ジ ス タ （¾ L の タ ー ン 才 フ動作を早 め、 ス ト レ ー ジ タ イ ム を短綜する ·。 また、 点籙で示す電 流閉路は プ リ ア ン プ P A P がオ フ状葸に あ る と き定常的 な低イ ン ビ ー ダ ン ス 回路 と して爵き、 パ ワ ー ス ィ ッ チ ン グ ト ラ ン ジ ス タ Q L の 才 フ 状態に 'ぉ レ、 て ベー ス 回路を安 定に保持する。
第 4 図は本 ·発明の更に別の実旌^回路図であ り 、 第 3 図の ド ラ イ ブ回路 に対 し 、 ダ イ オー ド D 4 か新 た に付加 さ れている点が異なる だけである。
さ て 、 ド ラ イ ブ ト ラ ン ジ ス タ Q 2 が オ ン し て 、 パル ス 電流 I P が' 1 次 コ イ ル CL ii に流れている状態において、 ト ラ ン ジ ス タ Q 1 が オ フ か ら オ ン に変化する と 、 1 点鎖 籙で示す電流閉路が形成され、 ドラ イ ブ ト ラ ン ジ ス タ Q2 に蓄積されている ベ ー ス電荷が強制的に引き抜かれ、 該 ド ラ イ ブ ト ラ ン ジ ス タ Q 2 の ス ト レ ー ジ タ イ ム が短縮す る 。 そ し て ド ラ イ ブ ト ラ ン ジ ス タ Q 2 が タ ー ン オ フ す る と パ ル ス電流 I P が途絶え、 フ ラ イ パ ッ ク 電圧に して 電流 I 2 の電流パ ス （点籙） が形成さ れ、 以後苐 3 図に おいて説萌 した と 同様に Q L の逆バイ ァ ス 電流が増加し、 該バワ ー ス イ ッ チ ン グ ト ラ ン ジ ス タ Q L は タ ー ン オ フ す る。 従っ て、 第 4 図に示す回路に よ れば第 3 図に示す効 杲に加えて 、 ブ リ ア ン ブ P A P 内 の ド ラ イ ブ ト ラ ン ジ ス タ Q 2 の ス ト レ ー ジ タ イ ム を短綜で き 、 増 々 パ ワ ー ス ィ ツ チ ン グ ト ラ ン ジ ス タ Q L の ス イ ッ チ ン グ時間を短縮で きる と い う 効果を生 じる
Figure imgf000009_0001
第 5 図は本発明に係る パ ワ ー ス ィ ツ チ ン グ ト ラ ン ジ ス タ ド ラ イ ブ回路の他の実施倒 を示す回路図であ り 、 第 4 図に示す回路とは基本的に、
(ィ）ノ、'ル ス ト ラ ン ス ； P T に 1 つ の ド ラ イ ブ ^ 1 次 コ イ ル C L 11 と集 1 の 1 次コ イ ル CL i3 と苐 2 の 1 次 コ イ ル CL 12 が設け られている 、
(口） ドラ イ ブ用 1 次 コ イ ル CL ii と第 2 の 1 次 コ イ ル CL i2 の接続点が電源 + B に接続され、 第 2 の 1 次 コ ィ ル CL i2 の他 が ス ィ ツ チ ン グ ト ラ ン ジ ス タ Q 4 に接続 され点線で示すよ う な電流バス が形成されてい る、 とい う 点において異なる。
さ て、 ト ラ ン ジ ス タ <¾ 1 が オ フ し てレ、る と きは 、 ド ラ イ ブ ト ラ ン ジ ス タ Q 2 がオ ン し てお り 、 実線矢印に示す ル ー ト でパ ル ス電流 I PIが ド ラ イ ブ用 1 次 コ イ ル CL ii を流れ、 ノ、'ル ス電流 I S 1 がパ ワ ー ス イ ッ チ ン グ ト ラ ン ジ ス タ Q L の ベー ス に流れ込み該ノ、， ワ ー ス ィ ッ チ ン グ ト ラ ン ジス タ Q L は導通 してレ、る 。
こ の状態で ト ラ ン ジ ス タ が オ フ か ら オ ン に変化す る と 、 点鎳及び 1 点鎖辕にて示す 3 つの電流パス が形成 される。 そ して 1 点鎖耪に示す第 1 の 1 次 コ イ ル CL l3 を通る電流バ ス I 1 に よ り 第 4 図において説明 した と 同 様に ド ラ イ ブ ト ラ ン ジ ス タ Q 2 に蓄積されてレ、る ベー ス 電荷が強 的に引き技かれ、 そ の ス ト'レ 一 ジ タ イ ム が短 綜する。 一方、 ド ラ イ ブ ト ラ ン ジ ス タ Q 2 が非導通と な る と コ ン デ ン サ C 1 及び笾抗 R 1 よ り なる 時定数回路を 介 してス ィ ツ チ ン グ ト ラ ン ジ ス タ Q 4 にベ ー ス電流が流 れ込み、 該ス イ ッ チ ン グ ト ラ ン ジ ス タ Q 4 は C R1 で決 ま る一定時間だけ オ ン し 、 パ ル ス電流 IP2が第 2 の 1 次 コ イ ル CL i2 に流れる。 これに よ り 、 ¾パ イ ァ ス電流が 急速に大き く な り パ ワ ー ス イ ッ チ ン グ ト ラ ン ジ ス タ Q L は短時間でオ フ と な る。 尚、 電流閉路 I 2 は逆バ イ ア ス 電流を増大させる ¾能を杲す と共にベ ー ス 回 ^を安定に 保持する機能を果す。
産業上の利用可能拴
以上の よ う に本発明に よ れば、 ス イ ッ チ ン グ ト ラ ン ジ ス タ の ス ト レ 一 ジ タ イ ム を短綜で き る と と も に電力損失 を軽镔で き る 。 ま た、 高局沒ス イ ッ チ ン グ が可能である ため、 ス イ ッ チ ン グ式安定化電源に適用可能であ り 、 そ
の小型化が可能と なる。
· -

Claims

請 求 の 範 囲
(1) 負荷に供給する電葸を断玆せ しめる パワー ス イ タ チ ン グ ト ラ ン ジス タを駆動する ベー ス回路と、 該ベー ス 回路の入力端に 2 次コ イ ルを接続したパ ル ス ト ラ ンスと、 パルス ト ラ ン ス の 1 次コ イ ル に流れる電流を入力信号に 従って跻锈せ しめ、 かつパル ス ト ラ ン ス の 1 次コ ィ ル に 直列に接続される と と も にパ ルス ト ラ ン ス の 2 次コ イ ル に発生する フ ラ イ バ ッ ク電 に対 し前記 ¾の 1 ^ コ イ ル とで電流閉路を形^する低ィ ン ビーダ ン ス回路を設けた ブ リ アンプとを有 し、 ブ リ アンブに入力される入力信号 に基ずいてベー ス回路出力端に接続されて る前記パヮ ー ス ィ グ チ ン グ ト ラ ン ジ ス タ を ^続制街する パ ワ ー ス ィ グ チ ン グ ト ラ ン ジス タ の ド ラ イ ブ回路。
(2) パルス ト ラ ン ス の 1 ^ コ イ ル に流れる電流を該 1 次 コ イ ル の両媸に設けた 2 個の ド ライ ブ ト ラ ン ジス タ に よ 新続せ しめる こ と を特铵 とする請求の範囲第（1) 項記載のパワ ース ィ プ チ ン グ ト ラ ン ジ ス タ の ド ラ イ ブ回 路。
(3) 低イ ン ビー ダ ン ス回路は一方の ド ラ イ ブ ト ラ ン ジ ス タ の コ レク タ とェ ミ ッ タ間に接続されたダイ オー ドと 他方の ド ラ イ ブ ト ラ ン ジ ス タ の ベー ス と エ ミ ク タ間に接 続されたダイ ォ一 ド と ブ リ ア ン プの入力側に設け られた オ ン状態の ト ラ ン ジ ス タ とで構成 したこ と を特铵とする 請求の範园苐（2}項記載のバ ヮ 一 ス ィ ジ チ ン グ ト ラ ン ジス タ の ド ラ イ ブ回路。
ΟΜΡί ' 1 1
(4) 負荷に供給する電源を 新続せ し める パ ワ ー ス イ ツ チ ン グ ト ラ ン ジ ス タ を ^動する べ一ス回路 と 、 1 次 コ ィ ル を 2 倨有'し、 該ベ ー ス 回路の入力蹈に 2 次 コ イ ルを接 続したノ、 ' ル ス ト ラ ン ス と 、 パ ル ス ト ラ ン ス の一方の 1 次 コ ィ ル に流れる 電流を入力信号に従っ て断；^せ し め、 か つパ ル ス ト ラ ン ス の他方の 1 次 コ イ ル に直列に接続され る と と も にバ ル ス ト ラ ン ス の 2 次 コ イ ル に 生する フ ラ ィ バ ッ ク 雩圧に対 し前記他方の 1 次 コ イ ル と で電流閉路 を形成する低ィ ン ビ ー ダ ン ス回路を設けた プ リ ア ン ブ と を有し、 プ リ ア ン プ に入力される入力信号に基すいてべ ー ス回路出力'竭に接^されている前記パ ワ ー ス ィ ッ チ ン グ ト ラ ン ジ ス タ を ^続龆 す る パ ワ ー ス ィ ツ チ ン グ ト ラ ン ジ ス タ の ド ラ イ ブ回路。
(5) 負荷に侯給する 電源を新続せ しめる パワ ー ス イ ツ チ ン グ ト ラ ン ジ ス タ を屋動する ベ ー ス 回路 と 、 ド ラ イ ブ 用 1 次 コ イ ル と第 1 と 第 2 の 1 次コ イ ルを有し、 該ベー ス 回路の入力鲻に 2 次 コ イ ルを接^したパ ル ス ト ラ ン ス と 、 ノ、' ル ス ト ラ ン ス の ド ラ イ ブ用 1 次コ イ ルに流れる電 流を入力信号に従っ て新続せ し め、 かつパ ル ス ト ラ ン ス の第 1 の 1 次 コ イ ル に直列に接続される と と も にパ ル ス ト ラ ン ス の 2 次コ イ ル に癸生する フ ラ イ パ ク ク 電圧に対 し前記苐 1 の 1 次 コ イ ル と で電流閉路を形成する低イ ン ビ ー ダ ン ス 回路を設け、 2 次 コ イ ル に フ ラ イ パ ッ ク 電圧 が発生した時苐 2 の 1 次 コ ィ ル に 一定時間電流を流通す る ス ィ ツ チ ン グ ト ラ ン ジ ス タ を設けた プ リ ア ン プ と を有 -,
O PI し、 ブ リ アンブに入力される入力信号に基ず てベー ス 回路出力 ¾に接続されている前記パワ ース ィ ツ チン グ ト ラ ン ジスタ を靳続制御するパ ワース ィ ツチング ト ラ ンジ ス タ の ドラ イ ブ回路。
(6) 低イ ン ビ一 ダ ン ス回路はダイ オー ド と 抗と プ リ ア ン プの入力倜に設け られたオ ン状態の ト ラ ン ジ ス タ と で *成 したこ とを特钹と する請求の簏囲第（4)項又は第 (5) 項言己载のバ ワー ス ィ プ チ ン グ ト ラ ン ジスタの ド ラ イ ブ回
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