TWI451390B - 液晶顯示裝置與驅動此裝置之方法 - Google Patents

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Description

液晶顯示裝置與驅動此裝置之方法
本發明涉及一種液晶顯示裝置，以及更尤其涉及一種可以將延遲裝置數目最小化、而在一預定時間期間，保持從位準位移器供應至放電電路的閘極高電壓之液晶顯示裝置、以及驅動此裝置之方法。
通常，一液晶顯示裝置以視頻信號為基礎、藉由控制液晶單元之光線透射而顯示影像。特別地，主動矩陣式LCD裝置(下文稱作“AM LCD裝置”)適合用於顯示移動影像，這是因為所述AM LCD裝置包括在液晶單元內各形成的切換元件。典型地，所述切換元件由薄膜電晶體TFT形成，如同於第1圖中所示。
參考第1圖，所述AM LCD裝置將數位輸入資料轉換為關於灰階參考電壓的類比資料電壓，且在同時將該類比資料電壓供應至資料線DL，以及將掃描脈衝供應至閘極線GL。
所述薄膜電晶體TFT被提供有一閘極電極，一源極電極和一汲極電極。在此時，薄膜電晶體TFT的閘極電極連接至閘極線GL，其源極電極連接至資料線DL，以及其汲極電極連接至：液晶單元Clc之像素電極、和儲存電容器Cst之電極。而且，液晶單元Clc的一共同電極被供應共同電壓Vcom。
當薄膜電晶體TFT導通時，所述儲存電容器Cst被資料線DL提供的一資料電壓充電，因而液晶單元Clc的一電壓保持在一恆定位準。
當掃描脈衝施加至閘極線GL時，所述薄膜電晶體TFT導通，因而在源極電極和汲極電極之間形成一通道。因此，資料線DL的電壓被供應至液晶單元Clc的像素電極上。當液晶單元Clc的液晶分子內的排列被像素電極和共同電極之間的一電場改變時，此藉由之入射光被調變。
當電源電壓VCC供應停止時，此包含上述結構像素之液晶顯示裝置藉由使用放電電路(圖中未示)從像素釋出剩餘電荷。在此時，在停止供應電源電壓後，放電電路將一閘極高電壓VGH提供至閘極線GL在一預定時間期間，因而藉由資料線DL釋出像素的剩餘電荷。所述放電電路在一恆定 時間期間藉由使用複數個低容量電容器(例如，大約15個低容量電容器)保持閘極高電壓VGH的供應時間。
習知技術中的液晶顯示裝置包括：提供有大約15個低容量電容器的放電電路。因此，習知技術中的液晶顯示裝置不可避免地具有增加之製造成本高而且電路結構複雜的不利效應。
因此，本發明涉及一種液晶顯示器裝置和驅動此裝置的方法，其實質’上避免由於習知技術中的限制與缺點所導致的一個或多個問題。
本發明的一個目的是提供一種液晶顯示裝置，其能夠將延遲裝置之數目最小化，而在一預定時間期間，保持從位準位移器供應至放電電路的閘極高電壓VGH，以及驅動此液晶裝置的方法。
對於本發明額外的優點、目的、以及特徵，一部份將在以下描述中說明，一部份將由檢視而對於熟習此技術人士為明顯，或者可以藉由實施本發明而得知。本發明的目的和其他優點可以藉由撰寫說明、其申請專利範圍、以及所附圖式中所特別指出的結構而實現與獲得。
為了達成本發明此根據本發明與目的之此等目標與其他優點，如同在此實現與廣泛說明者，一液晶顯示裝置包括：一第一泵單元，用於第一次汲取一所施加的高電位電源電壓；一第二泵單元，用於藉由第二次汲取第一次在第一泵單元內汲取的高電位電源電壓而產生一閘極高電壓；一位準移動器，用於將一輸入高電壓位移至對應於來自第二泵單元中的閘極高電壓位準之位準，並將閘極高電壓供應至一放電電路；以及一延遲裝置，連接在第二泵單元的輸入和輸出之間，用於將來自位準位移器的閘極高電壓輸出維持預定時間期間。
在另一方面，一液晶顯示裝置包括一第一泵單元，用於第一次汲取一所施加的高電位電源電壓；一第二泵單元，用於藉由第二次汲取第一次在第一泵單元內汲取的高電位電源電壓；一位準位移器，用於將一輸入高電壓位移至對應於來自第二泵單元中的閘極高電壓的位準之位準，以及將閘極高電壓供應至一放電電路，並將閘極高電壓供應至一放電電路；以及一 延遲裝置，連接在第一泵單元的輸入和輸出之間，用於將來自位準位移器的閘極高電壓維持預定時間期間。
在另一方面，一種驅動液晶顯示裝置的方法包括：第一次藉由一第一泵單元汲取一高電位電源電壓；藉由第二泵單元第二次汲取在第一泵單元中第一次汲取的高電位電源電壓以產生閘極高電壓；若將一低電壓輸入至位準位移器，則將一閘極低電壓藉由一位準位移器供應至一放電電路；若將所述高電壓輸入至位準位移器，則將高電壓藉由位準位移器位移至第二泵單元內產生的閘極高電壓之位準，並將閘極高電壓供應至放電電路；以及藉由連接在第二泵單元的輸入和輸出之間的一延遲裝置，將由位準位移器輸出的閘極高電壓維持一預定時間期間。
再一方面，一種驅動一液晶顯示裝置的方法包括：第一次藉由一第一泵單元汲取一高電位電源電壓；藉由一第二泵單元第二次汲取在第一泵單元中第一次汲取的高電位電源電壓以產生閘極高電壓；若將一低電壓輸入至位準位移器，則將一閘極低電壓藉由一位準位移器供應至一放電電路；若將所述高電壓輸入至位準位移器，則將藉由位準位移器，將高電壓位移至在第二泵單元中所產生的閘極高電壓之位準，並將閘極高電壓供應至放電電路；以及藉由連接在第一泵單元的輸入和輸出側之間之一延遲裝置，將由位準位移器輸出的閘極高電壓維持一預定時間期間。
應瞭解本發明以上一般性說明與以下詳細說明僅為典範與說明，其用意在於提供其所主張發明之進一步解釋。
此等所附圖式，其包括於此而構成本說明書之一部份，以提供本發明進一步瞭解，而說明本發明之實施例，且與此等說明一起用於解釋本發明之原理。
現在詳細說明本發明之較佳實施例，而在附圖中說明其例。當可能時在所有圖中使用相同參考號碼，以稱呼相同或類似元件。
以下參考所附圖式以說明此根據本發明較佳實施例之液晶顯示裝置與驅動此液晶顯示裝置之方法。
第2圖說明根據本發明較佳實施例之液晶顯示裝置。
參考第2圖，本發明中的一液晶顯示裝置100包括：一液晶顯示面板110，其包含複數條閘極線GL1至GLn，複數條資料線DL1至Dlm，以及複數個薄膜電晶體TFT，其中，每一條閘極線與每一條資料線彼此相交，並且各用於驅動液晶單元Clc的薄膜電晶體TFT形成在閘極線GL和資料線DL相交的位置；一資料驅動器120，其將資料供應至液晶顯示面板110的複數條資料線DL1至DLm；一閘極驅動器130，其將資料供應至液晶顯示面板110的複數條閘極線GL1至GLn；一計時控制器140，其控制資料驅動器120和閘極驅動器130；一放電驅動器150，其控制形成在液晶顯示面板110內的各像素的放電；以及一放電電路160，其在放電驅動器150的控制下，將各像素放電。
所述液晶顯示面板110包括：下基板和上基板的兩個基板，以及在兩個基板之間的空間內注入液晶形成的一液晶層。在下玻璃基板上，具有複數條閘極線GL1至GLn、複數條資料線DL1至Dlm、以及複數個薄膜電晶體TFT，其中，每一條閘極線與每一條資料線彼此相交，並且各用於驅動液晶單元Clc的薄膜電晶體TFT形成在閘極線GL和資料線DL相交的位置。響應於一掃描脈衝，所述薄膜電晶體TFT將資料線DL1至DLm的資料供應至液晶單元Clc。在這個情形中，薄膜電晶體TFT的一閘極電極連接至閘極線GL1至GLn，而源極電極連接至資料線DL1至DLm，以及其汲極電極連接至：液晶單元Clc的一像素電極、與一儲存電容器Cst。
所述薄膜電晶體TFT導通，以響應於經由複數條閘極線GL1至GLn中相對應閘極線而供應至其閘極電極之掃描脈衝。當薄膜電晶體TFT導通時候，此連接至薄膜電晶體TFT的汲極電極的相對應資料線的視頻資料被供應至液晶單元Clc的像素電極。
所述資料驅動器120將資料供應至資料線DL1至DLm上，以響應於由計時控制器140所供應之資料驅動控制信號DDC。而且，所述資料驅動器120將由計時控制器140所供應之數位資料(RGB資料或者RGBW資料)取樣與鎖定，並將取樣與鎖定的資料轉換為類比資料電壓，以參考由灰階參考電壓產生器(圖中未示)所供應灰階參考電壓，以顯示在液晶顯示面 板110的液晶顯示單元Clc中之灰階，並將類比資料電壓提供至資料線DL1至DLm。
所述閘極驅動器130依序產生掃描脈衝，這即是，閘極脈衝響應於從計時控制器140提供的一閘極驅動控制信號GDC和一閘極位移時脈GSC，並將產生的掃描脈衝供應至閘極線GL1至GLn。在此時，所述閘極驅動器130根據：自閘極驅動電壓產生器(圖中未示)提供的一閘極高電壓VGH、與一閘極低電壓VGL，確定各掃描脈衝的高位準電壓或者低位準電壓。所述閘極驅動器電壓產生器(圖中未示)接收一高電位電源電壓VDD，產生所述閘極高電壓VGH和所述閘極低電壓VGL，並將產生的閘極高電壓VGH和閘極低電壓VGL供應至閘極驅動器130。在此時，所述閘極驅動電壓產生高於包含在液晶顯示面板110的每個像素中薄膜電晶體TFT的一臨界電壓的閘極高電壓VGH，產生低於薄膜電晶體TFT的一臨界電壓的一閘極低電壓VGL，且將所產生閘極高電壓VGH和閘極低電壓VGL供應至閘極驅動器130。
而且，一反相器(圖中未示)將在反相器內產生的一方波信號轉換為一三角波信號，將三角波信號與供應至系統的一D.C.電源電壓VCC比較，因而產生與比較結果成比例的一叢發調降信號。當依據在反相器內產生的方波信號以確定產生叢發調降信號時，此用於控制在反相器中A.C.電壓和電流產生之驅動IC(圖中未示)、根據叢發調降信號控制供應至一背光元件(圖中未示)的A.C.電壓和電流之產生。
所述計時控制器140將自系統供應的數位資料(RGB資料或者RGBW資料)供應至資料驅動器120。而且，所述計時控制器140使用水平與垂直同步信號H和V、根據一時脈信號CLK，以產生閘極驅動控制信號GDC和資料驅動控制信號DDC，並將資料驅動控制信號DDC和閘極驅動控制信號GDC分別提供至資料驅動器120和閘極驅動器130。
在此時，所述資料驅動控制信號DDC包括：一源極位移時脈SSC、一源極啟動脈衝SSP、一極性控制信號POL、一源極輸出致能信號SOE。所述閘極驅動控制信號GDC包括：一閘極啟動脈衝GSP、一閘極位移時脈GSC、以及一閘極輸出致能GOE。
所述放電驅動器150藉由接收D.C.電源電壓VCC，而產生高電位電源電壓VDD，並藉由泵出所述高電位電源電壓VDD，而產生具有與掃描脈衝相同高位準之閘極高電壓VGH。然後，所述放電驅動器150偵測所施加D.C.電源電壓VCC的位準，並將閘極低電壓VGL和閘極高電壓VGH根據偵測到的電壓位準輸出至放電電路160。這即是，所述放電驅動器150控制放電電路160，以致於該放電電路160在電源電壓VCC施加於液晶顯示裝置100之正常驅動期間，並不實施各像素的放電，並且當停止電源電壓VCC供應時，放電電路160在一恒定時間期間從各像素實施剩餘電荷放電過程。
所述放電電路160包含第一至第n放電部分160-1至160-n，其輸入側共同連接至放電線DCL，並且其輸出側與閘極線GL1至GLn一對一對應連接。這即是，設置在第一水平線處的第一放電部分160-1的輸出側連接至第一閘極線GL1，而設置在最後水平線處的第n放電部分160-n的輸出側連接至最後的閘極線GLn。
當供應至液晶顯示裝置100上的D.C.電源電壓位準VCC下降至預設參考電壓位準之下時，所述第一至第n的放電部分160-1至160-n接收：具有與來自放電驅動器150的掃描脈衝的高位準對應的位準的閘極高電壓VGH，因而自液晶顯示面板110的每個像素中釋放出剩餘電荷。這即是，若自放電驅動器150供應的閘極高電壓VGH，在資料電壓並未供應至資料線DL1至DLm上的期間內，所述第一至第n放電部分160-1至160-n將閘極高電壓VGH供應至所連接相對應閘極線。因此，各像素的薄膜電晶體導通，以致於各像素的剩餘電荷藉由資料線DL1至DLm放電。
各第一至第n放電部分160-1至160-n設有相同結構的兩個薄膜電晶體TFT，其連接介於放電線DCL和相對應閘極線GL之間。例如，第一至第n放電部分160-1至160-n的電路結構分別連接至：第一閘極線GL1至最後閘極線GLn，如同以下說明。
所述第一放電部分160-1包括：串聯介於之放電線DCL和閘極線GL1之間之薄膜電晶體TFT1-1和TFT1-2。所述薄膜電晶體TFT1-1提供有：連接至放電線DCL之閘極電極和汲極電極；以及共同連接至閘極線GL1與薄膜電晶體TFT1-2汲極之源極。所述薄膜電晶體TFT1-2提供有與放電線DCL 連接的閘極和源極，以及共同連接至閘極線GL1和薄膜電晶體TFT1-1的源極之汲極。在此時，所述閘極線GL1連接至一輸出節點N1，其設置在薄膜電晶體TFT1-1的源極和薄膜電晶體TFT1-2的汲極之間。
若放電驅動器150藉由放電線DCL供應低於0V的閘極低電壓VGL，則所述薄膜電晶體TFT1-1和TFT1-2切斷，以致於所述第一放電部分160-1並不將電壓供應至閘極線GL1。在這個情形中，剩餘電荷不從連接至閘極線GL1之像素釋出。
若所述放電驅動器150藉由放電線DCL供應閘極高電壓VGH，則所述薄膜電晶體TFT1-1和TFT1-2導通，以致於所述第一放電部分160-1藉由將閘極高電壓VGH供應至閘極線GL1，而從連接至閘極線GL1的像素釋放剩餘電荷。在此時，連接至閘極線GL1的像素的薄膜電晶體TFT，藉由供應至第一放電部分160-1的閘極高電壓VGH而導通，因而將像素的剩餘電荷供應至資料線DL。
所述第n放電部分160-n包括：串聯介於放電線DCL和閘極線GLN之間之薄膜電晶體TFTn-1與TFTn-2。所述薄膜電晶體TFTn-1提供有：與放電線DCL連接的閘極電極和汲極電極，以及與閘極線GLn以及薄膜電晶體TFTn-2之汲極共同連接之源極。所述薄膜電晶體TFTn-2提供有與放電線DCL連接的閘極和源極，以及與閘極線GL1以及薄膜電晶體TFTn-1的源極共同連接之汲極。在此時，所述閘極線GL1連接至一輸出節點Nn，其設置在薄膜電晶體TFTn-1的源極和薄膜電晶體TFTn-2的汲極之間。
若放電驅動器150藉由放電線DCL供應低於0V的閘極低電壓VGH，則所述薄膜電晶體TFT1-1和TFT1-2切斷，以致於所述第n放電部分160-n並不將電壓供應至閘極線GLn。在這個情形下，剩餘電荷不從連接至閘極線GLn之像素釋出。
若所述放電驅動器150藉由放電線DCL供應閘極高電壓VGH，則所述薄膜電晶體TFTn-1和TFTn-2導通，以致於所述第n放電部分160-n藉由將閘極高電壓VGH供應至閘極線GLn、自連接至閘極線GLn的像素釋放剩餘電荷。在此時，連接至閘極線GLn的像素的薄膜電晶體TFT，藉由供應至第n個放電部分160-n的閘極高電壓VGH而導通，因而將像素的剩 餘電荷供應至資料線DL。
第3圖說明在第2圖中所顯示放電驅動器的一實施例。
參考第3圖，所述放電驅動器150包括：一電壓產生單元151，以第一泵單元152，一第二泵單元153，一電壓偵測單元154，一反相器155，一位準位移器156，以及一延遲裝置157。在此時，電壓產生單元151以對其所施加之D.C.電源電壓VCC，產生高電位電源電壓VDD。所述第一泵單元152第一次從電壓產生單元151輸出泵送高電位電源電壓VDD。所述第二泵單元153藉由將從第一泵單元152第一次抽取之高電位電源電壓VDD第二次泵送，而產生高位電壓VGH。所述電壓偵測單元154偵測到施加的D.C.電源電壓VCC的位準，並根據偵測到的D.C.電源電壓VCC的位準，輸出位準與電源電壓(VCC)的位準對應的低電壓(0V)或者高電壓VCC。而且，所述反相器155將自電壓偵測單元154輸出的高電壓VCC或者低電壓(0V)反相，並輸出高電壓VCC或者低電壓(0V)。所述位準位移器156將自反相器155輸出的低電壓(0V)的位準進行位移，並將閘極低電壓VGL輸出至放電電路160。而且，所述位準位移器156將自反相器155輸出的高電壓VCC的位準位移，並將閘極高電壓VGH輸出至放電電路160所述延遲裝置157在一預定時間期間，保持此從位準位移器156供應至放電電路160的閘極高電壓VGH。
所述電壓產生單元151接收D.C.電源電壓VCC，產生高電位電源電壓VDD，並將所產生的高電位電源電壓VDD輸出至第一泵單元152。在此時，所述高電位電源電壓VDD為供應至液晶顯示面板110上的電壓之間的最大值，其中，所述高電位電源電壓VDD大於電源電壓VCC。
所述第一泵單元152第一次抽取自電壓產生單元151輸出的高電位電源電壓VDD，因而將第一次抽取的高電位電源電壓VDD輸出至第二泵單元153。而且，所述第二泵單元153第二次將第一次抽取至第一泵單元152內的高電位電源電壓VDD進行抽取，並將位準與掃描脈衝的高位準一樣的閘極高電壓VGH輸出至位準位移器156。
所述電壓偵測單元154偵測到此供應至液晶顯示裝置100的D.C.電源電壓VCC的位準，並將偵測到的D.C.電源電壓VCC的位準與一預設參考 電壓位準比較，因而根據比對結果，將具有電源電壓VCC位準之高電壓VCC或者低電壓(0V)輸出至反相器155。如同於第4圖中所示，若偵測到的電壓的位準高於預設參考電壓位準Vref，則電壓偵測單元154將具有電源電壓VCC位準之高電壓VCC輸出至反相器155，因而防止剩餘電荷自每個像素釋出。
若偵測到的電壓的位準低於預設參考電壓位準Vref，所述電壓偵測單元154將低電壓(0V)輸出至反相器155，因而自每個像素釋放剩餘電荷。這即是，如同於第4圖中所示，所述電壓偵測單元154偵測電源電壓VCC開始下降的點，在電源電壓VCC下降到低於預設參考電壓位準Vref的點處，開始將每個像素放電，並對每個像素放電一放電期間Tdc。
若所述自電壓偵測單元154輸入高電壓VCC，則所述反相器155將高電壓VCC的位準反相，並將低電壓(0V)輸出至位準位移器156。同時，若所述低電壓自電壓偵測單元154輸入，則反相器155將低電壓(0V)的位準反相，並將高電壓VCC輸出至位準位移器156。
若所述自反相器155輸入低電壓(0V)，則位準位移元器156將低電壓(0V)的位準位移至低於0V的位準，並將大約-5V的閘極低電壓VGL藉由放電線DCL輸出至放電電路160。在此時，包含在放電電路160內的薄膜電晶體TFT藉由來自位準位移器156的閘極低電壓VGL切斷，因而防止每個像素放電。
若所述自反相器155輸入高電壓VCC，則位準位移元器156將高電壓VCC的位準位移至來自第二泵單元153的閘極高電壓VGH的位準，並將具有與掃描脈衝相同位準之閘極高電壓VGH經由放電線DCL輸出至放電電路160。在此時，包含在放電電路160中的薄膜電晶體TFT藉由來自位準位移器156的閘極高電壓VGH導通，因而實施每個像素釋放剩餘電荷。
所述延遲裝置157由第二泵單元153的輸入和輸出側之間的一個低容量電容器Cd構成。所述低容量電容器Cd在放電期間Tdc保持自位準位移器156供應至放電電路160的閘極高電壓VGH。
如同於第5圖中所示，延遲裝置157的電容器Cd可以連接至第一泵單元152的輸入和輸出側之間。
此根據本發明的液晶顯示裝置揭示包含一個電容器Cd的延遲裝置157，但是並不受限於此。另一方面，所述延遲裝置157可以設有至少兩個並聯或串聯之電容器。
因此，一個電容器可以連接在第一泵單元152的兩個側面之間，或者可以連接在第二泵單元153的兩個側面之間，因而在放電期間內保持供應至放電電路160上的閘極高電壓VGH。因此，此根據本發明之液晶顯示裝置允許：降低製造成本、簡化電路結構、且改善空間效率。
如同上述，本此根據本發明之液晶顯示裝置及其驅動方法具有以下優點。
本此根據本發明之液晶顯示裝置將延遲裝置數目最小化、而在一預定時間期間，保持從位準位移器供應至放電電路的閘極高電壓VGH。因此，此根據本發明之液晶顯示裝置允許：降低製造成本、簡化電路結構、且改善空間效率。
對於熟習此技術人士為明顯，可以對本發明作各種修正與變化，而不會偏離本發明之精神與範圍。因此，其用意為本發明包括：在所附申請專利範圍與其等同物之範圍中所提供本發明之修正與變化。
100‧‧‧液晶顯示裝置
110‧‧‧液晶顯示面板
120‧‧‧資料驅動器
130‧‧‧閘極驅動器
140‧‧‧計時控制器
150‧‧‧放電驅動器
151‧‧‧電壓產生單元
152‧‧‧第一泵單元
153‧‧‧第二泵單元
154‧‧‧電壓偵測單元
155‧‧‧反相器
156‧‧‧位準位移器
157‧‧‧延遲裝置
160‧‧‧放電電路
160-1‧‧‧第一放電部分
160-n‧‧‧第n放電部分
第1圖為說明根據習知技術液晶顯示裝置各像素之等效電路圖；第2圖說明根據本發明較佳實施例之液晶顯示裝置；第3圖說明為第2圖中所顯示放電驅動器之實施例；第4圖說明此供應至第2圖中所示液晶顯示裝置電源電壓的特性；以及第5圖說明為第2圖中所顯示放電驅動器之另一實施例。
100‧‧‧液晶顯示裝置
110‧‧‧液晶顯示面板
120‧‧‧資料驅動器
130‧‧‧閘極驅動器
140‧‧‧計時控制器
150‧‧‧放電驅動器
160‧‧‧放電電路
160－1‧‧‧第一放電部分
160－n‧‧‧第n放電部分

Claims (14)

  1. 一種液晶顯示裝置，包括：一第一泵單元，用於第一次抽取所施加之高電位電源電壓；一第二泵單元，用於藉由將在第一泵單元中第一次抽取的高電位電源電壓作第二次抽取，以產生一閘極高電壓；一位準位移器，用於將一輸入高電壓的位準位移至對應於來自第二泵單元閘極高電壓之位準，且將閘極高電壓供應至一放電電路，其中該放電電路包含複數個放電部分，每一放電部分包括串聯之一第一薄膜電晶體和一第二薄膜電晶體，其中該第一薄膜電晶體提供有連接至一放電線之一第一閘極和一第一汲極，以及共同連接至一閘極線與該第二薄膜電晶體的一第二汲極之一第一源極；以及該第二薄膜電晶體提供有與該放電線連接的一第二閘極和一第二源極，以及共同連接至該閘極線和該第一薄膜電晶體的該第一源極之該第二汲極；以及一延遲裝置，連接介於第二泵單元的輸入側和輸出側之間，用於將此由位準位移器輸出的閘極高電壓保持預設時間期間。
  2. 如申請專利範圍第1項所述之液晶顯示裝置，其中該延遲裝置由在第二泵單元的輸入側和輸出側之間連接的至少一個電容器組成。
  3. 如申請專利範圍第2項所述之液晶顯示裝置，其中至少一個電容器對應一低容量電容器。
  4. 如申請專利範圍第2項之液晶顯示裝置，其中該等電容器並聯或串聯。
  5. 如申請專利範圍第3項所述之液晶顯示裝置，其中該等電容器並聯或串聯。
  6. 一種液晶顯示裝置，包括：一第一泵單元，用於第一次抽取施加的一高電位電源電壓；一第二泵單元，用於藉由第二次抽取在第一泵單元內第一次抽取的高電位電源電壓，以產生一閘極高電壓；一位準位移器，用於將一輸入高電壓的位準位移至對應於第二泵單元閘極高電壓的位準，且將閘極高電壓供應至一放電電路，其中該放電電路包含複數個放電部分，每一放電部分包括串聯之一第一薄膜電晶體和一第二薄膜電晶體，其中該第一薄膜電晶體提供有連接至一放電線之一第一閘極和一第一汲極，以及共同連接至一閘極線與該第二薄膜電晶體的一第二汲極之一第一源極；以及該第二薄膜電晶體提供有與該放電線連接的一第二閘極和一第二源極，以及共同連接至該閘極線和該第一薄膜電晶體的該第一源極之該第二汲極；以及一延遲裝置，連接介於第一泵單元的輸入側和輸出側之間，用於將由位準位移器輸出的閘極高電壓保持一預設時間期間。
  7. 如申請專利範圍第6項所述之液晶顯示裝置，其中該延遲裝置由連接介於第一泵單元的輸入側和輸出側之間之至少一個電容器所構成。
  8. 如申請專利範圍第7項所述之液晶顯示裝置，其中至少一個電容器對應一低容量電容器。
  9. 如申請專利範圍第7項所述之液晶顯示裝置，其中該等電容器並聯或串聯。
  10. 如申請專利範圍第8項所述之液晶顯示裝置，其中該等電容器並聯或串聯。
  11. 一種驅動液晶顯示裝置之方法，包括：藉由一第一泵單元第一次抽取一高電位電源電壓；藉由一第二泵單元第二次抽取在第一泵單元中第一次所抽取的高電位電源電壓，以產生一閘極高電壓；若一低電壓輸入至位準位移元器，則藉由一位準位移器將一閘極低電壓供應至一放電電路；若高電壓輸入至位準位移元器，則藉由位準位移器將高電壓位移成第二泵單元中所產生閘極高電壓之位準，並將閘極高電壓供應至該放電電路，其中該放電電路包含複數個放電部分，每一放電部分包括串聯之一第一薄膜電晶體和一第二薄膜電晶體，其中該第一薄膜電晶體提供有連接至一放電線之一第一閘極和一第一汲極，以及共同連接至一閘極線與該第二薄膜電晶體的一第二汲極之一第一源極；以及該第二薄膜電晶體提供有與該放電線連接的一第二閘極和一第二源極，以及共同連接至該閘極線和該第一薄膜電晶體的該第一源極之該第二汲極；以及藉由連接在第二泵單元的輸入側和輸出側之間之延遲裝置，將由位準位移器輸出的閘極高電壓保持一預設時間期間。
  12. 如申請專利範圍第11項所述之方法，其中該延遲裝置由連接介於第二泵單元的輸入側和輸出側之間之至少一個電容組成。
  13. 一種驅動液晶顯示裝置之方法，包括：藉由一第一泵單元第一次抽取一高電位電源電壓；藉由一第二泵單元第二次抽取此在第一泵單元中第一次所抽取的高電位電源電壓，以產生一閘極高電壓；若一低電壓輸入至位準位移元器，則藉由一位準位移器將一閘極低電壓供應至一放電電路； 若高電壓輸入至位準位移元器，則藉由位準位移器將高電壓位移成第二泵單元中產生的閘極高電壓之位準，並將閘極高電壓供應至該放電電路，其中該放電電路包含複數個放電部分，每一放電部分包括串聯之一第一薄膜電晶體和一第二薄膜電晶體，其中該第一薄膜電晶體提供有連接至一放電線之一第一閘極和一第一汲極，以及共同連接至一閘極線與該第二薄膜電晶體的一第二汲極之一第一源極；以及該第二薄膜電晶體提供有與該放電線連接的一第二閘極和一第二源極，以及共同連接至該閘極線和該第一薄膜電晶體的該第一源極之該第二汲極；以及藉由連接介於第一泵單元的輸入側和輸出側之間之延遲裝置，將從位準位移器輸出的閘極高電壓保持一預設時間期間。
  14. 如申請專利範圍第13項所述之方法，其中該延遲裝置由連接介於第一泵單元的輸入側和輸出側之間之至少一個電容器所構成。
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