TWI420296B - 具有待機組態的電子裝置及其操作方法 - Google Patents

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Description

具有待機組態的電子裝置及其操作方法
本發明係為一種具有待機組態的電子裝置及其操作方法，尤其是有關於一種具有兩組不同特色的待機模組的電子裝置及其操作方法。
在現代用電設備中，在環境保護的前提下，省電的要求日益增加。元件正常工作與待機時的功耗與效率往往能決定電池使用時間的長短，所以會在設計上使用不同的工作或待機組態來針對系統需求減少功耗。例如無線網路的應用時會有所謂的靜音模式(Quiet Mode)、睡眠模式(Sleep Mode)、電源關閉(Power down Mode)、版卡失能(Card Disable)、射頻關閉(Radio off)等等設定。而待機組態如何能夠有效的節省非必要性的用電，成為目前值得研究的課題。
一般待機功能組態設定的方式有：
(一)　由內建或外部軟體驅動處理器進行待機功能組態的設定，即由系統先行設定觸發待機功能組態的條件，當條件滿足時即由外部軟體或內部軔體進行待機功能組態的設定。但是不管使用軟體或軔體均須保留其運作所需要的處理器，而這些處理器本身即已耗掉大量的功耗，並不經濟。
(二)　由外部腳位觸發，由特定硬體進行待機功能組態的設定，即由特定硬體進行待機功能組態的設定。然而，特定硬體只能進行有限度而且固定的組態設定，不同的待機組態必須使用不同的外部腳位來觸發，但在晶片面積日漸縮小外部腳位變少的趨勢下，使用太多的腳位來設定這些待機功能變成一種不經濟的作法。
緣此，本案之發明人係研究出一種具有待機組態的電子裝置及其操作方法，尤其是有關於一種具有兩組不同特色的待機模組的電子裝置及其操作方法，其係可改善習知技術中待機模式所需功耗太大或腳位太多之問題。
本發明的目的在於，提供一種裝置或方法，可於降低待機模組所需功耗的同時，減少待機模組所需的腳位。
本發明係揭示一種具有待機組態的電子裝置，其包含：一第一電路，包含一介面，用以與一外部裝置傳輸資料；一第二電路，包含一處理器，用以設定該第一電路的一第一供電組態；以及一第三電路，用以設定該第二電路的一第二電路供電組態，及在該第二電路失能時用以設定該第一電路的一第二供電組態；其中在該第二電路失能前，該處理器在複數組第一電路之供電組態中選出一第一電路供電組態以做為該第二供電組態。
本發明亦係揭示一種設定一電子裝置之待機狀態的方法，該方法包括以下步驟：供應電源至該電子裝置；提供複數組該電子裝置之供電組態；該電子裝置之一處理器自該複數組供電組態中，根據該電子裝置的狀態，選擇一第二供電組態；以及關閉該處理器的電源。
為使　貴審查委員對於本發明之結構目的和功效有更進一步之了解與認同，茲配合圖示範例詳細說明如後。
圖一為根據本發明之一態樣之一種具有待機組態的電子裝置10，其具有：一第一電路101，其包含一介面106，用以與一外部裝置10a傳輸資料；一第二電路102，用以設定第一電路101的供電組態，其包含一處理器107；以及一第三電路103，用以設定該第二電路的供電組態，及在第二電路102失能時用以設定該第一電路101的供電組態。根據本發明之一實施例，其可根據電子裝置10當時之狀況，例如第一電路101與第二電路102的使用情形或外部指令，自複數組供電組態中選出一適當的供電組態或待機組態，並據以設定外部腳位(未圖示)之觸發條件以及功能，或自複數組觸發條件中選出一適當的觸發條件以做為外部腳位的觸發條件。。其中該外部腳位例如可為一多功能輸入輸出腳位(GPIO)。然後，關閉處理器的電源，如此而可達更加省電之目的，且由外部腳位觸發之特定硬體的待機組態或供電組態的觸發條件設定可以不為固定，而可以由處理器根據其關閉前的狀況加以選定，而達單一腳位可選用多種觸發條件的功效，而達節省腳位之功效。
較佳的，該電子裝置10為一系統單晶片。
較佳的，一第一電路101進一步包含一物理層104及一媒體存取控制器105。
較佳的，第二電路102進一步包含一與處理器107協同運作的記憶體108，並進一步包含一第一暫存器109，用以儲存第一電路101的供電組態。
較佳的，第三電路103進一步包含一第二暫存器110，用以儲存第一電路101及第二電路101的供電組態。
圖二A~E進一步顯示當具有待機組態的電子裝置10為一無線網路卡時，電子裝置10的供電組態可包括但不限於以下幾種態樣：圖二A為正常操作模式，第一電路101及其中的介面106、第二電路102、第三電路103皆進入工作模式，即第二電路102設定第一電路101的供電模式為正常工作。此時亦可由或軔體或軟體來驅動處理器107以進行待機功能組態或供電組態的設定而改變第一電路101的工作狀態。
圖二B為射頻關閉(Radio Off)模式，此時關閉第一電路101中之物理層104及媒體存取控制器105的電源，而第二電路102及第一電路101中的介面106、第三電路103仍進入工作模式，且第二電路102可於接獲外部裝置10a而來的指示立刻打開(turn on)第一電路101中的電源。也就是說，由軔體或軟體來驅動處理器107以進行待機功能組態的設定，即第一暫存器109由電子裝置10先行設定觸發待機功能組態的條件，當條件滿足時即由軔體或軟體來驅動處理器107以進行待機功能組態或供電組態的設定。
圖二C為版卡失能(Card Disable)模式，此時關閉第一電路101中之物理層104及媒體存取控制器105的電源，本發明亦關閉第二電路102的電源，亦即將處理器107的電源關閉，但介面106進入低耗能模式(如SUS/L3)、第三電路103維持工作模式，且在第二電路102的電源關閉前第二電路102會設定第三電路101的第二暫存器110，亦即在第二電路102的電源關閉前，處理器107會根據電子裝置10當時之狀況，例如各電路的使用情形並預估接下來可能會發生的動作以自複數組供電組態中選出一適當的供電組態，以做為電子裝置10(或第一電路101)的供電組態。而此時例如外部裝置10a可透過介面106傳送特定之外部指令以使處理器107重新啟動電源、或進行特定的資料傳輸。
圖二D為外部腳位觸發模式，此時關閉第一電路101、第二電路102的電源，但第三電路103維持工作模式，其中第三電路101由外部腳位觸發，由特定硬體進行待機功能組態或供電組態的設定。但在第二電路102的電源關閉前處理器107會先設定好第三電路101的第二暫存器110，亦即在第二電路102的電源關閉前，處理器107會根據電子裝置10當時之狀況，自複數組供電組態中選出一適當的供電組態，以據以設定外部腳位(未圖示)的待機組態之觸發條件以及功能，或自複數組觸發條件中選出一適當的觸發條件以做為外部腳位的觸發條件。
圖二E為電源關閉(Power Down Mode)，此時關閉第一電路101、第二電路102及其中的介面106、第三電路103中的電源。
圖三揭示本發明之方法流程圖，其係關於一種設定一電子裝置之待機狀態的方法，該方法包括以下步驟：
s301：供應電源至該電子裝置；
s302：提供複數組該電子裝置之供電組態；
s303：該電子裝置之一處理器自該複數組供電組態中，根據該電子裝置的狀態，選擇一第二供電組態；以及
s304：關閉該處理器的電源。
較佳地，在圖三的方法中，於選擇該第二供電組態之步驟更包含根據該第二供電組態來設定一外部腳位之觸發條件，且該電子裝置更包含一介面106及一第三電路103，其中當該介面的電源亦為關閉時，該第三電路103根據該外部腳位之觸發，來啟動該第二供電組態。
較佳地，該電子裝置包含一介面，該介面在該處理器的電源關閉之狀態下，根據該第二供電組態而運作。
較佳地，在圖三的方法中，其步驟更包含該電子裝置之一第三電路根據該第二供電組態來設定該電子裝置的供電組態，且該第三電路另包含一第二暫存器，用以儲存該第二供電組態。
唯以上所述者，僅為本發明之範例實施態樣爾，當不能以之限定本發明所實施之範圍。即大凡依本發明申請專利範圍所作之均等變化與修飾，皆應仍屬於本發明專利涵蓋之範圍內，謹請　貴審查委員明鑑，並祈惠准，是所至禱。
10．．．電子裝置
10a．．．外部裝置
101．．．第一電路
102．．．第二電路
103．．．第三電路
104．．．物理層
105．．．媒體存取控制器
106．．．介面
107．．．處理器
108．．．記憶體
109．．．第一暫存器
110．．．第二暫存器
301~304．．．步驟
圖一係為本發明之一種具有待機組態的電子裝置示意圖；
圖二A~E本發明之電子裝置待機組態示意圖；
圖三係為用於本發明之待機組態方法流程圖。
10．．．電子裝置
10a．．．外部裝置
101．．．第一電路
102．．．第二電路
103．．．第三電路
104．．．物理層
105．．．媒體存取控制器
106．．．介面
107．．．處理器
108．．．記憶體
109．．．第一暫存器
110．．．第二暫存器

Claims (13)

  1. 一種具有待機組態的電子裝置，其包含：一第一電路，包含一介面，用以與一外部裝置傳輸資料；一第二電路，包含一處理器，用以設定該第一電路的一第一供電組態；以及一第三電路，用以設定該第二電路的一第二電路供電組態，及在該第二電路失能時用以設定該第一電路的一第二供電組態；其中在該第二電路失能前，該處理器在複數組第一電路之供電組態中選出一第一電路供電組態以做為該第二供電組態。
  2. 如申請專利範圍第1項之電子裝置，其中該第三電路根據該第二供電組態來設定一外部腳位之觸發條件。
  3. 如申請專利範圍第2項之電子裝置，其中當該第一電路及該第二電路失能時，該第三電路根據該外部腳位觸發，來啟動該第二供電組態。
  4. 如申請專利範圍第1項之電子裝置，其中該第三電路根據該第二電路供電組態來設定一外部腳位之觸發條件。
  5. 如申請專利範圍第4項之電子裝置，其中當該第一電路及該第二電路失能時，該第三電路根據該外部腳位觸發，來啟動該第二電路供電組態。
  6. 如申請專利範圍第1項之電子裝置，其中該第一電路另包含一物理層及一媒體存取控制器，其中當該物理層、該媒體存取控制器、及該第二電路的電源關閉時，該介面根 據該第二供電組態而運作。
  7. 一種設定一電子裝置之待機狀態的方法，該方法包含以下步驟：供應電源至該電子裝置；提供複數組該電子裝置之供電組態；該電子裝置之一處理器自該複數組供電組態中，根據該電子裝置的狀態，選擇一第二供電組態；以及關閉該處理器的電源；其中該電子裝置包含：一第一電路，包含一介面，用以與一外部裝置傳輸資料；一第二電路，包含一處理器，用以設定該第一電路的一第一供電組態；以及一第三電路，用以設定該第二電路的一第二電路供電組態，及在該第二電路失能時用以設定該第一電路的一第二供電組態；其中在該第二電路失能前，該處理器在複數組第一電路之供電組態中選出一第一電路供電組態以做為該第二供電組態。
  8. 如申請專利範圍第7項之方法，於選擇該第二供電組態之步驟更包含：根據該第二供電組態來設定一外部腳位之觸發條件。
  9. 如申請專利範圍第8項之方法，其中該電子裝置更包含一介面及該第三電路，其中當該介面的電源亦為關閉時，該第三電路根據該外部腳位之觸發，來啟動該第二供電組 態。
  10. 如申請專利範圍第7項之方法，更包含以下步驟：該電子裝置之該第三電路根據該第二供電組態來設定該電子裝置的供電組態。
  11. 如申請專利範圍第7項之方法，其中該電子裝置包含一介面，該介面在該處理器的電源關閉之狀態下，根據該第二供電組態而運作。
  12. 一種設定一電子裝置之待機狀態的方法，該方法包含以下步驟：供應電源至該電子裝置；提供該電子裝置複數組待機組態觸發條件；該電子裝置之一處理器自該複數組待機組態觸發條件中，根據該電子裝置的狀態，選擇一外部腳位之一第二觸發條件；以及關閉該處理器的電源；其中該電子裝置包含：一第一電路，包含一介面，用以與一外部裝置傳輸資料；一第二電路，包含一處理器，用以設定該第一電路的一第一供電組態；以及一第三電路，用以設定該第二電路的一第二電路供電組態，及在該第二電路失能時用以設定該第一電路的一第二供電組態；其中在該第二電路失能前，該處理器在複數組第一電路之供電組態中選出一第一電路供電組態以做 為該第二供電組態。
  13. 如申請專利範圍第12項之方法，更包含以下步驟：其中當該外部腳位之該第二觸發條件發生，該電子裝置之該第三電路啟動該處理器。
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