TWI220233B - Video graphics adapter structure sharing a scaling circuit - Google Patents

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1220233 五、發明說明（1) 發明所屬之技術領域 本發明係關於一種視訊繪圖卡（VGA )結構，其特別係 關於一種共用縮放電路的視訊繪圖卡結構。 先前技術 第一圖顯示習知視訊繪圖卡（VGA)的結構圖。習知視 訊繪圖卡10主要包括有二維/三維（2D/3D)處理引擎101以 及解壓縮處理引擎1 0 3，通常在解壓縮處理引擎1 0 3内部線 路即具備有縮放（scaling)電路103a，而這個縮放電路 1 0 3 a主要處要解壓縮後的視訊資料的縮放功能，並無法對 二維/三維處理引擎1 0 1提供任何的助益，因此當二維/三 維處理引擎1 0 1發生有縮放處理的需求時，則必須在二維/ 三維處理引擎1 0 1内部另外再設置一個縮放電路，如此才 能滿足二維/三維處理引擎1 0 1對縮放處理的需求，然而此 另增新的縮放電路的解決方式，雖然可以解決問題，但換 來的成本代價實在過於高昂。 本發明發明人有鑑於上述習知技藝的缺失，乃積極改 良以解決習知技藝的缺點，而發明出一種改良上述習知技 藝的結構來予以變更，使得本發明的視訊繪圖卡能夠在不 損失視訊繪圖卡既有功能以及不影響實際效能的前提下， 以精簡化的結構來實現。 發明内容 本發明主要目的係提供一種不損失視訊繪圖卡既有功
第5頁 1220233 五、發明說明（2) 能以及不影響實際效能的前提下，以精簡化的結構來實現 視訊繪圖卡。 為達成本發明上述的目的，本發明提供一種視訊繪圖 卡（VGA)結構，包括：二維/三維（2D/3D)處理引擎，用於處 理輸入之繪圖/文書（Grapgic/Text)資料；解壓縮處理引 擎，用於解壓縮處理輸入之視訊壓縮資料；其特徵在於： 共用於2D/3D處理引擎與解壓縮處理引擎的縮放（scanng) 電路，用於接收2 D / 3 D處理引擎處理後的資料以及解壓縮 處理引擎處理後的資料。 為使熟悉該項技藝人士瞭解本發明之目的、特徵及功 效，茲藉由下述具體實施例，並配合所附之圖式，對本發 明詳加說明，說明如后： 實施方式 第二圖顯示本發明視訊繪圖卡的結構圖。本發明的視 訊繪圖卡（V G A ) 2 0主要包括有如下所述，二維/三維 (2D/3D)處理引擎201，用於處理輸入之繪圖/文書 (Grapgic/Text)資料201a。解壓縮處理引擎2 0 3，用於解 壓縮處理輸入之視訊壓縮資料2 0 3a。共用於2D/3D處理引 擎201與解壓縮處理引擎2 0 3的縮放（seal ing)電路2 0 5，用 於接收2D/3D處理引擎201處理後的資料20 lb以及解壓縮處 理引擎2 0 3處理後的資料203b。本發明最主要的特徵乃在 於縮放電路2 0 5係被二維/三維處理引擎2 0 1以及解壓縮處 理引擎2 0 3所共用，據此，解壓縮處理引擎2 0 3内部本身不
第6頁 1220233 五、發明說明（3) 須另具備有額外的縮放電路，其直接就可以利用縮放電路 2 0 5，同時，二維/三維處理引擎2 0 1若有須進一步處理縮 放功能時，亦直接交由縮放電路2 0 5處理即可。依據本發 明所實施的視訊繪圖卡2 0，二維/三維處理引擎2 0 1以及解 壓縮處理引擎2 0 3其内部線路設計不再各自設置專屬的縮 放電路，完全以共用的縮放電路2 0 5來提供縮放功能。 本發明的視訊繪圖卡（VGA) 20可以進一步包括多工器 2 0 7，其中多工器2 0 7的輸入端2 0 7 a分別連接2 D / 3 D處理引 擎2 0 1的輸出端與解壓縮處理引擎2 0 3的輸出端，多工器 2 0 7的輸出端20 7b連接縮放電路2 0 3的輸入端。據此，本發 明的視訊繪圖卡（V G A ) 2 0以多工處理方式，讓縮放電路 2 0 3以多工進行來自二維/三維處理引擎2 0 1以及解壓縮處 理引擎2 0 3的縮放處理要求。 本發明視訊繪圖卡（VGA) 20所具有的二維/三維處理 引擎2 0 1、二維/三維處理引擎2 0 1、放電路2 0 3以及多工器 2 0 7等，其各自的具體實施手段，皆可以直接使用習知VGA 技藝。 本發明上述的視訊壓縮資料2 0 3 a在具體態樣係為 MPEG1視訊壓縮資料、一 MPEG2視訊壓縮資料、MPEG4視訊 壓縮資料等其中一個。而繪圖/文書資料2 0 1 a在具體態樣 係為來自一遊戲（Game)應用程式所產生的資料，或者是係 為來自遊戲（Game )應用程式所產生的資料’又或者是係為 來自一使用微軟（M i c r 〇 s 〇 f t)公司的D i r e c t X所編寫的應用 程式所產生的資料，又或者是係為來自文書處理應用程式
1220233 五、發明說明（4) 所產生的資料，又或者是係為來自一圖像處理應用程式所 產生的資料。 本發明的視訊繪圖卡2 0由於共用縮放電路2 0 3的主要 特徵，明顯地能夠讓視訊繪圖卡2 0在不損失任何功能外以 及不影響實際效能下，更容易達成精簡化所有線路的複雜 度，大大降低晶片的gate count，進而具有省電的效以及 降低製造成本的具體表現。 熟習本技術者須了解可在本發明的精神及觀點内對本 發明進行多種不同的修改。而本發明係涵蓋由申請專利範 圍及其對等之涵意的觀點内任何的修改及變更。 1220233 圖式簡單說明 第一圖顯示習知視訊繪圖卡（VGA)的結構圖。 第二圖顯示本發明視訊繪圖卡的結構圖。
圖號編號說明 10 習知視訊繪圖卡 101 二維/三維（2D/3D)處理引 擎 103 解壓縮引擎 103a 縮放（sea 1 i ng)電路 20 視訊繪圖卡 201 二維/三維（2D/3D)處理引 擎 201a 資料 201b 資料 203 解壓縮處理引擎 2 0 3a 資料 2 0 3b ^ 資料 205 縮放（sea 1 i ng)電路 207 多工器 2 0 7a 輸入端 2 0 7b 輸出端

Claims (1)

1220233 六、申請專利範圍 i·—種視訊繪圖卡（VGA)結構，包括： 一二維/三維（2 D / 3 D )處理引擎，用於處理輸入之繪圖 文書（Grapgic/Text)資料； + 解壓縮處理彳丨擎，用於解壓縮處理輸入之視訊 貧料； 其特徵在於：一共用於該2D/3D處理引擎與該解壓縮 ς，引擎的縮放（seal ing)電路，用於接收該2D/3D處理引 ，處理後的資料以及該解壓縮處理引擎處理後的資料。 ·=申請專利範圍第1項所述之VGA結構，進一步包括一多 ^ = i其中该多工态的輸入端分別連接該2D/3D處理引擎 端 =解壓縮處理引擎的輸出#，該多工器的輸出 知連接该細放seal ing電路的輸出端。 專==1項所述之VGA結構，其中該視訊壓縮 貝U為一 Μ二EG1，讯壓縮資料、_ MpEG2視訊壓縮資料、 一 MPEG4視訊壓細資料等其中一個。 1 tX所編寫的應用程式所產生 im: ΐ: ϊ!項所述之vga結才冓，其中該繪圖/文 m圍i?(Game)應用程式所產生的資料。 書資料係為來自一遊戲員構，其中該ΐ圖/文 6·如申請專利範圍第i項所述之'，私式所產生的貝料。 書資料係為來自一使用、 GA結構，其中該繪圖/文 的資料。 7.如申請專利範圍第1項所述夕^ 書資㈣為來自1書吉構，其”繪圖/文 曰知理愿用程式所產生的資料。 1220233 六、申請專利範圍 8.如申請專利範圍第1項所述之VGA結構，其中該繪圖/文 書資料係為來自一圖像處理應用程式所產生的資料。
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