TW202320167A - 定向選擇性沉積 - Google Patents

定向選擇性沉積 Download PDF

Info

Publication number
TW202320167A
TW202320167A TW111133518A TW111133518A TW202320167A TW 202320167 A TW202320167 A TW 202320167A TW 111133518 A TW111133518 A TW 111133518A TW 111133518 A TW111133518 A TW 111133518A TW 202320167 A TW202320167 A TW 202320167A
Authority
TW
Taiwan
Prior art keywords
plasma
containing precursor
semiconductor substrate
feature
hydrogen
Prior art date
Application number
TW111133518A
Other languages
English (en)
Inventor
巴加夫S 席特拉
索哈姆 阿斯拉尼
約書亞 拉布尼茨
史林尼法斯D 奈馬尼
怡利 葉
Original Assignee
美商應用材料股份有限公司
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 美商應用材料股份有限公司 filed Critical 美商應用材料股份有限公司
Publication of TW202320167A publication Critical patent/TW202320167A/zh

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/0226Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
    • H01L21/02263Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase
    • H01L21/02271Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition
    • H01L21/02274Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition in the presence of a plasma [PECVD]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J37/00Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
    • H01J37/32Gas-filled discharge tubes
    • H01J37/32009Arrangements for generation of plasma specially adapted for examination or treatment of objects, e.g. plasma sources
    • H01J37/32082Radio frequency generated discharge
    • H01J37/32137Radio frequency generated discharge controlling of the discharge by modulation of energy
    • H01J37/32146Amplitude modulation, includes pulsing
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
    • H01L21/306Chemical or electrical treatment, e.g. electrolytic etching
    • H01L21/3065Plasma etching; Reactive-ion etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • H01L21/311Etching the insulating layers by chemical or physical means
    • H01L21/31105Etching inorganic layers
    • H01L21/31111Etching inorganic layers by chemical means
    • H01L21/31116Etching inorganic layers by chemical means by dry-etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3205Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
    • H01L21/32055Deposition of semiconductive layers, e.g. poly - or amorphous silicon layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3205Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
    • H01L21/321After treatment
    • H01L21/32105Oxidation of silicon-containing layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3205Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
    • H01L21/321After treatment
    • H01L21/3211Nitridation of silicon-containing layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3205Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
    • H01L21/321After treatment
    • H01L21/3213Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
    • H01L21/32133Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only
    • H01L21/32135Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only
    • H01L21/32136Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only using plasmas
    • H01L21/32137Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only using plasmas of silicon-containing layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J2237/00Discharge tubes exposing object to beam, e.g. for analysis treatment, etching, imaging
    • H01J2237/32Processing objects by plasma generation
    • H01J2237/33Processing objects by plasma generation characterised by the type of processing
    • H01J2237/332Coating
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J2237/00Discharge tubes exposing object to beam, e.g. for analysis treatment, etching, imaging
    • H01J2237/32Processing objects by plasma generation
    • H01J2237/33Processing objects by plasma generation characterised by the type of processing
    • H01J2237/334Etching

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Power Engineering (AREA)
  • Chemical & Material Sciences (AREA)
  • Plasma & Fusion (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Analytical Chemistry (AREA)
  • General Chemical & Material Sciences (AREA)
  • Inorganic Chemistry (AREA)
  • Chemical Vapour Deposition (AREA)

Abstract

範例處理方法可包括形成含矽前驅物的電漿。此方法可包括以含矽前驅物的電漿流出物在半導體基板上沉積可流動膜。處理區可至少部分地被界定在面板與基板支撐件之間,半導體基板坐落在基板支撐件上。可從偏壓電源施加偏壓功率至基板支撐件。此方法可包括在半導體處理腔室的處理區內形成含氫前驅物的電漿。此方法可包括以含氫前驅物的電漿流出物從半導體基板內的特徵的側壁蝕刻可流動膜。此方法可包括以含氫前驅物的電漿流出物緻密化界定在半導體基板內的特徵內的剩餘可流動膜。

Description

定向選擇性沉積
本案主張2021年9月8日提出的美國專利申請案第17/469,529號的權益,其全文實際上藉由參照而被併入本文。
本發明關於半導體處理。更明確地,本發明關於沉積、蝕刻及轉換包括可流動膜的材料的方法。
藉由在基板表面上產生複雜地圖案化材料層而得以製造積體電路。在基板上產生圖案化材料要求暴露材料的形成與移除的受控方法。隨著裝置尺寸持續縮減,材料形成會影響後續操作。例如,在間隙填充操作中,材料可被形成或沉積以填充形成在半導體基板上的溝槽或其他特徵。當特徵可以較高的深寬比及減少的臨界尺寸為特徵時,這些填充操作會被挑戰。例如,由於沉積會發生在特徵的頂部處及沿著特徵的側壁,持續的沉積會夾止(pinch off)此特徵,包括在特徵內的側壁之間,及會產生在特徵內的空孔。此會影響裝置效能及後續處理操作。
因此,有著對於可用以產生高品質裝置與結構的改善系統及方法的需求。這些及其他需求藉由本發明所解決。
範例處理方法可包括形成含矽前驅物的電漿。含矽前驅物的電漿可從電漿電源被形成在第一功率位準。此方法可包括以含矽前驅物的電漿流出物在半導體基板上沉積可流動膜。半導體基板可被容納在半導體處理腔室的處理區中。半導體基板可界定在半導體基板內的特徵。處理區可被至少部分地界定在面板與基板支撐件之間,半導體基板坐落在基板支撐件上。偏壓功率可從偏壓電源施加至基板支撐件。此方法可包括在半導體處理腔室的處理區內形成含氫前驅物的電漿。含氫前驅物的電漿可從電漿電源被形成在第二功率位準。偏壓功率可從在第三功率位準的偏壓電源被施加至基板支撐件,第三功率位準大於第二功率位準。此方法可包括以含氫前驅物的電漿流出物從半導體基板內的特徵的側壁蝕刻及/或改質可流動膜。此方法可包括以含氫前驅物的電漿流出物緻密化被界定在半導體基板內的特徵內的剩餘可流動膜。
在一些實施例中,半導體基板內的特徵可以大於或約5:1的深寬比為特徵。此特徵可以跨越此特徵為小於或約10 nm的寬度為特徵。偏壓電源在沉積與蝕刻兩者期間可被操作在脈衝頻率為小於或約1 kHz的脈衝模式。當偏壓電源在蝕刻期間被操作在脈衝模式時,電漿電源可被操作在連續波模式。偏壓電源在沉積與蝕刻兩者期間可被操作在工作週期為小於或約50%。在電漿電源的進行(engagement)之後,偏壓電源可被進行(engaged)。緻密化可包括降低可流動膜的氫含量至小於或約30原子%。此方法可包括在緻密化之後,形成轉換前驅物的電漿。此方法可包括將可流動膜轉換成改質膜。轉換前驅物可包括含氮前驅物、含氧前驅物、或含碳前驅物。此方法可在第二循環中被重複。半導體基板的溫度在此方法期間可被維持在小於或約20 °C的溫度。
本發明的一些實施例可包含處理方法。此方法可包括形成含矽前驅物的電漿。含矽前驅物的電漿可從電漿電源被形成在第一功率位準。此方法可包括以含矽前驅物的電漿流出物在半導體基板上沉積可流動膜。半導體基板可被容納在半導體處理腔室的處理區中。半導體基板可界定在半導體基板內的特徵。偏壓功率可從偏壓電漿被施加至基板支撐件。此方法可包括在半導體處理腔室的處理區內形成含氫前驅物的電漿。含氫前驅物的電漿可被形成在第二功率位準以用於電漿電源。偏壓功率可從偏壓電源被施加至在第三功率位準的含氫前驅物的電漿。此方法可包括以含氫前驅物的電漿流出物從被界定在半導體基板內的特徵的側壁蝕刻可流動膜。此方法可包括以含氫前驅物的電漿流出物緻密化被界定在半導體基板內的特徵內的剩餘可流動膜。
在一些實施例中,當偏壓電源在蝕刻期間被操作在頻率小於或約1 kHz的脈衝模式時,提供第二功率位準的電漿電源可被連續地操作。偏壓電源在沉積與蝕刻的各者期間可被操作在工作週期為小於或約25%。此蝕刻可從在特徵的基底填充之上的特徵的側壁完全地移除可流動膜。此方法可包括在緻密化之後,形成轉換前驅物的電漿。此方法可包括將可流動膜轉換成改質膜。轉換前驅物可包括含氮前驅物、含氧前驅物、或含碳前驅物。改質膜可為或包括氮化矽、氧化矽、或碳化矽。
本發明的一些實施例可包含處理方法。此方法可包括利用脈衝來源功率與脈衝偏壓功率形成含矽前驅物的電漿。此方法可包括以含矽前驅物的電漿流出物在半導體基板上沉積可流動膜。半導體基板可被容納在半導體處理腔室的處理區中。半導體基板界定在半導體基板內的特徵。此方法可包括利用脈衝來源功率與脈衝偏壓功率在半導體處理腔室的處理區內形成含氫前驅物的電漿。此方法可包括以含氫前驅物的電漿流出物從被界定在半導體基板內的特徵的側壁蝕刻可流動膜。此方法可包括以含氫前驅物的電漿流出物緻密化被界定在半導體基板內的特徵內的剩餘可流動膜。此方法可包括形成轉換前驅物的電漿。此方法可包括將可流動膜轉換成改質膜。在一些實施例中,改質膜可為或包括矽及氮、氧、或碳中的一者或多者。
本發明可提供相較於習知系統與技術的許多益處。例如,藉由在沉積期間執行處理,在特徵內來自底部所產生的材料的品質可改善,其會與來自在側壁上的材料的品質有所差異。此外,藉由執行根據本發明的實施例的蝕刻操作,相對於較高品質的經處理材料,側壁覆蓋會被選擇性蝕刻。這些與其他實施例及它們的許多優點與特徵結合之後說明書與隨附圖示而被更加詳細地說明。
非晶矽可被使用在半導體裝置製造中用於若干結構與處理,包括作為犧牲材料,例如作為假性閘極材料,或作為溝槽填充材料。在間隙填充操作中,一些處理可利用在處理條件下形成的可流動膜以限制沉積的保角性,其會容許沉積的材料較佳地填充基板上的特徵。可流動矽材料可藉由相對大量的氫為特徵,及可相較於所形成膜為較不緻密。因此,可執行後續處理操作以固化所產生膜。習知技術可利用UV固化處理以移除氫及處理此膜。然而,UV固化會造成顯著的膜收縮,其會致使特徵上的應力及在結構內產生空孔。
隨著特徵尺寸持續縮減,可流動膜對於狹窄特徵會受挑戰,狹窄特徵會進一步以較高的深寬比為特徵。例如,由於在特徵的側壁上的沉積,特徵的夾捏(pinching)會更易於發生,小特徵尺寸中的夾捏會進一步限制流動進一步進入此特徵,及會產生空孔。此外,對於可執行非晶矽的轉換的處理,在轉換期間的側壁材料的膨脹會進一步限制進入在特徵內。本發明藉由執行形成在特徵中的材料的定向處理,定向處理可不被執行在沉積在側壁上的材料上,而可克服這些限制。此外,本發明在固化操作期間可執行所形成膜的選擇性蝕刻及/或改質,選擇性蝕刻及/或改質能夠移除側壁上的較低品質材料,同時維持特徵內的較緻密材料。此可限制或防止在溝槽填充期間的側壁覆蓋,容許改善的填充操作被執行。此外,轉換操作可在固化之後被執行,轉換操作可進一步降低特徵內的流動限制。在敘述根據本發明的一些實施例的腔室(之後所論述的電漿處理操作可在其中執行)的一般態樣之後,可論述特定方法。將理解到本發明不意於受限於所論述的特定膜、腔室、或處理,由於所述的技術可被用以改善若干膜形成處理,及可被應用於各種處理腔室與操作。
第1圖顯示根據本發明的一些實施例之範例處理腔室100的剖面視圖。此圖示可繪示併入本發明的一或多個態樣的系統的概觀,及/或可執行根據本發明的實施例的一或多個沉積或其他處理操作的系統。腔室100或所執行方法的額外細節可在之後進一步說明。腔室100可被利用以根據本發明的一些實施例形成膜層,然而將理解到此方法可被類似地執行在其中可發生膜形成的任何腔室中。處理腔室100可包括腔室主體102、安置在腔室主體102之內的基板支撐件104、及與腔室主體102耦接且將基板支撐件104封閉在處理容積120中的蓋組件106。基板103可被提供穿過開口126至處理容積120,開口126可習知地使用狹縫閥或門被密封以用於處理。基板103在處理期間可坐落在基板支撐件的表面105上。基板支撐件104可為可旋轉的,如藉由箭頭145所示,沿著軸147,基板支撐件104的軸件144可位於軸147。或者,基板支撐件104在沉積處理期間如必要的可被舉升以旋轉。
電漿輪廓調變器111可安置在處理腔室100中以控制遍佈安置在基板支撐件104上的基板103的電漿分佈。電漿輪廓調變器111可包括安置鄰接於腔室主體102的第一電極108,及可將腔室主體102與蓋組件106的其他部件分開。第一電極108可為蓋組件106的部分,或可為分開的側壁電極。第一電極108可為環形或圓環狀構件,及可為圓環電極。第一電極108可為在圍繞處理容積120的處理腔室100的圓周的周圍的連續迴路,或若期望地可為在選定位置處不連續。第一電極108也可為穿孔電極,諸如穿孔圓環或網狀電極,或可為板狀電極,諸如,例如,第二氣體分配器。
一或多個隔離器110a、110b(其可為介電材料,諸如陶瓷或金屬氧化物,例如氧化鋁及/或氮化鋁)可接觸第一電極108及將第一電極108從氣體分配器112及從腔室主體102電氣地分開及熱地分開。氣體分配器112可界定孔洞118,用於將處理前驅物分配進入處理容積120。氣體分配器112可與第一來源電源142耦接,諸如RF產生器、RF電源、DC電源、脈衝DC電源、脈衝RF電源、或可與處理腔室耦接的任何其他電源。在一些實施例中,第一來源電源142可為RF電源。
氣體分配器112可為導電氣體分配器或非導電氣體分配器。氣體分配器112也可由導電與非導電部件所形成。例如,氣體分配器112的主體可為導電的,而氣體分配器112的面板可為非導電的。氣體分配器112可被供電,諸如藉由第一來源電源142,如第1圖所示,或氣體分配器112在一些實施例中可與接地耦接。
第一電極108可與第一調諧電路128耦接,第一調諧電路128可控制處理腔室100的接地路徑。第一調諧電路128可包括第一電子感測器130與第一電子控制器134。第一電子控制器134可為或包括可變電容器或其他電路元件。第一調諧電路128可為或包括一或多個電感器132。第一調諧電路128可為使得在處理期間的存在於處理容積120中的電漿條件下的能夠可變阻抗或可控制阻抗的任何電路。在如圖示的一些實施例中,第一調諧電路128可包括在接地與第一電子感測器130之間被並聯耦接的第一電路分支與第二電路分支。第一電路分支可包括第一電感器132A。第二電路分支可包括第二電感器132B,其與第一電子控制器134串聯耦接。第二電感器132B可安置在第一電子控制器134與一節點之間,此節點將第一與第二電路分支兩者連接至第一電子感測器130。第一電子感測器130可為電壓或電流感測器及可與第一電子控制器134耦接,其可提供在處理容積120之內的電漿條件的一程度的封閉迴路控制。
第二電極122可與基板支撐件104耦接。第二電極122可嵌入在基板支撐件104之內或與基板支撐件104的表面耦接。第二電極122可為一板、穿孔板、一網、線網、或導電元件的任何其他分散佈置。第二電極122可為調諧電極,及可藉由導線146與第二調諧電路136耦接,導線146例如為具有選定電阻(諸如50Ω)的電纜,例如被安置在基板支撐件104的軸件144中。第二調諧電路136可具有第二電子感測器138與第二電子控制器140,其可為第二可變電容器。第二電子感測器138可為電壓或電流感測器,及可與第二電子控制器140耦接以提供進一步控制在處理容積120中的電漿條件。
第三電極124(其可為偏壓電極及/或靜電吸附電極)可與基板支撐件104耦接。第三電極可透過濾波器148與第二來源電源150耦接,濾波器148可為阻抗匹配電路。第二來源電源150可為DC電源、脈衝DC電源、RF偏壓電源、脈衝RF電源或偏壓電源、或這些電源的組合或其他電源。在一些實施例中,第二來源電源150可為RF偏壓電源。
第1圖的蓋組件106與基板支撐件104可被使用於用於電漿或熱處理的任何處理腔室。在操作中,處理腔室100可提供在處理容積120中的電漿條件的實時控制。基板103可安置在基板支撐件104上,及處理氣體根據任何所期望的流動計畫可使用入口114被流動穿過蓋組件106。入口114可包括來自遠端電漿源單元116的遞送,遠端電漿源單元116可與腔室流體地耦接,及在一些實施例中的旁通117用於可不流動穿過遠端電漿源單元116的處理氣體遞送。氣體可穿過出口152離開處理腔室100。電源可與氣體分配器112耦接以在處理容積120中建立電漿。在一些實施例中,基板可經受使用第三電極124的電氣偏壓。
當在處理容積120中賦能一電漿時,在電漿與第一電極108之間可建立電位差。電位差也可被建立在電漿與第二電極122之間。電子控制器134、140可接著被使用以調整藉由兩個調諧電路128與136所代表的接地路徑的流動性質。一設定點可被傳遞至第一調諧電路128與第二調諧電路136以提供獨立控制沉積速率及從中心至邊緣的電漿密度均勻性。在電子控制器可皆為可變電容器的實施例中,電子感測器可調整可變電容器,以獨立地最大化沉積速率及最小化厚度不均勻性。
調諧電路128、136的每一者可具有可變阻抗,可使用個別的電子控制器134、140調整可變阻抗。當電子控制器134、140為可變電容器,可變電容器的每一者的電容範圍及第一電感器132A與第二電感器132B的電感可被選擇以提供阻抗範圍。此範圍可取決於電漿的頻率及電壓特性,其可具有最小值在各可變電容器的電容範圍中。因此,當第一電子控制器134的電容是在最小值或最大值時,第一調諧電路128的阻抗會是高的,造成具有在基板支撐件上方的最小的空中或側向覆蓋的電漿形狀。當第一電子控制器134的電容接近最小化第一調諧電路128的阻抗的數值時,電漿的空中覆蓋會成長至最大值,有效地覆蓋基板支撐件104的整個工作區域。當第一電子控制器134的電容偏離最小阻抗設定時,電漿形狀會從腔室壁縮減及基板支撐件的空中覆蓋會減少。第二電子控制器140可具有類似效果,當第二電子控制器140的電容可被改變時,增加或減少基板支撐件上方的電漿的空中覆蓋。
電子感測器130、138可被使用以調諧封閉迴圈中的個別電路128、136。取決於所使用的感測器的類型,用於電流或電壓的設定點可被安裝在每個感測器中,及感測器可被提供帶有控制軟體,控制軟體決定對每個個別電子控制器134、140的調整,以最小化與此設定點的偏離。因此,電漿形狀在處理期間可被選定及被動態地控制。將理解到儘管前方論述係基於電子控制器134、140(其可為可變電容器),具有可調整特性的任何電子部件可被使用以提供帶有可調整阻抗的調諧電路128與136。
處理腔室100在本發明的一些實施例中可被利用於可包括用於半導體結構的形成、處理、蝕刻、或轉換的處理方法。將理解到所說明的腔室不會被當作限制,及可經設置以執行所說明的操作的任何腔室可被類似地使用。第2圖顯示根據本發明的一些實施例的處理方法200中的範例操作。此方法可被執行在各種處理腔室中及在一或多種主框架或工具上,包括上述的處理腔室100。方法200可包括若干任選的操作,其可為或可不為與根據本發明的方法的一些實施例明確地相關聯。例如,許多的操作被說明以提供結構形成的更廣範疇,但對於本發明並非關鍵的,或可藉由將會是更易於理解的替代方法來執行。方法200可敘述第3A-3C中圖解顯示的操作,這些繪圖將連結方法200的操作來敘述。將理解到圖示僅繪示部分圖解視圖,及基板可含有任何數目的額外材料和具有各種特性及態樣的特徵,如圖示中所繪示。
方法200可包括在所列出的操作的起始之前的額外操作。例如,額外處理操作可包括在半導體基板上形成結構,其可包括形成及移除材料兩者。例如,可形成電晶體結構、記憶體結構、或任何其他結構。前處理操作可被執行在可執行方法200的腔室中,或在遞送基板進入可執行方法200的半導體處理腔室或多個腔室之前,處理可執行在一或多個其他處理腔室中。無論如何,方法200可任選地包括遞送半導體基板至半導體處理腔室的處理區,諸如上述的處理腔室100,或可包括上述的部件的其他腔室。基板可被沉積在基板支撐件上,基板支撐件可為諸如基板支撐件104的台座,及可留駐在腔室的處理區中,諸如上述的處理容積120。
其上已經執行數個操作的基板可為結構300的基板305,結構300可顯示出其上可執行半導體處理的基板的部分視圖。將理解到結構300可僅顯示在處理期間的少數頂部層以繪示本發明的態樣。基板305可包括其中可形成一或多個特徵310的材料。基板305可為使用在半導體處理中的任意數目的材料。基板材料可為或包括矽、鍺、包括氧化矽或氮化矽的介電材料、金屬材料、或這些材料的任何數目的組合,其可為基板305,或形成在結構300中的材料。特徵310可以根據本發明的任何形狀或組態為特徵。在一些實施例中,特徵可為或包括形成在基板305內的溝槽結構或孔洞。
雖然特徵310可以任何形狀或尺寸為特徵,在一些實施例中,特徵310可以較高的深寬比、或特徵的深度對於跨越特徵的寬度的比例為特徵。例如,在一些實施例中,特徵310可以大於或約5:1的深寬比為特徵,及可以深寬比大於或約10:1、大於或約15:1、大於或約20:1、大於或約25:1、大於或約30:1、大於或約40:1、大於或約50:1、或更大為特徵。此外,特徵可以跨越包括兩個側壁之間的特徵的狹窄的寬度或直徑為特徵,諸如尺寸小於或約20 nm,及可以跨越此特徵的寬度為小於或約15 nm、小於或約12 nm、小於或約10 nm、小於或約9 nm、小於或約8 nm、小於或約7 nm、小於或約6 nm、小於或約5 nm、或更小為特徵。
在一些實施例中,方法200可包括任選的處理操作,諸如預處理,其可被執行以製備用於沉積的基板305的表面。一旦製備好,方法200可包括遞送一或多種前驅物至容納結構300的半導體處理腔室的處理區。前驅物可包括一或多種含矽前驅物,及一或多種稀釋劑或載氣,諸如與含矽前驅物被遞送的惰性氣體或其他氣體。電漿可由包括含矽前驅物的沉積前驅物在操作205形成。電漿可形成在處理區內,其可容許沉積材料沉積在基板上。例如,在一些實施例中,藉由如先前所述的施加電漿功率至面板,電容耦合電漿可形成在處理區內。
含矽材料可在操作210從含矽前驅物的電漿流出物被沉積在基板上。此材料在一些實施例中可為可流動含矽材料,其可為或包括非晶矽。經沉積材料可至少部分地流動進入在基板上的特徵中以提供由下而上類型的間隙填充。如第3A圖所繪示,材料315可沉積在基板305上,及可流動進入溝槽或特徵310中。如圖示,經沉積材料315可流動進入特徵的底部中,雖然一數量的材料會保留在基板的側壁上如被繪示為材料317,及在特徵的頂部上或之間的被繪示為材料319。雖然被沉積的數量可為相對小的,在側壁上的保留材料會限制後續流動。此外,若執行經沉積材料的習知轉換,諸如轉換成例如氮化矽,此轉換會涉及膜的膨脹。對於經縮減尺寸的特徵,形成在側壁上的殘留材料會被轉換及朝著相對的側壁向外膨脹。此會致使特徵被夾止(pinched off),其會在特徵內形成空孔。
在沉積期間所施加的功率可為較低功率電漿,其可限制解離,及其可維持在經沉積材料中的氫併入的數量。此經併入氫可貢獻被沉積材料的可流動性。此外,不同於習知技術,本發明可併入偏壓處理,其可產生對於在沉積操作期間的經沉積膜的處理。此處理可包括利用來源功率,諸如如先前所敘述的與面板或噴淋頭耦接,及利用偏壓功率,諸如如上方所論述的被施加穿過基板支撐件。此來源功率可用以執行含矽前驅物的受控解離,其可限制解離及容許較長的材料鏈被形成。當這些材料接觸基板時,較長鏈的含矽材料可具有增加的可流動性,其可改善由下而上填充。
此來源功率可被脈衝,及工作週期可被降低,其在一些實施例中可進一步降低有效電漿功率。例如,此來源功率可施加在任何較高頻率,諸如大於或約10 MHz、大於或約13 MHz、大於或約15 MHz、大於或約20 MHz、或更高。電漿電源可遞送電漿功率至面板為小於或約300 W,及可遞送功率為小於或約250 W、小於或約200 W、小於或約150 W、小於或約100 W、小於或約50 W、或更小。此外,此來源功率可被脈衝在脈衝頻率為20 kHz或更小,諸如小於或約15 kHz、小於或約12 kHz、小於或約10 kHz、小於或約8 kHz、或更小。此外,脈衝工作週期可被施加在小於或約50%,及可被施加在小於或約40%、小於或約30%、小於或約20%、小於或約10%、小於或約5%、小於或約1%或更小。此可限制矽前驅物解離,及改善長鏈形成。
在一些實施例中,為了促進解離與沉積,沉積前驅物可包括一或多種惰性氣體,諸如氬及/或氦,其可助於改善解離。此外,在一些實施例中,沉積前驅物可包括雙原子氫,其可被流動以促進在沉積期間的處理製程,及其可被偏壓功率提供所協助。例如,氫可與含矽前驅物被遞送,以氫對於含矽前驅物的流率比例為大於或約0.5:1,及可被遞送於流率比例為大於或約1:1、大於或約1.5:1、大於或約2:1、大於或約2.5:1、大於或約3.0:1、大於或約3.5:1、大於或約4.0:1、或更大。
氫也可在所產生的電漿中被解離,及可藉由利用偏壓功率遞送而被進一步活化。例如,在一些實施例中,偏壓電源可被操作在相較於來源功率更低的頻率,及可被操作在小於或約10 MHz、小於或約5 MHz、小於或約2 MHz、或更小。此電源可被操作在功率為小於或約500 W,及可被操作在小於或約450 W、小於或約400 W、小於或約350 W、或更小。偏壓功率可創造流出物移動的一數量的指向性,及可容許較輕的氫自由基進一步解離氬及/或氦,其可被更加具體地被向下引導於此結構。此較低頻率功率也可賦予額外能量於離子,離子以更加直線路徑向下行進至此基板。
這些氫與惰性氣體自由基物種可沿著與行進方向正交的表面傳送能量至材料,諸如沿著特徵的底部及沿著特徵的頂部的材料,諸如材料315與319。此能量可助於釋放過量氫,其可緻密化在這此位置中的膜。如第3B圖所示,雖然沿著側壁的材料317可不被影響,或可具有受限的改變,然而材料315與319可被緻密化,其可改善材料的品質。因此,在一些實施例中,沿著結構的頂部與底部的材料可以較高的品質為特徵,其可包括相較於會已經沿著特徵的側壁所沉積材料之增加的密度。
然而,藉由利用偏壓功率,沉積電漿可以增加的功率為特徵,其會進一步解離含矽前驅物及降低可流動性。因此,為了限制此效應,偏壓功率也可被脈衝在脈衝頻率為小於或約10 kHz,及可被脈衝在頻率為小於或約5 kHz、小於或約1 kHz、小於或約500 Hz、小於或約100 Hz、小於或約50 Hz、小於或約10 Hz、或更小。此外,工作週期可被操作在小於或約50%,及可被操作在小於或約40%、小於或約30%、小於或約20%、小於或約10%、小於或約5%、或約1%,其可進一步降低偏壓功率的影響。藉由將偏壓功率操作在非常低的脈衝頻率與工作週期,偏壓功率可被利用以增加在特徵的頂部處與在特徵的底部處的膜品質,同時限制對於任何其他沉積特性的影響。此外,藉由利用低功率,氫可不會被充足地賦能而致使蝕刻經沉積材料,或導致基於惰性氣體流出物的衝擊之材料的濺射。
在一數量的沉積之後,在本發明的一些實施例中,可執行蝕刻及/或改質處理,其被設置以選擇性回蝕形成的材料及改質剩餘材料。此處理可被執行在與沉積相同的腔室中,及可以循環處理來執行以填充此特徵。在一些實施例中,含矽前驅物流動可被停止及處理區可被淨化。諸如氬及/或氦的惰性氣體的流動也可被停止。在淨化之後,含氫前驅物可被流入處理腔室的處理區中。在一些實施例中,改質處理可僅包括含氫前驅物,其在一些實施例中可為雙原子氫。改質電漿可形成在操作215,其也可為形成在處理區內的電容耦合電漿,然而在一些實施例中可類似地應用電感耦合電漿。
類似於沉積處理,在蝕刻操作期間,額外的電源可被採用及如先前所述的與基板支撐件耦合以提供偏壓於產生在基板之上的電漿。因此,蝕刻處理也可包括來源功率與偏壓功率兩者。此可拉引電漿流出物至基板,其可衝擊此膜及致使經沉積材料的緻密化,特別是已經藉由在沉積期間所執行的處理而被至少部分地改善的材料。雖然可使用任何的含氫材料,在一些實施例中,雙原子氫可被用於作為含氫前驅物以產生蝕刻電漿。氫自由基與離子可輕易地滲透形成在溝槽內的材料,及可從此膜釋放被併入的氫而致使緻密化。所施加的偏壓功率可為相對低的以限制所產生膜的濺射,及以限制對於結構的任何潛在損害。此外,藉由調整施加的來源功率與偏壓功率,可執行蝕刻操作,其可降低經沉積材料的側壁覆蓋,同時限制對於先前經處理材料的效應。
藉由從電漿電源遞送功率至面板,雙原子氫或任何其他含氫材料可被利用以在處理區內產生電漿。此電漿功率在一些實施例中可大於在沉積期間所使用的電漿功率,兩者皆來自來源功率與偏壓功率。例如,所遞送的電漿來源功率可大於或約100 W,及可大於或約200 W、大於或約300 W、大於或約400 W、大於或約500 W、或更大。藉由增加在處理電漿形成期間的電漿功率,可產生更大量的電漿流出物。然而,隨著電漿功率增加,從結構的底部被蝕刻的材料的數量也會增加。因此,在一些實施例中,電漿來源功率可維持在小於或約500 W,及可維持在小於或約400 W、小於或約300 W、或更小。此外,也可調整偏壓功率的態樣。例如,在一些處理操作中,偏壓功率可高於電漿來源功率,其可提供足夠功率至電漿以確保較低品質材料的蝕刻的發生,諸如在沉積操作期間不會被處理的沿著側壁的材料。
施加較大的偏壓功率可增加氫對於蝕刻經沉積材料的能力。雖然在沉積期間的偏壓功率可被降低以限制蝕刻效應,在改質操作期間,可在上述的任何頻率下的偏壓功率可被增加至大於或約500 W,及可被增加至大於或約800 W、大於或約1000 W、大於或約1200 W、大於或約1400 W、大於或約1600 W、大於或約1800 W、或更大。然而,因為偏壓功率可賦予指向性,偏壓功率可如下方所論述的被脈衝,其可提供較低品質材料的蝕刻,同時維持先前處理的材料,及其可改質及/或緻密化此材料。電漿流出物可接著在操作220蝕刻可流動膜,及可從溝槽的側壁移除可流動膜。同時地及有益地,被更加指向性遞送的電漿流出物可滲透形成在特徵的底部處的剩餘膜,及在任選的操作225可降低氫併入以緻密化此膜。如第3C圖所示,材料317可從基板305的側壁及懸伸區被移除,其可維持在特徵的底部區及沿著結構的頂部區的經沉積材料。作為添加的益處,在結構的頂部的經緻密材料319藉由限制在材料上任何影響也可保護下方材料免於損害。此處理也可提供在剩餘材料中的降低的氫併入,諸如氫併入為小於或約40原子%,及可提供降低的氫併入為小於或約35原子%、小於或約30原子%、小於或約25原子%、小於或約20原子%、小於或約15原子%、小於或約10原子%、小於或約5原子%、或更小。
可進行額外的調整以藉由調整所施加的電漿功率或偏壓功率的一或多種特性,進一步增加蝕刻沿著特徵的側壁的經沉積材料。例如,在一些實施例中,電漿電源與偏壓電源兩者可被操作在連續波模式。此外,此等電源的一者或兩者可被操作在脈衝模式。在一些實施例中,來源功率可被操作在連續波模式,而偏壓功率被操作在脈衝模式。偏壓功率的脈衝頻率可為先前所論述的任何脈衝頻率。偏壓功率的工作週期可小於或約75%,及偏壓功率可被操作在工作週期為小於或約70%、小於或約60%、小於或約50%、小於或約40%、小於或約30%、小於或約20%、小於或約10%、小於或約5%、或更小。藉由操作偏壓功率持續降低的工作週期,諸如開機時間週期小於或約50%,各循環的較大量的時間可在特徵內執行更等向性蝕刻,諸如在關機時間期間,其可較佳地從側壁移除材料。
額外的功率組態也可包括來源功率與偏壓功率為主從關係的一數量的同步。例如,此兩個電源可被操作在脈衝定向,及偏壓功率可被同步以在每個脈衝的來源功率已經被進行之後而進行偏壓功率。也可應用層級至層級(level-to-level)脈衝方案。例如,在偏壓功率的工作期間,來源功率可被操作在第一電漿功率。在此循環的偏壓功率被關閉的剩餘期間,來源功率可被操作在第二電漿功率,其可大於第一電漿功率。此可藉由移除偏壓誘發的指向性而增加等向性蝕刻及也可增加等向蝕刻的蝕刻特性兩者。在本發明的實施例中,沉積與蝕刻處理在循環中可被重複任何次數以填充特徵,其可以非晶矽填充特徵。
此外,在一些實施例中,其中矽可被尋找以在特徵中被轉換,此循環也可包括轉換操作。藉由在蝕刻循環期間的轉換,穿過特徵的滲透問題可被完全地解決。又,藉由在固化及蝕刻/改質之後執行轉換操作,經沉積材料可在轉換之前從側壁被移除,其可限制如先前所述在溝槽內或側壁之間的特徵的橫向膜膨脹。此轉換可被執行在與沉積和處理不同的腔室中,然而,在一些實施例中,兩個或更多個操作,包括所有的操作,可被執行在單一處理腔室內。此相較於習知製程可降低等候時間。
方法200也可任選地包括將非晶矽轉換至另一種材料。例如,在蝕刻與緻密化之後,一或多種轉換前驅物可被遞送至腔室的處理區。例如,含氮前驅物、含氧前驅物、及/或含碳前驅物可被遞送至腔室的處理區,伴隨任何載氣或稀釋氣體。電漿可由轉換前驅物所形成,其可接著接觸特徵內的非晶矽材料。在任選的操作230,轉換前驅物的電漿流出物可與溝槽內的非晶矽材料交互作用,及將材料轉換成氮化矽、氧化矽、碳化矽、氮氧化矽、碳氧化矽、矽碳氮化物、或氧碳氮化矽,伴隨可被用以轉換非晶矽膜的任何其他材料。電漿功率可類似於先前所述的功率,及例如可從約100 W至高達約1,000 W或更高以用於電容耦合系統,及高達10 kW或更高以用於電感耦合系統,然而也可執行任何類型的轉換。
雖然此沉積可被形成至數奈米或更多,藉由執行先前所述的蝕刻處理,緻密化材料的厚度可被控制於厚度為小於或約500 Å,及可小於或約450 Å、小於或約400 Å、小於或約350 Å、小於或約300 Å、小於或約250 Å、小於或約200 Å、小於或約150 Å、小於或約100 Å、小於或約50 Å、或更小。藉由控制經沉積材料的厚度,穿過整個厚度的轉換可被更加輕易地執行,及在習知處理中普遍的滲透問題可被解決。在經沉積材料的轉換之後,此處理接著被完整地重複以繼續產生經轉換材料向上穿過此特徵。
關於在任何的形成操作期間所使用的沉積前驅物,本發明可使用任何數目的前驅物。在任何的矽形成、氧化矽形成、或氮化矽形成的期間可使用的含矽前驅物可包括但不限於矽烷(SiH 4)、二矽烷(Si 2H 6)、三矽烷、或其他有機矽烷,包括環六矽烷、四氟化矽(SiF 4)、四氯化矽(SiCl 4)、二氯矽烷(SiH 2Cl 2)、四乙氧基矽烷(TEOS)、及可使用在含矽膜形成中的任何其他含矽前驅物。藉由利用較高階的矽烷,可產生較長的材料鏈,其在一些實施例中可增加流動性。在一些實施例中,含矽材料可為無氮的、無氧的、及/或無碳的。使用在本發明中所述的任何操作中的含氧前驅物可包括O 2、N 2O、NO 2、O 3、H 2O、及可使用在氧化矽膜形成中或其他膜形成中的任何其他含氧前驅物。使用在任何操作中的含氮前驅物可包括N 2、N 2O、NO 2、NH 3、N 2H 2、及可使用在氮化矽膜形成中的任何其他含氮前驅物。含碳前驅物可為或包括任何含碳材料,諸如任何烴類、或包括碳的任何其他前驅物。在任何操作中,可包括一或多種額外前驅物,諸如惰性前驅物,其可包括Ar、He、Xe、Kr、或其他材料,諸如氮、氨、氫、或其他前驅物。
溫度與壓力也可影響本發明的操作。例如,在一些實施例中,為了促進膜流動,此處理可被執行在溫度低於或約20 °C,及可被執行在溫度小於或約0 °C、小於或約20 °C、小於或約-50 °C、小於或約-75 °C、小於或約-100 °C、或更低。在此方法中,溫度可被維持在任何的這些範圍中,包括在處理及蝕刻期間,及在轉換期間。腔室內的壓力也可保持在相對低的以用於任何的處理,諸如在腔室壓力為小於或約20托,及壓力可維持在小於或約15托、小於或約10托、小於或約5托、小於或約3托、小於或約2托、小於或約1托、小於或約0.1托、或更小。藉由執行根據本發明的一些實施例的處理,可執行利用含矽材料的狹窄特徵的改善填充。
在前面的說明中,為了闡明目的,已說明許多細節以提供理解本發明的各種實施例。然而,在沒有這些細節中的一些細節或帶有額外細節下可實行特定實施例,對於通常知識者是顯而易見的。
已經揭示數個實施例,通常知識者將認知到在不背離實施例的精神下,可使用各種修改、替代架構、及等效物。此外,並未說明若干的周知處理與元件,以避免不必要地混淆本發明。因此,上述說明不應當作限制本發明的範疇。此外,方法或處理可被敘述為依序或成步驟的,但將理解到操作可被同時地執行,或與列表出不同的順序執行。
當提供一數值範圍時,除非上下文明確地另外指明,理解到在範圍的上限值與下限值之間的至下限值的單位的最小部分之每個中介值也被明確地揭示。在敘明範圍中的任何敘明值或未敘明中介值及敘明範圍中的任何其他敘明或中介值之間的任何較窄範圍被涵蓋。彼等較小範圍的上限值與下限值可獨立地在此範圍中被包括或被排除,及受到在敘明範圍中的任何明確排除限值,在較小範圍中任一限值被包括、限值皆不被包括、或限值皆被包括的各範圍也被涵蓋在本發明中。當敘明範圍包括限值的一者或兩者,也包括排除這些被包括限值的任一者或兩者的範圍。
在本文中及隨附申請專利範圍中使用時,除非上下文清楚地另外指明,單數形式的「一(a)」、「一(an)」及「該」包括複數參照物。因此,例如,關於「一前驅物」包括複數個此前驅物,及關於「該層」包括關於一或多個層及通常知識者所知的其等效物,以此類推。
又,字詞「包含(comprise(s))」、「包含(comprising)」、「含有(contain(s))」、「含有(containing)」、「包括(include(s))」、及「包括(including)」當被使用在本說明書及在之後的申請專利範圍中時,旨在指明敘明特徵、整體、部件、或操作的存在,但它們不排除一或多個其他特徵、整體、部件、操作、動作或群組的存在或添加。
100:處理腔室 102:腔室主體 103:基板 104:基板支撐件 105:表面 106:蓋組件 108:第一電極 110a:隔離器 110b:隔離器 111:電漿輪廓調變器 112:氣體分配器 114:入口 116:遠端電漿源單元 117:旁通 118:孔洞 120:處理容積 122:第二電極 124:第三電極 126:開口 128:第一調諧電路 130:第一電子感測器 132A:第一電感器 132B:第二電感器 134:第一電子控制器 136:第二調諧電路 138:第二電子感測器 140:第二電子控制器 142:第一來源電源 144:軸件 145:箭頭 146:導線 147:軸 148:濾波器 150:第二來源電源 152:出口 200:方法 205,210,215,220,225,230:操作 300:結構 305:基板 310:特徵 315:材料 317:材料 319:材料
藉由參照本說明書的剩餘部分及圖式,可實現進一步理解所揭示技術的本質與優點。
第1圖顯示根據本發明的一些實施例的範例處理腔室的圖解剖面視圖。
第2圖顯示根據本發明的一些實施例的處理方法中的範例操作。
第3A-3C圖顯示根據本發明的一些實施例的在處理期間的基板的圖解剖面視圖。
數個圖示被包括作為示意圖。將理解到圖示是用於例示目的,且不被當作按照比例的,除非有明確地敘明為按照比例的。此外,作為示意圖,圖示被提供以助於理解且可不包括與現實代表物相比較之所以態樣或資訊,及可包括誇大的材料以用於例示目的。
在隨附圖示中,類似的部件及/或特徵可具有相同元件符號。再者,相同類型的各種部件可藉由元件符號之後的字母來區別,此字母用以區別類似部件。若在本說明書中僅使用首要元件符號,此說明可應用於具有相同首要元件符號的類似部件的任一者,而與字母無關。
國內寄存資訊(請依寄存機構、日期、號碼順序註記) 無 國外寄存資訊(請依寄存國家、機構、日期、號碼順序註記) 無
200:方法
205,210,215,220,225,230:操作

Claims (20)

  1. 一種處理方法,包含以下步驟: 形成一含矽前驅物的一電漿,其中該含矽前驅物的該電漿從一電漿電源被形成在一第一功率位準; 以該含矽前驅物的電漿流出物在一半導體基板上沉積一可流動膜,其中該半導體基板被容納在一半導體處理腔室的一處理區中,其中該半導體基板界定在該半導體基板內的一特徵,其中該處理區至少部分地被界定在一面板與一基板支撐件之間,該半導體基板坐落在該基板支撐件上,及其中從一偏壓電源施加一偏壓功率至該基板支撐件; 在該半導體處理腔室的該處理區內形成一含氫前驅物的一電漿,其中該含氫前驅物的該電漿從該電漿電源被形成在一第二功率位準,及其中一偏壓功率從該偏壓電源以一第三功率位準被施加至該基板支撐件,該第三功率位準大於該第二功率位準; 以該含氫前驅物的電漿流出物從該半導體基板內的該特徵的一側壁蝕刻該可流動膜;及 以該含氫前驅物的電漿流出物緻密化被界定在該半導體基板內的該特徵內的剩餘可流動膜。
  2. 如請求項1所述之處理方法,其中該半導體基板內的該特徵以大於或約5:1的一深寬比為特徵,及其中該特徵以跨越該特徵為小於或約10 nm的一寬度為特徵。
  3. 如請求項1所述之處理方法,其中在該沉積與該蝕刻兩者期間,該偏壓電源以一脈衝頻率被操作在一脈衝模式,該脈衝頻率為小於或約1 kHz。
  4. 如請求項3所述之處理方法,其中當該偏壓電源在該蝕刻期間被操作在該脈衝模式時,該電漿電源被操作在一連續波模式。
  5. 如請求項3所述之處理方法,其中該偏壓電源在該沉積與該蝕刻兩者期間被操作在一工作週期為小於或約50%。
  6. 如請求項1所述之處理方法,其中在該電漿電源的進行之後,該偏壓電源被進行。
  7. 如請求項1所述之處理方法,其中該緻密化之步驟包含以下步驟:降低該可流動膜的一氫含量至小於或約30原子%。
  8. 如請求項1所述之處理方法,進一步包含以下步驟: 在該緻密化之後,形成一轉換前驅物的一電漿;及 將該可流動膜轉換成一改質膜。
  9. 如請求項8所述之處理方法,其中該轉換前驅物包含一含氮前驅物、一含氧前驅物、或一含碳前驅物。
  10. 如請求項8所述之處理方法,其中該方法在一第二循環中被重複。
  11. 如請求項8所述之處理方法,其中該半導體基板的一溫度在該方法期間被維持在小於或約20 °C的一溫度。
  12. 一種處理方法,包含以下步驟: 形成一含矽前驅物的一電漿,其中該含矽前驅物的該電漿從一電漿電源被形成在一第一功率位準; 以該含矽前驅物的電漿流出物在一半導體基板上沉積一可流動膜,其中該半導體基板被容納在一半導體處理腔室的一處理區中,其中該半導體基板界定在該半導體基板內的一特徵,及其中從一偏壓電源施加一偏壓功率至一基板支撐件; 在該半導體處理腔室的該處理區內形成一含氫前驅物的一電漿,其中該含氫前驅物的該電漿對於該電漿電源被形成在一第二功率位準,及其中一偏壓功率從該偏壓電源以一第三功率位準被施加至該含氫前驅物的該電漿; 以該含氫前驅物的電漿流出物從界定在該半導體基板內的該特徵的一側壁蝕刻該可流動膜;及 以該含氫前驅物的電漿流出物緻密化被界定在該半導體基板內的該特徵內的剩餘可流動膜。
  13. 如請求項12所述之處理方法,其中當該偏壓電源在該蝕刻期間被操作在一頻率為小於或約1 kHz的一脈衝模式時,提供該第二功率位準的該電漿電源被連續地操作。
  14. 如請求項13所述之處理方法,其中該偏壓電源在該沉積與該蝕刻的各者期間被操作在一工作週期為小於或約25%。
  15. 如請求項12所述之處理方法,其中該蝕刻從該特徵的一基底填充之上的該特徵的該側壁完全地移除該可流動膜。
  16. 如請求項12所述之處理方法,進一步包含以下步驟: 在該緻密化之後,形成一轉換前驅物的一電漿;及 將該可流動膜轉換成一改質膜。
  17. 如請求項16所述之處理方法,其中該轉換前驅物包含一含氮前驅物、一含氧前驅物、或一含碳前驅物。
  18. 如請求項17所述之處理方法,其中該改質膜包含氮化矽、氧化矽、或碳化矽。
  19. 一種處理方法,包含以下步驟: 利用一脈衝來源功率與一脈衝偏壓功率形成一含矽前驅物的一電漿; 以該含矽前驅物的電漿流出物在一半導體基板上沉積一可流動膜,其中該半導體基板被容納在一半導體處理腔室的一處理區中,其中該半導體基板界定在該半導體基板內的一特徵; 利用一脈衝來源功率與一脈衝偏壓功率在該半導體處理腔室的該處理區內形成一含氫前驅物的一電漿; 以該含氫前驅物的電漿流出物從被界定在該半導體基板內的該特徵的一側壁蝕刻該可流動膜; 以該含氫前驅物的電漿流出物緻密化被界定在該半導體基板內的該特徵內的剩餘可流動膜; 形成一轉換前驅物的一電漿;及 將該可流動膜轉換成一改質膜。
  20. 如請求項19所述之處理方法,其中該改質膜包含矽及氮、氧、或碳中的一者或多者。
TW111133518A 2021-09-08 2022-09-05 定向選擇性沉積 TW202320167A (zh)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US17/469,529 2021-09-08
US17/469,529 US11862458B2 (en) 2021-09-08 2021-09-08 Directional selective deposition

Publications (1)

Publication Number Publication Date
TW202320167A true TW202320167A (zh) 2023-05-16

Family

ID=85385387

Family Applications (1)

Application Number Title Priority Date Filing Date
TW111133518A TW202320167A (zh) 2021-09-08 2022-09-05 定向選擇性沉積

Country Status (5)

Country Link
US (2) US11862458B2 (zh)
KR (1) KR20240055067A (zh)
CN (1) CN118020141A (zh)
TW (1) TW202320167A (zh)
WO (1) WO2023038837A1 (zh)

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7163896B1 (en) * 2003-12-10 2007-01-16 Novellus Systems, Inc. Biased H2 etch process in deposition-etch-deposition gap fill
JP2011525682A (ja) * 2008-05-14 2011-09-22 アプライド マテリアルズ インコーポレイテッド Rf電力供給のための時間分解チューニングスキームを利用したパルス化プラズマ処理の方法及び装置
US8329587B2 (en) 2009-10-05 2012-12-11 Applied Materials, Inc. Post-planarization densification
US8846536B2 (en) 2012-03-05 2014-09-30 Novellus Systems, Inc. Flowable oxide film with tunable wet etch rate
CN106653675B (zh) 2015-08-28 2020-07-10 中芯国际集成电路制造(北京)有限公司 浅沟槽隔离结构的形成方法
US9997351B2 (en) 2015-12-08 2018-06-12 Varian Semiconductor Equipment Associates, Inc. Apparatus and techniques for filling a cavity using angled ion beam
JP7168586B2 (ja) * 2017-05-13 2022-11-09 アプライド マテリアルズ インコーポレイテッド 高品質のボイド充填法のための流動性堆積及び高密度プラズマ処理工程サイクル
JP7203515B2 (ja) 2017-06-06 2023-01-13 アプライド マテリアルズ インコーポレイテッド 連続した堆積-エッチング-処理方法を使用した酸化ケイ素及び窒化ケイ素のボトムアップ成長

Also Published As

Publication number Publication date
WO2023038837A1 (en) 2023-03-16
US20230377875A1 (en) 2023-11-23
US20230071366A1 (en) 2023-03-09
KR20240055067A (ko) 2024-04-26
US11862458B2 (en) 2024-01-02
CN118020141A (zh) 2024-05-10

Similar Documents

Publication Publication Date Title
TWI794883B (zh) 可流動膜形成及處理
US11939674B2 (en) Methods to reduce material surface roughness
US20220336216A1 (en) Helium-free silicon formation
TW202320167A (zh) 定向選擇性沉積
TW202230445A (zh) 容納寄生電漿形成的半導體處理腔室
US20230386829A1 (en) Low temperature silicon oxide gap fill
US20230360903A1 (en) Large area gapfill using volumetric expansion
TWI790736B (zh) 單腔室流動膜的形成和處理
US20240038527A1 (en) Forming films with improved film quality
TW202412066A (zh) 低溫氧化矽間隙填充
TWI819398B (zh) 拉伸的氮化物沉積系統及方法
US20230051200A1 (en) Seam-free gapfill deposition
TWI809877B (zh) 矽鍺的熱沉積
US11430654B2 (en) Initiation modulation for plasma deposition
US20230360924A1 (en) Low temperature carbon gapfill
TW202410123A (zh) 低溫碳隙填充