TW201906359A - 一種上報緩存狀態報告的方法和設備 - Google Patents

一種上報緩存狀態報告的方法和設備 Download PDF

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Abstract

本發明實施例提供一種上報緩存狀態報告的方法和設備，用以解決現有技術中存在的BSR MAC CE格式無法滿足5G NR需求的問題。本發明實施例中，終端根據有緩存資料量的邏輯通道組生成指示資訊，按照指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於BSR MAC CE中，以及將指示資訊置於BSR MAC CE中。由於能夠通過指示資訊指示BSR MAC CE中緩存資料量資訊對應的邏輯通道組，從而能夠滿足5G NR需求。

Description

一種上報緩存狀態報告的方法和設備
本發明屬於無線通訊技術領域，特別是關於一種上報緩存狀態報告的方法和設備。
在長期演進(Long Term Evolution，LTE)系統中，每個無線承載(Radio Bearer，RB)對應一條邏輯通道，每個邏輯通道需要一個對應的邏輯通道號(Logical Channel ID，LCID)來標識。
媒體存取控制(Media Access Control，MAC)層具有邏輯通道複用功能，將多個邏輯通道的資料組織到一個MAC協定資料單元(Protocol Data Unit，PDU)中，傳給實體層進行發送。
MAC PDU的總體結構如圖1A所示，MAC PDU的結構示意圖中，MAC PDU包括MAC頭(header)、0個或多個MAC業務資料單元(SDU)、0個或多個MAC控制單元(Control Element，CE)和可選的填充(padding)位元。
其中，MAC PDU頭包括一個或多個子頭(sub-header)，每個MAC子頭對應一個MAC SDU、MAC CE或padding。
MAC SDU對應的MAC子頭採用7bit L域如圖1B所示，採 用15bit L域如圖1C所示。
每種MAC子頭包含的域和具體含義各有不同，MAC子頭中常見的域包括：LCID：用於標識MAC SDU的邏輯通道實體或MAC控制單元的類型或padding；E(擴展域)：指示在MAC頭中所在的MAC子頭後面是否有後續域；R(預留位元)：用於後續應用擴展，大小為2bits，由於本發明有些實施例會利用預留位元，所以在用到預留位元的實施例中可以根據需要用不同的名字命名該位元，比如擴展位元等；「F2」和「F」(格式域)：用於聯合指示L域的長度；L(長度指示域)：用於指示MAC SDU或MAC控制單元的長度，單位為byte。
其中，LTE中緩存狀態上報(Buffer Status Report，BSR)MAC CE的格式有兩種：只報一個邏輯通道組(Logical Channel Group，LCG)的BSR MAC CE和上報全部4個邏輯通道組的BSR MAC CE。
在LTE中，邏輯通道佔用的LCID個數不多，由於LCID數量足夠，每出現一種MAC CE，都佔用一個LCID。
在5G新空口(New Radio，NR)引入了多種業務類型，邏輯通道數和邏輯通道組的數量都大大增加，LTE的BSR MAC CE的格式已不適用。
綜上所述，目前BSR MAC CE格式無法滿足5G NR的需求。
本發明實施例提供一種上報緩存狀態報告的方法和設備，用以解決現有技術中存在的BSR MAC CE格式無法滿足5G NR需求的問題。
本發明實施例提供的一種上報緩存狀態報告的方法，該方法包括：終端根據有緩存資料量的邏輯通道組生成指示資訊；終端按照指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於緩存狀態報告媒體存取控制控制單元BSR MAC CE中，以及將指示資訊置於BSR MAC CE中；終端向網路側設備上報緩存狀態報告。
本發明實施例提供的一種上報緩存狀態報告的方法，該方法包括：網路側設備接收終端上報的緩存狀態報告；網路側設備根據緩存狀態報告的指示資訊，確定緩存狀態報告的BSR MAC CE中攜帶緩存資料量的對應的邏輯通道組，其中指示資訊是終端根據有緩存資料量的邏輯通道組生成的。
本發明實施例提供的一種上報緩存狀態報告的終端，該終端包括處理器、收發機和記憶體，其中：處理器，用於通過控制收發機發送和接收資料，並讀取記憶體中的程式，執行下列過程：根據有緩存資料量的邏輯通道組生成指示資訊；按照指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於緩存狀態 報告媒體存取控制控制單元BSR MAC CE中，以及將指示資訊置於BSR MAC CE中；控制收發機向網路側設備上報緩存狀態報告；收發機，用於接收和發送資料。
本發明實施例提供的一種上報緩存狀態報告的網路側設備，該網路側設備包括處理器、收發機和記憶體，其中：處理器，用於通過收發機發送和接收資料，並讀取記憶體中的程式，執行下列過程：控制收發機接收終端上報的緩存狀態報告；根據緩存狀態報告的指示資訊，確定緩存狀態報告的BSR MAC CE中攜帶緩存資料量的對應的邏輯通道組，其中指示資訊是終端根據有緩存資料量的邏輯通道組生成的；收發機，用於接收和發送資料。
本發明實施例提供的一種電腦可讀存儲介質，其上存儲有電腦程式，電腦程式被處理器執行時實現如終端或網路側設備的方法的步驟。
本發明實施例終端根據有緩存資料量的邏輯通道組生成指示資訊，按照指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於BSR MAC CE中，以及將指示資訊置於BSR MAC CE中。由於能夠通過指示資訊指示BSR MAC CE中緩存資料量資訊對應的邏輯通道組，從而能夠滿足5G NR需求。
1200~1202、1300~1301‧‧‧步驟
10‧‧‧終端
20‧‧‧網路側設備
800‧‧‧生成模組
801‧‧‧處理模組
802‧‧‧上報模組
900‧‧‧接收模組
901‧‧‧確定模組
1000、1100‧‧‧匯流排
1001、1101‧‧‧處理器
1002、1102‧‧‧收發機
1003、1103‧‧‧匯流排界面
1004、1104‧‧‧記憶體
1005‧‧‧使用者介面
1105‧‧‧天線
為了更清楚地說明本發明實施例中的技術方案，下面將對實施例描述中所需要使用的附圖作簡要介紹，顯而易見地，下面描述中的附圖僅僅是本發明的一些實施例，對於本領域的普通技術人員來講，在不付出進步性勞動性的前提下，還可以根據這些附圖獲得其他的附圖。
圖1A為背景技術中MAC PDU結構示意圖；圖1B為背景技術中7bit L域的MAC SDU對應的MAC子頭結構示意圖；圖1C為背景技術中15bit L域的MAC SDU對應的MAC子頭結構示意圖；圖2為本發明實施例上報緩存狀態報告的系統結構示意圖；圖3A為本發明實施例第一種BSR MAC CE示意圖；圖3B為本發明實施例第二種BSR MAC CE示意圖；圖3C為本發明實施例第三種BSR MAC CE示意圖；圖4A為本發明實施例第一種MAC子頭示意圖；圖4B為本發明實施例第二種MAC子頭示意圖；圖4C為本發明實施例第三種MAC子頭示意圖；圖5A為本發明實施例1中第一種BSR MAC CE示意圖；圖5B為本發明實施例1中第二種BSR MAC CE示意圖；圖6A為本發明實施例3中第一種BSR MAC CE示意圖；圖6B為本發明實施例3中第二種BSR MAC CE示意圖；圖7A為本發明實施例4中第一種BSR MAC CE示意圖；圖7B為本發明實施例4中第二種BSR MAC CE示意圖； 圖8為本發明實施例第一種終端的結構示意圖；圖9為本發明實施例第一種網路側設備的結構示意圖；圖10為本發明實施例第二種終端的結構示意圖；圖11為本發明實施例第二種網路側設備的結構示意圖；圖12為本發明實施例終端上報緩存狀態報告的方法流程示意圖；圖13為本發明實施例網路側設備接收緩存狀態報告的方法流程示意圖。
為了使本發明的目的、技術方案和優點更加清楚，下面將結合附圖對本發明作進一步地詳細描述，顯然，所描述的實施例僅僅是本發明一部份實施例，而不是全部的實施例。基於本發明中的實施例，本領域普通技術人員在沒有做出進步性勞動前提下所獲得的所有其它實施例，都屬於本發明保護的範圍。
如圖2所述，本發明實施例上報緩存狀態報告的系統包括：終端10，用於根據有緩存資料量的邏輯通道組生成指示資訊；按照指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於緩存狀態報告媒體存取控制控制單元BSR MAC CE中，以及將該指示資訊置於BSR MAC CE中；向網路側設備上報緩存狀態報告；網路側設備20，用於接收終端上報的緩存狀態報告；根據緩存狀態報告的指示資訊，確定該緩存狀態報告的BSR MAC CE中攜帶緩存資料量的對應的邏輯通道組，其中指示資訊是終端根據有緩存資料量資訊的邏輯通 道組生成的。
本發明實施例終端根據有緩存資料量的邏輯通道組生成指示資訊，按照該指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於BSR MAC CE中，以及將該指示資訊置於BSR MAC CE中。由於能夠通過指示資訊指示BSR MAC CE中緩存資料量對應的邏輯通道組，從而能夠滿足5G NR需求，進一步提高了緩存上報的效率，並且節省了資源。
可選的，終端和網路側可以根據需要上報緩存資料量的邏輯通道組的數量及邏輯通道組指示資訊，確定BSR MAC CE的長度。從而在MAC子頭中可以不攜帶長度指示，當然BSR MAC CE的長度不是固定的。
也就是說，需要上報緩存資料量的邏輯通道組的數量不同，BSR MAC CE的長度不同，但MAC子頭中不需要長度指示域L用於指示變長的BSR MAC CE的長度。
本發明實施例中一個邏輯通道組緩存資料量上報Buffer Size以8bit和6bit作為示例，具體實現中Buffer Size只會是8bit或6bit中的一種，不可能同時出現。以8bit Buffer Size為例，如果需要上報緩存資料量的邏輯通道組個數為K，則BSR MAC CE的長度為K+1。
本發明實施例的BSR MAC CE類型分為兩種，每種有不同的格式：完整BSR MAC CE和截短BSR MAC CE。下面分別進行介紹。
第一種：完整BSR MAC CE。
這種方式中，終端將當前能夠上報的所有邏輯通道組的緩存資料量，按照指示資訊指示的順序置於BSR MAC CE中。
在實施中，可以用bitmap(位元點陣圖)作為指示資訊。
若該指示資訊為bitmap，該bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量，邏輯通道組最大個數為8，則可以用1byte的bitmap作為邏輯通道組指示資訊。
假設針對特定邏輯通道組，1表示上報，0表示不上報，當前有緩存資料量且需要進行緩存上報的所有邏輯通道組是邏輯通道組0、邏輯通道組1和邏輯通道組5，則bitmap為11000100。
終端按照邏輯通道組0、邏輯通道組1和邏輯通道組5的順序將對應的緩存資料量置於BSR MAC CE中。
相應的，如果網路側設備收到的bitmap為11000100，就知道BSR MAC CE中攜帶了邏輯通道組0、邏輯通道組1和邏輯通道組5的緩存資料量。
對於完整的BSR MAC CE還有一種實施方式就是如果當前能夠上報的所有邏輯通道組就是最大個數的邏輯通道組，即所有8個邏輯通道組都要進行緩存上報，則指示資訊可以採用隱式方式不出現在BSR MAC CE中。
比如圖3A所示，一共有8個邏輯通道組，當前能夠上報的所有邏輯通道組是這8個，則將這8個邏輯通道組的緩存資料量都置於BSR MAC CE中；相應的，如果網路側設備收到的BSR MAC CE中沒有指示資訊，就知道BSR MAC CE中包括了所有邏輯通道組的緩存資料量。
當然，上面的這種情況攜帶指示資訊也同樣可以。
對於完整的BSR MAC CE可以在對應的MAC CE子頭中攜帶BSR MAC CE的長度指示域。
另一方面，因為邏輯通道組指示資訊位元位元上的數值表示是否上報對應邏輯通道組的緩存資料量，每個邏輯通道組的緩存資料量佔用的位元數是固定的，則網路側設備可以根據邏輯通道組指示資訊確定BSR MAC CE中包括多少個邏輯通道組的緩存資料量，所以網路側設備可以確定出BSR MAC CE的長度，而不需要單獨攜帶一個長度指示域，所以MAC子頭中可以不攜帶長度指示域。
第二種：截短的BSR MAC CE。
這種方式中，終端將當前能夠上報的部分邏輯通道組的緩存資料量，按照該指示資訊指示的順序置於BSR MAC CE中。
在實施中，可以用bitmap作為指示資訊。
若該指示資訊為bitmap，該bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量或位元位元上的數值表示對應邏輯通道組是否有緩存資料量。
若位元位上的數值表示是否上報對應邏輯通道組的緩存資料量，邏輯通道組數量最大為8個，可以用1byte bitmap進行邏輯通道組指示，1表示上報，0表示不上報，當前能夠上報的所有邏輯通道組是邏輯通道組0、邏輯通道組1和邏輯通道組5，終端按邏輯通道組順序和當前資源可以容納的BSR MAC CE大小，上報邏輯通道組0和邏輯通道組1的緩存資料量，則bitmap為11000000。
終端按照邏輯通道組0和邏輯通道組1的順序將對應的緩存資料量置於BSR MAC CE中。
相應的，如果網路側設備收到的bitmap為1100000，就知道BSR MAC CE中攜帶了邏輯通道組0和邏輯通道組1的緩存資料量。
若位元位元上的數值表示對應邏輯通道組是否有緩存資料量，邏輯通道組數量最大為8個，可以用1byte bitmap進行邏輯通道組指示，1表示有緩存資料量，0表示沒有緩存資料量，終端有緩存資料量的邏輯通道組為邏輯通道組0、邏輯通道組1、邏輯通道組2和邏輯通道組3，但當前能夠上報緩存資料量的邏輯通道組是邏輯通道組0和邏輯通道組1。本例中bitmap為11110000，但截短BSR MAC CE中只有邏輯通道組0和邏輯通道組1的緩存資料量上報。
終端按照邏輯通道組0和邏輯通道組1的順序將對應的緩存資料量置於BSR MAC CE中。
相應的，如果網路側設備收到的bitmap為11110000，就知道邏輯通道組0、邏輯通道組1、邏輯通道組2和邏輯通道組3有緩存資料量，後續在解析BSR MAC CE時發現有兩個邏輯通道組的緩存資料量，就知道BSR MAC CE中包括了邏輯通道組0和邏輯通道組1的緩存資料量，並且還能夠知道終端還有邏輯通道組2和邏輯通道組3的緩存資料量未上報。
對於截短的BSR MAC CE可以在對應的MAC CE子頭中攜帶BSR MAC CE的長度指示域。
另一方面，截短BSR MAC CE作為padding BSR上報。網路 側設備根據MAC PDU的長度和其他負荷組成的MAC子PDU長度，確定BSR MAC CE及BSR MAC CE對應的MAC子頭組成的MAC子PDU(也可以稱為MAC sub-PDU)的長度，其中其他負荷包括MAC SDU和/或除了BSR MAC CE之外的其他MAC CE。
如果其他負荷包括MAC SDU，則其他負荷組成的MAC子PDU包括MAC SDU及其對應的MAC子頭；如果其他負荷包括除了BSR MAC CE之外的其他MAC CE，則其他負荷組成的MAC子PDU包括除了BSR MAC CE之外的其他MAC CE及其對應的MAC子頭；如果其他負荷包括MAC SDU和除了BSR MAC CE之外的其他MAC CE，則其他負荷組成的MAC子PDU包括MAC SDU及其對應的MAC子頭，以及包括除了BSR MAC CE之外的其他MAC CE及其對應的MAC子頭。
例如，每個MAC子PDU可以包括1個MAC SDU及其對應的MAC子頭，每個MAC子PDU可以包括除了BSR MAC CE之外的1個其他MAC CE及其對應的MAC子頭。
若位元位上的數值表示是否上報對應邏輯通道組的緩存資料量，BSR MAC CE的長度也可以通過該指示資訊對應的邏輯通道組個數獲得BSR MAC CE長度。
基於此，網路側設備可以確定出BSR MAC CE的長度，MAC子頭中可以不需攜帶長度指示域。
具體的，若網路側設備根據MAC PDU的長度和其他負荷組成的MAC子PDU長度，確定BSR MAC CE及BSR MAC CE對應的MAC 子頭組成的MAC子PDU的長度，則網路側設備通過MAC PDU長度減去其他負荷組成的MAC子PDU長度後，可以確定padding長度。
該padding部分不需要長度指示，用該padding部分上報截短BSR MAC CE時，同樣可以不需要長度指示域。
可選的，本發明實施例BSR MAC CE中的單個邏輯通道的緩存資料量的容量(即buffer size)分為8bit(具體參見圖3B)和6bit(具體參見圖3C)兩種。
6bit buffer size下，由於BSR MAC CE格式是以byte為單位的，除buffer size外，剩餘bit則為預留bit。
本發明實施例提供了兩種BSR MAC CE的格式，一種可選的方式是在BSR MAC CE對應的MAC子頭中攜帶用於指示BSR MAC CE類型的資訊。
具體的，終端將用於指示BSR MAC CE類型的資訊置於BSR MAC CE對應的MAC子頭中；相應的，網路側設備根據MAC子頭中的用於指示BSR MAC CE類型的資訊，確定對應的BSR MAC CE的類型。
本發明實施例提供了多種MAC子頭中包含用於指示BSR MAC CE類型的資訊的方式，下面分別進行介紹。
方式一、LCID域和CE Type組合指示BSR MAC CE類型：用LCID域表示對應的內容是BSR MAC CE，用另一個域CE Type進一步指示該BSR MAC CE的具體類型。
具體的，終端通過BSR MAC CE對應的MAC子頭中的1個 LCID值指示對應的MAC CE為BSR MAC CE，並用CE Type進一步指示完整BSR MAC CE或截短BSR MAC CE；相應的，網路側設備通過BSR MAC CE對應的MAC子頭中的LCID域確定對應的MAC CE為BSR MAC CE後，根據CE Type具體確定BSR MAC CE類型為完整BSR MAC CE或截短BSR MAC CE。
這裡方式一是用1個LCID值指示MAC CE為BSR MAC CE，具體LCID值採用幾位元都可以，比如可以用1表示MAC CE為BSR MAC CE，也可以用11表示MAC CE為BSR MAC CE；進一步用CE Type指示BSR MAC CE的類型是完整還是截短，比如可以用1表示完成，0表示截短；也可以用11表示完整，10表示截短。
在實施中，可以用整個CE Type指示，也可以用CE Type中的一個或多個位元指示。
如圖4A所示，圖中CE Type佔用2bit，根據本發明實施例也可以採用圖4B，這樣CE Type只佔用1bit，另一個bit為預留bit。
方式一實際是通過LCID表示是否是BSR，以及通過CE Type表示是完整還是截短。
比如LCID=x，表示是BSR，CE Type=1表示完整BSR，0表示截短BSR，則一個完整的BSR MAC CE對應的MAC子頭中的LCID=x，CE Type值是1；一個截短的BSR MAC CE對應的MAC子頭中的LCID值=x，CE Type值是0。
需要說明的是，圖4A和圖4B中長度指示域L是冗餘資訊，為了格式統一，也可以包含長度指示域。由於包含長度指示域不是必須的， 圖中以虛線表示，即表示該域可以不存在。
方式二、LCID域指示不同的BSR MAC CE類型：具體為用不同的LCID值表示不同類型的BSR MAC CE。
具體的，終端用BSR MAC CE對應的MAC子頭中的兩個LCID值分別用於指示BSR MAC CE是完整BSR MAC CE或截短BSR MAC CE； 相應的，網路側設備根據BSR MAC CE對應的MAC子頭中的LCID值確定BSR MAC CE格式。
這裡方式二是用兩個LCID值指示MAC CE為完整BSR MAC CE或截短BSR MAC CE，具體LCID值採用幾位元都可以，比如可以用1表示MAC CE為完整BSR MAC CE，0表示MAC CE為截短BSR MAC CE；也可以用11表示MAC CE為完整BSR MAC CE，10表示MAC CE為截短BSR MAC CE。
比如LCID=x表示完整BSR MAC CE，LCID=y表示截短BSR MAC CE。其他bit可以作為預留bit，如圖4C所示。
方式二實際是通過LCID的值表示BSR MAC CE是完整BSR MAC CE還是截短BSR MAC CE。
比如LCID1表示完整BSR MAC CE，LCID2表示截短BSR MAC CE，則一個完整的BSR MAC CE對應的MAC子頭中的LCID值是LCID1；一個截短的BSR MAC CE對應的MAC子頭中的LCID值是LCID0。
需要說明的是，圖4C中長度指示域L是冗餘資訊，為了格式統一，也可以包含長度指示域。由於包含長度指示域不是必須的，圖中 以虛線表示，即表示該域可以不存在。
下面列舉幾個例子對本發明的方案進行說明。
實施例1：Regular(常規)BSR或periodic(週期)BSR上報。
終端側：終端側在觸發regular BSR或periodic BSR後，上報全部緩存資訊，即只能上報完整BSR。
BSR MAC CE格式如圖3A。舉例來說，如果終端有邏輯通道組0、邏輯通道組2、邏輯通道組4和邏輯通道組5的緩存資料量，則具體的BSR MAC CE如圖5A(8bit Buffer Size)或圖5B(6bit Buffer Size)。
該BSR MAC CE對應的MAC子頭格式為圖4A、圖4B或圖4C中的一種。MAC子頭中可以有長度指示域L，也可以沒有長度指示域L。
基地台側：接收UE發送的BSR上報，從BSR MAC CE的第一個位元組確定有緩存資料量的邏輯通道組，並接收隨後的緩存資料量報告。據此對終端進行後續上行調度。
實施例2：padding BSR上報完整緩存資訊。
終端側：終端在組織上行資料包後如果有剩餘資源，終端緩存中還有資料待傳輸，但剩餘資源不足以容納一個新的MAC SDU時，可以組織padding BSR上報，即將BSR MAC CE置於padding中上報。
當剩餘資源足夠容納全部BSR上報時，padding BSR中上報完整BSR MAC CE。BSR MAC CE及其頭格式與實施例1相同。
基地台側：基地台接收到終端發送的padding BSR後，確定終端側還有待傳輸的上行資料，據此對終端進行後續上行調度。
實施例3：truncated(截短)BSR上報(bitmap指示當前截短BSR MAC CE中包含的邏輯通道組)。
終端側：終端在組織上行資料包後如果有剩餘資源，終端緩存中還有資料待傳輸，但剩餘資源不足以容納一個新的MAC SDU時，終端可以組織padding BSR上報。當剩餘資源不足以容納全部邏輯通道組的BSR上報時，padding BSR中上報截短BSR MAC CE。
本實施例中bitmap只指示當前截短BSR MAC CE中包含的邏輯通道組。舉例來說，例如終端緩存中有邏輯通道組0、邏輯通道組1、邏輯通道組4和邏輯通道組5的資料待發送，但當前只有3byte剩餘資源，則BSR MAC CE如圖6A或圖6B所示。
該截短BSR MAC CE對應的MAC子頭格式為圖4A、圖4B或圖4C中的一種。MAC子頭中可以有長度指示域L，也可以沒有長度指示域L。
基地台側：基地台接收到終端發送的截短BSR MAC CE後，確定終端側還有待傳輸的上行資料，可以為終端分配多於截短BSR MAC CE所指示緩存資料量所需的上行傳輸資源。
實施例4：truncated BSR上報(bitmap指示終端全部有緩存的邏輯通道組)。
終端側：終端在組織上行資料包後如果有剩餘資源，終端緩存中還有資料待傳輸，但剩餘資源不足以容納一個新的MAC SDU時，終端可以組織padding BSR上報。當剩餘資源不足以容納全部邏輯通道組的BSR上報時，padding BSR中上報截短BSR MAC CE。
本實施例中bitmap指示終端全部有緩存的邏輯通道組。舉例來說，例如終端緩存中有邏輯通道組0、邏輯通道組1、邏輯通道組4和邏輯通道組5的資料待發送，但當前只有3byte剩餘資源，則BSR MAC CE如圖7A或圖7B所示。
該截短BSR MAC CE對應的MAC子頭格式為圖4A、圖4B或圖4C中的一種。MAC子頭中可以有長度指示域L，也可以沒有長度指示域L。
基地台側：基地台接收到終端發送的截短BSR MAC CE後，確定終端側還有待傳輸的上行資料，且確定終端還有邏輯通道組4和邏輯通道組5的緩存資料量未上報，基地台可為終端分配多於截短BSR MAC CE所指示緩存資料量所需的上行傳輸資源。
如圖8所示，本發明實施例第一種終端包括：生成模組800，用於根據有緩存資料量的邏輯通道組生成指示資訊；處理模組801，用於按照該指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於緩存狀態報告媒體存取控制控制單元BSR MAC CE中，以及將該指示資訊置於BSR MAC CE中；上報模組802，用於向網路側設備上報緩存狀態報告。
可選的，處理模組801還用於：向網路側上報緩存狀態報告之前，根據需要上報緩存資料量的邏輯通道組的數量，確定BSR MAC CE的長度。
可選的，BSR MAC CE格式包括完整BSR MAC CE和截短BSR MAC CE； 處理模組801具體用於：若BSR MAC CE格式為完整BSR MAC CE，則將當前能夠上報的所有邏輯通道組的緩存資料量，按照指示資訊指示的順序置於BSR MAC CE中；或，若BSR MAC CE格式為截短BSR MAC CE，則將當前能夠上報的部分邏輯通道組的緩存資料量，按照指示資訊指示的順序置於BSR MAC CE中。
可選的，處理模組801還用於：向網路側設備上報緩存狀態報告之前，將用於指示BSR MAC CE類型的資訊置於BSR MAC CE對應的MAC子頭中。
可選的，處理模組801還用於：通過BSR MAC CE對應的MAC子頭中的1個LCID值指示對應的MAC CE為BSR MAC CE，並用CE Type進一步指示是完整BSR MAC CE或截短BSR MAC CE；或，用BSR MAC CE對應的MAC子頭中的兩個LCID值分別用於指示BSR MAC CE是完整BSR MAC CE或截短BSR MAC CE。
可選的，該指示資訊為位元點陣圖bitmap，該bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量，或位元位上的數值表示對應邏輯通道組是否有緩存資料量。
如圖9所示，本發明實施例第一種網路側設備包括：接收模組900，用於接收終端上報的緩存狀態報告；確定模組901，用於根據緩存狀態報告的指示資訊，確定緩存狀態報告 的BSR MAC CE中攜帶緩存資料量的對應的邏輯通道組，其中，指示資訊是終端根據有緩存資料量的邏輯通道組生成的。
可選的，該指示資訊為位元點陣圖bitmap，該bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量或位元位元上的數值表示對應邏輯通道組是否有緩存資料量。
可選的，確定模組901還用於：根據MAC子頭中的用於指示BSR MAC CE類型的資訊，確定對應的BSR MAC CE的類型。
可選的，確定模組901具體用於：若LCID和CE Type的組合作為用於指示BSR MAC CE類型的資訊，則通過BSR MAC CE對應的MAC子頭中的1個LCID值在確定對應的MAC CE為BSR MAC CE後，根據CE Type確定BSR MAC CE的類型；或，若LCID值用於指示BSR MAC CE類型的資訊，則根據BSR MAC CE對應的MAC子頭中的LCID值確定BSR MAC CE類型，其中不同的LCID值具體用於指示是完整BSR MAC CE還是截短BSR MAC CE。
可選的，若BSR MAC CE為完整BSR MAC CE，則BSR MAC CE中包括終端當前能夠上報的所有邏輯通道組的緩存資料量；或，若BSR MAC CE為截短BSR MAC CE，則BSR MAC CE中包括終端當前能夠上報的部分邏輯通道組的緩存資料量。
可選的，確定模組901還用於：根據指示資訊指示的攜帶緩存資料量對應的邏輯通道組的數量，確定 BSR MAC CE的長度；或，若BSR MAC CE為padding BSR上報，則根據MAC PDU的長度和其他負荷組成的MAC子PDU長度，確定BSR MAC CE及BSR MAC CE對應的MAC子頭組成的MAC子PDU的長度，其中其他負荷包括MAC SDU和/或除了BSR MAC CE之外的其他MAC CE。
如圖10所示，本發明實施例第二種終端包括處理器1001、收發機1002和記憶體1004，其中：處理器1001，用於通過收發機1002發送和接收資料，並讀取記憶體1004中的程式，執行下列過程：根據有緩存資料量的邏輯通道組生成指示資訊；按照指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於緩存狀態報告媒體存取控制控制單元BSR MAC CE中，以及將指示資訊置於BSR MAC CE中；控制收發機1002向網路側設備上報緩存狀態報告；收發機1002，用於接收和發送資料；可選的，在控制收發機1002向網路側上報緩存狀態報告之前，處理器1001還用於讀取記憶體1004中的程式以執行下列過程：根據需要上報緩存資料量的邏輯通道組的數量，確定BSR MAC CE的長度。
可選的，BSR MAC CE的格式包括完整BSR MAC CE和截短BSR MAC CE；處理器1001讀取記憶體1004中的程式執行下列過程：若BSR MAC CE的格式為完整BSR MAC CE，則將當前能夠上報的所有邏輯通道組的緩存資料量，按照指示資訊指示的順序置於BSR MAC CE中；或， 若BSR MAC CE的格式為截短BSR MAC CE，則將當前能夠上報的部分邏輯通道組的緩存資料量，按照指示資訊指示的順序置於BSR MAC CE中。
可選的，在控制收發機1002向網路側設備上報緩存狀態報告之前，處理器1001還用於讀取記憶體1004中的程式以執行下列過程：將用於指示BSR MAC CE類型的資訊置於BSR MAC CE對應的MAC子頭中。
可選的，處理器1001還用於讀取記憶體1004中的程式以執行下列過程：通過BSR MAC CE對應的MAC子頭中的1個LCID值指示對應的MAC CE為BSR MAC CE，並用CE Type進一步指示是完整BSR MAC CE或截短BSR MAC CE；或，用BSR MAC CE對應的MAC子頭中的兩個LCID值分別用於指示BSR MAC CE是完整BSR MAC CE或截短BSR MAC CE。
可選的，指示資訊為位元點陣圖bitmap，該bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量，或位元位上的數值表示對應邏輯通道組是否有緩存資料量。
在圖10中，匯流排架構(用匯流排1000來代表)，匯流排1000可以包括任意數量的互聯的匯流排和橋，匯流排1000將包括由通用處理器1001代表的一個或多個處理器和記憶體1004代表的記憶體的各種電路連結在一起。匯流排1000還可以將諸如週邊設備、穩壓器和功率管理電路等之類的各種其他電路連結在一起，這些都是本領域所公知的，因此，本文不再對其進行進一步描述。匯流排介面1003在匯流排1000和收發機1002 之間提供介面。收發機1002可以是一個元件，也可以是多個元件，比如多個接收器和發送器，提供用於在傳輸介質上與各種其他裝置通信的單元。例如：收發機1002從其他設備接收外部資料。收發機1002用於將處理器1001處理後的資料發送給其他設備。取決於計算系統的性質，還可以提供使用者介面1005，例如小鍵盤、顯示器、揚聲器、麥克風、操縱桿。
處理器1001負責管理匯流排1000和通常的處理，如前述運行通用作業系統。而記憶體1004可以被用於存儲處理器1001在執行操作時所使用的資料。
可選的，處理器1001可以是中央處理器(CPU)、專用積體電路(Application Specific Integrated Circuit，ASIC)、現場可程式設計閘陣列(Field-Programmable Gate Array，FPGA)或複雜可程式設計邏輯器件(Complex Programmable Logic Device，CPLD)。
如圖11所述，本發明實施例第二種網路側設備包括處理器1101、收發機1102和記憶體1104，其中：處理器1101，用於通過收發機1102發送和接收資料，並讀取記憶體1104中的程式，執行下列過程：控制收發機1102接收終端上報的緩存狀態報告；根據緩存狀態報告的指示資訊，確定緩存狀態報告的BSR MAC CE中攜帶緩存資料量的對應的邏輯通道組，其中指示資訊是終端根據有緩存資料量的邏輯通道組生成的；收發機1102，用於接收和發送資料。
可選的，該指示資訊為位元點陣圖bitmap，該bitmap中每個 位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量或位元位元上的數值表示對應邏輯通道組是否有緩存資料量。
可選的，在控制收發機1102接收終端上報的緩存狀態報告之後，處理器1101還用於讀取記憶體1104中的程式以執行下列過程：根據MAC子頭中的用於指示BSR MAC CE的類型的資訊，確定對應的BSR MAC CE的類型。
可選的，處理器1101讀取記憶體1104中的程式以執行下列過程：若LCID和CE Type的組合作為用於指示BSR MAC CE類型的資訊，則通過BSR MAC CE對應的MAC子頭中的1個LCID值在確定對應的MAC CE為BSR MAC CE後，根據CE Type確定BSR MAC CE的類型；或，若LCID值用於指示BSR MAC CE類型的資訊，則根據BSR MAC CE對應的MAC子頭中的LCID值確定BSR MAC CE的類型，其中，不同的LCID值用於指示是完整BSR MAC CE還是截短BSR MAC CE。
可選的，若BSR MAC CE為完整BSR MAC CE，則BSR MAC CE中包括終端當前能夠上報的所有邏輯通道組的緩存資料量；或，若BSR MAC CE為截短BSR MAC CE，則BSR MAC CE中包括終端當前能夠上報的部分邏輯通道組的緩存資料量。
可選的，在控制收發機1102接收終端上報的緩存狀態報告之後，處理器1101還用於讀取記憶體1104中的程式以執行下列過程：根據指示資訊指示的攜帶緩存資料量對應的邏輯通道組的數量，確定 BSR MAC CE的長度；或，若BSR MAC CE為padding BSR上報，則根據MAC PDU的長度和其他負荷組成的MAC子PDU長度，確定BSR MAC CE及BSR MAC CE對應的MAC子頭組成的MAC子PDU的長度，其中其他負荷包括MAC SDU和/或除了BSR MAC CE之外的其他MAC CE。
在圖11中，匯流排架構(用匯流排1100來代表)，匯流排1100可以包括任意數量的互聯的匯流排和橋，匯流排1100將包括由處理器1101代表的一個或多個處理器和記憶體1104代表的記憶體的各種電路連結在一起。匯流排1100還可以將諸如週邊設備、穩壓器和功率管理電路等之類的各種其他電路連結在一起，這些都是本領域所公知的，因此，本文不再對其進行進一步描述。匯流排介面1103在匯流排1100和收發機1102之間提供介面。收發機1102可以是一個元件，也可以是多個元件，比如多個接收器和發送器，提供用於在傳輸介質上與各種其他裝置通信的單元。經處理器1101處理的資料通過天線1105在無線介質上進行傳輸，進一步，天線1105還接收資料並將資料傳送給處理器1101。
處理器1101負責管理匯流排1100和通常的處理，還可以提供各種功能，包括定時，週邊介面，電壓調節、電源管理以及其他控制功能。而記憶體1104可以被用於存儲處理器1101在執行操作時所使用的資料。
可選的，處理器1101可以是CPU、ASIC、FPGA或CPLD。
基於同一發明構思，本發明實施例中還提供了一種終端上報緩存狀態報告的方法，由於該方法對應的設備是本發明實施例上報緩存狀 態報告的系統中的終端，並且該方法解決問題的原理與該系統相似，因此該方法的實施可以參見系統的實施，重複之處不再贅述。
如圖12所述，本發明實施例終端上報緩存狀態報告的方法包括：步驟1200、終端根據有緩存資料量的邏輯通道組生成指示資訊；步驟1201、終端按照指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於BSR MAC CE中，以及將指示資訊置於BSR MAC CE中；步驟1202、終端向網路側設備上報緩存狀態報告。
可選的，終端向網路側上報緩存狀態報告之前，還包括：終端根據需要上報緩存資料量的邏輯通道組的數量，確定BSR MAC CE的長度。
可選的，BSR MAC CE格式包括完整BSR MAC CE和截短BSR MAC CE；終端按照指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於BSR MAC CE中，包括：若BSR MAC CE格式為完整BSR MAC CE，則終端將當前能夠上報的所有邏輯通道組的緩存資料量，按照指示資訊指示的順序置於BSR MAC CE中；或，若BSR MAC CE格式為截短BSR MAC CE，則終端將當前能夠上報的部分邏輯通道組的緩存資料量，按照指示資訊指示的順序置於BSR MAC CE中。
可選的，終端向網路側設備上報緩存狀態報告之前，還包括：終端將用於指示BSR MAC CE類型的資訊置於BSR MAC CE對應的MAC子頭中。
可選的，終端通過BSR MAC CE對應的MAC子頭中的1個邏輯通道號LCID值指示對應的MAC CE為BSR MAC CE，並用CE類型Type進一步指示是完整BSR MAC CE或截短BSR MAC CE；或，終端用BSR MAC CE對應的MAC子頭中的兩個LCID值分別用於指示BSR MAC CE是完整BSR MAC CE或截短BSR MAC CE。
可選的，指示資訊為位元點陣圖bitmap，bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量，或位元位上的數值表示對應邏輯通道組是否有緩存資料量。
基於同一發明構思，本發明實施例中還提供了一種網路側設備接收緩存狀態報告的方法，由於該方法對應的設備是本發明實施例上報緩存狀態報告的系統中的網路側設備，並且該方法解決問題的原理與該系統相似，因此該方法的實施可以參見系統的實施，重複之處不再贅述。
如圖13所示，本發明實施例網路側設備接收緩存狀態報告的方法包括：步驟1300、網路側設備接收終端上報的緩存狀態報告；步驟1301、網路側設備根據緩存狀態報告的指示資訊，確定緩存狀態報告的BSR MAC CE中攜帶緩存資料量的對應的邏輯通道組，其中指示資 訊是終端根據有緩存資料量的邏輯通道組生成的。
可選的，該指示資訊為bitmap，該bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量或位元位元上的數值表示對應邏輯通道組是否有緩存資料量。
可選的，網路側設備接收終端上報的緩存狀態報告之後，還包括：網路側設備根據MAC子頭中的用於指示BSR MAC CE類型的資訊，確定對應的BSR MAC CE的類型。
可選的，網路側設備根據MAC子頭中的用於指示BSR MAC CE類型的資訊，確定對應的BSR MAC CE的類型，包括：若LCID和CE Type的組合用於指示BSR MAC CE類型的資訊，則網路側設備通過BSR MAC CE對應的MAC子頭中的1個LCID值在確定對應的MAC CE為BSR後，根據CE Type確定BSR MAC CE的類型；或，若LCID值用於指示BSR MAC CE類型的資訊，則網路側設備根據BSR MAC CE對應的MAC子頭中的LCID值確定BSR MAC CE類型，其中不同的LCID值具體用於指示是完整BSR MAC CE還是截短BSR MAC CE。
可選的，若BSR MAC CE為完整BSR MAC CE，則BSR MAC CE中包括終端當前能夠上報的所有邏輯通道組的緩存資料量；或，若BSR MAC CE為截短BSR MAC CE，則BSR MAC CE中包括終端當前能夠上報的部分邏輯通道組的緩存資料量。
可選的，網路側設備接收終端上報的緩存狀態報告之後，還包括： 網路側設備根據指示資訊指示的攜帶緩存資料量對應的邏輯通道組的數量，確定BSR MAC CE的長度；或，若BSR MAC CE為padding BSR上報，則網路側設備根據MAC PDU的長度和其他負荷組成的MAC子PDU長度，確定BSR MAC CE及BSR MAC CE對應的MAC子頭組成的MAC子PDU的長度，其中其他負荷包括MAC SDU和/或除了BSR MAC CE之外的其他MAC CE。
本發明實施例還提供一種電腦可讀存儲介質，其上存儲有電腦程式，該存儲介質可以是非易失性的，即斷電後內容不丟失。該存儲介質中存儲軟體程式，該軟體程式在被一個或多個處理器讀取並執行時可實現本發明實施例上面任何一種上報緩存狀態報告的方案。
該存儲介質可以通過外部介面或內部介面與處理器連接。比如記憶體是U盤、移動硬碟等，則可以通過外部介面連接；比如記憶體是處理器所在的設備中的存儲模組，則可以通過內部介面連接。
本發明實施例還提供一種電腦程式產品，該軟體程式在被一個或多個處理器讀取並執行時可實現本發明實施例上面任何一種上報緩存狀態報告的方案。
以上參照示出根據本發明實施例的方法、裝置(系統)和/或電腦程式產品的框圖和/或流程圖描述本發明。應理解，可以通過電腦程式指令來實現框圖和/或流程圖示圖的一個塊以及框圖和/或流程圖示圖的塊的組合。可以將這些電腦程式指令提供給通用電腦、專用電腦的處理器和/或其它可程式設計資料處理裝置，以產生機器，使得經由電腦處理器和/或其它可程式設計資料處理裝置執行的指令創建用於實現框圖和/或流程圖 塊中所指定的功能/動作的方法。
相應地，還可以用硬體和/或軟體(包括固件、駐留軟體、微碼等)來實施本發明。更進一步地，本發明實施例可以採取電腦可使用或電腦可讀存儲介質上的電腦程式產品的形式，其具有在介質中實現的電腦可使用或電腦可讀程式碼，以由指令執行系統來使用或結合指令執行系統而使用。在本發明實施例的上下文中，電腦可使用或電腦可讀介質可以是任意介質，其可以包含、存儲、通信、傳輸、或傳送程式，以由指令執行系統、裝置或設備使用，或結合指令執行系統、裝置或設備使用。
顯然，本領域的技術人員可以對本發明進行各種改動和變型而不脫離本發明的精神和範圍。這樣，倘若本發明的這些修改和變型屬於本發明申請專利範圍及其等同技術的範圍之內，則本發明也意圖包含這些改動和變型在內。

Claims (25)

  1. 一種上報緩存狀態報告的方法，其特徵在於，該方法包括：終端根據有緩存資料量的邏輯通道組生成指示資訊；該終端按照該指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於緩存狀態報告媒體存取控制控制單元BSR MAC CE中，以及將該指示資訊置於該BSR MAC CE中；該終端向網路側設備上報緩存狀態報告。
  2. 如請求項1所述的上報緩存狀態報告的方法，其中，該終端向該網路側上報緩存狀態報告之前，還包括：該終端根據需要上報緩存資料量的邏輯通道組的數量，確定該BSR MAC CE的長度。
  3. 如請求項1所述的上報緩存狀態報告的方法，其中，該BSR MAC CE的格式包括完整BSR MAC CE和截短BSR MAC CE；該終端按照該指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於該BSR MAC CE中，包括：若該BSR MAC CE的格式為完整BSR MAC CE，則該終端將當前能夠上報的所有邏輯通道組的緩存資料量，按照該指示資訊指示的順序置於該BSR MAC CE中；或，若該BSR MAC CE的格式為截短BSR MAC CE，則該終端將當前能夠上報的部分邏輯通道組的緩存資料量，按照該指示資訊指示的順序置於該BSR MAC CE中。
  4. 如請求項3所述的上報緩存狀態報告的方法，其中，該終端向網路側設備上報緩存狀態報告之前，還包括：該終端將用於指示該BSR MAC CE的類型的資訊置於該BSR MAC CE對應的MAC子頭中。
  5. 如請求項4所述的上報緩存狀態報告的方法，其中，該終端通過該BSR MAC CE對應的MAC子頭中的1個邏輯通道號LCID值指示對應的MAC CE為BSR MAC CE，並用CE類型Type進一步指示是完整BSR MAC CE或截短BSR MAC CE；或，該終端用該BSR MAC CE對應的MAC子頭中的兩個LCID值分別用於指示BSR MAC CE是完整BSR MAC CE或截短BSR MAC CE。
  6. 如請求項1至5中任一項所述的上報緩存狀態報告的方法，其中，該指示資訊為位元點陣圖bitmap，該bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量，或位元位上的數值表示對應邏輯通道組是否有緩存資料量。
  7. 一種上報緩存狀態報告的方法，其特徵在於，該方法包括：網路側設備接收終端上報的緩存狀態報告；該網路側設備根據該緩存狀態報告的指示資訊，確定該緩存狀態報告的BSR MAC CE中攜帶緩存資料量的對應的邏輯通道組，其中該指示資訊是該終端根據有緩存資料量的邏輯通道組生成的。
  8. 如請求項7所述的上報緩存狀態報告的方法，其中，該指示資訊為位元點陣圖bitmap，該bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量或位元位元上的數值表示對應邏輯通道組是否有緩存資料量。
  9. 如請求項7所述的上報緩存狀態報告的方法，其中，該網路側設備接收終端上報的緩存狀態報告之後，還包括：該網路側設備根據MAC子頭中的用於指示該BSR MAC CE的類型的資訊，確定對應的BSR MAC CE的類型。
  10. 如請求項9所述的上報緩存狀態報告的方法，其中，該網路側設備根據MAC子頭中的用於指示該BSR MAC CE的類型的資訊，確定對應的BSR MAC CE的類型，包括：若LCID和CE Type的組合用於指示BSR MAC CE類型的資訊，則該網路側設備通過該BSR MAC CE對應的MAC子頭中的1個LCID值在確定 對應的MAC CE為BSR後，根據CE Type確定BSR MAC CE的類型；或，若LCID值用於指示BSR MAC CE類型的資訊，則該網路側設備根據該BSR MAC CE對應的MAC子頭中的LCID值確定BSR MAC CE的類型，其中，不同的LCID值用於指示是完整BSR MAC CE還是截短BSR MAC CE。
  11. 如請求項10所述的上報緩存狀態報告的方法，其中，若該BSR MAC CE為完整BSR MAC CE，則該BSR MAC CE中包括該終端當前能夠上報的所有邏輯通道組的緩存資料量；或，若該BSR MAC CE為截短BSR MAC CE，則該BSR MAC CE中包括該終端當前能夠上報的部分邏輯通道組的緩存資料量。
  12. 如請求項7至11中任一項所述的上報緩存狀態報告的方法，其中，該網路側設備接收終端上報的緩存狀態報告之後，還包括：該網路側設備根據該指示資訊指示的攜帶緩存資料量對應的邏輯通道組的數量，確定該BSR MAC CE的長度；或，若該BSR MAC CE為填充padding BSR上報，則該網路側設備根據MAC協定資料單元PDU的長度和其他負荷組成的MAC子PDU長度，確定該BSR MAC CE及該BSR MAC CE對應的MAC子頭組成的MAC子PDU的長度，其中，其他負荷包括MAC SDU和/或除了BSR MAC CE之外的其他MAC CE。
  13. 一種上報緩存狀態報告的終端，其特徵在於，該終端包括處理器、收發機和記憶體，其中，該處理器，用於通過控制該收發機發送和接收資料，並讀取該記憶體中的程式，執行下列過程：根據有緩存資料量的邏輯通道組生成指示資訊；按照該指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於緩存狀態報告媒體存取控制控制單元BSR MAC CE中，以及將該指示資訊置於BSR MAC CE中；控制該收發機向網路側設備上報緩存狀態報告； 該收發機，用於接收和發送資料。
  14. 如請求項13所述的上報緩存狀態報告的終端，其中，在控制該收發機向該網路側上報緩存狀態報告之前，該處理器還用於讀取該記憶體中的程式以執行下列過程：根據需要上報緩存資料量的邏輯通道組的數量，確定該BSR MAC CE的長度。
  15. 如請求項13所述的上報緩存狀態報告的終端，其中，該BSR MAC CE的格式包括完整BSR MAC CE和截短BSR MAC CE；該處理器讀取該記憶體中的程式執行下列過程：按照該指示資訊指示的順序將當前能夠上報的至少一個邏輯通道組的緩存資料量，置於該BSR MAC CE中，包括：若該BSR MAC CE的格式為完整BSR MAC CE，則將當前能夠上報的所有邏輯通道組的緩存資料量，按照該指示資訊指示的順序置於該BSR MAC CE中；或，若該BSR MAC CE的格式為截短BSR MAC CE，則將當前能夠上報的部分邏輯通道組的緩存資料量，按照該指示資訊指示的順序置於該BSR MAC CE中。
  16. 如請求項15所述的上報緩存狀態報告的終端，其中，在控制該收發機向網路側設備上報緩存狀態報告之前，該處理器還用於讀取該記憶體中的程式以執行下列過程：將用於指示該BSR MAC CE的類型的資訊置於該BSR MAC CE對應的MAC子頭中。
  17. 如請求項16所述的上報緩存狀態報告的終端，其中，該處理器還用於讀取該記憶體中的程式以執行下列過程：通過該BSR MAC CE對應的MAC子頭中的1個邏輯通道號LCID值指示對應的MAC CE為BSR MAC CE，並用CE類型Type進一步指示是完整BSR MAC CE或截短BSR MAC CE；或， 用該BSR MAC CE對應的MAC子頭中的兩個LCID值分別用於指示BSR MAC CE是完整BSR MAC CE或截短BSR MAC CE。
  18. 如請求項13至17中任一項所述的上報緩存狀態報告的終端，其中，該指示資訊為位元點陣圖bitmap，該bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量，或位元位上的數值表示對應邏輯通道組是否有緩存資料量。
  19. 一種上報緩存狀態報告的網路側設備，其特徵在於，該網路側設備包括處理器、收發機和記憶體，其中，該處理器，用於通過該收發機發送和接收資料，並讀取該記憶體中的程式，執行下列過程：控制該收發機接收終端上報的緩存狀態報告；根據該緩存狀態報告的指示資訊，確定該緩存狀態報告的BSR MAC CE中攜帶緩存資料量的對應的邏輯通道組，其中該指示資訊是該終端根據有緩存資料量的邏輯通道組生成的；該收發機，用於接收和發送資料。
  20. 如請求項19所述的上報緩存狀態報告的網路側設備，其中，該指示資訊為位元點陣圖bitmap，該bitmap中每個位元位元對應一個邏輯通道組，且位元位上的數值表示是否上報對應邏輯通道組的緩存資料量或位元位元上的數值表示對應邏輯通道組是否有緩存資料量。
  21. 如請求項19所述的上報緩存狀態報告的網路側設備，其中，在控制該收發機接收終端上報的緩存狀態報告之後，該處理器還用於讀取該記憶體中的程式以執行下列過程：根據MAC子頭中的用於指示該BSR MAC CE的類型的資訊，確定對應的BSR MAC CE的類型。
  22. 如請求項21所述的上報緩存狀態報告的網路側設備，其中，該處理器讀取該記憶體中的程式以執行下列過程：根據MAC子頭中的用於指示BSR MAC CE類型的資訊，確定對應的BSR MAC CE的類型，包括： 若LCID和CE Type的組合用於指示BSR MAC CE類型的資訊，則通過該BSR MAC CE對應的MAC子頭中的1個LCID值在確定對應的MAC CE為BSR後，根據CE Type確定BSR MAC CE的類型；或，若LCID值用於指示BSR MAC CE類型的資訊，則根據該BSR MAC CE對應的MAC子頭中的LCID值確定BSR MAC CE的類型，其中，不同的LCID值用於指示是完整BSR MAC CE還是截短BSR MAC CE。
  23. 如請求項22所述的上報緩存狀態報告的網路側設備，其中，若該BSR MAC CE為完整BSR MAC CE，則該BSR MAC CE中包括該終端當前能夠上報的所有邏輯通道組的緩存資料量；或，若該BSR MAC CE為截短BSR MAC CE，則該BSR MAC CE中包括該終端當前能夠上報的部分邏輯通道組的緩存資料量。
  24. 如請求項19至23中任一項所述的上報緩存狀態報告的網路側設備，其中，在控制該收發機接收終端上報的緩存狀態報告之後，該處理器還用於讀取該記憶體中的程式以執行下列過程：根據該指示資訊指示的攜帶緩存資料量對應的邏輯通道組的數量，確定該BSR MAC CE的長度；或，若該BSR MAC CE為填充padding BSR上報，則根據MAC協定資料單元PDU的長度和其他負荷組成的MAC子PDU長度，確定該BSR MAC CE及該BSR MAC CE對應的MAC子頭組成的MAC子PDU的長度，其中，其他負荷包括MAC SDU和/或除了BSR MAC CE之外的其他MAC CE。
  25. 一種電腦可讀存儲介質，其上存儲有電腦程式，其特徵在於：該電腦程式被處理器執行時實現如請求項1至6或者7至12中任一項該方法的步驟。
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