TW201701706A - 基於競爭之排程請求的低延遲 - Google Patents

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Abstract

揭露用於減少用於基於競爭之排程請求(SR)之延遲的技術。使用者設備(UE)能隨機地選擇用於實體隨機存取通道(PRACH)傳輸的PRACH前置索引。UE可與SR訊息一起多工PRACH前置索引，SR訊息含有用於PRACH傳輸的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)。UE可處理與PRACH傳輸之子幀#(n)中的SR訊息多工的PRACH前置索引用於傳輸至增強節點B(eNB)，其中n為子幀編號。

Description

基於競爭之排程請求的低延遲
本發明係關於基於競爭之排程請求的低延遲。
無線行動通訊技術使用各種標準和協定以傳送節點(例如，傳輸站)與無線裝置(例如，行動裝置)之間的資料。一些無線裝置使用在下行鏈路(DL)傳輸中的正交頻分多重存取(OFDMA)和在上行鏈路(UL)傳輸的單載波頻分多重存取(SC-FDMA)來通訊。使用用於信號傳輸之正交頻分多工(OFDM)的標準和協定包括第三代合作夥伴計劃(3GPP)長期演進(LTE)、電氣和電子工程師學會(IEEE)802.16標準(例如，802.16e、802.16m)(也就是俗稱如WiMAX(全球互通微波存取)的工業團體)、以及IEEE 802.11標準(也就是俗稱如WiFi的工業團體)。
在3GPP無線電存取網路(RAN)LTE系統中，節點可以是演進通用陸地無線電存取網路(E- UTRAN)節點B(通常也表示為演進節點B、增強型節點B、eNodeB、或eNB)和無線電網路控制器(RNC)(其與稱為使用者設備(UE)的無線裝置通訊)的組合。下行鏈路(DL)傳輸可以是從節點(例如，eNodeB)至無線裝置(例如，UE)的通訊，而上行鏈路(UL)傳輸可以是從無線裝置至節點的通訊。
在3GPP LTE中，上行鏈路能使用實體隨機存取通道(PRACH)來建立。數據能經由實體下行鏈路共享通道(PDSCH)從eNB發送到UE。實體上行鏈路控制通道(PUCCH)能用以確認接收到資料。下行鏈路和上行鏈路通道或傳輸能使用時分雙工(TDD)或頻分雙工(FDD)。
在3GPP LTE系統中，UE需要傳送排程請求(SR)以獲取用於其上行鏈路傳輸的資源。目前，有兩種方法用於SR傳輸。一種方法是藉由在配置子幀中使用PUCCH。可替代地，可使用經由PRACH的基於競爭程序以發送SR。然而，使用經由PUCCH或PRACH之目前方法傳送SR會有相對大的延遲。這些延遲會增加通訊系統的等待時間。
100‧‧‧胞元
104‧‧‧eNB
108‧‧‧使用者設備
110‧‧‧使用者設備
200‧‧‧無線電幀
Tf‧‧‧期間
210i‧‧‧子幀
220a‧‧‧槽
220b‧‧‧槽
260‧‧‧實體下行鏈路控制通道
266‧‧‧實體下行鏈路共享通道
230a‧‧‧資源區塊
230b‧‧‧資源區塊
230i‧‧‧資源區塊
230m‧‧‧資源區塊
230n‧‧‧資源區塊
236‧‧‧子載波
232‧‧‧OFDM符元
240i‧‧‧資源元件
242‧‧‧OFDM符元
246‧‧‧子載波
250a‧‧‧位元
250b‧‧‧位元
500‧‧‧RAR
600‧‧‧實例
602‧‧‧PRACH信號結構
604‧‧‧PRACH傳輸信號格式
700‧‧‧表格
800‧‧‧第一選項
1000‧‧‧第二選項
1100‧‧‧第三選項
1200‧‧‧酬載結構
1300‧‧‧流程圖
1310-1340‧‧‧方塊
1400‧‧‧流程圖
1410-1440‧‧‧方塊
1500‧‧‧功能性
1510-1530‧‧‧方塊
1600‧‧‧功能性
1610-1620‧‧‧方塊
1700‧‧‧圖
1800‧‧‧UE裝置
1802‧‧‧應用電路
1804‧‧‧基頻電路
1806‧‧‧射頻電路
1808‧‧‧前端模組電路
1810‧‧‧天線
1812‧‧‧儲存媒體
1804a-d‧‧‧基頻處理器
1804e‧‧‧中央處理單元
1804f‧‧‧音頻DSP
1806a‧‧‧混合器電路
1806b‧‧‧放大器電路
1806c‧‧‧濾波器電路
1806d‧‧‧合成器電路
1900‧‧‧圖
1910‧‧‧節點
1912‧‧‧節點裝置
1914‧‧‧處理模組
1916‧‧‧收發器模組
1918‧‧‧電路
1920‧‧‧無線裝置
1922‧‧‧處理模組
1924‧‧‧收發器模組
將從結合附圖的詳細說明顯而易見本揭露之特徵和優點，附圖經由舉例共同繪示本揭露之特徵；且其中： 第1圖繪示依照實例之在具有擁有兩個裝置之演進節點B(eNB)之胞元內的LTE操作區；第2圖繪示依照實例之用於包括傳統實體下行鏈路控制通道(PDCCH)之下行鏈路(DL)傳輸之無線電幀資源(例如，資源格)的圖；第3圖描繪依照實例之相較於低延遲之基於PRACH之SR傳輸的基於傳統實體隨機存取通道(PRACH)之排程請求(SR)傳輸；第4圖繪示依照實例之另一低延遲之基於PRACH之SR傳輸；第5圖繪示依照實例之隨機存取回應(RAR)樣式；第6圖繪示依照實例之實體隨機存取通道(PRACH)傳輸信號；第7圖繪示依照實例之低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸結構格式的表格；第8圖繪示依照實例之用於低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸結構的第一選項；第9圖繪示依照實例之使用1.25kHz子載波間隔的低延遲實體隨機存取通道(PRACH)排程請求(SR)訊息傳輸；第10圖繪示依照實例之用於低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸結構的第二選 項；第11圖繪示依照實例之用於低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸結構的第三選項；第12圖繪示依照實例之低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸結構的酬載結構；第13圖繪示依照實例之用於傳送低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸的流程圖；第14圖繪示依照實例之用於產生低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸的流程圖；第15圖繪示依照實例之可操作以藉由演進節點(eNB)進行減少用於基於競爭之排程請求(SR)的延遲之使用者設備(UE)的功能性；第16圖描繪依照實例之可操作以藉由使用者設備(UE)減少用於基於競爭之排程請求(SR)的延遲之演進節點B(eNB)的功能性；第17圖繪示依照實例之無線裝置(例如，UE)的圖；第18圖繪示依照實例之節點(例如，eNB)和無線裝置(例如，UE)的圖；及第19圖繪示依照實例之使用者設備(例如，UE)裝置之示範元件的圖。
現在將參考所繪示之示範實施例，且本文將使用特定語言以描述示範實施例。然而，將了解並不藉此打算限制技術的範圍。
【發明內容及實施方式】
在揭露和說明本技術之前，要了解本技術並不限於本文所揭露之特定結構、程序步驟、或材料，而是延伸至如將由本相關領域之那些通常技藝者識別出的以上之等效物。也應了解本文所運用的術語僅用於描述特定實例之目的且不打算為限制的。在不同圖中的相同標號表示相同元件。在流程圖和程序中提供的數字係為了清楚繪示步驟及操作而提供且不一定指示特定順序或序列。
示範實施例
在下面提出技術實施例的初步概述且之後接著進一步詳細說明具體技術實施例。此初步摘要係打算用以幫助讀者更快速地了解本技術，但並不打算用以識別出本技術之主要特徵或基本特徵，也不打算用以限制所主張的主題之範圍。
在一態樣中，3GPP無線電存取網路(RAN)LTE系統可包括演進通用陸地無線電存取網路(E-UTRAN)，其可包括複數個演進節點B(eNB)，並與複數個行動台通訊(也稱為使用者設備(UE))。給定E-UTRAN的無線電協定堆疊包括無線電資源控制層 (RRC)、封包資料會聚協定層(PDCP)、無線電鏈路控制層(RLC)、媒體存取控制層(MAC)、以及實體層(PHY)。
為了利用共享通道(SCH)資源，當在UE之間共享資源時，eNB中的MAC可藉由實體下行鏈路控制通道(PDCCH)發訊動態地分配下行鏈路共享通道(DL-SCH)或上行鏈路共享通道(UL-SCH)資源。在一實例中，PDCCH可包括胞元無線電網路暫時識別符(C-RNTI)或其他類型的識別符以取決於交通量、每個UE的服務品質(QoS)要求、以及相關無線電承載而分配實體層資源。
排程請求(SR)可被UE用於請求UL資源。當UE不具有分配給目前傳輸時間間隔(TTI)之任何UL資源時，會觸發SR。TTI是在無線電鏈路上的傳輸之期間。在一實例中，3GPP LTE Rel.12 TTI可包含單一OFDMA子幀，具有1毫秒(ms)之期間。使用者設備(UE)可傳送排程請求(SR)以獲得UL資源用於UL傳輸。UE可藉由1)在配置子幀中的實體上行鏈路控制通道(PUCCH)或2)在基於競爭之通訊中的實體隨機存取通道(PRACH)來傳送SR傳輸。然而，PUCCH傳輸和PRACH傳輸都受到相當大的延遲。例如，用於經由PUCCH或PRACH發送SR的3GPP LTE Rel.12程序會需要多達20個子幀(即20ms)。
PRACH能用以攜帶隨機存取前置使用者用於 隨機存取程序的初始。例如，隨機存取前置可包括循環前綴(CP)、序列(SEQ)、和保護時間(GT)。PRACH取決於特定前置格式而在頻域中可佔據6個實體資源區塊(PRB)，並在時域中跨越1、2或3個子幀。在頻域中，不使用在6個PRB之兩端的幾個子載波以避免與相鄰的PUCCH/PUSCH干擾。在時域中，循環前綴(CP)和保護時間(GT)可用以避免與前一個和下一個子幀干擾。事實證明，GT決定最大胞元半徑。
再者，為了增強胞元邊緣附近之UE的效能(例如，胞元邊緣使用者)，可降低用於PRACH格式0的最大編碼率，其可以等於具有藉由在6個資源區塊(RB)內之1個OFDM符元傳送之長BSR訊息的80/144=0.56(例如，0.56的編碼率)。由於可能限制頻率資源，因此降低編碼率的一種方式是藉由壓縮訊息位元。因此，SR訊息位元可從80位元壓縮到40位元(或具有新循環冗餘檢查(CRC)序列的24位元)。然後最大編碼率可降低到0.28及/或更低允許接收性能能顯著增強。
因此，提出本技術以在現有LTE系統和5G無線技術系統中支援關鍵任務機器類型通訊(MTC)以提供用於具有保障低延遲和可用性和可靠性服務之連接的增加效率和可靠性。因此，在一態樣中，本技術提供用於基於競爭之排程請求(SR)用於低延遲應用的解決方法。尤其是，技術基於PRACH傳輸提供用於基於低延遲競爭的 SR訊息。在一態樣中，PRACH前置和SR訊息可在PRACH訊息傳輸中被一起多工和傳送。
在一態樣中，提出用於減少用於基於競爭之排程請求(SR)之延遲的技術。使用者設備(UE)能隨機地選擇用於實體隨機存取通道(PRACH)傳輸的PRACH前置索引。UE可與SR訊息一起多工PRACH前置索引，SR訊息含有用於PRACH傳輸的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)。UE可處理與PRACH傳輸之子幀#(n)中的SR訊息多工的PRACH前置索引用於傳輸至增強節點B(eNB)，其中n為子幀編號。
在另一態樣中，提出用於減少用於基於競爭之排程請求(SR)之延遲的技術。eNodeB可從使用者設備(UE)接收具有與排程請求(SR)訊息多工之隨機選定PRACH前置索引的實體隨機存取通道(PRACH)傳輸，SR訊息含有胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)在PRACH傳輸之子幀#(n)中，其中n為子幀編號。
又在另一態樣中，提出用於減少用於基於競爭之排程請求(SR)之延遲的技術。使用者設備(UE)可根據用於實體隨機存取通道(PRACH)傳輸之胞元無線電網路暫時識別符(C-RNTI)、胞元識別(ID)、及子幀#(n)來計算擾亂循環冗餘碼(CRC)序列，其中n為子幀編號。UE可判定目前緩衝器尺寸和緩衝器尺寸索 引(BSI)。UE可使用BSI和擾亂CRC序列來計算PRACH前置索引用於產生排程請求(SR)訊息。
第1圖繪示在具有擁有兩個裝置之演進節點B(eNB)之胞元100內的LTE操作區。第1圖繪示可關聯於錨型胞元、巨型胞元或主要胞元的eNB 104。又，胞元100可包括與eNB 104通訊的使用者設備(UE)108、110。
eNB 104可以是如巨型eNB的高傳輸功率eNB用於覆蓋和連接性。eNB 104可負責移動性，也可負責無線電資源控制(RRC)發信和其它類型的控制發信。使用者設備(UE)108、110可由巨型eNB 104支援。
第2圖繪示依照實例之用於包括傳統實體下行鏈路控制通道(PDCCH)之下行鏈路(DL)傳輸之無線電幀資源(例如，資源格)的圖。在實例中，用以傳送資料之信號的無線電幀200可配置以具有10毫秒(ms)的期間Tf。每個無線電幀可被分段或分成每個1ms長的十個子幀210i。每個子幀可進一步細分成兩個槽220a和220b，每個具有0.5ms的期間Tslot。第一槽(#0)220a可包括傳統實體下行鏈路控制通道(PDCCH)260及/或實體下行鏈路共享通道(PDSCH)266，且第二槽(#1)220b可包括使用PDSCH傳送的資料。在一態樣中，無線電幀200之架構設計的至少一部分也可適用於在上行鏈路(UL)傳輸中的單載波頻分多重存取(SC-FDMA)。
用於被節點和無線裝置使用之元件載波 (CC)的每個槽基於CC頻寬可包括多個資源區塊(RB)230a、230b、230i、230m、及230n。CC可具有擁有頻寬和中心頻率的載波頻率。CC的每個子幀可包括在傳統PDCCH中發現的下行鏈路控制資訊(DCI)。當使用傳統的PDCCH時，在控制區域中的傳統PDCCH在每個子幀或實體RB(PRB)中可包括一至三行的第一OFDM符元。在子幀中剩餘11至13個OFDM符元(或當不使用傳統PDCCH時是14個OFDM符元)可被分配給用於資料的PDSCH(用於短或正常循環前綴)。
控制區域可包括實體控制格式指示器通道(PCFICH)、實體混合自動重複請求(混合ARQ)指示器通道(PHICH)、和PDCCH。在用於PDCCH之控制區域中的OFDM符元的數量可藉由在實體控制格式指示器通道(PCFICH)中傳送的控制通道格式指示器(CFI)決定。PCFICH可位於每個子幀的第一OFDM符元中。PCFICH和PHICH會具有先於PDCCH的優先權，所以PCFICH和PHICH在PDCCH之前被排程。
在一示範實施例中，每個RB(實體RB或PRB)230i可包括12個子載波236，具有每個子載波15kHz的頻寬(在頻寬軸)和每個槽6或7個正交頻分多工(OFDM)符元232(在時間軸)。若採用短或一般循環前綴，則RB可使用七個OFDM符元。若使用延伸循環前綴，則RB可使用六個OFDM符元。資源區塊可使用短或一般循環前綴被映射至84個資源元件(RE)240i，或資 源區塊可使用延伸循環前綴被映射至72個RE(未顯示)。RE可以是藉由一個子載波(即，15kHz)246之一個OFDM符元242的單位。
在正交相移鍵控(QPSK)調變的情況下，每個RE會傳送資訊的2個位元250a和250b。可使用其它類型的調變，例如16個正交振幅調變(QAM)或64個QAM以在每個RE中傳送更大數量的位元，或二相移鍵控(BPSK)調變以在每個RE中傳送較少數量的位元(單一位元)。RB可被配置用於從eNB到UE的下行鏈路傳輸，或RB可被配置用於從UE到eNB的上行鏈路傳輸。
第2圖的實例不打算為限制的。相反，它只是OFDMA無線電幀結構的一個例子。未來5G系統可能具有可用以構建OFDMA子幀210i和無線電幀200之不同數量的子載波和OFDM符元。每個OFDM符元232可能具有不同時間，並且每個子載波可能具有不同頻寬。更短的子幀可以實現具有較低延遲的通訊架構。
如前所述，UE可藉由1)配置子幀中的實體上行鏈路控制通道(PUCCH)或2)實體隨機存取通道(PRACH)來傳送SR傳輸。然而，PUCCH傳輸和PRACH傳輸都會受到大或長的時間延遲。例如，使用PUCCH，UE可配置以等待UE的配置SR傳輸子幀以使用PUCCH來發送SR。UE可配置以等待直到UE的上行鏈路許可到達為止以發送緩衝器狀態報告(BSR)。接著UE可等待接收上行鏈路許可以傳送第一上行鏈路資料傳輸。 另外，使用PUCCH用於發出SR可能無法用於所有UE，因為eNB可能由於資源限制而不為每個UE配置用於SR配置的設定操作。可替代地，使用PRACH用於發出SR也可具有如第3圖所示的大延遲。
第3圖比較A)基於傳統實體隨機存取通道(PRACH)之排程請求(SR)傳輸與B)本技術的基於低延遲PRACH之SR傳輸。例如，在A)中，基於傳統實體隨機存取通道(PRACH)之排程請求(SR)傳輸在整個基於PRACH之SR傳輸程序中總共包括5個訊息。例如，在基於競爭之隨機存取程序中，UE可發送PRACH信號至eNB中。eNB可發送隨機存取回應(RAR)至UE。在接收RAR之後，UE可發送Msg3(隨機存取的第三個訊息)，並在Msg3中攜帶CCCH SDU(公共控制通道服務資料單元，共同控制通道服務資料單元)或UE的胞元無線電網路暫時識別符(C-RNTI)用於初始隨機存取。在發送Msg3之後，UE會啟動競爭解析計時器(CRT)，並會從eNB接收競爭解析回應訊息MSG4(RAR的第四個訊息)。UE可接著傳送Msg5(第五個訊息)。
然而，為了降低延遲，能簡化基於傳統隨機存取通道(PRACH)之排程請求(SR)傳輸的SR傳輸和接收程序。在一實例中，可藉由降低5個總訊息來簡化SR程序。例如，為了降低用於產生低延遲SR傳輸框架的延遲，如第3圖之B)基於低延遲PRACH之SR傳輸中 所示，可一起傳送PRACH和包括如C-RNTI和緩衝器狀態報告(BSR)之資訊的訊息。
在第3圖之B)中，使用者設備(UE)可隨機地選擇用於實體隨機存取通道(PRACH)傳輸的PRACH前置索引。UE可與SR訊息一起多工PRACH前置索引，SR訊息含有用於PRACH傳輸的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)。UE可傳送與PRACH傳輸之子幀#(n)中的SR訊息多工的PRACH前置索引作為第一訊息至增強節點B(eNB)，其中n為子幀編號。例如，若SR不在預定時間週期內被排程，則UE可重新傳送具有與含有C-RNTI和BSR的SR訊息一起多工之PRACH前置索引的PRACH傳輸至eNB。
換言之，UE可藉由隨機地選擇與SR訊息(在子幀n含有UE的C-RNTI和BSR資訊，其中n為子幀編號)一起多工之PRACH前置索引來傳送新的基頻信號。若在子幀(n+k)接收上行鏈路許可，則UE可傳送UE的上行鏈路資料；否則，UE可能在配置PRACH子幀上傳送具有新隨機前置索引的新基頻信號。應注意k可以是正整數且經由主資訊區塊(MIB)、系統資訊區塊(SIB)或UE特定專用RRC發信被較高層預定義及/或配置。亦即，k為藉由主資訊區塊(MIB)、系統資訊區塊(SIB)、或UE特定專用RRC發信的信號期間。因此，可藉由僅發送用於基於競爭之排程請求(SR)的1個訊息 來達到低延遲，且最小延遲可以是4個傳輸時間間隔(TTI)的間隔，其顯著減少用於上行鏈路傳輸的等待時間。
現在回到第4圖，描繪另一低延遲之基於PRACH之SR傳輸400。在一態樣中，UE可傳送具有與SR訊息一起多工之PRACH前置索引的另一PRACH傳輸至eNB，SR訊息含有胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)。為了使UE明確地獲得SR解碼狀態，可使用隨機存取回應(RAR)。若UE的資料被正確地解碼，則RAR可包含UE的C-RNTI，而不是在目前基於競爭之隨機存取中使用的暫時C-RNTI。上行鏈路許可可加在RAR中以排程UE的第一次傳輸。亦即，能在第5圖中定義在第4圖中使用的RAR結構樣式，且RAR 500可由四個欄位組成：R欄位、時序提前命令欄位、UL許可欄位、及C-RNTI，其中，「R」可以是保留位元且可以是0，其可與在3GPP TS 36.321中的章節6.2.3定義相同。
第6圖繪示依照實例之實體隨機存取通道(PRACH)傳輸信號的實例600。亦即，第6圖繪示PRACH信號結構602，其中信號期間k之值可由PRACH格式決定。循環前綴(CP)是具有時間集之OFDM符元之間的保護週期以降低或消除符元之間的干擾。序列(SEQ)可指示PRACH基頻序列，而保留欄位(RES)可指示空白或空資源。應注意可以頻分多工(FDM)或時 分多工(TDM)方式或FDM及/或TDM之組合來多工PRACH前置和基於競爭之SR訊息。
第6圖也繪示PRACH傳輸信號格式604。亦即，PRACH信號結構604(其可類似於及/或相同於PRACH傳輸信號格式602)可包括循環前綴(CP)、PRACH基頻序列(SEQ)，且可包括資料。第一部分可以是如第6圖中指示為「PRACH」的PRACH信號，且可基於前置索引k，且第二部分可以是指示為「Msg」的訊息信號。應注意「Msg」部分再次包括CP的原因是為了降低符元間干擾，其來自多路徑衰減通道。第一PRACH信號可能對Msg具有干擾。Msg具有與在每個ODFM符元之前之CP相同的動機。又，可在第12圖中描繪壓縮之前的訊息格式。
例如，在一態樣中，可在PRACH信號中的保留資源中傳送SR訊息。第7圖繪示依照實例之低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸結構格式的表格700(例如，表格1)。亦即，第7圖的表格700包括PRACH結構格式形式的標頭0-3、時間Ts(例如，Ts=1/(15000x2048)秒)中的循環前綴(CP)、時間Ts中的SEQ、保留資源、及可用於資料之OFDM符元的數量。換言之，第7圖的表格700總結用於不同PRACH格式之SR訊息傳輸之可用OFDM符元的數量。
例如，針對PRACH格式0，可使用1個OFDM符元用於SR訊息傳輸。應注意此選項可能適用於 同步的UE，其可利用所保留的資源用於SR訊息。針對PRACH格式1，可使用7個OFDM符元用於SR訊息傳輸。針對PRACH格式2，可使用2個OFDM符元用於SR訊息傳輸。對於PRACH格式3，可使用10個OFDM符元用於SR訊息傳輸。可基於系統要求使用其它數量的OFDM符元用於SR訊息傳輸。
現在回到第8圖，描繪用於低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸結構的第一選項800。更具體來說，SR訊息酬載可加至RES位置中，且SR訊息酬載偏移類型可經由MIB、SIB、及/或UE特定專用RRC發信被eNodeB配置。如第8圖所示，基於競爭之SR傳輸的三個類型可被定義為1)類型0，其可指示不需要樣本偏移(例如，第8圖中的CP和資料緊跟著SEQ)，2)類型1，其可指示SR訊息酬載可位在RES區的中間(例如，CP和資料是在鄰近於SEQ的兩個空資源之間；及3)類型2，其可表示SR訊息酬載可位在基頻信號的尾端。對於三種類型之基於競爭之SR傳輸之何者的決定可以是胞元特定或UE特定的配置。此外，佔用的OFDM符元編號可能被配置，並可在[1，L]之範圍，其中L是如表格1中所定義之資料的可用OFDM符元之編號。
在一態樣中，可在PRACH前置之後的後續子幀中傳送SR訊息。對於此選項，eNB可在一個幀內的不連續子幀中配置PRACH傳輸。例如，針對PRACH格式0(例如，第8圖的PRACH格式0)，eNB可使用PRACH 配置#12來配置PRACH傳輸(例如，可在一個幀內的子幀#0、2、4、6、8中傳送PRACH)。可在一個幀內的子幀#1、3、5、7、及9中傳送SR訊息。
取決於SR訊息的酬載大小，可在PRACH傳輸之後的隨後子幀中定義多個潛在資源(或SR傳輸機會)。例如，若SR訊息的酬載大小是較大的(例如，7個位元組+24個位元CRC，如第12B圖所示)，則SR傳輸在頻域中可跨越1個OFDM符元和6個實體資源區塊(PRB)。分配用於SR傳輸之資源元件(RE)的數量可以是72，以15kHz子載波間隔。在另一態樣中，若SR訊息的酬載大小是較小的(例如，3個位元組+24個位元CRC，如第12C圖所示)，則SR傳輸在頻域中可跨越1個OFDM符元和第2個PRB。分配用於SR傳輸之RE的數量可以是24，以15kHz子載波間隔。
在又一態樣中，可對SR訊息傳輸使用1.25kHz子載波間隔。在此情況中，SR傳輸可跨越1個子幀，且局部及/或分佈式傳輸可用於SR訊息傳輸。例如，若SR訊息傳輸佔用72個RE，則子載波索引#0、12、24、等等可用於一個SR訊息機會，如第9圖所示，繪示使用1.25kHz子載波間隔的低延遲實體隨機存取通道(PRACH)排程請求(SR)訊息傳輸900。應注意在此情況下，可認為總共12個SR傳輸機會。應注意使用1.25kHz子載波間隔選項可被採用於不同步和同步方案。對於使用15kHz子載波間隔中，UE可按照用於SR訊息傳輸 的下行鏈路時序(例如，用於PRACH的傳輸時序，且可對齊SR訊息)。應注意在目前LTE配置中，SR只被允許在一些子幀中週期性地傳送。例如，它可僅在每個幀的子幀5中傳送。在當使用15kHz子載波間隔的情況下，可減少資源或SR傳輸機會的數量。尤其是，在時域中，可將2個OFDM符元聚集在一起用於SR傳輸機會。
第10圖繪示用於低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸結構的第二選項1000。亦即，第10圖繪示用於使用其中可對SR訊息傳輸使用15kHz子載波間隔的實例A)和其中可對SR訊息傳輸使用1.255kHz子載波間隔的實例B)之非同步情境之低延遲之基於競爭之SR結構的實例。應注意可在第二選項1000中延伸子載波間隔的其他頻寬。
在一態樣中，可在鄰近於PRACH前置之PRB中傳送SR訊息。因此，額外N個PRB可被分配鄰近於PRACH前置，但不包括PUCCH區域，由此N可以是正整數，且經由MIB、SIB、及/或UE特定專用RRC發信由更高層預定義及/或配置。此外，這些N個PRB可取決於PRACH傳輸的配置而位在PRACH前置的一側或兩側。
在一態樣中，PRACH前置在頻域中可跨越6個PRB。此外，PRACH可使用保護頻帶以避免在前置邊緣的資料干擾。用於PRACH傳輸之子載波間隔可以是1.25kHz，且未使用子載波的長度可以是25。同樣地，為了避免在PRACH前置邊緣的干擾，保護頻帶可用於基於 競爭的SR傳輸。在一實例中，未使用子載波的數量也可以是25。
第11圖繪示依照實例之用於低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸結構的第三選項1100。亦即，第11圖繪示當在PRACH前置之上側為SR訊息傳輸分配1個額外PRB時的基於競爭之SR設計的一個實例。如第11圖所示，未使用的子載波(例如，「未使用」)可被保留用於保護頻帶。在此實例中，分配給SR訊息傳輸之RE的數量可以是144。應注意在此情況下，RE的總數量可以是1008用於7個PRB，其由於可對接收器使用相同快速傅立葉轉換(FFT)尺寸(即，1024)之事實而可允許eNB實作。
取決於SR訊息的酬載尺寸，可在1個PRB內定義多個資源。例如，若SR訊息的酬載尺寸是小的(例如，3個位元組+24個位元CRC，如第12C圖)，則可定義至少2個SR訊息傳輸機會(例如，如2或3的SR訊息傳輸機會)。
現在回到SR訊息結構格式和資源映射架構，第12圖繪示依照實例之低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸結構的酬載結構1200。第12圖描繪潛在SR訊息酬載結構，其分別可以是A)具有MAC標頭的短BSR結構、B)具有MAC標頭的長BSR結構、C)沒有MAC標頭的短BSR結構、及D)沒有MAC標頭的長BSR結構。
尤其是，在一實例中，對於基於短BSR之結構，用於SR訊息的位元數量可以是40，而對於基於長BSR之結構，位元的數量可以是56。SR訊息中的位元之實際數量可取決於系統需求。
酬載尺寸可減少到包含用於上行鏈路傳輸的關鍵資訊(例如，酬載尺寸可減少到只包含關鍵資訊)。例如，在SR訊息中，可能只包括C-RNTI或UE ID的一部分。短BSR結構也可包含邏輯通道識別符(LCID)。緩衝器尺寸也可能包括在SR訊息中。
在一態樣中，也提出可在SR訊息中包括用於PRACH傳輸的序列識別符(ID)的技術。序列ID的包括可協助eNB識別PRACH傳輸和關聯之SR訊息之間的連結。
在另一態樣中，也可包括用於隨後上行鏈路傳輸的資源分配。在此情況中，例如，eNB可能只需要發送肯定應答/否定應答(ACK/NACK)反饋至UE。用於ACK，UE可在所請求的資源中傳送上行鏈路資料。
在一態樣中，用於循環冗餘碼(CRC)，可基於SR酬載及/或可被附加到SR訊息之酬載的標頭來計算8、16或24個同位檢查位元。例如，CRC碼產生器可具有以多項式次數8、12、16和24的四個產生器多項式及產生器多項式gCRC8(D)、gCRC16(D)、gCRC24A(D)及gCRC24B(D)之其一者，其中：gCRC8(D)=1+D+D3+D4+D7+D8 (1), gCRC16(D)=1+D5+D12+D16 (2),gCRC24A(D)=1+D+D3+D4+D5+D6+D7+D8+D10+D11+D14+D17+D18+D23+D24, (3)，及gCRC24B(D)=1+D+D5+D23+D24 (4)。
在一態樣中，用於通道編碼和速率匹配，去尾迴旋碼(TBCC)或渦輪碼(TC)可被採用於SR訊息的通道編碼。由於當酬載尺寸是較小時TBCC優於TC，因此可對SR訊息再使用現有的TBCC。在通道編碼之後，可進行速率匹配以在一個SR傳輸機會內填寫可用的RE。
在另一態樣中，在通道編碼和速率匹配之後，可進行擾亂操作以隨機化任何干擾，例如在UE和eNB之間的干擾。為了擾亂序列的初始化，可考慮下列選項。在一態樣中，擾亂序列可以下列初始化 其中是胞元ID。在另一態樣中，擾亂種子可定義為胞元ID、及/或幀索引及/或子幀索引及/或OFDM符元編號的函式，即 ，或 其中nFrame是幀編號，nSF是子幀索引且nsymbol是一個子幀內的OFDM符元索引。在一態樣中，擾亂種子可給定為： 在一態樣中，為了確保穩固接收SR訊息，可使用使用二進制相移鍵控(BPSK)或四相相移鍵控(QPSK)的調變和編碼架構。此外，可對SR訊息傳輸使用單載波頻分多重存取(SC-FDMA)或正交頻分多重存取(OFDMA)架構。
用於資源映射架構，如上所提到的，可根據用於多工PRACH前置和SR訊息之SR訊息酬載尺寸和選項來定義多個SR傳輸機會。可考量幾個選項以將SR訊息映射至傳輸資源。在一態樣中，UE可隨機選擇用於傳輸SR訊息的SR傳輸機會。在另一態樣中，UE可鏈結SR傳輸至PRACH前置簽名。應注意當UE傳送PRACH前置時，UE以特定樣式傳送且此特定樣式可稱為「簽名」。在每個LTE胞元中，總共有64個PRACH前置簽名可用且UE隨機地選擇這些簽名之其一者。
例如，UE可在pthSR傳輸機會中傳送SR訊息，藉此p可定義為用於PRACH傳輸的序列ID之函式，其可被定義為：p=f(IPRACH) (10)，其中IPRACH是用於PRACH傳輸的序列ID。在另外態樣中，PRACH可攜帶用於SR訊息的某些資訊。在一實例中，PRACH可能攜帶用於SR訊息的至多6個位元資訊。在另一實例中，可在PRACH中攜帶用於SR訊息的3位元資訊。
第12圖也可描繪在壓縮操作之前的SR訊息。可藉由UE隨機地選擇前置索引k用於基於競爭的存取。在一態樣中，可基於BSR、C-RNTI、和用於實體隨機存取通道(PRACH)傳輸之子幀#(n)並當產生SR信號時計算前置索引k，如在第6圖所示。例如，前置索引產生可根據等式：k(i)=(b(i)+c(i))mod2 (11)，其中k(i)指示k中的「第i個」位元，b(i)是緩衝器尺寸指示器(BSI)，c(i)表示擾亂序列，其可基於關聯於目前SR訊息、子幀#(n)、及胞元ID的C-RNTI來產生。例如，在一態樣中，c(i)產生可以是cinit的初始值，其可以與PUSCH相同，其可能使用等式： 其中nRNTI是C-RNTI的值，nsf表示幀內的子幀索引，且是指胞元ID。
由於總共有64個前置索引，因此總共可以有6個位元用於緩衝器尺寸指示器(BSI)傳輸。可使用6個位元BSI以指示用於邏輯通道群組(LCG)的全部緩衝器尺寸，且預定值可用於緩衝器尺寸指示器。替代地，也可使用在多個隨機存取(RA)前置中的前置索引。BSI位元數可取決於隨機存取(RA)前置之數量的配置。因此，可使用至少4個前置索引。可預先決定由BSI採用的值(其可具有預定指示)及/或可使用用於BSI之高層配置作為BSI的值。
如第12圖所示，用於C)沒有MAC標頭的短BSR結構和D)沒有MAC標頭的長BSR結構，MAC標頭不再需要用於SR訊息傳輸，因為傳輸格式在eNB與UE之間是透明的。因此，新的SR訊息可能只含有使用C)沒有MAC標頭的短BSR結構和D)在第12圖中沒有MAC標頭的長BSR結構之格式的C-RNTI。
在一態樣中，可藉由CRC序列(如可與PUSCH相同的CRC序列)編碼SR訊息。替代地，為了實現較低的編碼率，可使用更短的CRC序列，例如，8位元CRC序列。以這種方式，最大編碼率可等於24/144=0.1667，其相較於先前SR訊息格式可以增進70百分比(%)。在一態樣中，eNB信號偵測程序可包括eNB，例如，首先偵測PRACH信號以獲得估計的通道和前置索引。C-RNTI可藉由基於估計的通道解碼SR訊息來被eNB獲得。緩衝器尺寸可藉由解擾前置索引來被eNB獲得。
第13圖繪示依照實例之用於傳送低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸的流程圖1300。第13圖描繪依照實例之例如可操作以執行低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸之使用者設備(UE)的功能性。功能性1300可被實作為方法或功能性1300可執行成機器上的指令，其中指令包括在至少一電腦可讀媒體或一個非暫態機器可讀儲存媒體上。一或多個處理器和記憶體可配置以根據用於實體隨機存取 通道(PRACH)傳輸的胞元無線電網路暫時識別符(C-RNTI)、胞元識別(ID)、及子幀#(n)來計算擾亂循環冗餘碼(CRC)序列，其中n為子幀編號，如在方塊1310中。一或多個處理器和記憶體可配置以判定目前緩衝器尺寸和緩衝器尺寸索引(BSI)，如在方塊1320中。一或多個處理器和記憶體可配置以使用BSI和擾亂CRC序列來計算PRACH前置索引用於產生排程請求(SR)訊息，如在方塊1330中。亦即，可使用BSI和擾亂CRC序列來計算PRACH前置索引。一或多個處理器和記憶體可配置以傳送具有SR訊息的PRACH信號，如在方塊1340中。
第14圖繪示依照實例之用於產生低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸的流程圖1400。第14圖描繪依照實例之例如可操作以執行低延遲實體隨機存取通道(PRACH)排程請求(SR)傳輸之使用者設備(UE)的功能性。功能性1400可被實作為方法或功能性1400可執行成機器上的指令，其中指令包括在至少一電腦可讀媒體或一個非暫態機器可讀儲存媒體上。一或多個處理器和記憶體可配置以根據用於實體隨機存取通道(PRACH)傳輸的胞元無線電網路暫時識別符(C-RNTI)、胞元識別(ID)、及子幀#(n)來計算擾亂循環冗餘碼(CRC)序列，其中n為子幀編號，如在方塊1410中。一或多個處理器和記憶體可配置以檢查目前緩衝器尺寸和固定緩衝器尺寸索引(BSI)，如在方塊1420 中。一或多個處理器和記憶體可配置以使用固定BSI和擾亂CRC序列來計算PRACH前置索引用於產生排程請求(SR)訊息，如在方塊1430中。亦即，可使用固定BSI和擾亂CRC序列來計算PRACH前置索引。一或多個處理器和記憶體可配置以產生PRACH和SR訊息信號用於PRACH傳輸，如在方塊1440中。
應注意下列之各者可包括在第14圖中。換言之，下列之各者可能包括在每個動作中及/或與第14圖所述之一或多個動作結合。例如，SR訊息可位在與時域多工中之PRACH相同的資源區塊(RB)。可基於單載波頻分多重存取(SC-FDMA)或正交頻分多重存取(OFDMA)來產生SR訊息。SR訊息可在時域中被映射至PRACH子幀的保留資源。eNB可能藉由具有訊息偏移指示器的較高層發信來配置訊息位置。SR訊息可具有指示不需要樣本偏移的類型0格式；指示SR訊息之酬載位在保留區之中間的的類型1格式；表示SR訊息之酬載可位在基頻信號之尾端的類型2格式。SR訊息酬載可包含MAC標頭、SR、短緩衝器狀態報告(BSR)或長BSR、和UE的胞元無線電網路暫時識別符(C-RNTI)。又，SR時間窗可由eNodeB配置用於SR訊息。在一態樣中，若UE沒有根據SR時間窗在定義尺寸的子幀內被排程，則UE會在下個PRACH傳輸子幀重新傳送具有PRACH的先前訊息。在一態樣中，UE可從eNB接收含有UE之C-RNTI的隨機存取回應(RAR)以解決競爭。若UE在 RAR中偵測到UE的C-RNTI，則UE可認為UE的SR訊息會被eNB成功地解碼。替代地，若UE在RAR中未偵測到UE的C-RNTI，則UE可認為UE的SR訊息不被成功地解碼。
替代地，SR訊息的實體資源區塊可被分配為與PRACH信號相同的PRB，且以時域多工方式。可基於SR訊息來產生PRACH信號的前置索引。前置索引產生可基於SR訊息內容、胞元ID、子幀編號(例如，子幀編號為#(n))和無線電網路暫時識別符(RNTI)。可基於SC-FDMA或OFDMA波形產生SR訊息。
在一態樣中，UE可傳送與PRACH信號關聯的SR訊息以與BSR及/或BSI一起發送UE的SR訊息。可在與PRACH信號相關聯的訊息中暗中傳送SR訊息。可在SR訊息的訊息部分中傳送UE的C-RNTI。可在PRACH前置索引中暗中傳送UE的BSR。若(RA)前置的RRC信號元件數量被配置有短值，則BSI可用以產生前置索引，而不是BSR。前置索引可基於擾亂序列(其可能由胞元ID產生)、C-RNTI、及子幀編號來產生。
在一態樣中，eNB可基於與PRACH信號相關聯的訊息來解碼BSR和C-RNTI。eNB可基於PRACH信號來偵測前置索引和頻域通道，接著從資料部分解碼C-RNTI，最後基於前置索引和解碼的C-RNTI解碼BSR或BSI。
第15圖繪示依照實例之可操作以藉由演進節 點(eNB)進行減少用於基於競爭之排程請求(SR)的延遲之使用者設備(UE)的功能性1500。功能性1500可被實作為方法或功能性1500可執行成機器上的指令，其中指令包括在至少一電腦可讀媒體或一個非暫態機器可讀儲存媒體上。一或多個處理器和記憶體可配置以選擇用於實體隨機存取通道(PRACH)傳輸的PRACH前置索引，如在方塊1510中。一或多個處理器和記憶體可配置以與SR訊息一起多工PRACH前置索引，SR訊息含有用於PRACH傳輸的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)，如在方塊1520中。一或多個處理器和記憶體可配置以處理與PRACH傳輸之子幀#(n)中的SR訊息多工的PRACH前置索引用於傳輸至增強節點B(eNB)，其中n為子幀編號，如在方塊1530中。
第16圖描繪依照實例之可操作以藉由使用者設備(UE)減少用於基於競爭之排程請求(SR)的延遲之演進節點B(eNB)的功能性1600。功能性1600可被實作為方法或功能性1600可執行成機器上的指令，其中指令包括在至少一電腦可讀媒體或一個非暫態機器可讀儲存媒體上。一或多個處理器和記憶體可配置以從UE接收具有與排程請求(SR)訊息多工之隨機選定PRACH前置索引的實體隨機存取通道(PRACH)傳輸，SR訊息含有在PRACH傳輸之子幀#(n)中的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)，其中n係子 幀編號，且eNodeB可操作以排程SR時間窗，如在方塊1610中。一或多個處理器和記憶體可配置以處理包含C-RNTI的隨機存取回應(RAR)用於傳輸至UE以解決基於競爭的SR，如在方塊1620中。
第17圖繪示依照實例之無線裝置(例如，UE)的圖1700。第17圖提出無線裝置的示範說明，如使用者設備(UE)、行動站(MS)、行動無線裝置、行動通訊裝置、平板電腦、手持裝置、或其它類型的無線裝置。在一態樣中，無線裝置可包括天線、觸敏式顯示螢幕、揚聲器、麥克風、圖形處理器、應用處理器、內部記憶體、非揮發性記憶體埠、及其組合之至少一者。
無線裝置可包括配置以與節點或傳輸站(如基地台(BS)、演進節點B(eNB)、基頻單元(BBU)、遠端無線電頭(RRH)、遠端無線電設備(RRE)、中繼站(RS)、無線電設備(RE)、遠端無線電單元(RRU)、中央處理模組(CPM)、或其它類型的無線電廣域網路(WWAN)存取點)通訊的一或多個天線。無線裝置可被配置以使用包括3GPP LTE、WiMAX、高速封包存取(HSPA)、藍牙、和WiFi之至少一無線通訊標準來通訊。無線裝置可使用用於每個無線通訊標準的單獨天線或用於多個無線通訊標準的共享天線來通訊。無線裝置可在無線區域網路(WLAN)、無線個人區域網路(WPAN)、及/或WWAN中通訊。行動裝置可包括儲存媒體。在一態樣中，儲存媒體可關聯於及/或與應用處理 器、圖形處理器、顯示器、非揮發性記憶體埠、及/或內部記憶體通訊。在一態樣中，應用處理器和圖形處理器是儲存媒體。
如本文所使用，「電路」之詞可指一部分之，或包括專用積體電路(ASIC)、電子電路、處理器(共享、專用、或群組)、及/或記憶體(共享、專用、或群組)，其執行提供所述之功能的一或更多軟體或韌體程式、組合邏輯電路、及/或其他適當的硬體元件。在一些態樣中，電路能實作在一或多個軟體或韌體模組中，或關聯於電路的功能能藉由一或多個軟體或韌體模組實作。在一些態樣中，電路可包括至少部分可操作在硬體中的邏輯。
第18圖繪示針對一態樣之使用者設備(UE)裝置1800的示範元件。在一些態樣中，UE裝置1800可包括至少如所示地耦接在一起的應用電路1802、基頻電路1804、射頻(RF)電路1806、前端模組(FEM)電路1808和一或多個天線1810。
應用電路1802可包括一或多個應用處理器。例如，應用電路1802可包括例如但不限於一或多個單核心或多核心處理器的電路。處理器可包括通用處理器和專用處理器(例如，圖形處理器、應用處理器、等等)的任何組合。處理器可耦接於及/或可包括儲存媒體1812，並可配置以執行儲存在儲存媒體1812中的指令以使各種應用程式及/或操作系統能在系統上運行。
基頻電路1804可包括例如但不限於一或多個單核心或多核心處理器的電路。基頻電路1804可包括一或多個基頻處理器及/或控制邏輯以處理從RF電路1806之接收信號路徑接收的基頻信號，並產生用於RF電路1806之傳送信號路徑的基頻信號。基頻處理電路1804可與應用電路1802連接用於產生並處理基頻信號並用於控制控制RF電路1806的操作。例如，在一些態樣中，基頻電路1804可包括第二代(2G)基頻處理器1804a、第三代(3G)基頻處理器1804b、第四代(4G)基頻處理器1804c、及/或用於其他現有世代、開發中或將在未來開發之世代(例如，第五代(5G)、6G、等等)的其它基頻處理器1804d。基頻電路1804(例如，一或多個基頻處理器1804a-d)能夠處理各種無線電控制功能，其能經由RF電路1806與一或多個無線電網路通訊。無線電控制功能可包括但不限於信號調變/解調、編碼/解碼、無線電頻移、等等。在一些態樣中，基頻電路1804的調變/解調電路可包括快速傅立葉轉換(FFT)、預編碼、及/或星座映射/解映射功能。在一些態樣中，基頻電路1804的編碼/解碼電路可包括迴旋、去尾迴旋、渦輪、維特比、及/或低密度同位檢查(LDPC)編碼器/解碼器功能。調變/解調和編碼器/解碼器功能的態樣不限於這些實施例，並在其他態樣中可包括其他適當功能。
在一些態樣中，基頻電路1804可包括協定堆疊的元件，例如，演進通用陸地無線電存取網路 (EUTRAN)協定之元件，包括例如實體(PHY)、媒體存取控制(MAC)、無線電鏈路控制(RLC)、封包資料聚集協定(PDCP)、及/或無線電資源控制(RRC)元件。基頻電路1804的中央處理單元(CPU)1804e可配置以運行協定堆疊的元件用於PHY、MAC、RLC、PDCP及/或RRC層的發信。在一些態樣中，基頻電路可包括一或多個音頻數位信號處理器(DSP)1804f。音頻DSP 1804f可包括用於壓縮/解壓縮和迴聲消除的元件，並在其他態樣中可包括其他適當的處理元件。基頻電路的組件可適當地結合在單晶片、單晶片組中，或在一些態樣中設置在相同的電路板上。在一些態樣中，基頻電路1804和應用電路1802的一些或全部構成組件可一起實作例如在系統晶片(SOC)上。
在一些態樣中，基頻電路1804可提供與一或多個無線電技術相容的通訊。例如，在一些態樣中，基頻電路1804可支援與演進通用陸地無線電存取網路(EUTRAN)及/或其它無線城域網路(WMAN)、無線區域網路(WLAN)、無線個人區域網路(WPAN)通信。在基頻電路1804配置以支援一個以上之無線協定的無線電通訊之態樣可稱為多模式基頻電路。
RF電路1806能夠透過非固體介質使用調變的電磁輻射與無線網路通訊。在各種態樣中，RF電路1806可包括切換器、濾波器、放大器等以促進與無線網路通訊。RF電路1806可包括接收信號路徑，其可包括用以下 轉換從FEM電路1808接收的RF信號並提供基頻信號至基頻電路1804的電路。RF電路1806也可包括傳送信號路徑，其可包括用以上轉換由基頻電路1804提供的基頻信號，並提供RF輸出信號至FEM電路1808用於傳輸的電路。
在一些態樣中，RF電路1806可包括接收信號路徑和傳送信號路徑。RF電路1806的接收信號路徑可包括混合器電路1806a、放大器電路1806b和濾波器電路1806c。RF電路1806的傳送信號路徑可包括濾波器電路1806c和混合器電路1806a。RF電路1806也可包括合成器電路1806d，用於合成用於被接收信號路徑和傳送信號路徑之混合器電路1806a使用的頻率。在一些態樣中，接收信號路徑的混合器電路1806a可配置以基於由合成器電路1806d所提供之合成頻率來下轉換從FEM電路1808接收的RF信號。放大器電路1806b可配置以放大下轉換信號且濾波器電路1806c可以是配置以從下轉換信號中移除不需要之信號以產生輸出基頻信號的低通濾波器(LPF)或帶通濾波器(BPF)。輸出基頻信號可以被提供給基頻電路1804用於進一步處理。在一些態樣中，輸出基頻信號可以是零頻基頻信號，雖然這不是必要。在一些態樣中，接收信號路徑的混合器電路1806a可包含被動混合器，雖然態樣的範圍並不局限於此方面。
在一些態樣中，傳送信號路徑的混合器電路1806a可配置以基於由合成器電路1806d提供的合成頻率 來上轉換輸入基頻信號以產生用於FEM電路1808的RF輸出信號。基頻信號可由基頻電路1804提供並可被濾波器電路1806c過濾。濾波器電路1806c可包括低通濾波器(LPF)，雖然態樣的範圍並不局限於此方面。
在一些態樣中，接收信號路徑的混合器電路1806a和傳送信號路徑的混合器電路1806a可包括兩個或更多混合器，並可分別配置用於正交下轉換及/或上轉換。在一些態樣中，接收信號路徑的混合器電路1806a和傳送信號路徑的混合器電路1806a可包括兩個或更多混合器，並可配置用於鏡像抑制(例如，Hartley鏡像抑制)。在一些態樣中，接收信號路徑的混合器電路1806a和混合器電路1806a可分別配置用於直接下轉換及/或直接上轉換。在一些態樣中，接收信號路徑的混合器電路1806a和傳送信號路徑的混合器電路1806a可配置用於超外差操作。
在一些態樣中，輸出基頻信號和輸入基頻信號可以是類比基頻信號，雖然態樣的範圍並不局限於此方面。在一些替代態樣中，輸出基頻信號和輸入基頻信號可以是數位基頻信號。在這些替代態樣中，RF電路1806可包括類比至數位轉換器(ADC)和數位至類比轉換器(DAC)電路且基頻電路1804可包括數位基頻介面以與RF電路1806通訊。
在一些雙模式實施例中，可提供獨立的無線電IC電路用於為每個頻譜處理信號，雖然實施例的範圍 並不局限於此方面。
在一些實施例中，合成器電路1806d可以是分數N合成器或分數N/N+1合成器，雖然實施例的範圍並不局限於此方面，因為其它類型的頻率合成器可以是適當的。例如，合成器電路1806d可以是△-Σ合成器、倍頻器、或包含具有除頻器的鎖相迴路之合成器。
合成器電路1806d可配置以基於頻率輸入和除頻器控制輸入來合成用於被RF電路1806之混合器電路1806a使用的輸出頻率。在一些實施例中，合成器電路1806d可以是分數N/N+1合成器。
在一些實施例中，頻率輸入可由電壓控制振盪器(VCO)提供，雖然這並非必要。除頻器控制輸入可取決於所需的輸出頻率而被基頻電路1804或應用處理器1802提供。在一些實施例中，可基於由應用處理器1802所指示的通道從查找表確定除頻器控制輸入(例如，N)。
RF電路1806的合成器電路1806d可包括除頻器、延遲鎖相迴路(DLL)、多工器和相位累加器。在一些實施例中，除頻器可以是雙模除頻器(DMD)且相位累加器可以是數位相位累加器(DPA)。在一些實施例中，DMD可配置以將輸入信號除以N或N+1(例如，基於執行)以提供分數除頻比。在一些示範實施例中，DLL可包括一組串聯、可調諧的延遲元件、相位偵測器、電荷泵及D型正反器。在這些實施例中，延遲元件可配置以將VCO 週期斷成相位的Nd個相等封包，其中Nd為延遲線中的延遲元件之數量。以這種方式，DLL提供負反饋以幫助確保通過延遲線的總延遲是一個VCO週期。
在一些實施例中，合成器電路1806d可配置以產生載波頻率作為輸出頻率，而在其他實施例中，輸出頻率可以是載波頻率的倍數(例如，載波頻率的兩倍，載波頻率的四倍)，並結合正交產生器和除頻器電路地使用以在彼此具有多個不同相位的載波頻率產生多個信號。在一些實施例中，輸出頻率可以是LO頻率(fLO)。在一些實施例中，RF電路1806可包括IQ/極性轉換器。
FEM電路1808可包括接收信號路徑，其可包括配置以對從一或多個天線1810接收的RF信號操作、放大所接收的信號並提供接收之信號的放大版本至RF電路1806用於進一步處理的電路。FEM電路1808也可包括傳送信號路徑，其可包括配置以放大用於被RF電路1806提供之傳輸的信號用於被一或多個天線1810傳輸的電路。
在一些實施例中，FEM電路1808可包括TX/RX切換器用以在傳送模式和接收模式操作之間切換。FEM電路可包括接收信號路徑和傳送信號路徑。FEM電路的接收信號路徑可包括低雜訊放大器(LNA)以放大接收的RF信號並提供經放大的接收RF信號作為輸出(例如，至RF電路1806)。FEM電路1808的傳送信號路徑可包括功率放大器(PA)以放大輸入RF信號(例如，由 RF電路1806提供)，和一或多個濾波器以產生RF信號用於後續傳輸(例如，藉由一個或多個天線1810)。
在一些實施例中，UE裝置1800可包括額外元件，例如，記憶體/儲存器、顯示器、照相機、感測器、及/或輸入/輸出(I/O)介面。
第19圖繪示依照實例之節點1910(例如，eNB及/或服務GPRS支援節點)和無線裝置(例如，UE)的圖1900。節點可包括基地台(BS)、節點B(NB)、演進節點B(eNB)、基頻單元(BBU)、遠端無線電頭(RRH)、遠端無線電設備(RRE)、遠端無線電單元(RRU)、或中央處理模組(CPM)。在一態樣中，節點可以是服務GPRS支援節點。節點1910可包括節點裝置1912。節點裝置1912或節點1910可配置以與無線裝置1920通訊。節點裝置1912可配置以實作所述的技術。節點裝置1912可包括處理模組1914和收發器模組1916。在一態樣中，節點裝置1912可包括形成用於節點1910之電路1918的收發器模組1916和處理模組1914。在一態樣中，收發器模組1916和處理模組1914可形成節點裝置1912的電路。處理模組1914可包括一或多個處理器和記憶體。在一實施例中，處理模組1922可包括一或多個應用處理器。收發器模組1916可包括收發器和一或多個處理器和記憶體。在一實施例中，收發器模組1916可包括基頻處理器。
無線裝置1920可包括收發器模組1924和處 理模組1922。處理模組1922可包括一或多個處理器和記憶體。在一實施例中，處理模組1922可包括一個或多個應用處理器。收發器模組1924可包括收發器和一或多個處理器和記憶體。在一實施例中，收發器模組1924可包括基頻處理器。無線裝置1920可配置以實作所述的技術。節點1910和無線裝置1920也可包括一個或多個儲存媒體，如收發器模組1916、1924及/或處理模組1914、1922。
實例
下列實例關於特定技術實施例並指出可在實現上述實施例中使用或以其他方式合併的特定特徵、元件、或步驟。
實例1包括一種使用者設備(UE)的裝置，UE配置以減少用於基於競爭之排程請求(SR)的延遲，裝置包含一或多個處理器和記憶體，配置以：選擇用於實體隨機存取通道(PRACH)傳輸的PRACH前置索引；與SR訊息一起多工PRACH前置索引，SR訊息含有用於PRACH傳輸的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)；及處理與PRACH傳輸之子幀#(n)中的SR訊息多工的PRACH前置索引用於傳輸至增強節點B(eNB)，其中n為子幀編號。
實例2包括實例1的裝置，其中一或多個處理器和記憶體更配置以處理與在子幀#(n+k)中之用於 PRACH傳輸之SR訊息多工的PRACH前置索引用於傳輸至eNB，其中k為正整數，其中k為藉由主資訊區塊(MIB)、系統資訊區塊(SIB)、或UE特定專用RRC發信的信號期間。
實例3包括實例1的裝置，其中一或多個處理器和記憶體更配置以處理在PRACH傳輸之保留PRACH資源中的SR訊息用於傳輸至eNB。
實例4包括實例1的裝置，其中一或多個處理器和記憶體更配置以在與時分中之PRACH傳輸相同的資源區塊(RB)映射PRACH前置索引和SR訊息。
實例5包括實例1的裝置，其中一或多個處理器和記憶體更配置以在時域分中將SR訊息映射至PRACH傳輸的保留PRACH資源。
實例6包括實例5的裝置，其中SR訊息根據具有SR訊息酬載在PRACH基頻序列(SEQ)之後沒有偏移的第一類型、在空PRACH資源的中間部分具有SR訊息酬載的第二類型、及在SEQ的尾端具有SR訊息酬載的第三類型被映射至保留PRACH資源。
實例7包括實例1的裝置，其中一或多個處理器和記憶體更配置以在SR訊息中包括媒體存取控制(MAC)標頭、SR、短BSR結構格式、長BSR結構格式、及C-RNTI。
實例8包括實例1的裝置，其中一或多個處理器和記憶體更配置以根據單載波頻分多重存取(SC- FDMA)操作或正交頻分多重存取(OFDMA)操作來產生PRACH前置索引和SR訊息。
實例9包括實例1的裝置，其中一或多個處理器和記憶體更配置以：處理包含從eNB接收的C-RNTI之隨機存取回應(RAR)以解決基於競爭的SR；及使用RAR以明確得到SR解碼狀態，其中當UE在RAR中偵測C-RNTI時判定SR訊息被eNB成功地解碼。
實例10包括實例1的裝置，其中一或多個處理器和記憶體更配置以在時分多工或頻分多工中與SR訊息一起多工PRACH前置索引。
實例11包括實例1的裝置，其中一或多個處理器和記憶體更配置以處理在子幀#(n)中的PRACH前置和在子幀#(n)之後續子幀中的SR訊息用於傳輸至eNB。
實例12包括實例1的裝置，其中一或多個處理器和記憶體更配置以包括一序列ID在SR訊息中用於PRACH傳輸。
實例13包括實例1的裝置，其中一或多個處理器和記憶體更配置以根據短BSR結構格式或長BSR結構格式來配置SR訊息。
實例14包括實例1的裝置，其中一或多個處理器和記憶體更配置以鏈結SR訊息和PRACH前置索引。
實例15包括實例1的裝置，其中一或多個處 理器和記憶體更配置以若UE不在SR時間窗內被排程則處理在下一個PRACH傳輸子幀的SR訊息用於重新傳輸至eNB。
實例16包括實例1的裝置，其中一或多個處理器和記憶體更配置以處理在PRACH前置索引中的BSR用於暗中傳送至eNB。
實例17包括實例1的裝置，其中一或多個處理器和記憶體更配置以根據緩衝器尺寸索引(BSI)或攪亂序列來產生PRACH前置索引。
實例18包括實例1的裝置，其中裝置包括天線、觸敏式顯示螢幕、揚聲器、麥克風、圖形處理器、應用處理器、內部記憶體、非揮發性記憶體埠、及其組合之至少一者。
實例19包括一種eNodeB的裝置，可操作以藉由使用者設備(UE)減少用於基於競爭之排程請求(SR)的延遲，裝置包含一或多個處理器和記憶體，配置以：處理從UE接收的實體隨機存取通道(PRACH)傳輸，具有與排程請求(SR)訊息多工的選定PRACH前置索引，SR訊息含有在PRACH傳輸之子幀#(n)中的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)，其中n係子幀編號，其中eNodeB可操作以排程SR時間窗；及處理包含C-RNTI的隨機存取回應(RAR)用於傳輸至UE以解決基於競爭的SR。
實例20包括實例19的裝置，更配置以處理 與SR訊息多工之從UE接收的PRACH前置索引用於在子幀#(n+k)中的PRACH傳輸，其中k係正整數，其中k為藉由主資訊區塊(MIB)、系統資訊區塊(SIB)、或UE特定專用RRC發信的信號期間。
實例21包括實例19的裝置，更配置以處理在PRACH傳輸的保留PRACH資源中之從UE接收的SR訊息。
實例22包括實例19的裝置，更配置以使用具有用於與SR訊息多工之PRACH前置索引的訊息偏移指示器的較高層信號來指示PRACH傳輸的PRACH資源之位置用於PRACH傳輸。
實例23包括實例19的裝置，更配置以配置在單一幀內之不連續子幀中的PRACH傳輸用於允許UE傳送在子幀#(n)中的PRACH前置索引和在子幀#(n)之後續子幀中的SR訊息。
實例24包括實例19的裝置，更配置以配置在單一幀內之連續子幀中的PRACH傳輸用於允許UE傳送在子幀#(n)中的PRACH前置索引和在子幀#(n)之後續子幀中的SR訊息。
實例25包括實例19的裝置，更配置以處理包含C-RNTI的隨機存取回應(RAR)以解決基於競爭的SR用於傳輸至UE以允許UE使用該RAR來明確得到SR解碼狀態。
實例26包括實例19的裝置，更配置以根據 PRACH傳輸來偵測PRACH前置索引和頻域通道並解碼C-RNTI及解碼BSR。
實例27包括實例19的裝置，更配置以基於PRACH信號偵測前置索引和頻域通道，接著解碼來自資料部分的C-RNTI，最後基於前置索引和解碼的C-RNTI來解碼BSR或緩衝器尺寸索引(BSI)。
實例28包括實例19的裝置，更配置以使用在SR訊息中的序列ID來識別PRACH傳輸與SR訊息之間的鏈結。
實例29包括實例19的裝置，更配置以若UE不在SR時間窗內被排程，則在下一個PRACH傳輸子幀處理從UE接收的SR訊息之重新傳輸。
實例30包括一種使用者設備(UE)的裝置，UE係配置以減少用於基於競爭之排程請求(SR)的延遲，裝置包含一或多個處理器和記憶體，配置以：根據用於實體隨機存取通道(PRACH)傳輸的胞元無線電網路暫時識別符(C-RNTI)、胞元識別(ID)、及子幀#(n)來計算擾亂循環冗餘碼(CRC)序列，其中n為子幀編號；判定目前緩衝器尺寸和緩衝器尺寸索引(BSI)；使用BSI和擾亂CRC序列來計算PRACH前置索引用於產生排程請求(SR)訊息；及傳送具有SR訊息的PRACH信號。
實例31包括實例30的裝置，其中一或多個處理器和記憶體更配置以根據緩衝器狀態報告(BSR)、 胞元無線電網路暫時識別符(C-RNTI)、胞元識別(ID)、及子幀#(n)來計算K PRACH前置索引用於產生排程請求(SR)訊息，其中K為正整數。
實例32包括一種使用者設備(UE)的裝置，UE係配置以減少用於基於競爭之排程請求(SR)的延遲，裝置包含一或多個處理器和記憶體，配置以：選擇用於實體隨機存取通道(PRACH)傳輸的PRACH前置索引；與SR訊息一起多工PRACH前置索引，SR訊息含有用於PRACH傳輸的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)；及處理與PRACH傳輸之子幀#(n)中的SR訊息多工的PRACH前置索引用於傳輸至增強節點B(eNB)，其中n為子幀編號。
實例33包括實例32的裝置，其中一或多個處理器和記憶體更配置以處理與在子幀#(n+k)中之用於PRACH傳輸之SR訊息多工的PRACH前置索引用於傳輸至eNB，其中k為正整數，其中k為藉由主資訊區塊(MIB)、系統資訊區塊(SIB)、或UE特定專用RRC發信的信號期間。
實例34包括實例32或33的裝置，其中一或多個處理器和記憶體更配置以處理在PRACH傳輸之保留PRACH資源中的SR訊息用於傳輸至eNB。
實例35包括實例32的裝置，其中一或多個處理器和記憶體更配置以在與時分中之PRACH傳輸相同的資源區塊(RB)映射PRACH前置索引和SR訊息。
實例36包括實例32或35的裝置，其中一或多個處理器和記憶體更配置以在時域分中將SR訊息映射至PRACH傳輸的保留PRACH資源。
實例37包括實例36的裝置，其中SR訊息根據具有SR訊息酬載在PRACH基頻序列(SEQ)之後沒有偏移的第一類型、在空PRACH資源的中間部分具有SR訊息酬載的第二類型、及在SEQ的尾端具有SR訊息酬載的第三類型被映射至PRACH的保留PRACH資源。
實例38包括實例32的裝置，其中一或多個處理器和記憶體更配置以在SR訊息中包括媒體存取控制(MAC)標頭、SR、短BSR結構格式、長BSR結構格式、及C-RNTI。
實例39包括實例32或38的裝置，其中一或多個處理器和記憶體更配置以根據單載波頻分多重存取(SC-FDMA)操作或正交頻分多重存取(OFDMA)操作來產生PRACH前置索引和SR訊息。
實例40包括實例32的裝置，其中一或多個處理器和記憶體更配置以：處理包含從eNB接收的C-RNTI之隨機存取回應(RAR)以解決基於競爭的SR；及使用RAR以明確得到SR解碼狀態，其中當UE在RAR中偵測C-RNTI時判定SR訊息被eNB成功地解碼。
實例41包括實例32或40的裝置，其中一或多個處理器和記憶體更配置以在時分多工或頻分多工中與SR訊息一起多工PRACH前置索引。
實例42包括實例32的裝置，其中一或多個處理器和記憶體更配置以處理在子幀#(n)中的PRACH前置和在子幀#(n)之後續子幀中的SR訊息用於傳輸至eNB。
實例43包括實例32或42的裝置，其中一或多個處理器和記憶體更配置以包括一序列ID在SR訊息中用於PRACH傳輸。
實例44包括實例32的裝置，其中一或多個處理器和記憶體更配置以根據短BSR結構格式或長BSR結構格式來配置SR訊息。
實例45包括實例32或44的裝置，其中一或多個處理器和記憶體更配置以鏈結SR訊息和PRACH前置索引。
實例46包括實例32的裝置，其中一或多個處理器和記憶體更配置以若UE不在SR時間窗內被排程則處理在下一個PRACH傳輸子幀的SR訊息用於重新傳輸至eNB。
實例47包括實例32或46的裝置，其中一或多個處理器和記憶體更配置以處理在PRACH前置索引中的BSR用於暗中傳送至eNB。
實例48包括實例32的裝置，其中一或多個處理器和記憶體更配置以根據緩衝器尺寸索引(BSI)或攪亂序列來產生PRACH前置索引。
實例49包括實例32或48的裝置，其中裝置 包括天線、觸敏式顯示螢幕、揚聲器、麥克風、圖形處理器、應用處理器、內部記憶體、非揮發性記憶體埠、及其組合之至少一者。
實例50包括一種eNodeB的裝置，可操作以藉由使用者設備(UE)減少用於基於競爭之排程請求(SR)的延遲，裝置包含一或多個處理器和記憶體，配置以：處理從UE接收的實體隨機存取通道(PRACH)傳輸，具有與排程請求(SR)訊息多工的選定PRACH前置索引，SR訊息含有在PRACH傳輸之子幀#(n)中的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)，其中n係子幀編號，其中eNodeB可操作以排程SR時間窗；及處理包含C-RNTI的隨機存取回應(RAR)用於傳輸至UE以解決基於競爭的SR。
實例51包括實例50的裝置，更配置以處理與SR訊息多工之從UE接收的PRACH前置索引用於在子幀#(n+k)中的PRACH傳輸，其中k係正整數，其中k為藉由主資訊區塊(MIB)、系統資訊區塊(SIB)、或UE特定專用RRC發信的信號期間。
實例52包括實例50或51的裝置，更配置以處理在PRACH傳輸的保留PRACH資源中之從UE接收的SR訊息。
實例53包括實例50的裝置，更配置以使用具有用於與SR訊息多工之PRACH前置索引的訊息偏移指示器的較高層信號來指示PRACH傳輸的PRACH資源 之位置用於PRACH傳輸。
實例54包括實例50或53的裝置，更配置以配置在單一幀內之不連續子幀中的PRACH傳輸用於允許UE傳送在子幀#(n)中的PRACH前置索引和在子幀#(n)之後續子幀中的SR訊息。
實例55包括實例50的裝置，更配置以配置在單一幀內之連續子幀中的PRACH傳輸用於允許UE傳送在子幀#(n)中的PRACH前置索引和在子幀#(n)之後續子幀中的SR訊息。
實例56包括實例50或55的裝置，更配置以處理包含C-RNTI的隨機存取回應(RAR)以解決基於競爭的SR用於傳輸至UE以允許UE使用RAR來明確得到SR解碼狀態。
實例57包括實例50的裝置，更配置以根據PRACH傳輸來偵測PRACH前置索引和頻域通道並解碼C-RNTI及解碼BSR。
實例58包括實例50或57的裝置，更配置以基於PRACH信號偵測前置索引和頻域通道，接著解碼來自資料部分的C-RNTI，最後基於前置索引和解碼的C-RNTI來解碼BSR或緩衝器尺寸索引(BSI)。
實例59包括實例50的裝置，更配置以使用在SR訊息中的序列ID來識別PRACH傳輸與SR訊息之間的鏈結。
實例60包括實例50或59的裝置，更配置以 若UE不在SR時間窗內被排程，則在下一個PRACH傳輸子幀處理從UE接收的SR訊息之重新傳輸。
實例61包括一種使用者設備(UE)的裝置，UE係配置以減少用於基於競爭之排程請求(SR)的延遲，裝置包含一或多個處理器和記憶體，配置以：根據用於實體隨機存取通道(PRACH)傳輸的胞元無線電網路暫時識別符(C-RNTI)、胞元識別(ID)、及子幀#(n)來計算擾亂循環冗餘碼(CRC)序列，其中n為子幀編號；判定目前緩衝器尺寸和緩衝器尺寸索引(BSI)；使用BSI和擾亂CRC序列來計算PRACH前置索引用於產生排程請求(SR)訊息；及處理具有SR訊息的PRACH信號用於傳輸至enodeB。
實例62包括實例61的裝置，其中一或多個處理器和記憶體更配置以根據緩衝器狀態報告(BSR)、胞元無線電網路暫時識別符(C-RNTI)、胞元識別(ID)、及子幀#(n)來計算K PRACH前置索引用於產生排程請求(SR)訊息，其中K為正整數。
實例63包括一種使用者設備(UE)的裝置，UE係配置以減少用於基於競爭之排程請求(SR)的延遲，裝置包含一或多個處理器和記憶體，配置以：選擇用於實體隨機存取通道(PRACH)傳輸的PRACH前置索引；與SR訊息一起多工PRACH前置索引，SR訊息含有用於PRACH傳輸的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)；及處理與PRACH傳 輸之子幀#(n)中的SR訊息多工的PRACH前置索引用於傳輸至增強節點B(eNB)，其中n為子幀編號。
實例64包括實例63的裝置，其中一或多個處理器和記憶體更配置以處理與在子幀#(n+k)中之用於PRACH傳輸之SR訊息多工的PRACH前置索引用於傳輸至eNB，其中k為正整數，其中k為藉由主資訊區塊(MIB)、系統資訊區塊(SIB)、或UE特定專用RRC發信的信號期間；處理在PRACH傳輸之保留PRACH資源中的SR訊息用於傳輸至eNB；配置以在與時分中之PRACH傳輸相同的資源區塊(RB)映射PRACH前置索引和SR訊息；或配置以在時域分中將SR訊息映射至PRACH傳輸的保留PRACH資源。
實例65包括實例63或64的裝置，其中SR訊息根據具有SR訊息酬載在PRACH基頻序列(SEQ)之後沒有偏移的第一類型、在空PRACH資源的中間部分具有SR訊息酬載的第二類型、及在SEQ的尾端具有SR訊息酬載的第三類型被映射至PRACH的保留PRACH資源。
在實例66中，實例63或本文所述之實例之任一者的主題可能更包括，其中一或多個處理器和記憶體更配置以：在SR訊息中包括媒體存取控制(MAC)標頭、SR、短BSR結構格式、長BSR結構格式、及C-RNTI；根據單載波頻分多重存取(SC-FDMA)操作或正交頻分多重存取(OFDMA)操作來產生PRACH前置索引 和SR訊息；處理包含從eNB接收的C-RNTI之隨機存取回應(RAR)以解決基於競爭的SR；使用RAR以明確得到SR解碼狀態，其中當UE在RAR中偵測C-RNTI時判定SR訊息被eNB成功地解碼；或在時分多工或頻分多工中與SR訊息一起多工PRACH前置索引。
在實例67中，實例63或本文所述之實例之任一者的主題可能更包括，其中一或多個處理器和記憶體更配置以：處理在子幀#(n)中的PRACH前置和在子幀#(n)之後續子幀中的SR訊息用於傳輸至eNB；包括一序列ID在SR訊息中用於PRACH傳輸；根據短BSR結構格式或長BSR結構格式來配置SR訊息；或鏈結SR訊息和PRACH前置索引。
在實例68中，實例63或本文所述之實例之任一者的主題可能更包括，其中一或多個處理器和記憶體更配置以：若UE不在SR時間窗內被排程則處理在下一個PRACH傳輸子幀的SR訊息用於重新傳輸至eNB；處理在PRACH前置索引中的BSR用於暗中傳送至eNB；根據緩衝器尺寸索引(BSI)或攪亂序列來產生PRACH前置索引；或根據緩衝器尺寸索引(BSI)或攪亂序列來產生PRACH前置索引。
在實例69中，實例63或本文所述之實例之任一者的主題可能更包括，其中裝置包括天線、觸敏式顯示螢幕、揚聲器、麥克風、圖形處理器、應用處理器、內部記憶體、非揮發性記憶體埠、及其組合之至少一者。
實例70包括一種eNodeB的裝置，可操作以藉由使用者設備(UE)減少用於基於競爭之排程請求(SR)的延遲，裝置包含一或多個處理器和記憶體，配置以：處理從UE接收的實體隨機存取通道(PRACH)傳輸，具有與排程請求(SR)訊息多工的選定PRACH前置索引，SR訊息含有在PRACH傳輸之子幀#(n)中的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)，其中n係子幀編號，其中eNodeB可操作以排程SR時間窗；及處理包含C-RNTI的隨機存取回應(RAR)用於傳輸至UE以解決基於競爭的SR。
實例71包括實例70之任一者的裝置，更配置以處理與SR訊息多工之從UE接收的PRACH前置索引用於在子幀#(n+k)中的PRACH傳輸，其中k係正整數，其中k為藉由主資訊區塊(MIB)、系統資訊區塊(SIB)、或UE特定專用RRC發信的信號期間。
實例72包括實例70或71的裝置，更配置以處理在PRACH傳輸的保留PRACH資源中之從UE接收的SR訊息。
在實例73中，實例70或本文所述之實例之任一者的主題可能更包括，更配置以：使用具有用於與SR訊息多工之PRACH前置索引的訊息偏移指示器的較高層信號來指示PRACH傳輸的PRACH資源之位置用於PRACH傳輸；配置在單一幀內之不連續子幀中的PRACH傳輸用於允許UE傳送在子幀#(n)中的PRACH前置索 引和在子幀#(n)之後續子幀中的SR訊息；或配置在單一幀內之連續子幀中的PRACH傳輸用於允許UE傳送在子幀#(n)中的PRACH前置索引和在子幀#(n)之後續子幀中的SR訊息。
在實例74中，實例70或本文所述之實例之任一者的主題可能更包括，更配置以：處理包含C-RNTI的隨機存取回應(RAR)以解決基於競爭的SR用於傳輸至UE以允許UE使用RAR來明確得到SR解碼狀態；根據PRACH傳輸來偵測PRACH前置索引和頻域通道並解碼C-RNTI及解碼BSR；基於PRACH信號偵測前置索引和頻域通道，接著解碼來自資料部分的C-RNTI，最後基於前置索引和解碼的C-RNTI來解碼BSR或緩衝器尺寸索引(BSI)；或使用在SR訊息中的序列ID來識別PRACH傳輸與SR訊息之間的鏈結。
在實例75中，實例70或本文所述之實例之任一者的主題可能更包括，更配置以若UE不在SR時間窗內被排程，則在下一個PRACH傳輸子幀處理從UE接收的SR訊息之重新傳輸。
在實例76中，實例70或本文所述之實例之任一者的主題可能更包括藉由使用者設備(UE)減少用於基於競爭之排程請求(SR)的延遲，裝置包含：用於從UE接收的實體隨機存取通道(PRACH)傳輸的工具，PRACH傳輸具有與排程請求(SR)訊息多工的選定PRACH前置索引，SR訊息含有在PRACH傳輸之子幀# (n)中的胞元無線電網路暫時識別符(C-RNTI)和緩衝器狀態報告(BSR)，其中n係子幀編號，其中eNodeB可操作以排程SR時間窗；及用於發送包含C-RNTI的隨機存取回應(RAR)至UE的工具以解決基於競爭的SR。
實例77包括一種裝置，用於減少用於基於競爭之排程請求(SR)的延遲，裝置包含用於根據用於實體隨機存取通道(PRACH)傳輸的胞元無線電網路暫時識別符(C-RNTI)、胞元識別(ID)、及子幀#(n)來計算擾亂循環冗餘碼(CRC)序列之工具，其中n為子幀編號；用於判定目前緩衝器尺寸和緩衝器尺寸索引(BSI)之工具；用於使用BSI和擾亂CRC序列來計算PRACH前置索引之工具用於產生排程請求(SR)訊息；及用於傳送具有SR訊息的PRACH信號之工具。
如本文所使用，「電路」之詞可指一部分之，或包括專用積體電路(ASIC)、電子電路、處理器(共享、專用、或群組)、及/或記憶體(共享、專用、或群組)，其執行提供所述之功能的一或更多軟體或韌體程式、組合邏輯電路、及/或其他適當的硬體元件。在一些態樣中，電路能實作在一或多個軟體或韌體模組中，或關聯於電路的功能能藉由一或多個軟體或韌體模組實作。在一些態樣中，電路可包括至少部分可操作在硬體中的邏輯。
各種技術、或其某些態樣或部分可能採取在有形媒體(如軟碟、唯讀光碟機(CD-ROM)、硬碟機、 非暫態電腦可讀儲存媒體、或任何其他機器可讀儲存媒體)中實作的程式碼(即，指令)之形式，其中當程式碼被載入至機器(如電腦)中且被其執行時，機器成為用於實行各種技術的裝置。電路能包括硬體、韌體、程式碼、可執行碼、電腦指令、及/或軟體。非暫態電腦可讀儲存媒體可以是不包括信號的電腦可讀儲存媒體。在程式碼執行在可編程電腦上的情況下，計算裝置可能包括處理器、處理器可讀的儲存媒體(包括揮發性和非揮發性記憶體及/或儲存元件)、至少一輸入裝置、以及至少一輸出裝置。揮發性和非揮發性記憶體及/或儲存元件可能是隨機存取記憶體(RAM)、可抹除可編程唯讀記憶體(EPROM)、快閃機、光碟機、磁硬碟機、固態硬碟、或用於儲存電子資料的其他媒體。節點和無線裝置可能也包括收發器模組(即，收發器)、計數器模組(即，計數器)、處理模組(即，處理器)、及/或時脈模組(即，時脈器)或計時器模組(即，計時器)。可能實作或利用本文所述之各種技術的一或更多程式可能使用應用程式編程介面(API)、可重覆使用的控制、等等。這類程式可能以高階程序或物件導向編程語言來實作以與電腦系統通訊。然而，若需要的話，程式可能以組合或機器語言來實作。在任何情況下，語言可能是編譯或轉譯語言，且結合硬體實作。
如本文所使用，處理器之詞能包括通用處理器、如VLSI、FPGA的專用處理器、或任何類型的專用處 理器，以及使用在收發器中以發送、接收、及處理無線通訊的基頻處理器。
應了解本說明書中所述之許多功能單元已被標記為模組以更特別強調其實作獨立性。例如，模組可能被實作成包含客製超大型積體(VLSI)電路或閘陣列、如邏輯晶片、電晶體、或其他離散元件之現成半導體的硬體電路。模組可能也在如現場可編程閘陣列、可編程陣列邏輯、可編程邏輯裝置或之類的可編程硬體裝置中實作。
模組可能也在軟體中實作以藉由各種類型的處理器來執行。可執行碼的識別模組可能例如包含電腦指令的一或更多實體或邏輯方塊，其可能例如被組織成物件、程序、或函數。然而，識別模組的可執行碼不必在實體上置放在一起，而是可能包含儲存於不同位置中的不同指令，當其邏輯上結合在一起時，包含模組且為模組實現所述之目的。
實際上，可執行碼的模組可能是單一指令，或許多指令，且甚至可能分佈於數個不同的碼段上、在不同程式之間、及跨數個記憶體裝置。同樣地，操作資料在本文中可能被識別和繪示於模組內，且可能實作成任何適當的形式且被組織於任何適當類型的資料結構內。操作資料可能被收集為單一資料集，或可能分佈於不同位置上(包括不同儲存裝置上)，且可能至少部分僅存在為系統或網路上的電子信號。模組可能是被動或主動的，包括可操作以進行期望功能的代理器。
遍及本說明書提到的「實例」或「示範」意味著結合實例所述之特定特徵、結構、或特性係包括在本技術的至少一實施例中。於是，遍及本說明書之各個地方中所出現之「在實例中」或「示範」的說法不一定都指相同的實施例。
如本文所使用，為了方便起見，可能在共同列表中呈現複數個項目、結構元件、組成元件、及/或材料。然而，這些列表應被解釋為好像列表的每個構件被個別識別為單獨和特有構件。因此，上述列表的個別構件都不應在沒有相反的指示下完全基於其共同群組中的呈現被解釋為相同列表之任何其他構件的實際上等效物。另外，本技術的各種實施例和實例在本文中可能係指連同對其各種元件的替代方案。了解到上述實施例、實例、及替代方案不被解釋為彼此的實際上等效物，而是被解釋為本技術單獨和獨立的代表。
再者，在一或更多實施例中，所述之特徵、結構、或特性可能以任何適當方式來結合。在下面的說明中，提出許多具體細節(如佈局、距離、網路實例等之實例)以提供技術之實施例的全面性了解。然而，本相關領域之熟知技藝者將了解無需一或更多具體細節、或以其他方法、元件、佈局等便能實行所主張的主題。在其他情況下，未詳細顯示或說明熟知的結構、材料、或操作以免模糊技術的態樣。
儘管前述實例係說明在一或更多特定應用中 之本技術之原理，但本領域之那些通常技藝者將清楚明白在沒有行使發明性技能下，且在不脫離技術之原理和概念下能在實作之形式、用法和細節方面進行許多修改。因此，不打算技術被限制，除了被下面所提出之申請專利範圍限制以外。
100‧‧‧胞元
104‧‧‧eNB
108‧‧‧使用者設備
110‧‧‧使用者設備

Claims (31)

  1. 一種使用者設備(UE)的裝置，該UE配置以減少用於基於競爭之排程請求(SR)的延遲，該裝置包含一或多個處理器和記憶體，配置以：選擇用於一實體隨機存取通道(PRACH)傳輸的一PRACH前置索引；與一SR訊息一起多工該PRACH前置索引，該SR訊息含有用於該PRACH傳輸的一胞元無線電網路暫時識別符(C-RNTI)和一緩衝器狀態報告(BSR)；及處理與該PRACH傳輸之子幀#(n)中的該SR訊息多工的該PRACH前置索引用於傳輸至一增強節點B(eNB)，其中n為一子幀編號。
  2. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以處理與在子幀#(n+k)中之用於該PRACH傳輸之該SR訊息多工的該PRACH前置索引用於傳輸至該eNB，其中k為一正整數，其中k為藉由一主資訊區塊(MIB)、系統資訊區塊(SIB)、或UE特定專用RRC發信的信號期間。
  3. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以處理在該PRACH傳輸之一保留PRACH資源中的該SR訊息用於傳輸至該eNB。
  4. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以在與一時分中之該PRACH傳輸相同的一資源區塊(RB)映射該PRACH前置索引和該 SR訊息。
  5. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以在一時域分中將該SR訊息映射至該PRACH傳輸的一保留PRACH資源。
  6. 如申請專利範圍第5項所述之裝置，其中該SR訊息根據具有一SR訊息酬載在一PRACH基頻序列(SEQ)之後沒有偏移的一第一類型、在一空PRACH資源的中間部分具有一SR訊息酬載的一第二類型、及在該SEQ的尾端具有一SR訊息酬載的一第三類型被映射至該PRACH的該保留PRACH資源。
  7. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以在該SR訊息中包括一媒體存取控制(MAC)標頭、一SR、一短BSR結構格式、一長BSR結構格式、及該C-RNTI。
  8. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以根據一單載波頻分多重存取(SC-FDMA)操作或一正交頻分多重存取(OFDMA)操作來產生該PRACH前置索引和該SR訊息。
  9. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以：處理包含從該eNB接收的該C-RNTI之一隨機存取回應(RAR)以解決該基於競爭的SR；及使用該RAR以明確得到一SR解碼狀態，其中當該UE在該RAR中偵測該C-RNTI時判定該SR訊息被該 eNB成功地解碼。
  10. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以在時分多工或頻分多工中與一SR訊息一起多工該PRACH前置索引。
  11. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以處理在該子幀#(n)中的該PRACH前置和在該子幀#(n)之後續子幀中的該SR訊息用於傳輸至該eNB。
  12. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以包括一序列ID在該SR訊息中用於該PRACH傳輸。
  13. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以根據一短BSR結構格式或一長BSR結構格式來配置該SR訊息。
  14. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以鏈結該SR訊息和該PRACH前置索引。
  15. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以若該UE不在一SR時間窗內被排程則處理在下一個PRACH傳輸子幀的該SR訊息用於重新傳輸至該eNB。
  16. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以處理在該PRACH前置索引中的該BSR用於暗中傳送至該eNB。
  17. 如申請專利範圍第1項所述之裝置，其中該一或多個處理器和記憶體更配置以根據一緩衝器尺寸索引(BSI)或一攪亂序列來產生該PRACH前置索引。
  18. 如申請專利範圍第1項所述之裝置，其中該裝置包括天線、觸敏式顯示螢幕、揚聲器、麥克風、圖形處理器、應用處理器、內部記憶體、非揮發性記憶體埠、及其組合之至少一者。
  19. 一種eNodeB的裝置，可操作以藉由一使用者設備(UE)減少用於基於競爭之排程請求(SR)的延遲，該裝置包含一或多個處理器和記憶體，配置以：處理從該UE接收的一實體隨機存取通道(PRACH)傳輸，具有與一排程請求(SR)訊息多工的一選定PRACH前置索引，該SR訊息含有在該PRACH傳輸之子幀#(n)中的一胞元無線電網路暫時識別符(C-RNTI)和一緩衝器狀態報告(BSR)，其中n係一子幀編號，其中該eNodeB可操作以排程一SR時間窗；及處理包含該C-RNTI的一隨機存取回應(RAR)用於傳輸至該UE以解決該基於競爭的SR。
  20. 如申請專利範圍第19項所述之裝置，更配置以處理與該SR訊息多工之從該UE接收的該PRACH前置索引用於在子幀#(n+k)中的該PRACH傳輸，其中k為一正整數，其中k為藉由一主資訊區塊(MIB)、系統資訊區塊(SIB)、或UE特定專用RRC發信的信號期間。
  21. 如申請專利範圍第19項所述之裝置，更配置以處 理在該PRACH傳輸的一保留PRACH資源中之從該UE接收的該SR訊息。
  22. 如申請專利範圍第19項所述之裝置，更配置以使用具有用於與該SR訊息多工之該PRACH前置索引的一訊息偏移指示器的一較高層信號來指示該PRACH傳輸的一PRACH資源之位置用於該PRACH傳輸。
  23. 如申請專利範圍第19項所述之裝置，更配置以配置在單一幀內之不連續子幀中的該PRACH傳輸用於允許該UE傳送在該子幀#(n)中的該PRACH前置索引和在該子幀#(n)之後續子幀中的該SR訊息。
  24. 如申請專利範圍第19項所述之裝置，更配置以配置在單一幀內之連續子幀中的該PRACH傳輸用於允許該UE傳送在該子幀#(n)中的該PRACH前置索引和在該子幀#(n)之後續子幀中的該SR訊息。
  25. 如申請專利範圍第19項所述之裝置，更配置以處理包含該C-RNTI的一隨機存取回應(RAR)以解決該基於競爭的SR用於傳輸至該UE以允許該UE使用該RAR來明確得到一SR解碼狀態。
  26. 如申請專利範圍第19項所述之裝置，更配置以根據該PRACH傳輸來偵測該PRACH前置索引和一頻域通道並解碼該C-RNTI及解碼該BSR。
  27. 如申請專利範圍第19項所述之裝置，更配置以基於PRACH信號偵測前置索引和頻域通道，接著解碼來自資料部分的C-RNTI，最後基於前置索引和解碼的該C- RNTI來解碼該BSR或緩衝器尺寸索引(BSI)。
  28. 如申請專利範圍第19項所述之裝置，更配置以使用在該SR訊息中的一序列ID來識別該PRACH傳輸與該SR訊息之間的鏈結。
  29. 如申請專利範圍第19項所述之裝置，更配置以若該UE不在一SR時間窗內被排程，則在下一個PRACH傳輸子幀處理從該UE接收的該SR訊息之重新傳輸。
  30. 一種使用者設備(UE)的裝置，該UE係配置以減少用於基於競爭之排程請求(SR)的延遲，該裝置包含一或多個處理器和記憶體，配置以：根據用於一實體隨機存取通道(PRACH)傳輸的一胞元無線電網路暫時識別符(C-RNTI)、一胞元識別(ID)、及子幀#(n)來計算一擾亂循環冗餘碼(CRC)序列，其中n為一子幀編號；判定一目前緩衝器尺寸和一緩衝器尺寸索引(BSI)；使用該BSI和該擾亂CRC序列來計算一PRACH前置索引用於產生一排程請求(SR)訊息；及處理具有該SR訊息的一PRACH信號用於傳輸至一enodeB。
  31. 如申請專利範圍第30項所述之裝置，其中該一或多個處理器和記憶體更配置以根據一緩衝器狀態報告(BSR)、一胞元無線電網路暫時識別符(C-RNTI)、一胞元識別(ID)、及子幀#(n)來計算一K PRACH前置 索引用於產生一排程請求(SR)訊息，其中K為一正整數。
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