SU1591018A1 - Asynchronous triple-input priority device - Google Patents
Asynchronous triple-input priority device Download PDFInfo
- Publication number
- SU1591018A1 SU1591018A1 SU884643652A SU4643652A SU1591018A1 SU 1591018 A1 SU1591018 A1 SU 1591018A1 SU 884643652 A SU884643652 A SU 884643652A SU 4643652 A SU4643652 A SU 4643652A SU 1591018 A1 SU1591018 A1 SU 1591018A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- trigger
- output
- inputs
- triggers
- Prior art date
Links
Landscapes
- Bus Control (AREA)
Description
Изобретение относится к вычисли- ι тельной технике и.дискретной автоматике и может быть использовано в си-, стемах управления и передачи инфор- „ $ мации для обслуживания запросов в порядке их поступления.The invention relates to computer technology and discrete automation and can be used in systems, control and transmission of information for servicing requests in the order they are received.
Цель изобретения - повышение надежности устройства за счет исключения сбойных ситуаций при одновремен- ад ном приходе трех запросов.The purpose of the invention is to increase the reliability of the device by eliminating malfunctioning situations with the simultaneous arrival of three requests.
На чертеже представлена схема устройства, >The drawing shows a diagram of the device,>
Асинхронное трехвходовое устройство приоритета содержит КБ-тригге- 15 ры 1-3, выходные элементы ИЛИ-НЕ 4-6; элементы ИЛИ 7 и 8, входы.9-11. запросов и выходы 12г14 устройства.The asynchronous three-input priority device contains KB triggers 15– 1-3, output elements OR NOT 4–6; elements OR 7 and 8, inputs. 9-11. Queries and outputs 12g14 device.
Устройство работает, следующим образом. 20The device operates as follows. 20
Заявки (XI, Х2, ХЗ) поступают на входы 9-11 в случайные моменты времени. Факт прихода заявки отождествляется с появлением сигнала 1 на соответствующем входе. 25Applications (XI, X2, HZ) are received at inputs 9-11 at random times. The fact of the arrival of the application is identified with the appearance of signal 1 at the corresponding input. 25
Работу устройства подразделяют на фазу постановки заявки.в очередь.на обслуживание и фазу сдвига (фазу продвижения очереди)ГThe operation of the device is divided into the phase of the application. In turn. For maintenance and the phase of the shift (phase of the progress of the queue)
Рассмотрим случай одновременного 30 поступления заявок на обслуживание (в начальный момент очередь'свободна) .Consider the case of simultaneous 30 receipt of service requests (at the initial moment, the queue is free).
фаза постановки заявок в очередь. Одновременное поступление заявок вызывает состязания устойчивых внутренних состояний триггеров 1-3, в результате чего последние в первый момент времени могут установиться в произвольные состояния (0,1) или до (1,0), что в совокупности может привести к неопознаваемым дешифратором (элементы 4-6) кодам: (0,1) (1,0) (0,1) или.(1,0) (0,1) (1,0). Однако эти состояния триггеров не могут яв- 45 пяться устойчивыми внутренними состояниями. Действительно, пусть в триггеры запишется код (0,1) (1,0) (0,1)’. При этом на входах элемента ИЛИ 8 устанавливаются сигналы логиче- ад ского О, который через время задержки этого элемента поступает на , дополнительный К вход триггера 2. В результате этого последний переключается из состояния (1 ,0) в (0,1), неопознаваемый код (0,1) (1,0) (0,1) сменяется на приоритетный (0,1) (0,1) (0,1), которому соответствует состояние очереди XI, Х2, ХЗ, а на выходах элементов 4 и 8 устанавливаются сигналы 1. На этом процессы переключения триггеров завершаются.queuing phase of applications. Simultaneous receipt of applications causes the stable internal states of triggers 1-3 to compete, as a result of which the latter at the first moment of time can be set to arbitrary states (0,1) or to (1,0), which together can lead to an unrecognizable decoder (elements 4 -6) codes: (0,1) (1,0) (0,1) or. (1,0) (0,1) (1,0). However, these trigger states cannot be stable internal states. Indeed, let the code (0,1) (1,0) (0,1) ’be written in the triggers. In this case, at the inputs of the element OR 8, signals of logical O are set, which after a delay time of this element is supplied to the additional K input of trigger 2. As a result, the latter switches from state (1, 0) to (0,1), unrecognized code (0,1) (1,0) (0,1) is replaced by priority (0,1) (0,1) (0,1), which corresponds to the state of the queue XI, X2, ХЗ, and at the outputs of elements 4 and 8, signals 1 are set. At this, the trigger switching processes are completed.
Аналогично неопознаваемый код (1,0) (0,1) (1,0) переходит в приоритетный (1,0) (1,0) (1,0).Similarly, the unrecognized code (1,0) (0,1) (1,0) goes into priority (1,0) (1,0) (1,0).
Полный список приоритетных кодов устройства, соответствующих устойчивым внутренним состояниям триггеров, при различных комбинациях сигналов на входных шинах приведен в таблице.A complete list of device priority codes corresponding to the stable internal states of the triggers for various combinations of signals on the input buses is given in the table.
Неоднозначность соответствия таблицы. Состояние входов устрой- стваприоритетный код описывает ситуации одновременного поступления двух и более заявок на обслуживание., при которых предпочтение может быть отдано любой из них, что, очевидно, не нарушает выполняемой устройством функции:The ambiguity of the table match. The status of the device inputs, the priority code describes situations of simultaneous receipt of two or more service requests. In which any of them can be preferred, which, obviously, does not violate the functions performed by the device:
Фаза сдвига. Эта фаза начинается по окончании обслуживания заявки , стоящей в очереди на первом месте.Phase shift. This phase begins at the end of the service application, standing in line in the first place.
При этом обслуженная заявка снимается, что выражается в смене 1 на 0 на соответствующем входе.In this case, the served application is withdrawn, which is expressed in a change of 1 to 0 at the corresponding input.
Пусть при состоянии очереди Х1,Let the state of the queue X1,
Х2, ХЗ (см. таблицу) обслужена и снята заявка Х1. В результате этого первый й второй триггеры переключаются из состояния (0,1) в состояние (1,0) и в устройстве устанавливается приоритетный код (1,0) (1,0) (0,1).X2, HZ (see table) served and withdrawn application X1. As a result of this, the first and second triggers switch from state (0.1) to state (1.0) and the priority code (1.0) (1.0) (0.1) is set in the device.
Таким образом, заявка Х2 перемещается на первое, а ХЗ на второе место очереди,Thus, the application X2 moves to the first, and HZ to the second place in the queue,
Далее по обслуживанию заявки Х2 третий триггер переключается из состояния (0,1) в (1,0), а на прямом и инверсном выходах первого триггера устанавливаются сигналы 1. Полученный приоритетный код (1,1) (1,0) (1,0) соответствует очереди ХЗ, в которой второе и третье место свободны.Further on servicing the application X2, the third trigger switches from state (0,1) to (1,0), and the signals 1 are set at the direct and inverse outputs of the first trigger. Received priority code (1,1) (1,0) (1, 0) corresponds to the queue HZ, in which the second and third places are free.
Наконец, после снятия последней заявки ХЗ, в триггерах устанавливается приоритетный код (1,1) (1,1) (1,1), соответствующий свободной очереди.Finally, after the last HZ application has been withdrawn, the priority code (1,1) (1,1) (1,1) corresponding to the free queue is set in the triggers.
При ординарном потоке заявок на обслуживании в худшем случае состояния К- и 5-входов триггеров изменяются с (1,0) на (0,1) или наоборот.Это возможно при поступлении ί-й и одновременном снятии з~й заявок; 1,3 = = ' 1,3; $ ί ιΗ.In the case of an ordinary flow of service requests, in the worst case, the state of the K- and 5-inputs of the triggers change from (1,0) to (0,1) or vice versa. This is possible when the ί-th and simultaneous withdrawal of the ~-th requests are received; 1.3 = = '1.3; $ ί ιΗ.
Остальные ситуации описываются соседними изменениями состояний названных входов..Но эти соседние из5 1591018 менения не приводят к критическим состязаниям устойчивых состояний элементов триггеров, а следовательно, и к нарушению функции, выполняемой устройством.Other situations are described by neighboring state changes of the named inputs .. But these neighboring changes out of 5 1591018 do not lead to critical competitions of stable states of trigger elements, and, consequently, to a violation of the function performed by the device.
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU884643652A SU1591018A1 (en) | 1988-12-22 | 1988-12-22 | Asynchronous triple-input priority device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU884643652A SU1591018A1 (en) | 1988-12-22 | 1988-12-22 | Asynchronous triple-input priority device |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1591018A1 true SU1591018A1 (en) | 1990-09-07 |
Family
ID=21425647
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU884643652A SU1591018A1 (en) | 1988-12-22 | 1988-12-22 | Asynchronous triple-input priority device |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1591018A1 (en) |
-
1988
- 1988-12-22 SU SU884643652A patent/SU1591018A1/en active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4138732A (en) | Data transfer control system | |
US5155810A (en) | Dual FIFO peripheral with combinatorial logic circuitry | |
US4554628A (en) | System in which multiple devices have a circuit that bids with a fixed priority, stores all losing bids if its bid wins, and doesn't bid again until all stored bids win | |
US4016539A (en) | Asynchronous arbiter | |
JPH0554138B2 (en) | ||
US4533994A (en) | Priority circuit for a multiplexer terminal | |
US4604685A (en) | Two stage selection based on time of arrival and predetermined priority in a bus priority resolver | |
SU1591018A1 (en) | Asynchronous triple-input priority device | |
US5550780A (en) | Two cycle asynchronous FIFO queue | |
US3343136A (en) | Data processing timing apparatus | |
US4387446A (en) | Stack control system | |
SU1608663A1 (en) | Device for managing access to resources | |
EP0087266B1 (en) | Priority resolver circuit | |
KR940006299Y1 (en) | Access controller of dual memory | |
RU2032935C1 (en) | Signal arbitrator | |
SU1182660A1 (en) | Pulse switch with control signal storing | |
RU1783537C (en) | Device for connection of sources of information to common trunk line | |
SU1098001A1 (en) | Interruption controller | |
SU1589276A1 (en) | Two-input priority device | |
SU1298732A1 (en) | Information input device | |
SU583420A1 (en) | Pneumatic mechanical computing device | |
SU1282125A1 (en) | Priority interruption device | |
SU987613A1 (en) | Information input device | |
SU1327085A2 (en) | Information input device | |
EP0012016A1 (en) | Memory access control |